(57)【要約】【課題】  必要なアドレス空間を節約することができるようにＳＦＲを構成した半導体集積回路を提供すること。【解決手段】  機能コードレジスタ１１は、複数のタイマ１０−０〜１０−ｎのいずれかを指定する値を格納する。カウントレジスタ１２、１３およびモードレジスタ１４に値が書込まれると、機能コードレジスタ１１によって指定されたタイマにそれらの値が設定される。したがって、タイマが複数ある場合でも、カウントレジスタ１２および１３と、モードレジスタ１４とをそれぞれ１つにすることができ、レジスタを割当てるのに必要なアドレス空間を節約することが可能となる。【選択図】        図３
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【特許請求の範囲】
【請求項１】
複数の機能ブロックと、
前記複数の機能ブロックのいずれかを指定する値が格納される第１のレジスタと、
前記第１のレジスタによって指定された機能ブロックに設定する値が格納される第２のレジスタとを含む半導体集積回路。
【請求項２】
前記第２のレジスタは、前記第１のレジスタによって指定された機能ブロックから読出された値を格納する、請求項１記載の半導体集積回路。
【請求項３】
前記第１のレジスタは、不揮発性メモリによって構成される、請求項１または２記載の半導体集積回路。
【発明の詳細な説明】
【技術分野】
【０００１】
本発明は、機能ブロックを設定するのに用いられるＳＦＲ（Special Function Register）を備えた半導体集積回路に関し、特に、必要なアドレス空間を節約することができるようにＳＦＲを構成した半導体集積回路に関する。
【背景技術】
【０００２】
従来、回路動作の設定や動作結果を保持するためのレジスタが半導体集積回路に設けられることが多い。通常、このレジスタ群は、特定機能に応じて対をなすＳＦＲによって構成されることが多く、このＳＦＲに対するリード／ライトの際、ＳＦＲ固有のアドレスによってアクセスするＳＦＲを指定することが必要である。これに関連する技術として、特開平８−１９０５１７号公報および特開２００１−３２５２４４号公報に開示された発明がある。
【０００３】
特開平８−１９０５１７号公報に開示された多重タイマは、複数のタイマのそれぞれのカウント値とカウント値が書込まれているかどうかを示す設定表示情報とを保持するタイマメモリと、タイマメモリに保持された値を得て複数のタイマのカウント処理を時分割多重で行なうカウンタと、カウント処理時にタイムアウトを検出する手段と、複数のタイマの制御情報が書込まれるタイマコントロールレジスタと、タイマメモリ、カウンタ、タイムアウトを検出する手段、およびタイマコントロールレジスタの動作をそれぞれ制御する制御手段とを有し、タイマコントロールレジスタに書込まれた制御情報にしたがってカウント値と設定表示情報とを順次タイマメモリに書込み、カウント値と設定表示情報とを読出してカウンタに順次送る構成としたものである。
【０００４】
特開２００１−３２５２４４号公報に開示された半導体装置は、タイマ値設定レジスタに格納されているタイマ値に基づきカウント動作を行なうタイマ回路と、タイマ情報テーブルからタイマ値を読出してタイマ値設定レジスタに設定するタイマ値設定制御を行なうタイマ制御回路とを含む。タイマ回路は、タイマ情報テーブルのクロック情報に基づきクロックソースを選択しカウント動作を行なう。また、第１のタイマ情報テーブルからのタイマ値設定制御を終了した場合には、第１のタイマ情報テーブルの次テーブルポインタ情報で指定された第２のタイマ情報テーブルからのタイマ値設定制御を行なうものである。
【特許文献１】特開平８−１９０５１７号公報
【特許文献２】特開２００１−３２５２４４号公報
【発明の開示】
【発明が解決しようとする課題】
【０００５】
近年、半導体集積回路の多機能化、高集積化によって、半導体集積回路内に設けられるＳＦＲの数も増大する傾向にある。それに伴って、ＳＦＲに割当てるアドレスも増加するため、メモリ空間にＳＦＲを割当てている場合には、メモリに割当てるメモリ空間が減少するといった問題点があった。
【０００６】
また、上述した特開平８−１９０５１７号公報および特開２００１−３２５２４４号公報に開示された発明を用いても、この問題を解決することはできない。
【０００７】
本発明は、上記問題点を解決するためになされたものであり、その目的は、必要なアドレス空間を節約することができるようにＳＦＲを構成した半導体集積回路を提供することである。
【課題を解決するための手段】
【０００８】
本発明のある局面に従えば、半導体集積回路は、複数の機能ブロックと、複数の機能ブロックのいずれかを指定する値が格納される第１のレジスタと、第１のレジスタによって指定された機能ブロックに設定する値が格納される第２のレジスタとを含む。
【発明の効果】
【０００９】
第２のレジスタに格納された値が、第１のレジスタによって指定された機能ブロックに設定されるので、機能ブロックが複数ある場合でも、第２のレジスタを１つにすることができ、レジスタを割当てるのに必要なアドレス空間を節約することが可能となった。
【発明を実施するための最良の形態】
【００１０】
図１は、半導体集積回路の一例である、従来のタイマ回路に設けられたＳＦＲを説明するための図である。図１においては、Ｎ＋１個のタイマ０〜Ｎ（１０１−０〜１０１−ｎ）のそれぞれが、カウントレジスタ１１１および１１２と、モードレジスタ１１３とを含んでいる。カウントレジスタ１１１および１１２は、タイマに設定されるカウント値を格納するためのレジスタである。また、モードレジスタ１１３は、タイマの動作を設定するためのレジスタである。
【００１１】
図１に示すように、タイマ０〜Ｎ（１０１−０〜１０１−ｎ）のそれぞれに、３つのレジスタが必要となるため、合計で（Ｎ＋１）×３個のレジスタが必要となり、アドレス空間にそれに相当する数のレジスタを割当てなければならない。
【００１２】
図２は、本発明の実施の形態における半導体集積回路に設けられたＳＦＲを説明するための図である。このタイマ１は、機能コードレジスタ１１と、カウントレジスタ１２および１３と、モードレジスタ１４とを含む。機能コードレジスタ１１は、タイマ０〜Ｎのチャネル番号を格納するレジスタである。カウントレジスタ１２および１３と、モードレジスタ１４とは、機能コードレジスタ１１によって指定されたチャネル番号のタイマを制御するためのレジスタである。図２に示すように、４個のレジスタによって、（Ｎ＋１）個のタイマを制御するようにしている。
【００１３】
図３は、本発明の実施の形態における半導体集積回路の回路構成の一例を示すブロック図である。この半導体集積回路は、（Ｎ＋１）チャネルのタイマ（１０−０〜１０−ｎ）と、機能コードレジスタ１１と、カウントレジスタ１２および１３と、モードレジスタ１４と、デコーダ１５とを含む。
【００１４】
デコーダ１５は、機能コードレジスタ１１に設定されたチャネル番号をデコードし、タイマ０〜Ｎ（１０−０〜１０−ｎ）のいずれかを選択する。たとえば、機能コードレジスタ１１にチャネル番号“０”が格納されている場合、カウントレジスタ１２および１３にカウント値が書込まれると、タイマ０（１０−０）にそのカウント値が設定され、モードレジスタ１４に動作モードが書込まれると、タイマ０（１０−０）にそのモードが設定される。
【００１５】
また、機能コードレジスタ１１にチャネル番号“０”が格納されている場合、カウントレジスタ１２および１３からタイマ値を読出すと、タイマ０（１０−０）のタイマ値がカウントレジスタ１２および１３に転送され、その値が読出される。
【００１６】
以上説明したように、本実施の形態における半導体集積回路によれば、機能コードレジスタ１１に格納されたチャネル番号によってタイマを選択し、選択されたタイマとＳＦＲとの間で値の読出し／書込みを行なうようにしたので、レジスタをアクセスするために必要となるアドレス空間を節約することが可能となった。
【００１７】
なお、本実施の形態においては、複数チャネルのタイマについて説明したが、タイマ以外の回路、たとえば、ＤＭＡ（Direct Memory Access）コントローラなどのＳＦＲに適用できることは言うまでもない。
【００１８】
また、機能コードレジスタ１１に格納された値によって同じ機能を有する回路の１つを選択してレジスタの値の読出し／書込みを行なうようにしたが、異なる機能を有する回路も選択できるようにし、その回路との間でレジスタの値の読出し／書込みを行なうようにしてもよい。
【００１９】
さらには、機能コードレジスタ１１を不揮発性メモリによって構成することにより、予め使用できる機能を制限するようにしてもよい。
【００２０】
今回開示された実施の形態は、すべての点で例示であって制限的なものではないと考えられるべきである。本発明の範囲は上記した説明ではなくて特許請求の範囲によって示され、特許請求の範囲と均等の意味および範囲内でのすべての変更が含まれることが意図される。
【図面の簡単な説明】
【００２１】
【図１】半導体集積回路の一例である、従来のタイマ回路に設けられたＳＦＲを説明するための図である。
【図２】本発明の実施の形態における半導体集積回路に設けられたＳＦＲを説明するための図である。
【図３】本発明の実施の形態における半導体集積回路の回路構成の一例を示すブロック図である。
【符号の説明】
【００２２】
１，１０−０〜１０−ｎ，１０１−０〜１０１−ｎ  タイマ、１１  機能コードレジスタ、１２，１３，１１１，１１２  カウントレジスタ、１４，１１３  モードレジスタ、１５  デコーダ。
【図１】
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【図２】
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【図３】
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