(57)【要約】  複数の画素を含む表示装置の増幅回路は、入力部、バイアス部、そして出力部を含む。入力部は、第１電圧を供給する第１電源および第２電圧を供給する第２電源の間に連結され、第１入力信号および第２入力信号を受信して、第１および第２入力信号によって制御される。バイアス部は、入力部を動作させるためのバイアス電圧が印加されて、入力部によって制御される第１ノードおよび第２ノードを含む。そして、出力部は、第１ノードに印加される信号によってオン／オフされる第１出力トランジスタおよび第１出力トランジスタと異なるタイプであって第２ノードに印加される信号によってオン／オフされる第２出力トランジスタを使用して出力電圧を画素に印加する。この時、入力部は、第１電源に第１端が連結されて、第１入力信号によってオン／オフされる第１入力トランジスタ、および第１入力トランジスタと同一なタイプであり、第１電源に第１端が連結されて、第２入力信号によってオン／オフされる第２入力トランジスタを含む。そして、バイアス部は、第１入力トランジスタのオン／オフによって制御される第１トランジスタおよび第２入力トランジスタのオン／オフによって制御される第２トランジスタを含む。
2010532618.tif 000002
【特許請求の範囲】
【請求項１】
複数の画素を含む液晶表示装置の増幅回路において、
第１電圧を供給する第１電源および第２電圧を供給する第２電源の間に連結されて、第１入力信号および第２入力信号を受信し、前記第１および第２入力信号によって制御される入力部と、
前記入力部を動作させるためのバイアス電圧が印加されて、前記入力部によって制御される第１ノードおよび第２ノードを含むバイアス部と、
前記第１ノードに印加される信号によってオン／オフされる第１出力トランジスタおよび前記第１出力トランジスタと異なるタイプであって前記第２ノードに印加される信号によってオン／オフされる第２出力トランジスタを使用して出力電圧を前記画素に印加する出力部とを含み、
前記入力部は、
前記第１電源に第１端が連結されて、前記第１入力信号によってオン／オフされる第１入力トランジスタと、
前記第１入力トランジスタと同一なタイプであり、前記第１電源に第１端が連結されて、前記第２入力信号によってオン／オフされる第２入力トランジスタとを含み、
前記バイアス部は、
前記第１入力トランジスタのオン／オフによって制御される第１トランジスタと、
前記第２入力トランジスタのオン／オフによって制御される第２トランジスタとを含むことを特徴とする、増幅回路。
【請求項２】
前記第１および第２入力トランジスタは単一のトランジスタからなることを特徴とする、請求項１に記載の増幅回路。
【請求項３】
前記互いに異なるタイプの第１および第２出力トランジスタを使用して、前記出力電圧が前記画素に充電される時間と前記画素に充電された前記出力電圧が放電される時間とを対称的に制御することを特徴とする、請求項１に記載の増幅回路。
【請求項４】
前記第１電源は、第１電圧である電源電圧を供給し、前記第２電源は、第２電圧である接地電圧を供給し、前記出力電圧は共通電圧より所定のレベルだけ高い第１出力電圧であることを特徴とする、請求項１に記載の増幅回路。
【請求項５】
前記第１入力信号の電圧レベルが前記第２入力信号の電圧レベルより高い場合には、
前記第１ノードに印加される信号の電圧レベルが減少して前記第１出力トランジスタがターンオンされ、前記ターンオンされた第１出力トランジスタを通じて前記画素に前記第１出力電圧が充電されることを特徴とする、請求項４に記載の増幅回路。
【請求項６】
前記第１入力信号の電圧レベルが前記第２入力信号の電圧レベルより低い場合には、
前記第２ノードに印加される信号の電圧レベルが増加して前記第２出力トランジスタがターンオンされ、前記ターンオンされた第２出力トランジスタを通じて前記画素に充電された前記第１出力電圧が放電されることを特徴とする、請求項５に記載の増幅回路。
【請求項７】
前記第１電源は、前記第１電圧である接地電圧を供給し、前記第２電源は、第２電圧である電源電圧を供給し、前記出力電圧は共通電圧より所定のレベルだけ低い第２出力電圧であることを特徴とする、請求項１に記載の増幅回路。
【請求項８】
前記第１入力信号の電圧レベルが前記第２入力信号の電圧レベルより低い場合には、
前記第１ノードに印加される信号の電圧レベルが増加して前記第１出力トランジスタがターンオンされ、前記ターンオンされた第１出力トランジスタを通じて前記画素に充電された前記第２出力電圧が放電されることを特徴とする、請求項７に記載の増幅回路。
【請求項９】
前記第１入力信号の電圧レベルが前記第２入力信号の電圧レベルより高い場合には、
前記第２ノードに印加される信号の電圧レベルが減少して前記第２出力トランジスタがターンオンされ、前記ターンオンされた第２出力トランジスタを通じて前記画素に前記第２出力電圧が充電されることを特徴とする、請求項８に記載の増幅回路。
【請求項１０】
前記バイアス部は、
前記第１トランジスタの第１端に第１端が連結されて、バイアス電圧によってオン／オフされる第３および第４トランジスタと、
前記第２トランジスタの第１端に第１端が連結されて、前記バイアス電圧によってオン／オフされる第５および第６トランジスタと、
前記第３および第４トランジスタの第２端に第１端が連結されて、前記第２電源に第２端が連結される第７トランジスタと、
前記第７トランジスタのゲート電極にゲート電極が連結されて、前記第５および第６トランジスタの第２端に第１端が連結される第８トランジスタとを含むことを特徴とする、請求項１ないし請求項９のいずれか１項に記載の増幅回路。
【請求項１１】
前記第１出力トランジスタのゲート電極は、前記第２トランジスタの第１端および前記第５および第６トランジスタの第１端の間に位置する前記第１ノードに連結され、
前記第２出力トランジスタのゲート電極は、前記第５および第６トランジスタの第２端および前記第８トランジスタの第１端の間に位置する前記第２ノードに連結されることを特徴とする、請求項１ないし請求項９のいずれか１項に記載の増幅回路。
【請求項１２】
複数の走査信号が印加される複数の走査ラインおよび複数のデータ信号が印加される複数のデータラインによって定義される複数の画素と、
第１入力信号によってオン／オフされる第１入力トランジスタおよび前記第１入力トランジスタと同一なタイプであって第２入力信号によってオン／オフされる第２入力トランジスタを使用して、前記画素に第１出力電圧が充電される時間と前記画素に充電された第１出力電圧が放電される時間とを対称的に制御するポジティブ増幅回路と、
第３入力信号によってオン／オフされる第３入力トランジスタおよび前記第３入力トランジスタと同一なタイプであって第４入力信号によってオン／オフされる第４入力トランジスタを使用して、前記画素に前記第２出力電圧が充電される時間と前記画素に充電された第２出力電圧が放電される時間とを対称的に制御するネガティブ増幅回路とを含むことを特徴とする、表示装置の駆動装置。
【請求項１３】
前記第１ないし第４入力トランジスタは単一のトランジスタからなることを特徴とする、請求項１２に記載の表示装置の駆動装置。
【請求項１４】
前記第１入力信号の電圧レベルが前記第２入力信号の電圧レベルより高い場合には、
前記第１ノードに印加される信号の電圧レベルが減少して前記第１出力トランジスタがターンオンされ、前記ターンオンされた第１出力トランジスタを通じて前記画素に前記第１出力電圧が充電されることを特徴とする、請求項１２に記載の表示装置の駆動装置。
【請求項１５】
前記第１入力信号の電圧レベルが前記第２入力信号の電圧レベルより低い場合には、
前記第２ノードに印加される信号の電圧レベルが増加して前記第２出力トランジスタがターンオンされ、前記ターンオンされた第２出力トランジスタを通じて前記画素に充電された前記第１出力電圧が放電されることを特徴とする、請求項１４に記載の表示装置の駆動装置。
【請求項１６】
前記第３入力信号の電圧レベルが前記第４入力信号の電圧レベルより低い場合には、
前記第３ノードに印加される信号の電圧レベルが増加して前記第３出力トランジスタがターンオンされ、前記ターンオンされた第３出力トランジスタを通じて前記画素に充電された前記第２出力電圧が放電されることを特徴とする、請求項１２に記載の表示装置の駆動装置。
【請求項１７】
前記第３入力信号の電圧レベルが前記第４入力信号の電圧レベルより高い場合には、
前記第４ノードに印加される信号の電圧レベルが減少して前記第４出力トランジスタがターンオンされ、前記ターンオンされた第４出力トランジスタを通じて前記画素に前記第２出力電圧が充電されることを特徴とする、請求項１６に記載の表示装置の駆動装置。
【請求項１８】
前記第１および第２入力トランジスタは前記第３および第４入力トランジスタと互いに異なるタイプであることを特徴とする、請求項１２に記載の表示装置の駆動装置。
【請求項１９】
前記第１出力電圧は共通電圧より所定のレベルだけ高く、前記第２出力電圧は前記共通電圧より所定のレベルだけ低いことを特徴とする、請求項１２に記載の表示装置の駆動装置。
【請求項２０】
前記ポジティブ増幅回路は、
前記第１および第２入力トランジスタを含んで、前記第１および第２入力信号によって制御される入力部と、
前記第１入力トランジスタのオン／オフによって制御される第１トランジスタおよび前記第２入力トランジスタのオン／オフによって制御される第２トランジスタを含んで、前記第１および第２トランジスタのオン／オフによって信号が印加される第１ノードおよび第２ノードを含むバイアス部と、
前記第１ノードに印加される信号によってオン／オフされる第１出力トランジスタおよび前記第１出力トランジスタと互いに異なるタイプであって前記第２ノードに印加される信号によってオン／オフされる第２出力トランジスタを含む出力部とをさらに含むことを特徴とする、請求項１２ないし請求項１９のいずれか１項に記載の表示装置の駆動装置。
【請求項２１】
前記ネガティブ増幅回路は、
前記第３および第４入力トランジスタを含んで、前記第３および第４入力信号によって制御される入力部と、
前記第３入力トランジスタのオン／オフによって制御される第３トランジスタおよび前記第４入力トランジスタのオン／オフによって制御される第４トランジスタを含んで、前記第３および第４トランジスタのオン／オフによって信号が印加される第３ノードおよび第４ノードを含むバイアス部と、
前記第３ノードに印加される信号によってオン／オフされる第３出力トランジスタおよび前記第３出力トランジスタと互いに異なるタイプであって前記第４ノードに印加される信号によってオン／オフされる第４出力トランジスタを含む出力部とをさらに含むことを特徴とする、請求項１２ないし請求項１９のいずれか１項に記載の表示装置の駆動装置。
【請求項２２】
複数の画素を含む液晶表示装置の増幅回路において、
第１入力信号によってオン／オフされる第１入力トランジスタおよび第２入力信号によってオン／オフされる第２入力トランジスタを含んで、前記第１および第２入力信号によって制御される入力部と、
前記入力部を動作させるためのバイアス電圧が印加されて、前記入力部によって制御される第１トランジスタを含むバイアス部と、
前記第１トランジスタのゲート電極に位置する第１ノードの信号によってオン／オフされる第１出力トランジスタおよび前記第１出力トランジスタと同一なタイプであって前記第１トランジスタの第１端に位置する第２ノードの信号によってオン／オフされる第２出力トランジスタを含む出力部とを含むことを特徴とする、増幅回路。
【請求項２３】
前記第１および第２入力トランジスタは単一のトランジスタからなることを特徴とする、請求項２２に記載の増幅回路。
【請求項２４】
前記第１および第２入力トランジスタは同一なタイプであることを特徴とする、請求項２３に記載の増幅回路。
【発明の詳細な説明】
【技術分野】
【０００１】
本発明は、増幅回路およびこれを使用した表示装置の駆動装置に関し、特に、電力消耗が小さく、面積を減少させることができて、従来の回路と同一な特性を有する増幅回路に関する。
【背景技術】
【０００２】
近来、パーソナルコンピュータやテレビなどの軽量化および薄型化によりディスプレイ装置も軽量化および薄型化が要求されており、このような要求に応じて陰極線管（Ｃａｔｈｏｄｅ−Ｒａｙ−Ｔｕｂｅ；ＣＲＴ）の代わりに液晶表示装置（Ｌｉｑｕｉｄ  Ｃｒｙｓｔａｌ  Ｄｉｓｐｌａｙ；ＬＣＤ）などのフラット型ディスプレイが開発されている。
【０００３】
液晶表示装置は、両基板の間に注入されている異方性誘電率を有する液晶物質に電界（ｅｌｅｃｔｒｉｃ  ｆｉｅｌｄ）を印加し、この電界の強さを調節して外部の光源（バックライト）から基板に透過される光の量を調節することによって所望の画像信号を得る表示装置である。
【０００４】
このような液晶表示装置は、携帯が簡便なフラットパネル型ディスプレイの中でも代表的なものであり、この中でも薄膜トランジスタ（Ｔｈｉｎ  Ｆｉｌｍ  Ｔｒａｎｓｉｓｔｏｒ；ＴＦＴ）をスイッチング素子として使用したＴＦＴ−ＬＣＤが主に利用されている。
【０００５】
このような液晶表示装置は、二つの電極に電圧を印加して液晶層に電界を生成し、この電界の強さを調節して液晶層を通過する光の透過率を調節することによって、所望の画像を表示する。液晶表示装置は、液晶層に一方向の電界が長時間印加されることによって発生する劣化現象を防止するために、フレーム別、行別、または画素別に共通電圧Ｖｃｏｍに対するデータ信号の電圧極性を反転させる。
【０００６】
この時、データ信号の電圧は、データ駆動部を通じて液晶層に伝達されるが、このようなデータ駆動部は、データ信号の電圧を増幅する増幅回路を含む。
【０００７】
このような増幅回路は、下記特許文献１に提示されており、提示された従来の増幅回路は、反転入力端が互いに異なるタイプで構成される一対の入力トランジスタと連結され、非反転入力端が互いに異なるタイプで構成される一対の入力トランジスタと連結されるレールツーレール（ｒａｉｌ  ｔｏ  ｒａｉｌ）構造を有する。
【０００８】
以下、従来の増幅回路について図１および図２を参照して説明する。
【０００９】
図１は従来の増幅回路を簡略に示した図面である。
【００１０】
図１に示したように、従来の増幅回路１は、増幅器４０および互いに異なるタイプの出力トランジスタ３１、３２を使用して出力電圧を生成した後、生成した出力電圧を画素（図１では画素を直接的に示さずに画素のキャパシタをＣｐで示している）に伝達する。また、画素に伝達された出力電圧と同一な電圧が再び増幅回路の反転入力端（−）に入力される。この時、増幅回路の非反転入力端（＋）に入力電圧が印加されると、非反転入力端（＋）に印加された入力電圧および反転入力端（−）に入力された直前の出力電圧によって画素キャパシタＣｐの電圧は充電または放電される。
【００１１】
図２は従来の増幅回路を具体的に示した図面である。
【００１２】
図２に示したように、従来の増幅回路１は、入力部１０、バイアス部２０、および出力部３０を含む。図２では、トランジスタ１１、１２、１７、１８、１９_２、２３、２４、３２をＮ−チャンネル電界効果トランジスタ（Ｎ−ｃｈａｎｎｅｌ  ｍｅｔａｌ  ｏｘｉｄｅ  ｓｅｍｉｃｏｎｄｕｃｔｏｒ）で示し、トランジスタ１３、１４、１５、１６、１９_１、２１、２２、３１をＰ−チャンネル電界効果トランジスタ（Ｐ−ｃｈａｎｎｅｌ  ｍｅｔａｌ  ｏｘｉｄｅ  ｓｅｍｉｃｏｎｄｕｃｔｏｒ）で示した。
【００１３】
入力部１０は、トランジスタ１１、１２、１３、１４、１５、１６、１７、１８、１９_１、１９_２を含み、トランジスタ１９_１、１９_２にはバイアス電圧ＢＶ１、ＢＶ６がそれぞれ印加される。この時、増幅回路は、レールツーレール構造を有し、反転入力端（−）はトランジスタ１１、１３のゲート電極に連結され、非反転入力端（＋）はトランジスタ１２、１４のゲート電極に連結される。
バイアス部２０は、バイアス電圧ＢＶ２、ＢＶ３、ＢＶ４、ＢＶ５がそれぞれ印加されるトランジスタ２１、２２、２３、２４を含む。
出力部３０は、トランジスタ３１、３２およびキャパシタ３３、３４を含む。トランジスタ３１のゲート電極はノードＡに連結され、トランジスタ３２のゲート電極はノードＢに連結されて、出力電圧を伝達する。
【００１４】
このように、従来の増幅回路は、レールツーレール構造を採択することによって、増幅回路の面積全体のうちで入力トランジスタが占める面積が大きくなる問題が発生し、互いに異なるタイプの入力トランジスタそれぞれに対する定電流源を使用しなければならないので、消費電力が増加する問題が発生する。
【先行技術文献】
【特許文献】
【００１５】
【特許文献１】韓国登録特許１０−２００５−００３０５７０
【発明の概要】
【発明が解決しようとする課題】
【００１６】
本発明が目的とする技術的課題は、入力トランジスタの個数を減少させることができる増幅回路およびこれを使用した表示装置の駆動装置を提供することにある。
【課題を解決するための手段】
【００１７】
本発明の特徴による複数の画素を含む液晶表示装置の増幅回路は、第１電圧を供給する第１電源および第２電圧を供給する第２電源の間に連結されて、第１入力信号および第２入力信号を受信し、前記第１および第２入力信号によって制御される入力部と、前記入力部を動作させるためのバイアス電圧が印加されて、前記入力部によって制御される第１ノードおよび第２ノードを含むバイアス部と、前記第１ノードに印加される信号によってオン／オフされる第１出力トランジスタおよび前記第１出力トランジスタと異なるタイプであって前記第２ノードに印加される信号によってオン／オフされる第２出力トランジスタを使用して出力電圧を前記画素に印加する出力部とを含み、前記入力部は、前記第１電源に第１端が連結されて、前記第１入力信号によってオン／オフされる第１入力トランジスタと、前記第１入力トランジスタと同一なタイプであり、前記第１電源に第１端が連結されて、前記第２入力信号によってオン／オフされる第２入力トランジスタとを含み、前記バイアス部は、前記第１入力トランジスタのオン／オフによって制御される第１トランジスタと、前記第２入力トランジスタのオン／オフによって制御される第２トランジスタとを含む。
【００１８】
本発明の特徴による表示装置の駆動装置は、複数の走査信号が印加される複数の走査ラインおよび複数のデータ信号が印加される複数のデータラインによって定義される複数の画素と、第１入力信号によってオン／オフされる第１入力トランジスタおよび前記第１入力トランジスタと同一なタイプであって第２入力信号によってオン／オフされる第２入力トランジスタを使用して、前記画素に第１出力電圧が充電される時間と前記画素に充電された第１出力電圧が放電される時間とを対称的に制御するポジティブ増幅回路と、第３入力信号によってオン／オフされる第３入力トランジスタおよび前記第３入力トランジスタと同一なタイプであって第４入力信号によってオン／オフされる第４入力トランジスタを使用して、前記画素に前記第２出力電圧が充電される時間と前記画素に充電された第２出力電圧が放電される時間とを対称的に制御するネガティブ増幅回路とを含む。
【００１９】
本発明の特徴による複数の画素を含む液晶表示装置の増幅回路は、第１入力信号によってオン／オフされる第１入力トランジスタおよび第２入力信号によってオン／オフされる第２入力トランジスタを含んで、前記第１および第２入力信号によって制御される入力部と、前記入力部を動作させるためのバイアス電圧が印加されて、前記入力部によって制御される第１トランジスタを含むバイアス部と、前記第１トランジスタのゲート電極に位置する第１ノードの信号によってオン／オフされる第１出力トランジスタおよび前記第１出力トランジスタと同一なタイプであって前記第１トランジスタの第１端に位置する第２ノードの信号によってオン／オフされる第２出力トランジスタを含む出力部とを含む。
【図面の簡単な説明】
【００２０】
【図１】従来の増幅回路を簡略に示した図面である。
【図２】従来の増幅回路を具体的に示した図面である。
【図３】本発明の実施例による液晶表示装置を示した図面である。
【図４】本発明の実施例による液晶表示装置の各画素の等価回路を示した図面である。
【図５】本発明の実施例によるデータ駆動部のブロック図である。
【図６】本発明の第１実施例によるポジティブ増幅回路を簡略に示した図面である。
【図７】図６に示したポジティブ増幅回路を具体的に示した図面である。
【図８】および
【図９】本発明の第１実施例によるポジティブ増幅回路の動作を示した図面である。
【図１０】本発明の第１実施例によるネガティブ増幅回路を簡略に示した図面である。
【図１１】図１０に示したネガティブ増幅回路を具体的に示した図面である。
【図１２】および
【図１３】本発明の第１実施例によるネガティブ増幅回路の動作を示した図面である。
【図１４】本発明の第２実施例によるポジティブ増幅回路を簡略に示した図面である。
【図１５】図１４に示したポジティブ増幅回路を具体的に示した図面である。
【図１６】および
【図１７】本発明の第２実施例によるポジティブ増幅回路の動作を示した図面である。
【図１８】本発明の第２実施例によるネガティブ増幅回路を簡略に示した図面である。
【図１９】図１８に示したネガティブ増幅回路を具体的に示した図面である。
【図２０】および
【図２１】本発明の第２実施例によるネガティブ増幅回路の動作を示した図面である。
【発明を実施するための形態】
【００２１】
以下、添付した図面を参考にして、本発明の実施例について、本発明が属する技術分野で通常の知識を有する者が容易に実施することができるように詳しく説明する。しかし、本発明は多様な相異する形態で具現されることができ、ここで説明する実施例に限定されない。そして、図面では、本発明を明確に説明するために、説明に関係ない部分は省略し、明細書全体にわたって類似する部分については、類似する図面符号を付けた。
【００２２】
明細書全体で、ある部分が他の部分と「連結」されているとする場合、これは「直接的に連結」されている場合だけでなく、その中間に他の素子を置いて「電気的に連結」されている場合も含む。また、ある部分がある構成要素を「含む」とする場合、これは特に反対の記載がない限り、他の構成要素を除外するのではなく、他の構成要素をさらに含むことができることを意味する。
【００２３】
図３は、本発明の実施例による液晶表示装置を示した図面である。
【００２４】
図３に示したように、本発明の実施例による液晶表示装置は、液晶表示パネル１００、走査駆動部２００、データ駆動部３００、基準階調電圧生成部４００、および信号制御部５００を含む。
【００２５】
液晶表示パネル１００には、走査駆動部２００から印加される走査信号を伝達するための複数の走査ラインＧ１−Ｇｎが形成されており、複数の走査ラインと絶縁されて交差して、階調データに対応するデータ電圧（「データ信号」ともいう）を伝達するためのデータラインＤ１−Ｄｍが形成されている。行列形態に配列された複数の画素１１０は、それぞれ走査ラインおよびデータラインによって囲まれており、走査ラインおよびデータラインを通じて入力される信号によってバックライト（図示せず）から走査される光の透過率を変更させるが、これを図４を参照して説明する。
【００２６】
図４は、本発明の実施例による液晶表示装置の各画素の等価回路を示した図面である。
【００２７】
図４に示したように、液晶表示装置の各画素１１０は、ＴＦＴ１１２、液晶キャパシタＣ１、およびストレージキャパシタＣｓｔを含む。参考までに、図４で、データラインＤｍはデータラインＤ１−Ｄｍのうちの任意の一つのデータラインを示し、走査ラインＧｎは走査ラインＧ１−Ｇｎのうちの任意の一つの走査ラインを示す。
【００２８】
ＴＦＴ１１２は、ソース電極がデータラインＤｍと連結され、ゲート電極が走査ラインＧｎと連結される。液晶キャパシタＣ１は、ＴＦＴ１１２のドレイン電極および共通電圧Ｖｃｏｍの間に連結される。そして、ストレージキャパシタＣｓｔは、液晶キャパシタＣ１およびＴＦＴ１１２のドレイン電極の接点に連結される。
【００２９】
図４で、走査ラインＧｎに走査信号が印加されてＴＦＴ１１２がターンオンされると、データラインＤｍに供給されたデータ電圧ＶｄがＴＦＴ１１２を通じて各画素電極（図示せず）に印加される。そうすると、画素電極に印加される画素電圧Ｖｐおよび共通電圧Ｖｃｏｍの差に該当する電界が液晶（図４では等価的に液晶キャパシタＣ１で示した）に印加され、この電界の強さに対応する透過率で光が透過するようにする。この時、画素電圧Ｖｐは１フレームまたは１フィールドの間維持されなければならず、ストレージキャパシタＣｓｔは画素電極に印加される画素電圧Ｖｐを維持するために補助的に使用される。
【００３０】
図３を参照すれば、走査駆動部２００は、液晶表示パネル１００の走査ラインＧ１−Ｇｎに連結されて、ゲートオン電圧Ｖｏｎおよびゲートオフ電圧Ｖｏｆｆの組み合わせからなる走査信号を走査ラインＧ１−Ｇｎに印加する。具体的に、走査駆動部２００は、信号制御部５００から伝達されたゲート制御信号ＳＧによってゲートオン電圧Ｖｏｎを走査ラインＧ１−Ｇｎに印加して、走査ラインＧ１−Ｇｎに連結されたスイッチング素子をターンオンさせる。そうすると、データラインＤ１−Ｄｍに印加されたデータ電圧はターンオンされたスイッチング素子を通じて当該画素１１０に印加される。
【００３１】
データ駆動部３００は、液晶表示パネル１００のデータ線Ｄ１−Ｄｍに連結されており、基準階調電圧生成部４００から伝達された基準階調電圧に基づいて複数の階調電圧を生成する。具体的に、データ駆動部３００は、信号制御部５００からデジタル映像信号ＤＡＴＡを受信し、基準階調電圧生成部４００から伝達された複数の階調電圧のうちの受信されるデジタル映像信号ＤＡＴＡに対応する階調電圧、つまりデータ電圧を選択して、データラインＤ１−Ｄｍに印加する。
【００３２】
基準階調電圧生成部４００は、信号制御部５００に入力される映像データ信号Ｒ、Ｇ、Ｂによって画素１１０の透過率に関連した２セットの基準階調電圧の集合を生成する。２セットのうちの１セットは共通電圧Ｖｃｏｍより高いレベルを有する電圧ＶＤＤ−Ｖｃｏｍを有し、他の１セットは共通電圧Ｖｃｏｍより低いレベルを有する電圧Ｖｃｏｍ−Ｖｓｓを有する。
【００３３】
信号制御部５００は、外部またはグラフィック制御器（図示せず）から映像データ信号Ｒ、Ｇ、Ｂおよびその表示を制御する入力制御信号を受信する。入力制御信号の例としては、水平同期信号Ｈｓｙｎｃ、垂直同期信号Ｖｓｙｎｃ、データ印加領域信号ＤＥ、およびメインクロックＭＣＬＫなどがある。ここで、データ印加領域信号ＤＥは、データが出力される領域を表示する信号であり、メインクロックＭＣＬＫは、マイクロプロセッサ（Ｍｉｃｒｏｐｒｏｃｅｓｓｏｒ）（図示せず）から入力されて、基準信号になるクロック信号である。
【００３４】
信号制御部５００は、映像データ信号Ｒ、Ｇ、Ｂを液晶表示パネル１００の動作条件に合うように適切に処理して、ゲート制御信号ＳＧ、データ制御信号ＳＤ、およびデジタル映像信号ＤＡＴＡを生成する。信号制御部５００は、ゲート制御信号ＳＧを走査駆動部２００に伝達し、データ制御信号ＳＤおよびデジタル映像信号ＤＡＴＡをデータ駆動部３００に供給して、走査駆動部２００およびデータ駆動部３００を制御する。
【００３５】
本発明の実施例によるゲート制御信号ＳＧは、走査開始を指示する走査開始信号ＳＴＶと、ゲートオン電圧Ｖｏｎの出力周期を制御する少なくとも一つのクロック信号とを含むことができる。そして、データ制御信号ＳＤは、一行の画素に対する映像信号の伝送開始を知らせる水平同期開始信号ＳＴＨ、データラインＤ１−Ｄｍにデータ電圧の印加を指示するロード信号ＬＯＡＤ、およびデータクロック信号ＨＣＬＫを含む。また、データ制御信号ＳＤは、共通電圧Ｖｃｏｍに対するデータ電圧の極性を反転させる反転信号ＲＶＳをさらに含むことができる。そして、データ制御信号ＳＤは、データ駆動部３００の動作を制御する複数の信号ＳＥＬ０、ＳＥＬ１、ＳＨＬをさらに含むことができる。
【００３６】
図５は、本発明の実施例によるデータ駆動部のブロック図である。
【００３７】
図５に示したように、本発明の実施例によるデータ駆動部３００は、シフトレジスター３１０、ラッチ３２０、デジタルアナログ変換部３３０、出力電圧増幅部３４０、および出力バッファー３５０を含む。
【００３８】
シフトレジスター３１０は、信号制御部５００から受信されるデータクロック信号ＨＣＬＫに同期してイネーブル信号が出力される出力端子の位置を一つずつシフトさせる。そうすると、選択されるラッチ３２０の領域も順次にシフトされて、全てのラッチ３２０の領域にシフトレジスター３１０から伝達されるデジタル映像信号ＤＡＴＡが順次に記憶される。
【００３９】
ラッチ３２０は、シフトレジスター３１０に連結されており、シフトレジスター３１０から伝達されるイネーブル信号に応じて伝達されるデジタル映像信号ＤＡＴＡを保存する。この時、一行分のデジタル映像信号ＤＡＴＡがラッチ３２０に保存されると、信号制御部５００は、ラッチ３２０に印加されるロード信号ＬＯＡＤのレベルを変更し、これによってラッチ３２０の領域に保存されたデジタル映像信号ＤＡＴＡが一度にデジタルアナログ変換部３３０に伝達される。
【００４０】
デジタルアナログ変換部３３０は、基準階調電圧生成部４００から伝達される複数のアナログ階調電圧のうちの伝達されたデジタル映像信号ＤＡＴＡに対応する階調電圧を選択した後、出力電圧増幅部３４０に伝達する。
【００４１】
出力電圧増幅部３４０は、複数のポジティブ増幅回路Ｐ１−Ｐｎおよびネガティブ増幅回路Ｎ１−Ｎｍを含む。本発明の実施例によるポジティブ増幅回路は、複数の基準階調電圧に基づいて生成された複数の階調電圧のうちの共通電圧Ｖｃｏｍより所定のレベルだけ高い階調電圧を画素のキャパシタＣｐに印加し、ネガティブ増幅回路は、複数の階調電圧のうちの共通電圧Ｖｃｏｍより所定のレベルだけ低い階調電圧を画素のキャパシタＣｐに印加する。複数のポジティブおよびネガティブ増幅回路Ｐ１−Ｐｎ、Ｎ１−Ｎｍは、デジタルアナログ変換部３３０に連結されている非反転端子（＋）（図示せず）を通じてデジタルアナログ変換部３３０からのデータ電圧を受信する。この時、複数のポジティブおよびネガティブ増幅回路Ｐ１−Ｐｎ、Ｎ１−Ｎｍは、電圧フォロアー（ｖｏｌｔａｇｅ  ｆｏｌｌｏｗｅｒ）として機能する。出力バッファー３５０は、出力電圧増幅部３４０から伝達された電圧を出力する。
【００４２】
以下、本発明の第１実施例による増幅回路について具体的に説明する。
【００４３】
図６は、本発明の第１実施例によるポジティブ増幅回路を簡略に示した図面であり、図７は、図６に示したポジティブ増幅回路を具体的に示した図面である。本発明の第１実施例では、説明の便宜のために、複数のポジティブ増幅回路Ｐ１−Ｐｎのうちのポジティブ増幅回路Ｐ１を参照してポジティブ増幅回路について具体的に説明する。
【００４４】
図６に示したように、本発明の第１実施例によるポジティブ増幅回路Ｐ１は、ポジティブ増幅器６０１および同一なタイプのトランジスタ６３１、６３２を使用して出力電圧を生成する。ポジティブ増幅回路Ｐ１は、生成された出力電圧を画素キャパシタＣｐに伝達し、画素キャパシタＣｐに伝達された電圧と同一な電圧は再びポジティブ増幅回路Ｐ１の反転入力端（−）に入力される。この時、ポジティブ増幅回路Ｐ１の非反転入力端（＋）に入力電圧が印加されると、非反転入力端（＋）に印加された入力電圧および反転入力端（−）に入力された直前の出力電圧によって画素キャパシタＣｐの電圧は充電または放電される。つまり、反転入力端（−）に印加された電圧より所定のレベルだけ高い電圧が非反転入力端（＋）に印加されると、ポジティブ増幅回路Ｐ１は、非反転入力端（＋）および反転入力端（−）に印加された電圧によって共通電圧Ｖｃｏｍより所定のレベルだけ高い電圧（以下、第１出力電圧）を画素キャパシタＣｐに充電する。この時、反転入力端（−）に印加された電圧より所定のレベルだけ低い電圧が非反転入力端（＋）に印加されると、ポジティブ増幅回路Ｐ１は、非反転入力端（＋）および反転入力端（−）に印加された電圧によって画素キャパシタＣｐに充電された第１出力電圧を放電する。
【００４５】
図７に示したように、本発明の第１実施例によるポジティブ増幅回路Ｐ１は、入力部６１０、バイアス部６２０、および出力部６３０を含む。この時、図７の入力部６１０およびバイアス部６２０は、図６のポジティブ増幅器６０１を構成する。図７では、トランジスタ６１１、６１２、６１５、６２２をＮ−チャンネル電界効果トランジスタで示し、トランジスタ６１３、６１４、６２１、６３１、６３２をＰ−チャンネル電界効果トランジスタで示した。
【００４６】
入力部６１０は、トランジスタ６１１、６１２、６１３、６１４、６１５を含み、トランジスタ６１５にはバイアス電圧ＢＶ１が印加される。トランジスタ６１１のゲート電極は非反転入力端（＋）に連結され、トランジスタ６１２のゲート電極は反転入力端（−）に連結される。トランジスタ６１１のドレイン電極はトランジスタ６１３のドレイン電極に連結され、トランジスタ６１２のドレイン電極はトランジスタ６１４のドレイン電極と連結される。そして、トランジスタ６１３のゲート電極はトランジスタ６１４のゲート電極に連結され、トランジスタ６１３、６１４のソース電極は電源電圧ＶＤＤに連結される。そして、トランジスタ６１５のドレイン電極はトランジスタ６１１、６１２のソース電極に連結され、トランジスタ６１５のソース電極は接地電圧ＶＳＳに連結される。
【００４７】
バイアス部６２０は、トランジスタ６２１、６２２およびキャパシタＣ１を含み、トランジスタ６２２にはバイアス電圧ＢＶ１が印加される。この時、トランジスタ６２１のゲート電極はノードＡに連結され、トランジスタ６２１のゲート電極およびドレイン電極の間にはキャパシタＣ１が連結される。トランジスタ６２２のドレイン電極はトランジスタ６２１のドレイン電極に連結され、トランジスタ６２２のソース電極は接地電圧ＶＳＳに連結される。
【００４８】
出力部６３０は、トランジスタ６３１、６３２およびキャパシタＣ２を含む。トランジスタ６３１のゲート電極はノードＢに連結され、トランジスタ６３１のゲート電極およびドレイン電極の間にはキャパシタＣ２が連結される。トランジスタ６３２のゲート電極はノードＣに連結され、トランジスタ６３２のソース電極はトランジスタ６３１のドレイン電極に連結される。この時、液晶表示パネル１００の画素キャパシタＣｐはトランジスタ６３１、６３２の間に連結される。
【００４９】
図８および図９は、本発明の第１実施例によるポジティブ増幅回路の動作を示した図面である。
【００５０】
図８は、本発明の第１実施例によるポジティブ増幅回路Ｐ１で画素キャパシタＣｐに第１出力電圧を印加して充電する過程を示し、図９は、本発明の第１実施例によるポジティブ増幅回路Ｐ１で画素キャパシタＣｐに充電された第１出力電圧を放電させる過程を示した図面である。
【００５１】
図８および図９に示したように、入力部６１０は、バイアス電圧ＢＶ１に応答して動作する。つまり、トランジスタ６１５、６２２のそれぞれにバイアス電圧ＢＶ１が印加されると、トランジスタ６１５、６２２がターンオンされて入力部６１０は動作する。
【００５２】
図８に示されているように、入力部６１０でトランジスタ６１１のゲート電極に入力される電圧レベルがトランジスタ６１２のゲート電極に入力される電圧レベルより高い場合には、トランジスタ６１１がトランジスタ６１２より大きな電流Ｉ１を接地電圧ＶＳＳに伝送するため、ノードＡ、Ｂの電圧レベルはノードＤの電圧レベルより低くなる。この時、ノードＢの電圧レベルが減少するのに伴ってトランジスタ６２１がターンオンされて、ノードＣの電圧レベルは次第に増加し、それによってトランジスタ６３２はターンオフされる。そして、ノードＢの電圧レベルが減少するのに伴ってトランジスタ６３１がターンオンされて、画素キャパシタＣｐは第１出力電圧で充電される。
【００５３】
図９に示されているように、入力部６１０でトランジスタ６１１のゲート電極に入力される電圧レベルがトランジスタ６１２のゲート電極に入力される電圧レベルより低い場合には、トランジスタ６１２がトランジスタ６１１より大きな電流Ｉ２を接地電圧ＶＳＳに伝送するため、ノードＡ、Ｂの電圧レベルはノードＤの電圧レベルより高くなる。そうすると、トランジスタ６３１は増加したノードＢの電圧レベルによってターンオフされる。そして、ノードＢの電圧レベルが増加するのに伴ってトランジスタ６２１がターンオフされて、ノードＣの電圧レベルはノードＢより低くなる。そうすると、トランジスタ６３２は減少したノードＣの電圧レベルによってターンオンされて、画素キャパシタＣｐに充電された第１出力電圧は放電される。
【００５４】
図１０は、本発明の第１実施例によるネガティブ増幅回路を簡略に示した図面であり、図１１は、図１０に示したネガティブ増幅回路を具体的に示した図面である。本発明の第１実施例では、説明の便宜のために、複数のネガティブ増幅回路Ｎ１−Ｎｍのうちのネガティブ増幅回路Ｎ１を参照してネガティブ増幅回路について具体的に説明する。
【００５５】
図１０に示したように、本発明の第１実施例によるネガティブ増幅回路Ｎ１は、ネガティブ増幅器７０１および同一なタイプのトランジスタ７３１、７３２を使用して出力電圧を生成する。ネガティブ増幅回路Ｎ１は、生成された出力電圧を画素キャパシタＣｐに伝達し、画素キャパシタＣｐに伝達された電圧と同一な電圧は再びネガティブ増幅回路Ｎ１の反転入力端（−）に入力される。この時、ネガティブ増幅回路Ｎ１の非反転入力端（＋）に入力電圧が印加されると、非反転入力端（＋）に印加された入力電圧および反転入力端（−）に入力された直前の出力電圧によって画素キャパシタＣｐの電圧は充電または放電される。つまり、反転入力端（−）に印加された電圧より所定のレベルだけ高い電圧が非反転入力端（＋）に印加されると、ネガティブ増幅回路Ｎ１は、非反転入力端（＋）および反転入力端（−）に印加された電圧によって共通電圧Ｖｃｏｍより所定のレベルだけ低い電圧（以下、第２出力電圧）を画素キャパシタＣｐに充電する。この時、反転入力端（−）に印加された電圧より所定のレベルだけ低い電圧が非反転入力端（＋）に印加されると、ネガティブ増幅回路Ｎ１は、非反転入力端（＋）および反転入力端（−）に印加された電圧によって画素キャパシタＣｐに充電された第２出力電圧を放電する。
【００５６】
図１１に示したように、本発明の第１実施例によるネガティブ増幅回路Ｎ１の構成要素は、ポジティブ増幅回路Ｐ１の構成要素と単に異なるタイプのトランジスタおよびそれによる構成要素を使用するものに過ぎないので、図１１に示されたネガティブ増幅回路に対する具体的な説明は省略する。そして、ネガティブ増幅回路Ｎ１の連結関係は、ポジティブ増幅回路Ｐ１の連結関係と異なるが、これは単にトランジスタのタイプの差による構成要素および構成要素の位置が調整されたものに過ぎないので、図１２および図１３に示されたネガティブ増幅回路の動作に対する具体的な説明は省略する。
【００５７】
このように、本発明の第１実施例によるポジティブおよびネガティブ増幅回路は、レールツーレール構造を採択せずに単一の入力トランジスタを使用することによって、入力トランジスタが占める面積を従来の増幅回路より小さく減少させることができ、それによって増幅回路の全体的なサイズを減少させることができる。また、本発明の第１実施例によるポジティブおよびネガティブ増幅回路は、印加される定電流源の個数が従来の増幅回路より減少することによって、全体的な消費電力が減少する。
【００５８】
しかし、本発明の第１実施例によるポジティブおよびネガティブ増幅回路が画素キャパシタＣｐに電圧を充電または放電させる時、同一なタイプの出力トランジスタを使用するため、画素キャパシタＣｐに出力電圧が充電される時間と出力電圧が放電される時間とが互いに非対称的に維持されて、液晶表示パネル１００に表示される映像に問題が発生することがある。つまり、ポジティブ増幅回路のトランジスタ６３１、６３２で、トランジスタ６３１はドライバー（ｄｒｉｖｅｒ）として動作し、トランジスタ６３２はスイッチ（ｓｗｉｔｃｈ）として動作し、ネガティブ増幅回路のトランジスタ７３１、７３２で、トランジスタ７３２はドライバーとして動作し、トランジスタ７３１はスイッチとして動作することによって、非対称現象による問題が発生することがある。
【００５９】
以下、このような問題を解決するための本発明の第２実施例による増幅回路について具体的に説明する。
【００６０】
図１４は、本発明の第２実施例によるポジティブ増幅回路を簡略に示した図面であり、図１５は、図１４に示したポジティブ増幅回路を具体的に示した図面である。
【００６１】
図１４に示したように、本発明の第２実施例によるポジティブ増幅回路Ｐ１´は、ポジティブ増幅器８０１および互いに異なるタイプのトランジスタ８３１、８３２を使用して出力電圧を生成する。ポジティブ増幅回路Ｐ１´は、生成された出力電圧を画素キャパシタＣｐに伝達し、画素キャパシタＣｐに伝達された電圧と同一な電圧は再びポジティブ増幅回路Ｐ１´の反転入力端（−）に入力される。この時、ポジティブ増幅回路Ｐ１´の非反転入力端（＋）に入力電圧が印加されると、非反転入力端（＋）に印加された入力電圧および反転入力端（−）に入力された直前の出力電圧によって各画素キャパシタＣｐの電圧は充電または放電される。つまり、反転入力端（−）に印加された電圧より所定のレベルだけ高い電圧が非反転入力端（＋）に印加されると、ポジティブ増幅回路Ｐ１´は、非反転入力端（＋）および反転入力端（−）に印加された電圧によって共通電圧Ｖｃｏｍより所定のレベルだけ高い電圧（以下、第１出力電圧）を画素キャパシタＣｐに充電する。この時、反転入力端（−）に印加された電圧より所定のレベルだけ低い電圧が非反転入力端（＋）に印加されると、ポジティブ増幅回路Ｐ１´は、非反転入力端（＋）および反転入力端（−）に印加された電圧によって画素キャパシタＣｐに充電された第１出力電圧を放電する。
【００６２】
図１５に示したように、本発明の第２実施例によるポジティブ増幅回路Ｐ１´は、入力部８１０、バイアス部８２０、および出力部８３０を含む。この時、図１５の入力部８１０およびバイアス部８２０は、図１４のポジティブ増幅器８０１を構成する。図１５では、トランジスタ８１１、８１２、８１５、８２３、８２４、８２７、８２８、８３２をＮ−チャンネル電界効果トランジスタで示し、トランジスタ８１３、８１４、８２１、８２２、８２５、８２６、８３１をＰ−チャンネル電界効果トランジスタで示した。
【００６３】
入力部８１０は、トランジスタ８１１、８１２、８１３、８１４、８１５を含み、トランジスタ８１５にはバイアス電圧ＢＶ１が印加される。トランジスタ８１１のゲート電極は非反転入力端（＋）に連結され、トランジスタ８１２のゲート電極は反転入力端（−）に連結される。トランジスタ８１１のドレイン電極はトランジスタ８１３のドレイン電極に連結され、トランジスタ８１２のドレイン電極はトランジスタ８１４のドレイン電極に連結され、トランジスタ８１３、８１４のソース電極は電源電圧ＶＤＤに連結される。トランジスタ８１５のドレイン電極はトランジスタ８１１、８１２のソース電極に連結され、トランジスタ８１５のソース電極は接地電圧ＶＳＳに連結される。
【００６４】
バイアス部８２０は、トランジスタ８２１、８２２、８２３、８２４、８２５、８２６、８２７、８２８を含み、トランジスタ８２３、８２４、８２５、８２６にはバイアス電圧ＢＶ２、ＢＶ３がそれぞれ印加される。トランジスタ８２１のゲート電極はトランジスタ８１３のゲート電極に連結され、トランジスタ８２２のゲート電極はトランジスタ８１４のゲート電極に連結され、トランジスタ８２１、８２２のソース電極は電源電圧ＶＤＤに連結される。トランジスタ８２４のドレイン電極およびトランジスタ８２５のソース電極はトランジスタ８２１のドレイン電極に連結され、トランジスタ８２４のソース電極およびトランジスタ８２５のドレイン電極はトランジスタ８２８のドレイン電極に連結される。トランジスタ８２３のドレイン電極およびトランジスタ８２６のソース電極はトランジスタ８２２のドレイン電極に連結され、トランジスタ８２３のソース電極およびトランジスタ８２６のドレイン電極はトランジスタ８２７のドレイン電極に連結される。そして、トランジスタ８２７、８２８のゲート電極は互いに連結され、トランジスタ８２７、８２８のソース電極は接地電圧ＶＳＳに連結される。
【００６５】
出力部８３０は、トランジスタ８３１、８３２およびキャパシタＣ１、Ｃ２を含む。トランジスタ８３１のゲート電極はノードＣに連結され、トランジスタ８３１のゲート電極およびドレイン電極の間にキャパシタＣ１が連結される。トランジスタ８３２のゲート電極はノードＤに連結され、トランジスタ８３２のゲート電極およびドレイン電極の間にキャパシタＣ２が連結される。この時、液晶表示パネル１００の画素キャパシタＣｐはトランジスタ８３１、８３２の間に連結される。
【００６６】
図１６および図１７は、本発明の第２実施例によるポジティブ増幅回路の動作を示した図面である。
【００６７】
図１６は、本発明の第２実施例によるポジティブ増幅回路８００で画素キャパシタＣｐに第１出力電圧を印加して充電する過程を示し、図１７は、本発明の第２実施例によるポジティブ増幅回路８００で画素キャパシタＣｐに充電された第１出力電圧を放電させる過程を示した図面である。
【００６８】
図１６および図１７に示したように、入力部８１０は、バイアス電圧ＢＶ１、ＢＶ２、ＢＶ３に応答して動作する。つまり、トランジスタ８１５、８２３、８２４、８２５、８２６のそれぞれにバイアス電圧ＢＶ１、ＢＶ２、ＢＶ３が印加されると、トランジスタ８１５、８２３、８２４、８２５、８２６がターンオンされて入力部８１０は動作する。
【００６９】
図１６に示されているように、入力部８１０でトランジスタ８１１のゲート電極に入力される電圧レベルがトランジスタ８１２のゲート電極に入力される電圧レベルより高い場合には、トランジスタ８１１がトランジスタ８１２より大きな電流Ｉ１を接地電圧ＶＳＳに伝送するため、ノードＡの電圧レベルはノードＢの電圧レベルより低くなる。この時、ノードＡの電圧レベルが減少するのに伴ってトランジスタ８２１はターンオンされて、ノードＥの電圧レベルは増加する。そして、ノードＢの電圧レベルが増加するのに伴ってトランジスタ８２２がターンオフされ、ノードＥの電圧レベルが増加するのに伴ってトランジスタ８２７がターンオンされて、ノードＣ、Ｄの電圧レベルは減少する。そうすると、トランジスタ８３２は減少したノードＤの電圧レベルによってターンオフされ、トランジスタ８３１は減少したノードＣの電圧レベルによってターンオンされて、画素キャパシタＣｐは第１出力電圧で充電される。
【００７０】
図１７に示されているように、入力部８１０でトランジスタ８１１のゲート電極に入力される電圧レベルがトランジスタ８１２のゲート電極に入力される電圧レベルより低い場合には、トランジスタ８１２がトランジスタ８１１より大きな電流Ｉ２を接地電圧ＶＳＳに伝送するため、ノードＡの電圧レベルはノードＢの電圧レベルより高くなる。この時、ノードＡの電圧レベルが増加するのに伴ってトランジスタ８２１がターンオフされて、ノードＥの電圧レベルは減少する。そして、ノードＢの電圧レベルが減少するのに伴ってトランジスタ８２２がターンオンされ、ノードＥの電圧レベルが減少するのに伴ってトランジスタ８２７がターンオフされて、ノードＣ、Ｄの電圧レベルは増加する。そうすると、トランジスタ８３１は増加したノードＣの電圧レベルによってターンオフされ、トランジスタ８３２は増加したノードＤの電圧レベルによってターンオンされて、画素キャパシタＣｐに充電された第１出力電圧は放電される。
【００７１】
図１８は、本発明の第２実施例によるネガティブ増幅回路を簡略に示した図面であり、図１９は、図１８に示したネガティブ増幅回路を具体的に示した図面である。
【００７２】
図１８に示したように、本発明の第２実施例によるネガティブ増幅回路Ｎ１´は、ネガティブ増幅器９０１および互いに異なるタイプのトランジスタ９３１、９３２を使用して出力電圧を生成する。ネガティブ増幅回路Ｎ１´は、生成された出力電圧を画素キャパシタＣｐに伝達し、画素キャパシタＣｐに伝達された電圧と同一な電圧は再びネガティブ増幅回路Ｎ１´の反転入力端（−）に入力される。この時、ネガティブ増幅回路Ｎ１´の非反転入力端（＋）に入力電圧が印加されると、非反転入力端（＋）に印加された入力電圧および反転入力端（−）に入力された直前の出力電圧によって画素キャパシタＣｐの電圧は充電または放電される。つまり、反転入力端（−）に印加された電圧より所定のレベルだけ高い電圧が非反転入力端（＋）に印加されると、ネガティブ増幅回路Ｎ１´は、非反転入力端（＋）および反転入力端（−）に印加された電圧によって共通電圧Ｖｃｏｍより所定のレベルだけ低い電圧（以下、第２出力電圧）を画素キャパシタＣｐに充電する。この時、反転入力端（−）に印加された電圧より所定のレベルだけ低い電圧が非反転入力端（＋）に印加されると、ネガティブ増幅回路Ｎ１´は、非反転入力端（＋）および反転入力端（−）に印加された電圧によって画素キャパシタＣｐに充電された第２出力電圧を放電する。
【００７３】
図１９に示したように、本発明の第２実施例によるネガティブ増幅回路Ｎ１´の構成要素は、ポジティブ増幅回路Ｐ１´の構成要素と単に異なるタイプのトランジスタおよびそれによる構成要素を使用するものに過ぎないので、図１９に示されたネガティブ増幅回路に対する具体的な説明は省略する。そして、互いに異なるタイプのトランジスタ９３１、９３２で形成されるネガティブ増幅回路Ｎ１´の連結関係は、ポジティブ増幅回路Ｐ１´の連結関係と異なるが、これは単にトランジスタのタイプの差による構成要素および構成要素の位置が調整されたものに過ぎないので、図２０および図２１に示されたネガティブ増幅回路の動作に対する具体的な説明は省略する。
【００７４】
このように、本発明の第２実施例によるポジティブおよびネガティブ増幅回路は、レールツーレール構造を採択せずに単一の入力トランジスタを使用することによって、入力トランジスタが占める面積を従来の増幅回路より小さく減少させることができ、それによって増幅回路の全体的なサイズを減少させることができる。つまり、レールツーレール構造を採択する従来の増幅回路では、工程で発生する増幅回路のオフセット（ｏｆｆｓｅｔ）を減少させるために増幅回路で入力トランジスタが占める面積が増加したが、本発明の実施例による単一の入力トランジスタを採択する増幅回路では、従来より減少した入力トランジスタの面積の分だけ増幅回路全体の面積が減少することによって、増幅回路の全体的なサイズを減少させることができる。また、本発明の第２実施例によるポジティブおよびネガティブ増幅回路は、印加される定電流源の個数が減少することによって、全体的な消費電力が減少する。そして、本発明の第２実施例によるポジティブおよびネガティブ増幅回路は、互いに異なるタイプの出力トランジスタを使用することによって、出力電圧が充電される時間と放電される時間とを互いに対称的に維持して、表示される映像で発生した問題を解決することができる。
【００７５】
以上で、本発明の好適な実施例について詳細に説明したが、本発明の権利範囲はこれに限定されず、特許請求の範囲で定義している本発明の基本概念を利用した当業者の多様な変形および改良形態も本発明の権利範囲に属する。
【産業上の利用可能性】
【００７６】
本発明の実施例による増幅回路およびこれを使用した表示装置の駆動装置は、レールツーレール構造を採択せずに単一の入力トランジスタの構造を採択して、入力トランジスタの個数を減少させることができ、それによって増幅回路で入力トランジスタが占める面積が減少して、増幅回路の全体的なサイズを減少させることができる。
【００７７】
また、定電流源の個数が減少することによって、全体的な消費電力を減少させることができる。そして、互いに異なるタイプの出力トランジスタを使用することによって、出力電圧が充電される時間と放電される時間とを互いに対称的に維持することができる。
【図１】
2010532618.tif 000003
【図２】
2010532618.tif 000004
【図３】
2010532618.tif 000005
【図４】
2010532618.tif 000006
【図５】
2010532618.tif 000007
【図６】
2010532618.tif 000008
【図７】
2010532618.tif 000009
【図８】
2010532618.tif 000010
【図９】
2010532618.tif 000011
【図１０】
2010532618.tif 000012
【図１１】
2010532618.tif 000013
【図１２】
2010532618.tif 000014
【図１３】
2010532618.tif 000015
【図１４】
2010532618.tif 000016
【図１５】
2010532618.tif 000017
【図１６】
2010532618.tif 000018
【図１７】
2010532618.tif 000019
【図１８】
2010532618.tif 000020
【図１９】
2010532618.tif 000021
【図２０】
2010532618.tif 000022
【図２１】
2010532618.tif 000023
【国際調査報告】
2010532618.tif 000024
2010532618.tif 000025