(57)【特許請求の範囲】
【請求項１】
誘導負荷を駆動する誘導負荷駆動ドライバと、
還流ＭＯＳＦＥＴと、
前記誘導負荷駆動ドライバと還流ＭＯＳＦＥＴとを制御する制御部と、
定電流源とコンパレータを有する故障検出回路を備え、
前記制御部とは誘導負荷駆動ラインと動作モード選択ラインで接続され、前記誘導負荷駆動ドライバ及び前記還流ＭＯＳＦＥＴと接続され、かつ前記定電流源へ接続された動作モード選択部を備え、
前記動作モード選択部は、前記制御部からの信号により、誘導負荷実制御モードと還流ＭＯＳＦＥＴのオフ故障診断のモードを選択し、
前記制御部は、誘導負荷駆動前の初期条件として前記オフ故障診断のモードとなるように、前記動作モード選択部へ前記制御部からイニシャルチェックモードに移行する信号を送り、
前記動作モード選択部からの前記オフ故障診断モードの診断信号に基づいて、前記誘導負荷駆動ドライバをオフとし、前記還流ＭＯＳＦＥＴをオンとし、かつ前記動作モード選択部からの定電流源駆動信号に基づいて、前記定電流源から誘導負荷駆動ドライバの出力ラインに定電流を流し、
前記誘導負荷駆動ドライバの出力ラインの信号レベルについて、コンパレータを介し信号レベル判定を行うことを特徴とする還流ＭＯＳＦＥＴのオフ故障診断方法。
【請求項２】
請求項１において、前記故障検出回路はさらに基準電源を有し、前記定電流源は誘導負荷駆動ドライバの出力ラインに接続され、前記誘導負荷駆動ドライバの出力ラインはコンパレータの一方の入力端子に接続され、基準電源はコンパレータの他方の入力端子に接続されることを特徴とする還流ＭＯＳＦＥＴのオフ故障診断方法。
【請求項３】
請求項１において、還流ＭＯＳＦＥＴにインバータが接続され、誘導負荷駆動ドライバと信号が反転する構成であることを特徴とする還流ＭＯＳＦＥＴのオフ故障診断方法。
【発明の詳細な説明】
【技術分野】
【０００１】
本発明は、誘導負荷を通電および非通電状態とするオン・オフ制御を行う駆動回路において、誘導負荷オフ時の誘導サージ発生を防止する還流ＭＯＳＦＥＴの故障診断方法に関する。
【背景技術】
【０００２】
誘導負荷を通電および非通電状態とするオン・オフ制御を行う駆動回路において、オンからオフとなった時の誘導負荷へ発生する逆起電力を抑制するため還流用の素子を設ける。
【０００３】
従来、還流用素子としてダイオードを設定し電流を逃がしていることが多く見られるが、例えば特許文献１などに示すように見られるように、還流ダイオードをＭＯＳＦＥＴ等の半導体スイッチング素子に置き換えて適宜なタイミングでオン/オフさせる構成の還流制御装置も知られている。還流制御にＭＯＳＦＥＴ等の半導体スイッチング素子を使用することで、還流素子の発熱を緩和することができる。
【先行技術文献】
【特許文献】
【０００４】
【特許文献１】特開２００４−１３５４０４号公報
【発明の概要】
【発明が解決しようとする課題】
【０００５】
誘導負荷のオン・オフ制御を行った時、誘導負荷オフ時、還流ＭＯＳＦＥＴがオフ故障した場合、還流ＭＯＳＦＥＴの寄生ダイオードの存在により誘導サージの還流経路が成立してしまう。そして、この場合、ＭＯＳＦＥＴのオン電圧に比べて寄生ダイオード順方向電圧が大きいために、ＭＯＳＦＥＴの消費電力が大きくなり、これに伴う発熱によりＭＯＳＦＥＴが破壊して発炎、発火する事態を招く可能性がある。
【０００６】
そこで、本発明の目的は、還流ＭＯＳＦＥＴのオフ故障を早期に検出する還流ＭＯＳＦＥＴのオフ故障診断方法を提供することにある。
【課題を解決するための手段】
【０００７】
誘導負荷を駆動する誘導負荷駆動ドライバと、還流ＭＯＳＦＥＴと、前記誘導負荷駆動ドライバと還流ＭＯＳＦＥＴとを制御する制御部と、定電流源とコンパレータを有する故障検出回路を備え、
誘導負荷駆動前のイニシャルチェックとして、還流ＭＯＳＦＥＴをオンとし、定電流源から誘導負荷駆動ドライバの出力ラインに定電流を流し、還流ＭＯＳＦＥＴの正常時/オフ故障時の誘導負荷駆動ドライバの出力ラインの電位差を、コンパレータを介し信号レベル判定を行うことを特徴とする還流ＭＯＳＦＥＴのオフ故障診断方法。
【発明の効果】
【０００８】
本発明によれば、還流用素子としてＭＯＳＦＥＴを備える誘導負荷駆動回路において、故障判別が難しかった還流ＭＯＳＦＥＴのオフ故障を誘導負荷駆動前(実制御前)に診断検出可能とし、高い信頼性を提供できる。
【図面の簡単な説明】
【０００９】
【図１】第１実施形態による誘導負荷駆動回路を示す回路図。
【図２】図1における還流ＭＯＳＦＥＴ正常時の回路各部の信号を示すタイミングチャート。
【図３】図1における還流ＭＯＳＦＥＴオフ故障時の回路各部の信号を示すタイミングチャート。
【図４】第２実施形態による誘導負荷駆動回路を示す回路図。
【図５】図４における還流ＭＯＳＦＥＴ正常時の回路各部の信号を示すタイミングチャート。
【図６】図４における還流ＭＯＳＦＥＴオフ故障時の回路各部の信号を示すタイミングチャート。
【発明を実施するための形態】
【００１０】
本発明は、誘導負荷駆動回路の出力ラインに定電流源を接続し、誘導負荷駆動ドライバのオフ時に還流ＭＯＳＦＥＴオフ故障診断のため誘導負荷駆動回路出力ラインへ電流を流せる構成とする。また、誘導負荷駆動回路の出力ラインにコンパレータを接続し、出力ラインの電位レベルをコンパレータにて基準電位と比較し、その結果出力される信号のレベルをＣＰＵにて判定する構成とする。
【００１１】
誘導負荷駆動制御開始前のイニシャルチェックにおいて、誘導負荷駆動回路をオフとし、還流ＭＯＳＦＥＴをオンとしたとき、還流ＭＯＳＦＥＴが正常であれば、還流ＭＯＳＦＥＴのドレイン-ソース間は導通し、誘導負荷駆動回路の出力ラインはＧＮＤ電位となる。還流ＭＯＳＦＥＴがオフ故障していれば、還流ＭＯＳＦＥＴのドレイン-ソース間は断線状態となり、定電流源から誘導負荷へ電流が流れ、誘導負荷の抵抗成分分電位が上昇する。出力ラインがＧＮＤ電位であれば正常とし、電位が上昇していればオフ故障と判定する。
【００１２】
以下、図面を用いて本発明の実施形態を説明する。
[第１実施形態]
本発明の第１実施形態に係る、還流ＭＯＳＦＥＴのオフ故障診断方法について、図１を用いて説明する。
【００１３】
図１において、故障検出回路１２は誘導負荷駆動回路２に接続して用いられる。誘導負荷駆動回路２は交互にオン、オフされる誘導負荷駆動ドライバ４と還流ＭＯＳＦＥＴ５とを有し、誘導負荷駆動ドライバ４駆動ラインと還流ＭＯＳＦＥＴ５駆動ラインの間にはインバータ３が介され、誘導負荷駆動ドライバ４と還流ＭＯＳＦＥＴ５の駆動信号が常に反転する構成となっている。
【００１４】
誘導負荷駆動ドライバ４、還流ＭＯＳＦＥＴ５は直列に接続され、この状態で直流電源からの電流の供給を受ける入力端子７とグランド８との間に介在されている。誘導負荷駆動ドライバ４、還流ＭＯＳＦＥＴ５の接続部(以下、接続部９という)とグラウンド８の間には、直列に接続された誘導負荷１０が介在されている。
【００１５】
誘導負荷駆動ドライバ４のオン(すなわち還流ＭＯＳＦＥＴ５のオフ)時には、誘導負荷１０に静電エネルギーが蓄えられる。
【００１６】
誘導負荷駆動ドライバ４のオフ(すなわち還流ＭＯＳＦＥＴ５のオン)時には、還流経路１１が形成され、誘導負荷１０に蓄えられていた静電エネルギーに対応した電流が還流経路１１に流れる。制御部であるＣＰＵ１は、誘導負荷駆動ドライバ４と、還流ＭＯＳＦＥＴ５のゲート部を制御し、誘導負荷１０を駆動する。故障検出回路１２は、誘導負荷駆動ドライバ４と誘導負荷１０の接続部である接続部９に接続され、コンパレータ１４、定電流源１３を有している。コンパレータ１４はコンパレータ第１入力端子(−)１５とコンパレータ第２入力端子(＋)１６とを有し、コンパレータ第１入力端子(−)１５には、基準電圧Ｖｒｅｆが入力されている。コンパレータ第２入力端子(＋)１６は接続部９に接続され、当該部分の信号を受ける。コンパレータ１４は、接続部９と基準電圧Ｖｒｅｆとの比較結果を示す信号をコンパレータ出力端子１７より出力し、ＣＰＵ１へ入力する。コンパレータ１４は、接続部９の電位が基準電圧Ｖｒｅｆ未満の場合、ローレベル信号をコンパレータ出力端子１７より出力し、接続部９の電位が基準電圧Ｖｒｅｆ以上になるとハイレベル信号をコンパレータ出力端子１７より出力し制御部ＣＰＵポートＰ１へ入力する。故障検出回路１２はコンパレータ１４と接続部９の間に定電流源１３を有し、還流ＭＯＳＦＥＴ５のオフ故障診断時、還流ＭＯＳＦＥＴ５のオフ故障診断のため誘導負荷駆動回路出力ラインへ電流を流せる構成とする。
【００１７】
上述したように構成した故障検出回路を用いた還流ＭＯＳＦＥＴ５のオフ故障検出の方法を、図２と図３で説明する。
【００１８】
図２は、還流ＭＯＳＦＥＴ５が正常時の各々の信号レベル、および状態を示したものである。２-(ａ)は制御部ＣＰＵポートＰ１の信号レベル、２-(ｂ)は誘導負荷駆動ドライバ４の状態、２-(ｃ)は還流ＭＯＳＦＥＴ５の状態、２-(ｄ)は誘導負荷駆動ラインの電位レベル、２-(ｅ)は制御部ＣＰＵポートＰ２の信号レベルを示す。
【００１９】
図３は、還流ＭＯＳＦＥＴ５がオフ故障している時の各々の信号レベル、および状態を示したものである。３-(ａ)は制御部ＣＰＵポートＰ１の信号レベル、３-(ｂ)は誘導負荷駆動ドライバ４の状態、３-(ｃ)は還流ＭＯＳＦＥＴ５の状態、３-(ｄ)は誘導負荷駆動ラインの電位レベル、３-(ｅ)は制御部ＣＰＵポートＰ２の信号レベルを示す。
【００２０】
誘導負荷駆動回路２において、駆動初期条件として制御部ＣＰＵポートＰ１の初期値はローレベルとし、誘導負荷駆動ドライバ４をオフ、還流ＭＯＳＦＥＴ５をオンとなるようにし、定電流源１３から定電流を流す。還流ＭＯＳＦＥＴ５は正常時において、２-(ｃ)で示す通り還流ＭＯＳＦＥＴ５はオンとなり、ドレイン・ソース間は導通し、２-(ｄ)で示すように誘導負荷駆動回路出力ラインである接続部９はグランド電位となる。この時の電位はコンパレータ第２入力端子(＋)１６へ入力される。コンパレータ第２入力端子(＋)１６へ入力される信号レベルは基準電圧Ｖｒｅｆ未満となり、コンパレータ出力端子１７からは２-(ｅ)で示すようにローレベルが維持され、還流ＭＯＳＦＥＴ５がオフ故障していないことが診断できる。
【００２１】
一方、還流ＭＯＳＦＥＴ５がオフ故障していた場合は、３-(ｃ)で示すように還流ＭＯＳＦＥＴ５はオフ状態のままとなり、定電流源１３から誘導負荷１０へ通電される。そのため、３-(ｄ)で示すように誘導負荷駆動回路出力ラインである接続部９は誘導負荷１０の抵抗成分分電位が上昇する。この時の電位はコンパレータ第２入力端子(＋)１６へ入力される。第２入力端子(＋)１６へ入力される信号レベルは基準電圧Ｖｒｅｆ以上となり、コンパレータ出力端子１７からは３-(ｅ)で示すように、ハイレベルが出力され、制御部ＣＰＵポートＰ２へ入力され、２-(ｅ)に対する３-(ｅ)の信号レベルの差に基づいて還流ＭＯＳＦＥＴ５のオフ故障を診断検知することができる。
[第２実施形態]
本発明の第２実施形態に係る、還流ＭＯＳＦＥＴ５のオフ故障診断方法について、図４に基づいて説明する。
【００２２】
図４において、故障検出回路１２は誘導負荷駆動回路２に接続して用いられる。誘導負荷駆動回路２は交互にオン、オフされる誘導負荷駆動ドライバ４と還流ＭＯＳＦＥＴ５とを有し、誘導負荷駆動ドライバ４駆動ラインと還流ＭＯＳＦＥＴ５駆動ラインの間にはインバータ３が介され、誘導負荷駆動ドライバ４と還流ＭＯＳＦＥＴ５の駆動信号が常に反転する構成となっている。
【００２３】
制御部ＣＰＵ１と誘導負荷駆動回路２は、誘導負荷実制御モードと還流ＭＯＳＦＥＴ５のオフ故障診断とを持つ動作モード選択部１８で接続され、ＣＰＵポート３は動作モード選択ラインで動作モード選択部ポートＰ４へ接続し、ＣＰＵポートＰ１は誘導負荷駆動ラインで動作モード選択部ポートＰ５へ接続する構成となっている。また、動作モード選択部Ｐ７は故障検出回路１２の定電流源１３へと接続されている。
【００２４】
誘導負荷駆動ドライバ４、還流ＭＯＳＦＥＴ５は直列に接続され、この状態で直流電源からの電流の供給を受ける入力端子７とグランド８との間に介在されている。誘導負荷駆動ドライバ４、還流ＭＯＳＦＥＴ５の接続部(以下、接続部９という)とグラウンド８の間には、直列に接続された誘導負荷１０が介在されている。
【００２５】
誘導負荷駆動ドライバ４のオン(すなわち還流ＭＯＳＦＥＴ５のオフ)時には、誘導負荷１０に静電エネルギーが蓄えられる。誘導負荷駆動ドライバ４のオフ(すなわち還流ＭＯＳＦＥＴ５のオン)時には、還流経路１１が形成され、誘導負荷１０に蓄えられていた静電エネルギーに対応した電流が還流経路１１に流れる。制御部であるＣＰＵ１は、誘導負荷駆動ドライバ４と、還流ＭＯＳＦＥＴ５のゲート部を制御し、誘導負荷１０を駆動する。故障検出回路１２は、誘導負荷駆動ドライバ４と誘導負荷１０の接続部である接続部９に接続され、コンパレータ１４、定電流源１３を有している。
【００２６】
コンパレータ１４はコンパレータ第１入力端子(−)１５とコンパレータ第２入力端子(＋)１６とを有し、コンパレータ第１入力端子(−)１５には、基準電圧Ｖｒｅｆが入力されている。コンパレータ第２入力端子(＋)１６は接続部９に接続され、当該部分の信号を受ける。コンパレータ１４は、接続部９と基準電圧Ｖｒｅｆとの比較結果を示す信号をコンパレータ出力端子１７より出力し、ＣＰＵ１へ入力する。コンパレータ１４は、接続部９の電位が基準電圧Ｖｒｅｆ未満の場合、ローレベル信号をコンパレータ出力端子１７より出力し、接続部９の電位が基準電圧Ｖｒｅｆ以上になるとハイレベル信号をコンパレータ出力端子１７より出力し制御部ＣＰＵポートＰ１へ入力する。故障検出回路１２はコンパレータ１４と接続部９の間に定電流源１３を有し、還流ＭＯＳＦＥＴ５のオフ故障診断時、還流ＭＯＳＦＥＴ５のオフ故障診断のため誘導負荷駆動回路出力ラインへ電流を流せる構成とする。
【００２７】
上述したように構成した故障検出回路を用いた還流ＭＯＳＦＥＴ５のオフ故障検出の方法を、図５と図６で説明する。
【００２８】
図５は還流ＭＯＳＦＥＴ５が正常時の各々の信号レベル、および状態を示したものである。５-(ａ)は制御部ＣＰＵポートＰ３の信号レベル、５-(ｂ)は制御部ＣＰＵポートＰ１の信号レベル、５-(ｃ)は誘導負荷駆動ドライバ４の状態、５-(ｄ)は還流ＭＯＳＦＥＴ５の状態、５−（e）は誘導負荷駆動回路出力ライン電位、５-(ｆ)は制御部ＣＰＵポートＰ２の信号レベルを示す。
【００２９】
図６は還流ＭＯＳＦＥＴ５が正常時の各々の信号レベル、および状態を示したものである。６-(ａ)は制御部ＣＰＵポートＰ３の信号レベル、６-(ｂ)は制御部ＣＰＵポートＰ１の信号レベル、６-(ｃ)は誘導負荷駆動ドライバ４の状態、６-(ｄ)は還流ＭＯＳＦＥＴ５の状態、６−（e）は誘導負荷駆動回路出力ライン電位、６-(ｆ)は制御部ＣＰＵポートＰ２の信号レベルを示す。
【００３０】
誘導負荷駆動回路２において、誘導負荷１０駆動前の初期条件として制御部ＣＰＵポートＰ３よりイニシャルチェックモードとなるように信号を送る(５-(ａ))。イニシャルチェックモードへ移行後、制御部ＣＰＵポートＰ1より誘導負荷駆動ドライバ４および還流ＭＯＳＦＥＴ５を駆動する信号を送る。イニシャルチェックモードでは、ポートＰ６からはローレベルが出力され誘導負荷駆動ドライバ４はオフ(５-(ｃ))、すなわち還流ＭＯＳＦＥＴ５はオン(５-(ｄ))とするように動作する。また、ポートＰ７から定電流源１３へ信号を送り誘導負荷駆動回路出力ラインへ定電流を流す。還流ＭＯＳＦＥＴ５が正常であれば、ドレイン・ソース間は導通し、５-(ｅ)で示すように誘導負荷駆動回路出力ラインである。
接続部９はグランド電位となる。この時の電位はコンパレータ第２入力端子(＋)１６へ入力される。コンパレータ第２入力端子(＋)１６へ入力される信号レベルは基準電圧Ｖｒｅｆ未満となり、コンパレータ出力端子１７からは５-(ｆ)で示すようにローレベルが維持され、還流ＭＯＳＦＥＴ５がオフ故障していないことが診断できる。一方、還流ＭＯＳＦＥＴ５がオフ故障していた場合は、６-(ｄ)で示すように還流ＭＯＳＦＥＴ５はオフ状態のままとなり、定電流源１３から誘導負荷１０へ通電される。そのため、６-(ｅ)で示すように誘導負荷駆動回路出力ラインである接続部９は誘導負荷１０の抵抗成分分電位が上昇する。この時の電位はコンパレータ第２入力端子(＋)１６へ入力される。
【００３１】
コンパレータ第２入力端子(＋)１６へ入力される信号レベルは基準電圧Ｖｒｅｆ以上となり、コンパレータ出力端子１７からは６-(ｆ)で示すように、ハイレベルが出力され、制御部ＣＰＵポートＰ２へ入力され、５-(ｅ)に対する６-(ｅ)の信号レベルの差に基づいて還流ＭＯＳＦＥＴ５のオフ故障を診断検知することができる。
【００３２】
なお、上述した実施形態では、コンパレータ第１入力端子(-)１５に誘導負荷駆動回路の出力ラインを接続し、コンパレータ第２入力端子(+)１６に基準電位を接続した場合の実施例を報告しているが、例えば、コンパレータ第１入力端子(-)１５に基準電位を、コンパレータ第２入力端子(+)１６に誘導負荷駆動回路の出力ラインを接続しても同じ効果を得ることができる。
【符号の説明】
【００３３】
１：ＣＰＵ
２：誘導負荷駆動回路
３：インバータ
４：誘導負荷駆動ドライバ
５：還流ＭＯＳＦＥＴ
６：寄生ダイオード
７：電源入力端子
８：グランド
９：接続部
１０：誘導負荷
１１：還流経路
１２：故障検出回路
１３：定電流源
１４：コンパレータ
１５：コンパレータ第１入力端子(-)
１６：コンパレータ第２入力端子(+)
１７：コンパレータ出力端子
１８：動作モード選択部
【図１】
0006407636.tif 000002
【図２】
0006407636.tif 000003
【図３】
0006407636.tif 000004
【図４】
0006407636.tif 000005
【図５】
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【図６】
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