(57)【特許請求の範囲】
【請求項１】
インバータと、容量素子と、第１のトランジスタと、を有し、
前記第１のトランジスタのソース又はドレインの一方は、前記インバータの入力端子と電気的に接続され、
前記第１のトランジスタのソース又はドレインの他方は、前記インバータの出力端子と電気的に接続され、
前記インバータの入力端子は、前記容量素子の第１の電極と電気的に接続され、
前記容量素子の第２の電極には、第１のスイッチを介して参照電位が与えられ、
前記容量素子の第２の電極には、第２のスイッチを介して信号電位が与えられ、
前記インバータは、第２のトランジスタを有し、
前記第１のトランジスタは、チャネル形成領域を酸化物半導体層に有し、
前記酸化物半導体層は、Ｉｎ、Ｇａ、及びＺｎを含み、
前記第２のトランジスタは、チャネル形成領域にシリコンを含み、
前記第２のトランジスタ上方に絶縁層が位置し、
前記絶縁層上方に、前記第１のトランジスタが位置することを特徴とするコンパレータ。
【請求項２】
インバータと、容量素子と、第１のトランジスタと、を有するコンパレータであって、
前記第１のトランジスタのソース又はドレインの一方は、前記インバータの入力端子と電気的に接続され、
前記第１のトランジスタのソース又はドレインの他方は、前記インバータの出力端子と電気的に接続され、
前記インバータの入力端子は、前記容量素子の第１の電極と電気的に接続され、
前記容量素子の第２の電極には、第１のスイッチを介して参照電位が与えられ、
前記容量素子の第２の電極には、第２のスイッチを介して信号電位が与えられ、
前記インバータは、第２のトランジスタを有し、
前記第１のトランジスタは、チャネル形成領域を酸化物半導体層に有し、
前記酸化物半導体層は、Ｉｎ、Ｇａ、及びＺｎを含み、
前記第２のトランジスタは、チャネル形成領域にシリコンを含み、
前記第２のトランジスタ上方に絶縁層が位置し、
前記絶縁層上方に、前記第１のトランジスタが位置するコンパレータの作製方法であって、
前記第１のトランジスタは、
前記酸化物半導体層を形成する工程と、
前記酸化物半導体層中の水分又は水素を脱離させるための加熱処理を行う工程と、
前記加熱処理を行う工程の後に、前記酸化物半導体層に酸素を供給するための工程と、
を経て作製されることを特徴とするコンパレータの作製方法。
【発明の詳細な説明】
【技術分野】
【０００１】
コンパレータに関する。特にチョッパ型のコンパレータに関する。更に、チョッパ型の
コンパレータを用いた半導体装置に関する。また、当該半導体装置を用いた電子機器に関
する。
【背景技術】
【０００２】
コンパレータ（比較回路）には、差動増幅器（オペアンプ）を用いたものの他に、チョ
ッパ型のコンパレータ（チョッパーインバータコンパレータ、インバータチョッパ型コン
パレータ等ともいう）が広く利用されている。特許文献１（特許文献１中、図１参照）に
おいて、図９に示すようなチョッパ型のコンパレータが使用されている。
【０００３】
図９において、チョッパ型のコンパレータは、インバータ２６２１、容量素子２６２２
、スイッチ２６２４、スイッチ２６２５、及びスイッチ２６２６を有する。スイッチ２６
２４はインバータ２６２１と並列に電気的に接続される。インバータ２６２１の出力端子
は、チョッパ型のコンパレータの出力端子（図中、ＯＵＴと表記）と電気的に接続されて
いる。インバータ２６２１の入力端子は、容量素子２６２２の一対の電極のうちの一方と
電気的に接続されている。ここで、インバータ２６２１の入力端子、または容量素子２６
２２の一対の電極のうちの一方をノードＭ（図中、Ｍと表記）とする。容量素子２６２２
の一対の電極のうちの他方は、スイッチ２６２６を介して、チョッパ型のコンパレータの
入力端子（図中、ＩＮと表記）と電気的に接続され、且つスイッチ２６２５を介して、参
照電位が与えられる端子ＶＲと電気的に接続される。
【０００４】
図９に示したチョッパ型のコンパレータでは、スイッチ２６２６をオフ状態とし、スイ
ッチ２６２５をオン状態とし、且つスイッチ２６２４をオン状態として、端子ＶＲに参照
電位Ｖｒｅｆを入力する。こうして、ノードＭの電位をインバータ２６２１のしきい値電
圧（以下、Ｖｔｈｉともいう）に設定する。ここで、インバータ２６２１のしきい値電圧
とは、インバータ２６２１の入力電位と出力電位が等しくなる際の入力電位（または出力
電位）に相当する。ノードＭの電位をＶｔｈｉに設定することを初期化ともいう。なお、
初期化の動作は、容量素子２６２２の一対の電極間に所定の電圧（以下、基準電圧Ｖｃと
もいう）を保持させる動作ということもできる。ここで、基準電圧Ｖｃは参照電位Ｖｒｅ
ｆからしきい値電圧Ｖｔｈｉを引いた値となる。
【０００５】
初期化した後、スイッチ２６２６をオン状態とし、スイッチ２６２５をオフ状態とし、
且つスイッチ２６２４をオフ状態として、入力端子ＩＮに信号電位（以下、Ｖｉｎともい
う）を入力する。信号電位ＶｉｎがＶｔｈｉよりも高い電位（ハイレベルの電位：以下、
ＶｉｎＨという）であると、インバータ２６２１の出力電位はローレベルとなり、出力端
子ＯＵＴからローレベルの電位（以下、ＶｏｕｔＬという）が出力される。信号電位Ｖｉ
ｎがＶｔｈｉよりも低い電位（ローレベルの電位：以下、ＶｉｎＬという）であると、イ
ンバータ２６２１の出力電位はハイレベルとなり、出力端子ＯＵＴからハイレベルの電位
（以下、ＶｏｕｔＨという）が出力される。このように、入力端子ＩＮから入力された信
号に応じた信号を出力端子ＯＵＴから出力する動作を通常動作と呼ぶ。
【０００６】
以上のとおり、チョッパ型のコンパレータは動作する。
【先行技術文献】
【特許文献】
【０００７】
【特許文献１】特開２００３−２３３４２号公報
【発明の概要】
【発明が解決しようとする課題】
【０００８】
特許文献１に開示されたようなチョッパ型のコンパレータでは、スイッチ２６２４を構
成するトランジスタのオフ電流が問題となる。当該オフ電流（リーク電流）は、オフ状態
を選択されたスイッチ２６２４を介して流れる。当該リーク電流によって、ノードＭから
電荷が流出またはノードＭに電荷が流入する。こうして、初期化を行った後、時間が経過
する程に、容量素子２６２２に保持された基準電圧Ｖｃは変化してしまう。基準電圧Ｖｃ
が大きく変化すると、入力端子ＩＮに入力された信号電位Ｖｉｎを対応するレベルの電位
に変換して出力端子ＯＵＴから出力することができなくなる。
【０００９】
具体的には、初期化を行った後、基準電圧Ｖｃが変化することによってノードＭの電位
が低下して、低下分がＶｉｎＨとしきい値電圧Ｖｔｈｉの差分よりも大きくなると、入力
端子ＩＮに入力された信号電位ＶｉｎがＶｉｎＨであったときに、出力端子ＯＵＴからＶ
ｏｕｔＬを出力することができなくなる。また、初期化を行った後、基準電圧Ｖｃが変化
することによってノードＭの電位が上昇して、上昇分がしきい値電圧ＶｔｈｉとＶｉｎＬ
の差分よりも大きくなると、入力端子ＩＮに入力された信号電位ＶｉｎがＶｉｎＬであっ
たときに、出力端子ＯＵＴからＶｏｕｔＨを出力することができなくなる。つまり、初期
化を行った後、スイッチ２６２４を介して流れるリーク電流によって基準電圧Ｖｃが大き
く変化すると、コンパレータとして正常に機能しなくなり、誤作動の原因となる。
【００１０】
例えば、ＶｉｎＨとＶｉｎＬの（概略）中間の電位がＶｔｈｉとなる様にＶｉｎＨとＶ
ｉｎＬの値を設定したとき、基準電圧Ｖｃが変化することによるノードＭの電位の変動が
信号電位Ｖｉｎの振幅電圧（ＶｉｎＨとＶｉｎＬの差分）の半分よりも大きくなると、入
力端子ＩＮに入力された信号電位Ｖｉｎを所定のレベルの電位に変換して出力端子ＯＵＴ
から出力することができなくなる。つまり、コンパレータとして正常に機能しなくなり、
誤作動の原因となる。
【００１１】
そのため、上記誤作動を防止するために、所定の期間毎に、頻繁に初期化を行う必要が
ある。なお、初期化を行っている間は、コンパレータとしての動作（通常動作）を行うこ
とができない。そのため、通常動作を行うタイミングが制限される（駆動方法の自由度が
低い等ともいう）。なお、上記コンパレータを少なくとも２つ設け、一方のコンパレータ
において初期化を行っている間は、他方のコンパレータにおいて通常動作を行う手法があ
るが、動作が複雑になり、且つ回路面積も増大する。
【００１２】
そこで上記に鑑み、より信頼性が高い、新たな構成のチョッパ型のコンパレータを提供
することを課題とする。また、このようなコンパレータを用いた、より信頼性の高い半導
体装置を提供することを課題とする。
【課題を解決するための手段】
【００１３】
本発明のコンパレータの一態様は、インバータと、容量素子と、第１のスイッチと、第
２のスイッチと、第３のスイッチとを有し、入力された信号電位を対応するレベルの電位
に変換して出力信号とする。インバータの入力端子と出力端子とは、第１のスイッチを介
して電気的に接続される。インバータの入力端子は、容量素子の一対の電極のうちの一方
と電気的に接続される。容量素子の一対の電極のうちの他方は、第２のスイッチを介して
参照電位が与えられる。信号電位は第３のスイッチを介して容量素子の一対の電極のうち
の他方に与えられる。インバータの出力端子から出力される電位を出力信号とする。ここ
で、第１のスイッチは、オフ電流が極めて小さいトランジスタを用いて構成される。
【００１４】
本発明のコンパレータの一態様は、クロックドインバータと、容量素子と、第１のスイ
ッチと、第２のスイッチと、第３のスイッチとを有し、入力された信号電位を対応するレ
ベルの電位に変換して出力信号とする。クロックドインバータは、クロック信号に同期し
て、入力端子に入力された信号を反転させて出力端子から出力する。クロックドインバー
タの入力端子と出力端子とは、第１のスイッチを介して電気的に接続される。クロックド
インバータの入力端子は、容量素子の一対の電極のうちの一方と電気的に接続される。容
量素子の一対の電極のうちの他方は、第２のスイッチを介して参照電位が与えられる。信
号電位は第３のスイッチを介して容量素子の一対の電極のうちの他方に与えられる。クロ
ックドインバータの出力端子から出力される電位を出力信号とする。ここで、第１のスイ
ッチは、オフ電流が極めて小さいトランジスタを用いて構成される。
【００１５】
ここで、トランジスタのオフ電流とは、ｎチャネル型トランジスタにおいては、ドレイ
ンをソースよりも高い電位とした状態において、ソースの電位を基準としたときのゲート
の電位が０Ｖ以下であるときに、ソースとドレインの間に流れる電流のことを意味する。
或いは、ｐチャネル型トランジスタにおいては、ドレインをソースよりも低い電位とした
状態において、ソースの電位を基準としたときのゲートの電位が０Ｖ以上であるときに、
ソースとドレインの間に流れる電流のことを意味する。
【００１６】
第１のスイッチは、互いに並列に電気的に接続された複数のトランジスタを用いて構成
され、複数のトランジスタそれぞれをオフ電流が極めて小さいトランジスタとしてもよい
。そして、当該複数のトランジスタは、互いに重なる様に配置されていてもよい。当該複
数のトランジスタのチャネル幅は（概略）等しい構成とすることができる。当該複数のト
ランジスタのチャネル長は（概略）等しい構成とすることができる。
【００１７】
第１のスイッチは、互いに直列に電気的に接続された複数のトランジスタを用いて構成
され、複数のトランジスタそれぞれをオフ電流が極めて小さいトランジスタとしてもよい
。そして、当該複数のトランジスタは、互いに重なる様に配置されていてもよい。当該複
数のトランジスタのチャネル長は（概略）等しい構成とすることができる。当該複数のト
ランジスタのチャネル幅は（概略）等しい構成とすることができる。なお、互いに直列に
電気的に接続された複数のトランジスタは、マルチゲート型のトランジスタということも
できる。
【００１８】
第１のスイッチは、複数のマルチゲート型のトランジスタが互いに並列に電気的に接続
した構成とし、複数のマルチゲート型のトランジスタそれぞれをオフ電流が極めて小さい
トランジスタとしてもよい。
【００１９】
ここで、オフ電流が極めて小さいトランジスタとしては、シリコンよりも広いバンドギ
ャップを有する半導体でなる層や基板中にチャネルが形成されるトランジスタを用いるこ
とができる。シリコンよりも広いバンドギャップを有する半導体として化合物半導体があ
り、例えば、酸化物半導体、窒化物半導体などがある。例えば、オフ電流が極めて小さい
トランジスタとして、チャネルが酸化物半導体層に形成されるトランジスタを用いること
ができる。
【００２０】
また、インバータ、第２のスイッチ、及び第３のスイッチのうち少なくとも１つは、チ
ャネルがシリコン層またはシリコン基板に形成されるトランジスタを用いて構成され、当
該トランジスタは、第１のスイッチを構成するトランジスタと重なる様に設けられていて
もよい。
【発明の効果】
【００２１】
第１のスイッチをオフ電流が極めて小さいトランジスタを用いて構成するため、オフ状
態を選択された第１のスイッチを介して流れる電流（リーク電流）を抑制することができ
る。こうして、初期化を行った後、容量素子に保持された電圧の変動を抑制し、コンパレ
ータの誤作動を低減することができる。また、初期化を行う頻度を低減することができ、
駆動方法の自由度が高い。
【００２２】
また、オン状態を選択された第１のスイッチを介して流れる電流を大きくする、即ち第
１のスイッチを構成するトランジスタをオン電流の大きなトランジスタとすることによっ
て、初期化の動作を高速に行うことができる。ここで、トランジスタのオン電流を増大さ
せるには、トランジスタのチャネル幅を大きくすることによって達成することができる。
しかし、チャネル幅が大きくなる程、トランジスタの発熱の問題が顕著となる。そこで、
互いに並列に電気的に接続された複数のトランジスタを用いて第１のスイッチを構成する
。こうして、オン状態を選択された第１のスイッチを介して流れる電流を大きくしつつ、
第１のスイッチを構成する複数のトランジスタの発熱を抑制することができる。そのため
、コンパレータの信頼性を損なうことなく、初期化の動作をより高速に行うことができる
。また、当該複数のトランジスタを重ねて配置することによって、第１のスイッチが占め
る面積の増大を抑制しつつ、オン状態を選択された第１のスイッチを介して流れる電流を
大きくすることができる。そのため、コンパレータの信頼性を損なうことなく、回路面積
の増大を抑制し、且つ、初期化の動作をより高速に行うことができる。
【００２３】
なお、互いに直列に電気的に接続された複数のトランジスタを用いて第１のスイッチを
構成することによって、オフ状態を選択された第１のスイッチを介して流れる電流（リー
ク電流）を更に抑制することができる。そのため、初期化の頻度を更に低減することがで
きる。また、当該複数のトランジスタを重ねて配置することによって、第１のスイッチが
占める面積の増大を抑制しつつ、オフ状態を選択された第１のスイッチを介して流れる電
流（リーク電流）を更に抑制することができる。そのため、回路面積の増大を抑制し、且
つ、初期化の頻度を更に低減することができる。
【００２４】
なお、互いに並列に電気的に接続した複数のマルチゲート型のトランジスタを用いて第
１のスイッチを構成することによって、オン状態を選択された第１のスイッチを介して流
れる電流を大きくしつつ、第１のスイッチを構成する複数のトランジスタの発熱を抑制し
、且つオフ状態を選択された第１のスイッチを介して流れる電流（リーク電流）を抑制す
ることができる。そのため、コンパレータの信頼性を損なうことなく、初期化の動作をよ
り高速に行い、且つ、初期化の頻度を更に低減することができる。また、当該複数のマル
チゲート型のトランジスタを重ねて配置することによって、第１のスイッチが占める面積
の増大を抑制しつつ、オン状態を選択された第１のスイッチを介して流れる電流を大きく
することができる。そのため、コンパレータの信頼性を損なうことなく、回路面積の増大
を抑制し、初期化の動作をより高速に行い、且つ、初期化の頻度を更に低減することがで
きる。
【００２５】
こうして、より信頼性の高いコンパレータが得られる。また当該コンパレータを用いる
ことによって、より信頼性の高い半導体装置が得られる。
【図面の簡単な説明】
【００２６】
【図１】チョッパ型のコンパレータの構成を示す回路図、及び断面図。
【図２】チョッパ型のコンパレータの構成を示す回路図、及び断面図。
【図３】チョッパ型のコンパレータの構成を示す回路図、及び断面図。
【図４】コンパレータの作製工程を示す図。
【図５】コンパレータの作製工程を示す図。
【図６】コンパレータの作製工程を示す図。
【図７】携帯用の電子機器のブロック図。
【図８】電子書籍のブロック図。
【図９】従来のチョッパ型のコンパレータの構成を示す回路図。
【図１０】酸化物半導体層の構造を説明する図。
【図１１】酸化物半導体層の構造を説明する図。
【図１２】酸化物半導体層の構造を説明する図。
【図１３】酸化物半導体膜の成膜時基板加熱温度と欠陥密度の関係を示すグラフ。
【図１４】理想的な酸化物半導体層をチャネルに用いたトランジスタの移動度を示すグラフ。
【発明を実施するための形態】
【００２７】
以下では、実施の形態及び実施例について図面を用いて詳細に説明する。ただし、本発
明は以下の説明に限定されず、本発明の趣旨及びその範囲から逸脱することなくその形態
及び詳細を様々に変更し得ることは、当業者であれば容易に理解される。したがって、本
発明は、以下に示す実施の形態及び実施例の記載内容に限定して解釈されるものではない
。
【００２８】
なお、「ソース」や「ドレイン」の機能は、異なる極性のトランジスタを採用する場合
や、回路動作において電流の方向が変化する場合などには入れかわることがある。このた
め、本明細書においては、「ソース」や「ドレイン」の用語は、入れかえて用いることが
できるものとする。
【００２９】
「電気的に接続」には、「何らかの電気的作用を有するもの」を介して接続されている
場合が含まれる。ここで、「何らかの電気的作用を有するもの」は、接続対象間での電気
信号の授受を可能とするものであれば、特に制限はない。例えば、「何らかの電気的作用
を有するもの」には、電極や配線をはじめ、トランジスタなどのスイッチング素子、抵抗
素子、インダクタ、キャパシタ、その他の各種機能を有する素子などが含まれる。
【００３０】
回路図上は独立している構成要素どうしが電気的に接続しているように図示されている
場合であっても、実際には、例えば配線の一部が電極としても機能する場合など、一の導
電膜が、複数の構成要素の機能を併せ持っている場合もある。本明細書において電気的に
接続とは、このような、一の導電膜が、複数の構成要素の機能を併せ持っている場合も、
その範疇に含める。
【００３１】
「上」や「下」の用語は、構成要素の位置関係が「直上」または「直下」であることを
限定するものではない。例えば、「ゲート絶縁層上のゲート電極」の表現であれば、ゲー
ト絶縁層とゲート電極との間に他の構成要素を含むものを除外しない。
【００３２】
図面等において示す各構成の、位置、大きさ、範囲などは、理解の簡単のため、実際の
位置、大きさ、範囲などを表していない場合がある。このため、開示する発明は、必ずし
も、図面等に開示された位置、大きさ、範囲などに限定されない。
【００３３】
「第１」、「第２」、「第３」などの序数詞は、構成要素の混同を避けるために付すも
のである。
【００３４】
（実施の形態１）
本発明のチョッパ型のコンパレータの一態様について説明する。
【００３５】
（コンパレータの構成）
図１（Ａ）は、本発明のチョッパ型のコンパレータの回路図の一態様である。図１（Ａ
）において、チョッパ型のコンパレータ１０００は、スイッチ１６２４、スイッチ１６２
５、スイッチ１６２６と、インバータ１６２１、容量素子１６２２を有する。スイッチ１
６２４はインバータ１６２１と並列に電気的に接続される。インバータ１６２１の出力端
子は、チョッパ型のコンパレータ１０００の出力端子（図中、ＯＵＴと表記）と電気的に
接続されている。インバータ１６２１の入力端子は、容量素子１６２２の一対の電極のう
ちの一方と電気的に接続されている。ここで、インバータ１６２１の入力端子、または容
量素子１６２２の一対の電極のうちの一方をノードＭ（図中、Ｍと表記）とする。容量素
子１６２２の一対の電極のうちの他方は、スイッチ１６２６を介して、チョッパ型のコン
パレータ１０００の入力端子（図中、ＩＮと表記）と電気的に接続され、且つスイッチ１
６２５を介して、参照電位が与えられる端子ＶＲと電気的に接続される。
【００３６】
ここで、スイッチ１６２４は、オフ電流が極めて小さいトランジスタを用いて構成され
る。図１（Ａ）では、トランジスタ１１を用いて構成されている。トランジスタとしては
、例えば、酸化物半導体層にチャネルが形成されるトランジスタを用いることができる。
図１（Ａ）では、トランジスタ１１はチャネルが酸化物半導体層に形成されるトランジス
タであることを示すため、「ＯＳ」の符号を付している。トランジスタ１１のゲートは端
子ＯＳＧと電気的に接続され、制御信号が入力される。当該制御信号によって、トランジ
スタ１１のオン状態またはオフ状態が選択される。即ち、当該制御信号によって、スイッ
チ１６２４のオン状態またはオフ状態が選択される。
【００３７】
なお、インバータ１６２１の代わりに、クロック信号に同期して入力された信号を反転
して出力する、クロックドインバータを用いてもよい。スイッチ１６２５、スイッチ１６
２６、インバータ１６２１は、トランジスタを用いて構成することができる。当該トラン
ジスタは、任意の構成のトランジスタとすることができる。例えば、スイッチ１６２５、
スイッチ１６２６、インバータ１６２１は、シリコン層またはシリコン基板にチャネルが
形成されるトランジスタとすることができる。
【００３８】
（コンパレータの駆動方法）
図１（Ａ）に示したチョッパ型のコンパレータ１０００の駆動方法について説明する。
スイッチ１６２６をオフ状態とし、スイッチ１６２５をオン状態とし、且つスイッチ１６
２４をオン状態として、端子ＶＲに参照電位Ｖｒｅｆを入力する。こうして、ノードＭの
電位をインバータ１６２１のしきい値電圧（以下、Ｖｔｈｉともいう）に設定する。ここ
で、インバータ１６２１のしきい値電圧とは、インバータ１６２１の入力電位と出力電位
が等しくなる際の入力電位（または出力電位）に相当する。ノードＭの電位をＶｔｈｉに
設定することを、初期化ともいう。なお、初期化の動作は、容量素子１６２２の一対の電
極間に所定の電圧（以下、基準電圧Ｖｃともいう）を保持させる動作ということもできる
。ここで、基準電圧Ｖｃは参照電位Ｖｒｅｆからしきい値電圧Ｖｔｈｉを引いた値となる
。
【００３９】
初期化した後、スイッチ１６２６をオン状態とし、スイッチ１６２５をオフ状態とし、
且つスイッチ１６２４をオフ状態として、入力端子ＩＮに信号電位（以下、Ｖｉｎともい
う）を入力する。信号電位ＶｉｎがＶｔｈｉよりも高い電位（ハイレベルの電位：以下、
ＶｉｎＨという）であると、インバータ１６２１の出力電位はローレベルとなり、出力端
子ＯＵＴからローレベルの電位（以下、ＶｏｕｔＬという）が出力される。信号電位Ｖｉ
ｎがＶｔｈｉよりも低い電位（ローレベルの電位：以下、ＶｉｎＬという）であると、イ
ンバータ１６２１の出力電位はハイレベルとなり、出力端子ＯＵＴからハイレベルの電位
（以下、ＶｏｕｔＨという）が出力される。このように、入力端子ＩＮから入力された信
号に応じた信号を出力端子ＯＵＴから出力する動作を通常動作と呼ぶ。
【００４０】
以上のとおり、チョッパ型のコンパレータ１０００は動作する。
【００４１】
スイッチ１６２４をオフ電流が極めて小さいトランジスタ１１を用いて構成するため、
オフ状態を選択されたスイッチ１６２４を介して流れる電流（リーク電流）を抑制するこ
とができる。こうして、初期化を行った後、容量素子１６２２に保持された基準電圧Ｖｃ
の変動を抑制し、コンパレータ１０００の誤作動を低減することができる。また、コンパ
レータ１０００では初期化を行う頻度を低減することができ、駆動方法の自由度を高くす
ることができる。
【００４２】
（コンパレータの断面構成）
図１（Ａ）に示したコンパレータ１０００のより具体的な構成の一例について説明する
。図１（Ｂ）は、図１（Ａ）に示したコンパレータ１０００の構成を示した断面図である
。図１（Ｂ）では、スイッチ１６２４を構成するトランジスタ１１と、インバータ１６２
１を構成するトランジスタ１３３を代表で示す。
【００４３】
基板７００上に絶縁膜７０１が設けられ、絶縁膜７０１上にトランジスタ１３３が形成
されている。トランジスタ１３３は、チャネル形成領域７１０と、不純物領域７０９とを
有する半導体層と、ゲート絶縁膜として機能する絶縁膜７０３と、ゲート電極７０７とを
有する。当該半導体層は、例えば、シリコン層とすることができる。なお、トランジスタ
１３３は、チャネルが単結晶半導体基板に形成されるトランジスタであってもよい。単結
晶半導体基板としては、例えばシリコン基板を用いることができる。トランジスタ１３３
上に、絶縁膜７１２及び絶縁膜７１３が設けられ、その上にトランジスタ１１が形成され
ている。トランジスタ１１は、チャネル形成領域を含む領域９０９と、高濃度領域９０８
とを有する酸化物半導体層と、ゲート絶縁膜として機能する絶縁層７１８と、ゲート電極
７２２と、サイドウォールとして機能する絶縁物７２１ａ及び絶縁物７２１ｂと、ソース
電極及びドレイン電極として機能する導電層７１９及び導電層７２０とを有する。トラン
ジスタ１１上には、絶縁膜７２４が形成され、絶縁膜７２４上には、配線７２６が形成さ
れ、配線７２６上には絶縁膜７２７が形成されている。
【００４４】
図１（Ｂ）に示す様に、スイッチ１６２４を構成するトランジスタ１１は、コンパレー
タ１０００を構成するその他のトランジスタと重ねて配置することができる。例えば、イ
ンバータ１６２１を構成するトランジスタ１３３と重ねて配置することができる。こうし
て、コンパレータ１０００は、回路面積の増大を抑制しつつ、初期化を行う頻度を低減す
ることができ、駆動方法の自由度を高くすることができる。
【００４５】
本実施の形態は、他の実施の形態と適宜組み合わせて実施することが可能である。
【００４６】
（実施の形態２）
本発明のチョッパ型のコンパレータの別の一態様について説明する。図２（Ａ）は、本
発明のチョッパ型のコンパレータの回路図の一態様である。
【００４７】
図２（Ａ）に記載のチョッパ型のコンパレータ１０００は、図１（Ａ）で示したチョッ
パ型のコンパレータ１０００とは、スイッチ１６２４として、トランジスタ１１ａとトラ
ンジスタ１１ｂを互いに並列に電気的に接続している点が異なり、その他の構成について
は図１（Ａ）と同様であるため説明は省略する。なお、スイッチ１６２４は、２つのトラ
ンジスタでなる構成に限定されず、複数のトランジスタを互いに並列に電気的に接続した
構成とすることができる。こうして、スイッチ１６２４を介して流れる電流の電流値を大
きくすることが可能となり、初期化の動作を効率良く行うことができる。また、個々のト
ランジスタの発熱を抑制することができる。
【００４８】
図２（Ａ）におけるコンパレータ１０００の駆動方法については、図１（Ａ）に示した
コンパレータ１０００の駆動方法と同様であるため、説明は省略する。
【００４９】
（コンパレータの断面構成）
図２（Ａ）に示したコンパレータ１０００のより具体的な構成の一例について説明する
。図２（Ｂ）は、図２（Ａ）に示したコンパレータ１０００の構成を示した断面図である
。図２（Ｂ）では、スイッチ１６２４を構成するトランジスタ１１ａ及びトランジスタ１
１ｂと、インバータ１６２１を構成するトランジスタ１３３を代表で示す。トランジスタ
１１ａ及びトランジスタ１１ｂはそれぞれ、図１（Ｂ）に示したトランジスタ１１と同様
の構成とすることができる。なお、図１（Ｂ）と同じ部分は説明を省略する。トランジス
タ１１ｂ上には、絶縁膜７２４ｂが形成され、絶縁膜７２４ｂ上には配線７２６ｂが形成
され、配線７２６ｂ上には絶縁膜７２７ｂが形成されている。
【００５０】
図２（Ｂ）に示すように、スイッチ１６２４を構成するトランジスタ１１ａ及びトラン
ジスタ１１ｂは、コンパレータ１０００を構成するその他のトランジスタと重ねて配置す
ることができる。例えば、インバータ１６２１を構成するトランジスタ１３３と重ねて配
置することができる。また、トランジスタ１１ａ及びトランジスタ１１ｂも重ねて配置す
ることができる。こうして、コンパレータ１０００は、回路面積の増大を抑制しつつ、初
期化の動作を効率良く行い、また初期化を行う頻度を低減することができ、駆動方法の自
由度を高くすることができる。
【００５１】
本実施の形態は、他の実施の形態と適宜組み合わせて実施することが可能である。
【００５２】
（実施の形態３）
本発明のチョッパ型のコンパレータの別の一態様について説明する。図３（Ａ）は、本
発明のチョッパ型のコンパレータの回路図の一態様である。
【００５３】
図３（Ａ）に記載のチョッパ型のコンパレータ１０００は、図１（Ａ）で示したチョッ
パ型のコンパレータ１０００とは、スイッチ１６２４として、トランジスタ１１ａとトラ
ンジスタ１１ｃを直列に電気的に接続し、トランジスタ１１ｂとトランジスタ１１ｄを直
列に電気的に接続し、更に、トランジスタ１１ａとトランジスタ１１ｃでなる回路と、ト
ランジスタ１１ｂとトランジスタ１１ｄでなる回路とを並列に接続している点が異なる。
その他の構成については図１（Ａ）と同様であるため説明は省略する。なお、スイッチ１
６２４は、４つのトランジスタでなる構成に限定されず、複数のトランジスタを互いに直
列且つ並列に電気的に接続した構成とすることができる。この構成は、マルチゲート型の
トランジスタが並列に電気的に接続された構成ということもできる。こうして、スイッチ
１６２４を介して流れる電流の電流値を大きくすることが可能となり、初期化の動作を効
率良く行うことができる。また、個々のトランジスタの発熱を抑制することができる。更
に、スイッチ１６２４を介して流れる電流（リーク電流）を更に抑制することができるの
で、初期化の頻度を更に低減することができる。
【００５４】
なお、スイッチ１６２４は、４つのトランジスタでなる構成に限定されず、複数のトラ
ンジスタを互いに直列に電気的に接続した構成とすることもできる。この構成は、マルチ
ゲート型のトランジスタを用いた構成と考えることもできる。こうして、スイッチ１６２
４を介して流れる電流（リーク電流）を更に抑制することができるので、初期化の頻度を
更に低減することができる。
【００５５】
図３（Ａ）におけるコンパレータ１０００の駆動方法については、図１（Ａ）に示した
コンパレータ１０００の駆動方法と同様であるため、説明は省略する。
【００５６】
（コンパレータの断面構成）
図３（Ａ）に示したコンパレータ１０００のより具体的な構成の一例について説明する
。図３（Ｂ）は、図３（Ａ）に示したコンパレータ１０００の構成を示した断面図である
。図３（Ｂ）では、スイッチ１６２４を構成するトランジスタ１１ａ、トランジスタ１１
ｂ、トランジスタ１１ｃ及びトランジスタ１１ｄと、インバータ１６２１を構成するトラ
ンジスタ１３３を代表で示す。トランジスタ１１ａ、トランジスタ１１ｂ、トランジスタ
１１ｃ及びトランジスタ１１ｄはそれぞれ、図１（Ｂ）に示したトランジスタ１１と同様
の構成とすることができる。なお、図２（Ｂ）と同じ部分は説明を省略する。ここで、ト
ランジスタ１１ａとトランジスタ１１ｃとにおいて、高濃度領域９０８ａｃを共有してい
る。また、トランジスタ１１ａ及びトランジスタ１１ｃにおいて、導電層７２０ａｃを共
有している。この構成によって、トランジスタ１１ａ及びトランジスタ１１ｃの占める面
積をより小さくすることができる。トランジスタ１１ｂとトランジスタ１１ｄとにおいて
、高濃度領域９０８ｂｄを共有している。また、トランジスタ１１ｂ及びトランジスタ１
１ｄにおいて、導電層７２０ｂｄを共有している。この構成によって、トランジスタ１１
ｂ及びトランジスタ１１ｄの占める面積をより小さくすることができる。
【００５７】
図３（Ｂ）に示す様に、スイッチ１６２４を構成するトランジスタ１１ａ、トランジス
タ１１ｂ、トランジスタ１１ｃ及びトランジスタ１１ｄは、コンパレータ１０００を構成
するその他のトランジスタと重ねて配置することができる。例えば、インバータ１６２１
を構成するトランジスタ１３３と重ねて配置することができる。また、トランジスタ１１
ａ及びトランジスタ１１ｃと、トランジスタ１１ｂ及びトランジスタ１１ｄとを重ねて配
置することができる。こうして、コンパレータ１０００は、回路面積の増大を抑制しつつ
、初期化の動作を効率良く行い、また初期化を行う頻度を更に低減することができ、駆動
方法の自由度を高くすることができる。
【００５８】
本実施の形態は、他の実施の形態と適宜組み合わせて実施することが可能である。
【００５９】
（実施の形態４）
コンパレータの作製方法について説明する。本実施の形態では、図１（Ａ）に示したコ
ンパレータ１０００のうち、チャネルが酸化物半導体層に形成されるトランジスタ１１、
容量素子１６２２、及びインバータ１６２１を構成するトランジスタ１３３を例に挙げて
、コンパレータ１０００の作製方法について説明する。インバータ１６２１を相補型トラ
ンジスタによって構成する場合には、トランジスタ１３３と極性が異なる別のトランジス
タを設けることになる。ここで、トランジスタ１３３は、チャネルがシリコン層に形成さ
れるトランジスタである場合を例に挙げる。
【００６０】
なお、コンパレータ１０００の有するその他トランジスタ（例えば、スイッチ１６２６
やスイッチ１６２５を構成するトランジスタ）は、トランジスタ１３３と同様に作製する
ことができる。
【００６１】
まず、図４（Ａ）に示すように、基板７００上に絶縁膜７０１と、単結晶の半導体基板
から分離された半導体膜７０２とを形成する。
【００６２】
基板７００として使用することができる素材に大きな制限はないが、少なくとも、後の
加熱処理に耐えうる程度の耐熱性を有していることが必要となる。例えば、基板７００に
は、フュージョン法やフロート法で作製されるガラス基板、石英基板、半導体基板、セラ
ミック基板等を用いることができる。ガラス基板としては、後の加熱処理の温度が高い場
合には、歪み点が７３０℃以上のものを用いると良い。
【００６３】
また、本実施の形態では、半導体膜７０２が単結晶のシリコンである場合を例に挙げて
、以下、トランジスタ１３３の作製方法について説明する。なお、具体的な単結晶の半導
体膜７０２の作製方法の一例について、簡単に説明する。まず、単結晶の半導体基板であ
るボンド基板に、電界で加速されたイオンでなるイオンビームを注入し、ボンド基板の表
面から一定の深さの領域に、結晶構造が乱されることで局所的に脆弱化された脆化層を形
成する。脆化層が形成される領域の深さは、イオンビームの加速エネルギーとイオンビー
ムの入射角によって調節することができる。そして、ボンド基板と、絶縁膜７０１が形成
された基板７００とを、間に当該絶縁膜７０１が挟まるように貼り合わせる。貼り合わせ
は、ボンド基板と基板７００とを重ね合わせた後、ボンド基板と基板７００の一部に、１
Ｎ／ｃｍ２以上５００Ｎ／ｃｍ２以下、好ましくは１１Ｎ／ｃｍ２以上２０Ｎ／ｃｍ２以
下程度の圧力を加える。圧力を加えると、その部分からボンド基板と絶縁膜７０１とが接
合を開始し、最終的には密着した面全体に接合がおよぶ。次いで、加熱処理を行うことで
、脆化層に存在する微小ボイドどうしが結合して、微小ボイドの体積が増大する。その結
果、脆化層においてボンド基板の一部である単結晶半導体膜が、ボンド基板から分離する
。上記加熱処理の温度は、基板７００の歪み点を越えない温度とする。そして、上記単結
晶半導体膜をエッチング等により所望の形状に加工することで、半導体膜７０２を形成す
ることができる。
【００６４】
半導体膜７０２には、閾値電圧を制御するために、硼素、アルミニウム、ガリウムなど
のｐ型の導電性を付与する不純物元素、若しくはリン、砒素などのｎ型の導電性を付与す
る不純物元素を添加しても良い。閾値電圧を制御するための不純物元素の添加は、所定の
形状にエッチング加工する前の半導体膜に対して行っても良いし、所定の形状にエッチン
グ加工した後の半導体膜７０２に対して行っても良い。また、閾値電圧を制御するための
不純物元素の添加を、ボンド基板に対して行っても良い。若しくは、不純物元素の添加を
、閾値電圧を大まかに調整するためにボンド基板に対して行った上で、閾値電圧を微調整
するために、所定の形状にエッチング加工する前の半導体膜に対して、又は所定の形状に
エッチング加工した後の半導体膜７０２に対しても行っても良い。
【００６５】
なお、本実施の形態では、単結晶の半導体膜を用いる例について説明しているが、本発
明はこの構成に限定されない。例えば、ＳＴＩ（Ｓｈａｌｌｏｗ  Ｔｒｅｎｃｈ  Ｉｓｏ
ｌａｔｉｏｎ）等により素子分離したバルクの半導体基板を用いてもよい。例えば、絶縁
膜７０１上に気相成長法を用いて形成された多結晶、微結晶、非晶質の半導体膜を用いて
も良いし、上記半導体膜を公知の技術により結晶化しても良い。公知の結晶化方法として
は、レーザ光を用いたレーザ結晶化法、触媒元素を用いる結晶化法がある。或いは、触媒
元素を用いる結晶化法とレーザ結晶化法とを組み合わせて用いることもできる。また、石
英のような耐熱性に優れている基板を用いる場合、電熱炉を使用した熱結晶化方法、赤外
光を用いたランプ加熱結晶化法、触媒元素を用いる結晶化法、９５０℃程度の高温加熱法
を組み合わせた結晶化法を用いても良い。
【００６６】
次に、図４（Ｂ）に示すように、半導体膜７０２を用いて半導体層７０４を形成する。
そして、半導体層７０４上にゲート絶縁膜として機能する絶縁膜７０３を形成する。
【００６７】
絶縁膜７０３は、例えば、プラズマＣＶＤ法又はスパッタリング法などを用い、酸化珪
素、窒化酸化珪素、酸化窒化珪素、窒化珪素、酸化ハフニウム、酸化アルミニウム又は酸
化タンタル、酸化イットリウム、ハフニウムシリケート（ＨｆＳｉｘＯｙ（ｘ＞０、ｙ＞
０））、窒素が添加されたハフニウムシリケート（ＨｆＳｉｘＯｙ（ｘ＞０、ｙ＞０））
、窒素が添加されたハフニウムアルミネート（ＨｆＡｌｘＯｙ（ｘ＞０、ｙ＞０））等を
含む膜を、単層で、又は積層させることで、形成することができる。
【００６８】
なお、本明細書において酸化窒化物とは、その組成として、窒素よりも酸素の含有量が
多い物質であり、また、窒化酸化物とは、その組成として、酸素よりも窒素の含有量が多
い物質を意味する。
【００６９】
絶縁膜７０３の厚さは、例えば、１ｎｍ以上１００ｎｍ以下、好ましくは１０ｎｍ以上
５０ｎｍ以下とすることができる。本実施の形態では、プラズマＣＶＤ法を用いて、酸化
珪素を含む単層の絶縁膜を、絶縁膜７０３として用いる。
【００７０】
次いで、図４（Ｃ）に示すように、ゲート電極７０７を形成する。
【００７１】
ゲート電極７０７は、導電膜を形成した後、該導電膜を所定の形状に加工することで、
形成することができる。上記導電膜の形成にはＣＶＤ法、スパッタリング法、蒸着法、ス
ピンコート法等を用いることができる。また、導電膜は、タンタル（Ｔａ）、タングステ
ン（Ｗ）、チタン（Ｔｉ）、モリブデン（Ｍｏ）、アルミニウム（Ａｌ）、銅（Ｃｕ）、
クロム（Ｃｒ）、ニオブ（Ｎｂ）等を用いることができる。上記金属を主成分とする合金
を用いても良いし、上記金属を含む化合物を用いても良い。又は、半導体膜に導電性を付
与するリン等の不純物元素をドーピングした、多結晶珪素などの半導体を用いて形成して
も良い。
【００７２】
なお、本実施の形態ではゲート電極７０７を単層の導電膜で形成しているが、本実施の
形態はこの構成に限定されない。ゲート電極７０７は積層された複数の導電膜で形成され
ていても良い。
【００７３】
２つの導電膜の組み合わせとして、１層目に窒化タンタル又はタンタルを、２層目にタ
ングステンを用いることができる。上記例の他に、２つの導電膜の組み合わせとして、窒
化タングステンとタングステン、窒化モリブデンとモリブデン、アルミニウムとタンタル
、アルミニウムとチタン等が挙げられる。タングステンや窒化タンタルは、耐熱性が高い
ため、２層の導電膜を形成した後の工程において、熱活性化を目的とした加熱処理を行う
ことができる。また、２層の導電膜の組み合わせとして、例えば、ｎ型の導電性を付与す
る不純物元素がドーピングされた珪素とニッケルシリサイド、ｎ型の導電性を付与する不
純物元素がドーピングされた珪素とタングステンシリサイド等も用いることができる。
【００７４】
３つの導電膜を積層する３層構造の場合は、モリブデン膜とアルミニウム膜とモリブデ
ン膜の積層構造を採用するとよい。
【００７５】
また、ゲート電極７０７に酸化インジウム、酸化インジウム酸化スズ、酸化インジウム
酸化亜鉛、酸化亜鉛、酸化亜鉛アルミニウム、酸窒化亜鉛アルミニウム、又は酸化亜鉛ガ
リウム等の透光性を有する酸化物導電膜を用いることもできる。
【００７６】
なお、マスクを用いずに、液滴吐出法を用いて選択的にゲート電極７０７を形成しても
良い。液滴吐出法とは、所定の組成物を含む液滴を細孔から吐出又は噴出することで所定
のパターンを形成する方法を意味し、インクジェット法などがその範疇に含まれる。
【００７７】
また、ゲート電極７０７は、導電膜を形成後、ＩＣＰ（Ｉｎｄｕｃｔｉｖｅｌｙ  Ｃｏ
ｕｐｌｅｄ  Ｐｌａｓｍａ：誘導結合型プラズマ）エッチング法を用い、エッチング条件
（コイル型の電極層に印加される電力量、基板側の電極層に印加される電力量、基板側の
電極温度等）を適宜調節することにより、所望のテーパー形状を有するようにエッチング
することができる。また、テーパー形状は、マスクの形状によっても角度等を制御するこ
とができる。なお、エッチング用ガスとしては、塩素、塩化硼素、塩化珪素もしくは四塩
化炭素などの塩素系ガス、四弗化炭素、弗化硫黄もしくは弗化窒素などのフッ素系ガス又
は酸素を適宜用いることができる。
【００７８】
次に、図４（Ｄ）に示すように、ゲート電極７０７をマスクとして一導電性を付与する
不純物元素を半導体層７０４に添加することで、ゲート電極７０７と重なるチャネル形成
領域７１０と、チャネル形成領域７１０を間に挟む一対の不純物領域７０９とが、半導体
層７０４に形成される。
【００７９】
本実施の形態では、半導体層７０４にｐ型の導電性を付与する不純物元素（例えば硼素
）を添加する場合を例に挙げる。
【００８０】
次いで、図５（Ａ）に示すように、絶縁膜７０３、ゲート電極７０７を覆うように、絶
縁膜７１２、絶縁膜７１３を形成する。具体的に、絶縁膜７１２、絶縁膜７１３は、酸化
珪素、窒化珪素、窒化酸化珪素、酸化窒化珪素、窒化アルミニウム、窒化酸化アルミニウ
ムなどの無機の絶縁膜を用いることができる。特に、絶縁膜７１２、絶縁膜７１３に誘電
率の低い（ｌｏｗ−ｋ）材料を用いることで、各種電極や配線の重なりに起因する容量を
十分に低減することが可能になるため好ましい。なお、絶縁膜７１２、絶縁膜７１３に、
上記材料を用いた多孔性の絶縁膜を適用しても良い。多孔性の絶縁膜では、密度の高い絶
縁膜と比較して誘電率が低下するため、電極や配線の重なりに起因する寄生容量を更に低
減することが可能である。
【００８１】
本実施の形態では、絶縁膜７１２として酸化窒化珪素、絶縁膜７１３として窒化酸化珪
素を用いる場合を例に挙げる。また、本実施の形態では、ゲート電極７０７上に絶縁膜７
１２、絶縁膜７１３を形成している場合を例示しているが、本発明はゲート電極７０７上
に絶縁膜を１層だけ形成していても良いし、３層以上の複数の絶縁膜を積層するように形
成していても良い。
【００８２】
次いで、図５（Ｂ）に示すように、絶縁膜７１３にＣＭＰ（化学的機械研磨）処理やエ
ッチング処理を行うことにより、絶縁膜７１３の上面を平坦化する。なお、後に形成され
るトランジスタ１１の特性を向上させるために、絶縁膜７１３の表面は可能な限り平坦に
しておくことが好ましい。
【００８３】
以上の工程により、トランジスタ１３３を形成することができる。
【００８４】
次いで、トランジスタ１１の作製方法について説明する。まず、図５（Ｃ）に示すよう
に、絶縁膜７１３上に酸化物半導体層７１６を形成する。
【００８５】
酸化物半導体層７１６としては、少なくともＩｎ、Ｇａ、Ｓｎ及びＺｎから選ばれた一
種以上の元素を含有する。例えば、四元系金属の酸化物であるＩｎ−Ｓｎ−Ｇａ−Ｚｎ−
Ｏ系酸化物半導体や、三元系金属の酸化物であるＩｎ−Ｇａ−Ｚｎ−Ｏ系酸化物半導体、
Ｉｎ−Ｓｎ−Ｚｎ−Ｏ系酸化物半導体、Ｉｎ−Ａｌ−Ｚｎ−Ｏ系酸化物半導体、Ｓｎ−Ｇ
ａ−Ｚｎ−Ｏ系酸化物半導体、Ａｌ−Ｇａ−Ｚｎ−Ｏ系酸化物半導体、Ｓｎ−Ａｌ−Ｚｎ
−Ｏ系酸化物半導体、Ｈｆ−Ｉｎ−Ｚｎ−Ｏ系酸化物半導体や、二元系金属の酸化物であ
るＩｎ−Ｚｎ−Ｏ系酸化物半導体、Ｓｎ−Ｚｎ−Ｏ系酸化物半導体、Ａｌ−Ｚｎ−Ｏ系酸
化物半導体、Ｚｎ−Ｍｇ−Ｏ系酸化物半導体、Ｓｎ−Ｍｇ−Ｏ系酸化物半導体、Ｉｎ−Ｍ
ｇ−Ｏ系酸化物半導体や、Ｉｎ−Ｇａ−Ｏ系酸化物半導体、一元系金属の酸化物であるＩ
ｎ−Ｏ系酸化物半導体、Ｓｎ−Ｏ系酸化物半導体、Ｚｎ−Ｏ系酸化物半導体などを用いる
ことができる。また、上記酸化物半導体にＩｎとＧａとＳｎとＺｎ以外の元素、例えばＳ
ｉＯ２を含ませてもよい。
【００８６】
例えば、Ｉｎ−Ｓｎ−Ｚｎ−Ｏ系酸化物半導体とは、インジウム（Ｉｎ）、錫（Ｓｎ）
、亜鉛（Ｚｎ）を有する酸化物半導体、という意味であり、その組成比は問わない。また
例えば、Ｉｎ−Ｇａ−Ｚｎ−Ｏ系酸化物半導体とは、インジウム（Ｉｎ）、ガリウム（Ｇ
ａ）、亜鉛（Ｚｎ）を有する酸化物半導体、という意味であり、その組成比は問わない。
Ｉｎ−Ｇａ−Ｚｎ−Ｏ系酸化物半導体は、ＩＧＺＯと呼ぶことができる。
【００８７】
また、酸化物半導体としてＩｎ−Ｓｎ−Ｚｎ−Ｏ系の材料を用いる場合、原子数比でＩ
ｎ：Ｓｎ：Ｚｎが、１：２：２、２：１：３、１：１：１、または２０：４５：３５など
となる酸化物ターゲットを用いる。
【００８８】
また、酸化物半導体層７１６は、化学式ＩｎＭＯ３（ＺｎＯ）ｍ（ｍ＞０）で表記され
る薄膜を用いることができる。ここで、Ｍは、Ｚｎ、Ｇａ、Ａｌ、Ｍｎ及びＣｏから選ば
れた一または複数の金属元素を示す。例えばＭとして、Ｇａ、Ｇａ及びＡｌ、Ｇａ及びＭ
ｎ、またはＧａ及びＣｏなどがある。
【００８９】
また、酸化物半導体としてＩｎ−Ｚｎ−Ｏ系の材料を用いる場合、原子数比でＩｎ：Ｚ
ｎ＝５０：１〜１：２（モル数比に換算するとＩｎ２Ｏ３：ＺｎＯ＝２５：１〜１：４）
、好ましくはＩｎ：Ｚｎ＝２０：１〜１：１（モル数比に換算するとＩｎ２Ｏ３：ＺｎＯ
＝１０：１〜１：２）、さらに好ましくはＩｎ：Ｚｎ＝１．５：１〜１５：１（モル数比
に換算するとＩｎ２Ｏ３：ＺｎＯ＝３：４〜１５：２）となる酸化物ターゲットを用いる
。例えば、原子数比がＩｎ：Ｚｎ：Ｏ＝Ｘ：Ｙ：Ｚのとき、Ｚ＞１．５Ｘ＋Ｙとなる酸化
物ターゲットを用いる。
【００９０】
なお、酸化物半導体層７１６は、電子供与体（ドナー）となる水分又は水素などの不純
物が低減されることが好ましい。具体的には、酸化物半導体層７１６は、二次イオン質量
分析法（ＳＩＭＳ：Ｓｅｃｏｎｄａｒｙ  Ｉｏｎ  Ｍａｓｓ  Ｓｐｅｃｔｒｏｍｅｔｒｙ
）による水素濃度の測定値が、５×１０１９／ｃｍ３以下、好ましくは５×１０１８／ｃ
ｍ３以下、より好ましくは５×１０１７／ｃｍ３以下、更に好ましくは１×１０１６／ｃ
ｍ３以下である。
【００９１】
ここで、酸化物半導体層７１６中の、水素濃度の分析について触れておく。酸化物半導
体層中の水素濃度測定は、二次イオン質量分析法で行う。ＳＩＭＳ分析は、その原理上、
試料表面近傍や、材質が異なる層との積層界面近傍のデータを正確に得ることが困難であ
ることが知られている。そこで、層中における水素濃度の厚さ方向の分布をＳＩＭＳで分
析する場合、対象となる層が存在する範囲において、値に極端な変動がなく、ほぼ一定の
値が得られる領域における平均値を、水素濃度として採用する。また、測定の対象となる
層の厚さが小さい場合、隣接する層内の水素濃度の影響を受けて、ほぼ一定の値が得られ
る領域を見いだせない場合がある。この場合、当該層が存在する領域における、水素濃度
の極大値又は極小値を、当該層中の水素濃度として採用する。更に、当該層が存在する領
域において、極大値を有する山型のピーク、極小値を有する谷型のピークが存在しない場
合、変曲点の値を水素濃度として採用する。
【００９２】
酸化物半導体層７１６は、絶縁膜７１３上に形成した酸化物半導体膜を所望の形状に加
工することで、形成することができる。上記酸化物半導体膜の膜厚は、２ｎｍ以上２００
ｎｍ以下、好ましくは３ｎｍ以上５０ｎｍ以下、更に好ましくは３ｎｍ以上２０ｎｍ以下
とする。酸化物半導体膜は、酸化物半導体をターゲットとして用い、スパッタリング法に
より成膜する。また、酸化物半導体膜は、希ガス（例えばアルゴン）雰囲気下、酸素雰囲
気下、又は希ガス（例えばアルゴン）及び酸素混合雰囲気下においてスパッタリング法に
より形成することができる。
【００９３】
スパッタリング法を用いて酸化物半導体層７１６を作製する場合には、ターゲット中の
水素濃度のみならず、チャンバー内に存在する水、水素を極力低減しておくことが重要で
ある。具体的には、当該形成以前にチャンバー内をベークする、チャンバー内に導入され
るガス中の水、水素濃度を低減する、及びチャンバーからガスの排気する排気系における
逆流を防止するなどを行うことが効果的である。
【００９４】
また、酸化物半導体膜をスパッタリング法により成膜する前に、アルゴンガスを導入し
てプラズマを発生させる逆スパッタリングを行い、絶縁膜７１３の表面に付着している塵
埃を除去してもよい。逆スパッタリングとは、ターゲット側に電圧を印加せずに、アルゴ
ン雰囲気下で基板側にＲＦ電源を用いて電圧を印加して基板近傍にプラズマを形成して表
面を改質する方法である。なお、アルゴン雰囲気に代えて窒素、ヘリウムなどを用いても
よい。また、アルゴン雰囲気に酸素、亜酸化窒素などを加えた雰囲気で行ってもよい。ま
た、アルゴン雰囲気に塩素、四フッ化炭素などを加えた雰囲気で行ってもよい。
【００９５】
また、酸化物半導体膜に水素、水酸基及び水分がなるべく含まれないようにするために
、成膜の前処理として、スパッタリング装置の予備加熱室で絶縁膜７１２及び絶縁膜７１
３までが形成された基板７００を予備加熱し、基板７００に吸着した水分又は水素などの
不純物を脱離し排気してもよい。なお、予備加熱の温度は、１００℃以上４００℃以下、
好ましくは１５０℃以上３００℃以下である。また、予備加熱室に設ける排気手段はクラ
イオポンプが好ましい。なお、この予備加熱の処理は省略することもできる。また、この
予備加熱は、後に行われる絶縁膜７１７の成膜前に基板７００にも同様に行ってもよい。
【００９６】
本実施の形態では、Ｉｎ（インジウム）、Ｇａ（ガリウム）、及びＺｎ（亜鉛）を含む
ターゲットを用いたスパッタリング法により得られる膜厚３０ｎｍのＩｎ−Ｇａ−Ｚｎ−
Ｏ系酸化物半導体の薄膜を、酸化物半導体膜として用いる。上記ターゲットとして、例え
ば、各金属の組成比がＩｎ：Ｇａ：Ｚｎ＝１：１：０．５、Ｉｎ：Ｇａ：Ｚｎ＝１：１：
１、又はＩｎ：Ｇａ：Ｚｎ＝１：１：２であるターゲットを用いることができる。また、
Ｉｎ、Ｇａ、及びＺｎを含むターゲットの充填率は９０％以上１００％以下、好ましくは
９５％以上１００％未満である。充填率の高いターゲットを用いることにより、成膜した
酸化物半導体膜は緻密な膜となる。
【００９７】
本実施の形態では、減圧状態に保持された処理室内に基板を保持し、処理室内の残留水
分を除去しつつ水素及び水分が除去されたスパッタリングガスを導入し、上記ターゲット
を用いて酸化物半導体膜を成膜する。成膜時に、基板温度を１００℃以上６００℃以下、
好ましくは２００℃以上４００℃以下としても良い。基板を加熱しながら成膜することに
より、成膜した酸化物半導体膜に含まれる不純物濃度を低減することができる。また、ス
パッタリングによる損傷が軽減される。処理室内の残留水分を除去するためには、吸着型
の真空ポンプを用いることが好ましい。例えば、クライオポンプ、イオンポンプ、チタン
サブリメーションポンプを用いることが好ましい。また、排気手段としては、ターボポン
プにコールドトラップを加えたものであってもよい。クライオポンプを用いて処理室を排
気すると、例えば、水素原子、水（Ｈ２Ｏ）など水素原子を含む化合物（より好ましくは
炭素原子を含む化合物も）等が排気されるため、当該処理室で成膜した酸化物半導体膜に
含まれる不純物の濃度を低減できる。
【００９８】
成膜条件の一例としては、基板とターゲットの間との距離を１００ｍｍ、圧力０．６Ｐ
ａ、直流（ＤＣ）電源０．５ｋＷ、酸素（酸素流量比率１００％）雰囲気下の条件が適用
される。なお、パルス直流（ＤＣ）電源を用いると、成膜時に発生する塵埃が軽減でき、
膜厚分布も均一となるために好ましい。
【００９９】
また、スパッタリング装置の処理室のリークレートを１×１０−１０Ｐａ・ｍ３／秒以
下とすることで、スパッタリング法による成膜途中における酸化物半導体膜への、アルカ
リ金属、水素化物等の不純物の混入を低減することができる。また、排気系として上述し
た吸着型の真空ポンプを用いることで、排気系からのアルカリ金属、水素原子、水素分子
、水、水酸基、または水素化物等の不純物の逆流を低減することができる。
【０１００】
また、ターゲットの純度を、９９．９９％以上とすることで、酸化物半導体膜に混入す
るアルカリ金属、水素原子、水素分子、水、水酸基、または水素化物等を低減することが
できる。また、当該ターゲットを用いることで、酸化物半導体膜において、リチウム、ナ
トリウム、カリウム等のアルカリ金属の濃度を低減することができる。
【０１０１】
なお、酸化物半導体は不純物に対して鈍感であり、膜中にはかなりの金属不純物が含ま
れていても問題がなく、ナトリウム（Ｎａ）のようなアルカリ金属が多量に含まれる廉価
なソーダ石灰ガラスも使えると指摘されている（神谷、野村、細野、「アモルファス酸化
物半導体の物性とデバイス開発の現状」、固体物理、２００９年９月号、Ｖｏｌ．４４、
ｐｐ．６２１−６３３．）。しかし、このような指摘は適切でない。アルカリ金属は酸化
物半導体を構成する元素ではないため、不純物である。アルカリ土類金属も、酸化物半導
体を構成する元素ではない場合において、不純物となる。特に、アルカリ金属のうちＮａ
は、酸化物半導体層に接する絶縁膜が酸化物である場合、当該絶縁膜中に拡散してＮａ＋
となる。また、Ｎａは、酸化物半導体層内において、酸化物半導体を構成する金属と酸素
の結合を分断する、或いは、その結合中に割り込む。その結果、例えば、閾値電圧がマイ
ナス方向にシフトすることによるノーマリオン化、移動度の低下等の、トランジスタの特
性の劣化が起こり、加えて、特性のばらつきも生じる。この不純物によりもたらされるト
ランジスタの特性の劣化と、特性のばらつきは、酸化物半導体層中の水素濃度が十分に低
い場合において顕著に現れる。従って、酸化物半導体層中の水素濃度が１×１０１８／ｃ
ｍ３以下、より好ましくは１×１０１７／ｃｍ３以下である場合には、上記不純物の濃度
を低減することが望ましい。具体的に、二次イオン質量分析法によるＮａ濃度の測定値は
、５×１０１６／ｃｍ３以下、好ましくは１×１０１６／ｃｍ３以下、更に好ましくは１
×１０１５／ｃｍ３以下とするとよい。同様に、Ｌｉ濃度の測定値は、５×１０１５／ｃ
ｍ３以下、好ましくは１×１０１５／ｃｍ３以下とするとよい。同様に、Ｋ濃度の測定値
は、５×１０１５／ｃｍ３以下、好ましくは１×１０１５／ｃｍ３以下とするとよい。
【０１０２】
酸化物半導体膜は、単結晶、多結晶（ポリクリスタルともいう。）または非晶質などの
状態をとる。
【０１０３】
好ましくは、酸化物半導体膜は、ＣＡＡＣ−ＯＳ（Ｃ  Ａｘｉｓ  Ａｌｉｇｎｅｄ  Ｃ
ｒｙｓｔａｌｌｉｎｅ  Ｏｘｉｄｅ  Ｓｅｍｉｃｏｎｄｕｃｔｏｒ）膜とする。
【０１０４】
ＣＡＡＣ−ＯＳ膜は、完全な単結晶ではなく、完全な非晶質でもない。ＣＡＡＣ−ＯＳ
膜は、非晶質相に結晶部を有する結晶−非晶質混相構造の酸化物半導体膜である。なお、
当該結晶部は、一辺が１００ｎｍ未満の立方体内に収まる大きさであることが多い。また
、透過型電子顕微鏡（ＴＥＭ：Ｔｒａｎｓｍｉｓｓｉｏｎ  Ｅｌｅｃｔｒｏｎ  Ｍｉｃｒ
ｏｓｃｏｐｅ）による観察像では、ＣＡＡＣ−ＯＳ膜に含まれる非晶質部と結晶部との境
界は明確ではない。また、ＴＥＭによってＣＡＡＣ−ＯＳ膜には粒界（グレインバウンダ
リーともいう。）は確認できない。そのため、ＣＡＡＣ−ＯＳ膜は、粒界に起因する電子
移動度の低下が抑制される。
【０１０５】
ＣＡＡＣ−ＯＳ膜に含まれる結晶部は、ｃ軸がＣＡＡＣ−ＯＳ膜の被形成面の法線ベク
トルまたは表面の法線ベクトルに平行な方向に揃い、かつａｂ面に垂直な方向から見て三
角形状または六角形状の原子配列を有し、ｃ軸に垂直な方向から見て金属原子が層状また
は金属原子と酸素原子とが層状に配列している。なお、異なる結晶部間で、それぞれａ軸
およびｂ軸の向きが異なっていてもよい。本明細書において、単に垂直と記載する場合、
８５°以上９５°以下の範囲も含まれることとする。また、単に平行と記載する場合、−
５°以上５°以下の範囲も含まれることとする。
【０１０６】
なお、ＣＡＡＣ−ＯＳ膜において、結晶部の分布が一様でなくてもよい。例えば、ＣＡ
ＡＣ−ＯＳ膜の形成過程において、酸化物半導体膜の表面側から結晶成長させる場合、被
形成面の近傍に対し表面の近傍では結晶部の占める割合が高くなることがある。また、Ｃ
ＡＡＣ−ＯＳ膜へ不純物を添加することにより、当該不純物添加領域において結晶部が非
晶質化することもある。
【０１０７】
ＣＡＡＣ−ＯＳ膜に含まれる結晶部のｃ軸は、ＣＡＡＣ−ＯＳ膜の被形成面の法線ベク
トルまたは表面の法線ベクトルに平行な方向に揃うため、ＣＡＡＣ−ＯＳ膜の形状（被形
成面の断面形状または表面の断面形状）によっては互いに異なる方向を向くことがある。
なお、結晶部のｃ軸の方向は、ＣＡＡＣ−ＯＳ膜が形成されたときの被形成面の法線ベク
トルまたは表面の法線ベクトルに平行な方向となる。結晶部は、成膜することにより、ま
たは成膜後に加熱処理などの結晶化処理を行うことにより形成される。
【０１０８】
ＣＡＡＣ−ＯＳ膜を用いたトランジスタは、可視光や紫外光の照射による電気特性の変
動を低減することが可能である。よって、当該トランジスタは、信頼性が高い。
【０１０９】
なお、酸化物半導体膜を構成する酸素の一部は窒素で置換されてもよい。
【０１１０】
ＣＡＡＣ−ＯＳ膜に含まれる結晶構造の一例について図１０乃至図１２を用いて詳細に
説明する。なお、特に断りがない限り、図１０乃至図１２は上方向をｃ軸方向とし、ｃ軸
方向と直交する面をａｂ面とする。なお、単に上半分、下半分という場合、ａｂ面を境に
した場合の上半分、下半分をいう。また、図１０において、丸で囲まれたＯ原子は４配位
のＯ原子を示し、二重丸で囲まれたＯ原子は３配位のＯ原子を示す。
【０１１１】
図１０（Ａ）に、１個の６配位のＩｎ原子と、Ｉｎ原子に近接の６個の４配位の酸素原
子（以下４配位のＯ原子）と、を有する構造を示す。Ｉｎ原子が１個に対して、近接の酸
素原子のみ示した構造を、ここではサブユニットと呼ぶ。図１０（Ａ）の構造は、八面体
構造をとるが、簡単のため平面構造で示している。なお、図１０（Ａ）の上半分および下
半分にはそれぞれ３個ずつ４配位のＯ原子がある。図１０（Ａ）に示すサブユニットは電
荷が０である。
【０１１２】
図１０（Ｂ）に、１個の５配位のＧａ原子と、Ｇａ原子に近接の３個の３配位の酸素原
子（以下３配位のＯ原子）と、Ｇａ原子に近接の２個の４配位のＯ原子と、を有する構造
を示す。３配位のＯ原子は、いずれもａｂ面に存在する。図１０（Ｂ）の上半分および下
半分にはそれぞれ１個ずつ４配位のＯ原子がある。また、Ｉｎ原子も５配位をとるため、
図１０（Ｂ）に示す構造をとりうる。図１０（Ｂ）に示すサブユニットは電荷が０である
。
【０１１３】
図１０（Ｃ）に、１個の４配位のＺｎ原子と、Ｚｎ原子に近接の４個の４配位のＯ原子
と、による構造を示す。図１０（Ｃ）の上半分には１個の４配位のＯ原子があり、下半分
には３個の４配位のＯ原子がある。または、図１０（Ｃ）の上半分に３個の４配位のＯ原
子があり、下半分に１個の４配位のＯ原子があってもよい。図１０（Ｃ）に示すサブユニ
ットは電荷が０である。
【０１１４】
図１０（Ｄ）に、１個の６配位のＳｎ原子と、Ｓｎ原子に近接の６個の４配位のＯ原子
と、を有する構造を示す。図１０（Ｄ）の上半分には３個の４配位のＯ原子があり、下半
分には３個の４配位のＯ原子がある。図１０（Ｄ）に示すサブユニットは電荷が＋１とな
る。
【０１１５】
図１０（Ｅ）に、２個のＺｎ原子を含むサブユニットを示す。図１０（Ｅ）の上半分に
は１個の４配位のＯ原子があり、下半分には１個の４配位のＯ原子がある。図１０（Ｅ）
に示すサブユニットは電荷が−１となる。
【０１１６】
ここでは、サブユニットのいくつかの集合体を１グループと呼び、グループのいくつか
の集合体を１ユニットと呼ぶ。
【０１１７】
ここで、これらのサブユニット同士結合する規則について説明する。図１０（Ａ）に示
す６配位のＩｎ原子の上半分の３個のＯ原子は下方向にそれぞれ３個の近接Ｉｎ原子を有
し、下半分の３個のＯ原子は上方向にそれぞれ３個の近接Ｉｎ原子を有する。図１０（Ｂ
）に示す５配位のＧａ原子の上半分の１個のＯ原子は下方向に１個の近接Ｇａ原子を有し
、下半分の１個のＯ原子は上方向に１個の近接Ｇａ原子を有する。図１０（Ｃ）に示す４
配位のＺｎ原子の上半分の１個のＯ原子は下方向に１個の近接Ｚｎ原子を有し、下半分の
３個のＯ原子は上方向にそれぞれ３個の近接Ｚｎ原子を有する。この様に、金属原子の上
方向の４配位のＯ原子の数と、そのＯ原子の下方向にある近接金属原子の数は等しく、同
様に金属原子の下方向の４配位のＯ原子の数と、そのＯ原子の上方向にある近接金属原子
の数は等しい。Ｏ原子は４配位なので、下方向にある近接金属原子の数と、上方向にある
近接金属原子の数の和は４になる。従って、金属原子の上方向にある４配位のＯ原子の数
と、別の金属原子の下方向にある４配位のＯ原子の数との和が４個のとき、金属原子を有
する二種のサブユニット同士は結合することができる。例えば、６配位の金属原子（Ｉｎ
またはＳｎ）が下半分の４配位のＯ原子を介して結合する場合、４配位のＯ原子が３個で
あるため、５配位の金属原子（ＧａまたはＩｎ）または４配位の金属原子（Ｚｎ）のいず
れかと結合することになる。
【０１１８】
これらの配位数を有する金属原子は、ｃ軸方向において、４配位のＯ原子を介して結合
する。また、このほかにも、層構造の合計の電荷が０となるようにサブユニット同士が結
合して１グループを構成する。
【０１１９】
図１１（Ａ）に、Ｉｎ−Ｓｎ−Ｚｎ−Ｏ系の層構造を構成する１グループのモデル図を
示す。図１１（Ｂ）に、３つのグループで構成されるユニットを示す。なお、図１１（Ｃ
）は、図１１（Ｂ）の層構造をｃ軸方向から観察した場合の原子配列を示す。
【０１２０】
図１１（Ａ）においては、簡単のため、３配位のＯ原子は省略し、４配位のＯは個数の
み示し、例えば、Ｓｎ原子の上半分および下半分にはそれぞれ３個ずつ４配位のＯ原子が
あることを丸枠の３として示している。同様に、図１１（Ａ）において、Ｉｎ原子の上半
分および下半分にはそれぞれ１個ずつ４配位のＯ原子があり、丸枠の１として示している
。また、同様に、図１１（Ａ）において、下半分には１個の４配位のＯ原子があり、上半
分には３個の４配位のＯ原子があるＺｎ原子と、上半分には１個の４配位のＯ原子があり
、下半分には３個の４配位のＯ原子があるＺｎ原子とを示している。
【０１２１】
図１１（Ａ）において、Ｉｎ−Ｓｎ−Ｚｎ−Ｏ系の層構造を構成するグループは、上か
ら順に４配位のＯ原子が３個ずつ上半分および下半分にあるＳｎ原子が、４配位のＯ原子
が１個ずつ上半分および下半分にあるＩｎ原子と結合し、そのＩｎ原子が、上半分に３個
の４配位のＯ原子があるＺｎ原子と結合し、そのＺｎ原子の下半分の１個の４配位のＯ原
子を介して４配位のＯ原子が３個ずつ上半分および下半分にあるＩｎ原子と結合し、その
Ｉｎ原子が、上半分に１個の４配位のＯ原子があるＺｎ原子２個からなるサブユニットと
結合し、このサブユニットの下半分の１個の４配位のＯ原子を介して４配位のＯ原子が３
個ずつ上半分および下半分にあるＳｎ原子と結合している構成である。グループのいくつ
かを結合して１ユニットを構成する。
【０１２２】
ここで、３配位のＯ原子および４配位のＯ原子の場合、結合１本当たりの電荷はそれぞ
れ−０．６６７、−０．５と考えることができる。例えば、Ｉｎ（６配位または５配位）
原子、Ｚｎ（４配位）原子、Ｓｎ（５配位または６配位）原子の電荷は、それぞれ＋３、
＋２、＋４である。従って、Ｓｎ原子を含むサブユニットは電荷が＋１となる。そのため
、Ｓｎ原子を含む層構造を形成するためには、電荷＋１を打ち消す電荷−１が必要となる
。電荷−１をとる構造として、図１０（Ｅ）に示すように、２個のＺｎ原子を含むサブユ
ニットが挙げられる。例えば、Ｓｎ原子を含むサブユニットが１個に対し、２個のＺｎ原
子を含むサブユニットが１個あれば、電荷が打ち消されるため、層構造の合計の電荷を０
とすることができる。
【０１２３】
また、Ｉｎ原子は５配位および６配位のいずれもとることができるものとする。具体的
には、図１１（Ｂ）に示したユニットとすることで、Ｉｎ−Ｓｎ−Ｚｎ−Ｏ系の結晶（Ｉ
ｎ２ＳｎＺｎ３Ｏ８）を得ることができる。なお、得られるＩｎ−Ｓｎ−Ｚｎ−Ｏ系の層
構造は、Ｉｎ２ＳｎＺｎ２Ｏ７（ＺｎＯ）ｍ（ｍは０または自然数。）とする組成式で表
すことができる。
【０１２４】
また、このほかにも、四元系金属の酸化物であるＩｎ−Ｓｎ−Ｇａ−Ｚｎ−Ｏ系酸化物
や、三元系金属の酸化物であるＩｎ−Ｇａ−Ｚｎ−Ｏ系酸化物（ＩＧＺＯとも表記する。
）、Ｉｎ−Ａｌ−Ｚｎ−Ｏ系酸化物、Ｓｎ−Ｇａ−Ｚｎ−Ｏ系酸化物、Ａｌ−Ｇａ−Ｚｎ
−Ｏ系酸化物、Ｓｎ−Ａｌ−Ｚｎ−Ｏ系酸化物や、二元系金属の酸化物であるＩｎ−Ｚｎ
−Ｏ系酸化物、Ｓｎ−Ｚｎ−Ｏ系酸化物、Ａｌ−Ｚｎ−Ｏ系酸化物、Ｚｎ−Ｍｇ−Ｏ系酸
化物、Ｓｎ−Ｍｇ−Ｏ系酸化物、Ｉｎ−Ｍｇ−Ｏ系酸化物や、Ｉｎ−Ｇａ−Ｏ系酸化物、
一元系金属の酸化物であるＩｎ−Ｏ系酸化物、Ｓｎ−Ｏ系酸化物、Ｚｎ−Ｏ系酸化物など
を用いた場合も同様である。
【０１２５】
例えば、図１２（Ａ）に、Ｉｎ−Ｇａ−Ｚｎ−Ｏ系の層構造を構成する１グループのモ
デル図を示す。
【０１２６】
図１２（Ａ）において、Ｉｎ−Ｇａ−Ｚｎ−Ｏ系の層構造を構成するグループは、上か
ら順に４配位のＯ原子が３個ずつ上半分および下半分にあるＩｎ原子が、４配位のＯ原子
が１個上半分にあるＺｎ原子と結合し、そのＺｎ原子の下半分の３個の４配位のＯ原子を
介して、４配位のＯ原子が１個ずつ上半分および下半分にあるＧａ原子と結合し、そのＧ
ａ原子の下半分の１個の４配位のＯ原子を介して、４配位のＯ原子が３個ずつ上半分およ
び下半分にあるＩｎ原子と結合している構成である。グループのいくつかを結合して１ユ
ニットを構成する。
【０１２７】
図１２（Ｂ）に３つのグループで構成されるユニットを示す。なお、図１２（Ｃ）は、
図１２（Ｂ）の層構造をｃ軸方向から観察した場合の原子配列を示している。
【０１２８】
ここで、Ｉｎ（６配位または５配位）原子、Ｚｎ（４配位）原子、Ｇａ（５配位）原子
の電荷は、それぞれ＋３、＋２、＋３であるため、Ｉｎ原子、Ｚｎ原子およびＧａ原子の
いずれかを含むサブユニットは、電荷が０となる。そのため、これらのサブユニットの組
み合わせであればグループの合計の電荷は常に０となる。
【０１２９】
また、Ｉｎ−Ｇａ−Ｚｎ−Ｏ系の層構造を構成するグループは、図１２（Ａ）に示した
グループに限定されず、Ｉｎ原子、Ｇａ原子、Ｚｎ原子の配列が異なるグループを組み合
わせたユニットも取りうる。
【０１３０】
ＣＡＡＣ−ＯＳ膜は、スパッタリング法によって作製することができる。ターゲット材
料は上述のとおりの材料を用いることができる。スパッタリング法を用いてＣＡＡＣ−Ｏ
Ｓ膜を成膜する場合には、雰囲気中の酸素ガス比が高い方が好ましい。例えば、アルゴン
及び酸素の混合ガス雰囲気中でスパッタリング法を行う場合には、酸素ガス比を３０％以
上とすることが好ましく、４０％以上とすることがより好ましい。雰囲気中からの酸素の
補充によって、ＣＡＡＣ−ＯＳ膜の結晶化が促進されるからである。
【０１３１】
また、スパッタリング法を用いてＣＡＡＣ−ＯＳ膜を成膜する場合には、ＣＡＡＣ−Ｏ
Ｓ膜が成膜される基板を１５０℃以上に加熱しておくことが好ましく、１７０℃以上に加
熱しておくことがより好ましい。基板温度の上昇に伴って、ＣＡＡＣ−ＯＳ膜の結晶化が
促進されるからである。
【０１３２】
また、ＣＡＡＣ−ＯＳ膜に対して、窒素雰囲気中又は真空中において熱処理を行った後
には、酸素雰囲気中又は酸素と他のガスとの混合雰囲気中において熱処理を行うことが好
ましい。先の熱処理で生じる酸素欠損を後の熱処理における雰囲気中からの酸素供給によ
って復元することができるからである。
【０１３３】
また、ＣＡＡＣ−ＯＳ膜が成膜される膜表面（被成膜面）は平坦であることが好ましい
。ＣＡＡＣ−ＯＳ膜は、当該被成膜面に概略垂直となるｃ軸を有するため、当該被成膜面
に存在する凹凸は、ＣＡＡＣ−ＯＳ膜における結晶粒界の発生を誘発することになるから
である。よって、ＣＡＡＣ−ＯＳ膜が成膜される前に当該被成膜表面に対して化学機械研
磨（Ｃｈｅｍｉｃａｌ  Ｍｅｃｈａｎｉｃａｌ  Ｐｏｌｉｓｈｉｎｇ：ＣＭＰ）などの平
坦化処理を行うことが好ましい。また、当該被成膜面の平均ラフネスは、０．５ｎｍ以下
であることが好ましく、０．３ｎｍ以下であることがより好ましい。
【０１３４】
なお、スパッタリング等で成膜された酸化物半導体膜中には、不純物としての水分又は
水素（水酸基を含む）が含まれていることがある。本発明の一態様では、酸化物半導体膜
中の水分又は水素などの不純物を低減（脱水化または脱水素化）するために、減圧雰囲気
下、窒素や希ガスなどの不活性ガス雰囲気下、酸素ガス雰囲気下、又は超乾燥エア（ＣＲ
ＤＳ（キャビティリングダウンレーザー分光法）方式の露点計を用いて測定した場合の水
分量が２０ｐｐｍ（露点換算で−５５℃）以下、好ましくは１ｐｐｍ以下、好ましくは１
０ｐｐｂ以下の空気）雰囲気下で、酸化物半導体膜に加熱処理を施す。
【０１３５】
酸化物半導体膜に加熱処理を施すことで、酸化物半導体膜中の水分又は水素を脱離させ
ることができる。具体的には、２５０℃以上７５０℃以下、好ましくは４００℃以上基板
の歪み点未満の温度で加熱処理を行えば良い。例えば、５００℃、３分間以上６分間以下
で行えばよい。加熱処理にＲＴＡ法を用いれば、短時間に脱水化又は脱水素化が行えるた
め、ガラス基板の歪点を超える温度でも処理することができる。
【０１３６】
本実施の形態では、加熱処理装置の一つである電気炉を用いる。
【０１３７】
なお、加熱処理装置は電気炉に限られず、抵抗発熱体などの発熱体からの熱伝導又は熱
輻射によって、被処理物を加熱する装置を備えていてもよい。例えば、ＧＲＴＡ（Ｇａｓ
Ｒａｐｉｄ  Ｔｈｅｒｍａｌ  Ａｎｎｅａｌｉｎｇ）装置、ＬＲＴＡ（Ｌａｍｐ  Ｒａ
ｐｉｄ  Ｔｈｅｒｍａｌ  Ａｎｎｅａｌｉｎｇ）装置等のＲＴＡ（Ｒａｐｉｄ  Ｔｈｅｒ
ｍａｌ  Ａｎｎｅａｌｉｎｇ）装置を用いることができる。ＬＲＴＡ装置は、ハロゲンラ
ンプ、メタルハライドランプ、キセノンアークランプ、カーボンアークランプ、高圧ナト
リウムランプ、高圧水銀ランプなどのランプから発する光（電磁波）の輻射により、被処
理物を加熱する装置である。ＧＲＴＡ装置は、高温のガスを用いて加熱処理を行う装置で
ある。気体には、アルゴンなどの希ガス、又は窒素のような、加熱処理によって被処理物
と反応しない不活性気体が用いられる。
【０１３８】
加熱処理においては、窒素、又はヘリウム、ネオン、アルゴン等の希ガスに、水分又は
水素などが含まれないことが好ましい。又は、加熱処理装置に導入する窒素、又はヘリウ
ム、ネオン、アルゴン等の希ガスの純度を、６Ｎ（９９．９９９９％）以上、好ましくは
７Ｎ（９９．９９９９９％）以上、（即ち不純物濃度を１ｐｐｍ以下、好ましくは０．１
ｐｐｍ以下）とすることが好ましい。
【０１３９】
以上の工程により、酸化物半導体膜中の水素の濃度を低減することができる。
【０１４０】
こうして酸化物半導体膜中の水分又は水素を脱離させた後、酸化物半導体膜（または、
これを用いて形成した酸化物半導体層）に酸素を添加（供給）する。こうして、酸化物半
導体膜（酸化物半導体層）中やその界面等における酸素欠陥を低減し、酸化物半導体層を
ｉ型化又はｉ型に限りなく近くすることができる。
【０１４１】
酸素の添加は、例えば、酸化物半導体膜（または、これを用いて形成した酸化物半導体
層）に接して化学量論的組成比より酸素が多い領域を有する絶縁膜を形成し、その後加熱
することによって行うことができる。こうして、絶縁膜中の過剰な酸素を酸化物半導体膜
（酸化物半導体層）に供給することができる。こうして、酸化物半導体膜（酸化物半導体
層）を酸素を過剰に含む状態とすることができる。過剰に含まれる酸素は、例えば、酸化
物半導体膜（酸化物半導体層）を構成する結晶の格子間に存在する。
【０１４２】
なお、化学量論的組成比より酸素が多い領域を有する絶縁膜は、酸化物半導体膜（酸化
物半導体層）に接する絶縁膜のうち、上層に位置する絶縁膜又は下層に位置する絶縁膜の
うち、どちらか一方のみに用いても良いが、両方の絶縁膜に用いる方が好ましい。化学量
論的組成比より酸素が多い領域を有する絶縁膜を、酸化物半導体膜（酸化物半導体層）に
接する絶縁膜の、上層及び下層に位置する絶縁膜に用い、酸化物半導体膜（酸化物半導体
層）を挟む構成とすることで、上記効果をより高めることができる。
【０１４３】
ここで、化学量論的組成比より酸素が多い領域を有する絶縁膜は、単層の絶縁膜であっ
ても良いし、積層された複数の絶縁膜で構成されていても良い。なお、当該絶縁膜は、水
分や、水素などの不純物を極力含まないことが望ましい。絶縁膜に水素が含まれると、そ
の水素が酸化物半導体膜（酸化物半導体層）へ侵入し、又は水素が酸化物半導体膜（酸化
物半導体層）中の酸素を引き抜き、酸化物半導体膜が低抵抗化（ｎ型化）してしまい、寄
生チャネルが形成されるおそれがある。よって、絶縁膜はできるだけ水素を含まない膜に
なるように、成膜方法に水素を用いないことが重要である。また、絶縁膜には、バリア性
の高い材料を用いるのが望ましい。例えば、バリア性の高い絶縁膜として、窒化珪素膜、
窒化酸化珪素膜、窒化アルミニウム膜、酸化アルミニウム膜、又は窒化酸化アルミニウム
膜などを用いることができる。複数の積層された絶縁膜を用いる場合、窒素の含有比率が
低い酸化珪素膜、酸化窒化珪素膜などの絶縁膜を、上記バリア性の高い絶縁膜よりも、酸
化物半導体膜（酸化物半導体層）に近い側に形成する。そして、窒素の含有比率が低い絶
縁膜を間に挟んで、酸化物半導体膜（酸化物半導体層）と重なるように、バリア性の高い
絶縁膜を形成する。バリア性の高い絶縁膜を用いることで、酸化物半導体膜（酸化物半導
体層）内や他の絶縁膜の界面とその近傍に、水分又は水素などの不純物が入り込むのを防
ぐことができる。また、酸化物半導体膜（酸化物半導体層）に接するように窒素の比率が
低い酸化珪素膜、酸化窒化珪素膜などの絶縁膜を形成することで、バリア性の高い材料を
用いた絶縁膜が直接酸化物半導体膜（酸化物半導体層）に接するのを防ぐことができる。
【０１４４】
また、酸化物半導体膜（酸化物半導体層）中の水分又は水素を脱離させた後の酸素添加
は、酸素雰囲気下で酸化物半導体膜（酸化物半導体層）に加熱処理を施すことによってお
こなってもよい。上記酸素雰囲気下の加熱処理に用いられる酸素ガスには、水、水素など
が含まれないことが好ましい。又は、加熱処理装置に導入する酸素ガスの純度を、６Ｎ（
９９．９９９９％）以上、好ましくは７Ｎ（９９．９９９９９％）以上、（即ち酸素中の
不純物濃度を１ｐｐｍ以下、好ましくは０．１ｐｐｍ以下）とすることが好ましい。
【０１４５】
或いは、酸化物半導体膜（酸化物半導体層）中の水分又は水素を脱離させた後の酸素添
加は、イオン注入法又はイオンドーピング法などを用い行ってもよい。例えば、２．４５
ＧＨｚのマイクロ波でプラズマ化した酸素を酸化物半導体膜（酸化物半導体層）に添加す
れば良い。
【０１４６】
上述のように形成した酸化物半導体膜をエッチングして酸化物半導体層７１６を形成す
る。または、上述のように形成した酸化物半導体層によって酸化物半導体層７１６を形成
する。
【０１４７】
次いで、図５（Ｄ）に示すように、酸化物半導体層７１６上に絶縁膜７１７を形成する
。なお、上述した化学量論的組成比より酸素が多い領域を有する絶縁膜として絶縁膜７１
７を用いてもよい。そして、絶縁膜７１７上において、酸化物半導体層７１６と重なる位
置にゲート電極７２２を形成する。そして、ゲート電極７２２上に絶縁膜７２１を形成す
る。
【０１４８】
また、ゲート電極７２２は、絶縁膜７１７上に導電膜を形成した後、該導電膜をエッチ
ング加工することで形成することができる。ゲート電極７２２は、ゲート電極７０７と同
様の材料を用いて形成することが可能である。
【０１４９】
ゲート電極７２２の膜厚は、１０ｎｍ〜４００ｎｍ、好ましくは１００ｎｍ〜２００ｎ
ｍとする。本実施の形態では、タングステンターゲットを用いたスパッタリング法により
１５０ｎｍのゲート電極用の導電膜を形成した後、該導電膜をエッチングにより所望の形
状に加工することで、ゲート電極７２２を形成する。なお、レジストマスクをインクジェ
ット法で形成してもよい。レジストマスクをインクジェット法で形成するとフォトマスク
を使用しないため、製造コストを低減できる。
【０１５０】
次いで、異方性の高いエッチング方法により基板７００の表面に垂直な方向のエッチン
グ処理を行うことによって、図６（Ａ）に示すように、ゲート電極７２２の側面に設けら
れサイドウォールとして機能する絶縁物７２１ａ及び絶縁物７２１ｂと、ゲート電極７２
２、絶縁物７２１ａ及び絶縁物７２１ｂと重なる部分に残存しゲート絶縁膜として機能す
る絶縁層７１８と、が形成される。
【０１５１】
そして、図６（Ｂ）に示すように、ゲート電極７２２、絶縁物７２１ａ及び絶縁物７２
１ｂをマスクとして酸化物半導体層７１６にｎ型の導電性を付与するドーパントを添加し
、一対の高濃度領域９０８と、その間の領域９０９とを形成する。なお、領域９０９のう
ち、絶縁層７１８を間に挟んでゲート電極７２２と重なる領域がチャネル形成領域となる
。高濃度領域９０８を形成するためのドーパントの添加は、イオン注入法を用いることが
できる。ドーパントは、例えばヘリウム、アルゴン、キセノンなどの希ガスや、窒素、リ
ン、ヒ素、アンチモンなどの１５族原子などを用いることができる。例えば、窒素をドー
パントとして用いた場合、高濃度領域９０８中の窒素原子の濃度は、５×１０１９／ｃｍ
３以上１×１０２２／ｃｍ３以下であることが望ましい。ｎ型の導電性を付与するドーパ
ントが添加されている高濃度領域９０８は、酸化物半導体層７１６中の他の領域に比べて
導電性が高くなる。
【０１５２】
なお、図６（Ｂ）では、絶縁物７２１ａ及び絶縁物７２１ｂと重なる部分の酸化物半導
体層７１６には導電性を付与するドーパントが添加されない構成を示したがこれに限定さ
れない。図５（Ｄ）において、ゲート電極７２２を形成した後、導電性を付与するドーパ
ントを添加することによって、絶縁物７２１ａ及び絶縁物７２１ｂと重なる部分の酸化物
半導体層７１６に不純物領域を形成してもよい。また、図５（Ｄ）において、ゲート電極
７２２を形成した後、導電性を付与するドーパントを添加（第１の添加）し、更に、図６
（Ｂ）において、絶縁物７２１ａ及び絶縁物７２１ｂを形成した後、導電性を付与するド
ーパントを添加（第２の添加）することによって、絶縁物７２１ａ及び絶縁物７２１ｂと
重なる部分に低濃度領域を形成してもよい。当該低濃度領域は、高濃度領域９０８よりも
導電性を付与する不純物元素の濃度が低い。
【０１５３】
そして、図６（Ｃ）に示すように、高濃度領域９０８と接する導電層７１９及び導電層
７２０を形成する。導電層７１９及び導電層７２０は、ソース電極又はドレイン電極とし
て機能する。
【０１５４】
具体的に、導電層７１９及び導電層７２０は、スパッタリング法や真空蒸着法で導電膜
を形成した後、該導電膜を所定の形状に加工することで、形成することができる。
【０１５５】
導電層７１９及び導電層７２０となる導電膜は、アルミニウム、クロム、銅、タンタル
、チタン、モリブデン、タングステンから選ばれた元素、又は上述した元素を成分とする
合金か、上述した元素を組み合わせた合金膜等が挙げられる。また、アルミニウム、銅な
どの金属膜の下側もしくは上側にクロム、タンタル、チタン、モリブデン、タングステン
などの高融点金属膜を積層させた構成としても良い。また、アルミニウム又は銅は、耐熱
性や腐食性の問題を回避するために、高融点金属材料と組み合わせて用いると良い。高融
点金属材料としては、モリブデン、チタン、クロム、タンタル、タングステン、ネオジム
、スカンジウム、イットリウム等を用いることができる。
【０１５６】
また、導電層７１９及び導電層７２０となる導電膜は、単層構造でも、２層以上の積層
構造としてもよい。例えば、シリコンを含むアルミニウム膜の単層構造、アルミニウム膜
上にチタン膜を積層する２層構造、チタン膜と、そのチタン膜上に重ねてアルミニウム膜
を積層し、更にその上にチタン膜を成膜する３層構造などが挙げられる。また、Ｃｕ−Ｍ
ｇ−Ａｌ合金、Ｍｏ−Ｔｉ合金、Ｔｉ、Ｍｏ、は、酸化膜との密着性が高い。よって、下
層にＣｕ−Ｍｇ−Ａｌ合金、Ｍｏ−Ｔｉ合金、Ｔｉ、或いはＭｏで構成される導電膜、上
層にＣｕで構成される導電膜を積層し、上記積層された導電膜を導電層７１９及び導電層
７２０に用いることで、絶縁膜７１３、絶縁物７２１ａ、及び絶縁物７２１ｂと、導電層
７１９及び導電層７２０との密着性を高めることができる。
【０１５７】
また、導電層７１９及び導電層７２０となる導電膜としては、導電性の金属酸化物で形
成しても良い。導電性の金属酸化物としては酸化インジウム、酸化スズ、酸化亜鉛、酸化
インジウム酸化スズ、酸化インジウム酸化亜鉛又は前記金属酸化物材料にシリコン若しく
は酸化シリコンを含ませたものを用いることができる。
【０１５８】
導電膜形成後に加熱処理を行う場合には、この加熱処理に耐える耐熱性を導電膜に持た
せることが好ましい。
【０１５９】
本実施の形態では、導電膜にチタン膜を用いる。そのため、アンモニアと過酸化水素水
を含む溶液（アンモニア過水）を用いて、選択的に導電膜をウェットエッチングすること
ができる。具体的には、３１重量％の過酸化水素水と、２８重量％のアンモニア水と水と
を、体積比５：２：２で混合したアンモニア過水を用いる。或いは、塩素（Ｃｌ２）、塩
化硼素（ＢＣｌ３）などを含むガスを用いて、導電膜をドライエッチングしても良い。
【０１６０】
なお、フォトリソグラフィ工程で用いるフォトマスク数及び工程数を削減するため、透
過した光に多段階の強度をもたせる多階調マスクによって形成されたレジストマスクを用
いてエッチング工程を行ってもよい。多階調マスクを用いて形成したレジストマスクは複
数の膜厚を有する形状となり、エッチングを行うことで更に形状を変形することができる
ため、異なるパターンに加工する複数のエッチング工程に用いることができる。よって、
一枚の多階調マスクによって、少なくとも二種類以上の異なるパターンに対応するレジス
トマスクを形成することができる。よって露光マスク数を削減することができ、対応する
フォトリソグラフィ工程も削減できるため、工程の簡略化が可能となる。
【０１６１】
こうしてトランジスタ１１が形成される。トランジスタ１１では、高濃度領域９０８を
設けることで、ソース電極とドレイン電極（導電層７１９と導電層７２０）の間の抵抗を
下げることができる。
【０１６２】
そして、ソース電極とドレイン電極（導電層７１９と導電層７２０）の間の抵抗を下げ
ることで、トランジスタ１１の微細化を進めても、高いオン電流と、高速動作を確保する
ことができる。また、トランジスタ１１の微細化により、コンパレータ１０００を小型化
することができる。
【０１６３】
また、Ｉｎ−Ｇａ−Ｚｎ−Ｏ系酸化物半導体を酸化物半導体層７１６に用いた場合、窒
素を添加した後、３００℃以上６００℃以下で１時間程度加熱処理を施すことにより、高
濃度領域９０８中の酸化物半導体はウルツ鉱型の結晶構造を有するようになる。高濃度領
域９０８中の酸化物半導体がウルツ鉱型の結晶構造を有することで、さらに高濃度領域９
０８の導電性を高め、ソース電極とドレイン電極（導電層７１９と導電層７２０）の間の
抵抗を下げることができる。なお、ウルツ鉱型の結晶構造を有する酸化物半導体を形成し
て、ソース電極とドレイン電極（導電層７１９と導電層７２０）の間の抵抗を効果的に下
げるためには、窒素をドーパントとして用いた場合、高濃度領域９０８中の窒素原子の濃
度を、１×１０２０／ｃｍ３以上７ａｔｏｍｓ％以下とすることが望ましい。しかし、窒
素原子が上記範囲よりも低い濃度であっても、ウルツ鉱型の結晶構造を有する酸化物半導
体が得られる場合もある。
【０１６４】
また、高濃度領域９０８と、ソース電極又はドレイン電極として機能する導電層７１９
及び導電層７２０との間に、ソース領域及びドレイン領域として機能する酸化物導電膜を
設けるようにしても良い。酸化物導電膜の材料としては、酸化亜鉛を成分として含むもの
が好ましく、酸化インジウムを含まないものであることが好ましい。そのような酸化物導
電膜として、酸化亜鉛、酸化亜鉛アルミニウム、酸窒化亜鉛アルミニウム、酸化亜鉛ガリ
ウムなどを適用することができる。
【０１６５】
例えば、酸化物導電膜を形成する場合、酸化物導電膜を形成するためのエッチング加工
と、導電層７１９及び導電層７２０を形成するためのエッチング加工とを一括で行うよう
にしても良い。
【０１６６】
ソース領域及びドレイン領域として機能する酸化物導電膜を設けることで、高濃度領域
９０８と導電層７１９及び導電層７２０の間の抵抗を下げることができるので、トランジ
スタの高速動作を実現させることができる。また、ソース領域及びドレイン領域として機
能する酸化物導電膜を設けることで、トランジスタの耐圧を高めることができる。
【０１６７】
トランジスタ１１は、ソース電極及びドレイン電極（導電層７１９及び導電層７２０）
と、ゲート電極７２２とが重なっていない。すなわち、ソース電極及びドレイン電極（導
電層７１９及び導電層７２０）とゲート電極７２２との間には、絶縁層７１８の膜厚より
も大きい間隔が設けられている。よって、トランジスタ１１は、ソース電極及びドレイン
電極とゲート電極との間に形成される寄生容量を小さく抑えることができるので、高速動
作を実現することができる。
【０１６８】
なお、トランジスタ１１として、チャネルが酸化物半導体層に形成されるトランジスタ
に限定されず、シリコンよりもバンドギャップが広く、真性キャリア密度がシリコンより
も低い半導体材料を、チャネル形成領域に含むトランジスタを用いることもできる。この
ような半導体材料としては、酸化物半導体の他に、例えば、炭化シリコン、窒化ガリウム
などが挙げられる。このような半導体材料をチャネル形成領域に含むことで、オフ電流が
極めて低いトランジスタを実現することができる。
【０１６９】
また、トランジスタ１１はシングルゲート構造のトランジスタを用いて説明したが、必
要に応じて、電気的に接続された複数のゲート電極を有することで、チャネル形成領域を
複数有する、マルチゲート構造のトランジスタも形成することができる。
【０１７０】
なお、酸化物半導体層７１６に接する絶縁膜（本実施の形態においては、絶縁層７１８
が該当する。）は、第１３族元素及び酸素を含む絶縁材料を用いるようにしても良い。酸
化物半導体材料には第１３族元素を含むものが多く、第１３族元素を含む絶縁材料は酸化
物半導体との相性が良く、これを酸化物半導体層に接する絶縁膜に用いることで、酸化物
半導体層との界面の状態を良好に保つことができる。
【０１７１】
第１３族元素を含む絶縁材料とは、絶縁材料に一又は複数の第１３族元素を含むことを
意味する。第１３族元素を含む絶縁材料としては、例えば、酸化ガリウム、酸化アルミニ
ウム、酸化アルミニウムガリウム、酸化ガリウムアルミニウムなどがある。ここで、酸化
アルミニウムガリウムとは、ガリウムの含有量（原子％）よりアルミニウムの含有量（原
子％）が多いものを示し、酸化ガリウムアルミニウムとは、ガリウムの含有量（原子％）
がアルミニウムの含有量（原子％）以上のものを示す。
【０１７２】
例えば、ガリウムを含有する酸化物半導体層に接して絶縁膜を形成する場合に、絶縁膜
に酸化ガリウムを含む材料を用いることで酸化物半導体層と絶縁膜の界面特性を良好に保
つことができる。例えば、酸化物半導体層と酸化ガリウムを含む絶縁膜とを接して設ける
ことにより、酸化物半導体層と絶縁膜の界面における水素のパイルアップを低減すること
ができる。なお、絶縁膜に酸化物半導体の成分元素と同じ族の元素を用いる場合には、同
様の効果を得ることが可能である。例えば、酸化アルミニウムを含む材料を用いて絶縁膜
を形成することも有効である。なお、酸化アルミニウムは、水を透過させにくいという特
性を有しているため、当該材料を用いることは、酸化物半導体層への水の侵入防止という
点においても好ましい。
【０１７３】
また、酸化物半導体層７１６に接する絶縁膜は、酸素雰囲気下による熱処理や、酸素ド
ープなどにより、絶縁材料を化学量論的組成比より酸素が多い状態とすることが好ましい
。酸素ドープとは、酸素をバルクに添加することをいう。なお、当該バルクの用語は、酸
素を薄膜表面のみでなく薄膜内部に添加することを明確にする趣旨で用いている。また、
酸素ドープには、プラズマ化した酸素をバルクに添加する酸素プラズマドープが含まれる
。また、酸素ドープは、イオン注入法又はイオンドーピング法を用いて行ってもよい。
【０１７４】
例えば、酸化物半導体層７１６に接する絶縁膜として酸化ガリウムを用いた場合、酸素
雰囲気下による熱処理や、酸素ドープを行うことにより、酸化ガリウムの組成をＧａ２Ｏ
Ｘ（Ｘ＝３＋α、０＜α＜１）とすることができる。
【０１７５】
また、酸化物半導体層７１６に接する絶縁膜として酸化アルミニウムを用いた場合、酸
素雰囲気下による熱処理や、酸素ドープを行うことにより、酸化アルミニウムの組成をＡ
ｌ２ＯＸ（Ｘ＝３＋α、０＜α＜１）とすることができる。
【０１７６】
また、酸化物半導体層７１６に接する絶縁膜として酸化ガリウムアルミニウム（酸化ア
ルミニウムガリウム）を用いた場合、酸素雰囲気下による熱処理や、酸素ドープを行うこ
とにより、酸化ガリウムアルミニウム（酸化アルミニウムガリウム）の組成をＧａＸＡｌ
２−ＸＯ３＋α（０＜Ｘ＜２、０＜α＜１）とすることができる。
【０１７７】
酸素ドープ処理を行うことにより、化学量論的組成比より酸素が多い領域を有する絶縁
膜を形成することができる。このような領域を備える絶縁膜と酸化物半導体層が接するこ
とにより、絶縁膜中の過剰な酸素が酸化物半導体層に供給され、酸化物半導体層中、又は
酸化物半導体層と絶縁膜の界面における酸素欠陥を低減し、酸化物半導体層をｉ型化又は
ｉ型に限りなく近くすることができる。
【０１７８】
なお、化学量論的組成比より酸素が多い領域を有する絶縁膜は、酸化物半導体層７１６
に接する絶縁膜のうち、上層に位置する絶縁膜又は下層に位置する絶縁膜のうち、どちら
か一方のみに用いても良いが、両方の絶縁膜に用いる方が好ましい。化学量論的組成比よ
り酸素が多い領域を有する絶縁膜を、酸化物半導体層７１６に接する絶縁膜の、上層及び
下層に位置する絶縁膜に用い、酸化物半導体層７１６を挟む構成とすることで、上記効果
をより高めることができる。
【０１７９】
また、酸化物半導体層７１６の上層又は下層に用いる絶縁膜は、上層と下層で同じ構成
元素を有する絶縁膜としても良いし、異なる構成元素を有する絶縁膜としても良い。例え
ば、上層と下層とも、組成がＧａ２ＯＸ（Ｘ＝３＋α、０＜α＜１）の酸化ガリウムとし
ても良いし、上層と下層の一方を組成がＧａ２ＯＸ（Ｘ＝３＋α、０＜α＜１）の酸化ガ
リウムとし、他方を組成がＡｌ２ＯＸ（Ｘ＝３＋α、０＜α＜１）の酸化アルミニウムと
しても良い。
【０１８０】
また、酸化物半導体層７１６に接する絶縁膜は、化学量論的組成比より酸素が多い領域
を有する絶縁膜の積層としても良い。例えば、酸化物半導体層７１６の上層に組成がＧａ
２ＯＸ（Ｘ＝３＋α、０＜α＜１）の酸化ガリウムを形成し、その上に組成がＧａＸＡｌ
２−ＸＯ３＋α（０＜Ｘ＜２、０＜α＜１）の酸化ガリウムアルミニウム（酸化アルミニ
ウムガリウム）を形成してもよい。なお、酸化物半導体層７１６の下層を、化学量論的組
成比より酸素が多い領域を有する絶縁膜の積層としても良いし、酸化物半導体層７１６の
上層及び下層の両方を、化学量論的組成比より酸素が多い領域を有する絶縁膜の積層とし
ても良い。
【０１８１】
次に、図６（Ｄ）に示すように、絶縁膜７２４を形成する。絶縁膜７２４は、ＰＶＤ法
やＣＶＤ法などを用いて形成することができる。また、酸化珪素、酸化窒化珪素、窒化珪
素、酸化ハフニウム、酸化ガリウム、酸化アルミニウム等の無機絶縁材料を含む材料を用
いて形成することができる。なお、絶縁膜７２４には、誘電率の低い材料や、誘電率の低
い構造（多孔性の構造など）を用いることが望ましい。絶縁膜７２４の誘電率を低くする
ことにより、配線や電極などの間に生じる寄生容量を低減し、動作の高速化を図ることが
できるためである。なお、本実施の形態では、絶縁膜７２４を単層構造としているが、本
発明の一態様はこれに限定されず、２層以上の積層構造としても良い。
【０１８２】
次に、絶縁膜７２４に開口部を形成し、導電層７２０の一部を露出させる。その後、絶
縁膜７２４上に、上記開口部において導電層７２０と接する配線７２６を形成する。
【０１８３】
配線７２６は、ＰＶＤ法や、ＣＶＤ法を用いて導電膜を形成した後、当該導電膜をエッ
チング加工することによって形成される。また、導電膜の材料としては、アルミニウム、
クロム、銅、タンタル、チタン、モリブデン、タングステンから選ばれた元素や、上述し
た元素を成分とする合金等を用いることができる。マンガン、マグネシウム、ジルコニウ
ム、ベリリウム、ネオジム、スカンジウムのいずれか、又はこれらを複数組み合わせた材
料を用いてもよい。
【０１８４】
より具体的には、例えば、絶縁膜７２４の開口を含む領域にＰＶＤ法によりチタン膜を
薄く形成し、ＰＶＤ法によりチタン膜を薄く（５ｎｍ程度）形成した後に、開口部に埋め
込むようにアルミニウム膜を形成する方法を適用することができる。ここで、ＰＶＤ法に
より形成されるチタン膜は、被形成面の酸化膜（自然酸化膜など）を還元し、下部電極な
ど（ここでは導電層７２０）との接触抵抗を低減させる機能を有する。また、アルミニウ
ム膜のヒロックを防止することができる。また、チタンや窒化チタンなどによるバリア膜
を形成した後に、メッキ法により銅膜を形成してもよい。
【０１８５】
次に、配線７２６を覆うように絶縁膜７２７を形成する。更に絶縁膜７２７上に導電膜
を形成し、当該導電膜をエッチング加工することによって導電層７３０１を形成する。そ
の後、導電層７３０１を覆うように絶縁膜７３０２を形成し、絶縁膜７３０２上に導電膜
７３０３を形成する。こうして容量素子１６２２を形成することができる。容量素子１６
２２の一対の電極のうちの一方が導電層７３０１に対応し、一対の電極のうちの他方が導
電膜７３０３に対応し、誘電体層が絶縁膜７３０２に対応する。ここで、絶縁膜７２７、
導電層７３０１、絶縁膜７３０２、導電膜７３０３の材料は、その他絶縁膜や導電層と同
様の材料を用いることができる。
【０１８６】
上述した一連の工程により、コンパレータ１０００を作製することができる。
【０１８７】
本実施の形態は、他の実施の形態と適宜組み合わせて実施することが可能である。
【０１８８】
（実施の形態５）
本実施の形態では、酸化物半導体層にチャネルが形成されるトランジスタの電界効果移
動度について説明する。
【０１８９】
酸化物半導体に限らず、実際に測定される絶縁ゲート型トランジスタの電界効果移動度
は、さまざまな理由によって本来の移動度よりも低くなる。移動度を低下させる要因とし
ては半導体内部の欠陥や半導体と絶縁膜との界面の欠陥があるが、Ｌｅｖｉｎｓｏｎモデ
ルを用いると、半導体内部に欠陥がないと仮定した場合の電界効果移動度を理論的に導き
出せる。
【０１９０】
半導体本来の移動度をμ０、測定される電界効果移動度をμとし、半導体中に何らかの
ポテンシャル障壁（粒界等）が存在すると仮定すると、下記式で表現できる。
【０１９１】
【数１】
0006334770.tif 000002
【０１９２】
ここで、Ｅはポテンシャル障壁の高さであり、ｋがボルツマン定数、Ｔは絶対温度であ
る。また、ポテンシャル障壁が欠陥に由来すると仮定すると、Ｌｅｖｉｎｓｏｎモデルで
は、下記式で表される。
【０１９３】
【数２】
0006334770.tif 000003
【０１９４】
ここで、ｅは電気素量、Ｎはチャネル内の単位面積当たりの平均欠陥密度、εは半導体
の誘電率、ｎはチャネルのキャリア面密度、Ｃｏｘは単位面積当たりの容量、Ｖｇはゲー
ト電圧、ｔはチャネルの厚さである。なお、厚さ３０ｎｍ以下の半導体層であれば、チャ
ネルの厚さは半導体層の厚さと同一として差し支えない。
【０１９５】
線形領域におけるドレイン電流Ｉｄは、下記式で表される。
【０１９６】
【数３】
0006334770.tif 000004
【０１９７】
ここで、Ｌはチャネル長、Ｗはチャネル幅であり、ここでは、Ｌ＝Ｗ＝１０μｍである
。また、Ｖｄはドレイン電圧である。上式の両辺をＶｇで割り、更に両辺の対数を取ると
、下記式となる。
【０１９８】
【数４】
0006334770.tif 000005
【０１９９】
この右辺はＶｇの関数である。この式からわかるように、縦軸をｌｎ（Ｉｄ／Ｖｇ）、
横軸を１／Ｖｇとする直線の傾きから欠陥密度Ｎが求められる。すなわち、トランジスタ
のＩｄ―Ｖｇ特性から、欠陥密度を評価できる。
【０２００】
欠陥密度は酸化物半導体の成膜時の基板温度に依存する。図１３は基板加熱温度と欠陥
密度の関係を示す。酸化物半導体としては、インジウム（Ｉｎ）、ガリウム（Ｇａ）、亜
鉛（Ｚｎ）の比率が、Ｉｎ：Ｇａ：Ｚｎ＝１：１：１のものを用いた。基板加熱温度が高
いものは室温で成膜したものよりも欠陥密度が低下することが示される。
【０２０１】
このようにして求めた欠陥密度等をもとに、上記（数１）および上記（数２）よりμ０
＝８０ｃｍ２／Ｖｓが導出される。欠陥の多い酸化物半導体（Ｎ＝１．５×１０１２／ｃ
ｍ２程度）では、移動度は１０ｃｍ２／Ｖｓ程度である。しかし、半導体内部および半導
体と絶縁膜との界面の欠陥が無い理想的な酸化物半導体の移動度は８０ｃｍ２／Ｖｓとな
る。
【０２０２】
ただし、半導体内部に欠陥がなくても、チャネルとゲート絶縁物との界面での散乱によ
ってトランジスタの輸送特性は影響を受ける。すなわち、ゲート絶縁物界面からｘだけ離
れた場所における移動度μ１は、下記式で表される。
【０２０３】
【数５】
0006334770.tif 000006
【０２０４】
ここで、Ｄはゲート方向の電界、Ｂ、ｌは定数である。Ｂおよびｌは、実際の測定結果
より求めることができ、上記の測定結果からは、Ｂ＝２．３８×１０７ｃｍ／ｓ、ｌ＝１
０ｎｍ（界面散乱が及ぶ深さ）である。Ｄが増加する（すなわち、ゲート電圧が高くなる
）と上記（数５）の第２項が増加するため、移動度μ１は低下することがわかる。
【０２０５】
半導体内部の欠陥が無い理想的な酸化物半導体をチャネルに用いたトランジスタの移動
度μ２を計算した結果を図１４に示す。なお、計算にはシノプシス社製デバイスシミュレ
ーションソフト、Ｓｅｎｔａｕｒｕｓ  Ｄｅｖｉｃｅを使用し、酸化物半導体のバンドギ
ャップ、電子親和力、比誘電率、厚さをそれぞれ、３．１５電子ボルト、４．６電子ボル
ト、１５、３０ｎｍとした。さらに、ゲート、ソース、ドレインの仕事関数をそれぞれ、
５．５電子ボルト、４．６電子ボルト、４．６電子ボルトとした。また、ゲート絶縁物の
厚さは３０ｎｍ、比誘電率は４．１とした。チャネル長およびチャネル幅はともに１０μ
ｍ、ドレイン電圧Ｖｄは０．１Ｖである。
【０２０６】
図１４で示されるように、ゲート電圧１Ｖ強で移動度５０ｃｍ２／Ｖｓ以上のピークを
つけるが、ゲート電圧がさらに高くなると、界面散乱が大きくなり、移動度が低下する。
【０２０７】
本実施の形態は、他の実施の形態と適宜組み合わせて実施することが可能である。
【実施例１】
【０２０８】
本発明の一態様に係るチョッパ型のコンパレータを用いた半導体装置を利用することで
、装置を小型化し、信頼性の高い電子機器を提供することが可能である。
【０２０９】
本発明の一態様に係る半導体装置は、表示装置、パーソナルコンピュータ、記録媒体を
備えた画像再生装置（代表的にはＤＶＤ：Ｄｉｇｉｔａｌ  Ｖｅｒｓａｔｉｌｅ  Ｄｉｓ
ｃ等の記録媒体を再生し、その画像を表示しうるディスプレイを有する装置）に用いるこ
とができる。その他に、本発明の一態様に係るチョッパ型のコンパレータを用いた半導体
装置を用いることができる電子機器として、携帯電話、携帯型を含むゲーム機、携帯情報
端末、電子書籍、ビデオカメラ、デジタルスチルカメラなどのカメラ、ゴーグル型ディス
プレイ（ヘッドマウントディスプレイ）、ナビゲーションシステム、音響再生装置（カー
オーディオ、デジタルオーディオプレイヤー等）、複写機、ファクシミリ、プリンター、
プリンター複合機、現金自動預け入れ払い機（ＡＴＭ）、自動販売機などが挙げられる。
【０２１０】
本発明の一態様に係るチョッパ型のコンパレータを用いた半導体装置を、携帯電話、ス
マートフォン、電子書籍などの携帯用の電子機器に応用した場合について説明する。
【０２１１】
図７は、携帯用の電子機器のブロック図である。図７に示す携帯用の電子機器はＲＦ回
路４２１、アナログベースバンド回路４２２、デジタルベースバンド回路４２３、バッテ
リー４２４、電源回路４２５、アプリケーションプロセッサ４２６、フラッシュメモリ４
３０、ディスプレイコントローラ４３１、メモリ回路４３２、ディスプレイ４３３、タッ
チセンサ４３９、音声回路４３７、キーボード４３８などより構成されている。ディスプ
レイ４３３は表示部４３４、ソースドライバ４３５、ゲートドライバ４３６によって構成
されている。アプリケーションプロセッサ４２６はＣＰＵ４２７、ＤＳＰ４２８、インタ
ーフェース４２９を有している。例えば、ＲＦ回路４２１、アナログベースバンド回路４
２２、デジタルベースバンド回路４２３、電源回路４２５、アプリケーションプロセッサ
４２６、フラッシュメモリ４３０、ディスプレイコントローラ４３１、メモリ回路４３２
、ディスプレイ４３３、タッチセンサ４３９、音声回路４３７、のいずれかまたは全てに
上記実施の形態で示したチョッパ型のコンパレータを用いた半導体装置を採用することに
よって、電子機器を小型化し、信頼性を高めることができる。
【０２１２】
図８は電子書籍のブロック図である。電子書籍はバッテリー４５１、電源回路４５２、
マイクロプロセッサ４５３、フラッシュメモリ４５４、音声回路４５５、キーボード４５
６、メモリ回路４５７、タッチパネル４５８、ディスプレイ４５９、ディスプレイコント
ローラ４６０によって構成される。マイクロプロセッサ４５３はＣＰＵ４６１、ＤＳＰ４
６２、インターフェース４６３を有している。例えば、電源回路４５２、ＣＰＵ４６１、
ＤＳＰ４６２、インターフェース４６３、フラッシュメモリ４５４、音声回路４５５、メ
モリ回路４５７、タッチパネル４５８、ディスプレイ４５９、ディスプレイコントローラ
４６０のいずれかまたは全てに上記実施の形態で示したチョッパ型のコンパレータを用い
た半導体装置を採用することで、電子書籍を小型化し、信頼性を高めることができる。
【０２１３】
本実施例は、上記実施の形態と適宜組み合わせて実施することが可能である。
【符号の説明】
【０２１４】
１１    トランジスタ
１１ａ    トランジスタ
１１ｂ    トランジスタ
１１ｃ    トランジスタ
１１ｄ    トランジスタ
１３３    トランジスタ
４２１    ＲＦ回路
４２２    アナログベースバンド回路
４２３    デジタルベースバンド回路
４２４    バッテリー
４２５    電源回路
４２６    アプリケーションプロセッサ
４２７    ＣＰＵ
４２８    ＤＳＰ
４２９    インターフェース
４３０    フラッシュメモリ
４３１    ディスプレイコントローラ
４３２    メモリ回路
４３３    ディスプレイ
４３４    表示部
４３５    ソースドライバ
４３６    ゲートドライバ
４３７    音声回路
４３８    キーボード
４３９    タッチセンサ
４５１    バッテリー
４５２    電源回路
４５３    マイクロプロセッサ
４５４    フラッシュメモリ
４５５    音声回路
４５６    キーボード
４５７    メモリ回路
４５８    タッチパネル
４５９    ディスプレイ
４６０    ディスプレイコントローラ
４６１    ＣＰＵ
４６２    ＤＳＰ
４６３    インターフェース
７００    基板
７０１    絶縁膜
７０２    半導体膜
７０３    絶縁膜
７０４    半導体層
７０７    ゲート電極
７０９    不純物領域
７１０    チャネル形成領域
７１２    絶縁膜
７１３    絶縁膜
７１６    酸化物半導体層
７１７    絶縁膜
７１８    絶縁層
７１９    導電層
７２０    導電層
７２１    絶縁膜
７２２    ゲート電極
７２４    絶縁膜
７２６    配線
７２７    絶縁膜
９０８    高濃度領域
９０９    領域
１０００    コンパレータ
１６２１    インバータ
１６２２    容量素子
１６２４    スイッチ
１６２５    スイッチ
１６２６    スイッチ
２６２１    インバータ
２６２２    容量素子
２６２４    スイッチ
２６２５    スイッチ
２６２６    スイッチ
７２１ａ    絶縁物
７２１ｂ    絶縁物
７２４ｂ    絶縁膜
７２６ｂ    配線
７２７ｂ    絶縁膜
７３０１    導電層
７３０２    絶縁膜
７３０３    導電膜
７２０ａｃ    導電層
７２０ｂｄ    導電層
９０８ａｃ    高濃度領域
９０８ｂｄ    高濃度領域
【図１】
0006334770.tif 000007
【図２】
0006334770.tif 000008
【図３】
0006334770.tif 000009
【図４】
0006334770.tif 000010
【図５】
0006334770.tif 000011
【図６】
0006334770.tif 000012
【図７】
0006334770.tif 000013
【図８】
0006334770.tif 000014
【図９】
0006334770.tif 000015
【図１０】
0006334770.tif 000016
【図１１】
0006334770.tif 000017
【図１２】
0006334770.tif 000018
【図１３】
0006334770.tif 000019
【図１４】
0006334770.tif 000020