(57)【特許請求の範囲】
【請求項１】
第１および第２のトランジスタを差動接続し、該差動接続の部分に第１の電流源を接続し、前記第１および第２のトランジスタのコレクタ側にカレントミラー回路を接続した差動増幅回路と、エミッタを前記第１のトランジスタのベースおよび第２の電流源に接続した第３のトランジスタと、エミッタを前記第２のトランジスタのベースおよび第３の電流源に接続した第４のトランジスタとを備え、前記第３のトランジスタのベースと前記第４のトランジスタのベースにそれぞれ入力信号を入力し、前記カレントミラー回路の出力側から電流を取り出すようにした演算増幅器において、
前記第２のトランジスタのエミッタにベースを接続し、前記第２のトランジスタのコレクタにコレクタを接続し、前記第３のトランジスタのエミッタにエミッタを接続した第５のトランジスタと、
前記第１のトランジスタのエミッタにベースを接続し、前記第１のトランジスタのコレクタにコレクタを接続し、前記第４のトランジスタのエミッタにエミッタを接続した第６のトランジスタと、
を有することを特徴とする演算増幅器。
【請求項２】
請求項１に記載の演算増幅器において、
前記第１、第２、第３、第４、第５、第６のトランジスタを第１の導電型のトランジスタで構成し、前記カレントミラー回路を前記第１の導電型と反対の第２の導電型のトランジスタで構成したことを特徴とする演算増幅器。
【発明の詳細な説明】
【技術分野】
【０００１】
本発明は、応答速度を向上させた演算増幅器に関するものである。
【背景技術】
【０００２】
図６に従来の演算増幅器の構成を示す。Ｑ１，Ｑ２，Ｑ３，Ｑ４はＰＮＰトランジスタ、Ｑ５，Ｑ６はＮＰＮトランジスタ、Ｒ１，Ｒ２は抵抗、Ｃｃは位相補償用コンデンサ、Ｉ１，Ｉ２，Ｉ３は電流源、１はＧｍ増幅器、２はバッファ回路、ＩＮ＋は正転入力端子、ＩＮ−は反転入力端子、ＯＵＴは出力端子、Ｖ＋は高電位電源線、Ｖ−は低電位電源線である。
【０００３】
トランジスタＱ３，Ｑ４と抵抗Ｒ１，Ｒ２と電流源Ｉ１は差動回路を構成し、トランジスタＱ５，Ｑ６はその差動回路の能動負荷としてのカレントミラー回路を構成する。また、トランジスタＱ１と電流源Ｉ２は正転入力側のエミッタホロワを構成し、トランジスタＱ２と電流源Ｉ３は反転入力側のエミッタホロワを構成する。
【０００４】
上記のようにして構成される演算増幅器１０Ａを、図２に示すように、反転入力端子ＩＮ−と出力端子ＯＵＴを直結してボルテージホロワを構成し、正転入力端子ＩＮ＋に低電圧がＶＬ、高電圧がＶＨのパルス信号ＶＩＮ＋が入力されるように接続したとき、安定状態では、出力端子ＯＵＴの電圧ＶＯＵＴは、ＶＯＵＴ＝ＶＩＮ−である。
【０００５】
入力するパルス信号がＶＬであるときは、演算増幅器１０Ａの両端子ＩＮ＋，ＩＮ−の電圧は同じＶＬである。この後、ＶＩＮ＋がＶＨに向けて立ち上がると、トランジスタＱ１，Ｑ３がオフとなり、トランジスタＱ２，Ｑ４がオンとなって、電流源Ｉ１の電流Ｉ１がトランジスタＱ４からトランジスタＱ６に流れ、トランジスタＱ６とカレントミラー関係にあるトランジスタＱ５のコレクタがその電流Ｉ１を引き込む。つまり、トランジスタＱ５のコレクタ電流ＩＣ５はＩＣ５＝Ｉ１となる。このとき、トランジスタＱ３のコレクタ電流ＩＣ３はＩＣ３＝０である。したがって、コレクタ電流ＩＣ５はＧｍ増幅回路１に対する引き込み電流となり、コンデンサＣｃを充電させ、Ｐ点の電圧を上昇させ、この電圧が出力端子ＯＵＴから出力する。このときのその立上り傾斜、つまりスルーレートＳＲは、
ＳＲ＝Ｉ１／Ｃｃ                                    (1)
によって決まる。
【発明の開示】
【発明が解決しようとする課題】
【０００６】
ここで、出力電圧ＶＯＵＴの立上りを速くして応答特性を改善するには、上記スルーレートＳＲの値を大きくすればよく、このためには電流源Ｉ１の電流を大きくするか、あるいは位相補償用コンデンサＣｃの容量値を小さくすればよい。
【０００７】
しかし、このような手法によりスルーレートＳＲを大きくすると、位相余裕が少なくなって、出力電圧ＶＯＵＴに振動が発生し、動作の安定性が損なわれるという問題が発生する。
【０００８】
本発明の目的は、動作の安定性を損なうことなく、応答特性を改善した演算増幅器を提供することである。
【課題を解決するための手段】
【０００９】
上記目的を達成するために、請求項１にかかる発明の演算増幅器は、第１および第２のトランジスタを差動接続し、該差動接続の部分に第１の電流源を接続し、前記第１および第２のトランジスタのコレクタ側にカレントミラー回路を接続した差動増幅回路と、エミッタを前記第１のトランジスタのベースおよび第２の電流源に接続した第３のトランジスタと、エミッタを前記第２のトランジスタのベースおよび第３の電流源に接続した第４のトランジスタとを備え、前記第３のトランジスタのベースと前記第４のトランジスタのベースにそれぞれ入力信号を入力し、前記カレントミラー回路の出力側から電流を取り出すようにした演算増幅器において、前記第２のトランジスタのエミッタにベースを接続し、前記第２のトランジスタのコレクタにコレクタを接続し、前記第３のトランジスタのエミッタにエミッタを接続した第５のトランジスタと、前記第１のトランジスタのエミッタにベースを接続し、前記第１のトランジスタのコレクタにコレクタを接続し、前記第４のトランジスタのエミッタにエミッタを接続した第６のトランジスタと、を有することを特徴とする。
請求項２にかかる発明は、請求項１に記載の演算増幅器において、前記第１、第２、第３、第４、第５、第６のトランジスタを第１の導電型のトランジスタで構成し、前記カレントミラー回路を前記第１の導電型と反対の第２の導電型のトランジスタで構成したことを特徴とする。
【発明の効果】
【００１０】
本発明によれば、入力電圧が低電位から高電位に、および高電位から低電位に遷移する際に、一時的にスルーレートが大きくなるので、動作の安定性を損なうことなく、応答特性を改善することができる。また、回路の消費電流が増加することもない。
【発明を実施するための最良の形態】
【００１１】
以下、本発明の演算増幅器の実施例について説明する。図１はその１つの実施例の回路図である。図６で説明したものと同じものには同じ符号を付けてその詳しい説明は省略する。本実施例では、ＰＮＰトランジスタＱＡ１，ＱＡ２を追加したことを特徴とする。トランジスタＱＡ１は、ベースをトランジスタＱ４のエミッタに、エミッタをトランジスタＱ１のエミッタに、コレクタをトランジスタＱ４のコレクタに接続する。また、トランジスタＱＡ２は、ベースをトランジスタＱ３のエミッタに、エミッタをトランジスタＱ２のエミッタに、コレクタをトランジスタＱ３のコレクタに接続する。
【００１２】
なお、請求項との関係では、第１のトランジスタはＱ３に、第２のトランジスタはＱ４に、第３のトランジスタはＱ１に、第４のトランジスタはＱ２に、第５のトランジスタはＱＡ１に、第６のトランジスタはＱＡ２に、第１の電流源はＩ１に、第２の電流源はＩ２に、第３の電流源はＩ３に、それぞれ相当する。
【００１３】
上記のようにして構成される演算増幅器１０を、図２に示すように、反転入力端子ＩＮ−と出力端子ＯＵＴを直結してボルテージホロワを構成し、正転入力端子ＩＮ＋に低電圧がＶＬ、高電圧がＶＨのパルス信号ＶＩＮ＋が入力されるように接続したときの動作を説明する。
【００１４】
入力するパルス信号がＶＬであるときは、演算増幅器１０Ａの両端子ＩＮ＋，ＩＮ−の電圧は同じＶＬである。この後、ＶＩＮ＋がＶＨに向けて立ち上がると、トランジスタＱ１，Ｑ３がオフとなり、トランジスタＱ２，Ｑ４がオンとなる。トランジスタＱ４がオンとなることにより、電流源Ｉ１の電流Ｉ１がトランジスタＱ６のコレクタに流れ込む。また、このとき同時に、トランジスタＱＡ１もオンとなり、電流源Ｉ２の電流Ｉ２がトランジスタＱ６のコレクタに流れ込む。このため、トランジスタＱ６のコレクタ電流は、Ｉ１＋Ｉ２になる。
【００１５】
よって、トランジスタＱ６とカレントミラー関係にあるトランジスタＱ５のコレクタ電流ＩＣ５はＩＣ５＝Ｉ１＋Ｉ２となる。このとき、トランジスタＱ３のコレクタ電流ＩＣ３はＩＣ３＝０である。したがって、コレクタ電流ＩＣ５は増幅回路１に対する引き込み電流となり、コンデンサＣｃを充電させ、Ｐ点の電圧を上昇させ、この電圧が出力端子ＯＵＴから出力する。このときの出力電圧ＶＯＵＴはＶＩＮ−であり、その立上り傾斜、つまりスルーレートＳＲは、
ＳＲ＝（Ｉ１＋Ｉ２）／Ｃｃ                          (2)
によって決まる。
【００１６】
この式（２）は前記した式(1)に比べて、Ｉ２だけ大きな値を示す。このように、入力電圧ＶＩＮ＋の立上り時には、一時的にスルーレートＳＲが大きくなり、立上りが高速化される。なお、このとき、回路の総電流は図６で説明した回路と全く変化しない。また、このスルーレートＳＲはパルス応答時のみ作用するので、回路の安定性に変化を来すこともない。
【００１７】
図３に図１、図６の演算増幅器１０，１０Ａの応答波形を、図４に同演算増幅器１０，１０ＡのトランジスタＱ５のコレクタ電流ＩＣ５の変化を示す。図３では、入力電圧ＶＩＮ＋を点線で、図１の演算増幅器の出力電圧ＶＯＵＴを実線で、図６の演算増幅器の出力電圧ＶＯＵＴを破線で示した。図４では図１の演算増幅器のコレクタ電流ＩＣ５を実線で、図６の演算増幅器のコレクタ電流ＩＣ５を破線で示した。図３のＶＢＥＱＡ１はトランジスタＱＡ１のベース・エミッタ間に印加する電圧を示す。
【００１８】
本実施例では、入力電圧ＶＩＮ＋がＶＬのときは、トランジスタＱ５のコレクタ電流ＩＣ５は、Ｉ１／２であるが、時刻ｔ１で入力電圧ＶＩＮ＋がＶＨに向けて立ち上がると増大を開始し、電流Ｉ１になる。さらに、時刻ｔ２に至るとトランジスタＱＡ１がオンして、コレクタ電流ＩＣ５は電流Ｉ１＋Ｉ２に増大し、出力電圧ＶＯＵＴがＶＨに近づく時刻ｔ３でトランジスタＱＡ１がオフして電流Ｉ１に戻り、この後時刻ｔ４で電流はＩ１／２に戻る。時刻ｔ６で入力電圧ＶＩＮ＋がＶＬに向けて立ち下がると、今度はトランジスタＱ１，Ｑ３がオフし、トランジスタＱ２，Ｑ４がオンして、この後トランジスタＱＡ２がオンし、前記と逆に、トランジスタＱ３のコレクタ電流ＩＣ３によってコンデンサＣｃが充電され、Ｐ点の電圧が低下する。一方、破線で示す従来例では、コレクタ電流ＩＣ５は最大値がＩ１に留まる。
【００１９】
図５に図２のようにボルテージホロワ接続したときの演算増幅器の応答特性のシミュレーション結果を示す。(a)は図１の本実施例の演算増幅器１０、(b)は図６の従来の演算増幅器１０Ａについてである。いずれも、演算増幅器１０，１０Ａの電圧増幅度Ｇｖ＝１、抵抗ＲＴ＝５０Ω、抵抗ＲＬ＝５００Ω、コンデンサＣＬ＝５ｐＦの条件である。(a)の応答特性が(b)に比べて高速応答を示していることが確認できる。
【００２０】
なお、以上説明した実施例は本発明の一例であり、種々変形が可能である。例えば、抵抗Ｒ１，Ｒ２は必ずしも必要ではない。また、図１で示したトランジスタの導電型（ＰＮＰ，ＮＰＮ）は反対にすることができることは勿論であり、このとき、電流源Ｉ１，Ｉ２，Ｉ３は吸込み用として低電位電源線Ｖ−の側に接続する。
【図面の簡単な説明】
【００２１】
【図１】本発明の１つの実施例の演算増幅器の回路図である。
【図２】本実施例および従来例の演算増幅器をボルテージホロワとして構成した回路図である。
【図３】本実施例および従来例の演算増幅器を図２のボルテージホロワで動作させたときの応答特性図である。
【図４】本実施例および従来例の演算増幅器を図２のボルテージホロワで動作させたときのトランジスタＱ５のコレクタ電流ＩＣ５の特性図である。
【図５】本実施例および従来例の演算増幅器のシミュレーション結果の応答特性図である。
【図６】従来の演算増幅器の回路図である。
【符号の説明】
【００２２】
１：Ｇｍ増幅器
２：バッファ回路
１０，１０Ａ：演算増幅器
【図１】
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【図２】
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【図３】
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【図４】
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【図５】
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【図６】
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