(57)【特許請求の範囲】
【請求項１】
それぞれ関連するスイッチングデバイスを有する液晶表示素子の行列アレーと、これらの表示素子に接続され、これらの表示素子に選択信号およびデータ信号を供給する一組の行アドレス導体および一組の列アドレス導体と、これらの行アドレス導体にそれぞれの行アドレス期間において選択信号を供給する行駆動回路およびこれらの列アドレス導体にデータ信号を供給する列駆動回路とを具え、列駆動回路は１行の表示素子に対するデータ信号を、各々複数の列アドレス導体を含む複数の群の列アドレス導体にそれぞれの群アドレス期間で次々に供給するよう動作し、各群内の複数の列アドレス導体がその群アドレス期間においてそれらの関連するデータ信号のレベルに応じて充電されるよう構成されたアクティブマトリクス液晶表示装置において、
列駆動回路が、１つの行アドレス期間に、各列導体を２つの離間した充電期間で充電し、１つの群に対する第２充電期間が次の群の第１充電期間の後に発生するように構成されていることを特徴とするアクティブマトリクス液晶表示装置。
【請求項２】
２つの順次の群に対する充電期間は時間的に交互配置することを特徴とする請求項１記載のアクティブマトリクス液晶表示装置。
【請求項３】
全ての群に対する第１充電期間が行アドレス期間の第１部分内に発生し、全ての群に対する第２充電期間が行アドレス期間の第２部分内に発生することを特徴とする請求項１記載のアクティブマトリクス液晶表示装置。
【請求項４】
第１および第２充電期間はほぼ同一の持続時間を有することを特徴とする請求項１−３の何れかに記載のアクティブマトリクス液晶表示装置。
【請求項５】
第１充電期間内に、関連する列アドレス導体が少なくとも所要最終レベルの近くまで充電されることを特徴とする請求項１−４の何れかに記載のアクティブマトリクス液晶表示装置。
【発明の詳細な説明】
【０００１】
(技術分野)
本発明は、それぞれ関連するスイッチングデバイスを有する液晶表示素子の行列アレーと、これらの表示素子に接続され、これらの表示素子に選択信号およびデータ信号を供給する一組の行アドレス導体および一組の列アドレス導体と、これらの行アドレス導体にそれぞれの行アドレス期間において選択信号を供給する行駆動回路およびこれらの列アドレス導体にデータ信号を供給する列駆動回路とを具え、列駆動回路は１行の表示素子に対するデータ信号を、各々複数の列アドレス導体を含む複数の群の列アドレス導体にそれぞれの群アドレス期間で次々に供給するよう動作し、各群内の複数の列アドレス導体がその群アドレス期間においてそれらの関連するデータ信号のレベルに応じて充電されるよう構成されたアクティブマトリクス液晶表示装置に関するものである。
【０００２】
(発明の背景)
データグラフィック又はビデオ情報の表示に好適なアクティブマトリクス液晶（ＬＣ）表示装置が公知である。スイッチングデバイスとして各表示素子電極とそれぞれの行及び列アドレス導体との間に接続されたＴＦＴ（薄膜トランジスタ）を用いるこのような装置の代表例およびその一般的な駆動方法がＵＳ-Ａ-５１３０８２９に開示されている。これらの装置では、一組の行アドレス導体に接続された行駆動回路が選択（ゲート制御）信号を各行導体に順次に供給して１行の表示素子のＴＦＴをターンオンさせることにより行導体を走査し、一組の列導体に接続された列駆動回路が、行駆動回路による行導体の走査と同期して、データ信号を列導体に供給することによって、選択した行の表示素子をそれぞれのスイッチングデバイスを経てそれらの関連する列導体上のデータ信号の値に充電して所要の表示出力を発生する。このようにして、１フィールド期間において１つの表示画像を形成するために、全ての行を１行毎に各自の行アドレス期間において順次に駆動するとともに、表示素子のアレーを順次のフィールド期間においてこのように繰り返しアドレスする。
【０００３】
製造及び小型化のために、ある表示装置、特にポリシリコンＴＦＴを使用する表示装置の行及び／又は列駆動回路は、ＴＦＴを担持する基板の表示素子アレーの周囲に、アレーのアクティブマトリクス回路に使用されるのと同一面積の電子技術を用いて集積され、これらの駆動回路はＴＦＴ、導体ライン等と同時に、同一に製造されている。ＴＦＴを使用する場合、使用し得るＴＦＴ及び回路の動作性能の限界のために、列駆動回路は一般に簡単なマルチプレックス回路の形態に設けられる。このマルチプレックス列駆動回路の例が、ＵＳ−Ａ−４８９０１０１や、SID 95 digestの第81−84頁に掲載されているS. Higasi他の論文「A 1.8-in Poli-Si TFT-LCD for HDTV Projector with a 5-V Fully Integrated Driver」に開示されている。この列駆動回路の動作はマルチプレックス技術に基づいている。このマルチプレックス技術では、各群内の各列導体をマルチプレックススイッチを経て異なるビデオ入力ラインに接続し、アナログビデオ情報（データ）をビデオ情報が同時に供給される複数のビデオ入力ラインからマルチプレックススイッチを経て対応する群又はブロックの列アドレス導体に供給する。各列アドレス導体はマルチプレックス回路の１つの出力に接続され、これらの回路では、代表的には、１つの列導体と関連する出力が隣りの列導体に対するデータ信号の供給前又は供給中に高インピーダンスになるよう動作する。行アドレス（ビデオライン）期間中に、マルチプレックス回路は各群の列導体を、表示装置の全ての列導体が入力ライン上のビデオ情報の関連するレベルに対応するレベルに充電されるまで、順番に充電するよう動作する。１つの群の列導体の充電が終了すると、関連するマルチプレックススイッチが開き、列導体は高インピーダンスノードになり、供給された電圧を列導体キャパシタンスに維持し、次に次の群が充電される。回路はこのように動作して全ての群を次々に充電し、各行の表示素子を各自の行アドレス期間中に順次に駆動する。
【０００４】
このような列駆動回路を使用すると、表示素子アレーからの表示出力に問題が生ずることが確かめられている。特に、アレー内の所定の列内の表示素子が誤った駆動レベルになり、アレー内のこれらの列が誤差を示し、これらの列の誤差が、例えば均一なグレー領域の表示時に、表示画像内にはっきり見える垂直線として現われ、表示の均一性の欠如を生ずる。この問題は、表示素子電極を２つの隣接する列アドレス導体（及び行アドレス導体）と部分的にオーバラップするように配置して実行アパーチャ(開口率)を増大させた、例えばＵＳ-Ａ-５６４１９７４及びＥＰ-Ａ-Ｏ６１７３１０に開示されているようなハイアパーチャ（高開口率）形表示装置において特に目立つ。
【０００５】
本発明の目的は、マルチプレックス回路のように動作する列駆動回路を使用するタイプのアクティブマトリクス表示装置であって、上述した不所望な表示出力アーチファクトの問題を克服又は少なくともある程度軽減した表示装置を提供することにある。
【０００６】
(発明の開示)
本発明は、頭書に記載した種類のアクティブマトリクス液晶表示装置において、列駆動回路を、特許請求の範囲に記載の如く構成したことを特徴とする。列導体をこのように複数回充電すると、不所望な表示アーチファクトの程度が大きく減少する。
【０００７】
隣接する列アドレス導体の間に直接的又は間接的に容量結合が生じ得ることが確かであり、このような直接的又は間接的容量結合の存在は、１つの群の第１の列導体の電圧が列駆動回路の動作中に変化すると、この電圧変化がこの容量結合を経て、その前にアドレスされた群の少なくとも最終列導体（次にアドレスされた群に隣接する列導体）に結合され、この最終列導体に設定された電圧を妨害することを意味する。その結果として、各群（最終群は除く）の最終列導体の電圧に誤差が生じ、この誤差は表示画像に上述した可視垂直線を生ずる。影響を受ける列に対し２つ以上の充電期間を用いると、各群の最終列導体に生ずる電圧誤差の大きさが減少する。
【０００８】
列駆動回路は、各列アドレス導体を少なくとも２つの離間した充電期間で充電し、当該群の第２充電期間は次の群の第１充電期間の後に発生するよう構成するのが好ましい。次の群をアドレスする結果その前の群の最終列導体に生ずる電圧誤差が最も大きい。しかし、前の群の他の列導体にも電圧誤差が生ずるが、これらの誤差は次第に小さくなる。場合によっては１つの群内の最後の１つ又は２つの列導体のみを複数回充電するように構成すれば十分であるが、全ての列が同様にアドレスされる場合には、全ての列導体を複数回充電するよう構成して、他の列導体に生ずる誤差も最小にするのが有利である。これは、必要な列駆動回路を設計する際にも好都合である。
【０００９】
列導体は各充電期間内にビデオライン電圧のレベル、即ちデータ信号レベルに完全に充電させる必要はなく、第１充電期間内に部分的に充電するだけとすることができる。しかし、列導体は第１充電期間内に少なくとも所要レベルの近くまで充電するのが好ましい。
【００１０】
好適実施例では、２つの順次の群に対する充電期間を時間的に交互に配置する。例えば、各群に対し２つの充電期間がある場合には、第１群に対する第２充電期間を第２群に対する第１充電期間の後および第２群に対する第２充電期間の前に発生させ、第３群に対する第１および第２充電期間をそれぞれ第２群に対する第２充電期間の前および後に発生させ、以下同様とする。或いは又、列駆動回路はこれらの充電期間を異なる順番に発生するよう構成することもできる。例えば、同一の行アドレス期間内に、全ての群を連続的にアドレスして各々に第１充電期間を与え、次に再び連続的にアドレスして第２充電期間を与え、全ての群および全ての列導体が２つの充電期間を有するも、全ての第１充電期間が第２充電期間の前の発生するように構成することもできる。
【００１１】
（発明の好ましい実施の形態）
以下に、本発明のアクティブマトリクス表示装置の実施例を図面を参照して説明するが、これは単なる例示である。
図1を参照すると、アクティブマトリクス液晶表示装置は液晶表示素子１０の行及び列アレーを具える。図には簡単のため少数の表示素子しか示してないが、実際には数百行及び列の表示素子が存在し得る。これらの各表示素子はスイッチングデバイスとして作用する関連のＴＦＴ１２を具え、行及び列駆動回路３０及び３５により一組の行アドレス導体１４及び一組の列アドレス導体１６を経てアドレスされる。各ＴＦＴ１２のドレインは各行及び列アドレス導体の交点に隣接して位置する各表示素子電極１８に接続され、各行の表示素子１０と関連する全てのＴＦＴのゲートは同一の行アドレス導体１４に接続され、各列の表示素子と関連する全てのＴＦＴのソースは同一の列アドレス導体１６に接続される。一組の行及び列アドレス導体１４、１６、ＴＦＴ１２、及び画素電極１８はすべて同一の絶縁基板、例えばガラス基板上に担持され、種々の導電層、絶縁層及び半導電層の堆積及びフォトリソグラフィックパターニング技術を含む既知の薄膜技術を用いて製造される。アレーの全ての表示素子に共通の連続透明電極を担持する第２のガラス基板（図示せず）を基板２５に対向配置し、両基板をスペーサにより離間させるとともに表示素子アレーの周囲で封止して液晶物質を封入した密閉空間を構成する。各表示素子電極１８と共通電極の対向部分及びそれらの間の液晶物質が光変調表示素子を構成する。
【００１２】
この装置の全体的な構造も動作も、例えばＵＳ-Ａ-５１３０８２９に記載されているような慣例のプラクティスにしたがう。走査（ゲート制御）信号が行駆動回路３０によって各行アドレス導体１４に順番に供給され、アナログ電圧信号からなるデータ信号が列駆動回路３５によって、ゲート制御信号と同期して、列アドレス導体１６に供給される。各行導体にゲート制御信号が供給されると、この行導体に接続されたＴＦＴ１２がターンオンして、それぞれの表示素子を、それらの関連する列導体に存在するデータ信号のレベルに従って充電せしめる。例えば供給ビデオ信号のライン期間に対応する各行アドレス期間の終了時にゲート制御信号が終了すると、関連するＴＦＴがフィールド期間の残部中ターンオフしてこれらの表示素子を電気的に絶縁し、供給された電荷をＬＣキャパシタンスに蓄積してそれらの表示出力を、これらの表示素子が次のフィールド期間において再びアドレスされるまで維持する。
【００１３】
透過形動作モードでは、電極１８は透明導電材料からなり、各表示素子は背面光源から装置の一側、例えば基板２５に向けられた光を、それらの供給データ信号に従って変調するよう作用して、表示画像を反対側から見ることができる。反射形動作モードでは、表示素子電極１８は光反射性導電材料からなり、第２基板を経て装置の前面から入射する光を各表示素子のＬＣ材料でそれらの表示状態に応じて変調するとともに、表示素子電極により反射させて第２基板を経て前方へ戻し、装置の前方で見ることができる表示画像を発生する。
【００１４】
ハイアパーチャ(高開口率)形表示装置のアレーの一部分における表示素子電極と行及び列アドレス導体の代表的な物理的配置の一例を図２に線図的に示す。この図では図の明瞭のためにＴＦＴ１２は省略してあるが、該当表示素子と関連する行及び列導体の交点に隣接して位置する。各表示素子電極１８はＰn,mで表わし、ここでｎ及びｍは行番号及び列番号を示す。従って、電極Ｐn,mは関連する行及び列導体Ｒn及びＣmを経てアドレスされ、電極Ｐn,m+1は行及び列導体Ｒn及びＣm+1を経てアドレスされ、電極Ｐn+1,mは行及び列導体Ｒn+1及びＣmを経てアドレスされ、以下同様である。高開口率を与えるために、表示素子電極１８を、基板上に担持された行及び列アドレス導体及びＴＦＴを具えるアクティブマトリクス回路上に配置された絶縁材料、例えば窒化シリコン又はポリイミドまたはレジストのような有機材料の中間層上に担持し、それらの対向する縦辺の縁部が隣接する列導体１６と部分的にオーバラップするとともにそれらの上辺及び底辺の縁部が隣接する行導体１４とオーバラップするように広げる。従って、各列導体は２つの隣接する列の表示素子の表示素子電極と部分的にオーバラップすること明かである。各表示素子電極１８は絶縁層の下にある関連するＴＦＴのドレインに絶縁層に形成した接点孔（図示せず）を経て接続される。各表示素子電極１８は隣りの表示素子電極から行及び列導体の上の小さな間隙により分離されている。このタイプの構造の例がＵＳ-Ａ-５６４１９７４及びＥＰ-Ａ-０６１７３１０に開示されており、詳細についてはこれらを参照されたい。
【００１５】
行及び列駆動回路３０及び３５は基板２５上に集積され、同一の薄膜製造技術を用いてアクティブマトリクスアレーと同時に製造される。上述した論文に記載されている例のように、通常はポリシリコン技術が使用されるが、場合によってはアモルファスシリコン技術を使用することもできる。集積列駆動回路３５は簡単なマルチプレックス形の回路を具える。このような回路の一般的動作はマルチプレックス技術に基づく。このマルチプレックス技術では、アナログビデオ情報を複数のビデオ入力ラインから表示装置の対応する群の順次の列アドレス導体に順次に転送する。ビデオ情報はマルチプレックススイッチを経て転送され、これらのスイッチはＮＭＯＳＴＦＴ、ＰＭＯＳＴＦＴ又はＣＭＯＳ転送ゲートからなるものとすることができる。これらのスイッチはそれぞれの列導体と関連する回路出力端子を構成し、群毎に駆動され、１つの群のスイッチが駆動されると、対応する列が関連するビデオラインに存在するデータ信号電圧レベルに従って充電される。これらのスイッチがターンオフされると、列導体上の電圧が列導体のキャパシタンス及びこれらのキャパシタンスに並列に接続し得る追加の蓄積キャパシタに蓄積される。各行アドレス（ビデオライン）期間中に、各群のマルチプレックススイッチを次々にターンオンさせ、全ての列の表示素子を適切なビデオ情報で充電させる。
【００１６】
図３はマルチプレックス列駆動回路の既知の例の一部分を簡略線図で示す。この比較的簡単な例では、並列入力ビデオ信号が供給される３つのビデオ入力ラインＶ１，Ｖ２及びＶ３が存在し、マルチプレックススイッチ３６が３つづつ群に配置され、それらの出力は順次の列アドレス導体１６にそれぞれ接続されている。制御回路３７はシフトレジスタを具え（これは基板２５上に集積してもしなくてもよい）、マルチプレックススイッチ群の各群を制御信号Ｇ１，Ｇ２，Ｇ３．．．を用いて、行アドレス期間の終了時に、アレー内の全ての列が充電され終わるように選択する。Ｇ１が高値になると、最初の３つのマルチプレックススイッチ３６が閉じ、最初の３つの列Ｓ１，Ｓ２及びＳ３がこのときビデオラインＶ１，Ｎ２及びＶ３に存在する電圧レベルに充電される。Ｇ１が低値になると、３つの関連するマルチプレックススイッチが開き、列Ｓ１，Ｓ２及びＳ３をビデオラインから絶縁分離する。このとき、供給された電圧が列キャパシタンスに蓄積される。次に、制御信号Ｇ２が高値になり、次の群のスイッチ３６を閉じ、第２群の３つの列Ｓ４，Ｓ５及びＳ６がこのときそれぞれのビデオラインに存在する電圧に充電される。マルチプレックス回路のこのような動作は、各群の列が順次に適切に充電され、アレー内の全ての列導体が各行アドレス期間内に充電されるまで続く。次の行の表示素子は次の行アドレス期間において同様にアドレスされる。
【００１７】
このようなマルチプレックス形列駆動回路を使用すると、表示領域一面に規則正しい間隔の可視垂直線の形態の表示アーチファクトが現われる問題が経験された。これらのアーチファクトは、列駆動回路の動作時に個々の列導体へ意図しない電圧の容量結合が生じ、これらの列導体と関連する表示素子の電圧、従ってそれらの出力輝度に誤差を生ずることに起因する。このような容量結合は、列アドレス導体１６が表示素子電極１８の列に隣接して延在するために生ずる。その結果として、特に表示素子電極が列導体と部分的にオーバラップするハイアパーチャ形の表示素子レイアウトの場合には、列アドレス導体と隣接表示素子電極との間にかなりのキャパシタンスが存在する。各列導体は一行内の隣接する表示素子電極の間を延在するため、隣接する各対の列アドレス導体の間に電極を介して間接的に容量結合が存在する。各対の列導体が互いに隣接して設けられ、表示素子電極の列がこの列導体対の両側に設けられ、一方の表示素子電極の列が一方の列導体を経てアドレスされ、他方の表示素子電極の列が他方の列導体を経てアドレスされる他のレイアウトでは２つの列導体の間に直接容量結合が起り得る。
【００１８】
この効果を、アレー内の代表の少数の隣接表示素子に対する等価回路を示す図４、及び図３の回路の動作中の電圧波形の一例を示す図５を参照して更に説明する。表示装置の各表示素子は複数のキャパシタンスを含み、それらのいくつかが図４に示されている。Ｃ１及びＣ２は表示素子電極１８と２つの隣接する列導体１６との間のキャパシタンスを示す。Ｃ３は表示素子キャパシタンスを示す。このキャパシタンスＣ３は液晶キャパシタンスと表示素子蓄積キャパシタの組合せとすることができる。Ｃ４は列導体のキャパシタンスを示し、列導体と行導体との間のキャパシタンスと、列導体と表示素子アレーの共通電極との間のキャパシタンスと、ＴＦＴのゲート−ソースキャパシタンスを含む。他のキャパシタンスも存在し、この効果に寄与し得るが、明瞭のために省略する。
【００１９】
例えば、第２列内の表示素子を駆動する列導体Ｓ２上のビデオ情報の変化の効果を考察する。このビデオ情報の電圧変化はキャパシタンスＣ２を介して第１列の前表示素子の表示素子キャパシタンスＣ３に結合されるため、その表示素子電圧に変化を生じさせる。更に、列導体Ｓ１上の電圧が列駆動回路により維持されていない場合、すなわち列駆動回路の出力が高インピーダンスで、列導体Ｓ１がフローティングである場合には、この表示素子電圧の変化はキャパシタンスＣ１を経て列導体Ｓ１へも結合され得る。１つの列導体から隣の列導体へのこの電圧変化の結合は結合係数ＫＣにより表わすことができる。１つの列導体の電圧が量ΔＶだけ変化した場合、これが他の列導体に発生させる電圧変化はＫＣΔＶで与えられる。
【００２０】
この効果を更に図３及び図５を参照して説明する。ここでは、簡単のために表示素子アレーが均一のグレー領域に対しアドレスされものとし、且つビデオ情報駆動電圧の極性の行反転及びフィールド反転を用いるものとする。同様の効果が、他の反転方法に対しても、異なる数のビデオラインを有する回路に対しても、及び表示されたビデオ情報がもっと複雑な場合でも起る。図５において、Ｇ１，Ｇ２及びＧ３は最初の３つの群のマルチプレックススイッチ３６に供給される制御波形であり、これらの制御波形はこれらのスイッチをターンオンする電圧パルス信号を含み、Ｓ１−Ｓ９は最初の９つの列導体上に現われる電圧波形である。表示装置は均一なグレー領域を表示するので、３つのビデオラインＶ１−Ｖ３に供給される電圧波形は図５に示すように同一である。ビデオ信号の極性は各ビデオライン期間（Ｔｌ）ごとに反転する。制御回路３７が前述したように制御信号Ｇ１，Ｇ２，Ｇ３，．．．を用いて各群を順次に選択するため、行アドレス（ビデオライン）期間Ｔｌの終了時に、表示装置の全ての列が充電される。Ｇ１が高値になると、第１群の３つの列導体Ｓ１，Ｓ２及びＳ３がそれぞれのビデオラインの電圧レベルに充電される。その直後にＧ２が高値になって第２群が選択されるとき、列導体Ｓ４の電圧が変化するので、この変化が図３にノードｐ３で示す第３列内の表示素子の表示素子電極に、減少した振幅で結合される。この表示素子電圧の変化は、更に、その前にアドレスされた群内の最終列導体に結合される。これは、この列導体がこのときそのビデオラインインから切り離されるためである。その結果として、図５のＳ３の波形に示すように、その列電圧に誤差を生ずる。この電圧変化は表示素子ノードｐ２を経て列導体Ｓ２へも、及びノードｐ１を経て列導体Ｓ１へも結合される。しかし、各結合毎に、結合信号の振幅は係数ＫＣだけ減少する。従って、Ｓ３の電圧誤差が表示画像の均一性に最も重要となる。
【００２１】
第２群の３つの列が充電され終わると、制御信号Ｇ２は低値になり、第２群のマルチプレックススイッチはターンオフする。Ｇ３が高値になって第３群の列が充電されるとき、同様に列導体Ｓ７の電圧変化の結合によって列導体Ｓ６の電圧に誤差を生ずる。この効果がアレー内の各群の列に対し同様に起るため、一般に各マルチプレックス群内の最終又は最後の列が次の群内の隣接する列導体、即ち次に選択される群内の第１列導体の電圧変化によりかなりの電圧誤差を受けることになる。この誤差は一種のクロストークであり、表示画像内にマルチプレックス群の幅に対応する間隔の可視垂直線として現われる。
【００２２】
この誤差の大きさ、従ってその結果生ずる表示画像内のアーチファクトの可視性を低減するために、本発明では少なくともいくつかの列導体の所要の充電を２回以上の充電処理で実行する。
【００２３】
この方法に従って、各列導体を複数の充電処理で充電する列駆動回路の動作の一例を図６に示す。図６は最初の５つの制御信号Ｇ１−Ｇ５の波形を、本例では列導体Ｓ１，Ｓ４，Ｓ７，Ｓ１０，．．に供給する異なるレベルのデータ信号を含むビデオラインＶ１上のビデオ信号の変更波形例と一緒に示す。マルチプレックス列駆動回路の慣例の動作では、列導体の群を単一の順序で充電するが、本発明では列導体を各行アドレス期間内において２以上の別個の充電期間を用いて充電する。このような動作は制御信号波形を供給する制御回路３７を適切に変更することにより達成される。図６に示す方法の例では、各群に対し２つの充電期間を用い、順次の群の列導体に対する充電期間をインターリーブ（交互配置）する。従って、制御信号波形Ｇ１，Ｇ２，．．の各々はほぼ同一の持続時間の時間的に離間した２つのパルス信号を有し、両パルス信号が関連する群のマルチプレックススイッチ３６を駆動し、第１及び第２充電期間を決定する。図６に示すように、制御信号Ｇ１，Ｇ２，Ｇ３，．．のパルス信号は順番に配置し、第１群の第１充電期間を決定する第１パルス信号が第２群に対する第１及び第２パルス信号のインターバル内に位置し、全ての制御波形内のパルス信号がそれぞれ異なるタイムスロットを占め、互いに一致又はオーバラップしないようにする。従って、例えば、Ｇ１の第２パルス信号およびＧ３の第１パルス信号がＧ２の第１及び第２パルス信号のインターバル内に発生するが、これらのパルス信号はこのインターバルの前半部分と後半部分をそれぞれ占める。アレー内の列導体の群の総数がＣである場合、各制御信号の持続時間は約Ｔｌ/２Ｃにすることができる。
【００２４】
動作時に、図３において第１群の列Ｓ１，Ｓ２及びＳ３に予定されたビデオ情報（データ信号）がビデオラインに供給され、第１群のマルチプレックススイッチ３６がＧ１の第１パルス信号により選択される。このパルス信号の終了時に、第１群のスイッチ３６が開き、次に第２群の列Ｓ４，Ｓ５及びＳ６に対するビデオ情報がビデオラインに供給され、第２群のマルチプレックススイッチ３６が制御信号Ｇ２の第１パルス信号により選択される。このパルス信号の終了及びこれらのスイッチの開に続いて、第１群のビデオ情報が再びビデオラインに供給されるとともに、第１群のマルチプレックススイッチがＧ１の第２パルス信号により再び選択され、第１群の列が供給されるビデオ情報に従って再び充電される。続いて、第３群の列Ｓ７，Ｓ８及びＳ９に対するビデオ情報がビデオラインに供給されるとともに、第３群のマルチプレックススイッチがＧ３の第１パルス信号により選択され、次に第２群に対するビデオ情報が再び供給されるとともに、第２群の列が再び充電される。マルチプレックス回路の動作は、全ての群が選択され、関連する列が２度充電されるまでこのように続けられる。ビデオラインＶ１に供給されるビデオ情報波形の一例を示す図６には、それぞれのビデオ情報が供給される列も示されている。
【００２５】
この複数回充電法を採用する利点は図７に示す列電圧波形図を参照すると明らかになる。この図は、表示装置が前述の場合と同様に均一なビデオ領域に対しアドレスされ、同一のビデオ情報が３つのビデオラインＶ１，Ｖ２及びＶ３の各々に供給され、電圧誤差の効果が最も顕著である場合に存在するであろう波形を示す。例えば、マルチプレックススイッチ制御信号Ｇ２が最初に高値になると、列Ｓ６の充電が起り、列Ｓ６はビデオラインＶ３に存在する電圧に向って充電する。この充電期間の終了時にＧ２が低値になり、第２群のマルチプレックススイッチがターンオフする。この第１の充電期間後にこの列がビデオラインの電圧のレベル、即ち所要のデータ信号レベルに完全に充電されていなければならない必要はない点に注意されたい。次の充電期間中に、第１群の列（Ｓ１，Ｓ２及びＳ３）が再び充電され、その直後に第３群（Ｓ７，Ｓ８，Ｓ９）が始めて充電される。このとき列Ｓ７の電圧が変化するので、この変化が前述したように列Ｓ６に結合される。この充電期間の終了時に、列Ｓ７の電圧が量ＶＡだけ変化し、これにより列Ｓ６の電圧が量ＫＣＶＡだけ変化する。次の充電期間において、第２群の列に対するビデオ情報がビデオラインに再度供給されるとともに、第２群のマルチプレックススイッチが再び選択される。このとき、列Ｓ６はラインＶ３の電圧レベルに充電し、マルチプレックススイッチがターンオフする。次に第３群の列が再度充電されるとき、列Ｓ７の電圧の変化ＶＢが列Ｓ６に結合され、ＫＣＶＢの電圧誤差を生ずる。
【００２６】
多数回充電法のおかげで、列Ｓ６に生ずる誤差は慣例の単一充電法で生ずる誤差よりＶＢ/Ｖだけ小さくなる。多数回充電法を用いると、例えば列Ｓ６に生ずる電圧誤差の値は列Ｓ７に対する第２（最終）充電期間中の列電圧の変化に依存する。この誤差は充電期間の持続時間を延長することのより、又は使用する充電期間の数を増大することにより更に減少させることができる。
【００２７】
列をそれらの第１充電期間中にそれぞれのデータ信号のレベルに対応する所要の（最終）レベルに少なくとも近いレベルまで充電してＶＢの値を最小にするのが好ましい。
この場合、次の群の隣接する第１列に現われる電圧変化のために他の群の最終列に現われる電圧誤差及びこれにより生ずるアーチファクトの可視性も同様に最小になる。
【００２８】
総合効果は、第Ｎ群の最終列の電圧誤差の大きさが第（Ｎ＋１）群に対する第２充電期間により生ずる第（Ｎ＋１）群の第１列の電圧変化に比例することにある。順次の充電時における列電圧の変化が小さくなるため、前群の最終列に生ずる誤差も小さくなる。この誤差の減少は関連する表示素子の輝度誤差の減少をもたらす。
全ての行の表示素子を連続するそれぞれの行アドレス期間においてこのようにアドレスする。
【００２９】
他の方法では、列駆動回路を、制御信号Ｇ１，Ｇ２，Ｇ３，．．のパル信号信号を交互に配置する代わりに、全ての制御信号Ｇ１，Ｇ２，Ｇ３，．．の第１パルス信号を連続的に供給して全ての群のマルチプレックススイッチを連続的に駆動させ、次に再び全ての第２パルス信号を連続的に供給するように構成することができる。この方法も同様に電圧誤差を低減する。
【００３０】
上述したように、容量結合により生ずる電圧誤差は、群内の最終列導体、即ち次にアドレスされる群に直接隣接する列導体に対し最も大きく、その前の群内の他の列導体に生ずる誤差の大きさはその列導体が次にアドレスされる群から遠いほど小さくなる。場合によっては、列駆動回路は、各群内の最後の１つ又は２つの列導体のみを複数の充電期間で充電し、他の列導体を通常の如く単一の充電期間で充電するように構成することができる。この場合には、１つの群を各自の充電期間で充電し、次の群を次の充電期間で充電し、次に前記１つの群の最後の１つ又は２つの列導体を再び充電し、全ての群について以下同様に充電することができる。
【００３１】
カラー表示装置では、カラーフィルタ素子が慣例の如く他方の基板上に担持され、この場合には、ビデオ入力ラインＶ１，Ｖ２およびＶ３により赤、緑及び青のビデオ情報成分を搬送し、アレー内の隣接する列を赤、緑及び青情報を表示するよう配置することができる。
【００３２】
本発明は、特に表示素子電極が絶縁層上のアクティブマトリクス回路の上に担持されたタイプの表示装置構造に関連して説明したが、例えばＵＳ-Ａ-５１３０８２９に記載されているような、電極１８がＴＦＴ及びアドレス導体群とほぼ同一のレベルに、その横方向に位置する他のタイプの表示装置にも適用し得る。
【００３３】
ビデオ信号をビデオ入力ライン（例えばＶ１，Ｖ２及びＶ３）にビデオ信号を供給する列駆動回路３５の部分及び制御信号Ｇ１，Ｇ２，Ｇ３，．．をマルチプレックススイッチに供給する制御回路３７は基板２５上に集積する必要はなく、その代わりに、別個に形成して基板上のマルチプレックス回路に接続することもできる。
【００３４】
また、列駆動回路の少なくともマルチプレックス回路部分は、アクティブマトリクス回路と同一の基板上に完全に集積するのが特に好ましいが、駆動回路のこの回路部分を行駆動回路と同様に個別要素として製造し、例えばチップオンガラス技術を用いてアクティブマトリクス回路と電気的に接続することもできる。
【００３５】
本発明の説明を読めば、他の変形や変更が当業者に明かである。これらの変形や変更にはアクティブマトリクス液晶表示装置及びその構成部品の分野において既に既知の他の構成要件であって、上述した構成要件の代わりに、又は加えて使用し得る構成要件も含まれる。
【図面の簡単な説明】
【図１】  アクティブマトリクスＬＣ表示装置の簡略回路図である。
【図２】  ハイアパーチャ（高開口率）形の既知のアクティブマトリクスＬＣ表示装置の代表的な部分の表示素子電極と行及び列アドレス導体のレイアウトを示す線図である。
【図３】  既知のマルチプレックス形列駆動回路の一部分をいくつかの列導体及びそれらの関連キャパシタンスと一緒に示す線図である。
【図４】  図１の表示装置の表示素子アレーの一部分の等価回路図を示す。
【図５】  図１の表示装置を駆動する既知の方法に存在する代表的な駆動波形を示す図である。
【図６】  本発明による表示装置の一実施例の駆動中に現われる、列駆動回路に使用される制御信号波形を含む、種々の波形の例を示す図である。
【図７】  本発明による表示装置の一実施例の駆動中に現われる、列駆動回路に使用される制御信号波形を含む、種々の波形の例を示す図である。
【図１】
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【図２】
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【図３】
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【図４】
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【図５】
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【図６】
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【図７】
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