(57)【特許請求の範囲】
【請求項１】
ゲートラインとデータラインの交差部に形成された薄膜トランジスタと、その薄膜トランジスタに接続された画素電極を含む液晶セルと、前記データラインとその左側に隣接した画素電極の間に形成された第１寄生キャパシタと、前記データラインとその右側に隣接した画素電極の間に形成された第２寄生キャパシタを備え、
前記液晶セルは、左側に隣接したデータラインと接続される薄膜トランジスタを有する液晶セルからなる第１水平ラインと、右側に隣接したデータラインと接続される薄膜トランジスタを有する液晶セルからなる第２水平ラインとを具備し、
前記画素電極は、前記薄膜トランジスタが形成される位置と対角をなす前記データラインに隣接した一側部に形成される溝を具備し、
前記溝は、前記第１水平ラインでは前記データラインの左側の画素電極に形成され、前記第２水平ラインでは前記データラインの右側の画素電極に形成され、
前記第１水平ラインにおいて、前記データラインとその右側の画素電極は前記データラインと同一極性の画素信号を、前記データラインの左側の画素電極は前記データラインと反対極性の画素信号をそれぞれ充電するように形成され、
前記第２水平ラインにおいて、前記データラインの左側の画素電極は前記データラインと同一極性の画素信号を、前記データラインの右側の画素電極は前記データラインと反対極性の画素信号をそれぞれ充電するように形成され、
前記第１水平ラインと前記第２水平ラインは、少なくとも１水平ライン単位に交番して配置され、
データラインをコラム・インバージョン方式で駆動しながら液晶セルをドット・インバージョン方式で駆動し、
前記データラインの左側の画素電極に形成された溝の長さと、前記データラインの右側の画素電極に形成された溝の長さは同一である
ことを特徴とする液晶表示パネル。
【発明の詳細な説明】
【技術分野】
【０００１】
本発明は液晶表示装置に関わり、特に、消費電力を節減すると共に画質を向上させることができる液晶表示パネルに関するものである。
【背景技術】
【０００２】
液晶表示装置は、電界を利用して誘電異方性を有する液晶の光透過率を調節することで画像を表示するようになる。このために、液晶表示装置は、液晶セルがマトリックス形態に配列された液晶表示パネルと、液晶表示パネルを駆動するための駆動回路とを具備する。
【０００３】
液晶表示パネルは、液晶セルが画素信号により光透過率を調節することで画像を表示するようになる。駆動回路は、液晶表示パネルのゲートラインを駆動するためのゲート・ドライバーと、データラインを駆動するためのデータ・ドライバーと、ゲート・ドライバー及びデータ・ドライバーにタイミング制御信号と画素データを供給するタイミング制御部と、電源電圧を供給する電源部とを具備する。
【０００４】
具体的に、液晶表示装置は、図１に示すように、液晶セル(Clc)がマトリックス形態で配列された液晶表示パネル(２)と、液晶表示パネル(２)のゲートライン(GL１乃至GLn)を駆動するためのゲート・ドライバー（４）と、液晶表示パネル(２)のデータライン(DL１乃至DLm)を駆動するためのデータ・ドライバー(６)とを具備する。
【０００５】
図１において、液晶表示パネル(２)は、ｎ個のゲートライン(GL１乃至GLn)とｍ個のデータライン(DL１乃至DLm)の交差により定義される領域ごとに形成されてマトリックス形態に配列された薄膜トランジスタ(TFT)と液晶セル(Clc)とを具備する。薄膜トランジスタ(TFT)は、ゲートライン(DL１乃至GLn)からのスキャン信号に応答してデータライン(DL１乃至DLm)からの画素信号を液晶セル(Clc)に供給する。
【０００６】
液晶セル(Clc)は、液晶を間に置いて対面する共通電極と薄膜トランジスタに接続された画素電極を含めて等価的には液晶容量キャパシタ(Clc)で表示される。ゲート・ドライバー（４）は、タイミング制御部（８）からのゲート制御信号に応答してゲートライン(GL１乃至GLn)に順次供給されるスキャン信号を発生する。
【０００７】
データ・ドライバー（６）は、タイミング制御部（８）からのデータ制御信号に応答してタイミング制御部(８)からの画素データをアナログ画素信号に変換する。この場合、データ・ドライバー(６)は、ガンマ電圧発生部(図示しない)から供給されるガンマ電圧を利用して画素データを画素信号に変換する。そして、データ・ドライバー(６)は、変換された画素信号をゲートライン(GL)にスキャン信号が供給される度にデータライン(DL１乃至DLm)に供給する。
【０００８】
タイミング制御部(８)は、入力される垂直同期信号及び水平同期信号等を利用してゲート制御信号とデータ制御信号を発生してゲート・ドライバー(４)及びデータ・ドライバー（８）のタイミングを制御する。また、タイミング制御部(８)は、入力される画素データを整列してデータ・ドライバー(６)に供給する。
【０００９】
このような液晶表示装置は、液晶の劣化を防止すると共に表示品位を向上させるために、液晶表示パネルをインバージョン駆動方法で駆動する。インバージョン駆動方法としては、フレーム・インバージョン方式(Frame  Inversion  Systwm)、ライン(コラム)・インバージョン方式(Line(Column)  Inversion  System)、そしてドット・インバージョン方式(Dot  Inversion  System)が利用される。
【００１０】
フレーム・インバージョン駆動方法は、図２Ａ及び図２Ｂに図示するように、液晶セルの極性が１フレームの間では同一で、フレームごとに反転されるようにする。このようなフレーム・インバージョン駆動方法は、フレーム単位にフリッカが発生される問題点がある。
【００１１】
ライン・インバージョン駆動方法は、液晶セルの極性が、図３Ａ及び図３Ｂに図示するように、１水平ラインの間では同一で、水平ラインごとに、そしてフレームごとに反転されるようにする。このようなライン・インバージョン駆動方式は、水平方向の液晶セル間のクロストークが存在することにより、水平縞模様パターンにフリッカが発生される問題点がある。
【００１２】
コラム・インバージョン駆動方法は、液晶セルの極性が、図４Ａ及び図４Ｂに図示するように、１コラムラインの間では同一で、コラムラインごとに、そしてフレームごとに反転されるようにする。このようなコラム・インバージョン駆動方式は、垂直方向の液晶セル間のクロストークが存在することにより、垂直縞模様パターンにフリッカが発生される問題点がある。
【００１３】
ドット・インバージョン駆動方法は、図５Ａ及び図５Ｂに図示するように、液晶セルの極性が水平及び垂直方向に隣接するすべての液晶セルと相反されて、フレームごとに反転されるようにする。このようなドット・インバージョン駆動方法は、垂直及び水平方向に隣接した液晶セルの間に発生されるフリッカが相互相殺されることで、他のインバージョン方法に比べてすぐれた画質の画像を提供する。
【発明の開示】
【発明が解決しようとする課題】
【００１４】
しかし、ドット・インバージョン駆動方式は、データ・ドライバーからデータラインに供給される画素電圧信号の極性が水平及び垂直方向に反転されるので他のインバージョン方法に比べて画素信号の変動量、すなわち画素信号の周波数が大きいために消費電力が大きいとする短所がある。
【００１５】
従って、本発明の目的は、消費電力を節減すると共に画質を向上させることができる液晶表示パネルを提供することにある。
【課題を解決するための手段】
【００１６】
前記目的を達成するために、本発明に係る液晶表示パネルは、ゲートラインとデータラインの交差部に形成された薄膜トランジスタと、その薄膜トランジスタに接続された画素電極を含む液晶セルと、前記データラインとその左側に隣接した画素電極の間に形成された第１寄生キャパシタと、前記データラインとその右側に隣接した画素電極の間に形成された第２寄生キャパシタを備え、前記液晶セルは、左側に隣接したデータラインと接続される薄膜トランジスタを有する液晶セルからなる第１水平ラインと、右側に隣接したデータラインと接続される薄膜トランジスタを有する液晶セルからなる第２水平ラインとを具備し、前記画素電極は、前記薄膜トランジスタが形成される位置と対角をなす前記データラインに隣接した一側部に形成される溝を具備し、前記溝は、前記第１水平ラインでは前記データラインの左側の画素電極に形成され、前記第２水平ラインでは前記データラインの右側の画素電極に形成され、前記第１水平ラインにおいて、前記データラインとその右側の画素電極は前記データラインと同一極性の画素信号を、前記データラインの左側の画素電極は前記データラインと反対極性の画素信号をそれぞれ充電するように形成され、前記第２水平ラインにおいて、前記データラインの左側の画素電極は前記データラインと同一極性の画素信号を、前記データラインの右側の画素電極は前記データラインと反対極性の画素信号をそれぞれ充電するように形成され、前記第１水平ラインと前記第２水平ラインは、少なくとも１水平ライン単位に交番して配置され、データラインをコラム・インバージョン方式で駆動しながら液晶セルをドット・インバージョン方式で駆動し、前記データラインの左側の画素電極に形成された溝の長さと、前記データラインの右側の画素電極に形成された溝の長さは同一であることを特徴とする。
【発明の効果】
【００１７】
消費電力減少のために液晶セルがデータラインに沿ってジグザグ型に配列された本発明に係る液晶表示パネルは、画素電極に溝を形成してデータラインと左右側画素電極との間に形成される第１及び第２寄生キャパシタ(Cdp１、Cdp２)との間の容量偏差を最小化できるようになる。これにより、本発明に係る液晶表示パネルは、第１及び第２寄生キャパシタ(Cdp１、Cdp２)との間の容量偏差による垂直クロストーク現象とともに非対称光漏れを最小化して画質を向上させることができるようになる。
【発明を実施するための最良の形態】
【００１８】
本発明の好ましい実施の形態を説明するのに先立って本発明の直接的な技術背景になる液晶表示装置を見る事にする。
【００１９】
液晶表示装置は、液晶セルを交流駆動して液晶劣化を防止しながらも画質を向上させるためにドット・インバージョン駆動方法を主に採用する。しかし、ドット・インバージョン駆動方法は、液晶セル単位で画像信号の極性を反転させなければならないので画素信号の変動量が大きくなるようになって消費電力が大きいという問題点を抱いている。
【００２０】
このようなドット・インバージョン駆動方法の大きい消費電力問題を解決するために、データラインをコラム・インバージョン方式に駆動しながら液晶セルをドット・インバージョン方式で駆動できる液晶表示装置とその駆動方法を説明する。
【００２１】
図６は、本発明に係る液晶表示装置（以下、"Z-インバージョン液晶表示装置″と言う）を図示したものである。図６に図示された液晶表示装置は、液晶セルマトリックスを持つ液晶表示パネル(１２)と、液晶表示パネル(１２)のゲートライン(GL１乃至GLn)を駆動するためのゲート・ドライバー(１４)と、液晶表示パネル(１２)のデータライン(DL１乃至DLm+１)を駆動するためのデータ・ドライバー(１６)と、ゲート・ドライバー(１４)及びデータ・ドライバー(１６)を制御するためのタイミング制御部(１８)とを具備する。
【００２２】
液晶表示パネル(１２)は、ゲートライン(GL１乃至GLn)とデータライン(DL１乃至DLm+１)の交差により定義される領域ごとに形成された薄膜トランジスタ(TFT)と、画素電極(PXL)を含む液晶セルとを具備する。薄膜トランジスタ(TFT)は、ゲートライン(GL)からのスキャン信号に応答してデータライン(DL１乃至DLm+１)からの画素信号を画素電極(PXL)に供給する。画素電極(PXL)は、画素信号に応答して共通電極(図示しない)との間に位置する液晶を駆動することで光の透過率を調節するようになる。このような液晶セルは、薄膜トランジスタ(TFT)を通して垂直方向に沿って隣接したデータライン(DL)と交番的に接続される。
【００２３】
例えば、奇数番目のゲートライン(GL１、GL３、GL５、...)に接続された奇数番目の水平ラインの液晶セルは、左側に隣接したデータライン(DLi)(ここで、iは、陽の正数)に接続されて画素信号を供給される。反面に、偶数番目のゲートライン(GL２、GL４、GL６、...)に接続された偶数番目の水平ラインの液晶セルは、右側に隣接するデータライン(DLi+１)に接続されて画素信号を供給される。
【００２４】
タイミング制御部(１８)は、ゲート・ドライバー(１４)及びデータ・ドライバー(１６)を制御するタイミング制御信号を発生して、データ・ドライバー(１６)に画素データ信号を供給する。タイミング制御部(１８)で発生するゲート・タイミング制御信号としては、ゲート・スタートパルス(GSP)、ゲート・シフト・クロック信号(GSC)、ゲート出力イネーブル信号(GOE)が含まれる。タイミング制御部(１８)で発生するデータ・タイミング制御信号としては、ソース・スタートパルス(SSP)、ソース・シフト・クロック信号(SSC)、ソース出力イネーブル信号(SOE)、極性制御信号(POL)等が含まれる。
【００２５】
ゲート・ドライバー(１４)は、前記ゲート・タイミング制御信号を利用してゲートライン(GL１乃至GLn)にスキャン信号を順次的に供給する。これにより、ゲート・ドライバー(１４)は、そのスキャン信号に応答して薄膜トランジスタ(TFT)が水平ライン単位で駆動されるようにする。
【００２６】
データ・ドライバー(１６)は、入力された画素データをアナログ画素信号に変換してゲートライン(GL)にスキャン信号が供給される１水平期間ごとに１水平ライン分の画素信号をデータライン(DL１乃至DLm+１)に供給する。この場合、データ・ドライバー(１６)は、ガンマ電圧発生部(図示しない)から供給されるガンマ電圧を利用して画素データを画素信号に変換するようになる。
【００２７】
このようなデータ・ドライバー(１６)は、コラム・インバージョン方式に画素信号を供給して、データライン(DL１乃至DLm+１)のそれぞれに供給される画素信号が隣接したデータライン(DL)とは、相反した極性を持って、その極性がフレーム単位で反転させるようにする。すなわち、データ・ドライバー(１６)は、奇数データライン(DL１、DL３、...)と偶数データライン(DL２、DL４、...)に相互相反された極性の画素信号を供給して、そのデータライン(DL１乃至DLm+１)に供給される画素信号の極性をフレーム単位で反転させるようになる。
【００２８】
この場合、画素電極(PXL)がコラム・インバージョン方式に画素信号が供給されるデータライン(DL１乃至DLm+１)を基準にジグザグ型に配列されるのでその画素電極(PXL)を含む液晶セルは、ドット・インバージョン方式に駆動される。
【００２９】
特に、データ・ドライバー(１６)は、データライン(DL１乃至DLm+１)につれてジグザグ型に配列された画素電極(PXL)に正確な画素信号を供給するために水平期間ごとに交番的に画素信号の出力チャンネルを変更するようになる。
【００３０】
具体的に、データライン(DL１乃至DLm+１)の右側で接続された液晶セル(PXL)に画素信号を供給する場合に、データ・ドライバー(１６)は、第１乃至第mデータライン(DL１乃至DLm)にm個の有效画素信号を、第m+１データライン(DLm+１)にブランク信号を供給するようになる。
【００３１】
これとは、異なり、データライン(DL１乃至DLm+１)の左側で接続された液晶セル(PXL)に画素信号を供給する場合に、データ・ドライバー(１６)は、m個の有效画素信号を１チャンネルずつ右側にシフトさせ第２乃至第m+１データライン(DL２乃至DLm+１)に供給して、第１データライン(DL１)には、ブランク信号を供給するようになる。ここで、ブランク信号は、定義されない(Don't  care)信号を意味する。
【００３２】
これにより、Z-インバージョン液晶表示装置は、ドット・インバージョン方式に駆動される液晶セル(PXL)で画質が向上されて、データ・ドライバー(１６)は、コラム・インバージョン方式に画素信号を供給するので、ドット・インバージョン方式に画素信号を供給する場合より消費電力を著しく節減することができるようになる。
【００３３】
しかし、図６に図示されたZ-インバージョン液晶表示装置では、データライン(DL)と左右側画素電極(PXL)の間に形成される寄生キャパシタ(Cdp)の間に容量偏差が発生するようになる。これは、データライン(DL)と左右側画素電極(PXL)との間に寄生キャパシタ(Cdp)が形成される面積が相違するためである。
【００３４】
例えば、データラインと左右側画素電極の間に形成される寄生キャパシタ(Cdp)は、図７に図示するように、１データライン(DLk)と左側画素電極(P１または、P３)の間に形成される第１寄生キャパシタ(Cdp１)と、そのデータライン(DLk)と右側画素電極(P２または、P４)の間に形成される第２寄生キャパシタ(Cdp２)で構成される。ここで、第１及び第２寄生キャパシタ(Cdp１、Cdp２)は、その形成面積が相違するので相違する寄生容量を持っている。
【００３５】
具体的に、図７に図示するように、画素電極(P１、P２)がi番目のゲートライン(GLi)によって駆動される薄膜トランジスタ(TFT)を通して左側に隣接したデータライン(DLk-１、DLk)と接続された液晶セルからなる第１水平ライン(HL１)では、第１寄生キャパシタ(Cdp１)が第２寄生キャパシタ(Cdp２)より大きい寄生容量を持っている。これは、第１水平ライン(HL１)からデータライン(DLk)と向い合う左側画素電極(P１)の辺の長さ(゜)が、そのデータライン(DLk)と向い合う右側画素電極(P２)の辺の長さ(ケ)より長いからである。
【００３６】
すなわち、データライン(DLk)と第１寄生キャパシタ(Cdp１)を形成する左側画素電極(P１)の面積がそのデータライン(DLk)と第２寄生キャパシタ(Cdp２)を形成する右側画素電極(P２)の面積より大きいからである。これにより、電極面積と比例関係を持つ第１寄生キャパシタ(Cdp１)と第２寄生キャパシタ(Cdp２)の間に容量偏差が発生するようになる。
【００３７】
さらに、画素電極(P３、P４)が薄膜トランジスタ(TFT)を通して右側に隣接したデータライン(DLk、DLk＋１)と接続された液晶セルからなる第２水平ライン(HL２)では、第２寄生キャパシタ(Cdp２)が第１寄生キャパシタ(Cdp１)より大きい寄生容量を持っている。これは、第２水平ライン(HL２)においてデータライン(DLk)と向い合う右側画素電極(P４)の辺の長さ(β)が、そのデータライン(DLk)と向い合う左側画素電極(P３)の辺の長さ(α)より長いからである。
【００３８】
すなわち、データライン(DLk)と第２寄生キャパシタ(Cdp２)を形成する右側画素電極(P４)の面積がそのデータライン(DLk)と第１寄生キャパシタ(Cdp１)を形成する左側画素電極(P１)の面積より大きいからである。これにより、電極面積と比例関係を持つ第２寄生キャパシタ(Cdp２)と第１寄生キャパシタ(Cdp１)の間に容量偏差が発生するようになる。
【００３９】
このような第１及び第２キャパシタ(Cdp１、Cdp２)の間の容量偏差によりデータライン(DL)の上の画素信号が歪曲されて、歪曲された画素信号が画素電極(P)に誘起されて充電される。この結果、Z-インバージョン液晶表示装置の特定領域にクロストークキテストパターンを表示する場合、前記寄生容量偏差による垂直クロストークが発生して画質が低下される問題が発生するようになる。
【００４０】
また、データライン(DL)と画素電極(P)は、それら自分により発生される寄生キャパシタ(Cdp)の容量を減らすために所定の離隔距離を置いて配置される。このため、データライン(DL)と画素電極(P)との間でバックライトから駆動されない液晶を経由した光漏れが発生するようになる。特に、第１及び第２寄生キャパシタ(Cdp１、Cdp２)の発生面積が相違するにより、それらを通する光漏れの量も相違するようになる。
【００４１】
例えば、第１水平ライン(HL１)では、相対的に容量が大きい第１寄生キャパシタ(Cdp１)を通する光漏れの量が相対的に大きくて、第２水平ライン(HL２)では、相対的に容量が大きい第２寄生キャパシタ(Cdp２)を通する光漏れの量が相対的に大きく示されるようになる。このように、水平ライン単位で第１及び第２寄生キャパシタ(Cdp１、Cdp２)による非対称光漏れが発生するにより画質が低下される問題が発生するようになる。
【００４２】
このようにZ-インバージョン液晶表示装置で発生する寄生容量偏差による垂直クロストーク及び非対称光漏れを防止するために、本発明では、データライン(DLk)を基準にした第１及び第２寄生キャパシタ(Cdp１、Cdp２)の寄生容量が同一になるように液晶表示パネルを設計するようになる。特に、本発明では、画素電極(P)の構造を変更して第１及び第２寄生キャパシタ(Cdp１、Cdp２)が同一な寄生容量を持つようにする。
【００４３】
図８は、本発明の実施の形態によるZ-インバージョン液晶表示パネルの一部分を示す図である。図８に図示された液晶表示パネルは、ゲートライン(GL)とデータライン(DL)の交差により定義される領域ごとに形成された液晶セル(３２)を具備する。
【００４４】
液晶セル(３２)のそれぞれは、薄膜トランジスタ(TFT)と画素電極(P)を含む。薄膜トランジスタ(TFT)は、ゲートライン(GL)からのスキャン信号に応答してデータライン(DL)からの画素信号を画素電極(P)に供給する。画素電極(P)は、供給された画素信号に応答して共通電極(図示しない)との間に位置する液晶を駆動するようになる。これにより、液晶セル(３２)は、液晶の駆動によって光透過率を調節して画像を示すようになる。
【００４５】
特に、ドット・インバージョン駆動のために液晶セル(３２)は、垂直方向に沿って隣接したデータライン(DLk-１、DLk、DLk+１)と交番的に接続される。すなわち、液晶表示パネルは、左側に隣接したデータライン(DLk-１、DLk)に接続された液晶セル(３２)で構成される第１水平ライン(HL１)と、右側に隣接したデータライン(DLk、DLk+１)に接続された液晶セル(３２)で構成される第２水平ライン(HL２)を具備する。
【００４６】
このような第１水平ライン(HL１)と第２水平ライン(HL２)は、ドット・インバージョン駆動の場合、図８に図示されたように、１水平ライン単位で交番して配列される。これと異なり、２ドットまたは、３ドット以上のインバージョン駆動の場合、第１水平ラインと第２水平ラインは、２または、３以上の水平ライン単位で交番して配置される。
【００４７】
このようなデータライン(DL)と画素電極(P)の間には、寄生キャパシタ(Cdp)が存在するようになる。寄生キャパシタ(Cdp)は、保護膜(図示しない)を挟むデータライン(DL)と左側の画素電極(P)によって形成された第１寄生キャパシタ(Cdp１)と、保護膜(図示しない)を挟むそのデータライン(DL)と右側の画素電極(P)によって形成された第２寄生キャパシタ(Cdp２)を具備する。
【００４８】
ここで、第１及び第２寄生キャパシタ(Cdp１、Cdp２)との間の容量偏差を防止するために、第１及び第２寄生キャパシタ(Cdp１、Cdp２)は、同一な容量を持つように形成される。このために、相対的に容量が大きい寄生キャパシタを形成する画素電極(P)がデータライン(DL)に隣接した一側部に溝(３４)を具備するにより、その寄生キャパシタの容量が減ってなるようにする。
【００４９】
例えば、図８に図示するように、第１水平ライン(HL１)において、データライン(DLk)と相対的に容量が大きい第１寄生キャパシタ(Cdp１)を形成する左側画素電極(P１)がそのデータライン(DLk)に隣接した一側部に溝(３４)を具備するようにする。これにより、データライン(DLk)と左側画素電極(P１)との間の第１寄生キャパシタ(Cdp１)の容量が減るようになり、そのデータライン(DLk)と右側画素電極(P２)との間の第２寄生キャパシタ(Cdp２)との容量偏差が減るようになる。
【００５０】
この結果、第１水平ライン(HL１)では、第１及び第２寄生キャパシタ(Cdp１、Cdp２)との間の容量偏差が最小化できるようになる。ここで、データライン(DLk)の左側画素電極(P１)に形成される溝(３４)の位置は、図８に図示するように、そのデータライン(DLk)に隣接した一側部の上部または、下部等、その一側部のどの地点であっても関係ない。
【００５１】
一方、図８に図示するように、第２水平ライン(HL２)において、データライン(DLk)と相対的に容量が大きい第２寄生キャパシタ(Cdp２)を形成する右側画素電極(P４)がそのデータライン(DLk)に隣接した一側部に溝(３４)を具備するようにする。
【００５２】
これにより、データライン(DLk)と右側画素電極(P４)との間の第２寄生キャパシタ(Cdp２)の容量が減るようになり、そのデータライン(DLk)と左側画素電極(P３)との間の第１寄生キャパシタ(Cdp１)との容量偏差が減るようになる。この結果、第２水平ライン(HL２)でも第１及び第２寄生キャパシタ(Cd１、Cdp２)の間の容量偏差を最小化できるようになる。
【００５３】
ここで、データライン(DLk)の左側画素電極(P１)に形成される溝(３４)の位置は、図８に図示するように、そのデータライン(DLk)に隣接した一側部の上部または、下部等、その一側部のどの地点であっても関係ない。
【００５４】
このように、本発明に係るZ-インバージョン液晶表示パネルは、データライン(DL)と相対的に大きい容量の寄生キャパシタを形成する画素電極の面積を減少させるようになる。これにより、データライン(DL)と左右側画素電極(P)との間に形成される第１及び第２寄生キャパシタ(Cdp１、Cdp２)との間の容量偏差を最小化することができるようになる。これにより、第１及び第２寄生キャパシタ(Cdp１、Cdp２)との間の容量偏差による垂直クロストーク現象とともに非対称光漏れを防止して画質を向上させることができる。
【００５５】
上述したように、消費電力減少のために液晶セルがデータラインに沿ってジグザグ型に配列された本発明に係る液晶表示パネルは、画素電極に溝を形成してデータラインと左右側画素電極との間に形成される第１及び第２寄生キャパシタ(Cdp１、Cdp２)との間の容量偏差を最小化できるようになる。これにより、本発明に係る液晶表示パネルは、第１及び第２寄生キャパシタ(Cdp１、Cdp２)との間の容量偏差による垂直クロストーク現象とともに非対称光漏れを最小化して画質を向上させることができるようになる。
【００５６】
以上説明した内容を通して当業者であれば本発明の技術思想を一脱しない範囲内で多様な変更及び修正ができる。
【図面の簡単な説明】
【００５７】
【図１】従来の液晶表示装置を図示した図面である。
【図２Ａ】液晶表示装置のフレーム・インバージョン方式を説明するための図面である。
【図２Ｂ】液晶表示装置のフレーム・インバージョン方式を説明するための図面である。
【図３Ａ】液晶表示装置のライン・インバージョン方式を説明するための図面である。
【図３Ｂ】液晶表示装置のライン・インバージョン方式を説明するための図面である。
【図４Ａ】液晶表示装置のコラム・インバージョン方式を説明するための図面である。
【図４Ｂ】液晶表示装置のコラム・インバージョン方式を説明するための図面である。
【図５Ａ】液晶表示装置のドット・インバージョン方式を説明するための図面である。
【図５Ｂ】液晶表示装置のドット・インバージョン方式を説明するための図面である。
【図６】本発明に係わる液晶表示装置を図示した図面である。
【図７】図６に図示された液晶表示パネルでのクロストークの発生原因を説明するための図面である。
【図８】本発明の実施の形態による液晶表示パネルの一部分を図示した図面である。
【符号の説明】
【００５８】
２、１２：  液晶表示パネル、４、１４：ゲート・ドライバー、６、１６：  データ・ドライバー、８、１８：  タイミング制御部、TFT：薄膜トランジスタ、３２：液晶セル、３４：溝。
【図１】
0004805215.tif 000002
【図２Ａ】
0004805215.tif 000003
【図２Ｂ】
0004805215.tif 000004
【図３Ａ】
0004805215.tif 000005
【図３Ｂ】
0004805215.tif 000006
【図４Ａ】
0004805215.tif 000007
【図４Ｂ】
0004805215.tif 000008
【図５Ａ】
0004805215.tif 000009
【図５Ｂ】
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【図６】
0004805215.tif 000011
【図７】
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【図８】
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