(57)【要約】【課題】少ないメモリで効率的にデータ解析を行なえるようにする。【解決手段】インタフェース２１は、フレームとフレームとの間に隙間が存在するデータ列を伝送するネットワーク１に接続され、そのネットワーク１上を伝送するデータ列を取り込むとともに、そのデータ列に含まれる各フレームのエラー検知を行なう。付帯情報挿入手段２３は、インタフェース２１によるエラー検知結果および時刻発生手段２２からの時刻情報とを受け、取り込まれたデータ列のフレームとフレームの間の隙間に、その一方のフレームに対するエラー検知結果と取込時刻の少なくとも一方を含む付帯情報を挿入する。書込手段２４は、付帯情報挿入手段２３によって付帯情報が挿入されたデータ列をメモリ２５に時系列に書き込む。解析部２６はメモリ２５に書き込まれたデータ列を読み出して、そのデータ列に含まれる各フレームおよび付帯情報の解析を行なう。【選択図】　　　　図１
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【特許請求の範囲】
【請求項１】
フレームとフレームとの間に隙間が存在するデータ列を伝送するネットワークに接続され、該ネットワーク上を伝送するデータ列を取り込むとともに、該データ列に含まれる各フレームのエラー検知を行なうインタフェース（２１）と、
時刻情報を出力する時刻発生手段（２２）と、
前記インタフェースによるエラー検知結果および前記時刻発生手段からの時刻情報とを受け、前記インタフェースによって取り込まれたデータ列のフレームとフレームの間の隙間に、該隙間の両側にある２つのフレームのいずれか一方のフレームに対するエラー検知結果と取込時刻の少なくとも一方を含む付帯情報を挿入する付帯情報挿入手段（２３）と、
メモリ（２５）と、
前記付帯情報挿入手段によって付帯情報が挿入されたデータ列を前記メモリに時系列に書き込む書込手段（２４）と、
前記メモリに書き込まれたデータ列を読み出して、該データ列に含まれる各フレームおよび付帯情報の解析を行なう解析部（２６）とを備えたデータ解析装置。
【発明の詳細な説明】
【０００１】
【発明の属する技術分野】
本発明は、ネットワーク上を伝送するデータを取り込んで解析を行なうデータ解析装置において、少ないメモリで効率的に解析を行なえるようにするための技術に関する。
【０００２】
【従来の技術】
ネットワークの試験等を行なう場合、そのネットワークに試験用のデータ列を入力し、そのネットワーク上を伝送するデータ列を解析するという方法が用いられる。
【０００３】
ここで、ネックワークの伝送レートが遅い場合には、そのネットワーク上を伝送するデータ列を取り込みながらデータ列に含まれるフレームの解析をほぼリアルタイムに行なうことが可能であるが、例えば１０Ｇｂｐｓのイーサネット（登録商標）のように伝送レートが高速になるとリアルタイム解析を行なうことができないため、所定期間に取り込まれたデータ列を時系列にメモリに書き込み、そのメモリに書き込まれたデータ列を読み出して各フレームの解析を行なっている。なお、この解析は、そのフレーム自体の内容だけでなく、フレームの到着時刻やエラー検知結果等の付帯情報も対象となる。
【０００４】
図５は、上記の解析を行なう従来のデータ解析装置１０の構成を示すものである。
【０００５】
図５において、インタフェース１１は、ネットワーク１に接続して、ネットワーク１上を伝送するデータ列を内部に取り込むとともに、そのデータ列に含まれるフレームに対するＦＣＳ等のエラー検知を行なう。また、時刻発生手段１２は時刻情報Ｔをリアルタイムに出力する。
【０００６】
データ列書込手段１３は、インタフェース１１によって取り込まれたデータ列Ｄを時系列にデータ列メモリ１４に書き込む。
【０００７】
また、付帯情報書込手段１５は、インターフェイス１１による各フレーム毎のエラー検知結果Ｅとフレーム毎の取込時刻（到着時刻）とからなる付帯情報Ｈを付帯情報メモリ１６に書き込む。
【０００８】
解析部１７は、データ列メモリ１４にアクセスして、そのデータ列を読み出し、さらに、付帯情報メモリ１６にアクセスして付帯情報Ｈを読み出し、読み出したデータ列に含まれるフレームのデータと付帯情報とに基づいて、種々の解析を行なう。
【０００９】
【発明が解決しようとする課題】
しかしながら、上記のように構成された従来のデータ解析装置１０では、データ列メモリ１４と付帯情報メモリ１６の２種類の独立したメモリが必要となり、構成が複雑化し、解析部１７が解析に必要なデータを取得するのに時間がかかるという問題があった。
【００１０】
本発明は、この課題を解決して、少ないメモリで効率化に解析が行なえるデータ解析装置を提供することを目的としている。
【００１１】
【課題を解決するための手段】
前記目的を達成するために、本発明のデータ解析装置は、
フレームとフレームとの間に隙間が存在するデータ列を伝送するネットワークに接続され、該ネットワーク上を伝送するデータ列を取り込むとともに、該データ列に含まれる各フレームのエラー検知を行なうインタフェース（２１）と、
時刻情報を出力する時刻発生手段（２２）と、
前記インタフェースによるエラー検知結果および前記時刻発生手段からの時刻情報とを受け、前記インタフェースによって取り込まれたデータ列のフレームとフレームの間の隙間に、該隙間の両側にある２つのフレームのいずれか一方のフレームに対するエラー検知結果と取込時刻の少なくとも一方を含む付帯情報を挿入する付帯情報挿入手段（２３）と、
メモリ（２５）と、
前記付帯情報挿入手段によって付帯情報が挿入されたデータ列を前記メモリに時系列に書き込む書込手段（２４）と、
前記メモリに書き込まれたデータ列を読み出して、該データ列に含まれる各フレームおよび付帯情報の解析を行なう解析部（２６）とを備えている。
【００１２】
【発明の実施の形態】
以下、図面に基づいて本発明の実施の形態を説明する。
図１は、本発明を適用したデータ解析装置２０の構成を示している。
【００１３】
図１において、インタフェース２１は、例えば１０Ｇｂｐｓのイーサネット（登録商標）のように高速な伝送レートを有し、フレーム間に所定の隙間（ギャップデータ部やプリアンブル）が設けられたデータ列を伝送するネットワーク１に接続して、ネットワーク１上を伝送するシリアルのデータ列Ｄを装置内に取り込むとともに、そのデータ列Ｄに含まれるフレーム毎のエラー検知やシリアルパラレル変換処理等を行なう。
【００１４】
このインタフェース２１は、取り込んだデータ列に含まれる各フレームの終了位置または先頭位置とを検知し、所定ビット（例えば１２８ビット）でパラレル出力するデータ列Ｄ（シリアルで入力されるデータ列Ｄと実質的に同一なので同一符号を付す）における各フレームの終了位置情報ｅ（または終了位置情報ｓ）を出力する。また、各フレームについてのＦＣＳエラーチェックとフレーム長チェックとを行い、そのチェック結果Ｅ、Ｌを出力する。
【００１５】
時刻発生手段２２は時刻情報Ｔをリアルタイムに出力する。
【００１６】
付帯情報挿入手段２３は、インタフェース２１からの各フレーム毎のエラー検知結果Ｅ、Ｌ、終了位置情報ｅ（または先頭位置情報ｓ）および時刻発生手段２２からの時刻情報Ｔを受けて、各フレーム毎にエラー検知結果Ｅ、Ｌと取込時刻Ｔａ（図示せず）とからなる付帯情報Ｈを生成し、この付帯情報Ｈを、パラレルで入力されるデータ列Ｄの各フレームの後のギャップデータが挿入されている部分（あるいは、フレームの先頭位置を示すプリアンブル部でもよい）に順次挿入して出力する。この挿入位置は、各フレームの終了位置情報ｅに基づいて設定する。
【００１７】
つまり、本発明で定義されるフレーム間の隙間は、実際にデータ信号が無い状態だけでなく、隙間を生めるためのギャップデータが挿入されている部分やフレームの先頭位置を示すプリアンブルが挿入されている部分も含むものとする。
【００１８】
なお、ここでは、インタフェース２１においてパラレルに変換されたデータ列Ｄに付帯情報Ｈを挿入する場合について説明するが、インタフェース２１において、シリアルのデータ列を例えば１６ビット幅のパラレルのデータ列に変換して付帯情報挿入手段２３に出力し、付帯情報挿入手段２３において、その１６ビット幅のパラレルのデータ列に付帯情報Ｈを挿入して、さらにその８倍の１２８ビット幅のデータ列に変換して出力するようにしてもよい。
【００１９】
図２は、付帯情報Ｈのフォーマット例であり、ｈｏｕｒ（時間）、ｍｉｎ（分）、ｓ（秒）、ｍｓ（ミリ秒）、μｓ（マイクロ秒）、ｎｓ（ナノ秒）の各データからなる４５ビットの時刻情報Ｔａと、フレーム長についての２ビットのエラー検知結果Ｌ、ＦＣＳについての１ビットのエラー検知結果Ｅとで構成されている。
【００２０】
書込手段２４は、付帯情報挿入手段２３によって付帯情報Ｈが挿入されたデータ列Ｄ′を時系列にメモリ２５に書き込む。
【００２１】
解析部２６は、メモリ２５にアクセスして、そのデータ列から解析対象のフレームのデータと付帯情報Ｈとを読み出して、種々の解析を行なう。
【００２２】
次にこのデータ解析装置２０の動作を説明する。
始めにネットワーク１上に、図３の（ａ）のようにフレームＦ（ｉ）、Ｆ（ｉ＋１）の間にギャップデータが挿入されている部分とフレームの先頭を示すプリアンブル部とからなる所定長の隙間Ｇ（ｉ）が設けられたデータ列が伝送されている状態で、所定のタイミングｔ０にインタフェース２１がそのデータ列Ｄの取り込みを開始する。
【００２３】
この取り込まれたシリアルのデータ列Ｄは、インタフェース２１によってシリアルパラレル変換処理され、図３の（ｂ）のように、所定ビット（例えば１２８ビット）幅のパラレルデータ列Ｄに変換されて、付帯情報挿入手段２３へ順次出力される。
【００２４】
付帯情報挿入手段２３は、図３の（ｃ）に示しているように、入力されるパラレルのデータ列Ｄに含まれる各フレームＦ（ｉ）の終了位置の直後にそのフレームＦ（ｉ）についての付帯情報Ｈ（ｉ）を挿入して書込手段２４に出力する。
【００２５】
書込手段２４に入力されたデータ列Ｄ′は、図４のように、メモリ２５に所定のアドレス順に時系列に書き込まれる。
【００２６】
そして、解析部２６は、所定時間分のデータ列がメモリ２５に書き込まれた段階で、メモリ２５にアクセスして、書き込まれたデータ列を読み出し、そのデータ列に含まれる各フレームのデータと付帯情報とに基づいて、種々の解析を行なう。
【００２７】
ここで、解析部２６が行なう解析としては、付帯情報Ｈの取込時刻Ｔａに基づく各フレームの伝送遅延時間（ネットワークの伝搬遅延特性）、エラー頻度等である。
【００２８】
このように、実施形態のデータ解析装置２０では、ネットワーク１のフレーム間に、ギャップ部やプリアンブルのように解析に不要な隙間があることを利用し、データ列に含まれる各フレームについての付帯情報を、その隙間にぞれぞれ挿入した状態でメモリ２５に書き込むようにしている。
【００２９】
このため、付帯情報Ｈを記憶するための専用のメモリと書込み手段が不要となり、また、解析対象のフレームのデータとそのフレームについての付帯情報とを一括に読み出すことができ、解析を効率的に行なうことができる。
【００３０】
なお、ここでは付帯情報Ｈとして、取込時刻Ｔａとエラー検知情報Ｅ、Ｌとが含まれていたが、解析内容によっては、そのいずれか一方のみを付帯情報Ｈとしてデータ列のフレーム間に挿入してもよく、また、そのフレームに関する他の情報を含めた付帯情報Ｈをデータ列のフレーム間に挿入してもよい。
【００３１】
また、ここでは、付帯情報Ｈを各フレームの末尾側のギャップデータ挿入部分に挿入する場合について説明したが、付帯情報Ｈをフレームの先頭側（プリアンブル部）に挿入してもよい。この場合には、付帯情報Ｈを挿入する位置をフレームの先頭位置情報ｓに基づいて設定する。
【００３２】
また、ここではイーサネット（登録商標）等のネットワーク上のデータ列について解析を行なう場合について説明したが、フレーム間に隙間を確保して伝送する他のネットワークに対するデータの解析を行なう場合においても、本発明を適用できる。
【００３３】
また、ここでは、データの解析のみを行なう装置について説明したが、試験の用のデータ列をネットワークに入力する機能を有する試験装置のデータ解析部に、本発明を適用することも可能である。
【００３４】
【発明の効果】
以上説明したように、本発明のデータ解析装置は、ネットワーク上を伝送するデータ列のフレームとフレームの間に存在する隙間を利用し、データ列に含まれる各フレームについての付帯情報を、その隙間にぞれぞれ挿入した状態でフレームのデータとともにメモリに書き込むようにしている。
【００３５】
このため、付帯情報を記憶するための専用のメモリと書込み手段が不要となり、また、解析対象のフレームのデータとそのフレームについての付帯情報とを一括に読み出すことができ、解析を効率的に行なうことができる。
【図面の簡単な説明】
【図１】本発明の実施形態の構成を示す図
【図２】実施形態の要部が挿入する付帯情報のフォーマット例
【図３】実施形態の動作説明図
【図４】実施形態のメモリに記憶されたデータ列の例を示す図
【図５】従来装置の構成を示す図
【符号の説明】
１……ネットワーク、２０……データ解析装置、２１……インタフェース、２２……時刻発生手段、２３……付帯情報挿入手段、２４……書込手段、２５……メモリ、２６……解析部
【図１】
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【図２】
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【図３】
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【図４】
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【図５】
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