(57)【要約】【課題】プラズマディスプレイパネルにおいて、コストダウンを図るために駆動回路との接続構造を変更した場合であっても、接続の信頼性を確保できるようにすることを目的とする。【解決手段】前面板２２の表示電極の延長方向の両端部に表示ドライバ回路に接続するための表示電極引出部２４を形成するとともに、背面板２３のアドレス電極の延長方向の両端部にアドレスドライバ回路に接続するためのアドレス電極引出部２６を形成してパネル本体２１を構成し、かつ前記パネル本体２１の一方のアドレス電極引出部２６にアドレス電極とアドレスドライバ回路とを接続するＦＰＣ２８を配設するとともに、両方のアドレス電極引出部２６を防湿性樹脂２９により被覆した。【選択図】　図４
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【特許請求の範囲】
【請求項１】
複数の表示電極を配列して形成した前面板と、この前面板に間に放電空間が形成されるように対向配置されるとともに外周部が封着されかつ前記表示電極に交差するように複数のアドレス電極を配列して形成した背面板とを有し、前記前面板の表示電極の延長方向の両端部に表示ドライバ回路に接続するための表示電極引出部を形成するとともに、前記背面板のアドレス電極の延長方向の両端部にアドレスドライバ回路に接続するためのアドレス電極引出部を形成してパネル本体を構成し、かつ前記パネル本体の一方のアドレス電極引出部にアドレス電極とアドレスドライバ回路とを接続するフレキシブル配線板を配設するとともに、両方のアドレス電極引出部を樹脂により被覆したことを特徴とするプラズマディスプレイパネル。
【発明の詳細な説明】
【０００１】
【発明の属する技術分野】
本発明は、大画面で、薄型、軽量のディスプレイ装置として知られているプラズマディスプレイパネル（以下、ＰＤＰという）に関するものである。
【０００２】
【従来の技術】
ＰＤＰは、液晶パネルに比べて高速の表示が可能であり視野角が広いこと、大型化が容易であること、自発光型であるため表示品質が高いことなどの理由から、フラットパネルディスプレイ技術の中で最近特に注目を集めている。
【０００３】
一般に、このＰＤＰでは、ガス放電により紫外線を発生させ、この紫外線で蛍光体を励起して発光させカラー表示を行っている。そして、基板上に隔壁によって区画された表示セルが設けられており、これに蛍光体層が形成されている構成を有する。
【０００４】
このＰＤＰには、大別して、駆動的にはＡＣ型とＤＣ型があり、放電形式では面放電型と対向放電型の２種類があるが、高精細化、大画面化および製造の簡便性から、現状では、ＰＤＰの主流は、３電極構造の面放電型のもので、その構造は、一方の基板上に平行に隣接した表示電極を有し、もう一方の基板上に表示電極と交差する方向に配列されたアドレス電極と、隔壁、蛍光体層を有するもので、比較的蛍光体層を厚くすることができ、蛍光体によるカラー表示に適している。
【０００５】
【発明が解決しようとする課題】
ところで、ＡＣ型として代表的な交流面放電型ＰＤＰは、一般的に、面放電を行う表示電極を配列して形成したガラス基板からなる前面板とアドレス電極を配列して形成したガラス基板からなる背面板とを、両電極がマトリックスを組むように、しかも間隙に放電空間を形成するように平行に対向配置され、その外周部をガラスフリットなどの封着材によって封着することによりパネル本体が構成されている。そして、前記前面板、背面板から電極端子の引出しを行う場合は、それぞれの電極に外部から電圧が印加できるようにガラス基板の端面近傍まで形成された電極引出部を設け、この電極引出部を通して外部の駆動回路と接続することにより行っている。また、この電極引出部と駆動回路との接続は、電極引出部にフレキシブル配線板を異方性を有する異方導電性接着材を介して圧着することにより接続を行っている。
【０００６】
本発明はこのようなＰＤＰにおいて、コストダウンを図るために駆動回路との接続構造を変更した場合であっても、接続の信頼性を確保できるようにすることを目的とするものである。
【０００７】
【課題を解決するための手段】
上記目的を達成するために本発明は、パネル本体の一方のアドレス電極引出部にアドレス電極とアドレスドライバ回路とを接続するフレキシブル配線板を配設するとともに、両方のアドレス電極引出部を樹脂により被覆したものである。
【０００８】
【発明の実施の形態】
すなわち、本発明の請求項１記載の発明は、複数の表示電極を配列して形成した前面板と、この前面板に間に放電空間が形成されるように対向配置されるとともに外周部が封着されかつ前記表示電極に交差するように複数のアドレス電極を配列して形成した背面板とを有し、前記前面板の表示電極の延長方向の両端部に表示ドライバ回路に接続するための表示電極引出部を形成するとともに、前記背面板のアドレス電極の延長方向の両端部にアドレスドライバ回路に接続するためのアドレス電極引出部を形成してパネル本体を構成し、かつ前記パネル本体の一方のアドレス電極引出部にアドレス電極とアドレスドライバ回路とを接続するフレキシブル配線板を配設するとともに、両方のアドレス電極引出部を樹脂により被覆したことを特徴とする。
【０００９】
以下、本発明の一実施の形態によるＰＤＰについて、図１〜図５を用いて説明するが、本発明の実施の態様はこれに限定されるものではない。
【００１０】
まず、パネル本体の構造について図１を用いて説明する。図１に示すように、ガラス基板などの透明な前面側の基板１上には、スキャン電極とサステイン電極とで対をなすストライプ状の表示電極２が複数列形成され、そしてその電極群を覆うように誘電体層３が形成され、その誘電体層３上には保護膜４が形成されている。
【００１１】
また、前記前面側の基板１に対向配置される背面側の基板５上には、スキャン電極及びサステイン電極の表示電極２と交差するように、オーバーコート層６で覆われた複数列のストライプ状のアドレス電極７が形成されている。このアドレス電極７間のオーバーコート層６上には、アドレス電極７と平行に複数の隔壁８が配置され、この隔壁８間の側面およびオーバーコート層６の表面に蛍光体層９が設けられている。
【００１２】
これらの基板１と基板５とは、スキャン電極およびサステイン電極の表示電極２とアドレス電極７とがほぼ直交するように、微小な放電空間を挟んで対向配置されるとともに、周囲が封着材により封止され、そして前記放電空間には、ヘリウム、ネオン、アルゴン、キセノンのうちの一種または混合ガスが放電ガスとして封入されている。また、放電空間は、隔壁８によって複数の区画に仕切ることにより、表示電極２とアドレス電極７との交点が位置する複数の放電セルが設けられ、その各放電セルには、赤色、緑色及び青色となるように蛍光体層９が一色ずつ順次配置されている。
【００１３】
図２にこのパネル本体の電極配列を示しており、図２に示すようにスキャン電極およびサステイン電極とアドレス電極とは、Ｍ行×Ｎ列のマトリックス構成であり、行方向にはＭ行のスキャン電極ＳＣＮ１〜ＳＣＮＭおよびサステイン電極ＳＵＳ１〜ＳＵＳＭが配列され、列方向にはＮ列のアドレス電極Ｄ１〜ＤＮが配列されている。
【００１４】
このような電極構成のＰＤＰにおいては、アドレス電極とスキャン電極の間に書き込みパルスを印加することにより、アドレス電極とスキャン電極の間でアドレス放電を行い、放電セルを選択した後、スキャン電極とサステイン電極との間に、交互に反転する周期的な維持パルスを印加することにより、スキャン電極とサステイン電極との間で維持放電を行い、所定の表示を行うものである。
【００１５】
図３に、本実施の形態におけるＰＤＰの表示駆動回路の構成を示している。図３に示すように、図１に示す構成のＰＤＰ１０、アドレスドライバ回路１１、スキャンドライバ回路１２、サステインドライバ回路１３、放電制御タイミング発生回路１４、電源回路１５、１６、Ａ／Ｄコンバータ（アナログ・デジタル変換器）１７、走査数変換部１８、及びサブフィールド変換部１９を備えている。
【００１６】
図３の回路において、まず、映像信号ＶＤは、Ａ／Ｄコンバータ１７に入力される。また、水平同期信号Ｈ及び垂直同期信号Ｖは放電制御タイミング発生回路１４、Ａ／Ｄコンバータ１７、走査数変換部１８、サブフィールド変換部１９に与えられる。Ａ／Ｄコンバータ１７は、映像信号ＶＤをデジタル信号に変換し、その画像データを走査数変換部１８に与える。
【００１７】
走査数変換部１８は、画像データをＰＤＰ１０の画素数に応じたライン数の画像データに変換し、各ラインごとの画像データをサブフィールド変換部１９に与える。サブフィールド変換部１９は、各ラインごとの画像データの各画素データを複数のサブフィールドに対応する複数のビットに分割し、各サブフィールドごとに各画素データの各ビットをアドレスドライバ回路１１にシリアルに出力する。アドレスドライバ回路１１は、電源回路１５に接続されており、サブフィールド変換部１９から各サブフィールドごとにシリアルに与えられるデータをパラレルデータに変換し、そのパラレルデータに基づいて複数のアドレス電極に電圧を供給する。
【００１８】
放電制御タイミング発生回路１４は、水平同期信号Ｈおよび垂直同期信号Ｖを基準として、放電制御タイミング信号ＳＣ、ＳＵを発生し、各々スキャンドライバ回路１２およびサステインドライバ回路１３に与える。スキャンドライバ回路１２は、出力回路１２１及びシフトレジスタ１２２を有する。また、サステインドライバ回路１３は、出力回路１３１及びシフトレジスタ１３２を有する。これらのスキャンドライバ回路１２及びサステインドライバ回路１３は共通の電源回路１６に接続されている。
【００１９】
スキャンドライバ回路１２のシフトレジスタ１２２は、放電制御タイミング発生回路１４から与えられる放電制御タイミング信号ＳＣを垂直走査方向にシフトしつつ出力回路１２１に与える。出力回路１２１は、シフトレジスタ１２２から与えられる放電制御タイミング信号ＳＣに応答して複数のスキャン電極に順に駆動信号電圧を供給する。
【００２０】
サステインドライバ回路１３のシフトレジスタ１３２は、放電制御タイミング発生回路１４から与えられる放電制御タイミング信号ＳＵを垂直走査方向にシフトしつつ出力回路１３１に与える。出力回路１３１は、シフトレジスタ１３２から与えられる放電制御タイミング信号ＳＵに応答して複数のサステイン電極に順に駆動信号電圧を供給する。
【００２１】
図４はＰＤＰのパネル本体を示す平面図、図５はフレキシブルプリント配線板（ＦＰＣ）を取り付ける前のパネル本体を示す図で、図５（ａ）、（ｂ）はそれぞれパネル本体を背面側、前面側から見た図である。
【００２２】
パネル本体２１の前面板２２および背面板２３はほぼ矩形状であり、長辺と短辺を有している。図５（ａ）に示すように、前面板２２の短辺である左右両端部の封着材より外側の縁部には、スキャン電極またはサステイン電極それぞれに接続された複数本の端子が複数のブロックに分けられて形成され、これにより表示電極引出部２４が形成されている。すなわち、表示電極引出部２４には、所定の複数本の端子で１ブロックが構成された端子ブロック２５が複数設けられており、各々の端子ブロック２５にはＦＰＣ（図示せず）が接続される。
【００２３】
また、図５（ｂ）に示すように、背面板２３の長辺である両端部の封着材より外側の縁部には、アドレス電極に接続された複数本の端子が複数のブロックに分けられて形成され、これによりアドレス電極引出部２６が形成されている。このアドレス電極引出部２６には、所定の複数本の端子で１ブロックが構成された端子ブロック２７が複数設けられている。
【００２４】
ところで、このようなＰＤＰにおいては、コストダウンを図るために、シングルスキャン駆動が用いられるが、この駆動方式の場合、図４に示すように、一方の下端部側のアドレス電極引出部２６のみにアドレス電極とアドレスドライバ回路とを接続するＦＰＣ２８が接続され、上端部側のアドレス電極引出部２６にはＦＰＣ２８が接続されず、アドレス電極引出部２６の端子ブロック２７が露出した状態のままとなる。
【００２５】
このようにアドレス電極引出部２６の端子ブロック２７が露出した状態で電圧を印加すると、アドレス電極はパネル本体２１内でつながっていることから、露出した上端部側のアドレス電極引出部２６の電極間においても電位差が生じ、これによりアドレス電極を構成している銀電極において、雰囲気中の水分により銀のマイグレーション現象が生じてしまう。
【００２６】
本発明においては、一方の下端部側のアドレス電極引出部２６にアドレス電極とアドレスドライバ回路とを接続するＦＰＣ２８を配設するとともに、両方のアドレス電極引出部２６を光硬化性、熱硬化性、熱可塑性などの防湿性樹脂２９により被覆しており、両方のアドレス電極引出部２６が露出しない構造となるため、雰囲気中の水分が侵入して銀のマイグレーションを起こすことがなく、これによりシングルスキャン駆動方式を用いた場合でも、接続の信頼性を確保することができる。
【００２７】
【発明の効果】
以上の説明から明らかなように本発明によれば、コストダウンを図るためにシングルスキャン駆動方式を用いて場合であっても、銀のマイグレーションを防いで接続の信頼性を確保することができるという効果が得られる。
【図面の簡単な説明】
【図１】本発明の一実施の形態によるＰＤＰのパネルの概略構成を示す斜視図
【図２】同ＰＤＰの電極配列を示す説明図
【図３】同ＰＤＰの表示駆動回路の一例を示すブロック回路図
【図４】同ＰＤＰのＦＰＣ取り付け後のパネル本体を示す平面図
【図５】（ａ），（ｂ）は同ＰＤＰのＦＰＣ取り付け前のパネル本体を示す平面図
【符号の説明】
１、５　基板
２　表示電極
７　アドレス電極
１０　ＰＤＰ
２１　パネル本体
２２　前面板
２３　背面板
２４　表示電極引出部
２６　アドレス電極引出部
２８　ＦＰＣ
２９　防湿性樹脂
【図１】
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【図２】
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【図３】
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【図４】
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【図５】
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