(57)【要約】　　　（修正有）【課題】スルーレート（Ｓｌｅｗ　Ｒａｔｅ）を減少させる薄膜トランジスタ型液晶表示装置のソースドライバ回路及び方法を提供する。【解決手段】データラッチ部はメインクロック信号に応答してカラーデータを受信して保存し、所定の第１信号に応答して保存された前記カラーデータを出力する。スイッチバッファ部は前記データラッチ部から出力される前記カラーデータを受信し所定の第２信号に応答して前記カラーデータをパネルに印加する。出力制御部は前記メインクロック信号、パネルに出力されるカラーデータの電圧の極性を制御する極性反転信号及び第１クロック信号に応答して前記第１信号及び前記第２信号を発生する。これにより、半導体チップの外部から別の信号を作らず既存の信号を用いてパネルに印加されるカラーデータのスルーレート（カラーデータの出力が所望の値になるまでの時間に対応する）が減らせる長所がある。【選択図】　図３
2004004556.tif 000002
【特許請求の範囲】
【請求項１】
薄膜トランジスタ型液晶表示装置のソースドライバ回路において、
メインクロック信号に応答してカラーデータを受信して保存し、所定の第１信号に応答して保存された前記カラーデータを出力するデータラッチ部と、
前記データラッチ部から出力される前記カラーデータを受信し所定の第２信号に応答して前記カラーデータをパネルに印加するスイッチバッファ部と、
前記メインクロック信号、前記パネルに出力されるカラーデータの電圧の極性を制御する極性反転信号、及び第１クロック信号に応答して前記第１信号及び前記第２信号を発生する出力制御部と、
を備えることを特徴とする薄膜トランジスタ型液晶表示装置のソースドライバ回路。
【請求項２】
前記第１信号は、
前記極性反転信号の位相が反転される度に前記極性反転信号の立ち上がりエッジまたは立ち下がりエッジに応答して所定時間の間活性化され、
前記極性反転信号の位相が変わらない場合は、前記第１クロック信号が前記第１信号として発生されることを特徴とする請求項１に記載の薄膜トランジスタ型液晶表示装置のソースドライバ回路。
【請求項３】
前記第２信号は、前記極性反転信号の位相が反転される度に前記極性反転信号の立ち上がりエッジまたは立ち下がりエッジに応答して非活性化され前記第１クロック信号の立ち上がりエッジに応答して活性化され、
前記極性反転信号の位相が変わらない場合は、現在の状態を維持することを特徴とする請求項１に記載の薄膜トランジスタ型液晶表示装置のソースドライバ回路。
【請求項４】
前記出力制御部は、
前記メインクロック信号に応答して前記極性反転信号を受信し所定時間遅らせて出力する遅延部と、
第１クロック信号に応答して前記極性反転信号を受信し、前記極性反転信号の位相が反転される度に活性化され、前記極性反転信号の位相が変わらない場合は、前記第１クロック信号を前記第１信号として発生する第１信号発生部と、
前記極性反転信号、前記遅延部の出力信号、及び所定の遅延第１クロック信号を受信して、前記極性反転信号の立ち上がりエッジまたは立ち下がりエッジに応答して非活性化され前記第１クロック信号の立ち上がりエッジに応答して活性化され、前記極性反転信号の位相が変わらない場合は、現在の状態を維持する前記第２信号を発生する第２信号発生部と、
を備えることを特徴とする請求項１に記載の薄膜トランジスタ型液晶表示装置のソースドライバ回路。
【請求項５】
前記第２信号発生部は、
前記メインクロック信号に応答して前記第１クロック信号を受信し所定時間遅らせて前記遅延第１クロック信号を発生する遅延クロック部をさらに備えることを特徴とする請求項４に記載の薄膜トランジスタ型液晶表示装置のソースドライバ回路。
【請求項６】
前記遅延部は、
複数個のフリップフロップを備えることを特徴とする請求項４に記載の薄膜トランジスタ型液晶表示装置のソースドライバ回路。
【請求項７】
前記第１信号発生部は、
第１クロック信号に応答して前記極性反転信号を受信し遅らせて出力する第１及び第２フリップフロップと、
前記第１フリップフロップの出力及び前記第２フリップフロップの出力信号を受信して排他的論理和演算する第２排他的論理和手段と、
前記第２排他的論理和手段の出力を反転して出力する第２インバータと、
前記第２インバータの出力及び前記第１クロック信号を論理積演算する論理積手段と、
前記遅延部のフリップフロップのうち一番目のフリップフロップの反転出力信号を反転した信号及び三番目のフリップフロップの出力信号を排他的論理和演算する第３排他的論理和手段と、
前記第３排他的論理和手段及び前記論理積手段の出力を論理和演算して前記第１信号として出力する論理和手段と、を備えることを特徴とする請求項４に記載の薄膜トランジスタ型液晶表示装置のソースドライバ回路。
【請求項８】
前記第２信号発生部は、
前記極性反転信号及び前記遅延部の出力信号を受信して排他的論理和演算する第１排他的論理和手段と、
前記第１排他的論理和手段の出力及び前記遅延第１クロック信号を受信して出力するＳＲラッチと、
前記ＳＲラッチの出力を反転して前記第２信号として発生する第１インバータと、
を備えることを特徴とする請求項４に記載の薄膜トランジスタ型液晶表示装置のソースドライバ回路。
【請求項９】
薄膜トランジスタ型液晶表示装置のソースドライバ回路においてパネルに印加されるカラーデータのスルーレートを調節する方法において、
（ａ）メインクロック信号に応答してカラーデータを受信して保存し、所定の第１信号に応答して保存された前記カラーデータを出力する段階と、
（ｂ）前記出力されるカラーデータを受信し所定の第２信号に応答して前記カラーデータをパネルに印加する段階と、
を含むことを特徴とするパネルに印加されるカラーデータのスルーレートを調節する方法。
【請求項１０】
前記（ａ）段階は、
（ａ１）前記メインクロック信号に応答して前記カラーデータを受信して保存する段階と、
（ａ２）前記メインクロック信号、前記パネルに出力されるカラーデータの電圧の極性を制御する極性反転信号、及び第１クロック信号に応答して前記第１信号を発生する段階と、
（ａ３）前記第１信号に応答して前記カラーデータを出力する段階と、
を含むことを特徴とする請求項９に記載のパネルに印加されるカラーデータのスルーレートを調節する方法。
【請求項１１】
前記（ａ２）段階は、
（ａ２１）　前記第１クロック信号に応答して前記極性反転信号を受信し、前記極性反転信号を相異なる時間の間遅らせた二つの信号を排他的論理和演算する段階と、
（ａ２２）前記（ａ２１）段階の出力を反転して出力する段階と、
（ａ２３）前記（ａ２２）段階の出力及び前記第１クロック信号を論理積演算する段階と、
（ａ２４）メインクロック信号に応答して前記極性反転信号を受信し、前記極性反転信号を前記相異なる時間の間遅らせた前記二つの信号を排他的に論理和演算する段階と、
（ａ２５）前記（ａ２３）段階と前記（ａ２４）段階の出力を論理和演算して前記第１信号を発生する段階と、
を含むことを特徴とする請求項１０に記載のパネルに印加されるカラーデータのスルーレートを調節する方法。
【請求項１２】
前記（ｂ）段階は、
（ｂ１）前記出力されるカラーデータを受信し前記カラーデータがそれぞれ一定した電圧を表示するようデコーディングする段階と、
（ｂ２）前記デコーディングされたカラーデータを受信しバッファリングして出力する段階と、
（ｂ３）前記メインクロック信号、前記パネルに出力されるカラーデータの電圧の極性を制御する極性反転信号及び第１クロック信号に応答して前記第２信号を発生する段階と、
（ｂ４）前記第２信号に応答して前記カラーデータを前記パネルに印加する段階と、
を含むことを特徴とする請求項９に記載のパネルに印加されるカラーデータのスルーレートを調節する方法。
【請求項１３】
前記（ｂ３）段階は、
（ｂ３１）メインクロック信号に応答して前記極性反転信号を受信し、前記極性反転信号及び前記極性反転信号を遅らせた信号を受信して排他的論理和演算する段階と、
（ｂ３２）前記（ｂ３１）段階の出力及び前記第１クロック信号を遅らせた遅延第１クロック信号を受信しラッチする段階と、
（ｂ３３）前記（ｂ３２）段階の出力を反転して前記第２信号を発生する段階と、
を含むことを特徴とする請求項１２に記載のパネルに印加されるカラーデータのスルーレートを調節する方法。
【請求項１４】
前記第１信号は、
前記極性反転信号の位相が反転される度に前記極性反転信号の立ち上がりエッジまたは立ち下がりエッジに応答して所定時間の間活性化され、
前記極性反転信号の位相が変わらない場合は、前記第１クロック信号が前記第１信号として発生されることを特徴とする請求項９に記載のパネルに印加されるカラーデータのスルーレートを調節する方法。
【請求項１５】
前記第２信号は、
前記極性反転信号の位相が反転される度に前記極性反転信号の立ち上がりエッジまたは立ち下がりエッジに応答して非活性化され、前記第１クロック信号の立ち上がりエッジに応答して活性化され、
前記極性反転信号の位相が変わらない場合は、現在の状態を維持することを特徴とする請求項９に記載のパネルに印加される　カラーデータのスルーレートを調節する方法。
【請求項１６】
薄膜トランジスタ型液晶表示装置のソースドライバ回路において、
メインクロック信号に応答してカラーデータを受信して保存し、所定の第１信号に応答して保存された前記カラーデータを出力するデータラッチ部と、
前記データラッチ部から出力される前記カラーデータを受信し所定の第２信号に応答して前記カラーデータをパネルに印加するスイッチバッファ部と、
を備えることを特徴とする薄膜トランジスタ型液晶表示装置のソースドライバ回路。
【請求項１７】
前記第１信号は、
前記メインクロック信号、前記パネルに出力されるカラーデータの電圧の極性を制御する極性反転信号、及び第１クロック信号に応答して発生され、
前記極性反転信号の位相が反転される度に前記極性反転信号の立ち上がりエッジまたは立ち下がりエッジに応答して所定時間の間活性化され、
前記極性反転信号の位相が変わらない場合は、前記第１クロック信号が前記第１信号として発生されることを特徴とする請求項１６に記載の薄膜トランジスタ型液晶表示装置のソースドライバ回路。
【請求項１８】
前記第２信号は、
前記メインクロック信号、前記パネルに出力されるカラーデータの電圧の極性を制御する極性反転信号、及び第１クロック信号に応答して発生され、
前記極性反転信号の位相が反転される度に前記極性反転信号の立ち上がりエッジまたは立ち下がりエッジに応答して非活性化され前記第１クロック信号の立ち上がりエッジに応答して活性化され、
前記極性反転信号の位相が変わらない場合は、現在の状態を維持することを特徴とする請求項１６に記載の薄膜トランジスタ型液晶表示装置のソースドライバ回路。
【請求項１９】
薄膜トランジスタ型液晶表示装置のソースドライバにおいて、
メインクロック信号に応答してカラーデータを受信して保存する第１データラッチ部と、
前記第１データラッチ部から出力される前記カラーデータを受信して保存した後所定の第１信号に応答して保存された前記カラーデータを出力する第２データラッチ部と、
所定の電圧制御信号に応答して前記第２データラッチ部から出力される前記カラーデータがそれぞれ一定電圧を表示するようにするデコーディング部と、
前記デコーディング部から出力される前記カラーデータを受信しバッファリングして出力する出力バッファ部と、
所定の第２信号に応答して前記出力バッファ部から出力される前記カラーデータをパネルに印加したり遮断したりする出力スイッチ部と、
前記メインクロック信号、前記パネルに出力されるカラーデータの電圧の極性を制御する極性反転信号、及び第１クロック信号に応答して前記第１信号及び前記第２信号を発生する出力制御部と、
を備えることを特徴とする薄膜トランジスタ型液晶表示装置のソースドライバ回路。
【請求項２０】
前記出力制御部は、
前記メインクロック信号に応答して前記極性反転信号を受信し所定時間遅らせて出力する遅延部と、
第１クロック信号に応答して前記極性反転信号を受信し、前記極性反転信号の位相が反転される毎に活性化され、前記極性反転信号の位相が変わらない場合前記第１クロック信号を前記第１信号として発生する第１信号発生部と、
前記極性反転信号、前記遅延部の出力信号、及び所定の遅延第１クロック信号を受信して、前記極性反転信号の立ち上がりエッジまたは立ち下がりエッジに応答して非活性化され前記第１クロック信号の立ち上がりエッジに応答して活性化され、前記極性反転信号の位相が変わらない場合は、現在の状態を維持する前記第２信号を発生する第２信号発生部と、
を備えることを特徴とする請求項１９に記載の薄膜トランジスタ型液晶表示装置のソースドライバ回路。
【請求項２１】
前記第２信号発生部は、
前記メインクロック信号に応答して前記第１クロック信号を受信し所定時間遅らせて前記遅延第１クロック信号を発生する遅延クロック部をさらに備えることを特徴とする請求項２０に記載の薄膜トランジスタ型液晶表示装置のソースドライバ回路。
【請求項２２】
前記遅延部は、
複数個のフリップフロップを備えることを特徴とする請求項１９に記載の薄膜トランジスタ型液晶表示装置のソースドライバ回路。
【請求項２３】
前記第１信号発生部は、
第１クロック信号に応答して前記極性反転信号を受信し遅らせて出力する第１及び第２フリップフロップと、
前記第１フリップフロップの出力及び前記第２フリップフロップの出力信号を受信して排他的論理和演算する第２排他的論理和手段と、
前記第２排他的論理和手段の出力を反転して出力する第２インバータと、
前記第２インバータの出力及び前記第１クロック信号を論理積演算する論理積手段と、
前記遅延部のフリップフロップのうち一番目のフリップフロップの反転出力信号を反転した信号及び三番目のフリップフロップの出力信号を排他的論理和演算する第３排他的論理和手段と、
前記第３排他的論理和手段及び前記論理積手段の出力を論理和演算して前記第１信号として出力する論理和手段と、を備えることを特徴とする請求項１９に記載の薄膜トランジスタ型液晶表示装置のソースドライバ回路。
【請求項２４】
前記第２信号発生部は、
前記極性反転信号及び前記遅延部の出力信号を受信して排他的論理和演算する第１排他的論理和手段と、
前記排他的論理和手段の出力及び前記遅延第１クロック信号を受信して出力するＳＲラッチと、
前記ＳＲラッチの出力を反転して前記第２信号として発生する第１インバータと、
を備えることを特徴とする請求項１９に記載の薄膜トランジスタ型液晶表示装置のソースドライバ回路。
【発明の詳細な説明】
【０００１】
【発明の属する技術分野】
本発明は薄膜トランジスタ型液晶表示装置に係り、特にスルーレートを減少させうる薄膜トランジスタ型液晶表示装置のソースドライバ回路に関する。
【０００２】
【従来の技術】
一般に、液晶表示装置はパネルのゲートラインを駆動するためのゲートドライバとパネルのソースラインを駆動するためのソースドライバを具備する。ゲートドライバがパネルに高電圧を印加してパネルを導通状態にした後に、ソースドライバがそれぞれのソースラインに色を表示するための階調電圧（ソースドライバ出力信号）を印加することによってパネルに画面を表示する。
【０００３】
さらに詳しく説明すると、ソースドライバはパネルにディスプレイされる１画素当たり６ビットのカラーデータをプロセッサから１画素ずつ入力される。ソースドライバにはパネルのゲートラインの１ライン分の画素についてのカラーデータが入力されラッチされる。パネルのゲートラインの１ライン分に相当するカラーデータを全てラッチした後に、最後にそのライン分の各画素のカラーデータをまとめて、カラーを表示する電圧をパネルに１ラインずつ同時に印加する。この際、ゲートドライバはゲートラインのうち１ラインだけに高い電圧を印加してソースラインに印加されたカラーデータが該当ゲートラインに保存されうるようトランジスタをターンオンさせ電圧が貯蔵されカラーが表示できるようにする。
【０００４】
図１は従来の薄膜トランジスタ型液晶表示装置のソースドライバ回路を示すブロック図である。
【０００５】
図２は図１のソースドライバ回路の動作を示すタイミング図である。
【０００６】
図１を参照すれば、従来のソースドライバ回路１００はシフトレジスタ１１０、第１データラッチ部１２０、第２データラッチ部１３０、デコーダ１４０及び出力バッファ部１５０を備える。
【０００７】
シフトレジスタ１１０はメインクロック信号ＭＣＬＫを受信して第１データラッチ部１２０に印加する。メインクロック信号ＭＣＬＫに応答してカラーデータＤＡＴＡが第１データラッチ部１２０に入力されラッチされる。第２データラッチ部１３０は第１データラッチ部１２０からカラーデータＤＡＴＡを受信し第１クロック信号ＣＬＫ１に応答して出力する。デコーダ１４０は第２データラッチ部１３０から出力されるカラーデータＤＡＴＡを受信し電圧制御信号ＶＧＭＡに応答してカラーデータＤＡＴＡが一定電圧レベルを有するようにする。出力バッファ部１５０は一定した電圧レベルを有するカラーデータＤＡＴＡを受信し所定の基準電圧を基準にして基準電圧より高い電圧であるか低い電圧であるかを表示する極性反転信号ＰＯＬに応答してカラーデータＹＤＡＴＡの極性を表示してパネル１６０に出力する。
【０００８】
ところが、ソースドライバ回路１００において出力バッファ部１５０から出力されるカラーデータＹＤＡＴＡはスルーレート（Ｓｌｅｗ　Ｒａｔｅ）が重要な要素の一つである。特に、ＵＸＧＡ（Ｕｌｔｒａ　Ｅｘｔｅｎｄｅｄ　Ｇｒａｐｈｉｃｓ　Ａｒｒａｙ）級パネル以上では水平同期区間が１３μｓ〜１５μｓほどにしかならないため、出力バッファ部１５０から出力されるカラーデータＹＤＡＴＡのスルーレートが３μｓ以上の場合は良好な画質駆動が困難である。
【０００９】
出力バッファ部１５０から出力されるカラーデータＹＤＡＴＡのスルーレートはパネル１６０の高負荷によってさらに制約を受けるため、ソースドライバ回路１００の外部のパネル１６０上の抵抗やキャパシタによって矩形波のような駆動ができない。
【００１０】
図２を参照すると、出力バッファ部１５０から出力されるカラーデータＹＤＡＴＡは第１クロック信号ＣＬＫ１に応答して出力される。極性反転信号ＰＯＬの位相が変わる度にカラーデータＹＤＡＴＡの極性が基準電圧ＶＣＯＭを基準にして変わることが分かる。
【００１１】
カラーデータＹＤＡＴＡが第１クロック信号ＣＬＫ１に応答して出力されるが、第１クロック信号ＣＬＫ１は第２データラッチ部１３０に印加される信号なので出力バッファ部１５０から出力されるカラーデータＹＤＡＴＡのスルーレートには第２データラッチ部１３０から出力バッファ部１５０までの移動時間が含まれる。図２においても長いスルーレートによってカラーデータＹＤＡＴＡの出力曲線が緩やかに変わることが分かる。
【００１２】
このようにスルーレートが延びる（カラーデータの出力が所望の値となるまでに時間がかかる）ことによってソースドライバ回路における電流消費が多くなり、高い負荷及び高解像度を有するパネルの特性が不安定になる問題点がある。
【００１３】
【発明が解決しようとする課題】
本発明は前述した問題点を解決するために案出されたもので、その目的はカラーデータをパネルに印加する信号が入力される前に予めカラーデータをソースドライバ回路の出力バッファ部に印加してパネルに印加されるカラーデータのスルーレートを減らせる（カラーデータの出力が所望の値になるまでの時間を減少させる）ソースドライバ回路を提供するところにある。
【００１４】
本発明がなそうとする他の技術的課題は、カラーデータをパネルに印加する信号が入力される前に予めカラーデータをソースドライバ回路の出力バッファ部に印加してパネルに印加されるカラーデータのスルーレートを調節する方法を提供するところにある。
【００１５】
【課題を解決するための手段】
前述した技術的課題を達成するための本発明の好適な第１の実施形態による薄膜トランジスタ型液晶表示装置のソースドライバ回路は、データラッチ部、スイッチバッファ部及び出力制御部を備えることを特徴とする。
【００１６】
データラッチ部はメインクロック信号に応答してカラーデータを受信して保存し、所定の第１信号に応答して保存された前記カラーデータを出力する。
【００１７】
スイッチバッファ部は前記データラッチ部から出力される前記カラーデータを受信し所定の第２信号に応答して前記カラーデータをパネルに印加する。
【００１８】
出力制御部は前記メインクロック信号、前記パネルに出力されるカラーデータの電圧の極性を制御する極性反転信号及び第１クロック信号に応答して前記第１信号及び前記第２信号を発生する。
【００１９】
望ましくは、前記第１信号は前記極性反転信号の位相が反転される度に前記極性反転信号の立ち上がりエッジまたは立ち下がりエッジに応答して所定時間の間活性化され、前記極性反転信号の位相が変わらない場合は、前記第１クロック信号が前記第１信号として発生することを特徴とする。
【００２０】
また、前記第２信号は前記極性反転信号の位相が反転される度に前記極性反転信号の立ち上がりエッジまたは立ち下がりエッジに応答して非活性化され前記第１クロック信号の立ち上がりエッジに応答して活性化され、前記極性反転信号の位相が変わらない場合は現在の状態を維持することを特徴とする。
【００２１】
望ましくは、前記出力制御部は前記メインクロック信号に応答して前記極性反転信号を受信し所定時間遅らせて出力する遅延部、第１クロック信号に応答して前記極性反転信号を受信し、前記極性反転信号の位相が反転される度に活性化され、前記極性反転信号の位相が変わらない場合は、前記第１クロック信号を前記第１信号として発生する第１信号発生部及び前記極性反転信号、前記遅延部の出力信号、及び所定の遅延第１クロック信号を受信して、前記極性反転信号の立ち上がりエッジまたは立ち下がりエッジに応答して非活性化され前記第１クロック信号の立ち上がりエッジに応答して活性化され、前記極性反転信号の位相が変わらない場合は、現在の状態を維持する前記第２信号を発生する第２信号発生部を備えることを特徴とする。前記第２信号発生部は前記メインクロック信号に応答して前記第１クロック信号を受信し所定時間遅らせて前記遅延第１クロック信号を発生する遅延クロック部をさらに備える。
【００２２】
前記遅延部は複数個のフリップフロップを備えることを特徴とする。前記第１信号発生部は第１クロック信号に応答して前記極性反転信号を受信し遅らせて出力する第１及び第２フリップフロップ、前記第１フリップフロップの出力及び前記第２フリップフップの出力信号を受信して排他的論理和演算する第２排他的論理和手段、前記第２排他的論理和手段の出力を反転して出力する第２インバータ、前記第２インバータの出力及び前記第１クロック信号を論理積演算する論理積手段、前記遅延部のフリップフロップのうち一番目のフリップフロップの反転出力信号を反転した信号及び三番目のフリップフロップの出力信号を排他的論理和演算する第３排他的論理和手段及び前記第３排他的論理和手段及び前記論理積手段の出力を論理和演算して前記第１信号として出力する論理和手段を備えることを特徴とする。
【００２３】
前記第２信号発生部は前記極性反転信号及び前記遅延部の出力信号を受信して排他的論理和演算する第１排他的論理和手段、前記第１排他的論理和手段の出力及び前記遅延第１クロック信号を受信して出力するＳＲラッチ及び該ＳＲラッチの出力を反転して前記第２信号として発生する第１インバータを備えることを特徴とする。
【００２４】
前述した技術的課題を達成するための本発明の好適な第２の実施形態による薄膜トランジスタ型液晶表示装置のソースドライバ回路はデータラッチ部及びスイッチバッファ部を備えることを特徴とする。
【００２５】
データラッチ部はメインクロック信号に応答してカラーデータを受信して保存し、
所定の第１信号に応答して保存された前記カラーデータを出力する。スイッチバッファ部は前記データラッチ部から出力される前記カラーデータを受信し所定の第２信号に応答して前記カラーデータをパネルに印加する。
【００２６】
望ましくは、前記第１信号は前記メインクロック信号、前記パネルに出力されるカラーデータの電圧の極性を制御する極性反転信号及び第１クロック信号に応答して発生され、前記極性反転信号の位相が反転される度に前記極性反転信号の立ち上がりエッジまたは立ち下がりエッジに応答して所定時間の間活性化され、前記極性反転信号の位相が変わらない場合は前記第１クロック信号が前記第１信号として発生されることを特徴とする。また前記第２信号は前記メインクロック信号、パネルに出力されるカラーデータの電圧の極性を制御する極性反転信号及び第１クック信号に応答して発生され、前記極性反転信号の位相が反転される度に前記極性反転信号の立ち上がりエッジまたは立ち下がりエッジに応答して非活性化され前記第１クロック信号の立ち上がりエッジに応答して活性化され、前記極性反転信号の位相が変わらない場合は現在の状態を維持することを特徴とする。
【００２７】
前述した技術的課題を達成するための本発明の好適な第３の実施形態による薄膜トランジスタ型液晶表示装置のソースドライバ回路は、第１データラッチ部、第２データラッチ部、デコーディング部、出力バッファ部、出力スイッチ部及び出力制御部を備えることを特徴とする。
【００２８】
第１データラッチ部はメインクロック信号に応答してカラーデータを受信して保存する。第２データラッチ部は前記第１データラッチ部から出力される前記カラーデータを受信して保存した後所定の第１信号に応答して保存された前記カラーデータを出力する。デコーディング部は所定の電圧制御信号に応答して前記第２データラッチ部から出力される前記カラーデータがそれぞれ一定した電圧を表示するよいうにする。出力バッファ部は前記デコーディング部から出力される前記カラーデータを受信しバッファリングして出力する。出力スイッチ部は所定の第２信号に応答して前記出力バッファ部から出力される前記カラーデータをパネルに印加したり遮断したりする。
【００２９】
出力制御部は前記メインクロック信号、パネルに出力されるカラーデータの電圧の極性を制御する極性反転信号及び第１クロック信号に応答して前記第１信号及び前記第２信号を発生する。
【００３０】
望ましくは、前記出力制御部は前記メインクロック信号に応答して前記極性反転信号を受信し所定時間遅らせて出力する遅延部、第１クロック信号に応答して前記極性反転信号を受信し、前記極性反転信号の位相が反転される度に活性化され、前記極性反転信号の位相が変わらない場合前記第１クロック信号を前記第１信号として発生する第１信号発生部及び前記極性反転信号、前記遅延部の出力信号及び所定の遅延第１クロック信号を受信して、前記極性反転信号の立ち上がりエッジまたは立ち下がりエッジに応答して非活性化され前記第１クロック信号の立ち上がりエッジに応答して活性化され、前記極性反転信号の位相が変わらない場合は現在の状態を維持する前記第２信号を発生する第２信号発生部を備える。
【００３１】
第２信号発生部は前記メインクロック信号に応答して前記第１クロック信号を受信し所定時間遅らせて前記遅延第１クロック信号を発生する遅延クロック部をさらに備える。前記遅延部は複数個のフリップフロップを備える。前記第１信号発生部は第１クロック信号に応答して前記極性反転信号を受信し遅らせて出力する第１及び第２フリップフロップ、前記第１フリップフロップの出力及び前記第２フリップフロップの出力信号を受信して排他的論理和演算する第２排他的論理和手段、該第２排他的論理和手段の出力を反転して出力する第２インバータ、該第２インバータの出力及び前記第１クロック信号を論理積演算する論理積手段、前記遅延部のフリップフロップのうち一番目のフリップフロップの反転出力信号を反転した信号及び三番目のフリップフロップの出力信号を排他的論理和演算する第３排他的論理和手段及び前記第３排他的論理和手段及び前記論理積手段の出力を論理和演算して前記第１信号として出力する論理和手段を備える。
【００３２】
前記第２信号発生部は前記極性反転信号及び前記遅延部の出力信号を受信して排他的論理和演算する第１排他的論理和手段、該排他的論理和手段の出力及び前記遅延第１クロック信号を受信して出力するＳＲラッチ、該ＳＲラッチの出力を反転して前記第２信号として発生する第１インバータを備える。
【００３３】
前述した他の技術的課題を達成するための本発明の好適な第１の実施形態による薄膜トランジスタ型液晶表示装置のソースドライバ回路においてパネルに印加されるカラーデータのスルーレートを調節する方法は、（ａ）メインクロック信号に応答してカラーデータを受信して保存し、所定の第１信号に応答して保存された前記カラーデータを出力する段階、及び（ｂ）前記出力されるカラーデータを受信し所定の第２信号に応答して前記カラーデータをパネルに印加する段階を備えることを特徴とする。
【００３４】
前記（ａ）段階は、（ａ１）前記メインクロック信号に応答して前記カラーデータを受信して保存する段階、（ａ２）前記メインクロック信号、パネルに出力されるカラーデータの電圧の極性を制御する極性反転信号及び第１クロック信号に応答して前記第１信号を発生する段階、及び（ａ３）前記第１信号に応答して前記カラーデータを出力する段階を備えることを特徴とする。前記（ａ２）段階は、（ａ２１）前記第１クロック信号に応答して前記極性反転信号を受信し、前記極性反転信号を相異なる時間の間遅らせた二つの信号を排他的論理和演算する段階、（ａ２２）前記（ａ２１）段階の出力を反転して出力する段階、（ａ２３）前記（ａ２２）段階の出力及び前記第１クロック信号を論理積演算する段階、（ａ２４）メインクロック信号に応答して前記極性反転信号を受信し、前記極性反転信号を前記相異なる時間の間遅らせた前記二つの信号を排他的に論理和演算する段階、（ａ２５）前記（ａ２３）段階と前記（ａ２４）段階の出力を論理和演算して前記第１信号を発生する段階と、を含むことを特徴とする。
【００３５】
前記（ｂ）段階は、（ｂ１）前記出力されるカラーデータを受信し前記カラーデータがそれぞれ一定した電圧を表示するようデコーディングする段階、（ｂ２）前記デコーディングされたカラーデータを受信しバッファリングして出力する段階、（ｂ３）前記メインクロック信号、前記パネルに出力されるカラーデータの電圧の極性を制御する極性反転信号及び第１クロック信号に応答して前記第２信号を発生する段階、及び（ｂ４）前記第２信号に応答して前記カラーデータを前記パネルに印加する段階を備えることを特徴とする。前記（ｂ３）段階は（ｂ３１）メインクロック信号に応答して前記極性反転信号を受信し、前記極性反転信号及び前記極性反転信号を遅らせた信号を受信して排他的論理和演算する段階、（ｂ３２）前記（ｂ３１）段階の出力及び前記第１クロック信号を遅らせた遅延第１クロック信号を受信しラッチする段階、及び（ｂ３３）前記（ｂ３２）段階の出力を反転して前記第２信号を発生する段階と、
を含むことを特徴とする。
【００３６】
従って、本発明に係るソースドライバ回路及び方法は半導体チップの外部から別の信号を作らず既存の信号を用いてパネルに印加されるカラーデータのスルーレートを減らせる長所がある。また本発明に係るソースドライバ回路はソースドライバ回路の内部のシフトレジスタと出力バッファ部が同時にスイッチングされながら発生されるスイッチング電流を分散させることによって消費電流の減少が可能であり、スルーレートを減らすために出力バッファ部に使用されるドライビングトランジスタを小さくすることもできるため、チップ面積及び消費電流の減少が可能であるという長所がある。
【００３７】
【発明の実施の形態】
本発明と本発明の動作上の利点及び本発明の実施によって達成される目的を十分理解するためには本発明の望ましい実施形態を例示する添付した図面及び図面に記載された内容を参照すべきである。
【００３８】
以下、添付した図面に基づき本発明の望ましい実施形態を説明することによって本発明を詳述する。各図面に示された同一な参照符号は同様な構成要素を示す。
【００３９】
図３は本発明の好適な第１の実施形態に係る薄膜トランジスタ型液晶表示装置のソースドライバ回路を示す図である。
【００４０】
図４は図３のソースドライバ回路３００の動作を示すタイミング図である。
【００４１】
図５は図３の出力制御部３９５を示す回路図である。
【００４２】
図３、図４及び図５を参照すれば、本発明の好適な第１の実施形態に係る薄膜トランジスタ型液晶表示装置のソースドライバ回路３００はデータラッチ部３８０、スイッチバッファ部３９０及び出力制御部３９５を備えることを特徴とする。
【００４３】
データラッチ部３８０は、メインクロック信号ＭＣＬＫに応答してカラーデータＤＡＴＡを受信して保存し、所定の第１信号ＣＴＲＬＳ１に応答して保存されたカラーデータＤＡＴＡを出力する。
【００４４】
スイッチバッファ部３９０は、データラッチ部３８０から出力されるカラーデータＤＡＴＡを受信し所定の第２信号ＣＴＲＬＳ２に応答してカラーデータＹＤＡＴＡをパネル３７０に印加する。
【００４５】
出力制御部３９５は、メインクロック信号ＭＣＬＫ、パネル３７０に出力されるカラーデータＹＤＡＴＡの電圧の極性を制御する極性反転信号ＰＯＬ及び第１クロック信号ＣＬＫ１に応答して第１信号ＣＴＲＬＳ１及び第２信号ＣＴＲＬＳ２を発生する。望ましくは、第１信号ＣＴＲＬＳ１は極性反転信号ＰＯＬの位相が反転される度に極性反転信号ＰＯＬの立ち上がりエッジまたは立ち下がりエッジに応答して所定時間の間活性化され、極性反転信号ＰＯＬの位相が変わらない場合、第１クロック信号ＣＬＫ１が第１信号ＣＴＲＬＳ１として発生されることを特徴とする。
【００４６】
また、第２信号ＣＴＲＬＳ２は極性反転信号ＰＯＬの位相が反転される度に極性反転信号ＰＯＬの立ち上がりエッジまたは立ち下がりエッジに応答して非活性化され第１クロック信号ＣＬＫ１の立ち上がりエッジに応答して活性化され、極性反転信号ＰＯＬの位相が変わらない場合は現在の状態を維持することを特徴とする。
【００４７】
望ましくは、図５に示すように、出力制御部３９５はメインクロック信号ＭＣＬＫに応答して極性反転信号ＰＯＬを受信し所定時間遅らせて出力する遅延部５１０、第１クロック信号ＣＬＫ１に応答して極性反転信号ＰＯＬを受信し、極性反転信号ＰＯＬの位相が反転される度に活性化され、極性反転信号ＰＯＬの位相が変わらない場合第１クロック信号ＣＬＫ１を第１信号ＣＴＲＬＳ１として発生する第１信号発生部５２０及び極性反転信号ＰＯＬ、遅延部５１０の出力信号及び所定の遅延第１クロック信号ＣＬＫ１＿Ｄを受信して、極性反転信号ＰＯＬの立ち上がりエッジまたは立ち下がりエッジに応答して非活性化され第１クロック信号ＣＬＫ１の立ち上がりエッジに応答して活性化され、極性反転信号ＰＯＬの位相が変わらない場合は現在の状態を維持する第２信号ＣＴＲＬＳ２を発生する第２信号発生部５３０を備えることを特徴とする。
【００４８】
第２信号発生部５３０はメインクロック信号ＭＣＬＫに応答して第１クロック信号ＣＬＫ１を受信し所定時間遅らせて遅延第１クロック信号ＣＬＫ１＿Ｄを発生する遅延クロック部５３６をさらに備える。
【００４９】
遅延部５１０は複数個のフリップフロップを備えることを特徴とする。第１信号発生部５２０は第１クロック信号ＣＬＫ１に応答して極性反転信号ＰＯＬを受信し遅らせて出力する第１及び第２フリップフロップ５２１、５２２、第１フリップフロップ５２１の出力及び第２フリップフロップ５２２の出力信号を受信して排他的論理和演算する第２排他的論理和手段５２３、第２排他的論理和手段５２３の出力を反転して出力する第２インバータ５２４、第２インバータ５２４の出力及び第１クロック信号ＣＬＫ１を論理積演算する論理積手段５２５、遅延部５１０のフリップフロップのうち一番目のフリップフロップ５１１の反転出力信号を反転した信号及び三番目のフリップフロップ５１３の出力信号を排他的論理和演算する第３排他的論理和手段５２７、及び第３排他的論理和手段５２７及び論理積手段５２５の出力を論理和演算して第１信号ＣＴＲＬＳ１として出力する論理和手段５２５を備えることを特徴とする。
【００５０】
第２信号発生部５３０は極性反転信号ＰＯＬ及び遅延部５１０の出力信号を受信して排他的論理和演算する第１排他的論理和手段５３１、第１排他的論理和手段５３１の出力及び遅延第１クロック信号ＣＬＫ１＿Ｄを受信して出力するＳＲラッチ５３２、及びＳＲラッチ５３２の出力を反転して第２信号ＣＴＲＬＳ２として発生する第１インバータ５３５を備えることを特徴とする。
【００５１】
以下、図３、図４及び図５を参照して本発明の好適な第１の実施形態によるソースドライバ回路の動作を詳述する。
【００５２】
図３に示すように、データラッチ部３８０はメインクロック信号ＭＣＬＫに応答してカラーデータＤＡＴＡを受信して保存し、所定の第１信号ＣＴＲＬＳ１に応答して保存されたカラーデータＤＡＴＡを出力する。
【００５３】
さらに詳述すれば、メインクロック信号ＭＣＬＫはデータラッチ部３８０の内部のシフトレジスタ３１０によって第１データラッチ部３２０に入力され、カラーデータＤＡＴＡはメインクロック信号ＭＣＬＫに同期されデータラッチ部３８０内部の第１データラッチ部３２０に印加される。第１データラッチ部３２０にラッチされたカラーデータＤＡＴＡは第２データラッチ部３３０に入力され第１信号ＣＴＲＬＳ１に応答して出力される。
【００５４】
図４のタイミング図を見れば、第１信号ＣＴＲＬＳ１は極性反転信号ＰＯＬの反転位相が反転される度に極性反転信号ＰＯＬの立ち上がりエッジまたは立ち下がりエッジに応答して所定時間の間活性化され、極性反転信号ＰＯＬの位相が変わらない場合は、第１クロック信号ＣＬＫ１が第１信号ＣＴＲＬＳ１として発生される。
【００５５】
このように働く第１信号ＣＴＲＬＳ１は出力制御部３９５から発生される。出力制御部３９５の構成及び機能は後述する。
【００５６】
第１信号ＣＴＲＬＳ１に応答してカラーデータＤＡＴＡはデータラッチ部３８０からスイッチバッファ部３９０の出力バッファ部３５０に伝達される。図４から分かるように、第１信号ＣＴＲＬＳ１の活性区間、すなわち論理ハイレベル区間内ではカラーデータＡＭＰＯＵＴは出力バッファ部３５０から出力される。この際、出力バッファ部３５０から出力されるカラーデータＡＭＰＯＵＴの極性は極性反転信号ＰＯＬに応じて基準電圧ＶＣＯＭを基準に変わることが分かる。極性反転信号ＰＯＬの位相が変わらない場合（ｉ）、（ｉｉ）には第１クロック信号ＣＴＲＬＳ１が第１信号ＣＴＲＬＳ１として使用され、第１クロック信号ＣＴＲＬＳ１に応答してカラーデータＡＭＰＯＵＴが出力バッファ部３５０から出力される。
【００５７】
スイッチバッファ部３９０はデータラッチ部３８０から出力されるカラーデータＤＡＴＡを受信し所定の第２信号ＣＴＲＬＳ２に応答してカラーデータＹＤＡＴＡをパネル３７０に印加する。
【００５８】
さらに詳述すれば、データラッチ部３８０から出力されたカラーデータＤＡＴＡはスイッチバッファ部３９０内部のデコーディング部３４０で電圧制御信号ＶＣＭＡに応答して一定電圧レベルを有する。そして、カラーデータＤＡＴＡは出力バッファ部３５０に印加され出力される。カラーデータＤＡＴＡが出力バッファ部３５０まで印加され出力されることは第１信号ＣＴＲＬＳ１によってなされる。第２信号ＣＴＲＬＳ２はスイッチバッファ部３９０内部の出力スイッチ部３６０を制御してカラーデータＹＤＡＴＡをパネルに出力する。出力スイッチ部３６０は第２信号ＣＴＲＬＳ２が活性化されればターンオンされ、非活性化されればターンオフされる複数個のスイッチを備える。
【００５９】
第２信号ＣＴＲＬＳ２は極性反転信号ＰＯＬの位相が反転される毎に極性反転信号ＰＯＬの立ち上がりエッジまたは立ち下がりエッジに応答して非活性化され第１クロック信号ＣＬＫ１の立ち上がりエッジに応答して活性化され、極性反転信号ＰＯＬの位相が変わらない場合は現在の状態を維持する。
【００６０】
このような機能を果たす第２信号ＣＴＲＬＳ２は出力制御部３９５から発生される。出力制御部３９５の構成及び機能は後述する。
【００６１】
第１信号ＣＴＲＬＳ１によってカラーデータＤＡＴＡが出力スイッチ部３６０の直前まで至っており、このときに第２信号ＣＴＲＬＳ２がハイレベルに活性化されれば出力スイッチ部３６０がターンオンされながらカラーデータＹＤＡＴＡがパネルに出力される。第２信号ＣＴＲＬＳ２がハイレベルに活性化される間、第１信号ＣＴＲＬＳ１はローレベルに非活性化される。すなわち、第２信号ＣＴＲＬＳ２によって出力スイッチ部３６０からカラーデータＹＤＡＴＡがパネルに出力される間はデータラッチ部３８０に印加されるカラーデータＤＡＴＡは第２データラッチ部３８０に保存されており、出力スイッチ部３６０からパネル３７０にカラーデータＹＤＡＴＡが全て出力されれば、すなわち第２信号ＣＴＲＬＳ２がローレベルに非活性化されれば第１信号ＣＴＲＬＳ１がハイレベルに活性化され、第２データラッチ部３８０に保存されていたカラーデータＤＡＴＡは出力バッファ部３４０に印加される。
【００６２】
また、第２信号ＣＴＲＬＳ２がハイレベルに活性化される時間は第１クロック信号がハイレベルに活性化される時間と同様である。すなわち、スイッチバッファ部３９０の出力スイッチ部３６０からカラーデータＹＤＡＴＡがパネル３７０に印加される時間は従来のソースドライバ回路１００と同一でありながらデータラッチ部３８０のカラーデータＤＡＴＡは第１クロック信号ＣＬＫ１が印加される前に出力バッファ部３４０に転送される。従って、第１クロック信号ＣＬＫ１がハイレベルに発生されれば、すなわち第２信号ＣＴＲＬＳ２がハイレベルに発生されればカラーデータＹＤＡＴＡは出力スイッチ部３６０からパネルに直ちに出力される。
【００６３】
従来のソースドライバ回路１００では第１クロック信号ＣＬＫ１が発生された後カラーデータＤＡＴＡが第１及び第２データラッチ部３８０、デコーディング部３４０及び出力バッファ部３４０を通過する時間がパネル３７０に出力されるカラーデータＹＤＡＴＡのスルーレートに全て含まれる。しかし、本発明によれば第１クロック信号ＣＬＫ１が発生する前にカラーデータＤＡＴＡが予め出力バッファ部３４０に転送されているため、出力スイッチ部３６０からパネル３７０に出力されるカラーデータＹＤＡＴＡのスルーレート（カラーデータの出力が所望の値になるまでの時間に対応する）は極めて減少する。
【００６４】
第１信号ＣＴＲＬＳ１と第２信号ＣＴＲＬＳ２を発生する出力制御部３９５について説明する。
【００６５】
出力制御部３９５はメインクロック信号ＭＣＬＫ、パネル３７０に出力されるカラーデータＹＤＡＴＡの電圧の極性を制御する極性反転信号ＰＯＬ及び第１クロック信号ＣＬＫ１に応答して第１信号ＣＴＲＬＳ１及び第２信号ＣＴＲＬＳ２を発生する。
【００６６】
望ましくは、出力制御部３９５は遅延部５１０、第１信号発生部５２０及び第２信号発生部５３０を備える。
【００６７】
遅延部５１０はメインクロック信号ＭＣＬＫに応答して極性反転信号ＰＯＬを受信し所定時間遅らせて出力する。遅延部５１０は複数個のフリップフロップ５１１、５１２、５１３、５１４を備えることを特徴とする。
【００６８】
第１信号発生部５２０は第１クロック信号ＣＬＫに応答して極性反転信号ＰＯＬを受信し、極性反転信号ＰＯＬの位相が反転される毎に活性され、極性反転信号ＰＯＬの位相が変わらない場合第１クロック信号ＣＬＫ１を第１信号ＣＴＲＬＳ１として発生する。このため、第１信号発生部５２０は第１及び第２フリップフロップ５２１、５２２、排他的論理和手段５２３、５２７、インバータ５２４、５２６、論理積手段５２５及び論理和手段５２８を備える。
【００６９】
第１及び第２フリップフロップ５２１、５２２は第１クロック信号ＣＬＫ１に応答して動作され、極性反転信号ＰＯＬを受信し遅らせて第２排他的論理和手段５２３に印加する。また第１フリップフロップ５２１も極性反転信号ＰＯＬを遅らせて第２排他的論理和手段５２３に印加する。第２排他的論理和手段５２３の出力は第２インバータ５２４を経て論理積手段５２５に入力される。論理積手段５２５としては第１クロック信号ＣＬＫ１も印加される。
【００７０】
第２インバータ５２４の出力がハイレベルなら第２排他的論理和手段５２３の出力はローレベルであり、これは第２排他的論理和手段５２３の二つの入力が互いに同一な論理レベルを有することを意味する。すなわち、極性反転信号ＰＯＬが第１フリップフロップ５２１及び第２フリップフロップ５２２によって遅延され出力された信号の論理レベルが同一であるという意味なので、これは極性反転信号の論理レベルが所定時間の間に変化しないということを示す。この際論理積手段５２５に入力される第２インバータ５２４の出力がハイレベルなので、論理積手段５２５の出力は第１クロック信号ＣＬＫ１と同様な信号になる。
【００７１】
第１クロック信号ＣＬＫ１に同期される極性反転信号ＰＯＬの論理レベルが所定時間の間に変化しないため、遅延部５１０の三番目のフリップフロップ５１３の出力と一番目のフリップフロップ５１１の反転出力をインバータ５２６を通して受信する第３排他的論理和手段５２７の出力もローレベルになる。メインクロック信号ＭＣＬＫの周期は第１クロック信号ＣＬＫ１の周期に比べて相当に短いため、第１クロック信号ＣＬＫ１に同期される極性反転信号ＰＯＬの論理レベルが変わらなければメインクロック信号ＭＣＬＫに同期される極性反転信号の論理レベルも変わらないからである。ここで、第３排他的論理和手段５２７の入力は必ず遅延部５１０の一番目及び三番目のフリップフロップ５１１、５１３の出力である必要はなく、極性反転信号ＰＯＬが遅延される程が相異なる二つの入力であれば良い。第３排他的論理和手段５２７は極性反転信号ＰＯＬの論理レベルが変わるかどうかを感知する機能を果たすからである。
【００７２】
従って、第３排他的論理和手段５２７の出力がローレベルなので論理和手段５２８の出力である第１信号ＣＴＲＬＳ１は論理積手段５２５の出力と同様になり、論理積手段５２５の出力は第１クロック信号ＣＬＫ１と同様なので、結局極性反転信号ＰＯＬの論理レベルが変わらない場合は第１クロック信号ＣＬＫ１が第１信号ＣＴＲＬＳ１として発生される。これは、図４の（ｉ）及び（ｉｉ）部分に該当する。図４のタイミング図の（ｉ）及び（ｉｉ）部分は第１クロック信号ＣＬＫ１が第１信号ＣＴＲＬＳ１として発生されるため、出力バッファ部３４０の出力及び出力スイッチ部３６０の出力も従来のソースドライバ回路１００と同様な形態に出力される。
【００７３】
極性反転信号ＰＯＬの論理レベルが変われば、第３排他的論理和手段５２７の出力はハイレベルになり、よって論理和手段５２８は論理積手段５２５の出力の論理レベルを問わず第１信号ＣＴＲＬＳ１をハイレベルで出力する。すなわち、第１信号ＣＴＲＬＳ１は極性反転信号ＰＯＬの論理レベルが変われば極性反転信号ＰＯＬの立ち上がりエッジまたは立ち下がりエッジに応答して所定時間の間活性化される。
【００７４】
第２信号発生部５３０は極性反転信号ＰＯＬ、遅延部５１０の出力信号及び所定の遅延第１クロック信号ＣＬＫ１＿Ｄを受信して、極性反転信号ＰＯＬの立ち上がりエッジまたは立ち下がりエッジに応答して非活性化され第１クロック信号ＣＬＫ１の立ち上がりエッジに応答して活性化され、極性反転信号ＰＯＬの位相が変わらない場合は現在の状態を維持する第２信号ＣＴＲＬＳ２を発生する。このため、第２信号発生部５３０は第１排他的論理和手段５３１、ＳＲラッチ５３２及び第１インバータ５３５を備える。第２信号発生部５３０はメインクロック信号ＭＣＬＫに応答して第１クロック信号ＣＬＫ１を受信し所定時間遅らせて遅延第１クロック信号ＣＬＫ１＿Ｄを発生する遅延クロック部５３６をさらに備える。
【００７５】
極性反転信号ＰＯＬの論理レベルが変われば第１排他的論理和手段５３１の出力はハイレベルになり、ＳＲラッチ５３２の動作特性上ＳＲラッチ５３２の出力もハイレベルになる。従って、第１インバータ５３５の出力である第２信号ＣＴＲＬＳ２はローレベルになる。すなわち、極性反転信号ＰＯＬの論理レベルが変わる毎に第２信号ＣＴＲＬＳ２はローレベルで出力される。極性反転信号ＰＯＬの論理レベルが変わらなければ第１排他的論理和手段５３１の出力はローレベルになり、次いで第１クロック信号ＣＬＫ１が所定時間だけ遅延された遅延第１クロック信号ＣＬＫ１がハイレベルになればＳＲラッチ５３２の出力はローレベルになる。従って、第１インバータ５３５の出力である第２信号ＣＴＲＬＳ２はハイレベルになる。第２信号ＣＴＲＬＳ２は極性反転信号ＰＯＬの位相が変わるまでハイレベルを維持していてから極性反転信号ＰＯＬの位相が変わればローレベルに落ちる。
【００７６】
図４のタイミング図から分かる通り、第１信号ＣＴＲＬＳ１は極性反転信号ＰＯＬの立ち上がりエッジまたは立ち下がりエッジに応答して遅延部５１０の一番目のフリップフロップ５１１と三番目のフリップフロップ５１３による遅延時間間ハイレベルに活性化された後ローレベルに落ちる。勿論、極性反転信号ＰＯＬの論理レベルが変わらない場合は第１クロック信号ＣＬＫ１が第１信号ＣＴＲＬＳ１として発生される。
【００７７】
第２信号ＣＴＲＬＳ２は極性反転信号ＰＯＬの立ち上がりエッジまたは立ち下がりエッジに応答してローレベルに落ち、第１クロック信号ＣＬＫ１の立ち上がりエッジに応答してハイレベルに活性化される。第１クロック信号ＣＬＫ１の立ち上がりエッジよりやや後でハイレベルに活性化されることは遅延クロック部５３６による遅延時間のためである。
【００７８】
第１信号ＣＴＲＬＳ１と第２信号ＣＴＲＬＳ２はハイレベルに活性化される区間が重複されない。従って、第１信号ＣＴＲＬＳ１が活性化されデータラッチ部３８０に印加されたカラーデータＤＡＴＡがスイッチバッファ部３９０の出力バッファ部３４０まで転送された後第１信号ＣＴＲＬＳ１がローレベルに非活性化されれば、第２信号ＣＴＲＬＳ２がハイレベルに活性化され出力スイッチ部３６０をターンオンさせ、出力スイッチ部３６０から出力されるカラーデータＹＤＡＴＡをパネル３７０に印加する。
【００７９】
そして、第２信号ＣＴＲＬＳ２がローレベルに非活性化されれば、再び第１信号ＣＴＲＬＳ１がハイレベルに活性化されデータラッチ部３８０のカラーデータＤＡＴＡをスイッチバッファ部３９０に印加する。従って、従来のソースドライバ回路１００で第１クロック信号ＣＬＫ１が発生される時間と同一な時間にパネル３７０にカラーデータＹＤＡＴＡが印加されるが、出力スイッチ部３６０からパネル３７０に印加されるカラーデータＹＤＡＴＡのスルーレートは従来のソースドライバ回路１００より減少されうる。
【００８０】
本発明の好適な実施形態に係るソースドライバ回路３００は半導体チップの外部から別に信号を作らず既存の信号を用いてパネルに印加されるカラーデータＹＤＡＴＡのスルーレート（カラーデータの出力が所望の値になるまでの時間に対応する）が減らせる。また、本発明はドット反転型ソースドライバ回路以外もＮ−ライン反転型のモジュールにも適用できる。
【００８１】
本発明はソースドライバ回路内部のレベルシフターと出力バッファ部が同時にスイッチングされながら発生するスイッチング電流を分散させ消費電流の節減が可能であり、スルーレートを減らすために出力バッファ部に使われるドライビングトランジスタを小さくすることもできるため、チップ面積及び消費電流の節減が可能である。
【００８２】
ここで、第１信号ＣＴＲＬＳ１及び第２信号ＣＴＲＬＳ２の活性化レベルをハイレベルにし、非活性化レベルをローレベルに定義して説明したが、回路を構成するによっては活性化レベルをローレベルにし非活性化レベルをハイレベルにすることができることは当然である。
【００８３】
本発明の好適な第２の実施形態による薄膜トランジスタ型液晶表示装置のソースドライバ回路３００はデータラッチ部３８０及びスイッチバッファ部３９０を備えることを特徴とする。
【００８４】
データラッチ部３８０はメインクロック信号ＭＣＬＫに応答してカラーデータＤＡＴＡを受信して保存し、所定の第１信号ＣＴＲＬＳ１に応答して保存されたカラーデータＤＡＴＡを出力する。
【００８５】
スイッチバッファ部３９０はデータラッチ部３８０から出力されるカラーデータＤＡＴＡを受信し所定の第２信号ＣＴＲＬＳ２に応答してカラーデータＹＤＡＴＡをパネル３７０に印加する。
【００８６】
望ましくは、第１信号ＣＴＲＬＳ１は極性反転信号ＰＯＬの位相が反転される毎に極性反転信号ＰＯＬの立ち上がりエッジまたは立ち下がりエッジに応答して所定時間の間活性化され、極性反転信号ＰＯＬの位相が変わらない場合は、第１クロック信号ＣＬＫ１が第１信号ＣＴＲＬＳ１として発生される。
【００８７】
また、第２信号ＣＴＲＬＳ２は極性反転信号ＰＯＬの位相が反転される毎に極性反転信号ＰＯＬの立ち上がりエッジまたは立ち下がりエッジに応答して非活性化され第１クロック信号ＣＬＫ１の立ち上がりエッジに応答して活性化され、極性反転信号ＰＯＬの位相が変わらない場合は現在の状態を維持する。
【００８８】
当業者であれば、本発明の好適な第２の実施形態による薄膜トランジスタ型液晶表示装置のソースドライバ回路の動作は第１実施形態による薄膜トランジスタ型液晶表示装置のソースドライバ回路３００の動作から理解できよう。従って、この動作に対する詳細な説明は略する。
【００８９】
本発明の好適な第３の実施形態による薄膜トランジスタ型液晶表示装置のソースドライバ回路３００は第１データラッチ部３２０、第２データラッチ部３３０、デコーディング部３４０、出力バッファ部３５０、出力スイッチ部３６０及び出力制御部３９５を備えることを特徴とする。
【００９０】
第１データラッチ部３２０はメインクロック信号ＭＣＬＫに応答してカラーデータＤＡＴＡを受信して保存する。第２データラッチ部３３０は第１データラッチ部３２０から出力されるカラーデータＤＡＴＡを受信して保存した後所定の第１信号ＣＴＲＬＳ１に応答して保存されたカラーデータＤＡＴＡを出力する。デコーディング部３４０は所定の電圧制御信号ＶＧＭＡに応答して第２データラッチ部３３０から出力されるカラーデータＤＡＴＡがそれぞれ一定した電圧を表示するようにする。出力バッファ部３５０はデコーディング部３４０から出力されるカラーデータＤＡＴＡを受信しバッファリングしてカラーデータＡＭＰＯＵＴとして出力する。出力スイッチ部３６０は所定の第２信号ＣＴＲＬＳ２に応答して出力バッファ部３５０から出力されるカラーデータＡＭＰＯＵＴをパネル３７０にカラーデータＹＤＡＴＡとして印加したり遮断したりする。
【００９１】
出力制御部３９５はメインクロック信号ＭＣＬＫ、パネル３７０に出力されるカラーデータＹＤＡＴＡの電圧の極性を制御する極性反転信号ＰＯＬ及び第１クロック信号ＣＬＫ１に応答して第１信号ＣＴＲＬＳ１及び第２信号ＣＴＲＬＳ２を発生する。
【００９２】
出力制御部３９５はメインクロック信号ＭＣＬＫに応答して極性反転信号ＰＯＬを受信し所定時間遅らせて出力する遅延部５１０、第１クロック信号ＣＬＫ１に応答して極性反転信号ＰＯＬを受信し、極性反転信号ＰＯＬの位相が反転される時毎に活性化され、極性反転信号ＰＯＬの位相が変わらない場合第１クロック信号ＣＬＫ１を第１信号ＣＴＲＬＳ１として発生する第１信号発生部５２０及び極性反転信号ＰＯＬ、遅延部５１０の出力信号及び所定の遅延第１クロック信号ＣＬＫ１＿Ｄを受信して、極性反転信号ＰＯＬの立ち上がりエッジまたは立ち下がりエッジに応答して非活性化され第１クロック信号ＣＬＫ１の立ち上がりエッジに応答して活性化され、極性反転信号ＰＯＬの位相が変わらない場合は現在の状態を維持する第２信号ＣＴＲＬＳ２を発生する第２信号発生部５３０を備える。
【００９３】
第２信号発生部５３０はメインクロック信号ＭＣＬＫに応答して第１クロック信号ＣＬＫ１を受信し所定時間遅らせて遅延第１クロック信号ＣＬＫ１を発生する遅延クロック部５３６をさらに備える。遅延部５１０は複数個のフリップフロップ５１１、５１２、５１３、５１４を備える。第１信号発生部５２０は第１クロック信号ＣＬＫ１に応答して極性反転信号ＰＯＬを受信し遅らせて出力する第１及び第２フリップフロップ５２１、５２２、第１フリップフロップ５２１の出力及び第２フリップフロップ５２２の出力信号を受信して排他的論理和演算する第２排他的論理和手段５２３、第２排他的論理和手段５２３の出力を反転して出力する第２インバータ５２４、第２インバータ５２４の出力及び第１クロック信号ＣＬＫ１を論理積演算する論理積手段５２５、遅延部５１０のフリップフロップのうち一番目のフリップフロップ５１１の反転出力信号を反転した信号及び三番目のフリップフロップ５１３の出力信号を排他的論理和演算する第３排他的論理和手段５２７、及び第３排他的論理和手段５２７及び論理積手段５２５の出力を論理和演算して第１信号ＣＴＲＬＳ１として出力する論理和手段５２８を備える。
【００９４】
第２信号発生部５３０は極性反転信号ＰＯＬ及び遅延部５１０の出力信号を受信して排他的論理和演算する第１排他的論理和手段５３１、第１排他的論理和手段５３１の出力及び遅延第１クロック信号ＣＬＫ１＿Ｄを受信して出力するＳＲラッチ５３２、ＳＲラッチ５３２の出力を反転して第２信号ＣＴＲＬＳ２として発生する第１インバータ５３５を備える。
【００９５】
当業者であれば、本発明の好適な第３の実施形態による薄膜トランジスタ型液晶表示装置のソースドライバ回路の動作は第１実施形態による薄膜トランジスタ型液晶表示装置のソースドライバ回路３００の動作から理解できよう。従って、この動作に対する詳細な説明は省略される。
【００９６】
図６は本発明の好適な第１の実施形態によるパネルに印加されるカラーデータのスルーレートを調節する方法を示すフローチャートである。
【００９７】
図７は図６の第６１０段階を説明するフローチャートである。
【００９８】
図８は図７の第７２０段階を説明するフローチャートである。
【００９９】
図９は図６の第６２０段階を説明するフローチャートである。
【０１００】
図１０は図９の第９３０段階を説明するフローチャートである。
【０１０１】
図６〜図１０を参照すれば、本発明の好適な第１の実施形態による薄膜トランジスタ型液晶表示装置のソースドライバ回路においてパネルに印加されるカラーデータのスルーレートを調節する方法６００は、メインクロック信号に応答してカラーデータを受信して保存し、所定の第１信号に応答して保存されたカラーデータを出力する段階（第６１０段階）、及びこの出力されるカラーデータを受信し所定の第２信号に応答してカラーデータをパネルに印加する段階（第６２０段階）と、を含むことを特徴とする。
【０１０２】
さらに詳述すると、メインクロック信号に応答してカラーデータを受信して保存する段階（第７１０段階）、メインクロック信号、パネルに出力されるカラーデータの電圧の極性を制御する極性反転信号及び第１クロック信号に応答して第１信号を発生する段階（第７２０段階）、及び第１信号に応答してカラーデータを出力する段階（第７３０段階）を含むことを特徴とする。第７２０段階は第１クロック信号に応答して極性反転信号を受信し、極性反転信号を相異なる時間の間遅らせた二つの信号を排他的論理和演算する段階（第８１０段階）、第８１０段階の出力を反転して出力する段階（第８２０段階）、第８２０段階の出力及び第１クロック信号を論理積演算する段階（第８３０段階）、メインクロック信号に応答して極性反転信号を受信し、極性反転信号を相異なる時間の間遅らせた二つの信号を排他的に論理和演算する段階（第８４０段階）、第８３０段階と第８４０段階の出力を論理和演算して第１信号を発生する段階（第８５０段階）を含むことを特徴とする。
【０１０３】
第６２０段階はこの出力されるカラーデータを受信しカラーデータがそれぞれ一定した電圧を表示するようデコーディングする段階（第９１０段階）、デコーディングされたカラーデータを受信しバッファリングして出力する段階（第９２０段階）、メインクロック信号、パネルに出力されるカラーデータの電圧の極性を制御する極性反転信号及び第１クロック信号に応答して第２信号を発生する段階（第９３０段階）、及び第２信号に応答してカラーデータをパネルに印加する段階（第９４０段階）を含むことを特徴とする。
【０１０４】
第９３０段階はメインクロック信号に応答して極性反転信号を受信し、極性反転信号及び極性反転信号を遅らせた信号を受信して排他的論理和演算する段階（第１０１０段階）、該第１０１０段階の出力及び第１クロック信号を遅らせた遅延第１クロック信号を受信しラッチする段階（第１０２０段階）、及び第１０２０段階の出力を反転して第２信号を発生する段階（第１０３０段階）を含むことを特徴とする。
【０１０５】
以下、図６ないし図１０を参照してパネルに印加されるカラーデータのスルーレートを調節する方法を詳述する。
【０１０６】
パネルに印加されるカラーデータのスルーレートを調節する方法（６００）は薄膜トランジスタ型液晶表示装置のソースドライバ回路に係る。このようなソースドライバ回路は図３において既に説明されている。
【０１０７】
薄膜トランジスタ型液晶表示装置のソースドライバ回路はメインクロック信号に応答してカラーデータを受信して保存し、所定の第１信号に応答して保存されたカラーデータを出力する（第６１０段階）。
【０１０８】
さらに詳述すると、ソースドライバ回路はメインクロック信号に応答してカラーデータを受信して保存する（第７１０段階）。メインクロック信号はソースドライバ回路内部のシフトレジスタに入力され、シフトレジスタは入力されたメインクロック信号をシフトさせ出力する。カラーデータはシフトレジスタから出力されたメインクロック信号に同期されソースドライバ回路に入力され保存される。
【０１０９】
ソースドライバ回路はメインクロック信号、パネルに出力されるカラーデータの電圧の極性を制御する極性反転信号及び第１クロック信号に応答して第１信号を発生する（第７２０段階）。具体的に、第１信号は極性反転信号の位相が反転される毎に極性反転信号の立ち上がりエッジまたは立ち下がりエッジに応答して所定時間の間活性化され、極性反転信号の位相が変わらない場合は第１クロック信号が第１信号として発生される。
【０１１０】
ソースドライバ回路は第１信号に応じてカラーデータをパネルに出力する直前まで移動させ、後述する第２信号に応じてカラーデータをパネルに出力する。
【０１１１】
このような第１信号は次のような方法によって発生される。すなわち、ソースドライバ回路は第１クロック信号に応答して極性反転信号を受信し、極性反転信号を相異なる時間の間遅らせた二つの信号を排他的論理和演算する（第８１０段階）。第８１０段階の出力を反転して出力する（第８２０段階）。第８２０段階の出力及び第１クロック信号を論理積演算する（第８３０段階）。
【０１１２】
メインクロック信号に応答して極性反転信号を受信し、極性反転信号を相異なる時間の間遅らせた二つの信号を排他的に論理和演算する（第８４０段階）。第１信号は第８３０段階と第８４０段階の出力を論理和演算して発生される（第８５０段階）。
【０１１３】
ソースドライバ回路は前述した過程を経て発生された第１信号に応答してカラーデータを出力する（第７３０段階）。従来は第１クロック信号に応答してカラーデータがパネルに印加されることによってパネルに印加されるカラーデータのスルーレートにはカラーデータがソースドライバ回路に入力された後再びソースドライバ回路から出力されるまでの時間が全て含まれる。しかし、本発明の好適な実施形態に係る方法（６００）によれば、第１クロック信号より先に第１信号を発生させカラーデータをソースドライバ回路からパネルに出力される直前の状態にし、後述する第２信号に応答してカラーデータをパネルに印加する。第２信号は従来のソースドライバ回路からパネルにカラーデータを印加する際発生する第１クロック信号と同一なタイミングに発生する。従って、カラーデータが従来のソースドライバ回路と同一なタイミングでパネルに出力されながらも、パネルに出力されるカラーデータのスルーレート（カラーデータの出力が所望の値になるまでの時間に対応する）は極めて減少する。
【０１１４】
ソースドライバ回路はこの出力されるカラーデータを受信し、所定の第２信号に応答してカラーデータをパネルに印加する（第６２０段階）。
【０１１５】
さらに具体的に説明すれば、ソースドライバ回路はこの出力されるカラーデータを受信しカラーデータがそれぞれ一定した電圧を表示するようデコーディングし、デコーディングされたカラーデータを受信しバッファリングして出力する（第９１０段階、第９２０段階）。
【０１１６】
ソースドライバ回路はメインクロック信号、パネルに出力されるカラーデータの電圧の極性を制御する極性反転信号及び第１クロック信号に応答して第２信号を発生する（第９３０段階）。第２信号は極性反転信号の位相が反転される毎に極性反転信号の立ち上がりエッジまたは立ち下がりエッジに応答して非活性化され第１クロック信号の立ち上がりエッジに応答して活性化され、極性反転信号の位相が変わらない場合は現在の状態を維持する。
【０１１７】
このような第２信号は次のような方法によって発生される。すなわち、ソースドライバ回路はメインクロック信号に応答して極性反転信号を受信し、極性反転信号及び極性反転信号を遅らせた信号を受信して排他的論理和演算する（第１０１０段階）。第１０１０段階の出力及び第１クロック信号を遅らせた遅延第１クロック信号を受信しラッチする（第１０２０段階）。第２信号は第１０２０段階の出力を反転して発生される（第１０３０段階）。
【０１１８】
ソースドライバ回路は前述した過程を経て発生された第２信号に応答してソースドライバ回路から出力される直前の状態になっているカラーデータをパネルに印加する（第９４０段階）。従って、カラーデータのスルーレートは減少する。
【０１１９】
第１信号と第２信号は活性化される区間が重複しない。従って、第１信号が活性化されソースドライバ回路に印加されたカラーデータがパネルに出力される直前まで転送された後第１信号が非活性化されれば、第２信号が活性化されカラーデータをパネルに印加する。
【０１２０】
そして、第２信号は非活性化されれば、再び第１信号が活性化されカラーデータをパネルに出力される直前まで転送する。従って、従来のソースドライバ回路で第１クロック信号が発生する時間と同一な時間にパネルにカラーデータが印加されるが、パネルに印加されるカラーデータのスルーレートは従来のソースドライバ回路より減少されうる。
【０１２１】
以上のように図面と明細書において最適の実施形態が開示された。ここで特定の用語が使用されたが、これは単に本発明を説明するための目的から使用されるものであり、意味の限定や特許請求の範囲に記載された本発明の範囲を制限するために使用されたものではない。従って、当業者であれば、これより多様な変形及び均等な他の実施形態が可能である点を理解できよう。従って、本発明の真の技術的保護範囲は特許請求の範囲の技術的思想によって定められるべきである。
【０１２２】
【発明の効果】
前述した通り本発明に係るソースドライバ回路及び方法は、半導体チップの外部から別の信号を作らず既存の信号を用いてパネルに印加されるカラーデータのスルーレート（カラーデータの出力が所望の値になるまでの時間に対応する）を減らせるという長所がある。また本発明に係るソースドライバ回路はソースドライバの回路内部のシフトレジスタと出力バッファ部が同時にスイッチングされながら発生されるスイッチング電流を分散させることによって消費電流の節減が可能であり、スルーレートを減らすために出力バッファ部に使われるドライビングトランジスタを小さくすることもできるため、チップ面積及び消費電流の節減が可能であるという長所がある。
【図面の簡単な説明】
【図１】従来の薄膜トランジスタ型液晶表示装置のソースドライバ回路を示すブロック図である。
【図２】図１のソースドライバ回路の動作を示すタイミング図である。
【図３】本発明の好適な第１の実施形態に係る薄膜トランジスタ型液晶表示装置のソースドライバ回路を示す図である。
【図４】図３のソースドライバ回路の動作を示すタイミング図である。
【図５】図３の出力制御部を示す回路図である。
【図６】本発明の好適な第１の実施形態によるパネルに印加されるカラーデータのスルーレートを調節する方法を示すフローチャートである。
【図７】図６の第６１０段階を説明するフローチャートである。
【図８】図７の第７２０段階を説明するフローチャートである。
【図９】図６の第６２０段階を説明するフローチャートである。
【図１０】図９の第９３０段階を説明するフローチャートである。
【図１】
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【図２】
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【図３】
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【図４】
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【図５】
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【図６】
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【図７】
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【図８】
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【図９】
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【図１０】
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