(57)【要約】【課題】階調データの供給タイミングに依存せずにくし歯配線されたデータ線を駆動するデータドライバ及び該データドライバを含む電気光学装置を提供する。【解決手段】データドライバ３０は、階調データの供給開始タイミングを指示する信号を基準に該階調データの取込開始タイミングを設定するためのデータが設定される取込開始タイミング設定レジスタ６５０と、階調データの供給開始タイミングを指示する信号に基づき上記データに対応した期間だけ遅延させた第１及び第２の取込指示信号を生成する取込指示信号生成回路６５２とを含む。第１及び第２のデータラッチ１６０、１７０は、第１及び第２の取込指示信号に基づくタイミングで階調バス１１０の階調データを取り込む。第１及び第２の駆動回路４１０、４２０は、第１及び第２のデータラッチ１６０、１７０に取り込まれた階調データに基づきくし歯配線された第１及び第２の群のデータ線を駆動する。【選択図】        図１２
2004334105.tif 000002
【特許請求の範囲】
【請求項１】
複数の走査線と、所与の数のデータ線ごとにくし歯配線された複数のデータ線と、複数の画素とを含む電気光学装置の前記複数のデータ線を駆動するデータドライバであって、
前記複数のデータ線の各データ線が並ぶ順序に対応して階調データが供給される階調バスと、
前記階調データの供給開始タイミングを指示する信号を基準に該階調データの取込開始タイミングを設定するためのデータが設定される取込開始タイミング設定レジスタと、
前記階調データの供給開始タイミングを指示する信号を、前記取込開始タイミング設定レジスタに設定されたデータに対応した期間だけ遅延させた第１及び第２の取込指示信号を生成する取込指示信号生成回路と、
前記第１の取込指示信号に基づく取込タイミングで、前記階調バスの階調データを取り込む第１のデータラッチと、
前記第２の取込指示信号に基づく取込タイミングで、前記階調バスの階調データを取り込む第２のデータラッチと、
前記第１のデータラッチに取り込まれた階調データに基づいて、前記複数のデータ線のうち第１の群に属するデータ線を駆動する第１の駆動回路と、
前記第２のデータラッチに取り込まれた階調データに基づいて、前記複数のデータ線のうち第２の群に属するデータ線を駆動する第２の駆動回路と、
を含むことを特徴とするデータドライバ。
【請求項２】
請求項１において、
前記取込指示信号生成回路は、
前記階調データが供給されるタイミングに同期した基準クロックをカウントするカウンタを含み、
前記階調データの供給開始タイミングを指示する信号を基準に前記カウンタのカウントを開始して、そのカウント値が前記取込開始タイミング設定レジスタに設定されたデータに対応した第１のカウント値になったことを条件に、そのレベルが変化する前記第１及び第２の取込指示信号を生成することを特徴とするデータドライバ。
【請求項３】
請求項２において、
前記取込指示信号生成回路は、
前記カウンタのカウント値が前記第１のカウント値になるまでの間、前記階調データの供給開始タイミングを指示する信号をマスクすることにより前記第１及び第２の取込指示信号を生成することを特徴とするデータドライバ。
【請求項４】
請求項２又は３において、
前記カウンタのカウント値が前記第１のカウント値になった後、前記カウンタのカウント動作を停止させることを特徴とするデータドライバ。
【請求項５】
請求項１乃至４のいずれかにおいて、
複数のフリップフロップを有し、第１のシフトクロックに基づいて、第１の取込指示信号を第１のシフト方向にシフトして各フリップフロップからシフト出力を出力する第１のシフトレジスタと、
複数のフリップフロップを有し、第２のシフトクロックに基づいて、第２の取込指示信号を前記第１のシフト方向と反対の第２のシフト方向にシフトして各フリップフロップからシフト出力を出力する第２のシフトレジスタと、
前記階調バスに出力され前記所与の数のデータ線に対応した階調データを、各フリップフロップが前記第１のシフトレジスタのシフト出力に基づいて保持する複数のフリップフロップを有する第１のデータラッチと、
前記階調バスに出力され前記所与の数のデータ線に対応した階調データを、各フリップフロップが前記第２のシフトレジスタのシフト出力に基づいて保持する複数のフリップフロップを有する第２のデータラッチと、
を含み、
前記第１の駆動回路は、
各データ出力部が前記第１のデータラッチのフリップフロップに保持された前記階調データに基づいて各データ線を駆動する複数のデータ出力部を有し、
前記第２の駆動回路は、
各データ出力部が前記第２のデータラッチのフリップフロップに保持された前記階調データに基づいて各データ線を駆動する複数のデータ出力部を有することを特徴とするデータドライバ。
【請求項６】
請求項１乃至５のいずれかにおいて、
前記データ線が伸びる前記電気光学装置の第１の辺から第２の辺への方向と、前記第１又は第２のシフト方向とが同じ方向であることを特徴とするデータドライバ。
【請求項７】
請求項１乃至６のいずれかにおいて、
前記走査線が伸びる方向を長辺側とし、前記データ線が伸びる方向を短辺側とした場合に、前記電気光学装置の前記短辺側に沿って配置されることを特徴とするデータドライバ。
【請求項８】
複数の走査線と、
所与の数のデータ線ごとにくし歯配線された複数のデータ線と、
複数の画素と、
前記複数のデータ線を駆動する請求項１乃至７のいずれか記載のデータドライバと、
前記複数の走査線を走査する走査ドライバとを含むことを特徴とする電気光学装置。
【請求項９】
複数の走査線と、
所与の数のデータ線ごとにくし歯配線された複数のデータ線と、
複数の画素とを含む表示パネルと、
前記複数のデータ線を駆動する請求項１乃至７のいずれか記載のデータドライバと、
前記複数の走査線を走査する走査ドライバとを含むことを特徴とする電気光学装置。
【発明の詳細な説明】
【０００１】
【発明の属する技術分野】
本発明は、データドライバ及び電気光学装置に関する。
【０００２】
【従来の技術】
ＬＣＤ（液晶表示）パネルに代表される表示パネル（広義には電気光学装置又は表示装置）は、携帯電話機や携帯型情報端末（Ｐｅｒｓｏｎａｌ  Ｄｉｇｉｔａｌ  Ａｓｓｉｓｔａｎｔｓ：ＰＤＡ）に実装される。特にＬＣＤパネルは、他の表示パネルと比較して、より小型化、低消費電力化及び低コスト化を実現し、種々の電子機器に搭載されている。
【０００３】
ＬＣＤパネルでは、表示される画像の見易さを考慮して、ある一定サイズ以上のサイズが要求される。その一方で、電子機器に搭載された場合のＬＣＤパネルの実装サイズをできるだけ小さくすることが望まれている。このような実装サイズを小さくすることができるＬＣＤパネルとして、いわゆるくし歯配線されたＬＣＤパネルがある。
【０００４】
ＬＣＤパネルの実装サイズを小さくするために、ＬＣＤパネルの走査線を駆動する走査ドライバと該ＬＣＤパネルとの配線の領域を狭くしたり、ＬＣＤパネルのデータ線を駆動するデータドライバと該ＬＣＤパネルとの配線の領域を狭くしたりすることが有効である。
【０００５】
【特許文献１】
特開２００２−１５６６５４号公報
【０００６】
【発明が解決しようとする課題】
しかしながら、くし歯配線されたＬＣＤパネルの互いに対向する辺から、データドライバが該ＬＣＤパネルのデータ線を駆動する場合、通常のＬＣＤパネルではデータ線が並ぶ順序に対応して供給されていた階調データの順序を変更する必要が生ずる。
【０００７】
従来のデータドライバでは各データ線に対応して供給される階調データの順序を変更することができず、くし歯配線されたＬＣＤパネルを従来のデータドライバで駆動する場合、専用のデータスクランブルＩＣを付加する必要があった。
【０００８】
また、データドライバに対する階調データの供給開始タイミングを指示する信号が変化してから、実際に階調データが該データドライバに対して供給されるタイミングまでの期間は、コントローラの種類に依存しており一定ではない。したがって、くし歯配線されたＬＣＤパネルを駆動する場合、階調データの取込順序が狂ってしまうという問題が発生する。
【０００９】
本発明は、以上のような技術的課題に鑑みてなされたものであり、その目的とするところは、階調データの供給タイミングに依存することなく、くし歯配線されたデータ線を駆動するデータドライバ及び該データドライバを含む電気光学装置を提供することにある。
【００１０】
【課題を解決するための手段】
上記課題を解決するために本発明は、複数の走査線と、所与の数のデータ線ごとにくし歯配線された複数のデータ線と、複数の画素とを含む電気光学装置の前記複数のデータ線を駆動するデータドライバであって、前記複数のデータ線の各データ線が並ぶ順序に対応して階調データが供給される階調バスと、前記階調データの供給開始タイミングを指示する信号を基準に該階調データの取込開始タイミングを設定するためのデータが設定される取込開始タイミング設定レジスタと、前記階調データの供給開始タイミングを指示する信号を、前記取込開始タイミング設定レジスタに設定されたデータに対応した期間だけ遅延させた第１及び第２の取込指示信号を生成する取込指示信号生成回路と、前記第１の取込指示信号に基づく取込タイミングで、前記階調バスの階調データを取り込む第１のデータラッチと、前記第２の取込指示信号に基づく取込タイミングで、前記階調バスの階調データを取り込む第２のデータラッチと、前記第１のデータラッチに取り込まれた階調データに基づいて、前記複数のデータ線のうち第１の群に属するデータ線を駆動する第１の駆動回路と、前記第２のデータラッチに取り込まれた階調データに基づいて、前記複数のデータ線のうち第２の群に属するデータ線を駆動する第２の駆動回路とを含むデータドライバに関係する。
【００１１】
階調データの供給開始タイミングを指示する信号は、例えばデータドライバに接続されたコントローラから供給される。
【００１２】
取込開始タイミング設定レジスタには、階調データの供給開始タイミングを指示する信号と、取り込み対象である階調データとの時間的なずれ量を設定できればよい。
【００１３】
また第１のシフトレジスタのシフト方向と第２のシフトレジスタのシフト方向とが、互いに反対の方向であればよい。
【００１４】
本発明においては、取込開始タイミング設定レジスタに設定されたデータに応じて、取込指示信号生成回路において、階調データの供給開始タイミングを指示する信号を遅延させた第１及び第２の取込指示信号を生成するようにしている。これにより、データスクランブルＩＣを用いることなく、くし歯配線されたデータ線を駆動して、正常な画像を表示させることができる。しかも、コントローラの種類に依存して、階調データの供給開始タイミングを指示する信号を基準に実際に階調データが供給されるタイミングまでの期間が異なったとしても、コントローラの種類に応じたタイミングで階調データの取り込みを開始することができる。したがって、くし歯配線されたデータ線を駆動するために階調バスに供給された階調データの並び順序を変更する場合でも正しい階調データを取り込むことができ、正常な画像を表示させることができる。
【００１５】
また本発明に係るデータドライバでは、前記取込指示信号生成回路は、前記階調データが供給されるタイミングに同期した基準クロックをカウントするカウンタを含み、前記階調データの供給開始タイミングを指示する信号を基準に前記カウンタのカウントを開始して、そのカウント値が前記取込開始タイミング設定レジスタに設定されたデータに対応した第１のカウント値になったことを条件に、そのレベルが変化する前記第１及び第２の取込指示信号を生成してもよい。
【００１６】
また本発明に係るデータドライバでは、前記取込指示信号生成回路は、前記カウンタのカウント値が前記第１のカウント値になるまでの間、前記階調データの供給開始タイミングを指示する信号をマスクすることにより前記第１及び第２の取込指示信号を生成してもよい。
【００１７】
本発明によれば、カウンタを用いて第１及び第２の取込指示信号を生成するようにしたので、構成の簡素化をも図ることができる。
【００１８】
また本発明に係るデータドライバでは、前記カウンタのカウント値が前記第１のカウント値になった後、前記カウンタのカウント動作を停止させてもよい。
【００１９】
本発明によれば、データ線をくし歯配線することによる小型軽量化のみならず、無駄なカウント動作を停止させて低消費電力化を図ることができる。
【００２０】
また本発明に係るデータドライバでは、複数のフリップフロップを有し、第１のシフトクロックに基づいて、第１の取込指示信号を第１のシフト方向にシフトして各フリップフロップからシフト出力を出力する第１のシフトレジスタと、複数のフリップフロップを有し、第２のシフトクロックに基づいて、第２の取込指示信号を前記第１のシフト方向と反対の第２のシフト方向にシフトして各フリップフロップからシフト出力を出力する第２のシフトレジスタと、前記階調バスに出力され前記所与の数のデータ線に対応した階調データを、各フリップフロップが前記第１のシフトレジスタのシフト出力に基づいて保持する複数のフリップフロップを有する第１のデータラッチと、前記階調バスに出力され前記所与の数のデータ線に対応した階調データを、各フリップフロップが前記第２のシフトレジスタのシフト出力に基づいて保持する複数のフリップフロップを有する第２のデータラッチとを含み、前記第１の駆動回路は、各データ出力部が前記第１のデータラッチのフリップフロップに保持された前記階調データに基づいて各データ線を駆動する複数のデータ出力部を有し、前記第２の駆動回路は、各データ出力部が前記第２のデータラッチのフリップフロップに保持された前記階調データに基づいて各データ線を駆動する複数のデータ出力部を有してもよい。
【００２１】
本発明によれば、別個の第１及び第２のシフトクロックに基づいて、階調バスの階調データを取り込むことができるので、くし歯配線されたデータ線を駆動するデータドライバの構成の簡素化することができる。
【００２２】
また本発明に係るデータドライバでは、前記データ線が伸びる前記電気光学装置の第１の辺から第２の辺への方向と、前記第１又は第２のシフト方向とが同じ方向であってもよい。
【００２３】
また本発明に係るデータドライバでは、前記走査線が伸びる方向を長辺側とし、前記データ線が伸びる方向を短辺側とした場合に、前記電気光学装置の前記短辺側に沿って配置されてもよい。
【００２４】
本発明によれば、データ線の数が多ければ多いほど、くし歯配線された電気光学装置の実装サイズの縮小化を図ることができる。
【００２５】
また本発明は、複数の走査線と、所与の数のデータ線ごとにくし歯配線された複数のデータ線と、複数の画素と、前記複数のデータ線を駆動する上記のいずれか記載のデータドライバと、前記複数の走査線を走査する走査ドライバとを含む電気光学装置に関係する。
【００２６】
また本発明は、複数の走査線と、所与の数のデータ線ごとにくし歯配線された複数のデータ線と、複数の画素とを含む表示パネルと、前記複数のデータ線を駆動する上記のいずれか記載のデータドライバと、前記複数の走査線を走査する走査ドライバとを含む電気光学装置に関係する。
【００２７】
本発明によれば、階調データの供給タイミングに依存せず、くし歯配線されたデータ線を駆動して正しい画像を表示させる電気光学装置を提供することができる。
【００２８】
【発明の実施の形態】
以下、本発明の好適な実施の形態について図面を用いて詳細に説明する。なお、以下に説明する実施の形態は、特許請求の範囲に記載された本発明の内容を不当に限定するものではない。また以下で説明される構成の全てが本発明の必須構成要件であるとは限らない。
【００２９】
１．  電気光学装置
図１に、本実施形態における電気光学装置の構成の概要を示す。ここでは、電気光学装置として液晶装置を例に示す。液晶装置は、携帯電話機、携帯型情報機器（ＰＤＡ等）、デジタルカメラ、プロジェクタ、携帯型オーディオプレーヤ、マスストレージデバイス、ビデオカメラ、電子手帳又はＧＰＳ（Ｇｌｏｂａｌ  Ｐｏｓｉｔｉｏｎｉｎｇ  Ｓｙｓｔｅｍ）などの種々の電子機器に組み込むことができる。
【００３０】
液晶装置１０は、ＬＣＤパネル（広義には表示パネル。更に広義には電気光学装置）２０、データドライバ（ソースドライバ）３０、走査ドライバ（ゲートドライバ）４０、４２を含む。
【００３１】
なお、液晶装置１０にこれら全ての回路ブロックを含める必要はなく、その一部の回路ブロックを省略する構成にしてもよい。
【００３２】
ＬＣＤパネル２０は、複数の走査線（ゲート線）と、複数の走査線と交差する複数のデータ線（ソース線）と、各画素が複数の走査線のいずれかの走査線及び複数のデータ線のいずれかのデータ線により特定される複数の画素とを含む。１画素が例えばＲＧＢの３つの色成分により構成される場合、ＲＧＢ各１ドット計３ドットで１画素が構成される。ここで、ドットは各画素を構成する要素点ということができる。１画素に対応するデータ線は、１画素を構成する色成分数のデータ線ということができる。以下では、説明の簡略化のため、主に１画素が１ドットで構成されているものとして説明する。
【００３３】
各画素は、薄膜トランジスタ（Ｔｈｉｎ  Ｆｉｌｍ  Ｔｒａｎｓｉｓｔｏｒ：以下、ＴＦＴと略す）（スイッチング素子）と画素電極とを含む。データ線にはＴＦＴが接続され、該ＴＦＴに画素電極が接続される。
【００３４】
ＬＣＤパネル２０は例えばガラス基板からなるパネル基板上に形成される。パネル基板には、図１のＸ方向に複数配列されそれぞれＹ方向に伸びる走査線と、Ｙ方向に複数配列されそれぞれＸ方向に伸びるデータ線とが配置されている。ＬＣＤパネル２０では、複数のデータ線の各データ線がくし歯配線されている。図１では、ＬＣＤパネル２０の第１の辺側と該第１の辺と対向する第２の辺側から駆動されるように、各データ線がくし歯配線されている。くし歯配線とは、所与の数のデータ線（１又は複数のデータ線）ごとに、これらデータ線がその両側（ＬＣＤパネル２０の第１及び第２の辺）から内側（内部）に向けて交互にくし歯状に行われた配線ということができる。
【００３５】
図２に、画素の構成を模式的に示す。ここでは、１画素が１ドットで構成されているものとする。走査線ＧＬｍ（１≦ｍ≦Ｍ、Ｍ、ｍは整数）とデータ線ＤＬｎ（１≦ｎ≦Ｎ、Ｎ、ｎは整数）との交差点に対応する位置に画素ＰＥｍｎが設けられている。画素ＰＥｍｎは、ＴＦＴｍｎと画素電極ＰＥＬｍｎとを含む。
【００３６】
ＴＦＴｍｎのゲート電極は走査線ＧＬｍに接続される。ＴＦＴｍｎのソース電極はデータ線ＤＬｎに接続される。ＴＦＴｍｎのドレイン電極は画素電極ＰＥＬｍｎに接続される。画素電極と、該画素電極と液晶素子（広義には電気光学物質）を介して対向する対向電極ＣＯＭ（コモン電極）との間には、液晶容量ＣＬｍｎが形成されている。なお液晶容量ＣＬｍｎと並列に、保持容量を形成するようにしても良い。画素電極と対向電極ＣＯＭとの間の電圧に応じて、画素の透過率が変化するようになっている。対向電極ＣＯＭに供給される電圧ＶＣＯＭは、図示しない電源回路により生成される。
【００３７】
走査線は、走査ドライバ４０、４２によって走査される。図１では、１つの走査線が、走査ドライバ４０、４２により同一タイミングで駆動される。
【００３８】
データ線は、データドライバ３０によって駆動される。ＬＣＤパネル２０のデータ線は、第１及び第２の群に属するデータ線を含む（或いはＬＣＤパネル２０のデータ線は、第１及び第２の群のいずれかに属する）。
【００３９】
第１の群に属するデータ線は、データドライバ３０によってＬＣＤパネル２０の第１の辺側から駆動される。より具体的には、第１の群に属するデータ線は、ＬＣＤパネル２０の第１の辺側でデータドライバ３０のデータ出力部に接続される。図１では、データ線ＤＬ１、ＤＬ３、ＤＬ５、・・・、ＤＬ（２ｐ−１）（ｐは自然数）、・・・が第１の群に属する。
【００４０】
第２の群に属するデータ線は、ＬＣＤパネル２０の第１の辺と対向する第２の辺側から駆動される。より具体的には、第２の群に属するデータ線は、ＬＣＤパネル２０の第２の辺側でデータドライバ３０のデータ出力部に接続される。図２では、データ線ＤＬ２、ＤＬ４、ＤＬ６、・・・、ＤＬ２ｐ、・・・が第２の群に属する。ここで、ＬＣＤパネル２０の第１及び第２の辺は、データ線の伸びる方向で対向しているということができる。
【００４１】
このようにＬＣＤパネル２０では、選択された走査線に接続され隣り合う画素それぞれに対応して配置される各画素の色成分数のデータ線が互いに反対の方向から駆動されるようにくし歯配線されている。
【００４２】
より具体的には、図２においてデータ線がくし歯配線されたＬＣＤパネル２０では、選択された走査線ＧＬｍに接続されて隣り合う画素それぞれに対応してデータ線ＤＬｎ、ＤＬ（ｎ＋１）が配置されている場合、データ線ＤＬｎはＬＣＤパネル２０の第１の辺側からデータドライバ３０により駆動され、データ線ＤＬ（ｎ＋１）はＬＣＤパネル２０の第２の辺側からデータドライバ３０により駆動される。
【００４３】
なお１画素に対応してＲＧＢの各色成分に対応するデータ線が配置されている場合も同様である。この場合には、選択された走査線ＧＬｍに接続されて隣り合う画素それぞれに対応して３本の各色成分用データ線（Ｒｎ，Ｇｎ，Ｂｎ）を１組とするデータ線ＤＬｎと、３本の各色成分用データ線（Ｒ（ｎ＋１），Ｇ（ｎ＋１），Ｂ（ｎ＋１））を１組とするデータ線ＤＬ（ｎ＋１）が配置されているものとすると、データ線ＤＬｎはＬＣＤパネル２０の第１の辺側からデータドライバ３０により駆動され、データ線ＤＬ（ｎ＋１）はＬＣＤパネル２０の第２の辺側からデータドライバ３０により駆動される。
【００４４】
データドライバ３０は、一水平走査期間ごとに供給される一水平走査期間分の階調データに基づいてＬＣＤパネル２０のデータ線ＤＬ１〜ＤＬＮを駆動する。より具体的には、データドライバ３０は、階調データに基づいてデータ線ＤＬ１〜ＤＬＮの少なくとも１つを駆動することができる。
【００４５】
走査ドライバ４０、４２は、ＬＣＤパネル２０の走査線ＧＬ１〜ＧＬＭを走査する。より具体的には、走査ドライバ４０、４２は、一垂直期間内に走査線ＧＬ１〜ＧＬＭを順次選択し、選択した走査線を駆動する。
【００４６】
データドライバ３０及び走査ドライバ４０、４２は、図示しないコントローラによって制御される。コントローラは、中央処理装置（Ｃｅｎｔｒａｌ  Ｐｒｏｃｅｓｓｉｎｇ  Ｕｎｉｔ：ＣＰＵ）等のホストにより設定された内容に従って、データドライバ３０、走査ドライバ４０、４２及び電源回路に対して制御信号を出力する。より具体的には、コントローラは、データドライバ３０及び走査ドライバ４０、４２に対しては、例えば動作モードの設定や内部で生成した水平同期信号や垂直同期信号を供給する。水平同期信号は、水平走査期間を規定する。垂直同期信号は、垂直走査期間を規定する。
【００４７】
またコントローラは、ホストによって生成された階調データをデータドライバ３０に対して供給する。このとき、コントローラはデータドライバ３０に対し、階調データの供給開始タイミングを指示するイネーブル入出力信号ＥＩＯを出力し、該供給開始タイミングの後の所定期間経過後に階調データを順次出力する。コントローラが出力する階調データは、それぞれ各データ線に対応しており、ＬＣＤパネル２０のデータ線が並ぶ順序でデータドライバ３０に対して供給される。
【００４８】
更に、コントローラは、電源回路に対しては、対向電極ＣＯＭの電圧ＶＣＯＭの極性反転タイミングの制御を行う。電源回路は、外部から供給される基準電圧に基づいて、ＬＣＤパネル２０の各種電圧や、対向電極ＣＯＭの電圧ＶＣＯＭを生成する。
【００４９】
なお図１において、液晶装置１０にコントローラを含む構成にしてもよいし、コントローラを液晶装置１０の外部に設けてもよい。或いは、コントローラと共にホスト（図示せず）を液晶装置１０に含めるように構成してもよい。
【００５０】
また走査ドライバ４０、４２、コントローラ及び電源回路のうち少なくとも１つをデータドライバ３０に内蔵させてもよい。
【００５１】
また、データドライバ３０、走査ドライバ４０、４２、コントローラ及び電源回路の一部又は全部をＬＣＤパネル２０上に形成してもよい。例えば、ＬＣＤパネル２０上に、データドライバ３０及び走査ドライバ４０、４２を形成してもよい。この場合、ＬＣＤパネル２０は電気光学装置ともいうことができ、ＬＣＤパネル２０は、複数のデータ線と、複数の走査線と、各画素が複数のデータ線のいずれかと複数の走査線のいずれかとにより特定される複数の画素と、複数のデータ線を駆動するデータドライバと、複数の走査線を走査する走査ドライバとを含むように構成することができる。ＬＣＤパネル２０の画素形成領域に、複数の画素が形成される。
【００５２】
次に、くし歯配線されたＬＣＤパネルの利点について述べる。
【００５３】
図３に、くし歯配線されないＬＣＤパネルを含む電気光学装置の構成を模式的に示す。図３における電気光学装置８０は、くし歯配線されないＬＣＤパネル９０を含む。ＬＣＤパネル９０では、第１の辺側から各データ線がデータドライバ９２によって駆動される。したがって、データドライバ９２の各データ出力部と、ＬＣＤパネル９０の各データ線とを接続するための配線領域が必要となる。データ線の数が多くなりＬＣＤパネル９０の第１及び第２の辺の長さが長くなると、各配線を折り曲げる必要が生じ、配線領域の幅Ｗ０が必要となる。
【００５４】
これに対して、図１に示す電気光学装置１０では、ＬＣＤパネル２０の第１及び第２の辺側で、幅Ｗ０より小さい幅Ｗ１、Ｗ２が必要となるだけである。
【００５５】
電子機器への搭載を考慮すると、ＬＣＤパネル（電気光学装置）の長辺方向の長さが多少長くなるより、ＬＣＤパネルの短辺方向の長さが長くなってしまう方が不都合である。その理由の１つに、電子機器の表示部の額縁が広くなる等、デザイン面で望ましくない点が挙げられる。
【００５６】
図３ではＬＣＤパネルの短辺方向の長さが長くなっているのに対して、図１ではＬＣＤパネルの長辺方向の長さが長くなり、第１及び第２の辺側の配線領域の幅もほぼ等しく狭くすることができるという利点がある。また図１では、図３における非配線領域の面積を小さくすることができ、実装サイズを小さくすることも可能である。
【００５７】
データドライバ３０の各データ出力部の並ぶ順序が、ＬＣＤパネル２０のデータ線の並ぶ順序に対応している場合（即ち、データドライバ３０の各データ出力部の並ぶ順序がＬＣＤパネル２０のデータ線の並ぶ順序と同じ場合）、図４に示すようにＬＣＤパネル２０の短辺側に沿ってデータドライバ３０を配置することによって、第１及び第２の辺側から各データ出力部と各データ線とを接続する配線を配置することができ、配線の簡素化と、配線領域の縮小化とを図ることができる。
【００５８】
しかしながら、ＬＣＤパネル２０を駆動する場合、汎用のコントローラによりデータ線の並ぶ順序に対応して出力された階調データを受け取るデータドライバ３０では、受け取った階調データの順序を変更する必要が生ずる。
【００５９】
データドライバ３０がデータ出力部ＯＵＴ１〜ＯＵＴ３２０を有し、各データ出力部が第１の辺から第２の辺への方向に並んでいるものとする。各データ出力部は、ＬＣＤパネル２０の各データ線に対応している。
【００６０】
汎用のコントローラは、図５に示すように基準クロックＣＰＨに同期して、データ線ＤＬ１〜ＤＬ３２０にそれぞれ対応する階調データＤＡＴＡ１〜ＤＡＴＡ３２０をデータドライバ３０に対して供給する。データドライバ３０が図３に示すようなくし歯配線されていないＬＣＤパネルを駆動する場合、データ出力部ＯＵＴ１はデータ線ＤＬ１、データ出力部ＯＵＴ２はデータ線ＤＬ２、・・・、データ出力部ＯＵＴ３２０はデータ線ＤＬ３２０に接続されるため、問題なく表示することができる。しかし、図１又は図４に示したようにデータドライバ３０がくし歯配線されたＬＣＤパネルを駆動する場合、データ出力部ＯＵＴ１はデータ線ＤＬ１、データ出力部ＯＵＴ２はデータ線ＤＬ３、・・・、データ出力部ＯＵＴ３２０はデータ線ＤＬ２に接続されるため、意図した画像の表示ができない。
【００６１】
そのため、階調データの順序を変更するスクランブル処理を行って、図５に示したような階調データの並びを変える必要が生ずる。したがって、汎用のコントローラにより表示制御されるデータドライバによってくし歯配線されたＬＣＤパネルを駆動する場合、上述のスクランブル処理を行う専用のデータスクランブルＩＣを付加して、実装サイズが大きくならざるを得なかった。
【００６２】
本実施形態におけるデータドライバ３０によれば、汎用のコントローラから供給される階調データに基づき、くし歯配線されたＬＣＤパネルを駆動することができる。
【００６３】
また、階調データの供給開始タイミングを指示する信号（イネーブル入出力信号ＥＩＯ）を出力してから、該信号に対応して階調データをデータドライバ３０に対して出力するまでの期間は、コントローラの種類によって異なる。そのため、階調バスに供給された階調データを取り込むタイミングが、供給元のコントローラの種類に依存することになる。したがって、上述したくし歯配線されたデータ線を駆動するためにその並び順序を変更して階調データを取り込む場合、取り込んだ階調データの順序が異なることがある。
【００６４】
そこで本実施形態におけるデータドライバ３０では、階調データの供給タイミングに依存することなく、くし歯配線されたデータ線を駆動することができるようになっている。
【００６５】
２．  データドライバ
図６に、本実施形態におけるデータドライバ３０の構成の概要を示す。データドライバ３０は、データラッチ１００、ラインラッチ２００、ＤＡＣ（Ｄｉｇｉｔａｌ−ｔｏ−Ａｎａｌｏｇ  Ｃｏｎｖｅｒｔｅｒ）（広義には電圧選択回路）３００、データ線駆動回路４００を含む。
【００６６】
データラッチ１００は、一水平走査周期で階調データを取り込む。
【００６７】
ラインラッチ２００は、データラッチ１００に取り込まれた階調データを、水平同期信号ＨＳＹＮＣに基づいてラッチする。
【００６８】
ＤＡＣ３００は、各基準電圧が階調データに対応した複数の基準電圧の中から、ラインラッチ２００からの階調データに対応する駆動電圧（階調電圧）としてデータ線ごとに出力する。より具体的には、ＤＡＣ３００は、階調データをデコードし、デコード結果に基づいて複数の基準電圧のいずれかを選択する。ＤＡＣ３００において選択された基準電圧は、駆動電圧としてデータ線駆動回路４００に出力される。
【００６９】
データ線駆動回路４００は、３２０個のデータ出力部ＯＵＴ１〜ＯＵＴ３２０を有する。データ線駆動回路４００は、データ出力部ＯＵＴ１〜ＯＵＴ３２０を介して、ＤＡＣ３００からの駆動電圧に基づいてデータ線ＤＬ１〜ＤＬＮを駆動する。データ線駆動回路４００では、各データ出力部ＯＵＴが階調データ（ラッチデータ）に基づいて各データ線を駆動する複数のデータ出力部（ＯＵＴ１〜ＯＵＴ３２０）が、複数のデータ線の各データ線が並ぶ順序に対応して配置される。ここでは、データ線駆動回路４００は、３２０個のデータ出力部ＯＵＴ１〜ＯＵＴ３２０を有するものとしたが、その数に限定されるものではない。
【００７０】
図７に、データドライバ３０の１出力当たりの構成の概要を示す。
【００７１】
データラッチ１００−１は、ＬＣＤパネルのデータ線が並ぶ順序に対応して階調データが供給される階調バスの例えば１画素分の階調データを取り込む。例えば１画素がＲＧＢの各色成分画素から構成される場合、３ドット分の階調データを取り込む。データラッチ１００−１に取り込まれた階調データは、ラッチデータＬＡＴ１としてラインラッチ２００−１に供給される。
【００７２】
ラインラッチ２００−１は、水平同期信号ＨＳＹＮＣに基づいて、データラッチ１００−１に取り込まれたラッチデータＬＡＴ１をラッチする。ラインラッチ２００−１にラッチされた階調データは、ラッチデータＬＬＡＴ１としてＤＡＣ３００−１に供給される。
【００７３】
ＤＡＣ３００−１は、ラッチデータＬＬＡＴ１に対応した駆動電圧ＧＶ１を生成する。より具体的には、ＤＡＣ３００−１は、ラッチデータＬＬＡＴ１における各ドットの階調データに対応した駆動電圧ＧＶ１を生成する。
【００７４】
データ線駆動回路４００−１（データ出力部ＯＵＴ１）は、ＤＡＣ３００−１からの駆動電圧ＧＶ１に基づいて、該データ出力部ＯＵＴ１に接続されたデータ線ＤＬ１にデータ信号を出力する。
【００７５】
以下では、比較例におけるデータドライバとの対比において、本実施形態におけるデータドライバ３０の詳細な構成について説明する。
【００７６】
図８に、比較例におけるデータドライバの詳細な構成例を示す。
【００７７】
比較例におけるデータドライバ７００は、図１又は図４におけるデータドライバ３０に代えてＬＣＤパネル２０のくし歯配線されたデータ線を駆動することができる。
【００７８】
データドライバ７００は、階調バス１１０、第１及び第２のクロックライン１２０、１３０、第１及び第２のシフトレジスタ１４０、１５０、第１及び第２のデータラッチ１６０、１７０、第１及び第２のラインラッチ２１０、２２０、データ線駆動部６００を含む。データ線駆動部６００は、第１及び第２の駆動回路４１０、４２０を含む。
【００７９】
階調バス１１０には、データ線ＤＬ１〜ＤＬＮの各データ線が並ぶ順序に対応して階調データが供給される。第１のクロックライン１２０には、第１のシフトクロックＣＬＫ１が供給される。第２のクロックライン１３０には、第２のシフトクロックＣＬＫ２が供給される。
【００８０】
第１のシフトレジスタ１４０は、複数のフリップフロップを有し、第１のシフトクロックＣＬＫ１に基づいて、第１のシフトスタート信号ＳＴ１（第１の取込指示信号）を第１のシフト方向にシフトして、各フリップフロップからシフト出力を出力する。第１のシフト方向は、ＬＣＤパネル２０の第１の辺から第２の辺への方向とすることができる。第１のシフトレジスタ１４０のシフト出力ＳＦＯ１〜ＳＦＯ１６０は、第１のデータラッチ１６０に対して出力される。
【００８１】
図９に、第１のシフトレジスタ１４０の構成例を示す。第１のシフトレジスタ１４０では、Ｄフリップフロップ（以下、ＤＦＦと略す）１〜ＤＦＦ１６０が直列に接続され、第１のシフト方向にシフトするように構成される。ＤＦＦｋ（１≦ｋ≦１５９、ｋは自然数）のＱ端子が、次段のＤＦＦ（ｋ＋１）のＤ端子に接続される。各ＤＦＦは、Ｃ端子への入力信号の立ち上がりでＤ端子への入力信号を取り込んで保持し、保持した信号をＱ端子からシフト出力ＳＦＯとして出力する。
【００８２】
図８において、第２のシフトレジスタ１５０は、複数のフリップフロップを有し、第２のシフトクロックＣＬＫ２に基づいて、第２のシフトスタート信号ＳＴ２（第２の取込指示信号）を第１のシフト方向と反対の第２のシフト方向にシフトして、各フリップフロップからシフト出力を出力する。第２のシフト方向は、ＬＣＤパネル２０の第２の辺から第１の辺への方向とすることができる。第２のシフトレジスタ１５０のシフト出力ＳＦＯ１６１〜ＳＦＯ３２０は、第２のデータラッチ１７０に対して出力される。
【００８３】
図１０に、第２のシフトレジスタ１５０の構成例を示す。第２のシフトレジスタ１５０では、ＤＦＦ３２０〜ＤＦＦ１６１が直列に接続され、第２のシフト方向にシフトするように構成される。ＤＦＦｊ（１６２≦ｊ≦３２０、ｊは自然数）のＱ端子が、次段のＤＦＦ（ｊ−１）のＤ端子に接続される。各ＤＦＦは、Ｃ端子への入力信号の立ち上がりでＤ端子への入力信号を取り込んで保持し、保持した信号をＱ端子からシフト出力ＳＦＯとして出力する。
【００８４】
図８において、第１のデータラッチ１６０は、各フリップフロップがデータ出力部ＯＵＴ１〜ＯＵＴ１６０の各データ出力部に対応した複数のフリップフロップ（ＦＦ）１〜１６０（図示せず）を有する。ＦＦｉ（１≦ｉ≦１６０）は、第１のシフトレジスタ１４０のシフト出力ＳＦＯｉに基づいて階調バス１１０の階調データを保持する。第１のデータラッチ１６０のフリップフロップに保持された階調データは、ラッチデータＬＡＴ１〜ＬＡＴ１６０として第１のラインラッチ２１０に出力される。
【００８５】
第２のデータラッチ１７０は、各フリップフロップがデータ出力部ＯＵＴ１６１〜ＯＵＴ３２０の各データ出力部に対応した複数のフリップフロップ（ＦＦ）１６１〜３２０（図示せず）を有する。ＦＦｉ（１６１≦ｉ≦３２０）は、第２のシフトレジスタ１５０のシフト出力ＳＦＯｉに基づいて階調バス１１０の階調データを保持する。第２のデータラッチ１７０のフリップフロップに保持された階調データは、ラッチデータＬＡＴ１６１〜ＬＡＴ３２０として第２のラインラッチ２２０に出力される。
【００８６】
第１及び第２のラインラッチ２１０、２２０は、水平同期信号ＨＳＹＮＣに基づいて、第１及び第２のデータラッチ１６０、１７０に保持された階調データを保持する。第１及び第２のラインラッチ２１０、２２０に保持された階調データは、データ線駆動部６００に供給される。
【００８７】
データ線駆動部６００は、図６におけるＤＡＣ３００及びデータ線駆動回路４００と同様の機能を有する。第１の駆動回路４１０は、第１のラインラッチ２１０に保持された階調データに基づいて、データ線ＤＬ１、ＤＬ３、・・・、ＤＬ３１９（第１の群のデータ線）を駆動する。第２の駆動回路４２０は、第２のラインラッチ２２０に保持された階調データに基づいて、データ線ＤＬ３２０、ＤＬ３１８、・・・、ＤＬ４、ＤＬ２（第２の群のデータ線）を駆動する。
【００８８】
このように第１及び第２のデータラッチ１６０、１７０は、互いに個別に生成可能なシフト出力に基づき、共通に接続された階調バス１１０の階調データを取り込むことができるようになっている。こうすることで、第１及び第２のデータラッチ１６０、１７０には、それぞれ階調バスの階調データの並び順序を変更して、各データ出力部に対応するラッチデータを取り込むことができる。
【００８９】
図１１（Ａ）、（Ｂ）に、図８に示すデータドライバ７００の動作例のタイミング図を示す。なお図１１（Ａ）、（Ｂ）では、データ線ＤＬ１を駆動するための階調データＤＡＴＡ１を「１」、データ線ＤＬ２を駆動するための階調データＤＡＴＡ２を「２」、・・・と表わしている。また図１１（Ａ）、（Ｂ）では、第１のデータラッチ１６０に階調データを取り込むタイミング例を示している。
【００９０】
図１１（Ａ）において、負論理の水平同期信号ＨＳＹＮＣのパルスが入力されると、データドライバ７００は当該水平走査期間用の階調データに基づいてデータラインを駆動すると共に、次の水平走査期間用の階調データの取り込みを開始する。
【００９１】
そして、データドライバ７００では、コントローラからのイネーブル入出力信号ＥＩＯと該イネーブル入出力信号ＥＩＯに対応した階調データ（Ｄ）とが供給される。階調データ（Ｄ）は、基準クロックＣＰＨに同期して供給される。
【００９２】
データドライバ７００では、イネーブル入出力信号ＥＩＯに基づいて第１のシフトスタート信号ＳＴ１が生成される。またデータドライバ７００では、基準クロックＣＰＨでコントローラからの階調データ（Ｄ）がラッチされ、ラッチされた階調データが階調バス１１０に出力される。
【００９３】
第１のクロックライン１２０には、第１のシフトクロックＣＬＫ１が供給される。第１のシフトクロックＣＬＫ１は、初段取込期間において第１のシフトスタート信号ＳＴ１を取り込むためのパルスを有し、データ取込期間において基準クロックＣＰＨの立ち上がりエッジを基準とした分周クロックを有する。
【００９４】
第１のシフトレジスタ１４０では、初段取込期間において第１のシフトスタート信号ＳＴ１が取り込まれると、データ取込期間において分周クロックに同期してシフト出力ＳＦＯ１、ＳＦＯ２、・・・、ＳＦＯ１６０を出力する。
【００９５】
第１のデータラッチ１６０では、ＦＦｉ（１≦ｉ≦１６０）がシフト出力ＳＦＯｉの立ち下がりエッジで、階調バス１１０の階調データを取り込む。したがって、シフト出力ＳＦＯ１の立ち下がりエッジで階調バス１１０の階調データＤＡＴＡ１が取り込まれ、シフト出力ＳＦＯ２の立ち下がりエッジで階調バス１１０の階調データＤＡＴＡ３が取り込まれ、・・・、シフト出力ＳＦＯ１６０の立ち下がりエッジで階調バス１１０の階調データＤＡＴＡ３１９が取り込まれる。
【００９６】
なお図１１（Ａ）では、第１のデータラッチ１６０の階調データの取込タイミングを示しているが、第２のデータラッチ１７０に階調データを取り込むタイミングも同様である。ただし、第２のシフトスタート信号ＳＴ２は第１のシフトスタート信号ＳＴ１と同位相の信号とし、第２のクロックライン１３０に供給される第２のシフトクロックＣＬＫ２は、初段取込期間において第２のシフトスタート信号ＳＴ２を取り込むための立ち上がりエッジを有し、データ取込期間において第１のシフトクロックＣＬＫ１と逆位相の分周クロックを有する。
【００９７】
したがって第２のシフトレジスタ１５０では、初段取込期間において第２のシフトスタート信号ＳＴ２が取り込まれると、データ取込期間において分周クロックに同期してシフト出力ＳＦＯ３２０、ＳＦＯ３１９、・・・、ＳＦＯ１６１を出力する。
【００９８】
これにより、第２のデータラッチ１７０では、ＦＦｉ（１６１≦ｉ≦３２０）がシフト出力ＳＦＯｉの立ち下がりエッジで、階調バス１１０の階調データを取り込む。したがって、シフト出力ＳＦＯ３２０の立ち下がりエッジで階調バス１１０の階調データＤＡＴＡ２が取り込まれ、シフト出力ＳＦＯ３１９の立ち下がりエッジで階調バス１１０の階調データＤＡＴＡ４が取り込まれ、・・・、シフト出力ＳＦＯ１６１の立ち下がりエッジで階調バス１１０の階調データＤＡＴＡ３２０が取り込まれる。
【００９９】
以上のように、第１のデータラッチ１６０の複数のフリップフロップに保持されたデータ（ＬＡＴ１〜ＬＡＴ１６０）に基づいてＬＣＤパネル２０（電気光学装置）の第１の辺側からデータ線を駆動し、第２のデータラッチ１７０の複数のフリップフロップに保持されたデータ（ＬＡＴ１６１〜３２０）に基づいてＬＣＤパネル２０（電気光学装置）の第２の辺側からデータ線を駆動することで、データスクランブルＩＣを用いることなく、くし歯配線されたＬＣＤパネル２０を駆動することができるようになる。
【０１００】
ところが、図１１（Ｂ）では、コントローラがイネーブル入出力信号ＥＩＯを出力してから該イネーブル入出力信号ＥＩＯに対応して階調データをデータドライバに対して出力するまでの期間が、図１１（Ａ）と異なる。
【０１０１】
この場合、シフト出力ＳＦＯ１、ＳＦＯ２、・・・、ＳＦＯ１６０の出力タイミングは図１１（Ａ）と同様であるため、階調バス１１０の階調データを正しく取り込むことができない。したがって、くし歯配線されたデータ線を駆動して正しい画像を表示させることができない。
【０１０２】
そこで本実施形態におけるデータドライバ３０では、取込開始タイミング設定レジスタと、取込指示信号生成回路とを設け、取込開始タイミング設定レジスタの設定データに対応した期間だけ、イネーブル入出力信号ＥＩＯを遅延させて第１及び第２のシフトスタート信号ＳＴ１、ＳＴ２を生成することができるようになっている。こうすることで、コントローラごとに異なる階調データの供給タイミングに依存することなく、くし歯配線されたデータ線を駆動するための階調データを正しい順序で取り込むことができる。
【０１０３】
図１２に、本実施形態におけるデータドライバ３０の詳細な構成例を示す。図１２において、図８に示す比較例におけるデータドライバ７００と同一部分には同一符号を付し、適宜説明を省略する。
【０１０４】
図６におけるデータラッチ１００は、図１２における階調バス１１０、第１及び第２のクロックライン１２０、１３０、第１及び第２のシフトレジスタ１４０、１５０、第１及び第２のデータラッチ１６０、１７０を含む。また図６におけるデータラッチ１００は、図１２における取込開始タイミング設定レジスタ６５０、取込指示信号生成回路６５２を含む。図６におけるラインラッチ２００は、図１２における第１及び第２のラインラッチ２１０、２２０を含む。
【０１０５】
また図６におけるＤＡＣ３００、データ線駆動回路４００が、図１２におけるデータ線駆動部６００に相当する。第１の駆動回路４１０は、データ出力部ＯＵＴ１〜ＯＵＴ１６０に相当する。第２の駆動回路４２０は、データ出力部ＯＵＴ１６１〜ＯＵＴ３２０に相当する。
【０１０６】
本実施形態におけるデータドライバ３０が、図８に示す比較例におけるデータドライバ７００と異なる点は、上述のように取込開始タイミング設定レジスタ６５０と、取込指示信号生成回路６５２とを含む点である。取込指示信号生成回路６５２において生成された第１及び第２のシフトスタート信号ＳＴ１、ＳＴ２（第１及び第２の取込指示信号）が、第１及び第２のシフトレジスタ１４０、１５０に供給される。
【０１０７】
取込開始タイミング設定レジスタ６５０には、コントローラ等から供給される階調データの供給開始タイミングを指示する信号（イネーブル入出力信号ＥＩＯ）を基準に該階調データの取込開始タイミングを設定するためのデータが設定される。このデータは、ホスト、或いはコントローラによって設定される。例えばコントローラは、ホストにより該コントローラに設定された内容を、データドライバ３０の取込開始タイミング設定レジスタ６５０に設定する。
【０１０８】
取込指示信号生成回路６５２は、取込開始タイミング設定レジスタ６５０に設定されたデータに対応した期間だけ、イネーブル入出力信号ＥＩＯ（階調データの供給開始タイミングを指示する信号）を遅延させた第１及び第２のシフトスタート信号ＳＴ１、ＳＴ２（第１及び第２の取込指示信号）を生成する。第１及び第２のシフトクロックＣＬＫ１、ＣＬＫ２を工夫することで、第１及び第２のシフトスタート信号ＳＴ１、ＳＴ２は同位相の信号とすることができる。ここでは、第１及び第２のシフトスタート信号ＳＴ１、ＳＴ２は同位相の信号としているが、これに限定されるものではない。
【０１０９】
これにより、第１のシフトレジスタ１４０は、第１のシフトスタート信号ＳＴ１を第１のシフトクロックＣＬＫ１に基づいて第１のシフト方向にシフトし、シフト出力ＳＦＯ１、ＳＦＯ２、・・・、ＳＦＯ１６０を順次出力する。したがって、第１のデータラッチ１６０は、第１のシフトスタート信号ＳＴ１（第１の取込指示信号）に基づく取込タイミングで、階調バス１１０の階調データを取り込む。
【０１１０】
同様に第２のシフトレジスタ１５０は、第２のシフトスタート信号ＳＴ２を第２のシフトクロックＣＬＫ２に基づいて第２のシフト方向にシフトし、シフト出力ＳＦＯ３２０、ＳＦＯ３１９、・・・、ＳＦＯ１６１を順次出力する。したがって、第２のデータラッチ１７０は、第２のシフトスタート信号ＳＴ２（第２の取込指示信号）に基づく取込タイミングで、階調バス１１０の階調データを取り込む。
【０１１１】
図１３に、図１２に示すデータドライバ３０の動作例のタイミング図を示す。なお図１３では、データ線ＤＬ１を駆動するための階調データＤＡＴＡ１を「１」、データ線ＤＬ２を駆動するための階調データＤＡＴＡ２を「２」、・・・と表わしている。また図１３では、第１のデータラッチ１６０に階調データを取り込むタイミング例を示している。
【０１１２】
図１３において、負論理の水平同期信号ＨＳＹＮＣのパルスが入力されると、データドライバ３０は当該水平走査期間用の階調データに基づいてデータラインを駆動すると共に、次の水平走査期間用の階調データの取り込みを開始する。
【０１１３】
そして、データドライバ３０では、コントローラからのイネーブル入出力信号ＥＩＯと該イネーブル入出力信号ＥＩＯに対応した階調データ（Ｄ）とが供給される。階調データ（Ｄ）は、基準クロックＣＰＨに同期して供給される。
【０１１４】
データドライバ３０では、コントローラにより、取込開始タイミング設定レジスタ６５０に、図１３における期間Ｔに対応したデータ（例えば基準クロックＣＰＨのクロック数「１」）が予め設定されている。
【０１１５】
そしてデータドライバ３０では、イネーブル入出力信号ＥＩＯに基づいて第１のシフトスタート信号ＳＴ１が生成される。このときデータドライバ３０では、取込指示信号生成回路６５２において、取込開始タイミング設定レジスタ６５０の設定内容により期間Ｔだけイネーブル入出力信号ＥＩＯを遅延させた第１及び第２のシフトスタート信号ＳＴ１、ＳＴ２が生成される。
【０１１６】
更にデータドライバ３０では、基準クロックＣＰＨでコントローラからの階調データ（Ｄ）がラッチされ、ラッチされた階調データが階調バス１１０に出力される。
【０１１７】
第１のシフトレジスタ１４０では、初段取込期間において第１のシフトスタート信号ＳＴ１が取り込まれると、データ取込期間において分周クロックに同期してシフト出力ＳＦＯ１、ＳＦＯ２、・・・、ＳＦＯ１６０を出力する。
【０１１８】
第１のデータラッチ１６０では、ＦＦｉ（１≦ｉ≦１６０）がシフト出力ＳＦＯｉの立ち下がりエッジで、階調バス１１０の階調データを取り込む。したがって、シフト出力ＳＦＯ１の立ち下がりエッジで階調バス１１０の階調データＤＡＴＡ１が取り込まれ、シフト出力ＳＦＯ２の立ち下がりエッジで階調バス１１０の階調データＤＡＴＡ３が取り込まれ、・・・、シフト出力ＳＦＯ１６０の立ち下がりエッジで階調バス１１０の階調データＤＡＴＡ３１９が取り込まれる。
【０１１９】
なお図１３では、第１のデータラッチ１６０の階調データの取込タイミングを示しているが、第２のデータラッチ１７０に階調データを取り込むタイミングも同様である。したがって第２のシフトレジスタ１５０では、初段取込期間において第２のシフトスタート信号ＳＴ２が取り込まれると、データ取込期間において分周クロックに同期してシフト出力ＳＦＯ３２０、ＳＦＯ３１９、・・・、ＳＦＯ１６１を出力する。
【０１２０】
これにより、第２のデータラッチ１７０では、ＦＦｉ（１６１≦ｉ≦３２０）がシフト出力ＳＦＯｉの立ち下がりエッジで、階調バス１１０の階調データを取り込む。したがって、シフト出力ＳＦＯ３２０の立ち下がりエッジで階調バス１１０の階調データＤＡＴＡ２が取り込まれ、シフト出力ＳＦＯ３１９の立ち下がりエッジで階調バス１１０の階調データＤＡＴＡ４が取り込まれ、・・・、シフト出力ＳＦＯ１６１の立ち下がりエッジで階調バス１１０の階調データＤＡＴＡ３２０が取り込まれる。
【０１２１】
このようにデータドライバ３０では、取込開始タイミング設定レジスタ６５０の設定内容に応じてイネーブル入出力信号ＥＩＯを遅延させて第１及び第２のシフトスタート信号ＳＴ１、ＳＴ２を生成するようにしたので、図１１（Ｂ）と異なり、階調バス１１０の階調データを正しく取り込むことができるようになる。
【０１２２】
次に、取込指示信号生成回路６５２の詳細な構成例について説明する。
【０１２３】
図１４に、図１２に示す取込指示信号生成回路６５２の回路構成例を示す。図１４では、取込開始タイミング設定レジスタ６５０が４ビットのデータが設定されるものとする。
【０１２４】
取込指示信号生成回路６５２は、基準クロックＣＰＨ（又は基準クロックＣＰＨに対応するクロック）をカウントするリップルカウンタ６６０（広義にはカウンタ）を含む。そして、イネーブル入出力信号ＥＩＯ（階調データの供給開始タイミングを指示する信号）を基準にリップルカウンタ６６０のカウントを開始して、そのカウント値が取込開始タイミング設定レジスタ６５０に設定されたデータに対応した第１のカウント値になったことを条件に、そのレベルが変化する第１及び第２のシフトスタート信号ＳＴ１、ＳＴ２を生成する。
【０１２５】
リップルカウンタ６６０は、リセット付きＤＦＦであるＤＦＲ１〜ＤＦＲ４を含む。各ＤＦＲは、Ｃ端子への入力信号の立ち上がりでＤ端子への入力信号を保持し、保持した信号をＱ端子から出力すると共に、保持した信号の反転信号をＸＱ端子から出力する。そして、ＤＦＲのＲ端子への入力信号が「Ｌ」レベルのときに該ＤＦＲが初期化される。ＤＦＲ１〜ＤＦＲ４では、それぞれＸＱ端子とＤ端子とが接続される。ＤＦＲ１〜ＤＦ３のＸＱ端子は、次段のＤＦＲのＣ端子に接続される。ＤＦＲ１〜ＤＦＲ４のＲ端子には、水平同期信号ＨＳＹＮＣが共通に供給される。
【０１２６】
なお図１４では、リップルカウンタ６６０は、シーケンス検出回路６６２で所定のシーケンスを経た後にイネーブル入出力信号ＥＩＯが入力された後の基準クロックＣＰＨに対応する内部クロックＩＣＬＫをカウントしている。
【０１２７】
シーケンス検出回路６６２は、ＤＦＲ５、ＤＦＲ６を含む。ＤＦＲ５のＤ端子にはシステム電源電圧ｖｄｄが供給される。ＤＦＲ５のＣ端子には、水平同期信号ＨＳＹＮＣの反転信号が供給される。ＤＦＲ６のＤ端子は、ＤＦＲ５のＱ端子に接続される。ＤＦＲ６のＣ端子には、イネーブル入出力信号ＥＩＯが供給される。ＤＦＲ６のＱ端子からは、シーケンス検出回路６６２が所定のシーケンスを検出したか否かを示す検出信号ＲＥＩＯが取り出される。ＤＦＲ５、ＤＦＲ６のＲ端子には、反転リセット信号ＸＲＥＳの反転信号とＥＩＯ出力信号ＥＩＯ＿ＯＵＴとの反転論理和演算結果が供給される。ＥＩＯ出力信号ＥＩＯ＿ＯＵＴは、例えばデータドライバがカスケード接続された場合の次のデータドライバへのイネーブル入出力信号（ＥＩＯ）、又は取り込まれた階調データで一杯になったことを示す信号である。反転リセット信号ＸＲＥＳは、データドライバ３０の初期化信号である。
【０１２８】
このような構成のシーケンス検出回路６６２は、負論理の水平同期信号ＨＳＹＮＣの立ち上がり後に、正論理のイネーブル入出力信号ＥＩＯが立ち上がり、基準クロックＣＰＨが立ち上がったことを示す検出信号ＲＥＩＯを出力する。
【０１２９】
また取込指示信号生成回路６５２は、Ｄラッチ６６４を含む。Ｄラッチ６６４は、Ｃ端子への入力信号が「Ｈ」レベルのときＤ端子への入力信号をそのままＭ端子から出力し、Ｃ端子への入力信号が「Ｈ」レベルから「Ｌ」レベルに変化した時点でのＤ端子への入力信号を保持してＭ端子から出力する。Ｄラッチ６６４のＤ端子には、ＤＦＲ６のＱ端子が接続される。Ｄラッチ６６４のＣ端子には基準クロックＣＰＨが供給される。ＤラッチのＭ端子から、検出ラッチ信号ＳＥＩＯが出力される。
【０１３０】
そして第１のマスク回路６６６に、基準クロックＣＰＨと、検出ラッチ信号ＳＥＩＯと、比較結果信号ＣＯＭＰの反転信号とが入力される。第１のマスク回路６６６は、基準クロックＣＰＨと、検出ラッチ信号ＳＥＩＯと、比較結果信号ＣＯＭＰの反転信号との反転論理積演算結果を内部クロックＩＣＬＫとして出力する。
【０１３１】
比較結果信号ＣＯＭＰは、比較回路６６８によって生成される。比較回路６６８は、ＤＦＲ１〜ＤＦＲ４の各Ｑ端子からの出力信号と、取込開始タイミング設定レジスタ６５０の設定データＣ＜３：０＞の各ビットとを比較し、その比較結果信号を出力する。
【０１３２】
第１のマスク回路６６６により、シーケンス検出回路６６２により所定のシーケンスが検出された後にリップルカウンタ６６０に供給される内部クロックＩＣＬＫは、比較結果信号ＣＯＭＰによってマスクされる。より具体的には、リップルカウンタ６６０のカウント値が、期間Ｔに対応した設定データ（第１のカウント値）になった後、リップルカウンタ６６０に入力される内部クロックＩＣＬＫ（基準クロック）を固定して、カウント動作を停止させる。こうすることで、無駄なカウントを止めて低消費電力化を図る。
【０１３３】
また第２のマスク回路６７０には、シーケンス検出回路６６２の検出信号ＲＥＩＯと、比較結果信号ＣＯＭＰとが入力される。第２のマスク回路６７０は、検出信号ＲＥＩＯと、比較結果信号ＣＯＭＰとの論理積演算結果を内部イネーブル入出力信号Ｉ＿ＥＩＯとして出力する。すなわち、取込指示信号生成回路６５２は、リップルカウンタ６６０のカウント値が期間Ｔに対応した設定データ（第１のカウント値）になるまでの間、イネーブル入出力信号ＥＩＯ（階調データの供給開始タイミングを指示する信号）に基づいて生成された検出信号ＲＥＩＯをマスクして第１及び第２のシフトスタート信号ＳＴ１、ＳＴ２（第１及び第２の取込指示信号）を生成する。
【０１３４】
なお図１４では、第１及び第２のシフトスタート信号ＳＴ１、ＳＴ２は、立ち上がり検出回路６７２によって生成される。立ち上がり検出回路６７２は、内部イネーブル入出力信号Ｉ＿ＥＩＯの立ち上がりを検出し、該立ち上がりを検出したときに正論理のパルスを生成することができる。このような立ち上がり検出回路６７２は、例えば図１５に示す構成で実現できる。
【０１３５】
図１６（Ａ）、（Ｂ）に、図１４に示す取込指示信号生成回路６５２の第１及び第２の動作例のタイミング図を示す。図１６（Ａ）は、取込開始タイミング設定レジスタ６５０に「０」が設定され、基準クロックＣＰＨが「Ｈ」レベルのときにイネーブル入出力信号ＥＩＯが入力されたときの動作例を示す。図１６（Ｂ）は、取込開始タイミング設定レジスタ６５０に「０」が設定され、基準クロックＣＰＨが「Ｌ」レベルのときにイネーブル入出力信号ＥＩＯが入力されたときの動作例を示す。
【０１３６】
この場合、イネーブル入出力信号ＥＩＯが入力されると、内部イネーブル入出力信号Ｉ＿ＥＩＯが立ち上がり、その立ち上がりに対応したパルスが第１のシフトスタート信号ＳＴ１として出力される。図１６（Ａ）、（Ｂ）では、第１のシフトスタート信号ＳＴ１のみを示しているが、第２のシフトスタート信号ＳＴ２も同様である。
【０１３７】
図１７（Ａ）、（Ｂ）に、図１４に示す取込指示信号生成回路６５２の第３及び第４の動作例のタイミング図を示す。図１７（Ａ）は、取込開始タイミング設定レジスタ６５０に「２」が設定され、基準クロックＣＰＨが「Ｈ」レベルのときにイネーブル入出力信号ＥＩＯが入力されたときの動作例を示す。図１７（Ｂ）は、取込開始タイミング設定レジスタ６５０に「８」が設定され、基準クロックＣＰＨが「Ｌ」レベルのときにイネーブル入出力信号ＥＩＯが入力されたときの動作例を示す。
【０１３８】
図１７（Ａ）では、イネーブル入出力信号ＥＩＯが入力された後に、基準クロックＣＰＨの２つ目の立ち下がりで内部イネーブル入出力信号Ｉ＿ＥＩＯが「Ｈ」レベルとなる。そして、内部イネーブル入出力信号Ｉ＿ＥＩＯの立ち上がりに対応したパルスが第１のシフトスタート信号ＳＴ１として出力される。
【０１３９】
図１７（Ｂ）では、イネーブル入出力信号ＥＩＯが入力された後に、基準クロックＣＰＨの８つ目の立ち上がりを、基準クロックＣＰＨの立ち下がりで同期させた時点で内部イネーブル入出力信号Ｉ＿ＥＩＯが「Ｈ」レベルとなる。そして、内部イネーブル入出力信号Ｉ＿ＥＩＯの立ち上がりに対応したパルスが第１のシフトスタート信号ＳＴ１として出力される。
【０１４０】
図１７（Ａ）、（Ｂ）では、第１のシフトスタート信号ＳＴ１のみを示しているが、第２のシフトスタート信号ＳＴ２も同様である。
【０１４１】
図１２に示すデータドライバ３０では、第１及び第２のシフトスタート信号ＳＴ１、ＳＴ２を同位相の信号とすることが望ましい。その理由は、第１及び第２のシフトスタート信号ＳＴ１、ＳＴ２を別個に生成する必要が生ずるからである。
【０１４２】
第１及び第２のシフトスタート信号ＳＴ１、ＳＴ２が同位相の信号の場合、第１及び第２のシフトレジスタ１４０、１５０の初段で第１及び第２のシフトスタート信号ＳＴ１、ＳＴ２をそれぞれ取り込むための第１及び第２のシフトクロックＣＬＫ１、ＣＬＫ２を生成する必要がある。そこで、データドライバ３０は、次に示すようなシフトクロック生成回路を含むことが望ましい。
【０１４３】
図１８に、シフトクロック生成回路の構成の概要を示す。
【０１４４】
シフトクロック生成回路８００は、階調データが同期して供給される基準クロックＣＰＨに基づいて、第１及び第２のシフトクロックＣＬＫ１、ＣＬＫ２を生成する。シフトクロック生成回路８００は、互いに位相が反転する期間を含むように第１及び第２のシフトクロックＣＬＫ１、ＣＬＫ２を生成する。
【０１４５】
このように第１及び第２のシフトクロックＣＬＫ１、ＣＬＫ２を生成することによって、第１及び第２のシフトスタート信号ＳＴ１、ＳＴ２を同位相の信号とすることができ、構成及び制御の簡素化を図ることができる。
【０１４６】
図１９に、シフトクロック生成回路８００による第１及び第２のシフトクロックＣＬＫ１、ＣＬＫ２の生成タイミングの一例を示す。
【０１４７】
シフトクロック生成回路８００は、初段取込期間とデータ取込期間（シフト動作期間）とを規定するクロック選択信号ＣＬＫ＿ＳＥＬＥＣＴを生成する。初段取込期間は、第１のシフトレジスタ１４０に第１のシフトスタート信号ＳＴ１を取り込む期間、又は第２のシフトレジスタ１５０に第２のシフトスタート信号ＳＴ２を取り込む期間ということができる。データ取込期間は、初段取込期間経過後において、該初段取込期間において取り込まれた各シフトスタート信号がシフトされる期間ということができる。
【０１４８】
そしてクロック選択信号ＣＬＫ＿ＳＥＬＥＣＴを用いて、第１及び第２のシフトクロックＣＬＫ１、ＣＬＫ２がそれぞれ第１及び第２のシフトスタート信号ＳＴ１、ＳＴ２を取り込むためのエッジを持たせる。
【０１４９】
そのため、初段取込期間において、基準クロックＣＰＨのパルスＰ１を生成する。また基準クロックＣＰＨを分周して分周クロックＣＰＨＤを生成する。分周クロックＣＰＨＤは、第２のシフトクロックＣＬＫ２となる。更に分周クロックＣＰＨＤの位相を反転させて、反転分周クロックＸＣＰＨＤを生成する。
【０１５０】
そして、クロック選択信号ＣＬＫ＿ＳＥＬＥＣＴにより、初段取込期間では基準クロックＣＰＨのパルスＰ１を選択出力し、データ取込期間では反転分周クロックＸＣＰＨＤを選択出力することで、第１のシフトクロックＣＬＫ１が生成される。
【０１５１】
図２０に、シフトクロック生成回路８００の具体的な構成例である回路図を示す。
【０１５２】
図２１に、図２０におけるシフトクロック生成回路８００の動作タイミングの一例を示す。
【０１５３】
図２０及び図２１では、基準クロックＣＰＨを用いてクロックＣＬＫ＿Ａ、ＣＬＫ＿Ｂを生成し、クロック選択信号ＣＬＫ＿ＳＥＬＥＣＴにより選択出力される。第２のシフトクロックＣＬＫ２は、クロックＣＬＫ＿Ｂを反転した信号である。第１のシフトクロックＣＬＫ１は、クロック選択信号ＣＬＫ＿ＳＥＬＥＣＴが「Ｌ」レベルの初段取込期間においてクロックＣＬＫ＿Ａを選択出力し、クロック選択信号ＣＬＫ＿ＳＥＬＥＣＴが「Ｈ」レベルのデータ取込期間においてクロックＣＬＫ＿Ｂを選択出力した信号である。
【０１５４】
そして、以上のような第１及び第２のシフトスタート信号ＳＴ１、ＳＴ２、第１及び第２のシフトクロックＣＬＫ１、ＣＬＫ２により、データドライバ３０のデータラッチ１００では、以下のように動作する。
【０１５５】
図２２に、データドライバ３０のデータラッチ１００の動作のタイミングの一例を示す。
【０１５６】
ここでは、取込開始タイミング設定レジスタ６５０に「２」が設定されているものとする。またデータ線ＤＬ１に対応して階調データＤＡＴＡ１（図２２では単に「１」）、データ線ＤＬ２に対応して階調データをＤＡＴＡ２（図２２では単に「２」）、・・・として示している。そして、階調バス１１０には基準クロックＣＰＨに同期して階調データが出力されている。
【０１５７】
図２２では、イネーブル入出力信号ＥＩＯが入力された後に、基準クロックＣＰＨの２つ目の立ち下がりで内部イネーブル入出力信号Ｉ＿ＥＩＯが「Ｈ」レベルとなる。そして、内部イネーブル入出力信号Ｉ＿ＥＩＯの立ち上がりに対応したパルスが第１のシフトスタート信号ＳＴ１として出力される。第２のシフトスタート信号ＳＴ２も第１のシフトスタート信号ＳＴ１と同位相の信号として出力される。
【０１５８】
第１のシフトレジスタ１４０では、第１のシフトクロックＣＬＫ１の立ち上がりエッジに同期して、第１のシフトスタート信号ＳＴ１をシフトする。その結果、第１のシフトレジスタ１４０は、シフト出力ＳＦＯ１〜ＳＦＯ１６０の順に各シフト出力を出力する。
【０１５９】
また第１のシフトレジスタ１４０のシフト動作中に、第２のシフトレジスタ１５０では、第２のシフトクロックＣＬＫ２の立ち上がりに同期して、第２のシフトスタート信号ＳＴ２をシフトする。その結果、第２のシフトレジスタ１５０は、シフト出力ＳＦＯ３２０〜ＳＦＯ１６１の順に各シフト出力を出力する。
【０１６０】
第１のデータラッチ１６０では、第１のシフトレジスタ１４０からの各シフト出力の立ち下がりエッジで、階調バス１１０の階調データを取り込む。その結果、第１のデータラッチ１６０は、シフト出力ＳＦＯ１の立ち下がりで階調データＤＡＴＡ１、シフト出力ＳＦＯ２の立ち下がりで階調データＤＡＴＡ３、シフト出力ＳＦＯ３の立ち下がりで階調データＤＡＴＡ５、・・・を取り込む。
【０１６１】
一方、第２のデータラッチ１７０では、第２のシフトレジスタ１５０からの各シフト出力の立ち下がりエッジで、階調バス１１０の階調データを取り込む。その結果、第２のデータラッチ１７０は、シフト出力ＳＦＯ３２０の立ち下がりで階調データＤＡＴＡ２、シフト出力ＳＦＯ３１９の立ち下がりで階調データＤＡＴＡ４、シフト出力ＳＦＯ３１８の立ち下がりで階調データＤＡＴＡ６、・・・を取り込む。
【０１６２】
これにより、くし歯配線されたＬＣＤパネル２０の各データ線に対応したデータスクランブル後の階調データ（図５参照）を取り込むことができ、図１又は図４に示すようなＬＣＤパネル２０のデータ線ＤＬ１〜ＤＬ３２０にそれぞれ対応する階調データＤＡＴＡ１〜ＤＡＴＡ３２０が供給され、正しい画像を表示することができるようになる。そして、コントローラからのイネーブル入出力信号ＥＩＯの変化点を基準に、該コントローラからの階調データが供給開始されるまでの期間がコントローラに依存する場合であっても、くし歯配線されたデータ線を駆動するために正しい順序で階調データを取り込むことができる。
【０１６３】
なお、本発明は上述した実施の形態に限定されるものではなく、本発明の要旨の範囲内で種々の変形実施が可能である。上述の実施形態では、表示パネルの各画素がＴＦＴを有するアクティブマトリクス方式の液晶パネルを例に説明したが、これに限定されるものではない。パッシブマトリックス方式の液晶パネルにも適用することができる。また液晶パネルに限らず、例えばプラズマディスプレイ装置にも適用可能である。
【０１６４】
また１画素を３ドットで構成する場合は、３本の色成分用データ線を１組として、上述した各データ線に置き換えれば、同様に実現することができる。
【０１６５】
更に本実施形態では、第１及び第２のシフト方向を例えば図１２に示す方向として説明したが、これに限定されるものではない。
【０１６６】
また、本発明のうち従属請求項に係る発明においては、従属先の請求項の構成要件の一部を省略する構成とすることもできる。また、本発明の１の独立請求項に係る発明の要部を、他の独立請求項に従属させることもできる。
【図面の簡単な説明】
【図１】電気光学装置の構成の概要のブロック図。
【図２】画素の構成の模式図。
【図３】くし歯配線されないＬＣＤパネルを含む電気光学装置の構成を模式的に示すブロック図。
【図４】ＬＣＤパネルの短辺側に沿って配置されるデータドライバの例を示す説明図。
【図５】くし歯配線されたＬＣＤパネルを駆動するためにデータスクランブルの必要性を説明する図。
【図６】本実施形態におけるデータドライバの構成の概要の構成図。
【図７】１出力当たりのデータドライバの構成の概要の構成図。
【図８】比較例におけるデータドライバの構成のブロック図。
【図９】第１のシフトレジスタの構成例を示す回路図。
【図１０】第２のシフトレジスタの構成例を示す回路図。
【図１１】図１１（Ａ）、（Ｂ）は比較例におけるデータドライバの動作例を示すタイミング図。
【図１２】本実施形態におけるデータドライバの構成のブロック図。
【図１３】本実施形態におけるデータドライバの動作例を示すタイミング図。
【図１４】取込指示信号生成回路の構成例を示す回路図。
【図１５】立ち上がり検出回路の構成例を示す回路図。
【図１６】図１６（Ａ）、（Ｂ）は取込指示信号生成回路の第１及び第２の動作例のタイミング図。
【図１７】図１７（Ａ）、（Ｂ）は取込指示信号生成回路の第３及び第４の動作例のタイミング図。
【図１８】シフトクロック生成回路の構成図。
【図１９】シフトクロック生成回路による第１及び第２のシフトクロックの生成タイミングの一例を示すタイミング図。
【図２０】シフトクロック生成回路の構成例を示す回路図。
【図２１】図２０に示すシフトクロック生成回路の動作例のタイミング図。
【図２２】本実施形態におけるデータドライバのデータラッチの動作の一例を示すタイミング図。
【符号の説明】
３０  データドライバ、１００  データラッチ、１１０  階調バス、
１２０  第１のクロックライン、１３０  第２のクロックライン、
１４０  第１のシフトレジスタ、１５０  第２のシフトレジスタ、
１６０  第１のデータラッチ、１７０  第２のデータラッチ、
２００  ラインラッチ、２１０  第１のラインラッチ、
２２０  第２のラインラッチ、３００  ＤＡＣ、４００  データ線駆動回路、
４１０  第１の駆動回路、４２０  第２の駆動回路、６００  データ線駆動部、６５０  取込開始タイミング設定レジスタ、６５２  取込指示信号生成回路
【図１】
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【図２】
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【図３】
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【図４】
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【図５】
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【図６】
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【図７】
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【図８】
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【図９】
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【図１０】
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【図１１】
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【図１２】
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【図１３】
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【図１４】
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【図１５】
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【図１６】
2004334105.tif 000018
【図１７】
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【図１８】
2004334105.tif 000020
【図１９】
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【図２０】
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【図２１】
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【図２２】
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