(57)【要約】【課題】  従来は、ビタビアルゴリズムを用いて記録媒体に記録された被記録データの再生を行う際、媒体特性に起因する記録マーク形状の不揃いや、再生波形の非線形歪みが生じた場合、良好な再生性能を維持できない。【解決手段】  データ推定回路１４は、パスメモリ１２から出力された復号データ系列に基づき、入力データよりも所定ビット周期前の時点の入力データを推定した推定データを出力する。目標値演算回路１５は、推定データと入力データとの差を目標値誤差として目標値修正を行い、得られた複数の第１の目標値をブランチメトリック演算回路１１へ複数の目標値として出力する。ブランチメトリック演算回路１１は、最も出現頻度が高い（ヒストグラムでピークを持つ）複数の平均値に近付いた複数の第１の目標値に基づいてブランチメトリック演算ができるため、固定の目標値を使用するよりも復号性能を向上できる。【選択図】          図１
2004288368.tif 000002
【特許請求の範囲】
【請求項１】
入力データに対し複数の目標値を用いてブランチメトリックの演算を行って選択信号を生成するブランチメトリック演算回路と、
前記ブランチメトリック演算回路から出力された前記選択信号に基づいて入力データをビタビ復号した復号データ系列を出力するパスメモリと、
前記パスメモリから出力された前記復号データ系列に基づき、入力データを推定した推定データを出力するデータ推定回路と、
前記データ推定回路から出力された前記推定データと入力データとの差を目標値誤差として目標値修正を行い、得られた複数の第１の目標値をブランチメトリック演算回路へ複数の目標値として出力する目標演算手段とを有することを特徴とするビタビ復号器。
【請求項２】
前記目標値演算手段は、
複数の初期目標値を予め保持しておき、演算開始時点および誤差演算の非収束時には複数の目標値を前記ブランチメトリック演算回路へ複数の目標値として出力することを特徴とする請求項１記載のビタビ復号器。
【請求項３】
前記目標値演算手段は、
前記データ推定回路から出力された推定データと入力データとの差を目標値誤差として複数の第１目標値を生成する目標値演算回路と、
複数の第１の目標値のうち中央値の目標値を中心として各目標値の値が対称となるように、複数の第１の目標値のそれぞれに対応する修正目標値として複数の第2の目標値を生成する目標値修正回路と、
前記目標値演算回路により得られた目標値誤差が所定の閾値以下のときは複数の第１の目標値を前記ブランチメトリック演算回路へ出力し、目標値誤差が閾値を超えたときは複数の第２の目標値を前記ブランチメトリック演算回路へ出力する選択手段とからなることを特徴とする請求項１記載のビタビ復号器。
【発明の詳細な説明】
【技術分野】
【０００１】
本発明はビタビ復号器に係り、特に光ディスクや磁気ディスク等のディジタル記録媒体から記録データを復号するためのビタビ復号器に関する。
【背景技術】
【０００２】
光ディスクや磁気ディスク等のディジタル記録媒体の再生装置では、記録ピットの長さや深さから再生信号の非対称性が生じるため、再生信号を所定のしきい値でスライスしてディジタル信号を検出する検出回路のスライス位置を再生信号の非対称成分をもとにコントロールする装置（オートスライサ）などが、従来より使われている。また、従来、ビタビ復号器をこのような再生信号の非対称性に対応させるべく、ピット情報のアシンメトリ量を検出し、そのアシンメトリ量に基づいて補正ピット情報を生成し、この補正ピット情報をビタビ復号器により復調するようにした「光学式情報再生装置」（特開平６−１５０５４９号公報）が知られている。
【０００３】
【特許文献１】特開平６−１５０５４９号公報
【発明の開示】
【発明が解決しようとする課題】
【０００４】
しかるに、特開平６−１５０５４９号公報記載の発明によれば、既知のピットが記録してあるエリアでの補正だけでは記録エリア内での特性変化に追従することが困難であり、特に書き換え可能な媒体への適用への困難が予想される。
【０００５】
例えば、１Ｔ（Ｔはビット周期：以下同様）幅の孤立波形に対して、略１，１，１，１の値を持つ応答波形、いわゆる伝送特性がパーシャルレスポンス（以下、ＰＲと略記する）の（１，１，１，１）となるように波形等化を行い、例えば再生波形のレベル（波高値）が略−２、−１、０、１、２となるようにする場合、対称性の良好な再生信号をビット周期Ｔでサンプリングした、すなわち、ビタビ復号器への入力位置での波高値のヒストグラムを測定した結果は、図１０に示すようになる。
【０００６】
しかし、記録時のパワー過不足や媒体の特性変化によっては、ＰＲ（１，１，１，１）特性への波形等化が不可能になるような非線形歪みを生じ、その結果、図１１に示すような対称性の非常に悪い再生波形しか得られない場合がある。図１１の例では、−２、−１、０、１、２のレベルに波形を収束させようと波形等化器が動作をし、その結果、２のレベルに収束すべきサンプルの分散が大きくなってしまっており、このような非線形歪みが大きすぎる入力波に対しては従来のビタビ復号器では良好な復号動作ができないという問題がある。
【０００７】
本発明は、以上の点に鑑みなされたもので、ビタビアルゴリズムを用いて記録媒体に記録された被記録データの再生を行う際、記録パワーや、媒体特性に起因する記録マーク形状の不揃いや、再生特性によって生じる再生波形の非線形歪みが生じた場合でも、良好な再生性能を維持し得るビタビ復号器を提供することを目的とする。
【課題を解決するための手段】
【０００８】
本発明は上記の目的を達成するため、下記の構成になるビタビ復号器を提供する。
(１)  入力データに対し複数の目標値を用いてブランチメトリックの演算を行って選択信号を生成するブランチメトリック演算回路と、
前記ブランチメトリック演算回路から出力された前記選択信号に基づいて入力データをビタビ復号した復号データ系列を出力するパスメモリと、
前記パスメモリから出力された前記復号データ系列に基づき、入力データを推定した推定データを出力するデータ推定回路と、
前記データ推定回路から出力された前記推定データと入力データとの差を目標値誤差として目標値修正を行い、得られた複数の第１の目標値をブランチメトリック演算回路へ複数の目標値として出力する目標演算手段とを有することを特徴とするビタビ復号器。
(２)  前記目標値演算手段は、
複数の初期目標値を予め保持しておき、演算開始時点および誤差演算の非収束時には複数の目標値を前記ブランチメトリック演算回路へ複数の目標値として出力することを特徴とする請求項１記載のビタビ復号器。
(３)  前記目標値演算手段は、
前記データ推定回路から出力された推定データと入力データとの差を目標値誤差として複数の第１目標値を生成する目標値演算回路と、
複数の第１の目標値のうち中央値の目標値を中心として各目標値の値が対称となるように、複数の第１の目標値のそれぞれに対応する修正目標値として複数の第2の目標値を生成する目標値修正回路と、
前記目標値演算回路により得られた目標値誤差が所定の閾値以下のときは複数の第１の目標値を前記ブランチメトリック演算回路へ出力し、目標値誤差が閾値を超えたときは複数の第２の目標値を前記ブランチメトリック演算回路へ出力する選択手段とからなることを特徴とする請求項１記載のビタビ復号器。
【発明の効果】
【０００９】
本発明によれば、最も出現頻度が高い（ヒストグラムでピークを持つ）複数の平均値に近付いた複数の第１の目標値に基づいてブランチメトリック演算を行うようにしたため、非線形歪みのある入力データに対しても、従来に比べて誤り率が小さな正確なビタビ復号ができる。
【００１０】
また、本発明によれば、演算開始時点及び誤差演算の非収束時には、複数の初期目標値に基づくブランチメトリック演算を行うようにしたため、演算開始時点や誤差演算の非収束時でも安定にビタビ復号ができる。
【００１１】
更に、本発明によれば、ビタビ復号器に入力される等化波形（入力データ）が大きく歪んでいるときは、複数の第１の目標値のうち中央値の目標値を中心として各目標値の値が対称となるように、複数の第１の目標値のそれぞれに対応する修正目標値に基づき、入力データの歪みの影響を最小限にしたブランチメトリック演算が行えるようにしたため、大きく歪んだ入力データに対しても、ブランチメトリック誤差演算に非対称性を生じさせることなく、正確なビタビ復号ができる。
【発明を実施するための最良の形態】
【００１２】
次に、本発明の実施の形態について図面と共に説明する。図１は本発明になるビタビ復号器の一実施の形態のブロック図を示す。同図に示すように、この実施の形態は、入力端子１０を介して入力データｙ(k)が供給されるブランチメトリック演算回路１１と、復号データ系列を出力するパスメモリ１２と、パスメモリ１２の長さによって決定される遅延時間を持つ遅延回路１３と、推定データＹ(k-i)を出力するデータ推定回路１４と、目標値をブランチメトリック演算回路１１へ供給する目標値演算回路１５とより構成されている。この実施の形態は、従来のブランチメトリック演算回路１１及びパスメモリ１２からなるビタビ復号回路に、遅延回路１３、データ推定回路１４及び目標値演算回路１５を設けた点に特徴がある。
【００１３】
この実施の形態では、最短記録反転間隔が３Ｔに制限をされているディジタル信号が記録されている記録媒体の再生装置において、伝送特性が略ＰＲ（１，１，１，１）となるよう伝送路等化を行う場合に適用した場合を例にとって説明する。最短記録反転間隔が３Ｔに制限をされている記録媒体には、コンパクトディスク（ＣＤ）やＤＶＤ（Digital Versatile Disc）などがある。本実施の形態では最短記録反転間隔を３Ｔとした場合について述べるが、他の記録変調、伝送路等化方式についても本発明は適用可能である。
【００１４】
図２（ａ）は１Ｔ幅の孤立波に対して、略１，１，１，１の値を持つ応答波形、いわゆるＰＲ（１，１，１，１）特性を持つよう波形等化を行った場合の記録波形を示し、同図（ｂ）は再生波形を示す。この実施の形態では、図２（ｂ）に示すように、再生波形はレベル（波高値）が略−２，−１，０，１，２となるよう波形等化が行われる。
【００１５】
図３は図２に対応する状態遷移図を示す。同図中、Ｓ０，Ｓ１，Ｓ２，Ｓ３，Ｓ４，Ｓ５が入力データ（復号データと同様）がどの状態にあるのかを示し、状態間の矢印に付してある記号は左が入力ビット（入力データの１ビット）で、右が出力波高値を示している。図４は図３の状態遷移図に対応するＰＲ（１，１，１，１）の復号トレリスを示す。状態間の矢印に付してある記号は図３と同様に左が入力データの１ビットの値、右が出力波高値を示す。
【００１６】
図１に示したビタビ復号器は、ＰＲ（１，１，１，１）を用いたビタビ復号を行う回路で、その中のブランチメトリック演算回路１１は、図３の状態遷移図で表される波形等化が行われた再生波形を、ビット周期間隔でサンプリングした波形を、端子１０を介して入力データｙ(k)として受け、また、後述の目標値演算回路１５から５値の目標値ＴＵ、ＭＵ、ＺＥ、ＭＬ、ＴＬを受け、これらに基づいてブランチメトリック演算をして２つの選択信号０及び１を出力する。本実施の形態では、従来固定値であった目標値が、目標値誤差信号を基にして可変する点に特徴がある。
【００１７】
図５はブランチメトリック演算回路１１の一例の回路系統図を示す。同図中、目標値ＴＵ、ＭＵ、ＺＥ、ＭＬ、ＴＬはそれぞれ前記図４の復号トレリスに示した、５値の波高値「２」、「１」、「０」、「‐１」、「‐２」の平均値に対応している。減算器２１1は入力データｙ(k)から目標値ＴＬを差し引く減算を行い、減算器２１2及び２１3は入力データｙ(k)から目標値ＭＬを差し引く減算を行い、減算器２１4及び２１5は入力データｙ(k)から目標値ＺＥを差し引く減算を行い、減算器２１6及び２１7は入力データｙ(k)から目標値ＭＵを差し引く減算を行い、減算器２１8は入力データｙ(k)から目標値ＴＵを差し引く減算を行う。
【００１８】
減算器２１1〜２１8からそれぞれ取り出された入力データｙ(k)と対応する目標値との差分値（誤差信号）は、対応して設けられた２乗回路２２1〜２２8でそれぞれ２乗された後、加算器２３1〜２３8に供給されて、状態Ｓ０、Ｓ１、Ｓ２、Ｓ３、Ｓ４、Ｓ５における時間ｋ−１でのメトリックＬ0(k-1)、Ｌ1(k-1)、Ｌ2(k-1)、Ｌ3(k-1)、Ｌ4(k-1)、Ｌ5(k-1)と加算される。すなわち、加算器２３1及び２３3は２乗回路２２1、２２3の出力信号とメトリックＬ0(k-1)と加算し、加算器２３2は２乗回路２２2の出力信号とメトリックＬ1(k-1)と加算し、加算器２３4、２３5、２３7はそれぞれ２乗回路２２4、２２5、２２7の出力信号とメトリックＬ2(k-1)、Ｌ3(k-1)、Ｌ4(k-1)と加算し、加算器２３6及び２３8は２乗回路２２6、２２8の出力信号とメトリックＬ5(k-1)と加算する。
【００１９】
比較回路２４は加算器２３1及び２３2の両出力信号のレベルを比較し、加算器２３1の出力信号の方が加算器２３2の出力信号よりも小さいときには選択回路２５より加算器２３1の出力信号を、状態Ｓ０における時間ｋでのメトリックＬ0(k)として選択出力させ、上記と逆の場合は選択回路２５より加算器２３2の出力信号をメトリックＬ0(k)として出力させる。なお、時間ｋは時間ｋ−１よりも１ビット周期Ｔ後の任意の時間を表している。
【００２０】
一方、比較回路２７は加算器２３7及び２３8の両出力信号を比較し、加算器２３7の出力信号の方が加算器２３8の出力信号よりも小さいときには選択回路２６より加算器２３7の出力信号を、状態Ｓ５における時間ｋでのメトリックＬ5(k)として選択出力させ、上記と逆の場合は選択回路２６より加算器２３8の出力信号をメトリックＬ5(k)として出力させる。
【００２１】
また、加算器２３3、２３4、２３5及び２３6からは、それぞれ状態Ｓ３、Ｓ１、Ｓ４及びＳ２における時間ｋでのメトリックＬ3(k)、Ｌ1(k)、Ｌ4(k)及びＬ2(k)が取り出される。更に、比較回路２４及び２７からは、それぞれ選択信号０及び選択信号１が取り出される。これらの選択信号は選択回路２５、２６においてどちらの信号を選択したかを示す信号である。
【００２２】
これにより、上記のブランチメトリック演算回路１１から出力される状態Ｓ０、Ｓ１、Ｓ２、Ｓ３、Ｓ４及びＳ５における時間ｋでのメトリックＬ0(k)、Ｌ1(k)、Ｌ2(k)、Ｌ3(k)、Ｌ4(k)、Ｌ5(k)は、それぞれ次式で表される。
Ｌ0(k)=  min[[Ｌ0(k-1)+( y(k)−(-2)) 2｝，[Ｌ1(k-1)+( y(k)−(-1)) 2]]
Ｌ1(k) =  Ｌ2(k-1)＋( y(k)− (0))2
Ｌ2(k) =  Ｌ5(k-1)＋( y(k) − (1))2
Ｌ3(k) =  Ｌ0(k-1)＋( y(k) −(-1))2
Ｌ4(k) =  Ｌ3(k-1)＋( y(k) −(０))2
Ｌ5(k) = min[[Ｌ5(k-1)+( y(k)−(2)) 2｝，[Ｌ4(k-1)+( y(k)−(1)) 2]]
ただし、min［a、b］は、a、bのうち小を出力する演算子である。
【００２３】
上記の構成のブランチメトリック演算回路１１から取り出された選択信号０及び１は、図１に示すようにパスメモリ１２に供給され、ここで、ビタビ復号された復号データ系列を生成させる。パスメモリ１２は、例えば図６のブロック図に示すように、選択信号０により２つの入力信号の一方を選択する動作を行うｎ個の選択器３１1〜３１nと、選択信号１により２つの入力信号の一方を選択する動作を行うｎ個の選択器３２1〜３２nと、各々ビット周期Ｔの遅延時間を有する遅延素子３３1〜３３6、３４1〜３４6、３５1〜３５6などと、多数決回路３６とから構成されている。
【００２４】
図６の選択器３１1に入力される０、１、遅延素子３３2,３３3にそれぞれ入力される１、遅延素子３３4及び３３5にそれぞれ入力される０、選択器３２1に入力される０及び１の各１ビットの値がパスメモリ１２での復号動作により、最終的に１つの復号データ系列として多数決回路３６から取り出される。ここで、上記の各１ビットの値は図４に示した復号トレリスの値に対応している。
【００２５】
このパスメモリ１２において、選択器３１1では、前記メトリック演算で、Ｌ0(k)として、Ｌ0(k-1)＋( y(k)−(-2)) 2が出力された場合には選択信号０によってビット値０が選択され、Ｌ1(k-1)＋( y(k)−(-1)) 2が出力された場合には選択信号０によってビット値１が選択される。一方、選択器３２1では、前記メトリック演算で、Ｌ5(k)としてＬ5(k-1)＋( y(k)−(-2)) 2が出力された場合には選択信号１によってビット値１が選択され、Ｌ4(k-1)＋( y(k)−(-1)) 2が出力された場合にはビット値０が選択される。その他の選択器での動作も同様に、選択信号によって選択動作を行い図４の復号トレリスに基づくビタビ復号を行って行く。
【００２６】
なお、選択器３１1〜３１n、３２1〜３２n、遅延素子３３1〜３３6、３４1〜３４6、３５1〜３５6などの個数は復号性能によって定まるが、通常は上記のｎの値が３２程度になるように選ばれる。
【００２７】
このようにしてパスメモリ１２より取り出された復号データ系列は、図１の出力端子１６より出力されると共に、データ推定回路１４に供給される。データ推定回路１４は、パスメモリ１２の長さによってｋよりｉ時点前の推定データＹ(k-i)を目標値演算回路１５に出力する。
【００２８】
図７はデータ推定回路１４の一例のブロック図を示す。同図に示すように、データ推定回路１４は、ＰＲ（１，１，１，１）では、ビット周期Ｔのクロックで駆動される４段縦続接続された遅延素子４１、４２、４３及び４４と、遅延素子４１〜４４からの遅延信号を加算して一つの合成信号とする加算器４５と、加算器４５からの合成信号を入力として受け、推定データＹ(k-i)を出力する推定データ変換器４６とから構成されている。
【００２９】
このデータ推定回路１４の動作について説明するに、ビット列（バイナリ列）で出力される復号データ系列は、遅延素子４１〜４４により順次にビット周期Ｔずつ遅延されると共に、遅延素子４１〜４４の各出力遅延信号が加算器４５で加算合成されて合成信号とされた後、推定データ変換器４６に供給される。推定データ変換器４６は、加算器４５の出力値を変換して、図５における目標値ＴＵ，ＭＵ，ＺＥ，ＭＬ，ＴＬのうちの一つを推定データＹ(k-i)として出力する。
【００３０】
推定データ変換器４６によるデータ変換は次の規則でなされる。すなわち、遅延素子４１〜４４の各出力信号がすべて「０」であるとき（００００）は、加算器４５の出力合成信号の値は「０」であり、このとき推定データ変換器４６は目標値ＴＬを推定データＹ(k-i)として出力する。また、遅延素子４１〜４４の各出力信号のうち、遅延素子４１又は４４の出力信号が「１」で、残りの３つの出力信号が「０」であるとき（１０００又は０００１）には、加算器４５の出力合成信号の値は「１」であり、このとき推定データ変換器４６は目標値ＭＬを推定データＹ(k-i)として出力する。
【００３１】
また、遅延素子４１〜４４の各出力信号のうち、遅延素子４１及び４２の出力信号、あるいは遅延素子４３及び４４の出力信号が「１」で、残りの２つの出力信号が「０」であるとき（１１００又は００１１）には、加算器４５の出力合成信号の値は「２」であり、このとき推定データ変換器４６は目標値ＺＥを推定データＹ(k-i)として出力する。更に、遅延素子４１〜４４の各出力信号のうち、遅延素子４１又は４４の出力信号が「０」で、残りの３つの出力信号が「１」であるとき（１１１０又は０１１１）には、加算器４５の出力合成信号の値は「３」であり、このとき推定データ変換器４６は目標値ＭＵを推定データＹ(k-i)として出力し、遅延素子４１〜４４の各出力信号がすべて「１」のとき（１１１１）には、加算器４５の出力合成信号の値は「４」であり、このとき推定データ変換器４６は目標値ＴＵを推定データＹ(k-i)として出力する。以上をまとめると表１に示すようになる。
【表１】
2004288368.tif 000003
【００３２】
すなわち、データ推定回路１４は、復号データ系列として０が４つ続いた時は、その時点ｋよりｉ時点前のデータは目標値ＴＬ（従来の目標値−２に相当）であると推定し、同様に、０００１、１０００のように１が一つの場合は目標値ＭＬ（従来の目標値−１に相当）、１１００，００１１のように１が２つ続いた場合は目標値ＺＥ（従来の目標値０に相当）と推定され、推定データＹ(k-i)として出力される。ビタビ復号器の出力はビット誤りが低いため、非常に正確に推定データを得ることができる。
【００３３】
データ推定回路１４から出力された上記の推定データＹ(k-i)は、図１に示すように、目標値演算回路１５に供給される。また、この目標値演算回路１５には、ブランチメトリック演算回路１１への入力データｙ(k)が、パスメモリ１２の長さによって決定される遅延回路１３により、データ推定回路１４から出力される推定データＹ(i-1)と同じ時点まで遅延された遅延入力データｙ(k-i)が入力される。
【００３４】
目標値演算回路１５はこれらの入力データＹ(k-i)，ｙ(k-i)を基にして目標値の更新を行い、ブランチメトリック演算回路１１に出力をする。図８は目標値演算回路１５の一例の回路系統図を示す。同図に示すように、目標値演算回路１５は、誤差演算を行う減算器５１と、修正係数を乗ずる乗算器５２と、前記推定データＹ(k-i)によって選択動作する選択器５３及び５４と、加算器５５1〜５５5と、加算器５５1〜５５5と互いに独立したフィードバックループを構成する遅延素子５６1〜５６5とから構成される。
【００３５】
この目標値演算回路１５の動作について説明するに、遅延回路１３から取り出された遅延入力データｙ(k-i)は、減算器５１に供給され、ここで選択器５４により推定データＹ(k-i)によって選択された遅延素子５６1〜５６5のうちのいずれか一の遅延素子出力信号と減算されて、目標値誤差信号とされた後、乗算器５２で修正係数Ｇと乗算され、選択器５３に供給され、推定データＹ(k-i)に応じて加算器５５1〜５５5のうち、いずれか一の加算器に選択入力される。
【００３６】
例えば、推定データＹ(k-i)として目標値ＴＬが推定されたとすると、選択器５４が遅延素子５６5から取り出された１ビット周期Ｔ前の目標値ＴＬ(k-1)を選択するので、減算器５１からは[ｙ(k-i)−ＴＬ(k-1)]で表される目標値誤差信号が取り出され、乗算器５２で修正係数Ｇと乗算されて[Ｇ（ｙ(k-i)−ＴＬ(k-1)）]で表される信号とされた後、選択器５３により加算器５５5へ選択入力されて、遅延素子５６5から取り出された目標値ＴＬ(k-1)と加算される。これにより、加算器５５5からは次式
ＴＬ(k) =ＴＬ(k-1) + Ｇ（ｙ(k-i)−ＴＬ(k-1)）
で表される修正後の目標値ＴＬ(k)が取り出され、ブランチメトリック演算回路１１へ出力される。
【００３７】
推定データＹ(k-i)として他の目標値が推定された場合も同様であり、目標値ＴＵが推定されたときは選択器５３は入力信号を加算器５５1へ出力すると共に、選択器５４は遅延素子５６1の出力信号を選択し、目標値ＭＵが推定されたときは選択器５３は入力信号を加算器５５2へ出力すると共に、選択器５４は遅延素子５６2の出力信号を選択し、目標値ＺＥが推定されたときは選択器５３は入力信号を加算器５５3へ出力すると共に、選択器５４は遅延素子５６3の出力信号を選択し、目標値ＭＬが推定されたときは選択器５３は入力信号を加算器５５4へ出力すると共に、選択器５４は遅延素子５６4の出力信号を選択する。
【００３８】
なお、目標値演算回路１５には、初期目標値が入力され、遅延素子５６1〜５６5に保持されており、演算開始時点や、大きな無信号状態などで生じる誤差演算の非収束時には、初期目標値が用いられるよう、例えば、図示せぬシステムコントローラや、無信号検出回路等より、初期目標値選択信号が入力され、初期目標値が目標値として使用される。
【００３９】
このようにして目標値演算回路１５より取り出されてブランチメトリック演算回路１１に供給される、更新された５つの目標値は、ビタビ復号器に入力されたデータで、最も出現頻度が高い（ヒストグラムでピークを持つ）５つの平均値に近づいており、良好なビタビ復号が可能となる。すなわち、本実施の形態によれば、目標値修正を行う事で、ある程度の非線形歪みに対しては復号性能の改善効果が期待できる。
【００４０】
次に、本発明の他の実施の形態について説明する。上記の実施の形態では、ある程度の非線形歪みに対しては復号性能の改善効果が期待できるが、大きく歪んだ波形に対しては、歪みが大きい所でブランチメトリック誤差演算に非対称性を生じ、修正しきれない場合が生じる。そこで、この実施の形態では、図１の目標値演算回路１５の回路部分を、図９に示すブロック図の構成とすることにより、目標値を対称にし、大きな歪みに対してブランチメトリック演算回路１１が正常に動作を行うよう目標値制御をする構成としたものである。
【００４１】
図９において、目標値演算回路１５より取り出された、更新された５つの目標値は、目標値修正回路６１に供給されて修正される一方、直接に選択器６２に供給される。選択器６２は比較器６３からの選択信号に応じて、目標値修正回路６１からの修正目標値か目標値演算回路１５からの目標値を選択する。選択器６２の出力目標値は図１及び図５に示したブランチメトリック演算回路１１へ出力される。
【００４２】
目標値修正回路６１は、目標値演算回路１５からの５つの目標値ＴＵ、ＭＵ、ＺＥ、ＭＬ、ＴＬのうち中央値の目標値ＺＥを中心として各目標値の値が対称となるように、これら５つの目標値のそれぞれに対応する修正目標値ＴＵ´、ＭＵ´、ＺＥ´、ＭＬ´、ＴＬ´を生成する回路で、具体的には更新された５つの目標値ＴＵ、ＭＵ、ＺＥ、ＭＬ、ＴＬを用いて、例えば次式により修正目標値ＴＵ´、ＭＵ´、ＺＥ´、ＭＬ´、ＴＬ´を生成出力する。
ＴＵ´＝−ＴＬ´＝（ＴＵ−ＴＬ）／２
ＭＬ´＝−ＭＬ´＝（ＭＵ−ＭＬ）／２
ＺＥ´＝  ＺＥ
【００４３】
すなわち、修正目標値ＴＵ´、ＴＬ´は目標値ＴＵとＴＬの平均、修正目標値ＭＵ´、ＭＬ´は目標値ＭＵ、ＭＬの平均とされる。なお、目標値修正回路６１は、これよりも複雑な数式に基づいて目標修正値を生成することもできることは勿論である。
【００４４】
比較器６３は目標値演算回路１５内の図８に示した減算器５１から取り出された目標値誤差と、予め外部から設定されている閾値とを比較し、目標値誤差が閾値以下であるときには、選択器６２により目標値演算回路１５からの目標値を選択させ、目標値誤差が閾値を越えた時に目標値修正回路６１からの修正目標値を選択させる。目標値誤差はビタビ復号器の入力データｙ(k)の波形歪みに対応しているから、波形歪みがある設定値を越えるような大きな場合は、ブランチメトリック演算回路１１へ供給される目標値を目標値修正回路６１からの修正目標値に変更することにより、目標値を対称にし、大きな歪みに対してブランチメトリック演算回路１１を正常に動作させる。
【００４５】
なお、本発明は以上の実施の形態に限定されるものではなく、例えば、目標値誤差は、係数が掛けられた値でもよいし、積分処理などを行った後の信号を用いる事も可能である。また、選択器６２で選択される目標値は、初期目標値を用いる事も可能である。
【図面の簡単な説明】
【００４６】
【図１】本発明の一実施の形態のブロック図である。
【図２】ＰＲ（１，１，１，１）の説明図である。
【図３】ＰＲ（１，１，１，１）の状態遷移図である。
【図４】図３に対応する復号トレリス線図である。
【図５】図１中のブランチメトリックの演算回路の一例の回路系統図である。
【図６】図１中のパスメモリの一例のブロック図である。
【図７】図１中のデータ推定回路の一例のブロック図である。
【図８】図１中の目標値演算回路の一例の回路系統図である。
【図９】本発明の他の実施の形態の要部のブロック図である。
【図１０】対称な再生波のヒストグラムである。
【図１１】非対称な再生波のヒストグラムである。
【符号の説明】
【００４７】
１０  入力データ入力端子
１１  ブランチメトリック演算回路
１２  パスメモリ
１３  遅延回路
１４  データ推定回路
１５  目標値演算回路
１６  復号データ系列出力端子
３１1〜３１n、３２1〜３２n、５３、５４、６２ 選択器
４１〜４４、５６1〜５６5  遅延素子
４５、５５1〜５５5  加算器
４６  推定データ変換器
５１  減算器
５２  乗算器
６１  目標値修正回路
６３  比較器
【図１】
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【図２】
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【図３】
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【図４】
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【図５】
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【図６】
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【図７】
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【図８】
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【図９】
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【図１０】
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【図１１】
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