(57)【要約】【課題】スタガー型ＴＦＴ基板製造の露光工程数を削減する。【解決手段】ハーフトーンマスクを用いてＴＦＴ基板のドレインバスライン（ＤＢ）を形成する領域とＴＦＴを形成する領域にレジストパターンを形成し（ステップＳ１）、そのレジストパターンをマスクにしたエッチングによりＤＢを形成し、チャネルエッチングを行なってＴＦＴのチャネルとなる部分を形成する（ステップＳ２）。さらに、ハーフトーンマスクを用いてゲートバスライン（ＧＢ）を形成する領域と画素電極を形成する領域にレジストパターンを形成し（ステップＳ４）、そのレジストパターンをマスクにしたエッチングによりＧＢおよび画素電極を形成する（ステップＳ５）。ＤＢとチャネル、ＧＢと画素電極がそれぞれ１枚のハーフトーンマスクで形成され、スタガー型ＴＦＴ基板製造の露光工程数が削減される。【選択図】        図１
2004281687.tif 000002
【特許請求の範囲】
【請求項１】
スタガー型の薄膜トランジスタ基板の製造方法において、
ハーフトーンマスクを用いて、レジストに対する１回の露光により、異なる領域に異なる膜厚のレジストパターンを形成する工程を有することを特徴とする薄膜トランジスタ基板の製造方法。
【請求項２】
前記薄膜トランジスタ基板のドレインバスラインを形成するドレインバスライン形成領域と前記薄膜トランジスタ基板の薄膜トランジスタを形成する薄膜トランジスタ形成領域をマスクするレジストパターンを形成する際に、前記ハーフトーンマスクを用いて、レジストに対する１回の露光により、前記薄膜トランジスタ形成領域内の前記薄膜トランジスタのチャネルを形成するチャネル形成領域と、前記ドレインバスライン形成領域および前記薄膜トランジスタ形成領域内の前記チャネル形成領域以外の領域とに、レジストの膜厚が異なるレジストパターンを形成することを特徴とする請求項１記載の薄膜トランジスタ基板の製造方法。
【請求項３】
前記薄膜トランジスタ基板のゲートバスラインを形成するゲートバスライン形成領域と前記薄膜トランジスタ基板の画素電極を形成する画素電極形成領域をマスクするレジストパターンを形成する際に、前記ハーフトーンマスクを用いて、レジストに対する１回の露光により、前記ゲートバスライン形成領域と前記画素電極形成領域とにレジストの膜厚が異なるレジストパターンを形成することを特徴とする請求項１記載の薄膜トランジスタ基板の製造方法。
【請求項４】
スタガー型の薄膜トランジスタ基板の製造方法において、
基板上に動作層を介して形成されたドレインバスライン層上にレジストを形成する工程と、
ハーフトーンマスクを用いて前記レジストを露光し、薄膜トランジスタ基板のドレインバスラインを形成するドレインバスライン形成領域と前記薄膜トランジスタ基板の薄膜トランジスタを形成する薄膜トランジスタ形成領域とに、前記薄膜トランジスタのチャネルを形成するチャネル形成領域のみ膜厚をより薄くしたレジストパターンを形成する工程と、
前記レジストパターンを用いて前記ドレインバスライン層をエッチングする工程と、
前記チャネル形成領域の薄く形成されたレジストが除去されるまで前記レジストパターンをアッシングする工程と、
アッシング後に残る前記レジストパターンを用いて前記動作層をチャネルエッチングする工程と、
を有することを特徴とする薄膜トランジスタ基板の製造方法。
【請求項５】
前記基板上に前記動作層を介して形成された前記ドレインバスライン層上に前記レジストを形成する工程においては、前記基板と前記動作層との間に遮光膜を設け、前記動作層を介して形成された前記ドレインバスライン層上に前記レジストを形成することを特徴とする請求項４記載の薄膜トランジスタ基板の製造方法。
【請求項６】
アッシング後に残る前記レジストパターンを用いて前記動作層をチャネルエッチングする工程の後に、
アッシング後に残る前記レジストパターンを除去し、全面に絶縁膜を形成して前記絶縁膜に前記ドレインバスライン層に達するコンタクトホールを形成する工程と、
前記薄膜トランジスタ基板のゲートバスラインを形成するゲートバスライン形成領域と前記コンタクトホールが形成された領域とを除き、入射する光を散乱させる凹凸層を形成する工程と、
ゲートバスライン層を形成し、前記ゲートバスライン層上に、前記ゲートバスライン形成領域と前記薄膜トランジスタ基板の画素電極を形成する画素電極形成領域とをマスクするレジストパターンを形成する工程と、
前記レジストパターンを用いて前記ゲートバスライン層をエッチングする工程と、
を有することを特徴とする請求項４記載の薄膜トランジスタ基板の製造方法。
【請求項７】
スタガー型の薄膜トランジスタ基板の製造方法において、
基板上に動作層を介してドレインバスライン層を形成し、エッチングにより、薄膜トランジスタ基板のドレインバスラインを形成し、前記動作層に前記薄膜トランジスタ基板の薄膜トランジスタのチャネルとなる部分を形成する工程と、
絶縁膜を形成して前記絶縁膜に前記ドレインバスライン層に達するコンタクトホールを形成する工程と、
前記コンタクトホールが形成された前記絶縁膜上に透明導電膜層とゲートバスライン層とを積層形成し、前記ゲートバスライン層上に、ハーフトーンマスクを用いて、前記薄膜トランジスタ基板のゲートバスラインを形成するゲートバスライン形成領域と前記薄膜トランジスタ基板の画素電極を形成する画素電極形成領域とに、前記画素電極形成領域のレジストの膜厚が前記ゲートバスライン形成領域のレジストの膜厚より薄いレジストパターンを形成する工程と、
前記レジストパターンを用いて前記ゲートバスライン層と前記透明導電膜層とをエッチングする工程と、
前記画素電極形成領域の薄く形成されたレジストが除去されるまで前記レジストパターンをアッシングする工程と、
アッシング後に残る前記レジストパターンを用いて前記画素電極形成領域の前記ゲートバスライン層をエッチングする工程と、
を有することを特徴とする薄膜トランジスタ基板の製造方法。
【請求項８】
前記基板上に前記動作層を介して前記ドレインバスライン層を形成し、前記薄膜トランジスタ基板の前記ドレインバスラインを形成し、前記動作層に前記薄膜トランジスタ基板の前記薄膜トランジスタの前記チャネルとなる部分を形成する工程においては、前記基板と前記動作層との間に遮光膜を設け、前記動作層を介して前記ドレインバスライン層を形成し、前記薄膜トランジスタ基板の前記ドレインバスラインを形成し、前記動作層に前記薄膜トランジスタ基板の前記薄膜トランジスタの前記チャネルとなる部分を形成することを特徴とする請求項７記載の薄膜トランジスタ基板の製造方法。
【請求項９】
前記絶縁膜を形成して前記絶縁膜に前記ドレインバスライン層に達する前記コンタクトホールを形成する工程においては、前記ドレインバスライン層と前記透明導電膜層とをコンタクトするためのコンタクトホールと前記薄膜トランジスタ基板の端子のコンタクトホールとを形成することを特徴とする請求項７記載の薄膜トランジスタ基板の製造方法。
【請求項１０】
スタガー型の薄膜トランジスタ基板の製造方法において、
基板上に動作層を介してドレインバスライン層を形成し、エッチングにより、薄膜トランジスタ基板のドレインバスラインを形成し、前記動作層に前記薄膜トランジスタ基板の薄膜トランジスタのチャネルとなる部分を形成する工程と、
絶縁膜と透明導電膜層とを積層形成する工程と、
前記透明導電膜層上に、ハーフトーンマスクを用いて、前記絶縁膜に形成するコンタクトホールの領域が開口され前記薄膜トランジスタ基板の画素電極を形成する画素電極形成領域のみレジストの膜厚をより厚くしたレジストパターンを形成する工程と、
前記レジストパターンを用いて前記絶縁膜と前記透明導電膜層とをエッチングして前記コンタクトホールを形成する工程と、
前記画素電極形成領域以外の領域の薄く形成されたレジストが除去されるまで前記レジストパターンをアッシングする工程と、
アッシング後に残る前記レジストパターンを用いて前記透明導電膜層をエッチングする工程と、
を有することを特徴とする薄膜トランジスタ基板の製造方法。
【発明の詳細な説明】
【０００１】
【発明の属する技術分野】
本発明は薄膜トランジスタ（Ｔｈｉｎ  Ｆｉｌｍ  Ｔｒａｎｓｉｓｔｏｒ，ＴＦＴ）基板の製造方法に関し、特に複数種のマスクを用いた複数回の露光工程を経て製造されるスタガー型のＴＦＴ基板の製造方法に関する。
【０００２】
【従来の技術】
近年、液晶表示装置には、高精彩、高輝度、高品位などの表示性能の向上が強く求められており、特に搭載される液晶パネルのＴＦＴ基板について、その研究開発が進められている。さらに、今日では企業収益の点から、液晶表示装置の製造を、効率的に、かつ、より簡略化した製造プロセスで行なうことも求められる。また、製造に要する電力や原料についても環境に配慮した製造プロセスが地球規模で求められている。
【０００３】
現在、ＴＦＴ基板の製造は、主に逆スタガー型と呼ばれる方式で行なわれており、いずれも複数枚のマスクを用いて複数回の露光工程を経て形成される。その場合、ＴＦＴ基板に形成すべきゲートバスライン層、動作アイランド層、ドレインバスライン層、保護膜層、画素電極層といった少なくとも５枚のマスクを用いてＴＦＴ基板の製造が行なわれている。すなわち、逆スタガー型のＴＦＴ基板製造には、露光工程だけでも５工程必要であった。そのため、このような逆スタガー型のＴＦＴ基板製造においては、その生産性向上のため、ハーフトーンマスクを用いて露光プロセスを３回に削減する方法などが提案されている（例えば特許文献１参照）。
【０００４】
ところで、ＴＦＴ基板製造には、もうひとつスタガー型と呼ばれる方式があり、逆スタガー型とは異なる構造のＴＦＴ基板を形成することができる。スタガー型のＴＦＴ基板製造は、逆スタガー型の場合に比べ、例えばその構成層の連続成膜が可能である、製造過程での界面処理工程が不要である、といった利点を有している。
【０００５】
【特許文献１】
特開２００１−３１１９６５号公報
【０００６】
【発明が解決しようとする課題】
しかし、このようなスタガー型のＴＦＴ基板製造においても、従来は５枚ないし８枚程度のマスクを用いた複数回の露光工程が必要であったため、その生産効率が悪く、ＴＦＴ基板の完成までには多くの日数を要していた。また、マスク枚数（種類）が多く複数回の露光工程を経るため、ゴミなどによる表示欠陥が発生する確率が高くなってしまうという問題点があった。このように、スタガー型のＴＦＴ基板製造においては、その生産効率、歩留り、生産コストといった点で未だ課題が残されている。
【０００７】
本発明はこのような点に鑑みてなされたものであり、ＴＦＴ基板製造に要する露光工程数を削減し、生産性の良いスタガー型のＴＦＴ基板の製造方法を提供することを目的とする。
【０００８】
【課題を解決するための手段】
本発明では上記課題を解決するために、図１に例示するフローによって実現可能なＴＦＴ基板の製造方法が提供される。本発明のＴＦＴ基板の製造方法は、スタガー型のＴＦＴ基板の製造方法において、ハーフトーンマスクを用いて、レジストに対する１回の露光により、異なる領域に異なる膜厚のレジストパターンを形成する工程を有することを特徴とする。
【０００９】
このようなＴＦＴ基板の製造方法によれば、例えばＴＦＴ基板のドレインバスライン（ＤＢ）を形成する領域およびＴＦＴ基板のＴＦＴを形成する領域にレジストパターンを形成する際に、ハーフトーンマスクを用いた１回の露光でそれらの領域に目的のレジストパターンが形成される（ステップＳ１）。あるいは、ＴＦＴ基板のゲートバスライン（ＧＢ）を形成する領域およびＴＦＴ基板の画素電極を形成する領域にレジストパターンを形成する際に、ハーフトーンマスクを用いた１回の露光でそれらの領域に目的のレジストパターンが形成される（ステップＳ４）。そのため、１枚のマスクでＤＢとＴＦＴのチャネルを形成したりＧＢと画素電極を形成したりすることができるので（ステップＳ２，Ｓ５）、スタガー型ＴＦＴ基板製造に要する露光工程数が削減されるようになる。
【００１０】
【発明の実施の形態】
以下、本発明の実施の形態を、図面を参照して詳細に説明する。
まず第１の実施の形態について説明する。
【００１１】
図１は第１の実施の形態のスタガー型のＴＦＴ基板の製造方法のフローを示す図、図２から図２１は各製造工程の説明図である。第１の実施の形態のスタガー型ＴＦＴ基板製造は、大きく、図１のステップＳ１〜Ｓ５に示すフローで行なわれる。以下、各ステップについて、図２から図２１を参照して説明する。
【００１２】
まずステップＳ１について説明する。図２は連続成膜工程の要部断面図、図３は第１露光工程の要部断面図である。
スタガー型ＴＦＴ基板製造では、まず、図２に示すように、透明無アルカリガラスなどのガラス基板１上に、下地絶縁膜層２、動作層３、活性層４およびドレインバスライン（ＤＢ）層５を連続成膜する。これら下地絶縁膜層２、動作層３、活性層４およびＤＢ層５は、例えばＣＶＤ（Ｃｈｅｍｉｃａｌ  Ｖａｐｏｒ  Ｄｅｐｏｓｉｔｉｏｎ）装置を用いて１つのチャンバ内で連続成膜される。下地絶縁膜層２は、Ｓｉ３Ｎ４，ＳｉＯ，ＳｉＯＮなどを用いて、５０ｎｍ〜２００ｎｍ程度の膜厚になるよう形成し、動作層３および活性層４は、アモルファスシリコン（ａ−Ｓｉ）を用いて、それぞれ１０ｎｍ〜３００ｎｍ程度の膜厚になるよう形成する。活性層４は、その後、ホスフィンなどで処理してｎ＋層とする。また、ＤＢ層５は、後にＴＦＴ基板に形成されるＴＦＴのゲート絶縁膜が、動作層３の成膜などに比べて、プラズマＣＶＤ（Ｐ−ＣＶＤ）装置などを用いた高温工程で形成されることを考慮して、Ｃｒ，Ｍｏ，Ｔｉなどの高融点金属（合金を含む）を用いて形成する。ＤＢ層５は、１００ｎｍ〜３００ｎｍ程度の膜厚で形成する。なお、ＤＢ層５の形成にはスパッタ法を用いることも可能である。
【００１３】
続いて、図３に示すように、ＤＢ層５上に形成した感光性レジスト６ａに対してハーフトーンマスクを用いた第１露光を行ない、レジストパターンを形成する。ここで形成するレジストパターンは、ＴＦＴ基板のＤＢを形成する領域（ＤＢ形成領域）とＴＦＴ基板のＴＦＴを形成する領域（ＴＦＴ形成領域）をマスクするように形成される。さらに、この第１露光工程では、ハーフトーンマスクを用いた露光により、ＴＦＴ形成領域のうち、ＴＦＴのチャネルを形成する領域（チャネル形成領域）の感光性レジスト６ａの膜厚が、チャネル形成領域以外の領域の感光性レジスト６ａの膜厚よりも薄くなるようにして形成される。ハーフトーンマスクには、半透過膜を使用したタイプや多孔タイプのものを用いることができる。
【００１４】
ここで、ハーフトーンマスクについて説明する。図４は半透過膜を用いたハーフトーンマスクの説明図、図５は多孔タイプのハーフトーンマスクの説明図である。ただし、図５では、図４に示した要素と同一の要素については同一の符号を付し、その説明の詳細は省略する。
【００１５】
図４に示す半透過膜を用いたハーフトーンマスク１００は、マスク基板となる石英板１０１上に、入射光がある程度透過する半透過膜１０２が形成され、さらに、その半透過膜１０２上に部分的に、入射光の通過を遮断する遮光膜１０３が形成された構造を有している。半透過膜１０２には、クロム系（ＣｒＯＮ），モリブデン系（ＭｏＳｉＯＮ），タングステン系（ＷＳｉＯＮ），シリコン系（ＳｉＮ）などの材料が用いられる。また、遮光膜１０３には、例えばＣｒなどの金属材料が用いられる。半透過膜１０２および遮光膜１０３は、石英板１０１上にそれぞれ適当なパターンと膜厚で形成される。石英板１０１上に半透過膜１０２のみが形成されている領域は、入射光の半透過領域となり、半透過膜１０２と遮光膜１０３が積層形成されている領域は、入射光の遮光領域となる。このようなハーフトーンマスク１００を用いて、ガラス基板１０４上に被エッチング膜１０５を介して形成された感光性レジスト１０６を露光すると、半透過領域の感光性レジスト１０６ａの膜厚が、遮光領域の感光性レジスト１０６ｂの膜厚よりも薄く形成されるようになる。
【００１６】
また、図５に示す多孔タイプのハーフトーンマスク１００ａは、石英板１０１上にスリットを設けた遮光膜１０３ａが１層形成されていて、そのスリットが形成された領域が入射光の半透過領域になる。感光性レジスト１０６に対して異なる膜厚のレジストパターンを形成することができる点は、図４の半透過膜を用いたハーフトーンマスク１００と同じである。
【００１７】
図４および図５に示したようなハーフトーンマスクを用いることにより、１回の露光で異なる領域に異なる膜厚のレジストパターンを形成することができる。また、半透過膜の膜厚や材質を変更するなどして、２種以上の異なる膜厚のレジストパターンを形成することもできる。
【００１８】
このようなハーフトーンマスクを用いて、図３に示したように、感光性レジスト６ａに対する第１露光により、ＤＢ形成領域およびＴＦＴ形成領域に、それぞれの領域に応じた膜厚のレジストパターンを形成する。図６は第１露光工程後のエッチング工程の要部断面図である。第１露光工程でのレジストパターン形成後は、図６に示すように、そのレジストパターンをマスクにして、ＤＢ層５、活性層４および動作層３を、ウェットエッチングまたはドライエッチングする。
【００１９】
次にステップＳ２について説明する。ステップＳ２では、第１露光工程後に行なわれるエッチング工程に続き、レジストパターンのアッシング、チャネルエッチング、レジスト剥離が行なわれる。図７は第１アッシング工程の要部断面図、図８はチャネルエッチング工程の要部断面図、図９はチャネルエッチング工程後のレジスト剥離工程の要部断面図、図１０はチャネルエッチング工程後のレジスト剥離工程におけるＴＦＴ基板の基本構造の要部平面図である。なお、図９は図１０のＡ−Ａ断面図である。また、図１０には、便宜上、ＤＢ層下層の動作層も図示している。
【００２０】
図６に示したＤＢ層５、活性層４および動作層３のエッチング後は、感光性レジスト６ａのレジストパターンに対してＯ２を用いてアッシングを行ない、図７に示すように、チャネル形成領域のＤＢ層５上の感光性レジスト６ａを除去し、ＤＢ層５を露出させる。そして、図８に示すように、残った感光性レジスト６ａをマスクにしてチャネル形成領域のＤＢ層５および活性層４をウェットエッチングまたはドライエッチングする。チャネル形成領域の動作層３のエッチング（チャネルエッチング）は、動作層３をエッチオフせずにウェットエッチングまたはドライエッチングする。これにより、ＴＦＴのチャネルとなる部分が形成され、このチャネルエッチングは、そのチャネルとなる部分の動作層３の膜厚が、ＴＦＴ基板に形成すべきＴＦＴに要求される最適な膜厚となるように行なう。チャネルエッチング後は感光性レジスト６ａを剥離し、これにより、図９および図１０に示すようなＴＦＴ基板の基本構造が形成される。
【００２１】
次にステップＳ３について説明する。図１１は絶縁膜形成工程の要部断面図、図１２は第２露光工程の要部断面図、図１３は絶縁膜エッチング工程の要部断面図、図１４は絶縁膜エッチング工程におけるＴＦＴ基板の基本構造の要部平面図、図１５は透明導電膜層およびＧＢ層の成膜工程の要部断面図である。なお、図１３は図１４のＢ−Ｂ断面図である。また、図１４には、便宜上、ＤＢ層下層の動作層も図示している。
【００２２】
図９および図１０に示したＴＦＴ基板の基本構造形成後、図１１に示すように、全面に、Ｐ−ＣＶＤ装置を用いて絶縁膜７を形成する。ここで、絶縁膜７には、Ｓｉ３Ｎ４，ＳｉＯ，ＳｉＯＮなどを用いることができる。この絶縁膜７のうちチャネル形成領域に形成された部分は、後に完成するＴＦＴのゲート絶縁膜として機能するようになるため、Ｐ−ＣＶＤ装置を用いて２５０℃〜３００℃程度の高温条件で緻密な膜として形成される。また、絶縁膜７の膜厚は、その材質および形成するＴＦＴの要求特性に応じて、１００ｎｍ〜５００ｎｍ程度の範囲で適当に設定する。
【００２３】
絶縁膜７の形成後、図１２に示すように、絶縁膜７上に感光性レジスト６ｂを形成して第２露光を行ない、絶縁膜７にコンタクトホールを形成する領域（コンタクトホール形成領域）を断面テーパ状に開口したレジストパターンを形成する。この第２露光工程後、そのレジストパターンをマスクにして絶縁膜７をウェットエッチングまたはドライエッチングし、その後、感光性レジスト６ｂを剥離する。これにより、図１３および図１４に示すように、最上層が絶縁膜７に覆われ、その絶縁膜７の一部にＤＢ層５が露出するコンタクトホール７ａが形成されたＴＦＴ基板の基本構造が形成される。
【００２４】
感光性レジスト６ｂの剥離後は、図１５に示すように、全面に、透明導電膜層８およびＧＢ層９を、この順に成膜する。ここで、透明導電膜層８は、ＩＴＯ（Ｉｎｄｉｕｍ  Ｔｉｎ  Ｏｘｉｄｅ）などをＣＶＤ法やスパッタ法により３０ｎｍ〜１００ｎｍ程度の膜厚で形成する。また、ＧＢ層９には、膜の安定性、低抵抗性を考慮し、Ｃｒ，Ｍｏ，Ｔｉ，Ａｌなどを用いることができ、ＧＢ層９は、ＣＶＤ法やスパッタ法により１００ｎｍ〜３００ｎｍ程度の膜厚で形成する。この工程により、透明導電膜層８は、コンタクトホール７ａ内で露出していたＤＢ層５と直接コンタクトされるようになる。
【００２５】
次にステップＳ４について説明する。図１６は第３露光工程の要部断面図、図１７は透明導電膜層およびＧＢ層のエッチング工程の要部断面図、図１８は第２アッシング工程の要部断面図である。
【００２６】
図１５に示した透明導電膜層８およびＧＢ層９の成膜後は、図１６に示すように、感光性レジスト６ｃを形成し、再びハーフトーンマスクを用いて第３露光を行なう。この第３露光工程で、ＴＦＴ基板のＧＢを形成する領域（ＧＢ形成領域）とＴＦＴ基板の画素電極を形成する領域（画素電極形成領域）をマスクするレジストパターンが形成される。その際、そのレジストパターンを形成している感光性レジスト６ｃは、画素電極形成領域の膜厚が、ＧＢ形成領域の膜厚よりも薄くなるようにして形成される。次いで、図１７に示すように、そのレジストパターンをマスクにして、ＧＢ層９および透明導電膜層８をウェットエッチングまたはドライエッチングする。その後、図１８に示すように、画素電極形成領域の感光性レジスト６ｃがなくなるまでＯ２でアッシングを行ない、ＧＢ形成領域にのみ感光性レジスト６ｃを残す。
【００２７】
次にステップＳ５について説明する。図１９はＧＢ層エッチング工程の要部断面図、図２０はＧＢ層エッチング工程後のレジスト剥離工程の要部断面図、図２１はＴＦＴ基板の要部平面図である。なお、図２０は図２１のＣ−Ｃ断面図である。また、図２１には、便宜上、ＤＢ層下層の動作層も図示している。
【００２８】
図１８のアッシング後には、図１９に示すように、ＧＢ形成領域に残った感光性レジスト６ｃをマスクにして画素電極形成領域にあるＧＢ層９をウェットエッチングまたはドライエッチングし、その後、感光性レジスト６ｃを剥離する。これにより、図２０および図２１に示すように、ＤＢおよびＧＢとなる配線とともに、ガラス基板１上に下地絶縁膜層２を介してチャネル３ａが形成された動作層３、動作層３上に活性層４を介して形成されたＤＢ層５、およびチャネル３ａ上に絶縁膜７並びに透明導電膜層８を介して形成されたＧＢ層９を有するＴＦＴ基板１０が形成される。
【００２９】
このＴＦＴ基板１０において、露出する透明導電膜層８は画素電極として機能し、その透明導電膜層８の下側にコンタクトされたＤＢ層５はＴＦＴのソース電極として機能する。チャネル３ａを挟んだもう一方のＤＢ層５はＴＦＴのドレイン電極として機能し、最上層にあるＧＢ層９はＴＦＴのゲート電極として機能する。ゲート電極とチャネル３ａとの間にある絶縁膜７はＴＦＴのゲート絶縁膜となる。
【００３０】
以上説明したように、第１の実施の形態のスタガー型のＴＦＴ基板の製造方法では、第１露光工程におけるＤＢ形成領域、ＴＦＴ形成領域並びにチャネル形成領域の露光、および第３露光工程におけるＧＢ形成領域並びに画素電極形成領域の露光を、それぞれ１枚のハーフトーンマスクを用いて行なう。すなわち、従来はＤＢ形成領域とＴＦＴ形成領域の２つの領域、チャネル形成領域、ＧＢ形成領域および画素電極形成領域の各露光をそれぞれ別個の４枚のマスクを用いて行なう必要があったのに対し、この第１の実施の形態では、２枚のハーフトーンマスクを用いて行なう。これにより、従来４回必要であった露光工程を２回に削減することができ、ＴＦＴ基板製造全体では、上記第２露光工程と合わせて、合計３回の露光工程で済むようになり、製造工程を簡略化して、その生産性を向上させることができる。また、このように露光工程を削減することにより、ＴＦＴ基板製造の歩留りを向上させ、さらに、その生産コストも削減できるようになる。
【００３１】
なお、上記第１の実施の形態のスタガー型のＴＦＴ基板の製造方法においては、１回の露光工程にのみハーフトーンマスクを用いるようにしてもよい。すなわち、ＤＢ形成領域、ＴＦＴ形成領域およびチャネル形成領域の１回の露光にのみハーフトーンマスクを用い、ＧＢ形成領域および画素電極形成領域については通常のマスクを用いてそれぞれ露光を行なうようにすることができる。また、ＧＢ形成領域および画素電極形成領域の１回の露光にのみハーフトーンマスクを用い、ＤＢ形成領域、ＴＦＴ形成領域およびチャネル形成領域については通常のマスクを用いてそれぞれ露光を行なうようにすることもできる。
【００３２】
また、上記第１の実施の形態のスタガー型のＴＦＴ基板の製造方法において、ガラス基板１はもともと絶縁性であるため、下地絶縁膜層２は必ずしも成膜する必要はない。下地絶縁膜層２を成膜しない場合には、ガラス基板１上に動作層３を成膜した後、以降上記手順に従い、ＴＦＴ基板を製造すればよい。
【００３３】
また、図８に示した上記チャネルエッチング工程においては、ＤＢ層５をエッチングした後、アッシングなどにより全ての感光性レジスト６ａを除去し、露出したＤＢ層５をマスクにして、活性層４および動作層３をエッチングするようにしてもよい。これにより、先の図７に示した上記第１アッシング工程でのアッシングによって感光性レジスト６ａが収縮することによるエッチング後のチャネル幅の設計寸法からのずれの発生を抑制することができるようになり、より精度の良いチャネルエッチングが可能になる。
【００３４】
また、図１２および図１３に示した上記第２露光工程および上記絶縁膜エッチング工程では、コンタクトホール７ａの形成と同時に、ＤＢ層５の端子となる部分および蓄積容量バスライン（ＣＢ）層の端子となる部分（共に図１２および図１３には図示せず）についても、絶縁膜７にコンタクトホールを形成するようにしてもよい。
【００３５】
ここで、ＴＦＴ基板の端子構造について説明する。図２２は第１の実施の形態のＴＦＴ基板の要部平面図、図２３は図２２のＤ−Ｄ断面図である。ただし、図２２には、便宜上、ＤＢ層下層の動作層も図示している。第１の実施の形態のＴＦＴ基板製造においては、ＤＢ層５端部に形成されるドレイン端子は、図２２および図２３に示すように、透明導電膜層８が、ＤＢ層５上に絶縁膜７に一部オーバーラップして形成された構造を有している。このドレイン端子は、ＤＢ層５上の絶縁膜７にコンタクトホールを形成して、以下の図２４から図２９に示すような構造とすることも可能である。
【００３６】
図２４はドレイン端子構造を説明するＴＦＴ基板の要部平面図、図２５は図２４のＥ−Ｅ断面図である。ただし、図２４には、便宜上、ＤＢ層下層の動作層も図示している。図２４および図２５に示すドレイン端子は、ＤＢ層５上の絶縁膜７に形成されたコンタクトホール７ｂを介して、ＤＢ層５、透明導電膜層８およびＧＢ層９が接続されている。このような構造のドレイン端子は、まず、上記の図１２および図１３における絶縁膜７のエッチング工程の際、コンタクトホール７ａの形成と同時に、ドレイン端子を形成する部分（ドレイン端子形成部分）にもコンタクトホール７ｂを形成する。そして、図１５の透明導電膜層８およびＧＢ層９の成膜工程を経て、図１６の第３露光工程でドレイン端子形成部分をＧＢ形成領域とみなして、ＧＢ形成領域と共にドレイン端子形成部分にも膜厚の厚い感光性レジスト６ｃを形成するようにする。以降は図１７から図２１に示した上記各工程と同様である。このように、ドレイン端子形成部分にもコンタクトホール７ｂを形成し、ドレイン端子のＤＢ層５を透明導電膜層８からＧＢ層９につなぎ替えた構成とすることもできる。
【００３７】
図２６は別のドレイン端子構造を説明するＴＦＴ基板の要部平面図、図２７は図２６のＦ−Ｆ断面図である。ただし、図２６には、便宜上、ＤＢ層下層の動作層も図示している。図２６および図２７に示すドレイン端子は、ＤＢ層５上の絶縁膜７に形成されたコンタクトホール７ｃを介して、ＤＢ層５と透明導電膜層８が接続されている。このような構造のドレイン端子は、まず、上記の図１２および図１３における絶縁膜７のエッチング工程の際、コンタクトホール７ａの形成と同時に、ドレイン端子形成部分にもコンタクトホール７ｃを形成する。そして、図１５の透明導電膜層８およびＧＢ層９の成膜工程を経て、図１６の第３露光工程でドレイン端子形成部分を画素電極形成領域とみなして、画素電極形成領域と共にドレイン端子形成部分にも膜厚の薄い感光性レジスト６ｃを形成するようにする。以降は図１７から図２１に示した上記各工程と同様である。このように、ドレイン端子のＤＢ層５をコンタクトホール７ｃを介して透明導電膜層８に接続するようにつなぎ替えた構成とすることもできる。
【００３８】
図２８はＣＢの端子構造を説明するＴＦＴ基板の要部平面図、図２９は図２８のＧ−Ｇ断面図である。ただし、図２８には、便宜上、ＤＢ層下層の動作層も図示している。ＴＦＴ基板にＣＢを形成する場合には、上記の図１２および図１３における絶縁膜７のエッチングの際、コンタクトホール７ａの形成と同時に、ＣＢを形成する部分（ＣＢ形成部分）にコンタクトホール７ｄを形成する。そして、図１５の透明導電膜層８およびＧＢ層９の成膜工程を経て、図１６の第３露光工程で、ＣＢの画素電極形成領域（透明導電膜層８を残す領域）は薄い膜厚で、ＣＢのＧＢ形成領域（ＧＢ層９を残す領域）は厚い膜厚で、感光性レジスト６ｃを形成するようにする。以降は図１７から図２１に示した上記各工程と同様にしてＣＢが形成される。これにより、透明導電膜層８は、コンタクトホール７ｄを介してＤＢ層５にコンタクトされるようになる。
【００３９】
このように、第１の実施の形態のＴＦＴ基板製造においては、ＴＦＴ形成と同時にドレイン端子およびＣＢの端子を形成することができ、工程数を増加させることなく、端子構造を変更することも可能である。
【００４０】
次に第２の実施の形態について説明する。
スタガー型のＴＦＴ基板の製造においては、ガラス基板と下地絶縁膜層との間に遮光膜を設けるようにすることもできる。図３０は第２の実施の形態における第１露光工程の要部断面図、図３１は第２の実施の形態における第１露光工程後のエッチング工程の要部断面図である。ただし、図３０および図３１では、図３および図６に示した要素と同一の要素については同一の符号を付し、その説明の詳細は省略する。
【００４１】
第２の実施の形態のＴＦＴ基板製造では、ガラス基板１上に各層を連続成膜する際、図３０に示すように、まず、ガラス基板１上に遮光膜２０が形成され、その上に下地絶縁膜層２、動作層３、活性層４およびＤＢ層５が連続成膜される。遮光膜２０には、例えば絶縁性樹脂材料を用いることができる。そして、第１の実施の形態と同様にして、感光性レジスト６ａを形成してハーフトーンマスクを用いた第１露光を行ない、ＤＢ形成領域およびＴＦＴ形成領域に所定の膜厚のレジストパターンを形成する。この第１露光工程後のエッチング工程では、図３１に示すように、感光性レジスト６ａのレジストパターンをマスクにして、ＤＢ層５、活性層４、動作層３、下地絶縁膜層２および遮光膜２０を、ウェットエッチングまたはドライエッチングする。以降、第１の実施の形態で述べた第１アッシング工程以降の工程と同様の工程を経て、ＴＦＴ基板を形成する。
【００４２】
これにより、形成されるＴＦＴ基板の動作層３の下には、遮光膜２０が形成されるため、ガラス基板１側から光が入射したときにその光によって動作層３に電流が流れてしまうのを防止することができるようになる。このように、遮光膜２０を有するスタガー型のＴＦＴ基板の製造においても、露光にハーフトーンマスクを用いることにより、ＴＦＴ基板製造全体の露光工程数を従来よりも削減することができる。
【００４３】
なお、この第２の実施の形態のＴＦＴ基板製造においても、その端子構造は、第１の実施の形態と同様に変更することが可能である。
次に第３の実施の形態について説明する。
【００４４】
第３の実施の形態のスタガー型のＴＦＴ基板の製造方法においては、上記第１の実施の形態のスタガー型のＴＦＴ基板の製造方法において図２，図３，図６から図９に示した工程は同じである。それ以降の工程について、以下、図３２から図４３を参照して説明する。ただし、図３２から図４３では、第１の実施の形態で述べた要素と同一の要素については同一の符号を付し、その説明の詳細は省略する。
【００４５】
図３２は絶縁膜および透明導電膜層の成膜工程の要部断面図、図３３は第３の実施の形態における第２露光工程の要部断面図、図３４は透明導電膜層および絶縁膜のエッチング工程の要部断面図、図３５はアッシング工程の要部断面図である。
【００４６】
図９に示したレジスト剥離工程後、図３２に示すように、全面に、絶縁膜７および透明導電膜層８を成膜する。続いて、図３３に示すように、透明導電膜層８上に感光性レジスト６ｂを形成し、ハーフトーンマスクを用いて第２露光を行なう。この第２露光工程では、画素電極形成領域の感光性レジスト６ｂの膜厚がその他の領域の感光性レジスト６ｂに比べて厚くなるようにする。さらに、第２露光工程では、コンタクトホール形成領域を断面テーパ状に開口したレジストパターンを形成する。次いで、図３４に示すように、感光性レジスト６ｂのレジストパターンをマスクにして、透明導電膜層８および絶縁膜７をエッチングしてコンタクトホール７ｅを形成し、図３５に示すように、感光性レジスト６ｂをアッシングする。このアッシングにより、画素電極形成領域にのみ感光性レジスト６ｂが残るようにする。
【００４７】
図３６は透明導電膜層エッチング工程の要部断面図、図３７は透明導電膜層エッチング工程後のレジスト剥離工程の要部断面図、図３８は透明導電膜層エッチング工程後のレジスト剥離工程におけるＴＦＴ基板の基本構造の要部平面図である。ただし、図３７は図３８のＨ−Ｈ断面図である。また、図３８には、便宜上、ＤＢ層下層の動作層も図示している。
【００４８】
図３５に示した感光性レジスト６ｂのアッシング後は、図３６に示すように、残っている感光性レジスト６ｂのレジストパターンをマスクにして、透明導電膜層８をエッチングし、その後、感光性レジスト６ｂを剥離する。これにより、図３７および図３８に示すように、画素電極形成領域に透明導電膜層８が形成されたＴＦＴ基板の基本構造が形成される。なお、この段階では、ＤＢ層５はコンタクトホール７ｅ内に露出し、まだＤＢ層５と透明導電膜層８とはコンタクトされていない。
【００４９】
図３９はＧＢ層成膜工程の要部断面図、図４０は第３の実施の形態における第３露光工程の要部断面図、図４１はＧＢ層およびソースパッドの形成工程の要部断面図、図４２はＧＢ層およびソースパッドの形成工程後のレジスト剥離工程の要部断面図、図４３は第３の実施の形態のＴＦＴ基板の要部平面図である。ただし、図４２は図４３のＩ−Ｉ断面図である。また、図４３には、便宜上、ＤＢ層下層の動作層も図示している。
【００５０】
画素電極形成領域に透明導電膜層８を形成した後は、図３９に示すように、全面にＧＢ層９を成膜し、その後、図４０に示すように、感光性レジスト６ｃを形成して、ＧＢ形成領域および画素電極形成領域からコンタクトホール７ｅの領域をマスクするレジストパターンを形成する。この感光性レジスト６ｃのレジストパターンをマスクにして、図４１に示すように、ＧＢ層９をエッチングする。その後、感光性レジスト６ｃを剥離して、図４２および図４３に示すＴＦＴ基板３０を形成する。これにより、チャネル３ａ上には絶縁膜７を介して形成されたＧＢ層９がＴＦＴのゲート電極として形成され、かつ、ＤＢ層５と透明導電膜層８とをコンタクトするＧＢ層９がソースパッド３１として形成される。
【００５１】
このように、第３の実施の形態のスタガー型のＴＦＴ基板の製造方法では、第１露光工程は第１の実施の形態と同じにし、第２の露光工程でハーフトーンマスクを用いて、コンタクトホール７ｅ形成用の開口と画素電極形成領域の露光を行なう。この第３の実施の形態によっても、ハーフトーンマスクを第１，第２露光工程において２回用いることで、スタガー型ＴＦＴ基板製造に要する露光工程数を削減でき、生産性向上、歩留り向上、生産コスト削減が可能になる。
【００５２】
なお、上記第３の実施の形態のスタガー型のＴＦＴ基板の製造方法においても、第１の実施の形態で述べたのと同様、ハーフトーンマスクを用いる露光工程を１回のみにすることもできる。また、この第３の実施の形態のＴＦＴ基板製造においても、その端子構造は、第１の実施の形態と同様に変更することが可能である。
【００５３】
次に第４の実施の形態について説明する。
第４の実施の形態のスタガー型のＴＦＴ基板の製造方法においては、上記第１の実施の形態のスタガー型のＴＦＴ基板の製造方法において図２，図３，図６から図１３に示した工程は同じである。それ以降の工程について、以下、図４４から図４８を参照して説明する。ただし、図４４から図４８では、第１の実施の形態で述べた要素と同一の要素については同一の符号を付し、その説明の詳細は省略する。
【００５４】
この第４の実施の形態のＴＦＴ基板は、液晶表示装置においてバックライトなどによる光の照射を要しない反射型ＴＦＴ基板であり、ＴＦＴ形成面側に、入射した光を乱反射させるための凹凸層が形成される。
【００５５】
図４４は凹凸層形成工程の要部断面図、図４５はＧＢ層成膜工程の要部断面図、図４６は第４の実施の形態における第３露光工程の要部断面図である。
図１３に示した絶縁膜７のエッチング工程後、図４４に示すように、ＧＢ形成領域およびコンタクトホール７ａ部分を除く画素電極形成領域上に、表面を凹凸状にした凹凸層４１を形成する。この凹凸層４１は、アクリル樹脂などの樹脂材料を用いて形成することができる。次いで、図４５に示すように、全面にＧＢ層９を成膜し、その後、図４６に示すように、感光性レジスト６ｃを形成して第３露光を行ない、ＧＢ形成領域および画素電極形成領域をマスクするレジストパターンを形成する。
【００５６】
図４７はＧＢ層エッチング工程の要部断面図、図４８はＧＢ層エッチング工程後のレジスト剥離工程の要部断面図である。
レジストパターンの形成後、感光性レジスト６ｃをマスクにして、図４７に示すように、ＧＢ層９をエッチングし、図４８に示すように、感光性レジスト６ｃを剥離して、反射型ＴＦＴ基板４０を形成する。このＴＦＴ基板４０において、ＧＢ形成領域にはＧＢ層９がゲート電極として形成され、画素電極形成領域にはＧＢ層９が反射膜としても機能する画素電極として形成される。
【００５７】
このように、反射型ＴＦＴ基板４０の製造においては、ハーフトーンマスクを第１露光工程で１回用いることで、スタガー型ＴＦＴ基板製造に要する露光工程数を削減することができるので、生産性向上、歩留り向上、生産コスト削減が可能になる。
【００５８】
なお、この第４の実施の形態のＴＦＴ基板製造においても、その端子構造は、第１の実施の形態と同様に変更することが可能である。
図４９は液晶表示装置の要部断面図である。
【００５９】
上記第１〜第４の実施の形態に例示した製造方法により得られるＴＦＴ基板５１は、そのＴＦＴ形成面側に配向膜が形成され、カラーフィルタ（ＣＦ）層、コモン電極および配向膜が形成されたＣＦ基板５２と貼り合わせられる。貼り合せたＴＦＴ基板５１とＣＦ基板５２との間には液晶が封入され、それらの間に挟まれた液晶層５３が形成される。そして、ＴＦＴ基板５１およびＣＦ基板５２の外面側にそれぞれ偏光フィルムが貼り付けられ、液晶表示装置５０が形成される。
【００６０】
ＴＦＴ基板５１は上記の例に従って露光工程数を削減して生産性良く製造することができ、それにより、このような構成の液晶表示装置５０を効率的に低コストで製造することができる。
【００６１】
【発明の効果】
以上説明したように本発明では、スタガー型のＴＦＴ基板の製造に、レジストに対する１回の露光によって異なる領域に異なる膜厚のレジストパターンを形成することのできるハーフトーンマスクを用いるようにした。これにより、スタガー型のＴＦＴ基板製造に要する露光工程数を削減し、生産性、歩留りを向上させ、生産コストを削減することが可能になる。
【図面の簡単な説明】
【図１】第１の実施の形態のスタガー型のＴＦＴ基板の製造方法のフローを示す図である。
【図２】連続成膜工程の要部断面図である。
【図３】第１露光工程の要部断面図である。
【図４】半透過膜を用いたハーフトーンマスクの説明図である。
【図５】多孔タイプのハーフトーンマスクの説明図である。
【図６】第１露光工程後のエッチング工程の要部断面図である。
【図７】第１アッシング工程の要部断面図である。
【図８】チャネルエッチング工程の要部断面図である。
【図９】チャネルエッチング工程後のレジスト剥離工程の要部断面図である。
【図１０】チャネルエッチング工程後のレジスト剥離工程におけるＴＦＴ基板の基本構造の要部平面図である。
【図１１】絶縁膜形成工程の要部断面図である。
【図１２】第２露光工程の要部断面図である。
【図１３】絶縁膜エッチング工程の要部断面図である。
【図１４】絶縁膜エッチング工程におけるＴＦＴ基板の基本構造の要部平面図である。
【図１５】透明導電膜層およびＧＢ層の成膜工程の要部断面図である。
【図１６】第３露光工程の要部断面図である。
【図１７】透明導電膜層およびＧＢ層のエッチング工程の要部断面図である。
【図１８】第２アッシング工程の要部断面図である。
【図１９】ＧＢ層エッチング工程の要部断面図である。
【図２０】ＧＢ層エッチング工程後のレジスト剥離工程の要部断面図である。
【図２１】ＴＦＴ基板の要部平面図である。
【図２２】第１の実施の形態のＴＦＴ基板の要部平面図である。
【図２３】図２２のＤ−Ｄ断面図である。
【図２４】ドレイン端子構造を説明するＴＦＴ基板の要部平面図である。
【図２５】図２４のＥ−Ｅ断面図である。
【図２６】別のドレイン端子構造を説明するＴＦＴ基板の要部平面図である。
【図２７】図２６のＦ−Ｆ断面図である。
【図２８】ＣＢの端子構造を説明するＴＦＴ基板の要部平面図である。
【図２９】図２８のＧ−Ｇ断面図である。
【図３０】第２の実施の形態における第１露光工程の要部断面図である。
【図３１】第２の実施の形態における第１露光工程後のエッチング工程の要部断面図である。
【図３２】絶縁膜および透明導電膜層の成膜工程の要部断面図である。
【図３３】第３の実施の形態における第２露光工程の要部断面図である。
【図３４】透明導電膜層および絶縁膜のエッチング工程の要部断面図である。
【図３５】アッシング工程の要部断面図である。
【図３６】透明導電膜層エッチング工程の要部断面図である。
【図３７】透明導電膜層エッチング工程後のレジスト剥離工程の要部断面図である。
【図３８】透明導電膜層エッチング工程後のレジスト剥離工程におけるＴＦＴ基板の基本構造の要部平面図である。
【図３９】ＧＢ層成膜工程の要部断面図である。
【図４０】第３の実施の形態における第３露光工程の要部断面図である。
【図４１】ＧＢ層およびソースパッドの形成工程の要部断面図である。
【図４２】ＧＢ層およびソースパッドの形成工程後のレジスト剥離工程の要部断面図である。
【図４３】第３の実施の形態のＴＦＴ基板の要部平面図である。
【図４４】凹凸層形成工程の要部断面図である。
【図４５】ＧＢ層成膜工程の要部断面図である。
【図４６】第４の実施の形態における第３露光工程の要部断面図である。
【図４７】ＧＢ層エッチング工程の要部断面図である。
【図４８】ＧＢ層エッチング工程後のレジスト剥離工程の要部断面図である。
【図４９】液晶表示装置の要部断面図である。
【符号の説明】
１，１０４  ガラス基板
２  下地絶縁膜層
３  動作層
３ａ  チャネル
４  活性層
５  ＤＢ層
６ａ，６ｂ，６ｃ，１０６，１０６ａ，１０６ｂ  感光性レジスト
７  絶縁膜
７ａ，７ｂ，７ｃ，７ｄ，７ｅ  コンタクトホール
８  透明導電膜層
９  ＧＢ層
１０，３０，４０  ＴＦＴ基板
２０，１０３，１０３ａ  遮光膜
３１  ソースパッド
４１  凹凸層
１００，１００ａ  ハーフトーンマスク
１０１  石英板
１０２  半透過膜
１０５  被エッチング膜
【図１】
2004281687.tif 000003
【図２】
2004281687.tif 000004
【図３】
2004281687.tif 000005
【図４】
2004281687.tif 000006
【図５】
2004281687.tif 000007
【図６】
2004281687.tif 000008
【図７】
2004281687.tif 000009
【図８】
2004281687.tif 000010
【図９】
2004281687.tif 000011
【図１０】
2004281687.tif 000012
【図１１】
2004281687.tif 000013
【図１２】
2004281687.tif 000014
【図１３】
2004281687.tif 000015
【図１４】
2004281687.tif 000016
【図１５】
2004281687.tif 000017
【図１６】
2004281687.tif 000018
【図１７】
2004281687.tif 000019
【図１８】
2004281687.tif 000020
【図１９】
2004281687.tif 000021
【図２０】
2004281687.tif 000022
【図２１】
2004281687.tif 000023
【図２２】
2004281687.tif 000024
【図２３】
2004281687.tif 000025
【図２４】
2004281687.tif 000026
【図２５】
2004281687.tif 000027
【図２６】
2004281687.tif 000028
【図２７】
2004281687.tif 000029
【図２８】
2004281687.tif 000030
【図２９】
2004281687.tif 000031
【図３０】
2004281687.tif 000032
【図３１】
2004281687.tif 000033
【図３２】
2004281687.tif 000034
【図３３】
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【図３４】
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【図３５】
2004281687.tif 000037
【図３６】
2004281687.tif 000038
【図３７】
2004281687.tif 000039
【図３８】
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【図３９】
2004281687.tif 000041
【図４０】
2004281687.tif 000042
【図４１】
2004281687.tif 000043
【図４２】
2004281687.tif 000044
【図４３】
2004281687.tif 000045
【図４４】
2004281687.tif 000046
【図４５】
2004281687.tif 000047
【図４６】
2004281687.tif 000048
【図４７】
2004281687.tif 000049
【図４８】
2004281687.tif 000050
【図４９】
2004281687.tif 000051
【手続補正書】
【提出日】平成16年1月22日(2004.1.22)
【手続補正２】
【補正対象書類名】明細書
【補正対象項目名】特許請求の範囲
【補正方法】変更
【補正の内容】
【特許請求の範囲】
【請求項１】
スタガー型の薄膜トランジスタ基板の製造方法において、
ハーフトーンマスクを用いて、レジストに対する１回の露光により、異なる領域に異なる膜厚のレジストパターンを形成する工程を有することを特徴とする薄膜トランジスタ基板の製造方法。
【請求項２】
前記薄膜トランジスタ基板のドレインバスラインを形成するドレインバスライン形成領域と前記薄膜トランジスタ基板の薄膜トランジスタを形成する薄膜トランジスタ形成領域をマスクするレジストパターンを形成する際に、前記ハーフトーンマスクを用いて、レジストに対する１回の露光により、前記薄膜トランジスタ形成領域内の前記薄膜トランジスタのチャネルを形成するチャネル形成領域と、前記ドレインバスライン形成領域および前記薄膜トランジスタ形成領域内の前記チャネル形成領域以外の領域とに、レジストの膜厚が異なるレジストパターンを形成することを特徴とする請求項１記載の薄膜トランジスタ基板の製造方法。
【請求項３】
前記薄膜トランジスタ基板のゲートバスラインを形成するゲートバスライン形成領域と前記薄膜トランジスタ基板の画素電極を形成する画素電極形成領域をマスクするレジストパターンを形成する際に、前記ハーフトーンマスクを用いて、レジストに対する１回の露光により、前記ゲートバスライン形成領域と前記画素電極形成領域とにレジストの膜厚が異なるレジストパターンを形成することを特徴とする請求項１記載の薄膜トランジスタ基板の製造方法。
【請求項４】
スタガー型の薄膜トランジスタ基板の製造方法において、
基板上に動作層を介して形成されたドレインバスライン層上にレジストを形成する工程と、
ハーフトーンマスクを用いて前記レジストを露光し、薄膜トランジスタ基板のドレインバスラインを形成するドレインバスライン形成領域と前記薄膜トランジスタ基板の薄膜トランジスタを形成する薄膜トランジスタ形成領域とに、前記薄膜トランジスタのチャネルを形成するチャネル形成領域のみ膜厚をより薄くしたレジストパターンを形成する工程と、
前記レジストパターンを用いて前記ドレインバスライン層をエッチングする工程と、
前記チャネル形成領域の薄く形成されたレジストが除去されるまで前記レジストパターンをアッシングする工程と、
アッシング後に残る前記レジストパターンを用いて前記動作層をチャネルエッチングする工程と、
を有することを特徴とする薄膜トランジスタ基板の製造方法。
【請求項５】
前記基板上に前記動作層を介して形成された前記ドレインバスライン層上に前記レジストを形成する工程においては、前記基板と前記動作層との間に遮光膜を設け、前記動作層を介して形成された前記ドレインバスライン層上に前記レジストを形成することを特徴とする請求項４記載の薄膜トランジスタ基板の製造方法。
【請求項６】
アッシング後に残る前記レジストパターンを用いて前記動作層をチャネルエッチングする工程の後に、
アッシング後に残る前記レジストパターンを除去し、全面に絶縁膜を形成して前記絶縁膜に前記ドレインバスライン層に達するコンタクトホールを形成する工程と、
前記薄膜トランジスタ基板のゲートバスラインを形成するゲートバスライン形成領域と前記コンタクトホールが形成された領域とを除き、入射する光を散乱させる凹凸層を形成する工程と、
ゲートバスライン層を形成し、前記ゲートバスライン層上に、前記ゲートバスライン形成領域と前記薄膜トランジスタ基板の画素電極を形成する画素電極形成領域とをマスクするレジストパターンを形成する工程と、
前記レジストパターンを用いて前記ゲートバスライン層をエッチングする工程と、
を有することを特徴とする請求項４記載の薄膜トランジスタ基板の製造方法。
【請求項７】
スタガー型の薄膜トランジスタ基板の製造方法において、
基板上に動作層を介してドレインバスライン層を形成し、エッチングにより、薄膜トランジスタ基板のドレインバスラインを形成し、前記動作層に前記薄膜トランジスタ基板の薄膜トランジスタのチャネルとなる部分を形成する工程と、
絶縁膜を形成して前記絶縁膜に前記ドレインバスライン層に達するコンタクトホールを形成する工程と、
前記コンタクトホールが形成された前記絶縁膜上に透明導電膜層とゲートバスライン層とを積層形成し、前記ゲートバスライン層上に、ハーフトーンマスクを用いて、前記薄膜トランジスタ基板のゲートバスラインを形成するゲートバスライン形成領域と前記薄膜トランジスタ基板の画素電極を形成する画素電極形成領域とに、前記画素電極形成領域のレジストの膜厚が前記ゲートバスライン形成領域のレジストの膜厚より薄いレジストパターンを形成する工程と、
前記レジストパターンを用いて前記ゲートバスライン層と前記透明導電膜層とをエッチングする工程と、
前記画素電極形成領域の薄く形成されたレジストが除去されるまで前記レジストパターンをアッシングする工程と、
アッシング後に残る前記レジストパターンを用いて前記画素電極形成領域の前記ゲートバスライン層をエッチングする工程と、
を有することを特徴とする薄膜トランジスタ基板の製造方法。
【請求項８】
前記基板上に前記動作層を介して前記ドレインバスライン層を形成し、前記薄膜トランジスタ基板の前記ドレインバスラインを形成し、前記動作層に前記薄膜トランジスタ基板の前記薄膜トランジスタの前記チャネルとなる部分を形成する工程においては、前記基板と前記動作層との間に遮光膜を設け、前記動作層を介して前記ドレインバスライン層を形成し、前記薄膜トランジスタ基板の前記ドレインバスラインを形成し、前記動作層に前記薄膜トランジスタ基板の前記薄膜トランジスタの前記チャネルとなる部分を形成することを特徴とする請求項７記載の薄膜トランジスタ基板の製造方法。
【請求項９】
前記絶縁膜を形成して前記絶縁膜に前記ドレインバスライン層に達する前記コンタクトホールを形成する工程においては、前記ドレインバスライン層と前記透明導電膜層とをコンタクトするためのコンタクトホールと前記薄膜トランジスタ基板の端子のコンタクトホールとを形成することを特徴とする請求項７記載の薄膜トランジスタ基板の製造方法。
【請求項１０】
スタガー型の薄膜トランジスタ基板の製造方法において、
基板上に動作層を介してドレインバスライン層を形成し、エッチングにより、薄膜トランジスタ基板のドレインバスラインを形成し、前記動作層に前記薄膜トランジスタ基板の薄膜トランジスタのチャネルとなる部分を形成する工程と、
絶縁膜と透明導電膜層とを積層形成する工程と、
前記透明導電膜層上に、ハーフトーンマスクを用いて、前記絶縁膜に形成するコンタクトホールの領域が開口され前記薄膜トランジスタ基板の画素電極を形成する画素電極形成領域のみレジストの膜厚をより厚くしたレジストパターンを形成する工程と、
前記レジストパターンを用いて前記絶縁膜と前記透明導電膜層とをエッチングして前記コンタクトホールを形成する工程と、
前記画素電極形成領域以外の領域の薄く形成されたレジストが除去されるまで前記レジストパターンをアッシングする工程と、
アッシング後に残る前記レジストパターンを用いて前記透明導電膜層をエッチングする工程と、
を有することを特徴とする薄膜トランジスタ基板の製造方法。
【請求項１１】
スタガー型の薄膜トランジスタ基板において、
薄膜トランジスタのソースおよびドレインは、下層側から順にシリコン半導体層と不純物を含むシリコン半導体層と金属層とが積層された構造を有し、前記ソースおよび前記ドレイン上に前記薄膜トランジスタのゲート絶縁膜が形成されていることを特徴とする薄膜トランジスタ基板。
【請求項１２】
前記ソース上の前記ゲート絶縁膜に開口されたコンタクトホールを介して、前記ソースに画素電極が接続されていることを特徴とする請求項１１記載の薄膜トランジスタ基板。
【請求項１３】
前記薄膜トランジスタのゲート電極は、前記ゲート絶縁膜上に電極材料を２層積層して形成され、前記ソースに接続される前記画素電極は、前記ゲート電極を構成する２層の電極材料のうちの下層の電極材料により形成されていることを特徴とする請求項１２記載の薄膜トランジスタ基板。
【請求項１４】
前記下層の電極材料は、透明導電膜であることを特徴とする請求項１３記載の薄膜トランジスタ基板。
【手続補正３】
【補正対象書類名】明細書
【補正対象項目名】０００１
【補正方法】変更
【補正の内容】
【０００１】
【発明の属する技術分野】
本発明は薄膜トランジスタ（Thin Film Transistor，ＴＦＴ）基板の製造方法およびＴＦＴ基板に関し、特に複数種のマスクを用いた複数回の露光工程を経て製造されるスタガー型のＴＦＴ基板の製造方法およびＴＦＴ基板に関する。


【手続補正４】
【補正対象書類名】明細書
【補正対象項目名】０００３
【補正方法】変更
【補正の内容】
【０００３】
現在、ＴＦＴ基板の製造は、主に逆スタガー型と呼ばれる方式で行なわれており、複数枚のマスクを用いて複数回の露光工程を経て形成される。その場合、ＴＦＴ基板に形成すべきゲートバスライン層、動作アイランド層、ドレインバスライン層、保護膜層、画素電極層といった少なくとも５枚のマスクを用いてＴＦＴ基板の製造が行なわれている。すなわち、逆スタガー型のＴＦＴ基板製造には、露光工程だけでも５工程必要であった。そのため、このような逆スタガー型のＴＦＴ基板製造においては、その生産性向上のため、ハーフトーンマスクを用いて露光プロセスを３回に削減する方法などが提案されている（例えば特許文献１参照）。


【手続補正５】
【補正対象書類名】明細書
【補正対象項目名】０００７
【補正方法】変更
【補正の内容】
【０００７】
本発明はこのような点に鑑みてなされたものであり、ＴＦＴ基板製造に要する露光工程数を削減し、生産性の良い高品質のスタガー型のＴＦＴ基板の製造方法およびＴＦＴ基板を提供することを目的とする。


【手続補正６】
【補正対象書類名】明細書
【補正対象項目名】００３０
【補正方法】変更
【補正の内容】
【００３０】
以上説明したように、第１の実施の形態のスタガー型のＴＦＴ基板の製造方法では、第１露光工程におけるＤＢ形成領域、ＴＦＴ形成領域並びにチャネル形成領域の露光、および第３露光工程におけるＧＢ形成領域並びに画素電極形成領域の露光を、それぞれ１枚のハーフトーンマスクを用いて行なう。すなわち、従来はＤＢ形成領域とＴＦＴ形成領域の２つの領域、チャネル形成領域、ＧＢ形成領域および画素電極形成領域の各露光をそれぞれ別個の４枚のマスクを用いて行なう必要があったのに対し、この第１の実施の形態では、２枚のハーフトーンマスクを用いて行なう。これにより、従来４回必要であった露光工程を２回に削減することができ、ＴＦＴ基板製造全体では、上記第２露光工程と合わせて、合計３回の露光工程で済むようになり、製造工程を簡略化して、その生産性を向上させることができる。また、このように露光工程を削減することにより、ＴＦＴ基板製造の歩留りを向上させ、さらに、その生産コストも削減できるようになる。表示欠陥のない高品質のスタガー型のＴＦＴ基板が製造可能になる。
【手続補正７】
【補正対象書類名】明細書
【補正対象項目名】００６１
【補正方法】変更
【補正の内容】
【００６１】
【発明の効果】
以上説明したように本発明では、スタガー型のＴＦＴ基板の製造に、レジストに対する１回の露光によって異なる領域に異なる膜厚のレジストパターンを形成することのできるハーフトーンマスクを用いるようにした。これにより、スタガー型のＴＦＴ基板製造に要する露光工程数を削減し、生産性、歩留りを向上させ、生産コストを削減することが可能になる。表示欠陥のない高品質のスタガー型のＴＦＴ基板が製造可能になる。