(57)【要約】【課題】表示画素に供給される階調電流が微小な場合であっても、該階調電流を生成する動作を迅速に実行することができるとともに、表示データに対応した適切な電流値の階調電流を出力することができる電流生成供給回路及び該電流生成供給回路を備えた表示装置を提供する。【解決手段】電流生成供給回路ＩＬＡは、複数ビットのデジタル信号ｄ０〜ｄ３を個別に取り込んで保持するラッチ回路ＬＣ０〜ＬＣ３を備えたデータラッチ部１０と、マルチゲート構造を有する電界効果型トランジスタからなる基準電流トランジスタ及び単位電流トランジスタを適用したカレントミラー回路部２１Ａを備え、上記データラッチ部１０から出力される出力信号ｄ１０＊〜ｄ１３＊に基づいて、基準電流Ｉｒｅｆに対して所定比率の電流値を有する負荷駆動電流ＩＤを生成して負荷ＬＤに出力する電流生成部２０Ａと、を有している。【選択図】  図１
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【特許請求の範囲】
【請求項１】
負荷に電流を供給して駆動する電流生成供給回路において、
複数ビットのデジタル信号を保持する信号保持手段と、
定電流源から供給される基準電流に基づいて、前記デジタル信号の各ビットに対応する複数の単位電流を生成し、前記信号保持手段に保持された前記デジタル信号の各ビット値に応じて、前記単位電流の各々を選択的に合成し、負荷駆動電流として前記負荷に供給する電流生成手段と、
を備え、
前記電流生成手段は、前記基準電流が流れる基準電流トランジスタと、前記各単位電流が流れる複数の単位電流トランジスタと、を具備し、前記基準電流トランジスタ及び前記複数の単位電流トランジスタのうち、少なくとも、いずれか一つが、複数の電界効果型トランジスタを直列に接続した構成を有していることを特徴とする電流生成供給回路。
【請求項２】
前記電流生成手段において、前記基準電流トランジスタと前記複数の単位電流トランジスタとは、カレントミラー回路を構成していることを特徴とする請求項１記載の電流生成供給回路。
【請求項３】
前記基準電流トランジスタ又は前記複数の単位電流トランジスタを構成する前記複数の電界効果型トランジスタは、各々、電流路が直列に接続されるとともに、制御端子が共通に接続されていることを特徴とする請求項１又は２記載の電流生成供給回路。
【請求項４】
前記電流生成手段は、各々、前記基準電流トランジスタ及び前記複数の単位電流トランジスタを具備した複数のカレントミラー回路が多段接続された構成を有し、該複数のカレントミラー回路の前記基準電流トランジスタ又は前記複数の単位電流トランジスタを構成する前記電界効果型トランジスタの電流路が、各々直列に接続されていることを特徴とする請求項１又は２記載の電流生成供給回路。
【請求項５】
前記電流生成手段は、前記複数の単位電流が、前記複数ビットのデジタル信号の各々に対応して、前記基準電流に対して各々異なる比率の電流値を有するように設定されていることを特徴とする請求項１乃至４のいずれかに記載の電流生成供給回路。
【請求項６】
前記複数の単位電流トランジスタは、トランジスタサイズが各々異なるように形成されていることを特徴とする請求項５記載の電流生成供給回路。
【請求項７】
前記複数の単位電流トランジスタは、該各単位電流トランジスタの各チャネル幅が、互いに２ｋ（ｋ＝０、１、２、３、・・・）で規定される、異なる比率に設定されていることを特徴とする請求項６記載の電流生成供給回路。
【請求項８】
前記電流生成手段は、前記負荷駆動電流の信号極性を、前記負荷側から引き込む方向に流すように設定することを特徴とする請求項１乃至７のいずれかに記載の電流生成供給回路。
【請求項９】
前記電流生成手段は、前記負荷駆動電流の信号極性を、前記負荷に流し込む方向に流すように設定することを特徴とする請求項１乃至７のいずれかに記載の電流生成供給回路。
【請求項１０】
前記負荷は、前記電流生成手段から供給される前記負荷駆動電流の電流値に応じて、所定の輝度階調で発光動作する電流駆動型の発光素子を備えていることを特徴とする請求項１乃至９のいずれかに記載の電流生成供給回路。
【請求項１１】
前記発光素子は、有機エレクトロルミネッセント素子であることを特徴とする請求項１０記載の電流生成供給回路。
【請求項１２】
少なくとも、複数の走査線及び複数の信号線が相互に直交するように配設され、該走査線及び該信号線の交点に複数の表示画素がマトリクス状に配列された表示パネルと、前記各表示画素を行単位で選択状態にするための走査信号を前記各走査線に印加する走査駆動手段と、表示信号に基づく階調電流を、前記各信号線を介して前記各表示画素に供給する信号駆動手段と、を備え、選択状態にある前記表示画素に対して、所定の電流値を有する前記階調電流を供給することにより、前記表示パネルに所望の画像情報を表示する表示装置において、
前記信号駆動手段は、前記複数の信号線の各々に対応して、少なくとも、前記表示信号に基づく複数ビットのデジタル信号を保持する信号保持手段と、定電流源から供給される基準電流に基づいて、前記デジタル信号の各ビットに対応する複数の単位電流を生成し、前記信号保持手段に保持された前記デジタル信号の各ビット値に応じて、前記単位電流の各々を選択的に合成し、前記階調電流として前記表示画素に供給する電流生成手段と、を備えた電流生成供給回路を複数具備し、
前記電流生成手段は、前記基準電流が流れる基準電流トランジスタと、前記各単位電流が流れる複数の単位電流トランジスタと、を具備し、前記基準電流トランジスタ及び前記複数の単位電流トランジスタのうち、少なくとも、いずれか一つが、複数の電界効果型トランジスタを直列に接続した構成を有していることを特徴とする表示装置。
【請求項１３】
前記電流生成手段において、前記基準電流トランジスタと前記複数の単位電流トランジスタとは、カレントミラー回路を構成していることを特徴とする請求項１２記載の表示装置。
【請求項１４】
前記基準電流トランジスタ又は前記複数の単位電流トランジスタを構成する前記複数の電界効果型トランジスタは、各々、電流路が直列に接続されるとともに、制御端子が共通に接続されていることを特徴とする請求項１２又は１３記載の表示装置。
【請求項１５】
前記電流生成手段は、各々、前記基準電流トランジスタ及び前記複数の単位電流トランジスタを具備した複数のカレントミラー回路が多段接続された構成を有し、該複数のカレントミラー回路の前記基準電流トランジスタ又は前記複数の単位電流トランジスタを構成する前記電界効果型トランジスタの電流路が、各々直列に接続されていることを特徴とする請求項１２又は１３記載の表示装置。
【請求項１６】
前記電流生成手段は、前記複数の単位電流が、前記複数ビットのデジタル信号の各々に対応して、前記基準電流に対して各々異なる比率の電流値を有するように設定されていることを特徴とする請求項１２乃至１５のいずれかに記載の表示装置。
【請求項１７】
前記複数の単位電流トランジスタは、トランジスタサイズが各々異なるように形成されていることを特徴とする請求項１６記載の表示装置。
【請求項１８】
前記複数の単位電流トランジスタは、該各単位電流トランジスタの各チャネル幅が、互いに２ｋ（ｋ＝０、１、２、３、・・・）で規定される、異なる比率に設定されていることを特徴とする請求項１７記載の表示装置。
【請求項１９】
前記電流生成手段は、前記階調電流の信号極性を、前記表示画素側から引き込む方向に流すように設定することを特徴とする請求項１２乃至１８のいずれかに記載の表示装置。
【請求項２０】
前記電流生成手段は、前記階調電流の信号極性を、前記表示画素に流し込む方向に流すように設定することを特徴とする請求項１２乃至１８のいずれかに記載の表示装置。
【請求項２１】
前記複数の信号線に対応して設けられる前記複数の電流生成供給回路は、前記定電流源に接続された電流供給線に並列に接続され、
該各電流生成供給回路は、当該電流生成供給回路への前記基準電流の供給状態を制御するスイッチ手段を備え、
前記スイッチ手段を所定のタイミングで選択的に切換制御することにより、複数の前記電流生成供給回路のうち、唯一の前記電流生成供給回路に対してのみ、前記基準電流が供給されることを特徴とする請求項１２乃至２０のいずれかに記載の表示装置。
【請求項２２】
前記スイッチ手段の切換制御は、前記各電流生成供給回路の前記信号保持手段に前記デジタル信号を取り込み保持する際のタイミングに同期して行われることを特徴とする請求項２１記載の表示装置。
【請求項２３】
前記表示画素は、前記電流生成供給回路から供給される前記階調電流の電流値に応じて、所定の輝度階調で発光動作する電流駆動型の発光素子を備えていることを特徴とする請求項１２乃至２２のいずれかに記載の表示装置。
【請求項２４】
前記発光素子は、有機エレクトロルミネッセント素子からなる発光素子であることを特徴とする請求項２３記載の表示装置。
【発明の詳細な説明】
【０００１】
【発明の属する技術分野】
本発明は、電流生成供給回路及び該電流生成供給回路を備えた表示装置に関し、特に、画像表示信号（表示データ）に応じた電流を供給することにより所定の輝度階調で発光動作する電流駆動型（又は、電流指定型）の発光素子を備えた表示パネルに適用可能な電流生成供給回路及び該電流生成供給回路を備えた表示装置に関する。
【０００２】
【従来の技術】
近年、パーソナルコンピュータや映像機器のモニタやディスプレイとして、液晶表示装置（ＬＣＤ）等の陰極線管（ＣＲＴ）に替わる表示装置や表示デバイスの普及が著しい。特に、液晶表示装置は、旧来の表示装置（ＣＲＴ）に比較して、薄型軽量化、省スペース化、低消費電力化等が可能であるため、急速に普及している。また、比較的小型の液晶表示装置は、近年普及が著しい携帯電話やデジタルカメラ、携帯情報端末（ＰＤＡ）等の表示デバイスとしても広く適用されている。
【０００３】
このような液晶表示装置に続く次世代の表示デバイス（ディスプレイ）として、有機エレクトロルミネッセンス素子（以下、「有機ＥＬ素子」と略記する）や無機エレクトロルミネッセンス素子（以下、「無機ＥＬ素子」と略記する）、あるいは、発光ダイオード（ＬＥＤ）等のような自己発光型の光学要素（発光素子）を、マトリクス状に配列した表示パネルを備えた発光素子型のディスプレイ（表示装置）の本格的な実用化が期待されている。
【０００４】
このような発光素子型ディスプレイ（特に、アクティブマトリックス駆動方式を適用した発光素子型ディスプレイ）においては、液晶表示装置に比較して、表示応答速度が速く、視野角依存性もなく、また、高輝度・高コントラスト化、表示画質の高精細化、低消費電力化等が可能であるとともに、液晶表示装置のようにバックライトを必要としないので、一層の薄型軽量化が可能であるという極めて優位な特徴を有している。
【０００５】
このようなディスプレイの一例は、概略、行方向に配設された走査ラインと列方向に配設されたデータラインの各交点近傍に発光素子を含む表示画素が配列された表示パネルと、画像表示信号（表示データ）に応じた階調電流を生成して、データラインを介して各表示画素に供給するデータドライバと、所定のタイミングで走査信号を順次印加して特定の行の表示画素を選択状態にする走査ドライバと、を備え、各表示画素に供給された上記階調電流により、各発光素子が表示データに応じた所定の輝度階調で発光動作して、所望の画像情報が表示パネルに表示される。なお、発光素子型のディスプレイの具体例については、後述する発明の実施の形態において、詳しく説明する。
【０００６】
ここで、上記ディスプレイにおける表示駆動動作としては、複数の表示画素（発光素子）に対して、データドライバにより表示データに応じた電流値を有する個別の階調電流を生成し、走査ドライバにより選択された特定の行の表示画素に供給して、各発光素子を所定の輝度階調で発光させる動作を、１画面分の各行について順次繰り返す電流指定型の駆動方式や、走査ドライバにより選択された特定の行の表示画素に対して、データドライバにより一定の電流値の駆動電流を、表示データに応じた個別の時間幅（信号幅）で供給して、各発光素子を所定の輝度階調で発光させる動作を、１画面分順次繰り返すパルス幅変調（ＰＷＭ）型の駆動方式等が知られている。
【０００７】
このようなディスプレイに適用されるデータドライバの具体的な構成としては、例えば、図２１に示すように、電流路の一端側（エミッタ）が電源端子ＴＭｐに接続されるとともに、電流路の他端側（コレクタ）が基準電流入力端子ＴＭｒに接続されたトランジスタＴＰｒと、電流路の一端側（エミッタ）が共通電源ラインＬｐを介して上記電源端子ＴＭｐに共通に接続されるとともに、電流路の他端側（コレクタ）が個別の出力端子ＯＵＴ１、ＯＵＴ２、・・・ＯＵＴｍに接続され、かつ、各制御端子（ベース）が上記トランジスタＴＰｒの制御端子（ベース）に並列的に接続された複数のトランジスタＴＰ１、ＴＰ２、・・・ＴＰｍからなるカレントミラー回路を基本構成として備えた定電流駆動回路を良好に適用することができる。
【０００８】
このようなデータドライバにおいては、トランジスタＴＰｒに流れる基準電流Ｉｒに応じて、複数のトランジスタＴＰ１、ＴＰ２、・・・ＴＰｍに流れる一定の電流値を有する駆動電流ＩＰ１、ＩＰ２、・・・ＩＰｍを個別の出力端子ＯＵＴ１、ＯＵＴ２、・・・ＯＵＴｍを介して（もしくは、図示を省略した出力回路をさらに介して）、図示を省略した表示パネルを構成する複数の表示画素に一括して供給することにより、表示画素（発光素子）を発光動作させることができる。なお、図２１に示したようなデータドライバ（定電流駆動回路）については、例えば、特許文献１等に、その基本構成や、出力電流間のバラツキを改善した構成が記載されている。
【０００９】
また、データドライバの他の構成としては、例えば、図２２に示すように、表示データに応じた電流値を有する電流を生成、出力する電流源ＰＩに共通の電流供給ラインＬｉを介して接続された複数のラッチ回路ＬＴ１、ＬＴ２、・・・ＬＴｍと、該ラッチ回路ＬＴ１、ＬＴ２、・・・ＬＴｍごとに設けられた出力回路ＤＯ１、ＤＯ２、・・・ＤＯｍとを備えたものを良好に適用することができる。
【００１０】
このようなデータドライバにおいては、電流源ＰＩから出力される表示データに応じた電流Ｉｄｔを、時系列的に入力されるラッチ制御信号ＳＬ１、ＳＬ２、・・・ＳＬｍに基づいて、ラッチ回路ＬＴ１、ＬＴ２、・・・ＬＴｍに順次保持し、所定のタイミングで入力される出力イネーブル信号Ｓｅｎに基づいて、出力回路ＤＯ１、ＤＯ２、・・・ＤＯｍから個別の出力端子ＯＵＴ１、ＯＵＴ２、・・・ＯＵＴｍを介して、各ラッチ回路ＬＴ１、ＬＴ２、・・・ＬＴｍに保持された電流Ｉｄｔに基づく駆動電流ＩＤ１、ＩＤ２、・・・ＩＤｍを、表示パネルを構成する複数の表示画素に一括して供給する。ここで、図２２においては、複数のラッチ回路及び出力回路からなる構成を一組のみ示したが、このような構成を二組設けて、一方のラッチ回路群に電流を順次保持している期間に、他方のラッチ回路群に保持された電流を出力するようにした構成を適用するものであってもよい。
【００１１】
なお、図２１、図２２に示した従来技術においては、データドライバにより生成された駆動電流をデータドライバ側から表示パネル（表示画素）側に、流し込む方向に供給する場合について説明したが、上記特許文献１にも示されているように、データドライバにより生成された駆動電流を表示パネル（表示画素）側からデータドライバ側に、引き込む方向に供給するものも知られている。
【００１２】
【特許文献１】
特開２００２−２０２８２３号公報  （第３頁、図２、図１５）
【００１３】
【発明が解決しようとする課題】
しかしながら、上述したような発光素子型ディスプレイにおいては、以下に示すような問題を有していた。
すなわち、データドライバにより表示データに応じた駆動電流を表示画素ごとに生成し、出力端子に接続された各データラインを介して、特定行の各表示画素に一括して供給する従来の構成及び駆動制御方法においては、上記駆動電流が、表示データに対応して変化するとともに、各表示画素（データライン）に対応してデータドライバに個別に設けられたトランジスタやラッチ回路等の回路構成に、電流源から共通の電流供給ラインを介して供給される電流も変化することになる。
【００１４】
一般に、信号配線には寄生容量（配線容量）が存在するため、上述したようなデータラインや電流供給ラインを介して所定の電流を供給する動作は、当該信号配線（データライン、電流供給ライン）に存在する寄生容量を所定の電位まで充電、あるいは、放電することに相当する。そのため、データラインや電流供給ラインを介して供給される電流が微小である場合には、データラインや電流供給ラインへの充放電動作に時間を要し、当該信号ラインの電位が安定するまでに（ある程度の）時間を要することになる。
【００１５】
一方、データドライバにおける動作は、データライン数（すなわち、表示画素数）が増加するほど、各データラインにおける電流の保持動作等に割り当てられる動作期間が短くなって高速な動作を要求されるが、上述したようにデータラインや電流供給ラインへの充放電動作に所定の時間を要するため、この充放電動作の速度に起因してデータドライバの動作速度が律速されてしまうという問題を有していた。
すなわち、表示パネルの小型化や高精細化（高解像度化）等に伴って、データラインを介して供給される駆動電流の電流値が小さくなるほど、データドライバの動作速度が制約されることになり、良好な画像表示動作を実現することが困難になるという問題を有していた。
【００１６】
そこで、本発明は、上述した課題に鑑み、発光素子を電流指定方式で発光制御するディスプレイにおいて、表示画素に供給される階調電流が微小な場合であっても、該階調電流を生成する動作を迅速に実行することができるとともに、表示データに対応した適切な電流値の階調電流を出力することができる電流生成供給回路及びその制御方法を提供し、以て、表示応答特性及び表示画質の向上を図ることができる表示装置を提供することを目的とする。
【００１７】
【課題を解決するための手段】
請求項１記載の電流生成供給回路は、負荷に電流を供給して駆動する電流生成供給回路において、複数ビットのデジタル信号を保持する信号保持手段と、定電流源から供給される基準電流に基づいて、前記デジタル信号の各ビットに対応する複数の単位電流を生成し、前記信号保持手段に保持された前記デジタル信号の各ビット値に応じて、前記単位電流の各々を選択的に合成し、負荷駆動電流として前記負荷に供給する電流生成手段と、を備え、前記電流生成手段は、前記基準電流が流れる基準電流トランジスタと、前記各単位電流が流れる複数の単位電流トランジスタと、を具備し、前記基準電流トランジスタ及び前記複数の単位電流トランジスタのうち、少なくとも、いずれか一つが、複数の電界効果型トランジスタを直列に接続した構成を有していることを特徴とする電流生成供給回路。
【００１８】
請求項２記載の電流生成供給回路は、請求項１記載の電流生成供給回路において、前記電流生成手段において、前記基準電流トランジスタと前記複数の単位電流トランジスタとは、カレントミラー回路を構成していることを特徴とする。
請求項３記載の電流生成供給回路は、請求項１又は２記載の電流生成供給回路において、前記基準電流トランジスタ又は前記複数の単位電流トランジスタを構成する前記複数の電界効果型トランジスタは、各々、電流路が直列に接続されるとともに、制御端子が共通に接続されていることを特徴とする。
請求項４記載の電流生成供給回路は、請求項１又は２記載の電流生成供給回路において、前記電流生成手段は、各々、前記基準電流トランジスタ及び前記複数の単位電流トランジスタを具備した複数のカレントミラー回路が多段接続された構成を有し、該複数のカレントミラー回路の前記基準電流トランジスタ又は前記複数の単位電流トランジスタを構成する前記電界効果型トランジスタの電流路が、各々直列に接続されていることを特徴とする。
【００１９】
請求項５記載の電流生成供給回路は、請求項１乃至４のいずれかに記載の電流生成供給回路において、前記電流生成手段は、前記複数の単位電流が、前記複数ビットのデジタル信号の各々に対応して、前記基準電流に対して各々異なる比率の電流値を有するように設定されていることを特徴とする。
請求項６記載の電流生成供給回路は、請求項５記載の電流生成供給回路において、前記複数の単位電流トランジスタは、トランジスタサイズが各々異なるように形成されていることを特徴とする。
【００２０】
請求項７記載の電流生成供給回路は、請求項６記載の電流生成供給回路において、前記複数の単位電流トランジスタは、該各単位電流トランジスタの各チャネル幅が、互いに２ｋ（ｋ＝０、１、２、３、・・・）で規定される、異なる比率に設定されていることを特徴とする。
請求項８記載の電流生成供給回路は、請求項１乃至７のいずれかに記載の電流生成供給回路において、前記電流生成手段は、前記負荷駆動電流の信号極性を、前記負荷側から引き込む方向に流すように設定することを特徴とする。
【００２１】
請求項９記載の電流生成供給回路は、請求項１乃至７のいずれかに記載の電流生成供給回路において、前記電流生成手段は、前記負荷駆動電流の信号極性を、前記負荷に流し込む方向に流すように設定することを特徴とする。
【００２２】
請求項１０記載の電流生成供給回路は、請求項１乃至９のいずれかに記載の電流生成供給回路において、前記負荷は、前記電流生成手段から供給される前記負荷駆動電流の電流値に応じて、所定の輝度階調で発光動作する電流駆動型の発光素子を備えていることを特徴とする。
請求項１１記載の電流生成供給回路は、請求項１０記載の電流生成供給回路において、前記発光素子は、有機エレクトロルミネッセント素子であることを特徴とする。
【００２３】
請求項１２記載の表示装置は、少なくとも、複数の走査線及び複数の信号線が相互に直交するように配設され、該走査線及び該信号線の交点に複数の表示画素がマトリクス状に配列された表示パネルと、前記各表示画素を行単位で選択状態にするための走査信号を前記各走査線に印加する走査駆動手段と、表示信号に基づく階調電流を、前記各信号線を介して前記各表示画素に供給する信号駆動手段と、を備え、選択状態にある前記表示画素に対して、所定の電流値を有する前記階調電流を供給することにより、前記表示パネルに所望の画像情報を表示する表示装置において、前記信号駆動手段は、前記複数の信号線の各々に対応して、少なくとも、前記表示信号に基づく複数ビットのデジタル信号を保持する信号保持手段と、定電流源から供給される基準電流に基づいて、前記デジタル信号の各ビットに対応する複数の単位電流を生成し、前記信号保持手段に保持された前記デジタル信号の各ビット値に応じて、前記単位電流の各々を選択的に合成し、前記階調電流として前記表示画素に供給する電流生成手段と、を備えた電流生成供給回路を複数具備し、前記電流生成手段は、前記基準電流が流れる基準電流トランジスタと、前記各単位電流が流れる複数の単位電流トランジスタと、を具備し、前記基準電流トランジスタ及び前記複数の単位電流トランジスタのうち、少なくとも、いずれか一つが、複数の電界効果型トランジスタを直列に接続した構成を有していることを特徴とする表示装置。
【００２４】
請求項１３記載の表示装置は、請求項１２記載の表示装置において、前記電流生成手段において、前記基準電流トランジスタと前記複数の単位電流トランジスタとは、カレントミラー回路を構成していることを特徴とする。
請求項１４記載の表示装置は、請求項１２又は１３記載の表示装置において、前記基準電流トランジスタ又は前記複数の単位電流トランジスタを構成する前記複数の電界効果型トランジスタは、各々、電流路が直列に接続されるとともに、制御端子が共通に接続されていることを特徴とする。
請求項１５記載の表示装置は、請求項１２又は１３記載の表示装置において、前記電流生成手段は、各々、前記基準電流トランジスタ及び前記複数の単位電流トランジスタを具備した複数のカレントミラー回路が多段接続された構成を有し、該複数のカレントミラー回路の前記基準電流トランジスタ又は前記複数の単位電流トランジスタを構成する前記電界効果型トランジスタの電流路が、各々直列に接続されていることを特徴とする。
【００２５】
請求項１６記載の表示装置は、請求項１２乃至１５のいずれかに記載の表示装置において、前記電流生成手段は、前記複数の単位電流が、前記複数ビットのデジタル信号の各々に対応して、前記基準電流に対して各々異なる比率の電流値を有するように設定されていることを特徴とする。
請求項１７記載の表示装置は、請求項１６記載の表示装置において、前記複数の単位電流トランジスタは、トランジスタサイズが各々異なるように形成されていることを特徴とする。
【００２６】
請求項１８記載の表示装置は、請求項１７記載の表示装置において、前記複数の単位電流トランジスタは、該各単位電流トランジスタの各チャネル幅が、互いに２ｋ（ｋ＝０、１、２、３、・・・）で規定される、異なる比率に設定されていることを特徴とする。
請求項１９記載の表示装置は、請求項１２乃至１８のいずれかに記載の表示装置において、前記電流生成手段は、前記階調電流の信号極性を、前記表示画素側から引き込む方向に流すように設定することを特徴とする。
【００２７】
請求項２０記載の表示装置は、請求項１２乃至１８のいずれかに記載の表示装置において、前記電流生成手段は、前記階調電流の信号極性を、前記表示画素に流し込む方向に流すように設定することを特徴とする。
請求項２１記載の表示装置は、請求項１２乃至２０のいずれかに記載の表示装置において、前記複数の信号線に対応して設けられる前記複数の電流生成供給回路は、前記定電流源に接続された電流供給線に並列に接続され、該各電流生成供給回路は当該電流生成供給回路への前記基準電流の供給状態を制御するスイッチ手段を備え、前記スイッチ手段を所定のタイミングで選択的に切換制御することにより、複数の前記電流生成供給回路のうち、唯一の前記電流生成供給回路に対してのみ、前記基準電流が供給されることを特徴とする。
【００２８】
請求項２２記載の表示装置は、請求項２１記載の表示装置において、前記スイッチ手段の切換制御は、前記各電流生成供給回路の前記信号保持手段に前記デジタル信号を取り込み保持する際のタイミングに同期して行われることを特徴とする。
請求項２３記載の表示装置は、請求項１２乃至２２のいずれかに記載の表示装置において、前記表示画素は、前記電流生成供給回路から供給される前記階調電流の電流値に応じて、所定の輝度階調で発光動作する電流駆動型の発光素子を備えていることを特徴とする。
請求項２４記載の表示装置は、請求項２３記載の表示装置において、前記発光素子は、有機エレクトロルミネッセント素子からなる発光素子であることを特徴とする。
【００２９】
すなわち、本発明に係る電流生成供給回路は、有機ＥＬ素子や発光ダイオード等のように、電流値に応じて所定の駆動状態（発光輝度）で動作する負荷（表示画素）に対して、所定の電流値を有する負荷駆動電流（階調電流）を生成して供給する電流駆動装置であって、少なくとも、負荷の駆動状態を制御するための複数ビットのデジタル信号（表示データ）を並列的に取り込み保持するデータラッチ部（信号保持手段）と、該データラッチ部から出力される出力信号に基づいて、上記複数ビットのデジタル信号に対応した電流値を有する負荷駆動電流（階調電流）を生成して負荷に出力する電流生成部（電流生成手段）と、を有し、特に、上記電流生成部が、定電流源から供給される基準電流に基づいて、デジタル信号の各ビットに対応する複数の単位電流を生成する、基準電流トランジスタ及び複数の単位電流トランジスタからなるカレントミラー回路部を備えるとともに、該カレントミラー回路部が、上記基準電流トランジスタ及び複数の単位電流トランジスタをマルチゲート構造を有する電界効果型トランジスタにより形成した構成、もしくは、上記基準電流トランジスタ及び複数の単位電流トランジスタからなる複数のカレントミラー回路を、多段接続した構成を有している。
【００３０】
ここで、カレントミラー回路部を構成する複数の単位電流トランジスタとして、基準電流トランジスタに対してチャネル幅が各々異なる比率となるように形成することにより、上記複数の単位電流が各々異なる電流値を有するように設定することができ、各単位電流トランジスタに流れる単位電流を、上記デジタル信号に応じて選択的に合成（電流値を合算）することにより、上記負荷駆動電流を生成する構成を適用することができる。
【００３１】
これにより、カレントミラー回路部の基準電流トランジスタに一定の基準電流を流すのみで、各単位電流トランジスタに異なる電流値を有する複数の単位電流を一義的に流すことができ、負荷駆動電流の生成に関連して電流生成供給回路に供給される信号レベルが変動しない構成を有しているので、負荷駆動電流が微小な場合であっても、電流生成供給回路に接続される電流供給線に付加された寄生容量への充放電動作に起因する信号遅延の影響を排除して、電流生成供給回路、又は、電流生成供給回路を備えた電流駆動装置の動作速度を向上させることができる。
【００３２】
また、本発明に係る電流生成部においては、カレントミラー回路部を構成する基準電流トランジスタ及び複数の単位電流トランジスタの少なくとも一つを、複数の電界効果型トランジスタの電流路を直接に接続した回路構成を有しているので、基準電流トランジスタ又は複数の単位電流トランジスタを構成する各電界効果型トランジスタに印加される電圧を、実質的に低減して、ソース−ドレイン耐圧を向上させることができる。これにより、各電界効果型トランジスタの電圧−電流特性を改善することができ、電流生成部（カレントミラー回路部）により生成される負荷駆動電流における、指定階調に対する出力電流特性について、良好な線形性を実現することができる。したがって、負荷をデジタル信号に応じた適切な駆動状態で動作させることができる。
【００３３】
そして、本発明に係る表示装置においては、相互に直交する走査ライン（走査線）及びデータライン（信号線）の交点近傍に、発光素子を備えた表示画素をマトリクス状に配列してなる表示パネルを備えた表示装置において、上述したような電流生成供給回路をデータドライバ（信号駆動手段）に適用し、表示パネルの所定の行に配列された表示画素群の選択期間中に、各表示画素に対応して設けられた階調電流供給回路（電流生成供給回路）において、データラッチ部に保持した複数ビットのデジタル信号（表示データ）に基づいて電流生成部により生成された特定の単位電流の合成電流を、階調電流（負荷駆動電流）として、各表示画素に個別に供給するように構成されている。
【００３４】
これにより、上述したように、階調電流供給回路（電流生成供給回路）を構成するカレントミラー回路部の基準電流トランジスタに一定の電流値を有する基準電流を流すのみで、表示データ（表示信号）に応じた電流値を有する階調電流が生成されるので、表示パネルの小型化や高精細化に伴って表示画素が微細化された場合や、比較的下位の輝度階調で各表示画素を発光動作させる場合等のように、階調電流が微小な場合であっても、信号線の充放電動作に起因する動作速度の低下を抑制して、表示データに応じた適正な電流値を有する階調電流を迅速に生成して表示画素（発光素子）に供給することができる。したがって、表示画素を表示データに応じた適正な輝度階調で発光動作させることができ、所望の画像情報を良好な画質で表示することができる。
【００３５】
また、上述したようなデータドライバにおいては、各データラインや表示画素に対応して、共通の電流供給線に並列的に接続された複数の階調電流供給回路に対して、各階調電流供給回路に設けられたスイッチ手段を選択的に切換制御することにより、一時に唯一の階調電流供給回路にのみ、基準電流が供給されるように制御することができる。これにより、定電流発生源（定電流源）から供給される一定の電流値を有する基準電流が分割されることなく、各階調電流供給回路に選択的に供給され、該基準電流をそのまま用いて階調電流が生成されるので、各階調電流供給回路ごとの回路特性や能動素子の素子特性のバラツキの影響を受けることなく、表示データに応じた適切かつ均一化された電流値を有する階調電流を表示画素に供給することができ、輝度階調のバラツキを抑制した良好な表示画質を実現することができる。
【００３６】
さらに、上述したように階調電流供給回路に適用するカレントミラー回路部として、該カレントミラー回路部を構成する基準電流トランジスタ及び複数の単位電流トランジスタを、マルチゲート構造を有する電界効果型トランジスタにより形成した構成、もしくは、上記基準電流トランジスタ及び複数の単位電流トランジスタからなる複数のカレントミラー回路を、多段接続した構成を有していることにより、基準電流トランジスタ又は複数の単位電流トランジスタを構成する各電界効果型トランジスタに印加される電圧を、実質的に低減して、ソース−ドレイン耐圧を向上させることができるので、階調電流供給回路（カレントミラー回路部）により生成される階調電流における、表示データに対する出力電流特性について、良好な線形性を実現することができる。したがって、表示画素を低い階調で発光動作させるような場合であっても、輝度階調を良好な線形性で的確に制御することができるので、表示画素を表示データに基づいた適切な輝度階調で発光動作させることができ、表示画質の向上を図ることができる。
【００３７】
【発明の実施の形態】
以下、本発明に係る電流生成供給回路及び該電流生成供給回路を備えた表示装置について、実施の形態を示して詳しく説明する。
＜電流生成供給回路の第１の実施形態＞
まず、本発明に係る電流生成供給回路について、図面を参照して説明する。
図１は、本発明に係る電流生成供給回路の第１の実施形態を示す概略構成図である。
【００３８】
図１に示すように、本実施形態に係る電流生成供給回路ＩＬＡは、電流値を指定するための複数ビット（本実施形態においては、４ビットの場合を示す）のデジタル信号ｄ０、ｄ１、ｄ２、ｄ３（ｄ０〜ｄ３）を個別に取り込んで保持（ラッチ）するラッチ回路ＬＣ０、ＬＣ１、ＬＣ２、ＬＣ３（ＬＣ０〜ＬＣ３）を備えたデータラッチ部１０と、定電流発生源ＩＲから供給される一定の電流値を有する基準電流Ｉｒｅｆを取り込み、上記データラッチ部１０（各ラッチ回路ＬＣ０〜ＬＣ３）から出力される出力信号（反転出力信号）ｄ１０＊、ｄ１１＊、ｄ１２＊、ｄ１３＊（ｄ１０＊〜ｄ１３＊；以下、本明細書中では、反転極性を示す記号を、便宜的に「＊」を用いて示す。図１（ａ）、（ｂ）の符号参照）に基づいて、基準電流Ｉｒｅｆに対して所定比率の電流値を有する負荷駆動電流ＩＤを生成して図示を省略した負荷ＬＤに出力する電流生成部２０Ａと、を有して構成されている。ここで、本実施形態においては、定電流発生源ＩＲは、電流供給線Ｌｓを介して電流生成部２０Ａから基準電流Ｉｒｅｆを引き抜くように、低電位電源（例えば、接地電位）Ｖｇｎｄに接続されている。
【００３９】
なお、図１（ａ）に示したデータラッチ部１０の構成は、本明細書においては、便宜的に図１（ｂ）に示すような回路記号で示す。図１（ｂ）において、ＩＮ０〜ＩＮ３は、各々、図１（ａ）に示した各ラッチ回路ＬＣ０〜ＬＣ３の入力接点ＩＮを示し、ＯＴ０〜ＯＴ３は、各々、各ラッチ回路ＬＣ０〜ＬＣ３の非反転出力接点ＯＴを示し、ＯＴ０＊〜ＯＴ３＊は、各々、各ラッチ回路ＬＣ０〜ＬＣ３の反転出力接点ＯＴ＊を示す。各ラッチ回路ＬＣ０〜ＬＣ３の構成については、詳しく後述する。
【００４０】
以下、上記各構成について、具体的に説明する。
（データラッチ部１０）
データラッチ部１０は、図１に示すように、デジタル信号ｄ０〜ｄ３のビット数（４ビット）に応じた数のラッチ回路ＬＣ０〜ＬＣ３が並列に設けられた構成を有し、図示を省略したタイミングジェネレータやシフトレジスタ等から出力されるタイミング制御信号（非反転クロック信号）ＣＬＫ、（反転クロック信号）ＣＬＫ＊に基づいて、各々個別に供給される上記デジタル信号ｄ０〜ｄ３を同時に取り込み、当該デジタル信号ｄ０〜ｄ３に基づく信号レベルを出力、保持する動作（信号保持動作）を実行する。
【００４１】
（電流生成部２０Ａ）
図２は、本実施形態に適用される電流生成部の一具体例を示す回路構成図である。
電流生成部２０Ａは、図２に示すように、基準電流Ｉｒｅｆに対して、各々、異なる比率の電流値を有する複数の単位電流Ｉｓａ、Ｉｓｂ、Ｉｓｃ、Ｉｓｄを生成するカレントミラー回路部２１Ａと、上記複数の単位電流Ｉｓａ〜Ｉｓｄのうち、上述したデータラッチ部１０の各ラッチ回路ＬＣ０〜ＬＣ３から出力される出力信号ｄ１０＊〜ｄ１３＊（図１に示した反転出力端子ＯＴ＊の信号レベル）に基づいて、任意の単位電流を選択するスイッチ回路部２２Ａと、を備えている。
【００４２】
電流生成部２０Ａに適用されるカレントミラー回路部２１Ａは、具体的には、電流供給線Ｌｓを介して基準電流Ｉｒｅｆが供給される（引き抜かれる）電流入力接点ＩＮｉと高電位電源＋Ｖに接続された電源接点（以下、「高電位電源＋Ｖ」と記す）との間に、各電流路（ソース−ドレイン端子）が直列に接続されるとともに、各制御端子（ゲート端子）が共通の接点Ｎｇａに接続された２個のｐチャネル型の電界効果型トランジスタ（以下、「ｐチャネル型トランジスタ」と略記する；基準電流トランジスタ）ＴＰ１１ａ及びＴＰ１１ｂと、各接点Ｎａ、Ｎｂ、Ｎｃ、Ｎｄと高電位電源＋Ｖとの間に、各々、電流路が直列に接続されるとともに、各制御端子が接点Ｎｇａに共通に接続された各２個のｐチャネル型トランジスタ（単位電流トランジスタ）ＴＰ１２ａ及びＴＰ１２ｂ、ＴＰ１３ａ及びＴＰ１３ｂ、ＴＰ１４ａ及びＴＰ１４ｂ、ＴＰ１５ａ及びＴＰ１５ｂと、を備えた構成を有している。ここで、接点Ｎｇａは、電流入力接点ＩＮｉに直接接続されているとともに、高電位電源＋Ｖとの間に容量Ｃａが接続された構成を有している。
【００４３】
また、電流生成部２０Ａに適用されるスイッチ回路部２２Ａは、負荷が接続される電流出力接点ＯＵＴｉと上記各接点Ｎａ、Ｎｂ、Ｎｃ、Ｎｄとの間に電流路が接続されるとともに、制御端子に上記各ラッチ回路ＬＣ０〜ＬＣ３から個別に出力される出力信号ｄ１０＊〜ｄ１３＊が並列的に印加される複数（４個）のｐチャネル型トランジスタＴＰ１６、ＴＰ１７、ＴＰ１８、ＴＰ１９と、を備えた構成を有している。
【００４４】
ここで、本実施形態に係る電流生成部２０Ａにおいては、特に、カレントミラー回路部２１Ａを構成する各ｐチャネル型トランジスタ（単位電流トランジスタ）ＴＰ１２ａ及びＴＰ１２ｂ、ＴＰ１３ａ及びＴＰ１３ｂ、ＴＰ１４ａ及びＴＰ１４ｂ、ＴＰ１５ａ及びＴＰ１５ｂに流れる単位電流Ｉｓａ〜Ｉｓｄが、ｐチャネル型トランジスタ（基準電流トランジスタ）ＴＰ１１ａ及びＴＰ１１ｂに流れる基準電流Ｉｒｅｆに対して、各々異なる所定の比率の電流値を有するように設定されている。
【００４５】
具体的には、各単位電流トランジスタＴＰ１２ａ及びＴＰ１２ｂ、ＴＰ１３ａ及びＴＰ１３ｂ、ＴＰ１４ａ及びＴＰ１４ｂ、ＴＰ１５ａ及びＴＰ１５ｂのトランジスタサイズの合計が、各々異なる比率、例えば、各単位電流トランジスタＴＰ１２ａ及びＴＰ１２ｂ、ＴＰ１３ａ及びＴＰ１３ｂ、ＴＰ１４ａ及びＴＰ１４ｂ、ＴＰ１５ａ及びＴＰ１５ｂにおいて、チャネル長を一定とした場合の各チャネル幅の合計の比が、Ｗ１２：Ｗ１３：Ｗ１４：Ｗ１５＝１：２：４：８になるように形成されている。ここで、Ｗ１２は、単位電流トランジスタＴＰ１２ａ及びＴＰ１２ｂのチャネル幅の合計を示し、Ｗ１３は、単位電流トランジスタＴＰ１３ａ及びＴＰ１３ｂのチャネル幅の合計を示し、Ｗ１４は、単位電流トランジスタＴＰ１４ａ及びＴＰ１４ｂのチャネル幅の合計を示し、Ｗ１５は、単位電流トランジスタＴＰ１５ａ及びＴＰ１５ｂのチャネル幅の合計を示す。
【００４６】
これにより、各単位電流トランジスタＴＰ１２ａ及びＴＰ１２ｂ、ＴＰ１３ａ及びＴＰ１３ｂ、ＴＰ１４ａ及びＴＰ１４ｂ、ＴＰ１５ａ及びＴＰ１５ｂに流れる単位電流Ｉｓａ〜Ｉｓｄの電流値は、基準電流トランジスタＴＰ１１ａ及びＴＰ１１ｂのチャネル幅の合計をＷ１１とすると、各々Ｉｓａ＝（Ｗ１２／Ｗ１１）×Ｉｒｅｆ、Ｉｓｂ＝（Ｗ１３／Ｗ１１）×Ｉｒｅｆ、Ｉｓｃ＝（Ｗ１４／Ｗ１１）×Ｉｒｅｆ、Ｉｓｄ＝（Ｗ１５／Ｗ１１）×Ｉｒｅｆに設定される。すなわち、単位電流トランジスタＴＰ１２ａ及びＴＰ１２ｂ、ＴＰ１３ａ及びＴＰ１３ｂ、ＴＰ１４ａ及びＴＰ１４ｂ、ＴＰ１５ａ及びＴＰ１５ｂの各チャネル幅の合計値を、各々２ｋ（ｋ＝０、１、２、３、・・・；２ｋ＝１、２、４、８、・・・）に設定することにより、単位電流間の電流値を２ｋで規定される比率に設定することができる。
【００４７】
このように電流値が設定された各単位電流Ｉｓａ〜Ｉｓｄから、後述するように、複数ビットのデジタル信号ｄ０〜ｄ３（すなわち、データラッチ部１０からの出力信号ｄ１０＊〜ｄ１３＊）に基づいて、任意の単位電流を選択して合成することにより、２ｋ段階の電流値を有する負荷駆動電流ＩＤが生成される。したがって、図１、図２に示したように、４ビットのデジタル信号ｄ０〜ｄ３を適用した場合、各単位電流トランジスタＴＰ１２ａ及びＴＰ１２ｂ、ＴＰ１３ａ及びＴＰ１３ｂ、ＴＰ１４ａ及びＴＰ１４ｂ、ＴＰ１５ａ及びＴＰ１５ｂに接続されるトランジスタＴＰ１６〜ＴＰ１９のオン状態に応じて、２４＝１６段階（階調）の異なる電流値を有する負荷駆動電流ＩＤが生成される。
【００４８】
このような構成を有する電流生成部２０Ａにおいては、上記ラッチ回路ＬＣ０〜ＬＣ３から出力される出力信号ｄ１０＊〜ｄ１３＊の信号レベルに応じて、スイッチ回路部２２Ａのうちの、特定のトランジスタがオン動作（トランジスタＴＰ１６〜ＴＰ１９のいずれか１つ以上がオン動作する場合のほか、いずれのトランジスタＴＰ１６〜ＴＰ１９もオフ動作する場合を含む）し、該オン動作したトランジスタに接続されたカレントミラー回路部２２Ａの単位電流トランジスタ（ＴＰ１２ａ及びＴＰ１２ｂ、ＴＰ１３ａ及びＴＰ１３ｂ、ＴＰ１４ａ及びＴＰ１４ｂ、ＴＰ１５ａ及びＴＰ１５ｂのいずれか１つ以上の組み合わせ）に、基準電流トランジスタＴＰ１１ａ及びＴＰ１１ｂに流れる基準電流Ｉｒｅｆに対して、所定比率（ａ×２ｋ倍；ａは基準電流トランジスタＴＰ１１ａ及びＴＰ１１ｂのチャネル幅の合計値Ｗ１１により規定される定数）の電流値を有する単位電流Ｉｓａ〜Ｉｓｄが流れ、上述したように、電流出力接点ＯＵＴｉにおいて、これらの単位電流の合成値となる電流値を有する負荷駆動電流ＩＤが、高電位電源＋Ｖから、電流出力接点ＯＵＴｉ、オン状態にあるトランジスタ（ＴＰ１６〜ＴＰ１９のいずれか）及び単位電流トランジスタ（ＴＰ１２ａ及びＴＰ１２ｂ、ＴＰ１３ａ及びＴＰ１３ｂ、ＴＰ１４ａ及びＴＰ１４ｂ、ＴＰ１５ａ及びＴＰ１５ｂのいずれかの組み合わせ）を介して、図示を省略した負荷方向に流れる。
【００４９】
これにより、本実施形態に係る電流生成供給回路ＩＬＡにおいては、タイミング制御信号ＣＬＫ、ＣＬＫ＊により規定されるタイミングで、データラッチ部１０に入力される複数ビットのデジタル信号ｄ０〜ｄ３に応じて、電流生成部２２Ａにより所定の電流値を有するアナログ電流からなる負荷駆動電流ＩＤが生成されて、負荷ＬＤに供給されることになる（本実施形態においては、上述したように、電流生成供給回路側から負荷方向に負荷駆動電流が流し込まれる）。
【００５０】
なお、本実施形態においては、電流生成供給回路（各駆動電流供給回路部）に接続された負荷に対して、電流生成供給回路側から負荷駆動電流を流し込むように構成した場合（以下、便宜的に、「電流印加方式」と記す）について示したが、本発明においては、負荷側から電流生成供給回路方向に負荷駆動電流を引き込むように構成（以下、便宜的に、「電流シンク方式」と記す）したものであってもよい。電流シンク方式に対応した電流生成供給回路については、簡単に後述する。
【００５１】
ここで、本実施形態に係る電流生成部（カレントミラー回路部）の構成について、さらに詳しく説明する。
図３は、周知のｐチャネル型の電界効果型トランジスタの電圧−電流特性を示す図であり、図４は、周知のｐチャネル型の電界効果型トランジスタを適用して電流生成供給回路（電流生成部）を構成した場合の入力信号（デジタル信号；指定階調）に対する出力電流特性を示す図である。
【００５２】
まず、周知のＰチャネル型の電界効果型トランジスタ（薄膜トランジスタ）固有の電圧−電流特性について、図３（ａ）に示すように、１個のｐチャネル型トランジスタのみを備えた回路を用いて検証すると、図３（ｂ）中、実線で示すように、印加電圧（ソース−ドレイン間電圧；−Ｖｄｓ）の絶対値の増大に伴って、一旦飽和傾向を示したドレイン電流（−Ｉｄｓ）の絶対値が、再度増加する傾向を示すことが知られている。なお、図３（ｂ）中、点線は、ソース−ドレイン間電圧（−Ｖｄｓ）が特定の電圧領域で、ドレイン電流（ソース−ドレイン間電流；−Ｉｄｓ）が飽和傾向を示す理想的な素子特性（電圧−電流特性）を示している。
【００５３】
このような現象は、ＳＯＩ（Ｓｉｌｉｃｏｎ  Ｏｎ  Ｉｎｓｕｌａｔｏｒ）半導体層構造を有する電界効果トランジスタ等において、素子分離領域近傍で衝突イオン化が誘発され、これにより生成されたキャリヤ（ｐチャネル型トランジスタでは電子）がチャネル領域（ボディ領域）に注入、蓄積されること（基板浮遊効果）により、しきい値電圧が低下して、ドレイン電流が増加するキンク（ｋｉｎｋ）現象や、短チャネル効果によるものと考えられている。
【００５４】
そのため、このような電界効果型トランジスタを唯一適用して、上述したようなカレントミラー回路の基準電流トランジスタ及び各単位電流トランジスタを構成すると、基準電流に対する単位電流の電流値の比率が所望の設計値通りに設定されなくなる。これにより、このようなカレントミラー回路を適用した電流生成供給回路（電流生成部）において、入力信号であるデジタル信号（上述したデータラッチ部１０からの出力信号ｄ１０＊〜ｄ１３＊に相当する；指定階調）に対する出力電流（上述した負荷駆動電流ＩＤに相当する）の電流値が、例えば、図４（ａ）に示すように、非線形性を示すため、負荷の駆動状態を線形性良く制御することができず、負荷を低階調で駆動する場合に負荷駆動電流（出力電流）の電流値が過大になるという問題がある。したがって、例えば、後述するような表示画素（負荷）を低い階調で発光動作させるような場合、輝度階調を的確に制御することができないため、表示画質の劣化を招く可能性があった。
【００５５】
そこで、本発明においては、上述したようなキンク現象や短チャネル効果の影響を抑制するために、電流生成供給回路（電流生成部）においてカレントミラー回路を構成する基準電流トランジスタ及び単位電流トランジスタを、各々、複数の電界効果型トランジスタの直列接続により構成することにより、実質的にチャネル構造を分割した、いわゆる、マルチゲート構造（図２に示した回路構成においては、２個のｐチャネル型トランジスタを直列接続したデュアルゲート構造）を適用した構成を有している。
【００５６】
これにより、各電界効果型トランジスタに印加されるソース−ドレイン間電圧をこのようなマルチゲート構造を用いない場合より低減して、ソース−ドレイン耐圧を向上させることができるので、図３（ｂ）中、点線で示したような理想的な電圧−電流特性に近い特性を得ることができ、図４（ｂ）に示すように、指定階調に対して良好な線形性を有する出力電流特性が得られる。
したがって、本発明に係る電流生成供給回路を後述するような表示装置のデータドライバ（階調電流供給回路）に適用することにより、表示画素を低い階調で発光動作させるような場合であっても、輝度階調を的確に制御することができるので、表示画素を表示データに基づいた適切な輝度階調で発光動作させることができ、表示画質の向上を図ることができる。
【００５７】
なお、ここでは、ｐチャネル型トランジスタの特性についてのみ言及したが、後述するｎチャネル型の電界効果型トランジスタを適用した構成（図５、図６参照）においても同様の特性を有することは言うまでもない。また、図２においては、基準電流トランジスタ及び単位電流トランジスタの各々を、２個のｐチャネル型トランジスタの直列接続で構成した回路を示したが、２個以上の電荷効果型トランジスタを直列接続するものであってもよい。
【００５８】
また、本実施形態（図２）においては、マルチゲート構造を有する電界効果型トランジスタを、電流生成部のカレントミラー回路部を構成する基準電流トランジスタ及び単位電流トランジスタの双方に適用した回路構成について示したが、本発明はこれに限定されるものではなく、基準電流トランジスタに流れる基準電流に対する、各単位電流トランジスタに流れる単位電流の電流比率に応じて、基準電流トランジスタ側のみ、もしくは、単位電流トランジスタ側のみに、上述したようなマルチゲート構造を適用するものであってもよい。要するに、電流路を流れる電流（基準電流、単位電流）に対して、高い耐圧を必要とする電界効果型トランジスタに対してのみマルチゲート構造を適用するようにしてもよいし、該耐圧に応じて、直列接続する電界効果型トランジスタの個数を、基準電流トランジスタ及び各単位電流トランジスタごとに適宜変更設定するものであってもよい。
【００５９】
さらに、本実施形態（図２）においては、マルチゲート構造を有する電荷効果型トランジスタを、電流生成供給回路（電流生成部）のカレントミラー回路部を構成する基準電流トランジスタ及び単位電流トランジスタにのみ適用した回路構成を示したが、他の電界効果型トランジスタについても同様に適用できることは言うまでもない。
【００６０】
＜電流生成供給回路の他の構成例＞
次に、本実施形態に係る電流生成供給回路の他の構成例について、図面を参照して説明する。
図５は、本実施形態に係る電流生成供給回路の他の構成例を示す概略構成図である。図６は、本実施形態に係る電流生成供給回路に適用される電流生成部の他の具体例を示す回路構成図である。ここで、上述した実施形態と同等の構成については、同等の符号を付して、その説明を簡略化する。
【００６１】
具体的には、図５に示すように、本実施形態に係る電流生成供給回路ＩＬＢは、上述した実施形態と同様に、データラッチ部１０と、電流生成部２０Ｂと、を有するとともに、電流生成部２０Ｂに電流供給線Ｌｓを介して接続された定電流発生源ＩＲが、定電流発生源ＩＲ側から電流生成部２０Ｂ方向に基準電流Ｉｒｅｆを流し込むように、高電位電源＋Ｖに接続されている。
データラッチ部１０は、複数のデジタル信号ｄ０〜ｄ３に対応してラッチ回路ＬＣ０〜ＬＣ３が個別に設けられた構成を有し、各ラッチ回路ＬＣ０〜ＬＣ３の出力信号ｄ１０〜ｄ１３（非反転出力端子ＯＴの信号レベル）が電流生成部２０Ｂに出力されるように接続されている。
【００６２】
本実施形態に係る電流生成部２０Ｂは、図６に示すように、概略、上述した実施形態（図２参照）と略同等の回路構成を有するカレントミラー回路部２１Ｂ及びスイッチ回路部２２Ｂと、を備え、各ラッチ回路ＬＣ０〜ＬＣ３からの出力信号ｄ１０〜ｄ１３に基づいて、基準電流Ｉｒｅｆに対して、所定比率の電流値を有する複数の単位電流Ｉｓｈ、Ｉｓｉ、Ｉｓｊ、Ｉｓｋを任意に選択、合成して生成される負荷駆動電流ＩＤを負荷に供給するように構成されている。
【００６３】
具体的には、カレントミラー回路部２１Ｂ及びスイッチ回路部２２Ｂを構成する全てのトランジスタＴＮ１１ａ〜ＴＮ１５ｂ及びＴＮ１６〜ＴＮ１９がｎチャネル型の電界効果型トランジスタ（以下、「ｎチャネル型トランジスタ」と略記する）からなり、基準電流トランジスタＴＮ１１ａ及びＴＮ１１ｂは、各電流路が電流入力接点ＩＮｉと低電位電源Ｖｇｎｄとの間に直列に接続されるとともに、各制御端子が電流入力接点ＩＮｉに接続された共通の接点Ｎｇｂに接続されている。接点Ｎｇｂと低電位電源Ｖｇｎｄとの間には容量Ｃｂが接続されている。また、単位電流トランジスタＴＮ１２ａ及びＴＮ１２ｂ、ＴＮ１３ａ及びＴＮ１３ｂ、ＴＮ１４ａ及びＴＮ１４ｂ、ＴＮ１５ａ及びＴＮ１５ｂは、各々、各電流路が接点Ｎｈ、Ｎｉ、Ｎｊ、Ｎｋと低電位電源Ｖｇｎｄとの間に直列に接続されるとともに、各制御端子が接点Ｎｇｂに共通に接続されている。また、スイッチング用のトランジスタＴＮ１６〜ＴＮ１９は、各々、電流路が上記接点Ｎｈ、Ｎｉ、Ｎｊ、Ｎｋと電流出力接点ＯＵＴｉとの間に接続されるとともに、制御端子にラッチ回路ＬＣ０〜ＬＣ３から出力される出力信号ｄ１０〜ｄ１３が並列的に印加されるように構成されている。
【００６４】
ここで、本実施形態においても、カレントミラー回路部２１Ｂを構成する各２個の単位電流トランジスタＴＮ１２ａ及びＴＮ１２ｂ、ＴＮ１３ａ及びＴＮ１３ｂ、ＴＮ１４ａ及びＴＮ１４ｂ、ＴＮ１５ａ及びＴＮ１５ｂのトランジスタサイズの合計（すなわち、チャネル長を一定とした場合のチャネル幅の合計）が、基準電流トランジスタＴＮ１１ａ及びＴＮ１１ｂを基準として、所定の比率になるように形成され、各単位電流トランジスタＴＮ１２ａ及びＴＮ１２ｂ、ＴＮ１３ａ及びＴＮ１３ｂ、ＴＮ１４ａ及びＴＮ１４ｂ、ＴＮ１５ａ及びＴＮ１５ｂの電流路に流れる単位電流Ｉｓｈ〜Ｉｓｋが、基準電流Ｉｒｅｆに対して、各々異なる所定の比率の電流値を有するように設定されている。
【００６５】
これにより、本実施形態に係る電流生成供給回路２０Ｂにおいても、データラッチ部１０（ラッチ回路ＬＣ０〜ＬＣ３）から出力される出力信号ｄ１０〜ｄ１３の信号レベルに応じて、スイッチ回路部２２Ｂの特定のトランジスタＴＮ１６〜ＴＮ１９がオン動作して、各単位電流トランジスタＴＮ１２ａ及びＴＮ１２ｂ、ＴＮ１３ａ及びＴＮ１３ｂ、ＴＮ１４ａ及びＴＮ１４ｂ、ＴＮ１５ａ及びＴＮ１５ｂを介して基準電流Ｉｒｅｆの所定比率倍の電流値を有する単位電流Ｉｓｈ〜Ｉｓｋが流れ、これらの合成電流が電流出力接点ＯＵＴｉを介して負荷駆動電流ＩＤとして図示を省略した負荷に供給される（本実施形態においては、負荷側から電流生成供給回路方向に負荷駆動電流が流れ込む）。
【００６６】
したがって、上述した実施形態に示した電流生成供給回路ＩＬＡ、ＩＬＢにおいては、負荷に直接接続された電流生成供給回路に、定電流発生源ＩＲから電流供給線Ｌｓを介して、信号レベルが変動しない一定の基準電流Ｉｒｅｆを供給し、複数ビットのデジタル信号ｄ０〜ｄ３（データラッチ部１０の出力信号ｄ１０〜ｄ１３、ｄ１０＊〜ｄ１３＊）に基づいて、負荷を所望の駆動状態で動作させることができる電流値を有する負荷駆動電流ＩＤを生成することができる構成を有していることにより、電流供給線Ｌｓに供給される電流（基準電流）の変化に伴う電位変動をほとんど生じることがないので、負荷駆動電流の電流値が微少な場合や、負荷への負荷駆動電流の供給時間（あるいは、負荷の駆動時間）が短く設定されている場合であっても、電流供給ラインに付加された寄生容量（配線容量）への充放電動作に起因する電流生成供給回路の動作速度の低下を抑制して、電流生成供給回路、又は、該電流生成供給回路を適用した電流駆動装置の動作速度に対する制約を緩和し、負荷をより迅速かつ的確な駆動状態で動作させることができる。
【００６７】
なお、上述した各実施形態に示した複数ビットのデジタル信号としては、後述するように、表示装置に所望の画像情報を表示するための表示データ（表示信号）を適用することでき、この場合において、電流生成供給回路により生成、出力される負荷駆動電流は、表示パネルを構成する各表示画素を所定の輝度階調で発光動作させるために供給される階調電流に対応する。詳しくは、表示装置の実施形態の記載において説明する。
【００６８】
＜電流生成供給回路の第２の実施形態＞
次に、本実施形態に係る電流生成供給回路の第２の実施形態について、図面を参照して説明する。
図７は、第２の実施形態に係る電流生成供給回路に適用される電流生成部の一具体例を示す回路構成図である。ここで、上述した実施形態と同等の構成については、同等の符号を付して、その説明を簡略化する。
【００６９】
具体的には、本実施形態に係る電流生成供給回路は、上述した実施形態（図１参照）と同様に、データラッチ部１０と、図７に示す電流生成部２０Ｃと、を有するとともに、電流生成部２０Ｃに電流供給線Ｌｓを介して接続された定電流発生源ＩＲが、電流生成部２０Ｃ側から定電流発生源ＩＲ方向に基準電流Ｉｒｅｆを引き抜くように、低電位電源Ｖｇｎｄに接続されている。
【００７０】
本実施形態に係る電流生成部２０Ｃは、図７に示すように、概略、基準電流Ｉｒｅｆに対して、各々、異なる比率の電流値を有する複数の単位電流Ｉｓｐ、Ｉｓｑ、Ｉｓｒ、Ｉｓｓを生成するカレントミラー回路部２１Ｃと、上記複数の単位電流Ｉｓｐ〜Ｉｓｓのうち、上述したデータラッチ部１０の各ラッチ回路ＬＣ０〜ＬＣ３から出力される出力信号ｄ１０＊〜ｄ１３＊（図１参照）に基づいて、任意の単位電流を選択するスイッチ回路部２２Ｃと、を備えている。ここで、カレントミラー回路部２１Ｃは、２組のカレントミラー回路２１Ｃａ及び２１Ｃｂが階層状に接続（多段接続又は縦続接続）された、いわゆる、カスケード接続構造を有している。
【００７１】
電流生成部２０Ｃに適用されるカレントミラー回路部２１Ｃは、具体的には、電流供給線Ｌｓを介して基準電流Ｉｒｅｆが供給される（引き抜かれる）電流入力接点ＩＮｉと高電位電源＋Ｖとの間に、各電流路が直列に接続されるとともに、制御端子が各々個別の接点Ｎｇｃａ、Ｎｇｃｂに接続された２個のｐチャネル型トランジスタからなる基準電流トランジスタＴＰ２１ａ及びＴＰ２１ｂと、各接点Ｎｐ、Ｎｑ、Ｎｒ、Ｎｓと高電位電源＋Ｖとの間に、各々、電流路が直列に接続されるとともに、制御端子が各々個別の接点Ｎｇｃａ、Ｎｇｃｂに接続された各２個のｐチャネル型トランジスタからなる単位電流トランジスタＴＰ２２ａ及びＴＰ２２ｂ、ＴＰ２３ａ及びＴＰ２３ｂ、ＴＰ２４ａ及びＴＰ２４ｂ、ＴＰ２５ａ及びＴＰ２５ｂと、を備えた構成を有している。ここで、接点Ｎｇｃａは、基準電流トランジスタＴＰ２１ａ及びＴＰ２１ｂの接続接点に接続されているとともに、高電位電源＋Ｖとの間に容量Ｃｃａが接続され、また、接点Ｎｇｃｂは、電流入力接点ＩＮｉに直接接続されているとともに、高電位電源＋Ｖとの間に容量Ｃｃｂが接続された構成を有している。
【００７２】
すなわち、基準電流トランジスタＴＰ２１ａ及び単位電流トランジスタＴＰ２２ａ、ＴＰ２３ａ、ＴＰ２４ａ、ＴＰ２５ａ（さらには、容量Ｃｃａを含む回路）は、基準電流トランジスタＴＰ２１ａの制御端子（接点Ｎｇｃａ）に対して、単位電流トランジスタＴＰ２２ａ、ＴＰ２３ａ、ＴＰ２４ａ、ＴＰ２５ａの各制御端子が並列的に共通に接続されたカレントミラー回路２１Ｃａを構成し、また、基準電流トランジスタＴＰ２１ｂ及び単位電流トランジスタＴＰ２２ｂ、ＴＰ２３ｂ、ＴＰ２４ｂ、ＴＰ２５ｂ（さらには、容量Ｃｃｂを含む回路）は、基準電流トランジスタＴＰ２１ｂの制御端子（接点Ｎｇｃｂ）に対して、単位電流トランジスタＴＰ２２ｂ、ＴＰ２３ｂ、ＴＰ２４ｂ、ＴＰ２５ｂの各制御端子が並列的に共通に接続されたカレントミラー回路２１Ｃｂを構成し、これらの２組のカレントミラー回路２１Ｃａ及び２１Ｃｂが、高電位電源＋Ｖと各電流入力接点ＩＮｉ及び電流出力接点ＯＵＴｉ（接点Ｎｐ、Ｎｑ、Ｎｒ、Ｎｓ）間に、階層状に多段接続又は縦続接続（カスケード接続）された構成を有している。
なお、本実施形態においては、２組のカレントミラー回路２１Ｃａ及び２１Ｃｂをカスケード接続したカレントミラー回路部２１Ｃを示したが、本発明はこれに限定されるものではなく、２組以上の複数のカレントミラー回路をカスケード接続するものであってもよい。
【００７３】
また、電流生成部２０Ｃに適用されるスイッチ回路部２２Ｃは、負荷が接続される電流出力接点ＯＵＴｉと上記各接点Ｎｐ、Ｎｑ、Ｎｒ、Ｎｓとの間に電流路が接続されるとともに、制御端子に上記各ラッチ回路ＬＣ０〜ＬＣ３から個別に出力される出力信号ｄ１０＊〜ｄ１３＊が並列的に印加される複数（４個）のｐチャネル型トランジスタＴＰ２６、ＴＰ２７、ＴＰ２８、ＴＰ２９と、を備えた構成を有している。
【００７４】
ここで、カレントミラー回路部２１Ｃを構成する各単位電流トランジスタＴＰ２２ａ及びＴＰ２２ｂ、ＴＰ２３ａ及びＴＰ２３ｂ、ＴＰ２４ａ及びＴＰ２４ｂ、ＴＰ２５ａ及びＴＰ２５ｂに流れる単位電流Ｉｓｐ〜Ｉｓｓが、基準電流トランジスタＴＰ２１ａ及びＴＰ２１ｂに流れる基準電流Ｉｒｅｆに対して、各々異なる所定の比率の電流値を有するように、各トランジスタサイズの合計が設定されている。
【００７５】
ここで、上述した第１の実施形態と同様に、本実施形態においても、カレントミラー回路部２１Ｃを構成する各２個の単位電流トランジスタＴＰ２２ａ及びＴＰ２２ｂ、ＴＰ２３ａ及びＴＰ２３ｂ、ＴＰ２４ａ及びＴＰ２４ｂ、ＴＰ２５ａ及びＴＰ２５ｂのトランジスタサイズの合計（すなわち、チャネル長を一定とした場合のチャネル幅の合計）が、基準電流トランジスタＴＰ２１ａ及びＴＰ２１ｂを基準として、所定の比率になるように形成され、各単位電流トランジスタＴＰ２２ａ及びＴＰ２２ｂ、ＴＰ２３ａ及びＴＰ２３ｂ、ＴＰ２４ａ及びＴＰ２４ｂ、ＴＰ２５ａ及びＴＰ２５ｂの電流路に流れる単位電流Ｉｓｐ〜Ｉｓｓが、基準電流トランジスタＴＰ２１ａ及びＴＰ２１ｂに流れる基準電流Ｉｒｅｆに対して、各々異なる所定の比率の電流値を有するように設定されている。
【００７６】
これにより、本実施形態に係る電流生成供給回路２０Ｃにおいても、基準電流トランジスタ及び単位電流トランジスタを構成する各電界効果型トランジスタに印加される電圧を実質的に低減して、ソース−ドレイン耐圧を向上させることができるので、デジタル信号ｄ０〜ｄ３（すなわち、データラッチ部からの出力信号ｄ１０＊〜ｄ１３＊）により規定される指定階調に対して良好な線形性を有する出力電流特性（図４（ｂ）参照）が得られ、負荷の駆動状態を線形性良く制御することができる。
【００７７】
＜表示装置の第１の実施形態＞
次に、上述したような構成及び機能を有する電流生成供給回路を、データドライバに適用した表示装置について、具体的に説明する。
図８は、本発明に係る電流生成供給回路を適用可能な表示装置の第１の実施形態を示す概略ブロック図であり、図９は、本実施形態に係る表示装置に適用される表示パネルの一例を示す概略構成図である。ここでは、表示パネルとしてアクティブマトリクス方式に対応した表示画素を備えた構成について説明する。また、本実施形態においては、電流印加方式を採用した構成について説明する。
【００７８】
図８、図９に示すように、本実施形態に係る表示装置１００Ａは、概略、複数の表示画素（負荷）がマトリクス状に配列された表示パネル１１０Ａと、表示パネル１１０Ａの行方向に配列された表示画素群ごとに共通に接続された、走査ライン（走査線）ＳＬａ、ＳＬｂに接続された走査ドライバ（走査駆動手段）１２０Ａと、表示パネル１１０Ａの列方向に配列された表示画素群ごとに共通に接続された、データライン（信号線）ＤＬに接続されたデータドライバ（信号駆動手段）１３０Ａと、走査ドライバ１２０Ａ及びデータドライバ１３０Ａの動作状態を制御する各種制御信号を生成、出力するシステムコントローラ１４０Ａと、表示装置２００Ａの外部から供給される映像信号に基づいて、表示データやタイミング信号等を生成する表示信号生成回路１５０Ａと、を備えて構成されている。
【００７９】
以下、上記各構成について具体的に説明する。
（表示パネル１１０Ａ）
表示パネル１１０Ａは、具体的には、図９に示すように、各行ごとの表示画素群に対応して、各々、並列に配設された一対の走査ラインＳＬａ、ＳＬｂと、各列ごとの表示画素群に対応するとともに、走査ラインＳＬａ、ＳＬｂに対して直交するように配設されたデータラインＤＬと、これらの直交するラインの各交点近傍に配列された複数の表示画素（図９中、後述する画素駆動回路ＤＣｘ及び有機ＥＬ素子ＯＥＬからなる構成）と、を備えた構成を有している。
【００８０】
表示画素は、例えば、走査ドライバ１２０Ａから走査ラインＳＬａを介して印加される走査信号Ｖｓｅｌ、走査ラインＳＬｂを介して印加される走査信号Ｖｓｅｌ＊（走査ラインＳＬａに印加される走査信号Ｖｓｅｌの極性反転信号）、及び、データドライバ１３０ＡからデータラインＤＬを介して供給される階調電流Ｉｐｉｘ（上述した負荷駆動電流ＩＤに相当する）に基づいて、各表示画素における階調電流Ｉｐｉｘの書込動作及び発光動作を制御する画素駆動回路ＤＣｘと、該画素駆動回路ＤＣｘから供給される発光駆動電流の電流値に応じて発光輝度が制御される、周知の有機ＥＬ素子（発光素子）ＯＥＬと、を有して構成されている。なお、本実施形態においては、電流駆動型の発光素子として有機ＥＬ素子ＯＥＬを適用した場合について示すが、発光ダイオード等の他の発光素子を適用するものであってもよい。
【００８１】
ここで、画素駆動回路ＤＣｘは、概略、走査信号Ｖｓｅｌ、Ｖｓｅｌ＊に基づいて各表示画素の選択／非選択状態を制御し、選択状態において表示データに応じた階調電流Ｉｐｉｘを取り込んで電圧レベルとして保持し、非選択状態において上記保持した電圧レベルに基づく発光駆動電流を有機ＥＬ素子ＯＥＬに供給して、所定の輝度階調で発光させる動作を維持する機能を有している。なお、画素駆動回路ＤＣｘに適用可能な回路構成例については後述する。
【００８２】
（走査ドライバ１２０Ａ）
走査ドライバ１２０Ａは、システムコントローラ１４０Ａから供給される走査制御信号に基づいて、所定のタイミングで各走査ラインＳＬａ、ＳＬｂに選択レベルの走査信号Ｖｓｅｌ（例えば、ハイレベル）及びＶｓｅｌ＊（例えば、ローレベル）を順次印加することにより、各行ごとの表示画素群を選択状態とし、データドライバ１３０Ａにより表示データに基づく階調電流Ｉｐｉｘを各データラインＤＬに供給して、各表示画素に書き込むように制御する。
【００８３】
走査ドライバ１２０Ａは、具体的には、図９に示すように、シフトレジスタとバッファからなるシフトブロックＳＢを、各行の走査ラインＳＬａ、ＳＬｂごとに対応して複数段備え、システムコントローラ１４０Ａから供給される走査制御信号（走査スタート信号ＳＳＴＲ、走査クロック信号ＳＣＬＫ等）に基づいて、シフトレジスタにより表示パネル１１０Ａの上方から下方に順次シフトしつつ出力されるシフト信号が、バッファを介して所定の電圧レベル（選択レベル）を有する走査信号Ｖｓｅｌとして各走査ラインＳＬａに印加されるとともに、該走査信号Ｖｓｅｌを極性反転した電圧レベルが走査信号Ｖｓｅｌ＊として各走査ラインＳＬｂに印加される。
【００８４】
（データドライバ１３０Ａ）
データドライバ１３０Ａは、システムコントローラ１４０Ａから供給されるデータ制御信号（後述するサンプリングスタート信号ＳＴＲ、シフトクロック信号ＳＦＣ等）に基づいて、表示信号生成回路１５０Ａから供給される複数ビットのデジタル信号からなる表示データを取り込んで保持し、当該表示データに対応する電流値を有する階調電流Ｉｐｉｘを生成して、各データラインＤＬに同時並行的に供給するように制御する。すなわち、本実施形態に係るデータドライバ１３０Ａにおいては、上述した電流生成供給回路（図１及び図２参照）の構成及び機能を良好に適用することができる。なお、データドライバ１３０Ａの具体的な回路構成やその駆動制御動作については、詳しく後述する。
【００８５】
（システムコントローラ１４０Ａ）
システムコントローラ１４０Ａは、後述する表示信号生成回路１５０Ａから供給されるタイミング信号に基づいて、少なくとも、走査ドライバ１２０Ａ及びデータドライバ１３０Ａの各々に対して、走査制御信号（上述した走査スタート信号ＳＳＴＲや走査クロック信号ＳＣＬＫ等）及びデータ制御信号（上述したサンプリングスタート信号ＳＴＲやシフトクロック信号ＳＦＣ等）を生成して出力することにより、各ドライバを所定のタイミングで動作させて、表示パネル１１０Ａに走査信号Ｖｓｅｌ、Ｖｓｅｌ＊及び階調電流Ｉｐｉｘを出力させ、画素駆動回路ＤＣｘにおける所定の制御動作を連続的に実行させて、映像信号に基づく所定の画像情報を表示パネル１１０Ａに表示させる制御を行う。
【００８６】
（表示信号生成回路１５０Ａ）
表示信号生成回路１５０Ａは、例えば、表示装置１００Ａの外部から供給される映像信号から輝度階調信号成分を抽出し、表示パネル１１０Ａの１行分ごとに、該輝度階調信号成分を、複数ビットのデジタル信号からなる表示データとしてデータドライバ１３０Ａに供給する。ここで、上記映像信号が、テレビ放送信号（コンポジット映像信号）のように、画像情報の表示タイミングを規定するタイミング信号成分を含む場合には、表示信号生成回路１５０Ａは、上記輝度階調信号成分を抽出する機能のほか、タイミング信号成分を抽出してシステムコントローラ１４０Ａに供給する機能を有するものであってもよい。この場合においては、上記システムコントローラ１４０Ａは、表示信号生成回路１５０Ａから供給されるタイミング信号に基づいて、走査ドライバ１２０Ａやデータドライバ１３０Ａに対して供給する上記走査制御信号及びデータ制御信号を生成する。
【００８７】
なお、本実施形態において、表示パネル１１０Ａとその周辺に付設されるドライバやコントローラ等の周辺回路との実装構造については、特に限定するものではないが、例えば、少なくとも、表示パネル１１０Ａと走査トランジスタ１２０Ａ及びデータドライバ１３０Ａが単一の基板上に形成されているものであってもよいし、データドライバ１３０Ａのみ、もしくは、走査ドライバ１２０Ａ及びデータドライバ１３０Ａを、表示パネル１１０Ａとは別個に設けて電気的に接続するようにしたものであってもよい。
【００８８】
（表示画素の第１の構成例）
次いで、上述した表示装置（表示パネル１１０Ａ）の各表示画素に適用される画素駆動回路について簡単に説明する。
図１０は、本実施形態に適用される表示画素（画素駆動回路）の第１の実施例を示す回路構成図である。なお、ここで示す画素駆動回路は、本発明に係る表示装置に適用可能な一例を示すものにすぎず、同等の機能を有する他の回路構成を適用するものであってもよいことはいうまでもない。
【００８９】
図１０に示すように、本実施例に係る画素駆動回路ＤＣｘは、走査ラインＳＬａ、ＳＬｂとデータラインＤＬとの交点近傍に、ゲート端子が走査ラインＳＬａに、ソース端子及びドレイン端子が電源接点Ｖｄｄ及び接点Ｎｘａに各々接続されたｐチャネル型トランジスタＴｒ３１と、ゲート端子が走査ラインＳＬｂに、ソース端子及びドレイン端子がデータラインＤＬ及び接点Ｎｘａに各々接続されたｐチャネル型トランジスタＴｒ３２と、ゲート端子が接点Ｎｘｂに、ソース端子及びドレイン端子が接点Ｎｘａ及び接点Ｎｘｃに各々接続されたｐチャネル型トランジスタＴｒ３３と、ゲート端子が走査ラインＳＬに、ソース端子及びドレイン端子が接点Ｎｘｂ及び接点Ｎｘｃに各々接続されたｎチャネル型トランジスタＴｒ３４と、接点Ｎｘａ及び接点Ｎｘｂ間に接続されたコンデンサＣｘと、を備えた構成を有している。ここで、電源接点Ｖｄｄは、例えば、図示を省略した電源ラインを介して、高電位電源に接続され、常時、もしくは、所定のタイミングで一定の高電位電圧が印加される。
【００９０】
また、このような画素駆動回路ＤＣｘから供給される発光駆動電流により発光輝度が制御される有機ＥＬ素子ＯＥＬは、アノード端子が上記画素駆動回路ＤＣｘの接点Ｎｘｃに、カソード端子が低電位電源（例えば、接地電位Ｖｇｎｄ）に各々接続された構成を有している。ここで、コンデンサＣｘは、トランジスタＴｒ３３のゲート−ソース間に形成される寄生容量であってもよいし、その寄生容量に加えてゲート−ソース間にさらに、容量素子を別個に付加するようにしたものであってもよい。
【００９１】
このような構成を有する画素駆動回路ＤＣｘにおける有機ＥＬ素子ＯＥＬの駆動制御動作は、まず、書込動作期間において、例えば、走査ラインＳＬａに対してハイレベル（選択レベル）の走査信号Ｖｓｅｌを印加するとともに、走査ラインＳＬｂに対してローレベルの走査信号Ｖｓｅｌ＊を印加し、このタイミングに同期して、有機ＥＬ素子ＯＥＬを所定の輝度階調で発光動作させるための階調電流ＩｐｉｘをデータラインＤＬに供給する。ここでは、階調電流Ｉｐｉｘとして、正極性の電流を供給し、データドライバ１３０Ａ側からデータラインＤＬを介して表示画素（画素駆動回路ＤＣｘ）方向に当該電流が流し込まれる（印加する）ように設定する。
【００９２】
これにより、画素駆動回路ＤＣｘを構成するトランジスタＴｒ３２及びＴｒ３４がオン動作するとともに、トランジスタＴｒ３１がオフ動作して、データラインＤＬに供給された階調電流Ｉｐｉｘに対応する正の電位が接点Ｎｘａに印加される。また、接点Ｎｘｂ及び接点Ｎｘｃ間が短絡して、トランジスタＴｒ３３のゲート−ドレイン間が同電位に制御される。これにより、トランジスタＴｒ３３がオフ動作するとともに、コンデンサＣｘの両端（接点Ｎｘａ及び接点Ｎｘｂ間）には、階調電流Ｉｐｉｘに応じた電位差が生じ、該電位差に対応する電荷が蓄積され、電圧成分として保持される（充電される）。
【００９３】
次いで、発光動作期間において、走査ラインＳＬａに対してローレベル（非選択レベル）の走査信号Ｖｓｅｌを印加するとともに、走査ラインＳＬｂに対してハイレベルの走査信号Ｖｓｅｌ＊を印加し、このタイミングに同期して、階調電流Ｉｐｉｘの供給を遮断する。これにより、トランジスタＴｒ３２及びＴｒ３４がオフ動作してデータラインＤＬ及び接点Ｎｘａ間、並びに、接点Ｎｘｂ及び接点Ｎｘｃ間が電気的に遮断されることにより、コンデンサＣｘは、上述した書込動作において蓄積された電荷を保持する。
【００９４】
このように、コンデンサＣｘが書込動作時の充電電圧を保持することにより、接点Ｎｘａ及び接点Ｎｘｂ間（トランジスタのＴｒ３３のゲート−ソース間）の電位差が保持されることになり、トランジスタＴｒ３３はオン動作する。また、上記走査信号Ｖｓｅｌ（ローレベル）の印加により、トランジスタＴｒ３１が同時にオン動作するので、電源接点（高電位電源）ＶｄｄからトランジスタＴｒ３１及びＴｒ３３を介して、有機ＥＬ素子ＯＥＬに階調電流Ｉｐｉｘ（より詳しくは、コンデンサＣｘに保持された電荷）に応じた発光駆動電流が流れ、有機ＥＬ素子ＯＥＬが所定の輝度階調で発光する。このように、本実施例に係る画素駆動回路においては、ｐチャネル型トランジスタＴｒ３３は、発光駆動用トランジスタとしての機能を有していることになる。
【００９５】
（データドライバの第１の構成例）
次いで、上述した表示装置に適用されるデータドライバの構成について説明する。
本実施形態に係る表示装置１００Ａに適用されるデータドライバ１３０Ａは、概略、図１に示した電流生成供給回路ＩＬＡが各データラインＤＬに対応して、階調電流供給回路として個別に設けられ、各々の階調電流供給回路に対して、例えば、単一の定電流発生源ＩＲから共通の電流供給線Ｌｓを介して、一定の電流値を有する負の基準電流が供給される（すなわち、基準電流が引き抜かれるように供給される）ように構成されている。
図１１は、本実施形態に係る表示装置に適用されるデータドライバの第１の実施例を示す概略構成図である。ここでは、上述した電流生成供給回路（図１及び図２）の構成と対応付けながら説明し、同等の構成については同等の符号を付して説明する。
【００９６】
本実施例に係るデータドライバ１３０Ａは、例えば、図１１に示すように、システムコントローラ１４０Ａからデータ制御信号として供給されるシフトクロック信号ＳＦＣに基づいて、サンプリングスタート信号ＳＴＲをシフトしつつ、所定のタイミングでシフト信号ＳＲ１、ＳＲ２、ＳＲ３、・・・（上述したタイミング制御信号ＣＬＫに相当する）を順次出力するシフトレジスタ回路１３１Ａと、該シフトレジスタ回路１３１Ａからのシフト信号ＳＲ１、ＳＲ２、ＳＲ３、・・・の入力タイミングに基づいて、表示信号生成回路１５０Ａから順次供給される１行分の表示データＤ０〜Ｄｑ（ここでは、図１及び図２に示した電流生成供給回路に入力されるデジタル信号ｄ０〜ｄ３に対応させて、便宜的にｑ＝３とする）を順次取り込み、各表示画素における発光輝度に対応した階調電流Ｉｐｉｘを生成して、各データラインＤＬ１、ＤＬ２、・・・を介して供給する階調電流供給回路群１３２Ａと、該階調電流供給回路群１３２Ａを構成し、各データラインＤＬ１、ＤＬ２、・・・ごとに設けられた階調電流供給回路ＰＸＡ１、ＰＸＡ２、ＰＸＡ３、・・・（上述した電流生成供給回路ＩＬＡに相当する；以下、便宜的に「階調電流供給回路ＰＸＡ」とも記す）に対して、データドライバ１３０Ａの外部に設けられた定電流発生源ＩＲから一定の電流値を有する基準電流Ｉｒｅｆを定常的に供給する共通の電流供給線Ｌｓと、を備えて構成されている。
【００９７】
ここで、各階調電流供給回路ＰＸＡ１、ＰＸＡ２、ＰＸＡ３、・・・は、データラッチ部１０１、１０２、１０３、・・・（上述したデータラッチ部１０に相当する）及び階調電流生成部２０１Ａ、２０２Ａ、２０３Ａ、・・・（上述した電流生成部２０Ａに相当する）を備えた構成を有している。
なお、本実施形態においては、データドライバ１３０Ａに設けられた全ての階調電流供給回路ＰＸＡ１、ＰＸＡ２、ＰＸＡ３、・・・に対して、単一の定電流発生源ＩＲからの基準電流Ｉｒｅｆが共通に供給される構成を示したが、本発明はこれに限定されるものではなく、表示装置において、例えば、データドライバが表示パネルに対して複数個用いられている場合には、各データドライバごとに定電流発生源を個別に備えるものであってもよく、さらには、単一のデータドライバ内に設けられた複数の階調電流供給回路ごとに定電流発生源を備えるものであってもよい。
【００９８】
＜表示装置の駆動制御方法＞
次に、上述した構成を有する表示装置の動作について、図面を参照して説明する。
図１２は、本実施例に係るデータドライバにおける制御動作の一例を示すタイミングチャートであり、図１３は、本実施形態に係る表示パネル（表示画素）における制御動作の一例を示すタイミングチャートである。ここでは、図１１に示したデータドライバの構成に加え、図１及び図２に示した電流生成供給回路の構成も適宜参照しながら説明する。
【００９９】
まず、データドライバ１３０Ａにおける制御動作は、上述した階調電流供給回路ＰＸＡ１、ＰＸＡ２、ＰＸＡ３、・・・に設けられたデータラッチ部１０１、１０２、１０３、・・・に、表示信号生成回路１５０Ａから供給される表示データＤ０〜Ｄ３を取り込み保持するとともに、該表示データＤ０〜Ｄ３に基づく反転出力信号を一定期間出力する信号保持動作と、データラッチ部１０１、１０２、１０３、・・・から出力される反転出力信号ｄ１０＊〜ｄ１３＊、ｄ２０＊〜ｄ２３＊、ｄ３０＊〜ｄ３３＊、・・・に基づいて、各階調電流供給回路ＰＸＡ１、ＰＸＡ２、ＰＸＡ３、・・・に設けられた階調電流生成部２０１Ａ、２０２Ａ、２０３Ａ、・・・により、上記表示データＤ０〜Ｄ３に対応する階調電流Ｉｐｉｘを生成して各データラインＤＬ１、ＤＬ２、ＤＬ３、・・・を介して各表示画素に個別に供給する電流生成供給動作と、を設定することにより実行される。そして、これらの信号保持動作及び電流生成供給動作は、１水平選択期間内の帰線期間を除く期間に、各階調電流供給回路ＰＸＡ１、ＰＸＡ２、ＰＸＡ３、・・・ごとに順次実行される。
【０１００】
ここで、信号保持動作においては、図１２に示すように、シフトレジスタ回路１３１Ａから順次出力されるシフト信号ＳＲ１、ＳＲ２、ＳＲ３、・・・に基づいて、上記各データラッチ部１０１、１０２、１０３、・・・により、各列の表示画素（すなわち、各データラインＤＬ１、ＤＬ２、ＤＬ３、・・・）に対応して切り替わる表示データＤ０〜Ｄ３を順次取り込む動作が１行分連続的に実行され、該表示データＤ０〜Ｄ３が取り込まれたデータラッチ部１０１、１０２、１０３、・・・から順に、一定期間（次のシフト信号ＳＲ１、ＳＲ２、ＳＲ３、・・・が出力されるまでの期間）、反転出力信号ｄ１０＊〜ｄ１３＊、ｄ２０＊〜ｄ２３＊、ｄ３０＊〜ｄ３３＊、・・・が各階調電流生成部２０１Ａ、２０２Ａ、２０３Ａ、・・・に出力される。
【０１０１】
また、電流生成供給動作においては、図１２に示すように、反転出力信号ｄ１０＊〜ｄ１３＊、ｄ２０＊〜ｄ２３＊、ｄ３０＊〜ｄ３３＊、・・・に基づいて、各階調電流生成部２０１Ａ、２０２Ａ、２０３Ａ、・・・に設けられた複数のスイッチトランジスタ（図２に示したトランジスタＴＰ１６〜ＴＰ１９）のオン／オフ状態が制御され、オン動作したスイッチトランジスタに接続された単位電流トランジスタ（図５に示したトランジスタＴＰ１２ａ及びＴＰ１２ｂ、ＴＰ１３ａ及びＴＰ１３ｂ、ＴＰ１４ａ及びＴＰ１４ｂ、ＴＰ１５ａ及びＴＰ１５ｂ）に流れる単位電流の合成電流が、階調電流Ｉｐｉｘとして各データラインＤＬ１、ＤＬ２、ＤＬ３、・・・を介して順次供給される。
【０１０２】
ここで、階調電流Ｉｐｉｘは、例えば、全てのデータラインＤＬ１、ＤＬ２、ＤＬ３、・・・に対して、少なくとも一定期間、並列的（すなわち、同時並行的）に供給されるように設定される。また、本実施形態においては、上述したように、基準電流Ｉｒｅｆに対して予めトランジスタサイズにより規定された所定比率（例えば、ａ×２ｋ；ｋ＝０、１、２、３、・・・）の電流値を有する複数の単位電流を生成し、上記反転出力信号ｄ１０＊〜ｄ１３＊、ｄ２０＊〜ｄ２３＊、ｄ３０＊〜ｄ３３＊、・・・に基づいてスイッチトランジスタがオン／オフ動作することにより、所定の単位電流を選択して合成し、正極性の階調電流Ｉｐｉｘを生成して、データドライバ１３０Ａ側からデータラインＤＬ１、ＤＬ２、ＤＬ３、・・・方向に流し込むように該階調電流Ｉｐｉｘを供給する。
【０１０３】
なお、本実施例に係るデータドライバ１３０Ａにおいては、図１１に示したように、定電流発生源ＩＲから一定の電流値を有する基準電流Ｉｒｅｆが供給される共通の電流供給線Ｌｓに対して、複数の階調電流供給回路ＰＸＡ１、ＰＸＡ２、ＰＸＡ３、・・・が並列的に接続された構成を有し、図１２に示したように、各階調電流供給回路ＰＸＡ１、ＰＸＡ２、・・・において、表示データＤ０〜Ｄ３に基づいて、同時並行的に各データラインＤＬ１、ＤＬ２、ＤＬ３、・・・（表示画素）に供給される階調電流Ｉｐｉｘが生成されるので、電流供給線Ｌｓを介して各階調電流供給回路ＰＸＡ１、ＰＸＡ２、・・・に供給される電流は、定電流発生源ＩＲにより供給される基準電流Ｉｒｅｆそのものではなく、階調電流供給回路の数（すなわち、表示パネル１１０Ａに配設されたデータラインの数に相当する；例えば、ｍ個）に応じて、略均等分割された電流値（Ｉｒｅｆ／ｍ）を有する電流が供給されることになる。
【０１０４】
したがって、各階調電流供給回路ＰＸＡ１、ＰＸＡ２、・・・の階調電流生成部２０１Ａ、２０２Ａ、２０３Ａ、・・・を構成するカレントミラー回路部において設定される基準電流に対する各単位電流の電流値の比率（基準電流トランジスタに対する単位電流トランジスタのチャネル幅の比）を、各階調電流供給回路ＰＸＡ１、ＰＸＡ２、・・・（階調電流生成部２０１Ａ、２０２Ａ、２０３Ａ、・・・）に供給される上記電流値（Ｉｒｅｆ／ｍ）を勘案して、例えば、図２に示した回路構成における比率のｍ倍に設定するようにしてもよい。
【０１０５】
また、他の構成として、各階調電流供給回路ＰＸＡ１、ＰＸＡ２、・・・（階調電流生成部２０１Ａ、２０２Ａ、２０３Ａ、・・・）に、例えば、シフトレジスタ回路１３１Ａから出力されるシフト信号ＳＲ１、ＳＲ２、ＳＲ３、・・・に基づいて選択的にオン動作するスイッチ手段を設け、各階調電流生成部２０１Ａ、２０２Ａ、２０３Ａ、・・・において、表示データＤ０〜Ｄ３に基づいて階調電流Ｉｐｉｘが生成される電流生成供給動作の期間のみ、上記定電流発生源ＩＲからの基準電流Ｉｒｅｆをそのまま、各階調電流供給回路ＰＸＡ１、ＰＸＡ２、・・・（階調電流生成部２０１Ａ、２０２Ａ、２０３Ａ、・・・）に選択的に供給するようにしてもよい。
【０１０６】
そして、表示パネル１１０Ａ（表示画素）における制御動作は、図１３に示すように、表示パネル１１０Ａ一画面に所望の画像情報を表示する一走査期間Ｔｓｃを１サイクルとして、該一走査期間Ｔｓｃ内に、特定の走査ラインに接続された表示画素群を選択して、データドライバ１３０Ａから供給される表示データに対応する階調電流Ｉｐｉｘを書き込み、信号電圧として保持する書込動作期間（表示画素の選択期間）Ｔｓｅと、該保持された信号電圧に基づいて、上記表示データに応じた発光駆動電流を有機ＥＬ素子ＯＥＬに供給して、所定の輝度階調で発光動作させる発光動作期間（表示画素の非選択期間）Ｔｎｓｅと、を設定（Ｔｓｃ＝Ｔｓｅ＋Ｔｎｓｅ）し、各動作期間において、上述した画素駆動回路ＤＣｘと同等の駆動制御を実行する。ここで、各行ごとに設定される書込動作期間Ｔｓｅは、相互に時間的な重なりが生じないように設定される。また、書込動作期間Ｔｓｅは、少なくとも、上記データドライバ１３０Ａにおける電流生成供給動作において、各データラインＤＬへ階調電流Ｉｐｉｘを並列的に供給する一定期間を含む期間に設定される。
【０１０７】
すなわち、表示画素への書込動作期間Ｔｓｅにおいては、図１３に示すように、特定の行（ｉ行目）の表示画素に対して、走査ドライバ１２０Ａにより走査ラインＳＬａ、ＳＬｂを所定の信号レベルに走査することにより、データドライバ１３０Ａにより各データラインＤＬに並列的に供給された階調電流Ｉｐｉｘを電圧成分として一斉に保持する動作を実行し、その後の発光動作期間Ｔｎｓｅにおいては、上記書込動作期間Ｔｓｅに保持された電圧成分に基づく発光駆動電流を有機ＥＬ素子ＯＥＬに継続的に供給することにより、表示データに対応する輝度階調で発光する動作が継続される。
このような一連の駆動制御動作を、図１３に示すように、表示パネル１１０Ａを構成する全ての行の表示画素群について順次繰り返し実行することにより、表示パネル１画面分の表示データが書き込まれて、各表示画素が所定の輝度階調で発光し、所望の画像情報が表示される。
【０１０８】
したがって、本実施形態に係るデータドライバ１３０Ａ及び表示装置１００Ａにおいて、各データラインＤＬを介して特定の行の表示画素群に供給される階調電流Ｉｐｉｘが、各階調電流供給回路ＰＸＡ１、ＰＸＡ２、・・・により、単一の定電流発生源ＩＲから共通の電流供給線Ｌｓを介して供給される基準電流Ｉｒｅｆ（または、基準電流Ｉｒｅｆを階調電流供給回路の数で均等分割した電流）に基づいて生成されるので、表示データＤ０〜Ｄ３に応じて各階調電流供給回路ＰＸＡ１、ＰＸＡ２、・・・に供給される基準電流Ｉｒｅｆの電流値が変動することがなく、電流供給線Ｌｓの充放電動作に起因するデータドライバの動作速度の低下を抑制して、表示装置における表示応答特性並びに表示画質の向上を図ることができる。
【０１０９】
また、データドライバ（階調電流供給回路）において、上記基準電流が流れる基準電流トランジスタに対して、カレントミラー回路構成を有する複数の単位電流トランジスタのチャネル幅を、各々所定の比率（例えば、２ｋ倍）になるように設定することにより、基準電流に対して該比率により規定される電流値を有する複数の単位電流を流すことができ、表示データ（複数ビットのデジタル信号）に基づいて、これらを適宜合成することにより、２ｋ段階の電流値を有する階調電流を生成することができるので、表示データに対応した適切な電流値を有するアナログ電流からなる階調電流を、比較的簡易な回路構成により生成することができ、表示画素を適正な輝度階調で発光動作させることができる。
【０１１０】
特に、カレントミラー回路部を構成する基準電流トランジスタ及び単位電流トランジスタとして、各々、複数の電界効果型トランジスタを直列接続するとともに、各制御端子を共通に接続したマルチゲート構造を有する回路構成を適用しているので、各電界効果型トランジスタに印加される電圧を実質的に低減して、ソース−ドレイン耐圧を向上させることができ、階調電流供給回路において表示データ（すなわち、指定階調）に対する階調電流の特性（出力電流特性）として、良好な線形性が得られる（図４（ｂ）参照）。したがって、表示画素の発光輝度を線形性良く制御することができるので、比較的低い階調で発光動作させるような場合であっても、表示画素を表示データに基づいた適切な輝度階調で発光動作させることができ、表示画質の向上を図ることができる。
【０１１１】
なお、本実施形態においては、データドライバ及び表示画素（画素駆動回路）として、電流印加方式に対応した構成を示したが、本発明はこれに限定されるものではなく、図５、図６に示したように、表示画素側からデータドライバ方向に階調電流を引き込むように供給する電流シンク方式の回路構成を適用することもできる。また、図２、図６に示したように、階調電流供給回路のカレントミラー回路部を構成する各電界効果型トランジスタとして、マルチゲート構造を適用した回路構成を示したが、本発明はこれに限定されるものではなく、図７に示したように、カレントミラー回路を多段接続したカスケード接続構造を有する回路構成を適用するものであってもよい。
以下、上述した表示装置（表示パネル）の他の例として、電流シンク方式を適用した場合について説明する。
【０１１２】
＜表示装置の第２の実施形態＞
電流シンク方式を適用した表示装置は、概略、上述した第１の実施形態（図８、図９参照）と略同様の走査ドライバ、システムコントローラ及び表示信号生成回路を備えた構成を有しているが、表示パネルを構成する各表示画素（画素駆動回路）及びデータドライバが以下に示すように異なる構成を有している。
【０１１３】
（表示画素の第２の構成例）
図１４は、本実施形態に適用される画素駆動回路の一実施例を示す回路構成図であり、図１５は、本実施形態に係る表示装置の要部構成を示す概略構成図である。なお、ここで示す画素駆動回路は、本発明に係る表示装置に適用可能な一例を示すものにすぎず、同等の動作機能を有する他の回路構成を有するものであってもよいことはいうまでもない。また、第１の実施形態に示した表示装置及び画素駆動回路と同等の構成については、同等の符号を付してその説明を簡略化又は省略する。
【０１１４】
図１４に示すように、本実施例に係る画素駆動回路ＤＣｙは、例えば、走査ラインＳＬとデータラインＤＬとの交点近傍に、ゲート端子が走査ラインＳＬに、ソース端子が走査ラインＳＬに平行に配設された電源ラインＶＬに、ドレイン端子が接点Ｎｙａに各々接続されたｎチャネル型トランジスタＴｒ４１と、ゲート端子が走査ラインＳＬに、ソース端子及びドレイン端子がデータラインＤＬ及び接点Ｎｙｂに各々接続されたｎチャネル型トランジスタＴｒ４２と、ゲート端子が接点Ｎｙａに、ソース端子及びドレイン端子が電源ラインＶＬ及び接点Ｎｙｂに各々接続されたｎチャネル型トランジスタＴｒ４３と、接点Ｎｙａ及び接点Ｎｙｂ間に接続されたコンデンサＣｙと、を備えた構成を有している。
【０１１５】
また、このような画素駆動回路ＤＣｙから供給される発光駆動電流により発光輝度が制御される有機ＥＬ素子ＯＥＬは、アノード端子が上記画素駆動回路ＤＣｙの接点Ｎｙｂに、カソード端子が接地電位Ｖｇｎｄに各々接続された構成を有している。ここで、コンデンサＣｙは、ｎチャネル型トランジスタＴｒ４３のゲート−ソース間に形成される寄生容量であってもよいし、その寄生容量に加えてゲート−ソース間にさらに、容量素子を別個に付加するようにしたものであってもよい。
【０１１６】
ここで、電源ラインＶＬは、図１５に示すように、走査ラインと並行して配設されて各行の表示画素ごとに共通に接続され、その一端が電源ドライバ１６０Ｂに接続されている。電源ドライバ１６０Ｂは、概略、第１の実施形態に示した走査ドライバ１２０Ａと同等の構成を有し、各行ごとの電源ラインＶＬに対応して複数段のシフトブロック（図示を省略）を備え、システムコントローラから供給され、上記走査制御信号に同期する電源制御信号（電源スタート信号、電源クロック信号等）に基づいて、表示パネル１１０Ｂの上方から下方に順次シフトしつつ出力されたシフト信号が、所定の電圧レベル（例えば、走査ドライバ１２０Ｂによる選択状態においてはローレベル、非選択状態においてはハイレベル）を有する電源電圧Ｖｓｃとして各電源ラインＶＬに印加される。
【０１１７】
このような構成を有する画素駆動回路ＤＣｙにおける有機ＥＬ素子ＯＥＬの駆動制御動作は、まず、書込動作期間において、走査ラインＳＬに対して、選択レベル（ハイレベル）の走査信号Ｖｓｅｌを印加するとともに、電源ラインＶＬに対して、ローレベルの電源電圧Ｖｓｃを印加する。また、このタイミングに同期して、有機ＥＬ素子ＯＥＬを所定の輝度階調で発光動作させるために必要な所定の階調電流Ｉｐｉｘを、データドライバ１３０ＢからデータラインＤＬに供給する。ここでは、階調電流Ｉｐｉｘとして、負極性の電流を供給し、表示画素（画素駆動回路ＤＣｙ）側からデータラインＤＬを介してデータドライバ１３０Ｂ方向に当該電流を引き込むように設定する。
【０１１８】
これにより、画素駆動回路ＤＣｙを構成するｎチャネル型トランジスタＴｒ４１及びＴｒ４２がオン動作して、ローレベルの電源電圧Ｖｓｃが接点Ｎｙａに印加されるとともに、階調電流Ｉｐｉｘの引き込み動作によりｎチャネル型トランジスタＴｒ４２を介してローレベルの電源電圧Ｖｓｃよりも低電位の電圧レベルが接点Ｎｙｂに印加される。
このように、接点Ｎｙａ及びＮｙｂ間（ｎチャネル型トランジスタＴｒ４３のゲート−ソース間）に電位差が生じることにより、ｎチャネル型トランジスタＴｒ４３がオン動作して、電源ラインＶＬからｎチャネル型トランジスタＴｒ４３、接点Ｎｙｂ、ｎチャネル型トランジスタＴｒ４２を介して、データラインＤＬ方向に階調電流Ｉｐｉｘに対応した電流が流れる。
【０１１９】
このとき、コンデンサＣｙには、接点Ｎｙａ及びＮｙｂ間に生じた電位差に対応する電荷が蓄積され、電圧成分として保持される（充電される）。また、このとき、有機ＥＬ素子ＯＥＬのアノード端子（接点Ｎｙｂ）に印加される電位は、カソード端子の電位（接地電位）よりも低くなり、有機ＥＬ素子ＯＥＬに逆バイアス電圧が印加されることになるため、有機ＥＬ素子ＯＥＬには発光駆動電流が流れず、発光動作は行われない。
【０１２０】
次いで、発光動作期間においては、走査ラインＳＬに対して、非選択レベル（ローレベル）の走査信号Ｖｓｅｌを印加するとともに、電源ラインＶＬに対して、ハイレベルの電源電圧Ｖｓｃを印加する。また、このタイミングに同期して、階調電流Ｉｐｉｘの引き込み動作を停止する。
これにより、ｎチャネル型トランジスタＴｒ４１及びＴｒ４２がオフ動作して、接点Ｎｙａへの電源電圧Ｖｓｃの印加が遮断されるとともに、接点Ｎｙｂへの階調電流Ｉｐｉｘの引き込み動作に起因する電圧レベルの印加が遮断されるので、コンデンサＣｙは、上述した書込動作において蓄積された電荷を保持する。
【０１２１】
このように、コンデンサＣｙが書込動作時の充電電圧を保持することにより、接点Ｎｙａ及びＮｙｂ間（ｎチャネル型トランジスタのＴｒ４３のゲート−ソース間）の電位差が保持されることになり、ｎチャネル型トランジスタＴｒ４３はオン状態を維持する。また、電源ラインＶＬには、接地電位よりも高い電圧レベルを有する電源電圧Ｖｓｃが印加されるので、電源ラインＶＬからｎチャネル型トランジスタＴｒ４３、接点Ｎｙｂを介して、有機ＥＬ素子ＯＥＬに順バイアス方向に発光駆動電流が流れる。
【０１２２】
ここで、コンデンサＣｙに保持される電位差（充電電圧）は、上記書込動作時においてｎチャネル型トランジスタＴｒ４３に階調電流Ｉｐｉｘに対応する電流を流す際の電位差に相当するので、有機ＥＬ素子ＯＥＬに流れる発光駆動電流は、上記電流と同等の電流値を有することになり、発光動作期間においては、書込動作期間に書き込まれた階調電流に対応する電圧成分に基づいて、有機ＥＬ素子ＯＥＬは所望の輝度階調で発光する動作を継続する。
【０１２３】
したがって、このような一連の駆動制御動作を、走査ドライバ１２０Ｂ、電源ドライバ１６０Ｂ及び後述するデータドライバ１３０Ｂを用いて、図１３に示した動作制御と同様に、表示パネル１１０Ｂを構成する全ての行の表示画素群について順次繰り返し実行することにより、表示パネル１画面分の表示データが書き込まれて、各表示画素が所定の輝度階調で発光し、所望の画像情報が表示される。
【０１２４】
（データドライバの第２の構成例）
次いで、本実施形態に適用されるデータドライバの構成について説明する。
本実施形態に係る表示装置に適用されるデータドライバは、図１５に示すように、概略、図１１に示したデータドライバ１３０Ａと同等のシフトレジスタ回路１３１Ｂ及び電流供給線Ｌｓを備えるとともに、表示パネル１１０Ｂ（各表示画素）側から各データラインＤＬを介してデータドライバ１３０Ｂ方向に流れ込むように電流極性が設定された階調電流Ｉｐｉｘを生成する階調電流供給回路群１３２Ｂ（階調電流供給回路ＰＸＢ１、ＰＸＢ２、ＰＸＢ３、・・・）を備えた構成を有している。
【０１２５】
ここで、階調電流供給回路群１３２Ｂを構成する各階調電流供給回路ＰＸＢ１、ＰＸＢ２、ＰＸＢ３、・・・は、データラッチ部１０１、１０２、１０３、・・・（上述したデータラッチ部１０に相当する）及び階調電流生成部２０１Ｂ、２０２Ｂ、２０３Ｂ、・・・（上述した電流生成部２０Ｂに相当する）を備えた構成を有している。
【０１２６】
このような構成を有するデータドライバ１３０Ｂにおける制御動作は、上述した実施形態において示したデータドライバの駆動制御方法（図１２参照）と同様に、信号保持動作においては、シフトレジスタ回路１３１Ｂから順次出力されるシフト信号ＳＲ１、ＳＲ２、ＳＲ３、・・・に基づいて、各階調電流供給回路２０１Ｂ、２０２Ｂ、２０３Ｂ、・・・に設けられたデータラッチ部１０１、１０２、１０３、・・・により、各列ごとに順次取り込まれた表示データＤ０〜Ｄ３の非反転出力信号が階調電流生成部２０１Ｂ、２０２Ｂ、２０３Ｂ、・・・に出力される。
【０１２７】
また、電流生成供給動作においては、非反転出力信号に基づいて、階調電流生成部２０１Ｂ、２０２Ｂ、２０３Ｂ、・・・により複数の単位電流を生成、選択して合成し、負極性の階調電流Ｉｐｉｘを生成して、各表示画素側から各データラインＤＬ１、ＤＬ２、・・・を介して、データドライバ１３０Ｂ方向に該階調電流Ｉｐｉｘを引き込むように順次供給する。
【０１２８】
したがって、本実施形態に係るデータドライバ１３０Ｂを適用した表示装置においても、表示パネル（表示画素）に供給される各階調電流を、共通の電流供給線を介して供給される一定電流値の基準電流に基づいて生成することができるので、データドライバを構成する各階調電流供給回路に供給される電流値が変動することがなく、電流供給線の充放電動作に起因する動作速度の制約を緩和して、データドライバの動作速度を向上させることができる。また、各データラインに対応して個別に設けられた階調電流供給回路により表示データに応じた適切な電流値を有する（すなわち、良好な線形性の出力電流特性を有する）階調電流を生成して、各表示画素に供給することができるので、良好な階調表示を実現することができる。
【０１２９】
＜表示装置の第３の実施形態＞
次に、本発明に係る表示装置（データドライバ）の第３の実施形態について説明する。
本実施形態に係る表示装置に適用されるデータドライバは、概略、図１に示した電流生成供給回路ＩＬＡを基本構成とする階調電流供給回路が、各データラインごとに２組設けられ、所定の動作タイミングで各組の階調電流供給回路が、表示データの取り込み保持動作、及び、階調電流の生成供給動作を、交互かつ連続的に実行するように構成されている。ここで、本構成例においては、階調電流供給回路群に対して、単一の電流発生源から一定の電流値を有する負の基準電流が供給される。
【０１３０】
（データドライバの第３の構成例）
図１６は、本実施形態に係る表示装置に適用されるデータドライバの第３の実施例を示す概略構成図である。ここで、上述した実施形態と同等の構成については、同等の符号を付してその説明を簡略化又は省略する。
図１６に示すように、本実施例に係るデータドライバ１３０Ｃは、具体的には、図示を省略したシステムコントローラからデータ制御信号として供給されるシフトクロック信号ＳＦＣに基づいて、非反転クロック信号ＣＫａ及び反転クロック信号ＣＫｂを生成する反転ラッチ回路１３３Ｃと、該非反転クロック信号ＣＫａ及び反転クロック信号ＣＫｂに基づいて、サンプリングスタート信号ＳＴＲをシフトしつつ、所定のタイミングでシフト信号ＳＲ１、ＳＲ２、・・・（上述したタイミング制御信号ＣＬＫに相当する；以下、便宜的に「シフト信号ＳＲ」とも記す）を順次出力するシフトレジスタ回路１３１Ｃと、該シフトレジスタ回路１３１Ｃからのシフト信号ＳＲ１、ＳＲ２、・・・の入力タイミングに基づいて、図示を省略した表示信号生成回路から順次供給される１行分の表示データＤ０〜Ｄ３を順次取り込み、各表示画素における発光輝度に対応した階調電流Ｉｐｉｘを生成して、各データラインＤＬ１、ＤＬ２、・・・を介して供給（印加）する２組の階調電流供給回路群１３２Ｃ及び１３２Ｄと、システムコントローラからデータ制御信号として供給される切換制御信号ＳＥＬに基づいて、上記階調電流供給回路群１３２Ｃ及び１３２Ｄのいずれか一方を選択的に動作させるための選択設定信号（切換制御信号ＳＥＬの非反転信号ＳＬａ及び反転信号ＳＬｂ）を出力する選択設定回路１３４Ｃと、階調電流供給回路群１３２Ｃ及び１３２Ｄを構成する各階調電流供給回路ＰＸＣ１、ＰＸＣ２、・・・及びＰＸＤ１、ＰＸＤ２、・・・（以下、「階調電流供給回路部ＰＸＣ、ＰＸＤ」とも記す）に共通の電流供給線Ｌｓを介して一定の基準電流Ｉｒｅｆを供給する（負極性の電流を供給して引き抜く）定電流発生源ＩＲと、を備えて構成されている。
【０１３１】
（階調電流供給回路部ＰＸＣ、ＰＸＤ）
図１７は、本実施例に係るデータドライバに適用される階調電流供給回路の一具体例を示す構成図である。また、図１８は、本実施例に適用される階調電流供給回路を構成する階調電流生成部の一具体例を示す構成図であり、図１９は、本実施例に適用される階調電流供給回路を構成する階調電流生成部の他の具体例を示す構成図である。ここでは、上述した電流生成供給回路（図１、図２及び図７）の構成と対応付けながら説明する。また、上述した実施形態と同等の構成については、同等の符号を付してその説明を簡略化又は省略する。
【０１３２】
階調電流供給回路群１３２Ｃ、１３２Ｄを構成する各階調電流供給回路ＰＸＣ、ＰＸＤは、図１７に示すように、図１に示した電流生成供給回路ＩＬＡと同等の構成を有するデータラッチ部１０及び電流生成部２０Ｄと、データラッチ部１０からの非反転出力信号ｄ１０〜ｄ１３（非反転出力端子ＯＴ〜ＯＴ３の信号レベル）に基づいて、表示画素を黒表示動作等の特定の駆動状態で動作させる場合にのみ、表示画素（データラインＤＬ）に対して特定電圧を印加する特定状態設定部ＢＫＡと、選択設定回路１３４から出力される選択設定信号（切換制御信号ＳＥＬの非反転信号ＳＬａ又は反転信号ＳＬｂ）に基づいて、各階調電流供給回路ＰＸＣ、ＰＸＤの動作状態を選択的に設定する動作設定部ＡＣＡと、を備えた構成を有している。
【０１３３】
ここで、電流生成部２０Ｄは、図１８に示すように、図２に示した電流生成部と同様に、カレントミラー回路部２１Ｄを構成するマルチゲート構造を有するｐチャネル型トランジスタＴＰ６１ａ及びＴＰ６１ｂ、ＴＰ６２ａ〜ＴＰ６５ａ及びＴＰ６２ｂ〜ＴＰ６５ｂと、スイッチ回路部２２Ｄを構成するｐチャネル型トランジスタＴＰ６６〜ＴＰ６９に加え、後述する動作設定部ＡＣＡから出力されるタイミング制御信号ＲＣＫ（図１に示した非反転クロック信号ＣＬＫに相当する）に基づいて、電流入力接点ＩＮｉと接点Ｎｇｄとの間の導通状態を制御するｎチャネル型トランジスタからなるリフレッシュ制御トランジスタＴｒ６０を備えた回路構成を有している。
【０１３４】
また、電流生成部の他の回路構成（電流生成部２０Ｅ）としては、例えば、図１９に示すように、図７に示した電流生成部と同様に、ｐチャネル型トランジスタＴＰ７１ａ〜ＴＰ７５ａ及び容量Ｃｅａからなるカレントミラー回路２１Ｅａと、ｐチャネル型トランジスタＴＰ７１ｂ〜ＴＰ７５ｂ及び容量Ｃｅｂからなるカレントミラー回路２１Ｅａとをカスケード接続（多段接続又は縦続接続）した構成を有するカレントミラー回路部２１Ｅと、ｐチャネル型トランジスタＴＰ７６〜ＴＰ７９からなるスイッチ回路部２２Ｅに加え、動作設定部ＡＣＡから出力されるタイミング制御信号ＲＣＫに基づいて、基準電流トランジスタＴＰ７１ａ及びＴＰ７１ｂの接続接点と接点Ｎｇｅａ（基準電流トランジスタＴＰ７１ａのゲート端子）との間の導通状態を制御するｎチャネル型トランジスタからなるリフレッシュ制御トランジスタＴｒ７０ａ、及び、電流入力接点ＩＮｉと接点Ｎｇｅｂとの間の導通状態を制御するｎチャネル型トランジスタからなるリフレッシュ制御トランジスタＴｒ７０ｂを備えた回路構成を適用することもできる。
【０１３５】
すなわち、本実施例においては、リフレッシュ制御トランジスタＴｒ６０、又は、Ｔｒ７０ａ及びＴｒ７０ｂにより、動作設定部ＡＣＡから出力されるタイミング制御信号ＲＣＫ（非反転クロック信号）がハイレベルとなるタイミングにおいて、基準電流Ｉｒｅｆに基づく電荷が接点Ｎｇｄ、又は、接点Ｎｇｅａ及びＮｇｅｂに供給されて容量Ｃｄ、又は、容量Ｃｅａ及びＣｅｂに蓄積され、各接点Ｎｇｄ、又は、接点Ｎｇｅａ及びＮｇｅｂの電圧（基準電圧Ｖｒｅｆ）が一定電圧に再充電（リフレッシュ）される。なお、基準電圧Ｖｒｅｆのリフレッシュ動作においては、後述する。
【０１３６】
（特定状態設定部ＢＫＡ）
特定状態設定部ＢＫＡは、図１７に示すように、データラッチ部１０から出力される非反転出力信号ｄ１０〜ｄ１３を入力信号とする論理和演算回路（以下、「ＯＲ回路」と略記する）５１と、該ＯＲ回路５１の出力端が制御端子（ゲート）に接続されるとともに、電流路の一端側が特定電圧Ｖｂｋを印加する電圧源に、他端側が電流生成部２０Ｄの電流出力端子ＯＵＴｉに、各々接続されたｐチャネル型トランジスタからなる特定電圧印加トランジスタＴＰ５２と、を備えた構成を有している。
【０１３７】
このような構成を有する特定状態設定部ＢＫＡにおいては、上記データラッチ部１０から出力される非反転出力信号ｄ１０〜ｄ１３の信号レベルが全て“０”となる特定状態（黒表示状態に相当する）であるか否かが判別され、該特定状態においてのみ、特定電圧印加トランジスタＴＰ５２を介して、電流出力端子ＯＵＴｉ（すなわち、データラインＤＬ及び表示画素）に特定電圧Ｖｂｋが印加される。
【０１３８】
（動作設定部ＡＣＡ）
動作設定部ＡＣＡは、例えば、図１７に示すように、選択設定回路１３４Ｃから出力される選択設定信号（非反転信号ＳＬａ又は反転信号ＳＬｂ）を反転処理するインバータ５４と、データラインＤＬに電流路が設けられ、制御端子に上記選択設定信号の反転信号（インバータ５４の出力信号）が印加されるｐチャネル型トランジスタＴＰ５３と、選択設定信号（非反転信号ＳＬａ又は反転信号ＳＬｂ）の反転信号及びシフトレジスタ回路１３１Ｃからのシフト信号ＳＲを入力とするＮＡＮＤ回路５５と、該ＮＡＮＤ回路５５の論理出力を反転処理するインバータ５６と、該インバータ５６の反転出力をさらに反転処理するインバータ５７と、電流生成部２０Ｄへの基準電流Ｉｒｅｆの供給経路に電流路が設けられ、制御端子に上記インバータ５７の出力信号が印加されるｐチャネル型トランジスタからなる電流供給制御トランジスタＴＰ５８と、を備えた構成を有している。
【０１３９】
このような構成を有する階調電流供給回路部ＰＸＣ、ＰＸＤにおいては、選択設定回路１３４Ｃから動作設定部ＡＣＡに選択レベル（ハイレベル）の選択設定信号（非反転信号ＳＬａ又は反転信号ＳＬｂ）が入力されると、インバータ５４により信号極性が反転処理されて印加されることにより、ｐチャネル型トランジスタＴＰ５３がオン動作して、電流生成部２０Ｄの電流出力端子ＯＵＴｉが、ｐチャネル型トランジスタＴＰ５３を介してデータラインＤＬに接続される。このとき同時に、ＮＡＮＤ回路５５及びインバータ５６、５７により、シフト信号ＳＲの出力タイミングに関わらずデータラッチ部１０の非反転入力接点ＣＫ及び電流生成部２０Ｄにはローレベルのタイミング制御信号（非反転クロック信号）が、また、反転入力接点ＣＫ＊及びｐチャネル型トランジスタＴＰ５８の制御端子にはハイレベルのタイミング制御信号（反転クロック信号）が定常的に入力されて、データラッチ部１０に保持されている表示データＤ０〜Ｄ３に基づく反転出力信号ｄ１０＊〜ｄ１３＊が電流生成部２０Ｄに供給されるとともに、電流生成部２０Ｄへの基準電流Ｉｒｅｆの供給が遮断される。
【０１４０】
一方、選択設定回路１３４から非選択レベル（ローレベル）の選択設定信号（非反転信号ＳＬａ又は反転信号ＳＬｂ）が入力されると、インバータ５４により信号極性が反転処理されて印加されることにより、ｐチャネル型トランジスタＴＰ５３がオフ動作して、電流生成部２０Ｄの電流出力端子ＯＵＴｉがデータラインＤＬから切り離される。また、このとき同時に、ＮＡＮＤ回路５５及びインバータ５６、５７により、シフト信号ＳＲの出力タイミングに対応してデータラッチ部１０の非反転入力接点ＣＫ及び電流生成部２０Ｄにはハイレベルのタイミング制御信号が、また、反転入力接点ＣＫ＊及びｐチャネル型トランジスタＴＰ５８の制御端子にはローレベルのタイミング制御信号が入力されて、データラッチ部１０に表示データＤ０〜Ｄ３が取り込み保持されるとともに、電流生成部２０Ｄに基準電流Ｉｒｅｆが供給される。
【０１４１】
したがって、後述する選択設定回路１３４Ｃにより、２組の階調電流供給回路群１３２Ｃ及び１３２Ｄに入力する選択設定信号（切換制御信号ＳＥＬの非反転信号ＳＬａ又は反転信号ＳＬｂ）の信号レベルを適宜設定することにより、２組の階調電流供給回路群１３２Ｃ及び１３２Ｄのいずれか一方を選択状態とし、他方を非選択状態に設定することができる。
【０１４２】
（反転ラッチ回路１３３Ｃ／選択設定回路１３４Ｃ）
反転ラッチ回路１３３Ｃ又は選択設定回路１３４Ｃは、概略、シフトクロック信号ＳＦＣ又は切換制御信号ＳＥＬが印加されると、当該信号レベルが保持されて、該信号レベルの非反転信号及び反転信号が、各々非反転出力端子及び反転出力端子から出力され、シフトレジスタ回路１３１Ｃに対して非反転クロック信号ＣＫａ及び反転クロック信号ＣＫｂとして、また、階調電流供給回路群１３２Ｃ（各階調電流供給回路部ＰＸＣ−１、ＰＸＣ−２、・・・）及び１３２Ｄ（各階調電流供給回路部ＰＸＤ−１、ＰＸＤ−２、・・・）に対して非反転信号ＳＬａ及び反転信号ＳＬｂ（選択設定信号）として供給される。
【０１４３】
（シフトレジスタ回路１３１Ｃ）
シフトレジスタ回路１３１Ｃは、上述した反転ラッチ回路１３３Ｃから出力される非反転クロック信号ＣＫａ及び反転クロック信号ＣＫｂに基づいて、システムコントローラから供給されるサンプリングスタート信号ＳＴＲを取り込み、所定のタイミングで順次シフトしつつ、該シフト信号ＳＲ１、ＳＲ２、・・・を階調電流供給回路群１３２Ｃ及び１３２Ｄに出力する。
【０１４４】
図２０は、本実施例に係るデータドライバにおける制御動作の一例を示すタイミングチャートである。ここでは、図１７、図１８に示した階調電流供給回路（電流生成部）を適用した場合についてのみ説明しているが、図１９に示した電流生成部を適用した場合においても同様である。
【０１４５】
上述したようなデータドライバ１３０Ｃにおける制御動作は、非選択レベル（ローレベル）の選択設定信号を入力することにより、階調電流供給回路ＰＸＣ、ＰＸＤのデータラッチ部１０に表示データＤ０〜Ｄ３を取り込んで保持する信号保持動作期間においては、カレントミラー回路部２１Ｄに設けられたリフレッシュ制御トランジスタＴｒ６０、及び、動作設定部ＡＣＡに設けられた電流供給制御トランジスタＴＰ５８の双方をオン動作させることにより、基準電流トランジスタＴＰ６１ａ及びＴＰ６１ｂの電流路に基準電流Ｉｒｅｆを流すとともに、該基準電流トランジスタＴＰ６１ａ及びＴＰ６１ｂのゲート端子（接点Ｎｇｄ）に基準電流Ｉｒｅｆに基づく電荷を供給する。これにより、コンデンサＣｄに電荷が蓄積（充電）され、ゲート端子の電位（基準電圧Ｖｒｅｆ）が所定の一定電圧にリフレッシュされる（リフレッシュ動作）。また、このとき、動作設定部ＡＣＡに設けられたｐチャネル型トランジスタＴＰ５３がオフ状態にあることにより、電流生成部２０における階調電流Ｉｐｉｘの生成及びデータラインＤＬへの供給は行われない。
【０１４６】
また、本実施形態に係るデータドライバ１３０Ｃにおいて、選択レベル（ハイレベル）の選択設定信号を入力することにより、上記取り込み保持された表示データＤ０〜Ｄ３に基づいて階調電流供給回路ＰＸＣ、ＰＸＤにおいて階調電流を生成して供給する電流生成供給動作期間においては、上記リフレッシュ制御トランジスタＴｒ６０及び電流供給制御トランジスタＴＰ５８の双方をオフ動作させることにより、基準電流トランジスタＴＰ６１ａ及びＴＰ６１ｂのゲート端子（接点Ｎｇｄ）への電荷の供給を遮断する。このとき、上記リフレッシュ動作によりコンデンサＣｄに充電された電圧成分により、基準電流トランジスタＴＰ６１ａ及びＴＰ６１ｂのゲート端子の電位（基準電圧Ｖｒｅｆ）は、所定の一定電圧が保持されるので、階調電流供給回路ＰＸＣ、ＰＸＤにおいて、上記表示データＤ０〜Ｄ３に基づいて特定の単位電流トランジスタにのみ単位電流が流れ、該単位電流を合成することにより所望の電流値を有する階調電流Ｉｐｉｘが生成される。これにより、各階調電流供給回路ＰＸＣ、ＰＸＤから表示データに応じた電流値を有する階調電流ＩｐｉｘがデータラインＤＬを介して各表示画素に継続的に供給される。
【０１４７】
したがって、図２０に示すように、このような信号保持動作及び電流生成供給動作を所定の周期で順次繰り返し実行することにより、２組の階調電流供給回路群１３２Ｃ及び１３２Ｄにより表示データを連続的に取り込み保持しつつ、表示データに応じた階調電流Ｉｐｉｘを連続的に供給することができ、表示応答特性に優れた画像表示を実現することができる。
【０１４８】
また、各階調電流供給回路（電流生成部）を構成する各単位電流トランジスタＴＰ６２ａ〜ＴＰ６５ａ及びＴＰ６２ｂ〜ＴＰ６５ｂのゲート端子（接点Ｎｇｄ）に印加される電位（基準電圧Ｖｒｅｆ）を、周期的に所定の一定電圧値に再充電（リフレッシュ）することができるので、単位電流トランジスタにおける電流リーク等に起因する基準電圧の低下を抑制することができ、各単位電流トランジスタの導通状態のバラツキにより、階調電流（すなわち、表示画素の輝度階調）が不均一になる現象を抑制して、良好な階調表示動作（表示画質の向上）を実現することができる。
【０１４９】
【発明の効果】
以上説明したように、本発明に係る電流生成供給回路及びその制御方法によれば、有機ＥＬ素子や発光ダイオード等のように、電流値に応じて所定の駆動状態（発光輝度）で動作する複数の負荷に対して、所定の電流値を有する負荷駆動電流（階調電流）を生成して供給する電流駆動装置において、少なくとも、負荷の駆動状態を制御するための複数ビットのデジタル信号を並列的に取り込み保持するデータラッチ部と、該データラッチ部から出力される出力信号に基づいて、上記複数ビットのデジタル信号に対応した電流値を有する負荷駆動電流を生成して負荷に出力する電流生成部と、を有し、特に、上記電流生成部に設けられたカレントミラー回路部の基準電流トランジスタ及び複数の単位電流トランジスタが、マルチゲート構造を有する電界効果型トランジスタにより形成された構成、もしくは、基準電流トランジスタ及び複数の単位電流トランジスタからなる複数のカレントミラー回路を、多段接続（カスケード接続）した構成を有しているので、カレントミラー回路部（基準電流トランジスタ又は複数の単位電流トランジスタ）を構成する各電界効果型トランジスタに印加される電圧を、実質的に低減して、ソース−ドレイン耐圧を向上させることができる。これにより、各電界効果型トランジスタの電圧−電流特性を改善して、電流生成部（カレントミラー回路部）により生成される負荷駆動電流における、指定階調に対する出力電流特性について、良好な線形性を実現することができるので、負荷をデジタル信号に応じた適切な駆動状態で動作させることができる。
【０１５０】
また、カレントミラー回路部を構成する複数の単位電流トランジスタとして、基準電流トランジスタに対してチャネル幅が各々異なる比率となるように形成することにより、上記複数の単位電流が各々異なる電流値を有するように設定することができ、各単位電流トランジスタに流れる単位電流を、上記デジタル信号に応じて選択的に合成（電流値を合算）することにより、上記負荷駆動電流を生成する構成を適用することができる。
【０１５１】
これにより、カレントミラー回路部の基準電流トランジスタに一定の基準電流を流すのみで、各単位電流トランジスタに異なる電流値を有する複数の単位電流を一義的に流すことができ、負荷駆動電流の生成に関連して電流生成供給回路に供給される信号レベルが変動しない構成を有しているので、負荷駆動電流が微小な場合であっても、電流生成供給回路に接続される電流供給線に付加された寄生容量への充放電動作に起因する信号遅延の影響を排除して、電流生成供給回路、又は、電流生成供給回路を備えた電流駆動装置の動作速度を向上させることができる。
【０１５２】
そして、本発明に係る表示装置においては、相互に直交する走査ライン及びデータラインの交点近傍に、発光素子を備えた表示画素をマトリクス状に配列してなる表示パネルを備えた表示装置において、上述したような電流生成供給回路をデータドライバに適用し、表示パネルの所定の行に配列された表示画素群の選択期間中に、各表示画素に対応して設けられた階調電流供給回路（電流生成供給回路）において、データラッチ部に保持した複数ビットのデジタル信号（表示データ）に基づいて電流生成部において生成された特定の単位電流の合成電流を、階調電流として、各表示画素に個別に供給することにより、階調電流供給回路を構成するカレントミラー回路部の基準電流トランジスタに一定の電流値を有する基準電流を流すのみで、表示データに応じた電流値を有する階調電流を生成することができる。
【０１５３】
したがって、表示パネルの小型化や高精細化に伴って表示画素が微細化された場合や、比較的下位の輝度階調で各表示画素を発光動作させる場合等のように、階調電流が微小な場合であっても、信号線の充放電動作に起因する動作速度の低下を抑制して、表示データに応じた適正な電流値を有する階調電流を迅速に生成して表示画素（発光素子）に供給することができるので、表示画素を表示データに応じた適正な輝度階調で発光動作させることができ、所望の画像情報を良好な画質で表示することができる。
【０１５４】
また、階調電流供給回路（電流生成部）に適用するカレントミラー回路部として、該カレントミラー回路部を構成する基準電流トランジスタ及び複数の単位電流トランジスタを、マルチゲート構造を有する電界効果型トランジスタにより形成した構成、もしくは、上記基準電流トランジスタ及び複数の単位電流トランジスタからなる複数のカレントミラー回路を、多段接続（カスケード接続）した構成を有しているので、基準電流トランジスタ又は複数の単位電流トランジスタを構成する各電界効果型トランジスタに印加される電圧を、実質的に低減して、ソース−ドレイン耐圧を向上させることができ、階調電流供給回路（カレントミラー回路部）により生成される階調電流における、表示データに対する出力電流特性について、良好な線形性を実現することができる。したがって、表示画素を低い階調で発光動作させるような場合であっても、輝度階調を良好な線形性で的確に制御することができるので、表示画素を表示データに基づいた適切な輝度階調で発光動作させることができ、表示画質の向上を図ることができる。
【図面の簡単な説明】
【図１】本発明に係る電流生成供給回路の第１の実施形態を示す概略構成図である。
【図２】本実施形態に適用される電流生成部の一具体例を示す回路構成図である。
【図３】周知のｐチャネル型の電界効果型トランジスタの電圧−電流特性を示す図である。
【図４】周知のｐチャネル型の電界効果型トランジスタを適用して電流生成供給回路（電流生成部）を構成した場合の入力信号（デジタル信号；指定階調）に対する出力電流特性を示す図である。
【図５】本実施形態に係る電流生成供給回路の他の構成例を示す概略構成図である。
【図６】本実施形態に係る電流生成供給回路に適用される電流生成部の他の具体例を示す回路構成図である。
【図７】第２の実施形態に係る電流生成供給回路に適用される電流生成部の一具体例を示す回路構成図である。
【図８】本発明に係る電流生成供給回路を適用可能な表示装置の第１の実施形態を示す概略ブロック図である。
【図９】本実施形態に係る表示装置に適用される表示パネルの一例を示す概略構成図である。
【図１０】本実施形態に適用される表示画素（画素駆動回路）の第１の実施例を示す回路構成図である。
【図１１】本実施形態に係る表示装置に適用されるデータドライバの第１の実施例を示す概略構成図である。
【図１２】本実施例に係るデータドライバにおける制御動作の一例を示すタイミングチャートである。
【図１３】本実施形態に係る表示パネル（表示画素）における制御動作の一例を示すタイミングチャートである。
【図１４】本実施形態に適用される画素駆動回路の一実施例を示す回路構成図である。
【図１５】本実施形態に係る表示装置の要部構成を示す概略構成図である。
【図１６】本実施形態に係る表示装置に適用されるデータドライバの第３の実施例を示す概略構成図である。
【図１７】本実施例に係るデータドライバに適用される階調電流供給回路の一具体例を示す構成図である。
【図１８】本実施例に適用される階調電流供給回路を構成する階調電流生成部の一具体例を示す構成図である。
【図１９】本実施例に適用される階調電流供給回路を構成する階調電流生成部の他の具体例を示す構成図である。
【図２０】本実施例に係るデータドライバにおける制御動作の一例を示すタイミングチャートである。
【図２１】従来技術におけるデータドライバの一構成例を示す回路構成図である。
【図２２】従来技術におけるデータドライバの他の構成例を示す回路構成図である。
【符号の説明】
ＩＬＡ、ＩＬＢ        電流生成供給回路
１０                  データラッチ部
２０Ａ〜２０Ｅ        電流生成部
２１Ａ〜２１Ｅ        カレントミラー回路部
２１Ｃａ、２１Ｃｂ    カレントミラー回路
２２Ａ〜２２Ｅ        スイッチ回路部
１００Ａ              表示装置
１１０Ａ、１１０Ｂ    表示パネル
１２０Ａ、１２０Ｂ    走査ドライバ
１３０Ａ〜１３０Ｃ    データドライバ
ＰＸＡ〜ＰＸＤ        階調電流供給回路
ＤＣｘ、ＤＣｙ        画素駆動回路
【図１】
2004363813.tif 000003
【図２】
2004363813.tif 000004
【図３】
2004363813.tif 000005
【図４】
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【図５】
2004363813.tif 000007
【図６】
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【図７】
2004363813.tif 000009
【図８】
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【図９】
2004363813.tif 000011
【図１０】
2004363813.tif 000012
【図１１】
2004363813.tif 000013
【図１２】
2004363813.tif 000014
【図１３】
2004363813.tif 000015
【図１４】
2004363813.tif 000016
【図１５】
2004363813.tif 000017
【図１６】
2004363813.tif 000018
【図１７】
2004363813.tif 000019
【図１８】
2004363813.tif 000020
【図１９】
2004363813.tif 000021
【図２０】
2004363813.tif 000022
【図２１】
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【図２２】
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