(57)【要約】【課題】異なる信号特性を有する複数のＣＡＰＡ信号のそれぞれに対しＡＧＣ制御を行う自動利得制御装置、及び自動利得制御方法を提供する。【解決手段】異なる信号特性を有する複数のＣＡＰＡを持つ入力アナログ信号の振幅を利得で増幅するＶＧＡ１１と、上記ＶＧＡ１１の出力をサンプリングしてディジタル信号に変換するＡ／Ｄ変換手段１２と、上記ディジタル信号の信号長を検出する信号弁別手段１７と、上記信号長と外部から入力された制御ゲート１６に基づいて所望の信号長のディジタル信号の振幅情報を抽出する振幅情報抽出手段１３と、上記振幅情報に基づいて上記ＶＧＡ１１を制御するための制御信号を生成するＡＧＣ制御手段１４と、上記制御信号をアナログ信号に変換し、上記ＶＧＡ１１に出力するＤ／Ａ変換手段１５と、を備えた。【選択図】　　　図１
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【特許請求の範囲】
【請求項１】
記憶媒体から読み出された、データの位置情報である特性の異なる複数のアドレス情報を示すＩＤ部と、ユーザ情報を示すデータ部とを有するアナログ信号である情報を再生する際に、上記アナログ信号の振幅が一定になるよう自動的に調整する自動利得制御装置であってにおいて、　上記ＩＤ部が、特性の異なる複数の情報を有し、
上記アナログ信号に所定の利得を与えて、該信号の振幅を増幅させるの振幅を上記複数の情報のそれぞれの特性に応じた利得で増幅する可変利得増幅手段と、上記可変利得増幅手段の出力をサンプリングしてディジタル信号に変換するＡ／Ｄ変換手段と、
上記ディジタル信号のうちの上記複数のアドレス情報のそれぞれの特性に対応する信号から振幅情報を抽出する振幅情報抽出手段と、
上記振幅情報抽出手段により抽出された各振幅情報に基づいて上記可変利得増幅手段の利得を制御する自動利得制御手段と、を備えた、
ことを特徴とする自動利得制御装置。
【請求項２】
請求項１に記載の自動利得制御装置において、
上記ＩＤ部に含まれる複数のアドレス情報のうちの、最初のアドレス情報を示すＩＤ部を第１のＣＡＰＡ、次のアドレス情報を示すＩＤ部を第２のＣＡＰＡとし、上記第１のＣＡＰＡの利得に対して所定の一定比を持つよう第２のＣＡＰＡの利得を決定する利得比生成手段と、
外部から入力された制御ゲートに基づいて上記振幅情報抽出手段の出力または上記利得比生成手段の出力のいずれかを選択し、上記自動利得制御手段に出力する信号選択手段と、を備え、
上記自動利得制御手段は、上記信号選択手段により選択された信号に基づいて上記可変利得増幅手段の利得を制御する、
ことを特徴とする自動利得制御装置。
【請求項３】
請求項１に記載の自動利得制御装置において、
上記振幅抽出手段である第１の振幅抽出手段と同一の構成を有する第２の振幅抽出手段と、
上記自動利得制御手段である第１の自動利得制御手段と同一の構成を有する第２の自動利得制御手段と、
外部から入力された制御ゲートに基づいて上記Ａ／Ｄ変換手段の出力を、上記第１の振幅情報抽出手段または上記第２の振幅情報抽出手段のいずれかに出力する信号選択手段と、をさらに備え、
上記ＩＤ部に含まれる複数のアドレス情報のうちの、最初のアドレス情報を示すＩＤ部を第１のＣＡＰＡ、次のアドレス情報を示すＩＤ部を第２のＣＡＰＡとし、
上記第１の振幅情報抽出手段は、上記第１のＣＡＰＡから第１の振幅情報を抽出して上記第１の自動利得制御手段に出力し、上記第１の自動利得制御手段は、上記第１の振幅情報に基づいて上記可変利得増幅手段の利得を制御し、
上記第２の振幅情報抽出手段は、上記第２のＣＡＰＡから第２の振幅情報を抽出して上記第２の自動利得制御手段に出力し、上記第２の自動利得制御手段は、上記第２の振幅情報に基づいて上記可変利得増幅手段の利得を制御する、
ことを特徴とする自動利得制御装置。
【請求項４】
請求項１に記載の自動利得制御装置において、
上記振幅抽出手段である第１の振幅抽出手段と同一の構成を有する第２の振幅抽出手段と、
外部から入力された制御ゲートに基づいて上記Ａ／Ｄ変換手段の出力を、上記第１の振幅抽出手段または上記第２の振幅抽出手段のいずれかに出力する第１の信号選択手段と、
外部から入力された制御ゲートに基づいて上記第１の振幅情報抽出手段の出力または上記第２の振幅情報抽出手段の出力のいずれかを選択し、上記自動利得制御手段に出力する第２の信号選択手段と、をさらに備え、
上記ＩＤ部に含まれる複数のアドレス情報のうちの、最初のアドレス情報を示すＩＤ部を第１のＣＡＰＡ、次のアドレス情報を示すＩＤ部を第２のＣＡＰＡとし、
上記第１の振幅情報抽出手段は、上記第１のＣＡＰＡから第１の振幅情報を抽出し、
上記第２の振幅情報抽出手段は、上記第２のＣＡＰＡから第２の振幅情報を抽出し、
上記自動利得制御手段は、上記第２の信号選択手段により選択された振幅情報に基づいて上記可変利得増幅手段の利得を制御する、
ことを特徴とする自動利得制御装置。
【請求項５】
請求項１に記載の自動利得制御装置において、
所定の利得レベルを設定する利得設定手段を、さらに備え、
上記自動利得制御手段は、上記利得設定手段の出力に基づいて上記可変利得増幅手段の利得を制御する、
ことを特徴とする自動利得制御装置。
【請求項６】
請求項１ないし請求項５のいずれかに記載の自動利得制御装置において、
上記ディジタル信号の信号長を検出する信号弁別手段を、さらに備え、
上記振幅情報抽出手段は、上記信号弁別手段により検出された信号長に基づいて上記ディジタル信号のうちの所望の信号長の信号から振幅情報を抽出し上記自動利得制御手段に出力する、
ことを特徴とする自動利得制御装置。
【請求項７】
請求項６に記載の自動利得制御装置において、
上記自動利得制御手段は、上記信号長の信号振幅が一定になるよう上記可変利得増幅手段の利得を制御する、
ことを特徴とする自動利得制御装置。
【請求項８】
請求項６に記載の自動利得制御装置において、
上記自動利得制御手段は、上記信号長が３Ｔである信号の振幅が一定になるよう上記可変利得増幅手段の利得を制御する、
ことを特徴とする自動利得制御装置。
【請求項９】
請求項６に記載の自動利得制御装置において、
上記自動利得制御手段は、上記信号長が４Ｔもしくはそれ以上の長さを持つ信号の内の１つである信号の振幅が一定になるよう上記可変利得増幅手段の利得を制御する、
ことを特徴とする自動利得制御装置。
【請求項１０】
請求項６に記載の自動利得制御装置において、
上記自動利得制御手段は、上記信号長が３Ｔ、４Ｔ、またはそれ以外の長さを持つ複数の信号の組合せの内の１つである信号の振幅が平均的に一定になるよう上記可変利得増幅手段の利得を制御する、
ことを特徴とする自動利得制御装置。
【請求項１１】
記憶媒体から読み出された、データの位置情報である特性の異なる複数のアドレス情報を示すＩＤ部と、ユーザ情報を示すデータ部とを有する入力再生信号の振幅を可変利得増幅器を用いて増幅する際に、上記可変利得増幅器の利得を自動制御する自動利得制御方法において、
上記再生信号の上記ＩＤ部に含まれる複数のアドレス情報のそれぞれの特性に対応する信号から振幅情報を抽出し、
上記抽出された各振幅情報のそれぞれの特性に応じて上記可変利得増幅器の利得を自動制御する、
ことを特徴とする自動利得制御方法。
【請求項１２】
請求項１１に記載の自動利得制御方法において、
上記ＩＤ部に含まれる複数のアドレス情報のうちの、最初のアドレス情報を示すＩＤ部を第１のＣＡＰＡ、次のアドレス情報を示すＩＤ部を第２のＣＡＰＡとし、上記第１のＣＡＰＡの利得に対して所定の一定比を持つよう第２のＣＡＰＡの利得を決定し、
外部から入力される制御ゲートに基づいて上記第１のＣＡＰＡの利得と、上記第２のＣＡＰＡの利得とを切り換え、上記可変利得増幅器の利得の自動制御を行う、
ことを特徴とする自動利得制御方法。
【請求項１３】
請求項１１に記載の自動利得制御方法において、
上記ＩＤ部に含まれる複数のアドレス情報のうちの、最初のアドレス情報を示すＩＤ部を第１のＣＡＰＡ、次のアドレス情報を示すＩＤ部を第２のＣＡＰＡとし、外部から入力された制御ゲートに基づいて上記第１のＣＡＰＡから第１の振幅情報を抽出して上記可変利得増幅器の利得を制御する第１の自動利得制御、または上記第２のＣＡＰＡから第２の振幅情報を抽出して上記可変利得増幅器の利得を制御する第２の自動利得制御のいずれかを行う、
ことを特徴とする自動利得制御方法。
【請求項１４】
請求項１１に記載の自動利得制御方法において、
所定の利得レベルを設定し、該設定された利得に基づいて上記可変利得増幅器の利得の自動制御を行う、
ことを特徴とする自動利得制御方法。
【請求項１５】
請求項１１ないし請求項１４のいずれかに記載の自動利得制御方法において、
上記再生信号の信号長を検出し、
上記検出した信号長に基づいて上記再生信号から所望の信号長の振幅情報を抽出し、上記可変利得増幅器の利得の自動制御を行う、
ことを特徴とする自動利得制御方法。
【発明の詳細な説明】
【０００１】
【発明の属する技術分野】
本発明は、光ディスク装置等の記憶媒体からの再生信号の振幅を制御する自動利得制御装置、及び自動利得制御方法に関するものである。
【０００２】
【従来の技術】
近年、光ディスク装置や通信装置は大容量化（高速化）、小型化へと急速に推移しており、その技術はめざましい進歩を見せている。従来の光ディスク装置では、入力されるアナログ信号の振幅を一定に維持するためのオートゲインコントロール（以下ＡＧＣと呼ぶ）は、アナログ信号に対して全波整流または半波整流を行い、その出力を可変ゲインアンプ（以下ＶＧＡと呼ぶ）に入力し、ＡＧＣ制御を自動的に行っていた。また、この際、ＭＯやＤＶＤ−ＲＡＭに見られるセクターフォーマット構造をとる記憶媒体ではには、データの位置情報（アドレス情報）を有するＩＤ部と、ユーザーデータを記憶するＤＡＴＡ部とを持つデータが記憶されている。また、特に、ＤＶＤ−ＲＡＭには、ではＩＤ部に複数のＣＡＰＡと呼ばれるアドレス情報を有するブロックが存在する。この複数のＣＡＰＡは、再生する際に、信号振幅や、オフセットのが異なる信号特性を有するものである。
【０００３】
以下図面を参照しながら、上述した従来のＡＧＣ制御方式の一例について説明する。
図１５は従来のＡＧＣ制御方式の一例を示すブロック図である。図１５において、６１０はアナログ信号、６１１はゲインを外部制御により変化させるＶＧＡ、６１２はＶＧＡ出力を信号中心から折り返し、その出力を整流して振幅情報を取り出す全波整流器（ＦＷＲ）、６１３，６１４は全波整流した信号から高周波成分を除去するＬＰＦである。６３０はＩＤゲートであり、ＩＤ部とデータ部とを識別するための信号である。
【０００４】
まず、入力されたアナログ信号６１０は、ＶＧＡ６１１により、ゲインが与えられ、振幅が変化する。このＶＧＡ６１１の出力は、ＦＷＲ６１２により全波整流され、振幅情報が取り出される。
【０００５】
ＦＷＲ６１２から出力されたの振幅情報出力には、ＡＧＣ制御には不要な高周波成分が含まれるためを含むため、ＬＰＦ６１３及びＬＰＦ６１４により高域成分が除去され、ＶＧＡ６１１のゲイン制御信号としてＶＧＡ６１１に供給される。
【０００６】
ここで、ＬＰＦ６１３及び、ＬＰＦ６１４は、入力されるアナログ信号６１０のデータ部とＩＤ部をそれぞれ独立にＡＧＣ制御を行うためにあり、その切り換えはＩＤゲート６３０で行われる。データ部とＩＤ部では信号特性が大きく異なるため、それぞれを独立にＡＧＣ制御しているた。
【０００７】
【特許文献１】
特開平４−３３０８１１号公報
【０００８】
【発明が解決しようとする課題】
上述したように、従来のＡＧＣ制御方式では、ＩＤ部はひとまとめにし、１つ目のＣＡＰＡ信号と２つ目のＣＡＰＡ信号を同じゲインでＡＧＣ制御していたため、第１のＣＡＰＡと第２のＣＡＰＡの信号振幅がばらついたままて後段の処理系に入力される。その結果、ＣＡＰＡの読み取り精度が悪く、アドレス情報の読み取りエラーが頻発していた。そして、読み取り時にシステムの再試行動作が多発し、システム性能を低下させる要因となっていた。また、信号の分解能が大きく変動するため、アナログ方式で行ってきた全信号の平均化によるＡＧＣ制御方法ではアドレス読み取りエラーが頻発し、システム性能を低下させる要因となっていた。
【０００９】
本発明は、上記問題点を解消するためになされたものであり、ディジタル信号処理方式の特性を利用し、回路規模の増加を最小限にとどめ、異なる信号特性を有する複数のＣＡＰＡ信号のそれぞれに対しＡＧＣ制御を行う自動利得制御装置、及び自動利得制御方法を提案するものである。
【００１０】
【課題を解決するための手段】
上記課題を解決するために、本発明の請求項１に係る自動利得制御装置は、記憶媒体から読み出された、特性の異なる複数のアドレス情報を示すＩＤ部と、ユーザ情報を示すデータ部とを有するアナログ信号を再生する際に、上記アナログ信号の振幅が一定になるよう自動的に調整する自動利得制御装置であって、上記アナログ信号に所定の利得を与えて、該信号の振幅を増幅させる可変利得増幅手段と、上記可変利得増幅手段の出力をサンプリングしてディジタル信号に変換するＡ／Ｄ変換手段と、上記ディジタル信号のうちの上記複数のアドレス情報に対応する信号から振幅情報を抽出する振幅情報抽出手段と、上記振幅情報抽出手段により抽出された各振幅情報に基づいて上記可変利得増幅手段の利得を制御する自動利得制御手段と、を備えたことを特徴とするものである。
これにより、従来のようにアナログ信号に含まれるＩＤ部及びデータ部の両方に対し自動利得制御するのではなく、ＩＤ部のみに対して自動利得制御することによりアドレス読み取り率を向上させることができ、その結果、自動利得制御をより正確に行うことができる。
【００１１】
また、本発明の請求項２に係る自動利得制御装置は、請求項１に記載の自動利得制御装置において、上記ＩＤ部に含まれる複数のアドレス情報のうちの、最初のアドレス情報を示すＩＤ部を第１のＣＡＰＡ、次のアドレス情報を示すＩＤ部を第２のＣＡＰＡとし、上記第１のＣＡＰＡの利得に対して所定の一定比を持つよう第２のＣＡＰＡの利得を決定する利得比生成手段と、外部から入力された制御ゲートに基づいて上記振幅情報抽出手段の出力または上記利得比生成手段の出力のいずれかを選択し、上記自動利得制御手段に出力する信号選択手段と、を備え、上記自動利得制御手段は、上記信号選択手段により選択された信号に基づいて上記可変利得増幅手段の利得を制御することを特徴とするものである。
これにより、第１のＣＡＰＡと第２のＣＡＰＡのゲイン比を常に監視し、そのゲイン比に基づいて第１のＣＡＰＡと第２のＣＡＰＡとをそれぞれ独立に自動利得制御することができる。
【００１２】
また、本発明の請求項３に係る自動利得制御装置は、請求項１に記載の自動利得制御装置において、上記振幅抽出手段である第１の振幅抽出手段と同一の構成を有する第２の振幅抽出手段と、上記自動利得制御手段である第１の自動利得制御手段と同一の構成を有する第２の自動利得制御手段と、外部から入力された制御ゲートに基づいて上記Ａ／Ｄ変換手段の出力を、上記第１の振幅情報抽出手段または上記第２の振幅情報抽出手段のいずれかに出力する信号選択手段と、をさらに備え、上記ＩＤ部に含まれる複数のアドレス情報のうちの、最初のアドレス情報を示すＩＤ部を第１のＣＡＰＡ、次のアドレス情報を示すＩＤ部を第２のＣＡＰＡとし、上記第１の振幅情報抽出手段は、上記第１のＣＡＰＡから第１の振幅情報を抽出して上記第１の自動利得制御手段に出力し、上記第１の自動利得制御手段は、上記第１の振幅情報に基づいて上記可変利得増幅手段の利得を制御し、上記第２の振幅情報抽出手段は、上記第２のＣＡＰＡから第２の振幅情報を抽出して上記第２の自動利得制御手段に出力し、上記第２の自動利得制御手段は、上記第２の振幅情報に基づいて上記可変利得増幅手段の利得を制御することを特徴とするものである。
これにより、第１のＣＡＰＡと第２のＣＡＰＡの自動利得制御をより細かく行え、その結果、自動利得制御機能の性能を向上させることができる。
【００１３】
また、本発明の請求項４に係る自動利得制御装置は、請求項１に記載の自動利得制御装置において、上記振幅抽出手段である第１の振幅抽出手段と同一の構成を有する第２の振幅抽出手段と、外部から入力された制御ゲートに基づいて上記Ａ／Ｄ変換手段の出力を、上記第１の振幅抽出手段または上記第２の振幅抽出手段のいずれかに出力する第１の信号選択手段と、外部から入力された制御ゲートに基づいて上記第１の振幅情報抽出手段の出力または上記第２の振幅情報抽出手段の出力のいずれかを選択し、上記自動利得制御手段に出力する第２の信号選択手段と、をさらに備え、上記ＩＤ部に含まれる複数のアドレス情報のうちの、最初のアドレス情報を示すＩＤ部を第１のＣＡＰＡ、次のアドレス情報を示すＩＤ部を第２のＣＡＰＡとし、上記第１の振幅情報抽出手段は、上記第１のＣＡＰＡから第１の振幅情報を抽出し、上記第２の振幅情報抽出手段は、上記第２のＣＡＰＡから第２の振幅情報を抽出し、上記自動利得制御手段は、上記第２の信号選択手段により選択された振幅情報に基づいて上記可変利得増幅手段の利得を制御することを特徴とするものである。
これにより、第１のＣＡＰＡと第２のＣＡＰＡのＡＧＣ制御をより細かく制御することができ、その結果、自動利得制御機能の性能を向上させることができるとともに、回路規模をも小さくすることができる。
【００１４】
また、本発明の請求項５に係る自動利得制御装置は、請求項１に記載の自動利得制御装置において、所定の利得レベルを設定する利得設定手段を、さらに備え、上記自動利得制御手段は、上記利得設定手段の出力に基づいて上記可変利得増幅手段の利得を制御することを特徴とするものである。
これにより、設定した利得レベルに基づいて自動利得制御することができ、その結果、アドレスの読み取り率を向上させ、かつ、回路規模の増加を抑えた低コストで実現可能な自動利得制御装置を実現することができる。
【００１５】
また、本発明の請求項６に係る自動利得制御装置は、請求項１ないし請求項５のいずれかに記載の自動利得制御装置において、上記ディジタル信号の信号長を検出する信号弁別手段を、さらに備え、上記振幅情報抽出手段は、上記信号弁別手段により検出された信号長に基づいて上記ディジタル信号のうちの所望の信号長の信号から振幅情報を抽出し上記自動利得制御手段に出力することを特徴とするものである。
これにより、所望の信号長の信号に対して自動利得制御することができ、その結果、アドレス読み取り率を向上させることができる。
【００１６】
また、本発明の請求項７に係る自動利得制御装置は、請求項６に記載の自動利得制御装置において、上記自動利得制御手段は、上記信号長の信号振幅が一定になるよう上記可変利得増幅手段の利得を制御することを特徴とするものである。これにより、信号長が一定になるよう自動利得制御することができ、その結果、アドレス読み取り率を向上させることができる。
【００１７】
また、本発明の請求項８に係る自動利得制御装置は、請求項６に記載の自動利得制御装置において、上記自動利得制御手段は、上記信号長が３Ｔである信号の振幅が一定になるよう上記可変利得増幅手段の利得を制御する、ことを特徴とするものである。
これにより、信号長が３Ｔである信号の振幅が一定になるよう自動利得制御することができ、その結果、アドレス読み取り率を向上させることができる。
【００１８】
また、本発明の請求項９に係る自動利得制御装置は、請求項６に記載の自動利得制御装置において、上記自動利得制御手段は、上記信号長が４Ｔもしくはそれ以上の長さを持つ信号の内の１つである信号の振幅が一定になるよう上記可変利得増幅手段の利得を制御することを特徴とするものである。
これにより、信号長が４Ｔもしくはそれ以上の長さを持つ信号の内の一つである信号の振幅が一定になるよう自動利得制御することができ、その結果、アドレス読み取り率を向上させることができる。
【００１９】
また、本発明の請求項１０に係る自動利得制御装置は、請求項６に記載の自動利得制御装置において、上記自動利得制御手段は、上記信号長が３Ｔ、４Ｔ、またはそれ以外の長さを持つ複数の信号の組合せの内の１つである信号の振幅が平均的に一定になるよう上記可変利得増幅手段の利得を制御することを特徴とするものである。
これにより、信号長が３Ｔ、４Ｔ、またはそれ以外の長さを持つ複数の信号の組み合わせのうちの一つである信号の振幅が平均的に一定になるよう自動利得制御することができ、その結果、アドレス読み取り率を向上させることができる。
【００２０】
また、本発明の求項１１に係る自動利得制御方法は、記憶媒体から読み出された、特性の異なる複数のアドレス情報を示すＩＤ部と、ユーザ情報を示すデータ部とを有する再生信号の振幅を可変利得増幅器を用いて増幅する際に、上記可変利得増幅器の利得を自動制御する自動利得制御方法において、上記再生信号の上記ＩＤ部に含まれる複数のアドレス情報に対応する信号から振幅情報を抽出し、上記抽出された各振幅情報のそれぞれの特性に応じて上記可変利得増幅器の利得を自動制御することを特徴とするものである。
これにより、従来のようにアナログ信号に含まれるＩＤ部及びデータ部の両方に対し自動利得制御するのではなく、ＩＤ部のみに対して自動利得制御することができ、その結果、自動利得制御をより正確に行うことができる。
【００２１】
また、本発明の請求項１２に係る自動利得制御方法は、請求項１１に記載の自動利得制御方法において、上記ＩＤ部に含まれる複数のアドレス情報のうちの、最初のアドレス情報を示すＩＤ部を第１のＣＡＰＡ、次のアドレス情報を示すＩＤ部を第２のＣＡＰＡとし、上記第１のＣＡＰＡの利得に対して所定の一定比を持つよう第２のＣＡＰＡの利得を決定し、外部から入力される制御ゲートに基づいて上記第１のＣＡＰＡの利得と、上記第２のＣＡＰＡの利得とを切り換え、上記可変利得増幅器の利得の自動制御を行うことを特徴とするものである。
これにより、第１のＣＡＰＡと第２のＣＡＰＡとのゲイン比を常に監視し、そのゲイン比に基づいて第１のＣＡＰＡと第２のＣＡＰＡとをそれぞれ独立に自動利得制御することができる。
【００２２】
また、本発明の請求項１３に係る自動利得制御方法は、請求項１１に記載の自動利得制御方法において、上記ＩＤ部に含まれる複数のアドレス情報のうちの、最初のアドレス情報を示すＩＤ部を第１のＣＡＰＡ、次のアドレス情報を示すＩＤ部を第２のＣＡＰＡとし、外部から入力された制御ゲートに基づいて上記第１のＣＡＰＡから第１の振幅情報を抽出して上記可変利得増幅器の利得を制御する第１の自動利得制御、または上記第２のＣＡＰＡから第２の振幅情報を抽出して上記可変利得増幅器の利得を制御する第２の自動利得制御のいずれかを行うことを特徴とするものである。
これにより、第１のＣＡＰＡと第２のＣＡＰＡの自動利得制御をより細かく行え、その結果、自動利得制御機能の性能を向上させることができ、アドレス読み取り率を向上させることができる。
【００２３】
また、本発明の請求項１４に係る自動利得制御方法は、請求項１１に記載の自動利得制御方法において、所定の利得レベルを設定し、該設定された利得に基づいて上記可変利得増幅器の利得の自動制御を行うことを特徴とするものである。これにより、設定した利得レベルに基づいて自動利得制御することができ、その結果、アドレスの読み取り率を向上させることができる。
【００２４】
また、本発明の請求項１５に係る自動利得制御方法は、請求項１１ないし請求項１４のいずれかに記載の自動利得制御方法において、上記再生信号の信号長を検出し、上記検出した信号長に基づいて上記再生信号から所望の信号長の振幅情報を抽出し、上記可変利得増幅器の利得の自動制御を行うことを特徴とするものである。
これにより、所望の信号長の信号に対して自動利得制御することができ、その結果、アドレス情報読み出しエラーレートが最小になるよう制御する信号長を選択することができる。
【００２５】
【発明の実施の形態】
以下、本発明の実施の形態について、図面を参照しながら説明する。なお、ここで示す実施の形態はあくまでも一例であって、必ずしもこの実施の形態に限定されるものではない。
【００２６】
（実施の形態１）
以下に、本発明の実施の形態１による自動利得制御装置、及び自動利得制御方法について、図１、図６、図７、図８、及び図１１￣１４を用いて説明する。
図１は、本実施の形態１による自動利得制御装置の構成を示すブロック図である。
【００２７】
図１において、１０は、記憶媒体から再生された光の情報から電気信号に変換されたアナログ信号であり、データの位置情報である特性の異なる複数のアドレス情報を示すＩＤ部と、ユーザ情報を示すデータ部とを有する。ここで、ＩＤ部とは、特性の異なる複数の情報を有するものである。１１は、アナログ信号１０の振幅を、上記ＩＤ部に含まれる複数のアドレス情報のそれぞれの特性の応じた利得（ゲイン）で増幅するＶＧＡ（Ｖａｒｉａｂｌｅ　Ｇａｉｎ　Ａｍｐｌｉｆｉｅｒ）である。１２は、アナログ信号であるＶＧＡ１１の出力をサンプリングしてディジタル信号に変換するＡ／Ｄ変換器である。１３は、ディジタル信号に変換されたＶＧＡ１１の出力（再生信号）から振幅情報を抽出する振幅情報抽出手段である。１４は、振幅情報抽出手段１３により抽出された振幅情報に基づいてＶＧＡ１１を制御するための制御信号を出力するＡＧＣ制御手段である。１５は、ディジタル信号であるＡＧＣ制御手段１４の出力（制御信号）をアナログ信号に変換するＤ／Ａ変換器である。１６は、第１，第２のＣＡＰＡを識別する制御ゲートである。１７は、信号の長さ（例えば、３Ｔから１４Ｔ等）を弁別する信号弁別手段である。
【００２８】
図１１は、信号弁別手段１７の構成例を示す図である。
図１１に示す信号弁別手段１７は、入力アナログ信号の３Ｔ〜６Ｔの信号長を検出する検出手段１７１〜１７４と、各検出手段１７１〜１７４の出力のうちの１つをセレクタ１７６を用いて選択し、外部（振幅情報抽出手段１３）へ出力する制御レジスタ１７５と、を備えたものであり、３Ｔ〜６Ｔまでの任意の１つの信号長を選択し、該選択した信号長の信号に対して振幅を調整することができる。なお、検出手段は、３Ｔ〜６Ｔを検出するものとしたが、３Ｔ〜１４Ｔまでの信号長を検出するものであってもよい。
【００２９】
図１２は、信号弁別手段１７の別の構成例を示す図である。
図１２に示す信号弁別手段１７は、入力アナログ信号の３Ｔ〜６Ｔの信号長を検出する検出手段１７１〜１７４と、各検出手段１７１〜１７４の出力のうちの２つをセレクタ１７６を用いて選択する制御レジスタ１７５と、選択された２つの信号長を平均化して出力する平均化回路１７７と、を備えたものであり、３Ｔ〜６Ｔまでの任意の２つの信号長を平均化した信号長の信号に対して、振幅を調整することができる。なお、検出手段の出力のうち、任意の２つを選択するようにしたが、２つ以上であっても良い。
【００３０】
図１３は、振幅情報抽出手段１３の構成例を示す図である。
図１３に示す振幅情報抽出手段１３は、入力信号（信号弁別手段１７の出力）の上側エンベロープを検出する上側エンベロープ検出器１３１と，入力信号の下側エンベロープを検出する下側エンベロープ検出器１３２と、検出された上側エンベロープと下側エンベロープとの差分をとり、振幅を得る引き算機１３４と、を備えたものである。
【００３１】
図１４は、振幅情報抽出手段１３の別の構成例を示す図である。
図１４に示す振幅情報抽出手段１３は、入力信号（信号弁別手段１７の出力）を整流して振幅情報を取り出す全波整流器（ＦＷＲ）１３５と、該取り出された振幅情報を平均化する平均化回路１３６と、該平均化回路１３６の出力と制御レジスタ１３８により設定された目標値との差分を検出する差分検出手段１３７と、を備えたものである。
【００３２】
ここで、光ディスクの再生信号（入力アナログ信号１０）について説明する。光ディスクの再生信号は、光ピックアップから出力された時点で光学的な周波数特性ＭＴＦ（Ｍｏｄｅ　Ｔｒａｎｓｆｅｒ　Ｆｕｎｃｔｉｏｎ）により振幅が異なる。つまり、周波数の高い３Ｔ成分は信号振幅が小さく、４Ｔ，５Ｔ，６Ｔと周波数が下がる（周期が長くなる）ほど信号振幅は大きくなり、７Ｔ以上になるとほぼ最大振幅となる。
【００３３】
光ディスクの記録層に、例えば、図１０（ａ）に示したようにピットが形成されている場合について説明する。このようなピット列に対して光ビームを照射し、光検出器（図示せず）により受光すると、図１０（ｂ）に示すような光検出強度となる。このとき、ピットよりも大きすぎる光ビームが照射されたり、２つのピットにまたがって光ビームが照射される状態になると、符号間干渉が発生して、信号振幅が小さくなり、アドレス情報の読み取り精度が悪くなってしまう。
【００３４】
そこで、上記信号弁別手段１７では、信号振幅の小さい成分、つまり、３Ｔ，４Ｔ等の周波数が高い信号を選択的に弁別し、該弁別された信号のうち、特定の周波数成分のみを上記振幅情報検出手段１３により選択する。そして、上記ＡＧＣ制御手段１４では、その振幅レベルが一定になるように自動的にＡＧＣ制御を行なう。このように、信号振幅の小さい成分のみを抽出してＡＧＣ制御を行なうようにすれば、アドレス情報の読み取り精度を高めることができる。
【００３５】
なお、ＡＧＣ制御手段１４は、上記信号長が３Ｔである信号の振幅が一定になるようＶＧＡ１１の制御を行う。または、上記信号長が４Ｔもしくはそれ以上の長さを持つ信号の内の１つである信号の振幅が一定になるようＶＧＡ１１の制御を行う。または、上記信号長が３Ｔ、４Ｔ、またはそれ以外の長さを持つ複数の信号の組合せの内の１つである信号の振幅が平均的に一定になるようＶＧＡ１１の制御を行う。
【００３６】
図６は、アナログ信号１０の波形を示す模式図である。
図６において、１００はアナログ信号１０を模式化した再生波形Ａ、１０１はセクタフォーマット構成を取る記憶媒体から再生された再生信号の１つの区切りを示すセクタ、１１０はセクタ１０１の中のアドレス情報（データの位置情報）を示す有するＩＤ部、１２０はユーザ情報を示す有するＤＡＴＡ部である。
【００３７】
図７は、外部から入力される、アナログ信号１０の波形を示す模式図である。図７において、１０５はアナログ信号１０を模式化した再生波形Ｂ、１１１は第１のアドレス情報を示す第１のＣＡＰＡ、１１２は第２のアドレス情報を示す第２のＣＡＰＡ、１２１はユーザ情報を示す有するＤＡＴＡ部、１１５はＡＧＣ制御手段１４の出力を示すゲイン信号、３０１は第１のＣＡＰＡ１１１と第２のＣＡＰＡ１１２とを識別するＣＡＰＡゲート、３０２は第１のＣＡＰＡ１１１のみを検出する第１のＣＡＰＡゲート、３０３は第２のＣＡＰＡ１１２のみを検出する第２のＣＡＰＡゲート、３００はＩＤ部とデータ部とを識別するＩＤゲートである。
【００３８】
なお、制御ゲートの生成方法としては、第１のＣＡＰＡゲート３０２、または第２のＣＡＰＡゲート３０３のいずれかを制御ゲート１６としてもよい。また、第１のＣＡＰＡゲート３０２、または第２のＣＡＰＡゲートのいずれかとＩＤゲート３００との論理積、もしくは排他的論理和をとったものを制御ゲート１６としても良い。また、アドレス情報をが正確に再生できる状態になった後、フォーマット生成回路により、再生したい目的のアドレス情報（ＣＡＰＡ）の１つ又は複数前にあるＣＡＰＡゲートを始点としてカウンタを動作させ、再生したい目的のＣＡＰＡ位置に第１のＣＡＰＡゲート３０２または第２のＣＡＰＡゲート３０３を生成したものを制御ゲート１６としてもよい。
【００３９】
図８は、ＡＧＣ制御されたアナログ信号１０の波形を示す模式図である。
図８において、２０１はＡＧＣ制御されたＶＧＡ１１出力を示す再生波形、２１０はＶＧＡ１１の制御信号となるゲイン信号である。
【００４０】
以上のように構成された自動利得制御装置の動作について説明する。
アナログ信号１０は、図６及び図７に示すような再生波形Ａ１００及び再生波形Ｂ１０５の形態であって、ＶＧＡ１１に入力される。このとき、図７の再生波形Ｂ１０５に示すように、第１のＣＡＰＡ１１１と第２のＣＡＰＡ１１２は振幅がそれぞれ異なり不均一になっている。
【００４１】
ここで、ＶＧＡ１１にて振幅を増幅されたの出力はアナログ信号はであるため、Ａ／Ｄ変換器１２によりディジタル信号値に変換される。そして、信号弁別手段１７により上記Ａ／Ｄ変換器１２の出力から信号の長さに関する情報をが弁別するされる。このとき、信号弁別手段１７では、信号の間隔をチャネルクロックでカウント（１Ｔ、２Ｔ、３Ｔ…）することにより信号の長さを弁別するが弁別される。
【００４２】
そして、振幅情報抽出手段１３では、上記Ａ／Ｄ変換器１２の出力のうち、上記アナログ信号１０の振幅情報、及び上記信号弁別手段１７により弁別された信号長情報に基づいて特定の信号長（例えば、３Ｔ、６Ｔ）を持つ信号の振幅情報が抽出され、ＡＧＣ制御手段１４に供給される。
【００４３】
そして、ＡＧＣ制御手段１４では、振幅情報抽出手段１３から出力された振幅情報に基づいてゲインが制御され、その制御量はＤ／Ａ変換器１５によりアナログ信号であるゲイン信号１１５に変換され、このゲイン信号１１５によりＶＧＡ１１が制御される。その結果、再生波形Ｂ１０５のように第１のＣＡＰＡ１１１、及び第２のＣＡＰＡ１１２が不均一であった入力アナログ信号１０は、図８の再生波形２０１に示す第１のＣＡＰＡ２１１、及び第２のＣＡＰＡ２１２のように均一の振幅に制御される。
【００４４】
このような実施の形態１では、データの位置複数のアドレス情報を示すＩＤ部と、ユーザ情報を示すデータ部とを有する入力アナログ信号１０の振幅を増幅した後、ディジタル化し、該上記ディジタル化された信号のうちの、上記ＩＤ部に含まれる複数のアドレス情報のそれぞれの特性に対応する信号から振幅情報を抽出し、該上記抽出された各振幅情報に基づいてＶＧＡ１１のゲインを制御するようにしたので、ＩＤ部のみに対して該ＩＤ部に含まれる複数のアドレス情報のそれぞれの特性に応じた自動利得制御を行うことができ、その結果、自動利得制御をより正確に行い、アドレス情報読み出しのエラーレートを低減でき、安定したシステム構築を可能とすることができる。
【００４５】
また、本実施の形態１では、ディジタル信号の長さを検出する信号弁別手段１７を備えているので、所望の信号長の信号に対して自動利得制御することができ、その結果、アドレス読み取り率を向上させることができる。
【００４６】
（実施の形態２）
以下に、本発明の実施の形態２による自動利得制御装置、及び自動利得制御方法について、図２、図６、図７、及び図９を用いて説明する。なお、図６及び図７については、実施の形態１で説明したので、ここでは説明を省略する。
【００４７】
図２は、本実施の形態２による自動利得制御装置の構成を示すブロック図である。
図２において、２０は、記憶媒体から再生された光の情報から電気信号に変換されたアナログ信号であり、データの位置情報である特性の異なる複数のアドレス情報を示すＩＤ部と、ユーザ情報を示すデータ部とを有する。ここで、ＩＤ部とは、特性の異なる複数の情報を有するものである。２１は、アナログ信号２０の振幅を、上記ＩＤ部に含まれる複数のアドレス情報のそれぞれの特性の応じた利得（ゲイン）で増幅するＶＧＡ（Ｖａｒｉａｂｌｅ　Ｇａｉｎ　Ａｍｐｌｉｆｉｅｒ）である。２２は、アナログ信号であるＶＧＡ２１の出力をサンプリングしてディジタル信号に変換するＡ／Ｄ変換器である。２３は、Ａ／Ｄ変換器２２の出力（再生信号）から第１の振幅情報を抽出する振幅情報抽出手段である。２４は、振幅情報抽出手段２３の出力である第１の振幅情報に対し一定量の比を持つ第２の振幅情報を生成するゲイン比生成回路である。２５は、振幅情報抽出手段２３により抽出された振幅情報に基づいてＶＧＡ２１を制御するための制御信号を出力するＡＧＣ制御手段である。２６は、ディジタル信号であるＡＧＣ制御手段２５の出力（制御信号）をアナログ信号に変換するＤ／Ａ変換器である。２７は、外部から入力された制御ゲート３５０に基づいて上記振幅情報抽出手段２３の出力またはゲイン比生成回路２４の出力のいずれかの信号を選択する信号選択手段である。３５０は、第１，第２のＣＡＰＡを識別する制御ゲートである。なお、制御ゲート３５０は、上記実施の形態１の制御ゲートと同様に生成されるものである。
【００４８】
図９は、アナログ信号２０の波形を示す模式図である。
図９において、３３０はＶＧＡ２１に入力されるゲイン信号、３２１はゲイン区間Ａ、３２２はゲイン区間Ｂである。なお、ゲイン区間Ａとゲイン区間Ｂのゲイン比は一定である。３４０はＡＧＣ制御されたＶＧＡ２１出力の再生波形、３１１はＡＧＣ制御された再生波形３４０の第１のＣＡＰＡ、３１２はＡＧＣ制御された再生波形３４０の第２のＣＡＰＡ、３２０はＡＧＣ制御された再生波形３４０のＤＡＴＡ部である。
【００４９】
以上のように構成された自動利得制御装置の動作について説明する。
アナログ信号２０は、図６及び図７に示すような再生波形Ａ１００及び再生波形Ｂ１０５の形態であって、ＶＧＡ２１に入力される。このとき、図７の再生波形Ｂ１０５に示すように、第１のＣＡＰＡ１１１、及び第２のＣＡＰＡ１１２の振幅はそれぞれ異なり、不均一になっている。
【００５０】
ここで、ＶＧＡ２１にて振幅を増幅されたの出力はアナログ信号はであるため、Ａ／Ｄ変換器２２によりディジタル信号値に変換される。そして、振幅情報抽出手段２３により上記Ａ／Ｄ変換器２２の出力から上記入力アナログ信号２０の第１の振幅情報が抽出されるとともに、該抽出された第１の振幅情報信号に対して一定比の関係を持つ第２の振幅情報がゲイン比生成回路２４により新たに生成される。これら異なる２つの振幅情報は、信号選択手段２７により、上記再生波形Ｂ１０５の第１のＣＡＰＡ１１１、及び第２のＣＡＰＡ１１２のそれぞれに対応するよう上記制御ゲート３５０の信号に基づいて切り換えられ、ＡＧＣ制御手段２５に供給される。
【００５１】
ＡＧＣ制御手段２５では、上記信号選択手段２７により選択された振幅情報に基づいてＡＧＣのゲインが制御され、その制御量はＤ／Ａ変換器２６によりアナログ信号であるゲイン信号３３０に変換され、このゲイン信号３３０によりＶＧＡ２１が制御される。その結果、再生波形Ｂ１０５のように第１のＣＡＰＡ１１１、及び第２のＣＡＰＡ１１２が不均一であった入力アナログ信号２０は、図９の再生波形３４０に示す第１のＣＡＰＡ３１１、及び第２のＣＡＰＡ３１２のように均一に、あるいは振幅差はあるがその差が小さくなるように制御される。
【００５２】
このような実施の形態２では、複数のアドレスデータの位置情報を示すＩＤ部と、ユーザ情報を示すデータ部とを有する入力アナログ信号２０の振幅を増幅した後、ディジタル化し、該上記ディジタル化された信号のうちの、上記ＩＤ部に含まれる複数のアドレス情報のそれぞれの特性に対応する信号から振幅情報を抽出し、該上記抽出された各振幅情報に基づいてＶＧＡ２１のゲインを制御するようにしたので、ＩＤ部のみに対して該ＩＤ部に含まれる複数のアドレス情報のそれぞれの特性に応じた自動利得制御を行うことができ、その結果、自動利得制御をより正確に行い、アドレス情報読み出しのエラーレートを低減でき、安定したシステム構築を可能とすることができる。
【００５３】
また、本実施の形態２では、ゲイン区間Ａ３２１とゲイン区間Ｂ３２２のゲイン比を、第１のＣＡＰＡ１１１と第２のＣＡＰＡ１１２との比と同じ比になるよう設定するようにしたので、第１ＣＡＰＡと第２のＣＡＰＡとのゲイン比を常に監視し、そのゲイン比に基づいて第１、第２のＣＡＰＡをそれぞれ独立に自動利得制御することができる。
【００５４】
（実施の形態３）
以下に、本発明の実施の形態３による自動利得制御装置、及び自動利得制御方法について、図３、図７、及び図８を用いて説明する。なお、図７及び図８については、実施の形態１で説明したので、ここでは説明を省略する。
図３は、本実施の形態３による自動利得制御装置の構成を示すブロック図である。
【００５５】
図３において、３０は、記憶媒体から再生された光の情報から電気信号に変換されたアナログ信号であり、データの位置情報である特性の異なる複数のアドレス情報を示すＩＤ部と、ユーザ情報を示すデータ部とを有する。ここで、ＩＤ部とは、特性の異なる複数の情報を有するものである。３１は、アナログ信号３０の振幅を、上記ＩＤ部に含まれる複数のアドレス情報のそれぞれの特性に応じた利得（ゲイン）で増幅するＶＧＡ（Ｖａｒｉａｂｌｅ　Ｇａｉｎ　Ａｍｐｌｉｆｉｅｒ）である。３２は、アナログ信号であるＶＧＡ３１の出力をサンプリングしてディジタル信号に変換するＡ／Ｄ変換器である。３３は、ディジタル信号に変換された再生信号（Ａ／Ｄ変換器３２の出力）から第１の振幅情報を抽出する第１の振幅情報抽出手段である。３４は、第１の振幅情報抽出手段３３により抽出された第１の振幅情報に基づいて上記入力アナログ信号３０に対して振幅の制御を行う第１のＡＧＣ制御手段である。３５は、ディジタル信号に変換された再生信号（Ａ／Ｄ変換器３２の出力）から第２の振幅情報を抽出する第２の振幅情報抽出手段である。３６は、第２の振幅情報抽出手段３５により抽出された第２の振幅情報に基づいて上記入力アナログ信号３０に対して振幅の制御を行う第２のＡＧＣ制御手段である。３７は、第１のＡＧＣ制御手段３４あるいは第２のＡＧＣ制御手段３６の出力であるディジタル出力をアナログ信号に変換するＤ／Ａ変換器である。３８は、制御ゲート３５１に基づいてＡ／Ｄ変換器３２の出力を、第１の振幅情報抽出手段３３へ出力する経路、または第２の振幅情報抽出手段３５へ出力する経路、のいずれかの経路を選択する第１の信号選択手段である。なお、Ａ／Ｄ変換器３２の出力を第１の振幅情報抽出手段３３へ出力する経路とは、第１のＣＡＰＡ１１１のＡＧＣ制御を行うための第１のＣＡＰＡ用制御経路である。また、Ａ／Ｄ変換器３２の出力を第２の振幅情報抽出手段３５へ出力する経路とは、第２のＣＡＰＡ１１２のＡＧＣ制御を行うための第２のＣＡＰＡ用制御経路である。３９は、制御ゲート３５１に基づいて第１のＡＧＣ制御手段３４の出力、あるいは第２のＡＧＣ制御手段３６の出力、のいずれかを選択し、Ｄ／Ａ変換器３７に出力する第２の信号選択手段である。３５１は、第１，第２のＣＡＰＡを識別する制御ゲートである。なお、制御ゲート３５１は、上記実施の形態１の制御ゲートと同様に生成されるものである。
【００５６】
以上のように構成された自動利得制御装置の動作について説明する。
アナログ信号３０は、図７に示すような再生波形Ｂ１０５の形態であって、ＶＧＡ３１に入力される。このとき、図７の再生波形Ｂ１０５に示すように、第１のＣＡＰＡ１１１、及び第２のＣＡＰＡ１１２の振幅はそれぞれ異なり、不均一になっている。
【００５７】
ここで、ＶＧＡ３１にて振幅を増幅されたの出力はアナログ信号はであるため、Ａ／Ｄ変換器３２によりディジタル信号に変換される。そして、Ａ／Ｄ変換器３２でディジタル信号に変換された信号は、第１の信号選択手段３８により選択された制御経路に出力され、第１のＣＡＰＡ１１１のＡＧＣ制御用信号、または第２のＣＡＰＡ１１２のＡＧＣ制御用信号が生成される。
【００５８】
なお、第１のＣＡＰＡ１１１、第２のＣＡＰＡ１１２は、ＩＤゲート３００がアサートされている状態で、通常ＣＡＰＡゲート３０１のように出力される。また、制御ゲート３５１は、ＣＡＰＡゲート３０１を第１のＣＡＰＡゲート３０２と第２のＣＡＰＡゲート３０３とに分け、第１のＣＡＰＡゲート３０２により第１のＣＡＰＡ１１１制御用経路を、第２のＣＡＰＡゲート３０３により第２のＣＡＰＡ１１２制御用経路を、それぞれ選択するよう第１の信号選択手段３８、及び第２の信号選択手段３９を制御する。
【００５９】
制御ゲート３５１により選択された制御経路では、まず、第１の振幅情報抽出手段３３または第２の振幅情報抽出手段３５により、Ａ／Ｄ変換器３２の出力からアナログ信号３０の振幅情報が抽出され、それぞれ第１のＡＧＣ制御手段３４または第２のＡＧＣ制御手段３６に入力され、ＡＧＣ制御信号が生成される。第１のＡＧＣ制御手段３４、または第２のＡＧＣ制御手段３６の出力は、第２の信号選択手段３９により選択され、第１のＣＡＰＡ１１１と第２のＣＡＰＡ１１２に対応するＡＧＣ制御信号としてＤ／Ａ変換器３７に出力される。
【００６０】
そして、Ｄ／Ａ変換器３７では、制御ゲート３５１により選択されたＡＧＣ制御信号がアナログ信号であるゲイン信号２１０に変換され、このゲイン信号２１０によりＶＧＡ３１が制御される。その結果、再生波形Ｂ１０５のように第１のＣＡＰＡ１１１、及び第２のＣＡＰＡ１１２が不均一であった入力アナログ信号３０は、図８の再生波形２０１に示す第１のＣＡＰＡ２１１、第２のＣＡＰＡ２１２のように均一の振幅に制御される。
【００６１】
このような実施の形態３では、複数のアドレスデータの位置情報を示すＩＤ部と、ユーザ情報を示すデータ部とを有する入力アナログ信号３０の振幅を増幅した後、ディジタル化し、該上記ディジタル化された信号のうちの、上記ＩＤ部に含まれる複数のアドレス情報のそれぞれの特性に対応する信号から振幅情報を抽出し、上記抽出された各振幅情報に基づいてＶＧＡ３１のゲインを制御するようにしたので、ＩＤ部のみに対して該ＩＤ部に含まれる複数のアドレス情報のそれぞれの特性に応じた自動利得制御を行うことができ、その結果、自動利得制御をより正確に行い、アドレス情報読み出しのエラーレートを低減でき、安定したシステム構築を可能とすることができる。
【００６２】
また、本実施の形態３では、入力信号３０のＩＤ部１１０の第１のＣＡＰＡ１１１と第２のＣＡＰＡ１１２のそれぞれのゲインに応じてＶＧＡの利得制御を行うようにしたので、第１のＣＡＰＡと第２のＣＡＰＡの自動利得制御をより細かく行え、その結果、自動利得制御機能の性能を向上させることができ、アドレス読み取り率を向上させることができる。
【００６３】
（実施の形態４）
以下に、本発明の実施の形態４による自動利得制御装置、及び自動利得制御方法について、図４、図７、図８を用いて説明する。なお、図７及び図８については、実施の形態１で説明したので、ここでは説明を省略する。
図４は、本実施の形態４による自動利得制御装置の構成を示すブロック図である。
【００６４】
図４において、４０は、記憶媒体から再生された光の情報から電気信号に変換されたアナログ信号であり、データの位置情報である特性の異なる複数のアドレス情報を示すＩＤ部と、ユーザ情報を示すデータ部とを有する。ここで、ＩＤ部とは、特性の異なる複数の情報を有するものである。４１は、アナログ信号４０の振幅を、上記ＩＤ部に含まれる複数のアドレス情報のそれぞれの特性に応じた利得（ゲイン）で増幅するＶＧＡ（Ｖａｒｉａｂｌｅ　Ｇａｉｎ　Ａｍｐｌｉｆｉｅｒ）である。４２は、アナログ信号であるＶＧＡ４１の出力をサンプリングしてディジタル信号に変換するＡ／Ｄ変換器である。４３は、ディジタル信号である再生信号（Ａ／Ｄ変換器４２の出力）から第１の振幅情報を抽出する第１の振幅情報抽出手段である。４４は、ディジタル信号である再生信号（Ａ／Ｄ変換器４２の出力）から第２の振幅情報を抽出する第２の振幅情報抽出手段である。４５は、第１の振幅情報抽出手段４３または第２の振幅情報抽出手段４４により抽出された振幅情報に基づいて上記入力アナログ信号４０に対して振幅の制御を行うＡＧＣ制御手段である。４６は、ディジタル信号であるＡＧＣ制御手段４５の出力をアナログ信号に変換するＤ／Ａ変換器である。４７は、制御ゲート４１０に基づいてＡ／Ｄ変換器４２の出力を、第１の振幅情報抽出手段４３へ出力する経路、または第２の振幅情報抽手段４４へ出力する経路、のいずれかの経路を選択する第１の信号選択手段である。なお、Ａ／Ｄ変換器４２の出力を第１の振幅情報抽出手段４３へ出力する経路とは、第１のＣＡＰＡ１１１のＡＧＣ制御を行うための第１のＣＡＰＡ用制御経路である。また、Ａ／Ｄ変換器４２の出力を第２の振幅情報抽出手段４４へ出力する経路とは、第２のＣＡＰＡ１１２のＡＧＣ制御を行うための第２のＣＡＰＡ用制御経路である。４８は、制御ゲート４１０に基づいて第１の振幅情報抽出手段４３の出力、または第２の振幅情報抽出手段４４の出力、のいずれかを選択し、ＡＧＣ制御手段４５に出力する第２の信号選択手段である。４１０は、第１，第２のＣＡＰＡを識別する制御ゲートである。なお、制御ゲート４１０は、上記実施の形態１の制御ゲートと同様に生成されるものである。
【００６５】
以上のように構成された自動利得制御装置の動作について説明する。
アナログ信号４０は、図７に示すような再生波形Ｂ１０５の形態であって、ＶＧＡ４１に入力される。このとき、図７の再生波形Ｂ１０５に示すように、第１のＣＡＰＡ１１１、及び第２のＣＡＰＡ１１２の振幅はそれぞれ異なり、不均一になっている。
【００６６】
ここで、ＶＧＡ４１にて振幅を増幅されたの出力はアナログ信号はであるため、Ａ／Ｄ変換器４２によりディジタル信号に変換される。そして、Ａ／Ｄ変換器４２でディジタル信号に変換された信号は、第１の信号選択手段４７により選択された制御経路に出力され、第１のＣＡＰＡ１１１のＡＧＣ制御用信号、または第２のＣＡＰＡ１１２のＡＧＣ制御用信号が生成される。
【００６７】
なお、制御ゲート４１０は、ＣＡＰＡゲート３０１を第１のＣＡＰＡゲート３０２と第２のＣＡＰＡゲート３０３とに分け、第１のＣＡＰＡゲート３０２により第１のＣＡＰＡ１１１制御用経路を、第２のＣＡＰＡゲート３０３により第２のＣＡＰＡ１１２制御用経路を、それぞれ選択するよう第１の信号選択手段４７、及び第２の信号選択手段４８を制御する。
【００６８】
制御ゲート４１０により選択された制御経路では、まず、第１の振幅情報抽出手段４３または第２の振幅情報抽出手段４４により、Ａ／Ｄ変換器４２の出力からアナログ信号４０の振幅情報が抽出される。そして、第１の振幅情報抽出手段４３または第２の振幅情報抽出手段４４の出力は、制御ゲート４１０を用いて第２の信号選択手段４８により、第１のＣＡＰＡ１１１と第２のＣＡＰＡ１１２にそれぞれ対応する振幅情報出力として選択され、ＡＧＣ制御手段４５に入力され、ＡＧＣ制御信号が生成される。
【００６９】
次に、ＡＧＣ制御手段４５の出力は、Ｄ／Ａ変換器４６によりアナログ信号であるゲイン信号２１０、つまり、ＶＧＡ４１の制御信号に変換され、このゲイン信号２１０によりＶＧＡ４１が制御される。その結果、再生波形Ｂ１０５のように第１のＣＡＰＡ１１１、及び第２のＣＡＰＡ１１２が不均一であった入力アナログ信号４０は、図８の再生波形２０１に示す第１のＣＡＰＡ２１１、第２のＣＡＰＡ２１２のように均一の振幅に制御される。
【００７０】
このような実施の形態４では、複数のアドレスデータの位置情報を示すＩＤ部と、ユーザ情報を示すデータ部とを有する入力アナログ信号４０の振幅を増幅した後、ディジタル化し、該上記ディジタル化された信号のうちの、上記ＩＤ部に含まれる複数のアドレス情報のそれぞれの特性に対応する信号から振幅情報を抽出し、上記抽出された各振幅情報に基づいてＶＧＡ４１のゲインを制御するようにしたので、ＩＤ部のみに対して該ＩＤ部に含まれる複数のアドレス情報のそれぞれの特性に応じた自動利得制御を行うことができ、その結果、自動利得制御をより正確に行い、アドレス情報読み出しのエラーレートを低減でき、安定したシステム構築を可能とすることができる。
【００７１】
また、本実施の形態４では、入力信号４０のＩＤ部１１０の第１のＣＡＰＡ１１１と第２のＣＡＰＡ１１２のそれぞれのゲインに応じてＶＧＡの利得制御を行うようにしたので、第１、第２のＣＡＰＡのそれぞれを独立により細かく自動利得制御することができ、その結果、自動利得制御機能の性能をより向上することができる。また、上記実施の形態３の自動利得制御装置に比べてＡＧＣ制御手段を一つとしたので、回路規模も最小限にすることができる。
【００７２】
（実施の形態５）
以下に、本発明の実施の形態５による自動利得制御装置、及び自動利得制御方法について、図５、図６、図７、及び図８を用いて説明する。なお、図６から図８については、実施の形態１で説明したので、ここでは説明を省略する。
図５は、本実施の形態５による自動利得制御装置の構成を示すブロック図である。
【００７３】
図５において、５０は、記憶媒体から再生された光の情報から電気信号に変換されたアナログ信号であり、特性の異なる複数のデータの位置情報であるアドレス情報を示すＩＤ部と、ユーザ情報を示すデータ部とを有する。ここで、ＩＤ部とは、特性の異なる複数の情報を有するものである。５１は、アナログ信号５０の振幅を、上記ＩＤ部に含まれる複数のアドレス情報のそれぞれの特性に応じた利得（ゲイン）で増幅するＶＧＡ（Ｖａｒｉａｂｌｅ　Ｇａｉｎ　Ａｍｐｌｉｆｉｅｒ）である。５２は、アナログ信号であるＶＧＡ５１の出力をサンプリングしてディジタル信号に変換するＡ／Ｄ変換器である。５３は、ディジタル信号に変換された再生信号（Ａ／Ｄ変換器５２の出力）から振幅情報を抽出する振幅情報抽出手段である。５４は、振幅情報抽出手段５３により抽出された振幅情報に基づいて入力アナログ信号５０に対して振幅の制御を行うＡＧＣ制御手段である。５５は、ＶＧＡ５１に対する任意の固定ゲインの設定、またはＡＧＣ制御を行う設定、をするゲイン設定回路である。５６は、ディジタル信号であるＡＧＣ制御手段５４の出力をアナログ信号に変換するＤ／Ａ変換器である。５１０は、第１，第２のＣＡＰＡを識別する制御ゲートである。なお、制御ゲート５１０は、上記実施の形態１の制御ゲートと同様に生成されるものである。５３５はゲイン設定回路５５に状態を設定するゲイン設定信号である。
【００７４】
以上のように構成された自動利得制御装置の動作について説明する。
アナログ信号５０は、図６及び図７に示すような再生波形Ａ１００及び再生波形Ｂ１０５の形態であって、ＶＧＡ５１に入力される。このとき、図７の再生波形Ｂ１０５に示すように、第１のＣＡＰＡ１１１、及び第２のＣＡＰＡ１１２の振幅がそれぞれ異なり、不均一になっている。
【００７５】
ここで、ＶＧＡ１１にて振幅を増幅されたの出力はアナログ信号はであるため、Ａ／Ｄ変換器１２によりディジタル信号に変換される。そして、振幅情報抽出手段５３により上記Ａ／Ｄ変換器５２の出力から上記入力アナログ信号５０の振幅情報が抽出され、ＡＧＣ制御手段５４に供給される。
【００７６】
一方、ゲイン設定回路５５では、ゲイン設定信号５３５に基づいて、ＡＧＣ制御を行う第１の制御モード、またはＶＧＡ５１のゲインを任意の固定値にする第２の制御モード、のいずれかの制御モードが選択される。
【００７７】
ＡＧＣ制御手段５４では、第１の制御モードが設定された場合、振幅情報抽出手段５３の出力を基にＡＧＣのゲインを制御し、その制御量をＤ／Ａ変換器５６に出力する。また、第２の制御モードが設定された場合、任意の固定ゲインとするよう出力を制御し、その制御量をＤ／Ａ変換器５６に出力する。
【００７８】
Ｄ／Ａ変換器５６では、ディジタル信号であるＡＧＣ制御手段５４の出力がアナログ信号であるゲイン信号１１５に変換され、このゲイン信号１１５によりＶＧＡ１１が制御される。その結果、再生波形Ｂ１０５のように第１のＣＡＰＡ１１１と、第２のＣＡＰＡ１１２が不均一であった入力アナログ信号５０は、図８の再生波形２０１に示す第１のＣＡＰＡ２１１、第２のＣＡＰＡ２１２のように均一の振幅に制御される。このように、ＶＧＡ５１に固定ゲインを設定することで入力信号の絶対値を検出することができる。
【００７９】
このような実施の形態５では、複数のアドレスデータの位置情報を示すＩＤ部と、ユーザ情報を示すデータ部とを有する入力アナログ信号５０の振幅を増幅した後、ディジタル化し、該上記ディジタル化された信号のうちの、上記ＩＤ部に含まれる複数のアドレス情報のそれぞれの特性に対応する信号から振幅情報を抽出し、上記抽出された各振幅情報に基づいてＶＧＡ５１のゲインを制御するようにしたので、ＩＤ部のみに対して該ＩＤ部に含まれる複数のアドレス情報のそれぞれの特性に応じた自動利得制御を行うことができ、その結果、自動利得制御をより正確に行い、アドレス情報読み出しのエラーレートを低減でき、安定したシステム構築を可能とすることができる。
【００８０】
また、本実施の形態５では、ゲイン設定信号５３５に基づいて設定された所定のゲインレベルに基づいてＶＧＡ５１の利得制御を行うようにしたので、設定した利得レベルに基づいて自動利得制御することができ、その結果、アドレスの読み取り率を向上させ、かつ、回路規模の増加を抑えた低コストで実現可能な自動利得制御装置を実現することができる。
【００８１】
【発明の効果】
以上のように、本発明の請求項１に記載の自動利得制御装置によれば、記憶媒体から読み出された、特性の異なる複数のアドレス情報を示すＩＤ部と、ユーザ情報を示すデータ部とを有するアナログ信号を再生する際に、上記アナログ信号の振幅が一定になるよう自動的に調整する自動利得制御装置であって、上記アナログ信号に所定の利得を与えて、該信号の振幅を増幅させる可変利得増幅手段と、上記可変利得増幅手段の出力をサンプリングしてディジタル信号に変換するＡ／Ｄ変換手段と、上記ディジタル信号のうちの上記複数のアドレス情報に対応する信号から振幅情報を抽出する振幅情報抽出手段と、上記振幅情報抽出手段により抽出された各振幅情報に基づいて上記可変利得増幅手段の利得を制御する自動利得制御手段と、を備えたことより、従来のようにアナログ信号に含まれるＩＤ部、及びデータ部の両方に対し自動利得制御するのではなく、ＩＤ部のみに対して自動利得制御することによりアドレス読み取り率を向上させることができ、その結果、自動利得制御をより正確に行うことができる。
【００８２】
また、本発明の請求項２に記載の自動利得制御装置によれば、請求項１に記載の自動利得制御装置において、上記ＩＤ部に含まれる複数のアドレス情報のうちの、最初のアドレス情報を示すＩＤ部を第１のＣＡＰＡ、次のアドレス情報を示すＩＤ部を第２のＣＡＰＡとし、上記第１のＣＡＰＡの利得に対して所定の一定比を持つよう第２のＣＡＰＡの利得を決定する利得比生成手段と、外部から入力された制御ゲートに基づいて上記振幅情報抽出手段の出力または上記利得比生成手段の出力のいずれかを選択し、上記自動利得制御手段に出力する信号選択手段と、を備え、上記自動利得制御手段は、上記信号選択手段により選択された信号に基づいて上記可変利得増幅手段の利得を制御するようにしたので、第１のＣＡＰＡと第２のＣＡＰＡのゲイン比を常に監視し、そのゲイン比に基づいて第１のＣＡＰＡと第２のＣＡＰＡとをそれぞれ独立に自動利得制御することができる。
【００８３】
また、本発明の請求項３に記載の自動利得制御装置によれば、請求項１に記載の自動利得制御装置において、上記振幅抽出手段である第１の振幅抽出手段と同一の構成を有する第２の振幅抽出手段と、上記自動利得制御手段である第１の自動利得制御手段と同一の構成を有する第２の自動利得制御手段と、外部から入力された制御ゲートに基づいて上記Ａ／Ｄ変換手段の出力を、上記第１の振幅情報抽出手段または上記第２の振幅情報抽出手段のいずれかに出力する信号選択手段と、をさらに備え、上記ＩＤ部に含まれる複数のアドレス情報のうちの、最初のアドレス情報を示すＩＤ部を第１のＣＡＰＡ、次のアドレス情報を示すＩＤ部を第２のＣＡＰＡとし、上記第１の振幅情報抽出手段は、上記第１のＣＡＰＡから第１の振幅情報を抽出して上記第１の自動利得制御手段に出力し、上記第１の自動利得制御手段は、上記第１の振幅情報に基づいて上記可変利得増幅手段の利得を制御し、上記第２の振幅情報抽出手段は、上記第２のＣＡＰＡから第２の振幅情報を抽出して上記第２の自動利得制御手段に出力し、上記第２の自動利得制御手段は、上記第２の振幅情報に基づいて上記可変利得増幅手段の利得を制御するようにしたので、第１のＣＡＰＡと第２のＣＡＰＡの自動利得制御をより細かく行え、その結果、自動利得制御機能の性能を向上させることができる。
【００８４】
また、本発明の請求項４に記載の自動利得制御装置によれば、請求項１に記載の自動利得制御装置において、上記振幅抽出手段である第１の振幅抽出手段と同一の構成を有する第２の振幅抽出手段と、外部から入力された制御ゲートに基づいて上記Ａ／Ｄ変換手段の出力を、上記第１の振幅抽出手段または上記第２の振幅抽出手段のいずれかに出力する第１の信号選択手段と、外部から入力された制御ゲートに基づいて上記第１の振幅情報抽出手段の出力または上記第２の振幅情報抽出手段の出力のいずれかを選択し、上記自動利得制御手段に出力する第２の信号選択手段と、をさらに備え、上記ＩＤ部に含まれる複数のアドレス情報のうちの、最初のアドレス情報を示すＩＤ部を第１のＣＡＰＡ、次のアドレス情報を示すＩＤ部を第２のＣＡＰＡとし、上記第１の振幅情報抽出手段は、上記第１のＣＡＰＡから第１の振幅情報を抽出し、上記第２の振幅情報抽出手段は、上記第２のＣＡＰＡから第２の振幅情報を抽出し、上記自動利得制御手段は、上記第２の信号選択手段により選択された振幅情報に基づいて上記可変利得増幅手段の利得を制御するようにしたので、第１のＣＡＰＡと第２のＣＡＰＡのＡＧＣ制御をより細かく制御することができ、その結果、自動利得制御機能の性能を向上させることができるとともに、回路規模を小さくすることができる。
【００８５】
また、本発明の請求項５に記載の自動利得制御装置によれば、請求項１に記載の自動利得制御装置において、所定の利得レベルを設定する利得設定手段を、さらに備え、上記自動利得制御手段は、上記利得設定手段の出力に基づいて上記可変利得増幅手段の利得を制御するようにしたので、設定した利得レベルに基づいて自動利得制御することができ、その結果、アドレスの読み取り率を向上させ、かつ、回路規模の増加を抑えた低コストで実現可能な自動利得制御装置を実現することができる。
【００８６】
また、本発明の請求項６に記載の自動利得制御装置によれば、請求項１ないし請求項５のいずれかに記載の自動利得制御装置において、上記ディジタル信号の信号長を検出する信号弁別手段を、さらに備え、上記振幅情報抽出手段は、上記信号弁別手段により検出された信号長に基づいて上記ディジタル信号のうちの所望の信号長の信号から振幅情報を抽出し上記自動利得制御手段に出力するようにしたので、所望の信号長の信号に対して自動利得制御することができ、その結果、アドレス読み取り率を向上させることができる。
【００８７】
また、本発明の請求項７に記載の自動利得制御装置によれば、請求項６に記載の自動利得制御装置において、上記自動利得制御手段は、上記信号長の信号振幅が一定になるよう上記可変利得増幅手段の利得を制御するようにしたので、信号長が一定になるよう自動利得制御することができ、その結果、アドレス読み取り率を向上させることができる。
【００８８】
また、本発明の請求項８に記載の自動利得制御装置によれば、請求項６に記載の自動利得制御装置において、上記自動利得制御手段は、上記信号長が３Ｔである信号の振幅が一定になるよう上記可変利得増幅手段の利得を制御するようにしたので、信号長が３Ｔである信号の振幅が一定になるよう自動利得制御することができ、その結果、アドレス読み取り率を向上させることができる。
【００８９】
また、本発明の請求項９に記載の自動利得制御装置によれば、請求項６に記載の自動利得制御装置において、上記自動利得制御手段は、上記信号長が４Ｔもしくはそれ以上の長さを持つ信号の内の１つである信号の振幅が一定になるよう上記可変利得増幅手段の利得を制御するようにしたので、信号長が４Ｔもしくはそれ以上の長さを持つ信号の内の一つである信号の振幅が一定になるよう自動利得制御することができ、その結果、アドレス読み取り率を向上させることができる。
【００９０】
また、本発明の請求項１０に記載の自動利得制御装置によれば、請求項６に記載の自動利得制御装置において、上記自動利得制御手段は、上記信号長が３Ｔ、４Ｔ、またはそれ以外の長さを持つ複数の信号の組合せの内の１つである信号の振幅が平均的に一定になるよう上記可変利得増幅手段の利得を制御するようにしたので、信号長が３Ｔ、４Ｔ、またはそれ以外の長さを持つ複数の信号の組み合わせのうちの一つである信号の振幅が平均的に一定になるよう自動利得制御することができ、その結果、アドレス読み取り率を向上させることができる。
【００９１】
また、本発明の求項１１に記載の自動利得制御方法によれば、記憶媒体から読み出された、特性の異なる複数のアドレス情報を示すＩＤ部と、ユーザ情報を示すデータ部とを有する再生信号の振幅を可変利得増幅器を用いて増幅する際に、上記可変利得増幅器の利得を自動制御する自動利得制御方法において、上記再生信号の上記ＩＤ部に含まれる複数のアドレス情報に対応する信号から振幅情報を抽出し、上記抽出された各振幅情報のそれぞれの特性に応じて上記可変利得増幅器の利得を自動制御するようにしたので、従来のようにアナログ信号に含まれるＩＤ部、及びデータ部の両方に対し自動利得制御するのではなく、ＩＤ部のみに対して自動利得制御することができ、その結果、自動利得制御をより正確に行うことができる。
【００９２】
また、本発明の請求項１２に記載の自動利得制御方法によれば、請求項１１に記載の自動利得制御方法において、上記ＩＤ部に含まれる複数のアドレス情報のうちの、最初のアドレス情報を示すＩＤ部を第１のＣＡＰＡ、次のアドレス情報を示すＩＤ部を第２のＣＡＰＡとし、上記第１のＣＡＰＡの利得に対して所定の一定比を持つよう第２のＣＡＰＡの利得を決定し、外部から入力される制御ゲートに基づいて上記第１のＣＡＰＡの利得と、上記第２のＣＡＰＡの利得とを切り換え、上記可変利得増幅器の利得の自動制御を行うようにしたので、第１のＣＡＰＡと第２のＣＡＰＡとのゲイン比を常に監視し、そのゲイン比に基づいて第１のＣＡＰＡと第２のＣＡＰＡとをそれぞれ独立に自動利得制御することができる。
【００９３】
また、本発明の請求項１３に記載の自動利得制御方法によれば、請求項１１に記載の自動利得制御方法において、上記ＩＤ部に含まれる複数のアドレス情報のうちの、最初のアドレス情報を示すＩＤ部を第１のＣＡＰＡ、次のアドレス情報を示すＩＤ部を第２のＣＡＰＡとし、外部から入力された制御ゲートに基づいて上記第１のＣＡＰＡから第１の振幅情報を抽出して上記可変利得増幅器の利得を制御する第１の自動利得制御、または上記第２のＣＡＰＡから第２の振幅情報を抽出して上記可変利得増幅器の利得を制御する第２の自動利得制御のいずれかを行うようにしたので、第１のＣＡＰＡと第２のＣＡＰＡの自動利得制御をより細かく行え、その結果、自動利得制御機能の性能を向上させることができ、アドレス読み取り率を向上させることができる。
【００９４】
また、本発明の請求項１４に記載の自動利得制御方法によれば、請求項１１に記載の自動利得制御方法において、所定の利得レベルを設定し、該設定された利得に基づいて上記可変利得増幅器の利得の自動制御を行うようにしたので、設定した利得レベルに基づいて自動利得制御することができ、その結果、アドレスの読み取り率を向上させることができる。
【００９５】
また、本発明の請求項１５に記載の自動利得制御方法によれば、請求項１１ないし請求項１４のいずれかに記載の自動利得制御方法において、上記再生信号の信号長を検出し、上記検出した信号長に基づいて上記再生信号から所望の信号長の振幅情報を抽出し、上記可変利得増幅器の利得の自動制御を行うようにしたので、所望の信号長の信号に対して自動利得制御することができ、その結果、アドレス情報読み出しエラーレートが最小になるよう制御する信号長を選択することができる。
【図面の簡単な説明】
【図１】本発明の実施の形態１にかかる自動利得制御装置の構成を示すブロック図
【図２】本発明の実施の形態２にかかる自動利得制御装置の構成を示すブロック図
【図３】本発明の実施の形態３にかかる自動利得制御装置の構成を示すブロック図
【図４】本発明の実施の形態４にかかる自動利得制御装置の構成を示すブロック図
【図５】本発明の実施の形態５にかかる自動利得制御装置の構成を示すブロック図
【図６】アナログ信号の再生波形を示す模式図
【図７】アナログ信号のＡＧＣ制御を説明するための図
【図８】ＡＧＣ制御されたアナログ信号の再生波形を示す模式図
【図９】本発明の実施例の再生波形を示す模式図
【図１０】ピット列と光検出強度との関係を示す図
【図１１】本発明の信号弁別手段の構成の一例を示す図である。
【図１２】本発明の信号弁別手段の構成の一例を示す図である。
【図１３】本発明の振幅情報抽出手段の構成の一例を示す図である。
【図１４】本発明の振幅情報抽出手段の構成の一例を示す図である。
【図１５】従来の自動利得制御装置の構成を示すブロック図
【符号の説明】
１０　アナログ信号
１１　ＶＧＡ
１２　Ａ／Ｄ変換器
１３　振幅情報抽出手段
１３１　上側エンベロープ検出器
１３２　下側エンベロープ検出器
１３４　引き算器
１３５　ＦＷＲ
１３６　平均化回路
１３７　差分検出手段
１３８　制御レジスタ
１４　ＡＧＣ制御手段
１５　Ｄ／Ａ変換器
１６　制御ゲート
１７　信号弁別手段
１７１　３Ｔ検出手段
１７２　４Ｔ検出手段
１７３　５Ｔ検出手段
１７４　６Ｔ検出手段
１７５　制御レジスタ
１７６　セレクタ
１７７　平均化回路
２０　アナログ信号
２１　ＶＧＡ
２２　Ａ／Ｄ変換器
２３　振幅情報抽出手段
２４　ゲイン比生成回路
２５　ＡＧＣ制御手段
２６　Ｄ／Ａ変換器
２７　信号選択手段
３０　アナログ信号
３１　ＶＧＡ
３２　Ａ／Ｄ変換器
３３　第１の振幅情報抽出手段
３４　ＡＧＣ制御手段
３５　第２の振幅情報抽出手段
３６　ＡＧＣ制御器
３７　Ｄ／Ａ変換器
３８　第１の信号選択手段
３９　第２の信号選択手段
４０　アナログ信号
４１　ＶＧＡ
４２　Ａ／Ｄ変換器
４３　第１の振幅情報抽出手段
４４　第２の振幅情報抽出手段
４５　ＡＧＣ制御手段
４６　Ｄ／Ａ変換器
４７　第１の信号選択手段
４８　第２の信号選択手段
５０　アナログ信号
５１　ＶＧＡ
５２　Ａ／Ｄ変換手段
５３　振幅情報抽出手段
５４　ＡＧＣ制御手段
５５　ゲイン設定回路
５６　Ｄ／Ａ変換器
１００　再生波形Ａ
１０１　セクタ
１０５　再生波形Ｂ
１１０　ＩＤ部
１１１　第１のＣＡＰＡ
１１２　第２のＣＡＰＡ
１１５　ゲイン信号
１２０　ＤＡＴＡ部
１２１　ＤＡＴＡ部
２０１　再生波形
２１０　ゲイン信号
２１１　第１のＣＡＰＡ
２１２　第２のＣＡＰＡ
２２０　ＤＡＴＡ部
３００　ＩＤゲート
３０１　ＣＡＰＡゲート
３０２　第１のＣＡＰＡゲート
３０３　第２のＣＡＰＡゲート
３１１　第１のＣＡＰＡ
３１２　第２のＣＡＰＡ
３２０　ＤＡＴＡ部
３２１　ゲイン区間Ａ
３２２　ゲイン区間Ｂ
３３０　ゲイン信号
３４０　再生波形
３５１　制御ゲート
４１０　制御ゲート
５１０　制御ゲート
５３５　ゲイン設定信号
６１０　アナログ信号
６１１　ＶＧＡ
６１２　ＦＷＲ
６１３　ＬＰＦ
６１４　ＬＰＦ
６３０　ＩＤゲート
【図１】
2004048707.tif 000003
【図２】
2004048707.tif 000004
【図３】
2004048707.tif 000005
【図４】
2004048707.tif 000006
【図５】
2004048707.tif 000007
【図６】
2004048707.tif 000008
【図７】
2004048707.tif 000009
【図８】
2004048707.tif 000010
【図９】
2004048707.tif 000011
【図１０】
2004048707.tif 000012
【図１１】
2004048707.tif 000013
【図１２】
2004048707.tif 000014
【図１３】
2004048707.tif 000015
【図１４】
2004048707.tif 000016
【図１５】
2004048707.tif 000017