(57)【要約】【課題】新規な半導体物品の製造方法などを提供する。【解決手段】半導体基板上に化合物半導体多層膜を有する半導体物品の製造方法であって、化合物半導体基板１０００上に、エッチング犠牲層１０１０と、化合物半導体多層膜１０２０と、絶縁膜２０１０と、半導体基板２０００とを備え、且つ半導体基板と絶縁膜とを貫通する第１の溝２００５と、第１の溝に連結するように化合物半導体多層膜に設けられている第２の溝となる半導体基板溝１０２５とを有する部材を用意する工程、及び第１の溝と第２の溝を通して、エッチング液とエッチング犠牲層とを接触させて、エッチング犠牲層をエッチングし、前記部材から前記化合物半導体基板を分離する工程とを有する。【選択図】図１
2008135419.tif 000002
【特許請求の範囲】
【請求項１】
半導体基板上に化合物半導体多層膜を有する半導体物品の製造方法であって、
化合物半導体基板上に、エッチング犠牲層と、化合物半導体多層膜と、絶縁膜と、半導体基板とを、該化合物半導体基板側からこの順に備え、且つ前記化合物半導体多層膜に設けられている第１の溝と、前記第１の溝に連結するように前記半導体基板を貫通するように設けられている第２の溝とを有する部材を用意する工程、及び
前記第１の溝と前記第２の溝を通して、エッチング液と前記エッチング犠牲層とを接触させて、該エッチング犠牲層をエッチングし、前記部材から前記化合物半導体基板を分離する工程とを有することを特徴とする半導体物品の製造方法。
【請求項２】
前記部材は、前記化合物半導体基板に前記エッチング犠牲層を形成する工程、
前記エッチング犠牲層上に前記化合物半導体多層膜を形成する工程、
前記化合物半導体多層膜に前記第１の溝を、前記エッチング犠牲層が露出するように形成する工程、
前記第２の溝を備え、且つ前記絶縁膜を有する前記半導体基板を用意する工程、及び
前記化合物半導体基板と前記半導体基板とを、前記第１の溝と前記第２の溝とが連結するように貼り合わせる工程を経て用意されることを特徴とする請求項１記載の半導体物品の製造方法。
【請求項３】
前記化合物半導体基板と前記エッチング犠牲層との間に、前記エッチング液による前記化合物半導体基板のエッチングをストップするための層であるエッチング・ストップ層を有する請求項１又は２に記載の半導体物品の製造方法。
【請求項４】
前記絶縁膜には、前記第１及び第２の溝に連結する第３の溝が設けられている請求項１から３のいずれか１項に記載の半導体物品の製造方法。
【請求項５】
前記半導体基板の前記絶縁膜側表面には、絶縁層、あるいは回路層が設けられていることを特徴とする請求項１から４のいずれか１項に記載の半導体物品の製造方法。
【請求項６】
前記部材は、
前記化合物半導体基板に前記エッチング犠牲層を形成する工程、
前記エッチング犠牲層上に前記化合物半導体多層膜を形成する工程、
前記絶縁膜を有する前記半導体基板を用意する工程、
前記化合物半導体基板と前記半導体基板とを貼り合わせる工程、
前記半導体基板に前記第２の溝を形成する工程、
前記絶縁膜に前記第３の溝を形成する工程、及び
前記エッチング犠牲層が露出するように、前記化合物半導体多層膜に前記第１の溝を形成する工程、を経て用意されることを特徴とする請求項１記載の半導体物品の製造方法。
【請求項７】
前記化合物半導体基板上には、前記エッチング犠牲層と前記化合物半導体多層膜が交互に繰り返して積層されていることを特徴とする請求項１から６のいずれか１項に記載の半導体物品の製造方法。
【請求項８】
前記化合物半導体基板上には、前記エッチング・ストップ層、前記エッチング犠牲層と前記化合物半導体多層膜が交互に繰り返して積層されていることを特徴とする請求項３に記載の半導体物品の製造方法。
【請求項９】
前記化合物半導体多層膜と前記絶縁膜との間には、金属膜あるいはＤＢＲミラーの少なくとも一方が設けられていることを特徴とする請求項１から８のいずれか１項に記載の半導体物品の製造方法。
【請求項１０】
前記絶縁膜は、ポリイミド系絶縁材料である請求項１から９のいずれか１項に記載の半導体物品の製造方法。
【請求項１１】
前記半導体基板には、前記化合物半導体多層膜を含み構成される発光素子を駆動するためのドライバ回路を備えていることを特徴とする請求項１から１０のいずれか１項に記載の半導体物品の製造方法。
【請求項１２】
化合物半導体基板と半導体基板とを貼り合わせる工程を含み形成される半導体物品の製造方法であって、
化合物半導体基板と半導体基板とを用意する工程、
前記化合物半導体基板上にエッチング・ストップ層、エッチング犠牲層、活性層を含む化合物半導体多層膜、ミラー層を、該化合物半導体基板側からこの順に形成する工程、
前記化合物半導体多層膜に、前記エッチング犠牲層が露出するように第１の溝を設けて、該化合物半導体多層膜を島状に分割する工程、
前記半導体基板を貫通する第２の溝を形成する工程、
前記シリコン基板に設けられている前記第２の溝と、前記第１の溝とが連結するように、有機材料膜を介して前記化合物半導体基板と前記半導体基板とを貼り合わせて、部材を形成する工程、
前記エッチング犠牲層とエッチング液とを接触させて、前記部材から前記化合物半導体基板を分離する工程、及び
前記半導体基板上の前記化合物半導体多層膜を用いて、発光素子を形成する工程を有することを特徴とする半導体物品の製造方法。
【請求項１３】
請求項１から１２のいずれか１項に記載の半導体物品の製造方法を用いて製造されたＬＥＤ又はＬＤを含むアレイチップ。
【請求項１４】
請求項１３に記載の複数のＬＥＤアレイチップを連結し、ロッドレンズアレイが実装されていることを特徴とするＬＥＤプリンタヘッド。
【請求項１５】
請求項１４に記載のＬＥＤプリンタヘッドと、感光ドラムと、帯電器とを備え、前記ＬＥＤプリンタヘッドを光源として、前記感光ドラムに静電潜像を書き込む作像ユニットを含むことを特徴とするＬＥＤプリンタ。
【請求項１６】
請求項１４に記載のＬＥＤプリンタヘッドと、感光ドラムと、帯電器とを備え、前記ＬＥＤプリンタヘッドを光源として、前記感光ドラムに静電潜像を書き込む作像ユニットを複数含むことを特徴とするカラーＬＥＤプリンタ。
【請求項１７】
半導体基板上に化合物半導体多層膜を有する半導体部材であって、
化合物半導体基板上に、エッチング犠牲層と、化合物半導体多層膜と、絶縁膜と、シリコン基板とを、該化合物半導体基板側からこの順に備え、
前記化合物半導体多層膜には、前記エッチング犠牲層が露出するための溝が設けられており、且つ前記半導体基板と前記絶縁膜には、前記溝に連結する貫通溝が設けられていることを特徴とする半導体部材。
【請求項１８】
基板上に化合物半導体多層膜を有する半導体物品の製造方法であって、
第１の基板上に、エッチング犠牲層と、化合物半導体多層膜と、第２の基板とを、該第１の基板側からこの順に備え、且つ前記化合物半導体多層膜に設けられている第１の溝と、前記第２の基板を貫通し、前記第１の溝に連結するように設けられている第２の溝とを有する部材を用意する工程、及び
前記第１の溝と前記第２の溝を通して、エッチング液と前記エッチング犠牲層とを接触させて、該エッチング犠牲層をエッチングし、前記部材から前記第１の基板を分離する工程とを有することを特徴とする半導体物品の製造方法。
【請求項１９】
第１の基板上に該第１の基板側から分離層と、発光層とをこの順に成膜し、該発光層が内側に位置するように、前記第１の基板と第２の基板に貼り合わせて貼り合わせ部材を形成し、前記分離層をエッチング除去することにより前記発光層を前記第２の基板に転写する発光素子の製造方法であって、
前記第１の基板上の前記分離層と前記発光層とからなる組を１対として、この組をｎ回（ｎは２以上の自然数である。）繰り返して成膜し、
最表面の発光層のみを複数の島状にパターニングした後で、前記第１の基板と前記第２の基板とを貼り合わせて貼り合わせ構造体を形成し、
前記島状のパターニングが行われていることによって前記貼り合わせ構造体に形成されている空間に、エッチング液を浸透させて、前記分離層と前記エッチング液とを接触させて、前記島状の発光層を選択的に前記第２の基板に転写することを特徴とする発光素子の製造方法。
【請求項２０】
シリコン基板上に、ＤＢＲミラーを介して発光素子が設けられていることを特徴とする発光デバイス。
【請求項２１】
第１の半導体基板の表面に分離層、発光層、ＤＢＲ層の順に成膜し、これを半導体回路が形成された第２の基板に絶縁膜を介して貼り合わせる工程、
前記分離層をエッチング除去することにより前記第１の基板の発光層及びＤＢＲ層を前記第２の基板に転写する工程、
転写された前記発光層を複数の発光部にアレイ化する工程、
複数の前記発光部と、該発光部の点灯を制御するための前記半導体回路の電極部分とを電気的に接続する工程、を有することを特徴とするＬＥＤアレイの製造方法。
【請求項２２】
請求項１から１１のいずれか１項に記載の半導体物品の製造方法であって、
前記化合物半導体基板上の前記第１の溝で囲まれた島状の前記化合物半導体多層膜は長辺と短辺をもった矩形形状であり、その長辺（長手）方向に平行に、前記半導体基板を貫通する複数の前記第２の溝が、断続的にアレイ状に配置されていることを特徴とする半導体物品の製造方法。
【請求項２３】
請求項１から１１のいずれか１項に記載の半導体物品の製造方法であって、前記部材から前記化合物半導体基板を分離した後、島状の前記化合物半導体多層膜上に絶縁部材を介して、電極を形成して、長辺方向と短辺方向を持つ発光素子アレイチップにした後、前記第２の基板に設けられて、前記短辺方向に並んでいる、互いに平行な第２の貫通溝が互いに繋がるように、前記第２の基板を、前記長辺方向に切断していくことを特徴とする半導体物品の製造方法。
【請求項２４】
前記第１の溝により島状にパターニングされている前記化合物半導体多層膜は、その上面から見た形状が、長辺方向と短辺方向を有する四角形であり、
前記第２の基板を貫通している前記第２の溝は、前記長辺方向に沿って平行に、断続的に複数個設けられることで、長辺方向貫通溝群をなしており、
前記長辺方向貫通溝群が、島状の前記化合物半導体多層膜の短辺方向の長さと等しいか、それ以上の距離隔てて、互いに平行に複数並んでいることを特徴とする請求項１８記載の半導体物品の製造方法。
【請求項２５】
化合物半導体多層膜と前記第２の基板との間には、反射ミラーが設けられている請求項１８記載の半導体物品の製造方法。
【請求項２６】
第１の基板と第２の基板とを貼り合わせて構成される貼り合わせ構造体であって、
前記第１の基板上には、分離層を介して、島状にパターニングされている化合物半導体多層膜領域が設けられており、該化合物半導体多層膜領域同士の間には第１の溝があり、
前記化合物半導体多層膜領域は、その上面から見た形状が、長辺方向と短辺方向を有する四角形であり、
前記第２の基板には、該第２の基板を貫通している第２の溝が設けられており、該第２の溝は、前記長辺方向に沿って平行に、断続的に複数個設けられることで、長辺方向貫通溝群をなしており、
前記長辺方向貫通溝群が、島状の前記化合物半導体多層膜領域の短辺方向の長さと等しいか、それ以上の距離隔てて、互いに平行に複数並んでいることを特徴とする貼り合わせ構造体。
【請求項２７】
請求項１から１２及び１８のいずれか１項記載の半導体物品の製造方法を用いて製造されたＬＥＤアレイチップが、複数連結されており、かつロッドアレイレンズが実装されていないことを特徴とするＬＥＤプリンタヘッド。
【請求項２８】
半導体部材であって、
第１の基板上に、分離層と、化合物半導体多層膜と、絶縁膜と、第２の基板とを、該第１の基板側からこの順に備え、
前記化合物半導体多層膜には、該化合物半導体多層膜を複数の領域に分け、且つ前記分離層を露出させるための溝が設けられており、且つ前記第２の基板と前記絶縁膜には、前記溝に連結する貫通溝が設けられていることを特徴とする半導体部材。
【請求項２９】
基板上に化合物半導体多層膜を有する半導体物品の製造方法であって、
第１の基板上に、分離層と、化合物半導体多層膜と、第２の基板とを、該第１の基板側からこの順に備え、且つ前記化合物半導体多層膜に設けられている第１の溝と、前記第２の基板を貫通し、前記第１の溝に連結するように設けられている第２の溝とを有する部材を用意し、
前記部材から前記第１の基板を分離することを有することを特徴とする半導体物品の製造方法。
【発明の詳細な説明】
【技術分野】
【０００１】
本発明は、半導体部材、半導体物品の製造方法に関する。また、本発明は、当該方法を用いて作製される発光素子などの光素子や、ＬＥＤアレイチップ、ＬＥＤプリンタヘッド、及びＬＥＤプリンタに関する。
【背景技術】
【０００２】
ＧａＡｓ基板上に、エッチング犠牲層を介して、成膜された発光ダイオード構成層を、シリコン基板上に移設する技術が知られている。
【０００３】
特許文献１には、シリコン基板上に、発光ダイオード構成層を移設する技術が記載されている。
【０００４】
具体的には、まず、ＧａＡｓ基板上に犠牲層を介して形成した発光ダイオード構成層を、その発光領域毎に分割するための溝を設ける。当該溝の直下には、前記犠牲層が露出している。
【０００５】
次に、ドライフィルムレジストを前記発光ダイオード構成層に貼り付けて、そして、さらに、このドライフィルムレジストにメタルワイヤからなるメッシュ状の支持部材を貼り合わせる。
【０００６】
その後、前記レジストの内、前記メタルワイヤの直下に位置する部分以外を除去する。そして、メッシュ状の支持部材を介して、エッチング液と犠牲層とを接触させて、当該犠牲層のエッチングを行うことで、ＧａＡｓ基板を前記貼り合わせ構造体から分離する。
【０００７】
さらに、ＧａＡｓ基板の分離した後に、今度はシリコン基板と前記発光ダイオード構成層とを貼り合わせる。
【０００８】
こうして、シリコン基板上に発光ダイオード構成層が移設される。
【特許文献１】特開２００５−０１２０３４号公報
【発明の開示】
【発明が解決しようとする課題】
【０００９】
しかしながら、本発明者らは、前記特許文献１に記載の技術では、多くの貼り合わせ工程が必要であり、量産することを意識した場合、更なる工夫が必要であるという認識に至った。
【００１０】
そして、本発明者らは、貼り合わせ工程を少なくし、前記犠牲層をエッチングする際には、前記発光ダイオード構成層をシリコン基板上へ移設しておいた方が望ましいという考えに至り、後述するような画期的な本発明を成し得た。
【００１１】
本発明の目的は、以下の通りである。
【００１２】
すなわち、なるべく少ない回数の貼り合わせ工程により実現される新規な製造方法や新規部材を提供することにある。
【課題を解決するための手段】
【００１３】
第１の本発明に係る半導体基板上に化合物半導体多層膜を有する半導体物品の製造方法は、化合物半導体基板上に、エッチング犠牲層と、化合物半導体多層膜と、絶縁膜と、半導体基板とを、該化合物半導体基板側からこの順に備え、且つ前記化合物半導体多層膜に設けられている第１の溝と、前記第１の溝に連結するように前記半導体基板を貫通するように設けられている第２の溝とを有する部材を用意する工程、及び前記第１の溝と前記第２の溝を通して、エッチング液と前記エッチング犠牲層とを接触させて、該エッチング犠牲層をエッチングし、前記部材から前記化合物半導体基板を分離する工程とを有することを特徴とする。
【００１４】
ここで、前記部材は、前記化合物半導体基板に前記エッチング犠牲層を形成する工程、前記エッチング犠牲層上に前記化合物半導体多層膜を形成する工程、
前記化合物半導体多層膜に前記第１の溝を、前記エッチング犠牲層が露出するように形成する工程、前記第２の溝を備え、且つ前記絶縁膜を有する前記半導体基板を用意する工程、及び前記化合物半導体基板と前記半導体基板とを、前記第１の溝と前記第２の溝とが連結するように貼り合わせる工程を経て用意することができる。
【００１５】
あるいは、前記部材は、前記化合物半導体基板に前記エッチング犠牲層を形成する工程、前記エッチング犠牲層上に前記化合物半導体多層膜を形成する工程、前記絶縁膜を有する前記半導体基板を用意する工程、前記化合物半導体基板と前記半導体基板とを貼り合わせる工程、前記半導体基板に前記第２の溝を形成する工程、前記絶縁膜に前記第３の溝を形成する工程、及び前記エッチング犠牲層が露出するように、前記化合物半導体多層膜に前記第１の溝を形成する工程、を経て用意することができる。
【００１６】
前記半導体基板には、前記化合物半導体多層膜を含み構成される発光ダイオードを駆動するためのドライバ回路を備えていることもできる。
【００１７】
また、第２の本発明は、化合物半導体基板と半導体基板とを貼り合わせる工程を含み形成される半導体物品の製造方法であって、化合物半導体基板と半導体基板とを用意する工程、前記化合物半導体基板上にエッチング・ストップ層、エッチング犠牲層、活性層を含む化合物半導体多層膜、ミラー層を、該化合物半導体基板側からこの順に形成する工程、前記化合物半導体多層膜に、前記エッチング犠牲層が露出するように第１の溝を設けて、該化合物半導体多層膜を島状に分割する工程、前記半導体基板を貫通する第２の溝を形成する工程、前記シリコン基板に設けられている前記第２の溝と、前記第１の溝とが連結するように、有機材料膜を介して前記化合物半導体基板と前記半導体基板とを貼り合わせて、部材を形成する工程、前記エッチング犠牲層とエッチング液とを接触させて、前記部材から前記化合物半導体基板を分離する工程、及び前記半導体基板上の前記化合物半導体多層膜を用いて、ＬＥＤ素子を形成する工程を有することを特徴とする。
【００１８】
第３の本発明は、前述した半導体物品の製造方法を用いて製造されたＬＥＤアレイである。
【００１９】
このＬＥＤアレイに、ロッドレンズアレイが実装してＬＥＤプリンタヘッドを構成できる。
【００２０】
さらにまた、別の本発明は、前記ＬＥＤプリンタヘッドと、感光ドラムと、帯電器とを備え、前記ＬＥＤプリンタヘッドを光源として、前記感光ドラムに静電潜像を書き込む作像ユニットを含むことを特徴とするＬＥＤプリンタである。
【００２１】
特に前記作像ユニットを複数含むことにより、カラーＬＥＤプリンタを構成することもできる。
【００２２】
また、第４の本発明は、半導体基板上に化合物半導体多層膜を有する半導体部材であって、化合物半導体基板上に、エッチング犠牲層と、化合物半導体多層膜と、絶縁膜と、シリコン基板とを、該化合物半導体基板側からこの順に備え、前記化合物半導体多層膜には、前記エッチング犠牲層が露出するための溝が設けられており、且つ前記半導体基板と前記絶縁膜には、前記溝に連結する貫通溝が設けられていることを特徴とする。
【００２３】
また、第５の本発明は、基板上に化合物半導体多層膜を有する半導体物品の製造方法であって、第１の基板上に、エッチング犠牲層と、化合物半導体多層膜と、第２の基板とを、該第１の基板側からこの順に備え、且つ前記化合物半導体多層膜に設けられている第１の溝と、前記第２の基板を貫通し、前記第１の溝に連結するように設けられている第２の溝とを有する部材を用意する工程、及び前記第１の溝と前記第２の溝を通して、エッチング液と前記エッチング犠牲層とを接触させて、該エッチング犠牲層をエッチングし、前記部材から前記第１の基板を分離する工程とを有することを特徴とする。
【００２４】
また、第６の本発明は、第１の基板上に該第１の基板側から分離層と、発光層とをこの順に成膜し、該発光層が内側に位置するように、前記第１の基板と第２の基板に貼り合わせて貼り合わせ部材を形成し、前記分離層をエッチング除去することにより前記発光層を前記第２の基板に転写する発光素子の製造方法であって、前記第１の基板上の前記分離層と前記発光層とからなる組を１対として、この組をｎ回（ｎは２以上の自然数である。）繰り返して成膜し、最表面の発光層のみを複数の島状にパターニングした後で、前記第１の基板と前記第２の基板とを貼り合わせて貼り合わせ構造体を形成し、前記島状のパターニングが行われていることによって前記貼り合わせ構造体に形成されている空間に、エッチング液を浸透させて、前記分離層と前記エッチング液とを接触させて、前記島状の発光層を選択的に前記第２の基板に転写することを特徴とする。
【００２５】
また、第７の本発明は、シリコン基板上に、ＤＢＲミラーを介して発光素子が設けられていることを特徴とする発光デバイスである。
【００２６】
また、第８の本発明は、半導体部材であって、第１の基板上に、分離層と、化合物半導体多層膜と、絶縁膜と、第２の基板とを、該第１の基板側からこの順に備え、前記化合物半導体多層膜には、該化合物半導体多層膜を複数の領域に分け、且つ前記分離層を露出させるための溝が設けられており、且つ前記第２の基板と前記絶縁膜には、前記溝に連結する貫通溝が設けられていることを特徴とする。
【００２７】
また、第９の本発明は、基板上に化合物半導体多層膜を有する半導体物品の製造方法であって、第１の基板上に、分離層と、化合物半導体多層膜と、第２の基板とを、該第１の基板側からこの順に備え、且つ前記化合物半導体多層膜に設けられている第１の溝と、前記第２の基板を貫通し、前記第１の溝に連結するように設けられている第２の溝とを有する部材を用意し、前記部材から前記第１の基板を分離することを有することを特徴とする。
【００２８】
さらにまた、別の本発明は、第１の半導体基板の表面に分離層、発光層、ＤＢＲ層の順に成膜し、これを半導体回路が形成された第２の基板に絶縁膜を介して貼り合わせる工程、前記分離層をエッチング除去することにより前記第１の基板の発光層及びＤＢＲ層を前記第２の基板に転写する工程、転写された前記発光層を複数の発光部にアレイ化する工程、複数の前記発光部と、該発光部の点灯を制御するための前記半導体回路の電極部分とを電気的に接続する工程、を有することを特徴とするＬＥＤアレイチップの製造方法である。
【００２９】
また、別の本発明は、前記第１の本発明において、前記化合物半導体基板上の前記第１の溝で囲まれた島状の前記化合物半導体多層膜は長辺と短辺をもった矩形形状であり、その長辺（長手）方向に平行に、前記半導体基板を貫通する複数の前記第２の溝が、断続的にアレイ状に配置されていることを特徴とする。
【００３０】
また、別の本発明は、前記第１の本発明において、前記部材から前記化合物半導体基板を分離した後、島状の前記化合物半導体多層膜上に絶縁部材を介して、電極を形成して、長辺方向と短辺方向を持つ発光素子アレイチップにした後、前記第２の基板に設けられて、前記短辺方向に並んでいる、互いに平行な第２の貫通溝が互いに繋がるように、前記第２の基板を、前記長辺方向に切断していくことを特徴とする。
【００３１】
また、別の本発明は、前記第５の本発明において、前記第１の溝により島状にパターニングされている前記化合物半導体多層膜は、その上面から見た形状が、長辺方向と短辺方向を有する四角形であり、前記第２の基板を貫通している前記第２の溝は、前記長辺方向に沿って平行に、断続的に複数個設けられることで、長辺方向貫通溝群をなしており、前記長辺方向貫通溝群が、島状の前記化合物半導体多層膜の短辺方向の長さと等しいか、それ以上の距離隔てて、互いに平行に複数並んでいることを特徴とする。
【００３２】
また、別の本発明は、第１の基板と第２の基板とを貼り合わせて構成される貼り合わせ構造体であって、前記第１の基板上には、分離層を介して、島状にパターニングされている化合物半導体多層膜領域が設けられており、該化合物半導体多層膜領域同士の間には第１の溝があり、前記化合物半導体多層膜領域は、その上面から見た形状が、長辺方向と短辺方向を有する四角形であり、前記第２の基板には、該第２の基板を貫通している前記第２の溝が設けられており、該第２の溝は、前記長辺方向に沿って平行に、断続的に複数個設けられることで、長辺方向貫通溝群をなしており、前記長辺方向貫通溝群が、島状の前記化合物半導体多層膜領域の短辺方向の長さと等しいか、それ以上の距離隔てて、互いに平行に複数並んでいることを特徴とする。
【００３３】
さらに、別の本発明は、前述した半導体物品の製造方法を用いて製造されたＬＥＤアレイチップが、複数連結されており、かつロッドアレイレンズが実装されていないことを特徴とする。
【００３４】
なお、上述の記載において、「この順に」という意味は、登場している構成要件に関しては、この順にという意味であり、登場している層と層の間に、他の層が介在することを排除するものではない。
【発明の効果】
【００３５】
本発明によれば、特許文献１における技術よりも貼り合わせ工程を減らすことができる。
【００３６】
また、第１の基板（例えば、化合物半導体基板）と第２の基板（例えば、シリコン基板）とを貼り合わせて形成される部材に対して、エッチング液は、第２の基板に形成されている貫通溝を通じて、前記犠牲層と接触する。
【００３７】
そのため、部材の最外周側面からのみエッチング液を基板の面内方向に浸透させる場合に比して、犠牲層のエッチング時間の短縮化が可能となる。
【発明を実施するための最良の形態】
【００３８】
（第１の実施形態）
本実施形態に係る発明について図１から図３を用いて説明する。
【００３９】
図１において、１０００は第１の基板（化合物半導体基板又はＧｅなどの基板）である。１００９はエッチング・ストップ層、１０１０はエッチング犠牲層、１０２０は化合物半導体多層膜（ここでは、多層膜の層構成の詳細は省略している。）である。また、１０２５は化合物半導体多層膜１０２０を化合物半導体基板上に島状に分割するための第１の溝である。１００９は必要に応じて設けられるエッチング・ストップ層である。１００は、本発明に係る部材を示している。
【００４０】
２０００は第２の基板（例えばシリコン基板である。）、２００５は第２の基板に設けられている第２の溝、２０１０は絶縁膜（例えば有機材料膜）である。絶縁膜２０１０にも前記第２の溝に連結する第３の溝２００６が設けられている。本図においては、第１の溝と第２の溝の幅と間隔は等しく記載されているが、第１溝の幅は第２溝の幅より、大きくすることもできる。但し、第１の溝１０２５と、第２の溝である半導体基板溝２００５が連結されていることが必要のため、化合物半導体層の島の幅（後述する短辺方向の長さ）は第２の基板に貫通する溝と溝の間隔よりも小さくすることが望ましい。ここでは第２の基板としてシリコン基板を用いたが特にシリコン基板に限定されるものではない。
【００４１】
なお、図１において、第１の溝１０２５の幅は例えば、数μｍから数１００μｍである。また、第２の溝２００５の幅は、例えば、数μｍから数１００μｍである。なお、第２の溝（貫通溝）から、エッチング液や浸透しやすいように、５０μｍ以上、より好ましくは１００μｍ以上、さらに好ましくは２００μｍ以上の幅があった方がよい。但し、第２の基板の厚さにも依存する場合がある。なお、化合物半導体層の島の幅はシリコン基板に貫通する溝と溝の間隔よりも小さくしておくことが好ましい。また、絶縁膜２０１０も、必要に応じて適宜省略することができる。
【００４２】
図２は、図１におけるａ１−ｂ１間での切断面一部を示している。図２から明らかなように第１の基板１０００上に島状に化合物半導体多層膜１０２０が分割（パターニング）されている。
【００４３】
島の部分１０２０は、その周囲に比して凸形状となっている。もちろん、化合物半導体多層膜１０２０は、所望の形状にパターニングされていればよく、必ずしも図のような矩形状の島となっていなくてもよい。また、以下では、矩形の島の長辺の方向を長手方向といい、短辺方向を短手方向という場合がある。なお、図２において図１と同じものを指す場合には同じ符号を付しており、以下の図面でも同様である。
【００４４】
第１の溝１０２５は島状の化合物半導体多層膜１０２０の間の空間（間隙）である。なお、図１と同一構成部材を指す場合には同じ符号を付している。
【００４５】
また、図３は、図１におけるａ２−ｂ２間での切断面を示している。図３から明らかなように、第２の基板２０００には、第２の溝２００５が設けられている。なお、第２の溝２００５は、断続的に溝が形成されている。このように、貫通溝を断続的に設けることで、例えばシリコンウェハの場合にはその剛性を著しく損なうことがないので、その後のプロセスにおけるハンドリングが困難になる事態を避けることができる。
【００４６】
なお、図１２（ｂ）のように、第２の溝（貫通溝）の長手方向は、後工程においてチップ状に分離する際に使用するチップ・スクライブラインに沿って、その機械的強度も考慮して、分離して（断続的に）貫通溝を形成するのがよい。
【００４７】
図４は第１の溝１０２５と半導体基板溝２００５との位置関係を示すとともに、島状の化合物半導体多層膜１０２０が半導体基板溝２００５間に配置される様子を示す一部分解斜視図である。なお、図４は絶縁膜２０１０、エッチング・ストップ層１００９、エッチング犠牲層１０１０は簡易化のため省略されている。
【００４８】
また、図２と図３とを重ね合わせた場合に、ちょうど、貫通溝２００５ａと２００５ｂとの間に凸形状の島１０２０ａが位置することが好ましい。
【００４９】
もちろん、凸形状の島１０２０ａを支持することができるのであれば、必ずしも、図２、３のように、パターニングされている化合物半導体多層膜１０２０の長手方向に平行に位置するように、前記貫通溝２００５を設ける必要はない。例えば、（上面から見た場合に）前記長手方向に直交する、あるいは交差するように前記貫通溝２００５を設けることもできる。なお、貫通溝は、貫通していることからも、貫通孔ということもできる。
【００５０】
第１の基板（例えば化合物半導体基板）１０００と、エッチング犠牲層１０１０と、化合物半導体多層膜１０２０と、絶縁膜（例えば有機絶縁材料膜）２０１０と、第２の基板２０００（例えばシリコン基板）２０００とを含み構成される部材１００を用意する。
【００５１】
エッチング・ストップ層１００９は必要に応じて設ければよく必須ではない。
【００５２】
そして、図１に示されるように、前記第２の基板２０００（例えばシリコン基板）と絶縁膜２０１０をそれぞれ貫通している第２の溝２００５と第３の溝２００６とを通して、エッチング液を前記部材内部に浸透させる。
【００５３】
そして、エッチング液とエッチング犠牲層１０１０とを接触させることによってエッチング処理を行い、前記部材から第１の基板１０００を分離する。
【００５４】
なお、図１において、第１の溝１０２５は、エッチング犠牲層１０１０を貫通しているが、エッチング犠牲層１０１０を貫通させなくてもよい。前記部材１００から第１の基板１０００を除去する際、あるいはその時までに、エッチング犠牲層を露出し得ることが必要である。
【００５５】
また、図１に示しているエッチング・ストップ層１００９は必要に応じて設けておけばよく、時間的にエッチングの進行の程度を厳密に管理する場合には、必ずしも、このエッチング・ストップ層は設ける必要はない。但し、この層は、ウェハ全体で均一に前記エッチング犠牲層を露出させる効果がある。
【００５６】
（部材）
前記部材は、例えば以下の２つの方法により用意することができる。もちろん、図１の部材が実現できるのであれば、本発明は、以下の２つの方法に限られるものではない。
【００５７】
第１の方法は次のＡ１）からＥ１）の工程を含み実現される。
Ａ１）化合物半導体基板などの第１の基板１０００に前記エッチング犠牲層１０１０をエピタキシャル成長して成膜する工程
Ｂ１）前記エッチング犠牲層１０１０上に前記化合物半導体多層膜１０２０を形成する工程
Ｃ１）前記エッチング犠牲層１０１０が露出するように、前記化合物半導体多層膜１０２０に前記第１の溝１０２５を形成する工程
Ｄ１）前記第２の溝２０００を備え、且つ前記絶縁膜２０１０を有する前記第２の基板２０００を用意する工程
Ｅ１）前記第１の基板１０００と前記第２の基板２０００とを、前記第１の溝１０２５と前記第２の溝２００５とが連結するように貼り合わせる工程
なお、工程Ｃ１においては、前記化合物半導体多層膜を所望のパターン形状に分割することになるが、例えば図２のように凸形状の島が残るようにパターニングすることになる。なお、Ｃ１においては、前記エッチング犠牲層は、その最表面の少なくとも一部が露出していてもよいし、前記第１の溝がエッチング犠牲層の方向に延びて、当該第１の溝直下部におけるエッチング犠牲層は完全に除去されていてもよい。また、エッチング犠牲層の下の領域（例えば第１の基板やエッチング・ストップ層やバッファ層）が露出していてもよい。なお、貼り合わせ工程であるＥ１工程後に、前述の第３の溝を設けることもできる。
【００５８】
また、前記部材が作製できるのであれば、上記工程の順番は特に制限されるものではなく、例えば工程Ａ１）から工程Ｃ１）を行う前に、工程Ｄ１）を先に行ってもよい。
【００５９】
さらにまた、前記エッチング犠牲層をエピタキシャル成長させる前に、前記化合物半導体基板上に、エッチング・ストップ層をエピタキシャル成長させるとさらに制御性が高まる。具体的には、基板全域におけるエッチング均一性が向上する。図１には、エッチング・ストップ層を形成した例を示しているが、本発明においては必ずしも必要な層ではない。
【００６０】
また、シリコン基板などの第２の基板２０００に形成されている第２の貫通溝２００５の間隔と、島状に分離されている化合物半導体多層膜の幅とは実質的に同じか、あるいは化合物半導体多層膜の幅の方を小さくしておくのがよい。
【００６１】
さらにまた、なお、前記第２の溝２００５の形成は、例えば、図１に示す第２の溝の深さ方向（図面上では深さ方向とは上向きになる。）途中まで、すなわち、絶縁膜２０１０側の第２の基板の構成材料を部分的に残すように、ドライエッチング（ＲＩＥ）などで溝を形成しておく。ＲＩＥ時のマスクは特に限定されるものではないが、例えばＳｉＮ等である。その後、第１の基板１０００と第２の基板と貼り合わせる。その後、前記第２の基板に形成されている溝を、ウエットエッチングなどにより、溝を深さ方向に延ばして、当該溝が第２の基板２０００を貫通するようにしてもよい。
【００６２】
もちろん、前記第２の溝２００５の形成は、例えば、図１に示す第２の溝の深さ方向（図面上では深さ方向とは左向きになる。）途中まで、すなわち、絶縁膜２０１０側の第２の基板の構成材料を部分的に残すように、ドライエッチング（ＲＩＥ）などで溝を形成しておく。そして、前記第２の基板に形成されている溝を、ウエットエッチングなどにより延ばして、当該溝が第２の基板２０００を貫通させた後、第１の基板１０００と第２の基板と貼り合わせてもよい。
【００６３】
また、前記Ｄ１の工程においては、第２の基板に絶縁膜２０１０を設けている場合を示したが、所望の形状にパターニングされた化合物半導体多層膜１０２０上に、前記絶縁膜を設けた後、第２の基板と貼り合わせてもよい。もちろん、前記第２の基板がシリコン基板あるいはシリコン領域を有する基板である場合には、その表面に形成されている酸化層を前記絶縁膜として用いることもできる。なお、部材１００に配置されている絶縁膜２０１０は、予め第１の基板側の設けていても、第２の基板側に設けていても、あるいはその両方に設けていてもよい。なお、この絶縁膜２０１０は省略することもできる。例えば、第２の基板が石英やガラス基板などの絶縁基板の場合である。
【００６４】
前記部材を用意する第２の方法は、以下のように行う。
Ａ２）第１の基板１０００に前記エッチング犠牲層１０１０を成膜する工程
Ｂ２）前記エッチング犠牲層１０１０上に前記化合物半導体多層膜１０２０を形成する工程
Ｃ２）前記絶縁膜２０１０を有する前記第２の基板２０００を用意する工程
Ｄ２）前記第１の基板１０００と前記第２の基板２０００とを貼り合わせる工程
Ｅ２）前記シリコン基板２０００に前記第２の溝２００５を形成する工程
Ｆ２）前記第２の溝２００５の形成後、前記絶縁膜２０１０に第３の溝２００６を形成する工程
Ｇ２）前記エッチング犠牲層１０１０が露出するように前記化合物半導体多層膜１０２０に、前記第１の溝１０２５を形成する工程
なお、前記第２の溝２００５の形成は、例えば、図１に示す第２の溝の深さ方向（図面上では深さ方向とは左向きになる。）途中まで、すなわち、絶縁膜２０１０側の第２の基板の構成材料を部分的に残すように、ドライエッチング（ＲＩＥ）などで溝を形成しておく。その後、ウエットエッチングにより、当該溝が第２の基板２０００を貫通するようにしてもよい。
【００６５】
以上、図１に記載の部材を実現する方法を例示したが、本発明は、上記の各構成基板あるいは各構成層や各構成膜の間に、別な層や膜や領域を介在させること、または介在するように成膜したり、貼り合わせることを除外するものではない。例えば、絶縁膜２０１０と第２の基板２０００との間に、金属膜が部分的あるいは全面に設けられていてもよいし、前記第２の基板に、あるいは前記第２の基板と前記絶縁膜とを利用して、配線領域や回路領域が設けられていてもよい。ここでいう回路領域とは、前記化合物半導体多層膜を利用して、発光素子や受光素子を作製した場合の駆動回路やスイッチング回路、あるいは単に通電するため、または電圧を印加するための配線を含む回路である。
【００６６】
（第２の基板）
前記第２の基板２０００は、例えば半導体基板やシリコン基板や、表面に酸化層が形成されているシリコンウェハや、所望の電気回路（例えば、駆動ドライバ）が設けられているシリコンウェハなどの含むものである。図１のように、絶縁膜を有するシリコン基板は、例えば以下のようにして形成される。
【００６７】
すなわち、シリコン基板上に絶縁膜としての有機材料膜を一方の表面に形成した後、他方の面側に、半導体基板溝である第２の溝２００５を形成するためのマスク層をレジストを用いて形成し、マスクを利用してシリコン基板に半導体基板溝２００５を形成する。ＲＩＥなどのドライエッチングや、ウエットエッチングを用いてもよいし、露出箇所に石英の微粒子などをぶつけて物理的にシリコン基板を破壊しながら溝を掘っていくサンドブラスタなども用いることができる。もちろん、これらを組み合わせて利用することもできる。例えば、深さ方向にある程度、ＲＩＥやサンドブラスタにより溝を形成し、その後第１の基板と貼り合わせる前（あるいは後）に、ウエットエッチングによりシリコンなどからなる第１の基板に貫通孔を形成することができる。或いは、第一の基板の裏面から研削、研磨によって、前記の溝を表出させてもよい。
【００６８】
また、別な例としては、まずシリコン基板を貫通する第２の溝２００５を形成した後、一方の面に有機材料膜（例えば、ポジ型感光性のポリイミド膜である。）を塗布し、他方の面側から、シリコン基板をマスクとしてＵＶ光を照射する。そして、第２の溝２００５の上方に位置する部分の有機材料膜だけ現像し、除去する。もちろん、貫通溝が設けられているシリコン基板をマスクに有機材料膜を感光し、除去する工程は、第１の基板とシリコン基板とを貼り合わせた状態で行うこともできる。なお、貼り合わせ工程後に、第２の基板側から紫外線照射を行い、前記第２の溝の直上の有機材料膜を除去して、第３の溝を構成することもできる。
【００６９】
この手法の第２の基板の溝形成に応用する利点は、以下の通りである。
【００７０】
すなわち、デバイスプロセスではなく、シリコン基板上への溝形成のためのレジスト整形であるため、マスク合わせが必要で無い最初の層形成であること。又、溝のサイズが数百ミクロン以上であり、比較的大きな形状をもつことからレジスト中の気体の脱気が必要でないこと。そのためから、減圧機構が不要の安価でかつ生産性の高い装置が使用できることである。
【００７１】
なお、シリコン基板や絶縁膜に形成される貫通溝の作製方法は特に制限されるものではなく、所定のパターンを有するモールド（スタンパ）を用いたインプリント法によって行うこともできる。
【００７２】
なお、シリコン基板に異方性の溝を形成することに関しては、例えば、Ａｙｏｎらの文献（Ｓｅｎｓｓｅｒｓ  ａｎｄ  Ａｃｔｕａｔｏｒｓ  Ａ９１（２００１）３８１−３８５）に記載されている。
【００７３】
このような溝は例えば、側壁を保護しながらアスペクト比を劣化させずに、数百ミクロンもの厚いシリコンウェハに深堀ＲＩＥによって貫通溝を形成することが可能となる。また、化学的なエッチングにより溝を形成するのではなく、流体エネルギーやサンドブラスト法のように固体粒子をぶつけることによって貫通溝を形成することもできる。
【００７４】
また、シリコン基板２０００には、ドライバ回路を設けておくこともできる。ここでいうドライバ回路とは、例えば、発光ダイオード（ＬＥＤ）が、化合物半導体多層膜を含み構成される場合に、そのＬＥＤを駆動・制御するための回路のことである。
【００７５】
なお、シリコン基板は、いわゆるＣＺウェハは、もちろん、表面にエピタキシャルシリコン層を有する基板であってもよく、またシリコン基板の代替としてＳＯＩ基板を用いることもできる。
【００７６】
なお、シリコン基板などの第２の基板が有する貫通溝を通して（エッチング犠牲層を除去するための）エッチング液が進入し易いように、シリコン基板の貫通溝の側壁表面を、オゾンアッシングや、硫酸と過酸化水素水を混ぜたピラニア溶液等を利用することもできる。
【００７７】
また、第１の基板とシリコン基板などの第２の基板とを貼り合わせる際には、その間、あるいはシリコン基板上の絶縁膜と第１の基板との間に金属膜を介在させてもよい。ＬＥＤ素子を作製する場合には、反射層として機能し得る。もちろん、金属膜に替えて、ＤＢＲミラーでもよい。なお、反射用のミラーとして機能させるためには、金属膜（例えば、ＴｉやＡｕやＰｔなど）は、前記絶縁膜と第２の基板（例えばシリコン）との間に設けることもできる。なお、ＤＢＲ、すなわちいわゆるブラッグ反射ミラーを用いる場合は、このＤＢＲ層は、化合物半導体多層膜１０２０と絶縁膜２０１０との間に配置されることになる。
【００７８】
第２の基板としては、シリコン基板のほかにも、ガラス基板、石英基板、金属基板、セラミック基板、絶縁膜をコーティングした基板、などが適用できる。
第２の基板の厚さは、特に制限されるものではないが、５２５μｍ（４インチ）、６２５μｍ（６インチ）、７２５μｍ（８インチ）、７７５μｍ（１２インチ）程度のものを使用できる。第２の基板の厚さとしては、例えば、３００μｍから１０００μｍの範囲、強度の確保やプロセス上の観点からは、好ましくは、４００μｍから８００μｍの範囲である。
【００７９】
なお、第２の基板にあける貫通した溝（貫通孔）は、矩形状のスリットであってもよいし、図３のようにスリットが断続的に特定の間隔をもって配置されたものであってもよい。
【００８０】
さらにまた、第１の基板と第２の基板の貼り合わせには、ダイボンディングフィルム（日立化成工業株式会社）を利用することができる。例えば、シリコン基板などの第２の基板上に、ダイシング・テープとダイボンディングフィルムの機能を併せ持つ前述の日立化成社製のダイボンディングフィルムを貼り、ハンドリング性を高める。その後、アライメント等を行い、貼り合わせの際には、ダイシング・テープの方を除去し（例えば、ＵＶ光の照射などにより剥がす。）、第１の基板側との貼り合わせを行う。なお、第２の基板を貫通している第２の溝上にダイボンディングフィルムが残っている場合にはエッチング等により除去して、第１の溝と連結させる。
【００８１】
なお、第２の基板に形成されている貫通溝は、長辺と短辺をもった矩形（長方形、短冊形）あるいは四角形の貫通溝が、断続的に、あるいは不連続的に複数設けられているのがよい。特に、貫通溝の長辺（長手）方向には、当該複数の貫通溝が整列して（アレイ状に）断続的に配置するのがよい。ここで、断続的にとは、溝と溝との間に、間隙がある、すなわち、つながっていないということである。このことは、その後のデバイスプロセスへ投入する際に重要である基板の強度確保の点からも好ましい。この間隙の幅は、例えば数μｍから数百μｍの範囲である。
【００８２】
また、断続的に設けられているアレイ状の溝は、図３のように各アレイ状溝が、平行になるように設けられているのがよい。
【００８３】
（第１の基板）
第１の基板１０００の例としては、ＧａＡｓ基板、ｐ型ＧａＡｓ基板、ｎ型ＧａＡｓ基板、ＩｎＰ基板、ＳｉＣ基板、ＧａＮ基板、などを適用することができる。なお、化合物半導体基板以外にもサファイア基板、Ｇｅ基板を用いることもできる。好ましくは、ＧａＡｓ基板やＧａＮ基板などの化合物半導体基板である。
【００８４】
（エッチング犠牲層）
ここでいうエッチング犠牲層とは、前記化合物半導体多層膜のエッチング速度よりも早くエッチングされる層のことであり、分離層ということもできる。その上の多層膜に対して、エッチングレート比は、５倍以上がよく、好ましくは１０倍以上、さらに好ましくは、１００倍以上である。
【００８５】
例えば、ＡｌＡｓ層やＡｌＧａＡｓ層（例：Ａｌ０．７Ｇａ０．３Ａｓ）である。
【００８６】
ＡｌＧａＡｓ層をＡｌｘＧａｘ−１Ａｓ（１≧ｘ≧０．７）で示した場合、ｘが０．７以上でエッチング選択性が顕著となり、エッチング犠牲層にＡｌＡｓ層を用いる場合は、エッチング液として２〜１０％に希釈したＨＦ溶液を用いることができる。エッチング液としては、例えば１０％弗酸である。
【００８７】
なお、第１の基板としてサファイア基板を用いて、その上にエッチング犠牲層として、窒化クロム（ＣｒＮ）などの金属窒化膜を用いることができる。
青色や紫外光用のデバイス（ＬＥＤやレーザ）を実現するための機能層としての多層膜を窒化クロム上にエピタキシャル成長させる。この多層膜は、活性層としてＧａＩｎＮ、さらにスペーサ層としてＡｌＧａＮやＧａＮを用いることができる。
【００８８】
なお、この犠牲層のエッチャントとしては、一般的なＣｒエッチャント（クロムエッチング液など）を用いることができる。このようなエッチング液は、三菱化学株式会社から提供されている。
【００８９】
（第２の基板への貫通溝の作製）
第２の基板がシリコン基板である場合の貫通溝の作製は、ＳＦ６などの雰囲気の下、フッ素を利用したＲＩＥ（リアクティブイオンエッチング）を用いて行うことができる。もちろん、ラジカル種はフッ素に限られるものではない。ウエットエッチングで行う場合には、ＮａＯＨやＫＯＨ，ＴＭＡＨなどが利用できる。
【００９０】
なお、本発明においてエッチング犠牲層の露出は、エッチング液と当該犠牲層とが図１のように貼り合わせた状態で接触できるのであれば、いつの時点で、前記犠牲層が露出しても構わない。
【００９１】
シリコン基板への貫通溝の作製は、ＲＩＥ（リアクティブイオンエッチング）を用いて行うことができる。ウエットで行う場合には、エッチング液として、シリコン酸化物がフッ化水素酸に溶解することを利用して、ＨＮＯ３等の酸化剤とフッ化水素素溶液からなるものと用いることができる。添加剤としてＣＨ３ＣＯＯＨ、Ｂｒ２等が用いられる。（マルチエピタキシャル層）
第１の基板２０００上には、エッチング犠牲層１０１０と化合物半導体多層膜１０２０とを交互に繰り返して積層しておくこともできる。かかる場合、繰り返して、シリコン基板への前記化合物半導体多層膜の移設を行うことができる。もちろん、エッチング・ストップ層、エッチング犠牲層１０１０と化合物半導体多層膜１０２０とを交互に繰り返して積層しておくこともできる。また、第１の基板上へ予め交互に繰り返して積層しておくことで、犠牲層と多層膜１０２０とのペアを１対ずつ複数回の移設を行う場合にも、基板上でのエピタキシャル成長のための熱履歴が複数回にならないのでよい。この複数回の基板利用は著しい経済効果が期待できる。なぜならば、一般に化合物半導体基板はシリコンに比べて十倍以上高価であるからである。
【００９２】
（化合物半導体多層膜）
化合物半導体多層膜の層構成や材料は、半導体物品としてどのような素子を提供するかに依存する。半導体物品としては、発光素子として、発光ダイオード素子（ＬＥＤ素子）や発光レーザダイオード（ＬＤ素子）や受光素子などが挙げられる。
【００９３】
例えば、半導体物品としてＬＥＤ素子を提供する場合は、以下のような材料を用いた層構成とする。
【００９４】
すなわち、ｐ型ＧａＡｓ基板上に、ｐ−ＡｌＡｓ層（エッチング犠牲層）を形成し、その上に化合物半導体多層膜として、以下の層を設ける。
【００９５】
ｐ型ＧａＡｓコンタクト層、ｐ型ＡｌＧａＡｓクラッド層、ｐ型ＡｌＧａＡｓ活性層、ｎ型ＡｌＧａＡｓクラッド層、ｎ型ＧａＡｓコンタクト層を設ける。
【００９６】
なお、犠牲層と化合物半導体基板間には、エッチング・ストップ層としてＧａＩｎＰを用いることもできる。
【００９７】
硫酸でＧａＡｓ、ＡｌＧａＡｓ層をエッチングする場合、ＧａＩｎＰ層でストップする。その後ＧａＩｎＰ層は塩酸で除去する。アンモニア過水でＧａＡｓ、ＡｌＧａＡｓ層をエッチングする場合は、ＡｌＡｓがストップ層として望ましい。
【００９８】
また、化合物半導体多層膜の材料としては、ＧａＡｓ以外の系の化合物半導体材料、例えば、ＡｌＧａＩｎＰ系、ＩｎＧａＡｓＰ系、ＧａＮ系、ＡｌＧａＮ系、ＩｎＡｌＧａＮ系が本実施形態に適用され得る。
【００９９】
さらに、化合物半導体多層膜１０２０と前記有機材料などからなる絶縁膜２０１０との間には、金属膜あるいはＤＢＲミラーの少なくとも一方を設けておくこともできる。
【０１００】
ここで、金属膜とは、例えば、Ａｕ、Ａｇ，Ｔｉ、Ａｌ、ＡｌＳｉや、これらの材料からなる多層膜である。好ましい金属膜材料は、ＬＥＤの発光波長により選択される。例えば７００−８００ｎｍの赤色系ＬＥＤを作るのであれば、Ａｕ，Ａｇなどが反射率が高い。３６０ｎｍ付近の青色系ＬＥＤであればＡｌが好ましい。
【０１０１】
ＤＢＲミラー（ブラッグ反射ミラー）とは、例えばＧａＡｓ系の化合物半導体材料に対しては、ＡｌＡｓ層とＡｌＧａＡｓ層とを交互に複数回積層して構成されたり、Ａｌ酸化物層とＡｌ０．２Ｇａ０．８Ａｓとが交互に積層されてなるものである。アルミ酸化物をエピタキシャル成長で形成するのは難しいので、実際にはＡｌｘＧａ１-ｘＡｓでｘの値を０．２と０．８を交互にするなどで屈折率を制御することが好ましい。もちろん、低屈折率側にあたる層におけるＡｌの組成比率を高くしておき、積層後に酸化することでＡｌ酸化物にすることもできる。
【０１０２】
また、化合物半導体多層膜を利用してＬＥＤ素子を形成する場合には、ヘテロ接合型のＬＥＤに替えて、特許文献１にも記載されているようなホモ接合型のＬＥＤを構成することもできる。この場合、各層をそれぞれエピタキシャル成長させた後、固相拡散法により不純物拡散を行って活性層内にｐｎ接合を形成する。
【０１０３】
なお、コンタクト層とはｐ型又はｎ型電極とのオーミックコンタクトを取るために活性層を挟むクラッド層よりも高い不純物濃度を有するのがよい。
【０１０４】
なお、図１では、化合物半導体多層膜の層構成の詳細は、図面では省略している。
【０１０５】
第１の基板上のパターニングされた島状の領域は、その矩形の長辺方向の間隔（長辺方向に沿った島と島との間隔）は、あとの工程でのダイシング用の間隔に実質的に対応した配置になっているのがよい。なお、図２の２９０１が長辺方向、２９０２が短辺方向である。
【０１０６】
なお、部材からエッチング犠牲層を除去後に、さらに、前記化合物半導体多層膜をドット状の発光点が形成できるようにマスク等を利用して素子分離を行うことができる。
【０１０７】
（絶縁膜）
本実施形態に係る発明における、絶縁膜２０１０とは、例えば有機材料からなる膜である。有機材料からなる膜とは、例えばポリイミド系あるいは、他の有機絶縁膜、または絶縁フィルムである。このように、有機材料からなる膜としては、ポリイミドなどの有機絶縁膜である。具体的には、絶縁膜は、ポジ型の感光性ポリイミドからなるである。もちろん、感光した後、当該露光部分は実質的には、更なる感光性は有さない。なお、ポジ型ではなくネガ型の感光性ポリイミドはもちろん、非感光性のポリイミドも、別途マスクなどを利用して、第３の貫通溝を形成できるのであれば本発明に適用できる。なお、このポリイミドに関しては、たとえば 日立化成 デュポン マイクロシステムズ株式会社から提供されている。
【０１０８】
感光性を有するポリイミドについて、特開２００５−０１２０３４号公報に詳しく記載されている。具体的には、芳香族無水物に二重結合を持ったアルコール（例えばメタクリル酸ヒドロキシエチル）を反応させジカルボン酸を形成し、これにジアミンを反応させて、側鎖に二重結合をもったポリアミドを形成する。これはポリアミック酸のカルボキシル基を重合性の二重結合を持った構造に置換した構造に相当する。このポリマーを光開始剤や増感剤、接着助剤と一緒にＮＭＰ（ｎ−メチルピロリドン）のような極性溶媒に溶かしたものが、感光性ポリイミドである。
【０１０９】
なお、このポリイミドに関しては、感光性又は非感光性のものを使用することができる。
【０１１０】
また、その他の有機材料膜は、化合物半導体基板とシリコン基板とを貼り合せるために用いることができる。上述のポリイミド以外にも、エポキシ系接着層などを採用できる。
【０１１１】
光感光性を有する有機材料膜を貫通溝の上に被覆した後に、貫通溝を透してＵＶ光を照射することにより、シリコンの貫通溝上部の有機絶縁層を自己整合的に除去することが可能となる。
【０１１２】
また、絶縁膜としては、上述のように有機材料膜のみならず、酸化シリコン膜などの無機系の絶縁性の酸化膜を用いることもできる。また、シロキサン系の樹脂なども使用できる。
【０１１３】
なお、例えば第２の基板としてのシリコン基板上及び／またはその内部を利用して、回路領域を有する場合には、スピンオングラス（ＳＯＧ）を利用して、当該回路領域上の平坦性をあげるために酸化シリコン絶縁膜を形成してもよい。もちろん、複数種類の絶縁膜を積層して利用することもできる。
【０１１４】
また、ポリイミドなど有機系材料を用いて絶縁膜を形成することもできる。特に、スピン塗布により有機材料を塗布し、溶媒を揮発させるプリベーク工程を経て接着性を挙げながら第１の基板に貼り合わせ、その後密着性をあげることは、生産性の面からも有効である。
【０１１５】
また、図１における部材において、前記絶縁膜は、必要に応じて省略することもできる。さらに、絶縁膜を複数の層で構成することもできる。第１の基板側と第２の基板側の両側に、それぞれ絶縁膜を設けておき、貼り合わせる事もできるし、いずれかの基板側にのみ当該絶縁膜を設けておくこともできる。
【０１１６】
なお、第２の基板であるシリコン基板上やその内部に駆動回路などを設けられている場合は、絶縁膜２０１０は設けた方が好ましいが、本発明においては省略することもできる。
【０１１７】
また、本発明においては、絶縁膜として感光性のポリマーシートを利用できる。それ自体が接着性を有することがより好ましい。なお、第２の基板上に絶縁膜を形成する場合や、第１の基板側に絶縁膜を形成する場合には、加熱、圧着工程を経て形成してもよい。もちろん、溶液状の有機系材料（感光性のポリイミドなど）をスピン塗布によって成膜してもよい。あるいは、感光性のポリイミドをドライフィルムのようなシート状に形成した感光性ポリイミドシートを利用することもできる。
【０１１８】
（半導体物品の製造方法の一例）
以下に、半導体物品の製造方法の一例を示す。具体的には以下の工程を含み実現される。
１）  化合物半導体基板（第１の基板）とシリコン基板（第２の基板）とを用意する工程
２）  前記化合物半導体基板上にエッチング・ストップ層、エッチング犠牲層、活性層を含む化合物半導体多層膜、ミラー層を、該化合物半導体基板側からこの順に形成する工程
（なお、エッチング・ストップ層は必要に応じて利用すれば良く、本発明に必須の層ではない。）
３）  前記化合物半導体多層膜に、前記エッチング犠牲層が露出するように第１の溝を設けて、該化合物半導体多層膜を島状に分割する工程
４）  前記シリコン基板を貫通する第２の溝を形成する工程
５）  表面に有機材料膜を有する前記シリコン基板に設けられている前記第２の溝と、前記第１の溝とが連結するように、前記化合物半導体基板と前記シリコン基板とを貼り合わせて、貼り合わせ部材を形成する工程
６）  前記第１及び第２の溝を通して、前記エッチング犠牲層とエッチング液とを接触させて、前記部材から前記化合物半導体基板を分離する工程
７）  前記シリコン基板上の前記化合物半導体多層膜を用いて、ＬＥＤ素子を形成する工程
詳細な製造方法に関しては、後述する実施例において説明する。なお、２）の工程において、記載した層以外の層が含まれることを本発明は排除するものではなく、必要に応じて、上述した層や膜以外の材料が介在する場合も、当然に本発明に含まれる。
【０１１９】
また、本発明に係る貼り合わせによって構成される部材は以下の特徴を有する。
【０１２０】
すなわち、シリコン基板上に化合物半導体多層膜を有する半導体部材であって、化合物半導体基板上に、ＡｌＡｓ層と、化合物半導体多層膜と、有機絶縁膜と、シリコン基板とを、該化合物半導体基板側からこの順に備え、前記化合物半導体多層膜には、前記犠牲層が露出するように第１の溝が設けられており、且つ前記シリコン基板と前記有機材料膜には、前記第１の溝に連結する第２の溝が設けられていることを特徴とする。
【０１２１】
（その他）
なお、第１の溝１０２０や第２の溝２００５が深い場合には、ＡｌＡｓなどからなるエッチング犠牲層のエッチングにより発生したガス（水素）の泡が、その出口を塞いでしまうことがある。斯かる場合には、エッチングのための溶液や化合物半導体基板などのウェハに、連続的あるいは断続的に超音波を印加（間欠でも可）することが好ましい。また、エッチャント中に（例えば、フッ酸の中に）アルコールを添加しておくことも好ましい。
【０１２２】
（ミラー層）
化合物半導体発光層と有機材料膜などの絶縁膜との間には、金属膜あるいはＤＢＲミラーの少なくとも一方を設けておくこともできる。なお、このミラーがＴｉやＡｕやＰｔやＡｌＳｉなどからなるミラーの場合は、当該有機材料膜と第２の基板との間に介在させることもできる。たとえば、図７の如くである。図７では、詳細は後述するが、７０１０が絶縁層、７０８１がミラーである。
【０１２３】
ここで、ＤＢＲミラーは前記エピタキシャル成長された化合物半導体層上、連続してエピタキシャル成長することもできる。斯かる場合は、詳細は後述するが、図２０の７０２１がミラー層である。金属ミラーは成長された化合物半導体多層膜の上部に堆積形成されているか、あるいは、有機絶縁層上に堆積形成されているか、あるいは両者が同時に形成されていてもよい。
【０１２４】
以下に、ミラーとしてのＤＢＲに関して詳述する。
【０１２５】
ＤＢＲ層は、第１の基板上にエッチング犠牲層（分離層）を介して、活性層を含み構成される発光層を形成し、そして、このＤＢＲ層を形成することになる。
【０１２６】
ここで、第１の基板は、ＬＥＤ（発光ダイオード）を形成するための基板であり、ここではＬＥＤ用の化合物半導体膜が成長可能な基板が用いられる。第１の基板の材料としては、ＧａＡｓを基本とするIII‐Ｖ属化合物系を成長する場合には、ＧａＡｓ基板、または格子定数が近いＧｅ基板などが挙げられる。ＧａＡｓ基板の場合、当該基板にＡｌ、Ｐなどの同属系元素を含むものでも構わない。また、デバイスの構成に応じて、Ｐ型、Ｎ型を形成するための不純物を含んでいても構わない。
【０１２７】
この第１の基板上に、ＭＯＣＶＤ法、ＭＢＥ法などの手法により、犠牲層、発光層、ＤＢＲ層を順次エピタキシャル成長する。ここで、犠牲層とは、発光層に対して選択的にエッチング可能な材料からなる層のことであり、例えばＡｌＡｓ、あるいはＡｌｘＧａ１‐ｘＡｓ（１≧ｘ≧０．７）からなる。このような組成からなる犠牲層は、フッ酸溶液により選択的にエッチングされる。
【０１２８】
発光層は、発光素子として機能する化合物半導体層からなり、例えばＧａＡｓ、ＡｌＧａＡｓ、ＩｎＧａＡｓ、ＧａＰ、ＩｎＧａＰ、ＡｌＩｎＧａＰなどが可能であり、前記層中にｐｎ接合を有している。また、発光層１１０２の具体的な構成としては、例えば、クラッド層間に挟まれた活性層とからなる。
【０１２９】
ＤＢＲ層は、第１の基板に対してエピタキシャル成長可能なものであり、目的とするＬＥＤの波長に対して、屈折率の異なる層のペアを複数段重ねた構造からなる。
【０１３０】
このペアは屈折率の高い高屈折率層と低屈折率層からなる。そして、このペアを複数回積層したものが、ブラッグ反射膜、あるいはＤＢＲミラー（ＤＢＲ層）と呼ばれる。
【０１３１】
このブラッグ反射膜は、屈折率の異なる２種類の膜の膜厚ｄ１，ｄ２を、光学膜厚ｎ×ｄがそれぞれ１／４波長になるように設定し、その２種類の膜のｍ組倍（ｍは２以上の自然数）にすることで、組数ｍに対応した反射率が得られるものである。その場合に、ブラッグ反射膜を構成する層の屈折率の差が大きいほど、組数が小さくても高反射率が得られるものである。なお、本発明においては、上記ＤＢＲを構成する際の条件を最適化して、特定波長の光を７０％以上、好ましくは８０％以上、より好ましくは９０％以上の効率で反射できるように設計するのがよい。
【０１３２】
例えばＡｌＧａＡｓのＡｌ含有量の異なる層を交互に積層することによりＤＢＲ層が得られる。このとき、前述のエッチング犠牲層を選択的に除去する際に、ＤＢＲ層へのダメージを抑制するため、ＡｌｘＧａ１‐ｘＡｓと記載される場合の、Ａｌの含有量、すなわち、ｘは０．８以下にするのがよい。ｘは、好ましくは０．７以下、より好ましくは０．６以下、さらに好ましくは、０．４以下にするのがよい。ｘの下限値としては例えば、ゼロである。
【０１３３】
いずれにせよ、前記ＤＢＲ層を構成する屈折率が他方よりも低い低屈折率層は、ＡｌｘＧａ１−ｘＡｓ（０≦ｘ≦０．８）、ＡｌＩｎＧａＰ系材料、あるいはＡｌＧａＰ系材料から選択する。そして、前記エッチング犠牲層を、ＡｌＡｓあるいはＡｌｘＧａ１−ｘＡｓ（０．７≦ｘ≦１．０）から選択しておき、該分離層を選択的にエッチング除去する際に、前記低屈折率層にダメージが入り難い材料の組わせとしておくことが重要である。なお、犠牲層として、ＡｌＡｓ層を選択し、低屈折率層として、ＡｌＩｎＧａＰ系材料、あるいはＡｌＧａＰ系材料を用いる場合には、Ａｌの含有量に大きく依存せず、選択的な分離層の除去が可能である。
【０１３４】
なお、ＤＢＲ層の構成としては、（高屈折率層／低屈折率層）の組み合わせとして、特に、フッ酸耐性の高いＤＢＲ構成として、下記の３例が挙げられる。
１）Ａｌ0.6Ｇａ0.4Ａｓ／Ａｌ0.2Ｇａ0.8Ａｓ
２）ＡｌＩｎＧａＰ／Ａｌ0.2Ｇａ0.8Ａｓ
３）ＡｌＧａＰ／Ａｌ0.2Ｇａ0.8Ａｓ
なお、ペア数はレーザ（ＬＤ）を作製する場合では、９９．９％以上の反射率を求めるために３０層、４０層、或いはそれ以上の形成が必要となるが、例えば９０％以上の反射率で足りるＬＥＤの場合は、数層から１０層程度でも構わない。
【０１３５】
例えば、４インチＧａＡｓ基板１００上に、分離層であるｐ−ＡｌＡｓ層を１００ｎｍ、発光層を約２０００ｎｍ、ｎ−ＤＢＲ層をＭＯＣＶＤ法により成長する。発光層の詳細は、以下の通りである。クラッド層となるｐ−Ａｌ0.4Ｇａ0.6Ａｓ：３５０ｎｍ、活性層となるｐ−Ａｌ0.13Ｇａ0.87Ａｓ：３００ｎｍ、そしてＤＢＲ層側に位置するクラッドとなるｎ−Ａｌ0.23Ｇａ0.77Ａｓ：１３００ｎｍ、からなる。そして、ｎ−ＤＢＲ層の詳細は、Ａｌ0.2Ｇａ0.8Ａｓ：６３３Å／Ａｌ0.8Ｇａ0.2Ａｓ：５６５Åの組を２０ペア積層して構成することができる。なお、ＤＢＲを構成する材料の抵効率を低くしておけば、図２０のように７０２１のＤＢＲミラーから、電気的な接続を確保することができる。
【０１３６】
もちろん、活性層の両側にＤＢＲを設ける構成にすることもできる。後述するようにプリンタヘッドにおいて、ロッドレンズアレイを省略する場合には、必須ではないものの好適ではある。
【０１３７】
（エッチング・ストップ層）
必ずしも本発明においては必要ないが、エッチング犠牲層としてＡｌＡｓ層を使用する場合には、エッチストップ層として例えばＧａＩｎＰを利用することができる。
【０１３８】
（バッファ層）
なお、第１の基板、例えばＧａＡｓなどの化合物半導体基板やＧｅ基板やＧａＮ基板などの上にエッチング犠牲層を成長する前に、バッファ層を形成しておくことで、欠陥が少ない良好なエピタキシャル層を得ることができる。例えば、ＧａＡｓ基板上にはバッファ層としてＧａＡｓの薄膜を形成しておくことができる。Ｇｅ基板の場合には、ＧａＩｎＡｓなどが格子歪緩和に適している。
【０１３９】
（アライメント）
なお、第１の基板と第２の基板とのアライメントは、ウェハボンディングにおいて用いられる両面アライナーなどを用いて位置合わせを行うことができる。特に、第２の基板がシリコン基板である場合には、当該基板に設けられた貫通溝をアライメントマークに利用することもできる。又、該貫通溝はスクライブライン上に形成することができる。シリコン上に移設される発光層はチップサイズに相当する数百ミクロン以上の大面積であり、個別の数十ミクロンの発光素子の素子分離等は移設後のプロセスで確定される。したがって、島状活性層と貫通溝とのはり合わせ精度はデバイスプロセスで要求される数ミクロンは必要なく、数十ミクロンの精度で十分である。この観点から、ウェハのオリエンテーションフラットをアライメント基準としても可能である。
【０１４０】
（貼り合わせと分離工程）
貼り合わせに関して述べる。図１における絶縁膜２０１０としての有機絶縁層のガラス転移温度の数百度以上に加熱して、タック性をもたせ、シリコンウェハを加圧接合することにより、容易に行なわれる。接合強度も十分とれ、その後のプロセスにも問題が無い。タック性の無い接着層を用いない直接接合時に際して発生し易い、はり合わせ空隙（ボイド）は島状に分離して活性層が存在している。そのため、空気の取り込みも加圧接合される際に容易に島間の分離溝に沿って解消される。減圧にして接合すれば気体自体の量が減少し、空隙自体の形成が激減する。貼り合せた二枚のウェハを移設、分離するために、エッチング液が貫通溝を通して、犠牲層により均一に染み込むように、エッチング液槽を真空中に配置し、減圧下で、部材をエッチング液に浸漬することもできる。さらには超音波などの振動や加温、ウェハ自身の自転、公転などの回転運動も液循環速度を促進し、均一で短時間に移設・分離工程が完結する。
【０１４１】
なお、以下に、ＧａＡｓなどの第１の基板上に、エッチング犠牲層（分離層ともいう。）を介して、化合物半導体多層膜を形成し、この２つの層のペアを複数回形成して、プロセス上の低コスト化が期待できる方法について説明する。
【０１４２】
（マルチエピについて）
図２１を用いて説明する。
【０１４３】
図２１（ａ）において、１０００は、第１の基板（例えばＧａＡｓ）、２１０１はバッファ層である。
【０１４４】
分離層２１０２としては、高選択エッチング特性のあるＡｌＡｓ（ＡｌＧａＡｓ）を用いるので、これらの層をエピタキシャル成長できる基板が第１の基板ということになる。例として、結晶格子定数が近いＧａＡｓ基板又はＧｅ基板があげられる。ＳｉはＧａＡｓに対して格子定数差が４％程度あるが、直接成長させることは可能である。したがって、Ｓｉ基板上にＧａＡｓ膜を成長させたものを第１の基板１０００とすることも可能である。また、これらの基板に不純物がドーピングされていてもかまわない。
【０１４５】
図２１（ａ）において、第１の基板１０００以外の箇所について説明する。
【０１４６】
第１の基板１０００上に分離層２１０２及び活性層を含む発光層２１０３をこの順で連続してエピタキシャル成長させる。
【０１４７】
分離層２１０２の材料は、ＡｌＡｓ又はＡｌ（ｘ）Ｇａ（１−ｘ）Ａｓ（ｘ≧０．７）であり、膜厚としては数十〜数百ｎｍが好ましい。
【０１４８】
発光層２１０３の材料は、発光素子として化合物半導体層多層膜からなり、例えば、ＧａＡｓ、ＡｌＧａＡｓ、ＩｎＧａＡｓ、ＧａＰ、ＩｎＧａＰ、ＡｌＩｎＧａＰなどが利用される。また、発光層２１０３中にｐｎ接合を有している。
【０１４９】
なお、分離層２１０２を形成する前段階として、バッファ層２１０１を形成する場合があるが、これは任意である。バッファ層２１０１は、結晶欠陥を低減させるなどの目的である。
【０１５０】
成長方法は均一に成長できる方法であれば、特に限定されることはなく、ＭＯＣＶＤ法、ＭＢＥ法、ＬＰＥ法等のいずれの方法でもかまわない。
【０１５１】
さらに、分離層２１０２及び発光層２１０３を一組として、複数組の分離層３１０２、４１０２及び発光層３１０３、４１０３を、連続的にｎ組まで成長させる。この際、分離層２１０２の厚みを一定にする必要はない。上層になるに従って薄くすることも可能である。
【０１５２】
これは分離層２１０２をサイドエッチングする際に、膜厚が薄いほど、エッチング速度が大きいという特徴を考慮して、第１の基板１０００外周部の下層部において無駄なエッチングを極力避けるための一手法である。
【０１５３】
次に、図２１（ｂ）に示すように、最上部の発光層４１０３上に、光反射層４１０４を形成する。
【０１５４】
そして、光反射層４１０４を島状に残すようなレジストパターニング２１０５を形成する。
【０１５５】
光反射層４１０４の材料は形成する発光素子の波長に対する反射率が高い材料が好ましい。例えば、発光素子の材料がＧａＡｓ系で、発光波長が７５０〜８００ｎｍ程度であれば、Ａｕ（金）、Ａｇ（銀）、Ａｌ（アルミ）などが好ましい。もちろん、その他の光反射物質でもかまわない。
【０１５６】
発光波長が３６０ｎｍ程度の青色系であれば、光反射層４１０４の材料は、Ａｌなどが好ましい。なお、この光反射層に替えて、既述のＤＢＲ層を利用してもよいし、特に設けなくてもよい。すなわち、この光反射層４１０４は省略することもできる。
【０１５７】
また、島状にした発光層４１０３は、一つの島状の発光層４１０３が一つの発光素子の発光層を構成するようにしてもよいし、複数の発光素子がアレイ状に含まれる領域になるようにしてもよい。その際、島状の発光層４１０３の大きさは、後記する第２の基板１１０をダイシングする際のチップサイズと一致しているのが好ましい。
【０１５８】
光反射層４１０４は必須ではなく、後記する第２の基板２０００側に形成されてもよい。また全く無くてもよい。
【０１５９】
次いで、図２１（ｃ）に示すように、光反射層４１０４と最上部の発光層４１０３を島状にエッチングし、最上部の分離層２１０２の一部を露出させる。なお、この発光層を島状に、既述の第１の溝が取り囲んでいることになる。
【０１６０】
図２１（ｄ）に示すように、第１の基板１０００と第２の基板２０００とを貼り合わせる。
【０１６１】
第２の基板２０００の材質は任意であり、Ｓｉ基板のような半導体基板、導電性基板、絶縁性基板などどのような材質でもかまわない。既述のように、発光層を駆動するための駆動ドライバ回路などが設けられていてもよい。また、表面に有機材料膜などの絶縁膜を設けてあってもよい。
【０１６２】
また、第２の基板２０００の表面に光反射層４１０４を形成しておいてもかまわない。また、第１の基板１０００及び第２の基板２０００の双方の表面に反射層４１０４を形成しておき、反射層４１０４同士を接合しても構わない。
【０１６３】
第１の基板１０００と第２の基板２０００の貼り合わせの方法としては、接合後に加熱する方法、加圧する方法、両方を使う方法などがある。減圧雰囲気中で貼り合わせるのも有効である。
【０１６４】
なお、第２の基板２０００には、既に説明したように、本実施形態でいうところの第２の溝（貫通溝）が設けられているが、図では省略している。
【０１６５】
貼り合わせの結果、その界面近傍にパターニング溝による空間２１０６ができる。第１の溝と第２の溝もこの空間２１０６に連結していることになる。
【０１６６】
図２１（ｅ）は、各々の基板を分離した状態を示す図である。
【０１６７】
この分離は、最上層の分離層４１０２をエッチングすることによって行われる。
【０１６８】
この際、エッチング液は島状の分離領域によってできた空間２１０６に流入する。
【０１６９】
そして、最上層の分離層４１０２をエッチングし、結果として第１の基板１０００と第２の基板２０００とが分離される。この際のエッチング液には、フッ酸溶液又は塩酸溶液などが使用可能である。
【０１７０】
結果として、島状領域の発光層４１０３が第２の基板２０００に転写される。
【０１７１】
発光層４１０３が転写された第２の基板２０００は、デバイスプロセスに移り、発光素子が形成される。
【０１７２】
一方、最上層の発光層４１０３及び分離層４１０２を転写とエッチングにより失った第１の基板１０００は、最表面が発光層４１０３となり、図２１（ａ）に示す工程に戻る。
【０１７３】
発光層４１０３及び分離層４１０２を一対とした場合、これらが形成される数であるｎ回、以上の工程を繰り返すことにより、ｎ枚の発光素子が形成される基板が形成できることになる。なお、分離層と発光層の２つを一組として説明したが、これに反射層も加え、３層一組として、これを複数回積層してもよい。
【０１７４】
以上説明したように本発明によれば、新規な半導体物品の製造方法、及び新規な部材が提供される。ＬＥＤに代表される発光素子をチップ状に作製する際には、更に素子分離工程や配線工程、更に第２の基板のダイシング工程などを適宜行う。チップ上に複数の発光点を有するＬＥＤを作製するための素子分離は、例えば、化合物半導体多層膜の表面側における導電型がｐの場合には、その下のｎ型まで、あるいは活性層付近までパターニングして除去する。こうして、素子分離ができる。なお、ダイシング方向と第２の貫通溝に関しては、図３のケースとは反対にしてもよい。すなわち、チップの長辺方向に沿った、図３のような貫通溝ではなく、それと直交する短辺方向に沿って、貫通溝を設けておくのである。かかる場合、上面形が四角形あるいは矩形の長辺方向にそって、アレイ状に並べる際に、チップ同士の間は、ダイシングではなく、予め設けてあった貫通溝（例えばＲＩＥで作製。）に起因する側面を有する。このことは、密に詰めて配置する場合を考慮すると好ましい。もちろん、チップの長辺方向と短辺方向にいずれの方向にも沿って、断続的に設けられている溝の形成も好ましい。かかる場合、島状の化合物半導体多層膜の下面には、その長辺方向に沿った貫通溝と、短辺方向に沿った貫通溝が、断続的に設けられていることになる。
【０１７５】
（第２の実施形態）
第１の実施形態において説明した製造方法を用いることにより、図６に示すようなＬＥＤアレイが提供される。図６は、配線基板上で駆動回路とＬＥＤアレイとを接続した一例の構成を示す断面図である。ＬＥＤアレイは前述した半導体物品の製造方法の工程（７））で、シリコン基板上の島状の化合物半導体多層膜に複数のＬＥＤ素子を形成し、シリコン基板をダイシングにより分割して得ることができる。各ＬＥＤ素子の断面構成は後述する図７や図１５の左部のＬＥＤ発光領域を含むＬＥＤ素子と同じである。図６では複数のＬＥＤアレイチップ４０００を配線基板５０００上にライン状に並べ、複数のＬＥＤアレイチップ４０００の両側に同じくライン状に配置した複数のドライバＩＣ３０５０とＬＥＤアレイ４０００をワイヤ・ボンディングで電気的接続する。ＬＥＤアレイチップ４０００の各ＬＥＤ素子は交互に両側に配置されたドライバＩＣ３０５０の駆動素子とワイヤ・ボンディングで電気的接続される。ここでは、ライン状に配置した複数のＬＥＤアレイチップ４０００の両側にライン状に配置した複数のドライバＩＣ３０５０を配置している。もちろん、実装が可能ならば複数のＬＥＤアレイチップ４０００の片側に複数のドライバＩＣ３０５０を配置してよいことはもちろんである。
【０１７６】
さらに、必要に応じて、ライン状に配されたＬＥＤアレイチップ４０００に、ロッドレンズアレイ（例えば、ＳＬＡ：セルフォックレンズアレイ）３０００を実装することにより、ＬＥＤプリンタヘッド（図５）とすることもできる。ライン状に配されたＬＥＤアレイ４０００から放出された光はロッドレンズアレイ３０００で集光され、ＬＥＤアレイ結像３０６０が得られる。
【０１７７】
なお、既述のように、シリコン基板上に金属膜かＤＢＲミラーを介してＬＥＤ素子構成層が設けられている場合には、その指向性の向上と輝度増加により、素子寸法を微細加工しても、十分な輝度のデバイス発光点が実現される。したがって、ロッドレンズアレイは省略して、ＬＥＤプリントヘッドから直接、感光体に潜像形成することが可能となり、部品点数の少なく、経済効果も高い図５の構成のＬＥＤプリンタヘッドとすることもできる。
【０１７８】
なお、図６は、ワイヤ・ボンディングによりドライバＩＣ（駆動回路）とＬＥＤ素子とを接続する場合を示しているが、Ｓｉ基板側に直接ドライバ回路を作りこんでおき、ＬＥＤ素子と接続することもできる（図７［反射層を有機絶縁層上、デバイス直下に設置］）。
【０１７９】
図７において、ドライバＩＣを構成するＭＯＳトランジスタ７０６０を含むシリコン基板７０００上に有機材料からなる絶縁膜７０１０が設けられる。そして、絶縁膜７０１０上に化合物半導体多層膜からなるＬＥＤ発光領域７０７０が設けられる。７０８０は絶縁膜（ＳｉＯ２やＳｉＮ）、７０５０はＭＯＳトランジスタ７０６０のソース又はドレイン領域となるワイヤパッドである。７０８１は、ミラーとして機能する層（例えば、ＴｉやＡｕなどの金属ミラー）である。７０８３、７０８４は配線あるいは埋め込み配線あるいは電極パッドである。
【０１８０】
このように、貼り合わせる第２の基板側に駆動用のドライバＩＣを含ませておけば、図１９に示すように、ダイシング方向１６２５にダイシングすることで、図７に示すチップ１９６０を切り出すことができる。なお、図１９において、切り出したチップアレイ１９６０をプリント基板１９３０に並べていく様子を示している。１９１１は第２の基板である。なお、第２の基板には、貫通溝である第２の溝が、チップの長辺方向に沿って、断続的に、図３のように設けてあるが、図１９では省略している。
【０１８１】
なお、マトリックス駆動する際の一例を、図８に示す。図８は電極数を減らすための時分割駆動可能な発光素子アレイ回路８５００を示す図である。図８において、８０１１はｎ側電極、８０１７はｐ型電極、８０２１はｎ型ＡｌＧａＡｓ上絶縁膜、８０２２はｐ型ＧａＡｓコンタクト層上絶縁膜、８０２３は発光領域である。
【０１８２】
なお、本実施形態においては、発光素子としてＬＥＤを用いたＬＥＤアレイチップ挙げたが、もちろん、ＬＤ（Laser Diode）アレイチップとしてもよい。
【０１８３】
また、図２０には、図７の形態を変更した例を示している。図７と同じ機能を有する部分には同じ符号を付している。図７では有機絶縁膜７０１０とシリコン基板７０００側にミラー７０８１を設けていた。図２０では、化合物半導体多層膜１０２０に直接、ミラー層７０２１（金属ミラーであったり、ＤＢＲ層であったりする。）が設けられている。斯かる場合、発光領域となる１０２０で基板向きに生じる光を有機絶縁膜７０１０を介することなく反射できるので極めて性能が高くなる。図７では、ミラー層７０２１を利用して、駆動回路７０６０と電気的に接続している。なお、ミラー層が、低抵抗（ｎ＋）ＤＢＲである場合にも同様に、当該ミラーを利用して駆動回路との電気的接続ができる。
【０１８４】
（第３の実施形態）
第２の実施形態で説明したＬＥＤプリンタヘッドを用いて、ＬＥＤプリンタを構成した例を図９（ａ）に示す。
【０１８５】
図９（ａ）は、本発明に係わるＬＥＤプリンタの構成例を示す概略断面図である。
【０１８６】
図９（ａ）において、プリンタ本体８１００の内部には、時計廻りに回転する感光ドラム８１０６が収納されている。感光ドラム８１０６の上方には、感光ドラムを露光するためのＬＥＤプリンタヘッド８１０４が設けられている。ＬＥＤプリンタヘッド８１０４は、画像信号に応じて発光する複数の発光ダイオードが配列されたＬＥＤアレイ８１０５と、各々の発光ダイオードの発光パターンを感光ドラム８１０６上に結像させるロッドレンズアレイ８１０１とから構成される。ここで、ロッドレンズアレイ８１０１は、先に説明した実施形態に示す構成を有している。ロッドレンズアレイ８１０１による発光ダイオードの結像面と感光ドラム８１０６の位置は一致するように配置されている。つまり、発光ダイオードの発光面と感光ドラムの感光面とは、ロッドレンズアレイによって光学的に共役関係とされている。
【０１８７】
感光ドラム８１０６の周囲には、感光ドラム８１０６の表面を一様に帯電させる帯電器８１０３及びプリンタヘッド８１０４による露光パターンに応じて感光ドラム８１０６にトナーを付着させ、トナー像を形成する現像器８１０２が設けられている。感光ドラム８１０６の周囲には、感光ドラム８１０６上に形成されたトナー像をコピー用紙等の不図示の被転写材上に転写する転写帯電器８１０７及び転写後に感光ドラム８１０６上に残留しているトナーを回収するクリーニング手段８１０８が設けられている。こうして作像ユニットが構成される。
【０１８８】
さらに、プリンタ本体８１００には、上記被転写材を積載する用紙カセット８１０９、用紙カセット８１０９内の被転写材を感光ドラム８１０６と転写帯電器８１０７との間に供給する給紙手段８１１０が設けられている。また、転写されたトナー像を被転写材に定着させるための定着器８１１２、被転写材を定着器８１１２に導く搬送手段８１１１及び定着後に排出された被転写材を保持する排紙トレイ８１１３が設けられている。
【０１８９】
図９（ｂ）に本発明に係るカラープリンタの一構成例の機構部の概要構成図を示す。複数（図の場合は４つ）の作像ユニットを有することになる。図９（ｂ）において、９００１，９００２，９００３，９００４はそれぞれマゼンタ（Ｍ）、シアン（Ｃ）、イエロー（Ｙ）、ブラック（Ｋ）の各感光体ドラム、９００５，９００６，９００７，９００８は各ＬＥＤプリンタヘッドである。９００９は、転写紙を搬送すると共に各感光体ドラム９００１，９００２，９００３，９００４に接触するための搬送ベルトである。９０１０は給紙用のレジストローラ、９０１１は定着ローラである。９０１２は搬送ベルト９００９に転写紙を吸着保持するためのチャージャー、９０１３は除電チャージャー、９０１４は転写紙の先端検出用センサを示す。
【０１９０】
（第４の実施形態）
なお、第１の実施形態において説明した半導体物品の製造方法を用いて、ＬＥＤ素子を作製し、それを用いてディスプレイなどの表示装置を作製することもできる。かかる場合は、複数の波長を有するＬＥＤを用意するのがよい。
【０１９１】
（第５の実施形態：貼り合わせ構造体）
本実施形態に係る発明は、第１の基板と第２の基板とを貼り合わせて構成される貼り合わせ構造体である。
【０１９２】
そして、前記第１の基板上には、分離層を介して、島状にパターニングされている化合物半導体多層膜を含む領域（図２における１０２０）が設けられており、該化合物半導体多層膜領域同士の間には第１の溝（図１における１０２５）がある。
【０１９３】
そして、この前記化合物半導体多層膜領域は、その上面から見た形状が、長辺方向２９０１と短辺方向２９０２を有する四角形である。
【０１９４】
前記第２の基板２０００には、該第２の基板を貫通している前記第２の溝２００５が設けられており、該第２の溝は、前記長辺方向に沿って平行に、断続的に複数個設けられることで、長辺方向貫通溝群（図３の３９９８）をなしている。
【０１９５】
前記長辺方向貫通溝群３９９８が、島状の前記化合物半導体多層膜領域の短辺方向の長さと等しいか、それ以上の距離隔てて、互いに平行に複数並んでいることを特徴とする。ここでいう距離とは、図３における矢印３９９９である。２つの基板を貼り合わせた状態では、領域１０２０が、２つの第２の溝間に位置するようになる。このようにしておけば、この貼り合わせ構造体を、短辺方向に沿ってダイシングすることで、チップ化することができるのである。
【０１９６】
なお、本実施形態における説明に登場した、分離層や、第１、第２の基板、化合物半導体多層膜を含む領域などについては、既述の実施形態において説明したことが矛盾しない限り、全て適用される。特に第２の基板は、シリコンウェハに駆動回路などのドライバを設けておくことも好ましい。
【０１９７】
なお、領域１０２０の長さは、その長辺方向の長さは、前記第２の貫通溝の長辺方向の長さに等しいか、それより短くすることもできる。もちろん、例えば、領域１０２０の長辺方向の長さを、４つの貫通溝分の長さに相当する長さにしておくこともできる。
【０１９８】
（第６の実施形態）
また、別の本発明は以下の特徴を有する。
【０１９９】
第１の基板上に該第１の基板側から分離層と、発光層とをこの順に成膜し、該発光層が内側に位置するように、前記第１の基板と第２の基板に貼り合わせて貼り合わせ部材を形成し、前記分離層をエッチング除去することにより前記発光層を前記第２の基板に転写する発光素子の製造方法であって、前記第１の基板上の前記分離層と前記発光層とからなる組を１対として、この組をｎ回（ｎは２以上の自然数である。）繰り返して成膜し、最表面の発光層のみを複数の島状にパターニングした後で、前記第１の基板と前記第２の基板とを貼り合わせて貼り合わせ構造体を形成し、前記島状のパターニングが行われていることによって前記貼り合わせ構造体に形成されている空間に、エッチング液を浸透させて、前記分離層と前記エッチング液とを接触させて、前記島状の発光層を選択的に前記第２の基板に転写することを特徴とする発光素子の製造方法。
【０２００】
（第７の実施形態）
また、別の本発明は以下の特徴を有する。
【０２０１】
すなわち、シリコン基板上に、ＤＢＲミラーを介して発光素子が設けられていることを特徴とする発光デバイスである。
【０２０２】
ＤＢＲを設けたいわゆるマイクロキャビティＬＥＤ構成にした後、これをシリコン基板に移設し、より指向性の高いスポットを実現して、ロッドレンズを必須としない、密着型プリンタヘッドを得ることができる。
【０２０３】
また、ＬＥＤアレイの製造方法は、以下の特徴を有する。すなわち、第１の半導体基板の表面に分離層、発光層、ＤＢＲ層の順に成膜し、これを半導体回路が形成された第２の基板に絶縁膜を介して貼り合わせる工程、前記分離層をエッチング除去することにより前記第１の基板の発光層及びＤＢＲ層を前記第２の基板に転写する工程、転写された前記発光層を複数の発光部にアレイ化する工程、複数の前記発光部と、該発光部の点灯を制御するための前記半導体回路の電極部分とを電気的に接続する工程である。
【０２０４】
以下に、本発明について、実施例を用いて説明する。
【実施例】
【０２０５】
図１０から図１８を用いて実施例を説明する。
【０２０６】
まず、ｐ−ＧａＡｓ基板１０００を用意する。必要に応じて不図示のバッファ層を形成した後、エッチング・ストップ層１００９として、ＧａＩｎＰ層を成膜する。その上に、エッチング犠牲層１０１０として、ｐ−ＡｌＡｓ層を形成する。さらに、化合物半導体多層膜１０２０を形成する。この多層膜は、上から順に、ｎ型ＧａＡｓコンタクト層、ｎ型クラッド層、ｐ型活性層、ｐ型クラッド層、ｐ型コンタクト層である。
【０２０７】
さらに、その上に、ＡｌＧａＡｓ多層膜（Ａｌ0.8ＧａＡｓ／Ａｌ0.2ＧａＡの１０ペア）１０２２を形成し、これをＤＢＲミラーとして機能させる（図１０）。
【０２０８】
なお、エッチング・ストップ層と犠牲層と化合物半導体多層膜は繰り返して形成（マルチエピタキシャル）しておいてもよく、そのようにした例が図１１に示してある。ＡｌＧａＡｓ多層膜１０２２上には、エッチング・ストップ層１１０９として、ＧａＩｎＰ層を成膜する。その上に、エッチング犠牲層１１１０として、ｐ−ＡｌＡｓ層を形成する。さらに、化合物半導体多層膜１１２０を形成する。さらに、その上に、ＡｌＧａＡｓ多層膜（Ａｌ0.8ＧａＡｓ／Ａｌ0.2ＧａＡの１０ペア）１０２２を形成する。これをＤＢＲミラーとして機能させる。
【０２０９】
図１１に示すように、第１の溝１１２５を、レジストをマスクとして、エッチングして形成する。エピタキシャル層１１２０をチップ状に分離する。例えば、２５０μｍ ｘ ８ｍｍ,分離幅は８０μｍほどで、スクライブラインに相当するのがよい。あるいは、エッチングを促進するために、チップ幅２５０μｍを短縮してもよい、最短長はＬＥＤ個別素子の大きさである数十ミクロンまで縮小することができる。
【０２１０】
図１２に示すように、シリコン基板２０００にスクライブライン状に貫通溝（半導体基板溝）２００５を形成する。シリコン基板には、上記のスクライブラインに長手方向に８０μｍ×８ｍｍの矩形形状の溝をウェハを貫通して形成する。手法はＭＥＭＳに実用化されている深堀ＲＩＥ又はサンドブラスト法などが適用される。なお、溝が形成されたシリコン基板には、駆動回路が形成されていてもよいし、そのまま、熱伝導が約三倍向上し、価格が十分の一以下であるシリコン本来の特性を利用してデバイス層が無くとも良い。
【０２１１】
そして、ポジ型の感光性有機絶縁膜ポリイミドをスピン塗布して、光感光性を有する有機絶縁膜（有機材料膜）２０１０を貫通溝の上に被覆した後に、貫通溝を通してＵＶ光を照射する。こうすることにより、シリコンの貫通溝上部の有機絶縁膜を自己整合的に除去することが可能となる。こうして、有機絶縁膜にも第３の貫通溝２００６を設ける。溝つきのシリコン基板の表面に永久接着層として用いられるポジ型感光ポリイミド・有機絶縁層を塗布し、基板裏面よりＵＶ光照射により溝上に被覆したポリイミドを露光、現像して除去する。
【０２１２】
図１２（ｂ）は、４又は６インチのウェハを上面からみた場合の前記貫通溝を示している。
【０２１３】
図１３に示すように、両基板を貼り合わせる。貼り合わせは、有機絶縁膜２０１０をガラス転移温度以上に予備加熱して接着性を高めた上で、加圧、加熱することによって行う。なお、マルチエピタキシャル層を用いて、マルチ転写する場合には、チップサイズ毎にＤＢＲ反射層、デバイス層をＡｌＡｓ犠牲層までエッチングしてから貼り合わせる。溝にエッチング液を浸透させるためである。エッチング液を進入させたり、ジェット流を用いてエッチング液の進入を補助することが効果的である。又、はり合わせたウェハ対を減圧下に置くか、あるいは、その間隙を減圧にして、エッチング液の侵入を促進することも効果的である。
【０２１４】
有機絶縁膜の存在する溝の間に分離されたエピタキシャル層の表面をタック性（接着性）のあるポリイミド表面に押し当て、密着し、接着しボイドの無い接合が実現される。ポリイミド層は接着層として素子分離のための永久絶縁層として用いられる。貼り付けるエピタキシャル層側には、光反射層として金属ミラーあるいは、ＤＢＲミラーが直接、付与されているのがよい。その場合、有機絶縁膜の下部に反射ミラー層を埋設する場合と比較して、光吸収による光損失を回避し、２倍か、界面の全反射率を考慮すれば、それ以上の光増幅が可能となる。
【０２１５】
次に、２〜１０％に希釈したＨＦ溶液に前記貼り合わせ部材を浸潤し、ＡｌＡｓ犠牲層１１１０を選択的にエッチング除去する。希ＨＦに上記はり合わせ基板を浸潤することによって、約十万倍の選択エッチがエピ・ＧａＡｓ基板界面に設けられた分離層を効率良く、溶解し、短時間で分離が完了する。島状分離が無い場合には、ウェハのサイズにもよるが、ウェハ全域を分離するのに一週間以上かかる場合もある。
【０２１６】
なお、エッチング液が浸透し難い場合は、エッチング液に、超音波を印加したり、圧力をかけてエッチング液を進入させたり、ジェット流を用いてエッチング液の進入を補助することが効果的である。又、はり合わせたウェハ対を減圧下に置くか、あるいは、その間隙を減圧にして、エッチング液の侵入を促進することも効果的である。
【０２１７】
すると図１４に示すように、ＧａＡｓ基板１０００が部材から分離する。
【０２１８】
その後、メサエッチングでエピタキシャル層のｎ層を露出させる。具体的には、図１５に示すように、カソード電極をクラッド層下に形成したコンタクト層あるいは、反射ＤＢＲミラーにＮ型不純物をドーピングすることによって低抵抗層を形成しておく。そして、その直上にエッチング・ストップ層ＧａＩｎＰなどを設置してメサエッチで、図示するように、ＬＥＤ断面を台形に整形すると同時にカソードコンタクト層を露出させる。その後、パッシベーション膜を形成し、コンタクトホールを作製し、そこにメタルを充填して、ＬＥＤデバイスが形成される。
【０２１９】
９０００はシリコン基板である。必要に応じてドライバ回路が組み込まれていてもよい。９０１０は絶縁膜であり、例えば有機材料である。９０１５はワイヤ・ボンディングパッドである。絶縁膜９０１０は必要に応じて設ければよい。９０４０はメタルなどのミラーとして機能する部分である。この層も必要に応じて設ければよい。９０５０は配線である。９０３０はエピタキシャル層であり、多層膜構成から例えば成る。９０２０は絶縁膜である。９０３０は、メサ状にエッチングしたり、点発光のために、必要に応じて素子分離する。この分離は、多層膜構成を上面側から見た場合に、表面の導電型（ｐ又はｎ）が例えば、ｐ型の場合には、活性層が露出するか、ｎ型の層が露出するまで除去することで、発光点毎に分離（アレイ化）できる。
【０２２０】
９０４１の部分は、必要に応じて設けられる部分であり、例えば９０３０の多層膜に連続的に形成された低抵抗層である。すなわち、９０４１は省略可能である。なお、９０４０が金属メタルである場合は、引出し配線９０１５と電気的接続しないようにしておく。但し、配線９０１５と等電位に保つように電気的に９０１５と９０４０を接続しておいてもよい。
【０２２１】
図１６のようにダイシング・ソーを行う方向１６２５により、チップ１６００の短手方向に、ソーイングすることにより、ウェハを切断すると同時に、チップ長手方向に整列された貫通溝２００５の端部がこのソーイングによって連結される。こうして、チップ１６００に個別に分断される。もちろん、ウェハはダイシング・テープ上に貼付しておけば、チップ分離に際して、飛散することを防止できる。なお、図１６において、１６１１は第２の基板（例えばシリコンウェハ）であり、１６０５と１７０５は第２の基板に設けられている第２の貫通溝を示している。チップ１６００の小さな四角は発光領域を模式的に示している。
【０２２２】
なお、高密度チップをチップ端面を接合して繋ぎ合わせて長尺アレイを実現するために、端面のチッピングが問題となる場合には、チップの長手方向と直角な方向のチップ間に分離溝を形成し、長手方向にダイシング・ソーを走行させればよい。そもそも、脆弱な化合物半導体基板を切断するよりも、シリコン基板の方がチッピングは少ない。特に、２４００ＤＰＩのような、素子間距離が１０μｍほどであり、その精度でチップ間を接続せざるを得ない場合には、ＲＩＥで整形した溝端面の平滑性が有効となる。また、チップ四隅にシリコンを残して周囲に貫通溝を形成してもよい。その場合には、ダイシング・テープを伸展するだけでチップ分離が可能となる。貫通溝を形成する際には、機械的研削によって半導体基板を切断せず、化学的反応によるエッチングであるため、切断面の面精度は格段に向上する。図１６において太線でしめしたように貫通溝のアレイ状の配列方向に直交する方向にダイシング・ソーをおこなうと、個々のチップ分割されることになる。なお、図１６の拡大図におけるＣ１とＣ２間の断面図が、例えば、図１５のチップということになる。
【０２２３】
図１７（ａ）は、シリコン基板上にドライバ回路を形成した構成を示している。図１７（ｂ）はウェハ面内にこのシフトレジスタ、ラッチなどの駆動回路チップを配列して形成した平面図を示している。図１７（ａ）、（ｂ）において、１７００はシリコン基板、１７０１はＳｉＯ２からなる絶縁膜、１７０２はワイヤ・ボンディングパッド、１７０３は駆動回路を構成するＭＯＳトランジスタ、１７０４はシリコンウェハ、１７０５は駆動回路チップである。
【０２２４】
そして、図１８に示すように、まず、シリコンウェハ１８００からシリコン駆動回路チップ１８２２をダイシング・ソーにより切り出し、シリコンウェハ１８２０からＬＥＤチップ１８２１をダイシング・ソーにより切り出す。ダイシングの際には、第２の基板裏面にダイシング・テープを貼った状態でダイシングするのが好ましい。
【０２２５】
次にプリント基板１８３０へ、シリコン駆動回路チップ１８２２とＬＥＤチップ１８２１のダイボンディングを行い、シリコン駆動回路チップ１８２２とＬＥＤチップ１８２１とをワイヤ・ボンディングによって、電気的接続を行なう。その後、プリント基板１８３０とシリコン駆動回路チップ１８２２のドライバ回路とをワイヤ・ボンディングにより接続する。さらに、光量バラツキ補正回路ＩＣを付与して、ＬＥＤアレイが得られる。
【０２２６】
以上、本発明の代表的な実施形態及び実施例について説明したが、本実施形態及び本実施例は種々の変形が可能であり、本願の請求の範囲によって規定される本発明の精神及び範囲から逸脱しないかぎり、種々の置換、変更が可能である。
【０２２７】
本実施例によれば、貫通溝を有するシリコン基板を用いることにより、シリコン基板上へ化合物半導体多層膜を移設するための貼り合わせ回数も、既述の特許文献１に比して格段に減らすことができる。そして、デバイス歩留まりの向上と工程低減による著しい効果が期待される。
【産業上の利用可能性】
【０２２８】
本発明は、半導体基板上にアレイ状に半導体素子を形成するアレイ素子、特に半導体基板上に形成されたＬＥＤ素子を用いたＬＥＤプリンタやディスプレイ、あるいは、光送受信用素子や受光素子などに利用することができる。受光素子に利用すれば、スキャナーを構成することもできる。また、ＬＥＤアレイヘッドとこの受光素子を組み合わせれば、照明系一体型のスキャナーが作製される。
【図面の簡単な説明】
【０２２９】
【図１】本発明の第１の実施形態の半導体物品の製造方法に係わる部材の断面図である。
【図２】図１のａ１−ｂ１断面を下方から見た図である。
【図３】図１のａ２−ｂ２断面を示す図である。
【図４】第１の溝と半導体基板溝との位置関係を示すとともに、島状の化合物半導体多層膜が半導体基板溝間に配置される様子を示す一部分解斜視図である。
【図５】配線基板上で駆動回路とＬＥＤアレイとを接続した一例の構成を示す断面図である。
【図６】ＬＥＤプリンタヘッドを示す図である。
【図７】Ｓｉ基板側に直接ドライバ回路を作りこみ、ＬＥＤ素子と接続した状態を示す断面図である。
【図８】電極数を減らすための時分割駆動可能な発光素子アレイ回路８５００を示す図である。
【図９】（ａ）はＬＥＤプリンタの一構成例を示す概念図、（ｂ）はカラープリンタの一構成例を示す概念図である。
【図１０】本発明の半導体物品の製造方法の一実施例を示す図である。
【図１１】本発明の半導体物品の製造方法の一実施例を示す図である。
【図１２】本発明の半導体物品の製造方法の一実施例を示す図である。
【図１３】本発明の半導体物品の製造方法の一実施例を示す図である。
【図１４】本発明の半導体物品の製造方法の一実施例を示す図である。
【図１５】ＬＥＤアレイの断面図である。
【図１６】本発明の半導体物品の製造方法の一実施例を示す図である。
【図１７】本発明の半導体物品の製造方法の一実施例を示す図である。
【図１８】本発明の半導体物品の製造方法の一実施例を示す図である。
【図１９】本発明の半導体物品の製造方法の一実施例を示す図である。
【図２０】Ｓｉ基板側に直接ドライバ回路を作りこみ、ＬＥＤ素子と接続した状態を示す断面図である。
【図２１】第１の基板上に分離層と発光層とからなる組を複数積層した場合を示す工程図である。
【符号の説明】
【０２３０】
１０００  化合物半導体基板
１００９  エッチング・ストップ層
１０１０  エッチング犠牲層
１０２０  化合物半導体多層膜
１０２５  第１の溝
２０００  シリコン基板
２００５  第２の溝
２００６  第３の溝
２０１０  絶縁膜（有機材料膜）
【図１】
2008135419.tif 000003
【図２】
2008135419.tif 000004
【図３】
2008135419.tif 000005
【図４】
2008135419.tif 000006
【図５】
2008135419.tif 000007
【図６】
2008135419.tif 000008
【図７】
2008135419.tif 000009
【図８】
2008135419.tif 000010
【図９】
2008135419.tif 000011
【図１０】
2008135419.tif 000012
【図１１】
2008135419.tif 000013
【図１２】
2008135419.tif 000014
【図１３】
2008135419.tif 000015
【図１４】
2008135419.tif 000016
【図１５】
2008135419.tif 000017
【図１６】
2008135419.tif 000018
【図１７】
2008135419.tif 000019
【図１８】
2008135419.tif 000020
【図１９】
2008135419.tif 000021
【図２０】
2008135419.tif 000022
【図２１】
2008135419.tif 000023