(57)【特許請求の範囲】
【請求項１】
金属−酸化膜−半導体からなる絶縁ゲート構造を有する半導体装置の評価方法であって、
前記半導体装置のゲートに、最大電圧が前記半導体装置の閾値電圧以上のＡＣ電圧を印加し続けたまま、前記半導体装置の高電位・低電位間に一定電圧を印加する第１工程と、
前記ＡＣ電圧の印加時間に応じて前記半導体装置の高電位側から低電位側に流れる電流の変化を測定する第２工程と、
前記第２工程の測定値に基づいて、前記半導体装置のターンオン時の前記閾値電圧の変動を取得する第３工程と、
を含むことを特徴とする半導体装置の評価方法。
【請求項２】
前記ＡＣ電圧の最小電圧は、前記半導体装置の閾値電圧未満であることを特徴とする請求項１に記載の半導体装置の評価方法。
【請求項３】
前記第１工程では、前記最大電圧と前記閾値電圧との差分未満の前記一定電圧を設定することを特徴とする請求項１または２に記載の半導体装置の評価方法。
【請求項４】
前記第３工程では、前記第２工程の測定値に、前記ＡＣ電圧の印加時間に対する、前記半導体装置の閾値電圧以上の電圧を流した時間の比率の逆数を掛けた値に基づいて、前記半導体装置のターンオン時の前記閾値電圧の変動を取得することを特徴とする請求項１〜３のいずれか一つに記載の半導体装置の評価方法。
【請求項５】
前記第３工程前に、前記半導体装置の高電位側から低電位側へ向かう方向に流れる電流、および、前記半導体装置のゲートに印加される電圧に基づいて、前記半導体装置に用いられている半導体のキャリア移動度および前記酸化膜の容量を決定することを特徴とする請求項１〜４のいずれか一つに記載の半導体装置の評価方法。
【請求項６】
金属−酸化膜−半導体からなる絶縁ゲート構造を有する半導体装置の評価装置であって、
前記半導体装置のゲートに接続され、前記半導体装置のゲートに、最大電圧が前記半導体装置の閾値電圧以上のＡＣ電圧を印加する電圧源と、
前記半導体装置の高電位側に接続され、前記半導体装置の高電位・低電位間に一定電圧を印加する定電圧源と、
を備え、
前記電圧源によって前記半導体装置のゲートに前記ＡＣ電圧を印加し続けたまま、前記定電圧源によって前記半導体装置に前記一定電圧を印加し、
前記ＡＣ電圧の印加時間に応じて前記半導体装置の高電位側と低電位側との間に流れる電流の変化を測定し、当該測定値に基づいて、前記半導体装置のターンオン時の前記閾値電圧の変動を取得することを特徴とする半導体装置の評価装置。
【請求項７】
前記ＡＣ電圧の最小電圧は、前記半導体装置の閾値電圧未満であることを特徴とする請求項６に記載の半導体装置の評価装置。
【請求項８】
前記一定電圧を、前記最大電圧と前記閾値電圧との差分未満とすることを特徴とする請求項６または７に記載の半導体装置の評価装置。
【請求項９】
前記測定値に、前記ＡＣ電圧の印加時間に対する、前記半導体装置の閾値電圧以上の電圧を流した時間の比率の逆数を掛けた値に基づいて、前記半導体装置のターンオン時の前記閾値電圧の変動を取得することを特徴とする請求項６〜８のいずれか一つに記載の半導体装置の評価装置。
【請求項１０】
前記半導体装置のゲートに前記ＡＣ電圧を印加する前に、前記半導体装置の高電位側から低電位側へ向かう方向に流れる電流、および、前記半導体装置のゲートに印加される電圧に基づいて、前記半導体装置に用いられている半導体のキャリア移動度および前記酸化膜の容量を決定することを特徴とする請求項６〜９のいずれか一つに記載の半導体装置の評価装置。
【請求項１１】
前記半導体装置は、半導体材料としてシリコンを用いて構成されていることを特徴とする請求項６〜１０のいずれか一つに記載の半導体装置の評価装置。
【請求項１２】
前記半導体装置は、半導体材料としてシリコンカーバイドを用いて構成されていることを特徴とする請求項６〜１０のいずれか一つに記載の半導体装置の評価装置。
【請求項１３】
前記半導体装置は、半導体材料としてゲルマニウムを用いて構成されていることを特徴とする請求項６〜１０のいずれか一つに記載の半導体装置の評価装置。
【請求項１４】
前記半導体装置は、半導体材料としてシリコンゲルマニウムを用いて構成されていることを特徴とする請求項６〜１０のいずれか一つに記載の半導体装置の評価装置。
【請求項１５】
前記半導体装置は、半導体材料としてガリウムヒ素を用いて構成されていることを特徴とする請求項６〜１０のいずれか一つに記載の半導体装置の評価装置。
【請求項１６】
前記半導体装置は、半導体材料として窒化ガリウムを用いて構成されていることを特徴とする請求項６〜１０のいずれか一つに記載の半導体装置の評価装置。
【請求項１７】
前記半導体装置は、半導体材料としてダイヤモンドを用いて構成されていることを特徴とする請求項６〜１０のいずれか一つに記載の半導体装置の評価装置。
【請求項１８】
所定情報を記憶する記憶部をさらに備え、
前記記憶部に予め記憶されたプログラムを実行させることによって、前記半導体装置のターンオン時の前記閾値電圧の変動の測定を自動で行うことを特徴とする請求項６〜１７のいずれか一つに記載の半導体装置の評価装置。
【発明の詳細な説明】
【技術分野】
【０００１】
この発明は、半導体装置の評価方法および半導体装置の評価装置に関する。
【背景技術】
【０００２】
従来、ＭＯＳＦＥＴ（Ｍｅｔａｌ  Ｏｘｉｄｅ  Ｓｅｍｉｃｏｎｄｕｃｔｏｒ  Ｆｉｅｌｄ  Ｅｆｆｅｃｔ  Ｔｒａｎｓｉｓｔｏｒ：絶縁ゲート型電界効果トランジスタ）においては、ゲートに電圧を印加することによりターンオン時の閾値電圧が変動することが問題となっている。閾値電圧の変動は、半導体装置に流れる電流のアンバランス（電流バランスがとれない）や、電流効率が低下するという問題につながる。このため、ターンオン時の閾値電圧の変動を抑制する必要がある。また、ターンオン時の閾値電圧の変動を抑制するために、ターンオン時の閾値電圧を正確に測定する必要がある。
【０００３】
従来の閾値電圧の測定方法として、ゲートに任意の時間で電圧（ゲート電圧）を印加し、ゲートへの電圧の印加を停止した後に、ソース−ドレイン間に流れる電流のゲート電圧依存性を測定することで閾値電圧を測定し、閾値電圧の変動の度合いを算出する方法が提案されている（例えば、下記非特許文献１参照。）。
【０００４】
従来の閾値電圧の他の測定方法として、ゲートに任意の時間、矩形パルスのようなＡＣ（交流）電圧（ゲート電圧）を印加し、ゲートへのＡＣ電圧の印加を停止した後に、ソース−ドレイン間に流れる電流のゲート電圧依存性を測定することで閾値電圧を測定し、閾値電圧の変動の度合いを算出する方法が提案されている（例えば、下記特許文献１参照。）。
【０００５】
しかしながら、上記方法では、ゲートに電圧を印加し、ゲートへの電圧の印加を停止した後に閾値電圧の測定を行うが、閾値電圧の測定にある程度の時間を要する。このため、ゲートへの電圧の印加を停止してから閾値電圧を測定するまでの間に、ゲートへの電圧の印加の影響が緩和し、閾値電圧の変動を過小評価してしまうという問題点がある。
【０００６】
このため、ゲートに定電圧を印加し続けた状態で閾値電圧の測定を行う方法が提案されている（例えば、下記非特許文献２参照。）。図１０は、非特許文献２の従来の技術による半導体装置の評価装置を模式的に示す回路図である。
【０００７】
図１０に示す実施の形態にかかる半導体装置の評価装置は、ＭＯＳＦＥＴ１１の閾値電圧Ｖthの変動量を測定してＭＯＳＦＥＴ１１の信頼性を評価する評価装置の一例であり、被測定物である例えばｎチャネル型のＭＯＳＦＥＴ１１と、ＭＯＳＦＥＴ１１に電気的なストレスを与える定電圧源１２および定電流源１３と、を備える。ＭＯＳＦＥＴ１１のドレインは定電流源１３に接続され、ソースおよびボディは接地されている。ＭＯＳＦＥＴ１１のゲートは定電圧源１２の正極に接続されている。定電圧源１２の負極は接地されている。
【０００８】
図１１は、従来の技術による定電圧源１２がＭＯＳＦＥＴ１のゲートに印加する電圧を示す特性図である。定電圧源１２は、ＭＯＳＦＥＴ１１の閾値電圧Ｖth以上の起電力を有し、常時、ＭＯＳＦＥＴ１１のゲートにＭＯＳＦＥＴ１１の閾値電圧Ｖth以上の一定のゲート電圧Ｖg（＞Ｖth）を印加し続ける。ＭＯＳＦＥＴ１１の閾値電圧Ｖthの変動量ΔＶthは、ＭＯＳＦＥＴ１のソース−ドレイン間電流Ｉsdを一定に維持した状態で測定されたＭＯＳＦＥＴ１１のソース−ドレイン間電圧Ｖsdの変動量を変換することで得られる。
【先行技術文献】
【特許文献】
【０００９】
【特許文献１】特開平８−５７０６号公報
【非特許文献】
【００１０】
【非特許文献１】エム・ドゥネ（Ｍ．Ｄｅｎａｉｓ）、外７名、オン−ザ−フライ  キャラクタリゼーション  オブ  ＮＢＴＩ  イン  ウルトラ−スィン  ゲート  オキサイド  ＰＭＯＳＦＥＴ’ｓ（Ｏｎ−ｔｈｅ−ｆｌｙ  ｃｈａｒａｃｔｅｒｉｚａｔｉｏｎ  ｏｆ  ＮＢＴＩ  ｉｎ  ｕｌｔｒａ−ｔｈｉｎ  ｇａｔｅ  ｏｘｉｄｅ  ＰＭＯＳＦＥＴ’ｓ）、アイ・トリプル・イー  インターナショナル  エレクトロン  デバイシズ  ミーティング（ＩＥＤＭ）  ２００４（ＩＥＥＥ  Ｉｎｔｅｒｎａｔｉｏｎａｌ  Ｅｌｅｃｔｒｏｎ  Ｄｅｖｉｃｅｓ  Ｍｅｅｔｉｎｇ（ＩＥＤＭ）  ２００４）、２００４年、ｐ．１０９−１１２
【非特許文献２】Ｍｉｔｓｕｒｕ  Ｓｏｍｅｔａｎｉ、他９名、“Ｅｘａｃｔ  Ｃｈａｒａｃｔｅｒｉｚａｔｉｏｎ  ｏｆ  Ｔｈｒｅｓｈｏｌｄ  Ｖｏｌｔａｇｅ  Ｉｎｓｔａｂｉｌｉｔｙ  ｉｎ  ４Ｈ−ＳｉＣ  ＭＯＳＦＥＴｓ  ｂｙ  Ｎｏｎ−ｒｅｌａｘａｔｉｏｎ  ｍｅｔｈｏｄ”，  Ｍａｔｅｒｉａｌｓ  Ｓｃｉｅｎｃｅ  Ｆｏｒｕｍ、Ｖｏｌｓ８２１−８２３（２０１５）、ｐｐ６８５−６８８
【発明の概要】
【発明が解決しようとする課題】
【００１１】
しかしながら、パワーデバイス用途として、ゲートに印加される電圧は必ずしも定電圧ではなく、矩形パルスのようなＡＣ電圧が印加される場合がある。非特許文献２の方法では、ゲートに定電圧を印加し続けることで、閾値電圧測定における閾値電圧変動が緩和される影響を排除することが可能ではある。しかし、非特許文献２の方法では、ゲートに矩形パルスのようなＡＣ電圧が印加される場合、閾値電圧測定における閾値電圧変動が緩和される影響を排除することは難しい。また、非特許文献１の方法では、ゲートへのＡＣ電圧の印加を停止した後に、閾値電圧の測定を行うため、ゲートへの電圧の印加の影響が緩和し、閾値電圧の変動を過小評価してしまう。
【００１２】
この発明は、上述した従来技術による問題点を解消するため、ゲートにＡＣ電圧が印加されても、ターンオン時の閾値電圧の変動を正確に測定することができる半導体装置の評価方法および半導体装置の評価装置を提供することを目的とする。
【課題を解決するための手段】
【００１３】  上述した課題を解決し、本発明の目的を達成するため、この発明にかかる半導体装置の評価方法は、金属−酸化膜−半導体からなる絶縁ゲート構造を有する半導体装置の評価方法であって、前記半導体装置のゲートに、最大電圧が前記半導体装置の閾値電圧以上のＡＣ電圧を印加し続けたまま、前記半導体装置の高電位・低電位間に一定電圧を印加する第１工程と、前記ＡＣ電圧の印加時間に応じて前記半導体装置の高電位側から低電位側に流れる電流の変化を測定する第２工程と、前記第２工程の測定値に基づいて、前記半導体装置のターンオン時の前記閾値電圧の変動を取得する第３工程とを含むことを特徴とする。【００１４】
また、この発明にかかる半導体装置の評価方法は、上述した発明において、前記ＡＣ電圧の最小電圧は、前記半導体装置の閾値電圧未満であることを特徴とする。
【００１６】
また、この発明にかかる半導体装置の評価方法は、上述した発明において、前記第１工程では、前記最大電圧と前記閾値電圧との差分未満の前記一定電圧を設定することを特徴とする。
【００１７】
また、この発明にかかる半導体装置の評価方法は、上述した発明において、前記第３工程では、前記第２工程の測定値に、前記ＡＣ電圧の印加時間に対する、前記半導体装置の閾値電圧以上の電圧を流した時間の比率の逆数を掛けた値に基づいて、前記半導体装置のターンオン時の前記閾値電圧の変動を取得することを特徴とする。
【００１８】  また、この発明にかかる半導体装置の評価方法は、上述した発明において、前記第３工程前に、前記半導体装置の高電位側から低電位側へ向かう方向に流れる電流、および、前記半導体装置のゲートに印加される電圧に基づいて、前記半導体装置に用いられている半導体のキャリア移動度および前記酸化膜の容量を決定することを特徴とする。【００１９】  上述した課題を解決し、本発明の目的を達成するため、この発明にかかる半導体装置の評価装置は、金属−酸化膜−半導体からなる絶縁ゲート構造を有する半導体装置の評価装置であって、前記半導体装置のゲートに接続され、前記半導体装置のゲートに、最大電圧が前記半導体装置の閾値電圧以上のＡＣ電圧を印加する電圧源と、前記半導体装置の高電位側に接続され、前記半導体装置の高電位・低電位間に一定電圧を印加する定電圧源と、を備え、前記電圧源によって前記半導体装置のゲートに前記ＡＣ電圧を印加し続けたまま、前記定電圧源によって前記半導体装置に前記一定電圧を印加し、前記ＡＣ電圧の印加時間に応じて前記半導体装置の高電位側と低電位側との間に流れる電流の変化を測定し、当該測定値に基づいて、前記半導体装置のターンオン時の前記閾値電圧の変動を取得することを特徴とする。【００２０】
また、この発明にかかる半導体装置の評価装置は、上述した発明において、前記ＡＣ電圧の最小電圧は、前記半導体装置の閾値電圧未満であることを特徴とする。
【００２２】
また、この発明にかかる半導体装置の評価装置は、上述した発明において、前記一定電圧を、前記最大電圧と前記閾値電圧との差分未満とすることを特徴とする。
【００２３】
また、この発明にかかる半導体装置の評価装置は、上述した発明において、前記測定値に、前記ＡＣ電圧の印加時間に対する、前記半導体装置の閾値電圧以上の電圧を流した時間の比率の逆数を掛けた値に基づいて、前記半導体装置のターンオン時の前記閾値電圧の変動を取得することを特徴とする。
【００２４】  また、この発明にかかる半導体装置の評価装置は、上述した発明において、前記半導体装置のゲートに前記ＡＣ電圧を印加する前に、前記半導体装置の高電位側から低電位側へ向かう方向に流れる電流、および、前記半導体装置に用いられている半導体装置のゲートに印加される電圧に基づいて、前記半導体のキャリア移動度および前記酸化膜の容量を決定することを特徴とする。【００２５】
また、この発明にかかる半導体装置の評価装置は、上述した発明において、前記半導体装置は、半導体材料としてシリコンを用いて構成されていることを特徴とする。
【００２６】
また、この発明にかかる半導体装置の評価装置は、上述した発明において、前記半導体装置は、半導体材料としてシリコンカーバイドを用いて構成されていることを特徴とする。
【００２７】
また、この発明にかかる半導体装置の評価装置は、上述した発明において、前記半導体装置は、半導体材料としてゲルマニウムを用いて構成されていることを特徴とする。
【００２８】
また、この発明にかかる半導体装置の評価装置は、上述した発明において、前記半導体装置は、半導体材料としてシリコンゲルマニウムを用いて構成されていることを特徴とする。
【００２９】
また、この発明にかかる半導体装置の評価装置は、上述した発明において、前記半導体装置は、半導体材料としてガリウムヒ素を用いて構成されていることを特徴とする。
【００３０】
また、この発明にかかる半導体装置の評価装置は、上述した発明において、前記半導体装置は、半導体材料として窒化ガリウムを用いて構成されていることを特徴とする。
【００３１】
また、この発明にかかる半導体装置の評価装置は、上述した発明において、前記半導体装置は、半導体材料としてダイヤモンドを用いて構成されていることを特徴とする。
【００３２】
また、この発明にかかる半導体装置の評価装置は、上述した発明において、所定情報を記憶する記憶部をさらに備え、前記記憶部に予め記憶されたプログラムを実行させることによって、前記半導体装置のターンオン時の前記閾値電圧の変動の測定を自動で行うことを特徴とする。
【発明の効果】
【００３３】
本発明にかかる半導体装置の評価方法および半導体装置の評価装置によれば、半導体装置のゲートにストレス電圧を印加し、ＡＣ電圧を印加しながら閾値電圧の変動の度合いを評価することができる。このため、ゲートにＡＣ電圧が印加されても、閾値電圧の緩和が一切起こらない状態で、半導体装置の高電位側と低電位側との間に印加される電圧の変動量を測定することができ、この測定値に基づいてターンオン時の閾値電圧を正確に測定することができる。これにより、閾値電圧の経時変動の度合いを正確に評価することができるため、半導体装置に流れる電流のアンバランスや、電流効率が低下することを抑制することができるという効果を奏する。
【図面の簡単な説明】
【００３４】
【図１】実施の形態にかかる半導体装置の評価装置を模式的に示す回路図である。
【図２】ＡＣ電圧源２がＭＯＳＦＥＴ１のゲートに印加する電圧の経時変動を示す特性図である。
【図３】実施の形態にかかる半導体装置の評価装置の被測定物であるＭＯＳＦＥＴの構造の一例を示す断面図である。
【図４】実施の形態にかかる半導体装置の評価方法の概要を示すフローチャートである。
【図５】実施の形態にかかる半導体装置の評価方法によって測定されるソース−ドレイン間電流Ｉsd−ゲート電圧Ｖg特性を示す特性図である。
【図６】実施の形態にかかる半導体装置の評価方法によって測定されるソース−ドレイン間電流Ｉsdの経時変動を示す特性図である。
【図７】実施の形態にかかる半導体装置の評価方法を用いて測定された閾値電圧Ｖthの経時変動を示す特性図である。
【図８】実施の形態にかかる半導体装置の評価装置の被測定物である二重拡散型の縦型ＭＯＳＦＥＴの構造の一例を示す断面図である。
【図９】実施の形態にかかる半導体装置の評価装置の被測定物であるトレンチ型の縦型ＭＯＳＦＥＴの構造の一例を示す断面図である。
【図１０】従来の技術による半導体装置の評価装置を模式的に示す回路図である。
【図１１】従来の技術による定電圧源１２がＭＯＳＦＥＴ１のゲートに印加する電圧を示す特性図である。
【発明を実施するための形態】
【００３５】
以下に添付図面を参照して、この発明にかかる半導体装置の評価方法および半導体装置の評価装置の好適な実施の形態を詳細に説明する。本明細書および添付図面においては、ｎまたはｐを冠記した層や領域では、それぞれ電子または正孔が多数キャリアであることを意味する。また、ｎやｐに付す＋および−は、それぞれそれが付されていない層や領域よりも高不純物濃度および低不純物濃度であることを意味する。なお、以下の実施の形態の説明および添付図面において、同様の構成には同一の符号を付し、重複する説明を省略する。
【００３６】
（実施の形態）
実施の形態にかかる半導体装置の評価装置について説明する。図１は、実施の形態にかかる半導体装置の評価装置を模式的に示す回路図である。図１に示す実施の形態にかかる半導体装置の評価装置は、ＭＯＳＦＥＴ１の閾値電圧Ｖthの変動量を測定してＭＯＳＦＥＴ１の信頼性を評価する評価装置の一例であり、被測定物である例えばｎチャネル型のＭＯＳＦＥＴ１と、ＭＯＳＦＥＴ１に電気的なストレスを与えるＡＣ電圧源２および定電圧源３と、を備える。ＭＯＳＦＥＴ１のドレインは定電圧源３に接続され、ソースおよびボディは接地されている。ＭＯＳＦＥＴ１のゲートはＡＣ電圧源２の正極に接続されている。ＡＣ電圧源２の負極は接地されている。
【００３７】
ＡＣ電圧源２は、ＭＯＳＦＥＴ１の閾値電圧Ｖth以上の起電力を有し、常時、ＭＯＳＦＥＴ１のゲートに、以下に示す図２のような、時間とともに周期的に電圧が変化し、最大電圧がＭＯＳＦＥＴ１の閾値電圧Ｖth以上のＡＣ電圧（以下、ストレス電圧とする）Ｖgを印加し続ける。
【００３８】
図２は、ＡＣ電圧源２がＭＯＳＦＥＴ１のゲートに印加する電圧の経時変動を示す特性図である。ＡＣ電圧源２は、一定のＯＮ時間、閾値電圧Ｖth以上のＯＮ電圧（Ｖon）と、一定のＯＦＦ時間、閾値電圧Ｖth以下のＯＦＦ電圧（Ｖoff）とを有する矩形の電圧を周期的にＭＯＳＦＥＴ１のゲートに印加して、ＭＯＳＦＥＴ１を周期的にＯＮ・ＯＦＦする。また、図２は、矩形の電圧を印加する例であるが、矩形には限らない。例えば、ＡＣ電圧源２は、最大値が閾値電圧Ｖth以上であり、最小値が閾値電圧Ｖth以下である正弦波であってもよい。
【００３９】
定電圧源３は、常時、ＭＯＳＦＥＴ１のソース−ドレイン間に定電圧ストレス（ソース−ドレイン間電圧）Ｖsdを印加する。これにより、ＡＣ電圧源２によってＭＯＳＦＥＴ１のゲートにＯＮ電圧が印加されると、ＯＮ電圧が閾値電圧Ｖth以上なので、ＭＯＳＦＥＴ１がＯＮになり、ＭＯＳＦＥＴ１のソース−ドレイン間電流Ｉsdが流れる状態となる。ＡＣ電圧源２によってＭＯＳＦＥＴ１のゲートにＯＦＦ電圧が印加されると、ＯＦＦ電圧が閾値電圧Ｖth未満なので、ＭＯＳＦＥＴ１がＯＦＦになり、ＭＯＳＦＥＴ１のソース−ドレイン間電流Ｉsdが流れない状態となる。
【００４０】
また、定電圧源３は、電流測定器として機能し、ＭＯＳＦＥＴ１に一定のソース−ドレイン間電圧Ｖsdを印加したときに、ＭＯＳＦＥＴ１に流れるソース−ドレイン間電流Ｉsdを測定し監視（モニター）し続ける。すなわち、定電圧源３は、ＭＯＳＦＥＴ１のソース−ドレイン間電圧Ｖsdを一定に維持した状態で、ＭＯＳＦＥＴ１に流れるソース−ドレイン間電流Ｉsdの経時変動を測定する。定電圧源３として、例えば、被測定物に電流または電圧を供給すると同時に、被測定物にかかる電圧または被測定物に流れる電流を測定するいわゆるソースメジャメントユニット（ＳＭＵ：Ｓｏｕｒｃｅ  Ｍｅａｓｕｒｅｍｅｎｔ  Ｕｎｉｔ）を用いてもよい。
【００４１】
ここで、ＡＣ電圧源２のＯＮ時間とＯＦＦ時間をμ秒単位にすると、半導体装置評価装置に付属しているソースメジャメントユニット（以下、ＳＭＵとする）では、ＯＮ電圧とＯＦＦ電圧の変化によるソース−ドレイン間電流Ｉsdの変化には追従できない。例えば、ＳＭＵで計測されるソース−ドレイン間電流Ｉsdは、ＳＭＵが追従可能な１ｍ秒間の平均電流となる。例えば、ＯＮ時間とＯＦＦ時間の比率がそれぞれ５０％であった場合、ソース−ドレイン間電流Ｉsdは、定電圧印加の時と比較して、５０％の量となる。このため、電圧印加時間に対するＯＮ時間の比率の逆数（１／（ＯＮ時間／（ＯＮ時間＋ＯＦＦ時間）））を、ソース−ドレイン間電流Ｉsdに掛けることにより、ＯＮ電圧のみを与え続けた場合のソース−ドレイン間電流Ｉonsdを求めることができる。
【００４２】
例えば、ＯＮ時間とＯＦＦ時間の比率がそれぞれ５０％であった場合、ＯＮ時間の比率の逆数（１／（０．５／（０．５＋０．５）））＝２を、ソース−ドレイン間電流Ｉsdに掛けることにより、ＯＮ電圧のみを与え続けた場合のソース−ドレイン間電流Ｉonsdを求めることができる。
【００４３】
また、ＭＯＳＦＥＴ１の閾値電圧Ｖthの変動量ΔＶthは、定電圧源３によって測定され、ＯＮ電圧のみを与え続けた場合に変換されたＭＯＳＦＥＴ１のソース−ドレイン間電流Ｉonsdの変動量を変換することで得られる。具体的には、ＭＯＳＦＥＴ１の閾値電圧Ｖthの変動量ΔＶthは、次のように算出される。ＭＯＳＦＥＴ１のソース−ドレイン間電圧ＶsdがＡＣ電圧源２によって供給されるストレス電圧ＶgのＯＮ電圧からＭＯＳＦＥＴ１の閾値電圧Ｖthを差し引いた値よりも十分に小さい境界条件（Ｖsd＜＜ＶgのＯＮ電圧−Ｖth）においては、ＭＯＳＦＥＴ１のソース−ドレイン間電流Ｉsdは、下記（１）式であらわされる。
【００４４】
【数１】
0006656692.tif 000002
【００４５】
また、上記（１）式を、ＭＯＳＦＥＴ１の閾値電圧Ｖthを解とする式に変換する。この式に基づいて、ＭＯＳＦＥＴ１にソース−ドレイン間電圧Ｖsdを印加した時点（ｔ＝０）から所定時間ｔまでのＭＯＳＦＥＴ１のソース−ドレイン間電流Ｉsdの変動量を、ＭＯＳＦＥＴ１の閾値電圧Ｖthの変動量ΔＶthに変換する下記（２）式が得られる。Ｌはチャネル長（ソース−ドレイン間の最短距離）であり、Ｚはチャネル幅（チャネル長に直交する方向のチャネル部の幅）であり、μnはキャリア移動度であり、Ｃoxはゲート絶縁膜（酸化膜）容量である。
【００４６】
【数２】
0006656692.tif 000003
【００４７】
上記（２）式のＺ／Ｌ×μn×Ｃoxは、ソース−ドレイン間電流Ｉsdの変動量を閾値電圧Ｖthの変動量ΔＶthへ変換をする際に必要な係数（以下、変換係数とする）である。ＭＯＳＦＥＴ１のソース−ドレイン間電流Ｉsdは、ＭＯＳＦＥＴ１のゲートに印加されるストレス電圧Ｖgとほぼ比例関係（以下、Ｉsd−Ｖg特性とする）にあり、上記（２）式の変換係数（＝Ｚ／Ｌ×μn×Ｃox）はＩsd−Ｖg特性の傾きと一致する。
【００４８】
このため、ＭＯＳＦＥＴ１に定電圧ストレス（定電圧源３によるソース−ドレイン間電圧Ｖsd）を印加する前にＩsd−Ｖg特性を測定しておき、上記（２）式中のＩsdに、ＯＮ電圧のみを与え続けた場合のソース−ドレイン間電流Ｉonsdを代入することで、ＭＯＳＦＥＴ１の閾値電圧Ｖthの変動量ΔＶthを見積もることができる。
【００４９】
以上のように、定電圧源３が測定したソース−ドレイン間電流Ｉsdの変動量を、ＯＮ電圧のみを与え続けた場合のソース−ドレイン間電流Ｉonsdに変換し、変換したソース−ドレイン間電流Ｉonsdを上記（２）式のＩsdに代入することにより、ＭＯＳＦＥＴ１の閾値電圧Ｖthの変動量ΔＶthを見積もることができる。
【００５０】
次に、実施の形態にかかる半導体装置の評価装置によって閾値電圧Ｖthの変動の度合いを評価するＭＯＳＦＥＴ１の構造の一例について説明する。図３は、実施の形態にかかる半導体装置の評価装置の被測定物であるＭＯＳＦＥＴの構造の一例を示す断面図である。図３には、図１のＭＯＳＦＥＴ１の構造の一例として、横型ＭＯＳＦＥＴを示す。
【００５１】
図１に示すＭＯＳＦＥＴ１において、ｎ型半導体基板１１上には、ｐ型ボディ領域となるｐ型エピタキシャル層１２が設けられている。ｐ型エピタキシャル層１２の、ｎ型半導体基板１１側に対して反対側の表面層には、ｎ+型ソース領域１３、ｎ+型ドレイン領域１４およびｐ+型ボディコンタクト領域１５がそれぞれ選択的に設けられている。
【００５２】
ｐ型エピタキシャル層１２の、ｎ+型ソース領域１３とｎ+型ドレイン領域１４とに挟まれた部分の表面には、ゲート絶縁膜１６を介してゲート電極１７が設けられている。ソース電極１８はｎ+型ソース領域１３に接する。ドレイン電極１９はｎ+型ドレイン領域１４に接する。ボディ電極２０はｐ+型ボディコンタクト領域１５に接する。ソース電極１８およびボディ電極２０は接地されている。
【００５３】
特に限定しないが、例えば、ＭＯＳＦＥＴ１の各部の寸法および不純物濃度は次の値をとる。ｎ型半導体基板１１の比抵抗および厚さは、それぞれ０．０２Ωｃｍおよび３５０μｍである。ｐ型エピタキシャル層１２の不純物濃度および厚さは、それぞれ５×１０15／ｃｍ3および５μｍである。ｎ+型ソース領域１３の不純物濃度および厚さは、それぞれ２×１０20／ｃｍ3および０．３μｍである。ｎ+型ドレイン領域１４の不純物濃度および厚さは、それぞれ２×１０20／ｃｍ3および０．３μｍである。ｐ+型ボディコンタクト領域１５の不純物濃度および厚さは、それぞれ２×１０20／ｃｍ3および０．３μｍである。ゲート絶縁膜１６は、酸化膜（ＳｉＯ2）からなり、その厚さは５０ｎｍである。
【００５４】
次に、実施の形態にかかる半導体装置の評価方法について、例示した上記諸条件で作製されたＭＯＳＦＥＴ１の閾値電圧Ｖthの変動の度合いを評価する場合を例に説明する。図４は、実施の形態にかかる半導体装置の評価方法の概要を示すフローチャートである。
【００５５】
まず、ＭＯＳＦＥＴ１のソースおよびボディを接地し、ソース−ドレイン間電圧Ｖsdを０．１Ｖの一定電圧とした状態で、ＭＯＳＦＥＴ１のゲート電圧を０Ｖから１５Ｖの範囲でスイープ（変更）してＭＯＳＦＥＴ１のソース−ドレイン間電流Ｉsdを測定し、ＭＯＳＦＥＴ１のＩsd−Ｖg特性を取得する（ステップＳ１）。
【００５６】
ステップＳ１において、ＭＯＳＦＥＴ１に印加するゲート電圧Ｖgの最大値を、ＭＯＳＦＥＴ１の閾値電圧Ｖth（＝４Ｖ）以上、ＡＣ電圧源２のＯＮ電圧（＝１５Ｖ）以下に設定したときのＩsd−Ｖg特性を図５に示す。図５は、実施の形態にかかる半導体装置の評価方法によって測定されるソース−ドレイン間電流Ｉsd−ゲート電圧Ｖg特性を示す特性図である。
【００５７】
次に、ステップＳ１において取得したＭＯＳＦＥＴ１のＩsd−Ｖg特性に基づいて、ＭＯＳＦＥＴ１のキャリア移動度μnおよびゲート絶縁膜容量Ｃoxを決定する（ステップＳ２）。具体的には、Ｉsd−Ｖg特性が比例関係（直線）となるゲート電圧Ｖg以上のＩsd−Ｖg特性から、被測定物であるＭＯＳＦＥＴ１のＩsd−Ｖg特性の傾き（＝Ｚ／Ｌ×μn×Ｃox）を決定する。
【００５８】
図５に示すＩsd−Ｖg特性では、ゲート電圧Ｖg＝８Ｖ以上でＩsd−Ｖg特性がほぼ比例関係となるため、Ｉsd−Ｖg特性の、ゲート電圧Ｖg＝８Ｖ以上の部分から、ＭＯＳＦＥＴ１のキャリア移動度μnおよびゲート絶縁膜容量Ｃox、すなわち上記（２）式の変換係数（＝Ｚ／Ｌ×μn×Ｃox＝５．６×１０-8Ａ／Ｖ）を決定する。
【００５９】
次に、ＭＯＳＦＥＴ１のソースおよびボディを接地し、ＡＣ電圧源２によってＭＯＳＦＥＴ１のゲートにＯＮ電圧１５Ｖ、ＯＮ時間１０μｓ、ＯＦＦ電圧０Ｖ、ＯＦＦ時間１０μｓの矩形のストレス電圧Ｖgを印加した状態で、定電圧源３によって、ＭＯＳＦＥＴ１のソース−ドレイン間に例えば０．１Ｖの一定電圧（ソース−ドレイン間電圧Ｖsd）を印加する。そして、ＭＯＳＦＥＴ１のソース−ドレイン間に流れるソース−ドレイン間電流Ｉsdの変動量を測定する（ステップＳ３）。
【００６０】
ステップＳ３において測定された、ストレス電圧Ｖgの印加時間（バイアス時間）に対するソース−ドレイン間電流Ｉsdの経時変動を図６に示す。図６は、実施の形態にかかる半導体装置の評価方法によって測定されるソース−ドレイン間電流Ｉsdの経時変動を示す特性図である。図６に示すように、ソース−ドレイン間電流Ｉsdは、ストレス電圧Ｖgの印加時間が増えるに従い変動することがわかる。
【００６１】
次に、ステップＳ３において測定したソース−ドレイン間電流Ｉsdの変動量に、電圧印加時間に対するＯＮ時間の比率の逆数（１／（ＯＮ時間／（ＯＮ時間＋ＯＦＦ時間）））を掛けることにより、ＯＮ電圧のみを与え続けた場合のソース−ドレイン間電流Ｉonsdの変動量を推定することができる（ステップＳ４）。
【００６２】
今回の条件では、１／（１０μｓ／（１０μｓ＋１０μｓ））＝２をステップＳ３において測定したソース−ドレイン間電流Ｉsdの変動量に掛けることにより、ＯＮ電圧のみを与え続けた場合のソース−ドレイン間電流Ｉonsdの変動量を推定することができる。
【００６３】
次に、ステップＳ２において決定した変換係数（＝Ｚ／Ｌ×μn×Ｃox＝５．６×１０-8Ａ／Ｖ）および上記（２）式に基づいて、ステップＳ４において推定したソース−ドレイン間電流Ｉonsdの変動量を、閾値電圧Ｖthの変動量ΔＶthに変換することにより（ステップＳ５）、ＭＯＳＦＥＴ１の信頼性の評価が完了する。
【００６４】
その後、ステップＳ５において取得した閾値電圧Ｖthの変動量ΔＶthに基づいて、ＭＯＳＦＥＴ１やＭＯＳＦＥＴ１周辺の回路部に、ＭＯＳＦＥＴ１のターンオン時の閾値電圧の変動を抑制するための対策を行えばよい。この対策の一例としては、酸化膜形成後のＰｏｓｔ  Ｏｘｉｄａｔｉｏｎ  Ａｎｎｅａｌ（ＰＯＡ）処理時のＨ2濃度を増やしたり、アニール時間を延ばして変動を抑制する。
【００６５】
ここで、一例として、ソース−ドレイン間電流Ｉsdが３．３８６８×１０-7Ａから３．３６７９×１０-7Ａに変動したときの、閾値電圧Ｖthの変動量ΔＶthは０．０６７４Ｖである。上述した実施の形態にかかる半導体装置の評価方法は、例えば図１に示す実施の形態にかかる半導体装置の評価装置を用いて行われる。
【００６６】
次に、実施の形態にかかる半導体装置の評価方法を用いて測定されたＭＯＳＦＥＴ１の閾値電圧Ｖthの経時変動について説明する。図７は、実施の形態にかかる半導体装置の評価方法を用いて測定された閾値電圧Ｖthの経時変動を示す特性図である。図７には、実施の形態にかかる半導体装置の評価方法を用いて測定されたＭＯＳＦＥＴ１の閾値電圧Ｖthの経時変動を示す（以下、本発明の評価方法とする）。また、図７には、比較として、例えば上記非特許文献１を用いて測定されたＭＯＳＦＥＴ１の閾値電圧Ｖthの経時変動を示す（以下、従来の評価方法とする）。
【００６７】
図７に示す結果より、本発明の評価方法による閾値電圧Ｖthの測定値は、従来の評価方法による閾値電圧Ｖthの測定値よりも大きいことが確認された。この理由は、次の通りである。従来の評価方法では、ＭＯＳＦＥＴ１へのゲート電圧の印加を停止した後に、ＭＯＳＦＥＴ１の閾値電圧Ｖthを測定するため、ＭＯＳＦＥＴ１にゲート電圧を印加してから閾値電圧Ｖthを測定するまでの間に閾値電圧Ｖthの変動が緩和し、閾値電圧Ｖthの値が過小評価された状態になる。
【００６８】
一方、本発明の評価方法においては、ＭＯＳＦＥＴ１のゲートに常にストレス電圧Ｖgを印加し続けているため、閾値電圧Ｖthを緩和させることなく、閾値電圧Ｖthの変動を正確に測定することができるからである。
【００６９】
なお、以上の実施の形態では、図３に示す横型ＭＯＳＦＥＴについて記載してきたが、本発明にかかる半導体装置の評価方法は、図８に示す二重拡散型の縦型ＭＯＳＦＥＴ（ＤＭＯＳＦＥＴ：Ｄｏｕｂｌｅ−ｄｉｆｆｕｓｅｄ  ＭＯＳＦＥＴ）や図９に示すトレンチ型の縦型ＭＯＳＦＥＴについても適用可能である。
【００７０】
図８は、実施の形態にかかる半導体装置の評価装置の被測定物である二重拡散型の横型ＭＯＳＦＥＴの構造の一例を示す断面図である。図８に示す二重拡散型の横型ＭＯＳＦＥＴにおいて、ｎ+型ドレイン領域となるｎ+型半導体基板８１のおもて面上には、ｎ-型ドリフト領域となるｎ-型エピタキシャル層８２が設けられている。ｎ-型エピタキシャル層８２の、ｎ+型半導体基板８１側に対して反対側の表面層には、ｐ+型ベース領域となる２つのｐ+型領域８３が互いに離れて選択的に設けられている。
【００７１】
２つのｐ+型領域８３のｎ+型半導体基板８１側に対して反対側の表面層には、それぞれｎ+型ソース領域となるｎ+型領域８４が選択的に設けられている。ｎ-型エピタキシャル層８２の、２つのｐ+型領域８３に挟まれた部分の表面には、ゲート絶縁膜８５を介してゲート電極８６が設けられている。ソース電極８７はｐ+型領域８３およびｎ+型領域８４に接する。ドレイン電極８８はｎ+型半導体基板８１の裏面に設けられている。
【００７２】
特に限定しないが、例えば、二重拡散型の縦型ＭＯＳＦＥＴの各部の寸法および不純物濃度は次の値をとる。ｎ+型半導体基板８１の比抵抗および厚さは、それぞれ０．０２Ωｃｍおよび３５０μｍである。ｎ-型エピタキシャル層８２の不純物濃度および厚さは、それぞれ５×１０16／ｃｍ3および１０μｍである。ｐ+型領域８３の不純物濃度および厚さは、それぞれ２×１０17／ｃｍ3および０．５μｍである。ｎ+型領域８４の不純物濃度および厚さは、それぞれ２×１０20／ｃｍ3および０．３μｍである。ゲート絶縁膜８５は、酸化膜（ＳｉＯ2）からなり、その厚さは５０ｎｍである。
【００７３】
図９は、実施の形態にかかる半導体装置の評価装置の被測定物であるトレンチ型の縦型ＭＯＳＦＥＴの構造の一例を示す断面図である。図９に示すトレンチ型の縦型ＭＯＳＦＥＴにおいて、ｎ+型ドレイン領域となるｎ+型半導体基板９１のおもて面上には、ｎ-型ドリフト領域となるｎ-型エピタキシャル層９２が設けられている。ｎ-型エピタキシャル層９２の、ｎ+型半導体基板９１側に対して反対側の表面層には、ｐ+型ベース領域となるｐ+型領域９３が選択的に設けられている。ｐ+型領域９３のｎ+型半導体基板９１側に対して反対側の表面層には、ｎ+型ソース領域となるｎ+型領域９４が選択的に設けられている。ｎ+型半導体基板９１のｎ-型エピタキシャル層９２が設けられた側には、トレンチ構造が形成されている。
【００７４】
トレンチ９５は、ｎ-型エピタキシャル層９２のｎ+型半導体基板９１側に対して反対側の表面からｎ+型領域９４およびｐ+型領域９３を貫通してｎ-型エピタキシャル層９２に達する。トレンチ９５の内壁に沿って、トレンチ９５の底部および側壁にゲート絶縁膜９６が形成されており、トレンチ９５内のゲート絶縁膜９６の内側にゲート電極９７が形成されている。ソース電極９８はｐ+型領域９３およびｎ+型領域９４に接する。ドレイン電極９９はｎ+型半導体基板９１の裏面に設けられている。
【００７５】
特に限定しないが、例えば、トレンチ型の縦型ＭＯＳＦＥＴの各部の寸法および不純物濃度は次の値をとる。ｎ+型半導体基板９１の比抵抗および厚さは、それぞれ０．０２Ωｃｍおよび３５０μｍである。ｎ-型エピタキシャル層９２の不純物濃度および厚さは、それぞれ５×１０16／ｃｍ3および１０μｍである。ｐ+型領域９３の不純物濃度および厚さは、それぞれ２×１０17／ｃｍ3および０．５μｍである。ｎ+型領域９４の不純物濃度および厚さは、それぞれ２×１０20／ｃｍ3および０．３μｍである。ゲート絶縁膜９６は、酸化膜（ＳｉＯ2）からなり、その厚さは５０ｎｍである。
【００７６】
なお、本発明にかかる半導体装置の評価方法は、予め用意されたプログラムをパーソナルコンピュータやワークステーションなどのコンピュータで実行することにより各ステップの処理を自動で行ってもよい。このプログラムは、ソリッドステートドライブ（ＳＳＤ：Ｓｏｌｉｄ  Ｓｔａｔｅ  Ｄｒｉｖｅ）、ハードディスク、フレキシブルディスク、ＣＤ−ＲＯＭ、ＭＯ、ＤＶＤなどのコンピュータで読み取り可能な記録媒体に記録され、コンピュータによって記録媒体から読み出されることによって実行される。またこのプログラムは、インターネットなどのネットワークを介して配布することが可能な伝送媒体であってもよい。
【００７７】
以上、説明したように、実施の形態によれば、ＭＯＳＦＥＴのゲートにＡＣ電圧を印加し続けたまま、ＭＯＳＦＥＴのドレインに定電圧ストレスを印加して測定したソース−ドレイン間電流の変動量に、電圧印加時間に対するＯＮ時間の比率の逆数を掛けることにより、ＯＮ電圧のみを与え続けた場合のソース−ドレイン間電流の変動量を推定することができる。この推定したソース−ドレイン間電流の変動量に基づいて閾値電圧の変動量を算出することで、ＯＮ電圧のみを与え続けた場合のソース−ドレイン間電流を算出することができる。
【００７８】
このため、ゲートにＡＣ電圧が印加されても、閾値電圧の緩和が一切起こらない状態で、ＭＯＳＦＥＴのソース−ドレイン間電圧の変動量を測定することができ、この測定値に基づいて閾値電圧の経時変動の度合いを過小評価せずに正確に評価することができる。これにより、半導体装置に流れる電流のアンバランス（電流バランスがとれない）や、電流効率が低下することを抑制することができる。
【００７９】
以上において本発明は、上述した実施の形態に限らず、本発明の趣旨を逸脱しない範囲で種々変更可能である。例えば、上述した実施の形態では、被測定物にＡＣ電流を供給する機能と、被測定物にかかる電流を測定する機能とを有する定電圧源を用いた場合を例に説明しているが、これに限らず、定電圧源では被測定物への一定電圧の印加のみを行い、被測定物にかかる電流を測定する電流測定器を新たに設けてもよい。
【００８０】
また、上述した実施の形態では、ソース−ドレイン間電流の変動量に基づいて閾値電圧の変動量を算出しているが、これに限らず、例えばソースメジャメントユニットを用いて、ＭＯＳＦＥＴのソース−ドレイン間電流を一定に維持した状態でソース−ドレイン間電圧を測定し、ソース−ドレイン間電圧の変動量に基づいて閾値電圧の変動量を算出してもよい。
【００８１】
また、本発明では、半導体材料としてシリコン（Ｓｉ）、シリコンカーバイド（ＳｉＣ）、ゲルマニウム（Ｇｅ）、シリコンゲルマニウム（ＳｉＧｅ）、ガリウムヒ素（ＧａＡｓ）、窒化ガリウム（ＧａＮ）、またはダイヤモンド（Ｃ）を用いた半導体装置に適用可能である。また、上述した実施の形態では、被測定物としてＭＯＳＦＥＴを例に説明しているが、上述した実施の形態に限らず、ＭＯＳゲート（金属−酸化膜−半導体からなる絶縁ゲート）構造を備えたさまざまな構造の半導体装置を被測定物とすることが可能である。また、本発明は、被測定物である半導体装置の各領域の導電型を反転させても同様に成り立つ。
【産業上の利用可能性】
【００８２】
以上のように、本発明にかかる半導体装置の評価方法および半導体装置の評価装置は、半導体装置の特性評価に有用であり、特にゲート電圧を印加することによるターンオン時の閾値電圧の変動の度合いを評価するのに適している。
【符号の説明】
【００８３】
１  ＭＯＳＦＥＴ
２  ＡＣ電圧源
３  定電圧源
１１  ｎ型半導体基板
１２  ｐ型エピタキシャル層
１３  ｎ+型ソース領域
１４  ｎ+型ドレイン領域
１５  ｐ+型ボディコンタクト領域
１６、８５、９６  ゲート絶縁膜
１７、８６、９７  ゲート電極
１８、８７、９８  ソース電極
１９、８８、９９  ドレイン電極
２０  ボディ電極
８１、９１  ｎ+型半導体基板
８２、９２  ｎ-型エピタキシャル層
８３、９３  ｐ+型領域
８４、９４  ｎ+型領域
９５  トレンチ
Ｃox  ゲート絶縁膜容量
Ｉsd  ソース−ドレイン間電流
Ｖg  ストレス電圧
Ｖsd  ソース−ドレイン間電圧
Ｖth  閾値電圧
【図１】
0006656692.tif 000004
【図２】
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【図３】
0006656692.tif 000006
【図４】
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【図５】
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【図６】
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【図７】
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【図８】
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【図９】
0006656692.tif 000012
【図１０】
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【図１１】
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