【手続補正書】
【提出日】平成21年8月20日(2009.8.20)
【手続補正１】
【補正対象書類名】特許請求の範囲
【補正対象項目名】全文
【補正方法】変更
【補正の内容】
【特許請求の範囲】
【請求項１】
複数個のバーストから成るライトデータをメモリに書き込む制御を行うとともに、前記メモリに書き込まれたデータを読み出す制御を行うメモリ制御回路であって、
前記バーストの順番を並べ替えてｎ種類のライトデータを生成するライトデータ生成手段と、
前記ライトデータ生成手段によって生成されたｎ種類のライトデータの中から、メモリに書き込む際のデータ切り替え回数が前記バーストの順番を並べ替える前よりも少ないライトデータを選択するライトデータ選択手段と、
前記ライトデータ選択手段によって選択されたライトデータのバースト並び順を冗長ビットにエンコードするエンコード手段と、
前記ライトデータ選択手段によって選択されたライトデータと、前記エンコード手段によってエンコードされた冗長ビットとを前記メモリに書き込む書き込み手段と、
前記書き込み手段によって書き込まれたライトデータと冗長ビットとを前記メモリから読み出す読み出し手段と、
前記読み出し手段によって読み出された冗長ビットをデコードするデコード手段と、
前記デコード手段のデコーダ結果に従って、前記読み出し手段によって前記メモリから読み出されたリードデータのバースト並び順を検出するバースト並び順検出手段と、
前記バースト並び順検出手段の検出結果に従って前記リードデータのバースト並び順を並べ替えて前記並び替えを行う前のバーストの順番となるように復元するデータ復元手段とを有することを特徴とするメモリ制御回路。
【請求項２】
前記ライトデータ選択手段は、前記ライトデータの切り替え回数が最小となるように前記バーストの順番が並べ替えられたライトデータを選択することを特徴とする請求項１に記載のメモリ制御回路。
【請求項３】
複数個のバーストから成るライトデータをメモリに書き込む制御を行うとともに、前記メモリに書き込まれたデータを読み出す制御を行うメモリ制御回路であって、
前記バーストと所定のデータパターンとを比較する比較手段と、
前記比較手段の比較結果を冗長ビットにエンコードするエンコード手段と、
前記比較手段の比較により前記バーストが前記所定のデータパターンと一致しなかった場合、前記バーストをそのまま、ライトデータの一部として、一方、前記比較手段の比較により前記バーストが前記所定のデータパターンと一致した場合、前記所定のデータパターンと一致した前記バーストに代えて、固定の値のライトデータを、ライトデータの一部として出力するデータ固定制御手段と、
前記データ固定制御手段によって出力されたライトデータの一部と、前記エンコード手段によってエンコードされた冗長ビットとを前記メモリに書き込む書き込み手段と、
前記書き込み手段によって書き込まれたライトデータと冗長ビットとを前記メモリから読み出す読み出し手段と、
前記読み出し手段によって読み出された冗長ビットをデコードするデコード手段と、
前記デコード手段のデコード結果に従って、前記読み出し手段によって読み出されたライトデータをリードデータとして出力するか、前記所定のデータパターンをリードデータとして出力するか選択する選択手段とを有することを特徴とするメモリ制御回路。
【請求項４】
複数個のバーストから成るライトデータをメモリに書き込む制御を行うとともに、前記メモリに書き込まれたデータを読み出す制御を行うメモリ制御方法であって、
前記バーストの順番を並べ替えてｎ種類のライトデータを生成するライトデータ生成工程と、
前記ライトデータ生成工程において生成されたｎ種類のライトデータの中から、メモリに書き込む際のデータ切り替え回数が前記バーストの順番を並べ替える前よりも少ないライトデータを選択するライトデータ選択工程と、
前記ライトデータ選択工程において選択されたライトデータのバースト並び順を冗長ビットにエンコードするエンコード工程と、
前記ライトデータ選択工程において選択されたライトデータと、前記エンコード工程においてエンコードされた冗長ビットとを前記メモリに書き込む書き込み工程と、
前記書き込み工程において書き込まれたライトデータと冗長ビットとを前記メモリから読み出す読み出し工程と、
前記読み出し工程において読み出された冗長ビットをデコードするデコード工程と、
前記デコード工程におけるデコーダ結果に従って、前記読み出し工程において前記メモリから読み出されたリードデータのバースト並び順を検出するバースト並び順検出工程と、
前記バースト並び順検出工程における検出結果に従って前記リードデータのバースト並び順を並べ替えて前記並び替えを行う前のバーストの順番となるように復元するデータ復元工程とを有することを特徴とするメモリ制御方法。
【請求項５】
複数個のバーストから成るライトデータをメモリに書き込む制御を行うとともに、前記メモリに書き込まれたデータを読み出す制御を行うメモリ制御手順をコンピュータに実行させるためのプログラムであって、
前記バーストの順番を並べ替えてｎ種類のライトデータを生成するライトデータ生成手順と、
前記ライトデータ生成手順において生成されたｎ種類のライトデータの中から、メモリに書き込む際のデータ切り替え回数が前記バーストの順番を並べ替える前よりも少ないライトデータを選択するライトデータ選択手順と、
前記ライトデータ選択手順において選択されたライトデータのバースト並び順を冗長ビットにエンコードするエンコード手順と、
前記ライトデータ選択手順において選択されたライトデータと、前記エンコード手順においてエンコードされた冗長ビットとを前記メモリに書き込む書き込み手順と、
前記書き込み手順において書き込まれたライトデータと冗長ビットとを前記メモリから読み出す読み出し手順と、
前記読み出し手順において読み出された冗長ビットをデコードするデコード手順工程と、
前記デコード手順におけるデコーダ結果に従って、前記読み出し手順において前記メモリから読み出されたリードデータのバースト並び順を検出するバースト並び順検出手順と、
前記バースト並び順検出手順における検出結果に従って前記リードデータのバースト並び順を並べ替えて前記並び替えを行う前のバーストの順番となるように復元するデータ復元手順とをコンピュータに実行させるためのプログラム。
【手続補正２】
【補正対象書類名】明細書
【補正対象項目名】０００５
【補正方法】変更
【補正の内容】
【０００５】
このノイズは、スイッチングするトランジスタの数に比例して大きくなる。ＬＳＩチップに集積した数多くのトランジスタが同時にスイッチングすることによって生じる大きな電源バウンス、グラウンド・バウンスを同時スイッチングノイズ（ＳＳＯノイズ）と呼んでいる。
【手続補正３】
【補正対象書類名】明細書
【補正対象項目名】００１３
【補正方法】変更
【補正の内容】
【００１３】
本発明のプログラムは、複数個のバーストから成るライトデータをメモリに書き込む制御を行うとともに、前記メモリに書き込まれたデータを読み出す制御を行うメモリ制御手順をコンピュータに実行させるためのプログラムであって、前記バーストの順番を並べ替えてｎ種類のライトデータを生成するライトデータ生成手順と、前記ライトデータ生成手順において生成されたｎ種類のライトデータの中から、メモリに書き込む際のデータ切り替え回数が前記バーストの順番を並べ替える前よりも少ないライトデータを選択するライトデータ選択手順と、前記ライトデータ選択手順において選択されたライトデータのバースト並び順を冗長ビットにエンコードするエンコード手順と、前記ライトデータ選択手順において選択されたライトデータと、前記エンコード手順においてエンコードされた冗長ビットとを前記メモリに書き込む書き込み手順と、前記書き込み手順において書き込まれたライトデータと冗長ビットとを前記メモリから読み出す読み出し手順と、前記読み出し手順において読み出された冗長ビットをデコードするデコード手順工程と、前記デコード手順におけるデコーダ結果に従って、前記読み出し手順において前記メモリから読み出されたリードデータのバースト並び順を検出するバースト並び順検出手順と、前記バースト並び順検出手順における検出結果に従って前記リードデータのバースト並び順を並べ替えて前記並び替えを行う前のバーストの順番となるように復元するデータ復元手順とをコンピュータに実行させる。
【手続補正４】
【補正対象書類名】明細書
【補正対象項目名】００１５
【補正方法】変更
【補正の内容】
【００１５】
（第１の実施形態）
以下、本発明の実施形態について図面を参照しながら詳述する。
まず、本発明の第１の実施形態に係るメモリシステムについて説明する。
図１は、本実施形態に係るメモリシステムについて説明する図である。
【手続補正５】
【補正対象書類名】明細書
【補正対象項目名】００３４
【補正方法】変更
【補正の内容】
【００３４】
（第２の実施形態）
次に、本発明の第２の実施形態に係るメモリシステムについて説明する。
図５は、本実施形態に係るメモリシステムについて説明する図である。
３０００はメモリコントローラ、３１００はメモリである。メモリコントローラ３０００は、バスインターフェース３０１０、コマンド生成回路３０４０、ライトデータ生成回路３０３０、リードデータ受信回路３０２０等より構成されている。
【手続補正６】
【補正対象書類名】明細書
【補正対象項目名】００４１
【補正方法】変更
【補正の内容】
【００４１】
ライトデータバッファ３０３３内のライトデータは、バースト０〜バースト３（２０１〜２０４）のデータに分割できる。バースト０〜バースト３のデータは、データ比較回路（２１０−０〜２１０−ｎ）で各データパターンとの比較が行われる。データ比較結果はエンコード部３０３２に送信され、エンコードされる。また、比較結果は演算されヒットフラグが生成され、データ固定制御部３０３４に送信される。
【手続補正７】
【補正対象書類名】明細書
【補正対象項目名】００４６
【補正方法】変更
【補正の内容】
【００４６】
次に、図９を用いて、リードデータ選択部３０２２について説明する。
リードデータ選択部３０２２は、データパターン選択回路３１０及びデータパターン保持回路３２０より構成されている。本実施形態ではデータパターン保持回路２２０、３２０をリード、ライト個別に設けたが、同一のデータを保持するため共用も可能である。デコード部３０２３からのデコード結果に基づき、リードデータを選択する。