(57)【要約】【課題】歩留りが高く、且つエアギャップにより配線間の容量を十分に低減できる半導体装置の製造方法を提供する。【解決手段】半導体基板１０１上に配線間絶縁膜１０３を堆積した後、配線間絶縁膜１０３に配線溝１０４を形成し、その後、配線溝１０４の内部に下部配線１０７を形成する。配線間絶縁膜１０３の上及び下部配線１０７の上に保護膜１０９を形成した後、保護膜１０９上にハードマスク膜１１０を形成し、その後、ハードマスク膜１１０をパターン化する。パターン化されたハードマスク膜１１０を用いて、保護膜１０９及び配線間絶縁膜１０３を部分的に除去することにより、エアギャップ溝１１２を形成し、その後、エアギャップ溝１１２の上部を塞ぐように層間絶縁膜１１３を形成することにより、エアギャップ１１４を形成する。【選択図】図３
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【特許請求の範囲】
【請求項１】
基板上に第１の絶縁膜を形成する工程（ａ）と、
前記第１の絶縁膜に配線溝を形成する工程（ｂ）と、
前記配線溝の内部に配線を形成する工程（ｃ）と、
前記第１の絶縁膜の上及び前記配線の上に保護膜を形成する工程（ｄ）と、
前記保護膜上にハードマスク膜を形成する工程（ｅ）と、
前記ハードマスク膜をパターン化する工程（ｆ）と、
パターン化された前記ハードマスク膜を用いて、前記保護膜及び前記第１の絶縁膜を部分的に除去することにより、エアギャップ溝を形成する工程（ｇ）と、
前記エアギャップ溝の上部を塞ぐように第２の絶縁膜を形成することにより、エアギャップを形成する工程（ｈ）とを備えていることを特徴とする半導体装置の製造方法。
【請求項２】
請求項１に記載の半導体装置の製造方法において、
前記第１の絶縁膜はＳｉＯ2 膜又はＦＳＧ膜であることを特徴とする半導体装置の製造方法。
【請求項３】
請求項１又は２に記載の半導体装置の製造方法において、
前記保護膜はＳｉＮ膜、ＳｉＣ膜又はＳｉＣＮ膜であることを特徴とする半導体装置の製造方法。
【請求項４】
請求項１〜３のいずれか１項に記載の半導体装置の製造方法において、
前記ハードマスク膜はＴＥＯＳ膜、ＳｉＯＣ膜、ＳｉＮ膜、ＳｉＣＯ膜又はＳｉＣＮ膜であることを特徴とする半導体装置の製造方法。
【請求項５】
請求項１〜３のいずれか１項に記載の半導体装置の製造方法において、
前記ハードマスク膜は金属膜であることを特徴とする半導体装置の製造方法。
【請求項６】
請求項１〜５のいずれか１項に記載の半導体装置の製造方法において、
前記工程（ｆ）は、
前記ハードマスク膜上にレジストマスクを形成する工程と、
前記レジストマスクを用いて、前記ハードマスク膜を部分的に除去することにより、前記ハードマスク膜をパターン化する工程と、
前記レジストマスクを除去する工程とを含むことを特徴とする半導体装置の製造方法。
【請求項７】
請求項１〜６のいずれか１項に記載の半導体装置の製造方法において、
前記工程（ｇ）と前記工程（ｈ）との間に、前記ハードマスク膜を除去する工程（ｉ）をさらに備えていることを特徴とする半導体装置の製造方法。
【請求項８】
請求項７に記載の半導体装置の製造方法において、
前記工程（ｉ）において、ウェットエッチング法により前記ハードマスク膜を除去することを特徴とする半導体装置の製造方法。
【請求項９】
請求項８に記載の半導体装置の製造方法において、
前記工程（ｉ）において、前記エアギャップ溝の近傍に位置する部分の前記第１の絶縁膜を除去することにより、前記エアギャップ溝を拡大することを特徴とする半導体装置の製造方法。
【請求項１０】
請求項１〜９のいずれか１項に記載の半導体装置の製造方法において、
前記工程（ｇ）において、ウェットエッチング法により前記第１の絶縁膜を部分的に除去することを特徴とする半導体装置の製造方法。
【請求項１１】
請求項１〜１０のいずれか１項に記載の半導体装置の製造方法において、
前記工程（ｃ）は、
前記配線溝の内部を含む前記第１の絶縁膜上にバリア膜及び導電膜を順次積層する工程と、
前記配線溝からはみ出た前記バリア膜及び前記導電膜を除去する工程とを含むことを特徴とする半導体装置の製造方法。
【請求項１２】
請求項１１に記載の半導体装置の製造方法において、
前記バリア膜は金属窒化物又は金属ケイ化窒化物を含むことを特徴とする半導体装置の製造方法。
【請求項１３】
請求項１２に記載の半導体装置の製造方法において、
前記金属窒化物又は前記金属ケイ化窒化物に含まれる金属はチタン、タンタル又はタングステンであることを特徴とする半導体装置の製造方法。
【請求項１４】
請求項１〜１３のいずれか１項に記載の半導体装置の製造方法において、
前記工程（ｃ）は、前記配線の上面を覆うキャップ膜を形成する工程を含むことを特徴とする半導体装置の製造方法。
【請求項１５】
請求項１４に記載の半導体装置の製造方法において、
前記キャップ膜はタングステン又はタングステン合金を含むことを特徴とする半導体装置の製造方法。
【請求項１６】
請求項１５に記載の半導体装置の製造方法において、
前記タングステン合金はコバルトタングステンリン、コバルトタングステンボロン又はコバルトタングステンリンボロンであることを特徴とする半導体装置の製造方法。
【請求項１７】
請求項１４に記載の半導体装置の製造方法において、
前記キャップ膜は金属窒化物又は金属ケイ化窒化物を含むことを特徴とする半導体装置の製造方法。
【請求項１８】
請求項１７に記載の半導体装置の製造方法において、
前記金属窒化物又は前記金属ケイ化窒化物に含まれる金属はチタン、タンタル又はタングステンであることを特徴とする半導体装置の製造方法。
【発明の詳細な説明】
【技術分野】
【０００１】
本発明は、半導体装置の製造方法に関するものである。
【背景技術】
【０００２】
近年の半導体集積回路素子の微細化に伴い、配線間隔が狭くなってきている。これにより、配線間容量が増加し、信号の伝搬速度の低下が引き起こされるという問題がある。そのため、配線間容量を低減する試みとして、配線間に誘電率の低い絶縁膜材料を埋め込むことが検討されている。一方で、配線間にエアギャップを形成することにより、配線間容量を低減する方法も検討されている。以下、特許文献１に示されている従来のエアギャップ形成方法について、図面を参照しながら説明する。
【０００３】
まず、図５（ａ）に示すように、半導体基板１の表面に絶縁膜２を形成する。
【０００４】
次に、図５（ｂ）に示すように、フォトリソグラフィー及びドライエッチングにより、絶縁膜２の上部に配線溝３を形成する。
【０００５】
次に、図５（ｃ）に示すように、配線溝３の内部を含む絶縁膜２の上にバリア膜４及びＣｕ膜５を順次堆積した後、配線溝３からはみ出したバリア膜４及びＣｕ膜５をＣＭＰ（chemical mechanical polishing ）により除去し、下部配線６を形成する。
【０００６】
次に、図５（ｄ）に示すように、ＣＶＤ（chemical vapor deposition ）又は無電解めっきにより、下部配線６の表面にキャップ膜７を選択的に成長させる。
【０００７】
次に、図６（ａ）に示すように、ＣＶＤにより、絶縁膜２の上及び下部配線６を覆うキャップ膜７の上に保護膜８を堆積する。
【０００８】
次に、図６（ｂ）に示すように、フォトリソグラフィーによって、保護膜８の上にパターン化したレジストマスク９を形成する。レジストマスク９はエアギャップ形成領域に開口を有しており、これによってエアギャップ形成領域を制限することができる。
【０００９】
次に、図６（ｃ）に示すように、レジストマスク９を用いて、エアギャップ形成領域に位置する部分の保護膜８を除去する。
【００１０】
次に、エアギャップ形成領域に位置する部分のキャップ膜７をレジストマスク９と共にマスクとして用いて、図７（ａ）に示すように、下部配線６間に位置する部分の絶縁膜２をドライエッチングにより除去することにより、エアギャップ溝１０を形成し、その後、レジストマスク９を除去する。
【００１１】
次に、図７（ｂ）に示すように、ＣＶＤにより、半導体基板１の上に全面に亘って絶縁膜１１を堆積する。これにより、エアギャップ溝１０の内部が絶縁膜１１によって満たされる前に、エアギャップ溝１０の上部が絶縁膜１１により塞がれ、それによってエアギャップ１２が形成される。
【特許文献１】特開２００６−１２０９８８号公報
【発明の開示】
【発明が解決しようとする課題】
【００１２】
しかしながら、前述の従来の技術には、以下のような問題点がある。
【００１３】
第１の問題点は、図６（ｃ）に示す工程（保護膜８を除去する工程）で用いたレジストマスク９を除去したり又はポリマーを除去する際に、図８に示すように、キャップ膜７が酸化されたり又はダメージを受けることである。キャップ膜７が酸化されたり又はダメージを受けると、キャップ膜７が下部配線６を構成するＣｕ膜５の拡散防止膜としての役割を果たせなくなり、歩留まりが低下してしまうことが懸念される。尚、図８において↓は酸素プラズマを示している。
【００１４】
第２の問題点は、図７（ａ）に示す工程（エアギャップ溝１０を形成する工程）において、図８に示すように、下部配線６間に位置する部分の絶縁膜２をエッチングする際に保護膜８にダメージ層１３が形成されることである。このようにダメージ層１３が形成されると、図７（ｂ）に示す工程で堆積される絶縁膜１１と保護膜８との密着性が劣化したり、又はデバイスの信頼性が低下することが懸念される。
【００１５】
第３の問題点は、図６（ｃ）に示す工程（保護膜８を除去する工程）や図７（ａ）に示す工程（エアギャップ溝１０を形成する工程）で用いられるレジストマスク９のエッチング耐性が十分ではないことである。すなわち、保護膜８及び配線間の絶縁膜２を除去するのに十分なレジスト膜厚を確保できない場合、配線間の絶縁膜２のエッチング中にレジストマスク９が消失し、その結果、保護膜８が削られてしまい、デバイスの信頼性劣化につながることが懸念される。
【００１６】
本発明は、以上の従来技術の問題点を鑑みてなされたものであり、その目的は、歩留りが高く、且つエアギャップにより配線間の容量を十分に低減できる半導体装置の製造方法を提供することにある。
【課題を解決するための手段】
【００１７】
前記の目的を達成するために、本発明に係る半導体装置の製造方法は、基板上に第１の絶縁膜を形成する工程（ａ）と、前記第１の絶縁膜に配線溝を形成する工程（ｂ）と、前記配線溝の内部に配線を形成する工程（ｃ）と、前記第１の絶縁膜の上及び前記配線の上に保護膜を形成する工程（ｄ）と、前記保護膜上にハードマスク膜を形成する工程（ｅ）と、前記ハードマスク膜をパターン化する工程（ｆ）と、パターン化された前記ハードマスク膜を用いて、前記保護膜及び前記第１の絶縁膜を部分的に除去することにより、エアギャップ溝を形成する工程（ｇ）と、前記エアギャップ溝の上部を塞ぐように第２の絶縁膜を形成することにより、エアギャップを形成する工程（ｈ）とを備えている。
【００１８】
本発明の半導体装置の製造方法によると、保護膜上にハードマスク膜を形成するため、配線又はそのキャップ膜（拡散防止膜）を保護膜によって覆った状態で、言い換えると、配線又はそのキャップ膜が露出していない状態で、ハードマスク膜のパターン化に用いたレジストマスクを除去することできる。このため、レジスト除去やその後のポリマー除去の際に、配線又はそのキャップ膜が酸化されることを防止できるので、歩留まりの低下を防止することができる。
【００１９】
また、配線間に位置する絶縁膜（第１の絶縁膜）にエアギャップ溝を形成する際に、保護膜をハードマスク膜によって覆っているため、保護膜が直接エッチングされることがないので、保護膜のダメージを抑えることが可能となり、信頼性の低下を防止することができる。
【００２０】
さらに、保護膜の部分的な除去を含むエアギャップ溝形成においてレジストマスクではなくハードマスク膜を用いるため、エッチング中のレジスト膜減りに起因する種々の問題が生じなくなることは言うまでもない。
【発明の効果】
【００２１】
本発明によると、エアギャップにより配線間の容量を十分に低減できる半導体装置を歩留まり良く得ることができる。
【発明を実施するための最良の形態】
【００２２】
（第１の実施形態）
以下、本発明の第１の実施形態に係る半導体装置の製造方法について、図面を参照しながら説明する。
【００２３】
図１（ａ）〜（ｄ）、図２（ａ）〜（ｄ）及び図３（ａ）〜（ｄ）は第１の実施形態に係る半導体装置の製造方法の各工程を示す断面図である。
【００２４】
まず、図１（ａ）に示すように、半導体基板１０１上に層間絶縁膜１０２及び配線間絶縁膜１０３を形成する。尚、本実施形態では、層間絶縁膜１０２として例えばＳｉＯＣ膜、配線間絶縁膜１０３として例えばＴＥＯＳ（tetraethylorthosilicate ）膜を使用している。
【００２５】
次に、図１（ｂ）に示すように、フォトリソグラフィー及びドライエッチングにより、配線間絶縁膜１０３を貫通し且つ層間絶縁膜１０２の内部に達する配線溝１０４を形成する。
【００２６】
次に、図１（ｃ）に示すように、配線溝１０４の内部を含む配線間絶縁膜１０３上にバリア膜１０５及び導電膜１０６を順次堆積した後、配線溝１０４からはみ出したバリア膜１０５及び導電膜１０６を例えばＣＭＰにより除去することにより、配線溝１０４の内部に下部配線１０７を形成する。尚、本実施形態では、バリア膜１０５として例えばＴａＮ膜とＴａ膜とをこの順番で積層した膜、導電膜１０６として例えばＣｕ膜を使用している。
【００２７】
次に、図１（ｄ）に示すように、例えばＣＶＤ又は無電解メッキにより下部配線１０７の上面を覆うキャップ膜１０８を選択的に成長させる。尚、本実施形態では、キャップ膜１０８として例えば無電解めっきにより成長させたＣｏＷＰ（コバルトタングステンリン）膜を使用している。また、キャップ膜１０８の端部は、下部配線１０７の近傍に位置する部分の配線間絶縁膜１０３の上まで延びていてもよい。
【００２８】
次に、図２（ａ）に示すように、配線間絶縁膜１０３の上、及び下部配線１０７を覆うキャップ膜１０８の上に保護膜１０９を形成する。尚、本実施形態では、保護膜１０９として例えばＳｉＣＮ膜を用いている。
【００２９】
次に、図２（ｂ）に示すように、保護膜１０９上にハードマスク膜１１０を堆積する。すなわち、ハードマスク膜１１０は後述するエッチング工程でハードマスクとして機能する。尚、本実施形態では、ハードマスク膜１１０として例えばＴＥＯＳ膜を堆積している。
【００３０】
次に、図２（ｃ）に示すように、フォトリソグラフィーにより、エアギャップ形成領域に開口を有するレジストマスク１１１をハードマスク膜１１０上に形成する。これにより、後述するエアギャップ形成工程において、エアギャップ形成領域と非形成領域とを作り分けることができる。
【００３１】
次に、図２（ｄ）に示すように、ハードマスク膜１１０のうち、レジストマスク１１１により被覆されずに露出している部分をエッチングにより除去し、その後、アッシング及び洗浄によりレジストマスク１１１を除去する。この工程においては、キャップ膜１０８は保護膜１０９により被覆されているため、アッシング等により酸化されることはない。
【００３２】
次に、図３（ａ）に示すように、保護膜１０９のうちハードマスク膜１１０（パターン化されたハードマスク膜１１０：以下同じ）により被覆されずに露出している部分をエッチングにより除去する。
【００３３】
続いて、図３（ｂ）に示すように、ハードマスク膜１１０及びエアギャップ形成領域に位置するキャップ膜１０８をマスクとして、配線間絶縁膜１０３のうちハードマスク膜１１０により被覆されずに露出している部分をエッチングにより除去することによって、エアギャップ溝１１２を形成する。
【００３４】
さらに、図３（ｃ）に示すように、エアギャップ溝１１２の底部となる部分の層間絶縁膜１０２を例えば１００ｎｍ程度エッチングする。これにより、エアギャップ溝１１２を拡大することができるので、次工程でエアギャップ溝１１２に形成されるエアギャップを大きくすることができるので、配線（下部配線１０７）間の容量をさらに下げることができる。
【００３５】
尚、図３（ａ）〜図３（ｃ）に示す保護膜１０９、配線間絶縁膜１０３及び層間絶縁膜１０２のエッチングをウェットエッチング法を用いて連続的に行ってもよい。
【００３６】
次に、図３（ｄ）に示すように、例えばＣＶＤにより、半導体基板１０１の上に全面に亘って層間絶縁膜１１３を堆積する。これにより、エアギャップ溝１１２の内部が層間絶縁膜１１３によって満たされる前に、エアギャップ溝１１２の上部が層間絶縁膜１１３により塞がれ、それによってエアギャップ１１４が形成される。尚、本実施形態では、層間絶縁膜１１３として例えばＳｉＯＣ膜を用いている。
【００３７】
以上のように、本実施形態では、下部配線１０７を覆うキャップ膜１０８が露出した状態（図３（ａ）〜（ｃ）参照））においては、レジスト除去やポリマー除去等は行わないため、キャップ膜１０８が酸化されたり又はダメージを受けることはない。従って、歩留まりの低下を防止することができる。
【００３８】
以上の工程により形成された本実施形態の半導体装置の最終構造においては、図３（ｄ）に示すように、保護膜１０９の上にハードマスク膜１１０が堆積されていることが特徴となっている。
【００３９】
ここで、本発明の特徴であるハードマスク膜１１０の機能について述べる。ハードマスク膜１１０は、保護膜１０９及び配線間絶縁膜１０３をエッチングする際のマスクとして用いる。すなわち、レジストマスクのみによって保護膜１０９及び配線間絶縁膜１０３をエッチングするためにはレジストマスクのエッチング耐性が十分ではないと考えられるからである。言い換えると、ハードマスク膜１１０をマスクとして用いることにより、エッチング中のレジスト膜減りに起因する種々の問題を回避することができる。
【００４０】
また、ハードマスク膜１１０をマスクとして用いることにより、前述のように、レジストマスク除去時等にキャップ膜１０８（具体的にはキャップ膜１０８を構成するＣｏＷＰ）が酸化されることを防止することができ、それによって歩留まりの低下を防止することができる。
【００４１】
さらに、配線間絶縁膜１０３にエアギャップ溝１１２を形成する際に、保護膜１０９をハードマスク膜１１０によって覆っているため、保護膜１０９が直接エッチングされることがないので、保護膜１０９のダメージを抑えることが可能となり、信頼性の低下を防止することができる。
【００４２】
尚、本実施形態において、ハードマスク膜１１０としてＴＥＯＳ膜を用いたが、これに代えて、ＦＳＧ膜、ＳｉＯ2 膜、ＳｉＯＣ膜、ＳｉＮ膜、ＳｉＣＯ膜、ＳｉＣＮ膜又はＡｌＯ膜等を用いてもよい。或いは、これらの絶縁膜に代えて、Ｔｉ膜、Ｔａ膜又はＡｌ膜等の金属膜を用いてもよい。
【００４３】
また、本実施形態において、配線間絶縁膜１０３としてＴＥＯＳ膜を用いたが、これに代えて、ＦＳＧ（fluorine-doped silicate glass ）膜等を用いてもよい。
【００４４】
また、本実施形態において、保護膜１０９としてＳｉＣＮ膜を用いたが、これに代えて、ＳｉＮ膜又はＳｉＣ膜等を用いてもよい。
【００４５】
また、本実施形態において、バリア膜１０５として、ＴａＮ膜とＴａ膜とをこの順番で積層した膜を用いたが、バリア膜１０５は金属窒化物又は金属ケイ化窒化物を含むことが好ましく、当該金属窒化物又は当該金属ケイ化窒化物に含まれる金属はチタン、タンタル又はタングステンであることがさらに好ましい。
【００４６】
また、本実施形態において、キャップ膜１０８としてＣｏＷＰ膜を用いたが、キャップ膜１０８はタングステン又はタングステン合金を含むことが好ましく、当該タングステン合金はコバルトタングステンリン、コバルトタングステンボロン又はコバルトタングステンリンボロンであることがさらに好ましい。或いは、キャップ膜１０８は金属窒化物又は金属ケイ化窒化物を含むことが好ましく、当該金属窒化物又は当該金属ケイ化窒化物に含まれる金属はチタン、タンタル又はタングステンであることがさらに好ましい。
【００４７】
（第２の実施形態）
以下、本発明の第２の実施形態に係る半導体装置の製造方法について、図面を参照しながら説明する。尚、第２の実施形態についての説明は、前述の第１の実施形態と異なる部分についてのみ行うものとし、第１の実施形態と重複する説明については省略する。
【００４８】
図４（ａ）は第２の実施形態に係る半導体装置の製造方法の一工程を示す断面図である。本実施形態が第１の実施形態と異なっているのは、図３（ｃ）に示すエアギャップ溝１１２の形成工程と、図３（ｄ）に示すエアギャップ１１４の形成工程（層間絶縁膜１１３の形成工程）との間に、図４（ａ）に示すように、例えばウェットエッチング法によりハードマスク膜１１０を除去することである。これによって、図３（ｄ）に示すエアギャップ１１４の形成工程において、保護膜１０９上に層間絶縁膜１１３を直接堆積することが可能となるため、ハードマスク膜１１０を残存させたときに生じる膜厚ばらつき（ハードマスク膜１１０の有無に起因する層間絶縁膜１１３表面の段差）等を排除することができる。
【００４９】
また、本実施形態において、図４（ａ）に示す工程で、例えば、配線間絶縁膜１０３及びハードマスク膜１１０の両方のエッチングが可能な薬液を用いることによって、図４（ｂ）に示すように、エアギャップ形成領域の配線（下部配線１０７）間に残っている配線間絶縁膜１０３をさらに除去することが可能となる。すなわち、エアギャップ溝１１２の近傍に位置する部分の配線間絶縁膜１０３をさらに除去することにより、エアギャップ溝１１２を拡大することができ、その結果、エアギャップ１１４をより大きく形成することができるので、配線間領域のさらなる低誘電率化を実現することができる。
【００５０】
尚、第１又は第２の実施形態において、半導体基板直上の絶縁膜に埋め込まれた配線（いわゆるＭ１配線）間におけるエアギャップ形成について述べたが、さらに上層に形成された埋め込み配線間におけるエアギャップ形成に本発明を用いることによって同様の効果が得られることは言うまでもない。
【産業上の利用可能性】
【００５１】
本発明は、半導体装置の製造方法に関し、特に、配線間にエアギャップを形成する技術に適用した場合には、配線間の容量を十分に低減できる半導体装置を歩留り良く得られ、非常に有用である。
【図面の簡単な説明】
【００５２】
【図１】図１（ａ）〜（ｄ）は本発明の第１の実施形態に係る半導体装置の製造方法の各工程を示す断面図である。
【図２】図２（ａ）〜（ｄ）は本発明の第１の実施形態に係る半導体装置の製造方法の各工程を示す断面図である。
【図３】図３（ａ）〜（ｄ）は本発明の第１の実施形態に係る半導体装置の製造方法の各工程を示す断面図である。
【図４】図４（ａ）は本発明の第２の実施形態に係る半導体装置の製造方法の一工程を示す断面図であり、図４（ｂ）は図４（ａ）に示す工程の変形例を示す断面図である。
【図５】図５（ａ）〜（ｄ）は従来の半導体装置の製造方法の各工程を示す断面図である。
【図６】図６（ａ）〜（ｃ）は従来の半導体装置の製造方法の各工程を示す断面図である。
【図７】図７（ａ）及び（ｂ）は従来の半導体装置の製造方法の各工程を示す断面図である。
【図８】図８は従来の半導体装置の製造方法における問題点を示す図である。
【符号の説明】
【００５３】
１    半導体基板
２    絶縁膜
３    配線溝
４    バリア膜
５    Ｃｕ膜
６    下部配線
７    キャップ膜
８    保護膜
９    レジストマスク
１０    エアギャップ溝
１１    絶縁膜
１２    エアギャップ
１３    保護膜のダメージ層
１０１    半導体基板
１０２    層間絶縁膜
１０３    配線間絶縁膜
１０４    配線溝
１０５    バリア膜
１０６    Ｃｕ膜
１０７    下部配線
１０８    キャップ膜
１０９    保護膜
１１０    ハードマスク膜
１１１    レジストマスク
１１２    エアギャップ溝
１１３    層間絶縁膜
１１４    エアギャップ
【図１】
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【図２】
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【図３】
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【図４】
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【図５】
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【図６】
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【図７】
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【図８】
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