(57)【要約】【課題】配線数を減らすことによる歩留まり向上と開口率向上を実現するアクティブマトリックス型表示装置を得る。【解決手段】データ線１２とゲート線１１とを交差させて定義される画素ごとに、表示素子３３および蓄積容量３２を備えたアクティブマトリクス型表示装置において、それぞれの画素における表示素子３３および蓄積容量３２の一端を右隣の画素のデータ線１２ａに接続している。これにより、陰極線を不要とすることができ、配線数を減らすことができる。【選択図】図２
2008158239.tif 000002
【特許請求の範囲】
【請求項１】
データ線とゲート線とを交差させて定義される画素ごとに、表示素子および蓄積容量を備えたアクティブマトリクス型表示装置において、
それぞれの画素における前記表示素子および前記蓄積容量の一端を右隣の画素のデータ線に接続したことを特徴とするアクティブマトリクス型表示装置。
【請求項２】
請求項１に記載のアクティブマトリクス型表示装置において、
前記表示素子は、ＩＰＳ液晶あるいは有機ＥＬディスプレイであることを特徴とするアクティブマトリクス型表示装置。
【請求項３】
請求項１または２に記載のアクティブマトリクス型表示装置において、
前記データ線は、隣同士において正負が反転した電圧が印加されることを特徴とするアクティブマトリクス型表示装置。
【請求項４】
請求項３に記載のアクティブマトリクス型表示装置において、
前記データ線は、隣同士において正負が反転した電圧に対してさらにオフセットを加えた電圧が印加されることを特徴とするアクティブマトリクス型表示装置。
【請求項５】
請求項１ないし４のいずれか１項に記載のアクティブマトリクス型表示装置において、
前記蓄積容量の他端と１本前のゲート線との間に接続され、前記蓄積容量にオフセット電圧を与える補助容量をさらに備えたことを特徴とするアクティブマトリクス型表示装置。
【請求項６】
請求項５に記載のアクティブマトリクス型表示装置において、
前記ゲート線は、ゲート線方向全部の画素にデータ線を通じて加えたい電圧の平均値を、それぞれの画素の前記補助容量を通じて前記オフセット電圧として印加することを特徴とするアクティブマトリクス型表示装置。
【請求項７】
請求項５に記載のアクティブマトリクス型表示装置において、
前記データ線には、入力信号の変動幅よりも大きいＤＣ電圧をオフセット量として加算した電圧値が印加され、
前記ゲート線には、前記補助容量を通じて前記ＤＣ電圧を減算する電圧値が印加される
ことを特徴とするアクティブマトリクス型表示装置。
【発明の詳細な説明】
【技術分野】
【０００１】
本発明は、アクティブマトリクス型表示装置に関し、特に、歩留まり向上と開口率向上を実現するアクティブマトリックス型表示装置に関する。
【背景技術】
【０００２】
図１３は、従来の有機ＥＬ表示装置のある１つの画素における典型的な回路構成図である。この有機ＥＬ表示装置は、ゲート線１１、１つ前のゲート線１１ａ、データ線１２、右隣のデータ線１２ａ、電源線１３、陰極線１４、第１のＴＦＴ２１、第２のＴＦＴ２２、蓄積容量２３、およびＯＬＥＤ（Ｏｒｇａｎｉｃ  Ｌｉｇｈｔ  Ｅｍｉｔｔｉｎｇ  Ｄｉｓｐｌａｙ）素子２４で構成されている。
【０００３】
ここで、１段目を構成する第１のＴＦＴ２１は、データ線１２を通じたデータ信号を選択、保持するためのものである。また、２段目を構成する第２のＴＦＴ２２は、ＯＬＥＤ素子２４を駆動するためのものである。なお、このような基本的な２段ＴＦＴの構成に対して、駆動用の第２のＴＦＴ２２のＶｔｈ変動を補償するために、さらに、ＴＦＴが追加された回路も発明されている。
【０００４】
このような有機ＥＬ表示装置は、ゲート線１１、１１ａとデータ線１２、１２ａを交差させたアクティブマトリクス型表示装置の一種であり、蓄積容量２３の一端およびＯＬＥＤ素子２４のカソードが接続された陰極線１４を、ゲート線１１、１１ａ、データ線１２、１２ａ、電源線１３とは別に配線している（例えば、特許文献１参照）。
【０００５】
また、図１４は、従来の液晶表示装置のある１つの画素における典型的な回路構成図である。この液晶表示装置は、ゲート線１１、１つ前のゲート線１１ａ、データ線１２、右隣のデータ線１２ａ、陰極線１４、選択用ＴＦＴ３１、蓄積容量３２、および液晶素子３３で構成されている。
【０００６】
このような液晶表示装置も、ゲート線１１、１１ａとデータ線１２、１２ａを交差させたアクティブマトリクス型表示装置の一種であり、蓄積容量３２の一端および等価的に容量成分として表された液晶素子３３の一端が接続された陰極線１４を、ゲート線１１、１１ａ、データ線１２、１２ａとは別に配線している。
【０００７】
【特許文献１】国際公開Ｗ２００４／０４９２８６号パンフレット
【発明の開示】
【発明が解決しようとする課題】
【０００８】
しかしながら、従来技術には次のような課題がある。
従来のアクティブマトリックス型表示装置では、図１３、１４に示したように、ゲート線１１、１１ａ、データ線１２、１２ａとは別に、陰極線１４を設ける必要があった。この結果、配線数が多くなるため、欠陥による断線等によるパネル歩留まり低下の一因となっていた。さらに、配線数が多いことに伴って、開口率も減るというデメリットもあった。
【０００９】
特に、ＩＰＳ（Ｉｎ  Ｐｌａｎｅ  Ｓｗｉｔｃｗｉｎｇ）液晶においては、コモン線がＴＦＴ基板側にあることが必要であるため、配線数が多いことによるこのような歩留まり低下、開口率低減が問題となる。
【００１０】
本発明は上述のような課題を解決するためになされたもので、配線数を減らすことによる歩留まり向上と開口率向上を実現するアクティブマトリックス型表示装置を得ることを目的とする。
【課題を解決するための手段】
【００１１】
本発明に係るアクティブマトリックス型表示装置は、データ線とゲート線とを交差させて定義される画素ごとに、表示素子および蓄積容量を備えたアクティブマトリクス型表示装置において、それぞれの画素における表示素子および蓄積容量の一端を右隣の画素のデータ線に接続したものである。
【発明の効果】
【００１２】
本発明によれば、表示素子および蓄積容量の一端を右隣の画素のデータ線に接続し、陰極線を不要とすることにより、配線数を減らすことによる歩留まり向上と開口率向上を実現するアクティブマトリックス型表示装置を得ることができる。
【発明を実施するための最良の形態】
【００１３】
以下、本発明のアクティブマトリックス型表示装置の好適な実施の形態につき図面を用いて説明する。
【００１４】
実施の形態１．
図１は、本発明の実施の形態１における有機ＥＬ表示装置のある１つの画素における回路構成図である。この有機ＥＬ表示装置は、ゲート線１１、１つ前のゲート線１１ａ、データ線１２、右隣のデータ線１２ａ、電源線１３、第１のＴＦＴ２１、第２のＴＦＴ２２、蓄積容量２３、ＯＬＥＤ素子２４、および補助容量２５で構成されている。
【００１５】
従来構成を示した図１３の構成要素と比較すると、図１の構成要素は、陰極線１４を不要とする代わりに、補助容量２５を新たに備えている点が異なる。すなわち、図１に示した本実施の形態１における有機ＥＬ表示装置では、蓄積容量２３の一端、およびＯＬＥＤ素子２４のカソードを、陰極線１４に接続する代わりに右隣の画素のデータ線１２ａに接続することにより、陰極線１４を不要としている。
【００１６】
また、新たに追加されている補助容量２５については、図６を用いて、後に実施の形態２において詳述する。
【００１７】
次に、図２は、本発明の実施の形態１における液晶表示装置のある１つの画素における回路構成図である。この液晶表示装置は、ゲート線１１、１つ前のゲート線１１ａ、データ線１２、右隣のデータ線１２ａ、電源線１３、選択用ＴＦＴ３１、蓄積容量３２、液晶素子３３、および補助容量３４で構成されている。
【００１８】
従来構成を示した図１４の構成要素と比較すると、図２の構成要素は、陰極線１４を不要とする代わりに、補助容量３４を新たに備えている点が異なる。すなわち、図２に示した本実施の形態１における液晶表示装置では、蓄積容量３２の一端、および液晶素子３３の一端を、陰極線１４に接続する代わりに右隣の画素のデータ線１２ａに接続することにより、陰極線１４を不要としている。
【００１９】
次に、図３、図４を用いて、蓄積容量３２の一端、および液晶素子３３の一端を、陰極線１４に接続する代わりに右隣の画素のデータ線１２ａに接続することにより、従来と同様の表示を実現するための動作について説明する。以下の説明においては、図２の液晶表示装置に基づいて説明するが、図１の有機ＥＬ表示装置についても、動作原理は同様である。
【００２０】
図３は、本発明の実施の形態１における右隣の画素のデータ線１２ａを利用した接続による表示動作の説明図である。この図３に示すように、蓄積容量３２の一端を、陰極線１４ではなく右隣のデータ線１２ａに接続した場合に、蓄積容量３２に相当するＣｓに加わる電圧をＶｐ１、データ線１２、１２ａの電圧をそれぞれＶ１、Ｖ２であるとする。このとき、選択用ＴＦＴ３１がＯＮになれば、Ｖｐ１、Ｖ１、Ｖ２は、下式（１）の関係を有する。
Ｖｐ１＝Ｖ１−Ｖ２                                                    （１）
【００２１】
次に、この画素の右隣の画素において、Ｃｓに加わる電圧をＶｐ２、データ線の電圧をそれぞれＶ２、Ｖ３であるとする。このとき、選択用ＴＦＴ３１がＯＮになれば、Ｖｐ２、Ｖ２、Ｖ３は、下式（２）の関係を有する。
Ｖｐ２＝Ｖ２−Ｖ３                                                    （２）
【００２２】
同様に、さらに右側の画素について、続けていけば、ｋ番目の画素において、Ｖｐｋ、Ｖｋ、Ｖｋ＋１は、下式（３）の関係を有する。
Ｖｐｋ＝Ｖｋ−Ｖｋ＋１                                                （３）
【００２３】
これらの式を、Ｖｐｋについてｋ＝１からｎ−１まで足し合わせると、下式（４）の関係が得られる。
【００２４】
【数１】
2008158239.tif 000003
【００２５】
上式（４）をＶｎについて解くと、下式（５）となる。
【００２６】
【数２】
2008158239.tif 000004
【００２７】
従って、ｎ番目の画素の入力電圧信号Ｖｎは、１からｎ番目までの元の信号の合計をＶ１から引いたもので表すことができる。すなわち、図３に示すように、蓄積容量３２の一端を右隣のデータ線１２ａに接続した場合のそれぞれの入力電圧信号Ｖ１〜Ｖｎは、従来技術のように、蓄積容量３２の一端を陰極線１４に接続した場合の入力電圧信号（上式（１）〜（４）におけるＶｐ１〜Ｖｐｎに相当）を用いて、上式（５）の関係から求めることができる。
【００２８】
蓄積容量３２の一端を右隣のデータ線１２ａに接続した図３のような構成において、それぞれのデータ線に、上式（５）の関係を満たす入力電圧信号Ｖ１〜Ｖｎを実際に与えるための方法としては、次の２通りがある。第１の方法は、従来の入力電圧信号に相当するＶｐ１〜Ｖｐｎを、デジタル的に次々と加算していくものである。
【００２９】
また、第２の方法は、加算器を用いて、前の出力を順次加算していくものである。図４は、本発明の実施の形態１における加算器を用いた第２の方法を実現するための回路図である。このような回路を用いることにより、従来の入力電圧信号Ｖｐ１〜Ｖｐｎから、本発明の表示装置に対応する入力電圧信号Ｖ１〜Ｖｎを得ることができる。
【００３０】
しかしながら、ここで問題となるのは、正の数を加算していくと、ｎが増すにつれて出力が増大することである。そこで、加算結果の増大を防止するために、データ線の隣同士では、電圧レベルの正負を反転する。そうすれば、なめらかな画面では、平均値は、ほぼ０となり、上式（５）から求められる出力は、Ｖ１を中心に変化することとなり、出力の増大を防ぐことができる。
【００３１】
次に、図５は、本発明の実施の形態１における表示装置をＩＰＳ液晶の画素に適用した場合の具体例を示す図である。図５（ａ）は、従来の構成（図１４の回路に相当）を示しており、図５（ｂ）は、本発明の構成（図２の構成に相当）を示している。データ線の一部を表示用電極に使うことができるため、開口率が向上するメリットがある。さらに、データラインで表示部のコモン電極をつくるので、完全にコモンと配線を共通にすることができる。
【００３２】
以上のように、実施の形態１によれば、表示素子および蓄積容量の一端を右隣の画素のデータ線に接続し、陰極線を不要とすることにより、配線数を減らすことができる。この結果、歩留まり向上と開口率向上を実現するアクティブマトリックス型表示装置を得ることができる。
【００３３】
さらに、データ線を通じて印加する電圧は、データ線の隣同士で、電圧レベルの正負を反転することにより、ｎの増大に伴う電圧値の増大を防ぐことができる。
【００３４】
実施の形態２．
先の実施の形態１においては、陰極線１４を不要とする基本構成を採用し、データ線の隣同士では、電圧レベルの正負を反転することにより、ｎが増すにつれて出力が増大する問題の解決を図ったアクティブマトリックス型表示装置について説明した。次に、本実施の形態２では、この出力が増大する問題に対するさらなる改善策について説明する。
【００３５】
先の実施の形態１における基本構成を示した図３のような回路において、さらに問題となるのは、従来から液晶で見られるフリッカーパータンに対する出力信号の増大である。つまり、データ線１本おきに１、０、１、０と繰り返すパターン、またはそれに近いパターンに対しては、データ線の隣同士で電圧レベルの正負を反転しても、結果的にｎが増すにつれて出力が増大してしまうため、このような問題を改善する必要がある。
【００３６】
これは、１、−０．５、１、−０．５のような繰り返しパターンでも同様の問題があり、このような空間的に反転周期と同期して変動するパターンに弱いのである。出力本数が増えて１００本以上になると、理論的には数１００Ｖまで出力があがってしまう。
【００３７】
この対策として、もともと信号レベルにゲタをはかせておく前処理を行うことが考えられる。このような前処理は、デジタル信号の段階から加えてもよいが、ドライバＩＣのダイナミックレンジを損なわないためには、ドライバの出力に近いところでオフセットをつけることが効果的である。
【００３８】
そこで、本実施の形態２の表示装置においては、各画素単位でオフセットをつけることができるように、図１に示した補助容量２５あるいは図２に示した補助容量３４を備えている。なお、図２の液晶表示装置における補助容量３４の働きは、先の図１の有機ＥＬ表示装置における補助容量２５の働きと同様である。そこで、補助容量２５あるいは補助容量３４の働きについて、液晶表示装置を例に、図６を用いて説明する。
【００３９】
図６は、本発明の実施の形態２における補助容量の働きを示す説明図である。先の図３の構成と比較すると、この図６の構成は、選択用ＴＦＴ３１および蓄積容量３２に相当するＣｓの接続線と、１本前のゲート線１１ａとの間に接続された補助容量３４に相当するＣｃを備えている。これにより、Ｃｓには、一本前のゲート線１１ａに接続されたＣｃの働きにより、オフセットのかかった電圧が加わるので、元々の信号レベルにゲタをはかせることと同様の効果を得ることができる。
【００４０】
図６のような基本構成を有する各画素からなるアクティブマトリックス型表示装置に対して、データ全体にオフセットを与える場合には、次のようないくつかの方法がある。図７は、本発明の実施の形態２における第１の方法によるオフセット処理を示した回路図である。図７に示すように、第１の方法は、デジタル加算器４３により、デジタル的にあらかじめオフセットを与えたデータをデータドライバ４１に与えるとともに、デジタル減算器４４によりオフセットに応じた減算を施したデータに対して、Ｄ／Ａ変換器４５により変換したアナログ信号をゲートドライバ４２に与えるものである。
【００４１】
この図７に示したように、デジタル加算器４３によるオフセット量に応じて、デジタル減算器４４による減算を行うことのできる構成を有することにより、オフセットを付けない場合に対しても対応できる。また、このような構成は、単純なオフセットによる切り替えばかりでなく、例えば、表示パターンに応じてある関係式を持たせてオフセットを行うことも可能である。
【００４２】
上述した図７の回路は、データに応じてオフセットを逐次可変することができる。これに対して、オフセットを逐次可変する必要がなく、オフセット量をハード的に固定として扱う場合には、以下に示す第２の方法が現実的であり、図８〜１０を用いて説明する。
【００４３】
図８は、本発明の実施の形態２における第２の方法によるオフセット処理を行うための電源供給に関する回路図である。また、図９は、本発明の実施の形態２における第２の方法によるオフセット処理を示した回路図である。
【００４４】
図８（ａ）は、データドライバＶＲＥＦ回路の構成を示しており、回路設計に応じた可変電源および可変抵抗値を用いることにより、Ｖ１〜Ｖ９に所望の電圧を発生させることができる。より具体的には、Ｖ１およびＶ９にオフセット電圧Ｖ０分を加えることにより、ＶＲＥＦ回路の電源にオフセット量を付加することができる。
【００４５】
一方、図８（ｂ）は、ゲートドライバ電圧回路の構成を示しており、回路設計に応じた可変電源を用いることにより、ＶＧ１〜ＶＧ４に所望の電圧を発生させることができる。このようにして図８（ａ）、（ｂ）の回路による電圧値を図９の回路に用いることにより、オフセット量をハード的に固定としたアクティブマトリックス型表示装置を実現できる。
【００４６】
図１０は、本発明の実施の形態２における第２の方法によるオフセット処理を施した場合の具体的な電圧波形を示した図であり、原理的には既知の技術である。通常のゲート電圧の出力レベルとしては、通常、ＶＧ１、ＶＧ２の２値によりＯＮ／ＯＦＦ制御を行うが、ＶＧ３、ＶＧ４を含めた４値を用いることにより、この図１０に示したようなオフセットを持たせた補償駆動を行わせることが可能となる。本願発明においては、このようなゲートドライバ側の補償駆動を、データドライバ側のオフセット処理と連動して行う点を特徴としている。
【００４７】
ＶＧ３、ＶＧ４とオフセット電圧Ｖ０の関係は、下式で表すことができる。
Ｖ０＝（ＶＧ３−ＶＧ４）×Ｃｓ／Ｃａｌｌ                              （６）
上式（６）において、Ｃｓは、例えば、図２の補助容量３４に相当し、Ｃａｌｌは、図２の蓄積容量３２、液晶素子３３、および補助容量３４の各容量の合計値に相当する。そして、上式（６）のようなオフセット電圧Ｖ０を得るようにＶＧ３、ＶＧ４を調整することにより、所望のオフセット制御が可能となる。
【００４８】
図１１は、本発明の実施の形態２における第３の方法によるオフセット処理を示した回路図である。図１１に示すように、第３の方法は、一定電圧をデータドライバ４１のアナログ部に加算するとともに、ゲートドライバ４２のアナログ部に減算するものである。このようなアナログ回路によっても、オフセット機能を実現できる。
【００４９】
以上のように、実施の形態２によれば、１本前のゲート線に接続された補助容量の働きにより、蓄積容量にオフセットをかけることができる。この結果、空間的に反転周期と同期して変動するパターンに対してもｎの増大に伴う電圧値の増大を防ぐことができるアクティブマトリックス型表示装置を得ることができる。
【００５０】
なお、図１の有機ＥＬ表示装置の回路構成図におけるＯＬＥＤ素子２４の接続は、一例を示したものであり、他の接続方法とすることも可能である。図１２は、本発明における有機ＥＬ表示装置のある１つの画素における別の回路構成図である。図１２（ａ）、図１２（ｂ）のようにＯＬＥＤ素子２４を接続しても、図１の構成に基づいて説明した実施の形態１および２の効果と同様の効果を得ることができる。
【図面の簡単な説明】
【００５１】
【図１】本発明の実施の形態１における有機ＥＬ表示装置のある１つの画素における回路構成図である。
【図２】本発明の実施の形態１における液晶表示装置のある１つの画素における回路構成図である。
【図３】本発明の実施の形態１における右隣の画素のデータ線１２ａを利用した接続による表示動作の説明図である。
【図４】本発明の実施の形態１における加算器を用いた第２の方法を実現するための回路図である。
【図５】本発明の実施の形態１における表示装置をＩＰＳ液晶の画素に適用した場合の具体例を示す図である。
【図６】本発明の実施の形態２における補助容量の働きを示す説明図である。
【図７】本発明の実施の形態２における第１の方法によるオフセット処理を示した回路図である。
【図８】本発明の実施の形態２における第２の方法によるオフセット処理を行うための電源供給に関する回路図である。
【図９】本発明の実施の形態２における第２の方法によるオフセット処理を示した回路図である。
【図１０】本発明の実施の形態２における第２の方法によるオフセット処理を施した場合の具体的な電圧波形を示した図である。
【図１１】本発明の実施の形態２における第３の方法によるオフセット処理を示した回路図である。
【図１２】本発明における有機ＥＬ表示装置のある１つの画素における別の回路構成図である。
【図１３】従来の有機ＥＬ表示装置のある１つの画素における典型的な回路構成図である。
【図１４】従来の液晶表示装置のある１つの画素における典型的な回路構成図である。
【符号の説明】
【００５２】
１１  ゲート線、１１ａ  １本前のゲート線、１２  データ線、１２ａ  右隣のデータ線、１３  電源線、１４  陰極線、２１  第１のＴＦＴ、２２  第２のＴＦＴ、２３  蓄積容量、２４  ＯＬＥＤ素子、２５  補助容量、３１  選択用ＴＦＴ、３２  蓄積容量、３３  液晶素子（表示素子）、３４  補助容量、４１  データドライバ、４２  ゲートドライバ、４３  デジタル加算器、４４  デジタル減算器、４５  Ｄ／Ａ変換器。
【図１】
2008158239.tif 000005
【図２】
2008158239.tif 000006
【図３】
2008158239.tif 000007
【図４】
2008158239.tif 000008
【図５】
2008158239.tif 000009
【図６】
2008158239.tif 000010
【図７】
2008158239.tif 000011
【図８】
2008158239.tif 000012
【図９】
2008158239.tif 000013
【図１０】
2008158239.tif 000014
【図１１】
2008158239.tif 000015
【図１２】
2008158239.tif 000016
【図１３】
2008158239.tif 000017
【図１４】
2008158239.tif 000018