(57)【要約】【課題】従来は負荷分散部と出力制御部が複数のパケット処理部に直接パケット送受信を行うため、プリント配線基板等に実装する場合、基板の配線リソースを多く消費し、かつ構成が複雑で高速伝送が困難になる。【解決手段】外部からの受信パケットにヘッダ追加部が到着順シーケンスＮｏとパケットを処理済か否かの処理フラグを追加して、転送制御部とパケット処理部の組を複数組有した最前段組の転送制御部に送信し、転送制御部は、処理フラグと自身のパケット処理部稼働状態から、自身のパケット処理部か、次段転送制御部かにパケットを振り分け、次段転送制御部への送信は、処理済パケットの場合、元の受信順序に、未処理入力パケットの場合、処理済パケットの転送状態に依存せずに転送し、ヘッダ削除部が最終段転送制御部からのパケットのシーケンスＮｏと処理フラグを削除して外部に送信する。【選択図】図１
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【特許請求の範囲】
【請求項１】
接続された転送制御部とパケット処理部を一組とする複数の組と、外部からの受信パケットにパケット到着順序を示すシーケンスＮｏとパケットへの処理が実施済か否かを示す処理フラグをパケットの先頭部分に追加するヘッダ追加部と、入力されたパケットの先頭部分に追加されたシーケンスＮｏと処理フラグを削除するヘッダ削除部の各処理手段を備え、複数組の各組を構成する転送制御部が順次直列に接続され、最前段の転送制御部の前段にヘッダ追加部が、最後段の転送制御部の後段にヘッダ削除部が直列に接続され、
ヘッダ追加部は、受信パケットにシーケンスＮｏと処理フラグを追加して最前段の転送制御部に送信し、
転送制御部は、入力されたパケットの処理フラグと、自身に接続されたパケット処理部の稼働状態とから自身に接続されたパケット処理部か、次段処理手段かに入力パケットを振り分け、次段処理手段への送信は、処理済入力パケットの場合は、もとのパケットの受信順序に従い、未処理入力パケットの場合は、受信した処理済入力パケットの転送状態に依存せずに転送し、
ヘッダ削除部は、最後段の転送制御部からのパケットからシーケンスＮｏと処理フラグを削除して外部に送信する構成にされたことを特徴とする通信装置。
【発明の詳細な説明】
【技術分野】
【０００１】
この発明は、受信したパケットに対して暗号処理や認証処理等の処理を複数の処理部で行なう通信装置に関し、特にパケット単位で複数の処理部に分散処理させるための負荷分散技術に関する。
【背景技術】
【０００２】
広帯域の伝送路から受信したパケットに暗号処理等の重い処理を行なう場合、複数の処理部にパケット単位で分散処理させることにより装置全体としてのスループットを確保するとともに、パケットの転送順序を保存するための工夫が必要である。そのため、通信装置の内部では種々の負荷分散の手法が利用されている。
【０００３】
従来の通信装置では、装置内部を一つの負荷分散部、それぞれが同一の内部構成を有する複数のパケット処理部、一つの出力制御部で構成し、負荷分散部と複数のパケット処理部、また複数のパケット処理部と出力制御部は並列に接続する形態を有していた。装置外部の広帯域伝送路から受信したパケットを負荷分散部が複数のパケット処理部に順に送信し、出力制御部はパケット処理部で暗号処理等の処理が完了したパケットを順に受信する。複数のパケット処理部に送受信する際のパケットの転送順序は、負荷分散部がパケットの転送順序を示すシーケンスＮｏをパケット毎に付与し、出力制御部がこのシーケンスＮｏを基に複数のパケット処理部から順にパケットを受信することで維持していた（例えば特許文献１および特許文献２）。
【０００４】
【特許文献１】特表2005-522924号公報  第２５頁、図６
【特許文献２】特表2005-507614号公報  第２２頁、図１
【発明の開示】
【発明が解決しようとする課題】
【０００５】
従来は負荷分散部および出力制御部がいずれも複数のパケット処理部に対して直接パケットの送受信を行う集中制御方式で、パケット処理部の並列度をＮとすると、複数のパケット処理部とはそれぞれ1対Ｎの接続形態をとる。このような形態をプリント配線基板等のハードウェアに実装する場合、基板の配線リソースを多大に消費してしまう。またこれに伴い電気設計も複雑になり高速伝送が困難になる。加えて、性能向上や論理規模縮小等の理由でパケット処理部の並列度を変更する場合、負荷分散部や出力制御部に対しても変更が発生してしまうという問題点があった。
【０００６】
この発明は上記のような問題点を解決するためになされたもので、装置内部を一つのヘッダ生成部、それぞれが同一の内部構成を有する複数の転送制御部とパケット処理部、一つのヘッダ削除部で構成し、ヘッダ生成部、転送制御部とパケット処理部の複数の組、ヘッダ削除部を順に直列に並べてそれぞれを１対１に接続する形態を有し、パケットの転送順序を維持する機構を有することを特徴とする。このようにすることでプリント配線基板等のハードウェアに実装する際に配線リソースを抑制するとともに容易に高速伝送が可能な回路を構成すること、および転送制御部とパケット処理部の並列度を変更する場合でもヘッダ生成部やヘッダ削除部に対しては変更を及ぼさない回路を構成することを目的とする。
【課題を解決するための手段】
【０００７】
この発明に係る通信装置は、
転送制御部とパケット処理部が接続された組を複数組有し、この組を構成する転送制御部が順次直列に接続され、最前段の転送制御部の前段にヘッダ追加部が、最後段の転送制御部の後段にヘッダ削除部が直列に接続され
ヘッダ追加部は、外部からの受信パケットにパケット到着順序を示すシーケンスＮｏとパケットへの処理が実施済か否かを示す処理フラグをパケットの先頭部分に追加して、最前段の転送制御部に送信し、
転送制御部は、入力されたパケットの処理フラグと、自身に接続されたパケット処理部の稼働状態とから自身に接続されたパケット処理部か、転送制御部又はヘッダ削除部の次段処理手段かに入力パケットを振り分け、次段処理手段への送信は、処理済入力パケットの場合は、もとのパケットの受信順序に従って次段の処理手段に転送し、未処理入力パケットの場合は、受信した処理済入力パケットの転送状態には依存せずに転送し、
ヘッダ削除部は、最後段の転送制御部からのパケットの先頭部分に追加されたシーケンスＮｏおよび処理フラグを削除して外部に送信する構成にされる。
【発明の効果】
【０００８】
この発明によれば、ヘッダ生成部、転送制御とパケット処理部の複数の組、ヘッダ削除部を順に直列に並べてそれぞれを１対１に接続することで、パケットの転送順序を維持しつつ、プリント配線基板等のハードウェアに実装する際に配線リソースを抑制するとともに容易に高速伝送が可能な回路を構成できる。さらに転送制御部とパケット処理部の並列度を変更する場合でもヘッダ生成部やヘッダ削除部に対しては変更を及ぼさない回路が構成でき、システムの性能要件の変更に対しても柔軟に対応することができる。
【発明を実施するための最良の形態】
【０００９】
実施の形態１．
図１はこの発明の実施の形態１による通信装置を示す構成図である。１０１は、外部から受信したパケットにパケットの到着順序を示すシーケンスＮｏと暗号あるいは認証等のパケットへの処理を実施済か否かを示すフラグ（処理フラグ）をパケットの先頭部分に追加するヘッダ追加部、１０２は、受信した未処理のパケットをパケット処理部１０３に転送してパケットへの処理を実施するか、受信した処理済のパケットもしくは受信した未処理のパケットを後段の転送制御部もしくはヘッダ削除部１０４に転送するかを判断する転送制御部、１０３はパケットに暗号あるいは認証等の所定の処理を行うパケット処理部、１０４はヘッダ追加部１０１にてパケットの先頭部分に追加されたシーケンスＮｏおよび処理フラグを削除して外部に送信するヘッダ削除部である。
【００１０】
なお図１において、転送制御部１０２とパケット処理部１０３は接続されて組をなし、この組が複数のＮ個並列接続されている。また、Ｎ個のパケット処理部１０３はいずれも受信したパケットに対する処理の内容として同一の機能を提供することを想定している。従って、装置が受信した特定のパケットに対して所定の処理を実行して再び送信する間、そのパケットを受信して所定の処理を実行するパケット処理部は単一である。特定のパケットが複数の異なるパケット処理部に転送されて各々で処理されることはない。
【００１１】
図２はこの発明の実施の形態１による転送制御部１０２を示す構成図である。図において、２０１は、ヘッダ追加部１０１より受信したパケットを処理フラグとパケット処理部１０３の処理状態をもとに、パケット処理部１０３あるいは処理済中継パケットＦＩＦＯ２２１あるいは未処理中継パケットＦＩＦＯ２３１に振り分けるとともに、当該パケットのシーケンスＮｏを複製して、処理済ＳＮＦＩＦＯ２１２あるいは処理済中継ＳＮＦＩＦＯ２２２あるいは未処理中継ＳＮＦＩＦＯ２３２に振り分ける処理状態判定部である。
【００１２】
２１１は、パケット処理部１０３が所定の処理を実施したパケットを格納するＦＩＦＯ（Ｆｉｒｓｔ−Ｉｎ−Ｆｉｒｓｔ−Ｏｕｔ）構造を有する処理済パケットＦＩＦＯ、２１２は、処理済パケットＦＩＦＯ２１１に格納されるパケットのシーケンスＮｏを格納するＦＩＦＯ構造を有する処理済ＳＮＦＩＦＯ、２１３は、処理済ＳＮＦＩＦＯ２１２および処理済ＳＮフラグ２１５の状態をもとに処理済ＳＮレジスタ２１４を更新する処理済ＳＮレジスタ更新部、２１４は、処理済パケットＦＩＦＯ２１１に格納され、かつ最も先頭に位置するパケットのシーケンスＮｏを示す処理済ＳＮレジスタ、２１５は、処理済ＳＮレジスタ２１４の示す値の有効あるいは無効を示す処理済ＳＮフラグである。
【００１３】
２２１は、前段のパケット処理部１０３により所定の処理が既に実施されたパケットを格納するＦＩＦＯ構造を有する処理済中継パケットＦＩＦＯ、２２２は、処理済中継パケットＦＩＦＯ２２１に格納されるパケットのシーケンスＮｏを格納するＦＩＦＯ構造を有する処理済中継ＳＮＦＩＦＯ、２２３は、処理済中継ＳＮＦＩＦＯ２２２および処理済中継ＳＮフラグ２２５の状態をもとに処理済中継ＳＮレジスタ２２４を更新する処理済中継ＳＮレジスタ更新部、２２４は、処理済中継パケットＦＩＦＯ２２１に格納され、かつ最も先頭に位置するパケットのシーケンスＮｏを示す処理済中継ＳＮレジスタ、２２５は、処理済中継ＳＮレジスタ２２４の示す値の有効あるいは無効を示す処理済中継ＳＮフラグである。
【００１４】
２３１は、前段および当該のパケット処理部１０３で所定の処理を実施せず、さらに後段のパケット処理部１０３で処理を実施すべきパケットを格納するＦＩＦＯ構造を有する未処理中継パケットＦＩＦＯである。
２３２は、未処理中継パケットＦＩＦＯ２３１に格納されるパケットのシーケンスＮｏを格納するＦＩＦＯ構造を有する未処理中継ＳＮＦＩＦＯ、２３３は、未処理中継ＳＮＦＩＦＯ２３２および未処理中継ＳＮフラグ２３５の状態をもとに未処理中継ＳＮレジスタ２３４を更新する未処理中継ＳＮレジスタ更新部、２３４は、未処理済中継パケットＦＩＦＯ２３１を経由して転送されたパケットのシーケンスＮｏの履歴を示す未処理中継ＳＮレジスタ、２３５は、未処理中継ＳＮレジスタ２３４の示す値の有効あるいは無効を示す未処理中継ＳＮフラグである。
【００１５】
２０２は、各ＳＮレジスタ２１４、２２４、２３４、および各ＳＮフラグ２１５、２２５、２３５の状態をもとに、処理済パケットＦＩＦＯ２１１あるいは処理済中継パケットＦＩＦＯ２２１のいずれかを選択してパケットを読み出し後段の後段送信順序制御部２０４に送信する前段送信順序制御部である。
２０３は、当該の転送制御部１０２が後段の転送制御部１０２もしくはヘッダ削除部１０４に送信した、最新の処理済パケットもしくは最新の処理済中継パケットのシーケンスＮｏを示す中継カウンタ、２０４は、前段送信順序制御部２０２から受信するパケットあるいは未処理中継パケットＦＩＦＯ２３１に格納されたパケットのいずれかを選択して後段の転送制御部１０２もしくはヘッダ削除部１０４に送信する後段送信順序制御部である。
【００１６】
次に本実施の形態における通信装置の動作について説明する。
【００１７】
ヘッダ追加部１０１は、パケットを外部から受信するとそのパケットの受信順序を示すシーケンスＮｏを1から順にヘッダ部分に追加する。同様に当該パケットに対して暗号あるいは認証等のパケットへの処理を実施済か否かを後段の転送制御部１０２が判断するのに使用する処理フラグを処理未実施の状態にしてヘッダ部分に追加する。シーケンスＮｏと処理フラグをヘッダに追加後、後段（最前段）の転送制御部１０２に送信する。
【００１８】
次に転送制御部１０２は、受信したパケットの処理フラグと自己の状態に応じて以下の段落番号［００２１］〜［００３２］に記載の制御を行う。
【００１９】
処理状態判定部２０１は、第一のケースとして当該パケットの処理フラグが未実施を示していて、かつ接続されたパケット処理部１０３に処理中のパケットが存在せず新たにパケットを受信して処理が実施できる場合、当該パケットを接続されたパケット処理部１０３に送信する。これと並行して当該パケットからシーケンスＮｏを複製して処理済ＳＮＦＩＦＯ２１２に送信する。
【００２０】
処理状態判定部２０１は、第二のケースとして当該パケットの処理フラグが実施済を示している場合、当該パケットを処理済中継パケットＦＩＦＯ２２１に送信する。これと並行して当該パケットからシーケンスＮｏを複製して処理済中継ＳＮＦＩＦＯ２２２に送信する。
【００２１】
処理状態判定部２０１は、第三のケースとして当該パケットの処理フラグが未実施を示していて、かつパケット処理部１０３に処理中のパケットが存在し新たなパケットを受信して処理が実施できない場合、当該パケットを未処理中継パケットＦＩＦＯ２３１に送信する。これと並行して当該パケットからシーケンスＮｏを複製して未処理中継ＳＮＦＩＦＯ２３２に送信する。
【００２２】
パケット処理部１０３は、前記段落番号［００２１］の処理において新たにパケットを受信すると、暗号あるいは認証等のパケットに対する所定の処理を実行する。処理が完了したパケットは処理フラグを実施済に上書きして処理済パケットＦＩＦＯ２１１に送信する。
【００２３】
処理済ＳＮレジスタ更新部２１３は、対応する処理済ＳＮＦＩＦＯ２１２が空でなく、かつ対応処理済ＳＮフラグ２１５が無効の場合、処理済ＳＮＦＩＦＯ２１２からシーケンスＮｏを１エントリ読み出して対応する処理済ＳＮレジスタ２１４にその値を書き込む。次に処理済ＳＮフラグ２１５を有効に書き換える。処理済ＳＮレジスタ更新部２１３は、処理済ＳＮＦＩＦＯ２１２が空、あるいは処理済ＳＮフラグ２１５が有効の場合、それらが空でなく、かつ無効になるまで待機する。
以上の処理済ＳＮレジスタ更新部２１３の動作フローを図５に示す。
【００２４】
処理済中継ＳＮレジスタ更新部２２３は、処理済中継ＳＮＦＩＦＯ２２２および処理済中継ＳＮレジスタ２２４に対して段落番号［００２５］に記載の処理と同様の処理を行う。即ち処理済中継ＳＮＦＩＦＯ２２２が空でなく、かつ対応処理済中継ＳＮフラグ２２５が無効の場合、処理済中継ＳＮＦＩＦＯ２２２からシーケンスＮｏを１エントリ読み出して対応する処理済中継ＳＮレジスタ２２４にその値を書き込む。次に処理済中継ＳＮフラグ２２５を有効に書き換える。処理済中継ＳＮレジスタ更新部２２３は、処理済中継ＳＮＦＩＦＯ２２２が空、あるいは処理済中継ＳＮフラグ２２５が有効の場合、それらが空でなく、かつ無効になるまで待機する。
【００２５】
同じく未処理中継ＳＮレジスタ更新部２３３は、未処理中継ＳＮＦＩＦＯ２３２および未処理中継ＳＮレジスタ２３４に対して段落番号［００２５］に記載の処理と同様の処理を行う。
【００２６】
前段送信順序制御部２０２は、処理済ＳＮレジスタ２１４、処理済中継ＳＮレジスタ２２４、未処理中継ＳＮレジスタ２３４の中から、対応するＳＮフラグが有効、かつ対応するＳＮレジスタ値が中継カウンタ２０３に１を加えた値であるレジスタを検索する。検索した結果に応じて以下の段落番号［００２８］〜［００３１］に記載の処理を行う。
【００２７】
前段送信順序制御部２０２は、第一のケースとして該当するレジスタが処理済ＳＮレジスタ２１４である場合、処理済パケットＦＩＦＯ２１１から１パケットを読み出して後段送信順序制御部２０４に送信する。続いて前段送信順序制御部２０２は処理済ＳＮフラグ２１５を無効に書き換える。
【００２８】
前段送信順序制御部２０２は、第二のケースとして該当するレジスタが処理済中継ＳＮレジスタ２２４である場合、処理済中継パケットＦＩＦＯ２２１から１パケットを読み出して後段送信順序制御部２０４に送信する。続いて前段送信順序制御部２０２は処理済中継ＳＮフラグ２２５を無効に書き換える。
【００２９】
前段送信順序制御部２０２は、第三のケースとして該当するレジスタが未処理中継ＳＮレジスタ２３４である場合、未処理中継ＳＮフラグ２３５を無効に書き換える。ここで前段送信順序制御部２０２は処理済中継パケットＦＩＦＯ２３１から１パケットを読み出す制御は行わないことに注意する。
【００３０】
前段送信順序制御部２０２は、第四のケースとして該当するレジスタが存在しない場合、該当するレジスタが見つかるまで検索を継続する。
以上の前段送信順序制御部２０２による第一のケースから第四のケースにおける各動作フローを図６に示す。
【００３１】
後段送信順序制御部２０４は、前段送信順序制御部２０２から受信したパケットをヘッダ削除部１０４に転送する。同様に未処理中継パケットＦＩＦＯ２３１に格納されたパケットを読み出してヘッダ削除部１０４に転送する。ある時点で両者のパケットの転送が重なった場合、ラウンドロビンのアルゴリズム等で適当に分散して交互に読み出して送信する。
【００３２】
最後に、ヘッダ削除部１０４はシーケンスＮｏと処理フラグをヘッダ部分から削除してパケットを外部に送信する。
【００３３】
図３はこの発明の実施の形態１における通信装置の動作例１を示したタイミングチャートである。
【００３４】
ＴＩＭＥ１において、転送制御部＃１は、パケット処理部＃１が新たにパケットを処理可能であることを判別しパケット＃１をパケット処理部＃１に送信する。パケット処理部＃１はパケット＃１に対して処理の処理を開始する。
【００３５】
ＴＩＭＥ２において、転送制御部＃１は、パケット処理部＃１がパケット＃１を処理中であることを判別し、パケット＃２を未処理のまま転送制御部＃２に送信する。転送制御部＃２は、パケット処理部＃２が新たにパケットを処理可能であることを判別し、パケット＃２をパケット処理部＃２に送信する。パケット処理部＃２はパケット＃２に対して処理の処理を開始する。
【００３６】
ＴＩＭＥ３において、パケット処理部＃１はパケット＃１に対しての処理を完了しパケット＃１を転送制御部＃１に送信する。転送制御部＃１は自身の中継カウンタ２０３から次に転送すべき処理済パケットもしくは処理済中継パケットがパケット＃１であることを判別し、パケット＃１を転送制御部＃２に送信する。転送制御部＃１はパケット＃１を転送後に自身の中継カウンタ２０３に１を加える。この時点では、中継カウンタ２０３は次に転送すべき処理済パケットもしくは処理済中継パケットがパケット＃２であることを示す。更に転送制御部＃１は、自身の未処理中継ＳＮレジスタ２３４および未処理中継ＳＮフラグ２３５からパケット＃２が既に後段の転送制御部に未処理のまま転送されてしまっていることを判別し、中継カウンタ２０３に更に１を加える。これにより、転送制御部＃１の中継カウンタはパケット＃３を示すことになる。
【００３７】
ＴＩＭＥ４において、転送制御部＃２および転送制御部＃３は、パケット＃１が処理済であること、および自身の中継カウンタから次に転送すべき処理済パケットもしくは処理済中継パケットがパケット＃１であることを判別しパケット＃１を順に送信する。このとき転送制御部＃２および転送制御部＃３はパケット＃１が処理済であることからパケット処理部＃２およびパケット処理部＃３には送信せずに後段の転送制御部もしくはヘッダ削除部に転送するのみである。
【００３８】
図４はこの発明の実施の形態１における通信装置の動作例２を示したタイミングチャートである。
【００３９】
ＴＩＭＥ１１において、転送制御部＃１は、パケット処理部＃１が新たにパケットを処理可能であることを判別しパケット＃１をパケット処理部＃１に送信する。パケット処理部＃１はパケット＃１に対しての処理を開始する。  ここでパケット＃１は、後から順に転送するパケット＃２、パケット＃３、パケット＃４に対してパケット長が長く、パケット処理部でのパケットに対する処理が他のパケットよりも時間を長く要することを想定する。
【００４０】
ＴＩＭＥ１２において、転送制御部＃１は、パケット処理部＃１がパケット＃１を処理中であることを判別し、パケット＃３を未処理のまま転送制御部＃２に送信する。転送制御部＃２も同様にパケット＃３を未処理のまま転送制御部＃３に送信する。転送制御部＃３は、パケット処理部＃３が新たにパケットを処理可能であることを判別し、パケット＃３をパケット処理部＃３に送信する。パケット処理部＃３はパケット＃３に対して処理の処理を開始する。
【００４１】
ＴＩＭＥ１３において、パケット処理部＃２はパケット＃２に対しての処理を完了しパケット＃２を転送制御部＃２に送信する。転送制御部＃２は自身の中継カウンタから次に転送すべき処理済パケットもしくは処理済中継パケットがパケット＃１であることを判別しパケット＃２を転送せずに自身の処理済パケットＦＩＦＯ２１１に保持する。
【００４２】
ＴＩＭＥ１４において、パケット処理部＃１はパケット＃１に対しての処理を完了し転送制御部＃１にパケット＃１を送信する。転送制御部＃１は自身の中継カウンタ２０３から次に転送すべき処理済パケットもしくは処理済中継パケットがパケット＃１であることを判別しパケット＃１を転送制御部＃２に送信する。
【００４３】
ＴＩＭＥ１５において、転送制御部＃２はパケット＃１が処理済であること、および自身の中継カウンタ２０３から次に転送すべき処理済パケットもしくは処理済中継パケットがパケット＃１であることを判別しパケット＃１を転送制御部＃３に送信する。ここで転送制御部＃２はパケット＃１送信後に自身の中継カウンタ２０３に１を加える。
【００４４】
ＴＩＭＥ１６において、転送制御部＃２は自身の中継カウンタ２０３から次に転送すべき処理済パケットもしくは処理済中継パケットがパケット＃２であることを判別し自身の処理済パケットＦＩＦＯ２１１に保持していたパケット＃２を読み出し転送制御部＃３に送信する。
【産業上の利用可能性】
【００４５】
この発明は、パケットに暗号処理や認証処理等の処理を複数の処理部にパケット単位で分散処理させる情報通信システムに適用され、パケットの転送順序を維持しつつ配線リソースを抑制し、高速伝送が可能な回路を構成できる。
【図面の簡単な説明】
【００４６】
【図１】この発明の実施の形態１による通信装置を示す構成図である。
【図２】この発明の実施の形態１による転送制御部を示す構成図である。
【図３】この発明の実施の形態１における通信装置の動作例１を示したタイミングチャートである。
【図４】この発明の実施の形態１における通信装置の動作例２を示したタイミングチャートである。
【図５】処理済ＳＮレジスタ更新部の動作を示すフローチャートである。
【図６】前段送信順序制御部の動作を示すフローチャートである。
【符号の説明】
【００４７】
１０１；ヘッダ追加部、１０２；転送制御部、１０３；パケット処理部、１０４；ヘッダ削除部、２０１；処理状態判定部、２０２；前段送信順序制御部、２０３；中継カウンタ、２０４；後段送信順序制御部、２１１；処理済パケットＦＩＦＯ、２１２；処理済ＳＮＦＩＦＯ、２１３；処理済ＳＮレジスタ更新部、２１４；処理済ＳＮレジスタ、２１５；処理済ＳＮフラグ、２２１；処理済中継パケットＦＩＦＯ、２２２；処理済中継ＳＮＦＩＦＯ、２２３；処理済中継ＳＮレジスタ更新部、２２４；処理済中継ＳＮレジスタ、２２５；処理済中継ＳＮフラグ、２３１；未処理中継パケットＦＩＦＯ、２３２；未処理中継ＳＮＦＩＦＯ、２３３；未処理中継ＳＮレジスタ更新部、２３４；未処理中継ＳＮレジスタ、２３５；未処理中継ＳＮフラグ。
【図１】
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【図２】
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【図３】
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【図４】
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【図５】
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【図６】
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