(57)【要約】【課題】  従来のドライバ回路では、ＣＭＬ回路の出力振幅や中点電圧等の出力電圧を制御することが困難であった。さらに、従来のドライバ回路では、ＣＭＬ回路における出力電圧のハイレベルが電源電圧からドロップしていた。【解決手段】  ドライバ回路は、差動入力信号の振幅を変換して差動出力信号を出力する振幅変換部と、前記差動出力信号の振幅を設定する振幅設定部と、前記差動出力信号の振幅の中心値を設定するコモン電圧設定部とを有する。【選択図】  図１
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【特許請求の範囲】
【請求項１】
差動入力信号の振幅を変換して差動出力信号を出力する振幅変換部と、
前記差動出力信号の振幅を設定する振幅設定部と、
前記差動出力信号の振幅の中心値を設定するコモン電圧設定部とを有するドライバ回路。
【請求項２】
前記振幅設定部は、第１の電圧を生成する第１の電圧生成部と第１の抵抗を有し、
前記第１の抵抗及び前記第１の電圧に基づいて前記差動出力信号の振幅を制御する第１の電流を生成することを特徴とする請求項１に記載のドライバ回路。
【請求項３】
前記振幅設定部は、前記第１の電圧を変化させることで前記振幅変換部が出力する前記差動出力信号の振幅を変化させることを特徴とする請求項２に記載のドライバ回路。
【請求項４】
前記振幅設定部は、非反転入力端子に前記第１の電圧が接続され、反転入力端子に前記第１の抵抗が接続された第１の演算増幅器を有することを特徴とする請求項２に記載のドライバ回路。
【請求項５】
前記コモン電圧設定部は、第２の電圧を生成する第２の電圧生成部と第２の抵抗を有し、
前記第２の抵抗及び前記第２の電圧に基づいて前記差動出力信号の振幅の中心を制御する前記第２の電流を生成することを特徴とする請求項１乃至４のいずれか一項に記載のドライバ回路。
【請求項６】
前記コモン電圧設定部は、前記第２の電圧を変化させることで前記振幅変換部が出力する前記差動出力信号の振幅の中心値を変化させることを特徴とする請求項５に記載のドライバ回路。
【請求項７】
前記コモン電圧設定部は、非反転入力端子に前記第２の電圧が接続され、反転入力端子に前記第２の抵抗に接続された第２の演算増幅器を有することを特徴とする請求項５あるいは６に記載のドライバ回路。
【請求項８】
前記コモン電圧設定部は、前記第１の電流を生じる第１の電流源と前記第２の電流を生じる第２の電流源を有し、
前記第２の抵抗に対し前記第１の電流源及び前記第２の電流源を介し電流を流すことを特徴とする請求項５乃至７のいずれか１項に記載のドライバ回路。
【請求項９】
差動入力信号の振幅を変換して差動出力信号を出力する電圧変換方法であって、
第１の電流に基づいて前記差動出力信号の振幅を設定し、
第２の電流に基づいて前記差動出力信号の振幅の中心値を設定し、
前記第１の電流は、前記差動出力信号の振幅に相当する第１の所定電圧に基づいて生成され
前記第２の電流は、接地電位と第２の所定電圧との電圧差に基づいて生成されるドライバ回路の制御方法。
【請求項１０】
前記第１の電流あるいは前記第２の電流を変化させることで前記差動出力信号の振幅の中心値を一定に設定するドライバ回路の制御方法。
【発明の詳細な説明】
【技術分野】
【０００１】
本発明は、ドライバ回路に関し、特にＣＭＬ回路と電流設定回路を有するドライバ回路に関する。
【背景技術】
【０００２】
従来から、異なるシステム間において、システム間の信号を変換するためのインターフェース回路としてドライバ回路が用いられている。ドライバ回路は、差動入力信号の振幅を変換して差動信号を出力する回路である。従来のドライバ回路は、例えば特許文献１あるいは２に記載されている。図４は、特許文献１に記載のドライバ回路を示す図である。
【０００３】
特許文献１に記載のドライバ回路は、負荷Ｒ１、Ｒ２、スイッチ用のトランジスタＭ１、Ｍ２及び電圧制御電流源ＣＳ１によって構成されているＣＭＬ（Ｃｕｒｒｅｎｔ  Ｍｏｄｅ  Ｌｏｇｉｃ）回路１０を有している。また、電流を供給するためのレベルシフト回路１がＣＭＬ回路１０に接続されている。この場合、ＣＭＬ回路１０は、レベルシフト回路１によって生成される電流をＣＭＬ回路１０へ供給することによって、出力端ＯＵＴ及びＯＵＴＢによって出力される出力電圧の振幅を調整している。
【０００４】
また図５は、負荷Ｒ１、Ｒ２、スイッチ用のトランジスタＭ１、Ｍ２及び電圧制御電流源ＣＳ１によって構成されている従来のＣＭＬ回路１０を示す図である。この場合、ＣＭＬ回路１０が出力する出力のハイレベルは少なくとも電源電圧ＶＤＤからＲ５×Ｉｄ分ドロップする。
【０００５】
しかしながら、特許文献１に記載のドライバ回路では、レベルシフト回路１がＣＭＬ回路１０に供給する電流値の設定方法について、何ら記載されておらず、具体的にどのように振幅を決定するかは不明である。また、特許文献２に記載のドライバ回路では、ＣＭＬ回路１０における出力電圧のハイレベルが電源電圧からドロップしていた。
【特許文献１】特開２００４−３５０２７２号公報
【特許文献２】米国特許第６４２９７００号公報
【発明の開示】
【発明が解決しようとする課題】
【０００６】
上記したように、従来のドライバ回路では、ＣＭＬ回路の出力電圧を制御することが困難であった。
【課題を解決するための手段】
【０００７】
本発明にかかるドライバ回路は、差動入力信号の振幅を変換して差動出力信号を出力する振幅変換部と、前記差動出力信号の振幅を設定する振幅設定部と、前記差動出力信号の振幅の中心値を設定するコモン電圧設定部とを有する。
【０００８】
本発明のドライバ回路によれば、ＣＭＬ回路によって出力される電圧振幅及びコモン電圧（中点電圧）を制御することが可能である。
【発明の効果】
【０００９】
本発明のドライバ回路によれば、出力電圧を高い精度で制御することが可能となる。
【発明を実施するための最良の形態】
【００１０】
実施の形態１
以下、図面を参照して本発明の実施の形態について説明する。図１は、本発明の実施の形態１に関わるドライバ回路１００を示すブロック図である。図１に示すように、本実施の形態のドライバ回路１００は、振幅変換部（以降、ＣＭＬ回路１０と称す）、振幅設定部（以降、振幅電流設定回路２０と称す）、コモン電圧設定部（以降、コモン電流設定回路３０と称す）を有している。なお、各ブロックの詳細な構成については後述する。
【００１１】
ＣＭＬ回路１０は、入力される差動信号入力を変換して、差動信号をレシーバへ出力する回路である。振幅電流設定回路２０は、ドライバ回路１０によって出力される電圧の振幅を制御するための回路である。また、コモン電流設定回路３０は、ドライバ回路１０によって出力される電圧の最大値と最小値の中点であるコモン電圧（中点電圧）を制御するための回路である。
【００１２】
ＣＭＬ回路１０は、第１、第２の負荷（以降、抵抗Ｒ１、Ｒ２とする）、第１、第２のトランジスタＭ１、Ｍ２、電源電圧端子ＶＤＤ、第１〜第３の電圧制御電流源（以下、電流源と称す）ＣＳ１〜ＣＳ３、入力端ＩＮ、ＩＮＢ、出力端ＯＵＴ、ＯＵＴＢを有している。抵抗Ｒ１及びＲ２の一端は電源電圧端子ＶＤＤに共通接続されている。また、抵抗Ｒ１の他端は出力端ＯＵＴＢに接続され、抵抗Ｒ２の他端は出力端ＯＵＴに接続されている。また、第１のトランジスタＭ１及び第２のトランジスタＭ２は第１の電流源ＣＳ１のドレインに共通接続されている。また、トランジスタＭ１は出力ＯＵＴＢに接続され、トランジスタＭ２は出力ＯＵＴに接続されている。さらにトランジスタＭ１及びトランジスタＭ２のゲートにはそれぞれ入力端ＩＮ、ＩＮＢが接続されている。
【００１３】
また、第２の電流源ＣＳ２のドレインは出力端ＯＵＴＢに接続され、第３の電流源ＣＳ３のドレインは、出力端ＯＵＴに接続されている。なお、図１に示すＣＭＬ回路１０では、第２の電流源ＣＳ２は出力端ＯＵＴＢと抵抗Ｒ１との間に接続され、第３の電流源ＣＳ３は出力端ＯＵＴと抵抗Ｒ２の間に接続されているが、本発明の実施の形態における回路と等価であるため特に問題はない。また、第１〜第３の電流源ＣＳ１〜ＣＳ３はそれぞれ接地電位に接続されている。
【００１４】
振幅電流設定回路２０は、第３の負荷（以降、抵抗Ｒ３とする）、第４の電圧制御電流源（以下、電流源と称す）ＣＳ４、第１のオペアンプＡＭＰ１、電源電圧端子ＶＤＤ、第１の電圧生成部（以降、電圧生成部ｖｏｄと称す）を有している。第３の抵抗Ｒ３の一端は電源電圧端子ＶＤＤに接続され、他端は第４の電流源ＣＳ４のドレインに接続されている。また、電流源ＣＳ４のソースは接地電位に接続されている。また第１のオペアンプＡＭＰ１の反転入力端子には抵抗Ｒ３と電流源ＣＳ４との間のノードｎ１が接続され、非反転入力端子には電圧生成部ｖｏｄを介して電源電圧ＶＤＤに接続されている。さらに電流源ＣＳ４は、オペアンプＡＭＰ１の出力によって制御されている。
【００１５】
コモン電流設定回路３０は、第４の負荷（以降、抵抗Ｒ４とする）、第５、第６及び第７の電圧制御電流源（以下、電流源と称す）ＣＳ５、ＣＳ６、ＣＳ７、第２のオペアンプＡＭＰ２、電源電圧端子ＶＤＤ、第２の電圧生成部（以降、電圧生成部ｖｏｓと称す）を有している。第４の抵抗Ｒ４の一端は電源電圧端子ＶＤＤに接続され、他端は第６の電流源ＣＳ６及び第７の電流源ＣＳ７のドレインに接続されている。また、電流源ＣＳ６及び電流源ＣＳ７のソースは接地電位に接続されている。また、第２のオペアンプＡＭＰ２の反転入力端子には抵抗Ｒ４と電流源ＣＳ６との間のノードｎ２が接続され、非反転入力端子は電圧生成部ｖｏｓを介して接地電位に接続されている。さらに、電流源ＣＳ６及び電流源ＣＳ７は、オペアンプＡＭＰ２の出力部による出力によって制御されている。また、電流源ＣＳ５は抵抗Ｒ４と電流源ＣＳ６との間のノードｎ２と接地電位との間に接続され、振幅電流設定回路２０におけるオペアンプＡＭＰ１の出力部による出力によって制御されている。
【００１６】
また、電流源ＣＳ１、ＣＳ４及びＣＳ５のゲートは第１のオペアンプＡＭＰ１の出力部に共通に接続されている。そして、電流源ＣＳ２、ＣＳ３、ＣＳ６及びＣＳ７のゲートは第２のオペアンプＡＭＰ２の出力部に共通に接続されている。この場合、電流源ＣＳ１、ＣＳ４及びＣＳ５は、実質的に同一サイズのトランジスタであり、電流源ＣＳ２、ＣＳ３、ＣＳ６及びＣＳ７もまた実質的に同一サイズのトランジスタである。以下、図１を参照して本実施の形態のドライバ回路１００の詳細な動作について説明する。
【００１７】
ここで、抵抗Ｒ１、Ｒ２及びＲ３の抵抗値をそれぞれＲとし、Ｒ４の抵抗値をＲ／２とする。また、電流源ＣＳ１、ＣＳ４及びＣＳ５に生じる電流をＩｄとし、電流源ＣＳ２、ＣＳ３、ＣＳ６及びＣＳ７に生じる電流をＩｓとする。またトランジスタＭ１及びＭ２は、同一特性を有しており、入力端ＩＮ及びＩＮＢによって入力される"Ｈ"あるいは"Ｌ"レベルの入力信号に基づいてオンあるいはオフ状態に制御されるものとする。
【００１８】
まず、トランジスタＭ１がオン状態でトランジスタＭ２がオフ状態である場合について説明する。この場合、抵抗Ｒ１には電流源ＣＳ１による電圧降下（Ｉｄ×Ｒ）が発生するが、抵抗Ｒ２には電流源ＣＳ１による電圧降下は発生しない。なお、トランジスタＭ１及びトランジスタＭ２には、それぞれ電流源ＣＳ２、ＣＳ３による電圧降下（Ｉｓ×Ｒ）は発生している。従って、電流源ＣＳ２及びＣＳ３に生じる電流Ｉｓに関わらず、出力ＯＵＴからは"Ｈ"レベル（出力振幅の最大値）が出力され、出力ＯＵＴＢからは"Ｌ"レベル（出力振幅の最小値）が出力される。よって、出力される電圧の振幅をＶａとすると、Ｖａ（出力振幅の最大値−出力振幅の最小値）は電圧降下（Ｉｄ×Ｒ）分であることが確認できる。
【００１９】
ここで、振幅電流設定回路２０によって電流源ＣＳ１の制御を行う。振幅電流設定回路２０では、オペアンプＡＭＰ１において非反転入力端子及び反転入力端子に入力される電圧が仮想短絡されている。また、抵抗Ｒ３に生じる電圧降下はＲ×Ｉｄであるため、電源電圧ＶＤＤ−電圧生成部ｖｏｄ＝電源電圧ＶＤＤ−（Ｒ×Ｉｄ）が成立する。つまり、電圧生成部ｖｏｄ＝Ｒ×Ｉｄとなる。ここで、電流源ＣＳ４と電流源ＣＳ１に流れる電流は等しいため、電流源ＣＳ１に流れる電流もまたＩｄとなる。つまり、振幅電流設定回路２０内部の電圧生成部ｖｏｄの変化に応じて電流源ＣＳ１の電流Ｉｄは変化する。そして、電流源ＣＳ１の電流Ｉｄの変化に応じて電圧生成部１０の出力端ＯＵＴ及びＯＵＴＢによって出力される電圧の振幅Ｖａは変化する。例えば、振幅電流設定回路内の電圧生成部に設定された電圧ｖｏｄを大きくし、それに伴って電流源ＣＳ１に流れる電流Ｉｄが増加すると、ＣＭＬ回路１０によって出力される出力電圧の振幅Ｖａを増加させることが可能である。従って、振幅電流設定回路２０内部を変化させることによって、ＣＭＬ回路１０が出力する信号の出力振幅Ｖａを変化させることが可能となる。なお、振幅電流設定回路内の電圧生成部ｖｏｄは、バンドギャップジェネレータを用いることによって正確な値を容易に発生させることが可能である。
【００２０】
つまり、振幅電流設定回路内部の抵抗Ｒ３とＣＭＬ回路内部の抵抗Ｒ１、Ｒ２の抵抗値を等しく設定し、さらに振幅電流設定回路２０内部において、電圧生成部に設定された電圧ｖｏｄが抵抗Ｒ３に生じる電圧降下Ｒ×Ｉｄと等しくなるように構成することによって、電圧生成回路に設定された電圧ｖｏｄ＝Ｖａ（ＣＭＬ回路１０が出力する信号の電圧振幅）とすることが可能となる。よって、ＣＭＬ回路の出力振幅Ｖａ＝ｖｏｄ（電圧生成部によって設定された電圧）である。
【００２１】
このように、トランジスタＭ１がオン状態でトランジスタＭ２がオフ状態である場合、振幅電流設定回路２０に設定された電圧ｖｏｄをＣＭＬ回路１０によって出力される出力電圧の振幅Ｖａとするが、このとき電流源ＣＳ２及び電流源ＣＳ３に設定される電流Ｉｓに基づいてＣＭＬ回路１０の出力電圧の振幅Ｖａの中心値（コモンレベル）を適宜設定することが可能である。なお、ＣＭＬ回路１０の出力電圧の振幅Ｖａのコモンレベルは（出力ＯＵＴの出力レベル＋出力ＯＵＴＢの出力レベル）／２である。つまり、電流源ＣＳ２及び電流源ＣＳ３に設定される電流Ｉｓを変化させることによって、ＣＭＬ回路によって出力される出力電圧の振幅Ｖａのコモンレベルの大小を制御することが可能である。なお、電流源ＣＳ２及び電流源ＣＳ３に設定する電流Ｉｓの生成方法の詳細については後述する。
【００２２】
以上のように、出力ＯＵＴと出力ＯＵＴＢに出力される電圧の振幅Ｖａについては、振幅電流設定回路内部に電圧生成部ｖｏｄを設け、電流源ＣＳ１及びＣＳ４に流れる電流Ｉｄを変化させることによって、ＣＭＬ回路によって出力される出力電圧の振幅Ｖａの大小を制御することが可能となる。また、電流源ＣＳ２及びＣＳ３に流れる電流Ｉｓを変化させることによって、ＣＭＬ回路によって出力される出力電圧の振幅Ｖａのコモンレベルを制御することが可能となる。
【００２３】
また、トランジスタＭ１がオフ状態でトランジスタＭ２がオン状態である場合は、抵抗Ｒ２には電流源ＣＳ１による電圧降下（Ｉｄ×Ｒ）が発生するが、抵抗Ｒ１には電圧降下は発生しない。従って、出力ＯＵＴからは"Ｌ"レベル（出力電圧の振幅の最小値）が出力され、出力ＯＵＴＢからは"Ｈ"レベル（出力電圧の振幅の最大値）が出力される。しかしながら、電圧の振幅Ｖａ（出力電圧の振幅の最大値−出力電圧の振幅の最小値）を振幅電流設定回路２０内部の電圧ｖｏｄを変化させることによって制御していることに関しては、トランジスタＭ１がオン状態でトランジスタＭ２がオフ状態である場合と同一であるためその詳細な説明を省略する。またこの場合においても、電流源ＣＳ２及び電流源ＣＳ３に設定される電流Ｉｓに基づいてＣＭＬ回路１０の出力電圧の振幅Ｖａの中心値（コモンレベル）を適宜設定することが可能である。つまり、電流源ＣＳ２及び電流源ＣＳ３に設定される電流Ｉｓを変化させることによって、ＣＭＬ回路によって出力される出力電圧の振幅Ｖａのコモンレベルの大小を制御することが可能である。
【００２４】
次に、トランジスタＭ１及びトランジスタＭ２がオン状態である場合について説明する。この場合、抵抗Ｒ１とＲ２は並列に接続されているため、抵抗Ｒ１及びＲ２に流れる電流は等しい。よって、出力ＯＵＴと出力ＯＵＴＢの出力レベルは等しくなる。このとき、抵抗Ｒ１あるいはＲ２に流れる電流はそれぞれ（Ｉｄ＋２Ｉｓ）／２である。したがって、出力ＯＵＴあるいは出力ＯＵＴＢの出力レベルＶｂは電源電圧ＶＤＤ−Ｒ（Ｉｄ＋２Ｉｓ）／２である。
【００２５】
ここで、コモン電流設定回路３０によって、電流源ＣＳ２及びＣＳ３の制御を行う。コモン電流設定回路３０では、非反転入力端子及び反転入力端子に入力される電圧が仮想短絡されている。また、抵抗Ｒ４の抵抗値はＲ／２であるため、Ｒ４に生じる電圧降下は（Ｉｄ＋２Ｉｓ）Ｒ／２である。従って、電圧生成部ｖｏｓ＝電源電圧ＶＤＤ−Ｒ（Ｉｄ＋２Ｉｓ）／２が成立する。また、電流源ＣＳ６及び電流源ＣＳ７のそれぞれに流れる第２の電流（以降、電流Ｉｓと称す）は、電流源ＣＳ２及び電流源ＣＳ３にそれぞれ電流Ｉｓずつ供給される。つまり、電流源ＣＳ２及びＣＳ３と電流源ＣＳ６及びＣＳ７に流れる電流は等しくなるため、電流源ＣＳ２及びＣＳ３に流れる電流もそれぞれＩｓとなる。つまり、コモン電流設定回路３０内部の電圧生成部ｖｏｓの変化に応じて電流源ＣＳ２あるいはＣＳ３の電流Ｉｓは変化する。そして、電流源ＣＳ２あるいはＣＳ３に流れる電流Ｉｓの変化に応じて、ＣＭＬ回路１０の出力端ＯＵＴ及びＯＵＴＢの出力レベルＶｂは変化する。例えば、コモン電流設定回路３０内の電圧生成部ｖｏｓを大きくし、それに伴って、電流源ＣＳ２及びＣＳ３に流れる電流Ｉｓが減少することによって、ＣＭＬ回路１０によって出力される電圧Ｖｂを増加させることが可能である。つまり、コモン電流設定回路３０内部の電圧ｖｏｓを変化させることによって、ＣＭＬ回路１０が出力する信号のコモン電圧Ｖｂを変化させることが可能となる。なお、コモン電流設定回路３０内部の電圧ｖｏｓは、バンドギャップジェネレータを用いることによって、正確な値を容易に発生させることが可能である。
【００２６】
つまり、本実施の形態におけるドライバ回路では、コモン電流設定回路３０内部の抵抗Ｒ４をＣＭＬ回路内部の抵抗Ｒ１、Ｒ２の抵抗値の半分に設定し、さらにコモン電流設定回路３０内部において、コモン電流設定回路３０に設定された電圧ｖｏｓが電源電圧ＶＤＤ−Ｒ（Ｉｄ＋２Ｉｓ）／２と等しくなるような構成をとることによって、コモン電流設定回路に設定された電圧ｖｏｓ＝Ｖｂ（ＣＭＬ回路１０が出力するコモン電圧）とすることが可能となる。よって、ＣＭＬ回路１０によって出力されるコモン電圧Ｖｂ＝ｖｏｓ（電圧生成部によって設定された電圧）となる。
【００２７】
また、以上のようにコモン電流設定回路３０においてＣＭＬ回路１０によって出力されるコモン電圧を設定する場合、コモン電流設定回路３０に設定された電圧ｖｏｓを一定とし、さらに電流源ＣＳ２及びＣＳ３に流れる電流Ｉｓを変化させることによって、ＣＭＬ回路１０によって出力されるコモン電圧Ｖｂは電源電圧ＶＤＤに依存せずに、一定のレベルの値をとることが可能である。
【００２８】
以上のように、出力ＯＵＴ及び出力ＯＵＴＢに出力される電圧のコモン電圧Ｖｂについては、コモン電流設定回路内部に電圧生成部ｖｏｓを設け、電流源ＣＳ２及びＣＳ３に流れる電流Ｉｓを変化させることによって、コモン電圧Ｖｂを制御することが可能となる。
【００２９】
以上、ＣＭＬ回路１０内部に設けた電流源ＣＳ１、ＣＳ２及びＣＳ３を振幅電流設定回路２０及びコモン電流設定回路３０によって制御することによって、ＣＭＬ回路１０によって出力される電圧の振幅Ｖａ及びコモン電圧Ｖｂを制御することが可能である。
【００３０】
また、図２に本実施の形態のドライバ回路１００に示すＣＭＬ回路１０の電源電圧ＶＤＤに対する出力レベルの値についての図を示す。図１に示す本実施の形態のドライバ回路１００では、従来技術（図５参照）に示した抵抗Ｒ５に相当する抵抗をなくしている。従って、従来におけるドライバ出力のハイレベルは、少なくとも電源電圧ＶＤＤからＲ５×Ｉｄ分ドロップしていたが、本実施の形態におけるドライバ回路では抵抗Ｒ５に基づく電圧降下が生じることはない。よって、従来よりも低い電源電圧で所望の出力レベルを確保することが可能となる（図２、図６参照）。
【００３１】
実施の形態２
図３は、本実施の形態２のドライバ回路を示す図である。なお、図３において、図１と共通する構成に関しては、同一の符号を付し、その詳細な説明を省略する。図３に示すドライバ回路では、図１に示した構成に、抵抗値制御回路２が追加されている。
【００３２】
抵抗値制御回路２は、ＣＭＬ回路１０の抵抗Ｒｘ１、Ｒｘ２、振幅電流設定回路２０の抵抗Ｒｘ４、コモン電流設定回路３０の抵抗Ｒｘ５の抵抗値を適宜変更することが可能な回路である。この場合、それぞれの抵抗Ｒｘ１〜Ｒｘ５は、ＭＯＳトランジスタによって構成されており、ゲートに印加する電圧を変更させることによって抵抗値を変更している。
【００３３】
このように、ＣＭＬ回路１０の出力インピーダンス、振幅電流設定回路２０及びコモン電流設定回路３０内部のインピーダンスを同時に制御することによって、ドライバ回路１００の出力インピーダンスと出力負荷の特性インピーダンスの整合が可能になる。
【００３４】
以上、本発明の実施の形態では、ＣＭＬ回路１０内部に設けた電流源ＣＳ１、ＣＳ２及びＣＳ３を振幅電流設定回路２０及びコモン電流設定回路３０によって制御することによって、ＣＭＬ回路１０によって出力される電圧振幅Ｖａ及びコモン電圧（中点電圧）Ｖｂを制御することが可能である。また、ドライバの出力インピーダンス、振幅電流設定回路２０及び、コモン電流設定回路３０内部のインピーダンスを同時に制御することによって、ドライバの出力インピーダンスと出力負荷の特性インピーダンスの整合が可能になる。
【００３５】
以上、本発明の実施の形態について詳細に説明したが、本発明の趣旨を逸脱しない限り種々の変形が可能である。
【図面の簡単な説明】
【００３６】
【図１】実施の形態１にかかるドライバ回路１００を示す図である。
【図２】実施の形態１にかかるドライバ回路１００の電源電圧に基づいた出力レベルの変化を示す図である。
【図３】実施の形態２にかかるドライバ回路２００を示す図である。
【図４】従来のドライバ回路を示す図である。
【図５】従来のドライバ回路を示す図である。
【図６】従来のドライバ回路の電源電圧に基づいた出力レベルの変化を示す図である。
【符号の説明】
【００３７】
Ｒ１〜Ｒ５          抵抗
Ｍ１、Ｍ２          トランジスタ
ＣＳ１〜ＣＳ７      電圧制御電流源
ＡＭＰ１、ＡＭＰ２  オペアンプ
ＶＤＤ              電源電圧端子
ｖｏｄ  ｖｏｓ      電圧生成部による電圧
ＩＮ、ＩＮＢ        入力端
ＯＵＴ、ＯＵＴＢ    出力端
１                  レベルシフト回路
２                  抵抗値制御回路
１０                ＣＭＬ回路
２０                振幅電流設定回路
３０                コモン電流設定回路
１００、２００      ドライバ回路
【図１】
2008072234.tif 000003
【図２】
2008072234.tif 000004
【図３】
2008072234.tif 000005
【図４】
2008072234.tif 000006
【図５】
2008072234.tif 000007
【図６】
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