(57)【要約】【課題】電子放出部を備えた表示装置において、画素が短絡した場合に、隣接画素に短絡した影響が波及して、隣接画素の輝度が低下していた。【解決手段】通常の動作状態では、走査線１２から上部電極１４のコンタクト抵抗Ｒcontを介して、電子放出部１３に走査パルスが印加される。このとき、選択された走査線１２に接続された全ての電子放出部１３に、同時に正の選択パルスが印加されるため、上部電極１４の隣接抵抗Ｒcont-nは動作に影響を与えない。いずれかの電子放出部１３が短絡すると、短絡画素の影響で、隣接画素に印加される電圧が抵抗分割され、隣接画素に印加されるべき電圧が低下してしまう。したがって、コンタクト抵抗Ｒcontと隣接抵抗Ｒcont-nと比をＲcont-n／Ｒcont≧２b−１（ｂは中間調ビット数）とすることで、隣接画素の輝度低下を抑えることができる。【選択図】図２
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【特許請求の範囲】
【請求項１】
複数のデータ線と、このデータ線と交差する複数の走査線と、この走査線とデータ線との交差部にマトリクス状に配置された画素とを備えた画像表示装置において、
前記画素は、データ線を下部電極とし、データ線上に形成された絶縁層と、この絶縁層上に形成され、走査線上に亘って、画素を覆うように形成された上部電極とを備え、
前記上部電極における走査線と画素とのコンタクト抵抗Ｒcontと、上部電極における隣接画素間の隣接抵抗Ｒcont-nとの比を、Ｒcont-n／Ｒcont≧２b−１（ｂは中間調ビット数）とすることを特徴とする画像表示装置。
【請求項２】
前記上部電極は、走査線より幅広に形成されていることを特徴とする請求項１に記載の画像表示装置。
【発明の詳細な説明】
【技術分野】
【０００１】
本発明は、画素としてＭＩＭ型の電子放出部を備えた画像表示装置に関し、特に、画素欠陥の影響を抑えた表示装置に関する。
【背景技術】
【０００２】
ＭＩＭ（Metal-Insulator-Metal）型の電子放出部を備えた画像表示装置において、上部電極を自己整合で分離して画素分離を行うものが、下記特許文献１に記載されている。この文献において、上部電極の抵抗値については検討されていない。
【特許文献１】特開２００４−３６３０７５号公報
【発明の開示】
【発明が解決しようとする課題】
【０００３】
画素としてＭＩＭ型の電子放出部を備えた表示装置において、画素が短絡した場合に、上部電極の構成上、短絡した影響が隣接画素に波及して、隣接画素の輝度が低下していた。
【課題を解決するための手段】
【０００４】
本発明は、中間調ビット数をｂとしたときに、走査線と画素（電子放出部）とのコンタクト抵抗Ｒcontと、この画素に隣接する隣接画素間の隣接抵抗Ｒcont-nとの比を、Ｒcont-n／Ｒcont≧２b−１とすることを特徴とする。なお、コンタクト抵抗Ｒcontと隣接抵抗Ｒcont-nは上部電極の抵抗値である。
【発明の効果】
【０００５】
本発明によれば、何らかの原因で、画素に欠損が生じた場合でも、画素欠陥となるものの、隣接画素に与える影響を抑えることができるので、重大な不良とはならない。したがって、画像表示装置の歩留まりを向上することができ、また、隣接画素の輝度の低下を抑えることができる。
【発明を実施するための最良の形態】
【０００６】
以下、図面を用いて、本発明の実施例を説明する。
【実施例１】
【０００７】
図１は、本発明に係る表示装置の概略図である。図１において、カソード基板１０上に形成された複数のデータ線１１と、このデータ線１１上に絶縁層を介して、データ線１１と交差する複数の走査線１２とが形成されている。データ線１１と走査線１２との交差部には、ＭＩＭ型の電子放出部１３がマトリクス状に配置されている。電子放出部１３は、データ線１１を下部電極として、データ線１１上に形成された絶縁層と、この絶縁層上に形成された上部電極１４とからなる。また、上部電極１４は、１つの走査線１２上に亘って、電子放出部１３を覆うように、走査線１２より幅広に形成されている。
【０００８】
走査線１２によって選択された１行分の電子放出部１３は、データ線１１からの画像信号に応じて電子を放出する。各電子放出部１３から放出された電子は、図示しないアノード基板上に形成された各蛍光体を励起させ発光させる。このように、１ライン分の画像信号を表示し、順次、次のラインの画像信号を表示して、１画面分の画像を表示する。
【０００９】
図２は、図１中の点線四角内の等価回路図である。図２において、同図左側に示すように、走査線１２に正の選択パルスが印加され、同図上側に示すように、各データ線１１に画像信号に対応した負の信号が印加されると、各電子放出部１３から電子が放出され、１ライン分の画像信号を表示する。
【００１０】
このように、走査線１２に正の選択パルスを順次印加することで、１画面分の画像を表示する。次の１画面分の画像を表示する直前に、図２左側に示すように、全ての走査線１２に負の選択パルスを印加して、電子放出部１３に蓄積された電荷をリセットする。
【００１１】
通常の動作状態では、走査線１２から上部電極１４のコンタクト抵抗Ｒcontを介して、電子放出部１３に走査パルスが印加される。このとき、選択された走査線１２に接続された全ての電子放出部１３に、同時に正の選択パルスが印加されるため、上部電極１４の隣接抵抗Ｒcont-nは動作に影響を与えない。
【００１２】
ここで、画素としての電子放出部１３に接続される上部電極１４のコンタクト抵抗Ｒcontの値は、画素当たり数１００Ωであり、上部電極１４の隣接抵抗Ｒcont-nの値は、画素当たり数ＫΩであり、走査線１２は、数Ωである。そのため、走査線１２の抵抗値は無視できるので、図２の等価回路では、走査線１２の抵抗を示していない。
【００１３】
実際の表示装置では、例えば、ＷＸＧＡの場合、1366×768×3＝3147264の画素が存在しているため、数個の画素が短絡又は断線していることが想定される。
【００１４】
断線している場合には、図２の等価回路は図３のようになり、断線しているために、隣接画素に与える電気的な影響はないが、短絡している場合には、図２の等価回路は図４のようになり、短絡している画素の影響で、隣接画素に印加される電圧が抵抗分割され、隣接画素に印加されるべき電圧が低下してしまう。
【００１５】
図４において、本来、画素としての電子放出部１３に印加されるべき電圧をＶsdとすると、画素が短絡した場合に、隣接画素に印加される電圧Ｖsd'は、上部電極１４のコンタクト抵抗Ｒcontと隣接抵抗Ｒcont-nで分割され、次式（１）となる。
Ｖsd'＝Ｒcont-n  ／（Ｒcont-n＋Ｒcont）Ｖsd  ………（１）
【００１６】
このとき、Ｖsd−Ｖsd'の値が、中間調１ビット以下でないと、短絡起因により、表示に異常が生じてしまう。したがって、中間調ビット数をｂとしたときに、次式（２）が成り立たなければならない。
Ｖsd−Ｖsd'≦ Ｖsd／２b  ………（２）
【００１７】
このとき、Ｖsd−Ｖsd'は、式（１）を用いて、次式（３）となる。
すなわち、Ｖsd−Ｖsd'＝Ｖsd−Ｒcont-n  ／（Ｒcont-n＋Ｒcont）Ｖsdであるから、
Ｖsd−Ｖsd'＝Ｖsd｛１−Ｒcont-n  ／（Ｒcont-n＋Ｒcont）｝  ………（３）
【００１８】
この式（３）を式（２）に代入すると、
Ｖsd・｛１−Ｒcont-n  ／（Ｒcont-n＋Ｒcont）｝≦ Ｖsd／２bとなり、各辺をＶsdで割り、整理すると、Ｒcont  ／（Ｒcont-n＋Ｒcont）≦１／２bとなり、各辺に（Ｒcont-n＋Ｒcont）をかけて、整理すると、（１−１／２b）Ｒcont≦Ｒcont-n／２bとなる。この各辺を（１−１／２b）で割り、整理すると、Ｒcont／Ｒcont-n≦１／（２b−１）となり、各辺の逆数をとると、次式（４）が得られる。
Ｒcont-n／Ｒcont≧２b−１  ………（４）
【００１９】
この式（４）において、例えば、中間調ビット数ｂを７ビットとすると、ｂ＝７であるから、Ｒcont-n／Ｒcont≧１２７となる。また、ｂ＝８とすると、Ｒcont-n／Ｒcont≧２５５となり、さらに、ｂ＝１０とすると、Ｒcont-n／Ｒcont≧１０２３となる。
【００２０】
このように、画素が短絡した場合を想定して、短絡画素に隣接する隣接画素の輝度低下を抑えるために、中間調ビット数に応じて、隣接抵抗とコンタクト抵抗との比を決定することができる。
【図面の簡単な説明】
【００２１】
【図１】本発明に係る表示装置の概略図。
【図２】図１の等価回路図。
【図３】画素が断線した場合の等価回路図。
【図４】画素が短絡した場合の等価回路図。
【符号の説明】
【００２２】
１０…カソード基板、１１…データ線、１２…走査線、１３…電子放出部（画素）、１４…上部電極。
【図１】
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【図２】
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【図３】
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【図４】
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