(57)【要約】【課題】アドレス・クロスバを２重化したコンピュータ（データ処理装置）のエラー耐性をより向上させるための技術を提供する。【解決手段】エラーが発生したアドレス・クロスバ３０＃１は、その旨を通知するためのエラー通知信号Ｓ１をマネージメントボート５０に送信し、自身をシステムから切り離すことを要求するためのＧＡＣ＃１切り離し指示信号Ｓ２を各システムボード１０、及び各ＩＯユニット２０に送信する。マネージメントボード５０の制御部５０は、レジスタ５０に格納された通知信号Ｓ１の情報によりアドレス・クロスバ３０＃１でのエラーの発生を確認すると、アドレス・クロスバ３０＃０に、２重化のための２重化モードから独立に動作させるための１重化モードにモード変更させるための設定信号Ｓ４を生成して送信する。それにより、アドレス・クロスバ３０＃０を１重化モードで動作させる。【選択図】図３
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【特許請求の範囲】
【請求項１】
１つ以上のＣＰＵを搭載したシステムボード、及び周辺装置との接続用のＩＯユニットを実装可能なユニットとするデータ処理装置において、
前記ユニット間の接続に採用された、複数モードで動作可能な複数のクロスバと、
前記複数のクロスバを２重化のための第１のモードで動作させていた場合に、該複数のクロスバのうちの一つに発生したエラーにより、該エラーが影響する他のクロスバのモード設定を該第１のモードから独立に動作させるための第２のモードに変更するモード変更手段と、
を具備することを特徴とするデータ処理装置。
【請求項２】
前記モード変更手段は、前記複数のクロスバのなかでエラーが発生したクロスバから、該エラーの発生を通知するエラー通知信号を受信し、前記他のクロスバに、前記第１のモードから前記第２のモードに変更するための設定信号を送信することにより、該他のクロスバのモード変更を行う、
ことを特徴とする請求項１記載のデータ処理装置。
【請求項３】
前記モード変更手段は、前記複数のクロスバのなかでエラーが発生したクロスバから、該エラーの発生を通知する信号を前記他のクロスバに送信させ、該他のクロスバにモード変更を行わせることにより実現させている、
ことを特徴とする請求項１記載のデータ処理装置。
【請求項４】
１つ以上のＣＰＵを搭載したシステムボード、及び周辺装置との接続用のＩＯユニットを実装可能なユニットとするデータ処理装置に搭載される装置であって、
前記ユニット間の接続に採用された、複数モードで動作可能な複数のクロスバとそれぞれ送受信可能な送受信手段と、
２重化のための第１のモードで動作していた前記複数のクロスバのうちの一つから、エラーの発生を通知するエラー通知信号を前記送受信手段が受信した場合に、該エラーが影響する他のクロスバのモード設定を該第１のモードから独立に動作させるための第２のモードに変更するための設定信号を前記送受信手段により送信させて、該他のクロスバのモード変更を行うモード制御手段と、
を具備することを特徴とするモード管理装置。
【請求項５】
１つ以上のＣＰＵを搭載したシステムボード、及び周辺装置との接続用のＩＯユニットを実装可能なユニットとするデータ処理装置に該ユニット間の接続に採用されたクロスバのモード管理に用いられる方法であって、
前記ユニット間の接続に複数のクロスバを配置し、該複数のクロスバを２重化のための第１のモードで動作させ、
前記複数のクロスバのうちの一つに発生したエラーにより、該エラーが影響する他のクロスバのモード設定を前記第１のモードから独立に動作させるための第２のモードにモード変更する、
ことを特徴とするモード管理方法。
【請求項６】
それぞれが処理部を搭載する複数の処理ユニットと、
それぞれが前記複数の処理ユニットに接続され、前記複数の処理ユニット間のデータ転送に介在する、動作モードが二重化モードと一重化モードとに切り替えられる、二重化された複数のクロスバユニットと、
前記二重化された複数のクロスバユニットのうちいずれか一方にエラーが発生した場合、動作モードを二重化モードから一重化モードに切り替える指示を他方のクロスバユニットに送出するモード変更手段と、を備えたことを特徴とするデータ処理装置。
【発明の詳細な説明】
【技術分野】
【０００１】
本発明は、１つ以上のＣＰＵを搭載したシステムボード、及び周辺装置との接続用のＩＯユニットを接続可能なユニットとするデータ処理装置に関する。
【背景技術】
【０００２】
近年、コンピュータ（データ処理装置）のなかには、物理的に分離したユニットを複数、実装可能な構成が採用されたものがある。そのユニットとしては、ＣＰＵとメモリを搭載したシステムボード（ＳＢ）と、ハードディスク装置やＰＣＩスロットなどのＩＯデバイスを搭載したＩＯユニットとが用意されるのが普通である。そのようなユニットを用意するのは、ＣＰＵ資源やメモリ資源を状況に応じて柔軟に割り当てられるためである。つまり、それらをより効率的に活用できるという利点があるためである。その構成を採用したコンピュータには、システムボード、及びＩＯユニットはそれぞれ１つ以上、搭載される。クロスバは、それらのユニット間の相互接続に用いられる。そのようなコンピュータでは、１つ以上のシステムボートと、１つ以上のＩＯユニットとを１つの独立したシステムとして分割することが可能である。そのように分割してできる「独立したシステム」は「パーティション」と呼ばれる。
【０００３】
図９は、クロスバにより複数のユニットを接続したコンピュータの構成を説明する図である。図９に示すように、１つ以上のシステムボード１、及びＩＯユニット２は共に、２つのグローバル・アドレス・クロスバ（以降「アドレス・クロスバ」或いは「ＧＡＣ」と略記）３、及び４つのグローバル・データ・クロスバ（以降「データ・クロスバ」或いは「ＧＤＸ」と略記）４とそれぞれ接続されている。マネージメントボード（ＭＭＢ：Management Board）５は、管理専用ユニットであり、各ユニット１〜４とはＳＭバスにより接続されている。
【０００４】
２つのアドレス・クロスバ３は、同時に同じリクエスト制御を行っている。それにより、アドレス・クロスバ３はハードウェア的に２重化され、その２重化によってより高い信頼性を実現させている。ここでは便宜的に、２重化のための動作モードを「２重化モード」と呼ぶことにする。４つのデータ・クロスバ４が用意されているのは、通常、一度に大量のデータが転送されるためである。
【０００５】
２つのアドレス・クロスバ３にはそれぞれ「＃０」「＃１」が表記されている。このことから、２つのアドレス・クロスバ３のうちの一方のみを指す場合には、符号の後に「＃０」或いは「＃１」を付すことにする。これは他でも同様である。
【０００６】
２つのアドレス・クロスバ３は、同期して動作する。他方のデータ・クロスバ４では、２つのデータ・クロスバ４＃０、及び４＃２、２つのデータ・クロスバ４＃１、及び４＃３がそれぞれ同期して動作する。
【０００７】
アドレス・クロスバ３内に実装されているメモリやバッファ、或いはキューといったデータや制御情報を蓄えておく機構では、ＥＣＣ（Error Correcting Code）、或いはパリティが付加される。それにより、訂正不可能なエラーの発生を認識するようになっている。また、他の部分の動作を監視して、フリーズ等のエラーの発生を認識するようになっている。２重化モードで動作中にエラーが発生した場合、従来のコンピュータでは以下のように対応するようになっている。
【０００８】
図１０は、アドレス・クロスバ３＃１にエラーが発生した場合に、従来のコンピュータ各部が実行する処理の流れを示すフローチャートである。その図１０を参照して、エラーが発生したクロスバ３＃１を含む各部の動作について具体的に説明する。その図１０では、各部を、システムボード１及びＩＯユニット２（図中「ＳＢ／ＩＯＵ」と表記）、アドレス・クロスバ３＃０（図中「ＧＡＣ＃０」と表記）、アドレス・クロスバ３＃１（図中「ＧＡＣ３＃１」と表記）、及びマネージメントボード５（図中「ＭＭＢ」と表記）の４つに分けている。
【０００９】
アドレス・クロスバ３＃１は、エラーの発生を認識（検出）すると、その旨をマメージメントボード５、各システムボード１、及び各ＩＯユニット２にそれぞれ通知する（ＳＡ１）。各システムボード１、及び各ＩＯユニット２には、アドレス・クロスバ３＃１をシステムから論理的に切り離すことを求める信号（ＧＡＣ＃１切り離し信号）を送信する。その後、動作を停止させる（ＳＡ２）。
【００１０】
ＧＡＣ＃１切り離し信号を受信した各システムボード１、及び各ＩＯユニット２はそれぞれ、エラーが発生したアドレス・クロスバ３＃１を切り離す動作（処理）を行う（ＳＣ１）。その後は、切り離したクロスバ３＃１を使用しないことを除き、それまでと同様の動作を継続させる（ＳＣ２）。
【００１１】
マネージメントボード５では、上記通知をシステム管理に反映させる。他方のアドレス・クロスバ３＃０には、アドレス・クロスバ３＃１に発生したエラーは通知されず、それまでと同じ動作を継続させる。
【００１２】
このように、２重化したアドレス・クロスバ３の一方にエラーが発生すると、以降、そのエラーが発生したクロスバ３は使用せず、システムから切り離している。これは、データ信頼性の観点からである。このことから、２重化モードで動作していたアドレス・クロスバ３は、エラーの発生により動作を停止するようになっている（図１０）。
【特許文献１】特開平０９−１７９８３８号公報
【特許文献２】特公平０７−８２４７９号公報
【発明の開示】
【発明が解決しようとする課題】
【００１３】
アドレス・クロスバ３を２重化することにより、より高い信頼性が実現される。２つのアドレス・クロスバ３のうちの一方にエラーが発生しても、他方を用いてシステムを動作させることができる。しかし、その他方にもエラーが発生することがありうる。そのようなエラーが発生すると、そのエラーの発生により他方も停止するから、システムも停止することになる。
【００１４】
アドレス・クロスバ３に発生したエラーは、そのクロスバ３を停止すべきものでない場合がある。特定のユニット間にのみ影響するような部分的なエラーが発生することも多い。このことから、独立に動作させるモード（以降「１重化モード」）の設定時には、エラーの発生により停止が必要な部分のみを停止させ、エラーの影響を受けない部分は動作を継続させるようになっている。システムのより高い稼働率を実現させるためには、このようなことに着目し、エラー耐性を向上させることも重要と考えられる。
【００１５】
本発明は、アドレス・クロスバを２重化したコンピュータ（データ処理装置）のエラー耐性をより向上させるための技術を提供することを目的とする。
【課題を解決するための手段】
【００１６】
本発明の第１の態様のデータ処理装置は、１つ以上のＣＰＵを搭載したシステムボード、及び周辺装置との接続用のＩＯユニットを実装可能なユニットとするものであり、ユニット間の接続に採用された、複数モードで動作可能な複数のクロスバと、複数のクロスバを２重化のための第１のモードで動作させていた場合に、該複数のクロスバのうちの一つに発生したエラーにより、該エラーが影響する他のクロスバのモード設定を該第１のモードから独立に動作させるための第２のモードに変更するモード変更手段と、を具備する。
【００１７】
なお、上記モード変更手段は、複数のクロスバのなかでエラーが発生したクロスバから、該エラーの発生を通知するエラー通知信号を受信し、他のクロスバに、第１のモードから第２のモードに変更するための設定信号を送信することにより、該他のクロスバのモード変更を行う、ことが望ましい。また、そのモード変更手段は、複数のクロスバのなかでエラーが発生したクロスバから、該エラーの発生を通知する信号を他のクロスバに送信させ、該他のクロスバにモード変更を行わせることにより実現させている、ことが望ましい。
【００１８】
本発明の第２の態様のデータ処理装置は、それぞれが処理部を搭載する複数の処理ユニットと、それぞれが複数の処理ユニットに接続され、複数の処理ユニット間のデータ転送に介在する、動作モードが二重化モードと一重化モードとに切り替えられる、二重化された複数のクロスバユニットと、二重化された複数のクロスバユニットのうちいずれか一方にエラーが発生した場合、動作モードを二重化モードから一重化モードに切り替える指示を他方のクロスバユニットに送出するモード変更手段と、を備えている。
【００１９】
本発明のモード管理装置は、１つ以上のＣＰＵを搭載したシステムボード、及び周辺装置との接続用のＩＯユニットを実装可能なユニットとするデータ処理装置に搭載されることを前提とし、ユニット間の接続に採用された、複数モードで動作可能な複数のクロスバとそれぞれ送受信可能な送受信手段と、２重化のための第１のモードで動作していた複数のクロスバのうちの一つから、エラーの発生を通知するエラー通知信号を送受信手段が受信した場合に、該エラーが影響する他のクロスバのモード設定を該第１のモードから独立に動作させるための第２のモードに変更するための設定信号を送受信手段により送信させて、該他のクロスバのモード変更を行うモード制御手段と、を具備する。
【００２０】
本発明のモード管理方法は、１つ以上のＣＰＵを搭載したシステムボード、及び周辺装置との接続用のＩＯユニットを実装可能なユニットとするデータ処理装置に該ユニット間の接続に採用されたクロスバのモード管理に用いられる方法であって、ユニット間の接続に複数のクロスバを配置し、該複数のクロスバを２重化のための第１のモードで動作させ、複数のクロスバのうちの一つに発生したエラーにより、該エラーが影響する他のクロスバのモード設定を第１のモードから独立に動作させるための第２のモードにモード変更する。
【発明の効果】
【００２１】
本発明では、実装されたユニット（処理ユニット）間の接続に複数のクロスバ（クロスバユニット）を配置し、その複数のクロスバを２重化のための第１のモード（二重化モード）で動作させていた場合に、その複数のクロスバのうちの一つに発生したエラーにより、そのエラーが影響する他のクロスバのモード設定を第１のモードから独立に動作させるための第２のモード（一重化モード）にモード変更する。
【００２２】
第１のモードでは、データ信頼性の観点から、エラーが発生したクロスバは動作を停止させる。第２のモードでは、動作の停止が必要な部分のみを停止させる。このことから、他のクロスバでのエラーの発生により、エラーが発生していないクロスバを第１のモードから第２のモードにモード変更すると、部分的なエラーが発生したとしても、正常に動作可能な部分を用いたシステムの動作を継続させることができる。それにより、エラー耐性が向上し、システムのより高い稼働率を実現できるようになる。
【発明を実施するための最良の形態】
【００２３】
以下、本発明の実施の形態について、図面を参照しながら詳細に説明する。
図１は、本実施の形態によるデータ処理装置（コンピュータ）の構成を説明する図である。図１に示すように、１つ以上のシステムボード１０、及びＩＯユニット２０は共に、２つのグローバル・アドレス・クロスバ（以降「アドレス・クロスバ」或いは「ＧＡＣ」と略記）３０、及び４つのグローバル・データ・クロスバ（以降「データ・クロスバ」或いは「ＧＤＸ」と略記）４０とそれぞれ接続されている。マネージメントボード（ＭＭＢ：Management Board）５０は、管理専用ユニットであり、各ユニット１０〜４０とはＳＭバスにより接続されている。
【００２４】
アドレス・クロスバ３０は２重化され、２つのクロスバ３０は同時に同じリクエスト制御を行っている。それにより、高い信頼性を実現させている。４つのデータ・クロスバ４０が用意されているのは、通常、一度に大量のデータが転送されるためである。２つのアドレス・クロスバ３は同期して動作し、データ・クロスバ４０では、２つのデータ・クロスバ４０＃０、及び４０＃２、２つのデータ・クロスバ４０＃１、及び４０＃３がそれぞれ同期して動作する。
【００２５】
図２は、システムボード１０、及びＩＯユニット２０の構成例を説明する図である。
システムボード１０は、４つのＣＰＵ１０１、２つのＦＷＨ（Firm Ware Hub）１０２、ノース・ブリッジ（North Bridge）１０３、４つのメモリ・スイッチ（図中「Mem Swich」と表記）１０４、及び各メモリ・スイッチ１０４に接続された複数のメモリ１０５を備えた構成となっている。他方のＩＯユニット２０は、サウス・ブリッジ（South Bridge）２０１、そのブリッジ２０１に接続された２つのＳＥＲ２０２およびＰＣＩポートに接続されたＰＣＩデバイス、各ＳＥＲ２０２およびサウス・ブリッジ２０１に接続されたＩＣＨ６  ２０３、及び各ＩＣＨ６  ２０３に接続された６個のコントローラ２１１〜２１６を備えた構成となっている。ＩＣＨ６  ２０３は、Ｉ／Ｏコントローラ・ハブである。図２に示すコントローラ２１１〜２１６は一例であり、その種類や数は任意に変更できる。それらはＩＯユニット２０単位で任意に決定しても良い。
【００２６】
ＩＯユニット２０のサウス・ブリッジ２０１は、２つのアドレス・クロスバ３０、及び４つのデータ・クロスバ４０とそれぞれ接続されている。そのブリッジ２０１は、ＳＥＲ２０２、及びＩＣＨ６を介して各コントローラ２１１〜２１６を制御する。たとえばＰＣＩからの書き込みデータがあった場合、サウス・ブリッジ２０１からアドレス・クロスバ３０に対してリクエストが出される。システムボード１０からデータ・クロスバ４０を介して転送されるデータを受信した場合には、ＳＥＲ２０２、及びＩＣＨ６を介して送出すべきコントローラおよびＰＣＩに送出し、データの格納、出力、或いは送信を行わせる。
【００２７】
システムボード１０上の４つのＣＰＵ１０１は、メモリ１０５、他のシステムボード１ｂ０、或いはＩＯユニット２０へのリード／ライトコマンドをノース・ブリッジ１０３に発行する。ノース・ブリッジ１０３は、各ＣＰＵ１０１から入力したコマンドを一旦、格納し、優先順位に従ってそのなかから一つを選択し、それをリクエスト（アドレスリクエストとして発行し、アドレス・クロスバ３０、及び４つのメモリ・スイッチ１０４にそれぞれ出力する。
【００２８】
データ・クロスバ４０を介して転送されるデータは、メモリ・スイッチ１０４により受信されてノース・ブリッジ１０３に出力され、そのブリッジ１０３によりそれを必要とするＣＰＵ１０１に渡される。他のシステムボード１０、或いはＩＯユニット２０に転送すべきデータは、メモリ・スイッチ１０４によりデータ・クロスバ４０に送信され転送される。
【００２９】
アドレス・クロスバ３内に実装されているメモリやバッファ、或いはキューといったデータや制御情報を蓄えておく機構では、ＥＣＣ（Error Correcting Code）、或いはパリティが付加される。それにより、訂正不可能なエラーの発生を認識するようになっている。また、他の部分の動作を監視して、フリーズ等のエラーの発生を認識するようになっている。２重化モードで動作中にエラーが発生した場合、本実施の形態では以下のように対応するようになっている。図３〜図６を参照して、具体的に説明する。
【００３０】
図３は、エラー発生時に送受信される信号を説明する図である。その図３は、アドレス・クロスバ３０＃１にエラーが発生した場合のものである。このことから、そのクロスバ３０＃１にエラーが発生した場合を想定して、以降の説明も行う。
【００３１】
エラーが発生したアドレス・クロスバ３０＃１は、その旨を通知するためのエラー通知信号Ｓ１をマネージメントボート５０に送信し、自身をシステムから切り離すことを要求するためのＧＡＣ＃１切り離し指示信号Ｓ２を各システムボード１０、及び各ＩＯユニット２０に送信する。
【００３２】
エラー通知信号Ｓ１としてマネージメントボード５０に送信された情報は、レジスタ５２に格納される。マネージメントボード５０の制御部５０は、レジスタ５０に格納された情報によりアドレス・クロスバ３０＃１でのエラーの発生を確認すると、エラーが発生していないアドレス・クロスバ３０＃０に、２重化のための２重化モードから独立に動作させるための１重化モードにモード変更させるための設定信号Ｓ４を生成して送信する。それにより、その信号Ｓ４を受信したアドレス・クロスバ３０＃０は、以降、１重化モードで動作する。
【００３３】
図６は、設定されたモード、及び発生したエラーが影響する範囲によるエラーへの対応を説明する図である。
図６に示すように、１重化モードで動作するアドレス・クロスバ３０は、システム全体に影響するエラーが発生しない限り、動作は停止させない。発生したエラーがそのようなものでなければ、発生したエラーが影響するパーティションに対応する部分のみ停止（ダウン）させ、他の部分の動作を継続させる。システム全体に影響するエラーが発生した場合には、その旨をマネージメントボード５０に報告し、動作を全体的に停止させる。そのようにして、不必要な動作の停止は行わないため、処理が行えるパーティションは継続して処理を行うことができる。処理が行えないパーティションを構成するユニット１０、２０の停止（ダウン）はマネージメントボード５０によって行われる。
【００３４】
一方、２重化モードで動作するアドレス・クロスバ３０では、エラーが影響する範囲に係わらず、動作を全体的に停止させる。このようなことから、エラーが発生していないアドレス・クロスバ３０を２重化モードで動作させる場合と比較して、エラー耐性が向上し、それによってシステムのより高い稼働率を実現させることができる。
【００３５】
図４は、アドレス・クロスバ３０の構成を説明する図である。
クロスバ３０は、図４に示すように、内部にＬＳＩ３１が搭載され、そのＬＳＩ３１上には、構成設定レジスタ３２、複数の制御部３３、エラーレジスタ３４、及びエラー処理部３５が搭載されている。構成設定レジスタ３２は、各種設定変更を行うためのレジスタであり、設定変更はそれに格納された内容を書き換えることで行われる。各制御部３３はそれぞれ、対応するユニット間の通信を実現させるためのものであり、各制御部３３には、複数のエラー検出機能や、各ユニット１０、及び２０から発行されたリクエストのうちの一つを選択するための調停回路、ユニット間の通信を実現させるための通信回路などが搭載されている。エラー検出機能により検出したエラーに関する情報はエラーレジスタ３４に格納する。エラー処理部３５は、エラーレジスタ３４に格納された情報により、発生したエラーに対応するための処理を行う。その処理の実行により、発生したエラーをマネージメントボート５０に通知するためのエラー通知信号Ｓ１の送信、及びシステムから切り離すことを要求するための切り離し指示信号Ｓ２の各ユニット１０、及び２０への送信が実現される。
【００３６】
その指示信号Ｓ２は、各ユニット１０、及び２０にそれぞれ搭載されたＬＳＩ１１、及び２１に送信される。ＬＳＩ１１、及び２１はそれぞれ、例えば図２に示す構成ではノース・ブリッジ１０３、サウス・ブリッジ２０１に対応するものである。それらＬＳＩ１１、及び２１が指示信号Ｓ２を受け取ることにより、その指示信号Ｓ２を送信したアドレス・クロスバ３０は切り離されることとなる。
【００３７】
図５は、アドレス・クロスバ３０＃１にエラーが発生した場合に、各部が実行する処理の流れを示すフローチャートである。次に図５を参照して、エラーが発生したクロスバ３０＃１を含む各部の動作について具体的に説明する。その図５では、図１０と同様に、各部を、システムボード１０及びＩＯユニット２０（図中「ＳＢ／ＩＯＵ」と表記）、アドレス・クロスバ３０＃０（図中「ＧＡＣ＃０」と表記）、アドレス・クロスバ３０＃１（図中「ＧＡＣ３＃１」と表記）、及びマネージメントボード５０（図中「ＭＭＢ」と表記）の４つに分けている。
【００３８】
アドレス・クロスバ３０＃１は、制御部３３のうちの何れかがエラーの発生を認識（検出）すると、エラー処理部３５がエラー通知信号Ｓ１をマメージメントボード５０に、エラー切り離し指示信号Ｓ２（図中「ＧＡＣ＃１切り離し信号」と表記）を各システムボード１、及び各ＩＯユニット２にそれぞれ送信する（ＳＡ１１）。その後、動作を停止させる（ＳＡ２）。
【００３９】
各システムボード１０、及び各ＩＯユニット２０にそれぞれ搭載されたＬＳＩ１１、及び２１は、ＧＡＣ＃１切り離し指示信号Ｓ２の受信に応答して、アドレス・クロスバ３０＃１をシステムから切り離す動作（処理）を行う（ＳＣ１１）。その後は、切り離したクロスバ３０＃１を使用しないことを除き、それまでと同様の動作を継続させる（ＳＣ１２）。
【００４０】
マネージメントボード５０では、制御部５２がレジスタ５２を介してエラー通知信号Ｓ１を受信すると、エラーが発生していないアドレス・クロスバ３０＃０のモード設定を２重化モードから１重化モードに変更する決定を行い、そのための設定信号Ｓ４を生成してそのクロスバ３０＃０に送信する（ＳＤ１１）。
【００４１】
アドレス・クロスバ３０＃０に送信された設定信号Ｓ４は、構成設定レジスタ３２に格納され、各制御部３３はそのレジスタ３２の内容を参照して、モード設定を２重化モードから１重化モードに変更する（ＳＢ１１）。それにより、その後の各制御部３３は１重化モードで動作を継続させる（ＳＢ１２）。
【００４２】
なお、本実施の形態では、２重化したアドレス・クロスバ３０のうちの一方にエラーが発生した場合、他方のアドレス・クロスバ３０のモード変更をマネージメントボード５０により行うようにしているが、これは、マネージメントボード５０は各ユニット１０〜４０と通信が可能なためである。つまり、仕様の変更を抑えつつ対応が可能なためである。しかし、マネージメントボード５０を用いない方法によりそのモード変更を実現させても良い。例えば図７に示すように、２つのアドレス・クロスバ３０間で信号を送受信可能にして、エラーが発生したアドレス・クロスバ３０（ここではクロスバ３０＃１）から他のアドレス・クロスバ３０に、エラーの発生を通知する信号Ｓ１１を送信することにより、その信号Ｓ１１を受信したクロスバ３０にモード変更を行わせても良い。或いは図８に示すように、例えば切り離し指示信号Ｓ２を受信したシステムボード１０に、別のアドレス・クロスバ３０にエラーが発生したことを通知する信号Ｓ２１を、その指示信号Ｓ２を送信していない正常のアドレス・クロスバ３０に送信させて、モード変更を行わせても良い。その信号Ｓ２１を送信させるシステムボード１０、或いはＩＯユニット２０は、例えば予め優先順位を定め、正常に動作しているもののなかで最も優先順位の高いものを選択するようにしても良い。アドレス・クロスバ３０のモード変更用の専用ユニットを設け、その専用ユニットを介してモード変更を実現させても良い。
【００４３】
また本実施の形態では、アドレス・クロスバ３０を２重化しているが、３重化、或いはそれ以上の多重化を行うことも考えられる。３重化以上の多重化を行っている場合には、例えば２重化以上の多重化を行えなくなった状況下で、エラーが発生していないアドレス・クロスバ３０のモード変更を行えば良い。アドレス・クロスバ３０により相互接続させるユニットとしては、システムボード１０、及びＩＯユニット２０に限定されるものではない。その種類、及び組み合わせは任意に変更しても良い。
【図面の簡単な説明】
【００４４】
【図１】本実施の形態によるデータ処理装置（コンピュータ）の構成を説明する図である。
【図２】システムボード１０、及びＩＯユニット２０の構成例を説明する図である。
【図３】エラー発生時に送受信される信号を説明する図である。
【図４】アドレス・クロスバ３０の構成を説明する図である。
【図５】アドレス・クロスバ３０＃１にエラーが発生した場合に、各部が実行する処理の流れを示すフローチャートである。
【図６】設定されたモード、及び発生したエラーが影響する範囲によるエラーへの対応を説明する図である。
【図７】エラーが発生していないアドレス・クロスバ３０におけるモード変更を実現させる他の方法を説明する図である（その１）。
【図８】エラーが発生していないアドレス・クロスバ３０におけるモード変更を実現させる他の方法を説明する図である（その１）。
【図９】クロスバにより複数のユニットを接続したコンピュータの構成を説明する図である。
【図１０】アドレス・クロスバ３＃１にエラーが発生した場合に、従来のコンピュータ各部が実行する処理の流れを示すフローチャートである。
【符号の説明】
【００４５】
１０      システムボード
１１、２１、３１      ＬＳＩ
２０      ＩＯユニット
３０      グローバル・アドレス・クロスバ
３２      構成設定レジスタ
３３、５１    制御部
３４      エラーレジスタ
３５      エラー処理部
５０      マネージメントボード
５２      レジスタ
【図６】
2008046996.tif 000003
【図１】
2008046996.tif 000004
【図２】
2008046996.tif 000005
【図３】
2008046996.tif 000006
【図４】
2008046996.tif 000007
【図５】
2008046996.tif 000008
【図７】
2008046996.tif 000009
【図８】
2008046996.tif 000010
【図９】
2008046996.tif 000011
【図１０】
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