(57)【要約】  ジョセフソンインバータゲート回路は、極性または論理反転の効率的な実装形態を提供すると同時に、信号経路に物理的に大型の高効率磁気変圧器を不要にする。この回路は、半ねじれジョセフソン伝送線路（ＪＴＬ）または非シャントフローティングジョセフソン接合を備えたＪＴＬで構成され得、ＳＦＱ入力信号によってトリガされたときに２つの単一磁束量子（ＳＦＱ）パルスを生成し、その結果、極性が逆の出力ＳＦＱ信号が生成される。論理インバータとして実装された回路の適切な初期化は、信号反転ステージ内で磁束バイアスにより実行される。【選択図】図１Ａ
2021513238.tif 000002
【特許請求の範囲】
【請求項１】
少なくとも１つの単一磁束量子（ＳＦＱ）パルスを含む入力信号を供給する入力と、
前記入力信号を出力に伝播し、前記入力信号を出力信号に反転するように配置された少なくとも４つのジョセフソン接合を含む半ねじれジョセフソン伝送線路（ＪＴＬ）と、を備える、ジョセフソンインバータゲート回路。
【請求項２】
前記半ねじれＪＴＬに少なくとも１つの初期化電流を供給するように構成された少なくとも１つのＤＣ入力をさらに備える、請求項１に記載の回路。
【請求項３】
前記半ねじれＪＴＬに少なくとも１つの初期化電流を供給するようにそれぞれ構成された少なくとも２つのＤＣ入力をさらに備える、請求項１に記載の回路。
【請求項４】
前記ＪＴＬが中央ループを含み、前記少なくとも２つのＤＣ入力が、それらのそれぞれの初期化電流を前記中央ループに供給するようにそれぞれ構成される、請求項３に記載の回路。
【請求項５】
それぞれがＡＣ成分を有するバイアス信号を供給する少なくとも２つのバイアス入力をさらに備える、請求項１に記載の回路。
【請求項６】
前記少なくとも２つのバイアス信号の第１の前記ＡＣ成分が、前記少なくとも２つのバイアス信号の第２の前記ＡＣ成分と１８０°位相がずれている、請求項５に記載の回路。
【請求項７】
前記半ねじれＪＴＬが、入力端および出力端を含み、
前記半ねじれＪＴＬの各端が、信号伝播側および接地側を含み、
前記入力端の前記信号伝播側が、前記出力端の前記接地側であり、前記入力端の前記接地側が、前記出力端の前記信号伝播側であり、
前記少なくとも４つのジョセフソン接合の各々が、前記半ねじれＪＴＬの前記端の一方の前記信号伝播側と前記接地側との間に接続される、請求項１に記載の回路。
【請求項８】
前記インバータゲート回路が、極性インバータであり、それにより、
前記半ねじれＪＴＬの前記入力端に最も近い前記少なくとも４つのジョセフソン接合のうちの前記１つを２π超伝導相に設定する入力信号の前記出力への伝播時に、前記半ねじれＪＴＬの前記出力端に最も近い前記少なくとも４つのジョセフソン接合のうちの前記１つが−２π超伝導相を示し、
前記半ねじれＪＴＬの前記入力端に最も近い前記少なくとも４つのジョセフソン接合のうちの前記１つを０超伝導相にリセットする入力信号の前記出力への伝播時に、前記半ねじれＪＴＬの前記出力端に最も近い前記少なくとも４つのジョセフソン接合のうちの前記１つが０超伝導相を示す、請求項１に記載の回路。
【請求項９】
前記半ねじれＪＴＬの中央ループに機能的に等しく反対の初期化電流を供給するように構成された少なくとも２つのＤＣ入力をさらに備える、請求項８に記載の回路。
【請求項１０】
前記インバータゲート回路が、論理インバータであり、それにより、過渡的起動期間の後、
前記半ねじれＪＴＬの前記入力端に最も近い前記少なくとも４つのジョセフソン接合のうちの前記１つを２π超伝導相に設定する入力信号の前記出力への伝播時に、前記半ねじれＪＴＬの前記出力端に最も近い前記少なくとも４つのジョセフソン接合のうちの前記１つが０超伝導相を示し、
前記半ねじれＪＴＬの前記入力端に最も近い前記少なくとも４つのジョセフソン接合のうちの前記１つを０超伝導相にリセットする入力信号の前記出力への伝播時に、前記半ねじれＪＴＬの前記出力端に最も近い前記少なくとも４つのジョセフソン接合のうちの前記１つが２π超伝導相を示す、請求項１に記載の回路。
【請求項１１】
前記半ねじれＪＴＬの中央ループに機能的に等しく、かつ同じ方向の初期化電流を供給するように構成された少なくとも２つのＤＣ入力をさらに備える、請求項１０に記載の回路。
【請求項１２】
前記中央ループが、前記少なくとも４つのジョセフソン接合に追加される第５および第６のジョセフソン接合を含む、請求項１１に記載の回路。
【請求項１３】
単一磁束量子（ＳＦＱ）パルス入力に基づいて信号値を論理的に反転する方法であって、前記方法が、
第１の正のＳＦＱパルスを半ねじれジョセフソン伝送線路（ＪＴＬ）の入力端に供給して、前記半ねじれＪＴＬの出力端よりも前記半ねじれＪＴＬの前記入力端に近い前記半ねじれＪＴＬの入力側ジョセフソン接合を２π超伝導相に設定することと、
前記第１の正のＳＦＱパルスを供給する前または後に、ただし前記第１の正のＳＦＱパルスが前記中央ループを通じて前記出力に伝播することができる前に、１つのΦ０の電流を初期化電流として前記半ねじれＪＴＬの中央ループに注入し、それにより、前記第１の正のＳＦＱパルスが、前記初期化電流によって消滅し、前記入力側ジョセフソン接合の前記超伝導相に影響を与えることなく、前記中央ループを通じて前記半ねじれＪＴＬの前記出力端に伝播しないようにすることと、
負のＳＦＱパルスを前記半ねじれＪＴＬの前記入力端に供給して、前記入力側ジョセフソン接合を０超伝導相にリセットし、それにより、前記負のＳＦＱパルスが、前記半ねじれＪＴＬの前記出力端に伝播して、前記半ねじれＪＴＬの前記入力端よりも前記半ねじれＪＴＬの前記出力端に近い前記半ねじれＪＴＬの出力側ジョセフソン接合の前記超伝導相を２πに設定することと、を含む、方法。
【請求項１４】
第２の正のＳＦＱパルスを前記半ねじれＪＴＬの前記入力端に供給して、前記入力側ジョセフソン接合を２π超伝導相に設定し、それにより、前記第２の正のＳＦＱパルスが、前記半ねじれＪＴＬの前記出力端に伝播して、前記出力側ジョセフソン接合の前記超伝導相を０にリセットすることをさらに含む、請求項１３に記載の方法。
【請求項１５】
入力端であって、
入力ノードと第１のノードとの間に接続された第１のインダクタと、
前記第１のノードと回路接地との間に接続された第１のジョセフソン接合（ＪＪ）と、
前記第１のノードと第２のノードとの間に接続された第２のインダクタと、
前記第２のノードと第３のノードとの間に接続された第２のＪＪと、
前記第３のノードと前記回路接地との間に接続された第３のインダクタと、を含む入力端と、
出力端であって、
第４のノードと前記回路接地との間に接続された第４のインダクタと、
前記第４のノードと第５のノードとの間に接続された第３のＪＪと、
前記第５のノードと第６のノードとの間に接続された第５のインダクタと、
前記第６のノードと前記回路接地との間に接続された第４のＪＪと、
前記第６のノードと出力ノードとの間に接続された第６のインダクタと、を含む出力端と、
前記入力端と前記出力端とを接続する中央部分であって、前記中央部分が、
少なくとも２つのＪＪを含む中央ループを含む、中央部分と、を備える、超伝導逆量子論理（ＲＱＬ）インバータ回路。
【請求項１６】
前記中央ループが、前記インバータ回路が極性インバータとなるように、反対方向に、Φ０／２の電流をそれぞれ注入するように構成された変圧器結合ＤＣ磁束バイアス注入源をさらに含む、請求項１５に記載の回路。
【請求項１７】
前記中央中央ループが、前記インバータ回路が論理インバータとなるように、Φ０の電流を合計して注入するように構成された変圧器結合ＤＣ磁束バイアス注入源をさらに含む、請求項１５に記載の回路。
【請求項１８】
それぞれがＡＣ成分を有するバイアス信号を供給する２つのバイアス入力をさらに備え、前記第１のバイアス入力が、前記第２のノードで前記回路に接続された第７のインダクタを介して接続され、前記第２のバイアス入力が、前記第５のノードで前記回路に接続された第８のインダクタを介して接続される、請求項１５に記載の回路。
【請求項１９】
前記第２のノードと第７のノードとの間に接続された第１３のインダクタと、
前記第３のノードと第８のノードとの間に接続された第１４のインダクタと、
前記第８のノードと第９のノードとの間に接続された第５のＪＪと、
前記第７のノードと前記第９のノードとの間に接続された第１５のインダクタと、
前記第９のノードと第１０のノードとの間に第１の初期化電流を注入するように配置された第１の変圧器結合ＤＣ磁束バイアス注入源と、
前記第８のノードと第１１のノードとの間に第２の初期化電流を注入するように配置された第２の変圧器結合ＤＣ磁束バイアス注入源と、
前記第１１のノードと第１２のノードとの間に接続された第１６のインダクタと、
前記第１１のノードと前記第１０のノードとの間に接続された第６のＪＪと、
前記第１０のノードと前記第４のノードとの間に接続された第１７のインダクタと、
前記第１２のノードと前記第５のノードとの間に接続された第１８のインダクタと、
それぞれがＡＣ成分を有するバイアス信号を供給する２つのバイアス入力であって、前記第１のバイアス入力が、前記第７のノードで前記回路に接続された第７のインダクタを介して接続され、前記第２のバイアス入力が、前記第１２のノードで前記回路に接続された第８のインダクタを介して接続される、２つのバイアス入力と、をさらに備える、請求項１５に記載の回路。
【請求項２０】
前記中央ループのインダクタとそれぞれ並列に配置された第５および第６のジョセフソン接合をさらに備え、それぞれが、前記第５および第６のジョセフソン接合なしで前記中央ループに誘導的に供給されるそれぞれのＤＣバイアス入力と比較して、前記それぞれのＤＣバイアス入力によって供給される前記電流に対する感度が低下した状態で前記中央ループにΦ０／２磁束バイアスを供給するように構成されている、請求項１５に記載の回路。
【発明の詳細な説明】
【技術分野】
【０００１】
関連出願
本出願は、２０１８年２月１日に出願された米国特許出願第１５／８８７５２４号からの優先権を主張し、その全体が本明細書に組み込まれる。
【０００２】
本発明は、概して、量子的および古典的なデジタル超伝導回路に関し、具体的には、ジョセフソン極性および論理インバータゲートに関する。
【背景技術】
【０００３】
デジタルロジックの分野では、周知かつ高度に開発された相補型金属酸化膜半導体（ＣＭＯＳ）技術が幅広く使用されている。ＣＭＯＳが技術として成熟に近づくにつれ、速度、消費電力、計算密度、相互接続帯域幅などの面で高性能化につながる可能性のある代替技術が注目されている。ＣＭＯＳ技術の代替として、典型的な信号出力約４ナノワット（ｎＷ）、典型的なデータレート毎秒２０ギガビット（Ｇｂ／ｓ）以上、動作温度約４ケルビンの超伝導ジョセフソン接合（ＪＪ）を利用した超伝導ベースの単一磁束量子回路が挙げられる。
【０００４】
インバータは、入力信号を出力に反転できる電気回路デバイスである。極性インバータは、ある程度の大きさを有する正の入力値を反転させて出力信号を生成するように入力信号の極性を反転させるか、または、入力値と大きさが等しく、符号または極性が反対の負の入力値を有する出力状態を生成するものである。２つの論理センスのみを有するデジタルロジックのコンテキストでは、論理インバータは、論理入力を、論理入力の反対の論理センスを有する論理出力に反転することができるゲートである。したがって、反転した「ロー」または「０」の論理入力は「ハイ」または「１」の論理出力を提供し、その逆も同様である。極性インバータは、多くの場合、論理反転に関連するバイナリ状態よりも多くの状態、例えば３つ以上の状態を含むように、入力信号の極性を反転させることができる。
【発明の概要】
【０００５】
一例は、ジョセフソンインバータゲート回路を提供する。回路は、少なくとも１つの単一磁束量子（ＳＦＱ）パルスを含む入力信号を供給する入力と、入力信号を出力に伝播し、入力信号を出力信号に反転するように配置された少なくとも４つのジョセフソン接合を含む半ねじれジョセフソン伝送線路（ＪＴＬ）と、を含む。半ねじれＪＴＬは、中央ループを有することができる。インバータゲート回路は、極性インバータとすることができ、それにより、入力端ジョセフソン接合を２π超伝導相に設定する入力信号の出力への伝播時に、半ねじれＪＴＬの出力端ジョセフソン接合が−２π超伝導相を示し、入力端ジョセフソン接合を０超伝導相にリセットする入力信号の出力への伝播時に、出力端ジョセフソン接合が０超伝導相を示す。あるいは、インバータゲート回路は、論理インバータとすることができ、それにより、過渡的起動期間の後、入力端ジョセフソン接合を２π超伝導相に設定する入力信号の出力への伝播時に、出力端ジョセフソン接合が０超伝導相を示し、入力端ジョセフソン接合を０超伝導相にリセットする入力信号の出力への伝播時に、出力端ジョセフソン接合が２π超伝導相を示す。
【０００６】
別の例は、ＳＦＱパルス入力に基づいて信号値を論理的に反転する方法を提供する。第１の正のＳＦＱパルスは、半ねじれＪＴＬの入力端に供給されて、半ねじれＪＴＬの入力側ジョセフソン接合（すなわち、半ねじれＪＴＬの出力端よりも半ねじれＪＴＬの入力端に近いジョセフソン接合）を２π超伝導相に設定する。第１の正のＳＦＱパルスを供給する前または後に、ただし第１の正のＳＦＱパルスが半ねじれＪＴＬの中央ループを通じて出力に向かって伝播し得る前に、１つのΦ０の電流が初期化電流として中央ループに注入され、それにより、第１の正のＳＦＱパルスは、初期化電流によって消滅し、中央ループを通じて半ねじれＪＴＬの出力端に向かって伝播しないようにする。これは、入力側ジョセフソン接合の超伝導相には影響しない。次に、負のＳＦＱパルスが半ねじれＪＴＬの入力端に供給されて、入力側ジョセフソン接合を０超伝導相にリセットし、それにより、負のＳＦＱパルスが、半ねじれＪＴＬの出力端に伝播して、半ねじれＪＴＬの出力側ジョセフソン接合（すなわち、半ねじれＪＴＬの入力端よりも半ねじれＪＴＬの出力端に近いジョセフソン接合）の超伝導相を２πに設定する。この方法は、第２の正のＳＦＱパルスを半ねじれＪＴＬの入力端に供給して、入力側ジョセフソン接合を２π超伝導相に設定し、それにより、第２の正のＳＦＱパルスが、半ねじれＪＴＬの出力端に伝播して、出力側ジョセフソン接合の超伝導相を０にリセットすることにより続行できる。
【０００７】
別の例は、ＳＦＱパルス入力に基づいて信号値を論理的に反転する別の方法を提供する。第１の正のＳＦＱパルスは、ＪＴＬの中央部分にフローティングジョセフソン接合を有するＪＴＬの入力端に供給されて、ＪＴＬの入力側ジョセフソン接合を２π超伝導相に設定する。第１の正のＳＦＱパルスを提供する前または後に、ただし第１の正のＳＦＱパルスがＪＴＬの中央部分を通じて出力に向かって伝播し得る前に、Φ０／２の電流が初期化電流としてフローティングジョセフソン接合に注入され、それにより、第１の正のＳＦＱパルスは、初期化電流によって消滅し、中央部分を通じてＪＴＬの出力端に向かって伝播しないようにする。これは、入力側ジョセフソン接合の超伝導相には影響しない。次に、負のＳＦＱパルスがＪＴＬの入力端に供給されて、入力側ジョセフソン接合を０超伝導相にリセットし、それにより、負のＳＦＱパルスがＪＴＬの出力端に伝播して、ＪＴＬの出力側ジョセフソン接合の超伝導相を２πに設定する。この方法は、第２の正のＳＦＱパルスをＪＴＬの入力端に供給して、入力側ジョセフソン接合を２π超伝導相に設定し、それにより、第２の正のＳＦＱパルスが、ＪＴＬの出力端に伝播して、出力側ジョセフソン接合の超伝導相を０にリセットすることにより続行できる。
【０００８】
別の例は、ＳＦＱパルス入力に基づいて信号値を論理的に反転するさらに別の方法を提供する。第１の負のＳＦＱパルスは、半ねじれＪＴＬの出力端に供給されて、半ねじれＪＴＬの出力側ジョセフソン接合を２π超伝導相に設定する。第１の負のＳＦＱパルスを供給する前または後に、ただし第１の負のＳＦＱパルスが半ねじれＪＴＬの中央ループを通じて入力に向かって伝播し得る前に、１つのΦ０の電流が初期化電流として中央ループに注入され、それにより、第１の負のＳＦＱパルスは、初期化電流によって消滅し、中央ループを通じて半ねじれＪＴＬの入力端に向かって伝播しないようにする。これは、出力側ジョセフソン接合の超伝導相には影響しない。次に、正のＳＦＱパルスが半ねじれＪＴＬの入力端に供給されて、入力側ジョセフソン接合を２π超伝導相に設定し、それにより、第正のＳＦＱパルスが、半ねじれＪＴＬの出力端に伝播して、半ねじれＪＴＬの出力側ジョセフソン接合の超伝導相を０に設定する。この方法は、第２の負のＳＦＱパルスを半ねじれＪＴＬの入力端に供給して、入力側ジョセフソン接合を０超伝導相にリセットし、それにより、第２の負のＳＦＱパルスが、半ねじれＪＴＬの出力端に伝播して、出力側ジョセフソン接合の超伝導相を２πに設定することにより続行できる。
【０００９】
別の例は、ＳＦＱパルス入力に基づいて信号値を論理的に反転するさらに別の方法を提供する。第１の負のＳＦＱパルスは、ＪＴＬの中央部分にフローティングジョセフソン接合を有するＪＴＬの出力端に供給されて、ＪＴＬの出力側ジョセフソン接合を２π超伝導相に設定する。第１の負のＳＦＱパルスを提供する前または後に、ただし第１の負のＳＦＱパルスがＪＴＬの中央部分を通じて入力に向かって伝播し得る前に、Φ０／２の電流が初期化電流としてフローティングジョセフソン接合に注入され、それにより、第１の負のＳＦＱパルスは、初期化電流によって消滅し、中央部分を通じてＪＴＬの入力端に向かって伝播しないようにする。これは、出力側ジョセフソン接合の超伝導相には影響しない。次に、正のＳＦＱパルスがＪＴＬの入力端に供給されて、入力側ジョセフソン接合を２π超伝導相に設定し、それにより、第正のＳＦＱパルスが、ＪＴＬの出力端に伝播して、ＪＴＬの出力側ジョセフソン接合の超伝導相を０にリセットする。この方法は、第２の負のＳＦＱパルスをＪＴＬの入力端に供給して、入力側ジョセフソン接合を０超伝導相にリセットし、それにより、第２の負のＳＦＱパルスが、ＪＴＬの出力端に伝播して、出力側ジョセフソン接合の超伝導相を２πに設定することにより続行できる。
【００１０】
さらに別の例は、入力端、出力端、および入力端と出力端とを接続する中央部分から構成される超伝導逆量子論理（ＲＱＬ）インバータ回路を提供する。中央部分は、少なくとも２つのＪＪを含む中央ループ、および／または１つのΦ０の電流を注入するように構成された変圧器結合ＤＣ磁束バイアス注入源と直列のフローティングジョセフソン接合のうちの少なくとも１つを含む。入力端は、入力ノードと第１のノードとの間に接続された第１のインダクタと、第１のノードと回路接地との間に接続された第１のジョセフソン接合と、第１のノードと第２のノードとの間に接続された第２のインダクタと、第２のノードと第３のノードとの間に接続された第２のジョセフソン接合と、第３のノードと回路接地との間に接続された第３のインダクタと、を含む。出力端は、第４のノードと回路接地との間に接続された第４のインダクタと、第４のノードと第５のノードとの間に接続された第３のジョセフソン接合と、第５のノードと第６のノードとの間に接続された第５のインダクタと、第６のノードと回路接地との間に接続された第４のジョセフソン接合と、第６のノードと出力ノードとの間に接続された第６のインダクタと、を含む。
【００１１】
さらに別の例は、ジョセフソンインバータゲート回路を提供する。回路は、少なくとも１つの単一磁束量子（ＳＦＱ）パルスを含む入力信号を供給する入力と、入力信号を出力に伝播し、入力信号を出力信号に反転するように配置された少なくとも５つのジョセフソン接合を含むＪＴＬと、を含み、そのうちの１つは、ＪＴＬの中央にあるフローティングジョセフソン接合である。インバータゲート回路は、フローティングジョセフソン接合に初期化電流を供給する単一のＤＣ磁束バイアス入力を有することができる。インバータゲート回路は、第１の例に関して定義されたように、極性インバータまたは論理インバータとすることができる。
【００１２】
さらに別の例は、入力端、出力端、および入力端と出力端とを接続する中央部分で構成される超伝導逆量子論理（ＲＱＬ）インバータ回路を提供し、中央部分は、フローティングジョセフソン接合と、１つのΦ０の電流を注入するように構成された変圧器結合ＤＣ磁束バイアス注入源と、を含む。入力端は、入力ノードと第１のノードとの間に接続された第１のインダクタと、第１のノードと回路接地との間に接続された第１のジョセフソン接合と、第１のノードと第２のノードとの間に接続された第２のインダクタと、第２のノードと第３のノードとの間に接続された第３のインダクタと、第３のノードと回路接地との間に接続された第２のジョセフソン接合と、を含む。出力端は、第５のノードと回路接地との間に接続された第３のジョセフソン接合と、第５のノードと第６のノードとの間に接続された第７のインダクタと、第６のノードと第７のノードとの間に接続された第８のインダクタと、第７のノードと回路接地との間に接続された第４のジョセフソン接合と、第７のノードと出力ノードとの間に接続された第１０のインダクタと、を含む。回路は、それぞれがＡＣ成分を有するバイアス信号を供給する２つのバイアス入力をさらに含むことができ、第１のバイアス入力が、第２のノードで回路に接続された第４のインダクタを介して接続され、第２のバイアス入力が、第６のノードで回路に接続された第９のインダクタを介して接続される。
【図面の簡単な説明】
【００１３】
【図１Ａ】半ねじれジョセフソン伝送線路（ＪＴＬ）を有する例示的なジョセフソンインバータゲートのブロック図である。
【図１Ｂ】フローティングジョセフソン接合を含むＪＴＬを有する別の例示的なジョセフソンインバータゲートのブロック図である。
【図３Ａ】半ねじれＪＴＬを使用した例示的なジョセフソン極性インバータゲートの回路図である。
【図３Ｂ】図３Ａの例示的なゲートのシミュレーション結果のグラフである。
【図３Ｃ】例示的な回路の機能を示す図３Ａの例示的なジョセフソン極性インバータゲートの注釈付き回路図である。
【図３Ｄ】例示的な回路の機能を示す図３Ａの例示的なジョセフソン極性インバータゲートの注釈付き回路図である。
【図３Ｅ】例示的な回路の機能を示す図３Ａの例示的なジョセフソン極性インバータゲートの注釈付き回路図である。
【図３Ｆ】例示的な回路の機能を示す図３Ａの例示的なジョセフソン極性インバータゲートの注釈付き回路図である。
【図３Ｇ】例示的な回路の機能を示す図３Ａの例示的なジョセフソン極性インバータゲートの注釈付き回路図である。
【図４Ａ】半ねじれＪＴＬを使用した例示的なジョセフソン論理インバータゲートの回路図である。
【図４Ｂ】図４Ａの例示的なゲートのシミュレーション結果のグラフである。
【図４Ｃ】回路の第１の機能例を示す図４Ａの例示的なジョセフソン論理インバータゲートの注釈付き概略図である。
【図４Ｄ】回路の第１の機能例を示す図４Ａの例示的なジョセフソン論理インバータゲートの注釈付き概略図である。
【図４Ｅ】回路の第１の機能例を示す図４Ａの例示的なジョセフソン論理インバータゲートの注釈付き概略図である。
【図４Ｆ】回路の第１の機能例を示す図４Ａの例示的なジョセフソン論理インバータゲートの注釈付き概略図である。
【図４Ｇ】回路の第１の機能例を示す図４Ａの例示的なジョセフソン論理インバータゲートの注釈付き概略図である。
【図４Ｈ】回路の第１の機能例を示す図４Ａの例示的なジョセフソン論理インバータゲートの注釈付き概略図である。
【図４Ｉ】回路の第１の機能例を示す図４Ａの例示的なジョセフソン論理インバータゲートの注釈付き概略図である。
【図４Ｊ】回路の第１の機能例を示す図４Ａの例示的なジョセフソン論理インバータゲートの注釈付き概略図である。
【図４Ｋ】回路の第２の機能例を示す、図４Ａの例示的なジョセフソン論理インバータゲートの注釈付き概略図である。
【図４Ｌ】回路の第２の機能例を示す、図４Ａの例示的なジョセフソン論理インバータゲートの注釈付き概略図である。
【図４Ｍ】回路の第２の機能例を示す、図４Ａの例示的なジョセフソン論理インバータゲートの注釈付き概略図である。
【図４Ｎ】回路の第２の機能例を示す、図４Ａの例示的なジョセフソン論理インバータゲートの注釈付き概略図である。
【図４Ｏ】回路の第２の機能例を示す、図４Ａの例示的なジョセフソン論理インバータゲートの注釈付き概略図である。
【図４Ｐ】回路の第２の機能例を示す、図４Ａの例示的なジョセフソン論理インバータゲートの注釈付き概略図である。
【図４Ｑ】回路の第２の機能例を示す、図４Ａの例示的なジョセフソン論理インバータゲートの注釈付き概略図である。
【図４Ｒ】回路の第２の機能例を示す、図４Ａの例示的なジョセフソン論理インバータゲートの注釈付き概略図である。
【図５】半ねじれＪＴＬと直接結合を使用した例示的なジョセフソン論理インバータゲートの回路図である。
【図６】半ねじれＪＴＬを使用した例示的なジョセフソン論理インバータゲートの別の回路図である。
【図７】フローティングジョセフソン接合を含むＪＴＬを使用したジョセフソン極性インバータゲートの回路図である。
【図８】フローティングジョセフソン接合を含むＪＴＬを使用したジョセフソン論理インバータゲートの回路図である。
【図９】正の中央ＤＣ磁束バイアスを有する図８の例示的な論理インバータゲートのシミュレーション結果のグラフである。
【図１０】負の中央ＤＣ磁束バイアスを有する図８の例示的な論理インバータゲートのシミュレーション結果のグラフである。
【図１１Ａ】単一磁束量子（ＳＦＱ）パルス入力に基づいて信号値を論理的に反転する方法を示すフローチャートである。
【図１１Ｂ】単一磁束量子（ＳＦＱ）パルス入力に基づいて信号値を論理的に反転する方法を示すフローチャートである。
【発明を実施するための形態】
【００１４】
ＣＭＯＳ技術における反転には、概して、低電圧から高電圧への変換、またはその逆の変換が含まれる。位相モードロジック（ＰＭＬ）を使用する回路での信号の反転では、ＰＭＬ回路において論理状態はジョセフソン接合などの超伝導相として符号化され、このような位相が回路を伝播する正または負のパルス、例えば単一磁束量子（ＳＦＱ）パルスで設定またはリセットされるため、より困難な問題が発生する。符号化パラダイムの違いは、ＣＭＯＳ反転方法の手法および構造がＰＭＬ反転の実現に役立つものではないことを意味しており、シンプルで効果的なＰＭＬインバータを実装するには、新しい手法および構造を考案する必要がある。逆量子論理（ＲＱＬ）超伝導論理回路のファミリからの回路などの位相モード回路で信号反転を実現するための既存の手法は、極性反転変圧器と後続の論理「ハイ」に初期化するＪＴＬの使用に依存している。ただし、変圧器は物理的に大きく、高効率とする必要がある。
【００１５】
したがって、本開示は、概して、超伝導システムで使用するための論理ゲート回路に関する。いくつかの例では、１入力１出力の超伝導インバータゲートは、位相モード論理入力の極性反転を提供することができる。他の例では、１入力１出力の超伝導インバータゲートは、位相モード論理入力の論理反転を提供することができる。したがって、例えば、「ロー」および「ハイ」の論理状態がジョセフソン接合の０および２π超伝導相としてそれぞれ符号化される場合、ＲＱＬ超伝導回路などの超伝導回路のゲートは、ゲート入力の正のＳＦＱパルスに応答するゲート出力の負のＳＦＱパルス、およびゲート入力の負のＳＦＱパルスに応答するゲート出力の正のＳＦＱパルスを送信するように構成することができる。これらのパルスは、対応する論理「ロー」または「ハイ」状態を符号化するジョセフソン接合の位相を設定またはリセットできる。本明細書で説明するインバータは、信号経路上に物理的に大きな高効率変圧器を必要としない。
【００１６】
図１Ａは、入力ＩＮ１０２および入力ＩＮ１０２の反転に対応する出力ＯＵＴ１０４を有する例示的なジョセフソンインバータゲート１００のブロック図である。ジョセフソンインバータゲート１００の構成に応じて、出力ＯＵＴ１０４は、入力ＩＮ１０２の極性反転または論理反転を提供することができる。インバータゲート１００は、半ねじれジョセフソン伝送線路（ＪＴＬ）１０６を含み、これは、少なくとも４つのジョセフソン接合（ＪＪ）１０８−１、１０８−２、１０８−３、１０８−４を含み、互いに逆位相の２つのＡＣバイアスライン１１０、１１２から入力を受け取る。「半ねじれＪＴＬ」とは、従来のＪＴＬの構造に半ねじれが適用されており、出力の接地基準が入力に対してＪＴＬの反対側にあり、半ねじれＪＴＬが、印加されたＳＦＱ電圧パルスの極性を反転させることを意味する。インバータゲート１００は、４つ以上のジョセフソン接合を含むことができる。インバータゲート１００はまた、システム起動時に半ねじれＪＴＬ１０６の初期化条件を確立するために供給され得る１つ以上のＤＣ入力１１４、１１６を含み得る。例えば、ＤＣ入力１１４、１１６はそれぞれ、Φ０／２相当の電流を半ねじれＪＴＬ１０６の中央ループに注入できる。いくつかの例では、２つのΦ０／２の電流を供給して、互いに打ち消しあうことができる。他の例では、２つのΦ０／２の電流を供給し、合計して完全なΦ０にして、１つの全体のΦ０相当の電流を中央ループに配置することができる。入力ＩＮ１０２および出力ＯＵＴ１０４に供給される信号は、アサートまたはデアサートされた論理状態にそれぞれ対応する正または負の単一磁束量子（ＳＦＱ）パルスから構成することができる。対応する入力および出力論理状態は、ＪＴＬジョセフソン接合１０８−１から１０８−４の超伝導相に記憶（すなわち、符号化）することができる。
【００１７】
図１Ｂは、入力ＩＮ１５２および入力ＩＮ１５２の反転に対応する出力ＯＵＴ１５４を有する別の例示的なジョセフソンインバータゲート１５０のブロック図である。ゲート１００と同様に、ジョセフソンインバータゲート１５０の構成に応じて、出力ＯＵＴ１５４は、入力ＩＮ１５２の極性反転または論理反転を提供することができる。インバータゲート１５０は、少なくとも４つのジョセフソン接合（ＪＪ）１０８−１、１０８−２、１０８−３、１０８−４、さらに、減衰振動フローティングジョセフソン接合１５８−５を含むＪＴＬ１５６を含む。このコンテキストでの「フローティング」とは、ジョセフソン接合端子のどちらも接地されていないことを意味する。ＪＴＬ１５６は、２つのＡＣバイアスライン１６０、１６２から入力を受け取り、これらは、必ずしも正確ではないが、機能的には互いに逆位相である。インバータゲート１５０は、４つ以上のジョセフソン接合を含むことができる。インバータゲート１５０はまた、システム起動時にＪＴＬ１５６の初期化条件を確立するために供給され得るＤＣ入力１６４を含み得る。例えば、ＤＣ入力１６４は、Φ０／２の電流をフローティングＪＪ１５８−５に注入することができる。入力ＩＮ１５２および出力ＯＵＴ１５４に供給される信号は、アサートまたはデアサートされた論理状態にそれぞれ対応する正または負の単一磁束量子（ＳＦＱ）パルスから構成することができる。対応する入力および出力論理状態は、ＪＴＬジョセフソン接合１５８−１から１５８−４の超伝導相に記憶（すなわち、符号化）することができる。
【００１８】
図２は、前述のように、ＡＣバイアスされたジョセフソン接合で構成される「半ねじれ」を備えたＪＴＬのトポロジ２００を示しており、誘導性相互接続が、ねじれ点２０２で電気的に接続せずにねじれ点２０２で交差する上部および下部の太線で示されている。トポロジ２００は、ＲＱＬデータ符号化に対応することができ、全ての正のＳＦＱパルスの後に負のパルスが続く。
【００１９】
ＪＴＬ２００の各端は、電圧ノードではなく誘導性相互接続である上部信号伝播側および下部接地側を有しており、適切な絶縁および入力と出力との間の利得がある。ＪＴＬ２００の半ねじれ２０２は、ＪＴＬ２００が入力から出力に進むにつれて信号伝播側が接地側になることを意味する。入力ＲＱＬ  Ｉｎと出力ＲＱＬ  Ｏｕｔとの間の接続は誘導性であるため、トポロジ２００を短絡させることなく、入力の信号伝播側を出力で接地できる。各ジョセフソン接合は、ＡＣバイアス２０４、２０６、２０８、２１０によって提供されるバイアスによって部分的に規定される時間で局所的にトリガされ、信号が出力に伝播するまでに、電圧極性が反転する。半ねじれ２０２のため、ＡＣバイアス２０８および２１０は、ＡＣバイアス２０４、２０６とは方向が反対である（すなわち、ＡＣ位相が反転している）。論理ハイへの出力の初期化は、信号反転ステージ内で磁束バイアスを使用して実行できる（図２には図示せず）。
【００２０】
ＲＱＬ回路は、ＳＦＱパルスまたはそのようなパルスの列として論理変化を伝播する。したがって、信号の反転は、信号列を反転するためのＳＦＱパルスの作成または消滅を伴うように概念化されている可能性があるが、そのような機能の実装形態は物理的には困難である。したがって、論理信号をＳＦＱパルスで概念化するのではなく、論理状態は、論理要素として使用されるジョセフソン接合の超伝導相として概念化でき、位相は、全てのノードでの電圧の時間積分として定義される。トポロジ２００は、パルスを生成または消滅させようとする代わりに、入力と出力との間でジョセフソン接合位相極性を上下逆にするため、半ねじれＪＴＬトポロジ２００は、ハイ位相をロー位相に、またはその逆に変換し、それにより、端子ＲＱＬ  Ｉｎで供給される次に来るＳＦＱ電圧パルスの極性を反転することができる。図２は、８つのジョセフソン接合を有するものとして半ねじれＪＴＬ２００を示しているが、本開示によるインバータは、より少ないジョセフソン接合を用いて作製することができる。
【００２１】
図３Ａは、図２の半ねじれトポロジモデルに従う、直接結合を備えたＲＱＬ信号極性インバータ３００の、図３Ｂに示すシミュレーション結果プロットを伴う概略図を示す。ジョセフソン接合Ｊ１、Ｊ２、Ｊ３、Ｊ４の近くに配置されたドットを参照すると、正の入力パルスが出力に伝播した後の回路３００が最終状態で示されている。初期状態（図３Ｂの０ピコ秒付近）から、ジョセフソン接合Ｊ１、Ｊ２、Ｊ３、Ｊ４の全てが０超伝導相にあり、ＩＮＰＵＴラインで正のＳＦＱパルスとして供給される入力信号により、第１のジョセフソン接合Ｊ１がトリガ（２π超伝導相に配置）され、次に、第２のジョセフソン接合Ｊ２がトリガされ、次に、第３のジョセフソン接合Ｊ３がトリガされ、次に、第４のジョセフソン接合Ｊ４がトリガ（−２π超伝導相に配置）される。第４のジョセフソン接合Ｊ４は、各ジョセフソン接合近くのジョセフソン接合超伝導相ドットの相対配置によって図３Ａに示されるように、第１のジョセフソン接合Ｊ１のトリガと比較して「反対」の極性でトリガする。したがって、ＯＵＴＰＵＴラインは、ＩＮＰＵＴでの正のＳＦＱパルスに応答して負のＳＦＱパルスを送信し、その逆も同様である。
【００２２】
入力（例えば、第１のジョセフソン接合Ｊ１で測定される）および出力（例えば、第４のジョセフソン接合Ｊ４で測定される）における超伝導相は、図３Ｂのグラフにプロットされている。入力超伝導相は破線でプロットされ、出力超伝導相は実線でプロットされている。グラフからわかるように、入力超伝導相が０から２πに遷移した後（約２００ピコ秒付近）、短遅延時間で、出力超伝導相が０から−２πに遷移する。続いて、負のパルスが入力に到着して入力超伝導相を０に復元すると（約３５０ピコ秒付近）、出力超伝導相も０に戻る。次に、入力に別の正のパルスが到着して入力超伝導相を再び２π（約４００ピコ秒付近）に上げると、出力超伝導相は短い伝播時間後に再び−２π位相の極性反転を示す。その後、別の負のパルスが入力に到着して入力超伝導相を再び０にすると（約４５０ピコ秒付近）、出力超伝導相も０に戻る。したがって、図３Ｂのグラフは、図３Ａの極性インバータ３００の挙動を正確に特徴付けている。
【００２３】
さらに図３Ａに関して、第２および第３の接合Ｊ２およびＪ３は、回路３００の中心にある超伝導ループの一部である。ＡＣバイアス信号ＡＣＩＮおよびＡＣＯＵＴは、例えば、記号中の矢印の相対的なポインティングによって示されるように、大きさが等しく、必ずしも正確ではないが、機能的にはＡＣ位相が反対であるＡＣ正弦波信号であり得る。他の相対的なＡＣ位相割り当ても、動作回路３００をもたらすことができる。適切なバイアスを供給するために、ＤＣオフセット源ＤＣＩＮおよびＤＣＯＵＴは、それぞれ、変圧器結合Ｌ９／Ｌ１０およびＬ１１／Ｌ１２を介してジョセフソン接合Ｊ２およびＪ３によって共有される中央ループにΦ０／２の電流を置くことができ、Φ０は約２．０７ミリアンペア−ピコヘンリーに等しい。これらのΦ０／２磁束バイアスは、接地へのインダクタＬ３およびＬ４を考慮して、二重ウェル電位の対称性を維持するのに役立ち、回路は、インダクタＬ３およびＬ４を介して信号を直接グラウンドに送信することを補償するために、ＤＣ磁束バイアスなしで厳しい負荷がかけられる。しかしながら、回路３００では、中央ループに供給される任意の初期化電流に関して、２つのＤＣ源ＤＣＩＮおよびＤＣＯＵＴによって供給される機能的に等しく反対の電流が互いに打ち消しあう。第１の接合Ｊ１は、インダクタＬ３を通じて回路３００の底部で接地するのではなく、インダクタＬ４を通じて回路３００の上部で接地するように負荷がかけられる。図３Ａの極性インバータでは、信号経路に高効率変圧器がないことにさらに留意されたい。（ここで使用する「高効率」変圧器とは、結合係数ｋが０．５より大きい変圧器である。すなわち、ｋ＝Ｌｍ／√（ＬｐＬｓ）＞０．５であり、式中、Ｌｍは相互インダクタンスであり、ＬｐおよびＬｓは、一次インダクタおよび二次インダクタのそれぞれの自己インダクタンスである。回路３００では、Ｌ９／Ｌ１０変圧器およびＬ１１／Ｌ１２変圧器は信号経路にない。これは、一次インダクタＬ１０およびＬ１２が、信号振幅に関係なく任意の振幅を有し得るＤＣバイアスを送信するためである。）したがって、ＤＣバイアス電流の比例スケーリングを使用して、結合を任意に小さくすることができる。
【００２４】
図３Ｃから３Ｇは、図３Ａの極性反転回路３００の機能例を示す。図３Ｃは、極性インバータ３００の入力に導入されて電流３０２を生じさせる正の入力パルスを示す。これにより、第１のジョセフソン接合Ｊ１がトリガされ、図３Ｄの第１のジョセフソン接合Ｊ１の上に配置されたドットで示されているように、その超伝導相が０から２πに上昇する。第１のジョセフソン接合Ｊ１のトリガにより、機能的に等しく反対の電流３０４が初期入力パルス３０２を消滅させ、電流３０６を介して回路３００を通じて初期パルスを順方向に伝播し、次に第２のジョセフソン接合Ｊ２をトリガする。図３Ｅに示されるように、第２のジョセフソン接合Ｊ２のトリガは、別の消滅電流３０８および伝播電流３１０をもたらし、これにより、第３のジョセフソン接合Ｊ３がトリガされる。図３Ｆは、電流３１０と機能的に等しく反対であり、伝播電流３１４を引き起こす、消滅電流３１２の第３のトリガを示している。最後に、同じ方法で、第４のジョセフソン接合Ｊ４がトリガされ、３１６で電流３１４が消滅し、図３Ｇの出力から負のパルス３１８が伝播する。
【００２５】
したがって、正の入力パルス３０２は負の出力パルス３１８をもたらすことになる。図３Ｇの信号伝播ラインの反対側にある第４のジョセフソン接合Ｊ４のドットに示されているように、第４のジョセフソン接合Ｊ４は、図３Ｂに示されている極性反転機能と一致して、結論として−２π超伝導相にある。すなわち、入力が２πのとき、出力は−２πになる。同様に、回路３００の入力に導入される後続の負のパルスは、回路３００の出力から出る正のパルスになり、全てのジョセフソン接合Ｊ１〜Ｊ４を０超伝導相に戻す。
【００２６】
図４Ａは、図４Ｂに示される、直接結合を備えたＲＱＬ論理インバータの、付随するシミュレーション結果プロットを伴う概略図を示す。図４Ａの論理インバータは、図３Ａの極性インバータ３００と同様であるが、入力および出力を反対の論理状態に初期化することができ、例えば、入力をハイに初期化することができる。この初期化は、図３Ａの回路３００と比較して、２つのＤＣ磁束バイアスのうちの１つ（図示の場合ではＤＣＯＵＴ）の極性を逆にすることによって部分的に実行することができる。
【００２７】
一例として、システムの起動時に、最初の正の入力ＳＦＱパルスをＩＮＰＵＴラインに導入でき、その後すぐに、入力信号が回路４００を通じてＯＵＴＰＵＴラインに伝播し得る前に、ＤＣＩＮおよびＤＣＯＵＴバイアスが印加され、一緒に、ジョセフソン接合Ｊ２およびＪ３を含む中央ループへの１つの完全なΦ０の電流が注入される。第１の正の入力パルスが先に導入されていないと、注入された中央ループ電流によって不安定な状態が発生する可能性がある。なぜならば、他のＪＴＬと同様に、Φ０の電流を受け取ったジョセフソン接合はそれを渡そうとするが、それが入力に戻される（すなわち、第２のジョセフソン接合Ｊ２から第１のジョセフソン接合Ｊ１に戻る）のか、出力に（すなわち、第３のジョセフソン接合Ｊ３から第４のジョセフソン接合Ｊ４へ）渡されるのかは不明だからである。中央ループに完全なΦ０の電流を注入する直前に第１の正の入力ＳＦＱパルスを供給することにより、正の入力パルスは、機能的に等しく反対の中央ループ電流によって「食われ」（消滅し）、出力側ジョセフソン接合Ｊ３とＪ４の超伝導相を、初期の０超伝導相（例えば、論理「ロー」状態）から変更することなく、入力側ジョセフソン接合Ｊ１およびＪ２を２π超伝導相（例えば、論理「ハイ」状態）に保持する。したがって、初期化ＤＣ注入パルスが出力に伝播される可能性は、回路４００に第１の入力パルスを供給した後、適時にＤＣＩＮおよびＤＣＯＵＴ初期化電流をオンにすることによって回避できる。
【００２８】
図４Ｃ−４Ｊにより完全に示されている上記の初期化の例は、図４Ｂのプロットでは、同期間中に出力を変更することなく、ＤＣ磁束バイアスターンオンに関連する初期入力信号（すなわち、正のＳＦＱパルス）の供給によってトリガされる入力ジョセフソン接合位相の過渡期４４０として現れる。その後、後続の負のＳＦＱパルスが入力（約５０ピコ秒付近）に供給されると、出力が初めて論理「ハイ」になる。初期化中の入力側ジョセフソン接合Ｊ１およびＪ２の過渡２π超伝導相は、ジョセフソン接合Ｊ１およびＪ２の点描で満たされた超伝導相ドットによって図４Ａに示されている。入力でのハイからローへの、および出力でのローからハイへ（約５０ピコ秒付近）遷移は、図４Ａのジョセフソン接合Ｊ１およびＪ２の近くの中実ドットによって示されている。これらのドットは、ジョセフソン接合の点描で満たされた超伝導相ドットとは反対側に配置されているが、これらは０超伝導相への復元を示すことのみを意図しており、ジョセフソン接合が−２π超伝導相に遷移したことを意味するものではない。
【００２９】
入力に正のパルスを導入すると（約２００ピコ秒付近）、入力ジョセフソン接合超伝導相が０から２πに上昇し、出力ジョセフソン接合超伝導相が短い伝播時間の後に２πから０に低下する。入力（３５０ピコ秒付近）で負のパルスが発生すると、入力ジョセフソン接合超伝導相が２πから０に低下し、逆に、出力ジョセフソン接合超伝導相が０から２πに上昇する。入力に導入された第２の正のパルス（約４００ピコ秒付近）により、入力ジョセフソン接合超伝導相が再び０から２πに上昇し、逆に、出力ジョセフソン接合超伝導相が再び２πから０に低下する。入力（約４５０ピコ秒付近）に到達する第２の負のパルスが発生すると、入力ジョセフソン接合超伝導相が再び２πから０に低下し、逆に、出力ジョセフソン接合超伝導相が再び０から２πに上昇する。したがって、図４Ｂのプロットは、図４Ａの論理インバータ４００の挙動を正確に特徴付けている。
【００３０】
図４Ｂに示されていない、図４Ａの回路の別の初期化の例として、システムの起動時に、最初の負のＳＦＱパルスをＯＵＴＰＵＴラインを介して導入でき、その後すぐに、信号が回路４００を通じてＩＮＰＵＴラインに伝播し得る前に、ＤＣＩＮおよびＤＣＯＵＴバイアスが印加され、ジョセフソン接合Ｊ２およびＪ３を含む中央ループへの１つの完全なΦ０の電流が注入される。負のパルスは、機能的に等しく反対の中央ループ電流によって「食われ」（消滅し）、入力側ジョセフソン接合Ｊ１とＪ２の超伝導相を、初期の０超伝導相（例えば、論理「ロー」状態）から変更することなく、出力側ジョセフソン接合Ｊ３およびＪ４を２π超伝導相（例えば、論理「ハイ」状態）に保持する。この初期化の例は、図４Ｋ〜４Ｒにより完全に示されている。どちらの初期化の例でも、初期化パルスが印加される前または後にＤＣバイアスを印加できる。
【００３１】
図４Ｃ〜４Ｊは、図４Ａの論理インバータ回路４００の第１に説明された機能例を示し、初期化パルスは、ＩＮＰＵＴを通じて供給され、中央ループで「食われる」。図４Ｃは、論理インバータ４００のＩＮＰＵＴに導入されて電流４０２を生じさせる正の入力パルスを示す。これにより、第１のジョセフソン接合Ｊ１がトリガされ、図４Ｄの第１のジョセフソン接合Ｊ１の上に配置されたドットで示されているように、その超伝導相が０から２πに上昇する。第１のジョセフソン接合Ｊ１のトリガにより、機能的に等しく反対の電流４０４が初期電流４０２を消滅させ、電流４０６を介して回路４００を通じて初期パルスを順方向に伝播し、次に第２のジョセフソン接合Ｊ２をトリガする。図４Ｅに示されるように、第２のジョセフソン接合Ｊ２のトリガは、別の消滅電流４０８および伝播電流４１２をもたらす。
【００３２】
しかしながら、図３Ａの極性インバータ３００の機能とは対照的に、伝播電流４１２が回路を通じて伝播し得る前に、機能的に等しく反対の電流４１０がＤＣ電流源ＤＣＩＮおよびＤＣＯＵＴによって回路４００の中央ループに引き起こされ、第３のジョセフソン接合Ｊ３をトリガさせ得る前に電流４１２を消滅させる。したがって、第１のジョセフソン接合Ｊ１の超伝導相が２πであるにもかかわらず、第４のジョセフソン接合Ｊ４の超伝導相は０のままである。前述したように、代替として、初期化電流４０２の入力の前に、ＤＣ源によって引き起こされる中央ループ電流４１０を導入することができる。
【００３３】
図４Ｅに続いて、図４Ｆは、電流４１４を引き起こすために回路４００のＩＮＰＵＴに印加される負の入力パルスの後続の導入を示す。したがって、図４Ｇでは、第１のジョセフソン接合Ｊ１は、電流４１６と機能的に等しく反対の消滅電流４１４をトリガ解除する。負の入力パルスは、負の電流４１８を介して伝播し、それにより、図４Ｈに示されるように、第２のジョセフソン接合Ｊ２がトリガ解除される。同時に、消滅電流４２０および伝播電流４２２は、第２のジョセフソン接合Ｊ２のトリガ解除によって生成され、この時点で、第１および第２のジョセフソン接合Ｊ１およびＪ２の両方が、初期超伝導相０を再び示す。
【００３４】
次に、第２のジョセフソンＪ２のトリガ解除および回路４００の中央ループを通じた負パルス４２２の伝播により、図４Ｉに示すように、第３のジョセフソン接合Ｊ３をトリガして、電流４２２を機能的に等しく反対の電流４２４で消滅させ、また、伝播電流４２６を引き起こす。図４Ｉを図３Ｆと比較すると、第３のジョセフソン接合Ｊ３は、極性インバータ構成３００と比較して、論理インバータ構成４００において反対方向にトリガされており、したがって、それぞれの図面の第３のジョセフソン接合Ｊ３の周りのドットの相対配置で示されているように、第３のジョセフソン接合Ｊ３は、図３Ｆで取得した−２π超伝導相と比較して、図４Ｉで２π超伝導相を取得している。最後に、同じ方法で、第４のジョセフソン接合Ｊ４がトリガして、それ自体の２π超伝導相を取得し、４２８が電流４２６を消滅させ、図４ＪのＯＵＴＰＵＴから電流４３０を介して正のパルスを伝播させる。
【００３５】
したがって、負の入力パルス４１４が正の出力パルス４３０をもたらすことになる。さらに、図４Ｊの信号伝播ラインの手前にある第４のジョセフソン接合Ｊ４のドットに示されているように、第４のジョセフソン接合Ｊ４は、このシーケンスの終端に２π超伝導相にあり、これは、図４Ｂに示される過渡期４４０の終端に対応する。上記の機能は、図４Ｂに示される極性反転機能と一致する。すなわち、入力が０のとき、出力は２πになる。同様に、回路４００のＩＮＰＵＴに導入された後続の正のパルスは、回路４００のＯＵＴＰＵＴから負パルスを発生させ、ジョセフソン接合Ｊ１およびＪ２を２π超伝導相に配置し、ジョセフソン接合３およびＪ４を０超伝導相に戻し、再び図４Ｂおよび所望の極性インバータ機能と一致する。
【００３６】
図４Ｋ〜４Ｒは、図４Ａの論理インバータ回路４００の第２に説明された機能例を示し、初期化パルスは、ＯＵＴＰＵＴを通じて供給され、中央ループで「食われる」。初期状態から、図４Ｋは、論理インバータ４００のＯＵＴＰＵＴに導入されて電流４５０を引き起こす負のパルスを示す。これにより、第４のジョセフソン接合Ｊ４がトリガされ、図４Ｌの第４のジョセフソン接合Ｊ４の下に配置されたドットで示されているように、その超伝導相が０から２πに上昇する。第４のジョセフソン接合Ｊ４のトリガにより、機能的に等しく反対の電流４５２が初期入力電流４５０を消滅させ、電流４５４を介して回路４００を通じて初期パルスを逆方向に伝播し、次に第３のジョセフソン接合Ｊ３をトリガする。図４Ｍに示されるように、第３のジョセフソン接合Ｊ３のトリガは、別の消滅電流４５６および伝播電流４６０をもたらす。
【００３７】
同様に、前述の機能に加えて、図４Ｅで前述したように、電流４６０はさらに伝播することはできないが、回路４００の中央ループにおいて、ＤＣ電流源ＤＣＩＮおよびＤＣＯＵＴによって回路４００によって中央ループに引き起こされる機能的に等しく反対の電流４５８によって「食われる」。したがって、第４のジョセフソン接合Ｊ４の超伝導相が２πであるにもかかわらず、第２のジョセフソン接合Ｊ２の超伝導相は０のままである。
【００３８】
図４Ｍに続いて、図４Ｎは、電流４６２を引き起こすために回路４００のＩＮＰＵＴに印加され正の入力パルスの後続の導入を示す。したがって、図４Ｏでは、第１のジョセフソン接合Ｊ１は、電流４６２と機能的に等しく反対の消滅電流４６４をトリガする。正の入力パルスは、正の電流４６６を介して伝播し、それにより、図４Ｐに示されるように、第２のジョセフソン接合Ｊ２がトリガされる。同時に、消滅電流４６８および伝播電流４７０は、第２のジョセフソン接合Ｊ２のトリガによって生成され、この時点で、４つのジョセフソン接合Ｊ１〜Ｊ４は全て２π超伝導相を示す。
【００３９】
次に、第２のジョセフソンＪ２のトリガおよび回路４００の中央ループを通じた正のパルス４７０の伝播により、図４Ｑに示すように、第３のジョセフソン接合Ｊ３をトリガ解除して、電流４７０を機能的に等しく反対の電流４７２で消滅させ、また、伝播電流４７４を引き起こす。図４Ｑを図４Ｉと比較すると、第３のジョセフソン接合Ｊ３は、前述の動作シーケンス（図４Ｃ〜４Ｊに示す）と比較して、この動作シーケンス（図４Ｋ〜４Ｒに示す）によって反対方向にトリガされており、したがって、それぞれの図面の第３のジョセフソン接合Ｊ３の周りのドットの相対配置で示されているように、ジョセフソン接合Ｊ３は、図４Ｉで示された２π超伝導相と比較して、図４Ｑで０超伝導相を示す。最後に、同じ方法で、第４のジョセフソン接合Ｊ４がトリガ解除して、それ自体の０超伝導相を示し、４７６が電流４７４を消滅させ、図４Ｒの論理インバータ回路４００のＯＵＴＰＵＴから負のパルス４７８を伝播させる。
【００４０】
したがって、正の入力パルス４６２は負の出力パルス４７８をもたらすことになる。さらに、図４Ｒの第４のジョセフソン接合Ｊ４の近くにドットがないことにより示されるように、第４のジョセフソン接合Ｊ４は、このシーケンスの終端に０超伝導相にある。上記の機能は、所望の極性インバータ機能と一致する。すなわち、入力が２πのとき、出力は０になる。同様に、回路４００のＩＮＰＵＴに導入された後続の負のパルスは、回路４００のＯＵＴＰＵＴから正のパルスを発生させ、ジョセフソン接合Ｊ１およびＪ２を０超伝導相に戻し、ジョセフソン接合Ｊ３およびＪ４を２π超伝導相に配置し、再び所望の極性インバータ機能と一致する。
【００４１】
図５は、各側の追加の接合、すなわちジョセフソン接合Ｊ５およびＪ６を使用した磁束バイアスの注入を有する直接結合を備えたＲＱＬ論理インバータ５００の例示的な概略図を示す。この実装形態は、「デジタル磁束バイアス」実装形態とも呼ばれ得る。この構成５００では、バイアスＤＣＩＮおよびＤＣＯＵＴは、ジョセフソン接合Ｊ５およびＪ６におけるそれぞれの２π位相前進をトリガする。回路５００の中央ループの左側で、Ｌ９分岐およびＪ５／Ｌ１０分岐のインダクタンスが類似している場合、ＤＣＩＮの値に対する感度を下げて、所望のΦ０／２磁束バイアスが取得される。同様に、回路５００の中央ループの右側で、Ｌ１２分岐およびＪ６／Ｌ１３分岐のインダクタンスが類似している場合、ＤＣＯＵＴの値に対する感度を下げて、所望のΦ０／２磁束バイアスが取得される。その他の点では、回路５００は、図４Ａの前述の論理インバータ４００と同様に動作し、入力ジョセフソン接合Ｊ１、Ｊ２対出力ジョセフソン接合Ｊ３、Ｊ４における反対の超伝導相は、所望の論理反転機能を達成するために、回路４００に関して既に説明したように回路５００で実現することができる。
【００４２】
図６は、前述の例と比較してより高い出力駆動を生成するＲＱＬ論理インバータ６００の例示的な概略図を示す。入力および出力は、前の例と比較して接地に関してより絶縁されているが、トレードオフにより、インバータ６００は前の例と比較してより高いコンポーネント数を有している。その他の点では、回路６００は、図４Ａの前述の論理インバータ４００と同様に動作し、入力ジョセフソン接合Ｊ１、Ｊ２対出力ジョセフソン接合Ｊ３、Ｊ４における反対の超伝導相は、所望の論理反転機能を達成するために、回路４００に関して既に説明したように回路６００で実現することができる。
【００４３】
図７は、トリガされたときに２つのＳＦＱパルスを生成する単一のフローティング接合ＪＦを使用し、次いで負極性で出力をトリガする（すなわち、正の入力信号が入力ジョセフソン接合Ｊ１を２π超伝導相にした後、出力ジョセフソン接合Ｊ４が−２π超伝導相を示す）例示的なＲＱＬ極性インバータ回路７００の概略図である同様に、図８は、負の入力信号が入力ジョセフソン接合Ｊ１を０超伝導相にした後、出力ジョセフソン接合Ｊ４が２π超伝導相を示すことを除いて同様に動作する、例示的なＲＱＬ論理インバータ回路８００の概略図である。したがって、回路７００および８００は、図２に概念的に示されている半ねじれＪＴＬ構造には依存しない。図８の論理インバータは、変圧器結合Ｌ１０／Ｌ９を通じて供給される回路の中央にあるＤＣ電流源の方向に関係なく機能することができ、そのため、論理インバータ８００と極性インバータ７００を区別するのは、実際にはＡＣＯＵＴに関連するＤＣオフセットの極性となる。極性インバータ７００において、上記ＤＣオフセットは−Φ０／２であるのに対し、論理インバータ８００において、上記ＤＣオフセットは＋Φ０／２である。極性インバータ７００のＡＣＯＵＴにおけるこの負のＤＣオフセットは、回路７００のＯＵＴＰＵＴ上の第１の遷移が負（０から−２πまで）になるようにする。いずれかの回路７００または８００において、ＡＣＩｎは＋Φ０／２のＤＣオフセットを有する。
【００４４】
回路７００および８００におけるフローティングジョセフソン接合ＪＦの動作は、ジョセフソン接合デバイスの振り子の機械的類推を参照して説明することができる。ジョセフソン接合の運動方程式は、中央の揺動点に吊り下げられた物理的な振り子の運動方程式と同型であり、振り子がこの中央の揺動点の周りを１回または複数回回転することを妨げるものはない。この類推では、ジョセフソン接合の超伝導相は振り子の機械的相に例えることができ、ジョセフソン接合の電流は、振り子のトルクに相当し、ジョセフソン接合の電圧は、振り子の角速度に類似し、回路のジョセフソン接合に関連するインダクタは、類推ではねじりばねになる。
【００４５】
振り子のようなジョセフソン接合は、発振器として機能することができる。多くの回路の実装形態では、ジョセフソン接合にダンピング抵抗が備えられているため、臨界減衰に近くなる。ジョセフソン接合は、振り子式箱型大時計の振り子のように前後に揺れ動くのではなく、トリガされると、「上限を超えて一周」して、２π超伝導相回転を行い、その後安定する。例えば、ダンピング抵抗の値を大きくするか、その抵抗を完全に削除する（開回路を作成するなど）ことにより減衰振動している場合は、次に、トリガされると、減衰振動ジョセフソン接合が「上限を超えて」転がり、振り子式箱型大時計のように振動し始め、２回、すなわち４π超伝導相まで転がることさえあり得る。
【００４６】
図７を参照すると、ＩＮＰＵＴラインに正のＳＦＱパルスを導入すると、第１のジョセフソン接合Ｊ１がトリガされ、続いて第２のジョセフソン接合Ｊ２がトリガされ、次に、フローティングジョセフソン接合ＪＦがトリガされる。フローティングジョセフソン接合ＪＦは、例えば、ジョセフソン接合をそのシャント抵抗なしで構成することにより、かつ、回路７００の中央にあるＤＣ電流源から供給される磁束バイアスを、Φ０／２の電流をフローティングジョセフソン接合Ｆに（すなわち、第２のジョセフソン接合Ｊ２、フローティングジョセフソン接合ＪＦ、インダクタＬ５、および第３のジョセフソン接合Ｊ３によって形成される中央ループに）注入するように構成することにより、一度転がってはまた転がる振り子のように、減衰振動となるように配置されている。フローティングジョセフソン接合ＪＦが初めてトリガされるとき、中央ループの電流は−Φ０／２になり、フローティングジョセフソン接合ＪＦに「負荷」をかけることなく別のポテンシャル井戸に入れて、フローティングジョセフソン接合ＪＦは開始時と同じエネルギーレベルに留まる。
【００４７】
したがって、フローティングジョセフソン接合ＪＦの「運動量」は、図７のフローティングジョセフソン接合ＪＦの近くにある二重ドットで示されるように、２回目に「上限を超えて」、すなわち４π超伝導相まで運ぶことができる。結果の状態は安定せず、ジョセフソン接合ＪＦのフローティングが負のトリガになる。結果として生じる負のパルスは回路７００を通って伝播し、それにより、入力側ジョセフソン接合Ｊ１およびＪ２での正の入力パルスおよび２π超伝導相により、出力側ジョセフソン接合Ｊ３およびＪ４が−２π超伝導相になり、負パルスがＯＵＴＰＵＴラインから伝播する。図７に示すように、出力ＡＣバイアス信号ＡＣＯＵＴは、入力ＡＣバイアス信号ＡＣＩＮと極性が正確に反対ではない（例えば、ＡＣ位相が１８０°異なる）場合に機能的になるように構成される。
【００４８】
図８の論理インバータ８００は、図８の極性インバータ７００と同様に機能して、フローティングジョセフソン接合ＪＦを利用して反転を提供する。ただし、図３Ａの極性反転回路３００と比較して図４Ａの論理反転回路４００と同様に、図８の論理反転回路８００は、極性反転ではなく論理反転を実行する。回路８００は、構造的にも機能的にも回路７００とは異なる。構造的には、極性インバータ７００の−Φ０／２とは対照的に、ＡＣＯＵＴは＋Φ０／２のＤＣオフセットを有するように構成されている。機能的には、回路８００は、図４Ａの回路４００の機能に関して説明したものと同様の初期化プロセスによって機能する。
【００４９】
一例として、正のＳＦＱパルスが回路８００のＩＮＰＵＴに導入された直後であって、それがフローティングジョセフソン接合ＪＦを通じて伝播できる前に、Φ０／２相当の初期化電流が、ソースＤＣおよび変圧器結合Ｌ１０／Ｌ９を介してフローティングジョセフソン接合ＪＦに導入されており、入力から出力に伝播するときに、初期化電流が次に来る正の入力ＳＦＱパルスを消滅させ、しかし、一方で、図８のジョセフソン接合Ｊ１およびＪ２における点描で満たされた超伝導相ドットによって示されるように、入力側ジョセフソン接合Ｊ１およびＪ２を２π超伝導相に維持している。ＩＮＰＵＴで導入される後続の負の入力ＳＦＱパルスは、入力側ジョセフソン接合Ｊ１およびＪ２を０超伝導相にリセットし、出力まで伝播して、出力側ジョセフソン接合Ｊ３およびＪ４を２π超伝導相に設定する。伝播遅延の影響を受けて、後続の交互の正と負の入力ＳＦＱパルスはそれぞれ、回路を論理反転させる。すなわち、入力接合が２π超伝導相を示しているとき、回路が出力接合で０超伝導相を示し、逆も同様である。入力でのハイからローへの、および出力でのローからハイへ（約５０ピコ秒付近）遷移は、図４Ａのジョセフソン接合Ｊ１およびＪ２の近くの中実ドットによって示されている。ジョセフソン接合Ｊ１およびＪ２の点描で満たされた超伝導相ドットの反対側に配置された中実ドットは、０超伝導相への復元を示すことのみを意図しており、ジョセフソン接合が−２π超伝導相に遷移したことを意味するものではない。
【００５０】
別の初期化の例として、負のＳＦＱパルスが回路８００のＯＵＴＰＵＴに導入された直後であって、それがフローティングジョセフソン接合ＪＦを通じて伝播できる前に、Φ０／２相当の初期化電流が、ソースＤＣおよび変圧器結合Ｌ１０／Ｌ９を介してフローティングジョセフソン接合ＪＦに導入されており、出力から入力に伝播するときに、初期化電流が次に来る負のＳＦＱパルスを消滅させ、しかし、一方で、出力側ジョセフソン接合Ｊ３およびＪ４を２π超伝導相に維持している。ＩＮＰＵＴで導入される後続の正のＳＦＱパルスは、入力側ジョセフソン接合Ｊ１およびＪ２を２π超伝導相に設定し、出力まで伝播して、出力側ジョセフソン接合Ｊ３およびＪ４を０超伝導相にリセットする。伝播遅延の影響を受けて、後続の交互の負と正の入力ＳＦＱパルスはそれぞれ、回路を論理反転させる。すなわち、入力接合が０超伝導相を示しているとき、回路が出力接合で２π超伝導相を示し、逆も同様である。
【００５１】
図９は、正の中央ＤＣ磁束バイアスを有する図８の例示的な論理インバータゲートのシミュレーション結果のグラフであり、図１０は、負の中央ＤＣ磁束バイアスを有する図８の例示的な論理インバータゲートのシミュレーション結果のグラフである。論理インバータ８００は、中央のＤＣ磁束バイアスが正または負のΦ０／２を導入するかどうかにかかわらず機能する。唯一の違いは、ターンオン過渡期１０００である。
【００５２】
図１１Ａおよび１１Ｂのフローチャートは、単一磁束量子（ＳＦＱ）パルス入力に基づいて信号値を論理的に反転する方法１１００、１１５０を示す。方法１１００、１１５０は、例えば、それぞれ図４Ａまたは図８の回路４００または８００のいずれかと共に使用することができる。図１１Ａの方法１１００では、第１の正のＳＦＱパルスは、１１０２でＪＴＬの入力端に供給されて、ＪＴＬの入力側ジョセフソン接合（ＪＪ）（すなわち、ＪＴＬの出力端よりもＪＴＬの入力端に近いジョセフソン接合）を２π超伝導相に設定する。ＪＴＬは、図４Ａの回路４００に示されるような半ねじれＪＴＬ、または図８の回路８００のように、中央にフローティングジョセフソン接合を有するＪＴＬのいずれかであり得る。入力ＳＦＱパルスが半ねじれＪＴＬの中央ループを通じて出力に伝播し得る前、または入力ＳＦＱパルスがＪＴＬの中央フローティングジョセフソン接合を通じて伝播し得る前に、該当する場合は１つのΦ０の電流が中央ループに注入されるか（１１０４）、または、例えば、１つ以上のＤＣバイアス電流をオンにすることにより、Φ０／２の電流が初期化電流としてフローティングジョセフソン接合に注入される（１１０６）。これにより、第１の正のＳＦＱパルスが初期化電流によって消滅するため、第１の正のＳＦＱパルスはＪＴＬの出力端まで伝播しない。ただし、入力側ジョセフソン接合の超伝導相は影響を受けず、２πのままである。あるいは、ＤＣバイアス電流をオンにして印加可能な量の電流を注入（１１０４、１１０６）することは、第１のＳＦＱパルスを供給する（１１０２）前に実行することができ、動作１１０２と１１０４／１１０６を並べ替えることができる。
【００５３】
次に、負のＳＦＱパルスがＪＴＬ（該当する場合は、半ねじれまたは中央フローティングジョセフソン接合を有する）の入力端に供給されて（１１０８）、入力側ジョセフソン接合を０超伝導相にリセットし、それにより、負の入力ＳＦＱパルスが、ＪＴＬの出力端に伝播して（１１１０）、出力側ジョセフソン接合（すなわち、ＪＴＬの入力端よりもＪＴＬの出力端に近いＪＴＬのジョセフソン接合）の超伝導相を２πに設定する。したがって、論理反転が提供される。
【００５４】
図１１Ａの方法１１００は、第２の正のＳＦＱパルスをＪＴＬ（半ねじれまたはその他）の入力端に供給して（１１１２）、入力側ジョセフソン接合を２π超伝導相に設定し、それにより、第２の正のＳＦＱパルスが、ＪＴＬの出力端に伝播して（１１１４）、出力側ジョセフソン接合の超伝導相を０にリセットすることをさらに含むことができる。これは、論理反転機能が正しく実装されていることを示している。
【００５５】
図１１Ｂの方法１１５０では、第１の負のＳＦＱパルスは、ＪＴＬの出力端に供給されて（１１５２）、ＪＴＬ内の出力側ジョセフソン接合を２π超伝導相に設定する。ＪＴＬは、図４Ａの回路４００に示されるような半ねじれＪＴＬ、または図８の回路８００のように、中央にフローティングジョセフソン接合を有するＪＴＬのいずれかであり得る。出力ＳＦＱパルスが半ねじれＪＴＬの中央ループを通じて入力に伝播し得る前、または出力ＳＦＱパルスがＪＴＬの中央フローティングジョセフソン接合を介して伝播し得る前に、該当する場合は１つのΦ０の電流が中央ループに注入されるか（１１５４）、または、例えば、１つ以上のＤＣバイアス電流をオンにすることにより、Φ０／２の電流が初期化電流としてフローティングジョセフソン接合に注入される（１１５６）。これにより、第１の負のＳＦＱパルスが初期化電流によって消滅するため、第１の負のＳＦＱパルスはＪＴＬの入力端まで伝播しない。ただし、出力側ジョセフソン接合の超伝導相は影響を受けず、２πのままである。あるいは、ＤＣバイアス電流をオンにして印加可能な量の電流を注入（１１５４、１１５６）することは、第１のＳＦＱパルスを供給する（１１５２）前に実行することができ、動作１１５２と１１５４／１１５６を並べ替えることができる。
【００５６】
次に、正のＳＦＱパルスがＪＴＬ（該当する場合は、半ねじれまたは中央フローティングジョセフソン接合を有する）の入力端に供給されて（１１５８）、入力側ジョセフソン接合を２π超伝導相に設定し、それにより、第正の入力ＳＦＱパルスが、ＪＴＬの出力端に伝播して（１１６０）、出力側ジョセフソン接合の超伝導相を０にリセットする。したがって、論理反転が提供される。あるいは、ＪＴＬの入力端に第１の正のパルスを提供（１１５２）するのではなく、印加される第１のパルス１１０２は、入力への第１の正のパルスの出力に印加される負のパルスであり得、互いに反対に初期化された入力および出力に到達するものは全て良好となる。
【００５７】
図１１Ｂの方法１１５０は、第２の負のＳＦＱパルスをＪＴＬ（半ねじれまたはその他）の入力端に供給して（１１６２）、入力側ジョセフソン接合を０超伝導相にリセットし、それにより、第２の負のＳＦＱパルスが、ＪＴＬの出力端に伝播して（１１６４）、出力側ジョセフソン接合の超伝導相を２πに設定することをさらに含むことができる。これは、論理反転機能が正しく実装されていることを示している。方法１１００または１１５０のいずれかは、様々な方法で修正できることが理解されよう。入力ジョセフソン接合と出力ジョセフソン接合が互いに反対の超伝導相を持つように初期化される（すなわち、他方が２πであるときに一方が０である、またはその逆）という結果をもたらす動作の再順序付けまたは変更は、その後、所望の論理的反転をもたらす。
【００５８】
上述の方法１１００、１１５０はまた、本開示において前述したように、適切なＡＣバイアスを供給してＪＴＬにおけるジョセフソン接合の適時のトリガを引き起こし、これにより入力から出力への信号伝播を引き起こす動作を含むことができる。
【００５９】
本明細書でゲート回路図および添付の説明によって記載される例示的なインバータゲートは、ＲＱＬデータ符号化を使用するジョセフソン回路の論理反転を実行することができる。これらは、論理反転の効率的な実装形態を実現すると同時に、信号経路に磁気変圧器を必要としない。
【００６０】
本明細書で説明するジョセフソンインバータゲートは、非常に優れたパラメトリック動作マージン、少ないコンポーネント数を備え、他のインバータの実装形態と比較して効率とコストの利点を提供する。本明細書で説明するジョセフソンインバータゲートは、その設計において高効率変圧器を排除することで、プロセスのステップ数および歩留まりを設定しコストを決定する製造プロセスにおいて、多くの金属層（２つの金属層など）を節約することができる。本明細書で説明するジョセフソンインバータゲートは、信号の位置を切り替えて出力で接地して信号の反転を生成することを含む、半ねじれＪＴＬ信号経路のアプローチ、または、信号ラインに非シャントフローティングジョセフソン接合を使用して、ＳＦＱ入力信号によってトリガされたときに２つのＳＦＱパルスを生成し、極性が逆の出力ＳＦＱ信号を生成するアプローチに従って製造することができる。図７および８に示すように、この後者の実装形態は、図３Ａおよび４Ａに示す半ねじれＪＴＬの実装形態よりも概略的に単純であるが、パラメトリック動作マージンが狭い。
【００６１】
上記で説明したのは、本発明の例である。当然、本発明を説明する目的でコンポーネントまたは方法の考えられる全ての組み合わせを説明することは不可能であるが、当業者は、本発明の多くのさらなる組み合わせおよび置換が可能であることを認識するであろう。したがって、本発明は、添付の特許請求の範囲を含む、本出願の範囲内にあるそのような全ての変更、修正、および変形を包含することが意図されている。さらに、本開示または請求項が「１つの（ａ）」、「１つの（ａｎ）」、「第１の」、「別の」要素、またはそれらの同等物を引用する場合、そのような要素を１つ以上含むと解釈されるべきであり、そのような要素を２つ以上必要とせず、除外もしない。本明細書で使用される場合、「含む（ｉｎｃｌｕｄｅｓ）」という用語は、限定することなく含むことを意味し、「含んでいる（ｉｎｃｌｕｄｉｎｇ）」という用語は、限定することなく含んでいることを意味する。「に基づく（ｂａｓｅｄ  ｏｎ）」という用語は、少なくとも部分的に基づくことを意味する。本明細書で使用される「機能的に等しい（ｆｕｎｃｔｉｏｎａｌｌｙ  ｅｑｕａｌ）」という用語は、説明されたインバータ機能が実現されるように十分に等しいことを意味し、必ずしも正確に等しいとは限らない。
【図１Ａ】
2021513238.tif 000003
【図１Ｂ】
2021513238.tif 000004
【図２】
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【図３Ａ】
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【図３Ｂ】
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【図３Ｃ】
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【図３Ｄ】
2021513238.tif 000009
【図３Ｅ】
2021513238.tif 000010
【図３Ｆ】
2021513238.tif 000011
【図３Ｇ】
2021513238.tif 000012
【図４Ａ】
2021513238.tif 000013
【図４Ｂ】
2021513238.tif 000014
【図４Ｃ】
2021513238.tif 000015
【図４Ｄ】
2021513238.tif 000016
【図４Ｅ】
2021513238.tif 000017
【図４Ｆ】
2021513238.tif 000018
【図４Ｇ】
2021513238.tif 000019
【図４Ｈ】
2021513238.tif 000020
【図４Ｉ】
2021513238.tif 000021
【図４Ｊ】
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【図４Ｋ】
2021513238.tif 000023
【図４Ｌ】
2021513238.tif 000024
【図４Ｍ】
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【図４Ｎ】
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【図４Ｏ】
2021513238.tif 000027
【図４Ｐ】
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【図４Ｑ】
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【図４Ｒ】
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【図５】
2021513238.tif 000031
【図６】
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【図７】
2021513238.tif 000033
【図８】
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【図９】
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【図１０】
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【図１１Ａ】
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【図１１Ｂ】
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【手続補正書】
【提出日】令和2年7月31日(2020.7.31)
【手続補正１】
【補正対象書類名】特許請求の範囲
【補正対象項目名】全文
【補正方法】変更
【補正の内容】
【特許請求の範囲】
【請求項１】
少なくとも１つの単一磁束量子（ＳＦＱ）パルスを含む入力信号を供給する入力と、
前記入力信号を出力に伝播し、前記入力信号を出力信号に反転するように配置された少なくとも４つのジョセフソン接合を含む半ねじれジョセフソン伝送線路（ＪＴＬ）と、を備える、ジョセフソンインバータゲート回路。
【請求項２】
前記半ねじれＪＴＬに少なくとも１つの初期化電流を供給するように構成された少なくとも１つのＤＣ入力をさらに備える、請求項１に記載の回路。
【請求項３】
前記半ねじれＪＴＬに少なくとも１つの初期化電流を供給するようにそれぞれ構成された少なくとも２つのＤＣ入力をさらに備える、請求項１に記載の回路。
【請求項４】
前記ＪＴＬが中央ループを含み、前記少なくとも２つのＤＣ入力が、それらのそれぞれの初期化電流を前記中央ループに供給するようにそれぞれ構成される、請求項３に記載の回路。
【請求項５】
それぞれがＡＣ成分を有するバイアス信号を供給する少なくとも２つのバイアス入力をさらに備える、請求項１に記載の回路。
【請求項６】
前記少なくとも２つのバイアス信号の第１の前記ＡＣ成分が、前記少なくとも２つのバイアス信号の第２の前記ＡＣ成分と１８０°位相がずれている、請求項５に記載の回路。
【請求項７】
前記半ねじれＪＴＬが、入力端および出力端を含み、
前記半ねじれＪＴＬの各端が、信号伝播側および接地側を含み、
前記入力端の前記信号伝播側が、前記出力端の前記接地側であり、前記入力端の前記接地側が、前記出力端の前記信号伝播側であり、
前記少なくとも４つのジョセフソン接合の各々が、前記半ねじれＪＴＬの前記端の一方の前記信号伝播側と前記接地側との間に接続される、請求項１に記載の回路。
【請求項８】
前記インバータゲート回路が、極性インバータであり、それにより、
前記半ねじれＪＴＬの前記入力端に最も近い前記少なくとも４つのジョセフソン接合のうちの前記１つを２π超伝導相に設定する入力信号の前記出力への伝播時に、前記半ねじれＪＴＬの前記出力端に最も近い前記少なくとも４つのジョセフソン接合のうちの前記１つが−２π超伝導相を示し、
前記半ねじれＪＴＬの前記入力端に最も近い前記少なくとも４つのジョセフソン接合のうちの前記１つを０超伝導相にリセットする入力信号の前記出力への伝播時に、前記半ねじれＪＴＬの前記出力端に最も近い前記少なくとも４つのジョセフソン接合のうちの前記１つが０超伝導相を示す、請求項１に記載の回路。
【請求項９】
前記半ねじれＪＴＬの中央ループに機能的に等しく反対の初期化電流を供給するように構成された少なくとも２つのＤＣ入力をさらに備える、請求項８に記載の回路。
【請求項１０】
前記インバータゲート回路が、論理インバータであり、それにより、過渡的起動期間の後、
前記半ねじれＪＴＬの前記入力端に最も近い前記少なくとも４つのジョセフソン接合のうちの前記１つを２π超伝導相に設定する入力信号の前記出力への伝播時に、前記半ねじれＪＴＬの前記出力端に最も近い前記少なくとも４つのジョセフソン接合のうちの前記１つが０超伝導相を示し、
前記半ねじれＪＴＬの前記入力端に最も近い前記少なくとも４つのジョセフソン接合のうちの前記１つを０超伝導相にリセットする入力信号の前記出力への伝播時に、前記半ねじれＪＴＬの前記出力端に最も近い前記少なくとも４つのジョセフソン接合のうちの前記１つが２π超伝導相を示す、請求項１に記載の回路。
【請求項１１】
前記半ねじれＪＴＬの中央ループに機能的に等しく、かつ同じ方向の初期化電流を供給するように構成された少なくとも２つのＤＣ入力をさらに備える、請求項１０に記載の回路。
【請求項１２】
前記中央ループが、前記少なくとも４つのジョセフソン接合に追加される第５および第６のジョセフソン接合を含む、請求項１１に記載の回路。
【請求項１３】
単一磁束量子（ＳＦＱ）パルス入力に基づいて信号値を論理的に反転する方法であって、前記方法が、
第１の正のＳＦＱパルスを半ねじれジョセフソン伝送線路（ＪＴＬ）の入力端に供給して、前記半ねじれＪＴＬの出力端よりも前記半ねじれＪＴＬの前記入力端に近い前記半ねじれＪＴＬの入力側ジョセフソン接合を２π超伝導相に設定することと、
前記第１の正のＳＦＱパルスを供給する前または後に、ただし前記第１の正のＳＦＱパルスが前記中央ループを通じて前記出力に伝播することができる前に、１つのΦ０の電流を初期化電流として前記半ねじれＪＴＬの中央ループに注入し、それにより、前記第１の正のＳＦＱパルスが、前記初期化電流によって消滅し、前記入力側ジョセフソン接合の前記超伝導相に影響を与えることなく、前記中央ループを通じて前記半ねじれＪＴＬの前記出力端に伝播しないようにすることと、
負のＳＦＱパルスを前記半ねじれＪＴＬの前記入力端に供給して、前記入力側ジョセフソン接合を０超伝導相にリセットし、それにより、前記負のＳＦＱパルスが、前記半ねじれＪＴＬの前記出力端に伝播して、前記半ねじれＪＴＬの前記入力端よりも前記半ねじれＪＴＬの前記出力端に近い前記半ねじれＪＴＬの出力側ジョセフソン接合の前記超伝導相を２πに設定することと、を含む、方法。
【請求項１４】
第２の正のＳＦＱパルスを前記半ねじれＪＴＬの前記入力端に供給して、前記入力側ジョセフソン接合を２π超伝導相に設定し、それにより、前記第２の正のＳＦＱパルスが、前記半ねじれＪＴＬの前記出力端に伝播して、前記出力側ジョセフソン接合の前記超伝導相を０にリセットすることをさらに含む、請求項１３に記載の方法。
【国際調査報告】
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