(57)【要約】本発明は、ＴＦＴ基板、ＥＳＤ保護回路およびＴＦＴ基板の製造方法に係り、本実施例におけるＴＦＴ基板は、ベース基板と、ベース基板に設けられる第１のゲートと、第１のゲートの上に設けられる第１の絶縁層と、第１の絶縁層に設けられるドレインと、ソースと、アクティブ層と、ドレイン、ソース、およびアクティブ層の上に設けられる第２の絶縁層と、第２の絶縁層の上に設けられる第２のゲートとを備える。これにより、液晶パネル画面の異常表示を防ぐことができる。【選択図】図４
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【特許請求の範囲】
【請求項１】
ベース基板と、
前記ベース基板に設けられる第１のゲートと、
前記第１のゲートの上に設けられる第１の絶縁層と、
前記第１の絶縁層の上に設けられるドレインと、ソースと、アクティブ層と、
前記ドレイン、前記ソース、および前記アクティブ層の上に設けられる第２の絶縁層と、
前記第２の絶縁層の上に設けられ、マイナスの電圧に接続されている第２のゲートとを備え、前記ドレインの少なくとも一部と前記ソースの少なくとも一部とが、前記アクティブ層の外端に離間して設けられ、かつ前記アクティブ層を介して接続されることを特徴とする、ＴＦＴ基板。
【請求項２】
請求項１に記載のＴＦＴ基板であって、前記第１のゲートおよび前記第２のゲートが前記アクティブ層までそれぞれの距離は同じであることを特徴とする、ＴＦＴ基板。
【請求項３】
請求項１に記載のＴＦＴ基板であって、前記第２のゲートの形状は、Ｕ字状であることを特徴とする、ＴＦＴ基板。
【請求項４】
請求項１に記載のＴＦＴ基板であって、前記アクティブ層の前記ベース基板への正射影は、前記第１のゲートの前記ベース基板への正射影を少なくとも部分的に覆っていることを特徴とする、ＴＦＴ基板。
【請求項５】
請求項１に記載のＴＦＴ基板であって、前記ドレインと前記ソースは階段状であり、前記アクティブ層の外端に対称に設けられていることを特徴とする、ＴＦＴ基板。
【請求項６】
請求項１に記載のＴＦＴ基板であって、前記第１のゲートと、前記第２のゲートとの形状およびサイズは同じであることを特徴とする、ＴＦＴ基板。
【請求項７】
請求項１乃至６のいずれか１項に記載のＴＦＴ基板を備えるＥＳＤ保護回路であって、前記ＴＦＴ基板は、第１のＴＦＴトランジスタと第２のＴＦＴトランジスタとを備え、第１のＴＦＴトランジスタのドレインはプラスの電圧信号に接続され、第２のＴＦＴトランジスタのソースはマイナスの電圧信号に接続され、第１のＴＦＴトランジスタのソースと、第１のＴＦＴトランジスタの第１のゲートと、第２のＴＦＴトランジスタのドレインと共にデータ信号に接続され、第２のＴＦＴトランジスタの第１のゲートは、ソースに接続されることを特徴とする、ＥＳＤ保護回路。
【請求項８】
請求項７に記載のＥＳＤ保護回路であって、前記第１のＴＦＴトランジスタの第２のゲートおよび前記第２のＴＦＴトランジスタの第２のゲートは、第２のＴＦＴトランジスタのソースにそれぞれ接続されることを特徴とする、ＥＳＤ保護回路。
【請求項９】
ＴＦＴ基板の製造方法であって、
Ｓ１１．ベース基板を準備し、前記ベース基板に第１のゲートを形成することと、
Ｓ１２．前記第１のゲートおよび前記基板に第１の絶縁層を形成し、前記第１の絶縁層は前記第１のゲートを完全に覆うことと、
Ｓ１３．前記第１の絶縁層にドレイン、ソースおよびアクティブ層を形成し、ドレインの少なくとも一部とソースの少なくとも一部とが、離間して前記アクティブ層の外端に設けられ、かつ前記アクティブ層を介して接続されていることと、
Ｓ１４．前記ドレイン、前記ソースおよび前記アクティブ層の上に第２の絶縁層を形成し、前記第２の絶縁層は前記ドレイン、前記ソースおよび前記アクティブ層を完全に覆うことと、
Ｓ１５．前記第２の絶縁層の上にマイナスの電圧に接続される第２のゲートを形成することとのステップを含むことを特徴とする、ＴＦＴ基板の製造方法。
【請求項１０】
請求項９に記載のＴＦＴ基板の製造方法であって、前記ステップＳ１１の内に、前記ベース基板に第１のゲートを形成することは、
前記ベース基板上に第１の金属層を堆積し、フォトリソグラフィプロセスによって前記第１の金属層をパターニングして第１のゲートを得ること、
または、
前記ベース基板上に第１のポリシリコン層を形成し、前記第１のポリシリコン層にＮ型ドーピングを実行し、次にフォトリソグラフィプロセスによって前記Ｎ型のドープされたポリシリコン層をパターニングして、第１のゲートを得ることを含むことを特徴とする、ＴＦＴ基板の製造方法。
【請求項１１】
請求項９に記載のＴＦＴ基板の製造方法であって、ステップＳ１３は、
化学的または物理的気相成長法によって前記第１の絶縁層上に半導体層を堆積し、フォトリソグラフィプロセスによって前記半導体層をパターニングして、アクティブ層を得ることと、
前記アクティブ層および前記第１の絶縁層に第２の金属層を堆積し、フォトリソグラフィプロセスによって前記第２の金属層をパターニングして、ソースおよびドレインを得ることと、または、前記アクティブ層および前記第１の絶縁層に第２のポリシリコン層を形成し、前記第２のポリシリコン層にＮ型ドーピングを実行し、次にフォトリソグラフィプロセスによって前記第２のポリシリコン層をパターニングして、ソースおよびドレインを得ることを含むことを特徴とする、ＴＦＴ基板の製造方法。
【請求項１２】
請求項９に記載のＴＦＴ基板の製造方法であって、前記ステップＳ１５は、
前記第２の絶縁層に第３の金属層を堆積し、フォトリソグラフィプロセスによって前記第３の金属層をパターニングして第２のゲートを得ること、
または、
前記第２の絶縁層に第３のポリシリコン層を形成し、前記第３のポリシリコン層にＮ型ドーピングを実行し、次にフォトリソグラフィプロセスによって前記Ｎ型のドープされたポリシリコン層をパターニングして、第２のゲートを得ることを含むことを特徴とする、ＴＦＴ基板の製造方法。
【請求項１３】
請求項１０乃至１２のいずれか１項に記載のＴＦＴ基板の製造方法であって、前記フォトリソグラフィプロセスは、フォトレジスト、露光、現像およびエッチングプロセスを含むことを特徴とする、ＴＦＴ基板の製造方法。
【発明の詳細な説明】
【技術分野】
【０００１】
本発明は、液晶ディスプレイの分野に関し、特に、ＴＦＴ基板、ＥＳＤ保護回路およびＴＦＴ基板の製造方法に関する。
【背景技術】
【０００２】
ＴＦＴ−ＬＣＤ（Ｔｈｉｎ  Ｆｉｌｍ  Ｔｒａｎｓｉｓｔｏｒ  Ｌｉｑｕｉｄ  Ｃｒｙｓｔａｌ  Ｄｉｓｐｌａｙ、薄膜トランジスタ液晶ディスプレイ）は、軽量、薄型、低消費電力などの利点があるため、テレビ、ノートパソコン、携帯電話などの機器に広く使用されている。
【０００３】
フラットパネルディスプレイデバイスとして、液晶ディスプレイの液晶パネルは、通常、２枚のガラス基板と、ガラス基板間の液晶層とからなる。下部ガラス基板に多数のデータ線と多数の走査線が集積されており、それらは垂直方向に交互に配置されて多数の単位領域を形成しており、これらの単位領域はピクセルユニットとして定義されている。各ピクセルユニットは、主にピクセル電極、ストレージコンデンサ、ＴＦＴトランジスタなどのデバイスを備える。走査線上の駆動信号は、ＴＦＴトランジスタの動作状態を制御することができ、それにより、データ線の駆動信号を適時にピクセル電極に書き込むことができる。上記ドライブアレイを構成するガラス基板は、一般的にＴＦＴ基板と呼ばれている。上部ガラス基板にブラックマトリクス、カラーフィルター層、共通電極層を一体化で集積している。上部ガラス基板にはカラーフィルター層が設けられているため、一般的にカラーフィルター基板とも呼ばれている。ＴＦＴ基板とカラーフィルム基板とを合わせて液晶表示基板と呼んでも良い。
【０００４】
しかしながら、液晶表示基板の製造工程においては、現像、エッチング、セル内への液晶配向、および搬送などの複数の工程により静電放電（Ｅｌｅｃｔｒｏ−Ｓｔａｔｉｃ  Ｄｉｓｃｈａｒｇｅ、略称ＥＳＤ）が発生する場合がある。静電気により発生した電荷により、ＴＦＴトランジスタデバイスや絶縁層が損傷され、液晶パネルの劣化や歩留まりに影響を与える。そのため、液晶パネルの設計においては、パネルに静電気を放電するための専用な経路や部品も設計されており、このような設計はＥＳＤ保護回路と呼んでも良い。
【０００５】
図１は、従来技術におけるＥＳＤ保護回路の概略構成図であり、このＥＳＤ保護回路では、ＴＦＴトランジスタＭ１のソースがＴＦＴトランジスタＭ２のドレインに接続され、ＴＦＴトランジスタＭ１のドレインがプラスの電圧（ＶＧＨ）に接続され、ＴＦＴトランジスタＭ２のソースはマイナスの電圧（ＶＧＬ）に接続され、また、ＴＦＴトランジスタＭ１のゲートはそのソースに並列に接続され、ＴＦＴトランジスタＭ２のゲートもそのソースに並列に接続されている。データ信号（Ｄａｔａ）は、ドライバＩＣにて生成されて対応するピクセル電極に出力され、また、外部から静電気が流入するのを防ぐため、途中にそのＥＳＤ保護回路を通している。静電気が発生すると、外部から静電気（−ＫＶの高電圧）が流れ込み、それぞれのＶＧＨ側とＶＧＬ側に放電する。ただし、このＥＳＤ保護回路では、ＴＦＴトランジスタ工程の初期ターンオン電圧の均一性が低いため、実際の製品のＴＦＴトランジスタの初期ターンオン電圧はマイナスの電圧に移動し、すなわち、ＴＦＴトランジスタの初期ターンオン電圧は０より小さい。図２を参照すると、２つのＴＦＴトランジスタＭ１およびＭ２は、初期ターンオン電圧がマイナスの電圧であるためにターンオンされ、それによって大きなリーク電流を生成する。データ信号が入ると、リーク電流により、データ信号（Ｄａｔａ）にはプラスの電圧（ＶＧＨ）が混在し、図３を示すように、ここで、実線はドライバＩＣから出力されるデータ信号を表し、破線はＥＳＤ保護回路を通じたデータ信号を表する。データ信号を用いて画素電極を駆動すると、データ信号に不要な電圧が混在するため、ピクセル電極の輝度が異常となり、液晶パネルの表示画面に異常が発生する。
【発明の概要】
【０００６】
本発明が解決しようとする技術的問題は、上記従来技術におけるＴＦＴトランジスタは、ターンオン電圧がゼロ以下であるため、静電気発生時に液晶パネルを異常表示させることである。
【０００７】
本発明がその技術的問題を解決するために採用する技術的解決策は、以下を含むＴＦＴ基板を構築することであり、それは：
ベース基板と、
前記ベース基板に設けられる第１のゲートと、
前記第１のゲートの上に設けられる第１の絶縁層と、
前記第１の絶縁層の上に設けられる、ドレインと、ソースと、アクティブ層と、
前記ドレイン、前記ソース、および前記アクティブ層の上に設けられる第２の絶縁層と、
前記第２の絶縁層の上に設けられ、マイナスの電圧に接続されている第２のゲートとを備え、前記ドレインの少なくとも一部と前記ソースの少なくとも一部とが、前記アクティブ層の外端に離間して設けられ、かつ前記アクティブ層を介して接続されることを特徴とする、ＴＦＴ基板。
好ましくは、前記第１のゲートおよび前記第２のゲートが前記アクティブ層までそれぞれの距離は同じである。
好ましくは、前記第２のゲートの形状は、Ｕ字状である。
好ましくは、前記アクティブ層の前記ベース基板への正射影は、前記第１のゲートの前記ベース基板への正射影を少なくとも部分的に覆っている。
好ましくは、前記ドレインと前記ソースは階段状であり、前記アクティブ層の両端と上端に対称に設けられている。
好ましくは、前記第１のゲートと、前記第２のゲートとの形状およびサイズは同じである。
【０００８】
本発明はまた、上記のＴＦＴ基板を備えるＥＳＤ保護回路を構築し、前記ＴＦＴ基板は、第１のＴＦＴトランジスタと第２のＴＦＴトランジスタとを備え、第１のＴＦＴトランジスタＭ１のドレインはプラスの電圧信号に接続され、第２のＴＦＴトランジスタのソースはマイナスの電圧信号に接続され、第１のＴＦＴトランジスタのソースと、第１のＴＦＴトランジスタの第１のゲートと、第２のＴＦＴトランジスタのドレインと共にデータ信号に接続され、第２のＴＦＴトランジスタの第１のゲートは、ソースに接続される。
好ましくは、前記第１のＴＦＴトランジスタの第２のゲートおよび前記第２のＴＦＴトランジスタの第２のゲートは、第２のＴＦＴトランジスタのソースにそれぞれ接続される。
【０００９】
本発明はまた、以下のステップを含む、ＴＦＴ基板を製造する方法を構築する。
Ｓ１１．ベース基板を準備し、前記ベース基板上に第１のゲートを形成することと、
Ｓ１２．前記第１のゲートおよび前記基板に第１の絶縁層を形成し、前記第１の絶縁層は前記第１のゲートを完全に覆うことと、
Ｓ１３．前記第１の絶縁層にドレイン、ソースおよびアクティブ層を形成し、ドレインの少なくとも一部およびソースの少なくとも一部は、離間して前記アクティブ層の外端に設けられ、前記アクティブ層を介して接続されていることと、
Ｓ１４．前記ドレイン、前記ソースおよび前記アクティブ層の上に第２の絶縁層を形成し、前記第２の絶縁層は前記ドレイン、前記ソースおよび前記アクティブ層を完全に覆うことと、
Ｓ１５．前記第２の絶縁層の上にマイナスの電圧に接続される第２のゲートを形成することとのステップを含むことを特徴とする、ＴＦＴ基板の製造方法。
好ましくは、前記ステップＳ１１の内に、前記ベース基板に第１のゲートを形成し、それは、
前記ベース基板上に第１の金属層を堆積し、フォトリソグラフィプロセスによって前記第１の金属層をパターニングして第１のゲートを得ること、
または、
前記ベース基板上に第１のポリシリコン層を形成し、前記第１のポリシリコン層にＮ型ドーピングを実行し、次にフォトリソグラフィプロセスによって前記Ｎ型のドープされたポリシリコン層をパターニングして、第１のゲートを得ることを含むことを特徴とする、ＴＦＴ基板の製造方法。
好ましくは、ステップＳ１３はさらに以下を含む。
化学的または物理的気相成長法によって前記第１の絶縁層上に半導体層を堆積し、フォトリソグラフィプロセスによって前記半導体層をパターニングして、アクティブ層を得ることと、
前記アクティブ層および前記第１の絶縁層に第２の金属層を堆積し、フォトリソグラフィプロセスによって前記第２の金属層をパターニングして、ソースおよびドレインを得ることと、または、前記アクティブ層および前記第１の絶縁層に第２のポリシリコン層を形成し、前記第２のポリシリコン層にＮ型ドーピングを実行し、次にフォトリソグラフィプロセスによって前記第２のポリシリコン層をパターニングして、ソースおよびドレインを得ることを含むことを特徴とする、ＴＦＴ基板の製造方法。
好ましくは、前記ステップＳ１５は以下を含む。
前記第２の絶縁層に第３の金属層を堆積し、フォトリソグラフィプロセスによって前記第３の金属層をパターニングして第２のゲートを得ること、
または、
前記第２の絶縁層に第３のポリシリコン層を形成し、前記第３のポリシリコン層にＮ型ドーピングを実行し、次にフォトリソグラフィプロセスによって前記Ｎ型のドープされたポリシリコン層をパターニングして、第２のゲートを得ることを含むことを特徴とする、ＴＦＴ基板の製造方法。
好ましくは、前記フォトリソグラフィプロセスは、フォトレジスト、露光、現像およびエッチングプロセスを含む。
【００１０】
本発明の技術的解決策の実施において、ＴＦＴ基板はダブルゲート構造を採用し、第２のゲートはマイナスの電圧に接続されるため、ＴＦＴトランジスタのターンオン電圧は正の方向に移動することができる。また、ＴＦＴトランジスタによってＥＳＤ保護回路を構築すると、静電気が発生しても、両方のＴＦＴトランジスタのターンオン電圧が０より大きいため、リーク電流は非常小さいため、無視してもよく、結果として、ドライバＩＣからピクセル電極に出力されるデータ信号は不要な電圧信号が混入せず、ピクセル電極の輝度異常が発生せず、液晶画面の異常を防ぐ。
【図面の簡単な説明】
【００１１】
本発明の発明例をより明確に例示するために、実施例の説明に使用される図面を以下に簡単に説明する。以下の説明における図面は、本発明のいくつかの実施例であることが過ぎないと明らかであり、当業者にとっては、これらの図面に基づいて他の図面を創造的な仕事をすることなく得ることもできる。図面では：
【図１】図１は、従来技術におけるＥＳＤ保護回路の回路構成図である。
【図２】図２は、静電気が発生したときの図１のＥＳＤ保護回路の概略図である。
【図３】図３は、静電気が発生したときの入力データ信号と出力データ信号の波形図である。
【図４】図４は、本発明におけるＴＦＴ基板の概略構成図である。
【図５】図５は、従来技術におけるＴＦＴトランジスタと本発明におけるＴＦＴトランジスタのターンオン電圧のシミュレーションの概略図である。
【図６】図６は、本発明におけるＥＳＤ保護回路の回路構成図である。
【図７】図７は、本発明におけるＴＦＴ基板の製造方法の実施例１のフローチャートである。
【発明を実施するための形態】
【００１２】
以下、添付図面を参照しながら、本発明の実施例について明確に説明する。尚、以下の実施例は、明らかに本発明を具体化した一例のみであって、本発明の技術的範囲を限定する性格を有さない。本発明の範囲から逸脱することなく本発明の実施例に基づいて当業者によって得られる他のすべての実施例も、本発明の範囲である。
【００１３】
図４は、本発明における基板の実施例１の概略構成図であり、本実施例のＴＦＴ基板は、積層に設けられているベース基板１１、第１のゲート１２、第１の絶縁層１３、ドレイン１４、ソース１５、アクティブ層１６、第２の絶縁層１７、および第２のゲート１８を備える。ここで、第１のゲート１２は、ベース基板１１に設けられており、その面積は、ベース基板１１よりも小さく、ベース基板１１の中央部に設けられていることが好ましい。第１の絶縁層１３は、第１のゲート１２の上に設けられ、ドレイン１４、ソース１５およびアクティブ層１６は第１の絶縁層１３の上に設けられ、また、ドレイン１４の少なくとも一部およびソース１５の少なくとも一部は、離間してアクティブ層１６の外端にアクティブ層１６を介して接続される。また、第２の絶縁層１７は、ドレイン１４、ソース１５およびアクティブ層１６の上に配置され、ドレイン１４、ソース１５およびアクティブ層１６を覆い、第２のゲート１８は、第２の絶縁層１７の上に設けられており、また、第２のゲート１８はマイナスの電圧に接続される。
【００１４】
また、本実施例では、アクティブ層１６のベース基板１１への正射影は、第１のゲート１２のベース基板１１への正射影を部分的に覆っている。もちろん、他の実施例では、第１のゲート１２のベース基板１１への正射影を完全に覆ってもよい。
【００１５】
また、ドレイン１４とソース１５は階段状であり、アクティブ層１６の両端と上端に対称に設けられている。もちろん、他の実施例では、ドレイン１４およびソース１５は他の形状を有してもよく、また、アクティブ層の左端および右端、下端または上端に設けられてもよい。
【００１６】
また、第２のゲート１８の形状は、Ｕ字状である。もちろん、他の実施例では、第１のゲート１２と第２のゲート１８との形状およびサイズは同じであってもよく、両者がアクティブ層１６までそれぞれの距離は同じであり、もちろん、両者の形状、サイズ、およびアクティブ層１６までそれぞれの距離は異なっても良い。
【００１７】
本実施例におけるＴＦＴ基板はダブルゲート構造を採用しており、第１のゲート１２と第２のゲート１８がアクティブ層の両側に分布している。第１のゲートに電圧が印加されると、導電性チャネルのオン電流が発生しつつ、第２のゲート１８がマイナスの電圧を印加するため、導電性チャネルの電流量が抑制され、さらに導電性チャネルの断面積の増加が防止され、すなわちＴＦＴトランジスタのターンオン電圧の増加に相当する。図５を参照しながら、第２のゲート１８を追加しない場合、ＴＦＴトランジスタのターンオン電圧は−５Ｖであり、第２のゲート１８を追加した場合、ＴＦＴトランジスタのターンオン電圧は正方向に移動して０Ｖとなる。
【００１８】
図６は、本発明におけるＥＳＤ保護回路の回路構成図であり、本実施例におけるＥＳＤ保護回路は、上記実施例で示したＴＦＴ基板を備え、また、このＴＦＴ基板は、第１のＴＦＴトランジスタＭ１と第２のＴＦＴトランジスタＭ２とを備え、ここで、第１のＴＦＴトランジスタＭ１のドレインはプラスの電圧信号（ＶＧＨ）に接続され、第２のＴＦＴトランジスタＭ２のソースはマイナスの電圧信号（ＶＧＬ）に接続され、第１のＴＦＴトランジスタＭ１のソースと、第１のＴＦＴトランジスタＭ１の第１のゲートと、第２のＴＦＴトランジスタＭ２のドレインと共にデータ信号（Ｄａｔａ）に接続され、第２のＴＦＴトランジスタＭ２の第１のゲートは、ソースに接続される。
【００１９】
好ましくは、第１のＴＦＴトランジスタＭ１の第２のゲートおよび第２のＴＦＴトランジスタＭ２の第２のゲートは、第２のＴＦＴトランジスタＭ２のソースにそれぞれ接続され、その結果、電圧源を追加せずに、既存のマイナスの電圧信号（ＶＧＬ）を利用して第１のＴＦＴトランジスタＭ１の第２のゲートと第２のＴＦＴトランジスタＭ２の第２のゲートとを接続する。
【００２０】
本実施例では、ドライバＩＣがデータ信号（Ｄａｔａ）を出力した後、ＥＳＤ保護回路を介してピクセル電極に出力されるが、静電気が発生すると、両方のＴＦＴトランジスタＭ１、Ｍ２のターンオン電圧が０より大きいため、リーク電流は非常小さいため、無視してもよく、結果として、データ信号（Ｄａｔａ）に不要なプラスの電圧信号（ＶＧＨ）が混入されないため、ピクセル電極に出力されるデータ信号（Ｄａｔａ）がより正確になり、ピクセル電極の輝度の異常な状態が発生しない。
【００２１】
図７は、本発明におけるＴＦＴ基板の製造方法の実施例１のフローチャートであり、本実施例のＴＦＴ基板の製造方法は、以下の工程を含む。
【００２２】
Ｓ１１．ベース基板を準備し、ベース基板上に第１のゲートを形成する。
具体的には、一例では、第１のゲートを製造する方法は、ベース基板上に第１の金属層を堆積し、フォトリソグラフィプロセスによって第１の金属層をパターニングして第１のゲートを得る。第１の金属層の材料は、アルミニウム、モリブデン、銅、または銀であってよい。もちろん、別の例では、第１のゲートの製造方法は、ベース基板上に第１のポリシリコン層を形成し、第１のポリシリコン層にＮ型ドーピングを実行し、次にフォトリソグラフィプロセスによってＮ型のドープされたポリシリコン層をパターニングして、第１のゲートを得る。
【００２３】
Ｓ１２．第１の絶縁層を第１のゲートおよび基板上に形成し、第１の絶縁層は第１のゲートを完全に覆う。
【００２４】
Ｓ１３．第１の絶縁層にドレイン、ソースおよびアクティブ層を形成し、ドレインの少なくとも一部およびソースの少なくとも一部は、離間してアクティブ層の外端に設けられ、アクティブ層を介して接続されている。
【００２５】
具体的には、アクティブ層の製造方法は、化学的または物理的気相成長法によって第１の絶縁層上に半導体層を堆積し、フォトリソグラフィプロセスによって半導体層をパターニングして、アクティブ層を得る。
【００２６】
具体的には、ドレインおよびソースの製造方法は、アクティブ層および第１の絶縁層に第２の金属層を堆積し、フォトリソグラフィプロセスによって第２の金属層をパターニングして、ソースおよびドレインを得る；または、アクティブ層および第１の絶縁層に第２のポリシリコン層を形成し、第２のポリシリコン層にＮ型ドーピングを実行し、次にフォトリソグラフィプロセスによって第２のポリシリコン層をパターニングして、ソースおよびドレインを得る。
【００２７】
Ｓ１４．ドレイン、ソースおよびアクティブ層に第２の絶縁層を形成し、第２の絶縁層はドレイン、ソースおよびアクティブ層を完全に覆う。
【００２８】
Ｓ１５．  第２の絶縁層の上にマイナスの電圧に接続される第２のゲートを形成する。
【００２９】
具体的には、第２のゲートの製造方法は、第２の絶縁層に第３の金属層を堆積し、フォトリソグラフィプロセスによって第３の金属層をパターニングして、第２のゲートを得る；または、第２の絶縁層に第３のポリシリコン層を形成し、第３のポリシリコン層にＮ型ドーピングを実行し、次にフォトリソグラフィプロセスによってＮ型のドープされたポリシリコン層をパターニングして、第２のゲートを得る。
【００３０】
さらに、上記の実施例におけるフォトリソグラフィプロセスは、フォトレジスト、露光、現像およびエッチングプロセスを含む。
【００３１】
上記は本発明の好ましい実施例に過ぎず、本発明を限定することを意図するものではなく、当業者にとって、本発明は様々な改変および変更を有し得る。本発明の精神および原理の範囲内のあらゆる修正、同等の置換、改良などは、本発明の特許請求の範囲に含まれるものとする。
【図１】
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【図２】
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【図３】
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【図４】
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【図５】
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【図６】
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【図７】
2021504952.tif 000009
【国際調査報告】
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2021504952.tif 000011
2021504952.tif 000012
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