(57)【要約】  入力されたディジタル信号Ｘｉｎ［ｎ・Ｔｓ］の振幅及び位相を変化させ、振幅及び位相変化後のディジタル信号として、互いに異なるディジタル信号Ｘ１［ｎ・Ｔｓ］，Ｘ２［ｎ・Ｔｓ］，Ｘ３［ｎ・Ｔｓ］を出力するトランスバーサルフィルタ１０，２０，３０が並列に接続されているフィルタ回路１を設け、位相周波数演算部４が、トランスバーサルフィルタ１０，２０，３０から出力されたディジタル信号Ｘ１［ｎ・Ｔｓ］，Ｘ２［ｎ・Ｔｓ］，Ｘ３［ｎ・Ｔｓ］を用いる位相演算及び周波数演算を実施して、入力されたディジタル信号Ｘｉｎ［ｎ・Ｔｓ］の位相θＸ［ｎ・Ｔｓ］及び周波数ｆＸ［ｎ・Ｔｓ］を演算するように構成する。
2016139778.tif 000002
【特許請求の範囲】
【請求項１】
入力されたディジタル信号の振幅及び位相を変化させ、振幅及び位相変化後のディジタル信号として、互いに異なるディジタル信号を出力する複数のトランスバーサルフィルタが並列に接続されているフィルタ回路と、
前記複数のトランスバーサルフィルタから出力されたディジタル信号を用いる位相演算及び周波数演算を実施して、前記入力されたディジタル信号の位相及び周波数を演算する位相周波数演算部と
を備えた位相周波数検出装置。
【請求項２】
前記フィルタ回路は、前記複数のトランスバーサルフィルタとして、第１のトランスバーサルフィルタと第２のトランスバーサルフィルタと第３のトランスバーサルフィルタとが並列に接続されており、
前記位相周波数演算部は、
前記第１のトランスバーサルフィルタから出力されたディジタル信号と前記第２のトランスバーサルフィルタから出力されたディジタル信号との間で除算演算を実施して、その除算演算結果である第１の除算演算信号を出力する第１の除算演算回路と、
前記第３のトランスバーサルフィルタから出力されたディジタル信号と前記第２のトランスバーサルフィルタから出力されたディジタル信号との間で除算演算を実施して、その除算演算結果である第２の除算演算信号を出力する第２の除算演算回路と、
前記第１の除算演算回路から出力された第１の除算演算信号と前記第２の除算演算回路から出力された第２の除算演算信号との乗算演算を実施して、その乗算演算結果である乗算演算信号を出力する乗算演算回路と、
前記乗算演算回路から出力された乗算演算信号の冪根演算を実施して、その冪根演算結果である冪根演算信号を出力する冪根演算回路と、
前記冪根演算回路より出力された冪根演算信号と前記第１の除算演算信号又は前記第２の除算演算信号の符号から、前記入力されたディジタル信号の位相を演算する位相演算回路と、
前記位相演算回路により演算された位相から、前記入力されたディジタル信号の周波数を演算する周波数演算回路とから構成されていることを特徴とする請求項１記載の位相周波数検出装置。
【請求項３】
前記フィルタ回路は、前記複数のトランスバーサルフィルタとして、第１のトランスバーサルフィルタと第２のトランスバーサルフィルタと第３のトランスバーサルフィルタとが並列に接続されており、
前記位相周波数演算部は、
前記第１のトランスバーサルフィルタから出力されたディジタル信号と前記第３のトランスバーサルフィルタから出力されたディジタル信号との乗算演算を実施して、その乗算演算結果である第１の乗算演算信号を出力する第１の乗算演算回路と、
前記第２のトランスバーサルフィルタから出力されたディジタル信号の自乗演算を実施して、その自乗演算結果である第２の乗算演算信号を出力する第２の乗算演算回路と、
前記第１の乗算演算回路から出力された第１の乗算演算信号と前記第２の乗算演算回路から出力された第２の乗算演算信号との間で除算演算を実施して、その除算演算結果である除算演算信号を出力する除算演算回路と、
前記除算演算回路から出力された除算演算信号の冪根演算を実施して、その冪根演算結果である冪根演算信号を出力する冪根演算回路と、
前記冪根演算回路より出力された冪根演算信号と前記第１の乗算演算信号の符号から、前記入力されたディジタル信号の位相を演算する位相演算回路と、
前記位相演算回路により演算された位相から、前記入力されたディジタル信号の周波数を演算する周波数演算回路とから構成されていることを特徴とする請求項１記載の位相周波数検出装置。
【請求項４】
前記フィルタ回路は、前記複数のトランスバーサルフィルタとして、第１のトランスバーサルフィルタと第２のトランスバーサルフィルタとが並列に接続されており、
前記位相周波数演算部は、
前記第１のトランスバーサルフィルタから出力されたディジタル信号と前記第２のトランスバーサルフィルタから出力されたディジタル信号との間で除算演算を実施して、その除算演算結果である除算演算信号を出力する除算演算回路と、
前記除算演算回路から出力された除算演算信号の冪根演算を実施して、その冪根演算結果である冪根演算信号を出力する冪根演算回路と、
前記冪根演算回路より出力された冪根演算信号から、前記入力されたディジタル信号の周波数を演算する周波数演算回路と、
前記周波数演算回路により演算された周波数から、前記入力されたディジタル信号の位相を演算する位相演算回路とから構成されていることを特徴とする請求項１記載の位相周波数検出装置。
【請求項５】
前記複数のトランスバーサルフィルタは、
１つ以上の減算型１次トランスバーサルフィルタが直列に接続されて構成、１つ以上の加算型１次トランスバーサルフィルタが直列に接続されて構成、あるいは、減算型１次トランスバーサルフィルタと加算型１次トランスバーサルフィルタが直列に接続されて構成されており、
前記減算型１次トランスバーサルフィルタは、入力されたディジタル信号を分配する第１の分配回路と、前記第１の分配回路により分配された一方のディジタル信号を１サンプリング時間だけ遅延する第１の遅延回路と、前記第１の遅延回路により遅延されたディジタル信号と前記第１の分配回路により分配された他方のディジタル信号との間で減算演算を実施する減算演算回路とから構成され、
前記加算型１次トランスバーサルフィルタは、入力されたディジタル信号を分配する第２の分配回路と、前記第２の分配回路により分配された一方のディジタル信号を１サンプリング時間だけ遅延する第２の遅延回路と、前記第２の遅延回路により遅延されたディジタル信号と前記第２の分配回路により分配された他方のディジタル信号との加算演算を実施する加算演算回路とから構成されていることを特徴とする請求項１記載の位相周波数検出装置。
【請求項６】
前記フィルタ回路は、前記複数のトランスバーサルフィルタとして、第１のトランスバーサルフィルタと第２のトランスバーサルフィルタと第３のトランスバーサルフィルタとが並列に接続されており、
前記第１のトランスバーサルフィルタは、減算型１次トランスバーサルフィルタが２つ直列に接続されて構成され、
前記第２のトランスバーサルフィルタは、減算型１次トランスバーサルフィルタと加算型１次トランスバーサルフィルタが直列に接続されて構成され、
前記第３のトランスバーサルフィルタは、加算型１次トランスバーサルフィルタが２つ直列に接続されて構成されていることを特徴とする請求項５記載の位相周波数検出装置。
【請求項７】
前記フィルタ回路は、前記複数のトランスバーサルフィルタとして、第１のトランスバーサルフィルタと第２のトランスバーサルフィルタとが並列に接続されており、
前記第１のトランスバーサルフィルタは、減算型１次トランスバーサルフィルタが２つ直列に接続されて構成され、
前記第２のトランスバーサルフィルタは、加算型１次トランスバーサルフィルタが２つ直列に接続されて構成されていることを特徴とする請求項５記載の位相周波数検出装置。
【請求項８】
前記フィルタ回路は、前記複数のトランスバーサルフィルタとして、第１のトランスバーサルフィルタと第２のトランスバーサルフィルタと第３のトランスバーサルフィルタとが並列に接続されており、
前記第１のトランスバーサルフィルタは、減算型１次トランスバーサルフィルタが２つ直列に接続されて構成され、
前記第２のトランスバーサルフィルタは、前記第１のトランスバーサルフィルタを構成している２つの減算型１次トランスバーサルフィルタのうち、前段の減算型１次トランスバーサルフィルタから出力されたディジタル信号が入力される加算型１次トランスバーサルフィルタから構成され、
前記第３のトランスバーサルフィルタは、加算型１次トランスバーサルフィルタが２つ直列に接続されて構成されていることを特徴とする請求項５記載の位相周波数検出装置。
【請求項９】
前記フィルタ回路は、前記複数のトランスバーサルフィルタとして、第１のトランスバーサルフィルタと第２のトランスバーサルフィルタと第３のトランスバーサルフィルタとが並列に接続されており、
前記第１のトランスバーサルフィルタは、減算型１次トランスバーサルフィルタが２つ直列に接続されて構成され、
前記第３のトランスバーサルフィルタは、加算型１次トランスバーサルフィルタが２つ直列に接続されて構成され、
前記第２のトランスバーサルフィルタは、前記第３のトランスバーサルフィルタを構成している２つの加算型１次トランスバーサルフィルタのうち、前段の加算型１次トランスバーサルフィルタから出力されたディジタル信号が入力される減算型１次トランスバーサルフィルタから構成されていることを特徴とする請求項５記載の位相周波数検出装置。
【請求項１０】
前記フィルタ回路は、前記複数のトランスバーサルフィルタとして、第１のトランスバーサルフィルタと第２のトランスバーサルフィルタと第３のトランスバーサルフィルタとが並列に接続されており、
前記第１のトランスバーサルフィルタは、減算型１次トランスバーサルフィルタが２つ直列に接続されて構成され、
前記第２のトランスバーサルフィルタは、入力側の加算型１次トランスバーサルフィルタと出力側の減算型１次トランスバーサルフィルタが直列に接続されて構成され、
前記第３のトランスバーサルフィルタは、前記第３のトランスバーサルフィルタを構成している加算型１次トランスバーサルフィルタから出力されたディジタル信号が入力される加算型１次トランスバーサルフィルタから構成されていることを特徴とする請求項５記載の位相周波数検出装置。
【請求項１１】
前記複数のトランスバーサルフィルタのうち、いずれか１つのトランスバーサルフィルタは、
前記入力されたディジタル信号を分配する分配回路と、
前記分配回路により分配された一方のディジタル信号を１サンプリング時間だけ遅延する第１の遅延回路と、
前記第１の遅延回路により遅延されたディジタル信号を１サンプリング時間だけ遅延する第２の遅延回路と、
前記第１の遅延回路により遅延されたディジタル信号に対して、−２の係数を乗算する係数乗算回路と、
前記第２の遅延回路により遅延されたディジタル信号と、前記係数乗算回路により係数が乗算されたディジタル信号と、前記分配回路により分配された他方のディジタル信号との加算演算を実施する加算演算回路とから構成されていることを特徴とする請求項１記載の位相周波数検出装置。
【請求項１２】
前記複数のトランスバーサルフィルタのうち、いずれか１つのトランスバーサルフィルタは、
前記入力されたディジタル信号を分配する分配回路と、
前記分配回路により分配された一方のディジタル信号を１サンプリング時間だけ遅延する第１の遅延回路と、
前記第１の遅延回路により遅延されたディジタル信号を１サンプリング時間だけ遅延する第２の遅延回路と、
前記第２の遅延回路により遅延されたディジタル信号に対して、−１の係数を乗算する係数乗算回路と、
前記係数乗算回路により係数が乗算されたディジタル信号と、前記分配回路により分配された他方のディジタル信号との加算演算を実施する加算演算回路とから構成されていることを特徴とする請求項１記載の位相周波数検出装置。
【請求項１３】
前記複数のトランスバーサルフィルタのうち、いずれか１つのトランスバーサルフィルタは、
前記入力されたディジタル信号を分配する分配回路と、
前記分配回路により分配された一方のディジタル信号を１サンプリング時間だけ遅延する第１の遅延回路と、
前記第１の遅延回路により遅延されたディジタル信号を１サンプリング時間だけ遅延する第２の遅延回路と、
前記第１の遅延回路により遅延されたディジタル信号に対して、２の係数を乗算する係数乗算回路と、
前記第２の遅延回路により遅延されたディジタル信号と、前記係数乗算回路により係数が乗算されたディジタル信号と、前記分配回路により分配された他方のディジタル信号との加算演算を実施する加算演算回路とから構成されていることを特徴とする請求項１記載の位相周波数検出装置。
【請求項１４】
前記入力されたディジタル信号に重畳されているノイズを除去するディジタルフィルタが前記複数のトランスバーサルフィルタに実装されていることを特徴とする請求項１記載の位相周波数検出装置。
【請求項１５】
前記入力されたディジタル信号に重畳されているノイズを除去するディジタルフィルタが前記フィルタ回路の前段に接続されていることを特徴とする請求項１記載の位相周波数検出装置。
【請求項１６】
前記位相周波数演算部として、前記複数のトランスバーサルフィルタから出力されたディジタル信号を用いる位相演算及び周波数演算の処理内容が異なる複数の位相周波数演算部を設け、前記複数の位相周波数演算部により演算された位相及び周波数の統計演算を実施する統計演算部を備えたことを特徴とする請求項１記載の位相周波数検出装置。
【請求項１７】
前記フィルタ回路として、実装しているトランスバーサルフィルタの構成が異なる複数のフィルタ回路を設けるとともに、前記位相周波数演算部として、前記フィルタ回路の複数のトランスバーサルフィルタから出力されたディジタル信号を用いる位相演算及び周波数演算を実施する複数の位相周波数演算部を設け、前記複数の位相周波数演算部により演算された位相及び周波数の統計演算を実施する統計演算部を備えたことを特徴とする請求項１記載の位相周波数検出装置。
【発明の詳細な説明】
【技術分野】
【０００１】
この発明は、例えば、信号計測装置などに実装され、入力されたディジタル信号の位相及び周波数を検出する位相周波数検出装置に関するものである。
【背景技術】
【０００２】
以下の特許文献１に開示されている位相周波数検出装置は、Ａ／Ｄ変換回路、ディジタルＢＰＦ、遅延補償回路、ヒルベルト変換回路、位相角演算回路、メモリ及び周波数演算回路から構成されている。
Ａ／Ｄ変換回路は、入力されたアナログ信号をディジタル信号に変換し、そのディジタル信号をディジタルＢＰＦに出力する。
ディジタルＢＰＦは、Ａ／Ｄ変換回路から出力されたディジタル信号のうち、所望の帯域のディジタル信号だけを遅延補償回路及びヒルベルト変換回路に出力する。【０００３】
遅延補償回路は、ディジタルＢＰＦから所望の帯域のディジタル信号を受けると、ヒルベルト変換回路におけるヒルベルト変換に伴う遅延時間に相当する時間で、そのディジタル信号の時間シフトを行う。
ヒルベルト変換回路は、ディジタルＢＰＦから所望の帯域のディジタル信号を受けると、そのディジタル信号をヒルベルト変換することで、そのディジタル信号に対して、９０度位相差を有する信号を出力する。
なお、ヒルベルト変換回路の出力信号の振幅及び位相に対して要求される精度が高くなるほど、ヒルベルト変換に伴う遅延時間が長くなるため、その遅延補償回路が有する遅延回路の段数が多くなり、その段数は数１０〜数１００になる。【０００４】
位相角演算回路は、遅延補償回路の出力信号とヒルベルト変換回路の出力信号に基づく逆正接演算を実施することで、入力されたアナログ信号の位相を算出し、その位相をメモリ及び周波数演算回路に出力する。
周波数演算回路は、位相角演算回路から出力された位相と、メモリに格納されている１サンプリング時間前の位相とから、入力されたアナログ信号の周波数を演算する。
【先行技術文献】
【特許文献】
【０００５】
【特許文献１】特開２００５−９１２５５号公報（例えば、段落［０００８］、図１）
【発明の概要】
【発明が解決しようとする課題】
【０００６】
従来の位相周波数検出装置は以上のように構成されているので、ヒルベルト変換回路の出力信号の振幅及び位相に対して要求される精度が高くなるほど、ヒルベルト変換に伴う遅延時間が長くなり、遅延補償回路が有する遅延回路の段数が多くなる。このため、入力される信号が短パルスの信号である場合、入力信号の位相と周波数を検出することができないという課題があった。また、遅延回路の段数の増加に伴って回路規模が大きくなるとともに、ディジタル演算に伴う消費電力が高くなるという課題があった。【０００７】
この発明は上記のような課題を解決するためになされたもので、入力される信号が短パルスの信号でも位相と周波数を検出することができるとともに、遅延回路の段数の増加に伴う回路規模の大型化や消費電力の増加を抑えることができる位相周波数検出装置を得ることを目的とする。
【課題を解決するための手段】
【０００８】
この発明に係る位相周波数検出装置は、入力されたディジタル信号の振幅及び位相を変化させ、振幅及び位相変化後のディジタル信号として、互いに異なるディジタル信号を出力する複数のトランスバーサルフィルタが並列に接続されているフィルタ回路を設け、位相周波数演算部が、複数のトランスバーサルフィルタから出力されたディジタル信号を用いる位相演算及び周波数演算を実施して、入力されたディジタル信号の位相及び周波数を演算するようにしたものである。
【発明の効果】
【０００９】
この発明によれば、入力されたディジタル信号の振幅及び位相を変化させ、振幅及び位相変化後のディジタル信号として、互いに異なるディジタル信号を出力する複数のトランスバーサルフィルタが並列に接続されているフィルタ回路を設け、位相周波数演算部が、複数のトランスバーサルフィルタから出力されたディジタル信号を用いる位相演算及び周波数演算を実施して、入力されたディジタル信号の位相及び周波数を演算するように構成したので、入力されるディジタル信号が短パルスの信号でも位相と周波数を検出することができるとともに、遅延回路の段数の増加に伴う回路規模の大型化や消費電力の増加を抑えることができる効果がある。
【図面の簡単な説明】
【００１０】
【図１】この発明の実施の形態１による位相周波数検出装置を示す構成図である。
【図２】減算型１次トランスバーサルフィルタ及び加算型１次トランスバーサルフィルタを示す構成図である。
【図３】この発明の実施の形態２による位相周波数検出装置を示す構成図である。
【図４】この発明の実施の形態３による位相周波数検出装置を示す構成図である。
【図５】この発明の実施の形態４による位相周波数検出装置のフィルタ回路１を示す構成図である。
【図６】この発明の実施の形態５による位相周波数検出装置のフィルタ回路１を示す構成図である。
【図７】この発明の実施の形態６による位相周波数検出装置のフィルタ回路１を示す構成図である。
【図８】この発明の実施の形態７による位相周波数検出装置のトランスバーサルフィルタ１０を示す構成図である。
【図９】この発明の実施の形態８による位相周波数検出装置のトランスバーサルフィルタ２０を示す構成図である。
【図１０】この発明の実施の形態９による位相周波数検出装置のトランスバーサルフィルタ３０を示す構成図である。
【図１１】この発明の実施の形態１０による位相周波数検出装置のフィルタ回路１を示す構成図である。
【図１２】この発明の実施の形態１０による位相周波数検出装置のフィルタ回路１を示す構成図である。
【図１３】この発明の実施の形態１０による位相周波数検出装置のフィルタ回路１を示す構成図である。
【図１４】この発明の実施の形態１１による位相周波数検出装置を示す構成図である。
【図１５】この発明の実施の形態１１による位相周波数検出装置を示す構成図である。
【発明を実施するための形態】
【００１１】
以下、この発明をより詳細に説明するために、この発明を実施するための形態について、添付の図面にしたがって説明する。
【００１２】
実施の形態１．
図１はこの発明の実施の形態１による位相周波数検出装置を示す構成図である。
図１において、フィルタ回路１は入力されたディジタル信号Ｘｉｎの振幅及び位相を変化させ、振幅及び位相変化後のディジタル信号として、互いに異なるディジタル信号Ｘ１，Ｘ２，Ｘ３を出力するトランスバーサルフィルタ１０，２０，３０が並列に接続されている回路である。
【００１３】
第１のトランスバーサルフィルタであるトランスバーサルフィルタ１０は第１の減算型１次トランスバーサルフィルタＤである減算型１次トランスバーサルフィルタ１１，１２が直列に接続されている。
第２のトランスバーサルフィルタであるトランスバーサルフィルタ２０は第１の減算型１次トランスバーサルフィルタＤである減算型１次トランスバーサルフィルタ２１と、第１の加算型１次トランスバーサルフィルタＩである加算型１次トランスバーサルフィルタ２２とが直列に接続されている。
第３のトランスバーサルフィルタであるトランスバーサルフィルタ３０は第１の加算型１次トランスバーサルフィルタＩである加算型１次トランスバーサルフィルタ３１，３２が直列に接続されている。
【００１４】
位相周波数演算部４は除算演算回路４１，４２、乗算演算回路４３、ｎ乗根演算回路４４、位相演算回路４５及び周波数演算回路４６から構成されており、トランスバーサルフィルタ１０，２０，３０から出力されたディジタル信号Ｘ１，Ｘ２，Ｘ３を用いる位相演算及び周波数演算を実施して、入力されたディジタル信号Ｘｉｎの位相θＸ及び周波数ｆＸを演算する。
除算演算回路４１はトランスバーサルフィルタ２０から出力されたディジタル信号Ｘ２をトランスバーサルフィルタ１０から出力されたディジタル信号Ｘ１で除算し、その除算演算結果である除算演算信号Ｘ２／Ｘ１を第１の除算演算信号として乗算演算回路４３に出力する第１の除算演算回路である。
除算演算回路４２はトランスバーサルフィルタ２０から出力されたディジタル信号Ｘ２をトランスバーサルフィルタ３０から出力されたディジタル信号Ｘ３で除算し、その除算演算結果である除算演算信号Ｘ２／Ｘ３を第２の除算演算信号として乗算演算回路４３に出力する第２の除算演算回路である。
【００１５】
乗算演算回路４３は除算演算回路４１から出力された除算演算信号Ｘ２／Ｘ１と除算演算回路４２から出力された除算演算信号Ｘ２／Ｘ３との乗算演算を実施して、その乗算演算結果である乗算演算信号Ｙをｎ乗根演算回路４４に出力する回路である。
ｎ乗根演算回路４４は乗算演算回路４３から出力された乗算演算信号Ｙの絶対値のｎ乗根演算である冪根演算を実施して、そのｎ乗根演算結果であるｎ乗根演算信号Ｎを位相演算回路４５に出力する冪根演算回路である。
【００１６】
位相演算回路４５はｎ乗根演算回路４４より出力されたｎ乗根演算信号の逆正接演算を実施し、除算演算回路４２から出力された除算演算信号Ｘ２／Ｘ３の符号に応じて、その逆正接演算結果の符号変換を行うことで、ディジタル信号Ｘｉｎの位相θＸを演算する回路である。
なお、ｎ乗根演算回路４４及び位相演算回路４５は、例えば、乗算器や除算器などが組み合わされて構成させているものであってもよいが、例えば、ｎ乗根演算や逆正接演算の途中の演算結果を一時的に格納するメモリ又はテーブルと、上記の演算を実施するプロセッサ等の演算回路とから構成されているものであってもよい。
周波数演算回路４６は位相演算回路４５により演算された位相θＸから、入力されたディジタル信号Ｘｉｎの周波数ｆＸを演算する回路である。
【００１７】
図２は減算型１次トランスバーサルフィルタ及び加算型１次トランスバーサルフィルタを示す構成図である。
特に図２（ａ）は第１の減算型１次トランスバーサルフィルタＤを示し、図２（ｂ）は第２の減算型１次トランスバーサルフィルタ−Ｄを示している。
また、図２（ｃ）は第１の加算型１次トランスバーサルフィルタＩを示し、図２（ｄ）は第２の加算型１次トランスバーサルフィルタ−Ｉを示している。
ただし、図１の例では、第１の減算型１次トランスバーサルフィルタＤと第１の加算型１次トランスバーサルフィルタＩを使用しているが、第２の減算型１次トランスバーサルフィルタ−Ｄと第２の加算型１次トランスバーサルフィルタ−Ｉを使用していない。
【００１８】
図２（ａ）の第１の減算型１次トランスバーサルフィルタＤは分配回路５１、１サンプリング時間遅延回路５２及び減算演算回路５３から構成されている。
分配回路５１は入力されたディジタル信号Ｘｉｎを２つに分配する第１の分配回路である。
１サンプリング時間遅延回路５２は分配回路５１により分配された一方のディジタル信号Ｘｉｎを１サンプリング時間Ｔｓ（＝１／ｆｓ）だけ遅延する第１の遅延回路である。
減算演算回路５３は分配回路５１により分配された他方のディジタル信号Ｘｉｎから１サンプリング時間遅延回路５２により遅延されたディジタル信号を減算する回路である。
【００１９】
図２（ｂ）の第２の減算型１次トランスバーサルフィルタ−Ｄは分配回路５１、１サンプリング時間遅延回路５２及び減算演算回路５４から構成されている。
減算演算回路５４は１サンプリング時間遅延回路５２により遅延されたディジタル信号から分配回路５１により分配された他方のディジタル信号Ｘｉｎを減算する回路である。
なお、図２（ａ）の第１の減算型１次トランスバーサルフィルタＤと、図２（ｂ）の第２の減算型１次トランスバーサルフィルタ−Ｄとの違いは、減算演算回路５３，５４に対する入力信号の符号であり、図２（ａ）の第１の減算型１次トランスバーサルフィルタＤの出力信号の符号と、図２（ｂ）の第２の減算型１次トランスバーサルフィルタ−Ｄの出力信号の符号が逆になる。
【００２０】
図２（ｃ）の第１の加算型１次トランスバーサルフィルタＩは分配回路６１、１サンプリング時間遅延回路６２及び加算演算回路６３から構成されている。
分配回路６１は入力されたディジタル信号Ｘｉｎを２つに分配する第２の分配回路である。
１サンプリング時間遅延回路６２は分配回路６１により分配された一方のディジタル信号Ｘｉｎを１サンプリング時間Ｔｓだけ遅延する第２の遅延回路である。
加算演算回路６３は１サンプリング時間遅延回路６２により遅延されたディジタル信号と、分配回路５１により分配された他方のディジタル信号Ｘｉｎとを加算する回路である。
【００２１】
図２（ｄ）の第２の加算型１次トランスバーサルフィルタ−Ｉは分配回路６１、１サンプリング時間遅延回路６２及び加算演算回路６４から構成されている。
加算演算回路６４は１サンプリング時間遅延回路６２により遅延されたディジタル信号の符号が反転されて入力され、また、分配回路６１により分配された他方のディジタル信号Ｘｉｎの符号が反転されて入力され、符号反転後の遅延されたディジタル信号と、符号反転後の他方のディジタル信号Ｘｉｎとを加算する回路である。
なお、図２（ｃ）の第１の加算型１次トランスバーサルフィルタＩと、図２（ｄ）の第２の加算型１次トランスバーサルフィルタ−Ｉとの違いは、加算演算回路６３，６４に対する入力信号の符号であり、図２（ｃ）の第１の加算型１次トランスバーサルフィルタＩの出力信号の符号と、図２（ｄ）の第２の加算型１次トランスバーサルフィルタ−Ｉの出力信号の符号が逆になる。
【００２２】
次に動作について説明する。
フィルタ回路１のトランスバーサルフィルタ１０，２０，３０には、離散時間ｎ・Ｔｓでディジタル信号Ｘｉｎ［ｎ・Ｔｓ］が入力されるものとする。
下記の式（１）は、ディジタル信号Ｘｉｎ［ｎ・Ｔｓ］の時間波形を表している。
Ｘｉｎ［ｎ・Ｔｓ］＝α・ｃｏｓ（Δθ＋Σθｎ−１）      （１）
式（１）において、αはＸｉｎの振幅係数、Δθは１サンプリング時間における位相の変化量、Σθｎ−１は離散時間ゼロからｎ−１までの位相の積分値である。
【００２３】
トランスバーサルフィルタ１０は、図２（ａ）に示す第１の減算型１次トランスバーサルフィルタＤである減算型１次トランスバーサルフィルタ１１，１２が直列に接続されているため、ディジタル信号Ｘｉｎ［ｎ・Ｔｓ］が入力されると、そのディジタル信号Ｘｉｎ［ｎ・Ｔｓ］の振幅及び位相を変化させ、振幅及び位相変化後のディジタル信号Ｘ１［ｎ・Ｔｓ］を位相周波数演算部４に出力する。
即ち、トランスバーサルフィルタ１０を構成している減算型１次トランスバーサルフィルタ１１は、ディジタル信号Ｘｉｎ［ｎ・Ｔｓ］が入力されると、下記の式（２）に示すようなディジタル信号Ｘ１’［ｎ・Ｔｓ］を減算型１次トランスバーサルフィルタ１２に出力する。
Ｘ１’［ｎ・Ｔｓ］
＝Ｘｉｎ［ｎ・Ｔｓ］−Ｘｉｎ［（ｎ−１）・Ｔｓ］
＝α・ｃｏｓ（Δθ＋Σθｎ−１）−α・ｃｏｓ（Δθ＋Σθｎ−２）
＝α・ｃｏｓ（２・Δθ＋Σθｎ−２）−α・ｃｏｓ（Δθ＋Σθｎ−２）
＝−２・α・ｓｉｎ（０．５・Δθ）・ｓｉｎ（１．５・Δθ＋Σθｎ−２）
（２）
【００２４】
トランスバーサルフィルタ１０を構成している減算型１次トランスバーサルフィルタ１２は、減算型１次トランスバーサルフィルタ１１からディジタル信号Ｘ１’［ｎ・Ｔｓ］を受けると、下記の式（３）に示すようなディジタル信号Ｘ１［ｎ・Ｔｓ］を位相周波数演算部４に出力する。
Ｘ１［ｎ・Ｔｓ］
＝Ｘ１’［ｎ・Ｔｓ］−Ｘ１’［（ｎ−１）・Ｔｓ］
＝−２・α・ｓｉｎ（０．５・Δθ）・ｓｉｎ（１．５・Δθ＋Σθｎ−２）
＋２・α・ｓｉｎ（０．５・Δθ）・ｓｉｎ（０．５・Δθ＋Σθｎ−２）
＝−２・α・ｓｉｎ（０．５・Δθ）
・［ｓｉｎ（１．５・Δθ＋Σθｎ−２）−ｓｉｎ（０．５・Δθ＋Σθｎ−２）］
＝−２・α・ｓｉｎ（０．５・Δθ）・
［２・ｓｉｎ（０．５・Δθ）・ｃｏｓ（Δθ＋Σθｎ−２）］
＝−４・α・ｓｉｎ（０．５・Δθ）・ｓｉｎ（０．５・Δθ）
・ｃｏｓ（Δθ＋Σθｎ−２）
（３）
【００２５】
トランスバーサルフィルタ２０は、図２（ａ）に示す第１の減算型１次トランスバーサルフィルタＤである減算型１次トランスバーサルフィルタ２１と、図２（ｃ）に示す第１の加算型１次トランスバーサルフィルタＩである加算型１次トランスバーサルフィルタ２２とが直列に接続されているため、ディジタル信号Ｘｉｎ［ｎ・Ｔｓ］が入力されると、そのディジタル信号Ｘｉｎ［ｎ・Ｔｓ］の振幅及び位相を変化させ、振幅及び位相変化後のディジタル信号Ｘ２［ｎ・Ｔｓ］を位相周波数演算部４に出力する。
即ち、トランスバーサルフィルタ２０を構成している減算型１次トランスバーサルフィルタ２１は、ディジタル信号Ｘｉｎ［ｎ・Ｔｓ］が入力されると、下記の式（４）に示すようなディジタル信号Ｘ２’［ｎ・Ｔｓ］を加算型１次トランスバーサルフィルタ２２に出力する。
Ｘ２’［ｎ・Ｔｓ］
＝Ｘｉｎ［ｎ・Ｔｓ］−Ｘｉｎ［（ｎ−１）・Ｔｓ］
＝α・ｃｏｓ（Δθ＋Σθｎ−１）−α・ｃｏｓ（Δθ＋Σθｎ−２）
＝α・ｃｏｓ（２・Δθ＋Σθｎ−２）−α・ｃｏｓ（Δθ＋Σθｎ−２）
＝−２・α・ｓｉｎ（０．５・Δθ）・ｓｉｎ（１．５・Δθ＋Σθｎ−２）
（４）
【００２６】
トランスバーサルフィルタ２０を構成している加算型１次トランスバーサルフィルタ２２は、減算型１次トランスバーサルフィルタ２１からディジタル信号Ｘ２’［ｎ・Ｔｓ］を受けると、下記の式（５）に示すようなディジタル信号Ｘ２［ｎ・Ｔｓ］を位相周波数演算部４に出力する。
Ｘ２［ｎ・Ｔｓ］
＝Ｘ２’［ｎ・Ｔｓ］＋Ｘ２’［（ｎ−１）・Ｔｓ］
＝−２・α・ｓｉｎ（０．５・Δθ）・ｓｉｎ（１．５・Δθ＋Σθｎ−２）
−２・α・ｓｉｎ（０．５・Δθ）・ｓｉｎ（０．５・Δθ＋Σθｎ−２）
＝−２・α・ｓｉｎ（０．５・Δθ）
・［ｓｉｎ（１．５・Δθ＋Σθｎ−２）＋ｓｉｎ（０．５・Δθ＋Σθｎ−２）］
＝−２・α・ｓｉｎ（０．５・Δθ）
・［２・ｃｏｓ（０．５・Δθ）・ｓｉｎ（Δθ＋Σθｎ−２）］
＝−４・α・ｓｉｎ（０．５・Δθ）・ｃｏｓ（０．５・Δθ）
・ｓｉｎ（Δθ＋Σθｎ−２）
（５）
【００２７】
トランスバーサルフィルタ３０は、図２（ｃ）に示す第１の加算型１次トランスバーサルフィルタＩである加算型１次トランスバーサルフィルタ３１，３２が直列に接続されているため、ディジタル信号Ｘｉｎ［ｎ・Ｔｓ］が入力されると、そのディジタル信号Ｘｉｎ［ｎ・Ｔｓ］の振幅及び位相を変化させ、振幅及び位相変化後のディジタル信号Ｘ３［ｎ・Ｔｓ］を位相周波数演算部４に出力する。
即ち、トランスバーサルフィルタ３０を構成している加算型１次トランスバーサルフィルタ３１は、ディジタル信号Ｘｉｎ［ｎ・Ｔｓ］が入力されると、下記の式（６）に示すようなディジタル信号Ｘ３’［ｎ・Ｔｓ］を加算型１次トランスバーサルフィルタ３２に出力する。
Ｘ３’［ｎ・Ｔｓ］
＝Ｘｉｎ［ｎ・Ｔｓ］＋Ｘｉｎ［（ｎ−１）・Ｔｓ］
＝α・ｃｏｓ（Δθ＋Σθｎ−１）＋α・ｃｏｓ（Δθ＋Σθｎ−２）
＝α・ｃｏｓ（２・Δθ＋Σθｎ−２）＋α・ｃｏｓ（Δθ＋Σθｎ−２）
＝２・α・ｃｏｓ（０．５・Δθ）・ｃｏｓ（１．５・Δθ＋Σθｎ−２）
（６）
【００２８】
トランスバーサルフィルタ３０を構成している加算型１次トランスバーサルフィルタ３２は、加算型１次トランスバーサルフィルタ３１からディジタル信号Ｘ３’［ｎ・Ｔｓ］を受けると、下記の式（７）に示すようなディジタル信号Ｘ３［ｎ・Ｔｓ］を位相周波数演算部４に出力する。
Ｘ３［ｎ・Ｔｓ］
＝Ｘ３’［ｎ・Ｔｓ］＋Ｘ３’［（ｎ−１）・Ｔｓ］
＝２・α・ｃｏｓ（０．５・Δθ）・ｃｏｓ（１．５・Δθ＋Σθｎ−２）
＋２・α・ｃｏｓ（０．５・Δθ）・ｃｏｓ（０．５・Δθ＋Σθｎ−２）
＝２・α・ｃｏｓ（０．５・Δθ）
・［ｃｏｓ（１．５・Δθ＋Σθｎ−２）＋ｃｏｓ（０．５・Δθ＋Σθｎ−２）］
＝４・α・ｃｏｓ（０．５・Δθ）・ｃｏｓ（０．５・Δθ）
・ｃｏｓ（Δθ＋Σθｎ−２）
（７）
【００２９】
位相周波数演算部４は、トランスバーサルフィルタ１０，２０，３０からディジタル信号Ｘ１［ｎ・Ｔｓ］，Ｘ２［ｎ・Ｔｓ］，Ｘ３［ｎ・Ｔｓ］を受けると、そのディジタル信号Ｘ１［ｎ・Ｔｓ］，Ｘ２［ｎ・Ｔｓ］，Ｘ３［ｎ・Ｔｓ］を用いる位相演算及び周波数演算を実施して、入力されたディジタル信号Ｘｉｎの位相θＸ［ｎ・Ｔｓ］及び周波数ｆＸ［ｎ・Ｔｓ］を演算する。
即ち、位相周波数演算部４の除算演算回路４１は、トランスバーサルフィルタ１０，２０からディジタル信号Ｘ１［ｎ・Ｔｓ］，Ｘ２［ｎ・Ｔｓ］を受けると、下記の式（８）に示すように、そのディジタル信号Ｘ２［ｎ・Ｔｓ］をディジタル信号Ｘ１［ｎ・Ｔｓ］で除算し、その除算演算結果である除算演算信号Ｘ２［ｎ・Ｔｓ］／Ｘ１［ｎ・Ｔｓ］を乗算演算回路４３に出力する。
Ｘ２［ｎ・Ｔｓ］／Ｘ１［ｎ・Ｔｓ］
＝［−４・α・ｓｉｎ（０．５・Δθ）・ｃｏｓ（０．５・Δθ）
・ｓｉｎ（Δθ＋Σθｎ−２）］
／［−４・α・ｓｉｎ（０．５・Δθ）・ｓｉｎ（０．５・Δθ）
・ｃｏｓ（Δθ＋Σθｎ−２）］
＝ｃｏｔ（０．５・Δθ）・ｔａｎ（Δθ＋Σθｎ−２）
（８）
【００３０】
除算演算回路４２は、トランスバーサルフィルタ２０，３０からディジタル信号Ｘ２［ｎ・Ｔｓ］，Ｘ３［ｎ・Ｔｓ］を受けると、下記の式（９）に示すように、そのディジタル信号Ｘ２［ｎ・Ｔｓ］をディジタル信号Ｘ３［ｎ・Ｔｓ］で除算し、その除算演算結果である除算演算信号Ｘ２［ｎ・Ｔｓ］／Ｘ３［ｎ・Ｔｓ］を乗算演算回路４３に出力する。
Ｘ２［ｎ・Ｔｓ］／Ｘ３［ｎ・Ｔｓ］
＝［−４・α・ｓｉｎ（０．５・Δθ）・ｃｏｓ（０．５・Δθ）
・ｓｉｎ（Δθ＋Σθｎ−２）］
／［４・α・ｃｏｓ（０．５・Δθ）・ｃｏｓ（０．５・Δθ）
・ｃｏｓ（Δθ＋Σθｎ−２）］
＝−ｔａｎ（０．５・Δθ）・ｔａｎ（Δθ＋Σθｎ−２）
（９）
【００３１】
乗算演算回路４３は、除算演算回路４１，４２から出力された除算演算信号Ｘ２［ｎ・Ｔｓ］／Ｘ１［ｎ・Ｔｓ］，Ｘ２［ｎ・Ｔｓ］／Ｘ３［ｎ・Ｔｓ］を受けると、下記の式（１０）に示すように、その除算演算信号Ｘ２［ｎ・Ｔｓ］／Ｘ１［ｎ・Ｔｓ］と除算演算信号Ｘ２［ｎ・Ｔｓ］／Ｘ３［ｎ・Ｔｓ］を乗算し、その乗算演算結果である乗算演算信号Ｙ［ｎ・Ｔｓ］をｎ乗根演算回路４４に出力する。
Ｙ［ｎ・Ｔｓ］
＝（Ｘ２［ｎ・Ｔｓ］／Ｘ１［ｎ・Ｔｓ］）・（Ｘ２［ｎ・Ｔｓ］／Ｘ３［ｎ・Ｔｓ］）
＝−ｔａｎ２（Δθ＋Σθｎ−２）
（１０）
【００３２】
ｎ乗根演算回路４４は、乗算演算回路４３から乗算演算信号Ｙ［ｎ・Ｔｓ］を受けると、その乗算演算信号Ｙ［ｎ・Ｔｓ］の絶対値のｎ乗根演算を実施して、そのｎ乗根演算結果であるｎ乗根演算信号Ｎ［ｎ・Ｔｓ］を位相演算回路４５に出力する。
Ｎ［ｎ・Ｔｓ］＝ｔａｎ（Δθ＋Σθｎ−２）                （１１）
ここでのｎ乗根演算におけるｎは０．５であるため、Ｎ［ｎ・Ｔｓ］は［｜Ｙ［ｎ・Ｔｓ］｜］０．５となる。
【００３３】
位相演算回路４５は、ｎ乗根演算回路４４からｎ乗根演算信号Ｎ［ｎ・Ｔｓ］を受けると、下記の式（１２）に示すように、そのｎ乗根演算信号Ｎ［ｎ・Ｔｓ］の逆正接演算であるａｒｃｔａｎ演算を実施し、除算演算回路４２から出力された除算演算信号Ｘ２［ｎ・Ｔｓ］／Ｘ３［ｎ・Ｔｓ］の符号に応じて逆正接演算結果の符号変換を行うことで、ディジタル信号Ｘｉｎの位相θＸ［ｎ・Ｔｓ］を演算する。
即ち、除算演算信号Ｘ２［ｎ・Ｔｓ］／Ｘ３［ｎ・Ｔｓ］の符号が正であれば、ディジタル信号Ｘｉｎの位相θＸ［ｎ・Ｔｓ］の符号も正、除算演算信号Ｘ２［ｎ・Ｔｓ］／Ｘ３［ｎ・Ｔｓ］の符号が負であれば、ディジタル信号Ｘｉｎの位相θＸ［ｎ・Ｔｓ］の符号も負とする。
θＸ［ｎ・Ｔｓ］＝ｔａｎ−１（｜Ｎ［ｎ・Ｔｓ］｜）
＝ｔａｎ−１（｜ｔａｎ（Δθ＋Σθｎ−２）｜）
（１２）
【００３４】
ここでは、位相演算回路４５が、除算演算回路４２から出力された除算演算信号Ｘ２［ｎ・Ｔｓ］／Ｘ３［ｎ・Ｔｓ］の符号に応じて逆正接演算結果の符号変換を行う例を示しているが、除算演算回路４１から出力された除算演算信号Ｘ２［ｎ・Ｔｓ］／Ｘ１［ｎ・Ｔｓ］の符号に応じて逆正接演算結果の符号変換を行うようにしてもよい。
フィルタ回路１におけるトランスバーサルフィルタ１０，２０，３０の構成が図１の構成である場合、除算演算回路４１から出力された除算演算信号Ｘ２［ｎ・Ｔｓ］／Ｘ１［ｎ・Ｔｓ］の符号と、除算演算回路４２から出力された除算演算信号Ｘ２［ｎ・Ｔｓ］／Ｘ３［ｎ・Ｔｓ］の符号は同じである。
【００３５】
周波数演算回路４６は、位相演算回路４５がディジタル信号Ｘｉｎの位相θＸ［ｎ・Ｔｓ］を演算すると、下記の式（１３）に示すように、そのディジタル信号Ｘｉｎの位相θＸ［ｎ・Ｔｓ］から、入力されたディジタル信号Ｘｉｎの周波数ｆＸ［ｎ・Ｔｓ］を演算する。
ｆＸ［ｎ・Ｔｓ］
＝｛θＸ［ｎ・Ｔｓ］−θＸ［（ｎ−１）・Ｔｓ］｝・ｆｓ／（２π）
（１３）
【００３６】
この実施の形態１では、式（１２）と式（１３）より、位相周波数演算部４が、ヒルベルト変換を実施することなく、ディジタル信号Ｘｉｎの位相θＸ［ｎ・Ｔｓ］と周波数ｆＸ［ｎ・Ｔｓ］を検出することができる。
また、トランスバーサルフィルタ１０，２０，３０が使用している遅延回路の段数が２であるため、検出に伴う遅延時間は２サンプリング時間と短く、短パルスの入力信号も検出することができる。
【００３７】
この実施の形態１では、除算演算回路４１が除算演算信号Ｘ２［ｎ・Ｔｓ］／Ｘ１［ｎ・Ｔｓ］を演算して、除算演算回路４２が除算演算信号Ｘ２［ｎ・Ｔｓ］／Ｘ３［ｎ・Ｔｓ］を演算するものを示したが、除算演算回路４１が除算演算信号Ｘ１［ｎ・Ｔｓ］／Ｘ２［ｎ・Ｔｓ］を演算して、除算演算回路４２が除算演算信号Ｘ３［ｎ・Ｔｓ］／Ｘ２［ｎ・Ｔｓ］を演算するようにしてもよい。
この場合、ｎ乗根演算回路４４から出力されるｎ乗根演算信号Ｎ［ｎ・Ｔｓ］＝［｜Ｙ［ｎ・Ｔｓ］｜］０．５は、下記の式（１４）で与えられる。
Ｎ［ｎ・Ｔｓ］＝［｜Ｙ［ｎ・Ｔｓ］｜］０．５
＝ｃｏｔ（Δθ＋Σθｎ−２）              （１４）
ここで、ｃｏｔ−１（Ｘ）＝−ｔａｎ−１（Ｘ）＋π／２の公式より、式（１４）で得られた値を逆正接演算し、その逆正接演算結果の符号を反転して、π／２を加算すれば、ディジタル信号Ｘｉｎの位相θＸ［ｎ・Ｔｓ］は、式（１２）で得られる値と同一になる。
【００３８】
以上で明らかなように、この実施の形態１によれば、入力されたディジタル信号Ｘｉｎ［ｎ・Ｔｓ］の振幅及び位相を変化させ、振幅及び位相変化後のディジタル信号として、互いに異なるディジタル信号Ｘ１［ｎ・Ｔｓ］，Ｘ２［ｎ・Ｔｓ］，Ｘ３［ｎ・Ｔｓ］を出力するトランスバーサルフィルタ１０，２０，３０が並列に接続されているフィルタ回路１を設け、位相周波数演算部４が、トランスバーサルフィルタ１０，２０，３０から出力されたディジタル信号Ｘ１［ｎ・Ｔｓ］，Ｘ２［ｎ・Ｔｓ］，Ｘ３［ｎ・Ｔｓ］を用いる位相演算及び周波数演算を実施して、入力されたディジタル信号Ｘｉｎ［ｎ・Ｔｓ］の位相θＸ［ｎ・Ｔｓ］及び周波数ｆＸ［ｎ・Ｔｓ］を演算するように構成したので、入力されるディジタル信号Ｘｉｎ［ｎ・Ｔｓ］が短パルスの信号でも位相θＸ［ｎ・Ｔｓ］と周波数ｆＸ［ｎ・Ｔｓ］を検出することができるとともに、遅延回路の段数の増加に伴う回路規模の大型化や消費電力の増加を抑えることができる効果を奏する。
【００３９】
この実施の形態１では、トランスバーサルフィルタ１０が、図２（ａ）に示す第１の減算型１次トランスバーサルフィルタＤである減算型１次トランスバーサルフィルタ１１，１２が直列に接続され、トランスバーサルフィルタ２０が、図２（ａ）に示す第１の減算型１次トランスバーサルフィルタＤである減算型１次トランスバーサルフィルタ２１と、図２（ｃ）に示す第１の加算型１次トランスバーサルフィルタＩである加算型１次トランスバーサルフィルタ２２とが直列に接続され、トランスバーサルフィルタ３０が、図２（ｃ）に示す第１の加算型１次トランスバーサルフィルタＩである加算型１次トランスバーサルフィルタ３１，３２が直列に接続されている例を示している。
ただし、これは一例に過ぎず、トランスバーサルフィルタ１０，２０，３０において、使用する１次トランスバーサルフィルタの種類は任意の組み合わせでよい。
例えば、減算型１次トランスバーサルフィルタ１１，１２，２１については図２（ｂ）に示す第２の減算型１次トランスバーサルフィルタ−Ｄを使用し、加算型１次トランスバーサルフィルタ２２，３１，３２については図２（ｄ）に示す第２の加算型１次トランスバーサルフィルタ−Ｉを使用することもでき、同様の効果を奏することができる。
なお、使用する１次トランスバーサルフィルタの組み合わせによっては、位相演算回路４５における符号変換の結果が反転する。
【００４０】
実施の形態２．
上記実施の形態１では、位相周波数演算部４において、除算演算回路４１，４２が除算演算を実施してから乗算演算回路４３が乗算演算を行うものを示したが、位相周波数演算部４において、乗算演算を実施してから除算演算を行うようにしてもよい。
図３はこの発明の実施の形態２による位相周波数検出装置を示す構成図であり、図３において、図１と同一符号は同一または相当部分を示すので説明を省略する。
乗算演算回路７１はトランスバーサルフィルタ１０から出力されたディジタル信号Ｘ１［ｎ・Ｔｓ］と、トランスバーサルフィルタ３０から出力されたディジタル信号Ｘ３［ｎ・Ｔｓ］との乗算演算を実施し、その乗算演算結果Ｘ１［ｎ・Ｔｓ］・Ｘ３［ｎ・Ｔｓ］を第１の乗算演算信号として出力する第１の乗算演算回路である。
【００４１】
乗算演算回路７２はトランスバーサルフィルタ２０から出力されたディジタル信号Ｘ２［ｎ・Ｔｓ］の自乗演算を実施して、その自乗演算結果Ｘ２［ｎ・Ｔｓ］・Ｘ２［ｎ・Ｔｓ］を第２の乗算演算信号として出力する第２の乗算演算回路である。
除算演算回路７３は乗算演算回路７２の自乗演算結果Ｘ２［ｎ・Ｔｓ］・Ｘ２［ｎ・Ｔｓ］を乗算演算回路７１の乗算演算結果Ｘ１［ｎ・Ｔｓ］・Ｘ３［ｎ・Ｔｓ］で除算し、その除算演算結果（Ｘ２［ｎ・Ｔｓ］・Ｘ２［ｎ・Ｔｓ］）／（Ｘ１［ｎ・Ｔｓ］・Ｘ３［ｎ・Ｔｓ］）を除算演算信号としてｎ乗根演算回路４４に出力する回路である。
【００４２】
図３のように、位相周波数演算部４において、乗算演算回路７１，７２が乗算演算を実施してから除算演算回路７３が除算演算を行うようにしても、式（１０）に示す値と同じ値がｎ乗根演算回路４４に出力されるため、上記実施の形態１と同様の効果を奏することができる。
【００４３】
実施の形態３．
上記実施の形態１では、フィルタ回路１が、３つのトランスバーサルフィルタ１０，２０，３０が並列に接続されている構成について示したが、２つのトランスバーサルフィルタ１０，３０が並列に接続されている構成であってもよい。
図４はこの発明の実施の形態３による位相周波数検出装置を示す構成図であり、図４において、図１と同一符号は同一または相当部分を示すので説明を省略する。
この実施の形態３では、トランスバーサルフィルタ１０が第１のトランスバーサルフィルタを構成し、トランスバーサルフィルタ３０が第２のトランスバーサルフィルタを構成する。
【００４４】
除算演算回路８１はトランスバーサルフィルタ１０から出力されたディジタル信号Ｘ１をトランスバーサルフィルタ３０から出力されたディジタル信号Ｘ３で除算し、その除算演算結果である除算演算信号Ｘ１／Ｘ３をｎ乗根演算回路８２に出力する回路である。
ｎ乗根演算回路８２は除算演算回路８１から出力された除算演算信号Ｘ１／Ｘ３の絶対値のｎ乗根演算を実施して、そのｎ乗根演算結果であるｎ乗根演算信号Ｎを周波数演算回路８３に出力する冪根演算回路である。
【００４５】
周波数演算回路８３はｎ乗根演算回路８２より出力されたｎ乗根演算信号Ｎから、入力されたディジタル信号Ｘｉｎの周波数ｆＸを演算する回路である。
位相演算回路８４は周波数演算回路８３により演算された周波数ｆＸから、入力されたディジタル信号Ｘｉｎの位相θＸを演算する回路である。
【００４６】
次に動作について説明する。
フィルタ回路１のトランスバーサルフィルタ１０，３０には、上記実施の形態１と同様に、離散時間ｎ・Ｔｓでディジタル信号Ｘｉｎ［ｎ・Ｔｓ］が入力されるものとする。
【００４７】
トランスバーサルフィルタ１０は、図２（ａ）に示す第１の減算型１次トランスバーサルフィルタＤである減算型１次トランスバーサルフィルタ１１，１２が直列に接続されているため、ディジタル信号Ｘｉｎ［ｎ・Ｔｓ］が入力されると、そのディジタル信号Ｘｉｎ［ｎ・Ｔｓ］の振幅及び位相を変化させ、振幅及び位相変化後のディジタル信号Ｘ１［ｎ・Ｔｓ］を位相周波数演算部４に出力する。
即ち、トランスバーサルフィルタ１０を構成している減算型１次トランスバーサルフィルタ１１は、ディジタル信号Ｘｉｎ［ｎ・Ｔｓ］が入力されると、上記の式（２）に示すようなディジタル信号Ｘ１’［ｎ・Ｔｓ］を減算型１次トランスバーサルフィルタ１２に出力する。
トランスバーサルフィルタ１０を構成している減算型１次トランスバーサルフィルタ１２は、減算型１次トランスバーサルフィルタ１１からディジタル信号Ｘ１’［ｎ・Ｔｓ］を受けると、上記の式（３）に示すようなディジタル信号Ｘ１［ｎ・Ｔｓ］を位相周波数演算部４に出力する。
【００４８】
トランスバーサルフィルタ３０は、図２（ｃ）に示す第１の加算型１次トランスバーサルフィルタＩである加算型１次トランスバーサルフィルタ３１，３２が直列に接続されているため、ディジタル信号Ｘｉｎ［ｎ・Ｔｓ］が入力されると、そのディジタル信号Ｘｉｎ［ｎ・Ｔｓ］の振幅及び位相を変化させ、振幅及び位相変化後のディジタル信号Ｘ３［ｎ・Ｔｓ］を位相周波数演算部４に出力する。
即ち、トランスバーサルフィルタ３０を構成している加算型１次トランスバーサルフィルタ３１は、ディジタル信号Ｘｉｎ［ｎ・Ｔｓ］が入力されると、上記の式（６）に示すようなディジタル信号Ｘ３’［ｎ・Ｔｓ］を加算型１次トランスバーサルフィルタ３２に出力する。
トランスバーサルフィルタ３０を構成している加算型１次トランスバーサルフィルタ３２は、加算型１次トランスバーサルフィルタ３１からディジタル信号Ｘ３’［ｎ・Ｔｓ］を受けると、上記の式（７）に示すようなディジタル信号Ｘ３［ｎ・Ｔｓ］を位相周波数演算部４に出力する。
【００４９】
位相周波数演算部４は、トランスバーサルフィルタ１０，３０からディジタル信号Ｘ１［ｎ・Ｔｓ］，Ｘ３［ｎ・Ｔｓ］を受けると、そのディジタル信号Ｘ１［ｎ・Ｔｓ］，Ｘ３［ｎ・Ｔｓ］を用いる位相演算及び周波数演算を実施して、入力されたディジタル信号Ｘｉｎの位相θＸ［ｎ・Ｔｓ］及び周波数ｆＸ［ｎ・Ｔｓ］を演算する。
即ち、位相周波数演算部４の除算演算回路８１は、トランスバーサルフィルタ１０，３０からディジタル信号Ｘ１［ｎ・Ｔｓ］，Ｘ３［ｎ・Ｔｓ］を受けると、下記の式（１５）に示すように、そのディジタル信号Ｘ１［ｎ・Ｔｓ］をディジタル信号Ｘ３［ｎ・Ｔｓ］で除算し、その除算演算結果である除算演算信号Ｘ１［ｎ・Ｔｓ］／Ｘ３［ｎ・Ｔｓ］をｎ乗根演算回路８２に出力する。
Ｘ１［ｎ・Ｔｓ］／Ｘ３［ｎ・Ｔｓ］
＝［−４・α・ｓｉｎ（０．５・Δθ）・ｓｉｎ（０．５・Δθ）
・ｃｏｓ（Δθ＋Σθｎ−２）］
／［４・α・ｃｏｓ（０．５・Δθ）・ｃｏｓ（０．５・Δθ）
・ｃｏｓ（Δθ＋Σθｎ−２）］
＝−ｔａｎ２（０．５・Δθ）
（１５）
【００５０】
ｎ乗根演算回路８２は、除算演算回路８１から除算演算信号Ｘ１［ｎ・Ｔｓ］／Ｘ３［ｎ・Ｔｓ］を受けると、その除算演算信号Ｘ１［ｎ・Ｔｓ］／Ｘ３［ｎ・Ｔｓ］の絶対値のｎ乗根演算を実施して、そのｎ乗根演算結果であるｎ乗根演算信号Ｎ［ｎ・Ｔｓ］を周波数演算回路８３に出力する。
Ｎ［ｎ・Ｔｓ］＝ｔａｎ（０．５・Δθ）            （１６）
ここでのｎ乗根演算におけるｎは０．５であるため、Ｎ［ｎ・Ｔｓ］は［｜−ｔａｎ２（０．５・Δθ）｜］０．５となる。
【００５１】
周波数演算回路８３は、ｎ乗根演算回路８２からｎ乗根演算信号Ｎ［ｎ・Ｔｓ］を受けると、下記の式（１７）に示すように、そのｎ乗根演算信号Ｎ［ｎ・Ｔｓ］の逆正接演算であるａｒｃｔａｎ演算する。
ｔａｎ−１（｜Ｎ［ｎ・Ｔｓ］｜）
＝ｔａｎ−１（｜ｔａｎ（０．５・Δθ）｜）
＝０．５・Δθ                                    （１７）
そして、周波数演算回路８３は、ｎ乗根演算信号Ｎ［ｎ・Ｔｓ］の逆正接演算結果０．５・Δθを用いて、下記の式（１８）に示すように、ディジタル信号Ｘｉｎ［ｎ・Ｔｓ］の周波数ｆＸ［ｎ・Ｔｓ］を演算する。
ｆＸ［ｎ・Ｔｓ］
＝（０．５・Δθ）・２・ｆｓ／（２π）
＝Δθ・ｆｓ／（２π）                            （１８）
なお、式（１８）より、１サンプリング時間における位相の変化量Δθは、周波数ｆＸ［ｎ・Ｔｓ］と同様に常に正の値となる。このため、上記実施の形態１で述べたような位相の符号変換は不要である。
【００５２】
位相演算回路８４は、周波数演算回路８３がディジタル信号Ｘｉｎ［ｎ・Ｔｓ］の周波数ｆＸ［ｎ・Ｔｓ］を演算すると、下記の式（１９）に示すように、ディジタル信号Ｘｉｎ［ｎ・Ｔｓ］の周波数ｆＸ［ｎ・Ｔｓ］からディジタル信号Ｘｉｎ［ｎ・Ｔｓ］の位相θＸ［ｎ・Ｔｓ］を演算する。
θＸ［ｎ・Ｔｓ］＝Σ［ｆＸ［ｎ・Ｔｓ］・（２π）／ｆｓ］    （１９）
【００５３】
この実施の形態３では、式（１８）と式（１９）より、位相周波数演算部４が、ヒルベルト変換を実施することなく、ディジタル信号Ｘｉｎの位相θＸ［ｎ・Ｔｓ］と周波数ｆＸ［ｎ・Ｔｓ］を検出することができる。
また、トランスバーサルフィルタ１０，３０が使用している遅延回路の段数が２であるため、検出に伴う遅延時間は２サンプリング時間と短く、短パルスの入力信号も検出することができる。
【００５４】
この実施の形態３では、除算演算回路８１が除算演算信号Ｘ１［ｎ・Ｔｓ］／Ｘ３［ｎ・Ｔｓ］を演算するものを示したが、除算演算回路８１が除算演算信号Ｘ３［ｎ・Ｔｓ］／Ｘ１［ｎ・Ｔｓ］を演算するようにしてもよい。
ただし、この場合は、ｎ乗根演算信号Ｎ［ｎ・Ｔｓ］の逆正接演算結果に対してπ／２を加算する必要があり、π／２を加算することで、式（１７）で得られる値と同一になる。
【００５５】
以上で明らかなように、この実施の形態３によれば、入力されたディジタル信号Ｘｉｎ［ｎ・Ｔｓ］の振幅及び位相を変化させ、振幅及び位相変化後のディジタル信号として、互いに異なるディジタル信号Ｘ１［ｎ・Ｔｓ］，Ｘ３［ｎ・Ｔｓ］を出力するトランスバーサルフィルタ１０，３０が並列に接続されているフィルタ回路１を設け、位相周波数演算部４が、トランスバーサルフィルタ１０，３０から出力されたディジタル信号Ｘ１［ｎ・Ｔｓ］，Ｘ３［ｎ・Ｔｓ］を用いる位相演算及び周波数演算を実施して、入力されたディジタル信号Ｘｉｎ［ｎ・Ｔｓ］の位相θＸ［ｎ・Ｔｓ］及び周波数ｆＸ［ｎ・Ｔｓ］を演算するように構成したので、入力されるディジタル信号Ｘｉｎ［ｎ・Ｔｓ］が短パルスの信号でも位相θＸ［ｎ・Ｔｓ］と周波数ｆＸ［ｎ・Ｔｓ］を検出することができるとともに、遅延回路の段数の増加に伴う回路規模の大型化や消費電力の増加を抑えることができる効果を奏する。
【００５６】
この実施の形態３では、トランスバーサルフィルタ１０が、図２（ａ）に示す第１の減算型１次トランスバーサルフィルタＤである減算型１次トランスバーサルフィルタ１１，１２が直列に接続され、トランスバーサルフィルタ３０が、図２（ｃ）に示す第１の加算型１次トランスバーサルフィルタＩである加算型１次トランスバーサルフィルタ３１，３２が直列に接続されている例を示している。
ただし、これは一例に過ぎず、トランスバーサルフィルタ１０，３０において、使用する１次トランスバーサルフィルタの種類は任意の組み合わせでよい。
例えば、減算型１次トランスバーサルフィルタ１１，１２については図２（ｂ）に示す第２の減算型１次トランスバーサルフィルタ−Ｄを使用し、加算型１次トランスバーサルフィルタ３１，３２については図２（ｄ）に示す第２の加算型１次トランスバーサルフィルタ−Ｉを使用することもでき、同様の効果を奏することができる。
【００５７】
実施の形態４．
図５はこの発明の実施の形態４による位相周波数検出装置のフィルタ回路１を示す構成図であり、図５において、図１と同一符号は同一または相当部分を示している。
上記実施の形態１では、トランスバーサルフィルタ２０が、図２（ａ）に示す第１の減算型１次トランスバーサルフィルタＤである減算型１次トランスバーサルフィルタ２１と、図２（ｃ）に示す第１の加算型１次トランスバーサルフィルタＩである加算型１次トランスバーサルフィルタ２２とが直列に接続されているものを示したが、図５に示すように、トランスバーサルフィルタ２０が、トランスバーサルフィルタ１０の減算型１次トランスバーサルフィルタ１１から出力されたディジタル信号が入力される加算型１次トランスバーサルフィルタ２２から構成されているようにしてもよい。この加算型１次トランスバーサルフィルタ２２は、図２（ｃ）に示す第１の加算型１次トランスバーサルフィルタＩである。
【００５８】
図５の場合、トランスバーサルフィルタ１０の減算型１次トランスバーサルフィルタ１１から出力されるディジタル信号Ｘ１’［ｎ・Ｔｓ］は、図１のトランスバーサルフィルタ２０の減算型１次トランスバーサルフィルタ２１から出力されるディジタル信号Ｘ２’［ｎ・Ｔｓ］と同じになるので、トランスバーサルフィルタ２０の加算型１次トランスバーサルフィルタ２２から出力されるディジタル信号Ｘ２［ｎ・Ｔｓ］は、上記実施の形態１と同じである。
【００５９】
よって、位相周波数演算部４の動作は、上記実施の形態１と同様の動作になり、上記実施の形態１と同様の効果が得られる。
また、トランスバーサルフィルタ２０において、減算型１次トランスバーサルフィルタ２１が不要になるため、上記実施の形態１よりも、回路規模を小さくできる。
【００６０】
実施の形態５．
図６はこの発明の実施の形態５による位相周波数検出装置のフィルタ回路１を示す構成図であり、図６において、図１と同一符号は同一または相当部分を示している。
上記実施の形態１では、トランスバーサルフィルタ２０が、図２（ａ）に示す第１の減算型１次トランスバーサルフィルタＤである減算型１次トランスバーサルフィルタ２１と、図２（ｃ）に示す第１の加算型１次トランスバーサルフィルタＩである加算型１次トランスバーサルフィルタ２２とが直列に接続されているものを示したが、図６に示すように、トランスバーサルフィルタ２０が、トランスバーサルフィルタ３０の加算型１次トランスバーサルフィルタ３１から出力されたディジタル信号が入力される減算型１次トランスバーサルフィルタ２１から構成されているようにしてもよい。この減算型１次トランスバーサルフィルタ２１は、図２（ａ）に示す第１の減算型１次トランスバーサルフィルタＤである。
【００６１】
図６の場合、トランスバーサルフィルタ２０は、減算型１次トランスバーサルフィルタ２１のみで構成されているが、減算型１次トランスバーサルフィルタ２１は、トランスバーサルフィルタ３０の加算型１次トランスバーサルフィルタ３１から出力されたディジタル信号が入力されるので、実質的には、加算型１次トランスバーサルフィルタ３１と減算型１次トランスバーサルフィルタ２１が直列に接続されているトランスバーサルフィルタと等価である。
このトランスバーサルフィルタを構成している加算型１次トランスバーサルフィルタ３１と減算型１次トランスバーサルフィルタ２１の接続順序が、図１のトランスバーサルフィルタ２０における減算型１次トランスバーサルフィルタ２１と加算型１次トランスバーサルフィルタ２２の接続順序と逆になっているが、接続順序が逆でも最終的に出力されるディジタル信号は同じである。
このため、減算型１次トランスバーサルフィルタ２１のみで構成されている図６のトランスバーサルフィルタ２０から出力されるディジタル信号Ｘ２［ｎ・Ｔｓ］は、図１のトランスバーサルフィルタ２０から出力されるディジタル信号Ｘ２［ｎ・Ｔｓ］と同じになる。
【００６２】
よって、位相周波数演算部４の動作は、上記実施の形態１と同様の動作になり、上記実施の形態１と同様の効果が得られる。
また、トランスバーサルフィルタ２０において、加算型１次トランスバーサルフィルタ２２が不要になるため、上記実施の形態１よりも、回路規模を小さくできる。
【００６３】
実施の形態６．
図７はこの発明の実施の形態６による位相周波数検出装置のフィルタ回路１を示す構成図であり、図７において、図１と同一符号は同一または相当部分を示している。
上記実施の形態１では、トランスバーサルフィルタ２０における入力側の１次トランスバーサルフィルタが減算型１次トランスバーサルフィルタ２１で、出力側の１次トランスバーサルフィルタが加算型１次トランスバーサルフィルタ２２であり、また、トランスバーサルフィルタ３０が、図２（ｃ）に示す第１の加算型１次トランスバーサルフィルタＩである加算型１次トランスバーサルフィルタ３１，３２が直列に接続されているものを示している。
【００６４】
この実施の形態６では、図７に示すように、トランスバーサルフィルタ２０を構成している減算型１次トランスバーサルフィルタ２１と加算型１次トランスバーサルフィルタ２２の順番を入れ替えて、入力側の１次トランスバーサルフィルタが加算型１次トランスバーサルフィルタ２２で、出力側の１次トランスバーサルフィルタが減算型１次トランスバーサルフィルタ２１であるようにしている。
また、トランスバーサルフィルタ３０が、トランスバーサルフィルタ２０の加算型１次トランスバーサルフィルタ２２から出力されたディジタル信号が入力される加算型１次トランスバーサルフィルタ３２から構成されているようにしている。この加算型１次トランスバーサルフィルタ３２は、図２（ｃ）に示す第１の加算型１次トランスバーサルフィルタＩである。
【００６５】
図７の場合、トランスバーサルフィルタ２０を構成している加算型１次トランスバーサルフィルタ２２と減算型１次トランスバーサルフィルタ２１の接続順序が、図１のトランスバーサルフィルタ２０を構成している減算型１次トランスバーサルフィルタ２１と加算型１次トランスバーサルフィルタ２２の接続順序と逆になっているが、接続順序が逆でも最終的に出力されるディジタル信号Ｘ２［ｎ・Ｔｓ］は同じである。
また、トランスバーサルフィルタ２０の加算型１次トランスバーサルフィルタ２２から出力されるディジタル信号Ｘ２’［ｎ・Ｔｓ］は、図１のトランスバーサルフィルタ３０の加算型１次トランスバーサルフィルタ３１から出力されるディジタル信号Ｘ３’［ｎ・Ｔｓ］と同じになるので、トランスバーサルフィルタ３０の加算型１次トランスバーサルフィルタ３２から出力されるディジタル信号Ｘ３［ｎ・Ｔｓ］は、上記実施の形態１と同じである。
【００６６】
よって、位相周波数演算部４の動作は、上記実施の形態１と同様の動作になり、上記実施の形態１と同様の効果が得られる。
また、トランスバーサルフィルタ３０において、加算型１次トランスバーサルフィルタ３１が不要になるため、上記実施の形態１よりも、回路規模を小さくできる。
【００６７】
実施の形態７．
上記実施の形態１では、トランスバーサルフィルタ１０が、図２（ａ）に示す第１の減算型１次トランスバーサルフィルタＤである減算型１次トランスバーサルフィルタ１１，１２が直列に接続されているものを示したが、この実施の形態７では、トランスバーサルフィルタ１０が、図１のトランスバーサルフィルタ１０と別の回路で構成されているものについて説明する。
【００６８】
図８はこの発明の実施の形態７による位相周波数検出装置のトランスバーサルフィルタ１０を示す構成図である。
図８において、分配回路９１は入力されたディジタル信号Ｘｉｎを２つに分配する回路である。
１サンプリング時間遅延回路９２は分配回路９１により分配された一方のディジタル信号を１サンプリング時間Ｔｓだけ遅延する第１の遅延回路である。
１サンプリング時間遅延回路９３は１サンプリング時間遅延回路９２により遅延されたディジタル信号を１サンプリング時間Ｔｓだけ遅延する第２の遅延回路である。
係数乗算回路９４は１サンプリング時間遅延回路９２により遅延されたディジタル信号に対して、−２の係数を乗算する回路である。
加算演算回路９５は１サンプリング時間遅延回路９３により遅延されたディジタル信号と、係数乗算回路９４により係数が乗算されたディジタル信号と、分配回路９１により分配された他方のディジタル信号との加算演算を実施する回路である。
【００６９】
次に動作について説明する。
加算演算回路９５は、１サンプリング時間遅延回路９２，９３によって２サンプリング時間Ｔｓだけ遅延されたディジタル信号と、１サンプリング時間遅延回路９２によって１サンプリング時間Ｔｓだけ遅延されのち、係数乗算回路９４によって−２の係数が乗算されたディジタル信号と、分配回路９１により分配されたディジタル信号とを加算するものであるため、図８のトランスバーサルフィルタ１０の伝達特性ＤＦ１は、下記の式（２０）のようになる。
ＤＦ１＝Ｚ−２−２・Ｚ−１＋１                    （２０）
式（２０）において、Ｚ−１はｅｘｐ（−ｊω・Ｔｓ）の複素数であり、１サンプリング時間の遅延を表している。またＺ−２は２サンプリング時間の遅延を表している。
【００７０】
一方、図１のトランスバーサルフィルタ１０の伝達特性ＤＦ１は、図２（ａ）に示す第１の減算型１次トランスバーサルフィルタＤである減算型１次トランスバーサルフィルタ１１，１２が直列に接続されているものであるため、下記の式（２１）のようになる。
ＤＦ１＝（１−Ｚ−１）・（１−Ｚ−１）
＝Ｚ−２−２・Ｚ−１＋１                    （２１）
【００７１】
式（２０）と式（２１）より、図８のトランスバーサルフィルタ１０の伝達特性ＤＦ１と、図１のトランスバーサルフィルタ１０の伝達特性ＤＦ１は同じであり、図１のトランスバーサルフィルタ１０の代わりに、図８のトランスバーサルフィルタ１０を用いることができる。
【００７２】
実施の形態８．
上記実施の形態１では、トランスバーサルフィルタ２０が、図２（ａ）に示す第１の減算型１次トランスバーサルフィルタＤである減算型１次トランスバーサルフィルタ２１と、図２（ｃ）に示す第１の加算型１次トランスバーサルフィルタＩである加算型１次トランスバーサルフィルタ２２とが直列に接続されているものを示したが、この実施の形態８では、トランスバーサルフィルタ２０が、図１のトランスバーサルフィルタ２０と別の回路で構成されているものについて説明する。
【００７３】
図９はこの発明の実施の形態８による位相周波数検出装置のトランスバーサルフィルタ２０を示す構成図である。
図９において、分配回路１０１は入力されたディジタル信号Ｘｉｎを２つに分配する回路である。
１サンプリング時間遅延回路１０２は分配回路１０１により分配された一方のディジタル信号を１サンプリング時間Ｔｓだけ遅延する第１の遅延回路である。
１サンプリング時間遅延回路１０３は１サンプリング時間遅延回路１０２により遅延されたディジタル信号を１サンプリング時間Ｔｓだけ遅延する第２の遅延回路である。
係数乗算回路１０４は１サンプリング時間遅延回路１０３により遅延されたディジタル信号に対して、−１の係数を乗算する回路である。
加算演算回路１０５は係数乗算回路１０４により係数が乗算されたディジタル信号と、分配回路１０１により分配された他方のディジタル信号との加算演算を実施する回路である。
【００７４】
次に動作について説明する。
加算演算回路１０５は、１サンプリング時間遅延回路１０２，１０３によって２サンプリング時間Ｔｓだけ遅延されたのち、係数乗算回路１０４によって−１の係数が乗算されたディジタル信号と、分配回路１０１によって分配されたディジタル信号とを加算するものであるため、図９のトランスバーサルフィルタ１０の伝達特性ＤＦ２は、下記の式（２２）のようになる。
ＤＦ２＝１−Ｚ−２                            （２２）
【００７５】
一方、図１のトランスバーサルフィルタ２０の伝達特性ＤＦ２は、図２（ａ）に示す第１の減算型１次トランスバーサルフィルタＤである減算型１次トランスバーサルフィルタ２１と、図２（ｃ）に示す第１の加算型１次トランスバーサルフィルタＩである加算型１次トランスバーサルフィルタ２２とが直列に接続されているものであるため、下記の式（２３）のようになる。
ＤＦ２＝（１−Ｚ−１）・（１＋Ｚ−１）
＝１−Ｚ−２                            （２３）
【００７６】
式（２２）と式（２３）より、図９のトランスバーサルフィルタ２０の伝達特性ＤＦ２と、図１のトランスバーサルフィルタ２０の伝達特性ＤＦ２は同じであり、図１のトランスバーサルフィルタ２０の代わりに、図９のトランスバーサルフィルタ２０を用いることができる。
【００７７】
実施の形態９．
上記実施の形態１では、トランスバーサルフィルタ３０が、図２（ｃ）に示す第１の加算型１次トランスバーサルフィルタＩである加算型１次トランスバーサルフィルタ３１，３２が直列に接続されているものを示したが、この実施の形態９では、トランスバーサルフィルタ３０が、図１のトランスバーサルフィルタ３０と別の回路で構成されているものについて説明する。
【００７８】
図１０はこの発明の実施の形態９による位相周波数検出装置のトランスバーサルフィルタ３０を示す構成図である。
図１０において、分配回路１１１は入力されたディジタル信号Ｘｉｎを２つに分配する回路である。
１サンプリング時間遅延回路１１２は分配回路１１１により分配された一方のディジタル信号を１サンプリング時間Ｔｓだけ遅延する第１の遅延回路である。
１サンプリング時間遅延回路１１３は１サンプリング時間遅延回路１１２により遅延されたディジタル信号を１サンプリング時間Ｔｓだけ遅延する第２の遅延回路である。
係数乗算回路１１４は１サンプリング時間遅延回路１１２により遅延されたディジタル信号に対して、２の係数を乗算する回路である。
加算演算回路１１５は１サンプリング時間遅延回路１１３により遅延されたディジタル信号と、係数乗算回路１１４により係数が乗算されたディジタル信号と、分配回路１１１により分配された他方のディジタル信号との加算演算を実施する回路である。
【００７９】
次に動作について説明する。
加算演算回路１１５は、１サンプリング時間遅延回路１１２，１１３によって２サンプリング時間Ｔｓだけ遅延されたディジタル信号と、１サンプリング時間遅延回路１１２によって１サンプリング時間Ｔｓだけ遅延されのち、係数乗算回路１１４によって２の係数が乗算されたディジタル信号と、分配回路１１１により分配されたディジタル信号とを加算するものであるため、図１０のトランスバーサルフィルタ３０の伝達特性ＤＦ３は、下記の式（２４）のようになる。
ＤＦ３＝Ｚ−２＋２・Ｚ−１＋１                  （２４）
【００８０】
一方、図１のトランスバーサルフィルタ３０の伝達特性ＤＦ３は、図２（ｃ）に示す第１の加算型１次トランスバーサルフィルタＩである加算型１次トランスバーサルフィルタ３１，３２が直列に接続されているものであるため、下記の式（２５）のようになる。
ＤＦ３＝（Ｚ−１＋１）・（Ｚ−１＋１）
＝Ｚ−２＋２・Ｚ−１＋１                  （２５）
【００８１】
式（２４）と式（２５）より、図１０のトランスバーサルフィルタ３０の伝達特性ＤＦ３と、図１のトランスバーサルフィルタ３０の伝達特性ＤＦ３は同じであり、図１のトランスバーサルフィルタ３０の代わりに、図１０のトランスバーサルフィルタ３０を用いることができる。
【００８２】
実施の形態１０．
上記実施の形態１では、フィルタ回路１がトランスバーサルフィルタ１０，２０，３０から構成されているものを示したが、入力されたディジタル信号Ｘｉｎに重畳されているノイズを除去するディジタルフィルタがトランスバーサルフィルタ１０，２０，３０に実装されているようにしてもよい。
図１１はこの発明の実施の形態１０による位相周波数検出装置のフィルタ回路１を示す構成図であり、図１１において、図１と同一符号は同一または相当部分を示すので説明を省略する。
ディジタルフィルタ１３は減算型１次トランスバーサルフィルタ１２から出力されたディジタル信号に重畳されているノイズを除去するフィルタである。
ディジタルフィルタ２３は加算型１次トランスバーサルフィルタ２２から出力されたディジタル信号に重畳されているノイズを除去するフィルタである。
ディジタルフィルタ３３は加算型１次トランスバーサルフィルタ３２から出力されたディジタル信号に重畳されているノイズを除去するフィルタである。
【００８３】
ディジタルフィルタ１３，２３，３３は、ディジタル信号Ｘｉｎに重畳されているノイズを除去することができればよく、特に回路構成は問わないが、例えば、ＦＩＲ（Ｆｉｎｉｔｅ  Ｉｍｐｕｓｌｅ  Ｒｅｓｐｏｎｓｅ）型やＩＩＲ（Ｉｎｆｉｎｉｔｅ  Ｉｍｐｕｓｌｅ  Ｒｅｓｐｏｎｓｅ）型のフィルタを用いることができる。
ただし、図１の位相周波数演算部４が、ディジタル信号Ｘｉｎ［ｎ・Ｔｓ］の位相θＸ［ｎ・Ｔｓ］と周波数ｆＸ［ｎ・Ｔｓ］を検出できるようにするには、ディジタルフィルタ１３，２３，３３の伝達特性ＤＦが全て同じである必要がある。
【００８４】
図１１では、図１のフィルタ回路１に対して、ディジタルフィルタ１３，２３，３３を適用している例を示しているが、図４に示すように、２つのトランスバーサルフィルタ１０，３０から構成されているフィルタ回路１に対して、ディジタルフィルタ１３，３３を適用するようにしてもよい。
【００８５】
この実施の形態１０では、トランスバーサルフィルタ１０，２０，３０において、ディジタルフィルタ１３，２３，３３が、２つの１次トランスバーサルフィルタの出力端側に接続されているものを示しているが、図１２に示すように、ディジタルフィルタ１３，２３，３３が、２つの１次トランスバーサルフィルタの入力端側に接続されているものであってもよく、ディジタル信号に重畳されているノイズを除去することができる。
また、図１３に示すように、フィルタ回路１の前段にディジタルフィルタ１３が接続されているものであってもよく、ディジタル信号に重畳されているノイズを除去することができる。
【００８６】
実施の形態１１．
図１４はこの発明の実施の形態１１による位相周波数検出装置を示す構成図であり、図１４において、図１と同一符号は同一または相当部分を示すので説明を省略する。
位相周波数演算部１２１は図１の位相周波数演算部４と同じ構成の演算部であり、トランスバーサルフィルタ１０，２０，３０から出力されたディジタル信号Ｘ１，Ｘ２，Ｘ３を用いる位相演算及び周波数演算を実施して、入力されたディジタル信号Ｘｉｎの位相θＸ及び周波数ｆＸを演算する。
位相周波数演算部１２２は図４の位相周波数演算部４と同じ構成の演算部であり、トランスバーサルフィルタ１０，３０から出力されたディジタル信号Ｘ１，Ｘ３を用いる位相演算及び周波数演算を実施して、入力されたディジタル信号Ｘｉｎの位相θＸ及び周波数ｆＸを演算する。
図１の位相周波数演算部４と図４の位相周波数演算部４とは、上記実施の形態１，３で示しているように、位相演算及び周波数演算の処理内容が異なっている。
統計演算部１２３は位相周波数演算部１２１により演算された位相θＸと位相周波数演算部１２２により演算された位相θＸとの統計演算を実施するとともに、位相周波数演算部１２１により演算された周波数ｆＸと位相周波数演算部１２２により演算された周波数ｆＸとの統計演算を実施する。
【００８７】
次に動作について説明する。
位相周波数演算部１２１は、図１の位相周波数演算部４と同様に、ディジタル信号Ｘｉｎ［ｎ・Ｔｓ］の位相θＸ［ｎ・Ｔｓ］及び周波数ｆＸ［ｎ・Ｔｓ］を演算する。
位相周波数演算部１２２は、図４の位相周波数演算部４と同様に、ディジタル信号Ｘｉｎ［ｎ・Ｔｓ］の位相θＸ［ｎ・Ｔｓ］及び周波数ｆＸ［ｎ・Ｔｓ］を演算する。
【００８８】
位相周波数演算部１２１，１２２におけるディジタル演算のビット数が無限大であれば、そのディジタル演算において量子化誤差が発生しないため、式（１２）で求まるθＸ［ｎ・Ｔｓ］と、式（１９）で求まるθＸ［ｎ・Ｔｓ］とが同じ値になり、また、式（１３）で求まる周波数ｆＸ［ｎ・Ｔｓ］と、式（１８）で求まる周波数ｆＸ［ｎ・Ｔｓ］とが同じ値になる。
しかし、位相周波数演算部１２１，１２２におけるディジタル演算のビット数は有限の値であるため、量子化誤差が発生する。
【００８９】
そこで、統計演算部１２３は、位相周波数演算部１２１により演算された位相θＸ［ｎ・Ｔｓ］と位相周波数演算部１２２により演算された位相θＸ［ｎ・Ｔｓ］との統計演算を実施するとともに、位相周波数演算部１２１により演算された周波数ｆＸ［ｎ・Ｔｓ］と位相周波数演算部１２２により演算された周波数ｆＸ［ｎ・Ｔｓ］との統計演算を実施する。
ここで、位相周波数演算部１２１，１２２により演算された２つの位相θＸ［ｎ・Ｔｓ］の統計演算としては、２つの位相θＸ［ｎ・Ｔｓ］の平均値を求める演算や重み付け加算を求める演算などが考えられる。
また、位相周波数演算部１２１，１２２により演算された２つの周波数ｆＸ［ｎ・Ｔｓ］の統計演算としては、２つの周波数ｆＸ［ｎ・Ｔｓ］の平均値を求める演算や重み付け加算を求める演算などが考えられる。
これにより、位相周波数演算部１２１，１２２のディジタル演算で発生する量子化誤差の影響を軽減して、高精度な位相θＸ［ｎ・Ｔｓ］及び周波数ｆＸ［ｎ・Ｔｓ］得ることができる。
【００９０】
この実施の形態１１では、位相演算及び周波数演算の処理内容が異なっている位相周波数演算部１２１，１２２が実装され、統計演算部１２３が位相周波数演算部１２１，１２２の演算結果を統計演算するものを示したが、位相演算及び周波数演算の処理内容が異なる３つ以上の位相周波数演算部が実装され、統計演算部１２３が３つ以上の位相周波数演算部の演算結果を統計演算するようにしてもよい。
【００９１】
この実施の形態１１では、位相演算及び周波数演算の処理内容が異なっている位相周波数演算部１２１，１２２が実装されているものを示したが、複数の位相周波数演算部の前段に接続されるフィルタ回路１の構成が異なるようにして、統計演算部１２３が複数の位相周波数演算部の演算結果を統計演算するようにしてもよい。
例えば、図１５に示すように、ディジタルフィルタ１３，２３，３３が実装されていないトランスバーサルフィルタ１０，２０，３０で構成されているフィルタ回路１の出力信号からディジタル信号Ｘｉｎ［ｎ・Ｔｓ］の位相θＸ［ｎ・Ｔｓ］及び周波数ｆＸ［ｎ・Ｔｓ］を演算する位相周波数演算部１２１と、ディジタルフィルタ１３，２３，３３が実装されているトランスバーサルフィルタ１０，２０，３０で構成されているフィルタ回路１の出力信号からディジタル信号Ｘｉｎ［ｎ・Ｔｓ］の位相θＸ［ｎ・Ｔｓ］及び周波数ｆＸ［ｎ・Ｔｓ］を演算する位相周波数演算部１２１とを設け、統計演算部１２３が、２つの位相周波数演算部１２１により演算された位相θＸ［ｎ・Ｔｓ］の統計演算を実施するとともに、２つの位相周波数演算部１２１により演算された周波数ｆＸ［ｎ・Ｔｓ］の統計演算を実施するようにしてもよい。
この場合も、２つの位相周波数演算部１２１のディジタル演算で発生する量子化誤差の影響を軽減して、高精度な位相θＸ［ｎ・Ｔｓ］及び周波数ｆＸ［ｎ・Ｔｓ］を得ることができる。
【００９２】
なお、本願発明はその発明の範囲内において、各実施の形態の自由な組み合わせ、あるいは各実施の形態の任意の構成要素の変形、もしくは各実施の形態において任意の構成要素の省略が可能である。
【産業上の利用可能性】
【００９３】
この発明に係る位相周波数検出装置は、入力されたディジタル信号Ｘｉｎの位相θＸ及び周波数ｆＸを検出する際、入力されるディジタル信号Ｘｉｎが短パルスの信号でも検出する必要があるものに適している。
【符号の説明】
【００９４】
１  フィルタ回路、４  位相周波数演算部、１０  トランスバーサルフィルタ（第１のトランスバーサルフィルタ）、１１，１２  減算型１次トランスバーサルフィルタ、１３  ディジタルフィルタ、２０  トランスバーサルフィルタ（第２のトランスバーサルフィルタ）、２１  減算型１次トランスバーサルフィルタ、２２  加算型１次トランスバーサルフィルタ、２３  ディジタルフィルタ、３０  トランスバーサルフィルタ（第３のトランスバーサルフィルタ、第２のトランスバーサルフィルタ）、３１，３２  加算型１次トランスバーサルフィルタ、３３  ディジタルフィルタ、４１  除算演算回路（第１の除算演算回路）、４２  除算演算回路（第２の除算演算回路）、４３  乗算演算回路、４４  ｎ乗根演算回路（冪根演算回路）、４５  位相演算回路、４６  周波数演算回路、５１  分配回路（第１の分配回路）、５２  １サンプリング時間遅延回路（第１の遅延回路）、５３，５４  減算演算回路、６１  分配回路（第２の遅延回路）、６２  １サンプリング時間遅延回路（第２の遅延回路）、６３，６４  加算演算回路、７１  乗算演算回路（第１の乗算演算回路）、７２  乗算演算回路（第２の乗算演算回路）、７３  除算演算回路、８１  除算演算回路、８２  ｎ乗根演算回路（冪根演算回路）、８３  周波数演算回路、８４  位相演算回路、９１  分配回路、９２  １サンプリング時間遅延回路（第１の遅延回路）、９３  １サンプリング時間遅延回路（第２の遅延回路）、９４  係数乗算回路、９５  加算演算回路、１０１  分配回路、１０２  １サンプリング時間遅延回路（第１の遅延回路）、１０３  １サンプリング時間遅延回路（第２の遅延回路）、１０４  係数乗算回路、１０５  加算演算回路、１１１  分配回路、１１２  １サンプリング時間遅延回路（第１の遅延回路）、１１３  １サンプリング時間遅延回路（第２の遅延回路）、１１４  係数乗算回路、１１５  加算演算回路、１２１，１２２  位相周波数演算部、１２３  統計演算部。
【図１】
2016139778.tif 000003
【図２】
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【図３】
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【図４】
2016139778.tif 000006
【図５】
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【図６】
2016139778.tif 000008
【図７】
2016139778.tif 000009
【図８】
2016139778.tif 000010
【図９】
2016139778.tif 000011
【図１０】
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【図１１】
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【図１２】
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【図１３】
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【図１４】
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【図１５】
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【手続補正書】
【提出日】平成29年3月1日(2017.3.1)
【手続補正１】
【補正対象書類名】明細書
【補正対象項目名】０００８
【補正方法】変更
【補正の内容】
【０００８】
この発明に係る位相周波数検出装置は、入力されたディジタル信号の振幅及び位相を変化させ、振幅及び位相変化後のディジタル信号として、互いに異なるディジタル信号を出力する複数のトランスバーサルフィルタが並列に接続されているフィルタ回路と、複数のトランスバーサルフィルタから出力されたディジタル信号を用いる位相演算及び周波数演算を実施して、入力されたディジタル信号の位相及び周波数を演算する位相周波数演算部とを備え、フィルタ回路は、複数のトランスバーサルフィルタとして、第１のトランスバーサルフィルタと第２のトランスバーサルフィルタと第３のトランスバーサルフィルタとが並列に接続されており、位相周波数演算部は、第１のトランスバーサルフィルタから出力されたディジタル信号と第２のトランスバーサルフィルタから出力されたディジタル信号との間で除算演算を実施して、その除算演算結果である第１の除算演算信号を出力する第１の除算演算回路と、第３のトランスバーサルフィルタから出力されたディジタル信号と第２のトランスバーサルフィルタから出力されたディジタル信号との間で除算演算を実施して、その除算演算結果である第２の除算演算信号を出力する第２の除算演算回路と、第１の除算演算回路から出力された第１の除算演算信号と第２の除算演算回路から出力された第２の除算演算信号との乗算演算を実施して、その乗算演算結果である乗算演算信号を出力する乗算演算回路と、乗算演算回路から出力された乗算演算信号の冪根演算を実施して、その冪根演算結果である冪根演算信号を出力する冪根演算回路と、冪根演算回路より出力された冪根演算信号と第１の除算演算信号又は第２の除算演算信号の符号から、入力されたディジタル信号の位相を演算する位相演算回路と、位相演算回路により演算された位相から、入力されたディジタル信号の周波数を演算する周波数演算回路とから構成されているようにしたものである。
【手続補正２】
【補正対象書類名】特許請求の範囲
【補正対象項目名】全文
【補正方法】変更
【補正の内容】
【特許請求の範囲】
【請求項１】
入力されたディジタル信号の振幅及び位相を変化させ、振幅及び位相変化後のディジタル信号として、互いに異なるディジタル信号を出力する複数のトランスバーサルフィルタが並列に接続されているフィルタ回路と、
前記複数のトランスバーサルフィルタから出力されたディジタル信号を用いる位相演算及び周波数演算を実施して、前記入力されたディジタル信号の位相及び周波数を演算する位相周波数演算部と
を備え、
前記フィルタ回路は、前記複数のトランスバーサルフィルタとして、第１のトランスバーサルフィルタと第２のトランスバーサルフィルタと第３のトランスバーサルフィルタとが並列に接続されており、
前記位相周波数演算部は、
前記第１のトランスバーサルフィルタから出力されたディジタル信号と前記第２のトランスバーサルフィルタから出力されたディジタル信号との間で除算演算を実施して、その除算演算結果である第１の除算演算信号を出力する第１の除算演算回路と、
前記第３のトランスバーサルフィルタから出力されたディジタル信号と前記第２のトランスバーサルフィルタから出力されたディジタル信号との間で除算演算を実施して、その除算演算結果である第２の除算演算信号を出力する第２の除算演算回路と、
前記第１の除算演算回路から出力された第１の除算演算信号と前記第２の除算演算回路から出力された第２の除算演算信号との乗算演算を実施して、その乗算演算結果である乗算演算信号を出力する乗算演算回路と、
前記乗算演算回路から出力された乗算演算信号の冪根演算を実施して、その冪根演算結果である冪根演算信号を出力する冪根演算回路と、
前記冪根演算回路より出力された冪根演算信号と前記第１の除算演算信号又は前記第２の除算演算信号の符号から、前記入力されたディジタル信号の位相を演算する位相演算回路と、
前記位相演算回路により演算された位相から、前記入力されたディジタル信号の周波数を演算する周波数演算回路とから構成されていることを特徴とする位相周波数検出装置。
【請求項２】
入力されたディジタル信号の振幅及び位相を変化させ、振幅及び位相変化後のディジタル信号として、互いに異なるディジタル信号を出力する複数のトランスバーサルフィルタが並列に接続されているフィルタ回路と、
前記複数のトランスバーサルフィルタから出力されたディジタル信号を用いる位相演算及び周波数演算を実施して、前記入力されたディジタル信号の位相及び周波数を演算する位相周波数演算部と
を備え、
前記フィルタ回路は、前記複数のトランスバーサルフィルタとして、第１のトランスバーサルフィルタと第２のトランスバーサルフィルタと第３のトランスバーサルフィルタとが並列に接続されており、
前記位相周波数演算部は、
前記第１のトランスバーサルフィルタから出力されたディジタル信号と前記第３のトランスバーサルフィルタから出力されたディジタル信号との乗算演算を実施して、その乗算演算結果である第１の乗算演算信号を出力する第１の乗算演算回路と、
前記第２のトランスバーサルフィルタから出力されたディジタル信号の自乗演算を実施して、その自乗演算結果である第２の乗算演算信号を出力する第２の乗算演算回路と、
前記第１の乗算演算回路から出力された第１の乗算演算信号と前記第２の乗算演算回路から出力された第２の乗算演算信号との間で除算演算を実施して、その除算演算結果である除算演算信号を出力する除算演算回路と、
前記除算演算回路から出力された除算演算信号の冪根演算を実施して、その冪根演算結果である冪根演算信号を出力する冪根演算回路と、
前記冪根演算回路より出力された冪根演算信号と前記第１の乗算演算信号の符号から、前記入力されたディジタル信号の位相を演算する位相演算回路と、
前記位相演算回路により演算された位相から、前記入力されたディジタル信号の周波数を演算する周波数演算回路とから構成されていることを特徴とする位相周波数検出装置。
【請求項３】
入力されたディジタル信号の振幅及び位相を変化させ、振幅及び位相変化後のディジタル信号として、互いに異なるディジタル信号を出力する複数のトランスバーサルフィルタが並列に接続されているフィルタ回路と、
前記複数のトランスバーサルフィルタから出力されたディジタル信号を用いる位相演算及び周波数演算を実施して、前記入力されたディジタル信号の位相及び周波数を演算する位相周波数演算部と
を備え、
前記フィルタ回路は、前記複数のトランスバーサルフィルタとして、第１のトランスバーサルフィルタと第２のトランスバーサルフィルタとが並列に接続されており、
前記位相周波数演算部は、
前記第１のトランスバーサルフィルタから出力されたディジタル信号と前記第２のトランスバーサルフィルタから出力されたディジタル信号との間で除算演算を実施して、その除算演算結果である除算演算信号を出力する除算演算回路と、
前記除算演算回路から出力された除算演算信号の冪根演算を実施して、その冪根演算結果である冪根演算信号を出力する冪根演算回路と、
前記冪根演算回路より出力された冪根演算信号から、前記入力されたディジタル信号の周波数を演算する周波数演算回路と、
前記周波数演算回路により演算された周波数から、前記入力されたディジタル信号の位相を演算する位相演算回路とから構成されていることを特徴とする位相周波数検出装置。
【請求項４】
入力されたディジタル信号の振幅及び位相を変化させ、振幅及び位相変化後のディジタル信号として、互いに異なるディジタル信号を出力する複数のトランスバーサルフィルタが並列に接続されているフィルタ回路と、
前記複数のトランスバーサルフィルタから出力されたディジタル信号を用いる位相演算及び周波数演算を実施して、前記入力されたディジタル信号の位相及び周波数を演算する位相周波数演算部と
を備え、
前記複数のトランスバーサルフィルタは、
１つ以上の減算型１次トランスバーサルフィルタが直列に接続されて構成、１つ以上の加算型１次トランスバーサルフィルタが直列に接続されて構成、あるいは、減算型１次トランスバーサルフィルタと加算型１次トランスバーサルフィルタが直列に接続されて構成されており、
前記減算型１次トランスバーサルフィルタは、入力されたディジタル信号を分配する第１の分配回路と、前記第１の分配回路により分配された一方のディジタル信号を１サンプリング時間だけ遅延する第１の遅延回路と、前記第１の遅延回路により遅延されたディジタル信号と前記第１の分配回路により分配された他方のディジタル信号との間で減算演算を実施する減算演算回路とから構成され、
前記加算型１次トランスバーサルフィルタは、入力されたディジタル信号を分配する第２の分配回路と、前記第２の分配回路により分配された一方のディジタル信号を１サンプリング時間だけ遅延する第２の遅延回路と、前記第２の遅延回路により遅延されたディジタル信号と前記第２の分配回路により分配された他方のディジタル信号との加算演算を実施する加算演算回路とから構成されていることを特徴とする位相周波数検出装置。
【請求項５】
前記フィルタ回路は、前記複数のトランスバーサルフィルタとして、第１のトランスバーサルフィルタと第２のトランスバーサルフィルタと第３のトランスバーサルフィルタとが並列に接続されており、
前記第１のトランスバーサルフィルタは、減算型１次トランスバーサルフィルタが２つ直列に接続されて構成され、
前記第２のトランスバーサルフィルタは、減算型１次トランスバーサルフィルタと加算型１次トランスバーサルフィルタが直列に接続されて構成され、
前記第３のトランスバーサルフィルタは、加算型１次トランスバーサルフィルタが２つ直列に接続されて構成されていることを特徴とする請求項４記載の位相周波数検出装置。
【請求項６】
前記フィルタ回路は、前記複数のトランスバーサルフィルタとして、第１のトランスバーサルフィルタと第２のトランスバーサルフィルタとが並列に接続されており、
前記第１のトランスバーサルフィルタは、減算型１次トランスバーサルフィルタが２つ直列に接続されて構成され、
前記第２のトランスバーサルフィルタは、加算型１次トランスバーサルフィルタが２つ直列に接続されて構成されていることを特徴とする請求項４記載の位相周波数検出装置。
【請求項７】
前記フィルタ回路は、前記複数のトランスバーサルフィルタとして、第１のトランスバーサルフィルタと第２のトランスバーサルフィルタと第３のトランスバーサルフィルタとが並列に接続されており、
前記第１のトランスバーサルフィルタは、減算型１次トランスバーサルフィルタが２つ直列に接続されて構成され、
前記第２のトランスバーサルフィルタは、前記第１のトランスバーサルフィルタを構成している２つの減算型１次トランスバーサルフィルタのうち、前段の減算型１次トランスバーサルフィルタから出力されたディジタル信号が入力される加算型１次トランスバーサルフィルタから構成され、
前記第３のトランスバーサルフィルタは、加算型１次トランスバーサルフィルタが２つ直列に接続されて構成されていることを特徴とする請求項４記載の位相周波数検出装置。
【請求項８】
前記フィルタ回路は、前記複数のトランスバーサルフィルタとして、第１のトランスバーサルフィルタと第２のトランスバーサルフィルタと第３のトランスバーサルフィルタとが並列に接続されており、
前記第１のトランスバーサルフィルタは、減算型１次トランスバーサルフィルタが２つ直列に接続されて構成され、
前記第３のトランスバーサルフィルタは、加算型１次トランスバーサルフィルタが２つ直列に接続されて構成され、
前記第２のトランスバーサルフィルタは、前記第３のトランスバーサルフィルタを構成している２つの加算型１次トランスバーサルフィルタのうち、前段の加算型１次トランスバーサルフィルタから出力されたディジタル信号が入力される減算型１次トランスバーサルフィルタから構成されていることを特徴とする請求項４記載の位相周波数検出装置。
【請求項９】
前記フィルタ回路は、前記複数のトランスバーサルフィルタとして、第１のトランスバーサルフィルタと第２のトランスバーサルフィルタと第３のトランスバーサルフィルタとが並列に接続されており、
前記第１のトランスバーサルフィルタは、減算型１次トランスバーサルフィルタが２つ直列に接続されて構成され、
前記第２のトランスバーサルフィルタは、入力側の加算型１次トランスバーサルフィルタと出力側の減算型１次トランスバーサルフィルタが直列に接続されて構成され、
前記第３のトランスバーサルフィルタは、前記第２のトランスバーサルフィルタを構成している加算型１次トランスバーサルフィルタから出力されたディジタル信号が入力される加算型１次トランスバーサルフィルタから構成されていることを特徴とする請求項４記載の位相周波数検出装置。
【請求項１０】
入力されたディジタル信号の振幅及び位相を変化させ、振幅及び位相変化後のディジタル信号として、互いに異なるディジタル信号を出力する複数のトランスバーサルフィルタが並列に接続されているフィルタ回路と、
前記複数のトランスバーサルフィルタから出力されたディジタル信号を用いる位相演算及び周波数演算を実施して、前記入力されたディジタル信号の位相及び周波数を演算する位相周波数演算部と
を備え、
前記複数のトランスバーサルフィルタのうち、いずれか１つのトランスバーサルフィルタは、
前記入力されたディジタル信号を分配する分配回路と、
前記分配回路により分配された一方のディジタル信号を１サンプリング時間だけ遅延する第１の遅延回路と、
前記第１の遅延回路により遅延されたディジタル信号を１サンプリング時間だけ遅延する第２の遅延回路と、
前記第１の遅延回路により遅延されたディジタル信号に対して、−２の係数を乗算する係数乗算回路と、
前記第２の遅延回路により遅延されたディジタル信号と、前記係数乗算回路により係数が乗算されたディジタル信号と、前記分配回路により分配された他方のディジタル信号との加算演算を実施する加算演算回路とから構成されていることを特徴とする位相周波数検出装置。
【請求項１１】
入力されたディジタル信号の振幅及び位相を変化させ、振幅及び位相変化後のディジタル信号として、互いに異なるディジタル信号を出力する複数のトランスバーサルフィルタが並列に接続されているフィルタ回路と、
前記複数のトランスバーサルフィルタから出力されたディジタル信号を用いる位相演算及び周波数演算を実施して、前記入力されたディジタル信号の位相及び周波数を演算する位相周波数演算部と
を備え、
前記複数のトランスバーサルフィルタのうち、いずれか１つのトランスバーサルフィルタは、
前記入力されたディジタル信号を分配する分配回路と、
前記分配回路により分配された一方のディジタル信号を１サンプリング時間だけ遅延する第１の遅延回路と、
前記第１の遅延回路により遅延されたディジタル信号を１サンプリング時間だけ遅延する第２の遅延回路と、
前記第２の遅延回路により遅延されたディジタル信号に対して、−１の係数を乗算する係数乗算回路と、
前記係数乗算回路により係数が乗算されたディジタル信号と、前記分配回路により分配された他方のディジタル信号との加算演算を実施する加算演算回路とから構成されていることを特徴とする位相周波数検出装置。
【請求項１２】
入力されたディジタル信号の振幅及び位相を変化させ、振幅及び位相変化後のディジタル信号として、互いに異なるディジタル信号を出力する複数のトランスバーサルフィルタが並列に接続されているフィルタ回路と、
前記複数のトランスバーサルフィルタから出力されたディジタル信号を用いる位相演算及び周波数演算を実施して、前記入力されたディジタル信号の位相及び周波数を演算する位相周波数演算部と
を備え、
前記複数のトランスバーサルフィルタのうち、いずれか１つのトランスバーサルフィルタは、
前記入力されたディジタル信号を分配する分配回路と、
前記分配回路により分配された一方のディジタル信号を１サンプリング時間だけ遅延する第１の遅延回路と、
前記第１の遅延回路により遅延されたディジタル信号を１サンプリング時間だけ遅延する第２の遅延回路と、
前記第１の遅延回路により遅延されたディジタル信号に対して、２の係数を乗算する係数乗算回路と、
前記第２の遅延回路により遅延されたディジタル信号と、前記係数乗算回路により係数が乗算されたディジタル信号と、前記分配回路により分配された他方のディジタル信号との加算演算を実施する加算演算回路とから構成されていることを特徴とする位相周波数検出装置。
【国際調査報告】
2016139778.tif 000018
2016139778.tif 000019
2016139778.tif 000020
2016139778.tif 000021