(57)【特許請求の範囲】
【請求項１】
プロセッサを搭載可能な上面、前記上面の反対側の下面、及び前記上面から前記下面を貫通し、前記プロセッサと電気的に接続可能な複数の第１スルーホール及び複数の第２スルーホールを有する第１基板と、
前記第１基板の前記下面から離れた位置に配置され、電源装置を有する第２基板と、
前記第１基板の前記下面に実装され、複数の前記第１スルーホールと前記電源装置とを電気的に接続する第１導体と、
前記第１基板の前記下面に実装され、複数の前記第２スルーホールと前記電源装置とを電気的に接続する第２導体と、
を備え、
前記第１導体は、前記第１基板の前記下面に実装された第１部分と、前記第２基板を貫通する第３スルーホールが有する孔に挿入された第２部分とを含み、
前記第１導体の前記第１部分の径は、前記第３スルーホールが有する前記孔の径よりも大きいことを特徴とする電源供給基板。
【請求項２】
前記第１スルーホール及び前記第１導体を介して、前記電源装置から前記プロセッサに電源電圧が供給され、
前記第２スルーホール及び前記第２導体を介して、前記電源装置から前記プロセッサにグランド電圧が供給されることを特徴とする請求項１に記載の電源供給基板。
【請求項３】
複数の前記第１スルーホールの直下であって、前記第２基板の中央部分に前記第１導体が配置され、
複数の前記第２スルーホールの直下であって、前記第２基板の前記中央部分に前記第２導体が配置され、
前記第２基板の前記中央部分の外側の外周部分に前記電源装置が配置されることを特徴とする請求項１又は２に記載の電源供給基板。
【請求項４】
前記第２導体は、前記第１基板の前記下面に実装された第３部分と、前記第２基板を貫通する第４スルーホールが有する孔に挿入された第４部分とを含み、
前記第２導体の前記第３部分の径は、前記第４スルーホールが有する前記孔の径よりも
大きいことを特徴とする請求項１から３の何れか一項に記載の電源供給基板。
【請求項５】
前記第１導体は、前記第１基板の前記下面に実装された第１柱部と、前記第２基板と接触した第２柱部と、前記第１柱部と前記第２柱部との間に形成された第３柱部とを含み、
前記第３柱部の径は、前記第１柱部の径及び前記第２柱部の径よりも小さいことを特徴とする請求項１から４の何れか一項に記載の電源供給基板。
【請求項６】
前記第２導体は、前記第１基板の前記下面に実装された第４柱部と、前記第２基板と接触した第５柱部と、前記第４柱部と前記第５柱部との間に形成された第６柱部とを含み、
前記第６柱部の径は、前記第４柱部の径及び前記第５柱部の径よりも小さいことを特徴とする請求項１から５の何れか一項に記載の電源供給基板。
【請求項７】
プロセッサを搭載可能な上面、前記上面の反対側の下面、及び前記上面から前記下面を貫通し、前記プロセッサと電気的に接続可能な複数の第１スルーホール及び複数の第２スルーホールを有する第１基板と、
前記第１基板の前記下面から離れた位置に配置され、電源装置を有する第２基板と、
前記第１基板の前記下面に実装され、複数の前記第１スルーホールと前記電源装置とを電気的に接続する第１導体と、
前記第１基板の前記下面に実装され、複数の前記第２スルーホールと前記電源装置とを電気的に接続する第２導体と、
を備え、
前記第２導体は、前記第１基板の前記下面に実装された第１部分と、前記第２基板を貫通する第４スルーホールが有する孔に挿入された第２部分とを含み、
前記第２導体の前記第１部分の径は、前記第４スルーホールが有する前記孔の径よりも大きいことを特徴とする電源供給基板。
【発明の詳細な説明】
【技術分野】
【０００１】
本発明は、電源供給基板に関する。
【背景技術】
【０００２】
サーバ装置等の情報処理装置における電力供給では、商用電源から供給される一次電源（交流電源）を装置内の電源ユニットで二次電源（低い電圧の直流電源）に変換し、装置が備えるマザーボード等の基板の各所に電力が供給される。基板の各所に供給される電力の電圧値が、ＤＣ／ＤＣコンバータによって更に其々の部品に応じた電圧値に変換された後、各部品に電力が供給される。ＣＰＵ（Central Processing Unit）等のプロセッサに
対する電力供給では、基板の各所に供給される電力の電圧値が、ＤＣ／ＤＣコンバータによってプロセッサに応じた電圧値に変換された後、プロセッサに電力が供給される。
【０００３】
例えば、図９に示すように、基板１０１の同一平面上にＣＰＵ１１１、ＤＩＭＭ（Dual
Inline Memory Module）１１２、ＤＣ／ＤＣコンバータ１１３及び高速伝送部品１１４
が実装される。図１０に示すように、基板１０１内に形成された複数の給電経路１２１を介して、ＤＣ／ＤＣコンバータ１１３からＣＰＵ１１１に電力が供給される。また、図１０に示すように、基板１０１内には、複数の信号伝送路１２２が形成されている。図９は、基板１０１の平面図であり、図１０は、基板１０１の部分断面図である。
【０００４】
ＤＣ／ＤＣコンバータ１１３は、所定の電圧でＣＰＵ１１１に電力を供給するために、給電経路１２１の途中で生じる電圧降下を補う電圧を出力する。そのため、電圧降下が少なくなるように、ＤＣ／ＤＣコンバータ１１３をＣＰＵ１１１の近傍に設置する。ＣＰＵ１１１とＤＩＭＭ１１２等のメモリとの間の伝送距離が短いほど、サーバ装置における信号伝送が高速化され、サーバ装置の性能が向上する。例えば、図９に示すように、ＣＰＵ１１１の近傍にＤＩＭＭ１１２や高速伝送部品１１４を配置することにより、ＣＰＵ１１１とＤＩＭＭ１１２との間の伝送距離を短くし、また、ＣＰＵ１１１と高速伝送部品１１４との間の伝送距離を短くしている。
【先行技術文献】
【特許文献】
【０００５】
【特許文献１】国際公開第２００４／００４０００号
【特許文献２】国際公開第２００７／１２９５２６号
【特許文献３】特表２００３−５１８７５９号公報
【発明の概要】
【発明が解決しようとする課題】
【０００６】
近年、高性能なサーバ装置の需要が増加しており、プロセッサの性能の向上、信号伝送の高速化、メモリ容量の増大が求められている。プロセッサの周波数を増加することで、プロセッサの性能が向上する。例えば、ＣＰＵ１１１の周波数を増加すると、ＣＰＵ１１１の消費電力が増加するため、ＤＣ／ＤＣコンバータ１１３の数を増やすことにより、ＣＰＵ１１１に大電流を供給している。ＤＣ／ＤＣコンバータ１１３を追加することができる空きエリアが基板１０１にない場合、例えば、図１１に示すように、基板１０１の外形を大きくすることにより、ＤＣ／ＤＣコンバータ１１３の数を増やすことになる。基板１０１の外形が大きくなり、基板１０１の製造サイズが規格外となる場合、基板１０１が製造困難となったり、基板１０１の製造コストが増大したりする。
【０００７】
ＤＣ／ＤＣコンバータ１１３の数が増えると、ＤＣ／ＤＣコンバータ１１３からＣＰＵ
１１１への給電経路１２１が追加される。図１０に示すように、基板１０１内には複数の信号伝送路１２２が形成されているため、信号伝送路１２２を避けるようにして、基板１０１内に追加分の給電経路１２１を形成する。この場合、基板１０１の内層を増加することにより、基板１０１内に追加分の給電経路１２１を確保する。基板１０１の内層が増加し、基板１０１の製造厚みが規格外となる場合、基板１０１が製造困難となったり、基板１０１の製造コストが増大したりする。
【０００８】
図１２Ａ及び図１２Ｂに示すように、ＤＣ／ＤＣコンバータ１１３からＣＰＵ１１１への給電経路１２１を追加する場合、給電経路１２１は、ＣＰＵ１１１とＤＩＭＭ１１２との間の信号伝送路１２２を避けて設計される。図１２Ａは、給電経路１２１を追加する前の基板１０１の平面図である。図１２Ｂは、給電経路１２１を追加した後の基板１０１の平面図である。この場合、信号伝送路１２２を避けるようにして、基板１０１内に追加分の給電経路１２１を形成するため、給電経路１２１が細く長くなり、電圧降下の影響が大きくなる。また、給電経路１２１が信号伝送路１２２に近づくことで、信号伝送路１２２に電源ノイズが干渉し、伝送性能が低下する。
【０００９】
本件は、電圧降下及び電源ノイズを低減することを目的とする。
【課題を解決するための手段】
【００１０】
本件の一観点による電源供給基板は、プロセッサを搭載可能な上面、前記上面の反対側の下面、及び前記上面から前記下面を貫通し、前記プロセッサと電気的に接続可能な複数の第１スルーホール及び複数の第２スルーホールを有する第１基板と、前記第１基板の前記下面から離れた位置に配置され、電源装置を有する第２基板と、前記第１基板の前記下面に実装され、複数の前記第１スルーホールと前記電源装置とを電気的に接続する第１導体と、前記第１基板の前記下面に実装され、複数の前記第２スルーホールと前記電源装置とを電気的に接続する第２導体と、を備える。
【発明の効果】
【００１１】
本件によれば、電圧降下及び電源ノイズを低減することができる。
【図面の簡単な説明】
【００１２】
【図１】図１は、電源供給基板の模式図である。
【図２】図２は、ピラーの外観図である。
【図３】図３は、電源供給基板の模式図である。
【図４】図４は、電源供給基板の電源系統を示すブロック図である。
【図５】図５は、電源基板の内層における配線パターンを示す図である。
【図６】図６は、メインボードとＣＰＵとの間のインターフェースを示す図である。
【図７】図７は、メインボードと電源基板との接続方法の説明図である。
【図８】図８は、メインボードと電源基板との接続方法の説明図である。
【図９】図９は、基板の平面図である。
【図１０】図１０は、基板の部分断面図である。
【図１１】図１１は、基板の平面図である。
【図１２Ａ】図１２Ａは、給電経路を追加する前の基板の平面図である。
【図１２Ｂ】図１２Ｂは、給電経路を追加した後の基板の平面図である。
【図１３】図１３は、電源供給基板の模式図である。
【図１４】図１４は、ピラーを電源基板に実装する前の電源供給基板の模式図である。
【図１５】図１５は、ピラーが電源基板に実装された場合の電源供給基板の模式図である。
【図１６】図１６は、メインボードが膨張し、電源基板が膨張した場合の電源供給基板の模式図である。
【図１７】図１７は、メインボードの収縮速度よりも電源基板の収縮速度が速い場合の電源供給基板の模式図である。
【図１８】図１８は、電源供給基板の模式図である。
【図１９】図１９は、ピラーの外径を小さくした場合の電源供給基板の模式図である。
【図２０】図２０は、電源供給基板の模式図である。
【図２１】図２１は、ピラーの外観図である。
【図２２】図２２は、ピラーの外観図である。
【発明を実施するための形態】
【００１３】
以下、図面を参照して実施形態に係る電源供給基板（電子装置）について説明する。以下に示す電源供給基板の構成は例示であり、実施形態に係る電源供給基板の構成は、以下に示す構成に限定されない。
【００１４】
〈実施例１〉
実施例１に係る電源供給基板１について説明する。図１は、電源供給基板１の模式図である。電源供給基板１は、メインボード（マザーボード）２と、電源基板３と、メインボード２と電源基板３との間に配置された複数のピラー４とを備える。メインボード２は、例えば、複数の樹脂層によって形成されている。メインボード２は、ＣＰＵ５を搭載可能な上面（第１面）及び上面の反対側の下面（第２面）を有する。メインボード２の上面にはＣＰＵ５を搭載可能である。メインボード２の上面に設けられた複数の半田ボール１１を介して、メインボード２の上面にＣＰＵ５が搭載される。ＣＰＵ５の回路面に形成された電極（図示せず）に半田ボール１１が接合されている。メインボード２は、第１基板の一例である。電源基板３は、第２基板の一例である。ＣＰＵ５は、プロセッサの一例である。
【００１５】
メインボード２は、内部に形成された複数のスルーホール２１と複数の信号伝送路２２とを有する。複数の半田ボール１１の一部が、メインボード２の上面に形成された複数の面パターン２３上に配置されている。この場合、一つの面パターン２３上に複数の半田ボール１１が配置される。面パターン２３は、導電性を有し、例えば、銅箔を用いて形成されている。複数のスルーホール２１の配置と、面パターン２３の配置とは対応しており、複数のスルーホール２１と面パターン２３とが電気的に接続されている。
【００１６】
スルーホール２１は、メインボード２を貫通する孔と、メインボード２を貫通する孔の側壁に形成された銅めっきとを有する。スルーホール２１は、貫通ビアとも呼ばれる。例えば、ドリル加工、レーザー又はドライエッチング等により、メインボード２に孔を形成し、例えば、無電解めっき法及び電気めっき法により、メインボード２の孔の側壁に銅めっきを形成する。信号伝送路２２は、メインボード２の平面方向に延びる配線及びメインボード２の厚み方向に延びるビアを含む。信号伝送路２２は、ＣＰＵ５で処理される信号の伝送に用いられる信号線である。
【００１７】
ＣＰＵ５は、半田ボール１１及び面パターン２３を介して、スルーホール２１と電気的に接続可能である。ＣＰＵ５は、半田ボール１１及びメインボード２の上面に形成された電極（図示せず）を介して、信号伝送路２２と電気的に接続可能である。
【００１８】
表面実装技術（ＳＭＴ）により、複数のピラー４がメインボード２の上面の反対側の下面に実装されている。メインボード２の下面に形成された複数の面パターン２４上に複数のピラー４が配置され、ピラー４と面パターン２４とを半田２５によって半田付けすることにより、ピラー４がメインボード２の下面に実装される。この場合、一つの面パターン
２４上に一つのピラー４が配置される。面パターン２４は、導電性を有し、例えば、銅箔を用いて形成されている。
【００１９】
スルーホール２１と面パターン２４とが電気的に接続され、面パターン２４とピラー４とが電気的に接続されている。ピラー４は、電源基板３に接続されている。ピラー４は、導電性を有し、例えば、銅を用いて形成されている。ピラー４は、導体の一例である。図２は、ピラー４の外観図であり、ピラー４の側面及び底面を示している。ピラー４は、第１部分と、第１部分よりも細い第２部分とを有する。
【００２０】
電源基板３は、メインボード２の下面から離れた位置に配置され、複数のＤＣ／ＤＣコンバータ６を有する。電源基板３は、例えば、複数の樹脂層によって形成されている。複数のＤＣ／ＤＣコンバータ６は、電源基板３の下面に実装されている。ＤＣ／ＤＣコンバータ６は、電源装置の一例である。複数のＤＣ／ＤＣコンバータ６は、電源基板３の下面の反対側の上面に実装されてもよい。ＣＰＵ５とＤＣ／ＤＣコンバータ６とは電気的に接続されており、複数のピラー４及び複数のスルーホール２１を介して、ＤＣ／ＤＣコンバータ６からＣＰＵ５に電力（電源）が供給される。例えば、ＤＣ／ＤＣコンバータ６は、外部電源から供給される電圧を、ＣＰＵ５用の電圧まで下げて、ＣＰＵ５に電力を供給する。
【００２１】
図９及び図１０に示すように、基板１０１の同一平面上にＣＰＵ１１１及びＤＣ／ＤＣコンバータ１１３を配置する場合、信号伝送路１２２を避けるようにして、基板１０１内にＤＣ／ＤＣコンバータ１１３からＣＰＵ１１１までの給電経路１２１を形成する。そのため、ＤＣ／ＤＣコンバータ１１３からＣＰＵ１１１までの給電経路１２１が長くなる。
【００２２】
電源供給基板１では、メインボード２の下面に複数のピラー４が配置されている。すなわち、メインボード２の垂直方向にＤＣ／ＤＣコンバータ６からＣＰＵ５までの給電経路が形成されている。そのため、メインボード２の平面方向に給電経路を形成する場合と比較して、ＤＣ／ＤＣコンバータ６からＣＰＵ５までの給電経路が短くなる。電源供給基板１は、図９及び図１０に示す構造と比較して、ＤＣ／ＤＣコンバータ６からＣＰＵ５までの給電経路が短くなる。したがって、電源供給基板１によれば、ＤＣ／ＤＣコンバータ６からＣＰＵ５までの給電経路における電圧降下を抑制することができる。
【００２３】
電源供給基板１によれば、メインボード２の下面に複数のピラー４が配置することにより、メインボード２とＤＣ／ＤＣコンバータ６との間の給電経路をメインボード２の外部に配置することができる。すなわち、ＤＣ／ＤＣコンバータ６からＣＰＵ５までの給電経路の一部をメインボード２の外部に配置することができる。これにより、メインボード２の信号伝送路２２に対する給電経路からの電源ノイズを低減することができる。
【００２４】
図３は、電源供給基板１の模式図であって、電源基板３の詳細な構成が示されている。電源基板３は、内部に形成された複数のスルーホール３１、３２、３３、３４と、複数の電源配線３５と、複数のグランド配線３６とを有する。図３では、複数のピラー４の一つをピラー４Ａと示し、複数のピラー４の一つをピラー４Ｂと示している。ピラー４Ａは、第１導体の一例である。ピラー４Ｂは、第２導体の一例である。図３では、ピラー４Ａと電気的に接続されたスルーホール２１を、スルーホール２１Ａと示し、ピラー４Ｂと電気的に接続されたスルーホール２１を、スルーホール２１Ｂと示している。スルーホール２１Ａは、第１スルーホールの一例である。スルーホール２１Ｂは、第２スルーホールの一例である。
【００２５】
スルーホール３１、３２、３３、３４は、電源基板３を貫通する孔と、電源基板３を貫通する孔の側壁に形成された銅めっきとを有する。例えば、ドリル加工、レーザー又はド
ライエッチング等により、電源基板３に孔を形成し、例えば、無電解めっき法及び電気めっき法により、銅めっきを孔の側壁に形成する。
【００２６】
フロー半田付け（ＤＩＰ）方式によって、ピラー４Ａ、４Ｂが電源基板３に実装されている。スルーホール３１の孔にピラー４Ａの第２部分を挿し込み、スルーホール３２の孔にピラー４Ｂの第２部分を挿し込む。溶融半田に電源基板３の下面を浸漬し、ピラー４Ａとスルーホール３１とを半田３７によって半田付けし、ピラー４Ｂとスルーホール３２とを半田３７によって半田付けすることにより、ピラー４Ａ、４Ｂが電源基板３に実装される。ピラー４Ａとスルーホール３１との間の隙間に半田３７が流れ込み、ピラー４Ａとスルーホール３１とが接合される。ピラー４Ｂとスルーホール３２との間の隙間に半田３７が流れ込み、ピラー４Ｂとスルーホール３２とが接合される。
【００２７】
ＤＣ／ＤＣコンバータ６は、スルーホール３３、３４と電気的に接続されている。スルーホール３３は、電源配線３５と電気的に接続され、スルーホール３４は、グランド配線３６と電気的に接続されている。電源配線３５は、スルーホール３１と電気的に接続されている。グランド配線３６は、スルーホール３２と電気的に接続されている。スルーホール３１は、ピラー４Ａと電気的に接続されている。スルーホール３２は、ピラー４Ｂと電気的に接続されている。半田ボール１１、面パターン２３、スルーホール２１Ａ、２１Ｂ面パターン２４、ピラー４Ａ、４Ｂ、スルーホール３１、３２、３３、３４、電源配線３５及びグランド配線３６によって、ＤＣ／ＤＣコンバータ６からＣＰＵ５までの給電経路が形成されている。ＤＣ／ＤＣコンバータ６からＣＰＵ５までの給電経路は、ＣＰＵ５とＤＣ／ＤＣコンバータ６との間の電源経路及びＣＰＵ５とＤＣ／ＤＣコンバータ６との間のグランド経路を含む。
【００２８】
図３に示すように、複数のスルーホール２１Ａの直下にピラー４Ａが配置され、複数のスルーホール２１Ｂの直下にピラー４Ｂが配置されている。したがって、メインボード２とＤＣ／ＤＣコンバータ６との間の給電経路を、スルーホール２１Ａ、２１Ｂの直下に配置することができる。これにより、メインボード２の信号伝送路２２に対する給電経路からの電源ノイズを低減することができる。
【００２９】
図４は、電源供給基板１の電源系統を示すブロック図である。図４に示すように、ピラー４Ａ、４Ｂが電源基板３の中央部分に配置され、ＤＣ／ＤＣコンバータ６が電源基板３の中央部分の外側の外周部分に配置されている。一つのピラー４Ａ及び一つのピラー４Ｂを一組として、ピラー４Ａを電源接続に用い、ピラー４Ｂをグランド接続に用いている。すなわち、ＣＰＵ５とＤＣ／ＤＣコンバータ６との間の電源経路の一部としてピラー４Ａが用いられ、ＣＰＵ５とＤＣ／ＤＣコンバータ６との間のグランド経路の一部としてピラー４Ｂが用いられている。図４に示す例に限定されず、ピラー４Ａをグランド接続に用いて、ピラー４Ｂを電源接続に用いてもよい。
【００３０】
点線４１によって囲まれたピラー４Ａ、４Ｂ及びＤＣ／ＤＣコンバータ６が第１の電源系統に属している。点線４２によって囲まれたピラー４Ａ、４Ｂ及びＤＣ／ＤＣコンバータ６が第２の電源系統に属している。点線４３によって囲まれたピラー４Ａ、４Ｂ及びＤＣ／ＤＣコンバータ６が第３の電源系統に属している。点線４４によって囲まれたピラー４Ａ、４Ｂ及びＤＣ／ＤＣコンバータ６が第４の電源系統に属している。点線４５によって囲まれたピラー４Ａ、４Ｂ及びＤＣ／ＤＣコンバータ６が第５の電源系統に属している。第１〜第５の電源系統に属するＤＣ／ＤＣコンバータ６のそれぞれは、異なる電圧値でＣＰＵ５に電力を供給してもよい。また、第１〜第５の電源系統に属するＤＣ／ＤＣコンバータ６のそれぞれは、同一の電圧値でＣＰＵ５に電力を供給してもよい。
【００３１】
図４には、電源系統が５系統である場合の例を示しているが、電源系統の数は図４の例
に限定されず、ＣＰＵ５の仕様に応じて、電源系統の数を変更してもよい。また、複数のＤＣ／ＤＣコンバータ６が一つの電源系統に属していてもよい。例えば、図３の例では、複数のＤＣ／ＤＣコンバータ６が一つの電源系統に属しており、一つのピラー４Ａと複数のＤＣ／ＤＣコンバータ６とが電気的に接続され、一つのピラー４Ｂと複数のＤＣ／ＤＣコンバータ６とが電気的に接続されている。
【００３２】
図５は、電源基板３の内層における配線パターンを示す図である。配線パターンは、電源配線３５のパターン及びグランド配線３６のパターンを含む。図５に示すように、電源基板３の内層が領域５１〜５５に区画（画定）されており、第１〜第５の電源系統に属する配線パターンが領域５１〜５５内のそれぞれに配置されている。領域５１〜領域５５の配置と、第１〜第５の電源系統に属する各ＤＣ／ＤＣコンバータコンバータ６の配置とが対応している。すなわち、第１〜第５の電源系統に属する各ＤＣ／ＤＣコンバータ６の直下に第１〜第５の電源系統に属する配線パターン配置されている。電源基板３には電源部品（ＤＣ／ＤＣコンバータ６及び関連部品）のみが実装されているため、電源部品の実装及び電源基板３の内層における配線パターンを効率よく設計することができる。
【００３３】
一つのピラー４Ａと一つのＤＣ／ＤＣコンバータ６とが電気的に接続されてもよい。したがって、一つのピラー４Ａ及び複数のスルーホール２１Ａを介して、一つのＤＣ／ＤＣコンバータ６からＣＰＵ５に電源電圧が供給されてもよい。また、一つのピラー４Ａと複数のＤＣ／ＤＣコンバータ６とが電気的に接続されてもよい。したがって、一つのピラー４Ａ及び複数のスルーホール２１Ａを介して、複数のＤＣ／ＤＣコンバータ６からＣＰＵ５に電源電圧が供給されてもよい。
【００３４】
一つのピラー４Ｂと一つのＤＣ／ＤＣコンバータ６とが電気的に接続されてもよい。したがって、一つのピラー４Ｂ及び複数のスルーホール２１Ｂを介して、一つのＤＣ／ＤＣコンバータ６からＣＰＵ５にグランド電圧が供給されてもよい。また、一つのピラー４Ｂと複数のＤＣ／ＤＣコンバータ６とが電気的に接続されてもよい。したがって、一つのピラー４Ｂ及び複数のスルーホール２１Ｂを介して、複数のＤＣ／ＤＣコンバータ６からＣＰＵ５にグランド電圧が供給されてもよい。
【００３５】
電源基板３には、信号伝送路２２が形成されていない。そのため、電源基板３の内層における配線パターンは、信号伝送路２２の配置の影響を受けない。すなわち、電源基板３の内層のすべての層を給電経路として使用することができる。メインボード２には電源配線３５及びグランド配線３６が形成されていないため、メインボード２の信号伝送路２２に対する給電経路からの電源ノイズを低減することができる。
【００３６】
メインボード２の上面にＣＰＵ５が搭載されている。そのため、メインボード２とＣＰＵ５との接合面の平面度が良好であることが要求される。平面度が良好でない場合、メインボード２の上面とＣＰＵ５との間の距離が不均一となる。この場合、メインボード２の上面の半田ボール１１とＣＰＵ５との接合状態が悪くなり、ＣＰＵ５への給電が不安定となる。
【００３７】
例えば、メインボード２に大きな径を有する貫通孔を形成し、貫通孔内に銅ピラーや銅コインを埋め込むことにより、ＣＰＵ５への給電を行う場合がある。しかし、メインボード２に大きな径を有する貫通孔を形成すると、メインボード２に歪みが発生し、メインボード２とＣＰＵ５との接合面の平面度が悪化する。また、メインボード２内に銅ピラーや銅コインを埋め込む場合、メインボード２の製造コストが増大する。このように、メインボード２内に銅ピラーや銅コインを埋め込むことにより、ＣＰＵ５への給電を行う場合、デメリットが大きい。
【００３８】
メインボード２が有するスルーホール２１の形成は容易であり、メインボード２に複数のスルーホール２１を形成してもメインボード２には歪みや反りが発生しない。すなわちスルーホール２１の径は、ピラー４の径よりも小さく、メインボード２に歪みや反りが発生しないように、スルーホール２１の径の大きさが調整されている。一本のスルーホール２１の断面積は小さいため、一本のスルーホール２１を介してＣＰＵ５に供給される電力は小さい。そのため、一つの半田ボール１１と一本のスルーホール２１とを接合すると、ＣＰＵ５に供給される電力が不足する場合がある。
【００３９】
電源供給基板１によれば、スルーホール２１の本数を半田ボール１１の個数よりも多くすることにより、ＣＰＵ５に供給される電力を増加することができる。半田ボール１１とスルーホール２１とのインターフェース（接合部分）に面パターン２３が配置されている。これにより、一つの半田ボール１１に複数のスルーホール２１が電気的に接続され、ＣＰＵ５に供給される電力を増加することができる。したがって、電源供給基板１によれば、複数のピラー４及び複数のスルーホール２１を介して、ＤＣ／ＤＣコンバータ６からＣＰＵ５に大電流を供給することができる。
【００４０】
電源供給基板１では、電源基板３にＤＣ／ＤＣコンバータ６が配置されている。したがって、ＣＰＵ５の消費電力が増加し、ＤＣ／ＤＣコンバータ６の数を増やす場合において、メインボード２の実装エリアを使用することなく、ＤＣ／ＤＣコンバータ６を追加することができる。メインボード２とピラー４との接続はＳＭＴによって行われるため、メインボード２及びピラー４の設計は簡易になる。また、ピラー４の断面積は大きいため、ＤＣ／ＤＣコンバータ６からＣＰＵ５までの給電経路における電圧降下を抑制することができる。
【００４１】
図６は、メインボード２とＣＰＵ５との間のインターフェースを示す図である。図６の矩形６１は、ＣＰＵ５の外形部分である。ＣＰＵ５は、給電部６２及び複数の信号伝送部６３を有する。給電部６２は、ＤＣ／ＤＣコンバータ６から供給された電力をＣＰＵ５の各所に供給する。信号伝送部６３は、メインボード２の信号伝送路２２と接続されている。信号伝送部６３は、メインボード２の信号伝送路２２から信号を受信し、メインボード２の信号伝送路２２に信号を送信する。
【００４２】
図６に示すように、ＣＰＵ５の中央部分に給電部６２が配置され、ＣＰＵ５の中央部分の外側の外周部分に複数の信号伝送部６３が配置されている。すなわち、給電部６２と複数の信号伝送部６３とが分離して配置されている。ＣＰＵ５の中央部分の直下にピラー４Ａ、４Ｂが配置され、ＣＰＵ５の外周部分の直下にメインボード２の信号伝送路２２が配置されている。したがって、メインボード２の信号伝送路２２と、ＤＣ／ＤＣコンバータ６からＣＰＵ５までの給電経路とを分離することができ、メインボード２の信号伝送路２２に対する給電経路からの電源ノイズを低減することができる。
【００４３】
〈実施例２〉
実施例２に係る電源供給基板１について説明する。実施例２に係る電源供給基板１では、メインボード２と電源基板３とをコネクタによって接続する。図７及び図８は、メインボード２と電源基板３との接続方法の説明図である。メインボード２には、複数のピラー４に替えて、複数の第１コネクタ７１が設けられている。ＳＭＴにより、複数の第１コネクタがメインボード２の下面に実装されている。
【００４４】
電源基板３には、複数の第２コネクタが設けられている。第２コネクタは、第１コネクタ７１と連結（嵌合）する。第１コネクタ７１は、例えば、雄コネクタである。第２コネクタ７２は、例えば、雌コネクタである。第１コネクタ７１及び第２コネクタ７２は、例えば、銅を用いて形成されている。図７及び図８に示す例に限定されず、第１コネクタ７
１が雌コネクタであり、第２コネクタ７２が雄コネクタであってもよい。
【００４５】
ＤＩＰ方式によってピラー４を電源基板３に実装する場合、電源基板３からピラー４を取り外すためには、半田３７を再溶融させて、スルーホール３１、３２からピラー４を引き抜く。そのため、電源供給基板１に対して余計な熱負荷がかかる。メインボード２と電源基板３とを第１コネクタ７１及び第２コネクタ７２によって接続することにより、メインボード２と電源基板３との分離が容易になる。したがって、メインボード２と電源基板３との接続及び分離を繰り返すことが容易となり、電源供給基板１の保守性が向上する。
【００４６】
例えば、ピラー４の全体が円柱形状である場合、図１３に示すように、メインボード２と電源基板３との間の距離が定まらず、電源基板３の位置決めが困難となったり、電源基板３の位置決めができなかったりするという問題がある。また、スルーホール３１の径が大きい場合、メインボード２に対して電源基板３が平行とならず、メインボード２に実装されたコンデンサ等の電子部品８１と電源基板３に実装されたコンデンサ等の電子部品８２との間の距離が一定にならないという問題がある。メインボード２と電源基板３との間の距離に応じて、メインボード２の電子部品８１と電源基板３の電子部品８２との間の距離が変動する。メインボード２と電源基板３とが近づき過ぎることにより、メインボード２の電子部品８１と電源基板３の電子部品８２とが接触する恐れがある。
【００４７】
実施例１に係る電源供給基板１では、ピラー４Ａは、第１の径（直径）を有する第１部分と第２の径（直径）を有する第２部分とを備える。ピラー４Ａの第１部分及び第２部分は、円柱形状であり、ピラー４Ａの第１部分と第２部分とは繋がっている。ピラー４Ａの第１部分の径は、ピラー４Ａの第２部分の径よりも大きい。図１４に示すように、ピラー４Ａの第１部分の端面が面パターン２４と接触した状態で、ピラー４Ａの第１部分がメインボード２に実装されている。図１４は、ピラー４Ａを電源基板３に実装する前の電源供給基板１の模式図である。ピラー４Ａの第２部分の端面は、電源基板３側に向けられている。ピラー４Ａの第１部分の径が、ピラー４Ａの第２部分の径よりも大きいので、ピラー４Ａは段差形状を有する。換言すれば、ピラー４Ａは、ピラー４の一方の端面の中央部分が突出した形状になっている。電子部品８１は、メインボード２の下面に実装され、電子部品８２は、電源基板３の上面に実装されている。
【００４８】
図１５は、ピラー４Ａが電源基板３に実装された場合の電源供給基板１の模式図である。図１５に示すように、ピラー４Ａの第１部分は、メインボード２と電源基板３との間に位置し、ピラー４Ａの第２部分は、電源基板３の内部に位置している。ピラー４Ａが段差形状を有することにより、ピラー４Ａの第１部分が電源基板３の上面と接触し、ピラー４Ａの第２部分が電源基板３を貫通するスルーホール３１の孔に挿入される。スルーホール３１は、第３スルーホールの一例である。スルーホール３１の孔は、平面視で円形形状である。ピラー４Ａの第２部分の径は、スルーホール３１の孔の径（直径）よりも小さいため、ピラー４Ａの第２部分とスルーホール３１との間に隙間（空間）が形成される。ピラー４Ａの第２部分とスルーホール３１との間の隙間に半田３７が形成されることで、ピラー４Ａの第２部分とスルーホール３１とが接合される。
【００４９】
ピラー４Ａの段差形状により、電源基板３が一定の位置（メインボード２から所定の長さ離れた位置）で保持される。すなわち、ピラー４Ａの第１部分と電源基板３の上面とが接触し、ピラー４Ａの第２部分とスルーホール３１とが接合されることで、電源基板３が一定の位置で保持される。ピラー４Ａの第１部分の径は、スルーホール３１の径よりも大きいため、ピラー４Ａの第１部分と電源基板３の上面とが接触する。ピラー４Ａの第１部分と電源基板３の上面とが接触することにより、メインボード２に対して電源基板３が平行となり、メインボード２に対して電源基板３が傾かない。電源基板３が一定の位置で保持されることで、メインボード２の電子部品８１と電源基板３の電子部品８２との間の距
離が一定となる。実施例１に係る電源供給基板１によれば、電源基板３の位置決めが容易となるとともに、メインボード２と電源基板３との間の距離を一定に保つことができる。したがって、メインボード２の電子部品８１と電源基板３の電子部品８２との間の距離を一定に保つことができる。
【００５０】
ピラー４Ａの第１部分の長さを変更することにより、メインボード２と電源基板３との間の距離を調整することが可能である。電子部品８１の高さと電子部品８２の高さの合計値よりも、ピラー４Ａの第１部分の長さを大きくことにより、電子部品８１と電子部品８２との接触を回避することができる。
【００５１】
図１４及び図１５では、ピラー４Ａを図示し、ピラー４Ｂを図示していないが、ピラー４Ｂは、ピラー４Ａと同様の構成であってもよい。すなわち、ピラー４Ｂは、第１の径（直径）を有する第１部分と第２の径（直径）を有する第２部分とを備えてもよい。ピラー４Ｂの第１部分及び第２部分は、円柱形状であり、ピラー４Ｂの第１部分と第２部分とは繋がっている。ピラー４Ｂの第１部分の径は、ピラー４Ｂの第２部分の径よりも大きい。ピラー４Ｂの第１部分の径が、ピラー４Ｂの第２部分の径よりも大きいので、ピラー４Ｂは段差形状を有する。換言すれば、ピラー４Ｂは、ピラーＢの一方の端面の中央部分が突出した形状になっている。ピラー４Ｂが電源基板３に実装された場合、ピラー４Ｂの第１部分は、メインボード２と電源基板３との間に位置し、ピラー４Ｂの第２部分は、電源基板３の内部に位置する。
【００５２】
ピラー４Ｂが段差形状を有することにより、ピラー４Ｂの第１部分が電源基板３の上面と接触し、ピラー４Ｂの第２部分が電源基板３を貫通するスルーホール３２の孔に挿入される。スルーホール３２は、第４スルーホールの一例である。スルーホール３２の孔は、平面視で円形形状である。ピラー４Ｂの第２部分の径は、スルーホール３２の孔の径（直径）よりも小さいため、ピラー４Ｂの第２部分とスルーホール３２との間に隙間（空間）が形成される。ピラー４Ｂの第２部分とスルーホール３２との間の隙間に半田３７が形成されることで、ピラー４Ｂの第２部分とスルーホール３２とが接合される。ピラー４Ｂの第１部分と電源基板３の上面とが接触し、ピラー４Ｂの第２部分とスルーホール３２とが接合されることで、電源基板３が一定の位置で保持される。ピラー４Ｂの第１部分の径は、スルーホール３２の径よりも大きいため、ピラー４Ｂの第１部分と電源基板３の上面とが接触する。
【００５３】
ピラー４Ａ及び４Ｂの一方が段差形状を有してもよいし、ピラー４Ａ及び４Ｂの両方が段差形状を有してもよい。ピラー４Ａ及び４Ｂの少なくとも一方が段差形状を有することにより、電源基板３が一定の位置で保持され、メインボード２と電源基板３との間の距離を一定にすることができる。ピラー４Ａ及び４Ｂの両方が段差形状を有することで、メインボード２に対する電源基板３の平行度の精度が向上する。また、複数のピラー４Ａのうち少なくとも一つのピラー４Ａが段差形状を有してもよいし、複数のピラー４Ａの全部が段差形状を有してもよい。複数のピラー４Ａのうち２つ以上のピラー４Ａが段差形状を有することで、メインボード２に対する電源基板３の平行度の精度が向上する。更に、複数のピラー４Ｂのうち少なくとも一つのピラー４Ｂが段差形状を有してもよいし、複数のピラー４Ｂの全部が段差形状を有してもよい。複数のピラー４Ｂのうち２つ以上のピラー４Ｂが段差形状を有することで、メインボード２に対する電源基板３の平行度の精度が向上する。
【００５４】
〈実施例３〉
図１に示すように、ＤＣ／ＤＣコンバータ６からＣＰＵ５に、ピラー４を介して電力が供給されるため、ＤＣ／ＤＣコンバータ６からＣＰＵ５に大電流を供給することができる。ＤＣ／ＤＣコンバータ６で生成された電力は、電源基板３の内層における配線パターン
を通り、ピラー４の外周面及びピラー４内を通ってＣＰＵ５に供給される。メインボード２には、ピラー４からＣＰＵ５に電力を供給するためのスルーホール２１が形成されている。ＣＰＵ５に大電流を供給するため、複数のスルーホール２１がメインボード２に形成されている。
【００５５】
１つのスルーホール２１に流せる電流には制限があるため、ＣＰＵ５に大電流を供給するには、スルーホール２１の個数が多くなる。ピラー４から複数のスルーホール２１に電流を流すには、ピラー４と複数のスルーホール２１とが接することになるため、スルーホール２１の個数に応じて、ピラー４の外径が大きくなる。メインボード２とピラー４とを接合する半田２５（はんだ接合部）の強度を上げるためには、半田２５の接合面積を拡大することが有効である。ピラー４の外径が大きくなると、半田２５の接合面積が拡大する。
【００５６】
一方、ピラー４の外径を大きくすると、ピラー４の剛性が高くなる。ピラー４の剛性が高くなると、以下に示す理由から、メインボード２とピラー４とを接合する半田２５にクラック（亀裂）が発生する。
【００５７】
電源供給基板１を備えるサーバ装置の電源がＯＮとなり、サーバ装置が稼働すると、サーバ装置内の温度は高くなり、サーバ装置の電源がＯＦＦとなり、サーバ装置が停止すると、サーバ装置内の温度は低くなる。サーバ装置内の温度が高くなると、メインボード２及び電源基板３は膨張し、サーバ装置内の温度が低くなると、メインボード２及び電源基板３は収縮する。図１６は、サーバ装置が稼働状態となることにより、メインボード２が膨張し、電源基板３が膨張した場合の電源供給基板１の模式図である。
【００５８】
基板特性（基板の材料、種類、厚さ、内層数）により、メインボード２の熱膨張率と、電源基板３の熱膨張率とが異なる。そのため、メインボード２の収縮速度と電源基板３の収縮速度とが異なる。例えば、メインボード２の収縮速度よりも電源基板３の収縮速度が速い場合、メインボード２及び電源基板３に実装されたピラー４Ａ、４Ｂが、メインボード２及び電源基板３のそれぞれの挙動に追従することにより、ピラー４Ａ、４Ｂの周辺に応力が発生する。図１７は、メインボード２の収縮速度よりも電源基板３の収縮速度が速い場合の電源供給基板１の模式図である。
【００５９】
ピラー４Ａ、４Ｂの剛性が低い場合、ピラー４Ａ、４Ｂが、メインボード２及び電源基板３のそれぞれの挙動に追従する際、ピラー４Ａ、４Ｂが撓ることにより、半田２５に発生する応力が緩和される。しかしながら、上述のように、ピラー４Ａ、４Ｂの外径を大きくすると、ピラー４Ａ、４Ｂの剛性が高くなる。そのため、半田２５に発生する応力が高くなり、半田２５の接合面にクラックが発生する。図１８は、電源供給基板１の模式図であり、応力発生箇所が示されている。
【００６０】
ピラー４Ａ、４Ｂの外径を小さくすると、ピラー４Ａ、４Ｂの剛性が低下する。半田２５に発生する応力を緩和するため、図１９に示すように、ピラー４Ａ、４Ｂの外径を小さくする対処方法が考えられる。しかしながら、ピラー４Ａの外径を小さくすると、ピラー４Ａとスルーホール２１Ａとの接合面積（接触面積）が減少し、ピラー４Ｂの外径を小さくすると、ピラー４Ｂとスルーホール２１Ｂとの接合面積（接触面積）が減少する。そのため、ＣＰＵ５に対する電力供給が不足する可能性がある。また、ピラー４Ａ、４Ｂの外径を小さくすると、半田２５の接合面積が減少することにより、半田２５の接合強度が低下する可能性がある。
【００６１】
実施例３に係る電源供給基板１について説明する。図２０は、電源供給基板１の模式図である。図２１は、ピラー４Ａの外観図であり、ピラー４Ａの側面及び底面を示している
。ピラー４Ａは、メインボード２に実装された第１部分９１Ａと、電源基板３に実装された第２部分９２Ａとを有する。電源基板３を貫通するスルーホール３１の孔にピラー４Ａの第２部分９２Ａが挿し込まれる。ピラー４Ａの第１部分９１Ａは、第１柱部９３Ａと、第２柱部９４Ａと、第１柱部９３Ａと第２柱部９４Ａとの間に形成（配置）された第３柱部９５Ａとを含む。
【００６２】
ピラー４Ａの第１柱部９３Ａは、メインボード２の下面に実装されている。ピラー４Ａの第２柱部９４Ａは、ピラー４Ａの第２部分９２Ａと繋がっている。また、ピラー４Ａの第２柱部９４Ａは、電源基板３の上面と接触（接続）している。ピラー４Ａの第１柱部９３Ａの外径（第１の径）と、ピラー４Ａの第２柱部９４Ａの外径（第２の径）とは同一の大きさである。ピラー４Ａの第１柱部９３Ａの外径（図２１のＤ１）は、例えば、Φ７ｍｍである。ピラー４Ａの第２柱部９４Ａの外径（図２１のＤ２）は、例えば、Φ７ｍｍである。ピラー４Ａの第１柱部９３Ａの厚み（図２１のＴ１）は、例えば、１ｍｍである。ピラー４Ａの第２柱部９４Ａの厚み（図２１のＴ２）は、例えば、１ｍｍである。ピラー４Ａの第２柱部９４Ａの外径は、ピラー４Ａの第２部分９２Ａの外径よりも大きい。したがって、ピラー４Ａは、鍔形状（段差形状）を有しているため、製造時におけるピラー４Ａの脱落が抑止される。
【００６３】
ピラー４Ａの第３柱部９５Ａの第３の径は、ピラー４Ａの第１柱部９３Ａの第１の径及びピラー４Ａの第２柱部９４Ａの第２の径よりも小さい。ピラー４Ａの第３柱部９５Ａの第３の径（図２１のＤ３）は、例えば、Φ６ｍｍである。したがって、ピラー４Ａの第１部分９１Ａは、上部分（第１柱部９３Ａ）と下部分（第２柱部９４Ａ）との間の中間部分（第３柱部９５Ａ）が細くなっている。ピラー４Ａの第３柱部９５Ａの断面積が、ＣＰＵ５で使用される電力を供給可能な面積を確保している場合、ピラー４Ａの第３柱部９５Ａの第３の径を可能な限り小さくしてもよい。ピラー４Ａの第３柱部９５Ａの厚み（図２１のＴ３）は、例えば、５ｍｍである。
【００６４】
図２２は、ピラー４Ｂの外観図であり、ピラー４Ｂの側面及び底面を示している。ピラー４Ｂは、メインボード２に実装された第１部分９１Ｂと、電源基板３に実装された第２部分９２Ｂとを有する。電源基板３を貫通するスルーホール３２の孔にピラー４Ｂの第２部分９２Ｂが挿し込まれる。ピラー４Ｂの第１部分９１Ｂは、第１柱部９３Ｂと、第２柱部９４Ｂと、第１柱部９３Ｂと第２柱部９４Ｂとの間に形成（配置）された第３柱部９５Ｂとを含む。
【００６５】
ピラー４Ｂの第１柱部９３Ｂは、メインボード２の下面に実装されている。ピラー４Ｂの第２柱部９４Ｂは、ピラー４Ｂの第２部分９２Ｂと繋がっている。また、ピラー４Ｂの第２柱部９４Ｂは、電源基板３の上面と接触（接続）している。ピラー４Ｂの第１柱部９３Ｂの外径（第１の径）と、ピラー４Ｂの第２柱部９４Ｂの外径（第２の径）とは同一の大きさである。ピラー４Ｂの第１柱部９３Ｂの外径（図２２のＤ４）は、例えば、Φ７ｍｍである。ピラー４Ｂの第２柱部９４Ｂの外径（図２２のＤ５）は、例えば、Φ７ｍｍである。ピラー４Ｂの第１柱部９３Ｂの厚み（図２２のＴ４）は、例えば、１ｍｍである。ピラー４Ｂの第２柱部９４Ｂの厚み（図２２のＴ５）は、例えば、１ｍｍである。ピラー４Ｂの第２柱部９４Ｂの外径は、ピラー４Ｂの第２部分９２Ｂの外径よりも大きい。したがって、ピラー４Ｂは、鍔形状（段差形状）を有しているため、製造時におけるピラー４Ｂの脱落が抑止される。
【００６６】
ピラー４Ｂの第３柱部９５Ｂの第３の径は、ピラー４Ｂの第１柱部９３Ｂの第１の径及びピラー４Ｂの第２柱部９４Ｂの第２の径よりも小さい。ピラー４Ｂの第３柱部９５Ｂの第３の径（図２２のＤ６）は、例えば、Φ６ｍｍである。したがって、ピラー４Ｂの第１部分９１Ｂは、上部分（第１柱部９３Ｂ）と下部分（第２柱部９４Ｂ）との間の中間部分
（第３柱部９５Ｂ）が細くなっている。ピラー４Ｂの第３柱部９５Ｂの断面積が、ＣＰＵ５で使用される電力を供給可能な面積を確保している場合、ピラー４Ｂの第３柱部９５Ｂの第３の径を可能な限り小さくしてもよい。ピラー４Ｂの第３柱部９５Ｂの厚み（図２２のＴ６）は、例えば、５ｍｍである。
【００６７】
ピラー４Ａ、４Ｂの剛性は、材料力学上、断面二次モーメントにより表すことができる。断面二次モーメントの値が大きいほど剛性が高い。円形の断面二次モーメントＩは、次の式１で求められる。
Ｉ＝πｄ４／６４・・・式１
ｄはピラー４Ａ又は４Ｂの直径である。
【００６８】
式１に対して、実施例１に係るピラー４Ａの直径の値（ｄ＝Φ７ｍｍ）を代入すると、実施例１に係るピラー４Ａの断面二次モーメントの値は、Ｉ＝１１７．８となる。実施例１に係るピラー４Ａは、上部分と下部分との間の中間部分が細くなっていないストレート形状である。式１に対して、実施例３に係るピラー４Ａの第３柱部９５Ａの直径の値（ｄ＝Φ６ｍｍ）を代入すると、実施例３に係るピラー４Ａの第３柱部９５Ａの断面二次モーメントの値は、Ｉ＝６３．６となる。したがって、実施例３に係るピラー４Ａの第３柱部９５Ａの断面二次モーメントの値は、実施例１に係るピラー４Ａの断面二次モーメントの値の５４％程度に低下する。この結果から、実施例３に係るピラー４Ａの剛性は、実施例１に係るピラー４Ａの剛性よりも低下していることがわかる。ここでは、ピラー４Ａについて説明しているが、ピラー４Ｂについてもピラー４Ａと同一の形状を有しているので、ピラー４Ｂについても、ピラー４Ａと同様の結果となり、実施例３に係るピラー４Ｂの剛性は、実施例１に係るピラー４Ｂの剛性よりも低下する。
【００６９】
実施例１に係る半田２５に発生する応力の解析と、実施例３に係る半田２５に発生する応力の解析とを行った結果、実施例３に係る半田２５に発生する応力が低減していることが確認された。応力解析の条件及び結果を以下に示す。
解析条件：サーバ装置内の温度差＝６５℃
サーバ装置内の温度差は、サーバ装置内の温度が上昇したときの最高温度とサーバ装置内の温度が下降したときの最低温度との差分である。
解析結果１：実施例１に係る半田２５に発生する応力＝２８．６９ＭＰａ（最大値）
解析結果２：実施例３に係る半田２５に発生する応力＝２５．９９ＭＰａ（最大値）
解析結果１及び解析結果２から、実施例３に係る半田２５に発生する応力が約９％低減していることがわかる。
【００７０】
図２１には、ピラー４Ａの第２柱部９４Ａの外径が、ピラー４Ａの第２部分９２Ａの外径よりも大きい場合の例を示した。実施例３は、図２１に示す例に限定されず、ピラー４Ａの第２柱部９４Ａの外径と、ピラー４Ａの第２部分９２Ａの外径とが同じ大きさであってもよい。図２２には、ピラー４Ｂの第２柱部９４Ｂの外径が、ピラー４Ｂの第２部分９２Ｂの外径よりも大きい場合の例を示した。実施例３は、図２２に示す例に限定されず、ピラー４Ｂの第２柱部９４Ｂの外径と、ピラー４Ｂの第２部分９２Ｂの外径とが同じ大きさであってもよい。
【００７１】
実施例３に係る電源供給基板１によれば、ピラー４Ａが、第１柱部９３Ａ及び第２柱部９４Ａよりも細い第３柱部９５Ａを有することにより、半田２５に発生する応力を低減することができる。ピラー４Ａの第１柱部９３Ａの外径は小さくなっていない。そのため、ピラー４Ａとスルーホール２１Ａとの接合面積は減少しておらず、また、半田２５の接合面積も減少していない。したがって、実施例３に係る電源供給基板１によれば、ＣＰＵ５に対する電力供給の不足を回避しつつ、半田２５の接合強度を維持することができる。
【００７２】
実施例３に係る電源供給基板１によれば、ピラー４Ｂが、第１柱部９３Ｂ及び第２柱部９４Ｂよりも細い第３柱部９５Ｂを有することにより、半田２５に発生する応力を低減することができる。ピラー４Ｂの第１柱部９３Ｂの外径は小さくなっていない。そのため、ピラー４Ｂとスルーホール２１Ｂとの接合面積は減少しておらず、また、半田２５の接合面積も減少していない。したがって、実施例３に係る電源供給基板１によれば、ＣＰＵ５に対する電力供給の不足を回避しつつ、半田２５の接合強度を維持することができる。
【符号の説明】
【００７３】
１    電源供給基板
２    メインボード
３    電源基板
４    ピラー
５    ＣＰＵ
６    ＤＣ／ＤＣコンバータ
１１  半田ボール
２１、３１、３２、３３、３４  スルーホール
２２  信号伝送路
２３、２４  面パターン
２５、３７  半田
３５  電源配線
３６  グランド配線
７１  第１コネクタ
７２  第２コネクタ
８１、８２  電子部品
【図１】
0006565576.tif 000002
【図２】
0006565576.tif 000003
【図３】
0006565576.tif 000004
【図４】
0006565576.tif 000005
【図５】
0006565576.tif 000006
【図６】
0006565576.tif 000007
【図７】
0006565576.tif 000008
【図８】
0006565576.tif 000009
【図９】
0006565576.tif 000010
【図１０】
0006565576.tif 000011
【図１１】
0006565576.tif 000012
【図１２Ａ】
0006565576.tif 000013
【図１２Ｂ】
0006565576.tif 000014
【図１３】
0006565576.tif 000015
【図１４】
0006565576.tif 000016
【図１５】
0006565576.tif 000017
【図１６】
0006565576.tif 000018
【図１７】
0006565576.tif 000019
【図１８】
0006565576.tif 000020
【図１９】
0006565576.tif 000021
【図２０】
0006565576.tif 000022
【図２１】
0006565576.tif 000023
【図２２】
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