(57)【特許請求の範囲】
【請求項１】
画像データを記憶するメモリと、
前記メモリから読み出した画像データを一時記憶する第１のバッファと、
前記第１のバッファに所定量の画像データが記憶されたことを通知するバッファフル通知部と、
前記第１のバッファにバスを介して接続され、前記第１のバッファから読み出した画像データを一時記憶する第２のバッファと、
前記第２のバッファに記憶された画像データに基づいて媒体に画像を形成する画像形成手段と、
リード制御部と
を備え、
前記リード制御部は、
前記第１のバッファに記憶されている画像データの前記第２のバッファへの先読み命令が発生し、且つ、前記バッファフル通知部からの通知があった場合に、前記第１のバッファに記憶されている画像データからラインバッファ分の画像データを前記バスを介して取得して前記第２のバッファに記憶し、
前記画像形成手段からの画像データの転送要求に基づいて前記第２のバッファに記憶した画像データを前記画像形成手段に転送し、その転送後、前記第１のバッファに記憶されている画像データからラインバッファ分の画像データを前記バスを介して取得して前記第２のバッファに記憶して前記第２のバッファに記憶した画像データを前記画像形成手段に転送する処理を繰り返す
画像形成装置。
【請求項２】
前記バッファフル通知部は、前記第１のバッファに所定量の画像データが記憶されたことを検知した場合に、レジスタを介して前記通知を行う、請求項１に記載の画像形成装置。
【請求項３】
前記バッファフル通知部は、前記バスを介してライトリクエストを前記レジスタに発行することで前記通知を行う、請求項２に記載の画像形成装置。
【請求項４】
前記バッファフル通知部は、前記第１のバッファに所定量の画像データが記憶されたことを検知した場合に、ＣＰＵへの割り込みにより前記通知を行う、請求項１に記載の画像形成装置。
【請求項５】
前記第１のバッファおよび前記バッファフル通知部と、前記第２のバッファおよび前記リード制御部とが、Ｃ（シアン）、Ｍ（マゼンタ）、Ｙ（イエロー）、Ｋ（ブラック）の各版毎に用意される、請求項１〜４のいずれか一項に記載の画像形成装置。
【請求項６】
前記バスは、ＰＣＩ  Ｅｘｐｒｅｓｓである、請求項１〜５のいずれか一項に記載の画像形成装置。
【請求項７】
画像データを記憶するメモリと、
前記メモリから読み出した画像データを一時記憶する第１のバッファと、
前記第１のバッファにバスを介して接続され、前記第１のバッファから読み出した画像データを一時記憶する第２のバッファと、
前記第２のバッファに記憶された画像データに基づいて媒体に画像を形成する画像形成手段と、
を有する画像形成装置の制御方法であって、
前記第１のバッファに所定量の画像データが記憶されたことを通知するバッファフル通知ステップと、
前記第１のバッファに記憶されている画像データの前記第２のバッファへの先読み命令が発生し、且つ、前記バッファフル通知ステップからの通知があった場合に、前記第１のバッファに記憶されている画像データからラインバッファ分の画像データを前記バスを介して取得して前記第２のバッファに記憶する先読みステップと、
前記画像形成手段からの画像データの転送要求に基づいて前記第２のバッファに記憶した画像データを前記画像形成手段に転送し、その転送後、前記第１のバッファに記憶されている画像データからラインバッファ分の画像データを前記バスを介して取得して前記第２のバッファに記憶して前記第２のバッファに記憶した画像データを前記画像形成手段に転送する処理を繰り返すリードステップと、
を含む制御方法。
【発明の詳細な説明】
【技術分野】
【０００１】
本発明の実施形態は、画像形成装置およびその制御方法に関する。
【背景技術】
【０００２】
従来、エンジン部とコントローラ部とがＰＣＩ  Ｅｘｐｒｅｓｓ（登録商標）などの汎用バスで接続され、エンジン部のプロッタ（画像形成手段）が画像データの要求をした場合に、コントローラ部のメモリ上に準備された画像データを遅延なくプロッタに転送するために、エンジン部においてプロッタの前段（コントローラ部側）に配置されたＡＳＩＣのバッファに画像データを先読みして準備しておくように構成した画像形成装置が知られている。
【０００３】
また、従来では、メモリ上に画像データが準備されていない状態で、エンジン部から画像データの転送要求があることで、不良の画像データがエンジン部に転送されるのを防止するべく、メモリの所定数のトグルバッファに対する画像データの格納が完了した場合に、コントローラ部からエンジン部にリード許可を通知し、その通知を受けたエンジン部がコントローラ部に対して画像データの転送要求を行うように構成した画像形成装置（特許文献１参照）が知られている。
【発明の概要】
【発明が解決しようとする課題】
【０００４】
しかしながら、従来の画像形成装置では、メモリ上に画像データが準備されていたとしても、コントローラ部のＡＳＩＣのバッファに画像データが準備されていない状態で、画像データの先読み処理が行われると、不正な画像データがプロッタに転送されてしまい、それにより画像形成の品質が低下するなどの課題がある。
【０００５】
そこで、本発明は、前記従来の課題を解決するものであり、画像形成部（プロッタ）に不正な画像データが転送されるのを防止することが可能な画像形成装置およびその制御方法を提供することを目的とする。
【課題を解決するための手段】
【０００６】
前記した課題を解決し、目的を達成するために、本発明の画像形成装置は、画像データを記憶するメモリと、前記メモリから読み出した画像データを一時記憶する第１のバッファと、前記第１のバッファに所定量の画像データが記憶されたことを通知するバッファフル通知部と、前記第１のバッファにバスを介して接続され、前記第１のバッファから読み出した画像データを一時記憶する第２のバッファと、前記第２のバッファに記憶された画像データに基づいて媒体に画像を形成する画像形成手段と、リード制御部とを備え、前記リード制御部は、前記第１のバッファに記憶されている画像データの前記第２のバッファへの先読み命令が発生し、且つ、前記バッファフル通知部からの通知があった場合に、前記第１のバッファに記憶されている画像データからラインバッファ分の画像データを前記バスを介して取得して前記第２のバッファに記憶し、前記画像形成手段からの画像データの転送要求に基づいて前記第２のバッファに記憶した画像データを前記画像形成手段に転送し、その転送後、前記第１のバッファに記憶されている画像データからラインバッファ分の画像データを前記バスを介して取得して前記第２のバッファに記憶して前記第２のバッファに記憶した画像データを前記画像形成手段に転送する処理を繰り返す。
【０００７】
また、本発明の画像形成装置の制御方法は、画像データを記憶するメモリと、前記メモリから読み出した画像データを一時記憶する第１のバッファと、前記第１のバッファにバスを介して接続され、前記第１のバッファから読み出した画像データを一時記憶する第２のバッファと、前記第２のバッファに記憶された画像データに基づいて媒体に画像を形成する画像形成手段と、を有する画像形成装置の制御方法であって、前記第１のバッファに所定量の画像データが記憶されたことを通知するバッファフル通知ステップと、前記第１のバッファに記憶されている画像データの前記第２のバッファへの先読み命令が発生し、且つ、前記バッファフル通知ステップからの通知があった場合に、前記第１のバッファに記憶されている画像データからラインバッファ分の画像データを前記バスを介して取得して前記第２のバッファに記憶する先読みステップと、前記画像形成手段からの画像データの転送要求に基づいて前記第２のバッファに記憶した画像データを前記画像形成手段に転送し、その転送後、前記第１のバッファに記憶されている画像データからラインバッファ分の画像データを前記バスを介して取得して前記第２のバッファに記憶して前記第２のバッファに記憶した画像データを前記画像形成手段に転送する処理を繰り返すリードステップと、を含む。
【発明の効果】
【０００８】
本発明によれば、画像形成手段（プロッタ）に不正な画像データが転送されるのを防止することができ、それにより、画像形成の品質が低下するのを防止することができる。
【図面の簡単な説明】
【０００９】
【図１】図１は、本実施形態に係わる複合機のハードウェア構成を示すブロック図である。
【図２】図２は、第１の実施形態のＡＳＩＣ（Ｃ）の詳細を示すブロック図である。
【図３】図３は、第１の実施形態のＡＳＩＣ（Ｅ）の詳細を示すブロック図である。
【図４】図４は、第１の実施形態の複合機における処理の流れを示すシーケンス図である。
【図５】図５は、第２の実施形態のＡＳＩＣ（Ｃ）の詳細を示すブロック図である。
【図６】図６は、第２の実施形態のＡＳＩＣ（Ｃ）を有する複合機における処理の流れを示すシーケンス図である。
【図７】図７は、第３の実施形態のＡＳＩＣ（Ｃ）の詳細を示すブロック図である。
【図８】図８は、第３の実施形態のＡＳＩＣ（Ｅ）の詳細を示すブロック図である。
【発明を実施するための形態】
【００１０】
以下、本発明の実施形態について添付図面を参照して説明する。
【００１１】
なお、本発明の画像形成装置は、複合機（ＭＦＰ：Ｍｕｌｔｉ  Ｆｕｎｃｔｉｏｎ  Ｐｅｒｉｐｈｅｒａｌｓ）やプリンタなどの、記録用紙などの媒体に画像を形成することが可能な画像形成装置であるが、以下の説明では、スキャナ機能、コピー機能、プリンタ機能およびファクシミリ機能を有するデジタル複合機に適用した場合について説明する。
【００１２】
また、以下の説明では、複数の実施形態間において同様の構成要素には共通の符号を付し、重複する説明を省略する。
【００１３】
（第１の実施形態）
図１は、第１の実施形態に係る複合機１のハードウェア構成を示すブロック図である。
【００１４】
図１に示すように、本実施形態の複合機１は、複合機１における各種の処理動作を制御するコントローラ（Ｃｏｎｔｒｏｌｌｅｒ）部２と、不図示のスキャナ（画像読取手段）で記録用紙などの媒体に形成された画像を読み取る処理や、プロッタ（画像形成手段）３３で記録用紙などの媒体に画像を形成する処理などを行うエンジン（Ｅｎｇｉｎｅ）部（画像形成部）３とを主体に構成される。
【００１５】
コントローラ部２は、ＣＰＵ（Ｃｅｎｔｒａｌ  Ｐｒｏｃｅｓｓｉｎｇ  Ｕｎｉｔ）（Ｃ）２１、メモリ２２、ＮＢ（Ｎｏｒｔｈ  Ｂｒｉｄｇｅ）２３、ＡＳＩＣ（Ａｐｐｌｉｃａｔｉｏｎ  Ｓｐｅｃｉｆｉｃ  Ｉｎｔｅｇｒａｔｅｄ  Ｃｉｒｃｕｉｔ）（Ｃ）２４、ＨＤＤ（Ｈａｒｄ  Ｄｉｓｋ  Ｄｒｉｖｅ）２５などを有している。
【００１６】
ＣＰＵ（Ｃ）２１は、複合機１全体を統括的に制御するものであり、特に、コントローラ部２における各種処理動作を制御する第１の制御部である。
【００１７】
メモリ２２は、ＨＤＤ２５に格納された画像データの中から所定量の画像データを読み出して記憶する画像データ格納用のメモリである。
【００１８】
ＮＢ（ノースブリッジ）２３は、ＣＰＵ（Ｃ）２１と、メモリ２２と、ＡＳＩＣ（Ｃ）２４とを接続制御するチップである。
【００１９】
ＡＳＩＣ（Ｃ）２４は、コントローラ部２における各種の画像処理（例えば、画像データの回転や編集など）を行う第１の画像処理部である。
【００２０】
ＨＤＤ（ハードディスク装置）２５は、スキャナ（画像読取手段）（不図示）で読取られて必要な画像処理の行われた画像データ（以下、「スキャナデータ」という。）や、ホスト装置（不図示）から受信した画像データ（以下、「受信データ」という。）などを格納する記憶装置である。
【００２１】
なお、ＮＢ２３とＡＳＩＣ（Ｃ）２４とは、ＰＣＩ（Ｐｅｒｉｐｈｅｒａｌ  Ｃｏｍｐｏｎｅｎｔ  Ｉｎｔｅｒｆａｃｅ）  Ｅｘｐｒｅｓｓなどの汎用バスＢ１で接続されている。
【００２２】
エンジン部（画像形成部）３は、ＣＰＵ（Ｅ）３１、ＡＳＩＣ（Ｅ）３２と、プロッタ（画像形成手段）３３などを有している。
【００２３】
ＣＰＵ（Ｅ）３１は、エンジン部３における各種処理動作を制御する第２の制御部である。
【００２４】
ＡＳＩＣ（Ｅ）３２は、エンジン部３における各種の画像処理（例えば、スキャナ（画像読取手段）（不図示）で読み取った画像データに対する画像処理や、プロッタ（画像形成手段）３３に転送する画像データに対する画像処理など）を行う第２の画像処理部である。
【００２５】
なお、スキャナ（画像読取手段）（不図示）で読み取った画像データに対する画像処理としては、例えば、スキャナインタフェース（Ｉ／Ｆ）処理や、シェーディング補正処理や、フィルタ処理や、色補正処理や、変倍処理や、２値化処理などが挙げられる。
【００２６】
また、プロッタ（画像形成手段）３３に転送する画像データに対する画像処理としては、例えば、誤差拡散方法やプリンタγ変換などのプリンタ画像処理が挙げられる。
【００２７】
プロッタ３３は、レーザービームを用いた電子写真プロセスなどを使用して、受け取った画像データに基づく画像を記録用紙などの媒体に形成する画像形成手段である。
【００２８】
なお、本実施形態の複合機１では、コントローラ部２のＡＳＩＣ（Ｃ）２４とエンジン部３のＡＳＩＣ（Ｅ）３２とが、ＰＣＩ  Ｅｘｐｒｅｓｓなどの汎用のバスＢ２で接続されている。
【００２９】
また、図１の例では、特に図示していないが、本実施形態の複合機１は、ユーザからの操作入力を受け付ける操作部やユーザに通知する各種情報を表示する表示部などを有するユーザインタフェース部としての操作表示部や、外部のホスト装置と通信接続するための通信インタフェース部や、ファクシミリ通信を行うファクシミリユニットなどを有している。
【００３０】
図２は、コントローラ部２のＡＳＩＣ（Ｃ）２４の詳細な構成を示すブロック図である。
【００３１】
図２に示すように、このＡＳＩＣ（Ｃ）２４は、ＲＣ（Ｒｏｏｔ  Ｃｏｍｐｌｅｘ）２４ａと、出力バッファ（第１のバッファ）２４ｂと、ＲＤＭＡＣ（Ｒｅａｄ  Ｄｉｒｅｃｔ  Ｍｅｍｏｒｙ  Ａｃｃｅｓｓ  Ｃｏｎｔｒｏｌｌｅｒ）２４ｃと、ＥＰ（Ｅｎｄ  Ｐｏｉｎｔ）２４ｄと、バッファフル通知部２４ｅとを有している。
【００３２】
ここで、ＲＣ（ルートコンプレックス）２４ａは、ターゲットとして、汎用バスＢ２を介してエンジン部３のＡＳＩＣ（Ｅ）３２からのリードリクエストを受信し、出力バッファ２４ｂからの読み出しを制御する。また、ＲＣ２４ａは、マスタとして、バッファフル通知部２４ｅからのライト要求を受けると汎用バスＢ２を介してＡＳＩＣ（Ｅ）３２にライトリクエストを発行する。
【００３３】
出力バッファ２４ｂは、メモリ２２から読み出した画像データを一時的に記憶するためのバッファであり、第１の実施形態における出力バッファ２４ｂは、バッファ容量分のデータが充填（記憶）された場合に、出力バッファ２４ｂが充填されたこと（バッファフル）を通知するバッファフル信号をバッファフル通知部２４ｅに送出する。
【００３４】
ＲＤＭＡＣ（リードＤＭＡＣ）２４ｃは、メモリ２２から画像データを読み出すためのものである。
【００３５】
ＥＰ（エンドポイント）２４ｄは、マスタとして、バスＢ１を介してメモリ２２へのリードリクエストを発行するとともに、ターゲットとして、ＡＳＩＣ（Ｅ）３２のコミュニケーションバッファ３２ｇ経由で、ＣＰＵ（Ｃ）２１とＣＰＵ（Ｅ）３１間のデータ転送処理を行うものである。
【００３６】
バッファフル通知部２４ｅは、出力バッファ２４ｂが充填されたこと（バッファフル）を通知する部であり、具体的には、出力バッファ２４ｂからのバッファフル信号を検知した場合にＲＣ２４ａに対してライト要求を発行する。なお、ライト要求先のアドレスは、ＡＳＩＣ（Ｅ）３２のターゲット空間内に配置されたレジスタ３２ｅのアドレスである。
【００３７】
なお、図１や図２の例では、特に図示していないが、本実施形態のコントローラ部２は、ＳＢ（サウスブリッジ）や、ＲＯＭ（Ｒｅａｄ  Ｏｎｌｙ  Ｍｅｍｏｒｙ）やＲＡＭ（Ｒａｎｄｏｍ  Ａｃｃｅｓｓ  Ｍｅｍｏｒｙ)などのプログラムや各種データを格納または展開するためのメモリなどを有している。
【００３８】
図３は、エンジン部３のＡＳＩＣ（Ｅ）３２の詳細な構成を示すブロック図である。
【００３９】
図３に示すように、このＡＳＩＣ（Ｅ）３２は、出力バッファ（第２のバッファ）３２ａと、ＲＤＭＡＣ３２ｂと、ＥＰ３２ｃと、リード制御部３２ｄと、レジスタ３２ｅと、レジスタ３２ｆと、コミュニケーションバッファ３２ｇとを有している。
【００４０】
ここで、出力バッファ（第１）３２ａは、ＡＳＩＣ（Ｃ）２４の出力バッファ２４ｂから読み出した画像データを一時的に記憶するためのラインバッファである。
【００４１】
ＲＤＭＡＣ３２ｂは、ＡＳＩＣ（Ｃ）２４の出力バッファ２４ｂから画像データを読み出すためのものである。
【００４２】
ＥＰ３２ｃは、マスタとして、バスＢ２を介してＡＳＩＣ（Ｃ）２４へのリードリクエストを発行する。また、ＥＰ３２ｃは、ターゲットとして、ＡＳＩＣ（Ｃ）２４からのライトリクエストを受信し、レジスタ３２ｅへの書込みを行う。
【００４３】
リード制御部３２ｄは、ＲＤＭＡＣ３２ｂの起動タイミングを制御するものであり、ＡＳＩＣ（Ｃ）２４からのバッファフル通知と、ＣＰＵ（Ｃ）２１からのＭ２Ｐスタートコマンド（先読み命令）とを受けた場合に、ＲＤＭＡＣ３２ｂを起動し、ＲＤＭＡＣ３２ｂによりＡＳＩＣ（Ｃ）２４の出力バッファ２４ｂに充填（記憶）された画像データを読み出す（即ち、出力バッファ２４ｂに充填（記憶）された画像データを汎用バスＢ２を介して取得し、出力バッファ３２ａに記憶させる）。また、リード制御部３２ｄは、出力バッファ３２ａに画像データを充填（記憶）した後、プロッタ（画像形成手段）３３からの画像データの転送要求（ＦＳＹＮＣ）を受けると、プロッタ３３へのＭ２Ｐ（Ｍｅｍｏｒｙ  ｔｏ  Ｐｌｏｔｔｅｒ）データである画像データのデータ転送を開始する。
【００４４】
なお、ここでいうＭ２Ｐスタートコマンド（先読み命令）とは、出力バッファ２４ｂに記憶されている画像データを出力バッファ３２ａに読み出すための読み出し命令である。
【００４５】
レジスタ３２ｆは、ＡＳＩＣ（Ｅ）３２のターゲット空間内に配置されたレジスタであり、ＡＳＩＣ（Ｃ）２４から送出され、ＥＰ３２ｃ経由で受信したライトデータ（バッファフル通知）が書き込まれる。
【００４６】
レジスタ３２ｇは、ＣＰＵ（Ｅ）３１からアクセス可能な空間に配置されたレジスタであり、ＣＰＵ（Ｅ）３１から送出されたＭ２Ｐスタートコマンド（先読み命令）が書き込まれる。
【００４７】
コミュニケーションバッファ３２ｇは、ＣＰＵ（Ｅ）３１とＣＰＵ（Ｃ）２１との間で送受信される各種転送データを一時的に記憶するためのバッファである。
【００４８】
なお、図１や図３の例では、特に図示していないが、本実施形態のエンジン部３は、プロッタ（画像形成手段）３３やスキャナ（画像読取手段）（不図示）の駆動を制御する制御部を有している。
【００４９】
図４は、第１の実施形態の複合機１における処理の流れを示すシーケンス図である。
【００５０】
図４に示すように、まず、ステップＳ１において、画像形成時などの所定のタイミングで、ＣＰＵ（Ｃ）２１、ＡＳＩＣ（Ｃ）２４、ＡＳＩＣ（Ｅ）３２およびＣＰＵ（Ｅ）３１間で、各種のＭ２Ｐ制御パラメータをセットする。
【００５１】
その後、ステップＳ２において、ＣＰＵ（Ｅ）３１が、ＡＳＩＣ（Ｅ）３２にＭ２Ｐスタートコマンド（先読み命令）をセットする。
【００５２】
続いて、ステップＳ３において、ＡＳＩＣ（Ｃ）２４では、バッファフル通知部２４ｅが出力バッファ２４ｂからバッファフル信号を受信して、出力バッファ２４ｂのバッファフルを検知した場合に、バッファフル通知部２４ｅがＲＣ２４ａにライト要求としてのライトデータを発行する。すると、ＲＣ２４ａ経由でＡＳＩＣ（Ｅ）３２のレジスタ３２ｅにライトデータが書き込まれる。これにより、ＡＳＩＣ（Ｅ）３２のリード制御部３２ｄにバッファフル通知が行われる。
【００５３】
すると、続いて、ステップＳ４において、ＡＳＩＣ（Ｅ）３２が、ラインバッファ分の先読み処理を開始する。即ち、ＡＳＩＣ（Ｅ）３２は、ＡＳＩＣ（Ｃ）２４の出力バッファ２４ｂに充填（記憶）されたデータの中からラインバッファ分のデータを読み取り、出力バッファ３２ａに記憶する。そして、先読み処理によりラインバッファ分のデータを出力バッファ３２ａに充填（記憶）した後、ＡＳＩＣ（Ｅ）３２は、プロッタ（画像形成手段）３３からの画像データの転送要求（ＦＳＹＮＣ）の受信を待機する。
【００５４】
そして、ステップＳ５において、ＡＳＩＣ（Ｅ）３２は、プロッタ３３から画像データの転送要求（ＦＳＹＮＣ）を受信すると、プロッタ３３に対して画像データの転送を開始する。具体的には、ＡＳＩＣ（Ｅ）３２は、ステップＳ４で先読みして出力バッファ３２ａに充填（記憶）されている画像データをプロッタ３３に転送するとともに、その転送後、次のラインバッファ分の画像データをＡＳＩＣ（Ｃ）２４の出力バッファ２４ｂから読み取り、出力バッファ３２ａに充填（記憶）し、その出力バッファ３２ａに記憶した画像データをプロッタ３３に転送するという一連の処理を繰り返し実行する。
【００５５】
即ち、第１の実施形態によれば、エンジン部３のＡＳＩＣ（Ｅ）３２が画像データの先読み処理を実行する際には、コントローラ部２のＡＳＩＣ（Ｃ）２４の出力バッファ２４ａに画像データが常に準備されているため、プロッタ（画像形成手段）に不正な画像データが転送されるのを防止することができ、それにより、画像形成の品質が低下するのを防止することができる。
【００５６】
また、第１の実施形態によれば、ソフトウェアを介在することなくバッファフル通知をハードウェアで行うことができるので、ＡＳＩＣ（Ｅ）３２がより早くデータ要求を発行することが可能である。また、第１の実施形態によれば、ＡＳＩＣ（Ｅ）３２とＡＳＩＣ（Ｃ）２４との間に専用の信号線を追加する必要がないので、コスト面でのオーバヘッドを抑えることが可能である。
【００５７】
（第２の実施形態）
次に、第２の実施形態について図５および図６を用いて説明する。なお、第２の実施形態は、第１の実施形態と比較して、第１の実施形態のコントローラ部２のＡＳＩＣ（Ｃ）２４がＡＳＩＣ（Ｃ）２４Ａに変更されている点のみが相違している。
【００５８】
具体的には、図５に示すように、第２の実施形態のＡＳＩＣ（Ｃ）２４Ａは、第１の実施形態のＡＳＩＣ（Ｃ）２４におけるバッファフル通知部２４ｅを省略した構成となっている。
【００５９】
また、第２の実施形態のＡＳＩＣ（Ｃ）２４Ａでは、出力バッファ２４ｂがバッファ容量分のデータが充填された場合に、バッファフル信号をＥＰ２４ｄに送出する。そして、そのバッファフル信号を受けたＥＰ２４ｄがバスＢ１を介してＣＰＵ（Ｃ）２１への割り込みを発行する（即ち、バッファフル通知を行う）。その後、割り込みを受けたＣＰＵ（Ｃ）２１がソフトウェアによりＣＰＵ（Ｅ）３１を介してＡＳＩＣ（Ｅ）３２に対してバッファフル通知を行う。
【００６０】
図６は、第１の実施形態の複合機１において、コントローラ部２のＡＳＩＣ（Ｃ）２４に替えて、第２の実施形態のＡＳＩＣ（Ｃ）２４Ａを搭載した複合機１における処理の流れを示すシーケンス図である。
【００６１】
なお、この図６のシーケンスでは、ステップＳ１１、ステップＳ１２、ステップＳ１４およびステップＳ１５の処理が、図４のシーケンスにおけるステップＳ１、ステップＳ２、ステップＳ４およびステップＳ５のそれぞれの処理と同様であり、ステップＳ１３の処理のみがステップＳ３の処理と相違する。このため、以下では、同様の処理については説明を省略する。
【００６２】
図６のシーケンスにおけるステップＳ１３において、ＡＳＩＣ（Ｃ）２４Ａでは、ＥＰ２４ｄが出力バッファ２４ｂからバッファフル信号を受け取ると、バスＢ１を介してＣＰＵ（Ｃ）２１へのバッファフルの割り込みを発行する。すると、バッファフルの割り込みを受けたＣＰＵ（Ｃ）２１が、ソフトウェアにより、ＡＳＩＣ（Ｅ）３２のコミュニケーションバッファ３２ｇを介してＣＰＵ（Ｅ）３１にバッファフル通知を行い、そのバッファフル通知を受けたＣＰＵ（Ｅ）３１がＡＳＩＣ（Ｅ）３２に対してバッファフル通知を行う。
【００６３】
第１の実施形態では、バッファフル通知をハードウェアを利用しているのに対して、第２の実施形態では、バッファフル通知をソフトウェアを利用している点が相違している。
【００６４】
即ち、第２の実施形態によれば、コントローラ部２のＣＰＵ（Ｃ）２１がバッファフルを認識できるので、ソフトウェアでＣＰＵ（Ｃ）２１からＡＳＩＣ（Ｅ）３２にバッファフル通知を行うことができ、バッファフル通知を行うためのハードウェアのオーバヘッドを抑えることが可能である。
【００６５】
（第３の実施形態）
次に、第３の実施形態について図７および図８を用いて説明する。なお、第３の実施形態は、第１の実施形態と比較して、第１の実施形態のコントローラ部２のＡＳＩＣ（Ｃ）２４がＡＳＩＣ（Ｃ）２４Ｂに変更され、第１の実施形態のエンジン部３のＡＳＩＣ（Ｅ）３２がＡＳＩＣ（Ｅ）３２Ｂに変更され、プロッタ（画像形成手段）３３がプロッタ（画像形成手段）３３Ｂに変更されている点のみが相違している。
【００６６】
具体的には、図７に示すように、第３の実施形態のＡＳＩＣ（Ｃ）２４Ｂは、第１の実施形態のＡＳＩＣ（Ｃ）２４におけるＲＣ２４ａおよびＥＰ２４ｄを除く構成要素である出力バッファ２４ｂ、ＲＤＭＡＣ２４ｃおよびバッファフル通知部２４ｅが、Ｃ（シアン）、Ｍ（マゼンタ）、Ｙ（イエロー）、Ｋ（ブラック）の各版（各色）毎に用意されている。また、第３の実施形態のプロッタ（画像形成手段）３３Ｂは、各版（各色）毎の出力機構を備えている。
【００６７】
また、図８に示すように、第３の実施形態のＡＳＩＣ（Ｅ）３２Ｂは、第１の実施形態のＡＳＩＣ（Ｅ）３２におけるＥＰ３２ｃ、レジスタ３２ｆおよびコミュニケーションバッファ３２ｇを除く構成要素である出力バッファ３２ａ、ＲＤＭＡＣ３２ｂ、リード制御部３２ｄおよびレジスタ３２ｅが、Ｃ（シアン）、Ｍ（マゼンタ）、Ｙ（イエロー）、Ｋ（ブラック）の各版（各色）毎に用意されている。
【００６８】
即ち、第３の実施形態によれば、Ｃ（シアン）、Ｍ（マゼンタ）、Ｙ（イエロー）、Ｋ（ブラック）の各版（各色）成分に対応した複数の画像データを並列に転送できるので、画像データの転送を高速に行うことができる。
【００６９】
また、前記した第１〜第３の実施形態以外にも、第２の実施形態と第３の実施形態とを組合わせた実施形態とすることも可能である。即ち、第３の実施形態のＡＳＩＣ（Ｃ）２４Ｂにおいて、第２の実施形態に示したＡＳＩＣ（Ｃ）２４Ａのようにバッファフル通知部２４ｅを有さない構成とすることも可能である。
【００７０】
以上、例示的な実施形態に基づいて説明したが、本実施形態は、前記した実施形態により限定されるものではない。
【００７１】
例えば、前記した実施形態では、バッファフル通知部は、出力バッファにバッファ容量分のデータが充填されたことを通知する場合について説明したが、これ以外にも、バッファフル通知部が、出力バッファに所定量の画像データが記憶されたことを通知するような形態とすることも可能である。
【００７２】
また、前記した実施形態では、本発明の画像形成装置として、スキャナ機能、コピー機能、プリンタ機能およびファクシミリ機能を有するデジタル複合機に適用した場合について説明したが、これに限定されず、例えば、前記機能のうちの少なくとも２つ以上の機能を有するデジタル複合機や、プリンタ機能のみを有するプリンタなどに適用することも可能である。
【００７３】
また、前記した実施形態の画像形成装置で実行される各種のプログラムは、画像形成装置に予めインストールされる以外にも、インストール可能な形式または実行可能な形式のファイルで、コンピュータで読取り可能な記憶媒体に記憶して提供しても良いし、インターネットなどのネットワーク経由で提供または配布するようにしても良い。
【００７４】
その他、前記した実施形態における装置のハードウェア構成や処理手順などは、単なる例として記載したものであり、本実施形態は、それらにより限定されない。
【符号の説明】
【００７５】
１  複合機（画像形成装置）
２  コントローラ部
３  エンジン部（画像形成部）
２１  ＣＰＵ（Ｃ）（第１の制御部）
２２  メモリ
２３  ＮＢ
２４、２４Ａ、２４Ｂ  ＡＳＩＣ（Ｃ）（第１の画像処理部）
２５  ＨＤＤ
３３、３３Ｂ  プロッタ（画像形成手段）
Ｂ１、Ｂ２  バス
２４ａ  ＲＣ
２４ｂ  出力バッファ（第１のバッファ）
２４ｃ  ＲＤＭＡＣ
２４ｄ  ＥＰ
２４ｅ  バッファフル通知部（バッファフル通知部）
３１  ＣＰＵ（Ｅ）（第２の制御部）
３２、３２Ｂ  ＡＳＩＣ（Ｅ）（第２の画像処理部）
３２ａ  出力バッファ（第２のバッファ）
３２ｂ  ＲＤＭＡＣ
３２ｃ  ＥＰ
３２ｄ  リード制御部（リード制御部）
３２ｅ、３２ｆ  レジスタ
３２ｇ  コミュニケーションバッファ
【先行技術文献】
【特許文献】
【００７６】
【特許文献１】特開２０１０−６４３２９号公報
【図１】
0005750899.tif 000002
【図２】
0005750899.tif 000003
【図３】
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【図４】
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【図５】
0005750899.tif 000006
【図６】
0005750899.tif 000007
【図７】
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【図８】
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