(57)【特許請求の範囲】
【請求項１】
基板上に配置されたゲート電極と、
前記基板上に配置されたゲート絶縁膜と、
前記ゲート絶縁膜上に配置された酸化物半導体パターンと、
前記酸化物半導体パターン上に配置されたエッチング防止パターンと、
前記エッチング防止パターン上に配置された保護膜、および
前記保護膜および前記ゲート絶縁膜を貫いて形成されたコラムスペーサを含み、
前記コラムスペーサは、前記保護膜、前記エッチング防止パターン、前記酸化物半導体パターン、および前記ゲート絶縁膜と接する第１側壁と、前記保護膜および前記ゲート絶縁膜と接する第２側壁を含む薄膜トランジスタアレイ基板。
【請求項２】
前記保護膜、前記エッチング防止パターン、および前記酸化物半導体パターンは前記コラムスペーサの第１側壁に沿って垂直整列した請求項１に記載の薄膜トランジスタアレイ基板。
【請求項３】
前記コラムスペーサは上部領域および下部領域を含み、前記上部領域の前記第１側壁と前記第２側壁の間の距離は、前記下部領域の前記第１側壁と前記第２側壁の間の距離より大きい請求項１に記載の薄膜トランジスタアレイ基板
【請求項４】
前記コラムスペーサの上部領域は前記ゲート電極と重ならない請求項３に記載の薄膜トランジスタアレイ基板。
【請求項５】
前記コラムスペーサは前記保護膜の少なくとも一部と重なる請求項１に記載の薄膜トランジスタアレイ基板。
【請求項６】
前記コラムスペーサは透明有機物質または光遮断物質を含む請求項１に記載の薄膜トランジスタアレイ基板。
【請求項７】
前記エッチング防止パターンは前記ゲート電極と重なる第１領域と、前記ゲート電極と重ならない第２領域を含む請求項１に記載の薄膜トランジスタアレイ基板。
【請求項８】
前記エッチング防止パターンの前記第１領域は第１幅を有し、前記エッチング防止パターンの第２領域は第２幅を有するが、前記第１幅は前記第２幅より大きい請求項７に記載の薄膜トランジスタアレイ基板。
【請求項９】
ゲート電極を含む基板上にゲート絶縁膜、酸化物半導体層およびエッチング防止膜を順に積層し、
前記エッチング防止膜をパターニングして予備エッチング防止パターンを形成し、
前記酸化物半導体層および前記予備エッチング防止パターン上にソース電極と、前記ソース電極と分離されたドレーン電極を形成し、
前記予備エッチング防止パターン、前記ソース電極および前記ドレーン電極をマスクで前記酸化物半導体層をパターニングして予備酸化物半導体パターンを形成し、
前記予備エッチング防止パターンおよび前記ソース電極およびドレーン電極上に保護膜を形成し、
前記保護膜を貫く少なくとも一つのコラムスペーサ用開口部を形成することを含み、
前記少なくとも一つのコラムスペーサ用開口部を形成することは、前記予備エッチング防止パターンの一部と、前記予備エッチング防止パターンの一部と重なる領域の前記予備酸化物半導体パターンをエッチングし、エッチング防止パターンおよび酸化物半導体パターンを形成することを含む薄膜トランジスタアレイ基板の製造方法。
【請求項１０】
前記予備エッチング防止パターンは前記ゲート電極と重なる第１領域と、前記ゲート電極と重ならない第２領域を含み、
前記エッチング防止パターンを形成することは、前記第２領域の前記予備エッチング防止パターンの少なくとも一部と重なる領域の保護膜と、前記予備エッチング防止パターンの少なくとも一部を同時または順にエッチングすることを含む請求項９に記載の薄膜トランジスタアレイ基板の製造方法。
【請求項１１】
前記少なくとも一つのコラムスペーサ用開口部は第１幅を有する上部領域と前記第１幅より狭い第２幅を有する下部領域を含み、
前記エッチング防止パターンを形成することは、前記下部領域の一側壁が前記予備酸化物半導体パターンに垂直整列するように前記ゲート絶縁膜をエッチングすることを含む請求項１０に記載の薄膜トランジスタアレイ基板の製造方法。
【請求項１２】
前記酸化物半導体パターンを形成することは、
前記エッチング防止パターンを形成した後、前記保護膜上に導電膜を形成し、
前記導電膜を一部エッチングして画素電極および前記酸化物半導体パターンを形成することをさらに含む請求項１１に記載の薄膜トランジスタアレイ基板の製造方法。
【発明の詳細な説明】
【技術分野】
【０００１】
本発明は、薄膜トランジスタアレイ基板およびこれの製造方法に関するものであって、より詳細には酸化物半導体パターンの劣化による素子の劣化を減少させる薄膜トランジスタアレイ基板およびそれの製造方法に関するものである。
【背景技術】
【０００２】
液晶表示装置（Ｌｉｑｕｉｄ  Ｃｒｙｓｔａｌ  Ｄｉｓｐｌａｙ：ＬＣＤ）は、現在最も広く使用されているフラットパネル表示装置（Ｆｌａｔ  Ｐａｎｅｌ  Ｄｉｓｐｌａｙ：ＦＰＤ）のうち一つであって、電極が形成された２枚の基板とその間に挿入されている液晶層とからなり、電極に電圧を印加し、液晶層の液晶分子を再配列させることによって透過する光の量を調節して映像を表示する装置である。
【０００３】
一般的に、液晶表示装置は各画素をスイッチングするための薄膜トランジスタを含む。薄膜トランジスタはスイッチング信号の印加を受けるゲート電極と、データ電圧が印加されるソース電極と、データ電圧を出力するドレーン電極を三端子とし、スイッチング素子を成す。このような薄膜トランジスタはゲート電極とソース電極およびドレーン電極の間に形成されたアクティブ層を含む。このとき、薄膜トランジスタに含まれるアクティブ層は非晶質シリコン層が主に使用されている。最近では表示装置が大型化されることにつれ高性能の素子が必要とされ、酸化物半導体が大きく注目されている。
【発明の概要】
【発明が解決しようとする課題】
【０００４】
酸化物半導体を利用して薄膜トランジスタを製作する場合、エッチング工程と蒸着過程中に酸化物半導体層の劣化が生じる問題があった。このため、酸化物半導体層の劣化による素子の劣化を減少させる構造と方法が必要になった。
【０００５】
本発明が解決しようとする課題は、酸化物半導体パターンの劣化による素子の劣化を減少させる薄膜トランジスタアレイ基板を提供することにある。
【０００６】
本発明が解決しようとする他の課題は、酸化物半導体パターンの劣化による素子の劣化を減少させる薄膜トランジスタアレイ基板の製造方法を提供することにある。
【０００７】
本発明が解決しようとする課題は、以上で言及した課題に制限されず、言及されていないまた他の課題は次の記載から当業者に明確に理解できるであろう。
【課題を解決するための手段】
【０００８】
前記課題を解決するための本発明の一実施形態による薄膜トランジスタアレイ基板は、基板上に配置されたゲート電極と、前記基板上に配置されたゲート絶縁膜と、前記ゲート絶縁膜上に配置された酸化物半導体パターンと、前記酸化物半導体パターン上に配置されたエッチング防止パターン、および前記エッチング防止パターン上に配置されたソース電極およびドレーン電極を含み、前記酸化物半導体パターンはエッジ部を含み、前記エッジ部は導電性領域および非導電性領域を含む。
【０００９】
前記課題を解決するための本発明の他の実施形態による薄膜トランジスタアレイ基板は、基板上に配置されたゲート電極と、前記基板上に配置されたゲート絶縁膜と、前記ゲート絶縁膜上に配置された酸化物半導体パターンと、前記酸化物半導体パターン上に配置されたエッチング防止パターンと、前記エッチング防止パターン上に配置された保護膜、および前記保護膜および前記ゲート絶縁膜を貫いて形成されたコラムスペーサを含み、前記コラムスペーサは、前記保護膜、前記エッチング防止パターン、前記酸化物半導体パターン、および前記ゲート絶縁膜と接する第１側壁と、前記保護膜および前記ゲート絶縁膜と接する第２側壁を含む。
【００１０】
前記他の課題を解決するための本発明のいくつかの実施形態による薄膜トランジスタアレイ基板の製造方法は、ゲート電極を含む基板上にゲート絶縁膜、酸化物半導体層およびエッチング防止膜を順に積層し、前記エッチング防止膜をパターニングして予備エッチング防止パターンを形成し、前記酸化物半導体層および前記予備エッチング防止パターン上にソース電極と、前記ソース電極と分離されたドレーン電極を形成し、前記予備エッチング防止パターン、前記ソース電極および前記ドレーン電極をマスクで前記酸化物半導体層をパターニングして予備酸化物半導体パターンを形成し、前記予備エッチング防止パターンおよび前記ソース電極およびドレーン電極上に保護膜を形成し、前記保護膜を貫く少なくとも一つのコラムスペーサ用開口部を形成することを含み、前記少なくとも一つのコラムスペーサ用開口部を形成することは、前記予備エッチング防止パターンの一部と、前記予備エッチング防止パターンの一部と重なる領域の前記予備酸化物半導体パターンをエッチングし、エッチング防止パターンおよび酸化物半導体パターンを形成することを含む。
【００１１】
その他実施形態の具体的な内容は詳細な説明および図面に含まれている。
【図面の簡単な説明】
【００１２】
【図１Ａ】本発明の一実施形態による薄膜トランジスタアレイ基板の配置図である。
【図１Ｂ】図１Ａに示すＸ部分を拡大した拡大図である。
【図２Ａ】図１Ｂに示す薄膜トランジスタアレイ基板をＡ−Ａ’線およびＢ−Ｂ’線に沿って切断した断面図である。
【図２Ｂ】また他の実施形態で図２ＡのＹ部分を拡大した拡大図である。
【図３】図１Ｂに示す薄膜トランジスタアレイ基板をＣ−Ｃ’線に沿って切断した断面図である。
【図４】本発明の一実施形態による薄膜トランジスタアレイ基板の製造方法を順次に示す工程断面図である。
【図５】本発明の一実施形態による薄膜トランジスタアレイ基板の製造方法を順次に示す工程断面図である。
【図６】本発明の一実施形態による薄膜トランジスタアレイ基板の製造方法を順次に示す工程断面図である。
【図７】本発明の一実施形態による薄膜トランジスタアレイ基板の製造方法を順次に示す工程断面図である。
【図８】本発明の他の実施形態による薄膜トランジスタアレイ基板の断面図である。
【図９Ａ】本発明のまた他の実施形態による薄膜トランジスタアレイ基板の配置図である。
【図９Ｂ】図９に示すＡ−Ａ’およびＢ−Ｂ’に沿って切断した断面図である。
【図１０Ａ】本発明のまた他の実施形態による薄膜トランジスタアレイ基板の配置図である。
【図１０Ｂ】図１０Ａに示すＹ領域を拡大した拡大図である。
【図１１】本発明のまた他の実施形態による薄膜トランジスタアレイ基板の配置図である。
【図１２Ａ】本発明のまた他の実施形態による薄膜トランジスタアレイ基板の断面図である。
【図１２Ｂ】図１２Ａに示すＺ領域を拡大した拡大図である。
【図１２Ｃ】図１２Ａに示すＣ−Ｃ’線に沿って切断した断面図である。
【発明を実施するための形態】
【００１３】
本発明の利点および特徴、並びにそれらを達成する方法は、添付する図面とともに、後述する実施形態を参照することによって明確になる。しかし、本発明の目的は、以下に開示される実施形態に限定されず、異なる多様な実施形態によっても達成可能である。したがって、以下の実施形態は、単に、本発明の開示を十全たるものとし、当業者に本発明の範囲を認識させるために提供するものである。本発明の範囲は、あくまで請求項に記載された発明によってのみ規定される。なお、図面において、層、領域のサイズ、およびこれらの相対的なサイズは、説明の明瞭化のために誇張されている場合がある。
【００１４】
一つの素子（ｅｌｅｍｅｎｔｓ）または層が、異なる素子または層の「上（ｏｎ）」にあると指称される場合は、他の素子または層の真上にある場合だけでなく、その中間に他の層または他の素子が介在する場合も含む。これに対して、一つの素子が他の素子の「直接上（ｄｉｒｅｃｔｌｙ  ｏｎ）」、または「真上」にあると指称される場合は、その中間に他の素子または層が介在しない場合を示す。「および／または」という指称は、言及された各アイテムおよび一つ以上の全てのアイテムの組合せを含む。
【００１５】
空間的に相対的な位置を示す用語である「下（ｂｅｌｏｗ）」、「下（ｂｅｎｅａｔｈ）」、「下部（ｌｏｗｅｒ）」、「上（ａｂｏｖｅ）」、または「上部（ｕｐｐｅｒ）」などの用語は、図面に示されているように、一つの素子または構成要素と異なる素子または構成要素との相関関係を容易に記述するために使用されてもよい。空間的に相対的な位置を示す用語は、図示されている方向に加えて、使用時または動作時において当該素子が取り得る他の方向を含む用語として理解される。なお、明細書全体にかけて同一参照符号は同一構成要素を指すものとする。
【００１６】
以下、添付された図１Ａ〜図３を参照して本発明の一実施形態による薄膜トランジスタアレイ基板について詳細に説明する。図１Ａは、発明の一実施形態による薄膜トランジスタアレイ基板の配置図である。図１Ｂは、図１Ａに示すＸ部分を拡大した拡大図である。図２Ａは、図１Ｂに示す薄膜トランジスタアレイ基板をＡ−Ａ’線およびＢ−Ｂ’線に沿って切断した断面図である。図２Ｂは、また他の実施形態で図２ＡのＹ部分を拡大した拡大図である。図３は、図１Ｂに示す薄膜トランジスタアレイ基板をＣ−Ｃ’線に沿って切断した断面図である。
【００１７】
図１Ａ〜図３を参照すると、絶縁基板１０の上にゲート信号を伝達するゲート配線（２２、２４）が形成されている。絶縁基板１０は例えば、ソーダ石灰ガラスまたはホウケイ酸塩ガラスまたはプラスチックのようなガラスを含んでもよい。ゲート配線（２２、２４）は図１Ａ中において横方向に延長されているゲート線２２と、ゲート線２２に接続して突起形態で形成された薄膜トランジスタのゲート電極２４を含んでもよい。このとき、ゲート電極２４はゲート電極２４を貫いて形成されたゲート電極開口部２６を含んでもよく、ゲート電極開口部２６内にコラムスペーサ９４が配置されてもよい。これについての詳細な説明は後述する。
【００１８】
絶縁基板１０上にはストレージ電圧を伝達するストレージ配線（２８、２９）が形成されてもよい。ストレージ配線（２８、２９）は画素領域を横切ってゲート線２２と実質的に平行になるように形成されたストレージ線２８と、ストレージ線２８から分地してデータ線６２と平行になるように延長されたストレージ電極２９を含んでもよい。
【００１９】
ストレージ電極２９はデータ線６２に沿って形成された四角リング（ｒｉｎｇ）形態で形成されてもよい。すなわち、ストレージ電極２９の中心部には開口領域が形成されてデータ線６２が位置し、ストレージ電極２９のリングの部分は画素電極８０と少なくとも一部が重なってもよい。ストレージ電極２９は画素電極８０と重なって画素の電荷保存能力を向上させるストレージキャパシタ（ｓｔｏｒａｇｅ  ｃａｐａｃｉｔｏｒ）を形成することができる。また、ストレージ電極２９は画素電極８０とデータ線６２の間のカップリングを防止できる遮断電極の役割を果たす。
【００２０】
図面に図示するストレージ電極２９およびストレージ線２８の形状および配置は一つの例示に過ぎず、多様な形態で変形して形成してもよい。さらに、画素電極８０とゲート線２２の重複により発生するストレージキャパシタンス（ｓｔｏｒａｇｅ  ｃａｐａｃｉｔａｎｃｅ）が充分な場合、ストレージ電極２９およびストレージ線２８は形成されない場合もある。
【００２１】
絶縁基板１０およびゲート配線（２２、２４）の上にはゲート絶縁膜３０が形成される。例えば、ゲート絶縁膜３０は酸化ケイ素（ＳｉＯｘ）、窒化ケイ素（ＳｉＮｘ）または酸窒化ケイ素（ＳｉＯＮ）などで形成されてもよいが、本発明ではこれに限定されない。
【００２２】
ゲート絶縁膜３０の上には酸化物半導体パターン４２が形成される。酸化物半導体パターン４２は薄膜トランジスタのチャネル領域を形成することができる。チャネル領域はゲート電極と重なっている酸化物半導体パターン４２により形成されることができる。このような、酸化物半導体パターン４２は後述するデータ線６２およびエッチング防止パターン５２と重なって形成されてもよい。
【００２３】
より具体的には、図２Ａに図示するように、エッチング防止パターン５２の一側壁は保護膜７０および酸化物半導体パターン４２の一側壁と垂直に整列されることができる。言い換えれば、後述するコラムスペーサ（９２、９４）の一側壁に沿って保護膜７０、エッチング防止パターン５２、および酸化物半導体パターン４２の側壁が垂直に整列されて形成されることができ、これについての詳細な説明は後述する。
【００２４】
さらに、図２Ｂに図示するように、酸化物半導体パターン４２の一部がエッチング防止パターン５２より内側に形成されてもよい。言い換えれば、酸化物半導体パターン４２の一側壁がエッチング防止パターン５２の一側壁より一定の距離（Ｄ）だけ内側に形成されてもよい。
【００２５】
言い換えれば、エッチング防止パターン５２の一側壁は酸化物半導体パターン４２の一側壁より一定の距離（Ｄ）だけ突出して形成されてもよい。図面ではエッチング防止パターン５２の突出した領域の下部が保護膜７０で埋もれた場合を図示しているが、いくつかの他の実施形態で前記突出した領域の下部に空いた空間が形成される場合もある。これは、酸化物半導体パターン４２を、湿式エッチングを利用して形成する場合、エッチング防止パターン５２の下部にアンダーカット（ｕｎｄｅｒ−ｃｕｔ）が生じ得るからである。
【００２６】
酸化物半導体パターン４２は例えば、ＡｘＢｘＯｘまたはＡｘＢｘＣｘＯｘで表現される化学式を有する化合物を含む。ＡはＺｎまたはＣｄ、ＢはＧａ、ＳｎまたはＩｎ、ＣはＺｎ、Ｃｄ、Ｇａ、Ｉｎ、ＴａまたはＨｆを含む。ｘは０ではなく、Ａ、Ｂ、およびＣは互いに異なる。また他の実施形態によれば、ＩｎＺｎＯ、ＩｎＧａＯ、ＩｎＳｎＯ、ＺｎＳｎＯ、ＧａＳｎＯ、ＧａＺｎＯ、ＧａＺｎＳｎＯ、ＧａＩｎＺｎＯ、ＨｆＩｎＺｎＯ、ＴａＩｎＳｎＯおよびＺｎＯからなる群から選択されたいずれか一つの物質またはこれらの組合せを含んでもよい。このような酸化物半導体は水素化非晶質ケイ素に比べ、電荷の実効移動度（ｅｆｆｅｃｔｉｖｅ  ｍｏｂｉｌｉｔｙ）が２から１００倍ほど優れた半導体特性を有している。酸化物半導体パターン４２は非晶相（ａｍｏｒｐｈｏｕｓ  ｐｈａｓｅ）を有するかまたは結晶相（ｃｒｙｓｔａｌｌｉｎｅ  ｐｈａｓｅ）、または非晶質と結晶質が混合相（ｍｉｘｅｄ  ｐｈａｓｅ）を有するものでもよい。
【００２７】
図１Ｂ、図２Ａ及び図３を参照すると、酸化物半導体パターン４２はソース電極６５およびドレーン電極６６の間に位置するエッジ部（４２Ｅｃ、４２Ｅｎ）を含み、エッジ部（４２Ｅｃ、４２Ｅｎ）は少なくとも一つの導電性領域４２Ｅｃおよび少なくとも一つの非導電性領域４２Ｅｎを含む。ここで、エッジ部（４２Ｅｃ、４２Ｅｎ）は酸化物半導体パターン４２の側壁に沿って形成された領域のうちソース電極６５およびドレーン電極６６の間に位置する領域を意味する。例えば、図１Ｂに図示するように、酸化物半導体パターン４２のエッジ部（４２Ｅｃ、４２Ｅｎ）は、酸化物半導体パターン４２の縁から、酸化物半導体パターン４２の形状に沿って定義された仮想のエッジ線ＥＬまでの領域で定義され得る。
【００２８】
前述したように、酸化物半導体パターン４２のエッジ部は少なくとも一つの導電性領域４２Ｅｃと少なくとも一つの非導電性領域４２Ｅｎを含む。前述したように、エッジ部に沿って、言い換えれば、仮想のエッジ線ＥＬに沿って、ソース電極６５からドレーン電極６６に移動すると、エッジ部はソース電極６５に隣接した導電性領域４２Ｅｃ、非導電性領域４２Ｅｎ、およびドレーン電極６６に隣接した導電性領域４２Ｅｃを順に経ることができる。これはソース電極６５およびドレーン電極６６を基準にエッジ部の上部と下部いずれの方に移動しても同一である。つまり、図１Ｂにおいて、Ａ−Ａ’線を中心とすると、Ａ−Ａ’線の上側でも、下側においても、エッジ部はソース電極６５に隣接した導電性領域４２Ｅｃ、非導電性領域４２Ｅｎ、およびドレーン電極６６に隣接した導電性領域４２Ｅｃを順に経る。
【００２９】
また他の観点から、図１Ｂおよび図３に図示するように、ソース電極６５およびドレーン電極６６と、コラムスペーサ（９２、９４）の間の第３領域（ＩＩＩ）で酸化物半導体パターン４２は導電性領域４２Ｅｃのエッジ部を含んでもよく、コラムスペーサ（９２、９４）と隣接する第４領域（ＩＶ）で酸化物半導体パターン４２は非導電性領域４２Ｅｎのエッジ部を含んでもよい。つまり、図３において、エッジ部はソース電極６５に隣接した導電性領域４２Ｅｃ、非導電性領域４２Ｅｎ、さらに、コラムスペーサ用開口部９５を介して非導電性領域４２Ｅｎ、およびドレーン電極６６に隣接した導電性領域４２Ｅｃを順に経る。
【００３０】
後述する予備酸化物半導体パターン（図５の４２ａを参照）のエッジ部は、例えば保護膜（図６の７０参照）の形成過程中に生じた損傷により導電性を有することができる。
【００３１】
しかし、図１Ａおよび図１Ｂに図示するように、コラムスペーサ用開口部（９３、９５）内の斜線領域は予備エッチング防止パターン（図５の５２ａを参照）および予備酸化物半導体パターン４２ａのうちコラムスペーサ用開口部（９３、９５）と重なる領域であり、導電性を有する予備酸化物半導体パターン４２ａのエッジ部のうち一部が前記斜線領域と重なる。言い換えれば、前記斜線領域はコラムスペーサ用開口部（９３、９５）の形成過程で除去される。これによって、コラムスペーサ（９２、９４）と隣接した第４領域（ＩＶ）の酸化物半導体パターン４２は非導電性のエッジ部４２Ｅｎを有することができる。つまり、除去される前の斜線領域は、導電性のエッジ部４２Ｅｃを有する。あるいは、除去される前の斜線領域は、導電性のエッジ部４２Ｅｃ及び非導電性のエッジ部４２Ｅｎの一部を有する。しかし、コラムスペーサ用開口部（９３、９５）の形成により斜線領域が除去されることにより、導電性のエッジ部４２Ｅｃが除去され、あるいは、導電性のエッジ部４２Ｅｃ及び非導電性のエッジ部４２Ｅｎの一部が除去される。そのため、図３及び上記に示すように、コラムスペーサ（９２、９４）と隣接した第４領域（ＩＶ）の酸化物半導体パターン４２は非導電性のエッジ部４２Ｅｎを有することとなる。
【００３２】
要するに、酸化物半導体パターン４２のエッジ部のうち少なくとも一部、例えばコラムスペーサ（９２、９４）と接しない領域の少なくとも一部は導電性領域４２Ｅｃを有することができる。逆に、酸化物半導体パターン４２のエッジ部のうちコラムスペーサ（９２、９４）と接するか、または隣接する領域の少なくとも一部は非導電性領域４２Ｅｎを有することができる。
【００３３】
このように、酸化物半導体パターン４２のエッジ部のうち少なくとも一部が非導電性領域４２Ｅｎを有するため、酸化物半導体パターン４２のエッジ部のうち残りの領域が導電性領域４２Ｅｃであっても、酸化物半導体パターン４２のエッジ部に沿ってソース電極６５とドレーン電極６６が電気的に接続することを防止することができる。つまり、非導電性領域４２Ｅｎによって、導電性領域４２Ｅｃどうしが断線され、ソース電極６５とドレーン電極６６との電気的接続を防止する。
【００３４】
酸化物半導体パターン４２上にはエッチング防止パターン５２が形成される。図３に図示するように、絶縁基板１０はエッチング防止パターン５２がゲート電極２４と重なる第１領域（Ｉ）と、エッチング防止パターン５２がゲート電極２４と重ならない第２領域（ＩＩ）を含む。
【００３５】
このとき、第２領域（ＩＩ）は一つ以上が形成されてもよく、第２領域（ＩＩ）のうち少なくとも一つはゲート電極開口部２６内部に形成されてもよい。図１Ｂに図示するように、ゲートライン２２から延長されたゲート電極２４の終端から突出したエッチング防止パターン５２の一部と、ゲート電極開口部２６の内部へ延長され、ゲート電極２４を貫いて形成されたエッチング防止パターン５２の一部が第２領域（ＩＩ）に該当し得る。
【００３６】
さらに、エッチング防止パターン５２は第１幅（Ｗ１）と、第１幅（Ｗ１）より小さい第２幅（Ｗ２）を有することができ、例えばＴ字形状で形成されてもよい。より具体的には、ゲート電極開口部２６の内部に配置された第２領域（ＩＩ）のエッチング防止パターン５２は第２幅（Ｗ２）を有し、ゲート電極開口部２６の外部に配置されたエッチング防止パターン５２は第１幅（Ｗ１）を有することができる。
【００３７】
図２Ａにおいて、Ｂ−Ｂ’断面に図示するように、第２領域（ＩＩ）のエッチング防止パターン５２の側壁のうち少なくとも一部は酸化物半導体パターン４２の側壁と垂直に整列されることができる。先立って説明したように、図１Ｂに図示する斜線領域は、コラムスペーサ用開口部（９３、９５）形成のためのエッチング工程を行うことにより除去される予備エッチング防止パターン５２ａおよび予備酸化物半導体パターン４２ａの一部領域を意味する。すなわち、図５の、Ｂ−Ｂ’断面に示すように、コラムスペーサ用開口部（９３、９５）で定義された領域と重なる予備エッチング防止パターン５２ａおよび予備酸化物半導体パターン４２ａの一部がエッチング工程によって除去されることによって、該当領域のエッチング防止パターン５２の側壁と酸化物半導体パターン４２の側壁は垂直に整列されることができる。
【００３８】
いくつかの他の実施形態では、図２Ｂに図示するように、第１領域（Ｉ）のエッチング防止パターン５２の側壁のうち一部が酸化物半導体パターン４２の側壁より突出して形成される場合がある。後述する酸化物半導体層のエッチング工程により、予備エッチング防止パターン５２ａの一側壁が予備酸化物半導体パターン４２ａの一側壁より一定の距離（Ｄ）だけ突出して形成され得る。しかし、第１領域（Ｉ）のエッチング防止パターン５２は第２領域（ＩＩ）と異なってコラムスペーサ用開口部（９３、９５）と重なる領域が存在しない場合もある。したがって、前記酸化物半導体層のエッチング工程が行われた後にも、第１領域（Ｉ）のエッチング防止パターン５２の側壁は酸化物半導体パターン４２の側壁より突出した状態で維持することができる。
【００３９】
一方、エッチング防止パターン５２はＳｉＯｘおよびＳｉＮｘからなる群から選択されたいずれか一つの物質を含んでもよい。
【００４０】
酸化物半導体パターン４２は薄膜トランジスタのチャネル領域を除いてはデータ配線６２、６５、６６と実質的に同一な形状でパターニングすることができる。これは酸化物半導体パターン４２とデータ配線６２、６５、６６を一つのエッチングマスクを利用してパターニングするからである。
【００４１】
ゲート絶縁膜３０、酸化物半導体パターン４２およびエッチング防止パターン５２上にはデータ配線６２、６５、６６が形成されてもよい。データ配線６２、６５、６６は縦方向に形成されてゲート線２２と交差して画素を定義するデータ線６２と、データ線６２から枝（ｂｒａｎｃｈ）形態で分枝して酸化物半導体パターン４２およびエッチング防止パターン５２の上部に延長されているソース電極６５と、ソース電極６５と分離しており、ゲート電極２４または薄膜トランジスタのチャネル領域を中心にソース電極６５と対向するように酸化物半導体パターン４２およびエッチング防止パターン５２の上部に形成されているドレーン電極６６を含んでもよい。
【００４２】
エッチング防止パターン５２はソース電極６５およびドレーン電極６６の間に少なくとも一部が露出されてもよい。エッチング防止パターン５２、ソース電極６５およびドレーン電極６６の下部には酸化物半導体パターン４２が配置されてもよい。
【００４３】
データ配線６２、６５、６６は酸化物半導体パターン４２と直接接触してオーミックコンタクト（Ｏｈｍｉｃ  ｃｏｎｔａｃｔ）を形成する物質で構成されてもよい。データ配線６２、６５、６６が酸化物半導体パターン４２を構成する物質より仕事関数（ｗｏｒｋ  ｆｕｎｃｔｉｏｎ）が小さい物質からなると、二つの層間にオーミックコンタクトが形成され得る。
【００４４】
データ配線６２、６５、６６およびエッチング防止パターン５２上には保護膜７０が形成されてもよい。例えば、保護膜７０は酸化ケイ素（ＳｉＯｘ）、窒化ケイ素（ＳｉＮｘ）または酸窒化ケイ素（ＳｉＯＮ）などで形成されてもよいが、これに限定されないはもちろんである。また、保護膜７０にはコンタクトホール７５とコラムスペーサ（９２、９４）が形成されてもよい。
【００４５】
コンタクトホール７５は保護膜７０を貫いて形成され、コンタクトホール７５を介してドレーン電極６６と画素電極８０が電気的に接続することができる。画素電極８０はＩＴＯ（Ｉｎｄｉｕｍ  Ｔｉｎ  Ｏｘｉｄｅ）またはＩＺＯ（Ｉｎｄｉｕｍ  Ｚｉｎｃ  Ｏｘｉｄｅ）などの透明導電体またはアルミニウムなどの反射性導電体で形成されてもよいが、これに限定されないはもちろんである。
【００４６】
コラムスペーサ（９２、９４）は保護膜７０およびゲート絶縁膜３０を貫いて形成される。図面に図示するように、コラムスペーサ（９２、９４）は第１および第２側壁を含んでもよい。例えば、図２ＡのＢ−Ｂ’断面において、コラムスペーサ（９２、９４）の左側の第１側壁は保護膜７０、エッチング防止パターン５２、酸化物半導体パターン４２およびゲート絶縁膜３０と接し、右側の第２側壁は保護膜７０およびゲート絶縁膜３０と接してもよい。このとき、保護膜７０、エッチング防止パターン５２、および酸化物半導体パターン４２それぞれの一側壁はコラムスペーサ（９２、９４）の一側壁に沿って垂直に整列され得る。
【００４７】
また、コラムスペーサ（９２、９４）は上部領域および下部領域を含んでもよい。コラムスペーサ（９２、９４）の上部領域は、コラムスペーサ（９２、９４）の下部領域より第１側壁と第２側壁の間の距離が大きいように形成されてもよい。より具体的には、図２ＡのＢ−Ｂ’断面において、コラムスペーサ（９２、９４）の上部領域の第１側壁は、保護膜７０、エッチング防止パターン５２、酸化物半導体パターン４２と接し、下部領域の第１側壁はゲート絶縁膜３０と接してもよい。また、コラムスペーサ（９２、９４）の上部領域の第２側壁は、保護膜７０と接し、下部領域の第２側壁はゲート絶縁膜３０と接してもよい。この場合、コラムスペーサ（９２、９４）の上部領域の方が下部領域よりも第１側壁と第２側壁の間の距離が大きくなっている。
さらに、コラムスペーサ（９２、９４）の上部領域、より具体的には、コラムスペーサ用開口部（９３、９５）の上部領域はゲート電極２４と重ならない場合もある。
【００４８】
図２Ａに図示するように、コラムスペーサ（９２、９４）は保護膜７０の一部と重なってもよい。より具体的には、第２領域上に形成された保護膜７０の少なくとも一部と重なってもよい。図１Ｂおよび図２Ａを参照すると、コラムスペーサ（９２、９４）は保護膜７０およびゲート絶縁膜３０内に形成されたコラムスペーサ用開口部（９３、９５）覆ってあふれるように保護膜７０の上部表面上に延長されてもよい。図１Ｂで図示するように、レイアウトの観点から見るとき、コラムスペーサ（９２、９４）は点線で表示されたコラムスペーサ用開口部（９３、９５）を含むように形成してもよい。したがって、コラムスペーサ（９２、９４）はコラムスペーサ用開口部（９３、９５）を定義する保護膜７０の一部と重なってもよい。
【００４９】
第２領域（ＩＩ）と同様に、コラムスペーサ（９２、９４）も一つ以上形成されてもよく、コラムスペーサ（９２、９４）のうち少なくとも一つはゲート電極開口部２６の内部に形成されてもよい。図１Ａおよび図１Ｂに図示するように、コラムスペーサ（９２、９４）はゲートライン２２から延長されたゲート電極２４の終端から突出したエッチング防止パターン５２の一部と接するコラムスペーサ９２と、ゲート電極開口部２６内部に延長されたエッチング防止パターン５２の一部と接するコラムスペーサ９４を含んでもよい。
【００５０】
さらに、コラムスペーサ（９２、９４）は透明有機物質または光遮断物質からなる。
【００５１】
データ電圧が印加された画素電極８０は薄膜トランジスタアレイ基板と対向する上部基板の共通電極と共に電磁場を生成することによって画素電極８０と共通電極の間の液晶層の液晶分子の配列を決定する。
【００５２】
以下、図１〜図７を参照して本発明の一実施形態による薄膜トランジスタアレイ基板の製造方法について詳細に説明する。図４〜図７は、本発明の一実施形態による薄膜トランジスタアレイ基板の製造方法を順次に示す工程断面図である。
【００５３】
先に、図１〜図４に図示するように、ゲート電極２４が形成された絶縁基板１０上にゲート絶縁膜３０、酸化物半導体層４０およびエッチング防止膜を順に積層し、エッチング防止膜をパターニングして予備エッチング防止パターン５２ａを形成する。図面に図示していないが、ゲート電極２４とゲート線２２、ストレージ線２８およびストレージ電極２９は同一マスク工程により共に形成することができる。
【００５４】
具体的には、絶縁基板１０は、例えばソーダ石灰ガラス（ｓｏｄａ  ｌｉｍｅ  ｇｌａｓｓ）またはホウケイ酸塩ガラスのようなガラスまたはプラスチックで組成されてもよい。しかし、これは一つの例示に過ぎず、これに限定されないはもちろんである。
【００５５】
ゲート配線（２２、２４）を形成するため、例えば、スパッタリング（ｓｐｕｔｔｅｒｉｎｇ）方法を利用して絶縁基板１０上にゲート配線用導電膜を形成することができる。例えば、絶縁基板１０として熱にぜい弱なソーダ石灰ガラスを使用する場合、低温スパッタリング方式を利用してもよい。
【００５６】
続いて、ゲート配線用導電膜を湿式エッチングまたは乾式エッチングを利用してパターニングしてゲート配線（２２、２４）を形成してもよい。湿式エッチングを利用する場合、例えば、燐酸、硝酸、酢酸などのエッチング液を使用してもよい。乾式エッチングを利用する場合、例えば、塩素系のエッチングガス、例えばＣｌ２、ＢＣｌ３などを使用してもよい。また、ゲート配線２２を形成するとき、ゲート電極２４がゲート電極２４を貫くゲート電極開口部２６を含むように形成してもよい。
【００５７】
続いて、絶縁基板１０とゲート配線（２２、２４）上に、例えばプラズマ強化化学気相蒸着（ｐｌａｓｍａ  ｅｎｈａｎｃｅｄ  ｃｈｅｍｉｃａｌ  ｖａｐｏｒ  ｄｅｐｏｓｉｔｉｏｎ、ＰＥＣＶＤ）、反応性スパッタリング（ｒｅａｃｔｉｖｅ  ｓｐｕｔｔｅｒｉｎｇ）などを利用してゲート絶縁膜３０を形成してもよい。ゲート絶縁膜３０は絶縁基板１０の全面上に形成することができる。
【００５８】
続いて、ゲート絶縁膜３０上に例えば、スパッタリング法などを利用して酸化物半導体物質を全体的に形成して酸化物半導体層４０を形成してもよい。
続いて、酸化物半導体層４０上にエッチング防止膜を形成する。エッチング防止膜は例えば、化学気相蒸着（ｃｈｅｍｉｃａｌ  ｖａｐｏｒ  ｄｅｐｏｓｉｔｉｏｎ、ＣＶＤ）などの方法で酸化物半導体層４０の全面に形成されることができる。エッチング防止膜は例えば、シリコン酸化膜またはシリコン窒化膜であってもよいが、これに限定されない。また、エッチング防止膜を例えば、乾式エッチングなどの方法でパターニングして予備エッチング防止パターン５２ａを形成することができる。
【００５９】
続いて、図１Ａ〜図３および図５を参照して酸化物半導体層４０および予備エッチング防止パターン５２ａ上に互いに分離されたソース電極６５およびドレーン電極６６を形成し、予備エッチング防止パターン５２ａ、ソース電極６５、およびドレーン電極６６をマスクで酸化物半導体層（図４の４０を参照）をパターニングして予備酸化物半導体パターン４２ａを形成する。
【００６０】
具体的に、酸化物半導体層４０および予備エッチング防止パターン５２ａ上にデータ配線用導電層を形成し、データ配線用導電層と酸化物半導体層４０を例えば、湿式エッチング方法で同時または順次にエッチングしてデータ配線６２、６５、６６と予備酸化物半導体パターン４２ａを形成することができる。言い換えれば、予備エッチング防止パターン５２ａ、ソース電極、およびドレーン電極６６をマスクで酸化物半導体層４０をパターニングすることができる。
【００６１】
このとき、湿式エッチング方法を利用して酸化物半導体層４０をエッチングする場合、エッチング液によるアンダーカット（ｕｎｄｅｒ−ｃｕｔ）が生じ得る。これによって、図２Ｂに図示するように、酸化物半導体パターン４２の一部がエッチング防止パターン５２より内側に形成されることができる。言い換えれば、酸化物半導体パターン４２の一側壁がエッチング防止パターン５２の一側壁より一定の距離（Ｄ）だけ内側に形成されることができ、エッチング防止パターン５２の一側壁は酸化物半導体パターン４２の一側壁より一定の距離（Ｄ）だけ突出して形成されることができる。
【００６２】
ソース電極６５およびドレーン電極６６はゲート電極２４を中心に両側に分離して形成され、ソース電極６５およびドレーン電極６６が分離された領域にはエッチング防止パターン５２が露出され得る。
【００６３】
続いて、図１〜図３および図６を参照して予備エッチング防止パターン５２ａ、ソース電極６５、およびドレーン電極６６上に保護膜７０を形成し、第２領域（ＩＩ）の予備エッチング防止パターン（図５の５２ａを参照）の少なくとも一部をエッチングしてエッチング防止パターン５２を形成する。
【００６４】
より具体的には、保護膜７０は例えば、ＰＥＣＶＤまたは反応性スパッタリングなどを利用して形成してもよい。また、保護膜７０は例えば、シリコン酸化膜またはシリコン窒化膜であり得る。
【００６５】
このとき、予備酸化物半導体パターン４２ａのエッジ部、特に予備酸化物半導体パターン４２ａのうち保護膜７０と接する領域は、保護膜７０の蒸着工程のあいだプラズマガスなどに露出され得る。より具体的には、予備酸化物半導体パターン４２ａ上には予備エッチング防止パターン５２ａが配置され、予備酸化物半導体パターン４２ａの上面が前記プラズマガスなどに露出することから保護することができる。予備酸化物半導体パターン４２ａの下面はゲート絶縁膜３０により保護される。しかし、予備エッチング防止パターン４２ａおよびデータ配線６２、６５、６６などに整列して形成された予備酸化物半導体パターン４２ａの側壁は依然としてプラズマガスなどに露出され得る。これによって、予備酸化物半導体パターン４２ａのエッジ部、特に保護膜７０に露出された領域は、蒸着工程中に損傷されて導電性を有することができる。
【００６６】
続いて、保護膜７０上にコラムスペーサ用開口部（９３、９５）を形成するためのマスクパターン２００を形成し、前記マスクパターン２００をマスクで保護膜７０をパターニングすることができる。例えば、写真エッチング工程を利用してもよい。このとき、ドレーン電極６６の一部を露出させるコンタクトホール７５を共に形成してもよい。
【００６７】
前述したように、絶縁基板１０は予備エッチング防止パターン５２ａがゲート電極２４と重なる第１領域（Ｉ）と、予備エッチング防止パターン５２ａがゲート電極２４と重ならない第２領域（ＩＩ）を含んでもよい。
【００６８】
図６に図示するように、第２領域（ＩＩ）の予備エッチング防止パターン５２ａの少なくとも一部（図６中の点線部分）と重なる領域の保護膜７０と、前記予備エッチング防止パターン５２ａの少なくとも一部（図６中の点線部分）を同時または順にエッチングしてエッチング防止パターン５２を形成することができる。
【００６９】
このとき、第２領域（ＩＩ）の予備エッチング防止パターン５２ａの少なくとも一部（点線部分）は下部に重なる予備酸化物半導体パターン４２ａより先にエッチングされてもよい。より具体的には、保護膜７０上に形成されたマスクパターン２００を利用して保護膜７０をパターニングするとき、保護膜７０と類似のエッチング選択比を有する予備エッチング防止パターン５２ａの一部が共に除去される。例えば、予備エッチング防止パターン５２ａおよび保護膜７０これらいずれもシリコン酸化物であるとき、保護膜７０と予備エッチング防止パターン５２ａを同時に除去することができる。これとは異なり、予備エッチング防止パターン５２ａおよび保護膜７０が互いに異なる物質で形成された場合には、前記マスクパターン２００を利用して保護膜７０と予備エッチング防止パターン５２ａを順次に除去することができる。
【００７０】
ここで、保護膜７０上に形成されたマスクパターン２００は図１Ａ、図１Ｂ、図６に図示するように、コラムスペーサ用開口部９３が予備エッチング防止パターン５２ａおよび予備酸化物半導体パターン４２ａの一部と重なるように定義することができる。より具体的には、マスクパターン２００は導電性を有する予備酸化物半導体パターン４２ａのエッジ部のうち第２領域（ＩＩ）に該当する領域の少なくとも一部とコラムスペーサ用開口部９３が重なる領域が露出するように定義することができる。なお、第２領域（ＩＩ）は、エッチング防止パターン５２がゲート電極２４と重ならない領域である。したがって、マスクパターン２００によって露出された領域を除去してコラムスペーサ用開口部９３を形成することによって、酸化物半導体パターン４２のエッジ部のうち一部が非導電性を有する。したがって、酸化物半導体パターン４２のエッジ部に沿ってソース電極６５とドレーン電極６６が電気的に接続することを防止できる。
【００７１】
さらに、保護膜７０をパターニングするとき、ゲート絶縁膜３０を同時にまたは順次に除去することができる。図面に図示するように、エッチング防止パターン５２より突出した予備酸化物半導体パターン４２ａがエッチングマスクの役割を果たす。これによって、ゲート絶縁膜３０と接するコラムスペーサ用開口部（９３、９５）の下部領域の一側壁は予備酸化物半導体パターン４２ａの一側壁によって定義され得る。したがって、少なくとも一つのコラムスペーサ用開口部（９３、９５）は第１の幅を有する上部領域と、第１幅より狭い第２幅を有する下部領域を含んでもよい。コラムスペーサ用開口部（９３、９５）の下部領域の一側壁は予備酸化物半導体パターン４２ａに垂直に整列するようにゲート絶縁膜３０をエッチングすることができる。
【００７２】
このとき、予備酸化物半導体パターン４２ａは保護膜７０、予備エッチング防止パターン５２ａ、およびゲート絶縁膜３０と他のエッチング選択比を有するものであってもよい。これによって、予備酸化物半導体パターン４２ａがエッチング防止パターン５２より突出した状態を維持することができる。
【００７３】
続いて、図１〜図３および図７を参照して第２領域（ＩＩ）の予備エッチング防止パターン５２ａの少なくとも一部（図６の点線部分を参照）と重なる領域の予備酸化物半導体パターン４２ａをエッチングして酸化物半導体パターン４２を形成する。  
【００７４】
より具体的には、エッチング防止パターン５２を形成した後、保護膜７０上にデータ配線６２、６５、６６の一部と接続される画素電極用導電膜を形成することができる。このとき、画素電極用導電膜はＩＴＯ（Ｉｎｄｉｕｍ  Ｔｉｎ  Ｏｘｉｄｅ）またはＩＺＯ（Ｉｎｄｉｕｍ  Ｚｉｎｃ  Ｏｘｉｄｅ）などの透明導電体またはアルミニウムなどの反射性導電体でなされ得る。画素電極用導電膜はコンタクトホール７５を介してドレーン電極６６と接続することができる。
【００７５】
続いて、画素電極形成用マスクパターン（図示せず）を利用して画素電極用導電膜と、エッチング防止パターン５２から突出した領域の予備酸化物半導体パターン４２ａの一部をエッチングすることによって、画素電極８０および酸化物半導体パターン４２を形成することができる。このとき、画素電極８０および予備酸化物半導体パターン４２ａが例えば、類似のエッチング選択比を有する場合、画素電極用導電膜と予備酸化物半導体パターン４２ａが同時に除去され得る。または、画素電極８０および予備酸化物半導体パターン４２ａが互いに異なる選択比を有する場合、順次にこれらをエッチングすることもできる。
【００７６】
これによって、上部領域と下部領域が互いに異なるサイズの幅を有するコラムスペーサ用開口部（９３、９５）が形成されることができる。
【００７７】
要するに、少なくとも一つのコラムスペーサ用開口部（９３、９５）を形成することは、予備エッチング防止パターン５２ａの一部と、前記予備エッチング防止パターン５２ａの一部と重なる領域の予備酸化物半導体パターン４２ａをエッチングしてエッチング防止パターン５２および酸化物半導体パターン４２を形成することを含んでもよい。
【００７８】
再び図２Ａを参照して少なくとも一つのコラムスペーサ用開口部（９３、９５）を覆うように少なくとも一つのコラムスペーサ（９２、９４）を形成することができる。コラムスペーサ（９２、９４）は例えば、透明有機物質または光遮断物質であってもよい。
【００７９】
以上の実施形態ではゲート電極が酸化物半導体層の下に配置されたボトム  ゲート構造（ｂｏｔｔｏｍ  ｇａｔｅ  ｓｔｒｕｃｔｕｒｅ）について説明したが、本発明はこれに限定されず、ゲート電極が酸化物半導体層の上に配置されたトップゲート構造（ｔｏｐ  ｇａｔｅ  ｓｔｒｕｃｔｕｒｅ）でも適用することができる。
【００８０】
以下、図８を参照して本発明の他の実施形態による薄膜トランジスタアレイ基板２について詳細に説明する。図８は、本発明の他の実施形態による薄膜トランジスタアレイ基板の断面図である。本発明の他の実施形態による薄膜トランジスタアレイ基板２は保護膜（図２Ａの７０を参照）の代わりにカラーフィルタ（７１Ｒ、７１Ｇ）が形成されるＣＯＡ（ｃｏｌｏｒ  ｆｉｌｔｅｒ  ｏｎ  ａｒｒａｙ）構造を有するという点から前記一実施形態による薄膜トランジスタアレイ基板１と区別される。本発明の一実施形態による薄膜トランジスタアレイ基板１と実質的に同一構成要素については具体的な説明を省略する。
【００８１】
図８に図示するように、保護膜代りにカラーフィルタ（７１Ｒ、７１Ｇ）を形成するかまたは、有機膜を利用してもよい。このように、ゲート絶縁膜３０、エッチング防止パターン５２、ソース電極６５およびドレーン電極６６上にカラーフィルタ（７１Ｒ、７１Ｇ）や有機膜を形成しても酸化物半導体パターン４２のエッジ部に沿ってソース電極６５とドレーン電極６６が電気的に接続することを防止することができる。
【００８２】
以下、図９Ａおよび図９Ｂを参照して本発明のまた他の実施形態による薄膜トランジスタアレイ基板３について詳細に説明する。図９Ａは、本発明のまた他の実施形態による薄膜トランジスタアレイ基板の配置図である。図９Ｂは、図９Ａに示すＡ−Ａ’およびＢ−Ｂ’に沿って切断した断面図である。
【００８３】
本発明のまた他の実施形態による薄膜トランジスタアレイ基板３は、コラムスペーサ用開口部（９３、９７）をコラムスペーサではない絶縁膜７２により覆う点から上述した実施形態と区別される。以下ではこのような違いを中心に説明し、実質的に同一構成要素に対する具体的な説明は省略または簡略にする。また、コラムスペーサによっておおわれない点から図面符号９３および９７を「開口部」と称する。
【００８４】
より具体的には、図９Ａおよび図９Ｂに図示するように、酸化物半導体パターン４２とエッチング防止パターン５２の一側は開口部（９３、９７）に接して形成される。これは前述したように開口部（９３、９７）により定義された領域と、予備酸化物半導体パターンおよび予備エッチング防止パターンと、が重なるため、開口部（９３、９７）の形成によって前記重なる領域が除去されるからである。これによって、酸化物半導体パターン４２のエッジ部は導電性領域４２Ｅｃと非導電性領域４２Ｅｎを含む。エッジ部が導電性領域４２Ｅｃと非導電性領域４２Ｅｎを有することについては先立って説明したので、これについての重複される説明は省略する。
【００８５】
開口部（９３、９７）は絶縁物質層７２に覆われる。図面では保護膜７０と絶縁物質層７２を互いに異なる層で図示するが、これに限定されず、一つの層として形成される。ここで、一つの層とは、保護膜７０と絶縁物質層７２が互い同一物質で形成されたものを意味する。しかし、二つの層の物質が同一である場合のみを意味するのではなく、発明の目的に応じて多様に変形できるのはもちろんである。
【００８６】
以下、図１０Ａおよび図１０Ｂを参照して本発明のまた他の実施形態による薄膜トランジスタアレイ基板４について詳細に説明する。図１０Ａは、本発明のまた他の実施形態による薄膜トランジスタアレイ基板の配置図である。図１０Ｂは、図１０Ａに示すＹ領域を拡大した拡大図である。
【００８７】
本発明のまた他の実施形態による薄膜トランジスタアレイ基板４は、エッチング防止パターン５４が十字（＋）形状を有する点から本発明の一実施形態による薄膜トランジスタアレイ基板１と区別される。本発明のまた他の実施形態による薄膜トランジスタアレイ基板１と実質的に同一構成要素に対する具体的な説明は省略する。
【００８８】
図１０Ａおよび図１０Ｂを参照すると、第１領域（Ｉ）のエッチング防止パターン５４は第１幅（Ｗ１）を有し、第２領域（ＩＩ）のエッチング防止パターン５４は第２幅（Ｗ２）および第３幅（Ｗ３）を有するが、第１幅（Ｗ１）は第２幅（Ｗ２）および第３幅（Ｗ３）より大きい。第２幅（Ｗ２）および第３幅（Ｗ３）は同一であってもよく、異なっていてもよい。
【００８９】
より具体的には、第２領域（ＩＩ）のエッチング防止パターン５４のうち、ゲートライン２２から延長されたゲート電極２４の終端から突出した領域の第３幅（Ｗ３）を第１領域（Ｉ）のエッチング防止パターン５４の第１幅（Ｗ１）より小さく形成することによって、コラムスペーサ（９４、９６）が占める面積が相対的に減少する。したがって、コラムスペーサ（９４、９６）が光遮断物質から成る場合、開口率を向上できるという長所がある。
【００９０】
本発明のまた他の実施形態による薄膜トランジスタアレイ基板４の製造方法は、エッチング防止膜をパターニングして予備エッチング防止パターン５２ａを形成するときを除けば、本発明の一実施形態による薄膜トランジスタアレイ基板１の製造方法と実質的に同一である。すなわち、コラムスペーサ用開口部（９７、９５）により定義された領域と予備酸化物半導体パターンおよび予備エッチング防止パターンが重なって、コラムスペーサ用開口部（９７、９５）形成によって前記重なる領域が除去される。これによって、酸化物半導体パターン４４のエッジ部は導電性領域（４４Ｅｃ）と非導電性領域（４４Ｅｎ）を含むことができる。また、エッチング防止膜をパターニングする工程においても、十字形状を反映した予備エッチング防止パターン５２ａ用マスクパターンの形状でのみ差異があるだけである。
【００９１】
以下、図１１を参照して本発明のまた他の実施形態による薄膜トランジスタアレイ基板５について説明する。図１１は、本発明のまた他の実施形態による薄膜トランジスタアレイ基板５の配置図である。
【００９２】
本発明のまた他の実施形態による薄膜トランジスタアレイ基板５は、コラムスペーサ９２が一つのコラムスペーサ用開口部９３を覆う点から本発明の一実施形態による薄膜トランジスタアレイ基板１と区別される。言い換えれば、二つ以上のコラムスペーサ用開口部（９３、９７）のうち少なくとも一つはコラムスペーサ９２でない絶縁物質で埋もれる。すなわち、二つ以上のコラムスペーサ用開口部（９３、９７）のうちいずれか一つはコラムスペーサ９２で埋もれ、いずれか一つはコラムスペーサ９２ではない絶縁物質で覆われる。
【００９３】
より具体的には、本発明のまた他の実施形態による薄膜トランジスタアレイ基板５は、二つのコラムスペーサ用開口部（９３、９７）を形成するが、一つのコラムスペーサ用開口部９３がコラムスペーサ９２により覆われる場合もある。図面ではコラムスペーサ用開口部（９３、９７）が二つの場合を図示するが、コラムスペーサ用開口部（９３、９７）は二つ以上で形成されてもよく、コラムスペーサ９２は複数個のコラムスペーサ用開口部（９３、９７）のうち一部のみを覆うこともできる。ここで、コラムスペーサ９２が複数のコラムスペーサ用開口部（９３、９７）のうち「一部」を覆うことは、複数「個」の開口部のうち一部の「個」の開口部を覆うことを意味する。残りの開口部は上述した実施形態のように絶縁物質で覆ってもよい。
【００９４】
また、図面に図示するように、本発明のまた他の実施形態によるエッチング防止パターン５６は幅の変化なしに単一幅で形成されてもよい。すなわち、長方形形状で形成されてもよい。
【００９５】
以下、図１２Ａ〜図１２Ｃを参照して本発明のまた他の実施形態による薄膜トランジスタアレイ基板６について説明する。図１２Ａは、本発明のまた他の実施形態による薄膜トランジスタアレイ基板６の断面図である。図１２Ｂは、図１２Ａに示すＺ領域を拡大した拡大図である。図１２Ｃは、図１２Ａに示すＣ−Ｃ’線に沿って切断した断面図である。
【００９６】
本発明のまた他の薄膜トランジスタアレイ基板６はゲート電極２４に開口部を形成しない点から上述した実施形態と区別される。
【００９７】
図１２Ａ〜図１２Ｃを参照すると、本発明のまた他の実施形態による薄膜トランジスタアレイ基板６はゲート電極２４を含み、コラムスペーサ用開口部（９３、９５）はゲート電極２４内部に開口部を形成しない。このとき、コラムスペーサ用開口部（９３、９５）はエッチング防止パターン５２および酸化物半導体パターン４２の一側壁に接して形成される。
【００９８】
さらに、図１２Ｃに図示するように、コラムスペーサ用開口部９５はエッチング防止パターン５２および酸化物半導体パターン４２を貫いて形成されるが、ゲート電極２４を貫かない。図面ではコラムスペーサ用開口部９５がゲート絶縁膜３０も貫かないものと開示しているが、ゲート絶縁膜３０を貫くかどうかは工程方式に応じて変更してもよい。すなわち、いくつかの他の実施形態ではコラムスペーサ用開口部９５がゲート絶縁膜３０を貫いて形成されてもよい。
【００９９】
例えば、コラムスペーサ用開口部９５を形成するとき、スリットマスクなどを使用してコラムスペーサ用開口部９５に対応する領域のゲート絶縁膜３０の少なくとも一部が残存できるようにすることができる。これによって、ゲート絶縁膜３０の下部にゲート２４が配置され、ゲート２４が直接露出することを防止することができる。
【０１００】
上述した実施形態と同様に、本発明のまた他の実施形態による薄膜トランジスタアレイ基板６のコラムスペーサ用開口部（９３、９５）のうち少なくとも一つはコラムスペーサ９４ではない絶縁物質で覆われてもよい。もちろんコラムスペーサ用開口部（９３、９５）がいずれもコラムスペーサ９２で覆われるかまたは、絶縁物質で覆われれてもよいこととはもちろんである。
【０１０１】
以上添付された図面を参照して本発明の実施形態について説明したが、本発明が属する技術分野で通常の知識を有する者は、本発明が、その技術的思想や必須の特徴を変更しない範囲で他の具体的な形態で実施され得ることを理解することができる。したがって上記実施形態はすべての面で例示的なものであり、限定的でないものと理解しなければならない。
【図１Ａ】
0005746586.tif 000002
【図１Ｂ】
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【図２Ａ】
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【図２Ｂ】
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【図３】
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【図４】
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【図５】
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【図６】
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【図７】
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【図８】
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【図９Ａ】
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【図９Ｂ】
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【図１０Ａ】
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【図１０Ｂ】
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【図１１】
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【図１２Ａ】
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【図１２Ｂ】
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【図１２Ｃ】
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