(57)【特許請求の範囲】
【請求項１】
半導体装置において、
非導電性基板と、
前記非導電性基板の表面側に設けられた半導体素子搭載部と、
前記半導体素子搭載部の周囲に配置された内部端子と、
前記非導電性基板の裏面側に設けられた外部端子と、
前記半導体素子搭載部上に載置された半導体素子と、
前記内部端子と前記半導体素子とを電気的に接続する導電部と、
前記半導体素子搭載部、前記内部端子、前記半導体素子および前記導電部を封止する封止樹脂部とを備え、
前記非導電性基板は、前記非導電性基板を貫通して形成されたビアを有し、
前記非導電性基板の前記ビア内または前記ビアの側面に、前記内部端子と前記外部端子とを電気的に接続する導体が設けられ、
前記半導体素子搭載部の裏面に補強層が設けられ、かつ前記外部端子の各々は、平面から見て少なくとも１つの円周上に配置され、
前記封止樹脂部の角部に、前記外部端子の各々より面積が広く、かつ前記半導体素子搭載部側に向けて徐々に先細となる追加の外部端子が配置されていることを特徴とする半導体装置。
【請求項２】
前記外部端子の各々は、平面から見て互いに同心円の関係にある複数の円周の上に千鳥状に配置されていることを特徴とする請求項１記載の半導体装置。
【請求項３】
前記補強層は、平面から見て円形状からなることを特徴とする請求項１または２記載の半導体装置。
【請求項４】
前記補強層は、導電めっき層からなることを特徴とする請求項３記載の半導体装置。
【請求項５】
前記封止樹脂部は、直方体形状を有していることを特徴とする請求項１乃至４のいずれか一項記載の半導体装置。
【請求項６】
前記封止樹脂部は、円柱形状を有していることを特徴とする請求項１乃至４のいずれか一項記載の半導体装置。
【請求項７】
前記封止樹脂部は、截頭円錐形状、ドーム形状または截頭多角錐形状からなることを特徴とする請求項１乃至４のいずれか一項記載の半導体装置。
【請求項８】
前記内部端子の少なくとも１つの内部端子の上面に、他の半導体装置の裏面に接続可能な外部突出端子が形成されていることを特徴とする請求項１乃至７のいずれか一項記載の半導体装置。
【請求項９】
半導体装置の製造方法において、
非導電性基板と、前記非導電性基板の表面側に設けられた半導体素子搭載部と、前記半導体素子搭載部の周囲に配置された内部端子と、前記非導電性基板の裏面側に設けられた外部端子と、前記非導電性基板を貫通して形成されたビアと、前記非導電性基板の前記ビア内に充填または前記ビアの側面に設けられ、前記内部端子と前記外部端子とを電気的に接続する導体とを有する配線基板を準備する工程と、
前記配線基板の前記半導体素子搭載部上に、半導体素子を載置する工程と、
前記半導体素子と前記配線基板の前記内部端子とを、導電部により接続する工程と、
前記配線基板の前記半導体素子搭載部、前記配線基板の前記内部端子、前記半導体素子、および前記導電部を封止樹脂部により封止する工程とを備え、
前記配線基板の前記半導体素子搭載部の裏面に補強層が設けられ、かつ前記配線基板の前記外部端子の各々は、平面から見て互いに同心円の関係にある複数の円周の上に千鳥状に配置され、
前記封止樹脂部の角部に、前記外部端子の各々より面積が広く、かつ前記半導体素子搭載部側に向けて徐々に先細となる追加の外部端子が配置されていることを特徴とする半導体装置の製造方法。
【発明の詳細な説明】
【技術分野】
【０００１】
本発明は、半導体装置および半導体装置の製造方法に関する。
【背景技術】
【０００２】
近年、半導体装置は、高集積化や小型化技術の進歩、電子機器の高性能化と軽薄短小化の傾向から、ＬＳＩのＡＳＩＣに代表されるように、ますます高集積化、高機能化が進んできている。このように高集積化、高機能化された半導体装置においては、外部端子（ピン）の総和の増加や更なる多端子（ピン）化が要請されている。
【０００３】
このような半導体装置としては、リードフレームにＩＣチップ、ＬＳＩチップなどの半導体チップが搭載され、絶縁性樹脂で封止された構造をもつ半導体パッケージがある。このような半導体装置としては、ＱＦＮ（Quad Flat Non-leaded package）やＳＯＮ（Small Outline Non-leaded Package）などの薄型で実装面積の小さいタイプのものが知られている。また半田ボールをパッケージの外部端子として備えた表面実装型パッケージであるＢＧＡ（Ball Grid Array）と呼ばれる樹脂封止型の半導体装置が量産されている。さらに、ＢＧＡの半田ボールに代えてマトリックス状の平面電極からなる外部端子が設けられた表面実装型パッケージとして、ＬＧＡ（Land Grid Array）と呼ばれる半導体装置が存在する。
【０００４】
特許文献１には、ＢＧＡタイプの半導体装置において、絶縁基板の形状を円形形状にすることにより、コーナ部における応力の集中をなくし、中心から距離に応じた応力が均一に加わるようにした半導体パッケージが開示されている。
【先行技術文献】
【特許文献】
【０００５】
【特許文献１】特開２００１−２３０３３８号公報
【発明の概要】
【発明が解決しようとする課題】
【０００６】
近年、ＢＧＡタイプの半導体装置において、とりわけ半導体装置に熱ストレスが加わった際の実装信頼性を向上させることが求められている。
【０００７】
ところで一般に、半導体装置の熱膨張係数と実装基板の熱膨張係数とは異なっている。したがって、例えば製造時に熱が加えられたり、または自動車等の高温環境下で使用されたときに、半導体装置に対して熱ストレスが加わる。この場合、半導体装置の熱膨張係数と実装基板の熱膨張係数との相違により熱応力が生じ、この熱応力が特定の箇所に集中すると、その箇所から半導体装置が破損してしまうおそれがある。
【０００８】
例えば、特許文献１に記載のＢＧＡタイプの半導体装置は、熱衝撃等の環境変化に対して信頼性を高めたものであるが、熱ストレスが加わった際の信頼性をさらに向上させようとする場合、このような構成では不十分となるおそれがある。
【０００９】
本発明はこのような点を考慮してなされたものであり、熱ストレスが加わった際の信頼性を更に向上させることが可能な半導体装置および半導体装置の製造方法を提供することを目的とする。
【課題を解決するための手段】
【００１０】
本発明は、半導体装置において、非導電性基板と、前記非導電性基板の表面側に設けられた半導体素子搭載部と、前記半導体素子搭載部の周囲に配置された内部端子と、前記非導電性基板の裏面側に設けられた外部端子と、前記半導体素子搭載部上に載置された半導体素子と、前記内部端子と前記半導体素子とを電気的に接続する導電部と、前記半導体素子搭載部、前記内部端子、前記半導体素子および前記導電部を封止する封止樹脂部とを備え、前記非導電性基板は、前記非導電性基板を貫通して形成されたビアを有し、前記非導電性基板の前記ビア内または前記ビアの側面に、前記内部端子と前記外部端子とを電気的に接続する導体が設けられ、前記半導体素子搭載部の裏面に補強層が設けられ、かつ前記外部端子の各々は、平面から見て少なくとも１つの円周上に配置され、前記封止樹脂部の角部に、前記外部端子の各々より面積が広く、かつ前記半導体素子搭載部側に向けて徐々に先細となる追加の外部端子が配置されていることを特徴とする半導体装置である。
本発明は、前記外部端子の各々は、平面から見て互いに同心円の関係にある複数の円周の上に千鳥状に配置されていることを特徴とする半導体装置である。
【００１１】
本発明は、前記補強層は、平面から見て円形状からなることを特徴とする半導体装置である。
【００１２】
本発明は、前記補強層は、導電めっき層からなることを特徴とする半導体装置である。
【００１４】
本発明は、前記封止樹脂部は、直方体形状を有していることを特徴とする半導体装置である。
【００１５】
本発明は、前記封止樹脂部は、円柱形状を有していることを特徴とする半導体装置である。
【００１７】
本発明は、前記封止樹脂部は、截頭円錐形状、ドーム形状または截頭多角錐形状からなることを特徴とする半導体装置である。
【００１８】
本発明は、前記内部端子の少なくとも１つの内部端子の上面に、他の半導体装置の裏面に接続可能な外部突出端子が形成されていることを特徴とする半導体装置である。
【００１９】
本発明は、半導体装置の製造方法において、非導電性基板と、前記非導電性基板の表面側に設けられた半導体素子搭載部と、前記半導体素子搭載部の周囲に配置された内部端子と、前記非導電性基板の裏面側に設けられた外部端子と、前記非導電性基板を貫通して形成されたビアと、前記非導電性基板の前記ビア内に充填または前記ビアの側面に設けられ、前記内部端子と前記外部端子とを電気的に接続する導体とを有する配線基板を準備する工程と、前記配線基板の前記半導体素子搭載部上に、半導体素子を載置する工程と、前記半導体素子と前記配線基板の前記内部端子とを、導電部により接続する工程と、前記配線基板の前記半導体素子搭載部、前記配線基板の前記内部端子、前記半導体素子、および前記導電部を封止樹脂部により封止する工程とを備え、前記配線基板の前記半導体素子搭載部の裏面に補強層が設けられ、かつ前記配線基板の前記外部端子の各々は、平面から見て互いに同心円の関係にある複数の円周の上に千鳥状に配置され、前記封止樹脂部の角部に、前記外部端子の各々より面積が広く、かつ前記半導体素子搭載部側に向けて徐々に先細となる追加の外部端子が配置されていることを特徴とする半導体装置の製造方法である。
【発明の効果】
【００２０】
本発明によれば、半導体素子搭載部の裏面に補強層が設けられ、かつ各外部端子は、半導体素子搭載部の周囲において平面から見て少なくとも１つの円周上に配置されている。このことにより、半導体装置と実装基板との熱膨張の相違により生じる熱応力は、各外部端子に設けられたはんだ部に対して均等に加わり、特定のはんだ部が破損することを防止することができる。また、半導体素子搭載部の裏面に設けられた補強層により、半導体装置と実装基板とを強固に固着することができる。この結果、半導体装置を実装する際、あるいは半導体装置を実装した後、半導体装置に熱が加わった場合における、半導体装置と実装基板との接合信頼性を向上させることができる。
【図面の簡単な説明】
【００２１】
【図１】本発明の一実施の形態による半導体装置を示す斜視図。
【図２】本発明の一実施の形態による半導体装置を示す断面図（図１のII−II線断面図）。
【図３】本発明の一実施の形態による半導体装置を示す平面図。
【図４】本発明の一実施の形態による半導体装置を示す裏面（底面）図。
【図５】本発明の一実施の形態による半導体装置を示す部分拡大断面図。
【図６】半導体装置の製造方法を示す部分拡大断面図。
【図７】半導体装置の製造方法を示す部分拡大断面図。
【図８】本発明の一実施の形態による半導体装置が実装基板上に実装されている状態を示す断面図。
【図９】本発明の変形例（変形例１）による半導体装置を示す平面図。
【図１０】本発明の変形例（変形例１）による半導体装置を示す裏面（底面）図。
【図１１】本発明の変形例（変形例２）による半導体装置を示す平面図。
【図１２】本発明の変形例（変形例２）による半導体装置を示す裏面（底面）図。
【図１３】本発明の変形例（変形例３）による半導体装置を示す断面図。
【図１４】本発明の変形例（変形例３）による半導体装置を示す平面図。
【図１５】本発明の変形例（変形例３）による半導体装置を示す裏面（底面）図。
【図１６】本発明の変形例（変形例４）による半導体装置を示す平面図。
【図１７】本発明の変形例（変形例４）による半導体装置を示す裏面（底面）図。
【図１８】本発明の変形例（変形例５）による半導体装置を示す平面図。
【図１９】本発明の変形例（変形例５）による半導体装置を示す裏面（底面）図。
【図２０】本発明の変形例（変形例６）による半導体装置を示す断面図。
【図２１】本発明の変形例（変形例６）による半導体装置を示す平面図。
【図２２】本発明の変形例（変形例６）による半導体装置を示す裏面（底面）図。
【図２３】本発明の変形例（変形例７）による半導体装置を示す平面図。
【図２４】本発明の変形例（変形例７）による半導体装置を示す裏面（底面）図。
【図２５】本発明の変形例（変形例８）による半導体装置を示す平面図。
【図２６】本発明の変形例（変形例８）による半導体装置を示す裏面（底面）図。
【図２７】本発明の変形例（変形例９）による半導体装置を示す平面図。
【図２８】本発明の変形例（変形例９）による半導体装置を示す裏面（底面）図。
【図２９】本発明の変形例（変形例１０）による半導体装置を示す断面図。
【図３０】本発明の変形例（変形例１０）による半導体装置を示す斜視図。
【図３１】本発明の変形例（変形例１１）による半導体装置を示す断面図。
【図３２】本発明の変形例（変形例１２）による半導体装置を示す断面図。
【図３３】本発明の変形例（変形例１３）による半導体装置を示す部分拡大断面図。
【図３４】本発明の変形例（変形例１４）による半導体装置を示す平面図。
【図３５】本発明の変形例（変形例１５）による半導体装置を示す裏面（底面）図。
【図３６】本発明の変形例（変形例１６）による半導体装置を示す裏面（底面）図。
【図３７】本発明の変形例（変形例１７）による半導体装置を示す部分拡大断面図。
【図３８】本発明の変形例（変形例１７）による半導体装置の製造方法を示す部分拡大断面図。
【図３９】本発明の変形例（変形例１７）による半導体装置の製造方法を示す部分拡大断面図。
【図４０】本発明の変形例（変形例１８）による半導体装置を示す平面図。
【図４１】本発明の変形例（変形例１８）による半導体装置が実装基板上に実装されている状態を示す断面図。
【図４２】本発明の変形例（変形例１９）による半導体装置を示す平面図。
【図４３】本発明の変形例（変形例１９）による半導体装置を示す裏面（底面）図。
【図４４】本発明の変形例（変形例２０）による半導体装置を示す平面図。
【図４５】本発明の変形例（変形例２１）による半導体装置を示す断面図。
【図４６】本発明の変形例（変形例２２）による半導体装置を示す平面図。
【図４７】本発明の変形例（変形例２２）による半導体装置を示す裏面（底面）図。
【図４８】本発明の変形例（変形例２３）による半導体装置を示す平面図。
【図４９】本発明の変形例（変形例２３）による半導体装置を示す裏面（底面）図。
【図５０】本発明の変形例（変形例２４）による半導体装置を示す断面図。
【図５１】本発明の変形例（変形例２５）による半導体装置を示す断面図。
【図５２】本発明の変形例（変形例２６）による半導体装置を示す部分拡大断面図。
【図５３】本発明の変形例（変形例２７）による半導体装置を示す平面図。
【図５４】本発明の変形例（変形例２７）による半導体装置を示す断面図。
【発明を実施するための形態】
【００２２】
以下、本発明の一実施の形態について、図１乃至図８を参照して説明する。
【００２３】
半導体装置の構成
まず、図１乃至図５により、本発明の一実施の形態による半導体装置の構成について説明する。図１乃至図５は、本発明の一実施の形態による半導体装置を示す図である。
【００２４】
図１乃至図５に示すように、半導体装置２０は、非導電性基板１１と、非導電性基板１１の表面側の中心部に設けられた半導体素子搭載部１５と、非導電性基板１１の表面側であって、半導体素子搭載部１５の周囲に配置された複数の内部端子１７と、非導電性基板１１の裏面側に設けられた複数の外部端子１８とを備えている。また、非導電性基板１１の裏面側であって、半導体素子搭載部１５の裏面には補強層１４が設けられている。
【００２５】
半導体素子搭載部１５上には、半導体素子２１が載置されている。各内部端子１７と、半導体素子２１の各端子部２１ａとは、それぞれボンディングワイヤ（導電部）２２によって電気的に接続されている。
【００２６】
また、半導体素子搭載部１５、内部端子１７、半導体素子２１、およびボンディングワイヤ２２は、封止樹脂部２３によって樹脂封止されている。
【００２７】
さらに、非導電性基板１１は、非導電性基板１１を貫通して形成された複数のビア１２を有している（図５参照）。すなわち、非導電性基板１１のうち各内部端子１７に対応する部分にビア１２が設けられており、各ビア１２内に、内部端子１７と外部端子１８とを電気的に接続する導体１３が充填されている。この導体１３は、内部端子１７および外部端子１８と一体に構成されていても良く、別体に構成されていても良い。また、導体１３は、ビア１２内に完全に充填するのではなく、ビア１２の内側面のみに設けても良い。
【００２８】
また、非導電性基板１１のうち半導体素子搭載部１５の下面にもビア１２が設けられており、このビア１２内にも導体１３が充填されている。この導体１３は、半導体素子搭載部１５と補強層１４とを電気的に接続している。なお、導体１３は、半導体素子搭載部１５および補強層１４と一体に構成されていても良く、別体に構成されていても良い。
【００２９】
さらに、非導電性基板１１の裏面側において、各外部端子１８および補強層１４には、それぞれはんだ部４１、４２が設けられている。
【００３０】
なお、非導電性基板１１、半導体素子搭載部１５、複数の内部端子１７、複数の外部端子１８、複数の導体１３および補強層１４によって、配線基板１０が構成されている。
【００３１】
以下、半導体装置２０を構成する各構成部材について、順次説明する。
【００３２】
非導電性基板１１は、有機基板であっても無機基板であってもよい。有機基板としては、例えば、ポリエーテルサルホン（ＰＥＳ）、ポリエチレンナフタレート（ＰＥＮ）、ポリアミド、ポリブチレンテレフタレート、ポリエチレンテレフタレート、ポリフェニレンサルファイド、ポリエーテルエーテルケトン、液晶ポリマー、フッ素樹脂、ポリカーボネート、ポリノルボルネン系樹脂、ポリサルホン、ポリアリレート、ポリアミドイミド、ポリエーテルイミド、又は熱可塑性ポリイミド等からなる有機基板、又はそれらの複合基板を挙げることができる。また、無機基板としては、例えば、ガラス基板、シリコン基板、セラミックス基板等を挙げることができる。
【００３３】
非導電性基板１１の各ビア１２は、ドリル、炭酸ガスレーザ、ＵＶ−ＹＡＧレーザ、エキシマレーザ等により孔開け加工されたものである。また、ビア１２内に充填された導体１３は、例えば、電解めっきにより形成された銅等の導電性金属あるいは、銅粒子、銀粒子等の導電性粒子を含有した導電性ペーストを用いることができる。
【００３４】
本実施の形態において、半導体素子搭載部１５は、平面から見て円形状となっており（図３）、補強層１４は、平面から見て略円形状となっている（図４）。この場合、半導体素子搭載部１５と補強層１４とは、互いに同一の大きさの円からなっていても良く、異なる大きさの円からなっていても良い。また、補強層１４は、平面から見て半導体素子２１より大きく、かつ各外部端子１８より大きい形状とすることが好ましい。なお、半導体素子搭載部１５および補強層１４の形状は、円形に限られるものではなく、楕円形、多角形等としても良い。
【００３５】
各内部端子１７には、それぞれボンディングワイヤ２２が接続されている。一方、各外部端子１８は、それぞれ対応する各内部端子１７の裏面側に設けられており、各外部端子１８には、上述したようにそれぞれはんだ部４１が設けられている。また、各内部端子１７は、図３に示すように、周方向に沿って等間隔に配置されており、隣接する内部端子１７同士は互いに電気的に絶縁されている。同様に、各外部端子１８は、図４に示すように、周方向に沿って等間隔に配置されており、隣接する外部端子１８同士は互いに電気的に絶縁されている。
【００３６】
図３および図４に示すように、各内部端子１７および各外部端子１８は、それぞれ平面長方形形状を有している。このほか、内部端子１７および外部端子１８の形状としては、多角形、台形、円形（後述する図２７および図２８参照）、楕円形等であってもよい。
【００３７】
ところで本実施の形態において、各内部端子１７および各外部端子１８は、それぞれ平面から見て同一の円周上に配置されている。
【００３８】
すなわち図３に示すように、表面側において、各内部端子１７は円周Ｃ１上に配置されており、図４に示すように、裏面側において、各外部端子１８は円周Ｃ１上に配置されている。なお、各内部端子１７および各外部端子１８が円周上に配置されているとは、各内部端子１７および各外部端子１８の中心が円周上に配置されていることをいう。
【００３９】
なお、半導体素子搭載部１５、内部端子１７、補強層１４および外部端子１８は、それぞれ例えば電解めっきにより形成されたＣｕ等の導電めっき層から構成することができる。また、半導体素子搭載部１５、内部端子１７、補強層１４および外部端子１８の上に、更にＮｉめっき層、Ａｕめっき層等の追加の導電めっき層を積層しても良い。
【００４０】
さらに、図５に示すように、非導電性基板１１の所定部分に絶縁性のソルダーレジスト６４が設けられている。このソルダーレジスト６４は、半導体素子搭載部１５、内部端子１７、補強層１４および外部端子１８の一部を覆っている。
【００４１】
一方、半導体素子２１としては、従来一般に用いられている各種半導体素子を使用することが可能であり、特に限定されないが、例えば集積回路、大規模集積回路、トランジスタ、サイリスタ、ダイオード等を用いることができる。この半導体素子２１は、各々ボンディングワイヤ２２が取り付けられる複数の端子部２１ａを有している。また、半導体素子２１は、例えばダイボンディングペースト２８（図５参照）により、半導体素子搭載部１５の表面に固定されている。
【００４２】
各ボンディングワイヤ２２は、例えば金等の導電性の良い材料からなり、それぞれその一端が半導体素子２１の端子部２１ａに接続されるとともに、その他端が内部端子１７に接続されている。
【００４３】
本実施の形態において、封止樹脂部２３は直方体形状を有している。封止樹脂部２３としては、シリコーン樹脂やエポキシ樹脂等の熱硬化性樹脂、あるいはＰＰＳ樹脂等の熱可塑性樹脂を用いることができる。なお、図１および図３において、便宜上、封止樹脂部２３を透明なものとして表示しているが、黒色等の不透明なものが用いられても良い。
【００４４】
半導体装置の製造方法
次に、図１乃至図５に示す半導体装置２０の製造方法について、図６（ａ）−（ｆ）および図７（ａ）−（ｅ）を用いて説明する。なお、以下においては、１枚の非導電性基板１１を用いて複数の半導体装置２０を製造する工程について説明するが、これに限らず、１枚の非導電性基板１１を用いて１つの半導体装置２０のみを製造することも可能である。
【００４５】
まず図６（ａ）に示すように、非導電性基板１１の両面に銅箔８１を配設した銅張積層板８０を準備する。
【００４６】
次に、この銅張積層板８０に、ドリル、炭酸ガスレーザ、ＵＶ−ＹＡＧレーザ、エキシマレーザ等によりビア１２（スルーホール）を形成する（図６（ｂ））。なお、ビア１２は、円周Ｃ１（図３および図４）上であって、各内部端子１７および各外部端子１８に対応する位置に設けておく。
【００４７】
次に、ビア１２内を洗浄し、無電解めっきによりビア１２内部を含む銅張積層板８０の全面に所定の厚みで銅めっき層８４を形成して、ビア１２（図６（ｂ））内を導電化する。その後、電解銅めっきにより全面に所定の厚みで銅めっき層８２を形成して、ビア１２内を電気的に接続させる（図６（ｃ））。
【００４８】
次いで、ビア１２内に導電性金属あるいは導電性ペーストからなる導体１３を充填し、物理的研磨による表面平滑処理を行なう（図６（ｄ））。
【００４９】
続いて、ドライフィルムレジストあるいは液状レジストにより成膜処理を行ない、所定のパターン露光、現像を行なってレジストパターンを形成する。次にこのレジストパターンをマスクとして銅めっき層８２、銅めっき層８４および銅箔８１をパターンエッチングする。
【００５０】
このとき、それぞれ銅めっき層８２、銅めっき層８４および銅箔８１により、半導体素子搭載部１５、内部端子１７、補強層１４および外部端子１８が形成される（図６（ｅ））。なお、補強層１４は半導体素子搭載部１５の裏面に形成され、各外部端子１８はそれぞれ対応する内部端子１７の裏面に形成される。また、各内部端子１７および各外部端子１８は、半導体素子搭載部１５の周囲において円周Ｃ１（図３および図４）上に配置される。
【００５１】
その後、非導電性基板１１の所定部分に絶縁性のソルダーレジスト６４を設けることにより、上述した配線基板１０が得られる。
【００５２】
なお、配線基板１０としては、このような両面基板に限らず、ビルドアップ多層配線基板を用いても良い。
【００５３】
このようにして得られた配線基板１０は、非導電性基板１１と、非導電性基板１１の表面側に設けられた半導体素子搭載部１５と、半導体素子搭載部１５の周囲に配置された内部端子１７と、非導電性基板１１の裏面側に設けられた外部端子１８と、非導電性基板１１を貫通して形成されたビア１２と、非導電性基板１１のビア１２内に充填され、内部端子１７と外部端子１８とを電気的に接続する導体１３と、半導体素子搭載部１５の裏面に形成された補強層１４とを有している。
【００５４】
次に、この配線基板１０の半導体素子搭載部１５の表面に、半導体素子２１を搭載する。この場合、例えばダイボンディングペースト２８を用いて、半導体素子２１を半導体素子搭載部１５上に載置して固定する（ダイアタッチ工程）（図７（ａ））。
【００５５】
次に、半導体素子２１の各端子部２１ａと、各内部端子１７とを、ボンディングワイヤ２２によって互いに電気的に接続する（ワイヤボンディング工程）（図７（ｂ））。
【００５６】
次に、配線基板１０に対して熱硬化性樹脂または熱可塑性樹脂を射出成形またはトランスファ成形することにより、封止樹脂部２３を形成する（図７（ｃ））。これにより、半導体素子搭載部１５、内部端子１７、半導体素子２１、およびボンディングワイヤ２２を封止する。
【００５７】
次に、各半導体素子２１間の封止樹脂部２３および配線基板１０をダイシングすることにより、封止樹脂部２３および配線基板１０を各半導体素子２１毎に分離する（図７（ｄ））。
【００５８】
その後、各外部端子１８および補強層１４に、それぞれはんだ部４１、４２を設けることにより、図１乃至図５に示す半導体装置２０が得られる（図７（ｅ））。
【００５９】
本実施の形態の作用効果
次にこのような構成からなる本実施の形態の作用について、図８を用いて説明する。図８は、本実施の形態による半導体装置が実装基板上に実装されている状態を示す断面図である。
【００６０】
すなわち図８に示すように、本実施の形態による半導体装置２０は、実装基板４５上に配置して実装される。この場合、半導体装置２０は、各外部端子１８に設けられたはんだ部４１と、補強層１４に設けられたはんだ部４２とにより、実装基板４５に対して固定実装される。なお、実装基板４５は、主としてガラスエポキシ樹脂からなっている。
【００６１】
ところで、半導体装置２０には、実装基板４５にはんだにより実装する際、あるいは実装基板４５に実装された後の使用環境により、様々な熱が加わることが考えられる。この場合、半導体装置２０全体の熱膨張係数が実装基板４５の熱膨張係数と異なると、半導体装置２０と実装基板４５との熱膨張率の違いによって熱応力が生じる。この結果、とりわけ半導体装置２０と実装基板４５との間に位置するはんだ部４１およびはんだ部４２が破損してしまうおそれがある。
【００６２】
一般に、封止樹脂部２３の熱膨張係数は、実装基板４５の熱膨張係数より小さい。一例として、（これに限定されるものではないが）、主としてガラスエポキシ樹脂からなる実装基板４５およびエポキシ樹脂からなる封止樹脂部２３の熱膨張係数は、それぞれ約１６×１０−６（／Ｋ）および約１０×１０−６（／Ｋ）である。またＳｉからなる半導体素子２１の熱膨張係数は、約３．５×１０−６（／Ｋ）である。
【００６３】
したがって、半導体装置２０のうち、相対的に大きな割合を占める封止樹脂部２３の影響により、半導体装置２０全体の熱膨張係数は、実装基板４５の熱膨張係数から乖離する傾向がある。
【００６４】
本実施の形態によれば、複数の外部端子１８は、平面から見て１つの円周Ｃ１上に配置されている。したがって、半導体装置２０と実装基板４５との熱膨張の相違により生じる熱応力は、各外部端子１８に設けられたはんだ部４１に対して均等に加わるようになっており、特定のはんだ部４１が破損することを防止することができる。
【００６５】
また本実施の形態によれば、半導体素子搭載部１５の裏面に補強層１４が設けられているので、この補強層１４全体にはんだ部４２を設けることにより、補強層１４を実装基板４５に取り付けることができる。さらに、半導体素子２１からの熱を補強層１４から放熱することができる。
【００６６】
補強層１４の形状は図示されている以外にも自由に設計することが可能であるが、円形状（円盤状）となっていることが好ましい。半導体装置２０に熱が加わった際、半導体装置２０と実装基板４５との熱膨張係数の相違による熱応力は、周方向均一に分散する。したがって、補強層１４に設けられたはんだ部４２のうち特定の部分に熱応力が集中することがなく、はんだ部４２の破損を防止することができるからである。
【００６７】
とりわけ補強層１４は、半導体装置２０の中心部に設けられており、かつ半導体装置２０全体の面積に占める割合が大きいので、はんだ部４２を用いて補強層１４と実装基板４５とをしっかりと連結することができる。このように、半導体装置２０の中心部で補強層１４を実装基板４５に対して強固に連結しているので、半導体装置２０に熱応力が加わった場合でも、補強層１４周囲に設けられた外部端子１８に与える熱ストレスの影響を軽減することができる。
【００６８】
半導体装置の変形例
次に、図９乃至図５４により、本発明による半導体装置の各種変形例について説明する。図９乃至図５４において、図１乃至図８に示す実施の形態と同一部分には同一の符号を付して詳細な説明は省略する。
【００６９】
（変形例１）
図９および図１０は、本実施の形態の一変形例による半導体装置２０Ａを示している。すなわち図９は、半導体装置２０Ａの平面図（図３に対応する図）であり、図１０は、半導体装置２０Ａの裏面図（図４に対応する図）である。
【００７０】
図９および図１０に示す半導体装置２０Ａ（変形例１）において、図１乃至図８に示す実施の形態と異なり、封止樹脂部２３の４つの角部に、それぞれ平面略卵形状の外部端子７１（追加の外部端子）が配置されている。また各外部端子７１は、それぞれ外部端子１８より面積が広く、かつ半導体素子搭載部１５側に向けて徐々に先細となっている。
【００７１】
このような外部端子７１は、例えばグランド（ＧＮＤ）端子として用いることができる。また、このような比較的大型の外部端子７１を用いることにより、半導体装置２０Ａを実装基板４５に実装する際、はんだ部４１を用いて外部端子７１を実装基板４５に対して強固に連結することができ、半導体装置２０Ａに熱ストレスが加わった際の実装信頼性を更に向上させることができる。
【００７２】
なお、外部端子７１は封止樹脂部２３の４つの角部全てに設ける必要はなく、その一部の角部のみに設けても良い。
【００７３】
（変形例２）
図１１および図１２は、本実施の形態の一変形例による半導体装置２０Ｂを示している。すなわち図１１は、半導体装置２０Ｂの平面図（図３に対応する図）であり、図１２は、半導体装置２０Ｂの裏面図（図４に対応する図）である。
【００７４】
図１１および図１２に示す半導体装置２０Ｂ（変形例２）において、図１乃至図８に示す実施の形態と異なり、封止樹脂部２３は円柱形状を有している。この場合、封止樹脂部２３の外面を構成する円と、円周Ｃ１とは、互いに同心円からなっている。
【００７５】
このような半導体装置２０Ｂを製造する場合、封止樹脂部２３を形成する工程（図７（ｃ）参照）において、円柱形状の金型を用いることにより、このような円柱状の封止樹脂部２３を作製することができる。
【００７６】
この場合、封止樹脂部２３が平面から見て円形状からなっているので、半導体装置２０Ｂに熱が加わった際、半導体装置２０Ｂと実装基板４５との熱膨張係数の相違による熱応力を周方向均一に分散させることができ、半導体装置２０Ｂの実装信頼性を更に向上させることができる。
【００７７】
（変形例３）
図１３乃至図１５は、本実施の形態の一変形例による半導体装置２０Ｃを示している。すなわち図１３は、半導体装置２０Ｃの断面図（図２に対応する図）であり、図１４は、半導体装置２０Ｃの平面図（図３に対応する図）であり、図１５は、半導体装置２０Ｃの裏面図（図４に対応する図）である。
【００７８】
図１３乃至図１５に示す半導体装置２０Ｃ（変形例３）において、図１乃至図８に示す実施の形態と異なり、各内部端子１７および各外部端子１８は、平面から見て複数（２つ）の円周Ｃ１およびＣ２のうちいずれかの円周上に配置されている。
【００７９】
すなわち図１４に示すように、各内部端子１７は、２つの円周Ｃ１およびＣ２のうちいずれか一方の円周上に配置されており、かつ千鳥状に配列されている。円周Ｃ１およびＣ２は、互いに同心円の関係にあり、その径は円周Ｃ１の方が大きい。
【００８０】
同様に、図１５に示す半導体装置２０Ｃの裏面において、各外部端子１８は、２つの円周Ｃ１およびＣ２のうちいずれか一方の円周上に配置されており、かつ千鳥状に配列されている。
【００８１】
なお、内部端子１７および外部端子１８の面積および形状は、それらが配置されている円周毎に異ならせても良い。
【００８２】
このように各外部端子１８を複数の円周Ｃ１およびＣ２上に配置したことにより、半導体装置２０Ｃに熱ストレスが加わった際の実装信頼性を向上させることができるとともに、半導体装置２０Ｃの裏面において外部端子１８を効率良く配置することができ、半導体素子２１の多ピン化に対応することができる。
【００８３】
（変形例４）
図１６および図１７は、本実施の形態の一変形例による半導体装置２０Ｄを示している。すなわち図１６は、半導体装置２０Ｄの平面図（図３に対応する図）であり、図１７は、半導体装置２０Ｄの裏面図（図４に対応する図）である。
【００８４】
図１６および図１７に示す半導体装置２０Ｄ（変形例４）は、図９および図１０に示す変形例１と、図１３乃至図１５に示す変形例３とを組合せたものである。
【００８５】
すなわち、図１６および図１７に示す半導体装置２０Ｄにおいて、封止樹脂部２３の４つの角部に、それぞれ平面略卵形状の外部端子７１（追加の外部端子）が配置されている。また、各内部端子１７および各外部端子１８は、平面から見て２つの円周Ｃ１およびＣ２のうちいずれかの円周上に配置されている。
【００８６】
（変形例５）
図１８および図１９は、本実施の形態の一変形例による半導体装置２０Ｅを示している。すなわち図１８は、半導体装置２０Ｅの平面図（図３に対応する図）であり、図１９は、半導体装置２０Ｅの裏面図（図４に対応する図）である。
【００８７】
図１８および図１９に示す半導体装置２０Ｅ（変形例５）は、図１１および図１２に示す変形例２と、図１３乃至図１５に示す変形例３とを組合せたものである。
【００８８】
すなわち、図１８および図１９に示す半導体装置２０Ｅにおいて、封止樹脂部２３は、円柱形状を有している。また、各内部端子１７および各外部端子１８は、平面から見て２つの円周Ｃ１およびＣ２のうちいずれかの円周上に配置されている。
【００８９】
（変形例６）
図２０乃至図２２は、本実施の形態の一変形例による半導体装置２０Ｆを示している。すなわち図２０は、半導体装置２０Ｆの断面図（図２に対応する図）であり、図２１は、半導体装置２０Ｆの平面図（図３に対応する図）であり、図２２は、半導体装置２０Ｆの裏面図（図４に対応する図）である。
【００９０】
図２０乃至図２２に示す半導体装置２０Ｆ（変形例６）において、図１乃至図８に示す実施の形態と異なり、各内部端子１７および各外部端子１８は、平面から見て複数（３つ）の円周Ｃ１、Ｃ２およびＣ３のうちいずれかの円周上に配置されている。
【００９１】
すなわち図２１に示すように、各内部端子１７は、３つの円周Ｃ１、Ｃ２およびＣ３のうちいずれかの円周上に配置されており、かつ千鳥状に配列されている。円周Ｃ１、Ｃ２およびＣ３は、互いに同心円の関係にあり、その径は円周Ｃ３、Ｃ２、Ｃ１という順に大きくなっている。
【００９２】
同様に、図２２に示す半導体装置２０Ｆの裏面において、各外部端子１８は、３つの円周Ｃ１、Ｃ２およびＣ３のうちいずれかの円周上に配置されており、かつ千鳥状に配列されている。
【００９３】
なお、内部端子１７および外部端子１８を４つ以上の円周上に配置することも考えられる。また、内部端子１７および外部端子１８の面積および形状は、それらが配置されている円周毎に異ならせても良い。
【００９４】
このように各内部端子１７および各外部端子１８を複数の円周Ｃ１、Ｃ２およびＣ３上に配置したことにより、半導体装置２０Ｆに熱ストレスが加わった際の実装信頼性を向上させることができるとともに、半導体装置２０Ｆの裏面において外部端子１８を効率良く配置することができ、半導体素子２１の多ピン化に対応することができる。
【００９５】
（変形例７）
図２３および図２４は、本実施の形態の一変形例による半導体装置２０Ｇを示している。すなわち図２３は、半導体装置２０Ｇの平面図（図３に対応する図）であり、図２４は、半導体装置２０Ｇの裏面図（図４に対応する図）である。
【００９６】
図２３および図２４に示す半導体装置２０Ｇ（変形例７）は、図９および図１０に示す変形例１と、図２０乃至図２２に示す変形例６とを組合せたものである。
【００９７】
すなわち、図２３および図２４に示す半導体装置２０Ｇにおいて、封止樹脂部２３の４つの角部に、それぞれ平面略卵形状の外部端子７１（追加の外部端子）が配置されている。また、各内部端子１７および各外部端子１８は、平面から見て３つの円周Ｃ１、Ｃ２およびＣ３のうちいずれかの円周上に配置されている。
【００９８】
（変形例８）
図２５および図２６は、本実施の形態の一変形例による半導体装置２０Ｈを示している。すなわち図２５は、半導体装置２０Ｈの平面図（図３に対応する図）であり、図２６は、半導体装置２０Ｈの裏面図（図４に対応する図）である。
【００９９】
図２５および図２６に示す半導体装置２０Ｈ（変形例８）は、図１１および図１２に示す変形例２と、図２０乃至図２２に示す変形例６とを組合せたものである。
【０１００】
すなわち、図２５および図２６に示す半導体装置２０Ｈにおいて、封止樹脂部２３は、円柱形状を有している。また、各内部端子１７および各外部端子１８は、平面から見て３つの円周Ｃ１、Ｃ２およびＣ３のうちいずれかの円周上に配置されている。
【０１０１】
（変形例９）
図２７および図２８は、本実施の形態の一変形例による半導体装置２０Ｉを示している。すなわち図２７は、半導体装置２０Ｉの平面図（図３に対応する図）であり、図２８は、半導体装置２０Ｉの裏面図（図４に対応する図）である。
【０１０２】
図２７および図２８に示す半導体装置２０Ｉ（変形例９）は、図１３乃至図１５に示す半導体装置２０Ｃ（変形例３）において、各内部端子１７および各外部端子１８を平面円形状としたものである。
【０１０３】
なお、他の半導体装置（図１乃至図５、図９乃至図１２、図１６乃至図５４）についても、各内部端子１７および各外部端子１８を平面円形状としても良い。
【０１０４】
（変形例１０）
図２９および図３０（ａ）は、本実施の形態の一変形例による半導体装置２０Ｊを示している。すなわち図２９は、半導体装置２０Ｊの断面図（図２に対応する図）であり、図３０（ａ）は、半導体装置２０Ｊの斜視図である。
【０１０５】
図２９および図３０（ａ）に示す半導体装置２０Ｊ（変形例１０）において、図１乃至図８に示す実施の形態と異なり、封止樹脂部２３は、截頭円錐形状からなっており、その側面はテーパー形状となっている。また、非導電性基板１１は平面矩形形状を有している。
【０１０６】
このような半導体装置２０Ｊを製造する場合、封止樹脂部２３を形成する工程（図７（ｃ）参照）において、截頭円錐形状の金型を用いることにより、このような截頭円錐形状の封止樹脂部２３を作製することができる。
【０１０７】
なお、封止樹脂部２３の形状は、截頭円錐形状（図３０（ａ））に限らず、例えば円柱形状（図３０（ｂ））、ドーム形状（図３０（ｃ））または截頭多角錐形状（図３０（ｄ））としても良い。
【０１０８】
このように、封止樹脂部２３の形状を截頭円錐形状、円柱形状、ドーム形状または截頭多角錐形状とすることにより、熱膨張係数が相対的に低い封止樹脂部２３の体積を減らしている。このことにより、半導体装置２０全体の熱膨張係数を実装基板４５の熱膨張係数に近づけることができるので、半導体装置２０に熱が加わった際の熱応力を軽減し、実装信頼性を向上させることができる。また、封止樹脂部２３が熱収縮したときのそり低減を図ることができる。
【０１０９】
なお、図９乃至図１２に示す変形例１または２と、図２９に示す変形例１０とを組合せることも可能である。
【０１１０】
（変形例１１）
図３１は、本実施の形態の一変形例による半導体装置２０Ｋを示している。すなわち図３１は、半導体装置２０Ｋの断面図（図２に対応する図）である。
【０１１１】
図３１に示す半導体装置２０Ｋ（変形例１１）は、図１３乃至図１５に示す変形例３と、図２９に示す変形例１０とを組合せたものである。
【０１１２】
すなわち、図３１に示す半導体装置２０Ｋにおいて、封止樹脂部２３は、截頭円錐形状からなっている。また、各内部端子１７および各外部端子１８は、平面から見て２つの円周Ｃ１およびＣ２のうちいずれかの円周上に配置されている。
【０１１３】
なお、図１６乃至図１９に示す変形例４または５と、図２９に示す変形例１０とを組合せることも可能である。
【０１１４】
（変形例１２）
図３２は、本実施の形態の一変形例による半導体装置２０Ｌを示している。すなわち図３２は、半導体装置２０Ｌの断面図（図２に対応する図）である。
【０１１５】
図３２に示す半導体装置２０Ｌ（変形例１２）は、図２０乃至図２２に示す変形例６と、図２９に示す変形例１０とを組合せたものである。
【０１１６】
すなわち、図３２に示す半導体装置２０Ｌにおいて、封止樹脂部２３は、截頭円錐形状からなっている。また、各内部端子１７および各外部端子１８は、平面から見て３つの円周Ｃ１、Ｃ２およびＣ３のうちいずれかの円周上に配置されている。
【０１１７】
なお、図２３乃至図２６に示す変形例７または８と、図２９に示す変形例１０とを組合せることも可能である。
【０１１８】
（変形例１３）
図３３は、本実施の形態の一変形例による半導体装置２０Ｍを示している。図３３は、半導体装置２０Ｍの部分拡大断面図（図５に対応する図）である。
【０１１９】
すなわち、図３３に示す半導体装置２０Ｍにおいて、半導体素子搭載部１５は半導体素子２１の外周方向外側まで延びている。そして半導体素子搭載部１５と、半導体素子２１の一つまたは複数の端子部２１ａとが、ボンディングワイヤ２２によって接続されている。
【０１２０】
このように構成することにより、半導体素子２１の一部の端子部２１ａを、半導体素子搭載部１５、導体１３、補強層１４およびはんだ部４２を介して、実装基板４５に接続することができる。なお、このように半導体素子搭載部１５に接続される端子部２１ａとしては、ＧＮＤ（グランド）端子や電源端子等を挙げることができる。
【０１２１】
なお、図３３に示す変形例１３と、図９乃至図３２に示す各種変形例とを組合せても良いことは勿論である。
【０１２２】
（変形例１４）
図３４は、本実施の形態の一変形例による半導体装置２０Ｎを示している。すなわち図３４は、半導体装置２０Ｎの平面図（図３に対応する図）である。
【０１２３】
図３４に示す半導体装置２０Ｎ（変形例１４）において、内部端子１７のうち周方向内側に位置する内側端部の幅が細くなっており、この内側端部が半導体素子搭載部１５側に向けて内方に延びている。
【０１２４】
このように、内部端子１７を半導体素子２１近傍まで延ばしたことにより、例えば金からなるボンディングワイヤ２２の線長を短くすることができ、コストダウンを図ることができる。なお、この他の構成は、図１乃至図８に示す実施の形態と略同様である。
【０１２５】
（変形例１５）
図３５は、本実施の形態の一変形例による半導体装置２０Ｐを示している。すなわち図３５は、半導体装置２０Ｐの裏面図（図４に対応する図）である。
【０１２６】
図３５に示す半導体装置２０Ｐ（変形例１５）において、略円形の補強層１４に、放射状および／または円形のスリット６７が形成されている。補強層１４は、円形または円弧形からなる複数の部材１４ａから構成されている。
【０１２７】
このスリット６７の部分には補強層１４が存在しないため、はんだ部４２（はんだクリーム）の量を減らすことができる。これにより、はんだ付け実装時に、はんだクリームを内部に巻き込むことにより発生するボイドを外へ逃がすことができ、はんだ実装性を向上させることができる。なお、この他の構成は、図１乃至図８に示す実施の形態と略同様である。
【０１２８】
（変形例１６）
図３６は、本実施の形態の一変形例による半導体装置２０Ｑを示している。すなわち図３６は、半導体装置２０Ｑの裏面図（図４に対応する図）である。
【０１２９】
図３６に示す半導体装置２０Ｑ（変形例１６）において、補強層１４は、略同心円状に配置された、互いに同一の形状からなる複数の円形の部材１４ａからなっている。なお、補強層１４の形状は、円形のほか、矩形、楕円形、扇形、多角形等としても良い。
【０１３０】
このように補強層１４を複数の部材１４ａから構成したことにより、はんだ部４２（はんだクリーム）の量を減らすことができる。これにより、はんだ付け実装時に、はんだクリームを内部に巻き込むことにより発生するボイドを外へ逃がすことができ、はんだ実装性を向上させることができる。なお、この他の構成は、図１乃至図８に示す実施の形態と略同様である。
【０１３１】
（変形例１７）
図３７乃至図３９は、本実施の形態の一変形例による半導体装置２０Ｒを示している。すなわち図３７は、半導体装置２０Ｒの部分拡大断面図（図５に対応する図）であり、図３８および図３９は、半導体装置２０Ｒの製造方法を示す部分拡大断面図（それぞれ図６および図７に対応する図）である。
【０１３２】
図３７に示す半導体装置２０Ｒ（変形例１７）において、内部端子１７の内側端部は、半導体素子２１に向けて内側に延びており、これにより、内部端子１７の径方向（図３７の横方向）の長さは、外部端子１８の径方向の長さより長くなっている。
【０１３３】
図３８および図３９は、図３７に示す半導体装置２０Ｒの製造方法を示している。この場合、非導電性基板１１上に形成された銅めっき層８２、銅めっき層８４および銅箔８１をパターンエッチングする際（図３８（ｅ））、エッチングにより形成される表面側の開口部８６を、裏面側の開口部８７より内側に位置させることにより、内部端子１７の径方向の長さを外部端子１８の径方向の長さより長くする。
【０１３４】
このように、内部端子１７を半導体素子２１近傍まで延ばしたことにより、例えば金からなるボンディングワイヤ２２の線長を短くすることができ、コストダウンを図ることができる。なお、この他の構成は、図１乃至図８に示す実施の形態と略同様である。
【０１３５】
（変形例１８）
図４０および図４１は、本実施の形態の一変形例による半導体装置２０Ｓを示している。すなわち図４０は、半導体装置２０Ｓを示す平面図（図３に対応する図）であり、図４１は、半導体装置２０Ｓが実装基板４５上に実装されている状態を示す断面図（図８に対応する図）である。
【０１３６】
図４０および図４１に示す半導体装置２０Ｓ（変形例１８）において、各内部端子１７は、各外部端子１８より径方向内側に配置されている。この場合、各内部端子１７は、各外部端子１８が配置されている円周Ｃ１より径の小さい円周Ｃ４上に配置されている（図４０）。
【０１３７】
このように、内部端子１７を半導体素子２１近傍まで近づけたことにより、例えば金からなるボンディングワイヤ２２の線長を短くすることができ、コストダウンを図ることができる。なお、この他の構成は、図１乃至図８に示す実施の形態と略同様である。
【０１３８】
（変形例１９）
図４２および図４３は、本実施の形態の一変形例による半導体装置２０Ｔを示している。すなわち図４２は、半導体装置２０Ｔの平面図（図３に対応する図）であり、図４３は、半導体装置２０Ｔの裏面図（図４に対応する図）である。
【０１３９】
図４２および図４３に示す半導体装置２０Ｔ（変形例１９）は、図９および図１０に示す変形例１において、外部端子７１（追加の外部端子）を、封止樹脂部２３の４つの角部側から、内部端子１７および外部端子１８が配置された円周Ｃ１上まで径方向内側に延ばしたものである。
【０１４０】
このように、外部端子７１（追加の外部端子）が内部端子１７および外部端子１８近傍まで延びていることにより、内部端子１７および外部端子１８に対する実装ストレスをさらに緩和することができる。なお、この他の構成は、図９および図１０に示す変形例１と略同様である。
【０１４１】
（変形例２０）
図４４は、本実施の形態の一変形例による半導体装置２０Ｕを示している。すなわち図４４は、半導体装置２０Ｕの平面図（図３に対応する図）である。
【０１４２】
図４４に示す半導体装置２０Ｕ（変形例２０）は、図３４に示す変形例１４において、半導体素子搭載部１５と半導体素子２１の端子部２１ｂ（グランド（ＧＮＤ）端子）とを、ボンディングワイヤ２２によって電気的に接続したものである。
【０１４３】
この場合、半導体素子搭載部１５および補強層１４を用いて、半導体素子２１の端子部２１ｂ（グランド（ＧＮＤ）端子）と実装基板４５とを電気的に接続することができる。なお、この他の構成は、図３４に示す変形例１４と略同様である。
【０１４４】
（変形例２１）
図４５は、本実施の形態の一変形例による半導体装置２０Ｖを示している。すなわち図４５は、半導体装置２０Ｖの断面図（図２に対応する図）である。
【０１４５】
図４５に示す半導体装置２０Ｖ（変形例２１）は、図１３乃至図１５に示す変形例３において、各内部端子１７を、対応する各外部端子１８よりそれぞれ径方向内側に設けたものである。この場合、各内部端子１７はそれぞれ、対応する外部端子１８が配置されている円周Ｃ１およびＣ２より径の小さい円周上に配置されている。
【０１４６】
このように、内部端子１７を半導体素子２１近傍まで近づけたことにより、例えば金からなるボンディングワイヤ２２の線長を短くすることができ、コストダウンを図ることができる。なお、この他の構成は、図１３乃至図１５に示す変形例３と略同様である。
【０１４７】
（変形例２２）
図４６および図４７は、本実施の形態の一変形例による半導体装置２０Ｗを示している。すなわち図４６は、半導体装置２０Ｗの平面図（図３に対応する図）であり、図４７は、半導体装置２０Ｗの裏面図（図４に対応する図）である。
【０１４８】
図４６および図４７に示す半導体装置２０Ｗ（変形例２２）は、図１６および図１７に示す変形例３において、外部端子７１（追加の外部端子）を、封止樹脂部２３の４つの角部側から、内部端子１７および外部端子１８が配置された円周のうち最も内側の円周Ｃ２上まで径方向内側に延ばしたものである。
【０１４９】
このように、外部端子７１（追加の外部端子）が内部端子１７および外部端子１８近傍まで延びていることにより、内部端子１７および外部端子１８に対する実装ストレスをさらに緩和することができる。なお、この他の構成は、図１６および図１７に示す変形例３と略同様である。
【０１５０】
（変形例２３）
図４８および図４９は、本実施の形態の一変形例による半導体装置２０Ｘを示している。すなわち図４８は、半導体装置２０Ｘの平面図（図３に対応する図）であり、図４９は、半導体装置２０Ｘの裏面図（図４に対応する図）である。
【０１５１】
図４８および図４９に示す半導体装置２０Ｘ（変形例２３）は、図２３および図２４に示す変形例７において、外部端子７１（追加の外部端子）を、封止樹脂部２３の４つの角部側から、内部端子１７および外部端子１８が配置された円周のうち最も内側の円周Ｃ３上まで径方向内側に延ばしたものである。
【０１５２】
このように、外部端子７１（追加の外部端子）が内部端子１７および外部端子１８近傍まで延びていることにより、内部端子１７および外部端子１８に対する実装ストレスをさらに緩和することができる。なお、この他の構成は、図２３および図２４に示す変形例７と略同様である。
【０１５３】
（変形例２４）
図５０は、本実施の形態の一変形例による半導体装置２０Ｙを示している。すなわち図５０は、半導体装置２０Ｙの断面図（図２に対応する図）である。
【０１５４】
図５０に示す半導体装置２０Ｙ（変形例２４）は、図２９および図３０（ａ）に示す変形例１０において、内部端子１７を外部端子１８より径方向内側に設けたものである。この場合、各内部端子１７は、各外部端子１８が配置されている円周Ｃ１より径の小さい円周上に配置されている。
【０１５５】
このように、内部端子１７を半導体素子２１近傍まで近づけたことにより、例えば金からなるボンディングワイヤ２２の線長を短くすることができ、コストダウンを図ることができる。なお、この他の構成は、図２９および図３０（ａ）に示す変形例１０と略同様である。
【０１５６】
（変形例２５）
図５１は、本実施の形態の一変形例による半導体装置２０Ｚを示している。すなわち図５１は、半導体装置２０Ｚの断面図（図２に対応する図）である。
【０１５７】
図５１に示す半導体装置２０Ｚ（変形例２５）は、図３１に示す変形例１１において、各内部端子１７を、対応する各外部端子１８よりそれぞれ径方向内側に設けたものである。この場合、各内部端子１７はそれぞれ、対応する外部端子１８が配置されている円周Ｃ１およびＣ２より径の小さい円周上に配置されている。
【０１５８】
このように、内部端子１７を半導体素子２１近傍まで近づけたことにより、例えば金からなるボンディングワイヤ２２の線長を短くすることができ、コストダウンを図ることができる。なお、この他の構成は、図３１に示す変形例１１と略同様である。
【０１５９】
（変形例２６）
図５２は、本実施の形態の一変形例による半導体装置２０ａを示している。すなわち図５２は、半導体装置２０ａを示す部分拡大断面図（図５に対応する図）である。
【０１６０】
図５２に示す半導体装置２０ａ（変形例２６）は、図３３に示す変形例１３において、内部端子１７の内側端部を周方向内側に延ばしたものである。この場合、内部端子１７の径方向（図５２の横方向）の長さは、外部端子１８の径方向の長さより長くなっている。
【０１６１】
このように、内部端子１７を半導体素子２１近傍まで延ばしたことにより、例えば金からなるボンディングワイヤ２２の線長を短くすることができ、コストダウンを図ることができる。なお、この他の構成は、図３３に示す変形例１３と略同様である。
【０１６２】
（変形例２７）
図５３および図５４は、本実施の形態の一変形例による半導体装置２０ｂを示している。すなわち図５３は、半導体装置２０ｂの平面図（図３に対応する図）であり、図５４は、半導体装置２０ｂの断面図（図２に対応する図）である。
【０１６３】
図５３および図５４に示す半導体装置２０ｂ（変形例２７）において、複数の内部端子１７のうち少なくとも１つの上面に、外部突出端子６５が形成されている。外部突出端子６５は、封止樹脂部２３に形成された開口部２３ａから露出し形成され、半導体装置２０ｂの上面からの接続を可能としている。なお外部突出端子６５には、はんだやＡｇペーストなど一般的な接続材を用いることが可能である。
【０１６４】
このように、外部突出端子６５が内部端子１７の上面に形成されることにより、図５４に示すように、下方の半導体装置２０ｂの外部突出端子６５を、上方の半導体装置２０ｂの外部端子１８に接続することができる。これにより、複数の半導体装置２０ｂを上下に積層することが可能となる（図５４）。
【０１６５】
上記実施の形態および変形例に開示されている複数の構成要素を必要に応じて適宜組合せることも可能である。あるいは、上記実施の形態および変形例に示される全構成要素から幾つかの構成要素を削除してもよい。
【符号の説明】
【０１６６】
１０        配線基板
１１        非導電性基板
１２        ビア
１３        導体
１４        補強層
１５        半導体素子搭載部
１７        内部端子
１８        外部端子
２０        半導体装置
２０Ａ〜２０Ｚ、２０ａ、２０ｂ  半導体装置
２１        半導体素子
２２        ボンディングワイヤ（導電部）
２３        封止樹脂部
２８        ダイボンディングペースト
４１、４２  はんだ部
４５        実装基板
【図１】
0005769058.tif 000002
【図２】
0005769058.tif 000003
【図３】
0005769058.tif 000004
【図４】
0005769058.tif 000005
【図５】
0005769058.tif 000006
【図６】
0005769058.tif 000007
【図７】
0005769058.tif 000008
【図８】
0005769058.tif 000009
【図９】
0005769058.tif 000010
【図１０】
0005769058.tif 000011
【図１１】
0005769058.tif 000012
【図１２】
0005769058.tif 000013
【図１３】
0005769058.tif 000014
【図１４】
0005769058.tif 000015
【図１５】
0005769058.tif 000016
【図１６】
0005769058.tif 000017
【図１７】
0005769058.tif 000018
【図１８】
0005769058.tif 000019
【図１９】
0005769058.tif 000020
【図２０】
0005769058.tif 000021
【図２１】
0005769058.tif 000022
【図２２】
0005769058.tif 000023
【図２３】
0005769058.tif 000024
【図２４】
0005769058.tif 000025
【図２５】
0005769058.tif 000026
【図２６】
0005769058.tif 000027
【図２７】
0005769058.tif 000028
【図２８】
0005769058.tif 000029
【図２９】
0005769058.tif 000030
【図３０】
0005769058.tif 000031
【図３１】
0005769058.tif 000032
【図３２】
0005769058.tif 000033
【図３３】
0005769058.tif 000034
【図３４】
0005769058.tif 000035
【図３５】
0005769058.tif 000036
【図３６】
0005769058.tif 000037
【図３７】
0005769058.tif 000038
【図３８】
0005769058.tif 000039
【図３９】
0005769058.tif 000040
【図４０】
0005769058.tif 000041
【図４１】
0005769058.tif 000042
【図４２】
0005769058.tif 000043
【図４３】
0005769058.tif 000044
【図４４】
0005769058.tif 000045
【図４５】
0005769058.tif 000046
【図４６】
0005769058.tif 000047
【図４７】
0005769058.tif 000048
【図４８】
0005769058.tif 000049
【図４９】
0005769058.tif 000050
【図５０】
0005769058.tif 000051
【図５１】
0005769058.tif 000052
【図５２】
0005769058.tif 000053
【図５３】
0005769058.tif 000054
【図５４】
0005769058.tif 000055