(57)【要約】【課題】ＤＣ電源の着脱を短時間で検出する。【解決手段】ゲートコントローラ１２０は、第１トランジスタＭ１のオン、オフを制御する。充電コントローラ１２２は、第２トランジスタＭ２のゲート電圧を制御することにより、二次電池２０の充電を制御する。ＯＣＰ回路１０６は、ＤＣＩＮ端子および第１トランジスタＭ１を流れる入力電流ＩＤＣを多段階で可変のしきい値電流ＩＯＣＰと比較し、ＩＤＣ＞ＩＯＣＰのとき、第１トランジスタＭ１のゲート電圧ＶＧ１を、オン抵抗が増大するように変化させる。低電圧検出回路１０８は、ＤＣＩＮ端子の電圧ＶＤＣＩＮがしきい値電圧ＶＬＯＷを下回ると、ＯＣＰ回路１０６のしきい値電流ＩＯＣＰを１ステップ低下させる。ＤＣ電源検出部１１０は、しきい値電流ＩＯＣＰが最低値であるときに、ＶＤＣＩＮがＶＬＯＷを下回ると、ＤＣ電源２が非接続状態と判定する。【選択図】図３
2015211541.tif 000002
【特許請求の範囲】
【請求項１】
ＤＣ電源からのＤＣ電圧を受けるＤＣ入力端子と、
二次電池が接続される電池端子と、
システム端子と、
前記ＤＣ入力端子とシステム端子の間に設けられる第１トランジスタと、
前記システム端子と前記電池端子の間に設けられる第２トランジスタと、
前記第１トランジスタのオン、オフを制御するゲートコントローラと、
前記第２トランジスタのゲート電圧を制御することにより、前記二次電池の充電を制御する充電コントローラと、
前記ＤＣ入力端子および前記第１トランジスタを流れる入力電流を多段階で可変のしきい値電流と比較し、前記入力電流が前記しきい値電流に達すると、前記ゲートコントローラが生成する前記第１トランジスタのゲート電圧を、オン抵抗が増大するように変化させる過電流保護回路と、
前記ＤＣ入力端子の電圧を所定のしきい値電圧と比較し、前記ＤＣ入力端子の電圧が前記しきい値電圧を下回ると、前記過電流保護回路のしきい値電流を１ステップ低下させる低電圧検出回路と、
前記しきい値電流が最低値であるときに、前記ＤＣ入力端子の電圧が前記しきい値電圧を下回ると、前記ＤＣ電源が非接続状態と判定するＤＣ電源検出部と、
を備えることを特徴とする充電回路。
【請求項２】
前記しきい値電圧は、前記二次電池の満充電電圧より低く設定されることを特徴とする請求項１に記載の充電回路。
【請求項３】
前記ＤＣ入力端子の電圧を低電圧ロックアウト用のしきい値電圧と比較する低電圧ロックアウト回路をさらに備えることを特徴とする請求項１または２に記載の充電回路。
【請求項４】
前記第２トランジスタは、Ｐチャンネルトランジスタであり、その第１電極が前記システム端子と接続され、その第２電極が前記電池端子と接続されており、そのバックゲートと第１電極の間に第１バックゲートスイッチ、そのバックゲートと第２電極の間に第２バックゲートスイッチを有し、
前記充電回路は、前記システム端子の電圧が前記電池端子の電圧より高いとき、前記第１バックゲートスイッチをオン、前記第２バックゲートスイッチをオフし、前記システム端子の電圧が前記電池端子の電圧より低いとき、前記第１バックゲートスイッチをオフ、前記第２バックゲートスイッチをオンするバックゲートコントローラをさらに備えることを特徴とする請求項１から３のいずれかに記載の充電回路。
【請求項５】
前記バックゲートコントローラは、前記システム端子の電圧と前記電池端子の電圧とを比較するコンパレータを含むことを特徴とする請求項４に記載の充電回路。
【請求項６】
前記コンパレータのオン、オフ状態を制御するコンパレータコントローラをさらに備え、
前記コンパレータコントローラは、前記ＤＣ電源検出部が、前記ＤＣ電源が非接続状態であると判定し、かつ前記電池端子の電圧が前記システム端子の電圧より高いときに、前記コンパレータをオフすることを特徴とする請求項５に記載の充電回路。
【請求項７】
ひとつの半導体基板に一体集積化されることを特徴とする請求項１から６のいずれかに記載の充電回路。
【請求項８】
ＤＣ電源が接続される外部電源端子と、
二次電池と、
プロセッサと、
請求項１から６のいずれかに記載の充電回路と、
前記充電回路のシステム端子の電圧を受け、少なくとも前記プロセッサに電源電圧を供給する電源回路と、
を備えることを特徴とする電子機器。
【請求項９】
請求項１から６のいずれかに記載の充電回路と、
前記システム端子の電圧を受け、複数の電源電圧を生成する電源回路と、
前記電源回路を制御するパワーマネージメントコントローラと、
を備えることを特徴とするパワーマネージメント回路。
【請求項１０】
ＤＣ電源からのＤＣ電圧を受けるＤＣ入力端子と、
二次電池が接続される電池端子と、
システム端子と、
前記ＤＣ入力端子とシステム端子の間に設けられる第１トランジスタと、
その第１電極が前記システム端子と接続され、その第２電極が前記電池端子と接続されており、そのバックゲートと第１電極の間に第１バックゲートスイッチ、そのバックゲートと第２電極の間に第２バックゲートスイッチを有する第２トランジスタと、
前記第１トランジスタのオン、オフを制御するゲートコントローラと、
前記第２トランジスタのゲート電圧を制御することにより、前記二次電池の充電を制御する充電コントローラと、
前記ＤＣ電源の接続の有無を検出するＤＣ電源検出部と、
前記システム端子の電圧と前記電池端子の電圧とを比較するコンパレータを含み、前記システム端子の電圧が前記電池端子の電圧より高いとき、前記第１バックゲートスイッチをオン、前記第２バックゲートスイッチをオフし、前記システム端子の電圧が前記電池端子の電圧より低いとき、前記第１バックゲートスイッチをオフ、前記第２バックゲートスイッチをオンするバックゲートコントローラと、
前記ＤＣ電源検出部が前記ＤＣ電源が非接続状態であると判定し、かつ前記電池端子の電圧が前記システム端子の電圧より高いときに、前記コンパレータをオフするコンパレータコントローラと、
を備えることを特徴とする充電回路。
【請求項１１】
ひとつの半導体基板に一体集積化されることを特徴とする請求項１０に記載の充電回路。
【請求項１２】
ＤＣ電源が接続される外部電源端子と、
二次電池と、
プロセッサと、
請求項１０または１１に記載の充電回路と、
前記充電回路のシステム端子の電圧を受け、少なくとも前記プロセッサに電源電圧を供給する電源回路と、
を備えることを特徴とする電子機器。
【発明の詳細な説明】
【技術分野】
【０００１】
本発明は、二次電池を充電する充電回路に関する。
【背景技術】
【０００２】
携帯電話、タブレット端末、ノート型パーソナルコンピュータ（ＰＣ）、携帯ゲーム機器、デジタルカメラなどの電池駆動型の電子機器は、２次電池と、２次電池を充電する充電回路と、を備える。
【０００３】
図１は、本発明者が検討した電子機器の回路図である。電子機器１ｒは、充電回路１０ｒ、二次電池２０、電源回路２２、ＣＰＵ２４および複数の周辺回路２６を備える。二次電池２０は、リチウムイオン電池やニッケル水素電池などであり、電池電圧ＶＢＡＴを出力する。
【０００４】
複数の周辺回路２６は、メモリ（ＲＡＭ：Random Access Memory）、ハードディスク、ディスプレイなどを含む。電子機器１ｒの外部電源（ＥＸＴ）端子には、ＡＣアダプタやＵＳＢホストなどのＤＣ電源２が着脱可能となっており、ＤＣ電圧ＶＤＣが供給される。
【０００５】
充電回路１０ｒは、ＥＸＴ端子にＤＣ電源２が接続されているときには、ＤＣ電圧ＶＤＣを受け、二次電池２０を充電する。また充電回路１０ｒは、電池電圧ＶＢＡＴあるいはＤＣ電圧ＶＤＣのひとつを選択し、システム（ＳＹＳ）端子からシステム電圧ＶＳＹＳを出力する。
【０００６】
電源回路２２は、システム電圧ＶＳＹＳを受け、それを昇圧または降圧して電源電圧ＶＤＤを生成し、負荷であるＣＰＵ２４や周辺回路２６に供給する。電源回路２２は、ＤＣ／ＤＣコンバータやチャージポンプ回路、リニアレギュレータ（ＬＤＯ：Low Drop Output）などを含む。
【０００７】
充電回路１０ｒは、第１トランジスタＭ１、第２トランジスタＭ２、ＯＶＰ（Over Voltage Protection）回路１０２、ＵＶＬＯ（Under Voltage Lock Out）回路１０４、ゲートコントローラ１２０、充電コントローラ１２２を備える。
【０００８】
直流入力（ＤＣＩＮ）端子には、ＤＣ電源２からのＤＣ電圧ＶＤＣが入力され、電池（ＢＡＴ）端子には、二次電池２０が接続される。第１トランジスタＭ１は、ＤＣＩＮ端子とＳＹＳ端子の間に設けられる。第１トランジスタＭ１は、逆直列接続された２個のＮチャンネルＭＯＳＦＥＴを含む。
【０００９】
第２トランジスタＭ２は、ＳＹＳ端子とＢＡＴ端子の間に設けられる。第２トランジスタＭ２のバックゲートと第１電極の間、バックゲートと第２電極の間には、バックゲートスイッチＳＷ１１、ＳＷ１２が設けられる。
【００１０】
ＤＣ電源２が接続されて正常なＤＣ電圧ＶＤＣが供給されているときには、ゲートコントローラ１２０は、第１トランジスタＭ１をオンする。第１トランジスタＭ１がオンすると、ＳＹＳ端子にはＤＣ電圧ＶＤＣが現れる。
【００１１】
ＤＣ電圧ＶＤＣが正常か否かは、ＯＶＰ回路１０２、ＵＶＬＯ回路１０４により判定される。ＯＶＰ回路１０２は、ＤＣ電圧ＶＤＣを過電圧保護用のしきい値ＶＯＶＰと比較し、ＵＶＬＯ回路１０４は、ＤＣ電圧ＶＤＣを低電圧ロックアウト用のしきい値ＶＵＶＬＯと比較する。比較結果は、ゲートコントローラ１２０に入力される。
【００１２】
正常なＤＣ電圧ＶＤＣが供給されているとき、充電コントローラ１２２は二次電池２０を充電する。具体的には、バックゲートスイッチＳＷ１１がオン、ＳＷ１２がオフとなる。充電コントローラ１２２は、第２トランジスタＭ２のゲート電圧を調節し、ＣＣ（定電流）充電モードあるいはＣＶ（定電圧）充電モードで二次電池２０を充電する。
【００１３】
ＤＣ電源２が接続されておらず、正常なＤＣ電圧ＶＤＣが入力されない場合、バックゲートスイッチＳＷ１２がオン、ＳＷ１１がオフとなる。また充電コントローラ１２２は第２トランジスタＭ２をフルオフする。これにより、電池電圧ＶＢＡＴがＳＹＳ端子を介して電源回路２２に供給される。
【先行技術文献】
【特許文献】
【００１４】
【特許文献１】特開２０１３−１２８３３８号公報
【発明の概要】
【発明が解決しようとする課題】
【００１５】
本発明者は、図１の充電回路１０ｒについて検討した結果、以下の課題を認識するに至った。
充電回路１０ｒでは、ＤＣ電源２が接続されているか否かは、ＤＣＩＮ端子の電圧ＶＤＣＩＮを監視し、所定のしきい値（たとえばＶＵＶＬＯ）を下回ると、ＤＣ電源２が接続されていないものと判定する。
【００１６】
図２は、図１の充電回路１０ｒの動作波形図である。初期状態においてＤＣ電源２が接続され、ＶＵＶＬＯ＜ＶＤＣ＜ＶＯＶＰを満たす正常なＤＣ電圧ＶＤＣが供給されており、第１トランジスタＭ１はオンしている。このとき、ＤＣＩＮ端子とＳＹＳ端子の電圧は、いずれもＤＣ電源２からの電圧ＶＤＣと等しい。
【００１７】
時刻ｔ０にＤＣ電源２が取り外される。このときＳＹＳ端子は電池電圧ＶＢＡＴまで低下する。この時点ではＤＣＩＮ端子とＳＹＳ端子の間は、オン状態の第１トランジスタＭ１によって接続されているため、ＤＣＩＮ端子の電位は、ＤＣ電源２が外されているにもかかわらず、電池電圧ＶＢＡＴまでしか低下しない。つまり、ＤＣＩＮ端子の電位はしきい値ＶＵＶＬＯを下回らないため、ＤＣ電源２が取り外されたことを直ちに検出することができない。やがて時刻ｔ１に、放電によって電池電圧ＶＢＡＴがしきい値ＶＵＶＬＯまで低下するとようやくＤＣ電源２が取り外されたものと判定され、第１トランジスタＭ１がオフとなる。
【００１８】
つまり図１の充電回路１０ｒでは、ＤＣ電源２が外されてから、取り外しが検出されるまでの期間ｔ０〜ｔ１、ＤＣＩＮ端子の電圧ＶＤＣＩＮを監視する回路や、充電コントローラ１２２などを動作させ続ける必要があり、これにより二次電池２０の電力が、充電回路１０の内部で無駄に消費される。
【００１９】
この問題を解決するために、しきい値ＶＵＶＬＯを、電池電圧ＶＢＡＴの典型値より高く設定する方法が考えられる。ところがこの場合、ＤＣ電源２の電流供給能力が小さい場合に、大きな電流ＩＤＣが流れると、ＤＣ電源２からのＤＣ電圧ＶＤＣがドロップしてＶＵＶＬＯを下回り、ＤＣ電源２が接続されているのにもかかわらず、取り外されたものと誤判定されるという別の問題が生ずる。
【００２０】
なお図１の充電回路１０ｒを公知技術と認定してはならず、またそこで生ずる上述の問題を当業者の一般的な認識としてとらえてはならない。
【００２１】
本発明は係る課題に鑑みてなされたものであり、そのある態様の例示的な目的のひとつは、ＤＣ電源の着脱を短時間で検出可能な充電回路の提供にある。
【課題を解決するための手段】
【００２２】
本発明のある態様は、充電回路に関する。充電回路は、ＤＣ電源からのＤＣ電圧を受けるＤＣ入力端子と、二次電池が接続される電池端子と、システム端子と、ＤＣ入力端子とシステム端子の間に設けられる第１トランジスタと、システム端子と電池端子の間に設けられる第２トランジスタと、第１トランジスタのオン、オフを制御するゲートコントローラと、第２トランジスタのゲート電圧を制御することにより、二次電池の充電を制御する充電コントローラと、ＤＣ入力端子および第１トランジスタを流れる入力電流を多段階で可変のしきい値電流と比較し、入力電流がしきい値電流に達すると、ゲートコントローラが生成する第１トランジスタのゲート電圧を、オン抵抗が増大するように変化させる過電流保護回路と、ＤＣ入力端子の電圧を所定のしきい値電圧と比較し、ＤＣ入力端子の電圧がしきい値電圧を下回ると、過電流保護回路のしきい値電流を１ステップ低下させる低電圧検出回路と、しきい値電流が最低値であるときに、ＤＣ入力端子の電圧がしきい値電圧を下回ると、ＤＣ電源が非接続状態と判定するＤＣ電源検出部と、を備える。
【００２３】
この態様によると、ＤＣ電源の電流容量不足によるＤＣ入力端子の電圧の低下と、ＤＣ電源の取り外しによるＤＣ入力端子の電圧の低下を区別することができ、ＤＣ電源の取り外しを確実に検出できる。
【００２４】
しきい値電圧は、二次電池の満充電電圧より低く設定されてもよい。
【００２５】
充電回路は、ＤＣ入力端子の電圧を低電圧ロックアウト用のしきい値電圧と比較する低電圧ロックアウト回路をさらに備えてもよい。
【００２６】
第２トランジスタは、Ｐチャンネルトランジスタであり、その第１電極がシステム端子と接続され、その第２電極が電池端子と接続されており、そのバックゲートと第１電極の間に第１バックゲートスイッチ、そのバックゲートと第２電極の間に第２バックゲートスイッチを有してもよい。充電回路は、システム端子の電圧が電池端子の電圧より高いとき、第１バックゲートスイッチをオン、第２バックゲートスイッチをオフし、システム端子の電圧が電池端子の電圧より低いとき、第１バックゲートスイッチをオフ、第２バックゲートスイッチをオンするバックゲートコントローラをさらに備えてもよい。
【００２７】
バックゲートコントローラは、システム端子の電圧と電池端子の電圧とを比較するコンパレータを含んでもよい。
【００２８】
充電回路は、コンパレータのオン、オフ状態を制御するコンパレータコントローラをさらに備えてもよい。コンパレータコントローラは、ＤＣ電源検出部が、ＤＣ電源が非接続状態であると判定し、かつ電池端子の電圧がシステム端子の電圧より高いときに、コンパレータをオフしてもよい。
これにより、ＤＣ電源が取り外された直後に、第２トランジスタおよびそのボディダイオードにラッシュ電流が流れるのを防止できる。
【００２９】
本発明の別の態様も、充電回路である。この充電回路は、ＤＣ電源からのＤＣ電圧を受けるＤＣ入力端子と、二次電池が接続される電池端子と、システム端子と、ＤＣ入力端子とシステム端子の間に設けられる第１トランジスタと、その第１電極がシステム端子と接続され、その第２電極が電池端子と接続されており、そのバックゲートと第１電極の間に第１バックゲートスイッチ、そのバックゲートと第２電極の間に第２バックゲートスイッチを有する第２トランジスタと、第１トランジスタのオン、オフを制御するゲートコントローラと、第２トランジスタのゲート電圧を制御することにより、二次電池の充電を制御する充電コントローラと、ＤＣ電源の接続の有無を検出するＤＣ電源検出部と、システム端子の電圧と電池端子の電圧とを比較するコンパレータを含み、システム端子の電圧が電池端子の電圧より高いとき、第１バックゲートスイッチをオン、第２バックゲートスイッチをオフし、システム端子の電圧が電池端子の電圧より低いとき、第１バックゲートスイッチをオフ、第２バックゲートスイッチをオンするバックゲートコントローラと、ＤＣ電源検出部がＤＣ電源が非接続状態であると判定し、かつ電池端子の電圧がシステム端子の電圧より高いときに、コンパレータをオフするコンパレータコントローラと、を備える。
【００３０】
この態様によると、ＤＣ電源が取り外された直後に、第２トランジスタおよびそのボディダイオードにラッシュ電流が流れるのを防止できる。
【００３１】
充電回路は、ひとつの半導体基板に一体集積化されてもよい。
「一体集積化」とは、回路の構成要素のすべてが半導体基板上に形成される場合や、回路の主要構成要素が一体集積化される場合が含まれ、回路定数の調節用に一部の抵抗やキャパシタなどが半導体基板の外部に設けられていてもよい。
回路を１つのチップ上に集積化することにより、回路面積を削減することができるとともに、回路素子の特性を均一に保つことができる。
【００３２】
本発明の別の態様は、電子機器に関する。電子機器は、ＤＣ電源が接続される外部電源端子と、二次電池と、プロセッサと、上述のいずれかの充電回路と、充電回路のシステム端子の電圧を受け、少なくともプロセッサに電源電圧を供給する電源回路と、を備える。
【００３３】
本発明の別の態様は、パワーマネージメント回路に関する。パワーマネージメント回路は、上述のいずれかの充電回路と、充電回路のシステム端子の電圧を受け、複数の電源電圧を生成する電源回路と、電源回路を制御するパワーマネージメントコントローラと、を備える。
【００３４】
なお、以上の構成要素の任意の組み合わせや、本発明の構成要素や表現を、方法、装置、システムなどの間で相互に置換したものもまた、本発明の態様として有効である。
【発明の効果】
【００３５】
本発明のある態様によれば、ＤＣ電源の着脱を短時間で検出できる。
【図面の簡単な説明】
【００３６】
【図１】本発明者が検討した電子機器の回路図である。
【図２】図１の充電回路の動作波形図である。
【図３】第１の実施の形態に係る充電回路を備える電子機器の回路図である。
【図４】ＤＣ電源が取り外されたときの図３の充電回路の動作波形図である。
【図５】電流容量が小さいＤＣ電源が接続されたときの図３の充電回路の動作波形図である。
【図６】充電回路の基本動作を説明する図である。
【図７】第２の実施の形態に係る充電回路の回路図である。
【図８】図８（ａ）は、図７の充電回路の動作波形図であり、図８（ｂ）は、図６の充電回路の動作波形図である。
【図９】パワーマネージメントＩＣを備える電子機器の斜視図である。
【発明を実施するための形態】
【００３７】
以下、本発明を好適な実施の形態をもとに図面を参照しながら説明する。各図面に示される同一または同等の構成要素、部材、処理には、同一の符号を付するものとし、適宜重複した説明は省略する。また、実施の形態は、発明を限定するものではなく例示であって、実施の形態に記述されるすべての特徴やその組み合わせは、必ずしも発明の本質的なものであるとは限らない。
【００３８】
本明細書において、「部材Ａが、部材Ｂと接続された状態」とは、部材Ａと部材Ｂが物理的に直接的に接続される場合のほか、部材Ａと部材Ｂが、電気的な接続状態に影響を及ぼさない他の部材を介して間接的に接続される場合も含む。また、「部材Ｃが、部材Ａと部材Ｂの間に設けられた状態」とは、部材Ａと部材Ｃ、あるいは部材Ｂと部材Ｃが直接的に接続される場合のほか、電気的な接続状態に影響を及ぼさない他の部材を介して間接的に接続される場合も含む。
【００３９】
（第１の実施の形態）
図３は、第１の実施の形態に係る充電回路１０を備える電子機器１の回路図である。充電回路１０の周辺回路については図１と同じであるため説明を省略する。
【００４０】
充電回路１０は、第１トランジスタＭ１、第２トランジスタＭ２、ゲートコントローラ１２０、充電コントローラ１２２、ＯＶＰ回路１０２、ＵＶＬＯ回路１０４、ＯＣＰ回路１０６、低電圧検出回路１０８、ＤＣ電源検出部１１０を備える。
【００４１】
充電回路１０のＤＣＩＮ端子には、ＤＣ電源２からのＤＣ電圧ＶＤＣが入力される。ＢＡＴ端子には二次電池２０が接続され、ＳＹＳ端子には電源回路２２が接続される。
【００４２】
電源回路２２は、複数の電源電圧ＶＤＤを生成し、負荷であるＣＰＵ２４、周辺回路２６に供給する。電子機器１を正常に起動・停止するためには、ＣＰＵ２４や周辺回路２６に対する電源電圧ＶＤＤを所定のシーケンスにしたがって生成、停止する必要があり、そのためにパワーマネージメント（ＰＭ）コントローラ２８が搭載される場合がある。電源回路２２は、ＰＭコントローラ２８を内蔵してもよい。
【００４３】
第１トランジスタＭ１はＤＣＩＮ端子とＳＹＳ端子の間に設けられる。ゲートコントローラ１２０は、第１トランジスタＭ１のオン、オフを制御する。ゲートコントローラ１２０は、正常なＤＣ電圧ＶＤＣが供給されているとき、つまり第１トランジスタＭ１をオンすべき期間において、第１トランジスタＭ１をフルオンしてもよい。
【００４４】
あるいはゲートコントローラ１２０は、ＳＹＳ端子の電圧（システム電圧）ＶＳＹＳが所定の目標電圧に近づくように、第１トランジスタＭ１のゲート電圧ＶＧ１を調節可能に構成されてもよい。つまりゲートコントローラ１２０および第１トランジスタＭ１は、リニアレギュレータを構成してもよい。
【００４５】
第２トランジスタＭ２は、ＳＹＳ端子とＢＡＴ端子の間に設けられる。充電コントローラ１２２は、第２トランジスタＭ２のゲート電圧ＶＧ２を制御することにより、二次電池２０の充電を制御する。
【００４６】
ＯＣＰ回路１０６は、ＤＣＩＮ端子および第１トランジスタＭ１を流れる入力電流ＩＤＣを、多段階で可変のしきい値電流ＩＯＣＰと比較する。そしてＯＣＰ回路１０６は、入力電流ＩＤＣがしきい値電流ＩＯＣＰに達すると、過電流状態と判定し、ゲートコントローラ１２０が生成する第１トランジスタＭ１のゲート電圧ＶＧ１を、そのオン抵抗が増大するように変化させる。つまり正常状態では、第１トランジスタＭ１をフルオンさせるために、ゲート電圧ＶＧ１を最大値に設定される。過電流状態が検出されると、ゲート電圧ＶＧ１を低下させ、入力電流ＩＤＣが小さくなるように第１トランジスタＭ１のオン抵抗を増大させる。
【００４７】
低電圧検出回路１０８は、ＤＣＩＮ端子の電圧ＶＤＣＩＮを所定のしきい値電圧ＶＬＯＷと比較し、ＤＣＩＮ端子の電圧ＶＤＣＩＮがしきい値電圧ＶＬＯＷを下回ると、低電圧検出信号Ｓ１をアサート（たとえばハイレベル）する。これを受けてＯＣＰ回路１０６は、しきい値電流ＩＯＣＰを１ステップ低下させる。しきい値電圧ＶＬＯＷは、二次電池２０の満充電電圧ＶＦＵＬＬより低く設定される。
【００４８】
ＤＣ電源検出部１１０は、しきい値電流ＩＯＣＰが最低値ＭＩＮまで低下した状態において、ＤＣＩＮ端子の電圧ＶＤＣＩＮがしきい値電圧ＶＬＯＷを下回ると、ＤＣ電源２が非接続状態であるものと判定する。
【００４９】
ＯＶＰ回路１０２は、ＤＣＩＮ端子の電圧ＶＤＣＩＮを過電圧保護用のしきい値電圧ＶＯＶＰと比較する。過電圧状態（ＶＤＣ＞ＶＯＶＰ）が検出されると、ゲートコントローラ１２０は第１トランジスタＭ１をオフする。
【００５０】
ＵＶＬＯ回路１０４は、ＤＣＩＮ端子の電圧ＶＤＣＩＮを低電圧ロックアウト用のしきい値電圧ＶＵＶＬＯと比較する。低電圧ロックアウト状態（ＶＤＣ＜ＶＵＶＬＯ）が検出されると、ゲートコントローラ１２０は第１トランジスタＭ１をオフする。
【００５１】
以上が充電回路１０の構成である。続いてその動作を、（i）ＤＣ電源２が取り外された状態と、（ii）電流容量が小さいＤＣ電源２が接続された状態と、について説明する。
【００５２】
（i）ＤＣ電源２が取り外された状態
図４は、ＤＣ電源２が取り外されたときの図３の充電回路１０の動作波形図である。初期状態において、ＤＣ電源２が接続され、ＶＵＶＬＯ＜ＶＤＣ＜ＶＯＶＰを満たす正常なＤＣ電圧ＶＤＣが供給されている。このときゲートコントローラ１２０は、第１トランジスタＭ１をフルオンしうるゲート電圧ＶＧ１（＝Ｖ０）を生成する。このとき、ＤＣＩＮ端子とＳＹＳ端子の電圧は、いずれもＤＣ電源２からの電圧ＶＤＣと等しい。
【００５３】
時刻ｔ０にＤＣ電源２が取り外される。このときＳＹＳ端子は電池電圧ＶＢＡＴまで低下する。この時点ではＤＣＩＮ端子とＳＹＳ端子の間は、オン状態の第１トランジスタＭ１によって接続されているため、ＤＣＩＮ端子の電位は、電池電圧ＶＢＡＴまで低下する。
【００５４】
ＤＣＩＮ端子の電圧ＶＤＣＩＮは、しきい値電圧ＶＬＯＷより低くなるため、低電圧検出回路１０８によって低電圧検出信号Ｓ１がアサートされる。低電圧検出信号Ｓ１がアサートされると、ＯＣＰ回路１０６は、過電流しきい値ＩＯＣＰを初期値（最大値ＭＡＸ）から１ステップ低下させる。
【００５５】
ＤＣ電源２が取り外された状態では、入力電流ＩＤＣは実質的にゼロとなるため、ＩＤＣ＜ＩＯＣＰであるため、過電流保護はかからない。つまり、ゲートコントローラ１２０が生成するゲート電圧ＶＧ１は最大値を維持し、第１トランジスタＭ１はフルオンし続ける。
【００５６】
時刻ｔ１においても、ＤＣＩＮ端子の電圧ＶＤＣＩＮはしきい値電圧ＶＬＯＷより低いため、低電圧検出信号Ｓ１はハイレベル（アサート）を維持する。そしてＯＣＰ回路１０６のしきい値電流ＩＯＣＰはさらに１ステップ低下する。この動作を繰り返すことで、しきい値電流ＩＯＣＰは最小値まで低下する（時刻ｔ２）。
【００５７】
そして、しきい値電流ＩＯＣＰが最低値ＭＩＮまで低下した状態において、ＤＣＩＮ端子の電圧ＶＤＣＩＮがしきい値電圧ＶＬＯＷを下回ると、ＤＣ電源検出部１１０は、ＤＣ電源２が非接続状態であるものと判定し、取り外し検出信号Ｓ２をアサートする。取り外し検出信号Ｓ２がアサートされると、ゲートコントローラ１２０は第１トランジスタＭ１のゲート電圧ＶＧ１を低下させ、第１トランジスタＭ１をオフする。
【００５８】
（ii）電流容量が小さいＤＣ電源２が接続された状態
図５は、電流容量が小さいＤＣ電源２が接続されたときの図３の充電回路１０の動作波形図である。
初期状態において、ＤＣ電源２が接続されている。入力電流ＩＤＣは、ＤＣ電源２の電流容量より小さなＩ０であり、ＶＵＶＬＯ＜ＶＤＣ＜ＶＯＶＰを満たす正常なＤＣ電圧ＶＤＣが供給されている。このときゲートコントローラ１２０は、第１トランジスタＭ１をフルオンしうるゲート電圧ＶＧ１（＝Ｖ０）を生成しており、ＤＣＩＮ端子とＳＹＳ端子の電圧は、いずれもＤＣ電源２からの電圧ＶＤＣと等しい。
【００５９】
時刻ｔ０に、ＤＣ電源２の負荷電流、すなわち入力電流ＩＤＣが増大し、ＤＣ電源２の電流容量を超えると、直流電圧ＶＤＣがドロップする。そしてＤＣＩＮ端子の電圧ＶＤＣＩＮが、しきい値電圧ＶＬＯＷより低くなると、低電圧検出回路１０８によって低電圧検出信号Ｓ１がアサートされる。低電圧検出信号Ｓ１がアサートされると、ＯＣＰ回路１０６は、過電流しきい値ＩＯＣＰを初期値（最大値ＭＡＸ）から１ステップ低下させる。
【００６０】
時刻ｔ１においても、ＤＣＩＮ端子の電圧ＶＤＣＩＮはしきい値電圧ＶＬＯＷより低いため、低電圧検出信号Ｓ１はアサートされ続ける。その結果、ＯＣＰ回路１０６は、過電流しきい値ＩＯＣＰをさらに１ステップ低下させる。
【００６１】
時刻ｔ１に過電流しきい値ＩＯＣＰが低下すると、入力電流ＩＤＣが過電流しきい値ＩＯＣＰを超えることとなり、過電流検出信号Ｓ３がアサートされる。過電流検出信号Ｓ３がアサートされると、ゲートコントローラ１２０は、第１トランジスタＭ１のゲート電圧ＶＧ１を低下させ、第１トランジスタＭ１のオン抵抗を増大させる。これにより電流制限がかかり、入力電流ＩＤＣが減少する。入力電流ＩＤＣの減少により、ＤＣ電圧ＶＤＣはわずかに増大する。
【００６２】
時刻ｔ２においても、ＤＣＩＮ端子の電圧ＶＤＣＩＮは、しきい値電圧ＶＬＯＷより低いため、低電圧検出信号Ｓ１のアサートは維持され、過電流しきい値ＩＯＣＰはさらに１ステップ低下する。このときＩＤＣ＞ＩＯＣＰであるため、過電流検出信号Ｓ３のアサートも維持され、第１トランジスタＭ１のゲート電圧ＶＧ１がさらに低下し、より強い電流制限がかかる。
【００６３】
電流制限の結果、入力電流ＩＤＣが減少して、ＤＣＩＮ端子の電圧ＶＤＣＩＮはさらに増大する。時刻ｔ３に、ＤＣＩＮ端子の電圧ＶＤＣＩＮがしきい値ＶＬＯＷを超えると、低電圧検出信号Ｓ１がネゲートされる。このときＩＤＣ＜ＩＯＣＰであるため、過電流検出信号Ｓ３はネゲートされ、過電流しきい値ＩＯＣＰは最小値ＭＩＮまで到達しない。したがって取り外し検出信号Ｓ２はアサートされることはない。
【００６４】
以上が充電回路１０の動作である。
【００６５】
この充電回路１０によれば、図４を参照して説明したように、ＤＣ電源２が外されたことを、二次電池２０の放電をまたずに、短時間で確実に検出することができる。
また、ＤＣ電源２の取り外しが検出されると直ちに、充電コントローラ１２２、低電圧検出回路１０８、ＤＣ電源検出部１１０、ＯＣＰ回路１０６等を停止できるため、二次電池２０の電力が無駄に消費されるのを防止できる。
【００６６】
また、ＤＣ電源２が取り外されたことによるＤＣＩＮ端子の電圧ＶＤＣＩＮの低下と、入力電流ＩＤＣの増大にともなうＤＣ電圧ＶＤＣのドロップに起因するＤＣＩＮ端子の電圧ＶＤＣＩＮの低下と、を区別することができる。これにより、回路の安定動作が保証される。
【００６７】
（第２の実施の形態）
第２の実施の形態では、第１の実施の形態と組み合わせて、あるいはそれとは別に利用可能な充電回路１０について説明する。
【００６８】
上述のように、充電回路１０においては、ＤＣ電源２の有無に応じて、第１トランジスタＭ１と第２トランジスタＭ２のオン、オフ、ならびに第２トランジスタＭ２のバックゲートスイッチＳＷ１１、ＳＷ１２を制御する。第２の実施の形態では、これらの制御に関する問題点を解決する。
【００６９】
はじめに充電回路１０において生じうる問題点を図６を参照して説明する。図６は、充電回路１０の基本動作を説明する図である。
【００７０】
ＤＣ電源検出部１１０は、ＤＣ電源２の接続の有無を検出する。検出結果は、ゲートコントローラ１２０、充電コントローラ１２２、バックゲートコントローラ１３０に送られる。ゲートコントローラ１２０、充電コントローラ１２２、バックゲートコントローラ１３０の動作は以下の通りである。
【００７１】
（１）ＤＣ電源２が接続されているとき
ゲートコントローラ１２０は、第１トランジスタＭ１をオンする。充電コントローラ１２２は、第２トランジスタＭ２のゲート電圧を調節し、ＤＣ電源２からの電圧ＶＤＣによって二次電池２０を充電する。バックゲートコントローラ１３０は、システム電圧ＶＳＹＳと電池電圧ＶＢＡＴの大小関係に応じて、ＶＳＹＳ＞ＶＢＡＴのとき、第１バックゲートスイッチＳＷ１１をオン、第２バックゲートスイッチＳＷ１２をオフし、ＶＳＹＳ＜ＶＢＡＴのとき、バックゲートスイッチＳＷ１１をオフ、ＳＷ１２をオンする。
【００７２】
（２）ＤＣ電源２が接続されていないとき
ゲートコントローラ１２０は、第１トランジスタＭ１をオフする。充電コントローラ１２２は、第２トランジスタＭ２のゲート電圧を接地電圧（０Ｖ）として第２トランジスタＭ２をフルオンさせる。バックゲートコントローラ１３０は、バックゲートスイッチＳＷ１１をオフ、ＳＷ１２をオンする。
【００７３】
この動作は、ＤＣ電源２の取り外しが検出されると、ＤＣ電源検出部１１０、充電コントローラ１２２、コンパレータ１３２をオフすることで実現できる。
【００７４】
コンパレータ１３２がオフすることで、その出力はローレベル（接地電圧）となる。このときバックゲートスイッチＳＷ１２はＰチャンネルＭＯＳＦＥＴであり、オンとなる。ＰチャンネルＭＯＳＦＥＴであるバックゲートスイッチＳＷ１１のゲートには、インバータ１３４からハイレベル電圧が入力され、オフする。
【００７５】
また充電コントローラ１２２がオフすることでその出力、つまり第２トランジスタＭ２のゲート電圧は接地電圧（０Ｖ）となる。第２トランジスタＭ２のバックゲートがＢＡＴ端子側に接続されることにより、第２トランジスタＭ２はフルオンとなる。
【００７６】
以上が充電回路１０の基本動作である。この構成では、ＤＣ電源２が接続されていないときに、ＤＣ電源検出部１１０、充電コントローラ１２２、バックゲートコントローラ１３０をオフすることにより、二次電池２０の無駄な電力消費を抑えることができ、二次電池２０の持続時間を伸ばすことができる。ところが、この充電回路１０では、以下の問題が生じうる。
【００７７】
二次電池２０の電圧ＶＢＡＴが低い深放電状態でＤＣ電源２が外されたとする。ＶＳＹＳ＞ＶＢＡＴの状態で、第２トランジスタＭ２がフルオンすると、ＳＹＳ端子からＢＡＴ端子に向かってラッシュ電流ＩＲＵＳＨが流れる。またこのとき、第２トランジスタＭ２のバックゲートはＢＡＴ端子側と接続されているため、第２トランジスタＭ２のボディダイオードＢＤ１にも、過電流が流れることとなる。
【００７８】
したがって過電流が流れても信頼性が確保されるように、トランジスタサイズを大きくし、またボディダイオードＢＤ１と接続される配線幅を十分に太く設計する必要があり、回路面積が大きくなるという問題があった。
【００７９】
第２の実施の形態はかかる課題に鑑みてなされたものであり、ＤＣ電源２が外されたときのラッシュ電流を抑制可能な充電回路１０の提供を目的とする。
【００８０】
図７は、第２の実施の形態に係る充電回路１０ａの回路図である。充電回路１０ａは、図６の充電回路１０に加えて、コンパレータコントローラ１４０をさらに備える。
【００８１】
ゲートコントローラ１２０、充電コントローラ１２２は、ＤＣ電源検出部１１０によりＤＣ電源２の取り外しが検出される、取り外し検出信号Ｓ２がアサートされるとオフ状態となる。これは図６のそれと同様である。
【００８２】
コンパレータコントローラ１４０は、取り外し検出信号Ｓ２およびバックゲートコントローラ１３０による比較結果に応じた信号（比較信号）Ｓ４を受け、それらに応じてコンパレータ１３２のオン、オフを制御する。コンパレータ１３２のオン、オフはイネーブル信号ＥＮに応じて制御され、たとえばイネーブル信号ＥＮがハイレベルのときコンパレータ１３２はオンされ、ローレベルのときオフされる。
【００８３】
コンパレータコントローラ１４０は、取り外し検出信号Ｓ２がアサートされ、かつ、比較信号Ｓ４がＶＳＹＳ＜ＶＢＡＴを示すときに、コンパレータコントローラ１４０をオフする。つまりコンパレータコントローラ１４０は、取り外し検出信号Ｓ２がアサートされた後、直ちにコンパレータ１３２をオフせず、ＶＳＹＳ＞ＶＢＡＴの間は、コンパレータコントローラ１４０を動作させ続ける。
【００８４】
以上が充電回路１０ａの構成である。続いてその動作を説明する。
図８（ａ）は、図７の充電回路１０ａの動作波形図であり、図８（ｂ）は、図６の充電回路１０の動作波形図である。トランジスタおよびスイッチを示す信号は、ローレベルがオフ、ハイレベルがオンに対応する。充電回路１０ａの利点を明確化するため、図8（ｂ）を参照して図６の充電回路１０の動作を再度説明する。
【００８５】
時刻ｔ０より前は、ＤＣ電源２が接続されている。ＶＤＣ≒ＶＳＹＳ＞ＶＢＡＴであるから、バックゲートコントローラ１３０によってバックゲートスイッチＳＷ１１がオン、ＳＷ１２がオフされる。第２トランジスタＭ２はオフしており、あるいは二次電池２０を充電するためにゲート電圧が調節されている。
【００８６】
時刻ｔ０にＤＣ電源２が取り外され、取り外し検出信号Ｓ２がアサートされると直ちに、第１トランジスタＭ１がオフし、また第２トランジスタＭ２のゲート電圧ＶＧ２が接地電圧となる。さらにコンパレータ１３２が停止することにより、バックゲートスイッチＳＷ１１がオフ、ＳＷ１２がオンとなる。これにより第２トランジスタＭ２がフルオンし、ラッシュ電流ＩＲＵＳＨが流れる。
【００８７】
続いて図８（ａ）を参照して、図７の充電回路１０ａの動作を説明する。
時刻ｔ０より前は、図８（ｂ）と同様である。時刻ｔ０に取り外し検出信号Ｓ２がアサートされると、第１トランジスタＭ１がオフされる。比較信号Ｓ４が、ＶＳＹＳ＞ＶＢＡＴを示すレベル（ここではローレベル）である間、第２トランジスタＭ２は直ちにフルオンされることなく、それより前の状態を維持する。
【００８８】
比較信号Ｓ４は、ＶＳＹＳ＞ＶＢＡＴを示すレベル（ここではローレベル）であるから、イネーブル信号ＥＮはハイレベル（アサート）を維持し、したがってバックゲートコントローラ１３０のコンパレータ１３２は動作し続け、ＶＳＹＳ＞ＶＢＡＴである期間ｔ０〜ｔ１、バックゲートスイッチＳＷ１１がオン、ＳＷ１２がオフとなる。
【００８９】
時刻ｔ２にＶＳＹＳ＜ＶＢＡＴとなると、バックゲートコントローラ１３０は、バックゲートスイッチＳＷ１１をオフ、ＳＷ１２をオンに切りかえる。また第２トランジスタＭ２のゲート電圧ＶＧ２が接地電圧となり、第２トランジスタＭ２がフルオンとなる。
【００９０】
時刻ｔ２に、比較信号Ｓ４がＶＳＹＳ＜ＶＢＡＴを示すレベル（ここではハイレベル）に遷移し、イネーブル信号ＥＮがローレベル（ネゲート）となり、コンパレータ１３２が停止する。
【００９１】
以上が充電回路１０ａの動作である。
この充電回路１０ａによれば、コンパレータコントローラ１４０を設け、ＤＣ電源２が取り外された後も、ＶＳＹＳ＞ＶＢＡＴの間は、バックゲートコントローラ１３０の機能である電圧比較にもとづくバックゲート制御を有効とすることにより、ラッシュ電流を抑制できる。
【００９２】
またＶＳＹＳ＜ＶＢＡＴとなりラッシュ電流のおそれが無くなると、コンパレータ１３２をオフすることで、図６と同程度に消費電力を低減できる。
【００９３】
以上、本発明について、実施の形態をもとに説明した。この実施の形態は例示であり、それらの各構成要素や各処理プロセスの組み合わせにいろいろな変形例が可能なこと、またそうした変形例も本発明の範囲にあることは当業者に理解されるところである。以下、こうした変形例について説明する。
【００９４】
（第１変形例）
第２の実施の形態において、図７のＤＣ電源検出部１１０としては、第１の実施の形態で説明したＤＣ電源の取り外し検出技術、すなわち図３の低電圧検出回路１０８、ＯＣＰ回路１０６、ＤＣ電源検出部１１０の組み合わせを用いてもよい。あるいは、図１を参照して説明したように、ＤＣＩＮ端子の電圧ＶＤＣＩＮとしきい値電圧ＶＵＶＬＯとの比較結果にもとづいて、ＤＣ電源２の取り外しを検出してもよい。
【００９５】
（第２変形例）
実施の形態では、充電回路１０と電源回路２２が別のＩＣである場合を説明したが、それらを一体化してもよい。
また、電子機器１を正常に起動・停止するためには、ＣＰＵ２４や周辺回路２６に対する電源電圧ＶＤＤを所定のシーケンスにしたがって生成、停止する必要があり、そのためにパワーマネージメントコントローラが搭載される場合がある。そこで充電回路１０と電源回路２２と、パワーマネージメント（ＰＭ）コントローラを、ひとつのＩＣ（ＰＭＩＣという）に集積化してもよい。
【００９６】
（用途）
最後に、充電回路１０の用途を説明する。図９は、ＰＭＩＣ４０を備える電子機器５００の斜視図である。電子機器５００はたとえばタブレット端末やスマートホンである。筐体５２０には、ＣＰＵ２４、ＲＡＭ、ＨＤＤなどの周辺回路２６、二次電池２０、およびＰＭＩＣ４０が内蔵される。ＰＭＩＣ４０は、ＣＰＵ２４やＲＡＭ、ＨＤＤに加えて、ディスプレイパネル５１０や、そのドライバ、オーディオ回路などに電源電圧を供給してもよい。なお電子機器５００は、ノートＰＣやコンソールゲーム機器、ポータブルゲーム機器、ウェアラブルＰＣ、ポータブルオーディオプレイヤ、デジタルカメラなどであってもよい。ＰＭＩＣ４０に代えて、充電回路１０と電源回路２２が別の部品として搭載されてもよい。
【００９７】
実施の形態にもとづき、具体的な用語を用いて本発明を説明したが、実施の形態は、本発明の原理、応用を示しているにすぎず、実施の形態には、請求の範囲に規定された本発明の思想を逸脱しない範囲において、多くの変形例や配置の変更が認められる。
【符号の説明】
【００９８】
１…電子機器、２…ＤＣ電源、１０…充電回路、２０…二次電池、２２…電源回路、２４…ＣＰＵ、２６…周辺回路、２８…ＰＭコントローラ、４０…ＰＭＩＣ、Ｍ１…第１トランジスタ、Ｍ２…第２トランジスタ、１０２…ＯＶＰ回路、１０４…ＵＶＬＯ回路、１０６…ＯＣＰ回路、１０８…低電圧検出回路、１１０…ＤＣ電源検出部、１２０…ゲートコントローラ、１２２…充電コントローラ、１３０…バックゲートコントローラ、１３２…コンパレータ、１３４…インバータ、１４０…コンパレータコントローラ、Ｓ１…低電圧検出信号、Ｓ２…取り外し検出信号、Ｓ３…過電流検出信号、Ｓ４…比較信号。
【図１】
2015211541.tif 000003
【図２】
2015211541.tif 000004
【図３】
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【図４】
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【図５】
2015211541.tif 000007
【図６】
2015211541.tif 000008
【図７】
2015211541.tif 000009
【図８】
2015211541.tif 000010
【図９】
2015211541.tif 000011