(57)【要約】半導体素子は、第１の半導体領域１と、第１の半導体領域１とは異なる導電型を有する第２の半導体領域２と、第１の半導体領域１と第２の半導体領域２との間に配置され且つ低濃度の不純物を含む第３の半導体領域３とを備えている。第１の半導体領域１と第２の半導体領域２との直接接合により形成される内側接合領域８と、内側接合領域８を包囲する第３の半導体領域３と第１の半導体領域１又は第２の半導体領域２との接合により外側接合領域９とを形成する。外側接合領域９に付着した不純物によるブレークダウンを生じないので、半導体素子の耐圧値が増加し、降伏電圧が安定化する。
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【特許請求の範囲】
【請求項１】
第１の半導体領域と、該第１の半導体領域とは異なる導電型を有し且つ前記第１の半導体領域に対向して配置された第２の半導体領域と、前記第１の半導体領域と第２の半導体領域との間に配置され且つ前記第１の半導体領域及び第２の半導体領域より低濃度の不純物を含む第３の半導体領域とを備えた半導体素子において、
前記第１の半導体領域と第２の半導体領域は、互いに直接接合される内側接合領域を形成し、
前記第３の半導体領域は、前記内側接合領域を包囲して環状に形成され且つ前記第１の半導体領域又は第２の半導体領域に対して接合される外側接合領域を形成することを特徴とする半導体素子。
【請求項２】
前記第１の半導体領域は、内側に形成される皿状凹部を備え、前記第２の半導体領域は、前記第１の半導体領域の皿状凹部に接合される平坦な底面を備える請求項１に記載の半導体素子。
【請求項３】
前記第２の半導体領域は略均一な厚さで形成され、前記第１の半導体領域の外面及び前記第２の半導体領域の外面にそれぞれ電極が形成され、前記電極の略中央に窪みが形成される請求項１又は２に記載の半導体素子。
【請求項４】
高濃度の不純物を含む第１の半導体領域上に低濃度の不純物を含む第３の半導体領域を設ける工程と、
前記第１の半導体領域に達する凹部を前記第３の半導体領域の内側に形成する工程と、
前記第１の半導体領域が露出する凹部上及び該凹部を包囲する前記第３の半導体領域上に前記第１の半導体領域とは導電型の異なる高濃度の不純物を含む第２の半導体領域を形成して、該第２の半導体領域と前記第１の半導体領域とを直接接合させて内側接合領域を形成すると共に、前記第２の半導体領域と前記第３の半導体領域とを直接接合させて前記内側接合領域を包囲する外側接合領域を形成する工程とを含むことを特徴とする半導体素子の製法。
【発明の詳細な説明】
技術分野
本発明は、半導体素子、特に耐圧値が安定した半導体素子及びその製法に属する。
背景技術
従来のプレーナ構造のダイオードは、保護膜を形成後に、Ｐ型の不純物源をＮ−型領域に拡散するため、横方向の拡散により保護膜とＮ−型領域との間にＰＮ接合領域の端部が入り込み、端部が露出しないため、付着物の影響を殆ど受けず、ダイオードの耐圧変動が生じ難い。しかしながら、曲率半径が小さいＰＮ接合領域の曲率部ほど、局所的な電界集中が発生して容易に臨界電界に達するため、プレーナ構造のダイオードは、ダイオードに比べて降伏電圧が低く、高耐圧値を達成できない。また、理論的に算定される耐圧が得られ難いため、素子の設計が難しい問題もある。
そこで、本発明は、降伏電圧が変動せず安定した耐圧値を有する半導体素子及びその製法を提供することを目的とする。また、本発明は、理論的な降伏電圧値に近似し、所望する耐圧が安定して得られ且つ素子設計も容易な半導体素子及びその製法を提供することを目的とする。
発明の開示
本発明による半導体素子は、第１の半導体領域（１）と、第１の半導体領域（１）とは異なる導電型を有し且つ第１の半導体領域（１）に対向して配置された第２の半導体領域（２）と、第１の半導体領域（１）と第２の半導体領域（２）との間に配置され且つ第１の半導体領域（１）及び第２の半導体領域（２）より低濃度の不純物を含む第３の半導体領域（３）とを備えている。第３の半導体領域（３）より何れも不純物濃度の高い第１の半導体領域（１）と第２の半導体領域（２）は、互いに直接接合され且つ電界集中点（ブレークダウンポイント）となる内側接合領域（８）を形成する。また、第３の半導体領域（３）は、内側接合領域（８）を包囲して環状に形成され且つ第１の半導体領域（１）又は第２の半導体領域（２）に対して接合される外側接合領域（９）を形成し、外側接合領域（９）には幅広の空乏層が形成されるため、逆方向のバイアスが印加されたとき電界集中が生じ難く、外側接合領域（９）に不純物が付着しても降伏（ブレークダウン）電圧の変動を生じない。
発明の実施するための最良の形態
図８に示す従来のメサ構造のダイオード４０は、カソード領域のＮ＋型領域２１及びＮ−型領域２３と、Ｎ−型領域２３上に形成されたアノード領域のＰ＋型領域２２とから成る半導体基板２４を備え、半導体基板２４の下面及び上面に一対の電極２５、２６が形成される。Ｎ−型領域２３は、Ｎ＋型領域２１及びＰ＋型領域２２に比べて低濃度の不純物を含有する。図８のダイオード４０では、Ｐ＋型領域２２とＮ−型領域２３との間のＰＮ接合領域２８が平面状に形成され、半導体基板２４の下面から上方に向けて末広がりとなる傾斜側面にＰＮ接合領域２８の端部２８ａが形成される。半導体基板２４が傾斜側面を有するメサ構造のダイオード４０では、図示しないがＮ型半導体領域とＰ型半導体領域との間に形成される空乏層が、Ｐ＋型領域２２とＮ−型領域２３とのＰＮ接合領域２８から半導体基板２４の端部２８ａ付近で幅広く広がる。このため、図８のダイオード４０では、平面ＰＮ接合を構成するＰ＋型領域２２及びＮ−型領域２３の不純物濃度から理論的に算定される値と同等の耐圧値が得られ、高耐圧化が達成される。
本発明の第１の実施の形態を示す図１及び図２のダイオード１０は、第１の半導体領域のＮ＋型領域１と、Ｎ＋型領域１に対向して形成され且つＮ＋型領域１と導電型の異なる第２の半導体領域のＰ＋型領域２と、Ｎ＋型領域１とＰ＋型領域２との間に配置され且つＮ＋型及びＰ＋型領域１、２より低濃度の不純物を含む第３の半導体領域のＮ−型領域３とを半導体基板４に備え、Ｎ＋型領域１及びＰ＋型領域２の各外面に一対の電極５、６が形成され電極６の略中央に窪み６ａを有するツェナダイオードを示す。
図９に示す従来のプレーナ構造のダイオード５０は、図８のダイオード４０と同様に、Ｎ＋型領域２１、Ｎ−型領域２３及びＰ＋型領域２２が形成された半導体基板３４と、Ｎ＋型領域２１及びＰ＋型領域２２の外面にそれぞれ形成された一対の電極２５、２６とを備え、上面を除きＮ−型領域２３によってＰ＋型領域２２を包囲する。Ｐ＋型及びＮ−型領域２２、２３間のＰＮ接合領域３８は、半導体基板３４の上面に形成され且つ保護膜３７により被覆された端部３８ａと、ＰＮ接合が湾曲する曲率部（スリフェリカル部）３８ｂとを備える。図９のダイオード５０を製造する際に、Ｎ−型領域２３の上面全体を酸化して二酸化ケイ素（ＳｉＯ２）の保護膜３７を形成し、保護膜３７を部分的にエッチング除去してＮ−型領域２３の露出した部分に拡散によりＰ＋型領域２２を形成するため、製造中及び製造後も常に保護膜３７によって端部３８ａが被覆され、付着物による耐圧変動が無く信頼性の高いダイオードを得ることができる。
図８に示すメサ構造のダイオード４０では、前記のように理論的に算出される高耐圧値が得られるが、ＰＮ接合領域２８の端部２８ａが露出するため、半導体基板２４の側面に付着したナトリウム等の有害物質によって降伏（ブレークダウン）電圧が変動し易い。図８に示すように、保護膜２７により端部２８ａを被覆しても、保護膜２７の形成前の製造時に不純物が端部２８ａに付着して耐圧性能が劣化し、信頼性の高いダイオードを得ることができない。
これに対し、図９に示すプレーナ構造のダイオード５０は、保護膜３７を形成後に、Ｐ型の不純物源をＮ−型領域２３に拡散するため、横方向の拡散により保護膜３７とＮ−型領域２３との間にＰＮ接合領域３８の端部３８ａが入り込み、端部３８ａが露出しないため、付着物の影響を殆ど受けず、ダイオードの耐圧変動が生じ難い。しかしながら、曲率半径が小さいＰＮ接合領域３８の曲率部３８ｂほど、局所的な電界集中が発生して容易に臨界電界に達するため、図９のプレーナ構造のダイオード５０は、図８のダイオード４０に比べて降伏電圧が低く、高耐圧値を達成できない。また、理論的に算定される耐圧が得られ難いため、素子の設計が難しくなる問題もある。
本実施の形態では、Ｎ＋型領域１及びＮ−型領域３の不純物にリンを用い、Ｐ＋型領域２の不純物にホウ素を用いる。ダイオード１０の上面に形成された凹部７に沿って、Ｐ＋型領域２がＮ＋型領域１上に略均一な厚さで形成され、半導体基板４の内部略中央には、Ｐ＋型領域２の平坦な底面２ａ及び湾曲状の傾斜面２ｂと、Ｎ＋型領域１の内側に形成された皿状凹部１ａとが直接ＰＮ接合する内側接合領域８を備える。内側接合領域８は、Ｎ−型領域３より高濃度の不純物を含むＮ＋型領域１とＰ＋型領域２とが直接接合されて平面ＰＮ接合を形成するため、Ｎ＋型領域１及びＰ＋型領域２の不純物濃度から算定される所望の耐圧が得られる。
Ｎ−型領域３は、内側接合領域８を包囲して環状に形成され且つＰ＋型領域２に対して直接接合される外側接合領域９をＰ＋型領域２と共に形成する。また、Ｎ−型領域３は、Ｎ＋型領域１の皿状凹部１ａに向かって先細となる図２の点線で示す環状の傾斜面３ａと、傾斜面３ａを包囲する水平な平坦面３ｂとを備え、傾斜面３ａ及び平坦面３ｂがＰ＋型領域２にＰＮ接合する。外側接合領域９は、半導体基板４の側面から露出した外端部９ａを備える。高濃度の不純物を含むＰ＋型領域２と低濃度の不純物を含むＮ−型領域３との間に形成された外側接合領域９から広がる空乏層は幅広く形成され、特に低濃度の不純物を含むＮ−型領域３側に広く形成される。このため、逆方向のバイアスが印加されたとき、外側接合領域９の外端部９ａに有害物が付着しても降伏（ブレークダウン）電圧が発生しない。また、本実施の形態では、Ｎ−型領域３の傾斜面３ａ及びＰ＋型領域２の傾斜面２ｂを設けて、外端部９ａから内側接合領域８までの距離を長くし、付着物による耐圧変動を抑制する。
図３に示すように、ダイオード１０を製造する際に、最初に、高濃度のリンを含むＮ＋型領域１が形成された半導体基板４を準備し、Ｎ＋型領域１上にＮ−型領域３を成長させるか又はＮ−型領域３の底部に不純物を拡散してＮ＋型領域１を形成することによって、Ｎ＋型領域１上にＮ−型領域３を設ける。図３（ａ）では、エピタキシャル成長法によって、高濃度の不純物を含むＮ＋型領域１上に低濃度の不純物を含むＮ−型領域３を薄く積層させる。半導体基板上に結晶性を維持して別の結晶層を成長させるエピタキシャル成長法では、成長過程に不純物をドーピングできる。本実施の形態では、図示しない反応容器内にＮ＋型領域１を有する半導体基板４を配置し、１１００〜１２００℃の高温下でモノシラン（ＳｉＨ４）ガス及び水素ガスを流入して、半導体基板４の下地シリコンの結晶格子に倣いシリコン原子を連続的に積層する。同時に、フォスフィン（ＰＨ３）等の不純物のリンを含むドーパンドガスを混合し、Ｎ＋型領域１上にＮ−型領域３を積層する。
次に、半導体基板４の上面に形成されたＮ−型領域３の内側表面をエッチングにより除去して、図３（ｂ）に示すように、Ｎ＋型領域１に達する凹部７を図２の示すようにＮ−型領域３の内側に円形状に形成する。凹部７の最下部７ａをＮ＋型領域１とＮ−型領域３との接合面より上方及び下方の何れに設けてもよいが、本実施の形態では、Ｐ＋型領域２がＮ＋型領域１に確実に接するように、Ｎ＋型領域１内に最下部７ａを設ける。凹部７の側面を曲率半径の大きい緩やかな曲面状に形成し、凹部７の側面を円形の内縁を有するＮ−型領域３によって包囲する。
続いて、Ｎ＋型領域１が露出する凹部７上及び凹部７を包囲するＮ−型領域３上にＮ＋型領域１とは導電型の異なる高濃度の不純物、例えばホウ素を拡散させて、高濃度のホウ素を含むＰ＋型領域２を図３（ｃ）に示すように形成し、第２の半導体領域２とＮ＋型領域１とを直接接合させて内側接合領域８を形成すると共に、Ｐ＋型領域２とＮ−型領域３とを直接接合させて内側接合領域８を包囲する外側接合領域９を形成する。ホウ素の拡散は、例えば不純物源のホウ素を含む固体薄膜をＮ−型領域３及び凹部７に形成して加熱処理する固体拡散法等によって行われる。Ｎ−型領域３及び凹部７に沿ってＰ＋型領域２が形成され、凹部７の最下部７ａに沿ったＰ＋型領域２の平坦な底面２ａをＮ＋型領域１に直接接合させる。Ｐ＋型領域２を形成することによって、Ｎ＋型領域１とＰ＋型領域２との間に、内側接合領域８を包囲してＮ−型領域３が配置され、Ｎ−型領域３の傾斜面３ａ及び平坦面３ｂとＰ＋型領域２とがＰＮ接合する。拡散によって形成されたＰ＋型領域２の厚さは、Ｎ＋型領域１とＮ−型領域３との不純物濃度が相違するため、Ｎ−型領域３で相対的に深く形成され、Ｐ＋型領域２の傾斜面２ｂとＮ−型領域３の傾斜面３ａとの間に若干の段差が生じる。
最後に、Ｎ＋型領域１の下面に平坦な電極５を接続すると共に、Ｐ＋型領域２の上面に窪み６ａを有する電極６を接続して、図１に示すダイオード１０を形成する。更に、一対の電極５、６に導線を結合し樹脂等で封止することにより製品となる。
ダイオード１０では、内側接合領域８に空乏層が狭く形成され、外側接合領域９に空乏層が幅広く形成される。このため、前記ダイオード１０に逆方向の電圧を印加し、電圧がＮ＋型及びＰ＋型領域１、２の不純物濃度等によって定まる理論耐圧を超えると、内側接合領域８において急激に逆方向の電流が流れる降伏（ブレークダウン）を生じる。図９に示すプレーナ構造の半導体素子５０では、曲率部３８ｂに電界が局所的に集中し、この部分で降伏が生じるのに対し、本実施の形態では、不純物濃度の高いＮ＋型領域１とＰ＋型領域２との間の平面状の内側接合領域８に電界を集中させるため、理論値に近似する降伏電圧を得ることができる。このため、ダイオード１０の設計を容易に行える。一方、外側接合領域９では幅広く形成された空乏層が電界集中を緩和し、ブレークダウンを生じない。このため、露出した外端部９ａに有害物が付着してもブレークダウンを生じない。ＰＮ接合の露出する外端部９ａから離間してダイオード１０の略中央に、ブレークダウンを生じる内側接合領域８を設けるため、図８のメサ構造のダイオード４０と異なり、半導体基板４側面の付着物等による影響を受けず降伏電圧が変動しない。
本発明では、前記実施の形態に限定されず、図４〜図７に示すように種々の変更が可能である。図４〜図７に示す第２〜第７の実施の形態では、図１に示す第１の実施の形態とほぼ同様の作用効果が得られる。
図４に示す第２の実施の形態は、図１に比べて第３の半導体領域３を厚く形成すると共に、第３の半導体領域３の傾斜面３ａの断面を平坦に形成したダイオード３０を示す。図４に示すダイオード２０の製法は、最初に、低濃度のリンを含む半導体基板の下面にリンを拡散させて、図５（ａ）に示すように、第３の半導体領域のＮ−型領域３の底部に部分的に、リンを高濃度含む第１の半導体領域のＮ＋型領域１を形成する。次に、図５（ｂ）に示すようにＮ−型領域３の内側をエッチングにより除去して凹部７を形成する。本実施の形態では凹部７の最下部７ａをＮ＋型領域１とＮ−型領域３との接合面より上方に形成する。続いて、Ｎ−型領域３及び凹部７に、Ｎ＋型領域１と導電型が異なる不純物のホウ素を拡散させて、高濃度の不純物を含む第２の半導体領域のＰ＋型領域２を半導体基板１４の上面に形成する。これにより、図５（ｃ）に示すように、半導体基板１４の略中央でＮ＋型領域１とＰ＋型領域２とが直接接合する平坦な内側接合領域８と、内側接合領域８を包囲してＰ＋及びＮ−型領域２、３間に接合する外側接合領域９とが形成される。Ｐ＋型領域２の形成後は、前記ダイオード１０と同様に電極５、６を形成することによって、図４に示すダイオード２０が得られる。
また、図６（ａ）〜（ｃ）に示す第３〜第５の実施の形態では、半導体領域の導電型の配置を変更した各ダイオード２０ａ、２０ｂ、２０ｃを示す。ダイオード２０ａの第１、第２及び第３の半導体領域１、２、３には、Ｎ＋型、Ｐ＋型及びＰ−型の半導体領域が各々形成され、ダイオード２０ｂの第１、第２及び第３の半導体領域１、２、３には、Ｐ＋型、Ｎ＋型及びＰ−型の半導体領域が各々形成され、ダイオード２０ｃの第１、第２及び第３の半導体領域１、２、３には、Ｐ＋型、Ｎ＋型及びＮ−型の半導体領域が各々形成される。図６（ａ）及び（ｃ）に示す各ダイオード２０ａ、２０ｃは、内側接合領域８と外側接合領域９とが略連続した平面状に形成されるため、高耐圧化が容易なダイオードを得ることができる。
図７（ａ）に示す第６の実施の形態は、図４のダイオード２０に対し、第２及び第３の半導体領域２、３間の外側接合領域９の形状を変更したダイオード３０ａを示す。また、図７（ｂ）に示す第７の実施の形態は、図６（ｂ）のダイオード２０ｂに対し、第１及び第３の半導体領域１、３間の接合面の形状を変更したダイオード３０ｂを示す。
産業上の利用可能性
以上のように本発明では、降伏電圧が理論値に近似する理想的な耐圧が得られると共に、付着物等の影響による降伏を防止して、耐圧変動が抑制され信頼性の高い半導体素子を形成することができる。
【図面の簡単な説明】
半導体素子をダイオードに適用した本発明による実施の形態を下記図面について以下説明する。
図１は、本発明による第１の実施の形態のダイオードを示す断面図
図２は、図１に示すダイオードの平面図
図３は、図１に示すダイオードの製法を示す工程断面図
図４は、本発明による第２の実施の形態のダイオードを示す断面図
図５は、図４に示すダイオードの製法を示す工程断面図
図６は、本発明による第３、第４及び第５の実施の形態のダイオードを示す断面図
図７は、本発明による第６及び第７の実施の形態を示すダイオードの断面図
図８は、従来のメサ構造のダイオードを示す断面図
図９は、従来のプレーナ構造のダイオードを示す断面図
【図１】
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【図２】
2003081681.tif 000004
【図３】
2003081681.tif 000005
【図４】
2003081681.tif 000006
【図５】
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【図６】
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【図７】
2003081681.tif 000009
【図８】
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【図９】
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【手続補正書】
【提出日】平成15年7月9日(2003.7.9)
【手続補正１】
【補正対象書類名】明細書
【補正対象項目名】特許請求の範囲
【補正方法】変更
【補正の内容】
【特許請求の範囲】
【請求項１】
（補正後）第１の半導体領域（１）と、該第１の半導体領域（１）とは異なる導電型を有し且つ前記第１の半導体領域（１）の一方の主面上に形成された第２の半導体領域（２）と、前記第１の半導体領域（１）と第２の半導体領域（２）との間に配置され且つ前記第１の半導体領域（１）及び第２の半導体領域（２）よりも不純物濃度の低い第３の半導体領域（３）とを備え、
前記第１の半導体領域（１）と第２の半導体領域（２）との間にＰＮ接合領域が形成され、
前記第３の半導体領域（３）は、前記第２の領域（２）を包囲して環状に形成され且つ前記第１の半導体領域（１）に接合される環状の外側接合領域（９）を形成する半導体素子において、
前記第２の半導体領域（２）は、前記第１の半導体領域（１）に直接接合された皿状凹部と、該皿状凹部を包囲し且つ前記第３の半導体領域（３）を介して前記第１の半導体領域（１）上に配置された平坦部とを有し、
第１の電極（６）は、前記皿状凹部と平坦部とを含む前記第２の半導体領域（２）の主面全体に形成され、
前記第１の半導体領域（１）の他方の主面に第２の電極（５）が形成され、
前記ＰＮ接合領域は、前記外側接合領域（９）の内側に形成され且つ前記外側接合領域（９）よりも前記第１の半導体領域（１）の他方の主面側に位置し、
前記第１の電極（６）の主面に窪み（６ａ）を有することを特徴とする半導体素子。
【請求項２】
（補正後）前記第２の半導体領域（２）は、前記第１の半導体領域（１）に形成された凹部（１ａ）の表面に直接接合される平坦な底面（２ａ）を備える請求項１に記載の半導体素子。
【請求項３】
削除
【請求項４】
削除
【国際調査報告】
2003081681.tif 000012
2003081681.tif 000013
2003081681.tif 000014
2003081681.tif 000015