(57)【要約】【課題】商用交流電源から電源部への電力が供給されている電力供給状態から商用交流電源から電源部への電力が供給されていない電力非供給状態に移行したときのメイン制御部の誤動作を抑制できる、画像形成装置を提供する。【解決手段】電力供給状態から電力非供給状態に移行すると、サブ電源回路１６からサブＡＳＩＣ１４に供給される電圧がサブ電源電圧からバックアップ電圧に切り替わる。サブＡＳＩＣ１４は、その切り替わり、又は、電源部１５からメインＡＳＩＣ１３に供給される電圧が所定値以下の低下、の少なくとも一方が生じた場合に、リセット信号「１」をメインＡＳＩＣ１３に出力する。サブＡＳＩＣ１４は、サブ電源回路１６からサブＡＳＩＣ１４に供給される電圧がサブ電源電圧であり、かつ、電源部１５からメインＡＳＩＣ１３に供給される電圧が所定値以上である場合に、リセット解除信号「０」をメインＡＳＩＣ１３に出力する。【選択図】図１
2019084699.tif 000002
【特許請求の範囲】
【請求項１】
モータを有する画像形成部と、
前記画像形成部を制御するメイン制御部と、
商用電源から電源ラインを通って供給される電力を前記モータと前記メイン制御部とにそれぞれ供給する電源部と、
前記電源ラインに接続されて、前記商用電源から前記電源ラインを通って電力が供給されるサブ電源回路と、
前記サブ電源回路から供給される電力によって作動し、リセット信号、又は、リセット解除信号を前記メイン制御部に出力するサブ制御部と、
前記商用電源から前記電源部へ電力が供給されている電力供給状態から前記商用電源から前記電源部へ電力が供給されない電力非供給状態への移行に伴い、前記サブ電源回路から前記サブ制御部に供給される電圧が第１電圧から前記第１電圧よりも低い第２電圧以下に切り替わるよう構成された電圧降下回路と、
を備え、
前記メイン制御部は、
前記サブ制御部から出力された前記リセット信号を受信した場合に前記メイン制御部自身を初期化し、前記サブ制御部から出力された前記リセット解除信号を受信した場合に前記メイン制御部自身の初期化状態を解除し、
前記サブ制御部は、
前記電圧降下回路による前記第１電圧から前記第２電圧以下への切り替わり、又は、前記電源部から前記メイン制御部に供給される電圧が所定値以下に低下の少なくとも一方が生じた場合、前記リセット信号を前記メイン制御部に出力し、前記サブ電源回路から前記サブ制御部に供給される電圧が前記第１電圧であり、かつ、前記電源部から前記メイン制御部に供給される電圧が前記所定値以上である場合、前記リセット解除信号を前記メイン制御部に出力する、
画像形成装置。
【請求項２】
請求項１に記載の画像形成装置であって、
前記サブ電源回路は、
前記商用電源から供給される電力によって電力が蓄えられる蓄電素子を有し、
前記電力供給状態において前記商用電源から供給される電力を前記サブ制御部へ出力、又は、前記電力非供給状態において前記蓄電素子から供給される電力を前記サブ制御部へ出力し、
前記第１電圧は、前記電力供給状態において前記商用電源から供給される電圧であって、
前記第２電圧は、前記電力非供給状態において前記蓄電素子から供給される電圧である、
画像形成装置。
【請求項３】
請求項２に記載の画像形成装置であって、
前記電源ラインは、一対の給電線を備え、
前記サブ電源回路は、
更に、
第１電極及び第２電極を有し、前記第１電極が前記一対の給電線の一方に接続される第１コンデンサと、
第３電極及び第４電極を有し、前記第３電極が前記一対の給電線の他方に接続される第２コンデンサと、
一対の第１入力端子および出力端子を有し、前記一対の第１入力端子の一方に前記第２電極が接続され、前記一対の第１入力端子の他方に前記第４電極が接続され、前記出力端子が接続線を介して前記サブ制御部に接続されて、前記一対の第１入力端子に入力される交流電力を直流電力に変換して前記出力端子から出力する第１整流平滑回路と、
を備える、
画像形成装置。
【請求項４】
請求項３に記載の画像形成装置であって、
前記電源部は、
一対の第２入力端子を有し、前記一対の第２入力端子の一方に前記一対の給電線の一方が接続され、前記一対の第２入力端子の他方に前記一対の給電線の他方が接続されて、前記一対の第２入力端子に入力される交流電力を直流電力に変換して出力する第２整流平滑回路と、
前記第２整流平滑回路が出力する直流電力を前記第２電圧の直流電力に変換して出力する電源ＩＣと、
を備え、
前記蓄電素子は、第５電極及び第６電極を有し、前記第５電極がグランドに接続され、前記第５電極と前記第６電極との間に印加される前記第２電圧の直流電力により充電され、
前記電圧降下回路は、前記第６電極に一端が接続され、前記接続線に他端が接続されて、前記第６電極から前記接続線に向かう方向に電流を整流する整流回路、を備え、
前記第１整流平滑回路は、前記電力供給状態のときに前記第１電圧を出力する、
画像形成装置。
【請求項５】
請求項４に記載の画像形成装置であって、
前記サブ制御部は、
前記電源部から前記メイン制御部に供給される電圧が前記所定値以下に低下したことに応じて前記リセット信号を出力する第１リセットＩＣと、
前記接続線から入力される電圧の値が前記第１電圧と前記第２電圧との間の値に設定された閾値以下に低下したことに応じて前記リセット信号を出力する第２リセットＩＣと、
を備え、
前記第１リセットＩＣ及び前記第２リセットＩＣの少なくとも一方から前記リセット信号が出力されるとき、前記メイン制御部に前記リセット信号を出力する、
画像形成装置。
【請求項６】
請求項５に記載の画像形成装置であって、
更に、
電源スイッチのオン操作およびオフ操作を受け付ける操作部、
を備え、
前記サブ制御部は、前記電源スイッチの前記オフ操作が前記操作部に受け付けられたことに応じて、前記メイン制御部に前記リセット信号を出力し、前記電源部に対して前記モータ及び前記メイン制御部への電力の供給の停止を指示する、
画像形成装置。
【発明の詳細な説明】
【技術分野】
【０００１】
本発明は、シートに画像を形成する画像形成装置に関する。
【背景技術】
【０００２】
たとえば、下記の特許文献１には、モータを含む画像形成部と、メイン制御回路と、商用交流電源から電源ライン（電源コード）を介して供給される電力を直流電力に変換し、変換された直流電力を画像形成部およびメイン制御回路にそれぞれ供給する電源部と、蓄電素子を有するサブ電源回路と、商用交流電源から電源部への電力が遮断されている場合にサブ電源回路の蓄電素子から供給される直流電力によって駆動されるサブ制御回路と、を有する画像形成装置が開示されている。
【０００３】
この画像形成装置では、サブ制御回路は、操作パネルの操作を検出し、その検出に応じて電源部に対してオン（電力供給）およびオフ（電力供給停止）の指示を行う。また、サブ制御回路は、商用交流電源の交流電圧から生成される直流電圧を検出する。電源部がオフされるか、または、商用交流電源から電源部への電力が遮断されているかにより、サブ制御回路が検出する直流電圧が所定値以下に低下すると、サブ制御回路は、メイン制御回路に対してリセット信号を出力し、メイン制御回路を保護する制御などを行う。
【先行技術文献】
【特許文献】
【０００４】
【特許文献１】特開２０１５−６６８２７号公報
【発明の概要】
【発明が解決しようとする課題】
【０００５】
ところが、商用交流電源から電源部への電力が遮断される場合に、次のような問題があった。
【０００６】
商用交流電源から電源部への電力が遮断されると、サブ制御回路は、直流電圧の所定値以下への低下を検出し、メイン制御回路に対してリセット信号を出力する。一方、画像形成部のモータは、商用交流電源から電源部への電力が遮断された後も直ちには停止せずに惰性（慣性）によって回転する。そのため、モータの惰性回転による回生電圧が直流電圧としてサブ制御回路に入力されて、サブ制御回路が検出する直流電圧が所定値を超えると、商用交流電源から電源部への電力が遮断されているにもかかわらず、サブ制御基板がメイン制御回路に対してリセット解除信号を出力し、メイン制御回路の誤動作が生じる懸念がある。
【０００７】
本発明の目的は、商用電源から電源部への電力が供給されている電力供給状態から商用電源から電源部への電力が供給されていない電力非供給状態に移行したときのメイン制御部の誤動作を抑制できる、画像形成装置を提供することである。
【課題を解決するための手段】
【０００８】
前記の目的を達成するため、本発明の一の局面に係る画像形成装置は、モータを有する画像形成部と、画像形成部を制御するメイン制御部と、商用電源から電源ラインを通って供給される電力をモータとメイン制御部とにそれぞれ供給する電源部と、電源ラインに接続されて、商用電源から電源ラインを通って電力が供給されるサブ電源回路と、サブ電源回路から供給される電力によって作動し、リセット信号、又は、リセット解除信号をメイン制御部に出力するサブ制御部と、商用電源から電源部へ電力が供給されている電力供給状態から商用電源から電源部へ電力が供給されない電力非供給状態への移行に伴い、サブ電源回路からサブ制御部に供給される電圧が第１電圧から第１電圧よりも低い第２電圧以下に切り替わるよう構成された電圧降下回路と、を備え、メイン制御部は、サブ制御部から出力されたリセット信号を受信した場合にメイン制御部自身を初期化し、サブ制御部から出力されたリセット解除信号を受信した場合にメイン制御部自身の初期化状態を解除し、サブ制御部は、電圧降下回路による第１電圧から第２電圧以下への切り替わり、又は、電源部からメイン制御部に供給される電圧が所定値以下に低下の少なくとも一方が生じた場合、リセット信号をメイン制御部に出力し、サブ電源回路からサブ制御部に供給される電圧が第１電圧であり、かつ、電源部からメイン制御部に供給される電圧が所定値以上である場合、リセット解除信号をメイン制御部に出力する。
【０００９】
この構成によれば、電源ラインを電流が流れる電力供給状態では、商用電源から電源ラインを通って電源部に電力が供給され、その電力が画像形成部のモータとメイン制御部とに供給される。一方、電源ラインには、サブ電源回路が接続されており、商用電源から電源ラインを通ってサブ電源回路に電力が供給される。サブ制御部は、サブ電源回路から供給される電力によって作動する。
【００１０】
電力供給状態から電源ラインを電流が流れない電力非供給状態に移行すると、電圧降下回路の機能により、その移行に伴って、サブ電源回路からサブ制御部に供給される電圧が第１電圧から第２電圧以下に切り替わる。サブ制御部は、第１電圧から第２電圧以下への切り替わり、又は、電源部からメイン制御部に供給される電圧が所定値以下の低下の少なくとも一方が生じた場合に、リセット信号をメイン制御部に出力する。メイン制御部は、リセット信号を受けて、メイン制御部自身を初期化する。これにより、メイン制御部への供給電圧の低下によるメイン制御部の誤動作（暴走）を抑制することができる。
【００１１】
リセット信号の出力後、サブ制御部は、サブ電源回路からサブ制御部に供給される電圧が第１電圧であり、かつ、電源部からメイン制御部に供給される電圧が所定値以上である場合に、リセット解除信号をメイン制御部に出力する。メイン制御部は、リセット解除信号を受けて、メイン制御部自身の初期化状態を解除する。
【００１２】
電力供給状態から電力非供給状態に移行し、電源部からメイン制御部に供給される電圧が所定値以下に低下した後に、画像形成部のモータの惰性回転による回生電圧が発生し、その回生電圧により電源部からメイン制御部に供給される電圧が所定値以上に上昇する場合がある。この場合においても、サブ電源回路からサブ制御部に供給される電圧が第１電圧でなければ、サブ制御部からメイン制御部にリセット解除信号が出力されない。よって、電力供給状態から電力非供給状態に移行したときに、メイン制御部が初期化状態の解除による誤動作を起こすことを抑制できる。
【発明の効果】
【００１３】
本発明によれば、商用電源から電源部への電力が供給されている電力供給状態から商用電源から電源部への電力が供給されていない電力非供給状態に移行したときのメイン制御部の誤動作を抑制することができる。
【図面の簡単な説明】
【００１４】
【図１】本発明の一実施形態に係る画像形成装置の電気的構成を示す図である。
【図２】図１に示される電気的構成の要部を示す図である。
【図３】画像形成装置の各状態におけるリセット信号及びリセット解除信号の出力状態を示す図である。
【図４】商用交流電源から電源部への電力が遮断されたときにサブＡＳＩＣに入力される電圧の時間変化を示す図である。
【図５】第２実施形態について説明するためのフローチャートである。
【発明を実施するための形態】
【００１５】
以下では、本発明の実施の形態について、添付図面を参照しつつ詳細に説明する。
【００１６】
＜画像形成装置の電気的構成＞
図１に示される画像形成装置１は、いわゆるプリンタであり、画像形成部１１、操作部１２、メインＡＳＩＣ（Application Specific Integrated Circuit）１３、サブＡＳＩＣ１４、電源部１５及びサブ電源回路１６を備えている。
【００１７】
画像形成部１１は、搬送経路を１枚ずつ搬送されるプリント用紙などのシートにカラー画像またはモノクロ画像を形成する電子写真方式の機構である。画像形成部１１には、レーザ光を出力する光源、ポリゴンミラー、ポリゴンモータを備えるスキャナ部や、シートを搬送する搬送ローラを備える搬送部を有し、ポリゴンミラーの回転や、搬送ローラなどの駆動力を発生するモータ１７が備えられている。
【００１８】
操作部１２は、各種の指示を入力するために操作される操作スイッチを備えている。操作スイッチには、押操作によりオン及びオフが交互に切り替わる電源スイッチ２１が含まれる。
【００１９】
メインＡＳＩＣ１３（メイン制御部の一例）は、ＣＰＵ（Central Processing Unit）を内蔵している。メインＡＳＩＣ１３には、操作部１２の操作スイッチの操作に応じた信号などが入力される。メインＡＳＩＣ１３のＣＰＵは、メインＡＳＩＣ１３に入力される情報に基づいて、メインＡＳＩＣ１３に接続されたフラッシュメモリなどの書き換え可能な不揮発性メモリであるＲＯＭ（Read Only Memory）に格納されているプログラムを実行することにより、各種の処理を実行し、画像形成部１１の動作などを制御する。
【００２０】
サブＡＳＩＣ１４（サブ制御部の一例）は、ＣＰＵを内蔵している。サブＡＳＩＣ１４には、操作部１２の操作スイッチの操作に応じた信号などが入力される。サブＡＳＩＣ１４の機能については、後述する。
【００２１】
電源部１５は、低圧電源部２２及び電圧変換回路２３を含む。
【００２２】
低圧電源部２２は、外部の商用交流電源ＡＣから電源ライン（電源コード）２４を介して供給される交流電力を直流電力に変換する。商用交流電源ＡＣは、たとえば、ＡＣ１００Ｖ電源である。
【００２３】
具体的には、低圧電源部２２は、整流平滑回路２５（第２整流平滑回路の一例）、変圧器２６および制御ＩＣ（Integrated Circuit）２７を備えている。電源ライン２４は、一対の給電線２４Ａ，２４Ｂを備えている。
【００２４】
整流平滑回路２５は、一対の入力端子２５Ａ，２５Ｂを有している。一方の入力端子２５Ａには、一方の給電線２４Ａが接続され、他方の入力端子２５Ｂには、他方の給電線２４Ｂが接続されている。また、整流平滑回路２５は、たとえば、一対の入力端子２５Ａ，２５Ｂに１次コイルの両端が接続されたトランスと、４個のダイオードをブリッジ接続して構成され、一対の入力端がトランスの２次コイルの両端に接続されたブリッジ回路と、ブリッジ回路の一対の出力端の一方に電極の一方が接続され、出力端の他方に電極の他方が接続されたコンデンサとを含む。この構成により、電源ライン２４（一対の給電線２４Ａ，２４Ｂ）から整流平滑回路２５の一対の入力端子２５Ａ，２５Ｂに入力される交流電力は、整流平滑回路２５で所定電圧の直流電力に変換されて、整流平滑回路２５から出力される。
【００２５】
変圧器２６は、整流平滑回路２５から出力される直流電力を所定の駆動電圧（たとえば、２４Ｖ）に変圧して出力する。
【００２６】
制御ＩＣ２７は、変圧器２６を制御して、変圧器２６から直流電力を出力させ、また、その直流電力の出力を停止させる。
【００２７】
電圧変換回路２３は、低圧電源部２２の変圧器２６から出力される直流電力を、必要に応じて降圧して、画像形成装置１の各部に供給する。
【００２８】
具体的には、電圧変換回路２３は、低圧電源部２２の変圧器２６から出力される所定の駆動電圧の直流電力を降圧せずに画像形成部１１のモータ１７に供給する。
【００２９】
また、電圧変換回路２３は、第１電源ＩＣ２８および第２電源ＩＣ２９（電源ＩＣの一例）を備えている。第１電源ＩＣ２８および第２電源ＩＣ２９には、たとえば、リニアレギュレータが内蔵されている。
【００３０】
第１電源ＩＣ２８は、低圧電源部２２の変圧器２６から出力される所定の駆動電圧の直流電力を所定のバックアップ電圧（Ｖ＿ＢＡＣＫＵＰ）に降圧して出力する。バックアップ電圧は、たとえば、５Ｖである。
【００３１】
第２電源ＩＣ２９は、低圧電源部２２の変圧器２６から出力される所定の駆動電圧の直流電力を所定のＩＣ動作電圧（ＶＤＤ）に降圧して出力する。ＩＣ動作電圧は、たとえば、３．３Ｖである。第２電源ＩＣ２９から出力される直流電力は、メインＡＳＩＣ１３に動作電力として供給される。また、第２電源ＩＣ２９から出力される直流電力は、サブＡＳＩＣ１４に入力される。
【００３２】
サブ電源回路１６は、電源ライン２４に接続されて、商用交流電源ＡＣから電源ライン２４を介して交流電力の供給を受ける。サブ電源回路１６は、第１コンデンサＣ１、第２コンデンサＣ２、整流平滑回路３１（第１整流平滑回路の一例）、バックアップコンデンサ３２（蓄電素子の一例）及び電圧降下回路３３を備えている。
【００３３】
第１コンデンサＣ１は、第１電極３４及び第２電極３５を有している。第１電極３４は、電源ライン２４の一方の給電線２４Ａに接続線３６Ａを介して接続されている。
【００３４】
第２コンデンサＣ２は、第３電極３７及び第４電極３８を有している。第３電極３７は、電源ライン２４の他方の給電線２４Ｂに接続線３６Ｂを介して接続されている。
【００３５】
整流平滑回路３１は、一対の入力端子４１Ａ，４１Ｂを有している。一方の入力端子４１Ａには、第１コンデンサＣ１の第２電極３５が接続されている。他方の入力端子４１Ｂには、第２コンデンサＣ２の第４電極３８が接続されている。電源ライン２４から供給される交流電力は、第１コンデンサＣ１及び第２コンデンサＣ２のインピーダンスによりその電圧の振幅が小さく抑制されて、整流平滑回路３１の一対の入力端子４１Ａ，４１Ｂに入力される。整流平滑回路３１は、低圧電源部２２の整流平滑回路２５と同様の構成を有しており、一対の入力端子４１Ａ，４１Ｂに入力される交流電力を所定のサブ電源電圧（ＡＣ＿ＤＩＲＥＣＴ＿ＶＤＤ）の直流電力に変換して、出力端子４１Ｃから出力する。所定のサブ電源電圧は、バックアップ電圧よりも大きい値に設定されている。バックアップ電圧が５Ｖである場合、所定のサブ電源電圧は、たとえば、６Ｖに設定されている。
【００３６】
バックアップコンデンサ３２は、第５電極４２及び第６電極４３を有している。第５電極４２は、グランドライン（Ｖｇｄ）に接続されている。第６電極４３には、第１ダイオード４４および抵抗４５の直列回路が接続されている。具体的には、第１ダイオード４４は、アノードが第１電源ＩＣ２８の出力端子ＯＵＴ２に接続され、カソードが抵抗４５の一端に接続されている。第６電極４３は、抵抗４５の他端に接続されている。これにより、第１電源ＩＣ２８の出力端子ＯＵＴ２から電圧が出力されるときに、その電圧がバックアップコンデンサ３２の第５電極４２と第６電極４３との間に印加され、バックアップコンデンサ３２が充電される。
【００３７】
電圧降下回路３３は、サブ電源回路１６に組み込まれている。電圧降下回路３３は、第２ダイオード４６を備えている。第２ダイオード４６は、アノードが第６電極４３に接続され、カソードが整流平滑回路３１の出力端子４１ＣとサブＡＳＩＣ１４とを接続する配線４７に接続されている。
【００３８】
＜サブＡＳＩＣの構成＞
サブＡＳＩＣ１４は、配線４７から入力される直流電力により動作する。サブＡＳＩＣ１４は、図２に示されるように、第１リセットＩＣ５１及び第２リセットＩＣ５２を備えている。
【００３９】
第１リセットＩＣ５１の第１電源端子５３及び第２リセットＩＣ５２の電源端子５４には、配線４８が接続されている。これにより、整流平滑回路３１の出力端子４１Ｃから直流電力が出力されるときには、その直流電力が第１リセットＩＣ５１の第１電源端子５３及び第２リセットＩＣ５２の電源端子５４に入力される。一方、整流平滑回路３１の出力端子４１Ｃから直流電力が出力されないときには、バックアップコンデンサ３２の電圧が第１リセットＩＣ５１の第１電源端子５３及び第２リセットＩＣ５２の電源端子５４に入力される。また、第２電源ＩＣ２９から出力される電圧（ＶＤＤ）が第１リセットＩＣ５１の第２電源端子５５に入力される。
【００４０】
第１リセットＩＣ５１は、第２電源端子５５に入力される電圧の値が所定値（たとえば、２．４Ｖ）以上であるときに、リセット解除信号「０（ローレベル）」を出力し、第２電源端子５５に入力される電圧の値が所定値未満であるときに、リセット信号「１（ハイレベル）」を出力端子５６から出力する。第１リセットＩＣ５１の出力端子５６からのリセット解除信号「０」及びリセット信号「１」は、メインＡＳＩＣ１３のリセット端子５７に入力される。
【００４１】
第２リセットＩＣ５２は、電源端子５４に入力される電圧の値がサブ電源電圧であるときに、リセット解除信号「０（ローレベル）」を出力し、電源端子５４に入力される電圧の値がサブ電源電圧（ＡＣ＿ＤＩＲＥＣＴ＿ＶＤＤ）とバックアップ電圧（Ｖ＿ＢＡＣＫＵＰ）の間に設定された閾値以下に低下したことに応じて、リセット信号「１（ハイレベル）」を出力端子５８から出力する。第２リセットＩＣ５２の出力端子５８からのリセット解除信号「０」及びリセット信号「１」は、メインＡＳＩＣ１３のリセット端子５７に入力される。
【００４２】
＜サブＡＳＩＣの動作＞
電源ライン２４が商用交流電源ＡＣに接続されている電力供給状態、かつ、操作部１２の電源スイッチ２１がオンである状態では、低圧電源部２２の変圧器２６から直流電力が出力されており、その直流電力が画像形成部１１に供給されている。また、変圧器２６から出力される直流電力が第２電源ＩＣ２９によりＩＣ動作電圧に降圧されて、メインＡＳＩＣ１３およびサブＡＳＩＣ１４に動作電力として供給されている。そのため、メインＡＳＩＣ１３のＣＰＵによる画像形成部１１の制御が可能であり、画像形成部１１による画像形成動作が可能である。
【００４３】
また、サブＡＳＩＣ１４にＩＣ動作電圧の直流電力が供給されているので、第１リセットＩＣ５１の第２電源端子５５には、所定値以上の電圧であるＩＣ動作電圧が入力されている。そのため、第１リセットＩＣ５１は、図３に示されるように、出力端子５６からリセット解除信号「０」を出力している。一方、電源ライン２４が商用交流電源ＡＣに接続されているので、サブ電源回路１６の整流平滑回路３１の出力端子４１Ｃからサブ電源電圧の直流電力が出力され、そのサブ電源電圧が第２リセットＩＣ５２の電源端子５４に入力されている。そのため、第２リセットＩＣ５２は、出力端子５８からリセット解除信号「０」を出力している。
【００４４】
第１リセットＩＣ５１の出力端子５６及び第２リセットＩＣ５２の出力端子５８の両方からリセット解除信号「０」が出力されているので、メインＡＳＩＣ１３のリセット端子５７には、それらの論理和であるリセット解除信号「０」が入力される。メインＡＳＩＣ１３のリセット端子５７にリセット解除信号「０」が入力されている状態では、メインＡＳＩＣ１３は、メインＡＳＩＣ１３自身の初期化状態を解除する。
【００４５】
電源ライン２４が商用交流電源ＡＣに接続されている電力供給状態で、操作部１２の電源スイッチ２１が押操作によりオンからオフに切り替えられると、操作部１２からオフ信号Ｘ１が出力される。メインＡＳＩＣ１３のＣＰＵは、オフ信号Ｘ１の受信に応じて、サブＡＳＩＣ１４にオフ命令Ｙ１を送信する。サブＡＳＩＣ１４は、オフ命令Ｙ１の受信に応じて、制御ＩＣ２７に停止信号Ｚ２を送信する。制御ＩＣ２７は、停止信号Ｚ２の受信に応じて、低圧電源部２２の変圧器２６に直流電力の出力を停止させる。これにより、第１電源ＩＣ２８及び第２電源ＩＣ２９からの直流電力の出力が停止する。
【００４６】
第２電源ＩＣ２９からの直流電力の出力が停止すると、サブＡＳＩＣ１４の第１リセットＩＣ５１の第２電源端子５５に入力される電圧が所定値未満に低下する。これに応じて、第１リセットＩＣ５１は、出力端子５６からリセット信号「１」を出力する。一方、電源ライン２４が商用交流電源ＡＣに接続されているので、サブ電源回路１６の整流平滑回路３１の出力端子４１Ｃからのサブ電源電圧の直流電力の出力は継続する。そのため、第２リセットＩＣ５２は、出力端子５８からリセット解除信号「０」を出力し続けている。
【００４７】
第１リセットＩＣ５１の出力端子５６からリセット信号「１」が出力され、第２リセットＩＣ５２の出力端子５８からリセット解除信号「０」が出力されているので、メインＡＳＩＣ１３のリセット端子５７には、リセット信号「１」とリセット解除信号「０」との論理和であるリセット信号「１」が入力される。メインＡＳＩＣ１３では、リセット端子５７にリセット信号「１」が入力されたことに応じて、誤動作防止のため、メインＡＳＩＣ１３に内蔵されているレジスタを初期値に書き換えるなどの初期化が実行される。
【００４８】
電源ライン２４が商用交流電源ＡＣに接続されている電力供給状態で、操作部１２の電源スイッチ２１がユーザの押操作によりオフからオンに切り替えられると、操作部１２からオン信号Ｙ２が出力される。サブＡＳＩＣ１４のＣＰＵは、オン信号Ｙ２の受信に応じて、制御ＩＣ２７に起動信号Ｚ１を送信する。制御ＩＣ２７は、起動信号Ｚ１の受信に応じて、低圧電源部２２の変圧器２６に直流電力の出力を開始させる。変圧器２６から直流電力が出力されることにより、その直流電力が画像形成部１１に供給される。また、変圧器２６から出力される直流電力が第２電源ＩＣ２９によりＩＣ動作電圧に降圧されて、メインＡＳＩＣ１３およびサブＡＳＩＣ１４に動作電力として供給される。
【００４９】
サブＡＳＩＣ１４にＩＣ動作電圧の直流電力が供給されると、サブＡＳＩＣ１４の第１リセットＩＣ５１の第２電源端子５５に、所定値以上の電圧であるＩＣ動作電圧が入力される。これに応じて、第１リセットＩＣ５１の出力端子５６からリセット解除信号「０」が出力される。一方、電源ライン２４が商用交流電源ＡＣに接続されているので、サブ電源回路１６の整流平滑回路３１の出力端子４１Ｃからのサブ電源電圧の直流電力の出力は継続する。そのため、第２リセットＩＣ５２は、出力端子５８からリセット解除信号「０」を出力し続けている。
【００５０】
第１リセットＩＣ５１の出力端子５６及び第２リセットＩＣ５２の出力端子５８の両方からリセット解除信号「０」が出力されているので、メインＡＳＩＣ１３のリセット端子５７には、それらの論理和であるリセット解除信号「０」が入力される。
【００５１】
電源ライン２４が商用交流電源ＡＣに接続され、操作部１２の電源スイッチ２１がオンである状態から、例えば、電源ライン２４が商用交流電源ＡＣから抜かれると、商用交流電源ＡＣから低圧電源部２２へ電力が供給されない電力非供給状態となり、電源ライン２４から低圧電源部２２の整流平滑回路２５への交流電力の入力がなくなる。そのため、変圧器２６からの直流電力の出力が停止し、第１電源ＩＣ２８および第２電源ＩＣ２９から出力される電圧が低下する。
【００５２】
第２電源ＩＣ２９からサブＡＳＩＣ１４の第１リセットＩＣ５１の第２電源端子５５に入力される電圧が所定値未満に低下する。これに応じて、第１リセットＩＣ５１は、出力端子５６からリセット信号「１」を出力する。
【００５３】
また、電源ライン２４からサブ電源回路１６への交流電力の入力がなくなる。これに伴って、サブ電源回路１６の整流平滑回路３１の出力端子４１Ｃからの直流電力の出力が停止し、図４に示されるように、出力端子４１Ｃに接続されている配線４７に印加されている電圧がサブ電源電圧（ＡＣ＿ＤＩＲＥＣＴ＿ＶＤＤ）から急峻に低下する。配線４７には、整流作用を有する第２ダイオード４６を含む電圧降下回路３３を介して、バックアップコンデンサ３２が接続されている。そのため、整流平滑回路３１の出力端子４１Ｃから出力される電圧がバックアップコンデンサ３２の電圧であるバックアップ電圧（Ｖ＿ＢＡＣＫＵＰ）まで低下すると、配線４７の電位がバックアップコンデンサ３２の第６電極４３の電位に維持される。整流平滑回路３１の出力端子４１Ｃから出力される電圧がバックアップ電圧まで急峻に低下する過程において、配線４７から第２リセットＩＣ５２の電源端子５４に入力される電圧の値が閾値以下に低下するので、これに応じて、第２リセットＩＣ５２は、出力端子５８からリセット信号「１」を出力する。
【００５４】
第１リセットＩＣ５１の出力端子５６及び第２リセットＩＣ５２の出力端子５８の両方からリセット信号「１」が出力されているので、メインＡＳＩＣ１３のリセット端子５７には、それらの論理和であるリセット信号「１」が入力される。メインＡＳＩＣ１３では、リセット端子５７にリセット信号「１」が入力されたことに応じて、メインＡＳＩＣ１３自身の初期化が実行される。
【００５５】
画像形成部１１のモータ１７の動作中に商用交流電源ＡＣから低圧電源部２２へ電力が供給されない電力非供給状態になると、電源ライン２４から低圧電源部２２の整流平滑回路２５への交流電力の入力がなくなるので、変圧器２６からの直流電力の出力が停止し、モータ１７への電力の供給がなくなる。このとき、モータ１７は、変圧器２６からの電力の供給がなくなっても、直ちには停止せずに惰性（慣性）によって回転する。そのため、モータ１７の惰性回転による回生電圧が直流電圧として発生し、その直流電圧が第２電源ＩＣ２９に入力されることにより、第２電源ＩＣ２９からサブＡＳＩＣ１４の第１リセットＩＣ５１の第２電源端子５５に入力される電圧の値が所定値を上回る場合がある。この場合、第２電源端子５５に入力される電圧の値が所定値を上回ったことに応じて、第１リセットＩＣ５１は、出力端子５６からリセット解除信号「０」を出力する。
【００５６】
一方、モータ１７に回生電圧が発生しても、その回生電圧は、サブ電源回路１６に入力されない。そのため、配線４７から第２リセットＩＣ５２の電源端子５４に入力される電圧の値は閾値以下のままであり、第２リセットＩＣ５２は、出力端子５８からリセット信号「１」を出力し続けている。
【００５７】
第１リセットＩＣ５１の出力端子５６からリセット解除信号「０」が出力され、第２リセットＩＣ５２の出力端子５８からリセット信号「１」が出力されているので、メインＡＳＩＣ１３のリセット端子５７には、リセット解除信号「０」とリセット信号「１」との論理和であるリセット信号「１」が入力される。メインＡＳＩＣ１３では、リセット端子５７にリセット信号「１」が入力されたことに応じて、メインＡＳＩＣ１３自身の初期化が実行される。
【００５８】
＜作用効果＞
以上のように、電源ライン２４を電流が流れる電力供給状態では、商用交流電源ＡＣから電源ライン２４を通って電源部１５に交流電力が供給され、電源部１５でその交流電力が直流電力に変換されて、電源部１５から画像形成部１１のモータ１７、メインＡＳＩＣ１３およびサブＡＳＩＣ１４に供給される。一方、電源ライン２４には、サブ電源回路１６が接続されており、商用交流電源ＡＣから電源ライン２４を通ってサブ電源回路１６に電力が供給される。サブＡＳＩＣ１４は、サブ電源回路１６から供給される電力によって作動する。
【００５９】
電力供給状態から電源ライン２４を電流が流れない電力非供給状態に移行すると、電圧降下回路３３の機能により、その移行に伴って、サブ電源回路１６からサブＡＳＩＣ１４に供給される電圧が第１電圧の一例であるサブ電源電圧（ＡＣ＿ＤＩＲＥＣＴ＿ＶＤＤ）から第２電圧の一例であるバックアップ電圧（Ｖ＿ＢＡＣＫＵＰ）以下に切り替わる。サブＡＳＩＣ１４は、サブ電源電圧からバックアップ電圧以下への切り替わり、又は、電源部１５からメインＡＳＩＣ１３に供給される電圧が所定値以下の低下、の少なくとも一方が生じた場合に、リセット信号「１」をメインＡＳＩＣ１３に出力する。メインＡＳＩＣ１３は、リセット信号「１」を受けて、メインＡＳＩＣ１３自身を初期化する。これにより、メインＡＳＩＣ１３への供給電圧の低下によるメインＡＳＩＣ１３の誤動作（暴走）を抑制することができる。
【００６０】
リセット信号「１」の出力後、サブＡＳＩＣ１４は、サブ電源回路１６からサブＡＳＩＣ１４に供給される電圧がサブ電源電圧であり、かつ、電源部１５からメインＡＳＩＣ１３に供給される電圧が所定値以上である場合に、リセット解除信号「０」をメインＡＳＩＣ１３に出力する。メインＡＳＩＣ１３は、リセット解除信号「０」を受けて、メインＡＳＩＣ１３自身の初期化状態を解除する。
【００６１】
電力供給状態から電力非供給状態に移行し、電源部１５からメインＡＳＩＣ１３に供給される電圧が所定値以下に低下した後に、画像形成部１１のモータ１７の惰性回転による回生電圧が発生し、その回生電圧により電源部１５からメインＡＳＩＣ１３に供給される電圧が所定値以上に上昇する場合がある。この場合にも、サブ電源回路１６からサブＡＳＩＣ１４に供給される電圧がサブ電源電圧に戻らないので、サブＡＳＩＣ１４からメインＡＳＩＣ１３にリセット解除信号「０」が出力されない。よって、電力供給状態から電力非供給状態に移行したときに、メインＡＳＩＣ１３が初期化状態の解除による誤動作を起こすことを抑制できる。
【００６２】
＜第２実施形態＞
前述の実施形態では、サブＡＳＩＣ１４に第１リセットＩＣ５１及び第２リセットＩＣ５２が備えられて、第１リセットＩＣ５１から出力されるリセット解除信号「０」又はリセット信号「１」と第２リセットＩＣ５２から出力される信号リセット解除信号「０」又はリセット信号「１」との論理和が取られて、その論理和によるリセット解除信号「０」又はリセット信号「１」がメインＡＳＩＣ１３のリセット端子５７に入力される構成を取り上げた。
【００６３】
この構成による機能は、サブＡＳＩＣ１４におけるプログラム処理によってソフトウエア的に実現されてもよい。すなわち、サブＡＳＩＣ１４のＣＰＵにより、図５に示される処理が実行されてもよい。
【００６４】
図５に示される処理では、サブＡＳＩＣ１４のＣＰＵは、第２電源ＩＣ２９から入力される電圧が所定値以上であり、かつ、サブ電源回路１６からサブＡＳＩＣ１４にサブ電源電圧の直流電力が入力されている場合に（Ｓ１：ＹＥＳ）、メインＡＳＩＣ１３のリセット端子５７にリセット解除信号「０」を入力する（Ｓ２）。
【００６５】
一方、サブＡＳＩＣ１４のＣＰＵは、第２電源ＩＣ２９から入力される電圧が所定値未満である場合、メインＡＳＩＣ１３のリセット端子５７にリセット信号「１」を入力する（Ｓ３）。また、サブＡＳＩＣ１４のＣＰＵは、商用交流電源ＡＣから低圧電源部２２へ電力が供給されないために、サブ電源回路１６からサブＡＳＩＣ１４にサブ電源電圧の直流電力が入力されておらず、サブ電源回路１６からサブＡＳＩＣ１４に入力される電圧がサブ電源電圧（ＡＣ＿ＤＩＲＥＣＴ＿ＶＤＤ）とバックアップ電圧（Ｖ＿ＢＡＣＫＵＰ）の間に設定された閾値以下である場合、メインＡＳＩＣ１３のリセット端子５７にリセット信号「１」を入力する（Ｓ３）。
【００６６】
サブ電源回路１６のバックアップコンデンサ３２から出力される直流電圧は、緩やかに電圧降下するため、バックアップコンデンサ３２の電圧からは、電源ライン２４が商用交流電源ＡＣに接続されているか否かの判断に時間がかかる。電圧降下回路３３が組み込まれたサブ電源回路１６の構成では、商用交流電源ＡＣから低圧電源部２２へ電力が供給されない場合に、サブ電源回路１６からサブＡＳＩＣ１４に入力される電圧がサブ電源電圧から閾値よりも低いバックアップ電圧まで急峻に低下する。そのため、サブ電源回路１６からサブＡＳＩＣ１４に入力される電圧が閾値以下に低下したことに応じて、サブＡＳＩＣ１４のＣＰＵがメインＡＳＩＣ１３のリセット端子５７にリセット信号「１」を入力することにより、商用交流電源ＡＣから低圧電源部２２へ電力供給停止からメインＡＳＩＣ１３の初期化が実行されるまでの時間を短縮でき、メインＡＳＩＣ１３が誤動作を起こすことを抑制できる。
【００６７】
＜変形例＞
以上、本発明の実施の形態について説明したが、本発明は、さらに他の形態で実施することもでき、前述の構成には、特許請求の範囲に記載された事項の範囲で種々の設計変更を施すことが可能である。
【符号の説明】
【００６８】
１：画像形成装置  １１：画像形成部  １２：操作部  １３：メインＡＳＩＣ
１４：サブＡＳＩＣ  １５：電源部  １６：サブ電源回路  １７：モータ  
２１：電源スイッチ  ２４：電源ライン  ２４Ａ，２４Ｂ：給電線
２５：整流平滑回路  ２５Ａ，２５Ｂ：入力端子  ２９：第２電源ＩＣ
３１：整流平滑回路  ３２：バックアップコンデンサ  ３３：電圧降下回路
３４：第１電極  ３５：第２電極  ３７：第３電極  ３８：第４電極  
４１Ａ，４１Ｂ：入力端子  ４２：第５電極  ４３：第６電極
４６：第２ダイオード  ＡＣ：商用交流電源  Ｃ１：第１コンデンサ
Ｃ２：第２コンデンサ  ５１：第１リセットＩＣ  ５２：第２リセットＩＣ
【図１】
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【図２】
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【図３】
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【図４】
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【図５】
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