(57)【要約】【課題】様々なインタフェースを実現することができる送信装置を得る。【解決手段】本開示の送信装置は、第１の動作モードにおいて、第１の出力端子の電圧を第１の電圧または第２の電圧に選択的に設定し、第２の動作モードにおいて、第１の出力端子の電圧を第３の電圧、第４の電圧、および第５の電圧のいずれかに選択的に設定する送信部を備える。【選択図】図２
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【特許請求の範囲】
【請求項１】
第１の動作モードにおいて、第１の出力端子の電圧を第１の電圧または第２の電圧に選択的に設定し、第２の動作モードにおいて、前記第１の出力端子の電圧を第３の電圧、第４の電圧、および第５の電圧のいずれかに選択的に設定する送信部を備えた
送信装置。
【請求項２】
前記送信部は、前記第１の動作モードにおいて、第２の出力端子の電圧を前記第１の電圧または前記第２の電圧に選択的に設定する
請求項１に記載の送信装置。
【請求項３】
前記送信部は、前記第２の動作モードにおいて、第２の出力端子の電圧を前記第３の電圧、前記第４の電圧、および前記第５の電圧のいずれかに選択的に設定するとともに、第３の出力端子の電圧を前記第３の電圧、前記第４の電圧、および前記第５の電圧のいずれかに選択的に設定する
請求項１または請求項２に記載の送信装置。
【請求項４】
各出力端子の電圧は互いに異なる
請求項２または請求項３に記載の送信装置。
【請求項５】
前記送信部は、
第１の信号および第２の信号のうちの一方を選択して出力する第１のセレクタと、
前記第１の信号の反転信号、前記第２の信号、および前記第２の信号の反転信号のうちのいずれかを選択して出力する第２のセレクタと、
前記第１の信号、前記第２の信号、および第３の信号に基づいて、第１の制御信号、第２の制御信号、および第３の制御信号を生成する第１の制御信号生成部と、
前記第１のセレクタの出力信号および前記第１の制御信号に基づいて前記第１の出力端子の電圧を設定する第１のドライバ部と、
前記第２のセレクタの出力信号および前記第２の制御信号に基づいて前記第２の出力端子の電圧を設定する第２のドライバ部と、
前記第３の出力端子の電圧を設定する第３のドライバ部と
を有する
請求項３に記載の送信装置。
【請求項６】
前記第１の動作モードにおいて、
前記第１のセレクタは、前記第１の信号および前記第２の信号を交互に選択し、
前記第２のセレクタは、前記第１のセレクタが前記第１の信号を選択する際に前記第１の信号の反転信号を選択し、前記第１のセレクタが前記第２の信号を選択する際に前記第２の信号の反転信号を選択し、
前記第１のドライバ部は、前記第１のセレクタの出力信号に基づいて、前記第１の出力端子の電圧を第１の電圧または第２の電圧に選択的に設定し、
前記第２のドライバ部は、前記第２のセレクタの出力信号に基づいて、前記第２の出力端子の電圧を前記第１の電圧または前記第２の電圧に選択的に設定する
請求項５に記載の送信装置。
【請求項７】
前記第２の動作モードにおいて、
前記第１のセレクタは、前記第１の信号を選択し、
前記第２のセレクタは、前記第２の信号を選択し、
前記第１のドライバ部は、前記第１の制御信号が第１の論理である場合には、前記第１のセレクタの出力信号に基づいて、前記第１の出力端子の電圧を前記第３の電圧または前記第４の電圧に選択的に設定し、前記第１の制御信号が第２の論理である場合には、前記第１の出力端子の電圧を前記第５の電圧に設定し、
前記第２のドライバ部は、前記第２の制御信号が前記第１の論理である場合には、前記第２のセレクタの出力信号に基づいて、前記第２の出力端子の電圧を前記第３の電圧または前記第４の電圧に選択的に設定し、前記第２の制御信号が前記第２の論理である場合には、前記第２の出力端子の電圧を前記第５の電圧に設定する
請求項６に記載の送信装置。
【請求項８】
第３の動作モードにおいて、
前記第１のセレクタは、前記第１の信号を選択し、
前記第２のセレクタは、前記第２の信号を選択し、
前記第１のドライバ部は、前記第１のセレクタの出力信号に基づいて、前記第１の出力端子の電圧を第６の電圧または第７の電圧に選択的に設定し、
前記第２のドライバ部は、前記第２のセレクタの出力信号に基づいて、前記第２の出力端子の電圧を前記第６の電圧または前記第７の電圧に選択的に設定する
請求項６または請求項７に記載の送信装置。
【請求項９】
前記送信部は、
前記第３の信号および第４の信号のうちの一方を選択して出力する第３のセレクタと、
前記第３の信号の反転信号、前記第４の信号、および前記第４の信号の反転信号のうちのいずれかを選択して出力する第４のセレクタと、
前記第４のセレクタの出力信号に基づいて第４の出力端子の電圧を設定する第４のドライバ部と
をさらに有し、
前記第３のドライバ部は、前記第３のセレクタの出力信号および前記第３の制御信号に基づいて前記第３の出力端子の電圧を設定する
請求項７に記載の送信装置。
【請求項１０】
前記第１の動作モードにおいて、
前記第３のセレクタは、前記第３の信号および前記第４の信号を交互に選択し、
前記第４のセレクタは、前記第３のセレクタが前記第３の信号を選択する際に前記第３の信号の反転信号を選択し、前記第３のセレクタが前記第４の信号を選択する際に前記第４の信号の反転信号を選択し、
前記第３のドライバ部は、前記第３のセレクタの出力信号に基づいて、前記第３の出力端子の電圧を前記第１の電圧または前記第２の電圧に選択的に設定し、
前記第４のドライバ部は、前記第４のセレクタの出力信号に基づいて、前記第４の出力端子の電圧を前記第１の電圧または前記第２の電圧に選択的に設定する
請求項９に記載の送信装置。
【請求項１１】
前記第２の動作モードにおいて、
前記第３のセレクタは、前記第３の信号を選択し、
前記第３のドライバ部は、前記第３の制御信号が前記第１の論理である場合には、前記第３のセレクタの出力信号に基づいて、前記第３の出力端子の電圧を前記第３の電圧または前記第４の電圧に選択的に設定し、前記第３の制御信号が前記第２の論理である場合には、前記第３の出力端子の電圧を前記第５の電圧に設定する
請求項９または請求項１０に記載の送信装置。
【請求項１２】
前記送信部は、
前記第１の信号を生成する第１のシリアライザと、
前記第２の信号を生成する第２のシリアライザと、
前記第３の信号を生成する第３のシリアライザと、
前記第４の信号を生成する第４のシリアライザと
をさらに有する
請求項９に記載の送信装置。
【請求項１３】
前記第１の出力端子、前記第２の出力端子、前記第３の出力端子、および前記第４の出力端子の配置の順番が、前記第１のシリアライザ、前記第２のシリアライザ、前記第３のシリアライザ、および前記第４のシリアライザの配置の順番と異なる
請求項１２に記載の送信装置。
【請求項１４】
各シリアライザは、シフトレジスタを用いて構成され、動作モードに応じて使用する段数を変更可能である
請求項１２または請求項１３に記載の送信装置。
【請求項１５】
前記送信部は、
前記第３の信号および第４の信号のうちの一方を選択して出力する第３のセレクタと、
前記第３の信号の反転信号、前記第４の信号、および前記第４の信号の反転信号のうちのいずれかを選択して出力する第４のセレクタと、
第５の信号および第６の信号のうちの一方を選択して出力する第５のセレクタと、
前記第５の信号の反転信号、前記第６の信号、および前記第６の信号の反転信号のうちのいずれかを選択して出力する第６のセレクタと、
前記第４の信号、前記第５の信号、および前記第６の信号に基づいて、第４の制御信号、第５の制御信号、および第６の制御信号を生成する第２の制御信号生成部と、
前記第４のセレクタの出力信号および前記第４の制御信号に基づいて第４の出力端子の電圧を設定する第４のドライバ部と、
前記第５のセレクタの出力信号および前記第５の制御信号に基づいて第５の出力端子の電圧を設定する第５のドライバ部と、
前記第６のセレクタの出力信号および前記第６の制御信号に基づいて第６の出力端子の電圧を設定する第６のドライバ部と
をさらに有し、
前記第３のドライバ部は、前記第３のセレクタの出力信号および前記第３の制御信号に基づいて前記第３の出力端子の電圧を設定する
請求項５から請求項７のいずれか一項に記載の送信装置。
【請求項１６】
前記第３のドライバ部は、前記第３の信号および前記第３の制御信号に基づいて第３の出力端子の電圧を設定する
請求項５から請求項８のいずれか一項に記載の送信装置。
【請求項１７】
各ドライバ部は、複数のドライバ回路を有し、
各ドライバ回路は、
一端が前記第１の電圧に対応する電圧を生成する第１の電源に導かれ、他端がそのドライバ回路が属するドライバ部の出力端子に導かれた第１のスイッチと、
一端が前記第２の電圧に対応する電圧を生成する第２の電源に導かれ、他端がそのドライバ回路が属するドライバ部の出力端子に導かれた第２のスイッチと
を有する
請求項５から請求項１６のいずれか一項に記載の送信装置。
【請求項１８】
各ドライバ部は、前記第２の動作モードにおいて、
そのドライバ部が有する複数の前記第１のスイッチのうちの少なくとも一つをオン状態にするとともに、そのドライバ部が有する複数の前記第２のスイッチをオフ状態にすることにより、そのドライバ部の出力端子の電圧を前記第３の電圧に設定し、
そのドライバ部が有する複数の前記第２のスイッチのうちの少なくとも一つをオン状態にするとともに、そのドライバ部が有する複数の前記第１のスイッチをオフ状態にすることにより、そのドライバ部の出力端子の電圧を前記第４の電圧に設定し、
そのドライバ部が有する複数の前記第１のスイッチのうちの少なくとも一つをオン状態にするとともに、そのドライバ部が有する複数の前記第２のスイッチのうちの少なくとも一つをオン状態にすることにより、そのドライバ部の出力端子の電圧を前記第５の電圧に設定する
請求項１７に記載の送信装置。
【請求項１９】
各ドライバ部は、前記第２の動作モードにおいて、
そのドライバ部が有する複数の前記第１のスイッチのうちの少なくとも一つをオン状態にするとともに、そのドライバ部が有する複数の前記第２のスイッチをオフ状態にすることにより、そのドライバ部の出力端子の電圧を前記第３の電圧に設定し、
そのドライバ部が有する複数の前記第２のスイッチのうちの少なくとも一つをオン状態にするとともに、そのドライバ部が有する複数の前記第１のスイッチをオフ状態にすることにより、そのドライバ部の出力端子の電圧を前記第４の電圧に設定し、
そのドライバ部が有する複数の前記第１のスイッチおよび複数の前記第２のスイッチをオフ状態にすることにより、１または複数の終端抵抗素子を介して、そのドライバ部の出力端子の電圧を前記第５の電圧に設定する
請求項１７に記載の送信装置。
【請求項２０】
前記送信部は、前記第１の動作モードおよび前記第２の動作モードを含む複数の動作モードのうちの一つを選択し、各セレクタおよび各ドライバ部の動作を制御する制御部をさらに有する
請求項５から請求項１９のいずれか一項に記載の送信装置。
【請求項２１】
前記制御部は、外部から供給された信号に基づいて、前記複数の動作モードのうちの一つを選択する
請求項２０に記載の送信装置。
【請求項２２】
送信装置と
受信装置と
を備え、
前記送信装置は、
第１の動作モードにおいて、第１の出力端子の電圧を第１の電圧または第２の電圧に選択的に設定し、第２の動作モードにおいて、前記第１の出力端子の電圧を第３の電圧、第４の電圧、および第５の電圧のいずれかに選択的に設定する送信部を有する
通信システム。
【発明の詳細な説明】
【技術分野】
【０００１】
本開示は、信号を送信する送信装置、およびそのような送信装置を備えた通信システムに関する。
【背景技術】
【０００２】
近年の電子機器の高機能化および多機能化に伴い、電子機器には、半導体チップ、センサ、表示デバイスなどの様々なデバイスが搭載される。これらのデバイス間では、多くのデータのやり取りが行われ、そのデータ量は、電子機器の高機能化および多機能化に応じて多くなってきている。
【０００３】
より多くのデータのやり取りを行う方法について、様々な技術が開示されている。例えば、特許文献１，２には、３つの電圧レベルを利用してデータのやりとりを行う通信システムが開示されている。
【先行技術文献】
【特許文献】
【０００４】
【特許文献１】特表２０１１−５１７１５９号公報
【特許文献２】特表２０１０−５２０７１５号公報
【発明の概要】
【発明が解決しようとする課題】
【０００５】
ところで、電子機器には、しばしば、様々なベンダーから供給されたデバイスが搭載される。そのようなデバイスは、互いに異なるインタフェースを有することがある。よって、このようなデバイスとデータのやりとりを行うデバイスは、様々なインタフェースを実現することができることが望まれる。
【０００６】
したがって、様々なインタフェースを実現することができる送信装置および通信システムを提供することが望ましい。
【課題を解決するための手段】
【０００７】
本開示の一実施形態における送信装置は、送信部を備えている。送信部は、第１の動作モードにおいて、第１の出力端子の電圧を第１の電圧または第２の電圧に選択的に設定し、第２の動作モードにおいて、第１の出力端子の電圧を第３の電圧、第４の電圧、および第５の電圧のいずれかに選択的に設定するように構成される。
【０００８】
本開示の一実施形態における通信システムは、送信装置と、受信装置とを備える。送信装置は、送信部を有する。送信部は、第１の動作モードにおいて、第１の出力端子の電圧を第１の電圧または第２の電圧に選択的に設定し、第２の動作モードにおいて、第１の出力端子の電圧を第３の電圧、第４の電圧、および第５の電圧のいずれかに選択的に設定するように構成される。
【０００９】
本開示の一実施形態における送信装置および通信システムでは、第１の動作モードにおいて、第１の出力端子の電圧は、第１の電圧または第２の電圧に選択的に設定される。また、第２の動作モードにおいて、第１の出力端子の電圧は、第３の電圧、第４の電圧、および第５の電圧のいずれかに選択的に設定される。
【発明の効果】
【００１０】
本開示の一実施形態における送信装置および通信システムによれば、第１の動作モードにおいて、第１の出力端子の電圧を第１の電圧または第２の電圧に選択的に設定し、第２の動作モードにおいて、第１の出力端子の電圧を第３の電圧、第４の電圧、および第５の電圧のいずれかに選択的に設定するようにしたので、様々なインタフェースを実現することができる。
【００１１】
なお、ここに記載された効果は必ずしも限定されるものではなく、本開示中に記載されたいずれの効果があってもよい。
【図面の簡単な説明】
【００１２】
【図１】本開示の実施の形態に係る送信装置の一構成例を表すブロック図である。
【図２】図１に示した送信部の一構成例を表すブロック図である。
【図３】図２に示したシリアライザの一構成例を表すブロック図である。
【図４】図２に示したドライバ部の一構成例を表すブロック図である。
【図５】図４に示したドライバ回路の一構成例を表す回路図である。
【図６】図１に示した送信装置が適用される通信システムの一構成例を表すブロック図である。
【図７】図６に示したレシーバ部の一構成例を表す回路図である。
【図８】図１に示した送信装置が適用される通信システムの他の構成例を表すブロック図である。
【図９】図８に示したレシーバ部の一構成例を表す回路図である。
【図１０】図８に示したレシーバ部の一動作例を表す説明図である。
【図１１】図１に示した送信装置が適用される通信システムの他の構成例を表すブロック図である。
【図１２】図１１に示したレシーバ部の一構成例を表す回路図である。
【図１３】図２に示した送信部の各ブロックの一配置例を表す説明図である。
【図１４Ａ】図２に示した送信部の一動作モードにおける一動作状態を表す説明図である。
【図１４Ｂ】図２に示した送信部の一動作モードにおける他の動作状態を表す説明図である。
【図１５】図２に示した送信部の一動作例を表すタイミング波形図である。
【図１６】図２に示した送信部の他の動作モードにおける一動作例を表す説明図である。
【図１７】図２に示した送信部の他の動作モードにおける一動作例を表す表である。
【図１８】図２に示した送信部の他の動作モードにおける一動作例を表す説明図である。
【図１９】変形例に係る送信部の各ブロックの一配置例を表す説明図である。
【図２０】他の変形例に係る送信部の一構成例を表すブロック図である。
【図２１】他の変形例に係る送信部の一構成例を表すブロック図である。
【図２２】他の変形例に係る送信部の一動作例を表すタイミング波形図である。
【図２３】他の変形例に係る送信部の一動作例を表すタイミング波形図である。
【図２４】実施の形態に係る送信装置が適用されたスマートフォンの外観構成を表す斜視図である。
【図２５】実施の形態に係る送信装置が適用されたアプリケーションプロセッサの一構成例を表すブロック図である。
【図２６】実施の形態に係る送信装置が適用されたイメージセンサの一構成例を表すブロック図である。
【図２７】他の変形例に係る送信部の一構成例を表すブロック図である。
【発明を実施するための形態】
【００１３】
以下、本開示の実施の形態について、図面を参照して詳細に説明する。なお、説明は以下の順序で行う。
１．実施の形態
２．適用例
【００１４】
＜１．実施の形態＞
［構成例］
図１は、実施の形態に係る送信装置の一構成例を表すものである。送信装置１は、複数のインタフェースを実現可能に構成されたものである。なお、本開示の実施の形態に係る通信システムは、本実施の形態により具現化されるので、併せて説明する。
【００１５】
送信装置１は、処理部９と、送信部１０とを備えている。処理部９は、６組のパラレル信号ＤＡＴＡ１〜ＤＡＴＡ６を生成するものである。パラレル信号ＤＡＴＡ１〜ＤＡＴＡ６のそれぞれは、この例では７ビットのビット幅を有するものである。送信部１０は、パラレル信号ＤＡＴＡ１〜ＤＡＴＡ６およびモード選択信号ＭＳＥＬに基づいて、信号ＳＩＧ１〜ＳＩＧ６を生成して出力端子Ｔout1〜Ｔout6から出力するものである。このようにして、送信装置１は、信号ＳＩＧ１〜ＳＩＧ６を生成し、伝送線路１０１〜１０６を介して、受信装置（図示せず）に送信するようになっている。この例では、伝送線路１０１〜１０６の特性インピーダンスは、５０［Ω］である。送信装置１は、後述するように、差動信号や、３相信号や、単相信号で受信装置に対してデータを送信することができるように構成されている。
【００１６】
図２は、送信部１０の一構成例を表すものである。送信部１０は、シリアライザＳＥＲ１〜ＳＥＲ６と、セレクタ２２，２４，２６，３１〜３６と、排他的論理和回路４１〜４６と、論理和回路５１〜５６と、ドライバ部ＤＲＶ１〜ＤＲＶ６と、制御部２０とを有している。なお、これらのブロック間の信号は、差動信号であってもよいし、単相信号であってもよい。
【００１７】
シリアライザＳＥＲ１〜ＳＥＲ６は、パラレル信号をシリアル信号に変換するものである。具体的には、シリアライザＳＥＲ１は、クロック信号ＣＬＫ１および制御信号ＣＴＬ１に基づいて、パラレル信号ＤＡＴＡ１をシリアライズして信号Ｐ１１とその反転信号Ｎ１１を生成するものである。シリアライザＳＥＲ２は、クロック信号ＣＬＫ２および制御信号ＣＴＬ２に基づいて、パラレル信号ＤＡＴＡ２をシリアライズして信号Ｐ１２とその反転信号Ｎ１２を生成するものである。シリアライザＳＥＲ３は、クロック信号ＣＬＫ１および制御信号ＣＴＬ１に基づいて、パラレル信号ＤＡＴＡ３をシリアライズして信号Ｐ１３とその反転信号Ｎ１３を生成するものである。シリアライザＳＥＲ４は、クロック信号ＣＬＫ２および制御信号ＣＴＬ２に基づいて、パラレル信号ＤＡＴＡ４をシリアライズして信号Ｐ１４とその反転信号Ｎ１４を生成するものである。シリアライザＳＥＲ５は、クロック信号ＣＬＫ１および制御信号ＣＴＬ１に基づいて、パラレル信号ＤＡＴＡ５をシリアライズして信号Ｐ１５とその反転信号Ｎ１５を生成するものである。シリアライザＳＥＲ６は、クロック信号ＣＬＫ２および制御信号ＣＴＬ２に基づいて、パラレル信号ＤＡＴＡ６をシリアライズして信号Ｐ１６とその反転信号Ｎ１６を生成するものである。
【００１８】
図３は、シリアライザＳＥＲ１の一構成例を表すものである。なお、以下ではシリアライザＳＥＲ１を例に説明するが、シリアライザＳＥＲ２〜ＳＥＲ６についても同様である。シリアライザＳＥＲ１は、この例ではシフトレジスタを含んで構成されるものであり、７ビットの信号Ｄ［６］〜Ｄ［０］を有するパラレル信号ＤＡＴＡ１をシリアライズする、いわゆる７：１のシリアライザである。このシリアライザＳＥＲ１は、差動信号を扱うように構成されており、シリアル信号として信号Ｐ１１，Ｎ１１を生成するようになっている。
【００１９】
シリアライザＳＥＲ１は、セレクタ７１〜７７と、フリップフロップ８１〜８７とを有している。セレクタ７１〜７７は、制御端子における信号が“１”である場合には、第１入力端子の信号を出力し、制御端子における信号が“０”である場合には、第２入力端子の信号を出力するものである。フリップフロップ８１〜８７は、Ｄ型のフリップフロップであり、クロック端子における信号の立ち上がりタイミングにおいて入力端子Ｄにおける信号をサンプリングして、そのサンプリング結果を出力端子Ｑから出力するものである。セレクタ７１の第１入力端子には信号Ｄ［６］が供給され、第２入力端子には“０”が供給され、制御端子には制御信号ＣＴＬ１が供給され、出力端子はフリップフロップ８１の入力端子Ｄに接続されている。フリップフロップ８１の入力端子Ｄはセレクタ７１の出力端子に接続され、クロック端子にはクロック信号ＣＬＫ１が供給され、出力端子Ｑはセレクタ７２の第２入力端子に接続されている。セレクタ７２の第１入力端子には信号Ｄ［５］が供給され、第２入力端子にはフリップフロップ８１の出力端子Ｑが接続され、制御端子には制御信号ＣＴＬ１が供給され、出力端子はフリップフロップ８２の入力端子Ｄに接続されている。フリップフロップ８２の入力端子Ｄはセレクタ７２の出力端子に接続され、クロック端子にはクロック信号ＣＬＫ１が供給され、出力端子Ｑはセレクタ７３の第２入力端子に接続されている。このように、シリアライザＳＥＲ１では、セレクタとフリップフロップとが交互に接続される。そして、セレクタ７７の第１入力端子には信号Ｄ［０］が供給され、第２入力端子にはフリップフロップ８６の出力端子Ｑが接続され、制御端子には制御信号ＣＴＬ１が供給され、出力端子はフリップフロップ８７の入力端子Ｄに接続されている。フリップフロップ８７の入力端子Ｄはセレクタ７７の出力端子に接続され、クロック端子にはクロック信号ＣＬＫ１が供給され、出力端子ＱにはシリアライザＳＥＲ１の出力信号Ｐ１１，Ｎ１１が生じるようになっている。
【００２０】
この構成により、シリアライザＳＥＲ１では、制御信号ＣＴＬ１を“１”にすることにより、フリップフロップ８１〜８７が、信号Ｄ［６］〜Ｄ［０］をそれぞれ記憶する。そして、制御信号ＣＴＬ１を“０”にすることにより、シリアライザＳＥＲ１はシフトレジスタとして動作し、クロック信号ＣＬＫ１に同期して信号Ｄ［０］〜Ｄ［６］をこの順で出力する。このようにして、シリアライザＳＥＲ１は、パラレル信号ＤＡＴＡ１をシリアライズして信号Ｐ１１，Ｎ１１を生成するようになっている。
【００２１】
セレクタ２２は、制御信号ＳＩＮＶに基づいて、信号Ｐ１２，Ｎ１２のうちの一方を選択して出力するものである。セレクタ２４は、制御信号ＳＩＮＶに基づいて、信号Ｐ１４，Ｎ１４のうちの一方を選択して出力するものであり、セレクタ２６は、制御信号ＳＩＮＶに基づいて、信号Ｐ１６，Ｎ１６のうちの一方を選択して出力するものである。
【００２２】
セレクタ３１は、制御信号ＳＥＬ１に基づいて、信号Ｐ１１，Ｐ１２のうちの一方を選択して、信号Ｓ３１として出力するものである。セレクタ３２は、制御信号ＳＥＬ２に基づいて、信号Ｎ１１およびセレクタ２２の出力信号のうちの一方を選択して、信号Ｓ３２として出力するものである。セレクタ３３は、制御信号ＳＥＬ３に基づいて、信号Ｐ１３，Ｐ１４のうちの一方を選択して、信号Ｓ３３として出力するものである。セレクタ３４は、制御信号ＳＥＬ４に基づいて、信号Ｎ１３およびセレクタ２４の出力信号のうちの一方を選択して、信号Ｓ３４として出力するものである。セレクタ３５は、制御信号ＳＥＬ５に基づいて、信号Ｐ１５，Ｐ１６のうちの一方を選択して、信号Ｓ３５として出力するものである。セレクタ３６は、制御信号ＳＥＬ６に基づいて、信号Ｎ１５およびセレクタ２６の出力信号のうちの一方を選択して、信号Ｓ３６として出力するものである。
【００２３】
排他的論理和回路４１は、信号Ｐ１１と信号Ｐ１３との排他的論理和（ＥＸ−ＯＲ：Exclusive OR）を求め、その結果を出力するものである。排他的論理和回路４２は、信号Ｐ１１と信号Ｐ１２との排他的論理和を求め、その結果を出力するものである。排他的論理和回路４３は、信号Ｐ１２と信号Ｐ１３との排他的論理和を求め、その結果を出力するものである。排他的論理和回路４４は、信号Ｐ１４と信号Ｐ１６との排他的論理和を求め、その結果を出力するものである。排他的論理和回路４５は、信号Ｐ１４と信号Ｐ１５との排他的論理和を求め、その結果を出力するものである。排他的論理和回路４６は、信号Ｐ１５と信号Ｐ１６との排他的論理和を求め、その結果を出力するものである。
【００２４】
論理和回路５１は、排他的論理和回路４１の出力信号と制御信号ＳＭＭとの論理和（ＯＲ）を求め、その結果を信号Ｓ５１として出力するものである。論理和回路５２は、排他的論理和回路４２の出力信号と制御信号ＳＭＭとの論理和を求め、その結果を信号Ｓ５２として出力するものである。論理和回路５３は、排他的論理和回路４３の出力信号と制御信号ＳＭＭとの論理和を求め、その結果を信号Ｓ５３として出力するものである。論理和回路５４は、排他的論理和回路４４の出力信号と制御信号ＳＭＭとの論理和を求め、その結果を信号Ｓ５４として出力するものである。論理和回路５５は、排他的論理和回路４５の出力信号と制御信号ＳＭＭとの論理和を求め、その結果を信号Ｓ５５として出力するものである。論理和回路５６は、排他的論理和回路４６の出力信号と制御信号ＳＭＭとの論理和を求め、その結果を信号Ｓ５６として出力するものである。
【００２５】
ドライバ部ＤＲＶ１は、信号Ｓ３１および信号Ｓ５１に基づいて、出力端子Ｔout1の電圧を、３つの電圧（高レベル電圧ＶＨ、低レベル電圧ＶＬ、および中レベル電圧ＶＭ）のうちの１つに設定可能に構成されたものである。ドライバ部ＤＲＶ２は、信号Ｓ３２および信号Ｓ５２に基づいて、出力端子Ｔout2の電圧を３つの電圧のうちの１つに設定可能に構成されたものである。ドライバ部ＤＲＶ３は、信号Ｓ３３および信号Ｓ５３に基づいて、出力端子Ｔout3の電圧を３つの電圧のうちの１つに設定可能に構成されたものである。ドライバ部ＤＲＶ４は、信号Ｓ３４および信号Ｓ５４に基づいて、出力端子Ｔout4の電圧を３つの電圧のうちの１つに設定可能に構成されたものである。ドライバ部ＤＲＶ５は、信号Ｓ３５および信号Ｓ５５に基づいて、出力端子Ｔout5の電圧を３つの電圧のうちの１つに設定可能に構成されたものである。ドライバ部ＤＲＶ６は、信号Ｓ３６および信号Ｓ５６に基づいて、出力端子Ｔout6の電圧を３つの電圧のうちの１つに設定可能に構成されたものである。
【００２６】
図４は、ドライバ部ＤＲＶ１の一構成例を表すものである。なお、以下ではドライバ部ＤＲＶ１を例に説明するが、ドライバ部ＤＲＶ２〜ＤＲＶ６についても同様である。ドライバ部ＤＲＶ１は、ドライバ制御部６０と、ドライバ回路６１〜６５とを有している。
【００２７】
ドライバ制御部６０は、信号Ｓ３１，Ｓ５１に基づいて、信号Ｐ６１〜Ｐ７５，Ｎ６１〜Ｎ６５を生成するものである。
【００２８】
ドライバ回路６１〜６５は、正入力端子に供給された信号および負入力端子に供給された信号に基づいて、出力端子Ｔout1の電圧を設定するものである。ドライバ回路６１の正入力端子には信号Ｐ６１が供給され、負入力端子には信号Ｎ６１が供給され、出力端子は出力端子Ｔout1に接続されている。ドライバ回路６２の正入力端子には信号Ｐ６２が供給され、負入力端子には信号Ｎ６２が供給され、出力端子は出力端子Ｔout1に接続されている。ドライバ回路６３の正入力端子には信号Ｐ６３が供給され、負入力端子には信号Ｎ６３が供給され、出力端子は出力端子Ｔout1に接続されている。ドライバ回路６４の正入力端子には信号Ｐ６４が供給され、負入力端子には信号Ｎ６４が供給され、出力端子は出力端子Ｔout1に接続されている。ドライバ回路６５の正入力端子には信号Ｐ６５が供給され、負入力端子には信号Ｎ６５が供給され、出力端子は出力端子Ｔout1に接続されている。すなわち、ドライバ回路６１〜６５の出力端子は、互いに接続されるとともに、出力端子Ｔout1に接続されている。
【００２９】
図５は、ドライバ回路６１の一構成例を表すものである。なお、以下ではドライバ回路６１を例に説明するが、ドライバ回路６２〜６５についても同様である。ドライバ回路６１は、トランジスタ９２，９３と、抵抗素子９１，９４，９５とを有している。トランジスタ９２，９３は、この例では、ＮチャネルＭＯＳ（Metal Oxide Semiconductor）型のＦＥＴ（Field Effect Transistor）である。トランジスタ９２のゲートは、ドライバ回路６１の正入力端子に対応するものであり、信号Ｐ６１が供給され、ソースは抵抗素子９１の一端に接続され、ドレインはトランジスタ９３のドレインに接続されるとともに抵抗素子９５の一端に接続されている。トランジスタ９３のゲートは、ドライバ回路６１の負入力端子に対応するものであり、信号Ｎ６１が供給され、ソースは抵抗素子９４の一端に接続され、ドレインはトランジスタ９２のドレインに接続されるとともに抵抗素子９５の一端に接続されている。抵抗素子９１の一端はトランジスタ９２のソースに接続され、他端には電圧Ｖ１が供給されている。電圧Ｖ１は、例えば４００［ｍＶ］である。抵抗素子９４の一端はトランジスタ９３のソースに接続され、他端は接地されている。抵抗素子９５の一端はトランジスタ９２，９３のドレインに接続され、他端は、ドライバ回路６１の出力端子に対応するものである。この例では、抵抗素子９１の抵抗値と、トランジスタ９２のオン抵抗の抵抗値と、抵抗素子９５の抵抗値の和は、２００［Ω］程度であり、同様に、抵抗素子９４の抵抗値と、トランジスタ９３のオン抵抗の抵抗値と、抵抗素子９５の抵抗値の和は、この例では２００［Ω］程度である。
【００３０】
この構成により、ドライバ部ＤＲＶ１は、信号Ｓ３１および信号Ｓ５１に基づいて、出力端子Ｔout1の電圧を、３つの電圧（高レベル電圧ＶＨ、低レベル電圧ＶＬ、および中レベル電圧ＶＭ）のうちの１つに設定する。具体的には、信号Ｓ５１が“１”である場合には、ドライバ制御部６０は、信号Ｓ３１に応じて、信号Ｐ６１〜Ｐ６５，信号Ｎ６１〜Ｎ６５を設定する。すなわち、ドライバ制御部６０は、信号Ｓ３１が“１”である場合には、信号Ｐ６１〜Ｐ６５のうちの例えば４つを“１”にし、残りの１つおよび信号Ｎ６１〜Ｎ６５を“０”に設定する。これにより、ドライバ回路６１〜６５では、ゲートに“１”が供給された４つのトランジスタ９２がオン状態になり、信号ＳＩＧ１が高レベル電圧ＶＨになる。また、ドライバ制御部６０は、信号Ｓ３１が“０”である場合には、信号Ｎ６１〜Ｎ６５のうちの例えば４つを“１”にし、残りの１つおよび信号Ｐ６１〜Ｐ６５を“０”に設定する。これにより、ドライバ回路６１〜６５では、ゲートに“１”が供給された４つのトランジスタ９３がオン状態になり、信号ＳＩＧ１が低レベル電圧ＶＬになる。一方、信号Ｓ５１が“０”である場合には、ドライバ制御部６０は、信号Ｓ３１にかかわらず、信号Ｐ６１〜Ｐ６５のうちの例えば２つを“１”にするとともに残りを“０”にし、信号Ｎ６１〜Ｎ６５のうちの例えば２つを“１”にするとともに残りを“０”にする。これにより、ドライバ回路６１〜６５では、ゲートに“１”が供給された２つのトランジスタ９２および２つのトランジスタ９３がオン状態になり、テブナン終端が実現され、信号ＳＩＧ１は中レベル電圧ＶＭになる。
【００３１】
言い換えれば、信号Ｓ５１は、信号ＳＩＧ１を中レベル電圧ＶＭにするか否かを制御する信号であり、ドライバ部ＤＲＶ１は、信号Ｓ５１が“０”である場合に、信号ＳＩＧ１を中レベル電圧ＶＭに設定する。また、ドライバ部ＤＲＶ１は、信号Ｓ５１が“１”である場合には、信号Ｓ３１に応じて信号ＳＩＧ１を高レベル電圧ＶＨまたは低レベル電圧ＶＬに設定するようになっている。
【００３２】
また、ドライバ部ＤＲＶ１では、このように、信号ＳＩＧ１の電圧レベルにかかわらず、１０個のトランジスタ９２，９３のうちの４つのトランジスタをオン状態にする。これにより、ドライバ部ＤＲＶ１では、信号ＳＩＧ１の電圧レベルにかかわらず、出力インピーダンスを５０［Ω］程度にすることができ、インピーダンスマッチングを実現しやすくすることができるようになっている。
【００３３】
また、ドライバ制御部６０は、オン状態にするトランジスタの数を変更することができるようになっている。具体的には、例えば、３つのトランジスタをオン状態にする場合には、ドライバ制御部６０は、信号Ｐ６１〜Ｐ６５のうちの例えば３つを“１”にすることにより３つのトランジスタ９２をオン状態にし、信号Ｎ６１〜Ｎ６５のうちの例えば３つを“１”にすることにより３つのトランジスタ９３をオン状態にする。また、例えば、５つのトランジスタをオン状態にする場合には、信号Ｐ６１〜Ｐ６５の全てを“１”にすることにより５つのトランジスタ９２をオン状態にし、信号Ｎ６１〜Ｎ６５の全てを“１”にすることにより５つのトランジスタ９３をオン状態にする。これにより、ドライバ部ＤＲＶ１では、出力信号ＳＩＧ１のスルーレートを調節することができるようになっている。
【００３４】
制御部２０は、モード選択信号ＭＳＥＬに基づいて、３つの動作モードＭ１〜Ｍ３のうちの１つを選択し、送信部１０がその選択された動作モードで動作するように、送信部１０を制御するものである。ここで、動作モードＭ１は、受信装置に対して差動信号によりデータを送信するモードであり、動作モードＭ２は、受信装置に対して３相信号によりデータを送信するモードであり、動作モードＭ３は、受信装置に対して単相信号によりデータを送信するモードである。モード選択信号ＭＳＥＬは、例えば送信装置１の外部から供給されるものである。制御部２０は、このモード選択信号ＭＳＥＬに基づいて、これらの３つの動作モードＭ１〜Ｍ３のうちの１つを選択する。そして、制御部２０は、選択された動作モードに応じて、クロック信号ＣＬＫ１，ＣＬＫ２、および制御信号ＣＴＬ１，ＣＴＬ２，ＳＩＮＶ，ＳＥＬ１〜ＳＥＬ６，ＳＭＭを生成し、これらの制御信号を用いて送信部１０の各ブロックの動作を制御するようになっている。
【００３５】
図６は、送信部１０が動作モードＭ１で動作する通信システム４の一構成例を表すものである。通信システム４は、送信装置１と、受信装置１１０とを備えている。受信装置１１０は、レシーバ部１１１〜１１３を有している。このモードでは、ドライバ部ＤＲＶ１，ＤＲＶ２がレシーバ部１１１に対して信号ＳＩＧ１，ＳＩＧ２をそれぞれ送信し、ドライバ部ＤＲＶ３，ＤＲＶ４がレシーバ部１１２に対して信号ＳＩＧ３，ＳＩＧ４をそれぞれ送信し、ドライバ部ＤＲＶ５，ＤＲＶ６がレシーバ部１１３に対して信号ＳＩＧ５，ＳＩＧ６をそれぞれ送信する。ここで、信号ＳＩＧ１，ＳＩＧ２は差動信号を構成し、信号ＳＩＧ３，ＳＩＧ４は差動信号を構成し、信号ＳＩＧ５，ＳＩＧ６は差動信号を構成する。すなわち、例えば、信号ＳＩＧ１，ＳＩＧ２のうちの一方は高レベル電圧ＶＨであり、他方は低レベル電圧ＶＬである。そして、レシーバ部１１１は、信号ＳＩＧ１，ＳＩＧ２を受信し、レシーバ部１１２は、信号ＳＩＧ３，ＳＩＧ４を受信し、レシーバ部１１３は、信号ＳＩＧ５，ＳＩＧ６を受信するようになっている。なお、この例では、１つの受信装置１１０に３つのレシーバ部１１１〜１１３を設け、その受信装置１１０に対してデータを送信したが、これに限定されるものではなく、これに代えて、例えば、３つの受信装置にそれぞれレシーバ部を１つずつ設け、これらの３つの受信装置に対してデータを送信してもよい。
【００３６】
図７は、レシーバ部１１１の一構成例を表すものである。なお、以下ではレシーバ部１１１を例に説明するが、レシーバ部１１２，１１３についても同様である。レシーバ部１１１は、抵抗素子１１６と、アンプ１１７とを有している。抵抗素子１１６は、通信システム４の終端抵抗として機能するものであり、抵抗値は、この例では、１００［Ω］程度である。抵抗素子１１６の一端は入力端子Ｔin11などに接続されるとともに信号ＳＩＧ１が供給され、他端は入力端子Ｔin12などに接続されるとともに信号ＳＩＧ２が供給される。アンプ１１７は、正入力端子における信号と負入力端子における信号の差分に応じて“１”または“０”を出力するものである。アンプ１１７の正入力端子は、抵抗素子１１６の一端および入力端子Ｔin11に接続されるとともに信号ＳＩＧ１が供給され、負入力端子は、抵抗素子１１６の他端および入力端子Ｔin12に接続されるとともに信号ＳＩＧ２が供給されている。
【００３７】
この構成により、通信システム４では、差動信号によりデータを送受信することができるようになっている。
【００３８】
図８は、送信部１０が動作モードＭ２で動作する通信システム５の一構成例を表すものである。通信システム５は、送信装置１と、受信装置１２０とを備えている。受信装置１２０は、レシーバ部１２１，１２２を有している。このモードでは、ドライバ部ＤＲＶ１〜ＤＲＶ３がレシーバ部１２１に対して信号ＳＩＧ１〜ＳＩＧ３をそれぞれ送信し、ドライバ部ＤＲＶ４〜ＤＲＶ６がレシーバ部１２２に対して信号ＳＩＧ４〜ＳＩＧ６をそれぞれ送信する。ここで、信号ＳＩＧ１〜ＳＩＧ３は３相信号を構成し、信号ＳＩＧ４〜ＳＩＧ６は３相信号を構成する。すなわち、信号ＳＩＧ１〜ＳＩＧ３は、互いに異なる電圧レベル（高レベル電圧ＶＨ、低レベル電圧ＶＬ、中レベル電圧ＶＭ）になるものである。そして、レシーバ部１２１は、信号ＳＩＧ１〜ＳＩＧ３を受信し、レシーバ部１２２は、信号ＳＩＧ４〜ＳＩＧ６を受信するようになっている。
【００３９】
図９は、レシーバ部１２１の一構成例を表すものである。なお、以下ではレシーバ部１２１を例に説明するが、レシーバ部１２２についても同様である。レシーバ部１２１は、抵抗素子１２４〜１２６と、アンプ１２７〜１２９とを有している。抵抗素子１２４〜１２６は、通信システム５の終端抵抗として機能するものであり、抵抗値は、この例では、５０［Ω］程度である。抵抗素子１２４の一端は入力端子Ｔin21などに接続されるとともに信号ＳＩＧ１が供給され、他端は抵抗素子１２５，１２６の他端に接続されている。抵抗素子１２５の一端は入力端子Ｔin22などに接続されるとともに信号ＳＩＧ２が供給され、他端は抵抗素子１２４，１２６の他端に接続されている。抵抗素子１２６の一端は入力端子Ｔin23などに接続されるとともに信号ＳＩＧ３が供給され、他端は抵抗素子１２４，１２６の他端に接続されている。アンプ１２７の正入力端子は、アンプ１２９の負入力端子、抵抗素子１２６の一端、および入力端子Ｔin21に接続されるとともに信号ＳＩＧ１が供給され、負入力端子は、アンプ１２８の正入力端子、抵抗素子１２５の一端、および入力端子Ｔin22に接続されるとともに信号ＳＩＧ２が供給される。アンプ１２８の正入力端子は、アンプ１２７の負入力端子、抵抗素子１２５の一端、および入力端子Ｔin22に接続されるとともに信号ＳＩＧ２が供給され、負入力端子は、アンプ１２９の正入力端子、抵抗素子１２６の一端、および入力端子Ｔin23に接続されるとともに信号ＳＩＧ３が供給される。アンプ１２９の正入力端子は、アンプ１２８の負入力端子、抵抗素子１２６の一端、および入力端子Ｔin23に接続されるとともに信号ＳＩＧ３が供給され、負入力端子は、アンプ１２７の正入力端子、抵抗素子１２４の一端、および入力端子Ｔin21に接続されるとともに信号ＳＩＧ１が供給される。
【００４０】
図１０は、レシーバ部１２１の一動作例を表すものである。この例では、信号ＳＩＧ１は高レベル電圧ＶＨであり、信号ＳＩＧ２は低レベル電圧ＶＬであり、信号ＳＩＧ３は中レベル電圧ＶＭである。この場合には、入力端子Ｔin21、抵抗素子１２４、抵抗素子１２５、入力端子Ｔin22の順に電流Ｉinが流れる。そして、アンプ１２７の正入力端子には高レベル電圧ＶＨが供給されるとともに負入力端子には低レベル電圧ＶＬが供給され、アンプ１２７は“１”を出力する。また、アンプ１２８の正入力端子には低レベル電圧ＶＬが供給されるとともに負入力端子には中レベル電圧ＶＭが供給され、アンプ１２８は“０”を出力する。また、アンプ１２９の正入力端子には中レベル電圧ＶＭが供給されるとともに負入力端子には高レベル電圧ＶＨが供給され、アンプ１２９は“０”を出力するようになっている。
【００４１】
この構成により、通信システム５では、３相信号によりデータを送受信することができるようになっている。
【００４２】
図１１は、送信部１０が動作モードＭ３で動作する通信システム６の一構成例を表すものである。通信システム６は、送信装置１と、受信装置１３０とを備えている。受信装置１３０は、レシーバ部１３１〜１３６を有している。このモードでは、ドライバ部ＤＲＶ１〜ＤＲＶ６がレシーバ部１３１〜１３６に対して信号ＳＩＧ１〜ＳＩＧ６をそれぞれ送信する。ここで、信号ＳＩＧ１〜ＳＩＧ６のそれぞれは、単相信号である。そして、レシーバ部１３１〜１３６は、信号ＳＩＧ１〜ＳＩＧ６をそれぞれ受信するようになっている。
【００４３】
図１２は、レシーバ部１３１の一構成例を表すものである。なお、以下ではレシーバ部１３１を例に説明するが、レシーバ部１３２〜１３６についても同様である。レシーバ部１３１は、抵抗素子１３８と、アンプ１３９とを有している。抵抗素子１３８は、通信システム６の終端抵抗として機能するものであり、抵抗値は、この例では、５０［Ω］程度である。抵抗素子１３８の一端は入力端子Ｔin31などに接続されるとともに信号ＳＩＧ１が供給され、他端にはバイアス電圧Ｖ２が供給されている。アンプ１３９の正入力端子は、抵抗素子１３８の一端および入力端子Ｔin31に接続されるとともに信号ＳＩＧ１が供給され、負入力端子には、バイアス電圧Ｖ３が供給されている。
【００４４】
この構成により、通信システム６では、単相信号によりデータを送受信することができるようになっている。
【００４５】
次に、送信部１０のレイアウトについて説明する。
【００４６】
図１３は、送信部１０における各ブロックの回路配置を表すものである。この図１３には、パッドＰＡＤ１〜ＰＡＤ６およびＥＳＤ（Electro-Static Discharge）保護回路ＥＳＤ１〜ＥＳＤ６も併せて示している。パッドＰＡＤ１〜ＰＡＤ６は、出力端子Ｔout1〜Ｔout6に対応するものであり、ＥＳＤ保護回路ＥＳＤ１〜ＥＳＤ６は、これらのパッドＰＡＤ１〜ＰＡＤ６の近くにそれぞれ配置されている。なお、この図１３では、セレクタ２２，２４，２６，３１〜３６を省いている。実線の矢印は、シリアライザＳＥＲ１〜ＳＥＲ６から、排他的論理和回路４１〜４６への信号の流れと、論理和回路５１〜５６からドライバ部ＤＲＶ１〜ＤＲＶ６への信号の流れを示している。
【００４７】
この例では、シリアライザＳＥＲ１、排他的論理和回路４１、論理和回路５１、およびドライバ部ＤＲＶ１が互いに近くなるように配置している。同様に、シリアライザＳＥＲ２、排他的論理和回路４２、論理和回路５２、ドライバ部ＤＲＶ２が互いに近くなるように配置し、シリアライザＳＥＲ３、排他的論理和回路４３、論理和回路５３、ドライバ部ＤＲＶ３が互いに近くなるように配置し、シリアライザＳＥＲ４、排他的論理和回路４４、論理和回路５４、ドライバ部ＤＲＶ４が互いに近くなるように配置し、シリアライザＳＥＲ５、排他的論理和回路４５、論理和回路５５、ドライバ部ＤＲＶ５が互いに近くなるように配置し、シリアライザＳＥＲ６、排他的論理和回路４６、論理和回路５６、ドライバ部ＤＲＶ６が互いに近くなるように配置している。この例では、このようにレイアウトすることにより、パッドＰＡＤ１〜ＰＡＤ６の配置の順番と、シリアライザＳＥＲ１〜ＳＥＲ６の配置の順番とを同じにしている。
【００４８】
ここで、セレクタ３１は、本開示における「第１のセレクタ」の一具体例に対応し、セレクタ２２，３２は、本開示における「第２のセレクタ」の一具体例に対応する。排他的論理和回路４１〜４３は、本開示における「第１の制御信号生成部」の一具体例に対応する。ドライバ部ＤＲＶ１は、本開示における「第１のドライバ部」の一具体例に対応し、ドライバ部ＤＲＶ２は、本開示における「第２のドライバ部」の一具体例に対応する。動作モードＭ１は、本開示における「第１の動作モード」の一具体例に対応し、動作モードＭ２は、本開示における「第２の動作モード」の一具体例に対応し、動作モードＭ３は、本開示における「第３の動作モード」の一具体例に対応する。動作モードＭ１において、高レベル電圧ＶＨは、本開示における「第１の電圧」の一具体例に対応し、低レベル電圧ＶＬは、本開示における「第２の電圧」の一具体例に対応する。動作モードＭ２において、高レベル電圧ＶＨは、本開示における「第３の電圧」の一具体例に対応し、低レベル電圧ＶＬは、本開示における「第４の電圧」の一具体例に対応し、中レベル電圧ＶＭは、本開示における「第５の電圧」の一具体例に対応する。動作モードＭ３において、高レベル電圧ＶＨは、本開示における「第６の電圧」の一具体例に対応し、低レベル電圧ＶＬは、本開示における「第７の電圧」の一具体例に対応する。
【００４９】
［動作および作用］
続いて、本実施の形態の送信装置１の動作および作用について説明する。
【００５０】
（全体動作概要）
まず、図１，２などを参照して、送信装置１の全体動作概要を説明する。処理部９は、６組のパラレル信号ＤＡＴＡ１〜ＤＡＴＡ６を生成する。送信部１０は、パラレル信号ＤＡＴＡ１〜ＤＡＴＡ６およびモード選択信号ＭＳＥＬに基づいて、信号ＳＩＧ１〜ＳＩＧ６を生成し、伝送線路１０１〜１０６を介して、受信装置に送信する。送信部１０の制御部２０は、モード選択信号ＭＳＥＬに基づいて、３つの動作モードＭ１〜Ｍ３のうちの１つを選択し、送信部１０がその選択された動作モードで動作するように、送信部１０を制御する。
【００５１】
（動作モードＭ１）
動作モードＭ１では、送信装置１は、受信装置に対して差動信号によりデータを送信する。以下に、動作モードＭ１での詳細動作について説明する。
【００５２】
図１４Ａ，１４Ｂは、動作モードＭ１における送信部１０の一動作例を表すものであり、図１４Ａは一の動作状態を示し、図１４Ｂは他の動作状態を示す。
【００５３】
動作モードＭ１では、制御部２０は、クロック信号ＣＬＫ１，ＣＬＫ２および制御信号ＣＴＬ１，ＣＴＬ２を生成する。ここで、クロック信号ＣＬＫ１，ＣＬＫ２は、互いに位相が１８０度ずれた信号である。そして、制御部２０は、シリアライザＳＥＲ１，ＳＥＲ３，ＳＥＲ５に対してクロック信号ＣＬＫ１および制御信号ＣＴＬ１を供給してパラレル信号ＤＡＴＡ１，ＤＡＴＡ３，ＤＡＴＡ５をシリアライズするようにそれぞれ制御するとともに、シリアライザＳＥＲ２，ＳＥＲ４，ＳＥＲ６に対してクロック信号ＣＬＫ２および制御信号ＣＴＬ２を供給してパラレル信号ＤＡＴＡ２，ＤＡＴＡ４，ＤＡＴＡ６をシリアライズするようにそれぞれ制御する。
【００５４】
また、制御部２０は、セレクタ２２，２４，２６に対して制御信号ＳＩＮＶを供給し、セレクタ２２が信号Ｎ１２を選択して出力し、セレクタ２４が信号Ｎ１４を選択して出力し、セレクタ２６が信号Ｎ１６を選択して出力するようにそれぞれ制御する。
【００５５】
また、制御部２０は、セレクタ３１に対して制御信号ＳＥＬ１を供給し、セレクタ３１が信号Ｐ１１と信号Ｐ１２を交互に選択して出力するように制御するとともに、セレクタ３２に対して制御信号ＳＥＬ２を供給し、セレクタ３２が信号Ｎ１１とセレクタ２２の出力信号（信号Ｎ１２）を交互に選択して出力するように制御する。その際、制御部２０は、セレクタ３１が信号Ｐ１１を選択して出力するときはセレクタ３２が信号Ｎ１１を選択するようにセレクタ３１，３２を制御し（図１４Ａ）、セレクタ３１が信号Ｐ１２を選択して出力するときはセレクタ３２が信号Ｎ１２を選択するようにセレクタ３１，３２を制御する（図１４Ｂ）。
【００５６】
図１５は、セレクタ３１，３２の一動作例を示すタイミング波形図を表すものであり、（Ａ）は信号Ｐ１１または信号Ｎ１１の波形を示し、（Ｂ）は信号Ｐ１２または信号Ｎ１２の波形を示し、（Ｃ）は信号Ｓ３１または信号Ｓ３２の波形を示す。この例では、シリアライザＳＥＲ１は、クロック信号ＣＬＫ１に同期して、データＳ０，Ｓ２，Ｓ４，…をこの順に信号Ｐ１１，Ｎ１１として出力し、シリアライザＳＥＲ２は、クロック信号ＣＬＫ２に同期して、データＳ１，Ｓ３，Ｓ５，…をこの順に信号Ｐ１２，Ｎ１２として出力する。その際、クロック信号ＣＬＫ１，ＣＬＫ２は互いに位相が１８０度ずれているため、信号Ｐ１１，Ｎ１１の遷移タイミングと、信号Ｐ１２，Ｎ１２の遷移タイミングもまたずれる。信号Ｐ１１，Ｎ１１におけるデータが安定している期間Ｔ１において（図１５（Ａ））、セレクタ３１は信号Ｐ１１を選択して信号Ｓ３１として出力するとともに、セレクタ３２は信号Ｎ１１を選択して信号Ｓ３２として出力する（図１５（Ｃ））。また、信号Ｐ１２，Ｎ１２におけるデータが安定している期間Ｔ２において（図１５（Ｂ））、セレクタ３１は信号Ｐ１２を選択して信号Ｓ３１として出力するとともに、セレクタ３２は信号Ｎ１２を選択して信号Ｓ３２として出力する（図１５（Ｃ））。ここで、信号Ｎ１１は信号Ｐ１１の反転信号であり、信号Ｎ１２は信号Ｐ１２の反転信号であるため、信号Ｓ３２は、信号Ｓ３１の反転信号である。このような動作の結果、信号Ｓ３１，Ｓ３２には、データＳ０，Ｓ１，Ｓ２，…がこの順に並ぶ。すなわち、動作モードＭ１では、セレクタ３１，３２は、２：１のシリアライザとして機能する。
【００５７】
同様に、制御部２０は、セレクタ３３に対して制御信号ＳＥＬ３を供給し、セレクタ３３が信号Ｐ１３と信号Ｐ１４を交互に選択して出力するように制御するとともに、セレクタ３４に対して制御信号ＳＥＬ４を供給し、セレクタ３４が信号Ｎ１３とセレクタ２４の出力信号（信号Ｎ１４）を交互に選択して出力するように制御する。また、制御部２０は、セレクタ３５に対して制御信号ＳＥＬ５を供給し、セレクタ３５が信号Ｐ１５と信号Ｐ１６を交互に選択して出力するように制御するとともに、セレクタ３６に対して制御信号ＳＥＬ６を供給し、セレクタ３６が信号Ｎ１５とセレクタ２６の出力信号（信号Ｎ１６）を交互に選択して出力するように制御する。
【００５８】
また、制御部２０は、論理和回路５１〜５６に対して、“１”を示す制御信号ＳＭＭを供給する。これにより、信号Ｓ５１〜Ｓ５６は“１”となる。その結果、ドライバ部ＤＲＶ１〜ＤＲＶ６は、信号Ｓ３１〜Ｓ３６に応じて、信号ＳＩＧ１〜ＳＩＧ６を高レベル電圧ＶＨまたは低レベル電圧ＶＬにそれぞれ設定する。その際、信号Ｓ３１と信号Ｓ３２は互いに反転しているため、信号ＳＩＧ１，ＳＩＧ２は差動信号を構成する。同様に、信号ＳＩＧ３，ＳＩＧ４は差動信号を構成し、信号ＳＩＧ５，ＳＩＧ６は差動信号を構成する。
【００５９】
このように、動作モードＭ１では、送信装置１は、受信装置に対して差動信号によりデータを送信する。
【００６０】
（動作モードＭ２）
動作モードＭ２では、送信装置１は、受信装置に対して３相信号によりデータを送信する。以下に、動作モードＭ２での詳細動作について説明する。
【００６１】
図１６は、動作モードＭ２における送信部１０の一動作例を表すものである。動作モードＭ２では、制御部２０は、クロック信号ＣＬＫ１，ＣＬＫ２および制御信号ＣＴＬ１，ＣＴＬ２を生成する。ここで、クロック信号ＣＬＫ１，ＣＬＫ２は、位相がほぼ等しい信号である。そして、制御部２０は、シリアライザＳＥＲ１，ＳＥＲ３，ＳＥＲ５に対してクロック信号ＣＬＫ１および制御信号ＣＴＬ１を供給してパラレル信号ＤＡＴＡ１，ＤＡＴＡ３，ＤＡＴＡ５をシリアライズするようにそれぞれ制御するとともに、シリアライザＳＥＲ２，ＳＥＲ４，ＳＥＲ６に対してクロック信号ＣＬＫ２および制御信号ＣＴＬ２を供給してパラレル信号ＤＡＴＡ２，ＤＡＴＡ４，ＤＡＴＡ６をシリアライズするようにそれぞれ制御する。
【００６２】
また、制御部２０は、セレクタ２２，２４，２６に対して制御信号ＳＩＮＶを供給し、セレクタ２２が信号Ｐ１２を選択して出力し、セレクタ２４が信号Ｐ１４を選択して出力し、セレクタ２６が信号Ｐ１６を選択して出力するようにそれぞれ制御する。
【００６３】
また、制御部２０は、セレクタ３１に対して制御信号ＳＥＬ１を供給して信号Ｐ１１を選択して信号Ｓ３１として出力するように制御し、セレクタ３２に対して制御信号ＳＥＬ２を供給してセレクタ２２の出力信号（信号Ｐ１２）を選択して信号Ｓ３２として出力するように制御し、セレクタ３３に対して制御信号ＳＥＬ３を供給して信号Ｐ１３を選択して信号Ｓ３３として出力するように制御する。同様に、制御部２０は、セレクタ３４に対して制御信号ＳＥＬ４を供給してセレクタ２４の出力信号（信号Ｐ１４）を選択して信号Ｓ３４として出力するように制御し、セレクタ３５に対して制御信号ＳＥＬ５を供給して信号Ｐ１５を選択して信号Ｓ３５として出力するように制御し、セレクタ３６に対して制御信号ＳＥＬ６を供給してセレクタ２６の出力信号（信号Ｐ１６）を選択して信号Ｓ３６として出力するように制御する。
【００６４】
また、制御部２０は、論理和回路５１〜５６に対して、“０”を示す制御信号ＳＭＭを供給する。これにより、信号Ｓ５１〜Ｓ５６は、排他的論理和回路４１〜４６の出力信号と同じ信号になる。その結果、ドライバ部ＤＲＶ１〜ＤＲＶ３は、信号Ｓ３１〜Ｓ３３および信号Ｓ５１〜Ｓ５３に基づいて、信号ＳＩＧ１〜ＳＩＧ３を、互いに異なる３つの電圧（高レベル電圧ＶＨ、低レベル電圧ＶＬ、中レベル電圧ＶＭ）に設定する。同様に、ドライバ部ＤＲＶ４〜ＤＲＶ６は、信号Ｓ３４〜Ｓ３６および信号Ｓ５４〜Ｓ５６に基づいて、信号ＳＩＧ４〜ＳＩＧ６を、互いに異なる３つの電圧（高レベル電圧ＶＨ、低レベル電圧ＶＬ、中レベル電圧ＶＭ）に設定する。
【００６５】
図１７は、排他的論理和回路４１〜４３およびドライバ部ＤＲＶ１〜ＤＲＶ３の動作を表すものである。なお、排他的論理和回路４４〜４６およびドライバ部ＤＲＶ４〜ＤＲＶ６についても同様である。
【００６６】
例えば、信号Ｐ１１が“１”であり、信号Ｐ１２，Ｐ１３がともに“０”である場合には、信号Ｓ５１，Ｓ５２がともに“１”になり、信号Ｓ５３が“０”になる。よって、ドライバ部ＤＲＶ１は、信号Ｓ３１（信号Ｐ１１）が“１”であり、信号Ｓ５１が“１”であるため、信号ＳＩＧ１を高レベル電圧ＶＨに設定する。また、ドライバ部ＤＲＶ２は、信号Ｓ３２（信号Ｐ１２）が“０”であり、信号Ｓ５２が“１”であるため、信号ＳＩＧ２を低レベル電圧ＶＬに設定する。また、ドライバ部ＤＲＶ３は、信号Ｓ５３が“０”であるため、信号ＳＩＧ３を中レベル電圧ＶＭに設定する。
【００６７】
また、例えば、信号Ｐ１１，Ｐ１３がともに“０”であり、信号Ｐ１２が“１”である場合には、信号Ｓ５１が“０”になり、信号Ｓ５２，Ｓ５３がともに“１”になる。よって、ドライバ部ＤＲＶ１は、信号Ｓ５１が“０”であるため、信号ＳＩＧ１を中レベル電圧ＶＭに設定する。また、ドライバ部ＤＲＶ２は、信号Ｓ３２（信号Ｐ１２）が“１”であり、信号Ｓ５２が“１”であるため、信号ＳＩＧ２を高レベル電圧ＶＨに設定する。また、ドライバ部ＤＲＶ３は、信号Ｓ３３（信号Ｐ１３）が“０”であり、信号Ｓ５３が“１”であるため、信号ＳＩＧ３を低レベル電圧ＶＬに設定する。
【００６８】
また、例えば、信号Ｐ１１，Ｐ１２がともに“０”であり、信号Ｐ１３が“１”である場合には、信号Ｓ５１，Ｓ５３がともに“１”になり、信号Ｓ５２が“０”になる。よって、ドライバ部ＤＲＶ１は、信号Ｓ３１（信号Ｐ１１）が“０”であり、信号Ｓ５１が“１”であるため、信号ＳＩＧ１を低レベル電圧ＶＬに設定する。また、ドライバ部ＤＲＶ２は、信号Ｓ５２が“０”であるため、信号ＳＩＧ２を中レベル電圧ＶＭに設定する。また、ドライバ部ＤＲＶ３は、信号Ｓ３３（信号Ｐ１３）が“１”であり、信号Ｓ５３が“１”であるため、信号ＳＩＧ３を高レベル電圧ＶＨに設定する。
【００６９】
このように、動作モードＭ２では、送信装置１は、受信装置に対して３相信号によりデータを送信する。
【００７０】
（動作モードＭ３）
動作モードＭ３では、送信装置１は、受信装置に対して単相信号によりデータを送信する。以下に、動作モードＭ３での詳細動作について説明する。
【００７１】
図１８は、動作モードＭ３における送信部１０の一動作例を表すものである。動作モードＭ３では、制御部２０は、クロック信号ＣＬＫ１，ＣＬＫ２および制御信号ＣＴＬ１，ＣＴＬ２を生成する。この例では、クロック信号ＣＬＫ１，ＣＬＫ２は、位相がほぼ等しい信号である。そして、制御部２０は、シリアライザＳＥＲ１，ＳＥＲ３，ＳＥＲ５に対してクロック信号ＣＬＫ１および制御信号ＣＴＬ１を供給してパラレル信号ＤＡＴＡ１，ＤＡＴＡ３，ＤＡＴＡ５をシリアライズするようにそれぞれ制御するとともに、シリアライザＳＥＲ２，ＳＥＲ４，ＳＥＲ６に対してクロック信号ＣＬＫ２および制御信号ＣＴＬ２を供給してパラレル信号ＤＡＴＡ２，ＤＡＴＡ４，ＤＡＴＡ６をシリアライズするようにそれぞれ制御する。
【００７２】
また、制御部２０は、セレクタ２２，２４，２６に対して制御信号ＳＩＮＶを供給し、セレクタ２２が信号Ｐ１２を選択して出力し、セレクタ２４が信号Ｐ１４を選択して出力し、セレクタ２６が信号Ｐ１６を選択して出力するようにそれぞれ制御する。
【００７３】
また、制御部２０は、セレクタ３１に対して制御信号ＳＥＬ１を供給して信号Ｐ１１を選択して信号Ｓ３１として出力するように制御する。また、制御部２０は、セレクタ３２に対して制御信号ＳＥＬ２を供給してセレクタ２２の出力信号（信号Ｐ１２）を選択して信号Ｓ３２として出力するように制御する。制御部２０は、セレクタ３３に対して制御信号ＳＥＬ３を供給して信号Ｐ１３を選択して信号Ｓ３３として出力するように制御する。制御部２０は、セレクタ３４に対して制御信号ＳＥＬ４を供給してセレクタ２４の出力信号（信号Ｐ１４）を選択して信号Ｓ３４として出力するように制御する。制御部２０は、セレクタ３５に対して制御信号ＳＥＬ５を供給して信号Ｐ１５を選択して信号Ｓ３５として出力するように制御する。制御部２０は、セレクタ３６に対して制御信号ＳＥＬ６を供給してセレクタ２６の出力信号（信号Ｐ１６）を選択して信号Ｓ３６として出力するように制御する。
【００７４】
また、制御部２０は、論理和回路５１〜５６に対して、“１”を示す制御信号ＳＭＭを供給する。これにより、信号Ｓ５１〜Ｓ５６は“１”となる。その結果、ドライバ部ＤＲＶ１〜ＤＲＶ６は、信号Ｓ３１〜Ｓ３６に応じて、信号ＳＩＧ１〜ＳＩＧ６を高レベル電圧ＶＨまたは低レベル電圧ＶＬに設定する。
【００７５】
このように、動作モードＭ１では、送信装置１は、受信装置に対して単相信号によりデータを送信する。
【００７６】
以上のように、送信装置１では、複数の動作モードＭ１〜Ｍ３を設け、差動信号、３相信号、および単相信号により受信装置に対してデータを送信することができるようにしたので、様々なインタフェースを実現することができる。
【００７７】
これにより、例えば、電子機器のシステム設計の自由度を高めることができる。具体的には、例えば、この送信部１０をプロセッサに搭載した場合には、３相信号に対応した周辺デバイスを用いて電子機器を構成することもできるし、差動信号に対応した周辺デバイスを用いて電子機器を構成することもできる。また、例えば、１つのプロセッサで様々なインタフェースを実現することができるため、インタフェースごとにプロセッサを準備する必要がないため、プロセッサの品種数を絞ることができ、コストを削減することができる。また、各動作モードＭ１〜Ｍ３において、シリアライザＳＥＲ１〜ＳＥＲ６、セレクタ３１〜３６、ドライバ部ＤＲＶ１〜ＤＲＶ６などを共用するようにしたので、インタフェースごとに別回路を設ける場合に比べて、回路配置に必要な面積を抑えることができる。
【００７８】
［効果］
以上のように本実施の形態では、複数の動作モードを設け、差動信号、３相信号、および単相信号により受信装置に対してデータを送信することができるようにしたので、様々なインタフェースを実現することができる。
【００７９】
［変形例１］
上記実施の形態では、図１３に示したように、パッドＰＡＤ１〜ＰＡＤ６の配置の順番と、シリアライザＳＥＲ１〜ＳＥＲ６の配置の順番とを同じにしたが、これに限定されるものではなく、これに代えて、例えば、図１９に示したように、パッドＰＡＤ１〜ＰＡＤ６の配置の順番と、シリアライザＳＥＲ１〜ＳＥＲ６の配置の順番とが異なるようにしてもよい。この例では、シリアライザＳＥＲ３、排他的論理和回路４２、論理和回路５２、およびドライバ部ＤＲＶ２が互いに近くなるように配置し、シリアライザＳＥＲ２、排他的論理和回路４３、論理和回路５３、およびドライバ部ＤＲＶ３が互いに近くなるように配置し、シリアライザＳＥＲ６、排他的論理和回路４４、論理和回路５５、およびドライバ部ＤＲＶ５が互いに近くなるように配置し、シリアライザＳＥＲ５、排他的論理和回路４６、論理和回路５６、およびドライバ部ＤＲＶ６が互いに近くなるように配置している。すなわち、この図１９の例は、図１３の例において、シリアライザＳＥＲ２とシリアライザＳＥＲ３とを入れ替え、シリアライザＳＥＲ５とシリアライザＳＥＲ６とを入れ替えたものである。これにより、本変形例では、シリアライザＳＥＲ１〜ＳＥＲ６から排他的論理和回路４１〜４６への信号パスの長さのばらつきを抑えることができる。すなわち、図１３に示した例では、シリアライザＳＥＲ３から排他的論理和回路４１への信号パスが他の信号パスに比べて長くなる。これにより、この信号パスを通る信号が遅延し、結果として信号ＳＩＧ１などの波形が乱れるおそれがある。一方、本変形例（図１９）では、シリアライザＳＥＲ１〜ＳＥＲ６から排他的論理和回路４１〜４６への信号パスの長さのばらつきを抑えることができるため、信号ＳＩＧ１〜ＳＩＧ６の波形が乱れるおそれを低減することができる。
【００８０】
［変形例２］
上記実施の形態では、制御部２０は、動作モードＭ１〜Ｍ３に応じてシリアライザＳＥＲ１〜ＳＥＲ６の動作を制御したが、その際、例えば、動作モードＭ１〜Ｍ３に応じて動作周波数を変更するようにしてもよい。また、例えば、フリップフロップ８１〜８７のうちの使用するフリップフロップの数を変更するようにしてもよい。例えば、シリアライザＳＥＲ１のフリップフロップ８１〜８７のうちの５つのフリップフロップを使用する場合には、まず、処理部９が、パラレル信号ＤＡＴＡ１として、信号Ｄ［４］〜Ｄ［０］をシリアライザＳＥＲ１に供給する。そして、シリアライザＳＥＲ１では、制御信号ＣＴＬ１を“１”にすることにより、フリップフロップ８３〜８７が、信号Ｄ［４］〜Ｄ［０］をそれぞれ記憶する。そして、制御信号ＣＴＬ１を“０”にすることにより、シリアライザＳＥＲ１は、クロック信号ＣＬＫ１に同期して信号Ｄ［０］〜Ｄ［４］をこの順で出力する。これにより、シリアライザＳＥＲ１は５：１のシリアライザとして動作する。
【００８１】
［変形例３］
上記実施の形態では、送信部１０に６つのドライバ部ＤＲＶ１〜ＤＲＶ６を設けたが、これに限定されるものではなく、これに代えて、例えば、図２０に示す送信部１０Ｃのように、４つのドライバ部ＤＲＶ１〜ＤＲＶ４を設けてもよい。この送信部１０Ｃは、上記実施の形態に係る送信部１０（図２）から、シリアライザＳＥＲ５，ＳＥＲ６、セレクタ２６，３５，３６、排他的論理和回路４４〜４６、論理和回路５５，５６、およびドライバ部ＤＲＶ５，ＤＲＶ６を省いたものである。この例では、ドライバ部ＤＲＶ４に供給される信号Ｓ５４を“１”に設定している。制御部２０Ｃは、動作モードＭ１〜Ｍ３に応じて、クロック信号ＣＬＫ１，ＣＬＫ２、および制御信号ＣＴＬ１，ＣＴＬ２，ＳＩＮＶ，ＳＥＬ１〜ＳＥＬ４，ＳＭＭを生成し、これらの制御信号を用いて送信部１０Ｃの各ブロックの動作を制御する。これにより、送信部１０Ｃは、動作モードＭ１では、信号ＳＩＧ１，ＳＩＧ２が差動信号を構成し、信号ＳＩＧ３，ＳＩＧ４が差動信号を構成する。また、動作モードＭ２では、信号ＳＩＧ１〜ＳＩＧ３が３相信号を構成する。動作モードＭ３では、信号ＳＩＧ１〜ＳＩＧ４は、それぞれ単相信号である。
【００８２】
また、例えば、図２１に示す送信部１０Ｄのように、３つのドライバ部ＤＲＶ１〜ＤＲＶ３を設けてもよい。この送信部１０Ｄは、上記実施の形態に係る送信部１０（図２）から、シリアライザＳＥＲ４〜ＳＥＲ６、セレクタ２４，２６，３３〜３６、排他的論理和回路４４〜４６、論理和回路５４〜５６、およびドライバ部ＤＲＶ４〜ＤＲＶ６を省いたものである。送信部１０では、シリアライザＳＥＲ３の出力信号Ｐ１３を、セレクタ３３を介してドライバ部ＤＲＶ３に供給したが、この送信部１０Ｄでは、シリアライザＳＥＲ３の出力信号Ｐ１３を直接ドライバ部ＤＲＶ３に供給している。制御部２０Ｄは、動作モードＭ１〜Ｍ３に応じて、クロック信号ＣＬＫ１，ＣＬＫ２、および制御信号ＣＴＬ１，ＣＴＬ２，ＳＩＮＶ，ＳＥＬ１，ＳＥＬ２，ＳＭＭを生成し、これらの制御信号を用いて送信部１０Ｄの各ブロックの動作を制御する。これにより、送信部１０Ｄは、動作モードＭ１では、信号ＳＩＧ１，ＳＩＧ２が差動信号を構成する。また、動作モードＭ２では、信号ＳＩＧ１〜ＳＩＧ３が３相信号を構成する。動作モードＭ３では、信号ＳＩＧ１〜ＳＩＧ３は、それぞれ単相信号である。
【００８３】
［変形例４］
上記実施の形態では、処理部９は、６組のパラレル信号ＤＡＴＡ１〜ＤＡＴＡ６を生成したが、その際、例えば８ｂ／１０ｂなどの変換方式によりデータをエンコードしてこれらのパラレル信号ＤＡＴＡ１〜ＤＡＴＡ６を生成してもよい。これにより、受信装置におけるクロックリカバリを容易に行うことができる。また、例えば、処理部９は、動作モードＭ１〜Ｍ３に応じて、エンコードをするか否か、あるいはエンコードの方式を変更するように構成してもよい。
【００８４】
［変形例５］
上記実施の形態では、信号ＳＩＧ１〜ＳＩＧ６を生成して受信装置に対して送信したが、その際、信号ＳＩＧ１〜ＳＩＧ６のうちの少なくとも１つを電圧ＶＨと電圧ＶＬの交番パターンにしてもよい。これにより、受信装置は、その信号をクロック信号として用いることができる。具体的には、例えば、動作モードＭ１において、図２２に示すように、信号ＳＩＧ５，ＳＩＧ６を差動のクロック信号にすることができる。また、例えば、動作モードＭ３において、図２３に示すように、信号ＳＩＧ６をクロック信号にすることができる。また、この図２３において、信号ＳＩＧ５を信号ＳＩＧ６の反転信号にすることにより、信号ＳＩＧ１〜ＳＩＧ４を単相信号にするとともに、信号ＳＩＧ５，ＳＩＧ６を差動のクロック信号にすることができる。
【００８５】
＜２．適用例＞
次に、上記実施の形態および変形例で説明した送信装置の適用例について説明する。
【００８６】
図２４は、上記実施の形態等の送信装置が適用されるスマートフォン３００（多機能携帯電話）の外観を表すものである。このスマートフォン３００には、様々なデバイスが搭載されており、それらのデバイス間でデータのやり取りを行う通信システムにおいて、上記実施の形態等の送信装置が適用されている。
【００８７】
図２５は、スマートフォン３００に用いられるアプリケーションプロセッサ３１０の一構成例を表すものである。アプリケーションプロセッサ３１０は、ＣＰＵ（Central Processing Unit）３１１と、メモリ制御部３１２と、電源制御部３１３と、外部インタフェース３１４と、ＧＰＵ（Graphics Processing Unit）３１５と、メディア処理部３１６と、ディスプレイ制御部３１７と、ＭＩＰＩ（Mobile Industry Processor Interface）インタフェース３１８とを有している。ＣＰＵ３１１、メモリ制御部３１２、電源制御部３１３、外部インタフェース３１４、ＧＰＵ３１５、メディア処理部３１６、ディスプレイ制御部３１７は、この例では、システムバス３１９に接続され、このシステムバス３１９を介して、互いにデータのやり取りをすることができるようになっている。
【００８８】
ＣＰＵ３１１は、プログラムに従って、スマートフォン３００で扱われる様々な情報を処理するものである。メモリ制御部３１２は、ＣＰＵ３１１が情報処理を行う際に使用するメモリ５０１を制御するものである。電源制御部３１３は、スマートフォン３００の電源を制御するものである。
【００８９】
外部インタフェース３１４は、外部デバイスと通信するためのインタフェースであり、この例では、無線通信部５０２およびイメージセンサ５０３と接続されている。無線通信部５０２は、携帯電話の基地局と無線通信をするものであり、例えば、ベースバンド部や、ＲＦ（Radio Frequency）フロントエンド部などを含んで構成される。イメージセンサ５０３は、画像を取得するものであり、例えばＣＭＯＳセンサを含んで構成される。
【００９０】
ＧＰＵ３１５は、画像処理を行うものである。メディア処理部３１６は、音声や、文字や、図形などの情報を処理するものである。ディスプレイ制御部３１７は、ＭＩＰＩインタフェース３１８を介して、ディスプレイ５０４を制御するものである。ＭＩＰＩインタフェース３１８は画像信号をディスプレイ５０４に送信するものである。画像信号としては、例えば、ＹＵＶ形式やＲＧＢ形式などの信号を用いることができる。このＭＩＰＩインタフェース３１８には、例えば、上記実施の形態等の送信装置が適用される。
【００９１】
図２６は、イメージセンサ４１０の一構成例を表すものである。イメージセンサ４１０は、センサ部４１１と、ＩＳＰ（Image Signal Processor）４１２と、ＪＰＥＧ（Joint Photographic Experts Group）エンコーダ４１３と、ＣＰＵ４１４と、ＲＡＭ（Random Access Memory）４１５と、ＲＯＭ（Read Only Memory）４１６と、電源制御部４１７と、Ｉ2Ｃ（Inter-Integrated Circuit）インタフェース４１８と、ＭＩＰＩインタフェース４１９とを有している。これらの各ブロックは、この例では、システムバス４２０に接続され、このシステムバス４２０を介して、互いにデータのやり取りをすることができるようになっている。
【００９２】
センサ部４１１は、画像を取得するものであり、例えばＣＭＯＳセンサにより構成されるものである。ＩＳＰ４１２は、センサ部４１１が取得した画像に対して所定の処理を行うものである。ＪＰＥＧエンコーダ４１３は、ＩＳＰ４１２が処理した画像をエンコードしてＪＰＥＧ形式の画像を生成するものである。ＣＰＵ４１４は、プログラムに従ってイメージセンサ４１０の各ブロックを制御するものである。ＲＡＭ４１５は、ＣＰＵ４１４が情報処理を行う際に使用するメモリである。ＲＯＭ４１６は、ＣＰＵ４１４において実行されるプログラムを記憶するものである。電源制御部４１７は、イメージセンサ４１０の電源を制御するものである。Ｉ2Ｃインタフェース４１８は、アプリケーションプロセッサ３１０から制御信号を受け取るものである。また、図示していないが、イメージセンサ４１０は、アプリケーションプロセッサ３１０から、制御信号に加えてクロック信号をも受け取るようになっている。具体的には、イメージセンサ４１０は、様々な周波数のクロック信号に基づいて動作できるよう構成されている。ＭＩＰＩインタフェース４１９は、画像信号をアプリケーションプロセッサ３１０に送信するものである。画像信号としては、例えば、ＹＵＶ形式やＲＧＢ形式などの信号を用いることができる。このＭＩＰＩインタフェース４１９には、例えば、上記実施の形態等の送信装置が適用される。
【００９３】
以上、実施の形態および変形例、ならびに電子機器への適用例を挙げて本技術を説明したが、本技術はこれらの実施の形態等には限定されず、種々の変形が可能である。
【００９４】
例えば、上記の実施の形態では、排他的論理和回路４１〜４６を設けたが、これに限定されるものではなく、これに代えて、例えば、図２７に示す送信部１０Ｅのように、信号Ｐ１１〜Ｐ１３に基づいて動作するエンコーダ９８と、信号Ｐ１４〜Ｐ１６に基づいて動作するエンコーダ９９とを設けてもよい。このエンコーダ９８，９９は、図１７に示した動作を実現できるように構成されたものである。また、例えば、エンコーダ９８は、信号Ｐ１１〜Ｐ１３，Ｎ１１〜Ｎ１３の全てまたは一部に基づいて動作するように構成してもよい。同様に、例えば、エンコーダ９９は、信号Ｐ１４〜Ｐ１６，Ｎ１４〜Ｎ１６の全てまたは一部に基づいて動作するように構成してもよい。
【００９５】
また、例えば、上記の実施の形態では、ドライバ部ＤＲＶ１〜ＤＲＶ６のそれぞれが、５つのドライバ回路６１〜６５を有するようにしたが、これに限定されるものではなく、これに代えて、例えば、４つ以下のドライバ回路を有していてもよいし、６つ以上のドライバ回路を有していてもよい。
【００９６】
また、例えば、上記の実施の形態では、ドライバ制御部６０は、動作モードＭ２において、信号Ｓ５１が“０”である場合において、ドライバ回路６１〜６５における２つのトランジスタ９２および２つのトランジスタ９３をオン状態にしたが、これに限定されるものではなく、これに代えて、全てのトランジスタ９２，９３をオフ状態にしてもよい。例えば、ドライバ部ＤＲＶ１の全てのトランジスタ９２，９３をオフ状態にした場合には、例えば、ドライバ部ＤＲＶ１の出力インピーダンスはハイインピーダンス状態になる。これにより、信号ＳＩＧ１は、レシーバ部１２１の抵抗素子１２４〜１２６（図９）を介して、中レベル電圧ＶＭに設定される。
【００９７】
なお、本明細書に記載された効果はあくまで例示であって限定されるものでは無く、また他の効果があってもよい。
【符号の説明】
【００９８】
１，１Ｃ，１Ｄ…送信装置、４〜６…通信システム、９…処理部、１０…送信部、２０，２０Ｃ，２０Ｄ…制御部、２２，２４，２６，３１〜３６，７１〜７７…セレクタ、４１〜４６…排他的論理和回路、５１〜５６…論理和回路、６０…ドライバ制御部、６１〜６５…ドライバ回路、８１〜８７…フリップフロップ、９１，９４，９５…抵抗素子、９２，９３…トランジスタ、９８，９９…エンコーダ、１０１〜１０６…伝送線路、１１０，１２０，１３０…受信装置、１１１〜１１３，１２１，１２２，１３１〜１３６…レシーバ部、１１６，１２４〜１２６，１３８…抵抗素子、１１７，１２７〜１２９，１３９…アンプ、３００…スマートフォン、３１０…アプリケーションプロセッサ、３１１…ＣＰＵ、３１２…メモリ制御部、３１３…電源制御部、３１４…外部インタフェース、３１５…ＧＰＵ、３１６…メディア処理部、３１７…ディスプレイ制御部、３１８…ＭＩＰＩインタフェース、３１９…システムバス、４１０…イメージセンサ、５０１…メモリ、５０２…無線通信部、４１１…センサ部、４１２…ＩＳＰ、４１３…ＪＰＥＧエンコーダ、４１４…ＣＰＵ、４１５…ＲＡＭ、４１６…ＲＯＭ、４１７…電源制御部、４１８…Ｉ2Ｃインタフェース、４１９…ＭＩＰＩインタフェース、４２０…システムバス、ＣＬＫ１，ＣＬＫ２…クロック信号、ＣＴＬ１，ＣＴＬ２，ＳＥＬ１〜ＳＥＬ６，ＳＩＮＶ，ＳＭＭ…制御信号、ＤＡＴＡ１〜ＤＡＴＡ６…パラレル信号、ＥＳＤ１〜ＥＳＤ６…ＥＳＤ保護回路、ＭＳＥＬ…モード選択信号、Ｎ１１〜Ｎ１６，Ｐ１１〜Ｐ１６，Ｓ３１〜Ｓ３６、Ｓ５１〜Ｓ５６…信号、ＰＡＤ１〜ＰＡＤ６…パッド、ＳＥＲ１〜ＳＥＲ６…シリアライザ、ＳＩＧ１〜ＳＩＧ６…信号、Ｔin11，Ｔin12，Ｔin21〜Ｔin23，Ｔin31…入力端子、Ｔout1〜Ｔout6…出力端子、ＶＨ…高レベル電圧、ＶＬ…低レベル電圧、ＶＭ…中レベル電圧。
【図１】
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【図２】
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【図３】
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【図４】
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【図５】
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【図６】
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【図７】
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【図８】
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【図９】
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【図１０】
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【図１１】
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【図１２】
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【図１３】
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【図１４Ａ】
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【図１４Ｂ】
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【図１５】
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【図１６】
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【図１７】
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【図１８】
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【図１９】
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【図２０】
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【図２１】
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【図２２】
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【図２３】
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【図２４】
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【図２５】
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【図２６】
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【図２７】
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