(57)【要約】【課題】適切なテスト条件を決定可能な技術を提供することを目的とする。【解決手段】テスト条件決定装置１は、マップ作成部１１と、耐圧推定部１２と、テスト条件決定部１３とを備える。マップ作成部１１は、エピタキシャル成長層の厚さの測定値、エピタキシャル成長層のキャリア濃度の測定値、並びに、エピタキシャル成長層及び基板の結晶欠陥の測定結果に基づいて、チップ２２に関するウエハマップ２５を作成する。耐圧推定部１２は、ウエハマップ２５に基づいてチップ２２の耐圧を推定する。テスト条件決定部１３は、耐圧推定部１２の推定結果に基づいてチップ２２に実施すべきテスト条件を決定する。【選択図】図１
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【特許請求の範囲】
【請求項１】
エピタキシャル成長層が配設された基板の複数個所における、前記エピタキシャル成長層の厚さの測定値、前記エピタキシャル成長層のキャリア濃度の測定値、並びに、前記エピタキシャル成長層及び前記基板の結晶欠陥の測定結果に基づいて、チップに関するウエハマップを作成するマップ作成部と、
前記マップ作成部で作成されたウエハマップに基づいて前記チップの耐圧を推定する耐圧推定部と、
前記耐圧推定部の推定結果に基づいて前記チップに実施すべきテスト条件を決定するテスト条件決定部と
を備える、テスト条件決定装置。
【請求項２】
請求項１に記載のテスト条件決定装置であって、
前記エピタキシャル成長層の厚さは、フーリエ変換赤外分光光度計を用いた反射干渉解析で測定され、
前記エピタキシャル成長層のキャリア濃度は、水銀電極を用いたＣ−Ｖ特性測定方法で測定され、
前記エピタキシャル成長層及び前記基板の結晶欠陥は、Ｘ線トポグラフ法で測定される、テスト条件決定装置。
【請求項３】
請求項１または請求項２に記載のテスト条件決定装置であって、
前記テスト条件決定部は、
前記テスト条件の決定として、高耐圧テストの実施の有無を決定する、テスト条件決定装置。
【請求項４】
（ａ）エピタキシャル成長層が配設された基板の複数個所における、前記エピタキシャル成長層の厚さの測定値、前記エピタキシャル成長層のキャリア濃度の測定値、並びに、前記エピタキシャル成長層及び前記基板の結晶欠陥の測定結果に基づいて、チップに関するウエハマップを作成する工程と、
（ｂ）前記工程（ａ）で作成されたウエハマップに基づいて前記チップの耐圧を推定する工程と、
（ｃ）前記工程（ｂ）の推定結果に基づいて前記チップに実施すべきテスト条件を決定する工程と
を備える、テスト条件決定方法。
【請求項５】
請求項４に記載のテスト条件決定方法であって、
前記エピタキシャル成長層及び前記基板の少なくとも一方へのイオン注入と、結晶性回復のためのアニールとが順に行われた後に、前記エピタキシャル成長層及び前記基板の結晶欠陥が測定される、テスト条件決定方法。
【請求項６】
請求項４に記載のテスト条件決定方法であって、
前記エピタキシャル成長層及び前記基板の少なくとも一方へのイオン注入と、結晶性回復のためのアニールと、アニール用保護膜の除去とが順に行われた後に、前記エピタキシャル成長層及び前記基板の結晶欠陥が測定される、テスト条件決定方法。
【発明の詳細な説明】
【技術分野】
【０００１】
本発明は、テスト条件を決定するテスト条件決定装置、及び、テスト条件決定方法に関する。
【背景技術】
【０００２】
半導体装置の品質を高めるために、エピタキシャル成長層が配設された基板をテストする技術が様々に提案されている（例えば特許文献１）。通常、基板とエピタキシャル成長層とを含む半導体素子の耐圧テストは、半導体素子表面に設けられた電極にプローバを接触させて行われる。
【先行技術文献】
【特許文献】
【０００３】
【特許文献１】特開２０１１−２５８６８３号公報
【発明の概要】
【発明が解決しようとする課題】
【０００４】
しかしながら、エピタキシャル成長層及び基板の結晶欠陥の単位面積あたりの個数が一定の値を超えた場合には、半導体素子の耐圧が低下する。耐圧が低下した半導体素子に定格最大値での耐圧テストを行うと、半導体素子が破損する場合があり、その際、テスター側の電極（ステージ）やプローバなどを破損させてしまうという問題があった。
【０００５】
そこで、本発明は、上記のような問題点を鑑みてなされたものであり、適切なテスト条件を決定可能な技術を提供することを目的とする。
【課題を解決するための手段】
【０００６】
本発明に係るテスト条件決定装置は、エピタキシャル成長層が配設された基板の複数点における、前記エピタキシャル成長層の厚さの測定値、前記エピタキシャル成長層のキャリア濃度の測定値、並びに、前記エピタキシャル成長層及び前記基板の結晶欠陥の測定結果に基づいて、チップに関するウエハマップを作成するマップ作成部と、前記マップ作成部で作成されたウエハマップに基づいて前記チップの耐圧を推定する耐圧推定部と、前記耐圧推定部の推定結果に基づいて前記チップに実施すべきテスト条件を決定するテスト条件決定部とを備える。
【発明の効果】
【０００７】
本発明によれば、エピタキシャル成長層の厚さの測定値、エピタキシャル成長層のキャリア濃度の測定値、並びに、エピタキシャル成長層及び基板の結晶欠陥の測定結果に基づいてウエハマップを作成し、作成されたウエハマップに基づいてチップの耐圧を推定し、その推定結果に基づいてチップに実施すべきテスト条件を決定する。これにより、適切なテスト条件を決定することができる。
【図面の簡単な説明】
【０００８】
【図１】実施の形態１に係るテスト条件決定装置の構成を示すブロック図である。
【図２】実施の形態１に係るテスト条件決定装置の動作を模式的に示す図である。
【図３】実施の形態１に係る半導体装置の製造方法を示すフローチャートである。
【図４】実施の形態１の変形例２に係る測定を説明するための図である。
【図５】実施の形態１の変形例２に係る測定を説明するための図である。
【図６】実施の形態１の変形例３に係る半導体装置の製造方法を示すフローチャートである。
【図７】実施の形態１の変形例３に係る半導体装置の製造方法を示すフローチャートである。
【発明を実施するための形態】
【０００９】
＜実施の形態１＞
図１は、本発明の実施の形態１に係るテスト条件決定装置１の構成を示すブロック図である。テスト条件決定装置１は、エピタキシャル成長層が配設された基板のチップに対してテスト条件を決定する装置である。テスト条件決定装置１は、例えば、ｎ型炭化珪素（ＳｉＣ）エピタキシャル成長層が配設された、当該エピタキシャル成長層よりも不純物濃度が高いｎ型炭化珪素（ＳｉＣ）基板のチップについてテスト条件を決定する。なお以下の説明において、ウエハと基板とは同義であり、チップと半導体素子とは同義であるものとする。
【００１０】
図１に示すように、テスト条件決定装置１は、マップ作成部１１と、耐圧推定部１２と、テスト条件決定部１３とを備える。
【００１１】
マップ作成部１１は、エピタキシャル成長層が配設された基板の複数個所における、エピタキシャル成長層の厚さの測定値、エピタキシャル成長層のキャリア濃度の測定値、並びに、エピタキシャル成長層及び基板の結晶欠陥の測定結果を取得する。そして、マップ作成部１１は、これら測定に基づいてチップに関するウエハマップを作成する。
【００１２】
図２は、実施の形態１に係るテスト条件決定装置１の動作を模式的に示す図である。
【００１３】
図２の測定結果ａは、エピタキシャル成長層の厚さの測定値に対応している。領域２１ａは、ウエハ２１のうち比較的高い耐圧が見込まれる厚さが測定された領域であり、厚さの閾値によって他の領域と区別される領域である。なお、エピタキシャル成長層の厚さは、フーリエ変換赤外分光光度計を用いた反射干渉解析で測定されることが好ましい。
【００１４】
図２の測定結果ｂは、エピタキシャル成長層のキャリア濃度の測定値に対応している。領域２１ｂは、ウエハ２１のうち比較的高い耐圧が見込まれるキャリア濃度が測定された領域であり、キャリア濃度の閾値によって他の領域と区別される領域である。なお、エピタキシャル成長層のキャリア濃度は、水銀電極を用いたＣ−Ｖ特性測定方法で測定されることが好ましい。
【００１５】
図２の測定結果ｃは、エピタキシャル成長層及び基板の結晶欠陥の測定結果に対応している。領域２１ｃは、ウエハ２１のうち比較的低い耐圧が見込まれる欠陥種及び欠陥密度が測定された領域であり、欠陥種または欠陥密度の閾値によって他の領域と区別される領域である。なお、エピタキシャル成長層及び基板の結晶欠陥の測定結果は、Ｘ線トポグラフ法で測定及び評価されることが好ましい。
【００１６】
マップ作成部１１は、エピタキシャル成長層の厚さの測定値、エピタキシャル成長層のキャリア濃度の測定値、並びに、エピタキシャル成長層及び基板の結晶欠陥の測定結果に基づいて、図２に示すような複数のチップ２２に関するウエハマップ２５を作成する。図２の例では、マップ作成部１１は、測定結果ａ，ｂ，ｃと、複数のチップ２２が配置された素子配置２３とを重ね合わせることによって、ウエハマップ２５を作成している。
【００１７】
耐圧推定部１２は、マップ作成部１１で作成されたウエハマップに基づいて各チップの耐圧を推定する。図２のウエハマップ２５の場合、領域２１ａ，２１ｂ，２１ｃの内側及び外側の組み合わせによって最大８段階の耐圧を推定することができる。もちろんウエハマップの作製に用いられる測定値の区分の数を増やせば、推定される耐圧の段階の数を増やすことは可能である。図２の例では、領域２１ｃに属するチップ２２のうち、大部分の領域が領域２１ａまたは領域２１ｂに属しないチップ２２の耐圧は、他のチップ２２の耐圧よりも低いと推定されている。
【００１８】
テスト条件決定部１３は、耐圧推定部１２の推定結果に基づいてチップに実施すべきテスト条件を決定する。図２の例では、テスト条件決定部１３は、耐圧が比較的低いと推定されたチップ２２、つまり概ね図２のハッチング領域内のチップ２２に対しては、テストフローＡ（星マーク）を決定する。一方、テスト条件決定部１３は、耐圧が比較的低くないと推定されたチップ２２に対しては、テストフローＢ（丸マーク）を決定する。なお、テスト条件決定部１３は、テスト条件の種類だけでなく、例えば印加する電圧の値などの各テスト条件の内容を決定してもよい。
【００１９】
図３は、テスト条件決定装置１が用いられる、本実施の形態１に係る半導体装置の製造方法を示すフローチャートである。
【００２０】
まずステップＳ１にて、基板（ウエハ）を準備する。ステップＳ２にて、基板にエピタキシャル成長層を、エピタキシャル成長によって形成する。
【００２１】
ステップＳ３にて、エピタキシャル成長層の厚さ、エピタキシャル成長層のキャリア濃度、並びに、エピタキシャル成長層及び基板の結晶欠陥を測定する。ステップＳ４にて、例えばウエハに複数のチップを形成するための写真製版やイオン注入などを伴うウエハプロセス（以下、本明細書において「ウエハプロセス」とはエピタキシャル成長後のウエハに対して実施するプロセスを指す）を行う。これによって、ＭＯＳＦＥＴ（Metal Oxide Semiconductor Field Effect Transistor）、ＩＧＢＴ（Insulated Gate Bipolar Transistor）、及び、ダイオードなどの半導体素子を基板に形成する。
【００２２】
半導体素子をテストする直前のステップＳ５にて、マップ作成部１１は、ステップＳ３の測定値及び測定結果に基づいてウエハマップを作成する。ステップＳ６にて、耐圧推定部１２は、ウエハマップに基づいて各チップの耐圧を推定する。ステップＳ７にて、テスト条件決定部１３は、耐圧の推定結果に基づいてチップに実施すべきテスト条件を決定する。
【００２３】
ステップＳ８にて、図示しないテスト装置が、テスト条件決定部１３で決定されたテスト条件に従ってチップにテストを行う。その後、図３の処理が終了する。
【００２４】
＜実施の形態１のまとめ＞
以上のような本実施の形態１に係るテスト条件決定装置１によれば、エピタキシャル成長層の厚さの測定値、エピタキシャル成長層のキャリア濃度の測定値、並びに、エピタキシャル成長層及び基板の結晶欠陥の測定結果に基づいてウエハマップを作成し、ウエハマップに基づいてチップの耐圧を推定し、耐圧の推定結果に基づいてチップに実施すべきテスト条件を決定する。このような構成によれば、半導体素子、電極、プローバ及びテスターなどの破壊を抑制可能なテスト条件、つまり適切なテスト条件を決定することができる。これにより、半導体素子、電極、プローバ及びテスターなどの破壊を抑制することができる。この結果、生産性の向上、または、耐圧が低い半導体素子の有効利用によるチップ脱落の抑制化が期待できる。
【００２５】
＜実施の形態１の変形例１＞
テスト条件決定部１３は、テスト条件の決定として、耐圧テストにおける印加電圧、または、耐圧テストの実施の有無を決定してもよい。このような構成によれば、半導体素子、電極、プローバ及びテスターの破壊が生じにくいテストを行うことができる。
【００２６】
＜実施の形態１の変形例２＞
エピタキシャル成長層の厚さ及びキャリア濃度は、一般的なエピタキシャル成長層形成方法によれば、ウエハの同心円状に分布する傾向がある。そこで、エピタキシャル成長層の厚さ及びキャリア濃度の測定は、図４に示すように、ウエハ２１の中心からウエハ２１の半径に沿って一定間隔Ｌ（例えば１ｃｍ）で行われてもよい。図４の例では、エピタキシャル成長層の厚さ及びキャリア濃度が、部分３１，３２，３３，３４，３５において測定されている。
【００２７】
そして、図５に示すように、円形状の領域４１のエピタキシャル成長層の厚さは、部分３１のエピタキシャル成長層の厚さと同じであるとし、環状の領域４２〜４５のエピタキシャル成長層の厚さは、それぞれ部分３２〜３５のエピタキシャル成長層の厚さと同じであるとしてもよい。また同様に、円形状の領域４１のエピタキシャル成長層のキャリア濃度は、部分３１のエピタキシャル成長層のキャリア濃度と同じであるとし、環状の領域４２〜４５のエピタキシャル成長層のキャリア濃度は、それぞれ部分３２〜３５のエピタキシャル成長層のキャリア濃度と同じであるとしてもよい。
【００２８】
このような本変形例２によれば、エピタキシャル成長層の厚さ及びキャリア濃度の測定個所を減らすことができる。なお、図４及び図５の例では、測定個所の数は５か所（部分３１〜３５）であったが、これに限ったものではない。
【００２９】
＜実施の形態１の変形例３＞
実施の形態１では、エピタキシャル成長層及び基板の結晶欠陥は、複数のチップ形成を意図したウエハプロセスの前、すなわち写真製版やイオン注入を用いる前の段階で行われた（図３）が、これに限ったものではない。以下、これについて説明する。
【００３０】
図６は、本変形例３に係る半導体装置の製造方法を示すフローチャートである。
【００３１】
まずステップＳ１１にて、基板（ウエハ）を準備する。ステップＳ１２にて、基板にエピタキシャル成長層を、エピタキシャル成長によって形成する。
【００３２】
ステップＳ１３にて、エピタキシャル成長層の厚さ、及び、エピタキシャル成長層のキャリア濃度の測定を実施する。本変形例３では、この工程においてエピタキシャル成長層及び基板の結晶欠陥の測定は行わない。
【００３３】
ウエハプロセスの工程であるステップＳ１４にて、エピタキシャル成長層及び基板の少なくとも一方へのイオン注入を行う。
【００３４】
ウエハプロセスの工程であるステップＳ１５にて、結晶性回復及び活性化を行うためのアニールを行う。
【００３５】
ウエハプロセスの工程であるステップＳ１６にて、エピタキシャル成長層及び基板の結晶欠陥を測定する。
【００３６】
ウエハプロセスの工程であるステップＳ１７にて、マップ作成部１１は、ステップＳ１３及びステップＳ１６の測定値及び測定結果に基づいてウエハマップを作成する。
【００３７】
ウエハプロセスの工程であるステップＳ１８にて、耐圧推定部１２は、ウエハマップに基づいて各チップの耐圧を推定する。
【００３８】
ウエハプロセスの工程であるステップＳ１９にて、テスト条件決定部１３は、耐圧の推定結果に基づいてチップに実施すべきテスト条件を決定する。その後、ロットエンドを経てウエハプロセスが終了する。
【００３９】
ステップＳ２０にて、図示しないテスト装置が、テスト条件決定部１３で決定されたテスト条件に従ってチップにテストを行う。その後、図６の処理が終了する。
【００４０】
図７は、本変形例３に係る半導体装置の別の製造方法を示すフローチャートである。なお、図７は、図６の製造方法にステップＳ３１及びＳ３２が追加されたものと同様である。このため、ここでは、ステップＳ３１及びＳ３２について主に説明する。
【００４１】
図６を用いて説明したステップＳ１１〜Ｓ１３が行われた後、ステップＳ１４にて、エピタキシャル成長層及び基板の少なくとも一方へのイオン注入を行う。
【００４２】
その後、ウエハプロセスの工程であるステップＳ３１にて、基板上にアニール用保護膜を形成する。次に、ステップＳ１５にて結晶性回復及び活性化を行うためのアニールを行う。
【００４３】
その後、ウエハプロセスの工程であるステップＳ３２にて、アニール用保護膜を除去する。それから、図６を用いて説明したステップＳ１６以降の処理が行われる。
【００４４】
図６の処理によれば、エピタキシャル成長層及び基板の少なくとも一方へのイオン注入と、結晶性回復のためのアニールとが順に行われた後に、エピタキシャル成長層及び基板の結晶欠陥が測定される。図７の処理によれば、エピタキシャル成長層及び基板の少なくとも一方へのイオン注入と、結晶性回復のためのアニールと、アニール用保護膜の除去とが順に行われた後に、エピタキシャル成長層及び基板の結晶欠陥が測定される。これらの処理によれば、イオン注入工程及びアニール工程で変化する結晶欠陥を用いてテスト条件を決定することができる。このため、テスト条件決定の精度を高めることができる。
【００４５】
＜その他＞
以上では、基板及びエピタキシャル成長層は炭化珪素を含んでいたが、これに限ったものではない。基板及びエピタキシャル成長層は、窒化ガリウム（ＧａＮ）などの他のワイドバンドギャップ半導体を含んでもよいし、珪素などの通常の半導体を含んでもよい。
【００４６】
なお、本発明は、その発明の範囲内において、実施の形態を適宜、変形、省略することが可能である。
【符号の説明】
【００４７】
１  テスト条件決定装置、１１  マップ作成部、１２  耐圧推定部、１３  テスト条件決定部、２２  チップ、２５  ウエハマップ。
【図１】
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【図２】
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【図３】
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【図４】
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【図５】
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【図６】
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【図７】
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