(57)【要約】【課題】回路パターンに対する構成部品の接合強度の低下を抑制することができる。【解決手段】半導体装置１０では、回路パターン１２ｂ，１２ｅ，１２ｈは、互いに対向する側面に保護膜１２ｂ２，１２ｅ１，１２ｅ４，１２ｈ２がそれぞれ形成されており、これらの保護膜１２ｂ２，１２ｅ１，１２ｅ４，１２ｈ２が形成された側面以外はめっき処理等が行われていない。このため、回路パターン１２ｂ，１２ｅ，１２ｈに直接はんだ１８ｈ，１８ｉ，１８ｌ，１８ｂ，１８ｆを介して半導体素子１５ａ，１５ｂ，１５ｄ及びコンタクト部品１６ｂ，１６ｆを接合すると、はんだ１８ｈ，１８ｉ，１８ｌ，１８ｂ，１８ｆの複数の回路パターン１２ｂ，１２ｅ，１２ｈに対する濡れ性の低下が抑制される。【選択図】図２
2019012779.tif 000002
【特許請求の範囲】
【請求項１】
絶縁板と前記絶縁板のおもて面に形成された複数の回路パターンとを含む基板と、
前記複数の回路パターンのおもて面の接合領域を露出して、前記複数の回路パターンの少なくとも互いに対向する側部にそれぞれ形成された複数の保護膜と、
前記複数の回路パターンの前記接合領域にはんだを介して接合された複数の構成部品と、
を有する半導体装置。
【請求項２】
前記複数の保護膜は、少なくとも、前記側部と共に前記側部に沿って、前記複数の回路パターンのおもて面の縁部にそれぞれ形成されている、
請求項１に記載の半導体装置。
【請求項３】
前記複数の保護膜は、前記側部及び前記縁部と共に前記複数の回路パターンのおもて面上に前記接合領域を露出して形成されている、
請求項２に記載の半導体装置。
【請求項４】
前記複数の構成部品のいずれかが、前記複数の回路パターンのうち、隣接する回路パターンに跨って接合されている、
請求項１に記載の半導体装置。
【請求項５】
前記複数の構成部品は、半導体素子またはコンタクト部品の少なくともいずれか一方である、
請求項１に記載の半導体装置。
【請求項６】
前記複数の構成部品は、電子部品である、
請求項４に記載の半導体装置。
【請求項７】
前記複数の回路パターンは、銅または銅合金により構成されている、
請求項１に記載の半導体装置。
【請求項８】
前記複数の第１保護膜は、ニッケルまたはニッケル合金により構成されている、
請求項１に記載の半導体装置。
【請求項９】
前記はんだは、錫−銀−銅を含む合金、錫−亜鉛−ビスマスを含む合金、錫−銅を含む合金、または錫−銀−インジウム−ビスマスを含む合金のうち、少なくともいずれかの合金を主成分とする鉛フリーはんだである、
請求項１に記載の半導体装置。
【請求項１０】
前記はんだは、ニッケル、ゲルマニウム、コバルトまたはシリコンが添加されている、
請求項９に記載の半導体装置。
【発明の詳細な説明】
【技術分野】
【０００１】
本発明は、半導体装置に関する。
【背景技術】
【０００２】
半導体装置は、例えば、ＩＧＢＴ（Insulted Gate Bipolar Transistor）、パワーＭＯＳＦＥＴ（Metal Oxide Semiconductor Field Effect Transistor）等の半導体素子を含んでいる。このような半導体装置は、例えば、電力変換装置として利用されている。
【０００３】
半導体装置は、絶縁板と絶縁板のおもて面に形成された複数の回路パターンとを有する基板を備えている。また、回路パターン上に半導体素子及び外部接続端子が配置されており、外部接続端子から印加された信号が回路パターンを経由して半導体素子に入力される。
【０００４】
この外部接続端子を回路パターンに取り付ける際には、筒状のコンタクト部品が用いられる。外部接続端子は、回路パターン上にはんだを介して接合されたコンタクト部品に圧入されて、コンタクト部品を経由して回路パターンに電気的に接続される（例えば、特許文献１参照）。
【先行技術文献】
【特許文献】
【０００５】
【特許文献１】米国特許出願公開第２００９／０１９４８８４号明細書
【発明の概要】
【発明が解決しようとする課題】
【０００６】
ところで、上記半導体装置では回路パターンの表面にニッケル等によるめっき処理が施されている。これにより、回路パターンからの腐食物の生成が抑制されて、当該腐食物の生成による回路パターン間の短絡が防止される。
【０００７】
しかし、このようなめっき処理が施された回路パターンは、はんだに対する濡れ性が低下して、また、はんだ内からボイドを取り除きにくくなる。このため、このようなめっき処理が施された回路パターンにはんだを介して、筒状のコンタクト部品、半導体素子等の構成部品を接合すると、回路パターンに対する構成部品の十分な接合強度が得られなくなってしまう。
【０００８】
本発明は、このような点に鑑みてなされたものであり、回路パターンに対する構成部品の接合強度の低下を抑制することができる半導体装置を提供することを目的とする。
【課題を解決するための手段】
【０００９】
本発明の一観点によれば、絶縁板と前記絶縁板のおもて面に形成された複数の回路パターンとを含む基板と、前記複数の回路パターンのおもて面の接合領域を露出して、前記複数の回路パターンの少なくとも互いに対向する側部にそれぞれ形成された複数の保護膜と、前記複数の回路パターンの前記接合領域にはんだを介して接合された複数の構成部品と、を有する半導体装置が提供される。
【発明の効果】
【００１０】
開示の技術によれば、回路パターンに対する構成部品の接合強度の低下を抑制して、半導体装置の信頼性の低下を防止することができる。
【図面の簡単な説明】
【００１１】
【図１】第１の実施の形態の半導体装置の平面図である。
【図２】第１の実施の形態の半導体装置の断面図である。
【図３】第１の実施の形態の半導体装置の平面図（構成部品未記入時）である。
【図４】第１の実施の形態の変形例の半導体装置の基板の回路パターンを説明する図である。
【図５】第２の実施の形態の半導体装置の要部平面図である。
【図６】第２の実施の形態の半導体装置の要部断面図である。
【図７】第３の実施の形態の半導体装置の要部平面図である。
【図８】第３の実施の形態の半導体装置の要部断面図（その１）である。
【図９】第３の実施の形態の半導体装置の要部断面図（その２）である。
【発明を実施するための形態】
【００１２】
以下、図面を参照して、実施の形態について説明する。
【００１３】
［第１の実施の形態］
第１の実施の形態の半導体装置について、図１〜図３を用いて説明する。
【００１４】
図１は、第１の実施の形態の半導体装置の平面図であり、図２は、第１の実施の形態の半導体装置の断面図である。また、図３は、第１の実施の形態の半導体装置の平面図（構成部品未記入時）である。
【００１５】
なお、図１及び図３では、ケース２１の蓋部２１ａ及び金属基板２０の図示を省略している。図２は、図１の一点鎖線Ｘ−Ｘにおける断面図である。さらに、図３は、図１において構成部品（半導体素子１５ａ，１５ｂ，１５ｄ、電子部品１５ｃ及びコンタクト部品１６ａ〜１６ｇ並びにボンディングワイヤ１７ａ〜１７ｅ）の図示を省略した場合を示している。
【００１６】
半導体装置１０は、図１及び図２に示されるように、セラミック回路基板１４（基板）とセラミック回路基板１４のおもて面に接合された半導体素子１５ａ，１５ｂ，１５ｄと電子部品１５ｃとコンタクト部品１６ａ〜１６ｇとコンタクト部品１６ａ〜１６ｇにそれぞれ取り付けられた外部接続端子１９ａ〜１９ｇとを有している。なお、セラミック回路基板１４（後述する回路パターン１２ａ〜１２ｈ）上に接合されている半導体素子１５ａ，１５ｂ，１５ｄ、電子部品１５ｃ、コンタクト部品１６ａ〜１６ｇの個数並びに接合位置は一例である。半導体素子１５ａ，１５ｂ，１５ｄ、電子部品１５ｃ、コンタクト部品１６ａ〜１６ｇは、セラミック回路基板１４（回路パターン１２ａ〜１２ｈ）上であれば、図１及び図２以外の場合でも構わない。
【００１７】
さらに、半導体装置１０は、セラミック回路基板１４が配置された金属基板２０と、金属基板２０上に設けられ、セラミック回路基板１４を覆い、外部接続端子１９ａ〜１９ｇが延出されたケース２１とを有している。
【００１８】
セラミック回路基板１４は、絶縁板１１と絶縁板１１のおもて面に形成された回路パターン１２ａ〜１２ｈと絶縁板１１の裏面に形成された金属板１３とを有している。
【００１９】
回路パターン１２ａ〜１２ｈは、導電性並びにはんだに対する濡れ性に優れた材質により構成されている。このような材質として、例えば、銀、銅、または、少なくともこれらの一種を含む合金等により構成されている。このような回路パターン１２ａ〜１２ｈは、それぞれ、図１に示すような、所定の形状を成している。なお、回路パターン１２ａ〜１２ｈの個数、形状並びに絶縁板１１に対する形成位置は一例であって、図１及び図２以外の場合でも構わない。
【００２０】
また、回路パターン１２ａ〜１２ｈには、互いに対向する側面に第１保護膜１２ａ１，１２ａ２，１２ｂ１〜１２ｂ３，１２ｃ１〜１２ｃ３，１２ｄ１，１２ｄ２，１２ｅ１〜１２ｅ４，１２ｆ１，１２ｆ２，１２ｇ１〜１２ｇ３，１２ｈ１，１２ｈ２がそれぞれ形成されている。
【００２１】
具体的には、回路パターン１２ａは、回路パターン１２ｂ，１２ｅに対向する側面に第１保護膜１２ａ１，１２ａ２がそれぞれ形成されている。回路パターン１２ｂは、回路パターン１２ｃ，１２ｅ，１２ａに対向する側面に第１保護膜１２ｂ１〜１２ｂ３がそれぞれ形成されている。回路パターン１２ｃは、回路パターン１２ｄ，１２ｅ，１２ｂに対向する側面に第１保護膜１２ｃ１〜１２ｃ３がそれぞれ形成されている。回路パターン１２ｄは、回路パターン１２ｃ，１２ｅに対向する側面に第１保護膜１２ｄ１，１２ｄ２がそれぞれ形成されている。
【００２２】
回路パターン１２ｅは、回路パターン１２ｄ，１２ｃ，１２ｂ，１２ａに対向する側面に第１保護膜１２ｅ１〜１２ｅ３がそれぞれ形成されている。さらに、回路パターン１２ｅは、回路パターン１２ｆ〜１２ｈに対向する側面に第１保護膜１２ｅ４が形成されている。
【００２３】
回路パターン１２ｆは、回路パターン１２ｅ，１２ｇに対向する側面に第１保護膜１２ｆ１，１２ｆ２がそれぞれ形成されている。回路パターン１２ｇは、回路パターン１２ｆ，１２ｅ，１２ｈに対向する側面に第１保護膜１２ｇ１〜１２ｇ３がそれぞれ形成されている。回路パターン１２ｈは、回路パターン１２ｇ，１２ｅに対向する側面に第１保護膜１２ｈ１，１２ｈ２がそれぞれ形成されている。
【００２４】
なお、以下では、第１保護膜１２ａ１，１２ａ２，１２ｂ１〜１２ｂ３，１２ｃ１〜１２ｃ３，１２ｄ１，１２ｄ２，１２ｅ１〜１２ｅ４，１２ｆ１，１２ｆ２，１２ｇ１〜１２ｇ３，１２ｈ１，１２ｈ２を特に区別しない場合には、符号を一部省略することがある。
【００２５】
このような第１保護膜は、耐食性に優れた材質が用いられる。このような材質は、例えば、アルミニウム、ニッケル、チタン、クロム、モリブデン、タンタル、ニオブ、タングステン、バナジウム、ビスマス、ジルコニウム、ハフニウム、金、白金、パラジウム、または、少なくともこれらの一種を含む合金等である。
【００２６】
また、回路パターン１２ａ〜１２ｈのこのような側面に対する上記の第１保護膜は、例えば、無電解めっきにより形成することができる。この際、回路パターン１２ａ〜１２ｈの第１保護膜を形成しない領域には、予め、マスキング（レジスト）を形成しておき、無電解めっき後に当該レジストを除去することで、回路パターン１２ａ〜１２ｈの所望の側面にのみ第１保護膜をそれぞれ形成することができる。
【００２７】
したがって、回路パターン１２ａ〜１２ｈは、互いに対向する側面にのみ上記の第１保護膜がそれぞれ形成されて、それらの第１保護膜が形成された側面以外の領域にはめっき処理が施されておらず、めっき膜等が形成されていない。
【００２８】
このような構成を有するセラミック回路基板１４として、例えば、ＤＣＢ（Direct Copper Bonding）基板、ＡＭＢ（Active Metal Blazed）基板を用いることができる。セラミック回路基板１４は、半導体素子１５ａ〜１５ｄで発生した熱を回路パターン１２ｅ，１２ｆ，１２ｇ，１２ｈ、絶縁板１１及び金属板１３を介して、金属基板２０側に伝導させることができる。
【００２９】
金属板１３は、熱伝導性に優れたアルミニウム、鉄、銀、銅、または、少なくともこれらの一種を含む合金等の金属により構成されている。
【００３０】
絶縁板１１は、熱伝導性に優れた、酸化アルミニウム、窒化アルミニウム、窒化珪素等の高熱伝導性のセラミックスにより構成されている。なお、絶縁板１１は平面視で、例えば、矩形状を成している。また、金属板１３は平面視で、絶縁板１１よりも面積が小さな矩形状を成している。
【００３１】
半導体素子１５ａ，１５ｂ，１５ｄは、例えば、ＩＧＢＴ、パワーＭＯＳＦＥＴ等のスイッチング素子を含んでいる。このような半導体素子１５ａ，１５ｂ，１５ｄは、例えば、裏面に主電極としてドレイン電極（または、コレクタ電極）を、おもて面に、主電極としてゲート電極及びソース電極（または、エミッタ電極）をそれぞれ備えている。
【００３２】
また、半導体素子１５ａ，１５ｂ，１５ｄは、必要に応じて、ＳＢＤ（Schottky Barrier Diode）、ＦＷＤ（Free Wheeling Diode）等のダイオードを含んでいる。このような半導体素子１５ａ，１５ｂ，１５ｄは、裏面に主電極としてカソード電極を、おもて面に主電極としてアノード電極をそれぞれ備えている。上記の半導体素子１５ａ，１５ｂ，１５ｄは、その裏面側が所定の回路パターン１２ｅ，１２ｆ，１２ｇ，１２ｈ上に接合されている。
【００３３】
半導体素子１５ａ，１５ｂ，１５ｄは、シリコン半導体素子、及び、炭化シリコン等のワイドバンドギャップ素子を用いることができる。
【００３４】
なお、半導体素子１５ａ，１５ｂは、回路パターン１２ｅの接合領域１５ａ１，１５ｂ１上にはんだ１８ｈ，１８ｉを介して接合されている。さらに、半導体素子１５ｄは、回路パターン１２ｈの接合領域１５ｄ１上にはんだ１８ｌを介して接合されている。
【００３５】
電子部品１５ｃは、例えば、抵抗、サーミスタ、コンデンサ、サージアブソーバ等である。このような、電子部品１５ｃは、回路パターン１２ｆ，１２ｇに跨って、回路パターン１２ｆ，１２ｇの接合領域１５ｃ１，１５ｃ２上にはんだ１８ｊ，１８ｋを介してそれぞれ接合されている。
【００３６】
図１及び図３に示されるように、この際、回路パターン１２ａ〜１２ｈは、既述の通り、第１保護膜が形成された側面以外にはめっき処理等が施されていない。このため、はんだ１８ｈ〜１８ｌは回路パターン１２ｅ〜１２ｈの半導体素子１５ａ，１５ｂ，１５ｄ及び電子部品１５ｃの接合領域に直接塗布され、はんだ１８ｈ〜１８ｌの回路パターン１２ｅ〜１２ｈに対する濡れ性の低下が抑制される。したがって、回路パターン１２ｅ〜１２ｈに対する半導体素子１５ａ，１５ｂ，１５ｄ及び電子部品１５ｃの接合強度の低下が抑制される。
【００３７】
仮に、回路パターン１２ｅ，１２ｈの半導体素子１５ａ，１５ｂ，１５ｄの接合領域１５ａ１，１５ｂ１，１５ｄ１にめっき処理が施されている場合には、はんだ１８ｈ，１８ｉ，１８ｌの回路パターン１２ｅ，１２ｈに対する濡れ性が低下してしまう。これにより、半導体素子１５ａ，１５ｂ，１５ｄと回路パターン１２ｅ，１２ｈとの間のはんだ接合部にボイド（空隙）が残存してしまう。そのため、半導体素子１５ａ，１５ｂ，１５ｄの接合強度が低下してしまう。また、半導体素子１５ａ，１５ｂ，１５ｄと金属基板２０との間の熱抵抗が大きくなり、放熱性が低下してしまう。
【００３８】
また、仮に、回路パターン１２ｆ，１２ｇの電子部品１５ｃの接合領域１５ｃ１，１５ｃ２にめっき処理が施されている場合には、はんだ１８ｊ，１８ｋの回路パターン１２ｆ，１２ｇに対する濡れ性が低下してしまう。これにより、電子部品１５ｃの電極面をはんだ１８ｊ，１８ｋが這い上がってしまう。これにより、回路パターン１２ｆ，１２ｇと電子部品１５ｃとの間に形成されるはんだ１８ｊ，１８ｋの量が減少し、電子部品１５ｃの接合強度が低下してしまう。
【００３９】
コンタクト部品１６ａ〜１６ｇは、開口端部間を貫通する中空孔が内部に形成された筒形状を有する。一方の開口端部側がはんだ１８ａ〜１８ｇにより回路パターン１２ａ〜１２ｄ，１２ｆ〜１２ｈの接合領域１６ａ１〜１６ｇ１上にそれぞれ接合される。また、コンタクト部品１６ａ〜１６ｇは、他方の開口端部から外部接続端子１９ａ〜１９ｇがそれぞれ圧入される。このようにして、コンタクト部品１６ａ〜１６ｇは、回路パターン１２ａ〜１２ｄ，１２ｆ〜１２ｈにはんだ１８ａ〜１８ｇを用いてそれぞれ接合されている。なお、図２では、コンタクト部品１６ａ〜１６ｇのうち、回路パターン１２ｂ，１２ｈ上に接合されているコンタクト部品１６ｂ，１６ｆを示している。このようなコンタクト部品１６ａ〜１６ｇは、導電性に優れたアルミニウム、鉄、銀、銅、または、少なくともこれらの一種を含む合金等の金属により構成されている。また、耐食性を向上させるために、例えば、ニッケルや金等の金属をめっき処理等によりコンタクト部品１６ａ〜１６ｇの表面にめっき膜を形成してもよい。このようなめっき膜の具体的な材質には、ニッケルや金の他に、ニッケル−リン合金や、ニッケル−ボロン合金等がある。
【００４０】
外部接続端子１９ａ〜１９ｇは、導電性に優れたアルミニウム、鉄、銀、銅、または、少なくともこれらの一種を含む合金等の金属により構成されている。外部接続端子１９ａ〜１９ｇは、棒状であって、その断面は、例えば、正方形を成している。外部接続端子１９ａ〜１９ｇは、コンタクト部品１６ａ〜１６ｇの中空孔にそれぞれ圧入されており、コンタクト部品１６ａ〜１６ｇを経由して回路パターン１２ａ〜１２ｄ，１２ｆ〜１２ｈに電気的に接続されている。
【００４１】
図１及び図３に示されるように、この際、回路パターン１２ａ〜１２ｈは、既述の通り、第１保護膜が形成された側面以外にはめっき処理等が施されていない。このため、はんだ１８ａ〜１８ｇは回路パターン１２ａ〜１２ｄ，１２ｆ〜１２ｈのコンタクト部品１６ａ〜１６ｇの接合領域に直接塗布され、はんだ１８ａ〜１８ｇの回路パターン１２ａ〜１２ｄ，１２ｆ〜１２ｈに対する濡れ性の低下が抑制される。したがって、回路パターン１２ａ〜１２ｄ，１２ｆ〜１２ｈに対するコンタクト部品１６ａ〜１６ｇの接合強度の低下が抑制される。このため、コンタクト部品１６ａ〜１６ｇに対して外部接続端子１９ａ〜１９ｇを確実に安定して圧入することができる。
【００４２】
仮に、回路パターン１２ａ〜１２ｄ，１２ｆ〜１２ｈのコンタクト部品１６ａ〜１６ｇの接合領域にめっき処理が施されている場合には、はんだ１８ａ〜１８ｇの回路パターン１２ａ〜１２ｄ，１２ｆ〜１２ｈに対する濡れ性が低下してしまう。この際、回路パターン１２ａ〜１２ｄ，１２ｆ〜１２ｈにはんだ１８ａ〜１８ｇを介してコンタクト部品１６ａ〜１６ｇを接合すると、はんだ１８ａ〜１８ｇがコンタクト部品１６ａ〜１６ｇの内部に這い上がってしまう。これにより、回路パターン１２ａ〜１２ｄ，１２ｆ〜１２ｈとコンタクト部品１６ａ〜１６ｇとの間に形成されるはんだ１８ａ〜１８ｇの量が減少し、コンタクト部品１６ａ〜１６ｇの接合強度が低下してしまう。また、コンタクト部品１６ａ〜１６ｇに外部接続端子１９ａ〜１９ｇを圧入することができなくなってしまう。または、コンタクト部品１６ａ〜１６ｇに外部接続端子１９ａ〜１９ｇを圧入しようとすると、コンタクト部品１６ａ〜１６ｇが曲がってしまうおそれもある。
【００４３】
このように回路パターン１２ａ〜１２ｈの半導体素子１５ａ，１５ｂ，１５ｄと電子部品１５ｃとコンタクト部品１６ａ〜１６ｇとの接合領域にはめっき処理等を施していないために、回路パターン１２ａ〜１２ｈに対するはんだ１８ａ〜１８ｇの濡れ性の低下が抑制される。したがって、回路パターン１２ａ〜１２ｈに対する半導体素子１５ａ，１５ｂ，１５ｄと電子部品１５ｃとコンタクト部品１６ａ〜１６ｇとの接合強度の低下が抑制される。
【００４４】
はんだ１８ａ〜１８ｌは、錫−銀−銅からなる合金、錫−亜鉛−ビスマスからなる合金、錫−銅からなる合金、錫−銀−インジウム−ビスマスからなる合金のうち、少なくともいずれかの合金を主成分とする鉛フリーはんだにより構成されている。また、このような主成分の他に、ニッケル、ゲルマニウム、コバルトまたはシリコン等の添加物が含まれてもよい。
【００４５】
なお、セラミック回路基板１４上では、回路パターン１２ａ〜１２ｈの間が適宜ボンディングワイヤ１７ａ〜１７ｅで電気的に接続されている。具体的には、図１及び図３に示されるように、回路パターン１２ｂのボンディング領域１２ｂ４と回路パターン１２ｅのボンディング領域１２ｅ５とをボンディングワイヤ１７ａで電気的に接続している。回路パターン１２ｃのボンディング領域１２ｃ４と半導体素子１５ａ（ソース電極）とがボンディングワイヤ１７ｂで、回路パターン１２ｄのボンディング領域１２ｄ４と半導体素子１５ａ（ゲート電極）とがボンディングワイヤ１７ｃで電気的にそれぞれ接続されている。さらに、半導体素子１５ａ，１５ｂとの間がボンディングワイヤ１７ｄで、回路パターン１２ａのボンディング領域１２ａ４と回路パターン１２ｈのボンディング領域１２ｈ４とがボンディングワイヤ１７ｅで電気的にそれぞれ接続されている。
【００４６】
なお、ボンディングワイヤ１７ａ〜１７ｅの回路パターン１２ａ〜１２ｅ，１２ｈのボンディング領域１２ａ４，１２ｂ４，１２ｃ４，１２ｄ４，１２ｅ５，１２ｈ４に対する接合は、例えば、超音波接合により行われる。このような、ボンディングワイヤ１７ａ〜１７ｅは、導電性に優れたアルミニウム、銅、金、または、少なくともこれらの一種を含む合金等の金属により構成されている。
【００４７】
図１及び図３に示されるように、この際、回路パターン１２ａ〜１２ｈは、既述の通り、所望の側面以外にはめっき処理等が施されていない。したがって、回路パターン１２ａ〜１２ｅ，１２ｈのボンディング領域１２ａ４，１２ｂ４，１２ｃ４，１２ｄ４，１２ｅ５，１２ｈ４に対してボンディングワイヤ１７ａ〜１７ｅを接合強度を低下させることなく確実に接合することができる。
【００４８】
このように半導体装置１０では、回路パターン１２ａ〜１２ｈ、半導体素子１５ａ，１５ｂ，１５ｄの間を必要に応じてボンディングワイヤ１７ａ〜１７ｅで接続されている。さらに、回路パターン１２ａ〜１２ｄ，１２ｆ〜１２ｈに外部接続端子１９ａ〜１９ｇが電気的に接続されることで半導体素子１５ａ，１５ｂ，１５ｄ及び電子部品１５ｃを含む所定の回路が構成される。
【００４９】
金属基板２０は、熱伝導性に優れた、例えば、アルミニウム、鉄、銀、銅、または、少なくともこれらの一種を含む合金等の金属により構成されている。また、耐食性を向上させるために、例えば、ニッケル等の材料をめっき処理等により金属基板２０の表面に形成してもよい。具体的には、ニッケルの他に、ニッケル−リン合金、ニッケル−ボロン合金等がある。
【００５０】
なお、この金属基板２０の裏面側に冷却器（図示を省略）をはんだまたは銀ろう等を介して接合させ、または、サーマルペースト等を介して機械的に取り付けることで放熱性を向上させることも可能である。この場合の冷却器は、例えば、熱伝導性に優れたアルミニウム、鉄、銀、銅、または、少なくともこれらの一種を含む合金等の金属により構成されている。また、冷却器として、フィン、または、複数のフィンから構成されるヒートシンク並びに水冷による冷却装置等を適用することができる。また、金属基板２０は、このような冷却器と一体的に構成されてもよい。その場合は、熱伝導性に優れたアルミニウム、鉄、銀、銅、または、少なくともこれらの一種を含む合金等の金属により構成される。そして、耐食性を向上させるために、例えば、ニッケル等の材料をめっき処理等により冷却器と一体化された金属基板２０の表面に形成してもよい。具体的には、ニッケルの他に、ニッケル−リン合金、ニッケル−ボロン合金等がある。
【００５１】
ケース２１は、セラミック回路基板１４を上方から覆う蓋部２１ａとセラミック回路基板１４の外周に設けられ、セラミック回路基板１４の側部を覆う側壁部２１ｂとから構成される箱型を成している。このようなケース２１は、熱可塑性樹脂により構成されている。当該樹脂として、ポリフェニレンサルファイド（ＰＰＳ）、ポリブチレンテレフタレート（ＰＢＴ）樹脂、ポリブチレンサクシネート（ＰＢＳ）樹脂、ポリアミド（ＰＡ）樹脂、または、アクリロニトリルブタジエンスチレン（ＡＢＳ）樹脂等がある。
【００５２】
また、このようなケース２１は、ケース２１の側壁部２１ｂが接着剤（図示を省略）を介して金属基板２０に接合される。なお、このような接着剤は、ケース２１の側壁部２１ｂの底部、または、金属基板２０のケース２１の設置領域上に塗布してもよい。接着剤の塗布は、マスクによるスクリーン印刷法やシリンジを用いたディスペンス法等の当該技術において知られている任意の方法を用いることができる。
【００５３】
ケース２１の内部を封止部材（図示を省略）により封止させることも可能である。封止部材は、例えば、マレイミド変性エポキシ樹脂、マレイミド変性フェノール樹脂、マレイミド樹脂等の熱硬化性樹脂で構成されている。また、封止部材は、ゲルにより構成されても構わない。このような封止部材は、ケース２１に形成されている所定の注入口からケース２１内に注入される。ケース２１内に注入された封止部材は、金属基板２０上における、セラミック回路基板１４と、半導体素子１５ａ，１５ｂ，１５ｄと、電子部品１５ｃと、コンタクト部品１６ａ〜１６ｇと、ボンディングワイヤ１７ａ〜１７ｅと、外部接続端子１９ａ〜１９ｇの一部とを封止する。
【００５４】
この際、回路パターン１２ａ〜１２ｈは、既述の通り、第１保護膜が形成された側面以外にはめっき処理等が施されていない。このため、回路パターン１２ａ〜１２ｈに対する封止部材の密着力が向上する。したがって、封止部材によりケース２１内のセラミック回路基板１４、半導体素子１５ａ，１５ｂ，１５ｄ、電子部品１５ｃ等を適切に封止することができる。
【００５５】
以上により、半導体装置１０が構成される。
【００５６】
このような半導体装置１０では、外部接続端子１９ａ〜１９ｇに対して、外部から入力信号が印加されて、出力信号を出力する。仮に、回路パターン１２ａ〜１２ｈの側面に第１保護膜が形成されていない場合には、腐食物の生成により回路パターン間の短絡が発生してしまう。具体的には、回路パターン１２ａ〜１２ｈにおいて互いに対向する側面に生じる電界等により、回路パターン１２ａ〜１２ｈの銅がイオン化され、回路パターン１２ａ〜１２ｈ間で銅の腐食物が生成されてしまう（イオンマイグレーション）。このため、隣接する回路パターン間にその腐食物が生成されてしまうと、当該隣接する回路パターン間が短絡してしまう。
【００５７】
ところが、半導体装置１０において、回路パターン１２ａ〜１２ｈのうち、隣接する回路パターンの対向する側面に第１保護膜がそれぞれ形成されている。このため、回路パターン１２ａ〜１２ｈのうちの隣接する回路パターンの対向する側面ではイオンマイグレーションによる腐食物の生成が抑制される。これにより、当該隣接する回路パターン間の短絡の発生を防止することができる。
【００５８】
上記半導体装置１０は、絶縁板１１と絶縁板１１のおもて面に形成された複数の回路パターン１２ａ〜１２ｈとを含むセラミック回路基板１４を有している。また、半導体装置１０は、複数の回路パターン１２ａ〜１２ｈのおもて面の接合領域１５ａ１，１５ｂ１，１５ｄ１，１５ｃ１，１５ｃ２，１６ａ１〜１６ｇ１にはんだ１８ａ〜１８ｉを介してそれぞれ配置された半導体素子１５ａ，１５ｂ，１５ｄ、電子部品１５ｃ及びコンタクト部品１６ａ〜１６ｇ並びにボンディングワイヤ１７ａ〜１７ｅを有している。さらに、半導体装置１０は、複数の回路パターン１２ａ〜１２ｈにおいて互いに対向する側面にそれぞれ形成された複数の第１保護膜を有している。
【００５９】
このような半導体装置１０では、複数の回路パターン１２ａ〜１２ｈは、互いに対向する側面に複数の第１保護膜がそれぞれ形成されており、これらの側面以外はめっき処理等が施されていない。
【００６０】
このため、複数の回路パターン１２ａ〜１２ｈの接合領域１５ａ１，１５ｂ１，１５ｄ１，１５ｃ１，１５ｃ２，１６ａ１〜１６ｇ１に直接はんだ１８ａ〜１８ｉを介して半導体素子１５ａ，１５ｂ，１５ｄと、電子部品１５ｃと、コンタクト部品１６ａ〜１６ｇとを接合すると、はんだ１８ａ〜１８ｉの複数の回路パターン１２ａ〜１２ｈに対する濡れ性の低下が抑制される。したがって、複数の回路パターン１２ａ〜１２ｈに対する半導体素子１５ａ，１５ｂ，１５ｄと、電子部品１５ｃと、コンタクト部品１６ａ〜１６ｇとの接合強度の低下が抑制される。
【００６１】
さらに、複数の回路パターン１２ａ〜１２ｈは、隣接する回路パターンの対向する側面に複数の第１保護膜がそれぞれ形成されているために、当該隣接する回路パターンの対向する側面にイオンマイグレーションによる腐食物の生成が抑制される。これにより、当該隣接する回路パターン間の短絡の発生を防止することができる。
【００６２】
したがって、半導体装置１０の故障の発生が低減されて、信頼性の低下を防止することができるようになる。
【００６３】
なお、半導体装置１０の構成部品としては、半導体素子１５ａ，１５ｂ，１５ｄ、電子部品１５ｃ、コンタクト部品１６ａ〜１６ｇ、ボンディングワイヤ１７ａ〜１７ｅが含まれる。構成部品は、これらに限らず、回路パターン１２ａ〜１２ｈに（はんだを介して）接合されるもの、例えば、リードフレーム等も含めることができる。
【００６４】
また、半導体装置１０のセラミック回路基板１４の回路パターン１２ａ〜１２ｈは、絶縁板１１上に、例えば、銅箔を形成して、所定のパターンにエッチングすることで得られる。第１の実施の形態の場合であれば、エッチングにより、回路パターン１２ａ〜１２ｈの側面が絶縁板１１のおもて面に対して垂直となるように形成されている。しかし、エッチング並びに絶縁板１１上の銅箔等の状況によっては、上記のように回路パターン１２ａ〜１２ｈの側面が絶縁板１１のおもて面に対して垂直とならない場合がある。以下、その場合の一例として回路パターン１２ｅ，１２ｈの場合を挙げて、図４を用いて説明する。
【００６５】
図４は、第１の実施の形態の変形例の半導体装置の基板の回路パターンを説明する図である。
【００６６】
なお、図４に示す範囲は、図２における断面の要部を拡大したものである。また、セラミック回路基板１４上の半導体素子１５ａ，１５ｂ，１５ｄ、電子部品１５ｃ及びコンタクト部品１６ａ〜１６ｇ並びにボンディングワイヤ１７ａ〜１７ｅの記載は省略している。
【００６７】
図４に示されるように、エッチングによっては、回路パターン１２ｅ，１２ｈの側面１２ｅｓ，１２ｈｓが絶縁板１１のおもて面に対して垂直ではなく、傾斜して形成される場合がある。
【００６８】
このように回路パターン１２ｅ，１２ｈの側面１２ｅｓ，１２ｈｓが絶縁板１１のおもて面に対して傾斜した場合でも、上記と同様に、側面１２ｅｓ，１２ｈｓに、第１保護膜１２ｅ４，１２ｈ２が形成される。また、図示を省略する他の回路パターン１２ａ〜１２ｄ，１２ｆ，１２ｇの側面がこのように絶縁板１１のおもて面に対して傾斜しても、同様に、第１保護膜が形成される。
【００６９】
そして、このように傾斜した側面に第１保護膜が形成された場合でも、上記半導体装置１０と同様の効果が得られる。
【００７０】
［第２の実施の形態］
第２の実施の形態では、第１の実施の形態の第１保護膜に加えて、第２保護膜を形成する場合について説明する。
【００７１】
第２の実施の形態の半導体装置１０ａについて、図５及び図６を用いて説明する。
【００７２】
図５は、第２の実施の形態の半導体装置の要部平面図であり、図６は、第２の実施の形態の半導体装置の要部断面図である。
【００７３】
なお、図５及び図６に示す半導体装置１０ａにおいて、第１の実施の形態の半導体装置１０（図１〜図３）と同じ符号のものは同じ構成を表している。
【００７４】
また、図５は、第１の実施の形態の図１の回路パターン１２ｅの周辺における平面図に対応している。図６は、図５の一点鎖線Ｘ−Ｘにおける断面図を表している。
【００７５】
半導体装置１０ａは、半導体装置１０と同様に、複数の回路パターン１２ａ〜１２ｈにおいて互いに対向する側面に第１保護膜がそれぞれ形成されている。さらに、半導体装置１０ａでは、回路パターン１２ａ〜１２ｈの側面に形成された第１保護膜に沿って、回路パターン１２ａ〜１２ｈのおもて面の縁部に第２保護膜が形成されている。
【００７６】
例えば、図５及び図６に示されるように、回路パターン１２ｅは、回路パターン１２ｂ〜１２ｄ（図１を参照）に対向する側面に第１保護膜１２ｅ１が形成されていると共に、第１保護膜１２ｅ１に沿って、回路パターン１２ｅのおもて面の縁部に第２保護膜１２ｅ６が形成されている。また、回路パターン１２ｅは、回路パターン１２ａ（図１を参照）に対向する側面に第１保護膜１２ｅ２，１２ｅ３が形成されていると共に、第１保護膜１２ｅ２，１２ｅ３に沿って、回路パターン１２ｅのおもて面の縁部に第２保護膜１２ｅ７，１２ｅ８が形成されている。さらに、回路パターン１２ｅは、回路パターン１２ｆ〜１２ｇ（図１を参照）に対向する側面に第１保護膜１２ｅ４が形成されていると共に、第１保護膜１２ｅ４に沿って、回路パターン１２ｅのおもて面の縁部に第２保護膜１２ｅ９が形成されている。
【００７７】
また、図５に示されるように、回路パターン１２ａは、回路パターン１２ｂ，１２ｅ（図１を参照）に対向する側面に第１保護膜１２ａ１，１２ａ２が形成されていると共に、第１保護膜１２ａ１，１２ａ２に沿って、回路パターン１２ａのおもて面の縁部に第２保護膜１２ａ５，１２ａ６が形成されている。なお、第２保護膜１２ａ６，１２ａ７，１２ｅ６〜１２ｅ９は、特に区別しない場合には、符号を一部省略することがある。
【００７８】
図示を省略するものの、回路パターン１２ａ，１２ｅと同様に、回路パターン１２ｂ〜１２ｄ，１２ｆ〜１２ｈについても、互いに対向する側面に第１保護膜が形成されていると共に、第１保護膜に沿って、回路パターン１２ｂ〜１２ｄ，１２ｆ〜１２ｈのおもて面の縁部に第２保護膜（図示を省略）が形成されている。
【００７９】
なお、第２保護膜は、第１保護膜と同様に、耐食性に優れた材質が用いられる。このような材質もまた、第１保護膜と同様に、例えば、アルミニウム、ニッケル、チタン、クロム、モリブデン、タンタル、ニオブ、タングステン、バナジウム、ビスマス、ジルコニウム、ハフニウム、金、白金、パラジウム、または、少なくともこれらの一種を含む合金等である。
【００８０】
また、このような第２保護膜は、第１の実施の形態の第１保護膜と同様に、無電解めっきにより形成することができる。この際、回路パターン１２ａ〜１２ｈの第１保護膜及び第２保護膜を形成しない領域には、予め、マスキング（レジスト）を形成しておき、無電解めっき後に当該レジストを除去することで、回路パターン１２ａ〜１２ｈに第１保護膜及び第２保護膜をそれぞれ形成することができる。
【００８１】
第１の実施の形態で説明したように、回路パターン１２ａ〜１２ｈにおいて、互いに対向する側面に形成された第１保護膜は、そのような側面における腐食物の生成を抑制することができる。
【００８２】
しかしながら、第１保護膜のみでは、隣接する回路パターンのそれぞれのおもて面の（第１保護膜に沿った）縁部における腐食物の生成を抑制することはできない。特に、隣接する回路パターン間の距離が短く、また、隣接する回路パターン間に大きな電界がかかる時には、隣接する回路パターンのおもて面の縁部に腐食物が生成され、場合によっては、当該回路パターン間を接続してしまうおそれがある。
【００８３】
そこで、第２の実施の形態では、側部に形成された第１保護膜と共に、おもて面の縁部の側部に形成された第１保護膜に沿って第２保護膜がさらに形成されている。これにより、回路パターン１２ａ〜１２ｈのうちの隣接する回路パターンの対向する側面及びおもて面の縁部にイオンマイグレーションによる腐食物の生成が抑制される。これにより、当該隣接する回路パターン間の短絡の発生を確実に防止することができる。
【００８４】
このように、半導体装置１０ａでは、複数の回路パターン１２ａ〜１２ｈは、隣接する回路パターンの対向する側面に複数の第１保護膜と、回路パターン１２ａ〜１２ｈのおもて面の縁部に第１保護膜に沿って第２保護膜とがそれぞれ形成されており、これらの側面及び縁部以外はめっき処理等が施されていない。
【００８５】
このため、複数の回路パターン１２ａ〜１２ｈの接合領域１５ａ１，１５ｂ１，１５ｄ１，１５ｃ１，１５ｃ２，１６ａ１〜１６ｇ１に直接はんだ１８ａ〜１８ｉを介して半導体素子１５ａ，１５ｂ，１５ｄと、電子部品１５ｃと、コンタクト部品１６ａ〜１６ｇとを接合すると、はんだ１８ａ〜１８ｉの複数の回路パターン１２ａ〜１２ｈに対する濡れ性の低下が抑制される。したがって、複数の回路パターン１２ａ〜１２ｈに対する半導体素子１５ａ，１５ｂ，１５ｄと、電子部品１５ｃと、コンタクト部品１６ａ〜１６ｇとの接合強度の低下が抑制される。
【００８６】
さらに、複数の回路パターン１２ａ〜１２ｈは、隣接する回路パターンの対向する側面に複数の第１保護膜（符号省略）及び回路パターンのおもて面の縁部に第１保護膜に沿って第２保護膜がそれぞれ形成されているために、当該隣接する回路パターンの対向する側面にイオンマイグレーションによる腐食物の生成が抑制される。これにより、当該隣接する回路パターン間の短絡の発生を確実に防止することができる。
【００８７】
したがって、半導体装置１０ａの故障の発生が低減されて、信頼性の低下を防止することができるようになる。
【００８８】
［第３の実施の形態］
第２の実施の形態の半導体装置１０ａでは、回路パターン１２ａ〜１２ｈのうち、隣接する回路パターンの対向する側面及び当該側面に沿ったおもて面の縁部にイオンマイグレーションによる腐食物の生成を抑制するために、第１保護膜及び第２保護膜を形成している。
【００８９】
このようなイオンマイグレーションによる回路パターン１２ａ〜１２ｈ間の腐食物の生成をより確実に抑制することができる半導体装置１０ｂについて図７〜図９を用いて説明する。
【００９０】
図７は、第３の実施の形態の半導体装置の要部平面図であり、図８及び図９は、第３の実施の形態の半導体装置の要部断面図である。
【００９１】
なお、図７〜図９に示す半導体装置１０ｂにおいて、第１の実施の形態の半導体装置１０（図１〜図３）と同じ符号のものは同じ構成を表している。
【００９２】
また、図７は、第２の実施の形態と同様に、第１の実施の形態の図１の回路パターン１２ｅの周辺における平面図に対応している。図８は、図７の一点鎖線Ｘ１−Ｘ１における断面図を表している。図９は、図７の一点鎖線Ｘ２−Ｘ２における断面図を表している。
【００９３】
半導体装置１０ｂは、半導体装置１０と同様に、複数の回路パターン１２ａ〜１２ｈにおいて互いに対向する側面に第１保護膜がそれぞれ形成されている。さらに、半導体装置１０ｂでは、複数の回路パターン１２ａ〜１２ｈの互いに対向する側面以外の側面にも第１保護膜がそれぞれ形成されている。また、半導体装置１０ｂでは、回路パターン１２ａ〜１２ｈの側面に形成された第１保護膜に沿って、回路パターン１２ａ〜１２ｈのおもて面の縁部に第２保護膜が形成されている。さらに、半導体装置１０ｂでは、複数の回路パターン１２ａ〜１２ｈの互いに対向する側面以外の側面に形成された第１保護膜に沿って、回路パターン１２ａ〜１２ｈのおもて面の縁部にも第２保護膜がそれぞれ形成されている。そして、半導体装置１０ｂでは、回路パターン１２ａ〜１２ｈのおもて面上に接合領域１５ａ１，１５ｂ１，１５ｄ１，１５ｃ１，１５ｃ２，１６ａ１〜１６ｇ１を露出して第３保護膜が形成されている。
【００９４】
すなわち、半導体装置１０ｂの複数の回路パターン１２ａ〜１２ｈは、そのおもて面上の接合領域１５ａ１，１５ｂ１，１５ｄ１，１５ｃ１，１５ｃ２，１６ａ１〜１６ｇ１を露出して全体が第１保護膜、第２保護膜、第３保護膜で覆われている。
【００９５】
例えば、図７〜図９に示されるように、回路パターン１２ｅは、第２の実施の形態と同様に、回路パターン１２ａ〜１２ｄ，１２ｆ〜１２ｈ（図１を参照）に対向する側面に第１保護膜１２ｅ１〜１２ｅ４が形成されている。さらに、回路パターン１２ａの残りの側面に第１保護膜１２ｅ１１，１２ｅ１２が形成されている。また、回路パターン１２ｅは、第１保護膜１２ｅ１〜１２ｅ４に沿って、おもて面の縁部に第２保護膜１２ｅ６〜１２ｅ９が形成されている。さらに、回路パターン１２ｅは、保護膜１２ｅ１１，１２ｅ１２に沿って、おもて面の縁部に第２保護膜１２ｅ１３，１２ｅ１４が形成されている。
【００９６】
さらに、回路パターン１２ｅは、おもて面上に接合領域１５ａ１，１５ｂ１を露出して第３保護膜１２ｅ１０が形成されている。
【００９７】
また、図７に示されるように、回路パターン１２ａは、回路パターン１２ｂ，１２ｅ（図１を参照）に対向する側面に第１保護膜１２ａ１，１２ａ２が形成されていると共に、第１保護膜１２ａ１，１２ａ２に沿って、回路パターン１２ａのおもて面の縁部に第２保護膜１２ａ５，１２ａ６が形成されている。
【００９８】
また、回路パターン１２ａは、残りの側面に第１保護膜１２ａ７が形成されていると共に、第１保護膜１２ａ７に沿って、回路パターン１２ａのおもて面の縁部に第２保護膜１２ａ８が形成されている。但し、半導体装置１０ｂの回路パターン１２ａでは、第１保護膜１２ａ２及び第２保護膜１２ａ６は、半導体装置１０ａの場合に対して回路パターン１２ａの辺に沿って延伸して形成されている。
【００９９】
さらに、回路パターン１２ａは、おもて面上に接合領域１６ａ１（図１を参照、図７では省略）を露出して第３保護膜１２ａ１０が形成されている。なお、第３保護膜１２ａ１０，１２ｅ１０は、特に区別しない場合には、符号を一部省略することがある。
【０１００】
図示を省略するものの、回路パターン１２ａ，１２ｅと同様に、回路パターン１２ｂ〜１２ｄ，１２ｆ〜１２ｈについても、周囲の全ての側面及び当該側面に沿ったおもて面の縁部に第１保護膜及び第２保護膜がそれぞれ形成されていると共に、回路パターン１２ｂ〜１２ｄ，１２ｆ〜１２ｈのおもて面上に接合領域１２ｂ１，１２ｃ２，１２ｄ１，１２ｆ１，１２ｇ１，１２ｈ１，１６ａ１〜１６ｇ１を露出して第３保護膜（図示を省略）が形成されている。
【０１０１】
なお、第３保護膜は、第１保護膜及び第２保護膜と同様に、耐食性に優れた材質が用いられる。このような材質もまた、第１保護膜と同様に、例えば、アルミニウム、ニッケル、チタン、クロム、モリブデン、タンタル、ニオブ、タングステン、バナジウム、ビスマス、ジルコニウム、ハフニウム、金、白金、パラジウム、または、少なくともこれらの一種を含む合金等である。
【０１０２】
また、このような第３保護膜は、第１，第２の実施の形態の第１，第２保護膜と同様に、無電解めっきにより形成することができる。この際、回路パターン１２ａ〜１２ｈの接合領域１５ａ１，１５ｂ１，１５ｄ１，１５ｃ１，１５ｃ２，１６ａ１〜１６ｇ１には、予め、マスキング（レジスト）を形成しておき、無電解めっき後に当該レジストを除去することで、回路パターン１２ａ〜１２ｈに第１保護膜、第２保護膜及び第３保護膜をそれぞれ形成することができる。したがって、第１保護膜、第２保護膜及び第３保護膜は、一体的に構成されている。すなわち、半導体装置１０ｂにおける複数の回路パターン１２ａ〜１２ｈに対して形成する第１保護膜、第２保護膜及び第３保護膜は、接合領域１５ａ１，１５ｂ１，１５ｄ１，１５ｃ１，１５ｃ２，１６ａ１〜１６ｇ１に対応するマスキング（レジスト）のみを形成すればよい。このため、第１，第２の実施の形態の場合に比べて、第１保護膜、第２保護膜及び第３保護膜の形成が容易となる。
【０１０３】
このように上記半導体装置１０ｂでは、複数の回路パターン１２ａ〜１２ｈは、回路パターンの周囲の側面に複数の第１保護膜と、回路パターン１２ａ〜１２ｈのおもて面の縁部に第１保護膜に沿って第２保護膜とがそれぞれ形成されている。さらに、複数の回路パターン１２ａ〜１２ｈは、そのおもて面上に接合領域１５ａ１，１５ｂ１，１５ｄ１，１５ｃ１，１５ｃ２，１６ａ１〜１６ｇ１を露出して第３保護膜がそれぞれ形成されている。
【０１０４】
このため、複数の回路パターン１２ａ〜１２ｈの接合領域１５ａ１，１５ｂ１，１５ｄ１，１５ｃ１，１５ｃ２，１６ａ１〜１６ｇ１に直接はんだ１８ａ〜１８ｉを介して半導体素子１５ａ，１５ｂ，１５ｄと、電子部品１５ｃと、コンタクト部品１６ａ〜１６ｇとを接合すると、はんだ１８ａ〜１８ｉの複数の回路パターン１２ａ〜１２ｈに対する濡れ性の低下が抑制される。したがって、複数の回路パターン１２ａ〜１２ｈに対する半導体素子１５ａ，１５ｂ，１５ｄと、電子部品１５ｃと、コンタクト部品１６ａ〜１６ｇとの接合強度の低下が抑制される。
【０１０５】
さらに、複数の回路パターン１２ａ〜１２ｈは、回路パターンの周囲の側面に複数の第１保護膜、回路パターンのおもて面の縁部に第１保護膜に沿って第２保護膜、回路パターンのおもて面上に接合領域を露出して第３保護膜がそれぞれ形成されている。このため、当該回路パターン間にイオンマイグレーションによる腐食物の生成が確実に抑制される。これにより、当該回路パターン間の短絡の発生をより確実に防止することができる。
【０１０６】
したがって、半導体装置１０ｂの故障の発生が低減されて、信頼性の低下を防止することができるようになる。
【０１０７】
なお、第３の実施の形態の半導体装置１０ｂの第１保護膜、第２保護膜及び第３保護膜を鑑みると、半導体装置１０は、複数の回路パターン１２ａ〜１２ｈにおいて、複数の回路パターン１２ａ〜１２ｈの接合領域１５ａ１，１５ｂ１，１５ｄ１，１５ｃ１，１５ｃ２，１６ａ１〜１６ｇ１が露出されていれば、少なくとも、隣接する回路パターンの対向する側面に複数の第１保護膜が形成されることを要する。
【０１０８】
同様に、半導体装置１０ｂは、複数の回路パターン１２ａ〜１２ｈにおいて、複数の回路パターン１２ａ〜１２ｈの接合領域１５ａ１，１５ｂ１，１５ｄ１，１５ｃ１，１５ｃ２，１６ａ１〜１６ｇ１が露出されていれば、少なくとも、隣接する回路パターンの対向する側面に複数の第１保護膜と、回路パターン１２ａ〜１２ｈのおもて面の縁部に第１保護膜に沿って第２保護膜とが形成されることを要する。
【符号の説明】
【０１０９】
１０，１０ａ，１０ｂ  半導体装置
１１  絶縁板
１２ａ，１２ｂ，１２ｃ，１２ｄ，１２ｅ，１２ｆ，１２ｇ，１２ｈ  回路パターン
１２ａ１，１２ａ２，１２ａ７，１２ｂ１，１２ｂ２，１２ｂ３，１２ｃ１，１２ｃ２，１２ｃ３，１２ｄ１，１２ｄ２，１２ｅ１，１２ｅ２，１２ｅ３，１２ｅ４，１２ｅ１１，１２ｅ１２，１２ｆ１，１２ｆ２，１２ｇ１，１２ｇ２，１２ｇ３，１２ｈ１，１２ｈ２  第１保護膜
１２ａ４，１２ｂ４，１２ｃ４，１２ｄ４，１２ｈ４，１２ｅ５  ボンディング領域
１２ａ５，１２ａ６，１２ａ８，１２ｅ６，１２ｅ７，１２ｅ８，１２ｅ９，１２ｅ１３，１２ｅ１４  第２保護膜
１２ａ１０，１２ｅ１０  第３保護膜
１３  金属板
１４  セラミック回路基板
１５ａ，１５ｂ，１５ｄ  半導体素子
１５ｃ  電子部品
１５ａ１，１５ｂ１，１５ｄ１，１５ｃ１，１５ｃ２，１６ａ１，１６ｂ１，１６ｃ１，１６ｄ１，１６ｅ１，１６ｆ１，１６ｇ１  接合領域
１６ａ，１６ｂ，１６ｃ，１６ｄ，１６ｅ，１６ｆ，１６ｇ  コンタクト部品
１７ａ，１７ｂ，１７ｃ，１７ｄ，１７ｅ  ボンディングワイヤ
１８ａ，１８ｂ，１８ｃ，１８ｄ，１８ｅ，１８ｆ，１８ｇ，１８ｈ，１８ｉ，１８ｊ，１８ｋ，１８ｌ  はんだ
１９ａ，１９ｂ，１９ｃ，１９ｄ，１９ｅ，１９ｆ，１９ｇ  外部接続端子
２０  金属基板
２１  ケース
２１ａ  蓋部
２１ｂ  側壁部
【図１】
2019012779.tif 000003
【図２】
2019012779.tif 000004
【図３】
2019012779.tif 000005
【図４】
2019012779.tif 000006
【図５】
2019012779.tif 000007
【図６】
2019012779.tif 000008
【図７】
2019012779.tif 000009
【図８】
2019012779.tif 000010
【図９】
2019012779.tif 000011