(57)【要約】【課題】イーサネットフレームを効率的に検知できるイーサネットフレーム検知回路を開示する。【解決手段】イーサネットフレームを検知するイーサネット検知装置４００に含まれるイーサネットフレーム検知回路３００ａ，３００ｂ，３００ｎは、受信されたデータのバイト（ｂｙｔｅ）カウント値を算出する受信バイトカウンタと、算出されたバイトカウント値に基づいて、マスクデータ及びフレームのパターンを含む比較データを計算するマスク及びパターン格納部と、計算されたマスクデータ及び比較データに基づいて、受信されたデータが、検知しようとする目的データと一致するか否かを判断する比較器と、判断結果に対応する検知信号を出力する検知信号発生器と、を含む。【選択図】図１
2019030025.tif 000002
【特許請求の範囲】
【請求項１】
イーサネットフレームを検知するイーサネットフレーム検知回路であって、
受信されたデータのバイトカウント値を算出する受信バイトカウンタと、
第１のマルチプレクサにより、検知しなくてもよいビットを無視するためのマスクレジスタデータ及び前記算出されたバイトカウント値に基づいて、マスクデータを計算し、かつ、第２のマルチプレクサにより、検知しようとするフレームを示すパターンレジスタデータ及び前記算出されたバイトカウント値に基づいて、フレームのパターンを含む比較データを計算するマスク及びパターン格納部と、
前記マスクデータ及び比較データに基づいて、前記受信されたデータが、検知しようとする目的データと一致するか否かを判断する比較器と、
前記判断結果に対応する検知信号を出力する検知信号発生器と、を含む、イーサネットフレーム検知回路。
【請求項２】
前記マスク及びパターン格納部は、
検知しなくてもよいビットを無視するためのマスクレジスタデータ及び検知しようとするフレームを示すパターンレジスタデータを格納し、前記格納されたマスクレジスタデータ及び前記パターンレジスタデータに基づいて、前記算出されたバイトカウント値に対応する前記マスクデータ及び前記比較データを生成及び格納するマスク及びパターン格納メモリを含む、請求項１に記載のイーサネットフレーム検知回路。
【請求項３】
前記マスク及びパターン格納メモリは、ＲＡＭ、ＲＯＭ、フラッシュメモリのうち少なくとも一つ以上で構成される、請求項２に記載のイーサネットフレーム検知回路。
【請求項４】
前記マスク及びパターン格納部は、
検知しなくてもよいビットを無視するためのマスクレジスタデータを格納するマスクレジスタデータ列と、
前記マスクレジスタデータ及び前記算出されたバイトカウント値に基づいて、前記マスクデータを計算する第１のマルチプレクサと、
検知しようとするフレームを示すパターンレジスタデータを格納するパターンレジスタデータ列と、
前記パターンレジスタデータ及び前記算出されたバイトカウント値に基づいて、前記比較データを計算する第２のマルチプレクサと、を含む、請求項１に記載のイーサネットフレーム検知回路。
【請求項５】
前記比較器は、
前記マスクデータに基づいて、前記受信されたデータにおいて前記検知しなくてもよいビットを無視する第１の比較器と、
前記比較データに基づいて、前記受信されたデータを、前記検知しようとする目的データと比較する第２の比較器と、を含む、請求項１に記載のイーサネットフレーム検知回路。
【発明の詳細な説明】
【技術分野】
【０００１】
本発明は、イーサネットフレーム検知回路に関し、より詳細には、イーサネットのネットワーク通信分野においてイーサネットフレームを検知するための検知回路に関する。
【背景技術】
【０００２】
イーサネット（Ｅｔｈｅｒｎｅｔ）は、最も代表的なバス構造方式のローカルエリアネットワークであって、イーサネットにおいて、データを送信するためにはＣＳＭＡ／ＣＤ（Ｃａｒｒｉｅｒ  Ｓｅｎｓｅ  Ｍｕｌｔｉｐｌｅ  Ａｃｃｅｓｓ  ｗｉｔｈ  Ｃｏｌｌｉｓｉｏｎ  Ｄｅｔｅｃｔｉｏｎ）方式を用いる。
【０００３】
イーサネットフレーム（Ｅｔｈｅｒｎｅｔ  Ｆｒａｍｅ）は、データの送信時に、上位層であるインターネット層で生成されたデータパケットにイーサネットヘッダ（ｈｅａｄｅｒ）とトレーラ（ｔｒａｉｌｅｒ）が追加され、媒体を介して送信される。そして、イーサネットフレームは、データの受信時には、ヘッダとトレーラが分離され、データパケットをネットワーク層に送る。
【０００４】
かかるイーサネットフレームは、受信側にイーサネットフレームが送信されることを知らせ、到着するフレームで０と１を区分できるように同期信号を提供するプリアンブル（Ｐｒｅａｍｂｌｅ）フィールド、フレームのスタート位置を示すスタートデリミター（Ｓｔａｒｔ  Ｄｅｌｉｍｉｔｅｒ）フィールド、宛先ＭＡＣアドレス（Ｄｅｓｔｉｎａｔｉｏｎ  Ａｄｄｒｅｓｓ）フィールド、送信元ＭＡＣアドレス（Ｓｏｕｒｃｅ  Ａｄｄｒｅｓｓ）フィールド、データフィールドに含まれた可変長さの送信データのサイズを示す長さ（Ｌｅｎｇｔｈ）フィールド、データ（ｄａｔａ）フィールド、データの送信過程におけるデータ変形エラーの発生有無を受信ホストが確認できるようにするチェックサム（Ｃｈｅｃｋｓｕｍ）フィールドで構成される。
【０００５】
一方、イーサネットデータを処理するためには、受信されたイーサネットフレームを検知し、その検知結果に応じて、受信されたイーサネットフレームを適宜処理することができる経路を介して伝達しなければならない。
【０００６】
したがって、イーサネットフレームを効率的に検知することができるイーサネットフレーム検知回路が要求されている。
【発明の概要】
【発明が解決しようとする課題】
【０００７】
本発明の目的は、イーサネットフレームを様々な方式により効率的に検知することにある。
【０００８】
また、本発明の他の目的は、イーサネットフレーム検知回路の生産コストを低減し、構成を単純化することにある。
【課題を解決するための手段】
【０００９】
本発明の一実施形態によるイーサネットフレーム検知回路は、受信されたデータのバイト（ｂｙｔｅ）カウント値を算出する受信バイトカウンタと、前記算出されたバイトカウント値に基づいて、マスクデータ及びフレームのパターンを含む比較データを計算するマスク及びパターン格納部と、前記計算されたマスクデータ及び比較データに基づいて、前記受信されたデータが、検知しようとする目的データと一致するか否かを判断する比較器と、前記判断結果に対応する検知信号を出力する検知信号発生器と、を含む。
【００１０】
前記マスク及びパターン格納部は、検知しなくてもよいビット（ｂｉｔ）を無視するた
めのマスクレジスタ及び検知しようとするフレームを示すパターンレジスタを格納し、前
記格納されたマスクレジスタ及び前記パターンレジスタに基づいて、前記算出されたバイ
トカウント値に対応する前記マスクデータ及び前記比較データを計算するマスク及びパタ
ーン格納メモリを含むことができる。
【００１１】
前記マスク及びパターン格納メモリは、ＲＡＭ（Ｒａｎｄｏｍ  Ａｃｃｅｓｓ  Ｍｅｍ
ｏｒｙ）、ＲＯＭ（Ｒｅａｄ  Ｏｎｌｙ  Ｍｅｍｏｒｙ）、フラッシュメモリ（Ｆｌａｓ
ｈ  Ｍｅｍｏｒｙ）の一つ以上で構成されることができる。
【００１２】
前記マスク及びパターン格納部は、検知しなくてもよいビットを無視するためのマスク
レジスタを格納するマスクレジスタ列と、前記マスクレジスタ及び前記算出されたバイト
カウント値に基づいて、前記マスクデータを計算する第１のマックスと、検知しようとす
るフレームを示すパターンレジスタを格納するパターンレジスタ列と、前記パターンレジ
スタ及び前記算出されたバイトカウント値に基づいて、前記比較データを計算する第２の
マックスと、を含むことができる。
【００１３】
前記比較器は、前記計算されたマスクデータに基づいて、前記受信されたデータにおい
て前記検知しなくてもよいビットを無視する第１の比較器と、前記計算された比較データ
に基づいて、前記受信されたデータを、前記検知しようとする目的データと比較する第２
の比較器と、を含むことができる。
【発明の効果】
【００１４】
本発明の実施形態によるイーサネットフレーム検知装置及びその動作方法によれば、様
々な構成によりイーサネットフレームを検知することができるため、イーサネットフレー
ム検知装置に要求される特性を満たすことができる。
【００１５】
また、本発明によれば、イーサネットフレーム検知回路の生産コストを低減し、構成を
単純化することができる。
【図面の簡単な説明】
【００１６】
【図１】本発明の一実施形態によるイーサネットシステムの構成を説明するためのブロック構成図である。
【図２】本発明の一実施形態によるイーサネットフレーム検知回路の構成を説明するためのブロック構成図である。
【図３】本発明の一実施形態によるイーサネットフレーム検知回路の動作方法を説明するためのフローチャートである。
【図４】本発明の一実施形態によるマスク及びパターン格納部の構成を示すイーサネットフレーム検知回路のブロック構成図である。
【図５】本発明の他の実施形態によるマスク及びパターン格納部の構成を示すイーサネットフレーム検知回路のブロック構成図である。
【発明を実施するための形態】
【００１７】
以下、本発明に係る実施形態について図面を参照してより詳細に説明する。以下の説明
で用いられる構成要素における接尾辞「モジュール」及び「部」は、明細書を容易に作成
するためにのみ付与または混用されるものであって、そのものが、互いに区別される意味
または役割を有するわけではない。
【００１８】
本発明の利点及び特徴、そしてそれらを果たす方法は、添付図面とともに詳細に後述する実施形態を参照すると明確になる。しかし、本発明は以下で開示される実施形態に限定されず、相違する多様な形態で具現されることができる。本実施形態は、本発明の開示が完全になるようにするとともに、本発明が属する技術分野において通常の知識を有する者に発明の範疇を完全に伝達するために提供されるものであって、本発明は請求範囲のみにより定義される。明細書全体において、同一参照符号は同一構成要素を示す。
【００１９】
本発明の実施形態を説明するにあたり、公知技術または構成についての具体的な説明が本発明の要旨を不明瞭にする可能性があると判断される場合には、その詳細な説明を省略する。そして、後述する用語は、本発明の実施形態における機能を考慮して定義された用語であり、これは使用者、運用者の意図または慣例などによって変わり得る。従って、その定義は本明細書の全体における内容を基に下すべきであろう。
【００２０】
添付した図面の各ブロックとフローチャートの各ステップの組み合わせは、コンピュータプログラムインストラクションによって行われてもよい。これらのコンピュータプログラムインストラクションは、汎用コンピュータ、特殊用コンピュータ、またはその他のプログラム可能なデータプロセッシング装備のプロセッサに搭載可能であるため、コンピュータまたはその他のプログラム可能なデータプロセッシング装備のプロセッサを介して行われるそのインストラクションが、図面の各ブロックまたはフローチャートの各ステップで説明された機能を行う手段を生成するようになる。これらのコンピュータプログラムインストラクションは、特定方式で機能を具現するためにコンピュータまたはその他のプログラム可能なデータプロセッシング装備を指向するコンピュータで利用可能なまたはコンピュータで読取り可能なメモリに格納されることもできるため、そのコンピュータで利用可能なまたはコンピュータで読取り可能なメモリに格納されたインストラクションは、図面の各ブロックまたはフローチャートの各ステップで説明された機能を行うインストラクション手段を内包する製造品目を生産することもできる。コンピュータプログラムインストラクションは、コンピュータまたはその他のプログラム可能なデータプロセッシング装備に搭載することもできるため、コンピュータまたはその他のプログラム可能なデータプロセッシング装備で一連の動作ステップが行われてコンピュータで実行されるプロセスを生成し、コンピュータまたはその他のプログラム可能なデータプロセッシング装備を行うインストラクションは、図面の各ブロックまたはフローチャートの各ステップで説明された機能を行うためのステップを提供することもできる。
【００２１】
また、各ブロックまたは各ステップは、特定の論理的機能を実行するための一つ以上の実行可能なインストラクションを含むモジュール、セグメントまたはコードの一部を示す。また、いくつかの代替実施形態では、ブロックまたはステップで言及した機能が順番を逸脱して発生することもできることに注目すべきである。例えば、引き続き図示されている２つのブロックまたはステップは、実質的に同時に行われてもよく、或いはそのブロックまたはステップが、該当する機能に応じて逆順に行われてもよい。
【００２２】
図１を参照して、本発明の一実施形態によるイーサネットシステム（Ｅｔｈｅｒｎｅｔ  ｓｙｓｔｅｍ）１０について説明する。
【００２３】
図１は本発明の一実施形態によるイーサネットシステム１０の構成を説明するためのブロック構成図である。
【００２４】
図１を参照すると、イーサネットシステム１０は、イーサネット網１００と、物理的インタフェース部２００と、イーサネット検知装置４００と、を含む。
【００２５】
イーサネット網１００は、物理的な通信網を意味することができる。例えば、イーサネット網１００は、バス構造方式のローカルエリアネットワーク（ＬＡＮ）を意味すること
ができる。
【００２６】
物理的インタフェース部２００は、イーサネット網１００に連結されて、データを受信
するためのインタフェース（ｉｎｔｅｒｆａｃｅ）であることができる。
【００２７】
イーサネット検知装置４００は、受信されたデータのイーサネットフレームを検知する
ことができる。
【００２８】
イーサネット検知装置４００は、複数のイーサネットフレーム検知回路３００ａ、３０
０ｂ、…３００ｎで構成されることができる。
【００２９】
ここで、一つのイーサネットフレーム検知回路は、最大Ｌバイトの長さを有する一つの
フレームを検知することができる。これにより、イーサネット検知装置４００は、ｎ個の
イーサネットフレーム検知回路を含む複数のイーサネットフレーム検知回路３００ａ、３
００ｂ、…３００ｎを用いて、ｎ個のフレームを同時に検知することができる。
【００３０】
以下、便宜のために、イーサネットフレーム検知回路の図面符号を「３００」として説
明する。
【００３１】
図２を参照して、イーサネットフレーム検知回路３００について詳細に説明する。
【００３２】
図２は本発明の一実施形態によるイーサネットフレーム検知回路３００の構成を説明す
るためのブロック構成図である。
【００３３】
図２を参照すると、イーサネットフレーム検知回路３００は、受信バイトカウンタ３１
０と、マスク及びパターン格納部３２０と、比較器３３０と、検知信号発生器３４０と、
を含む。
【００３４】
受信バイトカウンタ３１０は、受信されたデータが、イーサネットフレームにおいて何
番目のバイトであるかをカウントすることができる。これにより、受信バイトカウンタ３
１０は、受信中のデータのバイトカウント値を算出することができる。そして、受信バイ
トカウンタ３１０は、算出されたカウント値をマスク及びパターン格納部３２０と検知信
号発生器３４０に伝達することができる。
【００３５】
マスク及びパターン格納部３２０は、格納されたマスクレジスタ及びパターンレジスタ
に基づいて、算出されたカウント値に対応するマスクデータ及び比較データを計算するこ
とができる。
【００３６】
ここで、マスクレジスタとは、Ｌ個のバイトで構成され、ビット（ｂｉｔ）マスクを示
すレジスタを意味することができる。そのため、マスクレジスタは、検知しなくてもよい
ビットを無視するために用いられるレジスタを意味することができる。マスクデータとは
、算出されたカウント値に対応するマスクレジスタを意味することができる。
【００３７】
ここで、パターンレジスタとは、Ｌ個のバイトで構成され、ビットの比較パターンを示
すレジスタを意味することができる。そのため、パターンレジスタは、検知しようとする
フレームのパターンを示すためのレジスタを意味することができる。比較データは、算出
されたカウント値に対応するパターンレジスタを意味することができる。
【００３８】
比較器３３０は、計算されたマスクデータ及び比較データを、受信されたデータと比較
することができる。例えば、比較器３３０は、計算されたマスクデータに基づいて、受信されたデータにおいて検知が不要なビットを無視することができる。そして、比較器３３０は、計算された比較データに基づいて、受信されたデータにおいて検知しようとするフレームのパターンを検知することができる。ここで、検知しようとするフレームのパターンを含むデータを、目的データと言える。そして、比較器３３０はその比較結果を検知信号発生器３４０に伝達する。
【００３９】
一方、比較器３３０は複数の比較器を含むことができる。例えば、比較器３３０は、第１の比較器３３１及び第２の比較器３３２を含むことができる。
【００４０】
第１の比較器３３１は、計算されたマスクデータに基づいて、受信されたデータにおいて検知しなくてもよいビットを無視することができる。
【００４１】
第２の比較器３３２は、計算された比較データに基づいて、受信されたデータを検知しようとする目的データと比較することができる。
【００４２】
一方、受信されたデータは、第１の比較器３３１及び第２の比較器３３２を順に経ることができる。
【００４３】
検知信号発生器３４０は、比較結果に基づいて検知信号を出力する。
【００４４】
検知信号発生器３４０は、検知しようとする、最大Ｌバイトの長さを有する一つのフレームが検知されたか否かに対する信号として検知信号を出力することができる。
【００４５】
例えば、検知信号発生器３４０は、検知しようとするフレームが検知されると１を出力し、検知しようとするフレームと一致しない場合には０を出力することができる。
【００４６】
上述の説明に基づき、イーサネットフレーム検知回路３００の動作方法を説明する。
【００４７】
図３は本発明の一実施形態によるイーサネットフレーム検知回路３００の動作方法を説明するためのフローチャートである。
【００４８】
図３を参照すると、イーサネットフレーム検知回路３００の受信バイトカウンタ３１０は、受信中のデータのバイトカウント値を算出する（Ｓ１１０）。
【００４９】
受信バイトカウンタ３１０は、受信中または受信されたデータが、イーサネットフレームにおいて何番目のバイトであるかをカウントすることができる。これにより、受信バイトカウンタ３１０は、受信中のデータのバイトカウント値を算出することができる。そして、受信バイトカウンタ３１０は、算出されたカウント値をマスク及びパターン格納部３２０と検知信号発生器３４０に伝達することができる。
【００５０】
イーサネットフレーム検知回路３００のマスク及びパターン格納部３２０は、算出されたカウント値に基づいて、マスクデータと比較データをそれぞれ計算する（Ｓ１２０）。
【００５１】
マスク及びパターン格納部３２０は、格納されたマスクレジスタ及びパターンレジスタに基づいて、算出されたカウント値に対応するマスクデータ及び比較データを計算することができる。
【００５２】
一実施形態を図４を参照して説明する。
【００５３】
図４は本発明の一実施形態によるマスク及びパターン格納部３２０の構成を示すイーサ
ネットフレーム検知回路３００のブロック構成図である。
【００５４】
図４を参照すると、イーサネットフレーム検知回路３００のマスク及びパターン格納部
３２０は、マスクレジスタ列３２１と、第１のマックス（Ｍｕｘ）３２２と、パターンレ
ジスタ列３２３と、第２のマックス３２４と、を含むことができる。
【００５５】
マスクレジスタ列３２１はマスクレジスタを格納することができる。
【００５６】
第１のマックス３２２は、マスクレジスタ列３２１に格納されたマスクレジスタ及び算
出されたカウント値に基づいて、マスクデータを計算することができる。
【００５７】
例えば、第１のマックス３２２は、算出されたカウント値を選択信号として、マスクレ
ジスタ列３２１に格納されたマスクレジスタからマスクデータを選択することができる。
【００５８】
そして、第１のマックス３２２は、計算された比較マスクデータを比較器３３０に伝達
することができる。例えば、第１のマックス３２２は、計算されたマスクデータを第１の
比較器３３１に伝達することができる。
【００５９】
パターンレジスタ列３２３はパターンレジスタを格納することができる。
【００６０】
第２のマックス３２４は、パターンレジスタ列３２３に格納されたパターンレジスタ及
び算出されたカウント値に基づいて、比較データを計算することができる。
【００６１】
例えば、第２のマックス３２４は、算出されたカウント値を選択信号として、パターン
レジスタ列３２３に格納されたパターンレジスタから比較データを選択することができる
。
【００６２】
そして、第２のマックス３２４は、計算された比較データを比較器３３０に伝達するこ
とができる。例えば、第２のマックス３２４は、計算された比較データを第２の比較器３
３２に伝達することができる。
【００６３】
他の実施形態を図５を参照して説明する。
【００６４】
図５は本発明の他の実施形態によるマスク及びパターン格納部３２０の構成を示すイー
サネットフレーム検知回路３００のブロック構成図である。
【００６５】
図５を参照すると、イーサネットフレーム検知回路３００のマスク及びパターン格納部
３２０は、マスク及びパターン格納メモリ３２７を含むことができる。
【００６６】
マスク及びパターン格納メモリ３２７は、マスクレジスタ及びパターンレジスタを格納
することができる。そして、マスク及びパターン格納メモリ３２７は、格納されたマスク
レジスタ及びパターンレジスタに基づいて、算出されたカウント値に対応するマスクデー
タ及び比較データを計算することができる。そして、マスク及びパターン格納メモリ３２
７は、計算されたマスクデータ及び比較データを比較器３３０に伝達することができる。
例えば、マスク及びパターン格納メモリ３２７は、計算されたマスクデータを第１の比較
器３３１に伝達し、計算された比較データを第２の比較器３３２に伝達することができる
。
【００６７】
一方、マスク及びパターン格納メモリ３２７は様々な方式のメモリで構成されることが
できる。例えば、マスク及びパターン格納メモリ３２７は、ＲＡＭ（Ｒａｎｄｏｍ  Ａｃｃｅｓｓ  Ｍｅｍｏｒｙ）、ＲＯＭ（Ｒｅａｄ  Ｏｎｌｙ  Ｍｅｍｏｒｙ）、フラッシュメモリ（Ｆｌａｓｈ  Ｍｅｍｏｒｙ）の一つ以上で構成されることができる。
【００６８】
そして、マスク及びパターン格納メモリ３２７を含むイーサネットフレーム検知回路３００は、Ｄ‐フリップフロップ（ｆｌｉｐ‐ｆｌｏｐ）などの素子の使用を低減することができるため、イーサネットフレーム検知回路３００の生産コストを低減し、イーサネットフレーム検知回路３００を構成する半導体チップのサイズを減少させることができる。
【００６９】
さらに図３を参照する。
【００７０】
イーサネットフレーム検知回路３００の比較器３３０は、計算されたマスクデータと比較データに基づいて、受信されたデータが、検知しようとする目的データと一致するか否かを判断する（Ｓ１３０）。
【００７１】
比較器３３０は、計算されたマスクデータ及び比較データを、受信されたデータと比較することができる。
【００７２】
例えば、比較器３３０は、計算されたマスクデータに基づいて、受信されたデータにおいて検知が不要なビットを無視することができる。そして、比較器３３０は、計算された比較データに基づいて、受信されたデータにおいて検知しようとするフレームのパターンを検知することができる。ここで、検知しようとするフレームのパターンを含むデータを、目的データと言える。これにより、比較器３３０は、受信されたデータが、検知しようとする目的データと一致するか否かを判断することができる。そして、比較器３３０は、マスクデータ及び比較データと受信されたデータの比較による判断結果を検知信号発生器３４０に伝達することができる。
【００７３】
一方、比較器３３０は、上述のように複数の比較器で構成されることができる。
【００７４】
例えば、比較器３３０は、第１の比較器３３１及び第２の比較器３３２を含むことができる。
【００７５】
これにより、第１の比較器３３１は、計算されたマスクデータに基づいて、受信されたデータにおいて検知しなくてもよいビットを無視し、第２の比較器３３２は、計算された比較データに基づいて、受信されたデータを検知しようとする目的データと比較することができる。そして、第１の比較器３３１及び第２の比較器３３２は、その比較結果を検知信号発生器３４０に伝達することができる。
【００７６】
イーサネットフレーム検知回路３００の検知信号発生器３４０は、判断結果に対応する検知信号を出力する（Ｓ１４０）。
【００７７】
検知信号発生器３４０は、伝達された判断結果に基づいて検知信号を出力する。
【００７８】
検知信号発生器３４０は、検知しようとする、最大Ｌバイトの長さを有する一つのフレームが検知されたか否かに対する信号として検知信号を出力することができる。
【００７９】
例えば、検知信号発生器３４０は、検知しようとするフレームが検知されると１を出力し、検知しようとするフレームと一致しない場合には０を出力することができる。
【００８０】
このように、上述のイーサネットフレーム検知回路３００は、受信されたデータが検知しようとする、最大Ｌバイトの長さを有する一つのフレームが検知されたか否かに対する
信号として検知信号を出力することができる。
【００８１】
そして、イーサネット検知装置４００は、複数のイーサネットフレーム検知回路３００
を用いて、複数のフレームを同時に検知することができる。
【００８２】
これにより、イーサネット検知装置４００は、ｎ個のイーサネットフレーム検知回路３
００を含む場合、Ｎ ´ Ｌバイトのサイズを有するイーサネットフレームを同時に検知す
ることができる。
【００８３】
本発明の一実施形態によれば、上述の方法は、プログラムが記録された媒体にプロセッ
サが読み取ることができるコードとして具現することができる。プロセッサが読み取るこ
とができる媒体の例としては、ＲＯＭ、ＲＡＭ、ＣＤ‐ＲＯＭ、磁気テープ、フロッピデ
ィスク、光データ格納装置などが挙げられ、キャリアウェーブ（例えば、インターネット
を介した送信）の形態で具現されることも含む。
【００８４】
上述の本発明の実施形態によるイーサネットフレーム検知装置及びその動作方法によれ
ば、様々な構成によりイーサネットフレームを検知することができるため、イーサネット
フレーム検知装置に要求される特性を満たすことができる。
【００８５】
また、本発明によれば、イーサネットフレーム検知回路の生産コストを低減し、構成を
単純化することができる。
【００８６】
上記のように記載された実施形態は、上述の構成と方法が限定されて適用されるのでは
なく、実施形態の様々な変形が行われるように、各実施形態の全部または一部が選択的に
組み合わせられて構成されてもよい。
【００８７】
また、以上で本発明の好ましい実施形態について示して説明したが、本発明は上述の特
定の実施形態に限定されず、請求範囲にて請求する本発明の要旨を逸脱することなく当該
発明が属する技術分野において通常の知識を有する者によって様々な変形実施が可能であ
るだけでなく、かかる変形実施は本発明の技術的思想や展望から個別的に理解されてはな
らない。
【産業上の利用可能性】
【００８８】
本発明は、イーサネットフレーム検知回路に適用できる。
【符号の説明】
【００８９】
３００    イーサネットフレーム検知回路
３００ａ  第１のイーサネットフレーム検知回路
３００ｂ  第２のイーサネットフレーム検知回路
３００ｎ  第ｎのイーサネットフレーム検知回路
３１０    受信バイトカウンタ
３２０    マスク及びパターン格納部
３２７    マスク及びパターン格納メモリ
３３０    比較器
３２１    マスクレジスタ列
３２２    第１のマックス
３２３    パターンレジスタ列
３２４    第２のマックス
３３０    比較器
３３１    第１の比較器
３３２    第２の比較器
３４０    検知信号発生器
【図１】
2019030025.tif 000003
【図２】
2019030025.tif 000004
【図３】
2019030025.tif 000005
【図４】
2019030025.tif 000006
【図５】
2019030025.tif 000007