(57)【要約】【課題】  中間領域を有する半導体装置において、ネガティブキャパシタンス効果を抑制する技術を提供する。【解決手段】  半導体装置は、半導体基板と、トレンチと、ゲート絶縁膜と、ゲート電極、を備える。半導体基板が、ゲート絶縁膜に接しているｎ型のエミッタ領域と、エミッタ領域の下側でゲート絶縁膜に接しているｐ型の上部ボディ領域と、上部ボディ領域の下側でゲート絶縁膜に接しているｎ型の中間領域と、中間領域の下側でゲート絶縁膜に接しているｐ型の下部ボディ領域と、下部ボディ領域の下側でゲート絶縁膜に接しているｎ型のドリフト領域と、ドリフト領域に対して下側から接するｐ型のコレクタ領域、を有する。下部ボディ領域が、第１範囲と、第１範囲よりも結晶欠陥密度が高い第２範囲を有する。第２範囲が、ゲート絶縁膜に接している。第１範囲が、第２範囲に対してゲート絶縁膜と反対側で接している。【選択図】図２
2019129250.tif 000002
【特許請求の範囲】
【請求項１】
半導体基板と、
前記半導体基板の上面に設けられたトレンチと、
前記トレンチの内面を覆うゲート絶縁膜と、
前記トレンチ内に配置されており、前記ゲート絶縁膜によって前記半導体基板から絶縁されているゲート電極、
を備えており、
前記半導体基板が、
前記上面に露出しており、前記ゲート絶縁膜に接しているｎ型のエミッタ領域と、
前記エミッタ領域の下側で前記ゲート絶縁膜に接しているｐ型の上部ボディ領域と、
前記上部ボディ領域の下側で前記ゲート絶縁膜に接しているｎ型の中間領域と、
前記中間領域の下側で前記ゲート絶縁膜に接しているｐ型の下部ボディ領域と、
前記下部ボディ領域の下側で前記ゲート絶縁膜に接しているｎ型のドリフト領域と、
前記ドリフト領域に対して下側から接するｐ型のコレクタ領域、
を有しており、
前記下部ボディ領域が、第１範囲と、前記第１範囲よりも結晶欠陥密度が高い第２範囲を有しており、
前記第２範囲が、前記ゲート絶縁膜に接しており、
前記第１範囲が、前記第２範囲に対して前記ゲート絶縁膜と反対側で接している、
半導体装置。
【請求項２】
前記中間領域が、第３範囲と、前記第３範囲よりもｎ型不純物濃度が低い第４範囲を有しており、
前記第４範囲が、前記ゲート絶縁膜に接しており、
前記第３範囲が、前記第４範囲に対して前記ゲート絶縁膜と反対側で接している、
請求項１に記載の半導体装置。
【請求項３】
前記ドリフト領域が、第５範囲と、前記第５範囲よりも結晶欠陥密度が高い第６範囲を有しており、
前記第６範囲が、前記ゲート絶縁膜に接しており、
前記第５範囲が、前記第６範囲の周囲に配置されている、
請求項１または２に記載の半導体装置。
【請求項４】
請求項１の半導体装置の製造方法であって、
前記半導体基板に荷電粒子を注入することによって、前記第２範囲を形成する工程を備える、製造方法。
【請求項５】
請求項３の半導体装置の製造方法であって、
前記半導体基板に荷電粒子を注入することによって、前記第６範囲を形成する工程を備える、製造方法。
【発明の詳細な説明】
【技術分野】
【０００１】
本明細書に開示の技術は、半導体装置及びその製造方法に関する。
【０００２】
特許文献１には、半導体基板と、トレンチと、ゲート絶縁膜と、ゲート電極、を備える半導体装置が開示されている。トレンチは、半導体基板の上面に設けられている。ゲート絶縁膜は、トレンチの内面を覆っている。ゲート電極は、トレンチ内に配置されており、ゲート絶縁膜によって半導体基板から絶縁されている。また、半導体基板が、エミッタ領域と、上部ボディ領域と、中間領域と、下部ボディ領域と、ドリフト領域と、コレクタ領域、を有している。エミッタ領域は、半導体基板の上面に露出しており、ゲート絶縁膜に接しているｎ型領域である。上部ボディ領域は、エミッタ領域の下側でゲート絶縁膜に接しているｐ型領域である。中間領域は、上部ボディ領域の下側でゲート絶縁膜に接しているｎ型領域である。下部ボディ領域は、中間領域の下側でゲート絶縁膜に接しているｐ型領域である。ドリフト領域は、下部ボディ領域の下側でゲート絶縁膜に接しているｎ型領域である。コレクタ領域は、ドリフト領域に対して下側から接するｐ型領域である。
【０００３】
特許文献１の半導体装置では、オン動作において、コレクタ領域から上部ボディ領域へ向かう正孔の流れが、中間領域によって抑制される。このため、中間領域の下側の下部ボディ領域とドリフト領域に正孔が蓄積される。ドリフト領域内の正孔（すなわち、少数キャリア）の濃度が高くなることにより、ドリフト領域の抵抗が低下し、半導体装置で生じる損失が低減される。
【先行技術文献】
【特許文献】
【０００４】
【特許文献１】特開２００５−２１００４７号公報
【発明の概要】
【発明が解決しようとする課題】
【０００５】
上述したように、特許文献１の半導体装置がオンするときに、正孔が下部ボディ領域内に蓄積される。下部ボディ領域内のゲート絶縁膜近傍に正孔が蓄積されると、ゲート電極の下部ボディ領域に対向する部分に電子が引き寄せられる。下部ボディ領域に蓄積された正孔と引き寄せられた電子との間に容量が形成されるため、見かけ上、ゲート−エミッタ間の容量が低下する。以下では、この現象を、ネガティブキャパシタンス効果という。ネガティブキャパシタンス効果によってゲート−エミッタ間の容量が低下することに応じて、ゲート電圧が大きく変動するため、半導体装置の信頼性が低下する。本明細書では、中間領域を有する半導体装置において、ネガティブキャパシタンス効果を抑制する技術を提供する。
【課題を解決するための手段】
【０００６】
本明細書が開示する半導体装置は、半導体基板と、トレンチと、ゲート絶縁膜と、ゲート電極、を備えている。前記トレンチは、前記半導体基板の上面に設けられている。前記ゲート絶縁膜は、前記トレンチの内面を覆っている。前記ゲート電極は、前記トレンチ内に配置されており、前記ゲート絶縁膜によって前記半導体基板から絶縁されている。前記半導体基板が、エミッタ領域と、上部ボディ領域と、中間領域と、下部ボディ領域と、ドリフト領域と、コレクタ領域、を有している。前記エミッタ領域は、前記上面に露出しており、前記ゲート絶縁膜に接しているｎ型領域である。前記上部ボディ領域は、前記エミッタ領域の下側で前記ゲート絶縁膜に接しているｐ型領域である。前記中間領域は、前記上部ボディ領域の下側で前記ゲート絶縁膜に接しているｎ型領域である。前記下部ボディ領域は、前記中間領域の下側で前記ゲート絶縁膜に接しているｐ型領域である。前記ドリフト領域は、前記下部ボディ領域の下側で前記ゲート絶縁膜に接しているｎ型領域である。前記コレクタ領域は、前記ドリフト領域に対して下側から接するｐ型領域である。前記下部ボディ領域が、第１範囲と、前記第１範囲よりも結晶欠陥密度が高い第２範囲を有している。前記第２範囲が、前記ゲート絶縁膜に接しており、前記第１範囲が、前記第２範囲に対して前記ゲート絶縁膜と反対側で接している。
【０００７】
上記の半導体装置では、下部ボディ領域が、第１範囲と、第１範囲よりも結晶欠陥密度が高い第２範囲を有している。そして、第２範囲がゲート絶縁膜に接しており、第１範囲が第２範囲に対してゲート絶縁膜と反対側で接している。結晶欠陥は、再結合中心として機能する。したがって、結晶欠陥密度が高い第２範囲では、キャリアのライフタイムが短い。このため、下部ボディ領域の第２範囲に流入した正孔は、第１範囲に流入した正孔よりも短時間で消滅する。その結果、ゲート絶縁膜近傍の下部ボディ領域では、正孔が蓄積され難い。したがって、この半導体装置は、オンするときに、ネガティブキャパシタンス効果によるゲート電圧の変動が生じ難い。
【図面の簡単な説明】
【０００８】
【図１】実施例１の半導体装置１０の上面図。
【図２】図１のＩＩ−ＩＩ線における縦断面図。
【図３】比較例の半導体装置の要部断面図であり、ネガティブキャパシタンス効果を説明するための図。
【図４】実施例１の半導体装置１０及び比較例の半導体装置のターンオン時のゲート電圧を示す図。
【図５】実施例１の半導体装置１０及び比較例の半導体装置のターンオン時の電流値を示す図。
【図６】実施例１の半導体装置１０及び比較例の半導体装置がダイオードと直列に接続された場合に、ダイオードに印加されるサージ電圧を示す図。
【図７】半導体装置１０の製造工程の説明図。
【図８】半導体装置１０の製造工程の説明図。
【図９】実施例２の半導体装置１０ａの図２に対応する縦断面図。
【図１０】実施例２の半導体装置１０ａの製造工程の説明図。
【図１１】実施例３の半導体装置１０ｂの図２に対応する縦断面図。
【図１２】変形例の半導体装置の図２に対応する縦断面図。
【図１３】他の変形例の半導体装置の図１に対応する上面図。
【図１４】他の変形例の半導体装置の図１に対応する上面図。
【図１５】他の変形例の半導体装置の図１に対応する上面図。
【発明を実施するための形態】
【実施例１】
【０００９】
図１及び図２に示すように、実施例１の半導体装置１０は、半導体基板１２と、半導体基板１２の上面１２ａ及び下面１２ｂに形成された電極、絶縁体等を備える。半導体基板１２は、例えば、シリコンによって構成されている。半導体基板１２は、ＩＧＢＴ（Insulated Gate Bipolar Transistor）が形成されているＩＧＢＴ領域１６と、ダイオードが形成されているダイオード領域１８を有する。すなわち、半導体装置１０は、いわゆるＲＣ−ＩＧＢＴ（Reverse Conducting-IGBT）である。図１に示すように、ＩＧＢＴ領域１６とダイオード領域１８は、一方向に沿って交互に繰り返すように配置されている。
【００１０】
図２に示すように、半導体基板１２の上面１２ａには、複数のトレンチ４０が形成されている。各トレンチ４０は、図２の紙面に対して垂直方向に互いに平行に伸びている。ＩＧＢＴ領域１６とダイオード領域１８のそれぞれに、複数のトレンチ４０が形成されている。
【００１１】
ＩＧＢＴ領域１６内の各トレンチ４０の内面は、ゲート絶縁膜４２に覆われている。ＩＧＢＴ領域１６内の各トレンチ４０内には、ゲート電極４４が配置されている。ゲート電極４４は、ゲート絶縁膜４２によって半導体基板１２から絶縁されている。ゲート電極４４の上面は、層間絶縁膜４６に覆われている。
【００１２】
ダイオード領域１８内のトレンチ４０の内面は、絶縁膜５２に覆われている。ダイオード領域１８内の各トレンチ４０内には、制御電極５４が配置されている。制御電極５４は、絶縁膜５２によって半導体基板１２から絶縁されている。制御電極５４の上面は、層間絶縁膜５６に覆われている。制御電極５４の電位は、ゲート電極４４の電位から独立して制御される。
【００１３】
半導体基板１２の上面１２ａには、上部電極６０が形成されている。上部電極６０は、層間絶縁膜４６によってゲート電極４４から絶縁されており、層間絶縁膜５６によって制御電極５４から絶縁されている。半導体基板１２の下面１２ｂには、下部電極６２が形成されている。
【００１４】
ＩＧＢＴ領域１６の内部には、エミッタ領域２０、上部ボディ領域２２、ＩＧＢＴ中間領域２４、下部ボディ領域２６、ドリフト領域２８及びコレクタ領域３０が形成されている。
【００１５】
エミッタ領域２０は、ｎ型領域であり、半導体基板１２の上面１２ａに露出している。エミッタ領域２０は、上部電極６０にオーミック接触している。エミッタ領域２０は、ゲート絶縁膜４２に接している。
【００１６】
上部ボディ領域２２は、ｐ型領域であり、エミッタ領域２０の周囲に配置されている。上部ボディ領域２２は、エミッタ領域２０の下側でゲート絶縁膜４２に接している。上部ボディ領域２２は、ボディコンタクト領域２２ａと低濃度ボディ領域２２ｂを有している。
【００１７】
ボディコンタクト領域２２ａは、高濃度のｐ型不純物を含有するｐ型領域である。ボディコンタクト領域２２ａは、半導体基板１２の上面１２ａに露出している。ボディコンタクト領域２２ａは、上部電極６０にオーミック接触している。ボディコンタクト領域２２ａは、エミッタ領域に隣接している。
【００１８】
低濃度ボディ領域２２ｂは、ボディコンタクト領域２２ａよりもｐ型不純物濃度が低いｐ型領域である。低濃度ボディ領域２２ｂは、エミッタ領域２０とボディコンタクト領域２２ａの下側に形成されている。低濃度ボディ領域２２ｂは、エミッタ領域２０の下側でゲート絶縁膜４２に接している。
【００１９】
ＩＧＢＴ中間領域２４は、ｎ型領域であり、上部ボディ領域２２（すなわち、低濃度ボディ領域２２ｂ）の下側に形成されている。ＩＧＢＴ中間領域２４は、上部ボディ領域２２によってエミッタ領域２０から分離されている。ＩＧＢＴ中間領域２４は、上部ボディ領域２２の下側でゲート絶縁膜４２に接している。
【００２０】
下部ボディ領域２６は、ｐ型領域であり、ＩＧＢＴ中間領域２４の下側に形成されている。下部ボディ領域２６は、ＩＧＢＴ中間領域２４によって上部ボディ領域２２から分離されている。下部ボディ領域２６は、ＩＧＢＴ中間領域２４の下側でゲート絶縁膜４２に接している。下部ボディ領域２６は、低密度結晶欠陥範囲２６ａと高密度結晶欠陥範囲２６ｂを有している。高密度結晶欠陥範囲２６ｂの結晶欠陥密度は、低密度結晶欠陥範囲２６ａの結晶欠陥密度よりも高い。
【００２１】
高密度結晶欠陥範囲２６ｂは、ゲート絶縁膜４２に接する範囲に配置されている。低密度結晶欠陥範囲２６ａは、高密度結晶欠陥範囲２６ｂに対してゲート絶縁膜４２と反対側で接している。すなわち、低密度結晶欠陥範囲２６ａは、２つのトレンチ４０の間で、２つの高密度結晶欠陥範囲２６ｂに挟まれた位置に配置されている。
【００２２】
ドリフト領域２８は、ｎ型領域であり、下部ボディ領域２６の下側に形成されている。ドリフト領域２８は、下部ボディ領域２６によってＩＧＢＴ中間領域２４から分離されている。ドリフト領域２８は、低濃度ドリフト領域２８ａとバッファ領域２８ｂを有している。
【００２３】
低濃度ドリフト領域２８ａは、エミッタ領域２０よりも低濃度のｎ型不純物を含有するｎ型領域である。低濃度ドリフト領域２８ａは、下部ボディ領域２６の下側に形成されている。低濃度ドリフト領域２８ａは、下部ボディ領域２６によってＩＧＢＴ中間領域２４から分離されている。低濃度ドリフト領域２８ａは、下部ボディ領域２６の下側において、トレンチ４０の下端部近傍のゲート絶縁膜４２と接している。
【００２４】
バッファ領域２８ｂは、低濃度ドリフト領域２８ａよりも高濃度のｎ型不純物を含有するｎ型領域である。バッファ領域２８ｂは、低濃度ドリフト領域２８ａの下側に形成されている。
【００２５】
コレクタ領域３０は、高濃度のｐ型不純物を含有するｐ型領域である。コレクタ領域３０は、ドリフト領域２８（すなわち、バッファ領域２８ｂ）の下側に形成されている。コレクタ領域３０は、ドリフト領域２８によって下部ボディ領域２６から分離されている。コレクタ領域３０は、半導体基板１２の下面１２ｂに露出している。コレクタ領域３０は、下部電極６２にオーミック接触している。
【００２６】
ＩＧＢＴ領域１６内には、エミッタ領域２０、上部ボディ領域２２、ＩＧＢＴ中間領域２４、下部ボディ領域２６、ドリフト領域２８、コレクタ領域３０及びゲート電極４４等によって、上部電極６０と下部電極６２の間に接続されたＩＧＢＴが形成されている。半導体装置１０がＩＧＢＴとして動作する場合には、上部電極６０がエミッタ電極であり、下部電極６２がコレクタ電極である。
【００２７】
ダイオード領域１８の内部には、上部アノード領域３２、ダイオード中間領域３４、下部アノード領域３６及びカソード領域３８が形成されている。
【００２８】
上部アノード領域３２は、ｐ型領域であり、半導体基板１２の上面１２ａに露出している。上部アノード領域３２は、絶縁膜５２に接している。上部アノード領域３２は、アノードコンタクト領域３２ａと低濃度アノード領域３２ｂを有している。
【００２９】
アノードコンタクト領域３２ａは、高濃度のｐ型不純物を含有するｐ型領域である。アノードコンタクト領域３２ａは、半導体基板１２の上面１２ａに露出している。アノードコンタクト領域３２ａは、上部電極６０にオーミック接触している。
【００３０】
低濃度アノード領域３２ｂは、アノードコンタクト領域３２ａよりも低濃度のｐ型不純物を含有するｐ型領域である。低濃度アノード領域３２ｂは、アノードコンタクト領域３２ａの下側の領域を含むアノードコンタクト領域３２ａの周囲の領域に形成されている。低濃度アノード領域３２ｂは、絶縁膜５２に接している。低濃度アノード領域３２ｂの一部は、アノードコンタクト領域３２ａに隣接する位置で半導体基板１２の上面１２ａに露出している。
【００３１】
ダイオード中間領域３４は、ｎ型領域であり、上部アノード領域３２（すなわち、低濃度アノード領域３２ｂ）の下側に形成されている。ダイオード中間領域３４は、上部アノード領域３２の下側で絶縁膜５２に接している。ダイオード中間領域３４は、ＩＧＢＴ領域１６内のＩＧＢＴ中間領域２４と略同じ深さに形成されている。
【００３２】
下部アノード領域３６は、ｐ型領域であり、ダイオード中間領域３４の下側に形成されている。下部アノード領域３６は、ダイオード中間領域３４によって上部アノード領域３２から分離されている。下部アノード領域３６は、ダイオード中間領域３４の下側で絶縁膜５２に接している。下部アノード領域３６は、ＩＧＢＴ領域１６内の下部ボディ領域２６と略同じ深さに形成されている。
【００３３】
カソード領域３８は、ドリフト領域２８と繋がっているｎ型領域である。カソード領域３８は、下部アノード領域３６の下側に形成されている。カソード領域３８は、下部アノード領域３６によってダイオード中間領域３４から分離されている。カソード領域３８は、半導体基板１２の下面１２ｂに露出している。カソード領域３８は、下部電極６２にオーミック接触している。カソード領域３８は、低濃度ドリフト領域３８ａと、バッファ領域３８ｂと、カソードコンタクト領域３８ｃを有している。
【００３４】
低濃度ドリフト領域３８ａは、下部アノード領域３６の下側に形成されている。低濃度ドリフト領域３８ａは、下部アノード領域３６によってダイオード中間領域３４から分離されている。低濃度ドリフト領域３８ａは、下部アノード領域３６の下側において、トレンチ４０の下端部近傍の絶縁膜５２と接している。低濃度ドリフト領域３８ａは、ＩＧＢＴ領域１６内の低濃度ドリフト領域２８ａと略同じｎ型不純物濃度を有している。低濃度ドリフト領域３８ａは、ＩＧＢＴ領域１６内の低濃度ドリフト領域２８ａと繋がっている。
【００３５】
バッファ領域３８ｂは、低濃度ドリフト領域３８ａの下側に形成されている。バッファ領域３８ｂは、低濃度ドリフト領域３８ａよりも高濃度のｎ型不純物を含有するｎ型領域である。バッファ領域３８ｂは、ＩＧＢＴ領域１６内のバッファ領域２８ｂと略同じｎ型不純物濃度を有している。バッファ領域３８ｂは、ＩＧＢＴ領域１６内のバッファ領域２８ｂと繋がっている。
【００３６】
カソードコンタクト領域３８ｃは、バッファ領域３８ｂよりも高濃度のｎ型不純物を含有するｎ型領域である。カソードコンタクト領域３８ｃは、バッファ領域３８ｂの下側に形成されている。カソードコンタクト領域３８ｃは、半導体基板１２の下面に露出している。カソードコンタクト領域３８ｃは、下部電極６２にオーミック接触している。カソードコンタクト領域３８ｃは、ＩＧＢＴ領域１６内のコレクタ領域３０に隣接している。
【００３７】
ダイオード領域１８内には、上部アノード領域３２、ダイオード中間領域３４、下部アノード領域３６及びカソード領域３８等によって、上部電極６０と下部電極６２の間に接続されたダイオードが形成されている。半導体装置１０がダイオードとして動作する場合には、上部電極６０がアノード電極であり、下部電極６２がカソード電極である。すなわち、ダイオードは、ＩＧＢＴに対して逆並列に接続されている。
【００３８】
次に、半導体装置１０の動作について説明する。まず、ＩＧＢＴの動作について説明する。下部電極６２が上部電極６０よりも高電位となる電圧が印加された状態において、ゲート電極４４の電位を上昇させる場合を考える。ゲート電極４４の電位が上昇すると、ゲート絶縁膜４２に隣接する範囲の上部ボディ領域２２と下部ボディ領域２６にチャネルが形成される。すると、電子が、上部電極６０から、エミッタ領域２０、上部ボディ領域２２のチャネル、ＩＧＢＴ中間領域２４、下部ボディ領域２６のチャネル、ドリフト領域２８及びコレクタ領域３０を経由して下部電極６２へ向かって流れる。また、正孔が、下部電極６２から、コレクタ領域３０、ドリフト領域２８、下部ボディ領域２６、ＩＧＢＴ中間領域２４及び上部ボディ領域２２を経由して上部電極６０へ向かって流れる。このときに、コレクタ領域３０から上部ボディ領域２２へ向かう正孔の流れが、ＩＧＢＴ中間領域２４によって抑制される。このため、ＩＧＢＴ中間領域２４の下側に位置する下部ボディ領域２６とドリフト領域２８に正孔が蓄積される。このように、半導体装置１０がオンする際には、ドリフト領域２８内の正孔（すなわち、少数キャリア）の濃度が高くなることにより、ドリフト領域２８の抵抗が低下し、半導体装置１０で生じる損失が低減される。
【００３９】
ここで、図３を参照して、ネガティブキャパシタンス効果について説明する。図３は、比較例の半導体装置の構成を示しており、図２におけるＩＧＢＴ領域１６内のトレンチ４０の近傍に対応する図である。図３に示すように、この半導体装置は、トレンチ１４０と、トレンチ１４０の内面を覆うゲート絶縁膜１４２と、トレンチ１４０内に配置されるゲート電極１４４を有している。また、半導体基板１１２が、エミッタ領域１２０と、上部ボディ領域１２２（ボディコンタクト領域１２２ａ及び低濃度ボディ領域１２２ｂ）と、ＩＧＢＴ中間領域１２４と、下部ボディ領域１２６と、ドリフト領域１２８を有している。半導体基板１１２よりも上側の構成は、図示を省略している。この半導体装置では、本実施例の半導体装置１０と異なり、ＩＧＢＴ中間領域１２４のｎ型不純物濃度が略一定である。また、本実施例の半導体装置１０と比較して、ゲート絶縁膜近傍の下部ボディ領域１２６の結晶欠陥密度が低い。
【００４０】
比較例の半導体装置では、ゲート電極１４４の電位が上昇すると、下部電極（図示省略）から供給される正孔Ｈが下部ボディ領域１２６とドリフト領域１２８に蓄積する。このとき、ゲート絶縁膜１４２近傍に蓄積された正孔Ｈによって、ゲート電極１４４内に電子Ｅが引き寄せられる。このとき、正孔Ｈと電子Ｅによって容量Ｃｎｅｇが形成される。このとき形成される容量Ｃｎｅｇには、ゲート−エミッタ間の容量Ｃｇｅとは逆向きの電荷が蓄積されるため、見かけ上のゲート−エミッタ間の容量Ｃｇｅが低下する。このように、ゲート電極１４４内に誘起された電子によって、ゲート−エミッタ間の容量が低下する現象が、ネガティブキャパシタンス効果である。
【００４１】
比較例の半導体装置では、上記のネガティブキャパシタンス効果が生じると、図４の破線２００で示すように、ゲート電極１４４を充電する過程でゲート電圧Ｖｇが急峻に立ち上がる。その結果、図５の破線３００で示すように、半導体装置に大きな電流Ｉｃが流れる。したがって、比較例の半導体装置では、スイッチング損失が増大する。また、ゲート電圧がゲート電極１４４の耐圧を超えてしまい、ゲートリーク電流が増大する場合がある。また、比較例の半導体装置とダイオード（不図示）とが直列に接続される場合（例えば、インバータ）には、半導体装置がオンするとき（すなわち、ダイオードがオンからオフに切り換わり、逆回復電流Ｉａｋが流れるとき）に、図６の破線４００で示すように、当該ダイオードに大きなサージ電圧Ｖａｋが印加される。
【００４２】
一方、本実施例の半導体装置１０では、下部ボディ領域２６が、低密度結晶欠陥範囲２６ａと、低密度結晶欠陥範囲２６ａよりも結晶欠陥密度が高い高密度結晶欠陥範囲２６ｂを有している。そして、高密度結晶欠陥範囲２６ｂは、ゲート絶縁膜４２に接する範囲に配置されている。結晶欠陥は、再結合中心として機能するため、結晶欠陥密度が高い高密度結晶欠陥範囲２６ｂでは、キャリアのライフタイムが短い。このため、コレクタ領域３０から下部ボディ領域２６の高密度結晶欠陥範囲２６ｂに流入した正孔は、短時間で消滅する。その結果、高密度結晶欠陥範囲２６ｂ（すなわち、ゲート絶縁膜４２近傍の下部ボディ領域２６）では、正孔が蓄積され難い。
【００４３】
以上に説明したように、高密度結晶欠陥範囲２６ｂによって、高密度結晶欠陥範囲２６ｂにおける正孔の蓄積が抑制される。したがって、この半導体装置１０では、ネガティブキャパシタンス効果を抑制することができる。
【００４４】
この結果、図４の実線２１０で示すように、ゲート電極４４の電位を上昇させる過程において、ネガティブキャパシタンス効果によるゲート電圧の急峻な立ち上がりを抑制することができる。このため、ゲート電極４４を充電する際に、ゲート電圧が大きく変動することを抑制することができる。この結果、図５の実線３１０で示すように、半導体装置１０に大きな電流が流れることを抑制することができる。さらに、半導体装置１０とダイオード（不図示）とが直列に接続される場合（例えば、インバータ）には、半導体装置１０がオンするとき（すなわち、ダイオードがオンからオフに切り換わり、逆回復電流Ｉａｋが流れるとき）に、図６の実線４１０で示すように、当該ダイオードに大きなサージ電圧Ｖａｋが印加されることを抑制することができる。したがって、この半導体装置１０の信頼性を向上することができる。
【００４５】
その後、ゲート電極４４の電位を低下させると、チャネルが消失し、ＩＧＢＴがオフする。
【００４６】
次に、ダイオードの動作について説明する。ダイオードをオンさせる場合には、上部電極６０が下部電極６２よりも高電位となる電圧を印加する。すると、上部電極６０からアノードコンタクト領域３２ａ、低濃度アノード領域３２ｂ、ダイオード中間領域３４、下部アノード領域３６及びカソード領域３８を経由して、下部電極６２へ向かって電流が流れる。その後、下部電極６２と上部電極６０の間の電圧を逆電圧に切り換えると、ダイオードが逆回復動作を行う。すなわち、ダイオード領域１８内の低濃度ドリフト領域３８ａに蓄積されている正孔が、下部アノード領域３６、ダイオード中間領域３４及び上部アノード領域３２を経由して上部電極６０へ排出される。これにより、ダイオードに逆回復電流が流れる。そして、低濃度ドリフト領域３８ａに蓄積されている正孔が排出されると、ダイオードがオフする。
【００４７】
次に、半導体装置１０の製造方法について説明する。まず、図７に示すように、従来公知の方法により、各トレンチ４０、ＩＧＢＴ領域１６、ダイオード領域１８等を形成した、半導体基板１２を準備する。次いで、図８に示すように、マスク８０（例えば、シリコンマスク）を配置し、荷電粒子（例えば、ヘリウムイオン）を照射する。このとき、ゲート絶縁膜４２近傍の下部ボディ領域２６で荷電粒子が停止するように、荷電粒子の照射エネルギー及びマスク８０の厚さを調整する。また、ゲート絶縁膜４２近傍のみに荷電粒子が注入されるように、荷電粒子の照射範囲を調整する。すなわち、荷電粒子がゲート絶縁膜４２近傍の下部ボディ領域２６の各深さに停止するように、荷電粒子を複数回にわたって選択的に照射する。照射された荷電粒子が停止することによって、高密度の結晶欠陥（すなわち、高密度結晶欠陥範囲２６ｂ）が形成される。なお、下部ボディ領域２６のうち、荷電粒子が照射されなかった範囲が低密度結晶欠陥範囲２６ａとなる。
【００４８】
その後、層間絶縁膜４６、５６、上部電極６０、下部電極６２等を形成することによって、図２に示す半導体装置１０が完成する。
【実施例２】
【００４９】
次に、図９を参照して、実施例２の半導体装置１０ａについて説明する。なお、実施例２の半導体装置１０ａの構成のうち、実施例１の半導体装置１０と共通する構成については、説明を省略する。実施例２の半導体装置１０ａでは、図９に示すように、ドリフト領域２８（詳細には、低濃度ドリフト領域２８ａ）が、低密度結晶欠陥範囲２８ｃと高密度結晶欠陥範囲２８ｄを有している。高密度結晶欠陥範囲２８ｄの結晶欠陥密度は、低密度結晶欠陥範囲２８ｃの結晶欠陥密度よりも高い。
【００５０】
高密度結晶欠陥範囲２８ｄは、下部ボディ領域２６の下側において、トレンチ４０の下端部近傍のゲート絶縁膜４２に接する範囲に配置されている。すなわち、高密度結晶欠陥範囲２８ｄは、トレンチ４０の下端部を覆うように配置されている。低密度結晶欠陥範囲２８ｃは、高密度結晶欠陥範囲２８ｄの周囲に配置されている。本実施例では、低密度結晶欠陥範囲２８ｃは、高密度結晶欠陥範囲２８ｄを除く低濃度ドリフト領域２８ａの全域に配置されている。
【００５１】
本実施例の半導体装置１０ａでは、ドリフト領域２８（すなわち、低濃度ドリフト領域２８ａ）が、低密度結晶欠陥範囲２８ｃと、低密度結晶欠陥範囲２８ｃよりも結晶欠陥密度が高い高密度結晶欠陥範囲２８ｄを有している。このため、ドリフト領域２８の高密度結晶欠陥範囲２８ｄに流入した正孔は、短時間で消滅する。高密度結晶欠陥範囲２８ｄは、ゲート絶縁膜４２に接する範囲に配置されているため、ゲート絶縁膜４２の下端部近傍のドリフト領域２８では、正孔が蓄積され難い。したがって、この半導体装置１０ａでは、ドリフト領域２８に蓄積された正孔によるネガティブキャパシタンス効果を抑制することができ、ネガティブキャパシタンス効果に起因するゲート電極４４の電位の変動がより生じ難い。
【００５２】
なお、ドリフト領域２８の高密度結晶欠陥範囲２８ｄの結晶欠陥密度と、下部ボディ領域２６の高密度結晶欠陥範囲２６ｂの結晶欠陥密度の大小関係は限定されない。高密度結晶欠陥範囲２８ｄの結晶欠陥密度の方が高くてもよいし、高密度結晶欠陥範囲２６ｂの結晶欠陥密度の方が高くてもよいし、両者の結晶欠陥密度が略同じであってもよい。
【００５３】
次に、半導体装置１０ａの製造方法について説明する。半導体装置１０ａは、実施例１の図８に示す結晶欠陥（すなわち、高密度結晶欠陥範囲２６ｂ）を形成した後、図１０に示すように、マスク８０よりも厚いマスク９０（例えば、シリコンマスク）を配置し、荷電粒子（例えば、ヘリウムイオン）を照射する。このとき、ゲート絶縁膜４２下端部近傍のドリフト領域２８（すなわち、低濃度ドリフト領域２８ａ）で荷電粒子が停止するように、荷電粒子の照射エネルギー及びマスク９０の厚さを調整する。また、ゲート絶縁膜４２近傍のみに荷電粒子が注入されるように、荷電粒子の照射範囲を調整する。すなわち、荷電粒子がゲート絶縁膜４２下端部近傍のドリフト領域２８の各深さに停止するように、荷電粒子を複数回にわたって選択的に照射する。照射された荷電粒子が停止することによって、高密度の結晶欠陥（すなわち、高密度結晶欠陥範囲２８ｄ）が形成される。
【００５４】
その後、層間絶縁膜４６、５６、上部電極６０、下部電極６２等を形成することによって、図９に示す半導体装置１０ａが完成する。
【実施例３】
【００５５】
次に、図１１を参照して、実施例３の半導体装置１０ｂについて説明する。なお、実施例３の半導体装置１０ｂの構成のうち、実施例１の半導体装置１０と共通する構成については、説明を省略する。実施例３の半導体装置１０ｂでは、図１１に示すように、ＩＧＢＴ中間領域が、高濃度範囲２４ａと低濃度範囲２４ｂを有している。低濃度範囲２４ｂ内のｎ型不純物濃度は、高濃度範囲２４ａ内のｎ型不純物濃度よりも低い。
【００５６】
低濃度範囲２４ｂは、ゲート絶縁膜４２に接する範囲に配置されている。高濃度範囲２４ａは、低濃度範囲２４ｂに対してゲート絶縁膜４２と反対側で接している。すなわち、高濃度範囲２４ａは、２つのトレンチ４０の間で、２つの低濃度範囲２４ｂに挟まれた位置に配置されている。
【００５７】
本実施例の半導体装置１０ｂでは、ＩＧＢＴ中間領域２４が、高濃度範囲２４ａと、高濃度範囲２４ａよりもｎ型不純物濃度が低い低濃度範囲２４ｂを有している。低濃度範囲２４ｂは、ゲート絶縁膜４２に接する範囲に配置されている。このため、ゲート絶縁膜４２近傍においては、コレクタ領域３０から上部ボディ領域２２へ向かう正孔の流れが抑制され難い。したがって、この半導体装置１０では、ゲート絶縁膜４２近傍の下部ボディ領域２６（すなわち、高密度結晶欠陥範囲２６ｂ）において、より正孔が蓄積され難い。このように、半導体装置１０ｂでは、高密度結晶欠陥範囲２６ｂと低濃度範囲２４ｂによって、高密度結晶欠陥範囲２６ｂにおける正孔の蓄積が抑制される。したがって、この半導体装置１０ｂでは、ネガティブキャパシタンス効果をより抑制することができる。なお、本実施例のＩＧＢＴ中間領域２４の構成は、実施例２の半導体装置１０ａに用いてもよい。
【００５８】
なお、上述した各実施例において、ＩＧＢＴ領域１６内の全てのトレンチ４０の近傍に、高密度結晶欠陥範囲２６ｂ及びドリフト領域２８の高密度結晶欠陥範囲２８ｄが配置されていなくてもよい。すなわち、ＩＧＢＴ領域１６内の一部のトレンチ４０の近傍には、下部ボディ領域２６の高密度結晶欠陥範囲２６ｂ及びドリフト領域２８の高密度結晶欠陥範囲２８ｄが配置されていなくてもよい。
【００５９】
また、上述した実施例２では、低密度結晶欠陥範囲２８ｃは、高密度結晶欠陥範囲２８ｄの周囲に配置されていればよく、低濃度ドリフト領域２８ａ内の高密度結晶欠陥範囲２８ｄ以外の位置に結晶欠陥密度が高い範囲が設けられていてもよい。例えば、図１２に示すように、低濃度ドリフト領域２８ａ及び低濃度ドリフト領域３８ａ内に、結晶欠陥密度が高いライフタイム制御領域５０が形成されていてもよい。ライフタイム制御領域５０は、低濃度ドリフト領域２８ａから低濃度ドリフト領域３８ａに跨って、半導体基板１２の平面方向に層状に分布していてもよい。なお、ライフタイム制御領域５０が形成される深さは、特に限定されない。また、ライフタイム制御領域５０は、他の実施例の半導体装置に設けてもよい。
【００６０】
ＩＧＢＴがオフするときには、ＩＧＢＴがオンしているときにドリフト領域２８内に存在していた正孔が、上部ボディ領域２２を介して上部電極６０へ排出される。これによって、ターンオフ時にＩＧＢＴにテール電流が流れる。テール電流が大きいと、ＩＧＢＴのターンオフ損失が大きくなる。しかしながら、低濃度ドリフト領域２８ａ内にライフタイム制御領域５０が形成されていることにより、ＩＧＢＴがオフするときに、ドリフト領域２８内の正孔がライフタイム制御領域５０内で再結合により消滅する。したがって、上記の構成によると、テール電流を小さくすることができる。このため、ターンオフ損失が小さい。
【００６１】
また、ダイオードをオンからオフに切り換えるときには、ダイオードが逆回復動作を行い、ダイオードに逆回復電流が流れるため、損失が発生する。しかしながら、ダイオード領域１８内の低濃度ドリフト領域３８ａに結晶欠陥密度が高いライフタイム制御領域５０が形成されていることにより、ダイオードが逆回復動作をするときに、低濃度ドリフト領域３８ａ内の正孔の多くがライフタイム制御領域５０内で再結合によって消滅する。このように、上記の構成によると、ダイオードの逆回復動作時における正孔の流れ（すなわち、逆回復電流）が抑制され、損失が低減される。
【００６２】
また、上述した実施例３では、ＩＧＢＴ中間領域２４が、高濃度範囲２４ａ及び低濃度範囲２４ｂを有しており、高濃度範囲２４ａのｎ型不純物濃度が、低濃度範囲２４ｂのｎ型不純物濃度よりも高い構成であった。しかしながら、ＩＧＢＴ中間領域２４のｎ型不純物濃度は、ゲート絶縁膜４２から離れるにつれて徐々に低くなっていてもよい。すなわち、ＩＧＢＴ中間領域２４では、ゲート絶縁膜４２に接する位置のｎ型不純物濃度が最も高く、２つのトレンチ４０の中間位置におけるｎ型不純物濃度が最も低くてもよい。
【００６３】
また、上述した各実施例では、図１に示すように、ＩＧＢＴ領域１６とダイオード領域１８が一方向に沿って交互に繰り返すように配置されていたが、例えば、図１３〜図１５に示すように、ＩＧＢＴ領域１６とダイオード領域１８が他の形状で配置されていてもよい。また、本明細書が開示する技術では、半導体装置は、ダイオード領域１８を有していなくてもよい。
【００６４】
（対応関係）
ＩＧＢＴ中間領域２４が、中間領域の一例である。低密度結晶欠陥範囲２６ａが、第１範囲の一例である。高密度結晶欠陥範囲２６ｂが、第２範囲の一例である。高濃度範囲２４ａが、第３範囲の一例である。低濃度範囲２４ｂが、第４範囲の一例である。低密度結晶欠陥範囲２８ｃが、第５範囲の一例である。高密度結晶欠陥範囲２８ｄが、第６範囲の一例である。
【００６５】
本明細書が開示する技術要素について、以下に列挙する。なお、以下の各技術要素は、それぞれ独立して有用なものである。
【００６６】
本明細書が開示する一例の構成では、中間領域が、第３範囲と、第３範囲よりもｎ型不純物濃度が低い第４範囲を有していてもよい。第４範囲が、ゲート絶縁膜に接しており、第３範囲が、第４範囲に対してゲート絶縁膜と反対側で接していてもよい。
【００６７】
このような構成では、ゲート絶縁膜近傍においては、コレクタ領域から上部ボディ領域へ向かう正孔の流れが抑制され難い。したがって、ゲート絶縁膜近傍の下部ボディ領域において、より正孔が蓄積され難い。したがって、このような構成によれば、オンするときに、ネガティブキャパシタンス効果によるゲート電圧の変動が生じ難い。
【００６８】
本明細書が開示する一例の構成では、ドリフト領域が、第５範囲と、第５範囲よりも結晶欠陥密度が高い第６範囲を有していてもよい。第６範囲が、ゲート絶縁膜に接しており、第５範囲が、第６範囲の周囲に配置されていてもよい。
【００６９】
このような構成では、コレクタ領域からドリフト領域の第６範囲に流入した正孔は、短時間で消滅する。第６範囲は、ゲート絶縁膜に接する範囲に配置されているため、ゲート絶縁膜の下端部近傍のドリフト領域では、正孔が蓄積され難い。したがって、このような構成によれば、オンするときに、ネガティブキャパシタンス効果によるゲート電圧の変動が生じ難い。
【００７０】
本明細書が開示する一例の製造方法では、半導体基板に荷電粒子を注入することによって、第２範囲を形成する工程を備えていてもよい。また、半導体基板に荷電粒子を注入することによって、第６範囲を形成する工程を備えていてもよい。
【００７１】
以上、本発明の具体例を詳細に説明したが、これらは例示に過ぎず、特許請求の範囲を限定するものではない。特許請求の範囲に記載の技術には、以上に例示した具体例を様々に変形、変更したものが含まれる。本明細書または図面に説明した技術要素は、単独であるいは各種の組み合わせによって技術的有用性を発揮するものであり、出願時請求項記載の組み合わせに限定されるものではない。また、本明細書または図面に例示した技術は複数目的を同時に達成するものであり、そのうちの一つの目的を達成すること自体で技術的有用性を持つものである。
【符号の説明】
【００７２】
１０、１０ａ、１０ｂ：半導体装置、１２：半導体基板、１２ａ：上面、１２ｂ：下面、１６：ＩＧＢＴ領域、１８：ダイオード領域、２０：エミッタ領域、２２：上部ボディ領域、２２ａ：ボディコンタクト領域、２２ｂ：低濃度ボディ領域、２４：ＩＧＢＴ中間領域、２４ａ：高濃度範囲、２４ｂ：低濃度範囲、２６：下部ボディ領域、２６ａ：低密度結晶欠陥範囲、２６ｂ：高密度結晶欠陥範囲、２８：ドリフト領域、２８ａ：低濃度ドリフト領域、２８ｂ：バッファ領域、２８ｃ：低密度結晶欠陥範囲、２８ｄ：高密度結晶欠陥範囲、３０：コレクタ領域、３２：上部アノード領域、３４：ダイオード中間領域、３６：下部アノード領域、３８：カソード領域、４０：トレンチ、４２：ゲート絶縁膜、４４：ゲート電極、４６：層間絶縁膜、５０：ライフタイム制御領域、５２：絶縁膜、５４：制御電極、５６：層間絶縁膜、６０：上部電極、６２：下部電極
【図１】
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【図２】
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【図３】
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【図４】
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【図５】
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【図６】
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【図７】
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【図８】
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【図９】
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【図１０】
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【図１１】
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【図１２】
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【図１３】
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【図１４】
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【図１５】
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