(57)【要約】【課題】ダウンロード時のミスを低減させるとともに、メモリー容量を削減してコストダウンを行うことが可能な起動方法、及び上記起動方法を使用した表示装置を提供する。【解決手段】表示パネルを倍速駆動させるか否かを確認する確認手段と、前記表示パネルを通常駆動させる場合は、この通常駆動に対応したプログラムであって、第１のメモリーに記憶された第１のメインプログラムを読み込み、前記表示パネルを倍速駆動させる場合は、この倍速駆動に対応したプログラムであって、第２のメモリーに記憶された第２のメインプログラムを読み込むメインプログラム読み込み手段と、前記読み込まれた第１又は第２のメインプログラムを用いて表示装置の起動を行う起動手段と、を有する。【選択図】図４
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【特許請求の範囲】
【請求項１】
表示パネルの駆動速度を変更可能な表示装置を起動させる起動方法において、
前記表示パネルを倍速駆動させるか否かを確認する確認工程と、
前記表示パネルを通常駆動させる場合は、この通常駆動に対応したプログラムであって、第１のメモリーに記憶された第１のメインプログラムを読み込み、前記表示パネルを倍速駆動させる場合は、この倍速駆動に対応したプログラムであって、第２のメモリーに記憶された第２のメインプログラムを読み込むメインプログラム読み込み工程と、
前記読み込まれた第１又は第２のメインプログラムを用いて表示装置の起動を行う起動工程と、を有することを特徴とする起動方法。
【請求項２】
前記請求項１に記載の起動方法により起動する表示装置。
【請求項３】
当該表示装置の主たる駆動を制御するメイン基板と、
前記倍速駆動にかかる処理を行う倍速駆動制御基板と、を備え、
前記第１のメモリーは、前記第１の基板に実装され、
前記第２のメモリーは、前記倍速駆動制御基板に実装されることを特徴とする請求項２に記載の表示装置。
【請求項４】
前記確認工程では、前記倍速駆動制御基板の有無を確認することで表示パネルを倍速駆動するか否かを判断することを特徴とする請求項３に記載の表示装置。
【請求項５】
表示パネルの駆動速度を変更可能な表示装置において、
当該表示装置の主たる駆動を制御するとともに、第１のメモリーを有するメイン基板と、
前記駆動速度の変更にかかる処理を行うとともに、第２のメモリーを有する倍速駆動制御基板と、を備え、
前記メイン基板は、
前記倍速駆動制御基板の有無を確認することで表示パネルを倍速駆動するか否かを判断する確認手段と、
前記表示パネルを通常駆動させる場合は、この通常駆動に対応したプログラムであって、前記第１のメモリーに記憶された第１のメインプログラムを読み込み、前記表示パネルを倍速駆動させる場合は、この倍速駆動に対応したプログラムであって、前記第２のメモリーに記憶された第２のメインプログラムを読み込むメインプログラム読み込み手段と、
前記読み込まれた第１又は第２のメインプログラムを用いて表示装置の起動を行う起動手段と、を有することを特徴とする表示装置。
【発明の詳細な説明】
【技術分野】
【０００１】
本発明は、テレビジョン受像機の起動方法であって、所定のメインプログラムを読み込み起動を行う起動方法、及び上記起動方法を用いた表示装置に関する。
【背景技術】
【０００２】
近年、映像データーのフレームレートを変更させる倍速駆動により映像を表示する表示装置が知られている。例えば、このような表示装置では、フレームレートが６０Ｈｚで設定された映像データーを、整数倍（例えば、１２０Ｈｚ）で駆動させることで画像の繋がりを滑らかにして画像を向上させる。
【０００３】
また、倍速駆動を実現する表示装置において、映像データーに通常の処理を行なうためのメインプログラムに加えて、この映像データーに対してフレームレートを変更するための新たなプログラムを実装する必要がある。そのため、従来の表示装置においては、通常駆動に対応するメインプログラム（第１のメインプログラムと記載する。）、及び倍速駆動に対応するメインプログラム（第２のメインプログラムと記載する。）を予めメモリーに実装しておき、製品の駆動速度に応じてメインプログラムを使い分けていた。
【０００４】
従来、プログラムは基板に実装された所定のメモリーに記憶され、装置の起動時にはメモリーから直接読み出され、ワークメモリーに一旦展開した後、メインコントローラ等に読み出されて使用されていた（例えば、特許文献１−５参照。）。
【先行技術文献】
【特許文献】
【０００５】
【特許文献１】特開２００９−１３９９９７号公報
【特許文献２】特開２００８−２２５７６３号公報
【特許文献３】特開２００８−１０２７６１号公報
【特許文献４】特開２００６−２０２０８６号公報
【特許文献５】特開２００５−２９３３４１号公報
【発明の概要】
【発明が解決しようとする課題】
【０００６】
上記した第１のメインプログラム及び第２のメインプログラムは、通常は１つのメモリーの所定番地にそれぞれ格納されており、コントローラからの読み出し命令に応じてそれぞれ実行される。しかし、同一メモリーに各メインプログラムが記憶された場合、プログラムをダウンロードする際のミスが発生し易くなる。また、第１及び第２のメインプログラムを１つのメモリーに記憶する場合、メモリーに所定の記憶容量が必要となるため、コストアップになっていた。
【０００７】
本発明は、上記課題にかんがみてなされたもので、ダウンロード時のミスを低減させるとともに、メモリー容量を削減してコストダウンを行うことが可能な起動方法、及び上記起動方法を使用した表示装置の提供を目的とする。
【課題を解決するための手段】
【０００８】
上記課題を解決するために、本発明では、表示パネルの駆動速度を変更可能な表示装置を起動させる起動方法において、前記表示パネルを倍速駆動させるか否かを確認する確認工程と、前記表示パネルを通常駆動させる場合は、この通常駆動に対応したプログラムであって、第１のメモリーに記憶された第１のメインプログラムを読み込み、前記表示パネルを倍速駆動させる場合は、この倍速駆動に対応したプログラムであって、第２のメモリーに記憶された第２のメインプログラムを読み込むメインプログラム読み込み工程と、前記読み込まれた第１又は第２のメインプログラムを用いて表示装置の起動を行う起動工程と、を有する構成としてある。
【０００９】
上記のように構成された発明では、まず、表示装置を起動させる際、確認工程では、この表示装置が表示パネルを倍速駆動させるか否かを確認する。そして、表示パネルを通常駆動させる場合は、メインプログラム読み込み工程ではこの通常駆動に対応したプログラムであって、第１のメモリーに記憶された第１のメインプログラムを読み込む。一方、表示パネルを倍速駆動させる場合は、メインプログラム読み込み工程ではこの倍速駆動に対応したプログラムであって、第２のメモリーに記憶された第２のメインプログラムを読み込む。そして、読み込まれた第１又は第２のメインプログラムを用いて、起動工程では表示装置の起動を行う。
【００１０】
そのため、表示装置の起動時において、表示パネルの起動に応じて、別々のメモリーに記憶された第１又は第２のメインプログラムを読み込むため、同一メモリーに各メインプログラムが記憶されることはなく、プログラムをダウンロードする際のミスを低減することができる。また、第１及び第２のメインプログラムを１つのメモリーに記憶する場合に比べ、各メモリーの記憶容量を少なくすることができ、コストを低減することができる。
【００１１】
また、本発明は、表示装置の起動方法のみならず、当然この起動方法を用いた表示装置にも適用することができる。
【００１２】
そして、上記のような表示装置において、当該表示装置の主たる駆動を制御するメイン基板と、前記倍速駆動にかかる処理を行う倍速駆動制御基板と、を備え、前記第１のメモリーは、前記第１の基板に実装され、前記第２のメモリーは、前記倍速駆動制御基板に実装され構成としてもよい。
上記のように構成された発明では、表示パネルの駆動速度に応じて倍速駆動制御基板を使い分ける表示装置においても本発明を適用することが可能となる。
【００１３】
さらに、確認工程による具体的な処理の一例として、前記確認工程では、前記倍速駆動制御基板の有無を確認することで表示パネルを倍速駆動するか否かを判断する構成としてもよい。
上記のように構成された発明では、倍速駆動制御基板の有無により確認を行う構成とすることで、倍速駆動制御基板が存在しない場合は第２のメインプログラムを読み込まないため、製品の誤組み付けを容易に確認することができる。
【００１４】
また、本発明の他の局面として、表示パネルの駆動速度を変更可能な表示装置において、当該表示装置の主たる駆動を制御するとともに、第１のメモリーを有するメイン基板と、前記駆動速度の変更にかかる処理を行うとともに、第２のメモリーを有する倍速駆動制御基板と、を備え、前記メイン基板は、前記倍速駆動制御基板の有無を確認することで表示パネルを倍速駆動するか否かを判断する確認手段と、前記表示パネルを通常駆動させる場合は、この通常駆動に対応したプログラムであって、前記第１のメモリーに記憶された第１のメインプログラムを読み込み、前記表示パネルを倍速駆動させる場合は、この倍速駆動に対応したプログラムであって、前記第２のメモリーに記憶された第２のメインプログラムを読み込むメインプログラム読み込み手段と、前記読み込まれた第１又は第２のメインプログラムを用いて表示装置の起動を行う起動手段と、を有する構成としてもよい。
【発明の効果】
【００１５】
以上説明したように本発明によれば、ダウンロード時のミスを低減させるとともに、メモリー容量を削減してコストダウンを行うことができる。
また請求項３にかかる発明によれば、倍速駆動制御基板を使い分ける表示装置においても本発明を適用することが可能となる。
そして請求項４にかかる発明によれば、製品の誤組み付けを容易に確認することができる。
【図面の簡単な説明】
【００１６】
【図１】表示装置１００の構成を説明するためのブロック構成図である。
【図２】ＬＣＤパネル７０を６０Ｈｚで駆動する場合の表示装置１００の構成を説明するブロック構成図である。
【図３】メインメモリー９２に記憶される各プログラムを説明するための図である。
【図４】倍速駆動用メモリー８２に記憶される各プログラムを説明するための図である。
【図５】表示装置１００の起動時における処理を説明するためのフローチャートである。
【発明を実施するための形態】
【００１７】
以下、下記の順序に従って本発明の実施形態を説明する。
１．第１の実施形態：
２．第２の実施形態：
３．その他の実施形態：
【００１８】
１．第１の実施形態：
＝＝＝表示装置の構成＝＝＝＝
図１は、表示装置１００の構成を説明するためのブロック構成図である。また、図２は、ＬＣＤパネル７０を６０Ｈｚで駆動する場合の表示装置１００の構成を説明するブロック構成図である。本実施形態にかかる表示装置１００は以下の要部を備えて構成されている。符号９０は、メイン基板であり、入力された映像データーに主たる処理を施す。符号８０は、ＦＲＣ基板（倍速駆動制御用基板）であり、メイン基板９０によって所定の処理が施された映像データーのフレームレートを変換して出力する。符号７０は、ＬＣＤパネルであり、映像データーをもとに映像を出力する。 
【００１９】
上記構成の表示装置１００においては、ＬＣＤパネル７０の駆動速度に応じて各部の使用形態が異なる。即ち、ＬＣＤパネル７０を６０Ｈｚで駆動させる（通常の駆動）場合は、図２に示すようにメイン基板９０をＬＣＤパネル７０に接続させて使用する。一方、ＬＣＤパネル７０を１２０Ｈｚで駆動させる（倍速駆動）場合は、図１に示すように、メイン基板９０とＬＣＤパネル７０との間にＦＲＣ基板８０を介在させて使用する。
【００２０】
メイン基板９０は、表示装置１００を駆動するための以下の要部を備えて構成されている。符号９１は、メインＬＳＩであり、図示しないアンテナで受信されたテレビジョン放送信号からデジタルデーターを復調するフロントエンド部や、フロントエンド部により復調されたデジタルデーターに信号処理を施すバックエンド部を備えて構成されている。また、符号９２は、メインメモリー（第１のメモリー）であり、メインＬＳＩ９１が参照するプログラム及びデーターが記憶されている。
【００２１】
ここで、メインＬＳＩ９１と、メインメモリー９２とはチップセレクト線９３、及びメモリーバス９４により接続され、メインＬＳＩ９１から出力される信号に応じて、メインメモリー９２に記憶されたプログラム及びデーターのアクセスが行われる。
【００２２】
図３は、メインメモリー９２に記憶される各プログラムを説明するための図である。メインメモリー９２は、以下のプログラムを記憶している。ブートプログラム１０は、表示装置１００を構成するハードウェアーや各種プログラムを起動するためのプログラムである。第１のメインプログラム１１は、ＬＣＤパネル７０を６０Ｈｚで駆動する際使用されるプログラムである。確認プログラム１２は、メイン基板９０にＦＲＣ基板８０が接続されているか否かを確認するためのプログラムである。
【００２３】
ＦＲＣ基板８０は、メイン基板９０から出力される映像データーのフレームレートを変倍して出力するための以下の要部を備えて構成されている。符号８１は、倍速駆動用チップであり、メインＬＳＩ９１から出力された映像データー（デジタルデーター）のフレームレートを変倍して出力する。符号８２は、倍速駆動用メモリー（第２のメモリー）であり、ＬＣＤパネル７０を１２０Ｈｚで使用する場合にメインＬＳＩ９１又は倍速駆動用チップ８１が用いるプログラム及びデーターが記憶されている。符号８３は、選択部であり、メインＬＳＩ９１が倍速駆動用メモリー８２を参照する際に用いられる。
【００２４】
ここで、倍速駆動用チップ８１と、倍速駆動用メモリー８２とはチップセレクト線８４、及びメモリーバス８５により接続され、倍速駆動用チップ８１から出力される信号に応じて、倍速駆動用メモリー８２に記憶されたプログラム及びデーターのアクセスが行われる。さらに、ＦＲＣ基板８０とメイン基板９０とは、ＬＶＤＳケーブル、及び制御線６０とで接続されており、ＬＶＤＳケーブルを通じて映像データーの送信を行い、制御線６０を通じて制御信号の送信を行う。
【００２５】
図４は、倍速駆動用メモリー８２に記憶される各プログラムを説明するための図である。倍速駆動用メモリー８２は、以下のプログラムを記憶している。第２のメインプログラム２０は、ＬＣＤパネル７０を１２０Ｈｚで駆動させる際に使用されるプログラムである。フレームレート変換用プログラム２１は、第２のメインプログラムによるＬＣＤパネル７０を駆動させる際に、映像データーのフレームレートを変倍するためのプログラムである。
【００２６】
選択部８３は、倍速駆動用メモリー８２がアクセス対象となるためのセレクト信号を出力するための回路である。選択部８３は、アンド回路により構成され、メインＬＳＩ９１から出力される信号、及び倍速駆動用チップ８１から出力される信号が供に入力されたときのみセレクト信号を倍速駆動用メモリー８２に出力する。
【００２７】
ＬＣＤパネル７０は、メイン基板９０又はＦＲＣ基板８０から出力された映像データー（デジタルデーター）をもとに映像を出力する。ＬＣＤパネル７０は、映像データーをデジタル・アナログ変換するドライバー回路と、複数画素により構成されたパネル部と、パネル部を照射するバックライトと、を備えて構成されている。そのため、ＬＣＤパネル７０に映像データーが入力すると、ドライバー回路は映像データーをデジタル・アナログ変換してパネル部に出力する。また、パネル部の各画素にはＲ，Ｇ，Ｂのフィルムが付着されており、入力されたアナログ信号に応じてバックライトから照射された光の透過率が変化し、映像を出力する。なお、ＬＣＤパネル７０とメイン基板９０（通常駆動の場合）又はＦＲＣ基板８０（倍速駆動の場合）とはＬＶＤＳケーブルを通じて接続されている。
【００２８】
上記構成により、表示装置１００は、映像データーをもとに映像を出力する。また、表示装置１００の主電源が投入されるとメインＬＳＩ８１がメインプログラムを読み込むことで起動を開始する。このとき、表示装置１００は、ＬＣＤパネル７０を６０Ｈｚで駆動させる場合は第１のメインプログラム１１を使用し、ＬＣＤパネル７０を１２０Ｈｚで使用する場合は第２のメインプログラム２０を使用する。また、本実施形態にかかる表示装置１００では、第１のメインプログラム１１をメインメモリー９２に記憶し、第２のメインプログラム２０を倍速駆動用メモリー８２に記憶しており、ＬＣＤパネル７０の駆動速度に応じて参照先のメモリーが異なる。そのため、表示装置１００は、以下の起動方法を採用することで起動時におけるプログラムの参照先の変更に対応している。
【００２９】
＝＝＝表示装置の起動方法＝＝＝
図５は、表示装置１００の起動時における処理を説明するためのフローチャートである。図５に示す起動処理は、例えば、表示装置１００のメイン電源を投入した際、実行される処理であり、メインＬＳＩ９１がメインメモリー９２、又は倍速駆動用メモリー８２に記憶された各プログラムを用いて実行する。
【００３０】
ステップＳ１において、メインＬＳＩ９１は、第１のメインプログラム１１を内部メモリーに読み込む。即ち、電源投入時において、メインＬＳＩ９１はブートプログラム１０を読み込んでおり、このブートプログラム１０に従って、メインメモリー９２に記憶された第１のメインプログラム１１をメインメモリーに読み出す。
【００３１】
ステップＳ２において、メインＬＳＩ９１は、ＦＲＣ基板８０を起動させる。即ち、メインＬＳＩ９１は、ＦＲＣ基板８０を構成するハードウェアー及びソフトフェアーを初期化しＦＲＣ基板８０を起動させる。
【００３２】
ステップＳ３において、倍速駆動用チップ８１は、倍速駆動用メモリー８２に記憶されたフレームレート変換用プログラム２１を内部のメインメモリーに読み出す。なお、ステップＳ２及びＳ３における処理は、ＦＲＣ基板８０がメイン基板９０に接続されている場合に実行される処理である。
【００３３】
ステップＳ４において、メインＬＳＩ９１は、メイン基板９０にＦＲＣ基板８０が接続されているか否かを確認する。その一例として、メイン基板９０がＦＲＣ基板８０に接続されている場合は、メインＬＳＩ９１と倍速駆動用チップ８１は、制御線６０を介して接続されており、メインＬＳＩ９１は、この制御線を通じて倍速駆動用チップ８１に制御信号を出力する。そのため、メインＬＳＩ９１は上記制御信号の出力の有無によりＦＲＣ基板８０が接続されているか否かを判断する。上記、ステップＳ４の処理において、メインＬＳＩ９１は本発明の確認手段を実現する。さらに、ＦＲＣ基板８０の有無により確認を行う構成とすることで、ＦＲＣ基板８０が存在しない場合は第２のメインプログラム２０を読み込まないため、製品の誤組み付けを容易に確認することができる。
【００３４】
倍速駆動を行う場合は（ステップＳ４：ＹＥＳ）、ステップＳ６において、メインＬＳＩ９１は、倍速駆動用メモリー８２から第２のメインプログラム２０を読み込む。即ち、メインＬＳＩ９１は、選択部８３にチップセレクト信号を出力し、メモリーバス８５を通じてリード命令を倍速駆動用メモリー８２に出力し、内部メモリーに第２のメインプログラム２０を読み出す。そして、メインＬＳＩ９１は、第２のメインプログラムに従って、ＬＣＤパネル７０を１２０Ｈｚで駆動するための起動準備を行う（ステップＳ７）。
【００３５】
一方、倍速駆動を行わない場合は（ステップＳ４：ＮＯ）、メインＬＳＩ９１は、ステップＳ１で予め内部メモリーに読み込まれている第１のメインプログラム１１を用いて起動準備を行う（ステップＳ５）。そのため、ステップＳ１及びＳ６において、メインＬＳＩ９１は本発明のメインプログラム読み込み手段を実現する。さらに、ステップＳ５及びＳ７において、メインＬＳＩ９１は本発明の起動手段を実現する。
【００３６】
以上、説明したように、表示装置１００は、ＦＲＣ基板８０の接続の有無に応じて第１のメインプログラム１１又は第２のメインプログラム２０の使用を使い分けるため、第１のメインプログラム１１と第２のメインプログラム２０が別々の基板（メモリー）に実装されている場合でも、最適な起動処理を行なうことができる。さらに、第１及び第２のメインプログラムをそれぞれ分割してメモリーに記憶することができるため、第１及び第２のメインプログラムを同一のメモリーに記憶する場合に比べて、記憶容量の少ないメモリーを使用することができ、コストを低減することが可能となる。
【００３７】
２．第２の実施形態：
第１のメインプログラムと第２のメインプログラムとは、それぞれが別々に機能するプログラムに限定されず、ＬＣＤパネル７０を１２０Ｈｚで駆動する場合において、第１のメインプログラムと第２のメインプログラムを併用するものであってもよい。即ち、第２のメインプログラムは、第１のメインプログラムにオプション的な機能を付与するためのプログラムである場合に、ＬＣＤパネル７０の倍速駆動に、メインＬＳＩ９１に参照されるものであってもよい。
【００３８】
３．その他の実施形態：
本発明は様々な変形例が存在する。
即ち、ＬＣＤパネルを倍速駆動させるフレームレートを１２０Ｈｚとすることは一例であり、これに限定されない。例えば、ＦＲＣ基板８０が映像データーの画質を向上させる機能を備え、この機能のみを実行させて、入力映像データーのフレームレートを６０Ｈｚ（即ち１倍）で出力する場合においても、本発明は有効である。
【００３９】
なお、本発明は上記実施例に限られるものでないことは言うまでもない。当業者であれば言うまでもないことであるが、
・上記実施例の中で開示した相互に置換可能な部材および構成等を適宜その組み合わせを変更して適用すること
・上記実施例の中で開示されていないが、公知技術であって上記実施例の中で開示した部材および構成等と相互に置換可能な部材および構成等を適宜置換し、またその組み合わせを変更して適用すること
・上記実施例の中で開示されていないが、公知技術等に基づいて当業者が上記実施例の中で開示した部材および構成等の代用として想定し得る部材および構成等と適宜置換し、またその組み合わせを変更して適用すること
は本発明の一実施例として開示されるものである。
【符号の説明】
【００４０】
１０…ブートプログラム、１１…第１のメインプログラム、１２…確認プログラム、２０…第２のメインプログラム、２１…フレームレート変換用プログラム、７０…ＬＣＤパネル、８０…ＦＲＣ基板、８１…倍速駆動用チップ、８２…倍速駆動用メモリー、８３…選択部、８４…チップセレクト線、８５…メモリーバス、９０…メイン基板、９１…メインＬＳＩ、９２…メインメモリー、９３…チップセレクト線、９４…メモリーバス、１００…表示装置
【図１】
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【図２】
2011124794.tif 000004
【図３】
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【図４】
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【図５】
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