(57)【要約】 【課題】  ウエハ−プロセスで基板の上に製造された素子単位をチップ分離する際に研磨、切断などの工程を減らすことができ、基板を繰り返し使用できる窒化物半導体デバイス作製方法によって作製したデバイスを提供する。 【解決手段】  閉曲線をなす結晶成長速度の遅い欠陥の集合した欠陥集合領域Ｈと結晶成長速度の速い低欠陥の領域ＺＹの位置が予め決まっている窒化物半導体欠陥位置制御基板Ｓを用い、低欠陥領域ＺＹにデバイスの内部が、欠陥集合領域Ｈに境界線が来るように窒化ガリウム基板の上に窒化物半導体層（上層部Ｂ）をエピタキシャル成長させ、レーザ照射或いは機械的手段で欠陥位置制御基板Ｓと成長層（上層部Ｂ）を上下方向横方向に同時分離し、基板は繰り返し使用する。作製されたデバイスは端面が成長によるファセットで形成されている。 【選択図】  図２７
2011097065.tif 000002
【特許請求の範囲】
【請求項１】
半導体デバイスであるチップの上面にはデバイスを構成するための複数の窒化物半導体層（ＡｌｕｊＩｎｖｊＧａ１−ｕｊ−ｖｊＮ：０≦ｕｊ≦１、０≦ｖｊ≦１、ｕｊ＋ｖｊ≦１）を積層した上層部を有し、チップの周囲の端面が全て結晶成長によるファセットにより形成されたメサ型を有していることを特徴とする窒化物半導体デバイス。
【請求項２】
厚みが１０μｍ〜６００μｍで、水平方向の寸法が０．２ｍｍ〜５０ｍｍであることを特徴とする請求項１に記載の窒化物半導体デバイス。
【請求項３】
閉曲線状に形成された欠陥集合領域Ｈと欠陥集合領域Ｈによって囲まれた低欠陥領域ＺＹを含む窒化物半導体（ＡｌｘＩｎｙＧａ１−ｘ−ｙＮ：０≦ｘ≦１、０≦ｙ≦１、ｘ＋ｙ≦１）欠陥位置制御基板Ｓの上に、デバイスを構成するための複数のし窒化物半導体層（ＡｌｕｊＩｎｖｊＧａ１−ｕｊ−ｖｊＮ：０≦ｕｊ≦１、０≦ｖｊ≦１、ｕｊ＋ｖｊ≦１）を積層て上層部Ｂを形成する工程と、上層部Ｂを欠陥位置制御基板Ｓから上下に分離する工程とを含み、上層部Ｂを該上下分離工程と同時に横方向に欠陥集合領域Ｈに沿って分離して個々のチップに分離し、チップ端面が成長によるファセットで形成されており、メサ型の形状をしており、厚みが１０μｍ〜６００μｍで、水平方向の寸法が０．２ｍｍ〜５０ｍｍであることを特徴とする窒化物半導体デバイス。
【請求項４】
閉曲線状に形成された欠陥集合領域Ｈと欠陥集合領域Ｈによって囲まれた低欠陥領域ＺＹを含む窒化物半導体（ＡｌｘＩｎｙＧａ１−ｘ−ｙＮ：０≦ｘ≦１、０≦ｙ≦１、ｘ＋ｙ≦１）欠陥位置制御基板Ｓの上に、デバイスを構成するための複数の窒化物半導体層（ＡｌｕｊＩｎｖｊＧａ１−ｕｊ−ｖｊＮ：０≦ｕｊ≦１、０≦ｖｊ≦１、ｕｊ＋ｖｊ≦１）を積層して上層部Ｂを形成する工程と、上層部Ｂを欠陥位置制御基板Ｓから上下に分離する工程とを含み、上層部Ｂを該上下分離工程と同時に横方向に欠陥集合領域Ｈに沿って分離して個々のチップに分離し、チップ端面が成長によるファセットで形成されており、厚みが１０μｍ〜６００μｍで、水平方向の寸法が０．２ｍｍ〜５０ｍｍであることを特徴とする窒化物半導体デバイス。
【請求項５】
閉曲線状に形成された欠陥集合領域Ｈ、と欠陥集合領域Ｈによって囲まれた低欠陥領域ＺＹを含む窒化物半導体（ＡｌｘＩｎｙＧａ１−ｘ−ｙＮ：０≦ｘ≦１、０≦ｙ≦１、ｘ＋ｙ≦１）欠陥位置制御基板Ｓの上に、バンドギャップＥｇｑの狭い窒化物半導体の分離層Ｑを成長させ、その上にデバイスを構成するための複数の窒化物半導体層（ＡｌｕｊＩｎｖｊＧａ１−ｕｊ−ｖｊＮ：０≦ｕｊ≦１、０≦ｖｊ≦１、ｕｊ＋ｖｊ≦１）を積層して上層部Ｂとし、分離層ＱのバンドギャップＥｇｑより高く上層部Ｂの層のバンドギャップの最小値Ｅｇｂ（ｍｉｎ｛Ｅｇｊ｝）より低いエネルギーを持つ（Ｅｇｑ＜ｈｃ／λ＜Ｅｇｂ）レ−ザ光を照射することによって分離層Ｑを分解させ上層部Ｂを欠陥位置制御基板Ｓから上下に分離すると同時に横方向に欠陥集合領域Ｈに沿って分離して個々のチップに分離し、チップ端面が成長によるファセットで形成されており、メサ型の形状をしており、厚みが１０μｍ〜６００μｍで、水平方向の寸法が０．２ｍｍ〜５０ｍｍであることを特徴とする窒化物半導体デバイス。
【請求項６】
閉曲線状に形成された欠陥集合領域Ｈと欠陥集合領域Ｈによって囲まれた低欠陥領域ＺＹを含む窒化物半導体（ＡｌｘＩｎｙＧａ１−ｘ−ｙＮ：０≦ｘ≦１、０≦ｙ≦１、ｘ＋ｙ≦１）欠陥位置制御基板Ｓの上に、バンドギャップＥｇｑの狭い窒化物半導体の分離層Ｑを成長させ、その上にデバイスを構成するための複数の窒化物半導体層（ＡｌｕｊＩｎｖｊＧａ１−ｕｊ−ｖｊＮ：０≦ｕｊ≦１、０≦ｖｊ≦１、ｕｊ＋ｖｊ≦１）を積層して上層部Ｂとし、分離層ＱのバンドギャップＥｇｑより高く上層部Ｂの層のバンドギャップの最小値Ｅｇｂ（ｍｉｎ｛Ｅｇｊ｝）より低いエネルギーを持つ（Ｅｇｑ＜ｈｃ／λ＜Ｅｇｂ）レ−ザ光を照射することによって分離層Ｑを分解させ上層部Ｂを欠陥位置制御基板Ｓから上下に分離すると同時に横方向に欠陥集合領域Ｈに沿って分離して個々のチップに分離し、チップ端面が成長によるファセットで形成されており、厚みが１０μｍ〜６００μｍで、水平方向の寸法が０．２ｍｍ〜５０ｍｍであることを特徴とする窒化物半導体デバイス。 
【請求項７】
閉曲線状に形成された欠陥集合領域Ｈと欠陥集合領域Ｈによって囲まれた低欠陥領域ＺＹを含む窒化物半導体（ＡｌｘＩｎｙＧａ１−ｘ−ｙＮ：０≦ｘ≦１、０≦ｙ≦１、ｘ＋ｙ≦１）欠陥位置制御基板Ｓの上に、脆性の窒化物半導体の分離層Ｑを成長させ、その上にデバイスを構成するための複数の窒化物半導体層（ＡｌｕｊＩｎｖｊＧａ１−ｕｊ−ｖｊＮ：０≦ｕｊ≦１、０≦ｖｊ≦１、ｕｊ＋ｖｊ≦１）を積層して上層部Ｂとし、欠陥位置制御基板Ｓと上層部Ｂとにずり又は引っ張り応力を加えて分離層Ｑを破壊して、上層部Ｂを欠陥位置制御基板Ｓから上下に分離すると同時に横方向に欠陥集合領域Ｈに沿って分離して個々のチップに分離し、チップ端面が成長によるファセットで形成されており、メサ型の形状をしており、厚みが１０μｍ〜６００μｍで、水平方向の寸法が０．２ｍｍ〜５０ｍｍであることを特徴とする窒化物半導体デバイス。 
【請求項８】
欠陥集合領域Ｈと低欠陥領域ＺＹを含み欠陥集合領域Ｈが低欠陥領域ＺＹを囲む閉曲線状に形成された窒化物半導体（ＡｌｘＩｎｙＧａ１−ｘ−ｙＮ：０≦ｘ≦１、０≦ｙ≦１、ｘ＋ｙ≦１）欠陥位置制御基板Ｓの上に、欠陥位置制御基板ＳのバンドギャップＥｇｓより小さいバンドギャップＥｇｊを持つデバイスを構成するための複数の窒化物半導体層（ＡｌｕｊＩｎｖｊＧａ１−ｕｊ−ｖｊＮ：０≦ｕｊ≦１、０≦ｖｊ≦１、ｕｊ＋ｖｊ≦１）を積層して上層部Ｂとし、欠陥位置制御基板ＳのバンドギャップＥｇｓより低く上層部Ｂの層のバンドギャップの最小値Ｅｇｂ（ｍｉｎ｛Ｅｇｊ｝）より高いエネルギーを持つ（Ｅｇｑ＜ｈｃ／λ＜Ｅｇｓ）レ−ザ光を照射することによって上層部Ｂの一部を分解させ上層部Ｂを欠陥位置制御基板Ｓから上下に分離すると同時に横方向に欠陥集合領域Ｈに沿って分離して個々のチップに分離し、チップ端面が成長によるファセットで形成されており、厚みが１０μｍ〜６００μｍで、水平方向の寸法が０．２ｍｍ〜５０ｍｍであることを特徴とする窒化物半導体デバイス。
【請求項９】
欠陥集合領域Ｈの上には窒化物系半導体は遅い成長速度で成長し、低欠陥領域ＺＹの上には窒化物系半導体は速い成長速度で成長するものであることを特徴とする請求項３〜８のいずれかに記載の窒化物系半導体デバイス。
【請求項１０】
上層部Ｂの形成に続いて上部電極を形成し、チップ分離した後下部電極だけを形成することを特徴とする請求項３〜８の何れかに記載の窒化物半導体デバイス。 
【請求項１１】
上層部Ｂに引き続いて上部電極を形成せず、チップ分離した後上部電極と下部電極を形成することを特徴とする請求項３〜８の何れかに記載の窒化物半導体デバイス。 
【発明の詳細な説明】
【技術分野】
【０００１】
この発明は少ない工程数で欠陥密度の低い良好な窒化物半導体デバイスを製造する方法とその方法によって製造された窒化物半導体デバイスに関する。 
【背景技術】
【０００２】
特許文献１は窒化物半導体と異なる好ましくは３ｍｍ以上の厚さの下地基板（サファイヤ）の上に０．３μｍ以下のＩｎＧａＮバッファ層と１００μｍ以上の厚みのＧａＮ結晶を成長させ、下地基板を研磨によって除去し、ＧａＮの基板を得、ＧａＮ基板を研磨して平坦にしその上に窒化物半導体の薄膜を積層してＬＤを作製する方法を述べている。 
【０００３】
これはサファイヤ（Ａｌ２Ｏ３）、スピネル（ＭｇＡｌ２Ｏ４）など異種の厚い下地基板の上にバッファ層を介して厚いＧａＮの膜を作り、サファイヤ下地基板を研磨で除去しＧａＮの独立基板を得てから、ＧａＮバッファ層、クラック防止層、ｎ側クラッド層、ｎ側光ガイド層、活性層、ｐ側キャップ層、ｐ側光ガイド層、ｐ側クラッド層、ｐ側コンタクト層などの窒化物半導体薄膜を積層したエピタキシャル基板を作製する。ｐ側の側辺をエッチング除去してリッジ型とし、ｎ側電極、ｐ側電極を形成する。それは多数のデバイスが形成された基板であるから、境界線に沿って機械的手段によって切り出して個々のチップに分離する。これは２回の研磨と一回の機械的素子分離の工程が必要である。 
【０００４】
特許文献２は酸化物基板（サファイヤ）の上にＧａＮの結晶を成長させ、酸化物基板を除去して、ＧａＮの結晶基板を得て、その上にＧａＮの結晶をさらに成長させ十分な厚さのＧａＮ結晶を作りその表面を平滑に研磨してＧａＮのウエハ−を得るというＧａＮ基板の製造方法を述べている。これはサファイヤ基板の除去のための研磨と、ＧａＮ結晶の研磨と２度も研磨しなければならない。こうして得られたＧａＮ基板にｐ型、ｎ型のＩｎＧａＮ、ＡｌＧａＮ、ＧａＮ薄膜を成長させデバイスを作った場合、機械的手段でＧａＮ基板を切りチップ分離して個々別々の素子にしなければならない。次の特許文献３、４は窒化物半導体デバイスの作製手法と直接の関係はない。だから本発明に最も近い先行技術ではない。しかし本発明で重要な役割をするので予め説明する。 
【０００５】
特許文献３は本出願人による窒化ガリウム基板の新規な製造方法を述べている。本発明で重要な役割をする基板を製造する基礎の技術となるので挙げた。図１〜図１０によって説明する。図１のように下地基板（ＧａＡｓ、ＳｉＣ、サファイヤ、スピネル単結晶）ＵＳの上に孤立した点状（ドット状）のマスクＭ（ＳｉＯ２、ＳｉＮ、Ｗ、Ｐｔなど）を付けておく。縦断面図では図７に示すような状態である。その上に窒化ガリウムを気相成長させる。マスクＭ上は成長しにくく成長が遅れ、穴になる。そのようにして図２、図３のようにマスクＭの上にファセットＦよりなる穴（ピット）を作り出す。 
【０００６】
縦断面図では図８のようになる。ファセットＦは６角錐、１２角錐ピットを形成する。ここでは簡単のため６角錐のファセットＦよりなるファセットピットを示す。マスク以外ではピットはできない。図２、図３のように成長条件を調節しマスクＭ上のファセットを維持しながら窒化ガリウム結晶を成長させる。図２、図３は角錐のファセットの方位が違う。下地基板とマスク配置を決めれば図２、３の何れの方位のファセットピットも生成することができる。転位Ｄは成長面と直角に伸びるから内向きに転位Ｄが移動しファセットピット底へ転位Ｄが集中する。ピット底の部分に転位Ｄを捕獲する。縦断面図では図９のような状態になる。マスクＭ上位置にできる転位が集中した部分を欠陥集合領域Ｈと呼ぶ。 
【０００７】
その他の部分は転位が減って低転位の単結晶となる。ファセットＦの直下の部分は低欠陥単結晶領域Ｚとなる。ここは単結晶低転位で伝導度が高い。ファセットで覆いきれないでＣ面が存在しつつ成長したときＣ面の直下に成長した部分はＣ面成長領域Ｙと呼び単結晶低転位で伝導度は低い。マスクＭの上も欠陥集合領域Ｈで覆われる。図４のようなファセットピットが隣接し合うようになって成長を続ける。 
【０００８】
結晶がかなりの厚さになったら上面を研磨してファセットピットを除去し、下地基板を研削、エッチングなどで除去して窒化ガリウムの自立基板を得る。それが図５に示すものである。縦断面図では図１０のようになる。この窒化ガリウム基板は、Ｈ、Ｚ、Ｙよりなる。透明なので肉眼では区別が分からない。ＣＬ（カソードルミネセンス）によって区別が分かる。この成長法はマスクの配列と欠陥集合領域Ｈの配列がドット状なのでドット型と呼びその他のものと区別する。欠陥集合領域Ｈは孤立点であり閉曲線をなさない。 
【０００９】
低欠陥単結晶領域ＺとＣ面成長領域Ｙは何れも低転位の単結晶（共通の結晶方位を持つ）であるから、本発明では両者を含めて低欠陥領域ＺＹということにする。またＣ面成長領域Ｙがない場合は、自立基板として図６に示すような欠陥集合領域Ｈと低欠陥単結晶領域Ｚとのみからなる窒化ガリウム基板を得る。この場合は低欠陥単結晶領域Ｚを低欠陥領域ＺＹということになる。 
【００１０】
特許文献４は本出願人による窒化ガリウム基板の新規な製造方法を述べている。下地基板の上に平行線状（ストライプ状）のマスクＭを付けておき（図１１）その上に窒化ガリウムを気相成長させる。マスクＭの上は成長しにくい。マスクＭの上にファセットＦ、Ｆが対向するファセット溝を作り出しマスクＭ上のファセットＦを維持しながら窒化ガリウム結晶を成長させることによりファセット溝の底へ転位を集中捕獲する。 
【００１１】
図１２にそのような状態を示す。成長が進むとマスクＭの上が転位の集中した結晶によって覆われる。マスク位置にできる転位が集中した部分を欠陥集合領域Ｈと呼ぶ。その他の部分は転位が減って低転位の単結晶となる。平行なファセットＦ、Ｆ直下の部分は低欠陥単結晶領域Ｚと呼び伝導度が高い。ファセットＦで覆いきれないでＣ面が存在しつつ成長したときＣ面の直下に成長した部分はＣ面成長領域Ｙと呼び伝導度は低い。ある程度の厚みになると表面のファセット面を研磨などで平坦にし、下地基板を除去して窒化ガリウムだけの自立基板とする。 
【００１２】
図１３、図１４はそれを示す。図１３はＣ面成長領域Ｙがある場合のものである。図１４はＣ面成長領域Ｙがない場合のものである。ファセットＦの大きさを制御してＣ面成長領域Ｙを発生させたりなくしたりできる。この成長法はマスクの配列と欠陥集合領域Ｈの配列が平行線状なのでストライプ型と呼びその他のものと区別する。欠陥集合領域Ｈは孤立平行線であり開直線である。本発明のように閉曲線をなさない。 
【００１３】
低欠陥単結晶領域ＺとＣ面成長領域Ｙは何れも低転位の単結晶（共通の結晶方位を持つ）であるから、本発明ではＺとＹの両者を含めて低欠陥領域ＺＹということにする。ドット型の欠陥集合領域Ｈは孤立点で閉曲線でない。ストライプ型の欠陥集合領域Ｈも開直線であり閉曲線でない。ドット型もストライプ型も孤立点か開曲線の欠陥集合領域Ｈを持ち本発明を適用する基板にならない。しかし、本発明の基板製造技術の基礎となるので説明した。
【先行技術文献】
【特許文献】
【００１４】
【特許文献１】特開２００２−２６１０１４「窒化物半導体素子の製造方法」
【００１５】
【特許文献２】特開平１１−００１３９９「窒化ガリウム半導体単結晶基板の製造方法並びにその基板を用いた窒化ガリウムダイオード」
【００１６】
【特許文献３】特開２００３−１６５７９９（特願２００１−２８４３２４、特願２００２−２３０９２５）「単結晶窒化ガリウム基板およびその成長方法並びにその製造方法」
【００１７】
【特許文献４】特開２００３−１８３１００（特願２００１ー３１１０１８、特願２００２−２６９３８７）「単結晶窒化ガリウム基板と単結晶窒化ガリウムの結晶成長方法および単結晶窒化ガリウム基板の製造方法」
【発明の概要】
【発明が解決しようとする課題】
【００１８】
研磨、切断などの工程数を減らすことのできる窒化物半導体デバイス作製方法を提供することが本発明の第１の目的である。欠陥密度の低い半導体層を有する窒化物半導体デバイスを与えることが本発明の第２の目的である。繰り返し基板を用いることができて高価な窒化物半導体基板の消費を削減できる窒化物半導体デバイスの製造方法を提供することが本発明の第３の目的である。   
【課題を解決するための手段】
【００１９】
閉曲線をなす結晶成長速度の遅い欠陥の集合した欠陥集合領域Ｈと結晶成長速度の速い低欠陥領域ＺＹの位置が予め決まっている窒化物半導体欠陥位置制御基板Ｓ（ＡｌｘＩｎｙＧａ１ーｘ−ｙＮ：０≦ｘ≦１、０≦ｙ≦１）を用い、低欠陥領域ＺＹにデバイスの内部が、欠陥集合領域Ｈに境界線が来るように窒化ガリウム基板の上に窒化物半導体層（上層部Ｂ）をエピタキシャル成長させ、レーザ照射或いは機械的手段で欠陥位置制御基板Ｓと成長層（上層部Ｂ）を分離する。上層部Ｂの欠陥集合領域Ｈの上に成長した部分は薄いので自然に切れて、個々のチップに分離される。つまり上下分離と水平分離が同時的になされる。欠陥位置制御基板Ｓは繰り返し使用する。「結晶成長速度が速い」或いは「結晶成長速度が遅い」というのはその上に窒化物半導体の薄膜を成長させたときに成長速度が速いとか遅いという意味である。それ自体が成長するときに成長速度が遅いとか速いということではない。 
【００２０】
「結晶成長速度の遅い欠陥の集合した閉曲線をなす欠陥集合領域と結晶成長速度の速い低欠陥の領域の位置が予め決まっている基板」というのは冗長である。だから簡単に「欠陥位置制御基板」と呼び記号Ｓで表すことにする。これは前記の特許文献３、４の呈示した方法によって作られる。欠陥領域というのは欠陥集合領域Ｈに対応し、低欠陥領域というのは低欠陥領域ＺＹに対応する。欠陥位置制御基板Ｓといっても欠陥の集合した領域の位置だけがハッキリしているのではなく欠陥の少ない領域の位置もハッキリしているということである。しかも欠陥集合領域では窒化物半導体結晶（ＧａＮ、ＩｎＧａＮ、ＡｌＧａＮ、ＩｎＮ、ＡｌＮ、ＡｌＩｎＧａＮ）の成長が遅くて、低欠陥領域では窒化物半導体結晶の成長が速いという性質がある。 
【００２１】
さらに欠陥集合領域Ｈが閉曲線（Ｃｌｏｓｅｄ  Ｌｏｏｐ）をなすということが重要である。閉曲線というのは曲線上の任意の一点から出発し曲線に沿って移動する動点が有限の長さを移動したあと必ず元の位置へ帰って来るような曲線をいう。閉曲線の欠陥集合領域Ｈが低欠陥領域ＺＹを囲んでいる。低欠陥領域ＺＹが閉曲線で囲まれ孤立した形状になりデバイスの固有の形状と合致させる。特許文献３、４で欠陥集合領域Ｈは孤立点又は開直線であった。本発明では、欠陥集合領域Ｈが閉曲線でなければならない。下地基板の上に形成するマスクの形状によって欠陥集合領域Ｈをどのような形状にでもできる。欠陥集合領域Ｈを任意の閉曲線にすることもできる。 
【００２２】
欠陥位置制御基板Ｓに対して、その上に成長する多数の層を纏めて「上層部」と呼びＢで表すことにする。上層部Ｂは、デバイスの種類によって異なる構成を持つが、ｎ型、ｐ型のＧａＮ、ＡｌＧａＮ、ＩｎＧａＮの薄膜の積層体である。欠陥位置制御基板Ｓは均一でなく成長の遅い欠陥集合領域Ｈと、成長の速い低欠陥領域ＺＹとからなる。その上に同じ条件で窒化物半導体を成長させると、低欠陥領域ＺＹには十分窒化物半導体結晶が成長するが、欠陥集合領域Ｈの上には殆ど結晶が成長せず殆ど欠陥集合領域Ｈが露呈したまま残る。 
【００２３】
だから上層部Ｂは欠陥位置制御基板Ｓの低欠陥領域ＺＹでは厚く、欠陥集合領域Ｈでは薄い。上層部Ｂはそのように不均一な成長をする。成長速度が場所によって変わるので選択成長ということもできる。そこで成長速度の低い欠陥集合領域Ｈの上にデバイスの境界線を、成長速度の高い低欠陥領域ＺＹにデバイスの内部を対応させる。閉曲線よりなる欠陥集合領域Ｈが素子単位の境界線になる。素子単位がデバイス１個になる。だから上層部は複数のデバイスに当たる積層体を含む。上層部は電極を含む場合もあり、電極を含まない場合もある。 
【００２４】
さらにバンドギャップの狭い結晶からなる分離層Ｑを欠陥位置制御基板Ｓと上層部Ｂの間に設けて分離層Ｑをレーザ照射によって蒸発させチップＣを相互に分離するという手法も可能である。分離層Ｑはバンドギャップが狭くレ−ザ光を当てると分離層Ｑが分解し消失する。そのために欠陥位置制御基板Ｓと上層部Ｂが上下に分離する。 
【００２５】
分離層ＱのバンドギャップをＥｇｑとし、欠陥位置制御基板ＳのバンドギャップをＥｇｓとし、上層部Ｂのｊ番面の層のバンドギャップをＥｇｊとする。レ−ザ光波長λ及び分離層Ｑ、上層部Ｂ、欠陥位置制御基板Ｓに課せられた条件はＥｇｑ＜ｈｃ／λ＜Ｅｇｓ及びＥｇｑ＜ｈｃ／λ＜ｍｉｎ｛Ｅｇｊ｝ということである。ｍｉｎ｛…｝というのは｛…｝の最小値を意味する記号である。以後ｍｉｎ｛Ｅｇｊ｝＝Ｅｇｂと書くこともある。上層部Ｂを構成する半導体層の内、最小のバンドギャップを意味する。ｈはプランク定数、ｃは真空中の光速である。 
【００２６】
半導体、絶縁体はバンドギャップより小さいエネルギーの光を透過し、バンドギャップより大きいエネルギーの光を吸収するから、上の不等式を満たすレ−ザ光を当てると、分離層Ｑがレ−ザ光を吸収して加熱され熱分解し消失する。だから上層部Ｂと欠陥位置制御基板Ｓが上下方向に瞬時に分離する。 
【００２７】
上層部Ｂでは、欠陥集合領域Ｈで成長層が薄く弱いので欠陥集合領域Ｈを境界線として自然にチップ分離できる。 
【００２８】
上層部Ｂの結晶は基板から上下方向に分離すると直ちに相互に横方向分離するのである。だからチップ分離の工程が省かれることになる。これが本発明の最大の利点である。 
【００２９】
欠陥位置制御基板（ＡｌＩｎＧａＮ）Ｓ自体はそのまま分離されて残る。だから欠陥位置制御基板は再び基板として利用できる。つまり欠陥位置制御基板Ｓは上層部Ｂの窒化物半導体の形成によって損なわれないので繰り返し使用できる。これも本発明の大きな利点である。 
【発明の効果】
【００３０】
本発明は、閉曲線をなし成長速度の遅い欠陥集合領域Ｈと成長速度の速い低欠陥領域ＺＹを持ちその位置が予め決まっているような欠陥位置制御基板Ｓの上に、窒化物半導体よりなる上層部Ｂをエピタキシャル成長させ、上層部Ｂの上に電極Ｅを設けるか或いは設けず、レーザ照射によって欠陥位置制御基板Ｓから上層部Ｂを上下分離して同時に上層部ＢをチップＣへ分離するようになっている。 
【００３１】
或いは、閉曲線をなす成長速度の遅い欠陥集合領域Ｈと成長速度の速い低欠陥領域ＺＹを持ちその位置が予め決まっているような欠陥位置制御基板Ｓの上に、分離層Ｑを設け、その上に窒化物半導体よりなる上層部Ｂをエピタキシャル成長させ、上層部Ｂの上に電極Ｅを設けるか或いは設けず、レーザ照射、機械的手段によって分離層Ｑから、欠陥位置制御基板Ｓと上層部Ｂを上下分離して同時に上層部ＢをチップＣへ分離するようになっている。 
【００３２】
チップ分離してから下面の電極をチップ毎に形成する。上面の電極はウエハ−の段階で作製することもあり、チップ分離してから上面電極を作ることもある。 
【００３３】
上層部Ｂを欠陥位置制御基板Ｓから外すと同時に、チップ分離できてしまうので、チップ分離の工程を省くことができる。製造工程を大幅に削減することができるのでコストを削減できる。 
【００３４】
欠陥位置制御基板Ｓは無傷で残る。欠陥位置制御基板Ｓは何度も繰り返し使用することができる。基板Ｓも高価な窒化物半導体であるからそれを繰り返し使用することによるコスト削減の効果は大きい。   
【図面の簡単な説明】
【００３５】
【図１】図１は、特許文献３によって提案された下地基板ＵＳの上に孤立点状のマスクＭを形成しマスクＭの上にファセットピットを形成しファセットＦを維持しながら窒化ガリウム結晶を成長させることによってファセットピット底に欠陥集合領域Ｈを形成しその他の部分を低転位にするファセット成長法において、下地基板ＵＳにドットマスクを形成した状態の下地基板ＵＳの平面図。
【００３６】
【図２】図２は、特許文献３によって提案された下地基板ＵＳの上に孤立点状のマスクＭを形成しマスクＭの上にファセットピットを形成しファセットＦを維持しながら窒化ガリウム結晶を成長させることによってファセットピット底に欠陥集合領域Ｈを形成しその他の部分を低転位にするファセット成長法において、下地基板ＵＳにドットマスクを形成し窒化ガリウムを成長させマスクＭの上にファセットピットを生じさせファセットＦによって転位Ｄをピット底へ集める様子を示す窒化ガリウム結晶の平面図。ファセット稜線がマスクＭを結ぶ正三角形の辺に平行に生じている。
【００３７】
【図３】図３は、特許文献３によって提案された下地基板ＵＳの上に孤立点状のマスクＭを形成しマスクＭの上にファセットピットを形成しファセットＦを維持しながら窒化ガリウム結晶を成長させることによってファセットピット底に欠陥集合領域Ｈを形成しその他の部分を低転位にするファセット成長法において、下地基板ＵＳにドットマスクを形成し窒化ガリウムを成長させマスクＭの上にファセットピットを生じさせファセットＦによって転位Ｄをピット底へ集める様子を示す窒化ガリウム結晶の平面図。ファセット稜線がマスクを結ぶ正三角形の辺に直角に生じている。
【００３８】
【図４】図４は、特許文献３によって提案された下地基板ＵＳの上に孤立点状のマスクＭを形成しマスクＭの上にファセットピットを形成しファセットＦを維持しながら窒化ガリウム結晶を成長させることによってファセットピット底に欠陥集合領域Ｈを形成しその他の部分を低転位にするファセット成長法において、下地基板ＵＳにドットマスクを形成し窒化ガリウムを成長させマスクＭの上にファセットピットを生じさせファセットＦによって転位Ｄをピット底へ集めるようにし深いファセットピットを形成した状態の窒化ガリウム結晶の平面図。
【００３９】
【図５】図５は、特許文献３によって提案された下地基板ＵＳの上に孤立点状のマスクＭを形成しマスクＭの上にファセットピットを形成しファセットＦを維持しながら窒化ガリウム結晶を成長させることによってファセットピット底に欠陥集合領域Ｈを形成しその他の部分を低転位にするファセット成長法によって結晶成長させ下地基板ＵＳを除去し単独の窒化ガリウム基板としたものがマスクＭ上にできた欠陥集合領域ＨとファセットＦの下にできた低欠陥単結晶領域Ｚとファセットの継ぎ目にできたＣ面成長領域Ｙとよりなることを示す窒化ガリウム結晶の平面図。
【００４０】
【図６】図６は、特許文献３によって提案された下地基板ＵＳの上に孤立点状のマスクＭを形成しマスクＭの上にファセットピットを形成しファセットＦを維持しながら窒化ガリウム結晶を成長させることによってファセットピット底に欠陥集合領域Ｈを形成しその他の部分を低転位にするファセット成長法によって結晶成長させ下地基板ＵＳを除去し単独の窒化ガリウム基板としたものがマスクＭ上にできた欠陥集合領域ＨとファセットＦの下にできた低欠陥単結晶領域Ｚとよりなることを示す窒化ガリウム結晶の平面図。
【００４１】
【図７】図７は、特許文献３によって提案された下地基板ＵＳの上に孤立点状のマスクＭを形成しマスクＭの上にファセットピットを形成しファセットＦを維持しながら窒化ガリウム結晶を成長させることによってファセットピット底に欠陥集合領域Ｈを形成しその他の部分を低転位にするファセット成長法において、下地基板ＵＳにドットマスクを形成した状態の下地基板ＵＳの縦断面図。
【００４２】
【図８】図８は、特許文献３によって提案された下地基板ＵＳの上に孤立点状のマスクＭを形成しマスクＭの上にファセットピットを形成しファセットＦを維持しながら窒化ガリウム結晶を成長させることによってファセットピット底に欠陥集合領域Ｈを形成しその他の部分を低転位にするファセット成長法において、下地基板ＵＳにドットマスクを形成し窒化ガリウムを成長させるとマスクＭの上の成長が遅れマスクＭの上にファセットピットを生じファセットＦによって転位Ｄをピット底へ集める様子を示す窒化ガリウム結晶の縦断面図。
【００４３】
【図９】図９は、特許文献３によって提案された下地基板ＵＳの上に孤立点状のマスクＭを形成しマスクＭの上にファセットピットを形成しファセットＦを維持しながら窒化ガリウム結晶を成長させることによってファセットピット底に欠陥集合領域Ｈを形成しその他の部分を低転位にするファセット成長法において、下地基板ＵＳにドットマスクを形成し窒化ガリウムを成長させマスクＭの上にファセットピットを生じさせファセットＦによって転位をピット底へ集めピット底が欠陥集合領域Ｈになりファセットの下が低欠陥単結晶領域Ｚになりファセットの継ぎ目がＣ面成長領域Ｙになる様子を示す窒化ガリウム結晶の平面図。ファセット稜線がマスクＭを結ぶ正三角形の辺に直角に生じている。
【００４４】
【図１０】図１０は、特許文献３によって提案された下地基板ＵＳの上に孤立点状のマスクＭを形成しマスクＭの上にファセットピットを形成しファセットＦを維持しながら窒化ガリウム結晶を成長させることによってファセットピット底に欠陥集合領域Ｈを形成しその他の部分を低転位にするファセット成長法によって結晶成長させ下地基板ＵＳを除去し単独の窒化ガリウム基板としたものがマスクＭ上にできた欠陥集合領域ＨとファセットＦの下にできた低欠陥単結晶領域ＺとファセットＦの継ぎ目にできたＣ面成長領域Ｙとよりなるか或いは、ＨとＺからなることを示す窒化ガリウム結晶の平面図。
【００４５】
【図１１】図１１は、特許文献４によって提案された下地基板ＵＳの上に平行直線状のストライプマスクを形成しマスクＭの上に平行なファセット溝を形成しファセット溝を維持しながら窒化ガリウム結晶を成長させることによってファセット溝底に欠陥集合領域Ｈを形成しその他の部分を低転位にするファセット成長法において、下地基板ＵＳにストライプマスクを形成した状態の下地基板の平面図。
【００４６】
【図１２】図１２は、特許文献４によって提案された下地基板ＵＳの上に平行直線状のストライプマスクを形成しマスクＭの上に平行なファセット溝を形成しファセット溝を維持しながら窒化ガリウム結晶を成長させることによってファセット溝底に欠陥集合領域Ｈを形成しその他の部分を低転位にするファセット成長法において、下地基板ＵＳにストライプマスクを形成し窒化ガリウムを成長させマスクＭの上にファセット溝を生じさせファセットＦによって転位Ｄをファセット溝の底へ集める様子を示す窒化ガリウム結晶の平面図。
【００４７】
【図１３】図１３は、特許文献４によって提案された下地基板ＵＳの上に平行直線状のマスクＭを形成しマスクＭの上に平行なファセット溝を形成しファセットＦを維持しながら窒化ガリウム結晶を成長させることによってファセットピット底に欠陥集合領域Ｈを形成しその他の部分を低転位にするファセット成長法において、下地基板ＵＳを除去し研磨して、ファセット溝底が欠陥集合領域Ｈになりファセット溝の下が低欠陥単結晶領域Ｚになりファセット溝の継ぎ目がＣ面成長領域Ｙになった窒化ガリウム自立基板の平面図。
【００４８】
【図１４】図１４は、特許文献４によって提案された下地基板ＵＳの上に平行直線状のマスクＭを形成しマスクＭの上に平行なファセット溝を形成しファセットＦを維持しながら窒化ガリウム結晶を成長させることによってファセットピット底に欠陥集合領域Ｈを形成しその他の部分を低転位にするファセット成長法において、下地基板ＵＳを除去し研磨して、ファセット溝底が欠陥集合領域Ｈになりファセット溝の下が低欠陥単結晶領域Ｚになった窒化ガリウム自立基板の平面図。
【００４９】
【図１５】図１５は、本発明に必要な閉曲線の欠陥集合領域Ｈを有する欠陥位置制御基板Ｓを製造するため、下地基板ＵＳの上に正方形のマスクＭを付けその上にＡｌＩｎＧａＮ結晶をファセット成長させる直前の状態を示す下地基板ＵＳの平面図。
【００５０】
【図１６】図１６は、下地基板ＵＳの上に正方形のマスクＭを付けその上にＡｌＩｎＧａＮ結晶をファセット成長させ、マスクＭ上に欠陥集合領域Ｈを生成し、マスクＭ以外の部分に低欠陥領域ＺＹを生成することによって製造した本発明に必要な閉曲線（正方形）の欠陥集合領域Ｈを有する欠陥位置制御基板Ｓの平面図。
【００５１】
【図１７】図１７は、本発明に必要な閉曲線の欠陥集合領域Ｈを有する欠陥位置制御基板Ｓを製造するため、下地基板ＵＳの上に正六角形のマスクＭを付けその上にＡｌＩｎＧａＮ結晶をファセット成長させる直前の状態を示す下地基板の平面図。
【００５２】
【図１８】図１８は、下地基板ＵＳの上に正六角形のマスクＭを付けその上にＡｌＩｎＧａＮ結晶をファセット成長させ、マスクＭ上に欠陥集合領域Ｈを生成し、マスクＭ以外の部分に低欠陥領域ＺＹを生成することによって製造した本発明に必要な閉曲線（正六角形）の欠陥集合領域Ｈを有する欠陥位置制御基板Ｓの平面図。
【００５３】
【図１９】図１９は、下地基板ＵＳの上に正三角形のマスクＭを付けその上にＡｌＩｎＧａＮ結晶をファセット成長させ、マスクＭ上に欠陥集合領域Ｈを生成し、マスクＭ以外の部分に低欠陥領域ＺＹを生成することによって製造した本発明に必要な閉曲線（正三角形）の欠陥集合領域Ｈを有する欠陥位置制御基板Ｓの平面図。
【００５４】
【図２０】図２０は、下地基板ＵＳの上に平行四辺形のマスクＭを付けその上にＡｌＩｎＧａＮ結晶をファセット成長させ、マスクＭ上に欠陥集合領域Ｈを生成し、マスクＭ以外の部分に低欠陥領域ＺＹを生成することによって製造した本発明に必要な閉曲線（平行四辺形）の欠陥集合領域Ｈを有する欠陥位置制御基板Ｓの平面図。
【００５５】
【図２１】図２１は、閉曲線の欠陥集合領域Ｈと欠陥集合領域Ｈによって囲まれる低欠陥領域ＺＹとを含む欠陥の位置の予め決められた欠陥位置制御基板Ｓの上に分離層Ｑを成長させると欠陥集合領域Ｈの上には殆ど成長せず低欠陥領域ＺＹの上に成長することを説明するための欠陥位置制御基板Ｓと分離層Ｑの縦断面図。
【００５６】
【図２２】図２２は、閉曲線の欠陥集合領域Ｈと欠陥集合領域Ｈによって囲まれる低欠陥領域ＺＹとを含む欠陥の位置の予め決められた欠陥位置制御基板Ｓの上に分離層Ｑ、上層部Ｂを成長させると欠陥集合領域Ｈの上には殆ど成長せず低欠陥領域ＺＹの上に成長することを説明するための欠陥位置制御基板Ｓと分離層Ｑ、上層部Ｂの縦断面図。
【００５７】
【図２３】図２３は、閉曲線の欠陥集合領域Ｈと欠陥集合領域Ｈによって囲まれる低欠陥領域ＺＹとを含む欠陥の位置の予め決められた欠陥位置制御基板Ｓの上に分離層Ｑ、上層部Ｂを成長させると欠陥集合領域Ｈの上には殆ど成長せず低欠陥領域ＺＹの上に成長し隣接素子単位は横方向分離した状態にある薄膜・基板にレーザ照射或いは機械的手段によって応力を加え上層部Ｂを欠陥位置制御基板Ｓから上下分離した状態の縦断面図。上下分離と同時に横方向分離（チップ分離）する。基板を切断せず、一挙にチップ分離することができる。
【００５８】
【図２４】図２４は、チップ分離された素子の単位毎に上側電極Ｐを形成した状態を示すチップ断面図。
【００５９】
【図２５】図２５は、チップ分離された素子の単位毎に下側電極Ｒを形成した状態を示すチップ縦断面図。
【００６０】
【図２６】図２６は、図２２のように欠陥位置制御基板Ｓの上に上層部Ｂを積層しさらに上部電極Ｐをウエハ−プロセスで形成した状態を示す縦断面図。
【００６１】
【図２７】図２７は、上部電極Ｐを有する上層部Ｂを、機械的手段或いは光学的手段によって、欠陥位置制御基板Ｓから上下分離した状態の縦断面図。基板を切断せず一挙にチップ分離できる。基板は再利用できる。
【００６２】
【図２８】図２８は、分離層Ｑのバンドギャップより高いエネルギー（ｈν）で欠陥位置制御基板Ｓ、上層部Ｂのバンドギャップより低いエネルギー（ｈν）の光を上下何れから窒化物半導体薄膜・基板に照射しても、光は基板Ｓ、上層部Ｂでは吸収されず、分離層Ｑでのみ吸収されることを示す説明図。
【００６３】
【図２９】図２９は、正方形の欠陥集合領域Ｈとそれによって囲まれた低欠陥領域ＺＹよりなる欠陥位置制御基板Ｓの上に分離層Ｑを介し或いは介さずに窒化物半導体を気相成長させ上層部Ｂを形成し、機械的或いは光学的手段で欠陥位置制御基板Ｓから分離された正方形メサ型上層部ＢからなるチップＣの斜視図。
【００６４】
【図３０】図３０は、図２９の正方形メサ型上層部Ｂからなるチップの端面側面を研磨して上下面と直角の端面側面を持つ正方形チップＣにしたものの斜視図。
【００６５】
【図３１】図３１は、正三角形の欠陥集合領域Ｈとそれによって囲まれた低欠陥領域ＺＹよりなる欠陥位置制御基板Ｓの上に分離層Ｑを介し或いは介さずに窒化物半導体を気相成長させ上層部Ｂを形成し、機械的或いは光学的手段で欠陥位置制御基板Ｓから分離された正三角形メサ型上層部ＢからなるチップＣの斜視図。
【００６６】
【図３２】図３２は、図３１の正三角形メサ型上層部ＢからなるチップＣの端面側面を研磨して上下面と直角の端面側面を持つ正三角形チップＣにしたものの斜視図。
【００６７】
【図３３】図３３は、平行四辺形の欠陥集合領域Ｈとそれによって囲まれた低欠陥領域ＺＹよりなる欠陥位置制御基板Ｓの上に分離層Ｑを介し或いは介さずに窒化物半導体を気相成長させ上層部Ｂを形成し、機械的或いは光学的手段で欠陥位置制御基板Ｓから分離された平行四辺形メサ型上層部ＢからなるチップＣの斜視図。
【００６８】
【図３４】図３４は、図３３の平行四辺形メサ型上層部ＢからなるチップＣの端面側面を研磨して上下面と直角の端面側面を持つ平行四辺形チップＣにしたものの斜視図。
【００６９】
【図３５】図３５は、正六角形の欠陥集合領域Ｈとそれによって囲まれた低欠陥領域ＺＹよりなる欠陥位置制御基板Ｓの上に分離層Ｑを介し或いは介さずに窒化物半導体を気相成長させ上層部Ｂを形成し、機械的或いは光学的手段で欠陥位置制御基板Ｓから分離された正六角形メサ型上層部ＢからなるチップＣの斜視図。
【００７０】
【図３６】図３６は、図３５の正六角形メサ型上層部ＢからなるチップＣの端面側面を研磨して上下面と直角の端面側面を持つ正六角形チップＣにしたものの斜視図。
【００７１】
【図３７】図３７は、ＬＥＤ用に形成された上層部Ｂを欠陥位置制御基板Ｓから光学的又は機械的手段でチップ分離し上層部Ｂに上側電極Ｐや下側電極Ｒを取り付けた状態のＬＥＤ素子チップの構造を示す断面図。
【００７２】
【図３８】図３８は、ＨＥＭＴ用に形成された上層部Ｂを欠陥位置制御基板Ｓから光学的又は機械的手段でチップ分離し上層部Ｂに上側電極Ｐや下側電極Ｒを取り付けた状態のＨＥＭＴ素子チップの構造を示す断面図。
【００７３】
【図３９】図３９は、ショットキーダイオード用に形成された上層部Ｂを欠陥位置制御基板Ｓから光学的又は機械的手段でチップ分離し上層部Ｂに上側電極Ｐや下側電極Ｒを取り付けた状態のショットキーダイオード素子チップの構造を示す断面図。
【００７４】
【図４０】図４０は、縦型トランジスタ用に形成された上層部Ｂを欠陥位置制御基板Ｓから光学的または機械的手段でチップ分離し上層部Ｂに上側電極Ｐや下側電極Ｒを取り付けた状態の縦型トランジスタ素子チップの構造を示す断面図。
【発明を実施するための形態】
【００７５】
［１．欠陥位置制御基板Ｓ（図１６、図１８、図１９、図２０）］ 
組成は、ＡｌｘＩｎｙＧａ１−ｘ−ｙＮ（０≦ｘ≦１，０≦ｙ≦１，ｘ＋ｙ≦１）であるが、欠陥集合領域Ｈと低欠陥領域ＺＹの配分された位置が予め決まっているようなＡｌＩｎＧａＮ基板である。それは特許文献３、４において初めて与えられたものである。下地基板ＵＳの上にマスクＭを形成しマスクＭ上で結晶成長が遅れるのでマスクＭ上はファセットピットやファセット溝ができその他の領域の転位をファセット底へ引き寄せるので、マスク上の部分は転位が高密度に集結した欠陥集合領域Ｈとなりその他の部分は低転位の単結晶ＺＹとなる。 
【００７６】
だから本発明は前記の特許文献３、４の基板を出発原料とする。低欠陥領域ＺＹの上には窒化物半導体の成長が速く、欠陥集合領域Ｈでは窒化物半導体の成長が遅い。しかも欠陥集合領域Ｈが閉曲線をなすように設けられる。欠陥集合領域Ｈが閉曲線というのは特許文献３、４にはない。特許文献３のドット型では欠陥集合領域Ｈが孤立点となっており、特許文献４のストライプ型では欠陥集合領域Ｈは平行直線群となる。いずれも閉曲線ではない。 
【００７７】
本発明の出発基板は、特許文献３、４のファセット成長によって欠陥集合領域Ｈと低欠陥領域ＺＹを含むように作られしかも欠陥集合領域Ｈが閉曲線であるということを要件とする。それは欠陥集合領域Ｈに沿って切断したときに素子分が相互に分離できるためである。その閉曲線が素子一単位になる。だから素子一単位分の輪郭になるように欠陥位置制御基板Ｓに欠陥集合領域Ｈを形成するようにすれば良い。欠陥集合領域Ｈが閉曲線でなければならないのはそれがデバイスの外形そのものを決めるからである。マスクＭの上に欠陥集合領域ＨができるのでマスクＭの形状で欠陥集合領域Ｈの形状を自由に決められる。 
【００７８】
特許文献３、４のように欠陥位置制御基板Ｓにおいて欠陥集合領域Ｈや低欠陥領域ＺＹは縦方向に成長し、欠陥集合領域Ｈは、方位が反転した単結晶となっている。そのようになるのは、低欠陥領域ＺＹがＣ面成長し、表面をＧａ面、裏面をＮ面とし、欠陥集合領域Ｈが表面をＮ面、裏面をＧａ面とする場合だけである。つまりマスク付き基板の上にＣ面成長したときだけ、欠陥集合領域Ｈと低欠陥領域ＺＹが形成される。ということは欠陥位置制御基板Ｓは表面がＣ面（一部は−Ｃ面）であるということである。 
【００７９】
六方晶系の結晶にはＣ面以外に代表面としてＭ面（｛１−１００｝）やＡ面（｛１１−２０｝）があり、多くの場合、｛１−１００｝面が劈開面である。しかし｛１−１００｝面或いは｛１１−２０｝の上に、前記のような閉曲線の欠陥集合領域Ｈとそれによって囲まれる低欠陥領域ＺＹを形成できるかどうかは不明である。｛１−１００｝面或いは｛１１−２０｝面を持つ大型の窒化物半導体結晶は未だ作られていない。マスクＭを付けてその上に窒化物半導体を成長させた場合、欠陥集合領域Ｈと低欠陥領域ＺＹのような結晶方位が反転した領域になるかどうか不明である。またその上に窒化物半導体を成長させたときに成長速度の選択性があるかどうかも分からない。現在のところ、欠陥位置制御基板ＳというのはＣ面成長した結晶に限られる。だから劈開面が水平面にならない。従って自然劈開によって上下分離するということはできない。 
【００８０】
窒化物半導体は三方晶系或いは六方晶系のものが多いのでチップＣの輪郭線を劈開に合わせようとするとチップ形状（閉曲線形状）は正方形、正六角形、正三角形、平行四辺形、菱型等の形状となる。その場合は欠陥位置制御基板Ｓにおける欠陥集合領域Ｈは正六角形、正三角形、平行四辺形、菱型等となる。 
【００８１】
しかし本発明は劈開を利用しないでチップ分離する手法であるからチップ輪郭線を劈開面に合わせる必要はない。正方形矩形の輪郭線を持つチップＣとすることもできる。その場合は欠陥集合領域Ｈは正方形矩形となる。正方形、正六角形、正三角形、平行四辺形、菱型等、閉曲線形状の横寸法の最大値は５０ｍｍ、最小値は０．２ｍｍ程度である。 
【００８２】
図１５は下地基板ＵＳの上に正方形の閉曲線を持つマスクＭを形成した下地基板の一部の平面図である。その上に窒化物半導体（ＡｌＩｎＧａＮ）をファセット成長させて適当な厚みにしてファセット部分を研磨して下地基板ＵＳを除去し窒化物半導体（ＡｌＩｎＧａＮ）の自立基板としたものの一部平面図が図１６である。これはマスクＭの上の部分が欠陥集合領域Ｈとなりそれは閉曲線を構成する。閉曲線によって囲まれた部分が単結晶で低転位の低欠陥領域ＺＹとなる。低欠陥領域ＺＹは半導体デバイスの一単位となる。但しＺＹもＨも透明であり肉眼では区別が付かない。ＣＬ（カソードルミネセンス）や蛍光顕微鏡で観察して初めて区別が分かる。 
【００８３】
図１７は下地基板ＵＳの上に正六角形の閉曲線を持つマスクＭを形成した下地基板の一部の平面図である。その上に窒化物半導体（ＡｌＩｎＧａＮ）をファセット成長させて適当な厚みにしてファセット部分を研磨して下地基板ＵＳを除去し窒化物半導体（ＡｌＩｎＧａＮ）の自立基板としたものの一部平面図が図１８である。これはマスクＭの上の部分が欠陥集合領域Ｈとなりそれは閉曲線を構成する。閉曲線によって囲まれた部分が低欠陥領域ＺＹとなる。低欠陥領域ＺＹは半導体デバイスの一単位となる。この基板を使うと正六角形デバイスができる。この場合もＺＹもＨも透明であり肉眼では区別が付かない。ＣＬ（カソードルミネセンス）や蛍光顕微鏡で観察して初めて区別が分かる。 
【００８４】
それ以外にも正三角形、平行四辺形などの欠陥集合領域Ｈを持つ窒化物半導体欠陥位置制御基板Ｓを用いることもできる。図１９は正三角形欠陥集合領域Ｈを持つ欠陥位置制御基板Ｓの例を示す。図１５〜図１８と同じようにマスクＭの上に欠陥集合領域ＨができマスクＭ位置と欠陥集合領域Ｈ位置は１対１に対応する。だからここではマスクＭの図は省略し欠陥位置制御基板Ｓだけを示す。正三角形の欠陥集合領域Ｈが閉曲線をなす。それに囲まれて低転位の単結晶である低欠陥領域ＺＹが存在する。 
【００８５】
図２０は平行四辺形（菱型）の欠陥集合領域Ｈを持つ窒化物半導体欠陥位置制御基板Ｓの一部平面図である。平行四辺形の辺をなすように欠陥集合領域Ｈが存在する。閉曲線の欠陥集合領域Ｈによって囲まれた部分が低欠陥領域ＺＹである。 
【００８６】
欠陥位置制御基板Ｓは前記の特許文献３、４の手法で作ることができる。閉曲線にするというのが新たな要件である。それだけでなく、ここでは欠陥位置制御基板Ｓの特別な性質を利用してデバイス作製を容易にする。 
【００８７】
それはどういう性質であるのか？それは欠陥集合領域Ｈの上に窒化物半導体結晶は成長しにくいが、低欠陥領域ＺＹの上に窒化物半導体結晶は容易に成長する、という性質である。これは特許文献３、４を発明した頃には分からなかった特別の性質である。そもそも欠陥集合領域Ｈの正体は一体何であるのか？というのが特許文献３、４を発明した頃は分からなかった。今は欠陥集合領域Ｈの正体もかなり分かってきている。 
【００８８】
下地基板は三回対称性を持つものを用いる。その上に成長した窒化物半導体はＣ面を上面に持つ。しかしファセット成長させるので成長の途中では平坦なＣ面はあまり存在せず斜めファセット面が殆ど全面を覆っている。成長が終わってファセット面を研磨すると平坦面となる。この平坦面はＣ面であるべきである。低欠陥領域ＺＹでは確かにＣ面である。つまり低欠陥領域ＺＹの上面はＧａ面（Ｃ面）であるし下面はＮ面であるということが分かってきた。 
【００８９】
それは予想通りである。ところが欠陥集合領域Ｈは単結晶であるが、ｃ軸が反転した単結晶であることが分かってきた。つまり欠陥集合領域Ｈの上面はＮ面であり、下面はＧａ面である。欠陥位置制御基板Ｓというのは、Ｇａ面が表面にある低欠陥領域ＺＹと、Ｎ面が表面にある欠陥集合領域Ｈが組合わさってできている。裏面で見るとその反対である。裏面では欠陥集合領域ＨはＧａ面に、低欠陥領域ＺＹはＮ面となっている。 
【００９０】
それだけなら本発明を成立させる要件はまだ存在しないのであるが、その後、欠陥集合領域Ｈの上（Ｎ面）には窒化物半導体が成長しにくく、低欠陥領域ＺＹ（Ｇａ面）の上には窒化物半導体が成長しやすいという成長速度の選択性があることが分かってきた。Ｇａ面とＮ面の成長速度の選択性の発見は全く新規なものである。先に下地基板（ＧａＡｓ、サファイヤ、ＳｉＣ）の上にマスク（ＳｉＯ２、ＳｉＮ、Ｗ、Ｐｔ）を付けた場合にマスクＭの上には窒化ガリウムが成長しにくいということを述べた。だからマスクＭを底とするファセットＦが形成されやすかったのである。それは下地基板ＵＳとマスクＭの間の成長速度の不均一性（選択性）であった。 
【００９１】
本発明がここで新規に発見したのはそうではなく、ファセット成長法で作った窒化物半導体（ＡｌＩｎＧａＮ）基板の、欠陥集合領域Ｈの上で成長速度が遅く、低欠陥領域ＺＹの上で成長速度が速いという成長速度の不均一性である。そのような選択性の発見は新規のものである。ＨとＺＹの繰り返しよりなる窒化物半導体基板自体（欠陥位置制御基板Ｓ）が新規であるからその上に成長する結晶の成長速度の選択性の発見は全く新規なものである。 
【００９２】
本発明はそのような窒化物半導体欠陥位置制御基板ＳのＨとＺＹでの成長速度の選択性をうまく利用する。Ｈ、ＺＹの上の成長速度をＶＨ、ＶＺＹとする。ここでいう選択性というのはＶＨ＜ＶＺＹということである。 
【００９３】
本発明は、欠陥位置制御基板Ｓの上に分離層Ｑを介し上層部Ｂを成長させることもあり、分離層Ｑなしで上層部Ｂを成長させることもある。 
【００９４】
分離層Ｑを成長させても、欠陥集合領域Ｈの上には殆ど成長せず、専ら低欠陥領域ＺＹの上に成長する。その上に上層部Ｂを形成すると、欠陥集合領域Ｈの上には成長せず、低欠陥領域ＺＹの上だけに成長する。それは、欠陥位置制御基板Ｓの成長速度選択性という性質（ＶＨ＜ＶＺＹ）がその上にエピタキシャル成長させた窒化物半導体によって受け継がれるということである。それは欠陥集合領域Ｈが単に欠陥が多いからというのではなくて結晶方位が全く反転しているからである。欠陥集合領域ＨのＮ面の上に成長した分離層Ｑや上層部ＢはやはりＮ面を上面として成長しなければならない。エピタキシャル成長というのはそういうことである。ところがＮ面とＧａ面では選択性があり結晶方位は保持されるから成長層の数や厚みが増えてもそれは不変の性質として維持される。 
【００９５】
理想的には、成長層は低欠陥領域ＺＹだけに載り、欠陥集合領域Ｈの上にはエピタキシャル成長層が載らないということになる。多少欠陥集合領域Ｈの上に結晶が薄く載ってもそれはＫＯＨでエッチングすると簡単に取れてしまう。それによって欠陥集合領域Ｈ上の境界線溝がハッキリする。 
【００９６】
そこでエピタキシャル成長した結晶に、レーザ照射による衝撃や機械的な応力を加えると、上層部Ｂが、欠陥位置制御基板Ｓから簡単に取れる。上下方向の分離とともに横方向にもチップ分離する。そのように本発明は、欠陥位置制御基板ＳのＨとＺＹでの成長速度の違いを有効に利用している。 
【００９７】
図１６、図１８、図１９、図２０などの閉曲線の欠陥集合領域Ｈとそれで囲まれる低欠陥領域ＺＹを含むＡｌＩｎＧａＮ欠陥位置制御基板Ｓを本発明の出発基板として採用できる。 
【００９８】
［２．分離層Ｑ（図２１）］ 
分離層Ｑは欠陥位置制御基板Ｓと上層部Ｂの間にあって上下分離するときに消失或いは破断するものである。欠陥集合領域Ｈの上では成長しにくく低欠陥領域ＺＹの上では成長しやすいという選択性は分離層Ｑに対してもあるので好都合である。図２１には欠陥位置制御基板Ｓの上に分離層Ｑを成長させた状態を示す。低欠陥領域ＺＹの上（ＡｌＩｎＧａ面）には成長するが、欠陥集合領域Ｈの上（Ｎ面）には殆ど成長しない。成長時間や材料の節減のため分離層Ｑは十分に薄いものであることが望ましい。 
【００９９】
分離層Ｑは例えば３ｎｍ〜１０００ｎｍ程度の厚みとする。１０００ｎｍを越えてもよいのであるが材料が無駄である。３ｎｍ以下であるとレ−ザ光を選択的に吸収して分離層Ｑから分離するという訳に行かない。上下分離手段Ｗによって分離層Ｑは省くこともできる。上下分離手段Ｗによって分離層Ｑは異なる。レーザ照射Ｌによって分離する場合はバンドギャップＥｇｑが欠陥位置制御基板ＳのバンドギャップＥｇｓ、上層部Ｂの最小バンドギャップＥｇｂよりも小さいという条件がある。それに加えて、レーザの波長λがこれらバンドギャップの中間のエネルギーを持つという条件が必要である。 
【０１００】
Ｅｇｑ＜ｈｃ／λ＜Ｅｇｓ、Ｅｇｑ＜ｈｃ／λ＜Ｅｇｂ 
【０１０１】
半導体はバンドギャップより小さいエネルギー（ｈｃ／λ）の光を吸収できないが、バンドギャップより大きいエネルギーの光を吸収することができる。図２８はそれを説明する。欠陥位置制御基板Ｓの上に分離層Ｑ、上層部Ｂが成長しているとする。その右側にバンドギャップＥｇを書いている。レーザ光のエネルギーはｈν（ｈはプランク定数、νは波数ν＝ｃ／λ）によって表される。分離層Ｑのバンドギャップはｈνより小さく、上層部Ｂのバンドギャップはばらつきはあるがｈνより大きい。上の不等式のような波長のレ−ザ光は、上層部Ｂ、欠陥位置制御基板Ｓを透過するが、分離層Ｑで全部吸収される。分離層Ｑが急速に加熱され分解されるから分離層Ｑを切断面として上層部Ｂと欠陥位置制御基板Ｓが上下分離する。 
【０１０２】
上の不等式を満たす分離層Ｑの素材として、例えばＩｎＮ層がバンドギャップが小さくてどのようなＢ、Ｓの組み合わせに対しても利用できる。ＩｎＮはあまり用途がないし良い結晶ができないせいもあり長い間バンドギャップがいくらか分からず、２ｅＶとか１．７ｅＶとか言われていた。それが現在は０．７ｅＶ程度らしいということが分かっている。そのためＩｎＮのバンドギャップはＧａＮ、ＡｌＮより低く、それらの混晶であるＡｌＩｎＧａＮのどれよりもバンドギャップが低いものとなる。 
【０１０３】
上下分離手段Ｗが機械的なものである場合は、分離層Ｑは機械的に脆い素材とする。例えばＣ（炭素）、Ｆｅ（鉄）、Ｍｇ（マグネシウム）の何れかをドープしたＧａＮ結晶等を分離層Ｑとする。Ｃ、Ｆｅ、Ｍｇ等をドープしたＧａＮは脆く剥がれやすい結晶を作る。上下の層Ｂ，Ｑに横方向のずり応力を掛けるか、上下の層Ｂ，Ｑを吸着して引っ張り応力を掛ける。それによって上層部Ｂが欠陥位置制御基板Ｓから離れる。 
【０１０４】
［３．上層部Ｂ（図２２）］ 
分離層Ｑの上に上層部Ｂをエピタキシャル成長させる。様々な組成を持つ窒化物半導体層の積層体である。欠陥集合領域Ｈの上には殆ど成長せず、低欠陥領域ＺＹの上にのみ成長する。だから図２２のように、低欠陥領域ＺＹの上に台形（メサ型）の上層部Ｂが成長する。図２２は上面の電極Ｅを形成しない場合である。欠陥集合領域Ｈの上に当たる部分は境界線となる。これが欠陥位置制御基板Ｓの好都合なところである。台形1つがデバイスに対応する。 
【０１０５】
本発明は発光ダイオード、レ−ザダイオードなどの発光素子、整流器、バイポーラトランジスタ、電界効果トランジスタ、ＨＥＭＴ（Ｈｉｇｈ  Ｅｌｅｃｔｒｏｎ  Ｍｏｂｉｌｉｔｙ  Ｔｒａｎｓｉｓｔｏｒ：高電子移動度トランジスタ）などの電子素子、温度センサ、圧力センサ、放射線センサ、可視／紫外光検出器などの半導体センサ、ＳＡＷデバイス（Ｓｕｒｆａｃｅ  Ａｃｏｕｓｔｉｃ  Ｗａｖｅ  Ｄｅｖｉｃｅ）：表面弾性波素子）、振動子、共振器、発振器、ＭＥＭＳ（Ｍｉｃｒｏ  Ｅｌｅｃｔｒｏ  Ｍｅｃｈａｎｉｃａｌ  Ｓｙｓｔｅｍ）部品、圧電アクチュエータ等のデバイス用の基板として広く用いられる。上層部Ｂの構造は窒化物半導体系のデバイスの目的によって異なってくる。本発明において上層部Ｂの構造は多様である。 
【０１０６】
発光素子の場合は、基板部分、バッファ層、クラッド層、活性層、クラッド層、コンタクト層という構造となる。「基板部分」というのは、欠陥位置制御基板の一部ではない。欠陥位置制御基板Ｓは回収して再利用するからデバイスの一部にならない。チップ分離したときに機械的強度を維持するための基幹となる部分が必要である。その部分がここでいう「基板部分」である。後では単にｎ−ＧａＮ基板とか、ｎ−ＧａＮとか書くが、欠陥位置制御基板Ｓの一部と解してはならない。図３７〜図４０に完成したデバイスの縦断面図を示す。上層部Ｂというのは、完成したデバイスから上電極や下電極を除去した層構造の部分である。 
【０１０７】
受光素子の場合は基板部分、バッファ層、受光層、窓層、コンタクト層というようになる。ショットキーダイオードの場合は、基板部分、ｎ型層ということである。ＨＥＭＴの場合は基板部分，ｉ型層、ｉ型層というような構造となる。上層部Ｂを欠陥位置制御基板Ｓから分離した後、ｎ側電極、ｐ側電極を形成する。より具体的に上層部Ｂを述べる。 
【０１０８】
（ＬＥＤの場合：図３７）上から順に 
ｐ型ＧａＮ層６５ 
ｐ型ＡｌＧａＮ層６４ 
ＧａＮ／ＩｎＧａＮ−ＭＱＷ６３  （ＧａＮ／ＩｎＧａＮ）３ 
ＡｌＧａＮ層６２ 
ｎ型ＧａＮ層６０ 
ｎ型ＧａＮ層６０が前記の基板部分に当たる。ここでＭＱＷ６３はＧａＮとＩｎＧａＮの２層を３回積層したものである。 
【０１０９】
（ＨＥＭＴの場合；図３８）上から順に 
ｉ−ＡｌＧａＮ７３ 
ｉ−ＧａＮ７２ 
ＧａＮ基板７０ 
ＧａＮ基板７０が前記の基板部分に当たる。 
【０１１０】
（ショットキーダイオードの場合；図３９）上から順に 
ｎ――ＧａＮ８２ 
ｎ−ＧａＮ基板８０ 
ｎ−ＧａＮ基板８０が前記の基板部分に当たる。 
【０１１１】
（縦型ＭＩＳトランジスタの場合；図４０）
上から順に
ｎ＋型ＧａＮ９５ 
ｐ型ＧａＮ９３ 
ｎ−−ＧａＮ９２ 
ｎ−ＧａＮ基板９０ 
ｎ−ＧａＮ基板９０が前記の基板部分に当たる。 
【０１１２】
［４．上層部Ｂ＋電極Ｅ（図２６）］                   
上層部Ｂはエピタキシャル成長層の積層体であるが、その上に電極Ｅを形成した状態までウエハ−プロセスで行ってから上層部Ｂと欠陥位置制御基板Ｓを分離する場合もある。基板部分がｎ型であれば、上層部Ｂの上の電極はｐ側電極であることが多い。しかし素子構造によっては上面にｐ側、ｎ側電極の両方を設けることもできる。そのようにすれば通常のウエハ−プロセスと同じで電極形成もウエハ−プロセスの中で行うことができる。上層部Ｂは、発光素子の場合は、基板部分、バッファ層、クラッド層、活性層、クラッド層、コンタクト層、電極という構造となる。受光素子の場合は基板部分、バッファ層、受光層、窓層、コンタクト層、電極のような構造になる。ショットキーダイオードの場合は、基板部分、ｎ型層、ショットキー電極ということである。ＨＥＭＴの場合は基板部分、ｉ型層、ｉ型層、電極という構造となる。上層部Ｂを欠陥位置制御基板Ｓから分離した後チップＣの裏面に残りの電極を形成する。 
【０１１３】
（ＬＥＤの場合；図３７）上から順に 
ｐ電極（ニッケルＮｉ）６６ 
ｐ型ＧａＮ層６５ 
ｐ型ＡｌＧａＮ層６４ 
ＧａＮ／ＩｎＧａＮ−ＭＱＷ６３  （ＧａＮ／ＩｎＧａＮ）３ 
ＡｌＧａＮ層６２ 
ｎ型ＧａＮ層６０ 
ここでＭＱＷはＧａＮとＩｎＧａＮの２層を３回積層したものである。 
【０１１４】
（ＨＥＭＴの場合；図３８）上から順に 
ソース電極７４、ドレイン電極（Ｔｉ／Ａｌ／Ｔｉ／Ａｕ）７５、ゲート電極（Ａｕ）７６ 
ｉ−ＡｌＧａＮ７３ 
ｉ−ＧａＮ７２ 
ＧａＮ基板７０ 
【０１１５】
（ショットキーダイオードの場合；図３９）上から順に 
ショトキー電極（Ａｕ）８３ 
ｎ−−ＧａＮ８２ 
ｎ−ＧａＮ基板８０ 
【０１１６】
（縦型ＭＩＳトランジスタの場合；図４０）
上から順に
ソース電極（Ｔｉ／Ａｌ／Ｔｉ／Ａｕ）９７ 
ゲート電極（Ａｕ）９９ 
ｎ＋型ＧａＮ９５ 
ｐ型ＧａＮ９３ 
ｎ−−ＧａＮ９２ 
ｎ−ＧａＮ基板９０ 
【０１１７】
［５．上下水平分離手段（図２３、図２７）］ 
次に上層部Ｂを欠陥位置制御基板Ｓから上下方向に分離する。図２３、図２７にそれを示す。分離層Ｑの部分を破壊して、上層部Ｂと欠陥位置制御基板Ｓを上下に分離する。分離手段について述べる。上層部Ｂは欠陥集合領域Ｈを境界として横方向には予め分離しているから、本発明の場合は上下方向に分離すると同時に横方向にチップ分離する。だから分離手段というのは上下水平方向の分離手段だということになる。レーザ照射による手段と機械的な手段がある。また分離層Ｑを用いる場合と分離層Ｑを用いない場合がある。 
【０１１８】
（５Ａ．分離層Ｑを用いレーザ照射で分離する場合） 
欠陥位置制御基板Ｓと上層部Ｂの間に分離層Ｑを形成する。分離層Ｑの厚みは3nm〜1000nmである。分離層Ｑも欠陥集合領域Ｈの上には成長しにくく低欠陥領域ＺＹの上に成長しやすいという便利な性質がある。レーザ照射によって分離層Ｑだけを分解させるという場合は、分離層Ｑのバンドギャップが半導体層のどれよりも狭いものとし、半導体レーザのエネルギーが分離層Ｑのバンドギャップより大きく、その他の半導体層のどれよりも小さくなるようにする。分離層ＱのバンドギャップをＥｇｑとし、欠陥位置制御基板ＳのバンドギャップをＥｇｓとし、上層部Ｂのｊ番面の層のバンドギャップをＥｇｊとする。レ−ザ光波長λ及び分離層Ｑ、上層部Ｂ、欠陥位置制御基板Ｓに課せられた条件はＥｇｑ＜ｈｃ／λ＜Ｅｇｓ及びＥｇｑ＜ｈｃ／λ＜ｍｉｎ｛Ｅｇｊ｝である。 
【０１１９】
半導体、絶縁体はバンドギャップより小さいエネルギーの光を透過し、バンドギャップより大きいエネルギーの光を吸収する。それは図２８に示す通りである。上の不等式を満たすレ−ザ光を当てると、分離層Ｑがレ−ザ光を吸収して加熱され熱分解し消失する。だから上層部Ｂと欠陥位置制御基板Ｓが上下方向に瞬時に分離する。ＩｎＮ層を例えば分離層Ｑとする。これはＡｌＧａＩｎＮ結晶の中で最もバンドギャップが小さいのでレ−ザ光を選択的に吸収し熱分解する。 
上層部Ｂでは、欠陥集合領域Ｈで成長層が薄く弱いので欠陥集合領域Ｈを境界線として自然にチップ分離できる。上下方向分離と同時に水平方向分離できチップＣが切り放される。分離層Ｑの残留物Ｑ’が欠陥位置制御基板Ｓに残ることもある。それは研磨やエッチング等で除去できる。表面が平坦平滑になった欠陥位置制御基板Ｓは再利用できる。 
【０１２０】
（５Ｂ．分離層Ｑを用い機械的手段で分離する場合） 
欠陥位置制御基板Ｓと上層部Ｂの間に分離層Ｑを形成する。分離層Ｑの厚みは3nm〜1000nmである。機械的手段で分離層Ｑを境界として上層部Ｂと欠陥位置制御基板Ｓを上下に分離する。脆い結晶であることが分離層Ｑに求められる。例えば、炭素Ｃ、マグネシウムＭｇ、鉄ＦｅをドープしたＧａＮ膜を脆性の分離層Ｑとすることができる。欠陥位置制御基板Ｓを固定し上層部Ｂを引上げると脆性の分離層Ｑから分離する。 
【０１２１】
（５Ｃ．分離層Ｑを用いずレーザ照射で分離する場合） 
分離層Ｑを用いないで上下分離することもできる。欠陥位置制御基板Ｓの上に直接に上層部Ｂを形成する。この場合は、犠牲となって破断する部分がないので機械的手段で上下分離するという訳に行かない。だから機械的な分離手段を適用することができない。レーザ照射による光分離だけが可能である。この場合は、レ−ザ光を上層部Ｂが吸収して一部が分解して欠陥位置制御基板Ｓから上下分離するということになる。欠陥位置制御基板ＳのバンドギャップＥｇｓと上層部Ｂのバンドギャップの最小値Ｅｇｂとレーザ波長λはＥｇｂ＜ｈｃ／λ＜Ｅｇｓという不等式を満足しなければならない。 
【０１２２】
［６．上面電極の形成（図２４）］ 
図２３のように上層部Ｂがチップ分離される。その個々のチップＣの上面に上側電極Ｐ、Ｐを形成する。図２４に示す用に上側電極を持つチップができる。これは図２１〜２３に示す用にウエハ−プロセスで上側電極Ｐ、Ｐを形成しなかった場合である。しかし図２６、図２７のように、ウエハ−プロセスで上側電極Ｐ，Ｐを形成することもできる。その場合はチップ分離してからの上側電極Ｐ、Ｐの形成は不要である。 
【０１２３】
［７．下面電極の形成（図２５）］ 
次にチップ毎に上層部Ｂの裏面に下側電極Ｒを形成する。これによってデバイスチップができる。ウエハ−プロセスの過程で下側電極Ｒを形成できないのが本発明の欠点である。しかし図３８のように下側電極Ｒが不要のものもある。 
【０１２４】
［８．チップの形状の整形（図２９〜図３６）］ 
欠陥集合領域Ｈを境界とする成長をした上層部Ｂはメサ型（台形）になることが多い。メサ型でもデバイスとして機能することもある。しかし上下面が同じ大きさの直方体チップが良いという場合もある。その場合はチップ分離してから側面、端面を研磨して側壁を直角に仕上げる。 
【０１２５】
図２９は正方形底面、上面を持つメサ型のチップＣを示す。メサ型であっても良い場合はこのままの形状とする。また図３０のように端面、側面を加工してこれらの面を直角にした直方体のデバイスとすることもできる。図３１はチップ分離した正三角形のメサ型のチップＣである。端面を加工して図３２のような端面が直角の正三角形チップＣとすることもできる。図３３はメサ型の平行四辺形チップＣである。これもそのまま使えるし、図３４のように端面を直角にした平行四辺形のチップＣとすることもできる。図３５はメサ型の正六角形チップＣである。これも加工して図３６のような端面が直角の正六角形チップＣとすることもできる。 
【０１２６】
［９．最終的なデバイスの形状（図３７〜図４０）］ 
メサ型でもいいのであるが、ここでは端面側面を直角にしたデバイスの電極を付けたチップＣの状態を示す。積層構造は欠陥位置制御基板Ｓを含まず上層部Ｂだけからなる。上層部Ｂの厚みは１０μｍ〜６００μｍとする。通常の半導体デバイスのように基板も含むように切り出したものは基板が厚いのでデバイスの積層部の厚みは３００μｍ〜６００μｍ程度ある。しかし本発明は、半導体積層構造は上層部Ｂだけからなるので、上層部Ｂ厚みが１０μｍ〜３００μｍであることも可能である。
【０１２７】
（ＬＥＤの場合；図３７）上から順に 
ｐ電極（ニッケルＮｉ）６６ 
ｐ型ＧａＮ層６５ 
ｐ型ＡｌＧａＮ層６４ 
ＧａＮ／ＩｎＧａＮ−ＭＱＷ６３  （ＧａＮ／ＩｎＧａＮ）３ 
ＡｌＧａＮ層６２ 
ｎ型ＧａＮ層６０ 
ｎ電極（Ｔｉ／Ａｌ／Ｔｉ／Ａｕ）６７ 
【０１２８】
（ＨＥＭＴの場合；図３８）上から順に 
ソース電極７４、ドレイン電極（Ｔｉ／Ａｌ／Ｔｉ／Ａｕ）７５、ゲート電極（Ａｕ）７６ 
ｉ−ＡｌＧａＮ７３ 
ｉ−ＧａＮ７２ 
ＧａＮ層７０ 
【０１２９】
（ショットキーダイオードの場合；図３９）上から順に 
ショトキー電極（Ａｕ）８３ 
ｎ−−ＧａＮ８２ 
ｎ−ＧａＮ基板８０ 
オーミック電極（ｎ電極：Ｔｉ／Ａｌ／Ｔｉ／Ａｕ）８４ 
【０１３０】
（縦型ＭＩＳトランジスタの場合；図４０）
上から順に
ソース電極（Ｔｉ／Ａｌ／Ｔｉ／Ａｕ）９７ 
ゲート電極（Ａｌ）９９ 
ｎ＋型ＧａＮ９５ 
ｐ型ＧａＮ９３ 
ｎ−−ＧａＮ９２ 
ｎ−ＧａＮ基板９０ 
ドレイン電極（Ｔｉ／Ａｌ／Ｔｉ／Ａｕ）９４ 
【符号の説明】
【０１３１】
Ｓ  欠陥位置制御基板 
ＺＹ  低欠陥領域 
Ｈ  欠陥集合領域 
Ｂ  上層部 
Ｃ  チップ 
Ｙ  Ｃ面成長領域 
Ｚ  低欠陥単結晶領域 
Ｑ  分離層 
６０  ｎ型ＧａＮ層 
６２  ＡｌＧａＮ層 
６３  ＭＱＷ 
６４  ｐ型ＡｌＧａＮ層 
６５  ｐ型ＧａＮ層 
６６  ｐ電極 
６７  ｎ電極 
７０  ＧａＮ基板 
７２  ｉ−ＧａＮ 
７３  ｉ−ＡｌＧａＮ 
７４  ソース電極 
７５  ドレイン電極 
７６  ゲート電極 
８０  ｎ−ＧａＮ基板 
８２  ｎ−−ＧａＮ 
８３  ショットキー電極 
８４  オーミック電極 
９０  ｎ−ＧａＮ基板 
９２  ｎ−−ＧａＮ 
９３  ｐ−ＧａＮ 
９４  ドレイン電極 
９５  ｎ＋−ＧａＮ 
９７  ソース電極 
９９  ゲート電極 
【図１】
2011097065.tif 000003
【図２】
2011097065.tif 000004
【図３】
2011097065.tif 000005
【図４】
2011097065.tif 000006
【図５】
2011097065.tif 000007
【図６】
2011097065.tif 000008
【図７】
2011097065.tif 000009
【図８】
2011097065.tif 000010
【図９】
2011097065.tif 000011
【図１０】
2011097065.tif 000012
【図１１】
2011097065.tif 000013
【図１２】
2011097065.tif 000014
【図１３】
2011097065.tif 000015
【図１４】
2011097065.tif 000016
【図１５】
2011097065.tif 000017
【図１６】
2011097065.tif 000018
【図１７】
2011097065.tif 000019
【図１８】
2011097065.tif 000020
【図１９】
2011097065.tif 000021
【図２０】
2011097065.tif 000022
【図２１】
2011097065.tif 000023
【図２２】
2011097065.tif 000024
【図２３】
2011097065.tif 000025
【図２４】
2011097065.tif 000026
【図２５】
2011097065.tif 000027
【図２６】
2011097065.tif 000028
【図２７】
2011097065.tif 000029
【図２８】
2011097065.tif 000030
【図２９】
2011097065.tif 000031
【図３０】
2011097065.tif 000032
【図３１】
2011097065.tif 000033
【図３２】
2011097065.tif 000034
【図３３】
2011097065.tif 000035
【図３４】
2011097065.tif 000036
【図３５】
2011097065.tif 000037
【図３６】
2011097065.tif 000038
【図３７】
2011097065.tif 000039
【図３８】
2011097065.tif 000040
【図３９】
2011097065.tif 000041
【図４０】
2011097065.tif 000042