(57)【要約】【課題】内部短絡を防ぐ表示装置を提供する。また、内部短絡を防ぐ前記表示装置の製造方法を提供する。【解決手段】本発明の実施形態に係る表示装置は、基板１１１と、前記基板上に形成された半導体層１３３と、前記半導体層上に形成された有機絶縁膜１７０と、前記有機絶縁膜上に形成された複数の導電配線１８４，１８５，１８７，１８８，１８９と、前記複数の導電配線の間で前記有機絶縁膜に形成されたオープングルーブ７０８０とを含む。【選択図】図３
2011258918.tif 000002
【特許請求の範囲】
【請求項１】
基板と、
前記基板上に形成された半導体層と、
前記半導体層上に形成された有機絶縁膜と、
前記有機絶縁膜上に形成された複数の導電配線と、
前記複数の導電配線の間で前記有機絶縁膜に形成されたオープングルーブと、
を含む、表示装置。
【請求項２】
前記複数の導電配線は、前記オープングルーブを間において互いに離隔される、請求項１に記載の表示装置。
【請求項３】
前記半導体層上に形成されたゲート電極と、前記ゲート電極と前記半導体層の間に配置されたゲート絶縁膜とをさらに含む、請求項１または２に記載の表示装置。
【請求項４】
前記有機絶縁膜と前記ゲート電極の間に配置された無機絶縁膜をさらに含む、請求項３に記載の表示装置。
【請求項５】
前記オープングルーブは、前記有機絶縁膜と共に前記無機絶縁膜にも形成される、請求項４に記載の表示装置。
【請求項６】
前記無機絶縁膜は、水素を含む窒化シリコン膜を含む、請求項４または５に記載の表示装置。
【請求項７】
前記半導体層は、多結晶シリコン膜をパターニングして形成される、請求項１〜６のいずれか一項に記載の表示装置。
【請求項８】
前記複数の導電配線は、ソース電極およびドレイン電極を含む、請求項１〜７のいずれか一項に記載の表示装置。
【請求項９】
前記半導体層と同じ層に形成された第１キャパシタ電極と、前記ソース電極および前記ドレイン電極と同じ層に形成されて前記複数の導電配線の一部である第２キャパシタ電極とをさらに含む、請求項８に記載の表示装置。
【請求項１０】
前記ドレイン電極と連結した画素電極と、前記画素電極上に形成された有機発光層と、
前記有機発光層上に形成された共通電極と、をさらに含む、請求項８または９に記載の表示装置。
【請求項１１】
前記ゲート電極は、ゲート透明層と前記ゲート透明層上に形成されたゲート金属層を含む二重層で形成され、
前記画素電極は、前記ゲート電極のゲート透明層と同じ層に同じ素材で形成される、請求項１０に記載の表示装置。
【請求項１２】
前記ドレイン電極と連結した画素電極と、前記画素電極上に形成された液晶層と、前記液晶層上に形成された共通電極とをさらに含む、請求項８または９に記載の表示装置。
【請求項１３】
基板を設ける段階と、
前記基板に半導体層を形成する段階と、
前記半導体層上に有機絶縁膜を形成する段階と、
前記有機絶縁膜をパターニングしてオープングルーブを形成する段階と、
前記有機絶縁膜上に複数の導電配線を形成する段階と、
を含み、
前記複数の導電配線は、前記オープングルーブを間において互いに離隔される、表示装置の製造方法。
【請求項１４】
前記半導体層上にゲート絶縁膜を形成する段階と、前記ゲート絶縁膜上にゲート電極を形成する段階とをさらに含み、
前記有機絶縁膜は、前記ゲート電極上に形成される、請求項１３に記載の表示装置の製造方法。
【請求項１５】
前記複数の導電配線は、ソース電極およびドレイン電極を含む、請求項１３または１４に記載の表示装置の製造方法。
【請求項１６】
前記半導体層と同じ層に形成された第１キャパシタ電極と、前記ソース電極および前記ドレイン電極と同じ層に形成されて前記複数の導電配線の一部である第２キャパシタ電極とをさらに含む、請求項１５に記載の表示装置の製造方法。
【請求項１７】
前記ゲート電極と前記有機絶縁膜の間に無機絶縁膜を形成する段階をさらに含む、請求項１４〜１６のいずれか一項に記載の表示装置の製造方法。
【請求項１８】
前記有機絶縁膜、前記無機絶縁膜、および前記ゲート絶縁膜は、共に前記半導体層の一部を露出する複数の接触孔を有し、
前記複数の接触孔は、前記オープングルーブと共に形成される、請求項１７に記載の表示装置の製造方法。
【請求項１９】
前記複数の接触孔と前記オープングルーブは、
前記半導体層上にゲート絶縁膜を形成する段階と、
前記ゲート絶縁膜上に前記無機絶縁膜を形成する段階と、
前記無機絶縁膜上に前記有機絶縁膜を形成する段階と、
ハーフトーン露光を利用したフォトエッチング工程によって、前記複数の接触孔が形成される位置の前記有機絶縁膜と前記無機絶縁膜を除去し、前記オープングルーブが形成される位置の前記有機絶縁膜の一部を除去する段階と、
エッチング工程によって、前記複数の接触孔が形成される位置のゲート絶縁膜を除去して半導体層を露出する段階と、
前記オープングルーブが形成される位置に残存する前記有機絶縁膜の残りの一部を除去する段階と、
によって形成される、請求項１８に記載の表示装置の製造方法。
【請求項２０】
前記オープングルーブは、前記有機絶縁膜と前記無機絶縁膜を共にパターニングして形成される、請求項１７〜１９のいずれか一項に記載の表示装置の製造方法。
【請求項２１】
前記無機絶縁膜は、窒化シリコン膜および酸化シリコン膜のうちの１つ以上を含む、請求項１７〜２０のいずれか一項に記載の表示装置の製造方法。
【請求項２２】
前記無機絶縁膜は、シラン、アンモニア、および水素を用いるプラズマ化学気相蒸着法によって形成される窒化シリコン膜を含む、請求項１７〜２１のいずれか一項に記載の表示装置の製造方法。
【請求項２３】
前記ゲート電極上に前記無機絶縁膜を形成した後、アニーリング工程を進める段階をさらに含む、請求項１７〜２２のうちのいずれか一項に記載の表示装置の製造方法。
【請求項２４】
前記アニーリング工程は、摂氏２５０度以上の温度で熱処理する過程を含む、請求項２３に記載の表示装置の製造方法。
【発明の詳細な説明】
【技術分野】
【０００１】
本発明は表示装置およびその製造方法に関し、より詳細には、性能を向上させて不良の発生を抑制した表示装置およびその製造方法に関する。
【背景技術】
【０００２】
有機発光表示装置（ｏｒｇａｎｉｃ  ｌｉｇｈｔ  ｅｍｉｔｔｉｎｇ  ｄｉｏｄｅ  ｄｉｓｐｌａｙ）および液晶表示装置（ＬＣＤ）などのような大部分の平板型表示装置には、薄膜トランジスタ（ＴＦＴ）と共に有機絶縁膜が用いられる。
【０００３】
有機絶縁膜は、接触孔などの形成、または導電膜をパターニングする過程において様々なエッチング工程で露出される。しかしながら、有機絶縁膜がエッチング工程、特に乾式エッチング工程で露出されれば、表面粗度が急激に増加する。表面粗度が増加した有機絶縁膜上で導電膜を蒸着してパターニングする場合、有機絶縁膜の表面に導電物質が残存し易い。このように、有機絶縁膜の表面に残存する導電物質によって導電配線間が電気的に絶縁されることができず、短絡が発生するという問題がある。
【０００４】
導電配線間の短絡を防止する技術としては、たとえば下記特許文献１の液晶表示装置の製造方法が知られている。
【発明の概要】
【発明が解決しようとする課題】
【０００５】
本発明は、上記問題点を解決するためになされたものであって、本発明の目的は、内部短絡を防ぐ表示装置を提供することにある。
【０００６】
また、本発明の他の目的は、内部短絡を防ぐ前記表示装置の製造方法を提供することにある。
【課題を解決するための手段】
【０００７】
本発明の実施形態によれば、表示装置は、基板と、前記基板上に形成された半導体層と、前記半導体層上に形成された有機絶縁膜と、前記有機絶縁膜上に形成された複数の導電配線と、前記複数の導電配線の間で前記有機絶縁膜に形成されたオープングルーブとを含む。
【０００８】
前記複数の導電配線は、前記オープングルーブを間において互いに離隔してもよい。
【０００９】
前記半導体層上に形成されたゲート電極と、前記ゲート電極と前記半導体層の間に配置されたゲート絶縁膜とをさらに含んでもよい。
【００１０】
前記有機絶縁膜と前記ゲート電極の間に配置された無機絶縁膜をさらに含んでもよい。
【００１１】
前記オープングルーブは前記有機絶縁膜と共に前記無機絶縁膜にも形成されてもよい。
【００１２】
前記無機絶縁膜は、水素を含む窒化シリコン膜を含んでもよい。
【００１３】
前記半導体層は、多結晶シリコン膜をパターニングして形成されてもよい。
【００１４】
前記複数の導電配線は、ソース電極およびドレイン電極を含んでもよい。
【００１５】
前記半導体層と同じ層に形成された第１キャパシタ電極と、前記ソース電極および前記ドレイン電極と同じ層に形成されて前記複数の導電配線の一部である第２キャパシタ電極とをさらに含んでもよい。
【００１６】
前記表示装置は、前記ドレイン電極と連結した画素電極と、前記画素電極上に形成された有機発光層と、前記有機発光層上に形成された共通電極とをさらに含んでもよい。
【００１７】
前記ゲート電極は、ゲート透明層と前記ゲート透明層上に形成されたゲート金属層を含む二重層で形成されてもよい。また、前記画素電極は、前記ゲート電極のゲート透明層と同じ層に同じ素材で形成されてもよい。
【００１８】
また、前記表示装置は、前記ドレイン電極と連結した画素電極と、前記画素電極上に形成された液晶層と、前記液晶層上に形成された共通電極とをさらに含んでもよい。
【００１９】
また、本発明の実施形態によれば、表示装置の製造方法は、基板を設ける段階と、前記基板に半導体層を形成する段階と、前記半導体層上に有機絶縁膜を形成する段階と、前記有機絶縁膜をパターニングしてオープングルーブを形成する段階と、前記有機絶縁膜上に複数の導電配線を形成する段階とを含む。また、前記複数の導電配線は、前記オープングルーブを間において互いに離隔する。
【００２０】
前記半導体層上にゲート絶縁膜を形成する段階と、前記ゲート絶縁膜上にゲート電極を形成する段階とをさらに含み、前記有機絶縁膜は前記ゲート電極上に形成されてもよい。
【００２１】
前記複数の導電配線はソース電極およびドレイン電極を含んでもよい。
【００２２】
前記半導体層と同じ層に形成された第１キャパシタ電極と、前記ソース電極および前記ドレイン電極と同じ層に形成されて前記複数の導電配線の一部である第２キャパシタ電極とをさらに含んでもよい。
【００２３】
前記ゲート電極と前記有機絶縁膜の間に無機絶縁膜を形成する段階をさらに含んでもよい。
【００２４】
前記有機絶縁膜、前記無機絶縁膜、および前記ゲート絶縁膜は共に前記半導体層の一部を露出する複数の接触孔を有し、前記複数の接触孔は前記オープングルーブと共に形成されてもよい。
【００２５】
前記複数の接触孔と前記オープングルーブは、前記半導体層上にゲート絶縁膜を形成する段階と、前記ゲート絶縁膜上に前記無機絶縁膜を形成する段階と、前記無機絶縁膜上に前記有機絶縁膜を形成する段階と、ハーフトーン露光を利用したフォトエッチング工程によって前記複数の接触孔が形成される位置の前記有機絶縁膜と前記無機絶縁膜を除去し、前記オープングルーブが形成される位置の前記有機絶縁膜の一部を除去する段階と、エッチング工程によって前記複数の接触孔が形成される位置のゲート絶縁膜を除去して半導体層を露出する段階と、前記オープングルーブが形成される位置に残存する前記有機絶縁膜の残りの一部を除去する段階とによって形成されてもよい。
【００２６】
前記オープングルーブは、前記有機絶縁膜と前記無機絶縁膜を共にパターニングして形成されてもよい。
【００２７】
前記無機絶縁膜は、窒化シリコン膜および酸化シリコン膜のうちの１つ以上を含んでもよい。
【００２８】
前記無機絶縁膜は、シラン、アンモニア、および水素を用いるプラズマ化学気相蒸着法によって形成される窒化シリコン膜を含んでもよい。
【００２９】
前記表示装置の製造方法は、前記ゲート電極上に前記無機絶縁膜を形成した後、アニーリング工程を進行する段階をさらに含んでもよい。
【００３０】
前記アニーリング工程は、摂氏２５０度以上の温度で熱処理する過程を含んでもよい。
【発明の効果】
【００３１】
本発明の表示装置によれば、内部短絡を防ぐことができる。
【００３２】
また、表示装置に用いられる薄膜トランジスタの半導体層を効果的にアニーリングすることができる。
【００３３】
さらに、本発明の表示装置製造方法によれば、内部短絡を防ぐ前記表示装置を効果的に製造することができる。
【図面の簡単な説明】
【００３４】
【図１】本発明の第１実施形態に係る表示装置の構造を概略的に示す平面図である。
【図２】図１の表示装置が有する一画素領域を示す配置図である。
【図３】図２の薄膜トランジスタ、キャパシタ、および有機発光素子を中心に拡大して示す部分断面図である。
【図４】図２の表示装置の製造過程を順に示す断面図である。
【図５】図４に後続する断面図である。
【図６】図５に後続する断面図である。
【図７】図６に後続する断面図である。
【図８】図７に後続する断面図である。
【図９】図２の表示装置の製造過程を順に示す断面図である。
【図１０】本発明の第２実施形態に係る表示装置の構造を示す部分断面図である。
【図１１】本発明の第２実施形態に係る表示装置の構造を示す部分断面図である。
【発明を実施するための形態】
【００３５】
以下、添付の図面を参照しながら、本発明の様々な実施形態について、本発明が属する技術分野において通常の知識を有する者が容易に実施できるように詳しく説明する。本発明は様々に相違した形態で実現することができ、ここで説明する実施形態に限定されることはない。
【００３６】
また、明細書全体に渡って同一または類似した構成要素については同一する参照符号を付与する。さらに、様々な実施形態において、第１実施形態以外の実施形態では第１実施形態とは異なる構成を中心に説明する。
【００３７】
また、図面に示す各構成の大きさおよび厚さは、説明の便宜のために任意に示したため、本発明が必ずしも示されたものに限定されることはない。図面において、様々な層および領域を明確に表現するために厚さを拡大して示した。さらに、図面において、説明の便宜のために、一部の層および領域の厚さを誇張して示した。層、膜、領域、板などの部分が他の部分の「上に」または「の上に」あるとするとき、これは他の部分の「すぐ上に」にある場合だけではなく、その中間にさらに他の部分がある場合も含む。
【００３８】
以下、図１〜図３を参照しながら、本発明の第１実施形態に係る表示装置１０１について説明する。
【００３９】
図１に示すように、表示装置１０１は、表示領域ＤＡと非表示領域ＮＡに区分された基板１１１を含む。基板１１１の表示領域ＤＡには多数の画素領域ＰＥが形成されて画像を表示し、非表示領域ＮＡには１つ以上の駆動回路９１０，９２０が形成される。ここで、画素領域ＰＥは、画像を表示する最小単位である画素が形成された領域を意味する。しかしながら、本発明の第１実施形態において、必ずしも非表示領域ＮＡにすべての駆動回路９１０，９２０が形成されなければならないのではなく、駆動回路９１０，９２０の一部またはすべてが省略されてもよい。
【００４０】
図２に示すように、本発明の第１実施形態に係る表示装置１０１は、１つの画素領域ＰＥごとに有機発光素子７０と、２つの薄膜トランジスタ（ＴＦＴ）１０，２０と、１つのキャパシタ９０が配置された２Ｔｒ−１Ｃａｐ構造を有する有機発光表示装置である。しかしながら、本発明の第１実施形態がこれに限定されるものではない。したがって、表示装置１０１は、１つの画素領域ＰＥごとに３つ以上の薄膜トランジスタと２つ以上のキャパシタが配置された構造を有する有機発光表示装置であってもよい。さらに、表示装置１０１は、別途の配線がさらに形成されて多様な構造を有するように形成されてもよい。このように、追加で形成される薄膜トランジスタおよびキャパシタのうちの１つ以上は、補償回路を構成してもよい。
【００４１】
補償回路は、各画素領域ＰＥに形成された有機発光素子７０の均一性を向上させ、画質に偏差が生じることを抑制する。一般的に、補償回路は２〜８つの薄膜トランジスタを含んでもよい。
【００４２】
また、基板１１１の非表示領域ＮＡ上に形成された駆動回路９１０，９２０（図１に図示）も追加の薄膜トランジスタを含んでもよい。
【００４３】
有機発光素子７０は、正孔注入電極であるアノード電極と、電子注入電極であるカソード電極と、アノード電極とカソード電極の間に配置された有機発光層とを含む。
【００４４】
具体的には、本発明の第１実施形態において、表示装置１０１は、１つの画素領域ＰＥごとにそれぞれ形成された第１薄膜トランジスタ１０と第２薄膜トランジスタ２０を含む。第１薄膜トランジスタ１０および第２薄膜トランジスタ２０はそれぞれ、ゲート電極１５３，１５６と、半導体層１３３，１３６と、ソース電極１８４，１８７と、ドレイン電極１８５，１８８とを含む。
【００４５】
また、基板１１１上にゲートライン１５１と、データライン１８１と、共通電源ライン１８２とが形成される。１つの画素領域ＰＥは、ゲートライン１５１と、データライン１８１と、共通電源ライン１８２とによって定義されてもよい。しかしながら、画素領域ＰＥがこれに限定されるものではない。また、基板１１１上にキャパシタラインが追加で形成されてもよい。
【００４６】
データライン１８１には、第１薄膜トランジスタ１０のソース電極１８４が連結し、ゲートライン１５１には、第１薄膜トランジスタ１０のゲート電極１５３が連結する。また、第１薄膜トランジスタ１０のドレイン電極１８５とキャパシタ９０との間にノードが形成され、第１薄膜トランジスタ１０のドレイン電極１８５は、キャパシタ９０の第１キャパシタ電極１３９と連結する。また、第１薄膜トランジスタ１０のドレイン電極１８５には、第２薄膜トランジスタ２０のゲート電極１５６が連結する。また、第２薄膜トランジスタ２０のソース電極１８７には、共通電源ライン１８２が連結し、ドレイン電極１８８には、有機発光素子７０のアノード電極が連結する。以下、有機発光素子７０のアノード電極は画素電極とし、カソード電極は共通電極とする。さらに、アノード電極とカソード電極は、その位置が互いに変わってもよい。
【００４７】
第１薄膜トランジスタ１０は、発光させようとする画素領域ＰＥを選択するスイッチング素子として用いられる。第１薄膜トランジスタ１０が瞬間的にターンオンすればキャパシタ９０は蓄電され、このときに蓄電される電荷量はデータライン１８１から印加される電圧の大きさに比例する。また、第１薄膜トランジスタ１０がターンオフした状態で、第２薄膜トランジスタ２０のゲート電位はキャパシタ９０に蓄電された電位によって上昇する。また、第２薄膜トランジスタ２０は、ゲート電位が閾値電圧を超過すればターンオンする。これにより、共通電源ライン１８２に印加された電圧が第２薄膜トランジスタ２０を介して有機発光素子７０に印加され、有機発光素子７０は発光する。
【００４８】
このような画素領域ＰＥの構成は、上述したものに限定されるものではなく、当該技術分野の従事者が容易に変形して実施することができる範囲内で多様に変形が可能である。
【００４９】
以下、図３を参照しながら、本発明の第１実施形態に係る薄膜トランジスタ１０，２０、有機発光素子７０、およびキャパシタ９０の構造を積層順にしたがって詳しく説明する。
【００５０】
基板１１１は、ガラス、石英、セラミック、およびプラスチックなどからなる透明な絶縁性基板で形成される。しかしながら、本発明の第１実施形態がこれに限定されるものではなく、基板１１１がステンレス鋼などからなる金属性基板で形成されてもよい。また、基板１１１がプラスチックなどで形成される場合、フレキシブル（ｆｌｅｘｉｂｌｅ）な基板で形成されてもよい。
【００５１】
基板１１１上には、バッファ層１２０が形成される。バッファ層１２０は、化学気相蒸着（ｃｈｅｍｉｃａｌ  ｖａｐｏｒ  ｄｅｐｏｓｉｔｉｏｎ）法または物理気相蒸着（ｐｈｙｓｉｃａｌ  ｖａｐｏｒ  ｄｅｐｏｓｉｔｉｏｎ）法を利用し、酸化シリコン膜および窒化シリコン膜などのような絶縁膜を１つ以上含む単層または複層構造で形成される。
【００５２】
バッファ層１２０は、基板１１１で発生する水分または不純物の拡散および浸透を防ぎ、表面を平坦化し、半導体層を形成するための結晶化工程において熱の伝達速度を調節して結晶化が適切になされるように助ける役割を担う。
【００５３】
バッファ層１２０は、基板１１１の種類および工程条件に応じて省略されてもよい。
【００５４】
バッファ層１２０上には、半導体層１３３，１３６および第１キャパシタ電極１３９が形成される。半導体層１３３，１３６および第１キャパシタ電極１３９は、バッファ層１２０上に非晶質シリコン膜を形成し、これを結晶化して多結晶シリコン膜を形成した後、パターニングして形成される。しかしながら、本発明の第１実施形態がこれに限定されるものではない。場合によっては、第１キャパシタ電極１３９は、半導体層１３３，１３６とは異なる素材で形成されてもよい。
【００５５】
半導体層１３３，１３６および第１キャパシタ電極１３９上には、ゲート絶縁膜１４０が形成される。具体的には、ゲート絶縁膜１４０は、バッファ層１２０上で半導体層１３３，１３６および第１キャパシタ電極１３９を覆うように形成される。ゲート絶縁膜１４０は、テトラエトキシシラン（ｔｅｔｒａ  ｅｔｈｙｌ  ｏｒｔｈｏ  ｓｉｌｉｃａｔｅ、ＴＥＯＳ）、窒化ケイ素（ＳｉＮｘ）、および酸化ケイ素（ＳｉＯ２）などのように、当該技術分野の従事者に公知された多様な絶縁物質のうちの１つ以上を含んで形成される。
【００５６】
ゲート絶縁膜１４０上には、ゲート電極１５３，１５６および画素電極７１０が形成される。ゲート電極１５３，１５６は、半導体層１３３，１３６のチャネル領域１３３３，１３６６と重なるように半導体層１３３，１３６上に形成される。半導体層１３３，１３６は、不純物がドーピングされないチャネル領域１３３３，１３６６と、チャネル領域１３３３，１３６６の両側にそれぞれ配置されて不純物がドーピングされたソース領域１３３４，１３６７と、ドレイン領域１３３５，１３６８とに区分される。ゲート電極１５３，１５６は、不純物をドーピングしてソース領域１３３４，１３６７およびドレイン領域１３３５，１３６８を形成する過程において、チャネル領域１３３３，１３６６に不純物がドーピングされることを遮断する役割を担う。また、半導体層１３３，１３６のソース領域１３３４，１３６７およびドレイン領域１３３５，１３６８に不純物をドーピングする過程において、第１キャパシタ電極１３９にも不純物が共にドーピングされてもよい。
【００５７】
また、ゲート電極１５３，１５６は、ゲート透明層とゲート透明層上に形成されたゲート金属層を含む二重層で形成される。ゲート金属層は、モリブデン（Ｍｏ）、クロム（Ｃｒ）、アルミニウム（Ａｌ）、銀（Ａｇ）、チタニウム（Ｔｉ）、タンタル（Ｔａ）、およびタングステン（Ｗ）などのように、当該技術分野の従事者に公知された多様な金属物質のうちの１つ以上を含んで形成される。ゲート透明層は、ＩＴＯ（Ｉｎｄｉｕｍ  Ｔｉｎ  Ｏｘｉｄｅ）、ＩＺＯ（Ｉｎｄｉｕｍ  Ｚｉｎｃ  Ｏｘｉｄｅ）、ＺＩＴＯ（Ｚｉｎｃ  Ｉｎｄｉｕｍ  Ｔｉｎ  Ｏｘｉｄｅ）、ＧＩＴＯ（Ｇａｌｌｉｕｍ  Ｉｎｄｉｕｍ  Ｔｉｎ  Ｏｘｉｄｅ）、Ｉｎ２Ｏ３（Ｉｎｄｉｕｍ  Ｏｘｉｄｅ）、ＺｎＯ（Ｚｉｎｃ  Ｏｘｉｄｅ）、ＧＩＺＯ（Ｇａｌｌｉｕｍ  Ｉｎｄｉｕｍ  Ｚｉｎｃ  Ｏｘｉｄｅ）、ＧＺＯ（Ｇａｌｌｉｕｍ  Ｚｉｎｃ  Ｏｘｉｄｅ）、ＦＴＯ（Ｆｌｕｏｒｉｎｅ  Ｔｉｎ  Ｏｘｉｄｅ）、およびＡＺＯ（Ａｌｕｍｉｎｕｍ−Ｄｏｐｅｄ  Ｚｉｎｃ  Ｏｘｉｄｅ）などのような透明導電層のうちの１つ以上を含む。
【００５８】
画素電極７１０は、ゲート電極１５３，１５６のゲート透明層と同じ素材で同じ層に形成される。
【００５９】
ゲート電極１５３，１５６上には、無機絶縁膜１６０が形成される。無機絶縁膜１６０は、窒化シリコン膜および酸化シリコン膜のうちの１つ以上を含む。すなわち、無機絶縁膜１６０は、窒化シリコン膜または酸化シリコン膜で形成された単層で形成されるか、あるいは窒化シリコン膜と酸化シリコン膜とが積層された複層で形成されてもよい。また、無機絶縁膜１６０は水素を含有してもよい。特に、窒化シリコン膜が工程条件上において容易に水素を含有することができる。無機絶縁膜１６０は、絶縁機能以外に半導体層１３３，１３６をアニーリングする過程において半導体層１３３，１３６に水素を供給し、アニーリングが円滑に進められるように助ける役割を担うこともできる。
【００６０】
しかしながら、本発明の第１実施形態がこれに限定されるものではない。したがって、無機絶縁膜１６０は省略されてもよい。すなわち、後述する有機絶縁膜１７０がゲート電極１５３，１５６のすぐ上に形成されてもよい。
【００６１】
また、無機絶縁膜１６０は、画素電極７１０上には形成されない。すなわち、無機絶縁膜１６０は、画素電極７１０を露出するように形成される。
【００６２】
無機絶縁膜１６０上には、有機絶縁膜１７０が形成される。有機絶縁膜１７０は、無機絶縁膜１６０よりも相対的に厚い厚さに形成することが容易である。したがって、有機絶縁膜１７０は、安定した層間絶縁を確保できるように十分に厚い厚さで形成されてもよい。一例として、有機絶縁膜１７０は、３μｍ内外の厚さを有するように形成されてもよい。
【００６３】
また、有機絶縁膜１７０は、無機絶縁膜１６０と同様に画素電極７１０上には形成されない。すなわち、有機絶縁膜１７０も画素電極７１０を露出するように形成される。
【００６４】
有機絶縁膜１７０には、オープングルーブ（ｏｐｅｎ  ｇｒｏｏｖｅ）７０８０が形成される。本発明の第１実施形態において、オープングルーブ７０８０は有機絶縁膜１７０に形成され、有機絶縁膜１７０の下に位置する無機絶縁膜１６０を露出する。
【００６５】
また、有機絶縁膜１７０、無機絶縁膜１６０、およびゲート絶縁膜１４０は共に、半導体層１３３，１３６の一部を露出する複数の接触孔７６４４，７６４５，７６４７，７６４８を有する。複数の接触孔７６４４，７６４５，７６４７，７６４８は、半導体層１３３，１３６のソース領域１３３４，１３６７およびドレイン領域１３３５，１３６８の一部を露出する。
【００６６】
また、有機絶縁膜１７０は、第１キャパシタ電極１３９上に形成されたキャパシタ用開口部７０９０を有する。これは、第１キャパシタ電極１３９と第２キャパシタ電極１８９の間の厚さが過度に厚くなることによってキャパシタ９０の容量が低下することを防ぐためである。
【００６７】
有機絶縁膜１７０上には、複数の導電配線１８４，１８５，１８７，１８８，１８９が形成される。複数の導電配線は、ソース電極１８４，１８７と、ドレイン電極１８５，１８８と、第２キャパシタ電極１８９とを含む。また、複数の導電配線は、データライン１８１（図２に図示）および共通電源ライン１８２（図２に図示）をさらに含んでもよい。
【００６８】
また、複数の導電配線１８４，１８５，１８７，１８８，１８９は、ゲート電極１５３，１５６と同様に、当該技術分野の従事者に公知された多様な金属物質のうちの１つ以上を含んで形成されてもよい。
【００６９】
ソース電極１８４，１８７およびドレイン電極１８５，１８８はそれぞれ、接触孔７６４４，７６４５，７６４７，７６４８を介して半導体層１３３，１３６のソース領域１３３４，１３６７およびドレイン領域１３３５，１３６８と接触する。
【００７０】
また、第２キャパシタ電極１８９がソース電極１８４，１８７およびドレイン電極１８５，１８８と同じ位置に形成されたが、本発明の第１実施形態がこれに限定されるものではない。したがって、第２キャパシタ電極１８９はゲート電極１５３，１５６と同じ層に形成されてもよい。
【００７１】
オープングルーブ７０８０は、複数の導電配線１８４，１８５，１８７，１８８，１８９の間に形成される。すなわち、複数の導電配線１８４，１８５，１８７，１８８，１８９は、オープングルーブ７０８０を間において互いに離隔する。このように、オープングルーブ７０８０が複数の導電配線１８４，１８５，１８７，１８８，１８９をそれぞれ囲んで孤立させることにより、各導電配線１８４，１８５，１８７，１８８，１８９を互いに安定的に絶縁させることができる。すなわち、導電配線１８４，１８５，１８７，１８８，１８９をパターニングする過程において導電物質が有機絶縁膜１７０の表面に不必要に残存しても、オープングルーブ７０８０によって導電配線１８４，１８５，１８７，１８８，１８９が互いに短絡することを防ぐことができる。
【００７２】
複数の導電配線１８４，１８５，１８７，１８８，１８９上には画素定義膜１９０が形成される。画素定義膜１９０は、画素電極７１０の一部を露出する画素開口部１９５を含む。画素定義膜１９０は、当該技術分野の従事者に公知された多様な有機または無機物質で形成されてもよい。例えば、画素定義膜１９０は、感光性有機膜でパターニングされた後、熱硬化または光硬化されて形成されてもよい。
【００７３】
有機発光層７２０は画素電極７１０上に形成され、共通電極７３０は有機発光層７２０上に形成される。画素電極７１０、有機発光層７２０、および共通電極７３０は有機発光素子７０となる。さらに、画素電極７１０、有機発光層７２０、および共通電極７３０が順に積層される画素定義膜１９０の画素開口部１９５は、実際に有機発光素子７０の発光領域となる。
【００７４】
このような構成により、本発明の第１実施形態に係る表示装置１０１は、内部短絡を安定的に防ぐことができる。さらに、表示装置１０１に用いられる薄膜トランジスタ１０、２０の半導体層１３３，１３６を効果的にアニーリングすることができる。
【００７５】
以下、図４〜図９を参照しながら、本発明の第１実施形態に係る表示装置１０１の製造方法について説明する。
【００７６】
先ず、図４に示すように、基板１１１上にバッファ層１２０を形成する。バッファ層１２０は、窒化ケイ素（ＳｉＮｘ）の単一膜、または窒化ケイ素（ＳｉＮｘ）と酸化ケイ素（ＳｉＯ２）が積層された二重膜構造で形成されてもよい。
【００７７】
次に、バッファ層１２０上に半導体層１３３，１３６および第１キャパシタ電極１３９を形成する。半導体層１３３，１３６はバッファ層１２０上に非晶質シリコン膜を蒸着し、これを結晶化して多結晶シリコン膜を形成した後、パターニングする方法によって形成してもよい。
【００７８】
非晶質シリコン膜を結晶化させる方法としては、固相結晶化法（ｓｏｌｉｄ  ｐｈａｓｅ  ｃｒｙｓｔａｌｌｉｚａｔｉｏｎ）、エキシマレーザー結晶化法（ｅｘｃｉｍｅｒ  ｌａｓｅｒ  ｃｒｙｓｔａｌｌｉｚａｔｉｏｎ）、金属誘導結晶化（ｍｅｔａｌ  ｉｎｄｕｃｅｄ  ｃｒｙｓｔａｌｌｉｚａｔｉｏｎ、ＭＩＣ）方法、金属誘導側面結晶化（ｍｅｔａｌ  ｉｎｄｕｃｅｄ  ｌａｔｅｒａｌ  ｃｒｙｓｔａｌｌｉｚａｔｉｏｎ、ＭＩＬＣ）方法、およびＳＧＳ結晶化（ｓｕｐｅｒ  ｇｒａｉｎ  ｓｉｌｉｃｏｎ  ｃｒｙｓｔａｌｌｉｚａｔｉｏｎ）方法など、当該技術分野の従事者に公知された多様な結晶化方法が用いられてもよい。
【００７９】
次に、半導体層１３３，１３６および第１キャパシタ電極１３９を覆うゲート絶縁膜１４０を形成する。さらに、ゲート絶縁膜１４０上にゲート透明層およびゲート金属層を順に積層させる。
【００８０】
次に、図５に示すように、ゲート透明層およびゲート金属層をパターニングしてゲート電極１５３，１５６および画素電極中間体７１００を形成する。すなわち、ゲート電極１５３，１５６および画素電極中間体７１００は二重層で形成される。
【００８１】
次に、半導体層１３３，１３６に不純物をドーピングする。このとき、半導体層１３３，１３６は、不純物がドーピングされないチャネル領域１３３３，１３６６と、不純物がドーピングされたソース領域１３３４，１３６７と、ドレイン領域１３３５，１３６８とに区分される。ゲート電極１５３，１５６は、半導体層１３３，１３６のチャネル領域１３３３，１３６６に不純物がドーピングされることを遮断する役割を担う。
【００８２】
次に、図６に示すように、ゲート電極１５３，１５６および画素電極中間体７１００上に無機絶縁膜１６０を形成する。無機絶縁膜１６０は、窒化シリコン膜および酸化シリコン膜のうちの１つ以上を含む。すなわち、無機絶縁膜１６０は、窒化シリコン膜または酸化シリコン膜で形成された単層で形成されるか、あるいは窒化シリコン膜と酸化シリコン膜とが積層された複層で形成されてもよい。また、無機絶縁膜１６０は、水素を含有する。
【００８３】
一例として、無機絶縁膜１６０は、シラン、アンモニア、および水素を用いるプラズマ化学気相蒸着（ｐｌａｓｍａ  ｅｎｈａｎｃｅｄ  ｃｈｅｍｉｃａｌ  ｖａｐｏｒ  ｄｅｐｏｓｉｔｉｏｎ、ＰＥＣＶＤ）法によって形成される窒化シリコン膜を含んでもよい。このように形成された窒化シリコン膜は水素を含有するが、この水素は後述する半導体層１３３，１３６に対するアニーリング工程の効果を向上させる。
【００８４】
次に、アニーリング工程を進めて半導体層１３３，１３６の結晶欠陥を治癒する。アニーリング工程は、摂氏２５０度以上の温度で熱処理する過程を含む。摂氏４００度の温度が加わるとき、半導体層１３３，１３６の結晶欠陥を最も効果的に治癒することができる。
【００８５】
一方、無機絶縁膜１６０が省略されてゲート電極１５３，１５６のすぐ上に有機絶縁膜１７０が形成された状態でアニーリング工程が進められれば、摂氏２５０度以上の温度でアニーリング工程を進め難い。これは、約摂氏２３０度以上の熱が加われば、有機絶縁膜１７０が炭化して損傷するためである。
【００８６】
しかしながら、本発明の第１実施形態では、ゲート電極１５３，１５６のすぐ上に無機絶縁膜１６０を形成してアニーリング工程を進めるため、最適な温度でアニーリング工程を進めることができる。
【００８７】
また、有機絶縁膜１７０よりも窒化シリコン膜のような無機絶縁膜１６０がより多くの水素成分を含むため、無機絶縁膜１６０を形成する場合、より効果的に半導体層１３３，１３６のアニーリング工程を進めることができる。
【００８８】
無機絶縁膜１６０上に有機絶縁膜１７０を形成した後、図７に示すように、ハーフトーン（ｈａｌｆｔｏｎｅ）露光を利用したフォトエッチング工程によって、複数の接触孔７６４４，７６４５，７６４７，７６４８（図８に図示）が形成される位置の有機絶縁膜１７０と無機絶縁膜１６０を除去する。また、画素電極中間体７１００が露出されるように画素電極中間体７１００上の有機絶縁膜１７０と無機絶縁膜１６０をすべて除去する。また、オープングルーブ７０８０が形成される位置の有機絶縁膜１７０の一部を除去する。すなわち、オープングルーブ７０８０が形成される位置の有機絶縁膜１７０はすべて除去されずに一部が残存する。このとき、第１キャパシタ電極１３９上でキャパシタ用開口部７０９０（図８に図示）が形成される位置の有機絶縁膜１７０の一部も共に除去する。
【００８９】
次に、複数の接触孔７６４４，７６４５，７６４７，７６４８が形成される位置のゲート絶縁膜１４０を乾式エッチング工程によって除去する。乾式エッチング工程は、芳香性を有するプラズマエッチング方法が用いられる。乾式エッチング工程にはＣ４Ｆ８、ＳＦ６、およびＣＦ４などのようにフッ素成分を含むガスが用いられる。このとき、オープングルーブ７０８０が形成される位置およびキャパシタ用開口部７０９０が形成される位置に残存する有機絶縁膜１７０は、ゲート絶縁膜１４０をエッチングする過程において有機絶縁膜１７０の下に位置する無機絶縁膜１６０が除去または損傷しないように保護する。これは、有機絶縁膜１７０とゲート絶縁膜１４０のエッチング選択比が異なるために可能となる。反面、無機絶縁膜１６０は、ゲート絶縁膜１４０と同一または類似するエッチング選択比を有する。したがって、有機絶縁膜１７０の残存の部分がなければ、ゲート絶縁膜１４０をエッチングする過程において無機絶縁膜１６０も共にエッチングされるか、あるいは損傷することがある。
【００９０】
次に、図８に示すように、アッシング（ａｓｈｉｎｇ）工程によってオープングルーブ７０８０が形成される位置とキャパシタ用開口部７０９０が形成される位置に残存した有機絶縁膜１７０を除去し、オープングルーブ７０８０およびキャパシタ用開口部７０９０を完成する。
【００９１】
次に、図９に示すように、画素電極中間体７１００のゲート金属層を除去して画素電極７１０を形成する。また、有機絶縁膜１７０上に複数の導電配線１８４，１８５，１８７，１８８，１８９を形成する。複数の導電配線は、ソース電極１８４，１８７と、ドレイン電極１８５，１８８と、第２キャパシタ電極１８９とを含む。
【００９２】
ソース電極１８４，１８７およびドレイン電極１８５，１８８は、複数の接触孔７６４４，７６４５，７６４７，７６４８を介して半導体層１３３，１３６のソース領域１３３４，１３６７およびドレイン領域１３３５，１３６８とそれぞれ接触する。
【００９３】
次に、図３に示すように、画素電極７１０を露出する画素開口部１９５を有する画素定義膜１９０を形成する。また、画素開口部１９５を介して露出された画素電極７１０上に有機発光層７２０および共通電極７３０を順に形成する。
【００９４】
次に、対向基板２１０を配置して有機発光素子７０などをカバーする。
【００９５】
以上のような製造方法により、本発明の第１実施形態に係る表示装置１０１を効果的に製造することができる。これにより、表示装置１０１は、内部短絡を安定的に防ぐことができ、表示装置１０１に用いられる薄膜トランジスタ１０，２０の半導体層１３３，１３６を効果的にアニーリングすることができる。
【００９６】
以下、図１０を参照しながら、本発明の第２実施形態に係る表示装置１０２について説明する。
【００９７】
図１０に示すように、本発明の第２実施形態に係る表示装置１０２は、オープングルーブ７６８０が有機絶縁膜１７０と共に無機絶縁膜１６０にも形成される。すなわち、オープングルーブ７６８０はさらに深い深さを有してもよい。したがって、オープングルーブ７６８０は、各導電配線１８４，１８５，１８７，１８８，１８９を互いに安定的に絶縁させることができる。
【００９８】
このような構成により、表示装置１０２は、内部短絡を安定的に防ぐことができ、表示装置１０２に用いられる薄膜トランジスタ１０，２０の半導体層１３３，１３６を効果的にアニーリングすることができる。
【００９９】
また、本発明の第２実施形態に係る表示装置１０２の製造方法は、オープングルーブ７６８０を有機絶縁膜１７０と無機絶縁膜１６０に共に形成する点を除けば、第１実施形態と同じである。
【０１００】
以下、図１１を参照しながら、本発明の第３実施形態に係る表示装置１０３について説明する。
【０１０１】
本発明の第３実施形態に係る表示装置１０３は、有機発光素子７０（図２に図示）の代わりに液晶層３００を含む。具体的には、表示装置１０３は、薄膜トランジスタ２０のドレイン電極１８８と連結した画素電極３１０と、画素電極３１０上に形成された液晶層３００と、液晶層３００上に形成された共通電極３２０とを含む。
【０１０２】
液晶層３００は、当該技術分野の従事者に公知された多様な液晶を含んでもよい。
【０１０３】
また、表示装置１０３は、液晶層３００を間において基板１１１と対向配置された対向基板２１０をさらに含む。共通電極３２０は、対向基板２１０に形成される。
【０１０４】
また、表示装置１０３は、基板１１１および対向基板２１０にそれぞれ取り付けられた偏光板４１０，４２０さらに含んでもよい。
【０１０５】
また、第１実施形態と同様に、無機絶縁膜１６０はゲート電極上に形成され、有機絶縁膜１７０は無機絶縁膜１６０上に形成される。有機絶縁膜１７０上には、ソース電極１８７およびドレイン電極１８８を含む複数の導電配線が形成される。
【０１０６】
オープングルーブ７０８０は、有機絶縁膜１７０に形成される。複数の導電配線１８７、１８８は、オープングルーブ７０８０を間において互いに離隔する。すなわち、オープングルーブ７０８０は、複数の導電配線１８７，１８８を囲んで孤立させる。
【０１０７】
しかしながら、本発明の第３実施形態が上述したものに限定されるものではない。したがって、オープングルーブ７０８０は、第２実施形態と同様に、有機絶縁膜１７０と共に無機絶縁膜１６０にも形成されてもよい。
【０１０８】
このような構成により、液晶駆動によって画像を表示する表示装置１０３も、内部短絡を安定的に防ぐことができ、表示装置１０３に用いられる薄膜トランジスタ２０の半導体層１３６を効果的にアニーリングすることができる。
【０１０９】
本発明を上述した記載に基づいて好ましい実施形態を用いて説明したが、本発明はこれに限定されるものではなく、添付の特許請求の範囲の概念と範囲を逸脱しない限り多様な修正および変形が可能であるということを、本発明が属する技術分野に従事する者であれば容易に理解できるであろう。
【符号の説明】
【０１１０】
１０，２０  薄膜トランジスタ、
７０  有機発光素子、
９０  キャパシタ、
１０１，１０２，１０３  表示装置、
１１１  基板、
１２０  バッファ層、
１３３，１３６  半導体層、
１３９  第１キャパシタ電極、
１４０  ゲート絶縁膜、
１５３，１５６  ゲート電極、
１６０  有機絶縁膜、
１７０  無機絶縁膜、
１８４，１８７  ソース電極、
１８５，１８８  ドレイン電極、
１９０  画素定義膜、
７１０  画素電極、
７２０  有機発光層、
７３０  共通電極、
９１０，９２０  駆動回路、
ＤＡ  表示領域、
ＮＡ  非表示領域、
ＰＥ  画素領域。
【図１】
2011258918.tif 000003
【図２】
2011258918.tif 000004
【図３】
2011258918.tif 000005
【図４】
2011258918.tif 000006
【図５】
2011258918.tif 000007
【図６】
2011258918.tif 000008
【図７】
2011258918.tif 000009
【図８】
2011258918.tif 000010
【図９】
2011258918.tif 000011
【図１０】
2011258918.tif 000012
【図１１】
2011258918.tif 000013
【手続補正書】
【提出日】平成22年12月22日(2010.12.22)
【手続補正１】
【補正対象書類名】明細書
【補正対象項目名】０００４
【補正方法】削除
【補正の内容】