(57)【要約】マルチメディアデジタルビットストリームを処理する装置及び方法が開示される。この装置は、複数のマルチメディアプロセッサにより構成された処理チェーンを含む。各メディアプロセッサは、マルチメディアデジタルビットストリームの一部をリアルタイム処理する。マルチメディアデジタルビットストリームの各部は、第１のビットストリームと第２のビットストリームに分割される。第１のビットストリームは処理され、未だ処理されていない第２のビットストリームとマージされる。本発明の並列処理方法によれば、処理チェーンは完全に処理されたビットストリームをリアルタイムで出力することが可能になる。処理チェーンは、複数のビットレートトランスコーダ部を利用して高品位（ＨＤ）ビデオビットストリームをリアルタイムでトランスコードするため使用される。
2005507622.tif 000002
【特許請求の範囲】
【請求項１】
マルチメディアデジタルビットストリームを処理する能力を備えた装置であって、
当該装置は、複数のメディアプロセッサを含んで構成された処理チェーンを含み、前記複数のメディアプロセッサのそれぞれは、前記マルチメディアデジタルビットストリームの一部分を処理する能力を具備し、
前記複数のメディアプロセッサのそれぞれは、前記マルチメディアデジタルビットストリームの前記一部分を第１のビットストリームと第２のビットストリームに分割する能力を備え、前記第１のビットストリームを処理する能力を備え、処理済の第１のビットストリームを前記第２のビットストリームと組み合わせることが可能な装置。
【請求項２】
前記複数のマルチメディアプロセッサの個数は２個からＮ個まで変化し、Ｎは２よりも大きい整数である、請求項１に記載の装置。
【請求項３】
前記マルチメディアデジタルビットストリームは高品位デジタルビデオ信号を含んで構成される、請求項１に記載の装置。
【請求項４】
前記複数のメディアプロセッサのそれぞれは、前記マルチメディアデジタルビットストリームの一部分をトランスコードすることが可能なビットレートトランスコーダ部を含む、請求項１に記載の装置。
【請求項５】
前記ビットレートトランスコーダ部は、スプリット部とＢＲＴ'トランスコーダとマージ部とを含む、請求項４に記載の装置。
【請求項６】
前記ビットレートトランスコーダ部は、空のデータパケットを生成し、前記空のデータパケットを前記ビットレートトランスコーダ部の出力に付加することが可能な出力コンポーネントを含む、請求項４に記載の装置。
【請求項７】
前記処理チェーンの出力端にある最後のビットレートトランスコーダ部の出力コンポーネントにクロック制御回路をさらに有し、
前記クロック制御回路は前記処理チェーン内の前記最後のビットレートトランスコーダ部の出力のクロックレートを調整する能力を有する、請求項６に記載の装置。
【請求項８】
前記処理チェーンは、
前記処理チェーン内の１番目のメディアプロセッサに結合され、コンピュータファイルとビットポンプと無線周波フロントエンドのうちの一つからリアルタイムでマルチメディアデータを受信可能な入力ブロックと、
前記処理チェーン内の最後のメディアプロセッサに結合され、コンピュータファイルフォーマットとトランスポートストリームフォーマットのうちの一つでリアルタイムにマルチメディアデータを出力可能な出力ブロックと、
をさらに有する、請求項１に記載の装置。
【請求項９】
マルチメディアデジタルビットストリームを処理可能な装置を含むテレビジョンユニットであって、
当該装置は、複数のメディアプロセッサを含んで構成された処理チェーンを含み、前記複数のメディアプロセッサのそれぞれは、前記マルチメディアデジタルビットストリームの一部分を処理可能で、
前記複数のメディアプロセッサのそれぞれは、前記マルチメディアデジタルビットストリームの前記一部分を第１のビットストリームと第２のビットストリームに分割可能で、前記第１のビットストリームを処理可能で、処理済の第１のビットストリームを前記第２のビットストリームと組み合わせるとが可能なテレビジョンユニット。
【請求項１０】
前記複数のマルチメディアプロセッサの個数は２個からＮ個まで変化し、Ｎは２よりも大きい整数である、請求項９に記載のテレビジョンユニット。
【請求項１１】
前記マルチメディアデジタルビットストリームは高品位デジタルビデオ信号を含んで構成される、請求項９に記載のテレビジョンユニット。
【請求項１２】
前記複数のメディアプロセッサのそれぞれは、前記マルチメディアデジタルビットストリームの一部分をトランスコードすることが可能なビットレートトランスコーダ部を含む、請求項９に記載のテレビジョンユニット。
【請求項１３】
前記ビットレートトランスコーダ部は、スプリット部とＢＲＴ'トランスコーダとマージ部とを含む、請求項１２に記載のテレビジョンユニット。
【請求項１４】
前記ビットレートトランスコーダ部は、空のデータパケットを生成し、前記空のデータパケットを前記ビットレートトランスコーダ部の出力に付加することが可能な出力コンポーネントを含む、請求項１２に記載のテレビジョンユニット。
【請求項１５】
前記処理チェーンの出力端にある最後のビットレートトランスコーダ部の出力コンポーネントにクロック制御回路をさらに有し、
前記クロック制御回路は前記処理チェーン内の前記最後のビットレートトランスコーダ部の出力のクロックレートを調整することが可能な、請求項１４に記載のテレビジョンユニット。
【請求項１６】
前記処理チェーンは、
前記処理チェーン内の１番目のメディアプロセッサに結合され、コンピュータファイルとビットポンプと無線周波フロントエンドのうちの一つからリアルタイムでマルチメディアデータを受けることが可能な入力ブロックと、
前記処理チェーン内の最後のメディアプロセッサに結合され、コンピュータファイルフォーマットとトランスポートストリームフォーマットのうちの一つでリアルタイムにマルチメディアデータを出力することが可能な出力ブロックと、をさらに有する、請求項９に記載のテレビジョンユニット。
【請求項１７】
マルチメディアビットストリームを処理する方法であって、
処理チェーンの複数のメディアプロセッサのそれぞれにおいて前記マルチメディアデジタルビットストリームの一部分を処理するステップを含み、
前記複数のメディアプロセッサのそれぞれは、
前記マルチメディアデジタルビットストリームの前記一部分を第１のビットストリームと第２のビットストリームに分割するステップと、
前記第１のビットストリームを処理するステップと、
処理済みの第１のビットストリームを前記第２のビットストリームと組み合わせるステップと、を実行する、方法。
【請求項１８】
前記第１のビットストリームを処理するステップは、ビットレートトランスコーダ部で前記第１のビットストリームをトランスコードするステップを含む、請求項１７に記載のマルチメディアビットストリームを処理する方法。
【請求項１９】
前記ビットレートトランスコーダ部の出力コンポーネントで空のデータパケットを生成するステップと、
前記空のデータパケットを前記ビットレートトランスコーダ部の出力へ付加するステップと、
をさらに有する請求項１８に記載のマルチメディアビットストリームを処理する方法。
【請求項２０】
前記処理チェーン内の少なくとも一つのビットレートトランスコーダ部の出力のクロックレートを、クロック制御回路を用いて、調整するステップをさらに有する、請求項１９に記載のマルチメディアビットストリームを処理する方法。
【発明の詳細な説明】
【技術分野】
【０００１】
本発明は、一般的に、マルチメディア信号を処理するシステム及び方法に係わり、特に、マルチメディア信号を並列処理する装置及び方法に関する。本発明の１つの有利な実施形態は、高品位（ＨＤ）ビデオ信号用の効率的なトランスコーダを有する。
【背景技術】
【０００２】
セットトップボックス、ハイエンドテレビ、デジタルテレビ、パーソナルテレビ、ストレージ製品、情報携帯端末（ＰＤＡ）、無線インターネット装置などのような高品位マルチメディア装置の開発によって、多種多様なアーキテクチャが生じ、これらの装置のための新しい特徴がより積極的に取り入れるようになる。これらの新しい製品の開発と、ビデオデータを任意のフォーマットで表示し得る性能により、ビデオ処理アルゴリズム及びビデオ強調アルゴリズムに関して新しい要求と機会が生じた。これらの装置の殆どは、ＭＰＥＧ−２フォーマットのビデオを受信、および／または、蓄積する。
【０００３】
青色レーザに基づくデジタルビデオレコーダのような次世代記憶装置は、ある程度まで高品位（ＨＤ）能力を備えるであろう。高品位（ＨＤ）番組は、典型的に、毎秒２０００万ビット（毎秒２０メガビット、即ち、２０Ｍｂ／ｓ）でブロードキャストされ、ＭＰＥＧ−２ビデオ規格に従ってエンコードされる。デジタルビデオレコーダの記憶容量は約２０ギガバイト（２０ＧＢ）の範囲に収まる。これは、ビデオディスク１枚当たりに約２時間の高品位の記録時間を表す。
【０００４】
ビデオディスク１枚当たりの記録時間の量を増加させるため、ロングプレイ（ＬＰ）モードを規定することができる。例えば、ロングプレイ（ＬＰ）モードにおいて、毎秒２０メガビット（２０Ｍｂ／ｓ）のブロードキャストビットレートは、毎秒１０メガビット（１０Ｍｂ／ｓ）の蓄積ビットレートで記録される。これにより、ビデオディスク１枚当たり約４時間の記録時間が得られる。拡張ロングプレイモード（ＥＬＰ）モードでは、毎秒２０メガビット（２０Ｍｂ／ｓ）のブロードキャストビットレートは、毎秒５メガビット（５Ｍｂ／ｓ）の蓄積ビットレートで記録される。これにより、ビデオディスク１枚当たり約８時間の記録時間が得られる。
【０００５】
より低いレートでビットストリームを記録する処理は、ビットストリームの「トランスコード」と呼ばれる。高ビットレートビットストリームをトランスコードする方法は、ＭＰＥＧ−２デコーダを用いて高ビットレートビットストリームを復号化するステップと、ビットストリームをインターレース解除するステップと、２Ｄスケーリングを適用することにより低解像度へ変換するステップと、ビットストリームを再インターレースするステップと、得られたビットストリームをより低いビットレートで符号化するステップと、を含む。高ビットレートビットストリームをトランスコードする別の方法は、ビデオを完全に復号化及び再符号化することなく、ビットストリームを低ビットレートへ直接トランスコードするステップを含む。この方法は、ダイレクト・ビットレート・トランスコーディング（ＤＢＴ）として知られている。
【０００６】
メディアプロセッサは、ＭＰＥＧフォーマットのマルチメディアデータをトランスコードする能力を備えている。メディアプロセッサのビットレートトランスコーダがＭＰＥＧビデオデータの到着したレートと同じレートでＭＰＥＧビデオデータをトランスコード可能であるならば、トランスコード処理は「リアルタイム」で実行されたと呼ばれる。メディアプロセッサの計算リソースがＭＰＥＧビデオデータをリアルタイムで処理するために不十分であるならば、トランスコード処理は、ＭＰＥＧビデオデータの最後の部分が到着した後に完了する。
【０００７】
メディア処理が必要とする計算リソースが最小限であるならば、又は、処理対象のＭＰＥＧフレームのサイズが小さいならば、メディアプロセッサはリアルタイム性能レベルを達成し得る。例えば、フィリップスエレクトロニクス・ノースアメリカ社製のメディアプロセッサ（ＴＭ１１００、ＴＭ１３００）のＴｒｉｍｅｄｉａ（登録商標）の系列商品は標準品位（ＳＤ）のＭＰＥＧビデオデータに対するＭＰＥＧビデオ変換をほぼリアルタイムで実行し得る。Ｔｒｉｍｅｄｉａ（登録商標）プロセッサは、高品位（ＨＤ）ＭＰＥＧビデオデータを処理するため、毎秒約２５０乃至３００メガサイクルを必要とするはずである。このレベルの処理能力の水準は現時点では達成不可能である。
【０００８】
したがって、高品位（ＨＤ）ビデオデータのビットレートトランスコード処理をリアルタイムで実現するため、現行のメディアプロセッサに高品位（ＨＤ）ＭＰＥＧビデオデータを処理させることができる装置及び方法がこの技術分野において必要とされている。
【発明の開示】
【発明が解決しようとする課題】
【０００９】
本発明は、一般的に、マルチメディアデジタル信号を並列処理する装置及び方法を構成する。マルチメディアデジタル信号はデジタルビットストリームの形式である。本発明は、高品位（ＨＤ）ビデオデータのビットレートトランスコード処理をリアルタイムで実現するため、メディアプロセッサに高品位（ＨＤ）ＭＰＥＧビデオデータを処理させることができる。
【００１０】
本発明の有利な実施形態によれば、本発明の装置は、複数のメディアプロセッサにより構成された処理チェーンを含む。各メディアプロセッサは、マルチメディアデジタルビットストリームの一部をリアルタイム処理する。マルチメディアデジタルビットストリームの各部は、第１のビットストリームと第２のビットストリームに分割される。第１のビットストリームは処理され、未だ処理されていない第２のビットストリームとマージされる。処理チェーンは、完全に処理されたビットストリームをリアルタイムで出力する。
【００１１】
処理チェーンは、複数のビットレートトランスコーダ部を用いて、高品位（ＨＤ）ビデオビットストリームをリアルタイムでトランスコードするため使用される。
【００１２】
本発明の有利な実施形態によれば、本発明の方法は、処理チェーン内の複数のマルチメディアプロセッサの各々でマルチメディアデジタルビットストリームの一部を処理するステップと、各マルチメディアプロセッサにおける各部を第１のビットストリームと第２のビットストリームに分割するステップと、第１のビットストリームを処理するステップと、処理された第１のビットストリームを処理されていない第２のビットストリームにマージするステップと、を有する。
【課題を解決するための手段】
【００１３】
本発明の第１の目的は、マルチメディアデジタルビットストリームを並列処理する方法及び装置を提供することである。
【００１４】
本発明のもう一つの目的は、マルチメディアデジタルビットストリームをトランスコードする方法及び装置を提供することである。
【００１５】
本発明の更なる目的は、高品位（ＨＤ）デジタルビデオビットストリームをリアルタイムでトランスコードする方法及び装置を提供することである。
【００１６】
本発明のもう一つの目的は、本発明の処理チェーンにおける少なくとも一つのビットレートトランスコーダの出力のクロックレートを調整する装置及び方法を提供することである。
【００１７】
以上の記載は本発明の特徴及び技術的効果をかなり概略的に説明しているので、当業者は以下の発明の詳細な説明をよりよく理解するであろう。後述の本発明の付加的な特徴及び効果は、本発明の請求項の対象を形成する。当業者は、開示された概念と具体的な実施形態を、本発明のものと同じ目的を実行する他の構造を変更又は設計するための基礎として容易に使用できることを認めるであろう。当業者は、このような等価的な構成が最広義の形で本発明の精神及び範囲を逸脱しないことがわかるであろう。
【００１８】
発明の詳細な説明を行う前に、この特許書類を通じて使用される決まった単語及び句を定義しておくのが望ましい。即ち、「含む（include）」及び「構成される「comprise」や、それらから派生した用語は、制限のない包摂関係を表し、用語「又は（or）」は包含的であり、即ち、および／または（and/or）の意味を表し、「あるものと関連した（associated with）」及び「それと関連した（associated therewith）」やそれらから派生した句は、包含されること、相互に関連付けられること、収容すること、中に収容されること、あるものに又はあるものと接続すること、あるものに又はあるものと結合すること、連通可能であること、あるものと協働すること、インターリーブすること、並列すること、あるものに近いこと、あるものに又はあるものと密接な関係があること、保持すること、あるものを所有することなどを表し、用語「コントローラ」、「プロセッサ」又は「装置」は、少なくとも一つのオペレーションを制御し、ハードウェア、ファームウェア、ソフトウェア、又は、それらのうちの少なくとも二つの組み合わせとして実現されるあらゆるデバイス、システム、又は、それらの一部を表す。いずれかの特定のコントローラと関連している機能は、集中型又は分散型であり、局部的でも遠隔的でもよいことに注意する必要がある。決まった単語及び句の定義は、この特許文書を通じて与えられ、当業者は、殆どの場合ではなくても、多くの場合に、このような定義が、定義された単語及び句の従来の用法並びに将来の用法に当てはまることを理解するであろう。
【００１９】
本発明及び本発明の利点のより完全な理解のため、以下の記述が添付図面と共に参照される。添付図面中、同様の番号は同様の対象を指定する。
【発明を実施するための最良の形態】
【００２０】
以下で検討する図１乃至１４と、本発明の改良されたシステム及び方法の原理を説明するために本特許文書に記載された様々な実施形態は、例示だけを目的とするものであり、どのような形であっても本発明の範囲を限定するために構築されるべきではない。当業者は、本発明の原理はマルチメディアデジタルルチメディアデジタル信号を並列処理するあらゆるタイプの装置に好結果を伴って適用できることを容易に理解するであろう。
【００２１】
図１は本発明によるビットレートトランスコーダの有利な実施形態の説明図である。供給元１１０は、高品位（ＨＤ）MPEG-2ビデオデータをビットレートトランスコーダ１２０へ供給する。ビットレートトランスコーダ１２０は、ＢＲＴ'部１３０を含む。以下でより詳しく説明するように、ＢＲＴ'は、本発明の原理に従って高品位MPEG-2ビデオデータをトランスコードする。ビットレートトランスコーダ１２０からのトランスコードされた高品位MPEG-2ビデオデータは記憶部１４０へ供給される。記憶部１４０は、コンピュータのハードディスク、又は、デジタルビデオレコーダ（ＤＶＲ）を含んで構成される。記憶部１４０は、トランスコードされた高品位MPEG-2ビデオデータを高品位（ＨＤ）ビデオ表示部１５０へ供給する。高品位ビデオ表示部は、高品位テレビ（ＨＤＴＶ）、高品位（ＨＤ）コンピュータモニタ、又は、ＨＤビデオを表示する能力を備えた他のタイプのディスプレイ部を含んで構成される。
【００２２】
図２は、ファイルからのMPEG-2ビデオデータをトランスコードする本発明によるビットレートトランスコーダの別の有利な実施形態の説明図である。本実施形態では、供給元１１０は、高品位（ＨＤ）MPEG-2ビデオデータをコンピュータファイルに収容するコンピュータのハードディスクを含んで構成される。供給元１１０はＨＤデータをビットレートトランスコーダ１２０のファイル読み取り部２１０へ送る。ファイル読み取り部２１０は、高品位MPEG-2ビデオデータを読み取り、そのデータをＢＲＴ'部１３０用にフォーマットする。ＢＲＴ'部１３０は、本発明の原理に従って高品位MPEG-2ビデオデータをトランスコードする。ＢＲＴ'部１３０からのトランスコードされた高品位MPEG-2ビデオデータは、ファイル書き込み部２３０へ供給される。ファイル書き込み部２３０は、データをフォーマットし、記憶部１４０へ書き込む。本実施形態では、記憶部１４０は、トランスコードされた高品位MPEG-2ビデオデータをコンピュータファイルに収容するハードディスクを含んで構成される。
【００２３】
記憶部１４０のトランスコードされたデータはMPEG-2デコーダ２４０へ供給される。MPEG-2デコーダ２４０は、トランスコードされた高品位MPEG-2ビデオデータを復号化し、復号化されたデータをＨＤビデオ表示部１５０へ供給する。既に説明したように、ＨＤビデオ表示部１５０は、高品位テレビ（ＨＤＴＶ）、ＨＤコンピュータモニタ、又は、ＨＤビデオを表示する能力を備えた他のタイプのディスプレイ部を含んで構成されても良い。
【００２４】
図３は、高品位（ＨＤ）サーバー１１０からのMPEG-2ビデオデータをトランスコードする本発明による、ビットレートトランスコーダの別の有利な実施形態の説明図である。高品位（ＨＤ）１１０は、ＨＤトランスポートストリームをビットレートトランスコーダ１２０のビデオデジタイザ３１０へ供給する。ビデオデジタイザ３１０は、デジタル化されたビデオをデマルチプレクサ３２０へ供給する。デマルチプレクサ３２０は、ＨＤトランスポートストリームからMPEG-2基本ストリームを獲得し、MPEG-2基本ストリームをＢＲＴ'部１３０へ供給する。
【００２５】
ＢＲＴ'部１３０は、本発明の原理に従って高品位MPEG-2ビデオデータをトランスコードする。ＢＲＴ'部１３０からのトランスコードされた高品位MPEG-2ビデオデータはマルチプレクサ３４０へ供給される。マルチプレクサ３４０は、ＢＲＴ'部１３０からのMPEG-2基本ストリームをトランスポートストリームに多重化する。マルチプレクサ３４０は、次に、ＨＤトランスポートストリームをビデオレンド部３５０へ供給する。ビデオレンド部３５０は、トランスコードされた高品位MPEG-2ビデオデータをデジタルビデオレコーダ３６０へ供給する。トランスコードされたビデオデータを表示する命令を受けたとき、デジタルビデオレコーダ３６０は、ＨＤビデオ表示部１５０上でビデオ番組を再生する。上述の通り、ＨＤビデオ表示部１５０は、高品位テレビ（ＨＤＴＶ）、ＨＤコンピュータモニタ、又は、ＨＤビデオを表示する能力を備えた他のタイプのディスプレイ部を含んで構成されても良い。本発明の他の有利な実施形態では、ビットレートトランスコーダ１２０はテレビジョン部内に格納されても良い。テレビジョン部は、テレビ受像機又はテレビジョンセットトップボックスでもよい。
【００２６】
図４は、ＢＲＴ'部１３０の動作の第１の部分を説明するブロック図である。動作の第１の部分は、全体として参照番号４００で示されている。入力ビットストリーム４０５は、数字の系列「1, 2, 3, 4, 5, 6, 7, ...」によって表現されている。各数字は、ビットストリーム４０５の一部、即ち、「スライス」を表現する。文字「Ｈ」は、ヘッダを構成するビットストリーム４０５の一部を指定する。スプリット部４１０は、ビットストリーム４０５を第１のストリーム４１５と第２のストリーム４２０に分割する。図４に示されるように、第１のストリーム４１５は、ヘッダ「Ｈ」と、数字「1, 4, 7, ...」によって表現されたビットストリーム４１５の一部分と、を含んで構成される。第２のストリーム４２０は、ビットストリーム４０５の残りの部分を含んで構成される。即ち、第２のストリーム４２０は、ヘッダ「Ｈ」と、数字「2, 3, 4, 5, 6, 8, 9, 11, 12, ...」によって表現されたビットストリーム４０５の部分と、を含んで構成される。
【００２７】
ＢＲＴ'トランスコーダ４２５は、第１のストリーム４１５をトランスコードし、トランスコードされた第１のストリーム４３０を生成する。第１のトランスコードされたストリーム４３０は、トランスコードされたヘッダ「Ｈ'」と、数字「1', 4', 7', ...」によって表現されたビットストリーム４０５のトランスコードされた部分と、を含んで構成される。ビットストリームの番号付けされたスライス上のプライム記号は、トランスコード動作がそのビットストリームのスライスに対して実行されたことを示す。トランスコードされた第１のストリーム４３０及び第２のストリーム４２０は、部分的にトランスコードされたストリーム４４０を作成するため、マージ部４３５で組み合わされる。図４に示されるように、部分的にトランスコードされたストリーム４４０は、ヘッダ「Ｈ」と、数字「1', 2, 3, 4', 5, 6, 7', ...」によって表現されたビットストリーム４０５の部分と、を含んで構成される。トランスコードされたヘッダ「Ｈ'」は使用されない。なぜならば、ストリーム４４０は完全にはトランスコードされないからである。動作のこの段階で、ビットストリーム４０５のビットストリームスライスの３分の１（１／３）はトランスコードされている。
【００２８】
図５は、ＢＲＴ'部１３０の動作の第２の部分を説明するブロック図である。この動作の第２の部分は、全体として参照番号５００で示されている。入力ビットストリーム４４０は、動作の第１の部分４００からの出力と同じである。ビットストリーム４４０は、数字の系列「1', 2, 3, 4', 5, 6, 7', ...」によって表現される。各数字は、ビットストリーム４４０の一部を表現する。文字「Ｈ」は、ヘッダを構成するビットストリーム４４０の一部を指定する。スプリット部５１０は、ビットストリーム４４０を第１のストリーム５１５と第２のストリーム５２０に分割する。図５に示されるように、第１のストリーム５１５は、ヘッダ「Ｈ」と、数字「2, 5, 8, ...」によって表現されたビットストリーム４４０の一部分と、を含んで構成される。第２のストリーム５２０は、ビットストリーム４４０の残りの部分を含んで構成される。即ち、第２のストリーム５２０は、ヘッダ「Ｈ」と、数字「1', 3, 4', 6, 7', 9, 10', 12, 13', ...」によって表現されたビットストリーム４４０の部分と、を含んで構成される。
【００２９】
ＢＲＴ'トランスコーダ５２５は、第１のストリーム５１５をトランスコードし、トランスコードされた第１のストリーム５３０を生成する。第１のトランスコードされたストリーム５３０は、トランスコードされたヘッダ「Ｈ'」と、数字「2', 5', 8', ...」によって表現されたビットストリーム４４０のトランスコードされた部分と、を含んで構成される。トランスコードされた第１のストリーム５３０及び第２のストリーム５２０は、部分的にトランスコードされたストリーム５４０を作成するため、マージ部５３５で組み合わされる。図５に示されるように、部分的にトランスコードされたストリーム５４０は、ヘッダ「Ｈ」と、数字「1', 2', 3, 4', 5', 6, 7', ...」によって表現されたビットストリーム４４０の部分と、を含んで構成される。トランスコードされたヘッダ「Ｈ'」は使用されない。なぜならば、ストリーム５４０は完全にはトランスコードされないからである。動作のこの段階で、ビットストリーム４０５のビットストリームスライスの３分の２（２／３）はトランスコードされている。
【００３０】
図６は、ＢＲＴ'部１３０の動作の第３の部分を説明するブロック図である。この動作の第３の部分は、全体として参照番号６００で示されている。入力ビットストリーム５４０は、動作の第２の部分５００からの出力と同じである。ビットストリーム５４０は、数字の系列「1', 2', 3, 4', 5', 6, 7', ...」によって表現される。各数字は、ビットストリーム５４０の一部分、即ち、「スライス」を表現する。文字「Ｈ」は、ヘッダを構成するビットストリーム５４０の一部を指定する。スプリット部６１０は、ビットストリーム５４０を第１のストリーム６１５と第２のストリーム６２０に分割する。図６に示されるように、第１のストリーム５１５は、ヘッダ「Ｈ」と、数字「3, 6, 9, ...」によって表現されたビットストリーム５４０の一部分と、を含んで構成される。第２のストリーム６２０は、ビットストリーム５４０の残りの部分を含んで構成される。即ち、第２のストリーム６２０は、ヘッダ「Ｈ」と、数字「1', 2', 4', 5', 7', 8', 10', 11', 13', ...」によって表現されたビットストリーム５４０の部分と、を含んで構成される。
【００３１】
ＢＲＴ'トランスコーダ６２５は、第１のストリーム６１５をトランスコードし、トランスコードされた第１のストリーム６３０を生成する。第１のトランスコードされたストリーム６３０は、トランスコードされたヘッダ「Ｈ'」と、数字「3', 6', 9', ...」によって表現されたビットストリーム５４０のトランスコードされた部分と、を含んで構成される。トランスコードされた第１のストリーム６３０及び第２のストリーム６２０は、完全にトランスコードされたストリーム６４０を作成するため、マージ部６３５で組み合わされる。図５に示されるように、完全にトランスコードされたストリーム６４０は、トランスコードされたヘッダ「Ｈ'」と、数字「1', 2', 3', 4', 5', 6', 7', ...」によって表現された完全にビットトランスコードされたビットストリーム４０５の部分と、を含んで構成される。トランスコードされたヘッダ「Ｈ'」が使用される。なぜならば、ストリーム６４０は完全にトランスコードされているからである。動作のこの段階で、ビットストリーム４０５のビットストリームスライスの全部はトランスコードされている。
【００３２】
図４、図５及び図６に示された有利な実施形態において、ＢＲＴ'部１３０は３個の部を含んで構成される。第１の部は、スプリットユニッ４１０と、ＢＲＴ'トランスコーダ４２５と、マージ部４３５と、を含む。第２の部は、スプリット部５１０と、ＢＲＴ'トランスコーダ５２５と、マージ部５３５と、を含む。第３の部は、スプリット部６１０と、ＢＲＴ'トランスコーダ６２５と、マージ部６３５と、を含む。この実施形態は一例として示されていること、及び、本発明は、本実施形態に示されるように３個のＢＲＴ'トランスコーダの使用に限定されないことが理解される。例えば、本発明の並列処理装置及び方法は、２個のＢＲＴ'トランスコーダの処理チェーンにより構成してもよい。本発明の並列処理装置及び方法は、４個以上のＢＲＴ'トランスコーダの処理チェーンにを含んで構成してもよい。
【００３３】
このように本発明の装置及び方法は、上記のスライスパース方法によって、MPEG-2ビデオビットストリームを分割し、組み合わせることが可能である。無制限の個数のＢＲＴ'トランスコーダが使用され、各ＢＲＴ'トランスコーダは、MPEG-2ビデオビットストリームの選択された個数のスライスを保有する。任意の個数のＢＲＴ'トランスコーダは、３個のＢＲＴ'トランスコーダに関して説明したように処理チェーン内でカスケードされる。
【００３４】
本発明の装置及び方法は、完全な負荷バランスを達成する。なぜならば、各ＢＲＴ'トランスコーダは、ＭＰＥＧピクチャー全体からの小領域を表現するスライスが供給されるからである。この処理は並列に実行される。しかし、全ての並列処理された出力をプロセスの最後でマージすることは不要である。なぜならば、処理チェーン内の各ＢＲＴ'トランスコーダと関連した各マージ部で、部分的なマージが行われるからである。チェーン内の各ＢＲＴ'トランスコーダは、簡単な単一の入力インタフェースと、簡単な単一の出力インタフェースと、を含む。この配置構成は、（高品位MPEG-2ビデオデータのような）マルチメディアデータをリアルタイムで処理することができる。
【００３５】
図７は、本発明のビットレートトランスコーダの一つの有利な実施形態の入力ブロック７０５と、デマルチプレクサブロック７１０と、ビットレートトランスコード処理ブロック７１５と、を示す図である。入力ブロック７０５は、３個の並列入力モジュールからなる。「Ｆリード」入力モジュール７２５は、コンピュータファイルフォーマットのマルチメディアデータを受ける。「Ｆリード」入力モジュール７２５は、ＰＣＩバス、又は、ファイル入出力フォーマットを使用するその他の同様のデバイスからのマルチメディアデータを受ける。「ＶＩストリーム」入力モジュール７３０は、ビットポンプ又は無線周波（ＲＦ）フロントエンドからリアルタイムでマルチメディアデータを受ける。頭文字「ＶＩ」は「ビデオ入力」を表す。「プロデューサ」入力モジュール７３５は、テスト目的のためのビットストリームを発生させる能力を備えた開発テストツールである。
【００３６】
デマルチプレクサブロック７１０は二つのモジュールを含んで構成される。デマルチプレクサMPEG TSモジュール７４０は、入力ブロック７０５からマルチメディアデータを受け取る。デマルチプレクサＭＰＥＧトランスポートストリーム（ＴＳ）モジュール７４０は、入力トランスポートストリームからのビデオ基本ストリームを逆多重化する。コピーＭＵＸモジュール７４５はビデオ基本ストリームを受け、デマルチプレクサMPEG TSモジュール７４０からの出力バッファを、ダウンストリームコンポーネントによって要求されるシングルバッファパケットに記録する。コピーＭＵＸモジュール７４５はいかなるビデオ処理をも実行しない。
【００３７】
データは、次に、コピーＭＵＸモジュール７４５からビットレートトランスコード処理ブロック７１５へ進む。処理ブロック７１５でのスプリット部７５０は、ビットストリームを上述の方法で第１のストリームと第２のストリームに分割する。ＢＲＴ'トランスコーダ７５５は第１のストリームをトランスコードする。その後マージ部７６０は、トランスコードされた第１のストリームと、第２のストリームを上述の方法で組み合わせる。トランスコード処理ブロック７１５の出力は部分的にトランスコードされたビットストリームである。
【００３８】
上述のように、本発明の特定の実施形態は、処理ブロック７１５に示されるタイプの選択された個数のカスケード型処理ブロックを含んでも良い。図８は、カスケード型処理ブロックのチェーンの最後の処理ブロックを表すビットレートトランスコード処理ブロック８０５を例示する。処理ブロック８０５の出力は完全にトランスコードされたビットストリームである。
【００３９】
図８は、また、マルチプレクサ部８３０と出力部８４０を例示する。マルチプレクサ部８３０は、処理ブロック８０５からのビデオ基本ストリームをトランスポートストリームに多重化し、デマルチプレクサ７１０によって実行された処理を逆転する。マルチプレクサ部８３０の出力は出力部８４０へ供給される。
【００４０】
出力部８４０は３つの並列出力モジュールを含んで構成される。「Ｆライト」出力モジュール８５０はコンピュータファイルフォーマットでマルチメディアデータを出力する。「Ｆライト」出力モジュール８５０は、マルチメディアデータをＰＣＩバス、又は、ファイル入出力フォーマットを使用するその他の類似したデバイスへ出力する。「ＶＯストリーム」出力モジュール８６０は、マルチメディアデータをビットストリーム宛先へリアルタイムで出力する。頭文字「ＶＯ」は、「ビデオ出力」を表す。「ベリファイア」出力モジュール８７０は、「プロデューサ」入力モジュール７３５によって発生させられたテストビットストリームを検証し出力する能力を備えた開発テストツールである。
【００４１】
図９は、本発明の並列トランスコード処理装置及び方法を使用して、MPEG-2ビデオ信号の高品位（ＨＤ）ビットストリームをトランスコードする高品位（ＨＤ）トランスコード処理チェーン９００を例示するブロック図である。高品位（ＨＤ）ビットポンプ９０５は、ＨＤビットストリームを電気変換部９１０へ供給する。電気変換部９１０は、トランスコード処理チェーン９００のＢＲＴ'部で利用されるフォーマットに依存して、入力ビットストリームを、低電圧差信号（ＬＶＤＳ）フォーマットから、（１）エミッタ結合ロジック（ＥＣＬ）フォーマット、又は、（２）トランジスタ・トランジスタ・ロジック（ＴＴＬ）フォーマットへ変換する。
【００４２】
この典型的な実施形態において、トランスコード処理チェーン９００は、３個のＢＲＴ'部を含んで構成される。ＢＲＴ'部番号１の９１５と、ＢＲＴ'部番号２の９２０と、ＢＲＴ'部番号３の９２５とが存在する。ＢＲＴ'部番号３  ９２５の完全にトランスコードされた出力は電気変換部９３０へ供給される。電気変換部９３０は、トランスコードされたビットストリームを、（１）エミッタ結合ロジック（ＥＣＬ）フォーマット、又は、（２）トランジスタ・トランジスタ・ロジック（ＴＴＬ）フォーマットから、低電圧差信号（ＬＶＤＳ）フォーマットへ変換する。電気変換部９３０は、次に、変換後のトランスコードされたビットストリームを高品位（ＨＤ）デコーダ９３５へ送る。
【００４３】
ＨＤビットポンプ９０５は、ＨＤ  MPEG-2トランスポートストリームを生成する。３つのＢＲＴ'部９１５、９２０及び９２５は、MPEG-2トランスポートストリームをトランスコードする。ＨＤデコーダ９３５は、トランスコードされたビデオストリームをリアルタイムで復号化し表示する。
【００４４】
ＨＤビットポンプ９０５は、毎秒２０メガバイト（２０Ｍｂ／ｓ）のトランスポートストリームを生成する。トランスポートストリームは、ＢＲＴ'部９１５で逆多重化され、毎秒１０メガビット（１０Ｍｂ／ｓ）の目標出力ビットレートでトランスコードされたスライスの３分の１（１／３）を有する。ＢＲＴ'部９１５の出力は、毎秒２０メガビット（２０Ｍｂ／ｓ）のレートで送出される。ストリームの３分の１（１／３）が２０Ｍｂ／ｓから１０Ｍｂ／ｓへトランスコードされているので、出力データレートは２０Ｍｂ／ｓではなく、２０Ｍｂ／ｓよりも６分の１（１／６）だけ低い。その理由は、（１）ビットストリームのうちの１番目のトランスコードされていない３分の１の部分のレートは２０Ｍｂ／ｓであり、（２）ビットストリームのうちの２番目のトランスコードされていない３分の１の部分のレートは２０Ｍｂ／ｓであり、（３）ビットストリームのうちのトランスコードされている３分の１の部分のレートは１０Ｍｂ／ｓであるからである。
【００４５】
ＢＲＴ'部９１５から２０Ｍｂ／ｓの固定データレートで出力し続けるために、ＢＲＴ'部９１５の出力コンポーネントは、その出力に空のデータパケットを発生する。即ち、ＢＲＴ'部９１５は、ＢＲＴ'部９１５の出力データレートを２０Ｍｂ／ｓに一致させるため、十分な個数の空のデータパケットを発生し付加する。空のデータパケットは完全なデータパケットと同じサイズである。空のデータパケットは、送信するために完全なデータパケットと同じ時間を要するが、空のデータパケットはデータを含まない。ＢＲＴ'部９１５は、５個の完全なデータパケットおきに１個の空のデータパケットを送出する。ＢＲＴ'部９１５の実効出力ビットレートは、毎秒１６  ２／３メガビット（１６  ２／３Ｍｂ／ｓ）である。
【００４６】
ＢＲＴ'部９２０はＢＲＴ'部９１５の出力を受ける。ＢＲＴ'部９２０は、ＢＲＴ'部９１５によって送られた空のデータパケットを検出する能力を備えている。ＢＲＴ'部９２０は空のデータパケットを捨てる。ＢＲＴ'部９２０は、スライスの２番目の３分の１（１／３）をトランスコードする。これにより得られる出力ビットレートは、毎秒１３  １／３メガビット（１３  １／３Ｍｂ／ｓ）である。なぜならば、（１）ビットストリームのうちの未だトランスコードされていない３分の１の部分のレートは２０Ｍｂ／ｓであり、（２）ビットストリームのうちの１番目のトランスコードされた３分の１の部分のレートは１０Ｍｂ／ｓであり、（３）ビットストリームのうちの２番目のトランスコードされた３分の１の部分のレートは１０Ｍｂ／ｓであるからである。出力ビットレートを計算するための別の方法は、２０Ｍｂ／ｓビットレートに数量（１−１／６−１／６）を乗じることである。これは、２０Ｍｂ／ｓの３分の２倍（２／３）と等しい。これにより、１３  １／３Ｍｂ／ｓの出力ビットレートが与えられる。
【００４７】
ＢＲＴ'部９２０から２０Ｍｂ／ｓの固定データレートで出力し続けるために、ＢＲＴ'部９２０の出力コンポーネントは、その出力に空のデータパケットを発生する。即ち、ＢＲＴ'部９２０は、ＢＲＴ'部９２０の出力データレートを２０Ｍｂ／ｓに一致させるため、十分な個数の空のデータパケットを発生し付加する。ＢＲＴ'部９２０は、３個の完全なデータパケットおきに２個の空のデータパケットを送出する。ＢＲＴ'部９２０の実効出力ビットレートは、毎秒１３  １／３メガビット（１３  １／３Ｍｂ／ｓ）である。
【００４８】
ＢＲＴ'部９２５はＢＲＴ'部９２０の出力を受ける。ＢＲＴ'部９２５は、ＢＲＴ'部９２０によって送られた空のデータパケットを検出する能力を備えている。ＢＲＴ'部９２５は空のデータパケットを捨てる。ＢＲＴ'部９２５は、スライスの３番目の３分の１（１／３）をトランスコードする。これにより得られる出力ビットレートは、毎秒１０メガビット（１０Ｍｂ／ｓ）である。なぜならば、（１）ビットストリームのうちの１番目のトランスコードされた３分の１の部分のレートは１０Ｍｂ／ｓであり、（２）ビットストリームのうちの２番目のトランスコードされた３分の１の部分のレートは１０Ｍｂ／ｓであり、（３）ビットストリームのうちの３番目のトランスコードされた３分の１の部分のレートは１０Ｍｂ／ｓであるからである。出力ビットレートを計算するための別の方法は、２０Ｍｂ／ｓビットレートに数量（１−１／６−１／６−１／６）を乗じることである。これは、２０Ｍｂ／ｓの半分（１／２）と等しい。これにより、１０Ｍｂ／ｓの出力ビットレートが与えられる。
【００４９】
ＢＲＴ'部９２５から２０Ｍｂ／ｓの固定データレートで出力し続けるために、ＢＲＴ'部９２５の出力コンポーネントは、その出力に空のデータパケットを発生する。即ち、ＢＲＴ'部９２５は、ＢＲＴ'部９２５の出力データレートを２０Ｍｂ／ｓに一致させるため、十分な個数の空のデータパケットを発生し付加する。ＢＲＴ'部９２５は、１個の完全なデータパケットおきに１個の空のデータパケットを送出する。ＢＲＴ'部９２５の実効出力ビットレートは、毎秒１０メガビット（１０Ｍｂ／ｓ）である。
【００５０】
ＢＲＴ'部９２５からの完全にトランスコードされたビットストリームはＨＤデコーダへ供給されることになる。ＨＤデコーダ９３５はビットストリーム中の空のデータパケットを検出する能力を備えていないので、空のデータパケットは、ビットストリームがＨＤデコーダ９３５に到達する前に、ビットストリームから除去されなければならない。これは、図１０に示されたタイプのクロックレート制御回路１０００を用いることにより実現できる。クロックレート制御回路１０００は、ＢＲＴ'部９２５の出力コンポーネント内に組み込んでもよい。クロックレート制御回路１０００は、ＨＤデコーダ９３５がＢＲＴ'部９２５からデータを受ける際のレートを調整するため、ＢＲＴ'部９２５の出力のクロックレートを調整する。
【００５１】
クロックレート制御モジュール１０００において、プロデューサモジュール１０１０はデータパケットをバッファ１０２０へ送る。有利な一実施形態では、バッファ１０２０は最大で４０個のデータパケットを収容する。各データパケットは48,128バイト収容する。バッファ１０２０は、決して完全に一杯に、又は、完全に空にしてはならない。なぜならば、これらの二つの状態は何れも誤りのある出力データを生ずるからである。
【００５２】
バッファ１０２０は、データパケットをコンシューマモジュール１０３０へ供給する。コンシューマモジュール１０３０はバッファ１０２０からデータパケットを受け取り、そのデータパケットを（ＨＤデコーダ９３５のような）外部装置へ送る。コンシューマモジュール１０３０がデータパケットを使用する際のレートは、コントローラ１０４０によってコンシューマモジュール１０３０へ供給されるクロックレートの値だけによって決定される。コントローラ１０４０の目的は、バッファ１０２０がプロデューサモジュール１０１０のデータレートに追従し、バッファ１０２０がほぼ半分まで満ちた状態で保たれるように、コンシューマモジュール１０３０のクロックレートを調整することである。バッファ１０２０は、コントローラ１０４０に１０２０の充満状態を知らせる信号を供給する。
【００５３】
コントローラ１０４０が呼び出される周波数はサンプルレートである。このサンプルレートは、サンプルレートモジュール１０５０によってコントローラ１０４０へ供給される。コントローラ１０４０は、サンプルレートごとにクロックレートを調整するので、バッファ１０２０の充満状態はほぼ５０パーセント（５０％）で維持される。
【００５４】
プロデューサモジュール１０１０は、毎秒１メガビット（１Ｍｂ／ｓ）乃至毎秒２０メガビット（２０Ｍｂ／ｓ）のレートでバッファ１０２０を満たす。コンシューマモジュール１０３０は、コントローラ１０４０によって供給されるクロックレートに応じて、毎秒１メガビット（１Ｍｂ／ｓ）乃至毎秒２０メガビット（２０Ｍｂ／ｓ）のレートでバッファ１０２０を空にする。
【００５５】
有利な一実施形態では、コントローラ１０４０は、デジタル位相ロックループ（ＰＬＬ）回路（図示せず）を含む。誤り信号Ｅは、バッファ１０２０内のパケット数を、数値２０から減算することによって計算されても良い。誤り信号Ｅは、次に、定数Ｋで乗算され、クロックレートへ帰還される。この関係は次式：
クロックレート［ｎ］＝クロックレート［ｎ−１］＋Ｋ＊Ｅ
によって表現され、式中、ｎは個別のサンプル時間を表す。
【００５６】
コントローラ１０４０の位相ロックループ（ＰＬＬ）回路は、バッファ１０２０がオーバーフローしないように（即ち、４０パケットを上回らないように）、若しくは、アンダーフローしないように（即ち、０パケットに達しないように）、コンシューマモジュール１０３０のクロックレートを調整する。
【００５７】
図９に関して説明した本発明の有利な実施形態は、ＢＲＴ'部９２５にクロックレート制御回路１０００を採用する。本発明の別の有利な実施形態では、同様のクロックレート制御回路（図示せず）が各ＢＲＴ'部９１５、９２０及び９２５の出力コンポーネントに採用され、各ＢＲＴ'部の出力のビットレートを調整する。この別の有利な実施形態では、前述のケースのように空のデータパケットを発生させ追加する必要がない。
【００５８】
ビットレートトランスコード処理は、本発明の装置及び方法を使用して実現され得るマルチメディア処理の一つのタイプに過ぎない。本発明の装置及び方法は、並列スライスパース方法を用いるメディアプロセッサにおいて他のタイプのマルチメディア信号を処理するためにも使用されても良い。
【００５９】
図１１は、本発明による並列スライスパース方法の有利な実施形態を説明するフローチャートである。この方法のステップは、全体として参照番号１１００によって示されている。Ｎを、入力マルチメディアビットストリームを処理している処理チェーン内のメディアプロセッサの個数に一致させる（ステップ１１１０）。この数値Ｎは、２以上の整数である。
【００６０】
処理チェーン内の第１のメディアプロセッサは、ビットストリームの（１／Ｎ）うちの１番目のインターリーブされた部分を処理する（ステップ１１２０）。次に、処理チェーン内の第２のメディアプロセッサは、ビットストリームの（１／Ｎ）のうちの２番目のインターリーブされた部分を処理する（ステップ１１３０）。このプロセスは、処理チェーン内の各メディアプロセッサに対し継続する。メディアプロセッサ毎にこのプロセスが継続することは、図１１において、ステップ１１３０とステップ１１４０の間の省略記号（３個のドット）によって示されている。
【００６１】
処理チェーン内の最後のメディアプロセッサはＮ番目のメディアプロセッサである。処理チェーン内のＮ番目のメディアプロセッサは、ビットストリームの（１／Ｎ）のうちのＮ番目のインターリーブされた部分を処理する（ステップ１１４０）。完全に処理されたビットストリームは、次に、処理チェーンからリアルタイムで出力される（ステップ１１５０）。
【００６２】
図１２は、メディアストリームの第１のストリーム部がマルチメディア処理アルゴリズムによって処理される本発明の並列メディアプロセッサの動作を説明するブロック図である。Ｐ１はビデオストリームの第１の識別部分（例えば、ビデオフレームの上半分）を表し、Ｐ２はビデオストリームの第２の識別部分（例えば、ビデオフレームの下半分）を表すことにする。
【００６３】
ビットレートトランスコード処理に関して説明したように、ビデオストリームは、上述の並列スライスパース方法によって分割し、組み合わせてもよい。ビデオストリームデータはチェーン全体をリアルタイムで流れる。部分的に処理されたビデオストリームデータは、各メディアプロセッサの間をリアルタイムで転送される。
【００６４】
図１２は、メディアプロセッサの動作の第１の部分を説明するブロック図である。動作の第１の部分は、全体として参照番号１２００によって示される。入力ビットストリーム１２０５は、記号「Ｐ１」と「Ｐ２」によって表される。記号「Ｐ１」と「Ｐ２」は、それぞれ、ビットストリーム１２０５の一部、即ち、「スライス」を表す。スプリット部１２１０は、ビットストリーム１２０５を第１のストリーム１２１５と第２のストリーム１２２０に分割する。図１２に示されるように、第１のストリーム１２１５は、ビットストリーム４１５のうちの記号「Ｐ１」によって表された部分を含んで構成される。第２のストリーム１２２０は、ビットストリーム１２０５の残りの部分を含んで構成される。即ち、第２のストリーム１２２０は、ビットストリーム１２０５のうちの記号「Ｐ２」によって表された部分を含んで構成される。
【００６５】
処理アルゴリズム部１２２５は、第１のストリーム１２１５を処理し、処理済みの第１のストリーム１２３０を生成する。第１の処理済みのストリーム１２３０は、ビットストリーム１２０５のうちの記号「Ｐ１'」によって表された処理済みの部分を含んで構成される。ビットストリームの指定されたスライス上のプライム記号は、処理動作がそのビットストリームのスライスに対して実行されたことを示す。処理済の第１のストリーム１２３０と第２のストリーム１２２０は、マージ部１２３５で組み合わされ、部分的に処理済みのストリーム１２４０を作成する。図１２に示されるように、部分的に処理済みのストリーム１２４０は、ビットストリーム１２０５のうちの記号「Ｐ１'」によって指定された部分と記号「Ｐ２'」によって指定された部分と、を含んで構成される。動作のこの段階で、ビットストリーム１２０５のビットストリームスライスの半分（１／２）は処理済みである。
【００６６】
図１３は、メディアプロセッサの動作の第２の部分を説明するブロック図である。この動作の第２の部分は、全体として参照番号１３００で示されている。入力ビットストリーム１２４０は、動作の第１の部分１２００からの出力と同じである。ビットストリーム１２４０は、記号「Ｐ１'」と「Ｐ２'」とによって表現される。各記号は、ビットストリーム１２４０の一部分、即ち、「スライス」を表現する。スプリット部１３１０は、ビットストリーム１２４０を第１のストリーム１３１５と第２のストリーム１３２０に分割する。図１３に示されるように、第１のストリーム１３１５は、ビットストリーム１２４０のうちの記号「Ｐ２'」によって表現された部分を含んで構成される。第２のストリーム１３２０は、ビットストリーム１２４０の残りの部分を含んで構成される。即ち、第２のストリーム１３２０は、ビットストリーム１２４０のうちの記号「Ｐ１'」によって表された部分を含んで構成される。
【００６７】
処理アルゴリズム部１３２５は、第１のストリーム１３１５を処理し、処理済みの第１のストリーム１３３０を生成する。第１の処理済みのストリーム１３３０は、ビットストリーム１２４０のうちの記号「Ｐ２'」によって表された処理済みの部分を含んで構成される。処理済の第１のストリーム１３３０と第２のストリーム１３２０は、マージ部１３２５で組み合わされ、部分的に処理済みのストリーム５４０を作成する。図１３に示されるように、部分的に処理済みのストリーム１３４０は、ビットストリーム１２４０のうちの記号「Ｐ１'」によって指定された部分と記号「Ｐ２'」によって指定された部分と、を含んで構成される。動作のこの段階で、ビットストリーム１２０５のビットストリームスライスの全部は処理済みである。
【００６８】
図１４は、本発明の並列処理装置及び方法を用いてマルチメディア信号のビットストリームを処理する処理チェーン１４００を説明するブロック図である。この典型的な実施形態では、マルチメディア信号供給元１４０５は、マルチメディア信号を、Ｎ個のプロセッサ部を含んで構成された処理チェーンに供給する。Ｎ個のプロセッサ部は、プロセッサ部番号１の１４１０と、プロセッサ部番号２の１４１５と、プロセッサ部番号Ｎの１４２０である。プロセッサ部番号Ｎの１４２０の完全に処理済みの出力は宛先モジュール１４２５へ供給される。
【００６９】
クロック制御回路１０００によって表されたタイプのクロック制御回路は、処理チェーン１４００の出力ビットストリームレートを調整するため、最後のプロセッサ部（即ち、プロセッサ部番号Ｎの１４２０）で使用してもよい。或いは、クロック制御回路は、処理チェーン１４００の各プロセッサ部（１４１０、１４１５、１４２０）の出力コンポーネントで使用し、各プロセッサ部の出力ビットストリームレートを調整してもよい。
【００７０】
本発明は詳細に記述されているが、当業者は、最広義の形式で本発明の精神及び範囲から逸脱することなく、様々な変更、置換及び代替を行い得ることを認めるであろう。
【図面の簡単な説明】
【００７１】
【図１】本発明によるビットレートトランスコーダの有利な実施形態を説明するブロック図である。
【図２】ファイルからのMPEG-2ビデオデータをトランスコードする本発明によるビットレートトランスコーダの有利な実施形態を説明するブロック図である。
【図３】高品位（ＨＤ）サーバーからのMPEG-2ビデオストリームをトランスコードする本発明によるビットトランスコーダの有利な実施形態を説明するブロック図である。
【図４】ビットストリームの第１のインターリーブ部がトランスコードされる本発明によるビットレートトランスコーダの動作の第１の部分を説明するブロック図である。
【図５】図４のビットストリームの第２のインターリーブ部がトランスコードされる本発明によるビットレートトランスコーダの動作の第２の部分を説明するブロック図である。
【図６】図４のビットストリームの第３のインターリーブ部がトランスコードされる本発明によるビットレートトランスコーダの動作の第３の部分を説明するブロック図である。
【図７】本発明によるビットレートトランスコーダの有利な一実施形態の入力ブロック、デマルチプレクサブロック、及び処理ブロックを説明するブロック図である。
【図８】本発明によるビットレートトランスコーダの有利な一実施形態の処理ブロック、マルチプレクサブロック、及び出力ブロックを説明するブロック図である。
【図９】本発明によるMPEG-2ビデオ信号の高品位（ＨＤ）ビットストリームをトランスコードする高品位（ＨＤ）トランスコード処理チェーンを説明するブロック図である。
【図１０】本発明によるビットレートトランスコーダと共に使用するためのクロックレート制御回路を説明するブロック図である。
【図１１】本発明による並列スライスパース方法を説明する有利な実施形態を説明するフローチャートである。
【図１２】メディアストリームの第１の部分が処理される本発明の並列メディアプロセッサの動作を説明するブロック図である。
【図１３】図１２のメディアストリームの第２の部分が処理される本発明の並列メディアプロセッサの動作を説明するブロック図である。
【図１４】本発明によるメディアストリームを並列処理するカスケード型ビデオ回路を説明するブロック図である。
【図１】
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【図２】
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【図３】
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【図４】
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【図５】
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【図６】
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【図７】
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【図８】
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【図９】
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【図１０】
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【図１１】
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【図１２】
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【図１３】
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【図１４】
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【国際公開パンフレット】
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【国際調査報告】
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