(57)【要約】【課題】クロムの下部膜とアルミニウム合金の導電膜を順次に積層しパターニングし、基板上にゲート線、ゲート電極及びゲートパッドを含む横方向のゲート配線を形成する。次に、ゲート絶縁膜を形成し、その上に半導体層及び抵抗接触層を順次に形成する。次いで、クロムの下部膜とアルミニウム合金の上部膜からなる導電層を積層しパターニングし、ゲート線と交差するデータ線、ソース電極、ドレーン電極及びデータパッドを含むデータ配線を形成する。次いで、保護膜を積層しパターニングし、ドレーン電極、ゲートパッド及びデータパッドを露出する接触孔を形成する。この時、接触孔はゲート配線及びデータ配線の下部膜側壁が露出するようにドレーン電極、ゲートパッド及びデータパッドの境界線が接触孔から露出されるように形成する。次いで、ＩＺＯを積層しパターニングし、ドレーン電極、ゲートパッド及びデータパッドの側壁を通じてこれらと連結される画素電極、補助ゲートパッド及び補助データパッドを形成する。
2005506683.tif 000002
【特許請求の範囲】
【請求項１】
基板上に第１導電層からなる配線を形成する段階、
前記配線を覆う絶縁膜を積層する段階、
前記絶縁膜をパターニングし前記配線の側壁を露出する接触孔を形成する段階、及び
前記絶縁膜上に前記接触孔を通じて前記配線の前記側壁と接触する第２導電層を形成する段階、を含む配線の接触構造形成方法。
【請求項２】
前記第１導電層は、アルミニウムやアルミニウム合金の上部膜とモリブデンやモリブデン合金またはクロムの下部膜で形成する請求項１に記載の配線の接触構造形成方法。
【請求項３】
前記配線の外に位置する前記接触孔の境界線と、これと隣接した前記配線の境界線の間隔は２μｍ以内になるように前記接触孔を形成する請求項１に記載の配線の接触構造形成方法。
【請求項４】
前記第２導電層は透明な導電物質で形成する請求項１に記載の配線の接触構造形成方法。
【請求項５】
前記導電物質はＩＺＯである請求項４に記載の配線の接触構造形成方法。
【請求項６】
基板上に開口部を有する配線を形成する段階、
前記配線を覆う絶縁膜を積層する段階、
前記絶縁膜をパターニングし前記開口部を露出する接触孔を形成する段階、及び
前記絶縁膜上に前記接触孔を通じて前記配線と接触する第１導電層を形成する段階、を含む配線の接触構造形成方法。
【請求項７】
前記配線はアルミニウムやアルミニウム合金の上部膜と、モリブデンやモリブデン合金またはクロムの下部膜からなる第２導電層で形成される請求項６に記載の配線の接触構造形成方法。
【請求項８】
前記開口部は上部膜にのみ形成されている請求項７に記載の配線の接触構造形成方法。
【請求項９】
前記開口部は４μｍ×４μｍ以下の面積で形成される請求項８に記載の配線の接触構造形成方法。
【請求項１０】
前記上部膜及び下部膜は、一つの感光膜パターンを用いた写真エッチング工程で形成する請求項９に記載の配線の接触構造形成方法
【請求項１１】
前記第１導電層はＩＺＯで形成する請求項６に記載の配線の接触構造形成方法。
【請求項１２】
基板上に形成されている配線、
前記配線を覆っており、前記配線の側壁を露出する接触孔を有する絶縁膜、
前記絶縁膜上にＩＺＯで形成され、前記接触孔を通じて前記配線の側壁と接触している導電層、を含む配線の接触構造。
【請求項１３】
前記配線はクロムまたはモリブデンやモリブデン合金の下部膜とアルミニウムやアルミニウム合金の上部膜からなる請求項１２に記載の配線の接触構造。
【請求項１４】
基板上部に形成されており、開口部を有する配線、
前記配線を覆い、少なくとも前記開口部を露出する接触孔を有する絶縁膜、
前記絶縁膜上にＩＺＯで形成され、前記接触孔及び前記開口部を通じて前記配線と接触している導電層、を含む配線の接触構造。
【請求項１５】
前記配線はクロムまたはモリブデンやモリブデン合金の下部膜とアルミニウムやアルミニウム合金の上部膜からなる請求項１４に記載の配線の接触構造。
【請求項１６】
前記開口部は前記上部膜にのみ形成されている請求項１５に記載の配線の接触構造。
【請求項１７】
前記開口部は４μｍ×４μｍ以下の面積で形成されている請求項１４に記載の配線の接触構造。
【請求項１８】
絶縁基板上に形成されているゲート配線、
前記ゲート配線を覆うゲート絶縁膜、
前記ゲート絶縁膜上に形成されている半導体層、
前記半導体層上に形成されているデータ配線、
前記データ配線を覆っている保護膜、
前記ゲート絶縁膜または前記保護膜上に形成され、前記ゲート絶縁膜、または前記保護膜の第１接触孔を通じて前記ゲート配線または前記データ配線の側壁と接触している透明導電膜パターン、を含む薄膜トランジスタ基板。
【請求項１９】
前記ゲート配線または前記データ配線は、クロムまたはモリブデンやモリブデン合金の下部膜とアルミニウムやアルミニウム合金の上部膜からなる請求項１８に記載の薄膜トランジスタ基板。
【請求項２０】
前記ゲート絶縁膜及び前記保護膜は窒化ケイ素からなる請求項１８に記載の薄膜トランジスタ基板。
【請求項２１】
前記透明導電膜パターンはＩＺＯからなる請求項１８に記載の薄膜トランジスタ基板。
【請求項２２】
前記ゲート配線は横方向に延びているゲート線、前記ゲート線と連結されているゲート電極及び外部から走査信号の伝達を受けて前記ゲート線に伝達するゲートパッドを含み、前記データ配線は縦方向に延びているデータ線、前記データ線と連結されているソース電極、前記ソース電極と分離され前記ゲート電極を中心に前記ソース電極と対向し、前記第１接触孔を通じて側壁が露出しているドレーン電極及び外部から映像信号の伝達を受ける前記データ線に伝達するデータパッドを含む請求項１８に記載の薄膜トランジスタ基板。
【請求項２３】
前記保護膜は、前記データパッドを露出する第２接触孔及び前記ゲート絶縁膜と共に前記ゲートパッドを露出する第３接触孔を有し、前記第１乃至第３接触孔の大きさは４μｍ×４μｍ以上、１０μｍ×１０μｍ以下である請求項２２に記載の薄膜トランジスタ基板。
【請求項２４】
前記透明導電膜パターンは、前記ドレーン電極の側壁と接触する画素電極、前記第２及び第３接触孔を通じて前記データパッド及び前記ゲートパッドと各々連結されている補助データパッドまたは補助データパッドと接触されている請求項２３に記載の薄膜トランジスタ基板。
【請求項２５】
前記第２または第３接触孔では、前記データパッドまたは前記ゲートパッドの側壁が露出されており、前記補助データパッドまたは補助ゲートパッドは少なくとも前記データパッド及び前記ゲートパッドの側壁と接触されている請求項２４に記載の薄膜トランジスタ基板。
【請求項２６】
絶縁基板上にゲート線、前記ゲート線と連結されているゲート電極を含むゲート配線を形成する段階、
前記ゲート配線を覆うようにゲート絶縁膜を積層する段階、
前記ゲート絶縁膜上に半導体層を形成する段階、
前記半導体層及び前記ゲート絶縁膜上に前記ゲート線と交差するデータ線、前記データ線と連結され、前記ゲート電極に隣接するソース電極及び前記ゲート電極に対して前記ソース電極の対向側に位置するドレーン電極を含むデータ配線を形成する段階、
保護膜を積層する段階、
前記保護膜をパターニングして、前記ドレーン電極の側壁を露出する第１接触孔を形成する段階、
前記保護膜上に少なくとも前記ドレーン電極の側壁と接触する画素電極を形成する段階、を含む液晶表示装置用薄膜トランジスタ基板の製造方法。
【請求項２７】
前記ゲート配線または前記データ配線は、クロムまたはモリブデンやモリブデン合金の下部膜とアルミニウムやアルミニウム合金の上部膜で形成される請求項２６に記載の液晶表示装置用薄膜トランジスタ基板の製造方法。
【請求項２８】
前記ゲート絶縁膜及び前記保護膜は窒化ケイ素で形成される請求項２６に記載の液晶表示装置用薄膜トランジスタ基板の製造方法。
【請求項２９】
前記画素電極はＩＺＯで形成される請求項２６に記載の液晶表示装置用薄膜トランジスタ基板の製造方法。
【請求項３０】
前記ゲート配線は外部から走査信号の伝達を受けて、走査信号を前記ゲート線に伝達するゲートパッドをさらに含み、
前記データ配線は外部から映像信号の伝達を受けて、映像信号を前記データ線に伝達するデータパッドをさらに含み、
前記保護膜は前記データパッド第２接触孔及び前記ゲート絶縁膜と共に前記ゲートパッドを露出する第３接触孔を有し、
前記画素電極と同一な層に前記第２及び第３接触孔を通じて前記ゲートパッド及び前記データパッドと電気的に連結される補助ゲートパッドと補助データパッドをさらに形成する請求項２６に記載の液晶表示装置用薄膜トランジスタ基板の製造方法。
【請求項３１】
前記データ配線及び前記半導体層は、部分的に異なる厚さの感光膜パターンを用いた写真エッチング工程で共に形成する請求項２６に記載の液晶表示装置用薄膜トランジスタ基板の製造方法。
【請求項３２】
前記感光膜パターンは、第１の厚さを有する第１部分、前記第１の厚さより厚い第２部分、前記第１及び第２部分を除いた厚さを有しない第３部分を含む請求項３１に記載の液晶表示装置用薄膜トランジスタ基板の製造方法。
【請求項３３】
前記写真エッチング工程で前記感光膜パターンは第１領域、前記第１領域より低い透過率を有する第２領域及び前記第１領域より高い透過率を有する第３領域を含む、光マスクを用いて形成する請求項３２に記載の液晶表示装置用薄膜トランジスタ基板の製造方法。
【請求項３４】
前記写真エッチング工程で前記第１部分は、前記ソース電極と前記ドレーン電極との間、前記第２部分は前記データ配線上に位置するように形成する請求項３３に記載の液晶表示装置用薄膜トランジスタ基板の製造方法。
【請求項３５】
前記第１乃至第３領域の透過率を異ならせて調節するために、前記光マスクには半透明膜または露光器の分解能より小さいスリットパターンが形成されている請求項３４に記載の液晶表示装置用薄膜トランジスタ基板の製造方法。
【請求項３６】
前記第１部分の厚さは前記第２部分の厚さに対して１/２以下に形成する請求項３５に記載の液晶表示装置用薄膜トランジスタ基板の製造方法。
【請求項３７】
前記半導体層と前記データ配線との間に抵抗性接触層を形成する段階をさらに含む請求項２１に記載の液晶表示装置用薄膜トランジスタ基板の製造方法。
【請求項３８】
前記データ配線と前記接触層及び前記半導体層を一つのマスクを用いて形成する請求項３７に記載の液晶表示装置用薄膜トランジスタ基板の製造方法。
【発明の詳細な説明】
【技術分野】
【０００１】
本発明は、配線の接触構造及びその製造方法とこれを含む薄膜トランジスタ基板及びその製造方法に関する。
【背景技術】
【０００２】
一般に半導体装置の配線は信号を伝達する手段として用いられるため、信号遅延を最少化することが要求される。ここで、信号遅延を防止するために、配線は低抵抗を有する金属物質、特にアルミニウム（Ａｌ）やアルミニウム合金（Ａｌ  ａｌｌｏｙ）などのようなアルミニウム系金属物質を使用することが一般的である。しかし、アルミニウムやアルミニウム合金の配線は物理的、化学的特性が脆いため、他の導電物質と連結される際に接触部で腐蝕が発生し、半導体素子の特性を低下させる問題がある。特に、液晶表示装置のように、透明な導電物質であるＩＴＯを使用して画素電極を形成する場合に、ＩＴＯとアルミニウムやアルミニウム合金の配線と接する接触部でアルミニウムやアルミニウム合金の配線が腐食する。このような問題を解決するために、ＩＴＯの代わりにアルミニウム系の配線と接しても腐蝕が発生しないＩＺＯを画素電極として形成する技術が開発されているが、ＩＺＯの場合は接触部における接触抵抗が増加する問題がある。
【発明の開示】
【発明が解決しようとする課題】
【０００３】
本発明が目的とする技術的課題は、低抵抗物質からなると同時に低抵抗の接触特性を有する配線の接触構造及びその製造方法の提供にある。本発明の他の課題は、接触特性の良い配線の接触構造を含む薄膜トランジスタ基板及びその製造方法を提供することにある。
【課題を解決するための手段】
【０００４】
このような問題点を解決するために、本発明では、配線にアルミニウムやアルミニウム合金の導電膜を含めて形成し、接触部で接触孔を通じて側壁が露出されるように形成するか、または二重膜のうち一つに開口部を形成して他の膜を露出させる。この時、接触孔を通じて配線と連結されるＩＺＯの導電層が、接触孔での段差によって断線しないように接触孔の境界線とこれと隣接した配線の境界線との間隔が２μｍ範囲を超えないことが好ましい。
【０００５】
まず、本発明による配線の接触構造及びその製造方法において、基板上部に第１導電層により配線を形成し、その上部に絶縁膜を積層する。次に、絶縁膜をパターニングして配線の側壁を露出する接触孔を形成し、絶縁膜上に接触孔を通じて配線の側壁と接触する第２導電層を形成する。この時、第１導電層は低抵抗を有するアルミニウムやアルミニウム合金の上部膜と、ＩＺＯと低い接触抵抗を有するモリブデンやモリブデン合金またはクロムの下部膜とで形成されることが好ましい。第２導電層はＩＺＯで形成することが好ましい。
【０００６】
また、配線の外に位置する接触孔の境界線とこれと隣接した配線の境界線との間隔は２μｍ以内であるように接触孔を形成するのが好ましい。
【０００７】
また、本発明による他の配線の接触構造及びその製造方法において、基板上に開口部を有する配線を形成し、配線を覆う絶縁膜を積層する。次に、絶縁膜をパターニングして開口部を露出する接触孔を形成し、絶縁膜上に接触孔を通じて配線と接触する第１導電層を形成する。ここで、配線は、アルミニウムやアルミニウム合金の上部膜とモリブデンやモリブデン合金またはクロムの下部膜からなる第２導電層で形成し、第１導電層はＩＺＯで形成するのが好ましい。この時、開口部は上部膜にのみ形成し、開口部は４μｍ×４μｍ以下の面積を有するように形成することが良い。
【０００８】
上部膜及び下部膜は、一つの感光膜パターンを用いた写真エッチング工程で形成できる。
【０００９】
このような本発明による配線の接触構造及びその製造方法は、薄膜トランジスタ基板及びその製造方法に適用することができる。
【００１０】
本発明による薄膜トランジスタ基板には、絶縁基板上にゲート配線が形成されており、ゲート配線を覆うゲート絶縁膜及びその上に半導体層が形成されている。ゲート絶縁膜上にはデータ配線が形成され、その上部には半導体層を覆う保護膜が形成されている。ゲート絶縁膜または保護膜上には、少なくともゲート配線またはデータ配線の外に一部の境界線が位置し、ゲート配線またはデータ配線の側壁を露出するゲート絶縁膜または保護膜の第１接触孔を通じてゲート配線またはデータ配線の側壁と接触している透明導電膜パターンが形成されている。
【００１１】
ここで、ゲート配線またはデータ配線は、クロムまたはモリブデンやモリブデン合金の下部膜とアルミニウムやアルミニウム合金の上部膜からなり、ゲート絶縁膜及び保護膜は窒化ケイ素からなり、透明導電膜パターンはＩＺＯからなることが好ましい。
【００１２】
ゲート配線は横方向に延びているゲート線、ゲート線と連結されているゲート電極及び外部から走査信号の伝達を受けてゲート線に伝達するゲートパッドを含み、データ配線は縦方向に延びているデータ線、データ線と連結されているソース電極、ソース電極と分離されゲート電極を中心にソース電極と対向し、第１接触孔を通じて側壁が露出されているドレーン電極及び外部から映像信号の伝達を受けてデータ線に伝達するデータパッドを含む。
【００１３】
この時、保護膜は、データパッドを露出する第２接触孔及びゲート絶縁膜と共にゲートパッドを露出させる第３接触孔を有し、第１乃至第３接触孔の大きさは４μｍ×４μｍ以上、１０μｍ×１０μｍ以下であるのが好ましい。透明導電膜パターンは、ドレーン電極の側壁と接触される。そして、画素電極は、第２及び第３接触孔を通じてデータパッド及びゲートパッドと各々連結されている補助データパッドまたは補助ゲートパッドと接触されている。この時、第２または第３接触孔では、データパッドまたはゲートパッドの側壁が露出されており、補助データパッドまたは補助ゲートパッドは少なくともデータパッド及びゲートパッドの側壁と接触されているのが好ましい。
【００１４】
このような本発明による薄膜トランジスタ基板の製造方法において、まず、絶縁基板上にゲート線、ゲート線と連結されているゲート電極を含むゲート配線を形成する。次に、ゲート配線を覆うゲート絶縁膜及びその上に半導体層を順次に形成し、ゲート線と交差するデータ線、データ線と連結され、ゲート電極に隣接するソース電極及びゲート電極に対してソース電極の対向側に位置するドレーン電極を含むデータ配線を形成する。次いで、保護膜を積層しパターニングして、少なくともドレーン電極の外に境界線が位置しドレーン電極の側壁を露出する第１接触孔を形成し、保護膜上に少なくともドレーン電極の側壁と接触する画素電極を形成する。
【００１５】
ここで、データ配線及び半導体層は、部分的に厚さが異なる感光膜パターンを用いた写真エッチング工程で共に形成でき、感光膜パターンは第１の厚さを有する第１部分、第１の厚さより厚い第２部分、厚さを有しない第３部分を含むことが好ましい。
【００１６】
写真エッチング工程で感光膜パターンは、第１領域、第１領域より低い透過率を有する第２領域及び第１領域より高い透過率を有する第３領域を含む光マスクを用いて形成される。そして、写真エッチング工程において、第１部分はソース電極とドレーン電極との間、第２部分はデータ配線上に位置するように形成することが好ましい。
【００１７】
第１乃至第３領域の透過率を異ならせて調節するために、光マスクには半透明膜または露光器の分解能より小さいスリットパターンが形成されており、第１部分の厚さは第２部分の厚さに対して１／２以下にすることが好ましい。半導体層とデータ配線との間に抵抗性接触層を形成でき、データ配線と接触層及び半導体層を一つのマスクを用いて形成できる。
【発明の効果】
【００１８】
本発明によれば、接触部から配線の側壁傾斜面を露出させ、ＩＺＯ膜との接触抵抗が低い導電膜とＩＺＯ膜とを接触させて、配線とＩＺＯ膜の接触抵抗を最少化し、接触部の信頼性を確保できる。また、低抵抗のアルミニウムやアルミニウム合金を含む導電膜を含む配線を形成することで、大画面、高精細の製品特性を向上させることができる。そして、製造工程を単純化して液晶表示装置用薄膜トランジスタ基板を製造するので、製造工程を単純化し、製造費用を削減できる。
【発明を実施するための最良の形態】
【００１９】
添付した図面を参照して本発明の実施例よる配線の接触構造及びその製造方法と、これを含む薄膜トランジスタ基板及びその製造方法に対して本発明の属する技術分野における通常の知識を有する者が容易に実施できるように詳細に説明する。
【００２０】
図１Ａ乃至図３Ｅは、本発明の実施例に配線の接触構造を示した図面である。ここで、図１Ａ、図２Ａ、図２Ｃ及び図３Ａ乃至図３Ｅは、配線の接触構造を示す配置図であり、図１Ｂ、図２Ｂ及び図２Ｄは、各々図１Ａ、図２Ａ及び図３ＣのＩｂ-Ｉｂ’、ＩＩｂ-ＩＩｂ’及びＩＩｄ-ＩＩｄ’線に沿った断面図である。
【００２１】
半導体装置、特に信号を伝達する配線として信号の遅延を最少化するためには、１５μΩｃｍ以下の低い比抵抗を有するアルミニウムやアルミニウム合金の金属物質が適する。この時、配線は外部から信号を受けたり、外部に信号を伝達するために他の導電層と連結されるが、製造過程で他の導電物質との接触抵抗が小さいことが要求される。このために、本発明の実施例による配線の接触構造製造方法では、図１Ａ及び図１Ｂのように、基板１０上にモリブデンやモリブデン合金またはクロムなどのようにＩＺＯと低い接触抵抗を有する導電物質の下部膜１１１と、低抵抗を有するアルミニウムやアルミニウム合金からなる上部膜１１２を含む第１導電層１１を積層しパターニングし、配線を形成し、配線１１を覆う絶縁膜１２を積層する。次に、絶縁膜１２をパターニングして配線１１を露出する接触孔１３を形成し、絶縁膜１２の上に接触孔１３を通じて配線１１と直接連結され、ＩＺＯからなる第２導電層１４を形成する。この時、絶縁膜１２の接触孔１３は、配線１１の側壁境界面、特に下部膜１１１の側壁境界面が十分露出されるように形成し、ＩＺＯ膜１４と下部膜１１１が十分に接するように接触部を形成する。ここで、接触孔１３を通じて配線１１と連結される第２導電層１４が、接触孔１３の段差または配線１１下部のアンダーカット現象によって断線されることを防止できるように、接触孔１３から露出された配線１１の境界線とこれに隣接した接触孔１３の境界線との間の間隔（ｄ）が２μｍ範囲を超えないように接触孔１３を形成することが好ましい。
【００２２】
また、本発明の他の実施例による配線の接触構造及びその製造方法では、図２Ａ及び図２Ｂのように、第１導電層の配線１１の上部膜１１２に少なくとも一つ以上の開口部１５を形成し、配線１１を覆う絶縁膜１２をパターニングし、開口部１５を露出して接触孔１３を形成する。次に、開口部１５で配線１１の下部膜１１１と接触する第２導電層１４を形成する。この時、開口部１５の面積は４×４μｍ以下で形成するのが好ましい。このように開口部１５を小さく形成すれば、上部膜１１２と下部膜１１１を一つのマスクで形成できる。つまり、互いに異なるパターンの上部膜１１２と下部膜１１１をパターニングする時、まず写真エッチング工程で感光膜パターンをエッチングマスクとして、上部膜１１２を形成する。次いで、残った感光膜パターンまたは上部膜１１２をエッチングマスクとして下部膜１１１をエッチングする。この時、開口部１５の面積は４×４μｍ以下と非常に小さいため、開口部１５におけるエッチング速度が非常に遅く、下部膜１１１は完全に除去されず残る。こうして、互いに異なる模様の上部膜１１２と下部膜１１１を一つの感光膜パターンを用いる写真エッチング工程で形成できる。
【００２３】
さらに、本発明の他の実施例による配線の接触構造及びその製造方法において、下部膜１１１と第２導電層１４の接触面積を確保するために、図２Ｃ及び図２Ｄのように、上部膜１１２の周囲外部に下部膜１１１の上部面が露出するように形成し、配線１１の側面を階段構造に形成することもできる。この時、互いに異なるパターンの上部膜１１２と下部膜１１１を一つの感光膜パターンでパターニングする方法として、スリットパターンまたは半透明膜を用いたり、リフロー工程を用いて、周縁が他の部分より薄い配線用感光膜パターンを形成した後、二重でエッチングする方法が挙げられる。これに関しては、後に４枚マスクを用いた薄膜トランジスタアレイ基板の製造工程で具体的に説明する。
【００２４】
一方、図３Ａ乃至図３Ｄのように、配線１１と接触孔１３の誤整列マージンを有することができるように配線１１または接触孔１３を多様に変形でき、図３Ｅのように、配線１１の開口部１５を多数形成できる。
【００２５】
このような配線の接触構造及びその製造方法は、液晶表示装置用薄膜トランジスタ及びその製造方法にも適用できる。
【００２６】
以下、このような本発明による配線の接触構造を含む液晶表示装置用薄膜トランジスタ基板及び製造方法について図面を参照して詳細に説明する。まず、図４及び図５を参照して本発明の第１の実施例による液晶表示装置用薄膜トランジスタ基板の構造について詳細に説明する。
【００２７】
図４は、本発明の第１の実施例による液晶表示装置用薄膜トランジスタ基板であり、図５は、図４に示した薄膜トランジスタ基板のＶ-Ｖ’線に沿った断面図である。
【００２８】
絶縁基板１０上に、低抵抗を有するアルミニウムやアルミニウム合金の金属物質からなるゲート配線が形成されている。ゲート配線は横方向に延びているゲート線２２、ゲート線２２の端に連結され外部からのゲート信号の印加を受けてゲート線に伝達するゲートパッド２４及びゲート線２２に連結されている薄膜トランジスタのゲート電極２６を含む。
【００２９】
基板１０上には、窒化ケイ素（ＳｉＮｘ）などからなるゲート絶縁膜３０がゲート配線２２、２４、２６を覆っている。
【００３０】
ゲート電極２６のゲート絶縁膜３０上には、非晶質シリコンなどの半導体からなる半導体層４０が島状に形成されており、半導体層４０の上には、シリサイドまたはｎ型不純物が高濃度にドーピングされているｎ+水素化非晶質シリコンなどの物質で作られた抵抗接触層５５、５６が各々形成されている。
【００３１】
抵抗接触層５５、５６及びゲート絶縁膜３０上には、アルミニウム（Ａｌ）やアルミニウム合金（Ａｌ  ａｌｌｏｙ）、モリブデン（Ｍｏ）やモリブデン-タングステン（ＭｏＷ）合金、クロム（Ｃｒ）、タンタル（Ｔａ）、チタニウム（Ｔｉ）などの金属または導電体からなるデータ配線６２、６５、６６、６８が形成されている。データ配線は縦方向に形成され、ゲート線２２と交差して画素領域を定義するデータ線６２、データ線６２に連結され抵抗接触層５４の上部まで延びているソース電極６５、データ線６２の一端に連結され外部からの画像信号の印加を受けるデータパッド６８、ソース電極６５と分離されゲート電極２６に対してソース電極６５の反対側の抵抗接触層５６上に形成されているドレーン電極６６を含む。
【００３２】
データ配線６２、６５、６６、６８は、アルミニウムやアルミニウム合金の単一膜で形成するのが好ましいが、二重層以上で形成しても良い。二重層以上で形成する場合には、一つの層は低抵抗物質で形成し、他の層は別の物質、特にＩＺＯと低い接触抵抗を有する物質で作製することが好ましい。例として、Ａｌ（またはＡｌ合金）/ＣｒまたはＡｌ（またはＡｌ合金）/Ｍｏ（またはＭｏ合金）などが挙げられ、本発明の実施例でデータ配線６２、６５、６６、６８は、クロムの下部膜６０１とアルミニウム-ネオジム合金の上部膜６０２の二重膜で形成されている。
【００３３】
データ配線６２、６５、６６、６８及びこれらで覆われない半導体層４０上には窒化ケイ素からなる保護膜７０が形成されている。
【００３４】
保護膜７０には、ドレーン電極６６及びデータパッド６８を各々露出する接触孔７６、７８が形成されており、ゲート絶縁膜３０と共にゲートパッド２４を露出する接触孔７４が形成されている。ここで、接触孔７６はドレーン電極６６の境界線が露出されるように形成され、ドレーン電極６８の下部膜６０１と上部膜６０２の側壁が全て接触孔７６を通じて露出されている。この時、接触孔７６及びデータ配線６６は、図３Ａ乃至図３Ｅのように様々な形になることができ、特にドレーン電極６６を露出する接触孔７６は１０μｍ×１０μｍ以下、４μｍ×４μｍ以上であるのが好ましい。また、パッド２４、６８を露出する接触孔７４、７８もパッドの境界線が露出されるように形成することができ、接触部の接触抵抗を最少化するために接触孔７６より大きく形成することが好ましい。
【００３５】
保護膜７０上には、接触孔７６を通じてドレーン電極６６と電気的に連結され画素に位置する画素電極８２が形成されている。ここで、画素電極８２は、接触孔７６から露出されたドレーン電極６６の側壁、特にドレーン電極６６の下部膜６０１の側壁と十分に接触している。このような本発明の実施例による構造において、接触部の接触抵抗は良好なものと測定されている。これに関しては次の製造方法の記載で具体的に説明する。
【００３６】
また、保護膜７０上には、接触孔７４、７８を通じて各々ゲートパッド２４及びデータパッド６８と連結されている補助ゲートパッド８６及び補助データパッド８８が形成されている。画素電極８２と補助ゲート及びデータパッド８６、８８はＩＺＯで形成されている。ここで、画素電極８２は図４及び図５のように、ゲート線２２と重なって維持蓄電器を構成し、保持容量が不足した場合にはゲート配線２２、２４、２６と同一層に保持容量用配線を追加することもできる。
【００３７】
以下、このような本発明の第１の実施例による液晶表示装置用薄膜トランジスタ基板の製造方法について図４及び図５、図６Ａ乃至図９Ｂを参照して詳細に説明する。
【００３８】
まず、図６Ａ及び６Ｂに示すように、基板１０上に低抵抗を有するアルミニウムやアルミニウム合金のうち、２ａｔ％のＮｄを含むＡｌ-Ｎｄを含む標的を利用して２，５００Å程度の膜厚に１５０℃程度でスパッタリングで積層しパターニングして、ゲート線２２、ゲート電極２６及びゲートパッド２４を含み、テーパ構造を有する横方向のゲート配線を形成する。
【００３９】
次に、図７Ａ及び図７Ｂに示すように、窒化ケイ素からなるゲート絶縁膜３０、非晶質シリコンからなる半導体層４０、ドーピングされた非晶質シリコン層５０の３層膜を連続積層し、マスクを用いたパターニング工程で半導体層４０とドーピングされた非晶質シリコン層５０をパターニングして、ゲート電極２６と対向するゲート絶縁膜３０上に半導体層４０と抵抗接触層５０を形成する。ここで、ゲート絶縁膜３０は、窒化ケイ素を２５０〜４００℃の温度範囲、２，０００〜５，０００Å程度の膜厚に積層して形成することが好ましい。
【００４０】
次に、図８Ａ乃至図８Ｂに示すように、モリブデンやモリブデン合金またはクロムなどからなる下部膜６０１を５００Å程度の膜厚に、低抵抗を有するアルミニウムやアルミニウム合金のうち、２ａｔ％のＮｄを含むＡｌ-Ｎｄ合金の標的を利用して上部膜６０２を１５０℃程度で２，５００Å程度の膜厚さにスパッタリングで順次に積層する。その後、マスクを用いた写真工程でパターニングして、テーパ構造を有するデータ配線を形成する。データ配線としては、ゲート線２２と交差するデータ線６２、データ線６２と連結されゲート電極２６上部まで延びているソース電極６５、データ線６２は一側端に連結されているデータパッド６８及びソース電極６４と分離されており、ゲート電極２６を中心にソース電極６５と対向するドレーン電極６６を含む。ここで、上部膜６０２及び下部膜６０１は、両方湿式エッチングでエッチングすることができる。また、上部膜６０２は湿式エッチングで、下部膜６０１は乾式エッチングでエッチングすることもでき、下部膜６０１がモリブデンやモリブデン合金膜である場合には、上部膜６０２と一つのエッチング条件でパターニングすることができる。また、ドレーン電極６６の上部膜６０２にのみ開口部を形成し、最終的に図２Ａ及び図２Ｂのような接触構造を形成することもできる。この開口部の面積を４μｍ×４μｍ以下と小さく形成し、マスクを用いる写真エッチング工程を別途追加しないことが好ましい。
【００４１】
そして、この後形成されるＩＺＯ膜と下部膜６０１とが十分に接触できるように下部膜６０１が上部膜６０２の下部にアンダーカットされることを防止することや、下部膜６０１が上部膜６０２の外に出るように形成することが好ましい。このために、モリブテンやモリブデン合金で下部膜６０１を形成する場合には、下部膜６０１と上部膜６０２の膜厚の比を１：５以上で積層し、ＤＩＰモードで実施して電池反応を最適化し、下部膜がアンダーカットされることを防止する。また、下部膜６０１をクロムで形成する場合には、下部膜６０１を５００Å以下の膜厚さで積層し、洗浄工程または感光膜を除去する工程でアルミニウムやアルミニウム合金の上部膜６０２一部を除去する条件を適用し、クロムの下部膜６０１を上部膜６０２の外に出るように形成する。
【００４２】
次に、データ配線６２、６５、６６、６８で覆われないドーピングされた非晶質シリコン層パターン５０をエッチングしてゲート電極２６を中心に両側に分離する一方、両側のドーピングされた非晶質シリコン層５５、５６の間の半導体層パターン４０を露出させる。次いで、露出された半導体層４０の表面を安定化するために酸素プラズマ処理を実施することが好ましい。
【００４３】
次に、図９Ａ及び図９Ｂのように、窒化ケイ素のような無機絶縁膜を２５０〜４００℃の範囲で積層して保護膜７０を形成し、マスクを用いた写真エッチング工程でゲート絶縁膜３０と共に乾式エッチングでパターニングし、ゲートパッド２４、ドレーン電極６６及びデータパッド６８を各々露出する接触孔７４、７６、７８を形成する。ここで、接触孔７４、７６、７８を形成する時のエッチング条件は、アルミニウムまたはアルミニウム合金の金属膜がエッチングされない条件を適用するのが好ましく、エッチング気体としてはＦ系の気体を使用できる。接触孔７６は、ドレーン電極６６の境界線及び上部膜６０１と下部膜６０１の側壁が露出されるように、また接触孔７６からドレーン電極６６の境界線が露出されるように形成する。この時、ドレーン電極６６の外に位置する接触孔７６の境界線とこれと隣接したドレーン電極６６の境界線の間隔は、２μｍ以内の範囲になるように形成することが好ましい。これは、この後形成される画素電極８２とドレーン電極６６との間の接触抵抗を最少化し、接触孔７６形成時にドレーン電極６６の下部にアンダーカット現象が発生することを防止するためである。つまり、ドレーン電極６６の外に位置する接触孔７６の境界線とこれと隣接したドレーン電極６６の境界線の間隔を３μｍ以上にして接触孔７６を大きく形成すると、接触孔７６を形成する時にドレーン電極６６の下部でゲート絶縁膜３０が過度にエッチングされ、アンダーカット現象が発生する。そうすると、ゲート絶縁膜３０の段差によって、この後形成される画素電極８２がドレーン電極６６の下部で断線されるおそれがあり、これで接触部の接触抵抗が増加することになる。しかし、本発明の実施例のように、ドレーン電極６６の外に位置する接触孔７６の境界線と、これと隣接したドレーン電極６６の境界線の間隔を２μｍ以内の範囲で接触孔７６を形成すれば、ドレーン電極６６の下部でゲート絶縁膜３０が過度にエッチングされることなく、ドレーン電極６６側壁の傾斜面を完全に露出させることができる。勿論、ここでパッド２４、６８を露出する接触孔７４、７８もパッド２４、６８の境界線が露出されるように形成し、図１Ａ及び図１Ｂのように接触部を形成することもできる。
【００４４】
最後に、図４及び５に示すように、ＩＺＯ膜をスパッタリングで積層してマスクを用いたパターニングを実施し、接触孔７６を通じてドレーン電極６６と連結される画素電極８２と接触孔７４、７８を通じてゲートパッド２４及びデータパッド６８と各々連結される補助ゲートパッド８６及び補助データパッド８８を各々形成する。この時、画素電極８２は、ドレーン電極６６の下部でアンダーカット現象が発生しないので断線されない。また、ＩＺＯ膜と低い接触抵抗を有する下部膜６０１と十分に接しているので、接触部の接触抵抗を最少化することができる。本発明の実施例で、ＩＺＯ膜８２、８６、８８を形成するための標的は、出光（ｉｄｅｍｉｔｓｕ）社のＩＤＩＸＯ（商品名：ｉｎｄｉｕｍ  ｘ-ｍｅｔａｌ  ｏｘｉｄｅ）を使用し、標的はＩｎ2Ｏ3及びZｎＯを含み、Ｉｎ＋ZｎでZｎの含有量が１５〜２０ａｔ％の範囲であることが好ましい。また、ＩＺＯ膜は、接触抵抗を最少化するために２５０℃以下の範囲で積層するのが好ましい。
【００４５】
このような本発明の実施例による製造工程で、画素の集合からなる表示領域の外の周辺領域に、画素領域に形成されている構造と同様なテストパターンで接触構造を形成し、接触部の接触抵抗を測定する。三つの場合に対してそれぞれ測定した。即ち、テストパターンは、接触孔７６をドレーン電極６６上に形成する第１の場合と、ドレーン電極６６の外に位置する接触孔７６の境界線とこれと隣接したドレーン電極６６の境界線の間隔が３μｍ以上になるように接触孔を大きく形成する第２の場合、及び本発明の接触構造のようにドレーン電極６６の外に位置する接触孔７６の境界線とこれと隣接したドレーン電極６６の境界線の間隔が２μｍ以内の範囲になるように形成する第３の場合に対するテストパターンを形成し、２００個のテストパターンの接触抵抗を測定した。その結果、第１及び第２の場合は、接触抵抗がＥ７Ω以上と大きいものと測定されており、第３の場合はＥ６Ω以下と良好であった。
【００４６】
さらに、製造工程の時の様々な工程条件に対する接触部の接触抵抗をテストパターンを通じて測定した。
【００４７】
図１０は、本発明の実施例による液晶表示装置用薄膜トランジスタ基板の周辺領域に形成されたテストパターンの接触抵抗を測定した結果を示す表である。
【００４８】
前記テストパターンは、表示領域の外の周辺部に形成し、図１Ａ及び図１Ｂのようにデータ配線用金属層であるクロムの下部膜とアルミニウム合金の上部膜からなる配線、接触孔を有し窒化ケイ素からなる絶縁膜及びＩＺＯ膜からなる３層膜の構造に単純化し、２００個の接触部を形成して接触抵抗を測定した。ここで、第１パターンは、接触孔の境界線が配線の上部にのみ位置するように接触部を形成しており、第２パターンは本発明の実施例のように配線側壁の傾斜面とＩＺＯ膜が接触するように接触部を形成している。絶縁膜は２３５℃、３１０℃の温度、２，０００Å、３，０００Åの膜厚の各々異なる条件で保護膜及びゲート絶縁膜を積層し、配線は１５０℃、５０℃の温度で各々アルミニウム合金膜を積層する場合に対して接触抵抗を測定した。さらに、配線を１，５００Å、３，０００Åの抵抗性接触層をエッチングする気体に対して露出させた第１の場合と、６３秒、６８秒の間ＰＥモードで絶縁膜をエッチングして接触孔を形成する第２の場合、１，０００Ｗ、４００ＷのＩＣＰモードで絶縁膜をエッチングして接触孔を形成する第３の場合、接触孔を通じて露出された配線を洗浄しない場合及び７０秒間洗浄を行った第４の場合に対して各々接触抵抗を測定した。
【００４９】
図１０に示すように、接触孔を１０μｍ×１０μｍに形成した場合、第１のパターンの接触抵抗は５．３ＭΩ〜４．０ＧΩの範囲と大きく、第２のパターンの接触抵抗は１４ＫΩ〜５１５ＫΩの範囲でＥ５Ω以下と良好なものと測定された。さらに、第１のパターンで接触抵抗が６０ＫΩと良好に測定されたケースについて詳しく検討した結果、第１のパターンの接触構造が、第２のパターンの接触構造のように配線の境界線が接触孔から露出するように形成され、ＩＺＯ膜と配線側壁、特に下部膜と十分に接触される構造であることが分かった。
【００５０】
そして、接触孔を７μｍ×７μｍに形成した場合は、第１のパターンの接触抵抗は１２ＭΩ〜７．９ＧΩの範囲と大きく、第２のパターンの接触抵抗は１８ＫΩ〜６６４ＫΩの範囲でＥ５Ω以下と良好なものと測定された。また、接触孔を４μｍ×４μｍに形成した場合、第１のパターンの接触抵抗は４８ＭΩ〜８５ＧΩの範囲と大きく、第２のパターンの接触抵抗は３０ＫΩ〜１．２ＭΩの範囲と良好な測定結果が出た。
【００５１】
このような本発明の実施例による薄膜トランジスタアレイ基板の構造は、ゲート配線２２、２４、２６及びデータ配線６２、６４、６６、６８が、低抵抗を有するアルミニウムやアルミニウム合金の導電膜を含むと同時に接触部、特にデータ配線とＩＺＯ膜の画素電極８２の接触抵抗を最少化することができるので、大画面、高精細の液晶表示装置に適用することができる。
【００５２】
このような方法は、前述のように、５枚のマスクを用いる製造方法に適用できるが、４枚のマスクを用いる液晶表示装置用薄膜トランジスタ基板の製造方法にも同様に適用できる。これについて図面を参照して詳細に説明する。
【００５３】
まず、図１１乃至図１３を参照して、本発明の実施例による４枚のマスクを用いて完成した液晶表示装置用薄膜トランジスタ基板の単位画素構造について詳細に説明する。図１１は、本発明の第２の実施例による液晶表示装置用薄膜トランジスタ基板の配置図であり、図１２及び図１３は、各々図８に示す薄膜トランジスタ基板のＸＩＩ-ＸＩＩ’線及びＸＩＩＩ-ＸＩＩＩ’線に沿った断面図である。
【００５４】
絶縁基板１０上には、第１の実施例と同様にアルミニウムまたはアルミニウム合金の低抵抗導電物質からなるゲート線２２、ゲートパッド２４及びゲート電極２６を含むゲート配線が形成されている。そして、ゲート配線は、基板１０上にゲート線２２と平行し、上板の共通電極に入力される共通電極電圧などの電圧印加を外部から受ける維持電極２８を含む。維持電極２８は、後述する画素電極８２と連結された維持蓄電器用導電体パターン６８と重なり、画素の電荷保存能力を向上させる維持蓄電器を構成し、後述する画素電極８２とゲート線２２の重畳で発生する保持容量が十分な場合は形成しないこともある。
【００５５】
同様に、ゲート配線２２、２４、２６、２８は、アルミニウムやアルミニウム合金からなる単一層でも形成できるが、ＩＺＯと低い接触抵抗を有するクロムまたはモリブデンやモリブデン合金またはタンタルまたはチタニウムからなる下部膜２０１と、アルミニウムやアルミニウム合金からなる上部膜２０２を含む二重膜で形成されている。
【００５６】
ゲート配線２２、２４、２６、２８上には、窒化ケイ素（ＳｉＮｘ）などからなるゲート絶縁膜３０が形成され、ゲート配線２２、２４、２６、２８を覆っている。
【００５７】
ゲート絶縁膜３０上には、水素化非晶質シリコンなどの半導体からなる半導体パターン４２、４８が形成されており、半導体パターン４２、４８上には、リン（Ｐ）などのｎ型不純物として高濃度でドーピングされている非晶質シリコンなどからなる抵抗性接触層パターンまたは中間層パターン５５、５６、５８が形成されている。
【００５８】
抵抗性接触層パターン５５、５６、５８上には、低抵抗を有するアルミニウムやアルミニウム合金の導電物質からなる導電膜を含むデータ配線が形成されている。データ配線は、縦方向に形成されているデータ線６２、データ線６２の一端に連結され外部からの画像信号の印加を受けるデータパッド６８、そしてデータ線６２の分枝である薄膜トランジスタのソース電極６５からなるデータ線部を含む。さらに、データ線部６２、６８、６５と分離され、ゲート電極２６または薄膜トランジスタのチャンネル部（Ｃ）に対してソース電極６５の反対側に位置する薄膜トランジスタのドレーン電極６６と維持電極２８上に位置している維持蓄電器用導電体パターン６４も含む。維持電極２８を形成しない場合、維持蓄電器用導電体パターン６４も形成しない。
【００５９】
データ配線６２、６４、６５、６６、６８もゲート配線２２、２４、２６、２８と同様に、アルミニウムやアルミニウム合金の金属からなる単一層で形成できるが、第１の実施例と同様にクロムまたはモリブデンやモリブデン合金またはタンタルまたはチタニウムからなる下部膜６０１と、アルミニウムやアルミニウム合金からなる上部膜６０２を含む二重膜で形成されている。
【００６０】
接触層パターン５５、５６、５８は、その下部の半導体パターン４２、４８とその上部のデータ配線６２、６４、６５、６６、６８の接触抵抗を小さくする役割をし、データ配線６２、６４、６５、６６、６８と完全に同じ形態を有する。即ち、データ線部中間層パターン５５はデータ線部６２、６８、６５と同じであり、ドレーン電極用中間層パターン５６はドレーン電極６６と同じであり、維持蓄電器用中間層パターン５８は維持蓄電器用導電体パターン６４と同じである。
【００６１】
一方、半導体パターン４２、４８は、薄膜トランジスタのチャンネル部（Ｃ）を除けばデータ配線６２、６４、６５、６６、６８及び抵抗性接触層パターン５５、５６、５８と同じ形態である。具体的には、維持蓄電器用半導体パターン４８と維持蓄電器用導電体パターン６４及び維持蓄電器用接触層パターン５８は同じ形態であるが、薄膜トランジスタ用半導体パターン４２はデータ配線及び接触層パターンの他の部分と少し異なる。即ち、薄膜トランジスタのチャンネル部（Ｃ）でデータ線部６２、６８、６５、特にソース電極６５とドレーン電極６６が分離されており、データ線部中間層５５とドレーン電極用接触層パターン５６も分離されているが、薄膜トランジスタ用半導体パターン４２はここで切れることなく連結され、薄膜トランジスタのチャンネルを生成する。
【００６２】
データ配線６２、６４、６５、６６、６８上には、窒化ケイ素からなる保護膜７０が形成されている。保護膜７０は、ドレーン電極６６、データパッド６８及び維持蓄電器用導電体パターン６４を露出する接触孔７６、７８、７２を有し、また、ゲート絶縁膜３０と共にゲートパッド２４を露出する接触孔７４を有している。ここで、全ての接触孔７２、７４、７６、７８は、維持蓄電器用導電体パターン６４、ゲートパッド２４、ドレーン電極６６、データパッド６８の側壁、特にそれぞれのＩＺＯと低い接触抵抗を有する下部膜２０１、６０１が露出するように形成されている。
【００６３】
保護膜７０上には、薄膜トランジスタから画像信号を受けて上板の電極と共に電場を生成する画素電極８２が形成されている。画素電極８２は、ＩＺＯなどの透明な導電物質で形成され、接触孔７６を通じてドレーン電極６６と物理的・電気的に連結され画像信号の伝達を受ける。さらに、画素電極８２は、隣接するゲート線２２及びデータ線６２と重なって開口率を高くしているが、重ならないこともある。また、画素電極８２は、接触孔７２を通じて維持蓄電器用導電体パターン６４とも連結され導電体パターン６４に画像信号を伝達する。一方、ゲートパッド２４及びデータパッド６８上には、接触孔７４、７８を通じて各々これらと連結される補助ゲートパッド８６及び補助データパッド８８が形成されており、これらはパッド２４、６８と外部回路装置との接着性を補完し、パッドを保護する役割をするもので必須ではなく、これらの適用の要否は選択的である。ここでも、接触部でＩＺＯ膜８２、８６、８８は、維持蓄電器用導電体パターン６４、ゲートパッド２４、ドレーン電極６６、データパッド６８の側壁、特にＩＺＯと低い接触抵抗を有する下部膜２０１、６０１と接触されている。
【００６４】
ここでは、画素電極８２の材料の例として透明なＩＺＯを挙げたが、透明な導電性ポリマーなどで形成することもでき、反射型液晶表示装置の場合、不透明な導電物質を用いても構わない。
【００６５】
以下、図１１乃至図１３の構造を有する液晶表示装置用薄膜トランジスタ基板を４枚のマスクを用いて製造する方法について図１１乃至図１３、図１４Ａ乃至図２１Ｃを参照して詳細に説明する。
【００６６】
まず、図１４Ａ乃至１４Ｃに示したように、アルミニウムよりＩＺＯと低い接触抵抗を有するモリブデンやモリブデン合金またはクロムなどからなる下部膜２０１と、低抵抗を有するアルミニウムやアルミニウム合金のうち、２ａｔ％のＮｄを含むＡｌ-Ｎｄ合金の標的を利用して上部膜２０２をスパッタリングで順次に積層した後、１枚のマスクを用いた写真エッチング工程で基板１０上にゲート線２２、ゲートパッド２４、ゲート電極２６及び維持電極２８を含むゲート配線をテーパ構造で形成する。ここでも、以後形成されるＩＺＯ膜と下部膜２０１とが十分に接触するように下部膜２０１が上部膜２０２の下部にアンダーカットされることを防止したり、下部膜が上部膜の外に出るように形成するのが好ましい。このために、モリブデンやモリブデン合金で下部膜２０１を形成する場合には、下部膜２０１と上部膜２０２の膜厚比を１：５以上に積層し、基板全体をエッチング液に浸してエッチングを行うＤＩＰモードで電池反応を最適化し、下部膜がアンダーカットされることを防止する。また、下部膜２０１をクロムで形成する場合には、下部膜２０１を５００Å以下の膜厚に積層し、洗浄工程または感光膜を除去する工程でアルミニウムやアルミニウム合金の上部膜２０２の一部を除去する条件を適用し、クロムの下部膜２０１が上部膜２０２の外に出るように形成する。
【００６７】
次に、図１５Ａ及び１５Ｂに示したように、窒化ケイ素からなるゲート絶縁膜３０、半導体層４０、中間層５０を化学気相蒸着法を利用して各々１，５００Å乃至５，０００Å、５００Å乃至２，０００Å、３００Å乃至６００Åの膜厚に連続蒸着し、次いで低抵抗を有するアルミニウムやアルミニウム合金からなる上部膜６０１と、クロムまたはモリブデンやモリブデン合金からなる下部膜６０１を含む導電体層６０をスパッタリングなどの方法で１，５００Å乃至３，０００Åの膜厚に蒸着した後、その上に感光膜１１０を１μｍ乃至２μｍの膜厚に塗布する。
【００６８】
その後、第２マスクを通じて感光膜１１０に光を照射し現像して、図１６Ｂ及び１６Ｃに示したように、感光膜パターンの第２部分１１２、第１部分１１４を形成する。ここで、感光膜パターン１１２、１１４の中で薄膜トランジスタのチャンネル部（Ｃ）、つまり、ソース電極６５とドレーン電極６６の間に位置した第１部分１１４の厚さは、データ配線部（Ａ）、つまり、データ配線６２、６４、６５、６６、６８が形成される部分に位置した第２部分１１２の厚さより薄く形成し、その他の部分（Ｂ）の感光膜は全て取り除く。この時、チャンネル部（Ｃ）に残っている感光膜１１４の膜厚とデータ配線部（Ａ）に残っている感光膜１１２の膜厚の比は後述するエッチング工程の工程条件によって異ならせる必要があり、第１部分１１４の厚さを第２部分１１２の厚さの１/２以下にするのが好ましく、例えば、４，０００Å以下であることが好ましい。
【００６９】
このように、位置によって感光膜の膜厚を異ならせる方法としては様々なものがあり、Ａ領域の光透過量を調節するために主にスリット（ｓｌｉｔ）や格子状のパターンを形成したり半透明膜を用いる。この時、スリットの間に位置したパターンの線幅やパターン間の間隔、即ちスリットの幅は、露光時使用する露光器の分解能より小さいのが好ましく、半透明膜を利用する場合には、マスク作製時に透過率を調節するために異なる透過率を有する薄膜を利用したり、異なる膜厚の薄膜を用いることができる。
【００７０】
このようなマスクを通じて感光膜に光を照射すれば、光に直接露出される部分では高分子が完全分解され、スリットパターンや半透明膜が形成されている部分では光の照射量が少ないため高分子が不完全分解の状態となり、遮光膜で遮った部分では高分子がほとんど分解されない。次いで、感光膜を現像すると、分子が分解されなかった高分子部分だけが残され、照射光が少ない中央部分には光に全く照射されない部分より厚さの薄い感光膜を残すことができる。この時、露光時間を長くすれば全ての分子が分解されてしまうため、そうならないように注意する必要がある。
【００７１】
このような厚さの薄い感光膜１１４は、リフローが可能な物質からなる感光膜を用いて、光が完全に透過される部分と光が完全に透過されない部分に分けられた通常のマスクで露光した後、現像しリフローさせて感光膜が残留しない部分に感光膜の一部を流すことにより形成することもできる。
【００７２】
次に、感光膜パターン１１４及びその下部の膜など、即ち導電体層６０、中間層５０及び半導体層４０に対するエッチングを行う。この時、データ配線部（Ａ）にデータ配線及びその下部の膜などがそのまま残されることと、チャンネル部（Ｃ）に半導体層のみ残される必要があり、残りの部分（Ｂ）には前記三つの層である導電体層６０、中間層５０、半導体層４０が全て除去され、ゲート絶縁膜３０が露出されることが必要である。
【００７３】
図１４Ａ及び１４Ｂに示すように、その他の部分（Ｂ）の露出されている導電体層６０を除去し、その下部の中間層５０を露出させる。この過程では乾式エッチングや湿式エッチング方法を両方利用できる。この時、導電体層６０はエッチングされ、感光膜パターン１１２、１１４はほとんどエッチングされない条件下で行うのが良い。しかし、乾式エッチングの場合、導電体層６０のみをエッチングし、感光膜パターン１１２、１１４はエッチングされない条件を見つけ難いため、感光膜パターン１１２、１１４も一緒にエッチングされる条件下で行うこともできる。この場合には、湿式エッチングの場合より第１部分１１４の厚さを厚くし、この過程で感光膜パターンの第１部分１１４が除去され下部の導電体層６０が露出されることがないようにする。
【００７４】
導電体層６０がＭｏやＭｏＷ合金、ＡｌやＡｌ合金、Ｔａのいずれかを含む場合には、乾式エッチングや湿式エッチングのいずれの方法でも良い。しかし、Ｃｒは乾式エッチングでは除去されないため、導電体層６０がＣｒである場合は湿式エッチングのみを利用するのが良い。導電体層６０がＣｒである湿式エッチングの場合には、エッチング液としてＣｅＮＨＯ3を使用でき、導電体層６０がＭｏやＭｏＷである乾式エッチングのエッチング気体としては、ＣＦ4とＨＣｌの混合気体やＣＦ4とＯ2の混合気体を用いることができる。後者の場合、感光膜に対するエッチング比もほぼ同一である。
【００７５】
このようにすると、図１７Ａ及び図１７Ｂに示すように、チャンネル部（Ｃ）及びデータ配線部（Ａ）、（Ｂ）の導電体層、つまり、ソース/ドレーン用導電体パターン６７と維持蓄電器用導電体パターン６４だけ残され、その他の部分（Ｂ）の導電体層６０は全て除去され、その下部の中間層５０が露出される。残された導電体パターン６７、６４は、ソース及びドレーン電極６５、６６が分離されず連結されていることを除けば、データ配線６２、６４、６５、６６、６８の形態と同一である。また、乾式エッチングを使用した場合、感光膜パターン１１２、１１４もある程度の厚さがエッチングされる。
【００７６】
図１８Ａ及び１８Ｂに示すように、その他の部分（Ｂ）の露出された中間層５０及びその下部の半導体層４０を感光膜の第１部分１１４と共に乾式エッチング方法で同時に除去する。この時のエッチングは、感光膜パターン１１２、１１４と中間層５０及び半導体層４０（半導体層と中間層はエッチング選択性がほとんど無い）が同時にエッチングされ、ゲート絶縁膜３０はエッチングされない条件下で行う必要がある。特に、感光膜パターン１１２、１１４と半導体層４０に対するエッチング比がほとんど同一な条件下でエッチングすることが好ましい。例えば、ＳＦ6とＨＣｌの混合気体やＳＦ6とＯ2の混合気体を使用すれば、ほとんど同一な膜厚に二つの膜をエッチングすることができる。感光膜パターン１１２、１１４と半導体層４０に対するエッチング比が同一な場合、第１部分１１４の厚さは、半導体層４０と中間層５０の厚さを合せたものと同じであるか、それより小さい必要がある。
【００７７】
このようにして、図１８Ａ及び１８Ｂに示したように、チャンネル部（Ｃ）の第１部分１１４が除去されソース/ドレーン用導電体パターン６７が露出され、その他の部分（Ｂ）の中間層５０及び半導体層４０が除去されその下部のゲート絶縁膜３０が露出される。一方、データ配線部（Ａ）の第２部分１１２もエッチングされるので厚さが薄くなる。そして、この段階で半導体パターン４２、４８が完成する。図面符号５７と５８は、各々ソース/ドレーン用導電体パターン６７下部の中間層パターンと維持蓄電器用導電体パターン６４下部の中間層パターンを示す。
【００７８】
次いで、アッシング（ａｓｈｉｎｇ）を通じてチャンネル部（Ｃ）のソース/ドレーン用導電体パターン６７表面の残留感光膜を除去する。
【００７９】
図１９Ａ及び１９Ｂに示すように、チャンネル部（Ｃ）のソース/ドレーン用導電体パターン６７及びその下部のソース/ドレーン用中間層パターン５７をエッチングして除去する。この時、エッチングはソース/ドレーン用導電体パターン６７及び中間層パターン５７の両方に対して乾式エッチングのみで行うことができる。ソース/ドレーン用導電体パターン６７に対しては湿式エッチングで、中間層パターン５７に対しては乾式エッチングで行うこともできる。前者の場合、ソース/ドレーン用導電体パターン６７及び中間層パターン５７のエッチング選択比が大きい条件下でエッチングを行うことが好ましい。これは、エッチング選択比の大きくない場合、エッチング終了点を見つけ難くチャンネル部（Ｃ）に残る半導体パターン４２の膜厚を調節することが容易ではないためである。例えば、ＳＦ６とＯ２の混合気体を用いてソース/ドレーン用導電体パターン６７をエッチングする方法を挙げられる。湿式エッチングと乾式エッチングを入れ替えて行う後者の場合には、湿式エッチングされるソース/ドレーン用導電体パターン６７の側面はエッチングされるが、乾式エッチングされる中間層パターン５７はほとんどエッチングされないため階段状に形成される。中間層パターン５７及び半導体パターン４２のエッチング時に使用するエッチング気体の例としては、既に言及したＣＦ4とＨＣｌの混合気体やＣＦ4とＯ2の混合気体があり、ＣＦ4とＯ2を使用すれば、半導体パターン４２を均一な膜厚に残すことができる。この時、図１９Ｂに示すように、半導体パターン４２の一部が除去され厚さが薄くなることもあり、感光膜パターンの第２部分１１２もこの時ある程度の厚さがエッチングされる。この時のエッチングはゲート絶縁膜３０がエッチングされない条件で行う必要があり、第２部分１１２がエッチングされその下部のデータ配線６２、６４、６５、６６、６８が露出されることがないように感光膜パターンの厚いことが良いのは勿論である。
【００８０】
このようにして、ソース電極６５とドレーン電極６６が分離されながらデータ配線６２、６４、６５、６６、６８とその下部の接触層パターン５５、５６、５８が完成する。
【００８１】
最後に、データ配線部（Ａ）に残っている感光膜第２部分１１２を除去する。しかし、第２部分１１２の除去は、チャンネル部（Ｃ）ソース/ドレーン用導電体パターン６７を除去した後、その下の中間層パターン５７を除去する前に行われることもできる。
【００８２】
前述のように、湿式エッチングと乾式エッチングを入れ替えて実施したり、乾式エッチングのみ用いることができる。後者の場合には、一種類のエッチングを使用するので工程が比較的に簡便であるが、適当なエッチング条件を見つけ出すことが難しい。前者の場合には、エッチング条件の検索は比較的に簡単であるが、後者に比べて工程が面倒な点がある。
【００８３】
このようにしてデータ配線６２、６４、６５、６６、６８を形成した後、図２０Ａ及び図２０Ｂに示す第１の実施例のように、窒化ケイ素をＣＶＤ方法で２５０〜４００℃の範囲で蒸着して保護膜７０を形成する。第３マスクを利用して保護膜７０をゲート絶縁膜３０と共にエッチングし、ドレーン電極６６、ゲートパッド２４、データパッド６８及び維持蓄電器用導電体パターン６４の下部膜２０１、６０１を各々露出する接触孔７６、７４、７８、７２を形成する。
【００８４】
最後に、図１１乃至図１３のように、第１の実施例のような方法で厚さが４００Å乃至５００ÅであるＩＺＯ層をスパッタリング方法で蒸着し、第４マスクを使用してエッチングし、ドレーン電極６６及び維持蓄電器用導電体パターン６４と連結された画素電極８２、ゲートパッド２４と連結された補助ゲートパッド８６及びデータパッド６８と連結された補助データパッド８８を形成する。ＩＺＯをパターニングするためのエッチング液は、クロム（Ｃｒ）の金属膜をエッチングするとき使用するクロムエッチング液を使用するが、これはアルミニウムを腐蝕させないので、データ配線とゲート配線が腐食することを防止できる。エッチング液として（ＨＮＯ3/（ＮＨ4）2Ｃｅ（ＮＯ3）6/Ｈ2Ｏ）などが挙げられる。
【００８５】
このような本発明の第２の実施例では、第１の実施例による効果だけでなく、さらに、データ配線６２、６４、６５、６６、６８とその下部の接触層パターン５５、５６、５８及び半導体パターン４２、４８を一つのマスクを用いて形成し、この過程でソース電極６５とドレーン電極６６が分離され、製造工程を単純化できる。
【００８６】
本発明の第１及び第２の実施例による液晶表示装置用薄膜トランジスタアレイ基板及びその製造方法では、図１Ａ及び図１Ｂの接触構造を適用して説明したが、図２Ａ乃至図３Ｅに示した接触構造も同様に適用できる。図１Ａ乃至図３Ｅに示した接触構造は、他の半導体素子及びその製造方法に同様に適用できる。
【図面の簡単な説明】
【００８７】
【図１Ａ】本発明の実施例における配線の接触構造を示すものである（１）。
【図１Ｂ】本発明の実施例における配線の接触構造を示すものである（２）。
【図２Ａ】本発明の実施例における配線の接触構造を示すものである（３）。
【図２Ｂ】本発明の実施例における配線の接触構造を示すものである（４）。
【図２Ｃ】本発明の実施例における配線の接触構造を示すものである（５）。
【図２Ｄ】本発明の実施例における配線の接触構造を示すものである（６）。
【図３Ａ】本発明の実施例における配線の接触構造を示すものである（７）。
【図３Ｂ】本発明の実施例における配線の接触構造を示すものである（８）。
【図３Ｃ】本発明の実施例における配線の接触構造を示すものである（９）。
【図３Ｄ】本発明の実施例における配線の接触構造を示すものである（１０）。
【図３Ｅ】本発明の実施例における配線の接触構造を示すものである（１１）。
【図４】本発明の第１の実施例による液晶表示装置用薄膜トランジスタ基板を示すものである。
【図５】図４に示した薄膜トランジスタ基板のＩＶ-ＩＶ線に沿った断面図である。
【図６Ａ】本発明の第１の実施例による液晶表示装置用薄膜トランジスタ基板を製造する中間過程をその工程順によって示した薄膜トランジスタ基板の配置図である。
【図６Ｂ】図６ＡのＶＩｂ-ＶＩｂ’線に沿った断面図である。
【図７Ａ】本発明の第１の実施例による液晶表示装置用薄膜トランジスタ基板を製造する中間過程をその工程順によって示した薄膜トランジスタ基板の配置図である。
【図７Ｂ】図７ＡのＶＩＩｂ-ＶＩＩｂ’線に沿った断面図で、図６Ｂの次の段階を示すものである。
【図８Ａ】本発明の第１の実施例による液晶表示装置用薄膜トランジスタ基板を製造する中間過程をその工程順によって示した薄膜トランジスタ基板の配置図である。
【図８Ｂ】図８ＡのＶＩＩＩｂ-ＶＩＩＩｂ’線に沿った断面図で、図７Ｂの次の段階を示すものである。
【図９Ａ】本発明の第１の実施例による液晶表示装置用薄膜トランジスタ基板を製造する中間過程をその工程順によって示した薄膜トランジスタ基板の配置図である。
【図９Ｂ】図９ＡのＩＸｂ-ＩＸｂ’線に沿った断面図で、図８Ｂの次の段階を示すものである。
【図１０】本発明の実施例による液晶表示装置用薄膜トランジスタ基板の周辺領域に形成されたテストパターンの接触抵抗を測定した結果を示す表である。
【図１１】本発明の第２の実施例による液晶表示装置用薄膜トランジスタ基板の配置図である。
【図１２】図１１に示した薄膜トランジスタ基板のＸＩＩ-ＸＩＩ’線に沿った断面図である。
【図１３】図１１に示した薄膜トランジスタ基板のＸＩＩＩ-ＸＩＩＩ’線に沿った断面図である。
【図１４Ａ】本発明の第２の実施例によって製造する初段階での薄膜トランジスタ基板の配置図である。
【図１４Ｂ】図１４ＡのＸＩＶｂ-ＸＩＶｂ’線に沿った断面図である。
【図１４Ｃ】図１４ＡのＸＩＶｃ-ＸＩＶｃ’線に沿った断面図である。
【図１５Ａ】図１４ＡのＸＩＶｂ-ＸＩＶｂ’線に沿った断面図で、図１４Ｂの次の段階を示す。
【図１５Ｂ】図１４ＡのＸＩＶｃ-ＸＩＶｃ’線に沿った断面図で、図１４Ｃ次の段階を示す。
【図１６Ａ】図１５Ａ及び１５Ｂの次の段階の薄膜トランジスタ基板の配置図である。
【図１６Ｂ】図１６ＡのＸＶＩｂ-ＸＶＩｂ’線に沿った断面図である。
【図１６Ｃ】図１６ＡのＸＶＩｃ-ＸＶＩｃ’線に沿った断面図である。
【図１７Ａ】図１６ＡのＸＶＩｂ-ＸＶＩｂ’線に沿った断面図で、図１６Ｂの次の段階を工程順によって示すものである。
【図１７Ｂ】図１６Ａの及びＸＶＩｃ-ＸＶＩｃ’線に沿った断面図で、１６Ｃの次の段階を工程順によって示すものである。
【図１８Ａ】図１６ＡのＸＶＩｂ-ＸＶＩｂ’線に沿った断面図で、図１７Ｂの次の段階を工程順によって示すものである。
【図１８Ｂ】図１６Ａの及びＸＶＩｃ-ＸＶＩｃ’線に沿った断面図で、１７Ｃの次の段階を工程順によって示すものである。
【図１９Ａ】図１６ＡのＸＶＩｂ-ＸＶＩｂ’線に沿った断面図で、図１８Ｂの次の段階を工程順によって示すものである。
【図１９Ｂ】図１６Ａの及びＸＶＩｃ-ＸＶＩｃ’線に沿った断面図で、１８Ｃの次の段階を工程順によって示すものである。
【図２０Ａ】図１９Ａ及び図１９Ｂの次の段階の薄膜トランジスタ基板の配置図である。
【図２０Ｂ】図２０ＡのＸＸｂ-ＸＸｂ’線に沿った断面図である。
【図２０Ｃ】図２０ＡのＸＸｃ-ＸＸｃ’線に沿った断面図である。
【図１０】
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【国際公開パンフレット】
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【国際公開パンフレット（コレクトバージョン）】
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【国際調査報告】
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