(57)【要約】半導体再配線方法を提供し、キャリア（１００）上の各電気的接続点（２１１、２１２、２２１、２２２、２３１、２３２）のオフセット値を計算した後、まずマスクレス露光方式方式を採用してオフセット値を修正して、電気的接続点上に再配線構造を形成し、その後、マスク露光方式ー方式を採用してキャリア（１００）に対して単一化処理をして、再配線構造上に配線層及び／または半田ボール（７００）を形成する。このように、マスクレス露光方式及びマスク露光方式を結合することによって、単にマスクレス露光方式方式を用いる際に比べて効率が向上され、時間が節約される。
2019530241.tif 000002
【特許請求の範囲】
【請求項１】
それぞれが複数の電気的接続点を有する複数の半導体素子を載置するためのキャリアを設置するステップ１と、
各電気的接続点の前記キャリアに対する位置を測定し、測定した位置と前記電気的接続点が前記キャリアに対する標準位置とを比較して各電気的接続点のオフセット値を得るステップ２と、
得られたオフセット値に基づいてマスクレス露光方式によって各電気的接続点上に再配線構造を形成して前記オフセット値を修正するステップ３と、
マスク露光方式によって前記キャリアに対して単一化処理を行って再配線構造の上部に配線層及び／または半田ボールを形成するステップ４と、
を含むことを特徴とする半導体再配線方法。
【請求項２】
ステップ３は、
第１誘電層を堆積するステップと、
第１誘電層上に第１フォトレジスト層をコーティングするステップと、
ステップ２で得られたオフセット値に基づいて、マスクレス露光方式方式によって第１フォトレジスト層に対応する一つの電気的接続点とアライメントされる複数の第１フォトレジストパターンを形成するステップと、
第１フォトレジスト層をマスクとして第１誘電層をエッチングし、第１誘電層に複数の第１開口を形成し、各第１開口に対応する電気的接続点を露出させるステップと、
第１フォトレジスト層を除去するステップと、
第２フォトレジスト層をコーティングするステップと、
前記オフセット値に基づいて、マスクレス露光方式方式によって第２フォトレジスト層に複数の第２フォトレジストパターンを形成して前記再配線構造を形成するための領域を定義するステップと、
前記領域に金属を充填して前記再配線構造を形成するステップと、を含むことを特徴とする請求項１に記載の半導体再配線方法。
【請求項３】
ステップ４は、
第２誘電層を堆積するステップと、
第２誘電層上に第３フォトレジスト層をコーティングするステップと、
マスク露光方式によって第３フォトレジスト層にそれぞれ一つのボール搭載パッド領域に対応する複数の第３フォトレジストパターンを形成するステップと、
第３フォトレジスト層をマスクとして第２誘電層をエッチングし、第２誘電層に複数の第２開口を形成し、各第２開口に再配線構造を部分的に露出させるステップと、
露出された一部再配線構造に半田ボールを形成するステップと、を含むことを特徴とする請求項２に記載の半導体再配線方法。
【請求項４】
前記再配線構造の領域はステップ４における前記第二開口の中において再配線構造のみ露出されるように定義される、
ことを特徴とする請求項３に記載の半導体再配線方法。
【請求項５】
前記半導体素子はチップである、
ことを特徴とする請求項１に記載の半導体再配線方法。
【請求項６】
それぞれが複数の電気的接続点を有する複数の半導体素子を載置するためのキャリアを設置するステップと、
各電気的接続点の前記キャリアに対する位置を測定するステップと、
測定した位置と前記電気的接続点が前記キャリアに対する標準位置とを比較して各電気的接続点のオフセット値を得るステップと、
前記オフセット値と既設の臨界範囲とを比較し、比較結果に基づいてリソグラフィを行い、前記電気的接続点上に再配線構造を形成するステップであって、
オフセット値が前記臨界範囲より小さい電気的接続点に対してマスク露光方式を採用し、
オフセット値が前記臨界範囲より大きい電気的接続点に対してマスクレス露光方式を採用し、
オフセット値が前記臨界範囲内にある電気的接続点に対して前記電気的接続点を囲む他の電気的接続点で最も多く採用される露光方式を選択することを含む再配線構造を形成するステップと、
キャリアをマスク露光方式によって単一化処理して、再配線構造上に配線層及び／または半田ボールを形成するステップと、を含むことを特徴とする半導体再配線方法。
【請求項７】
互いに垂直し且つ前記キャリアの表面に同時に平行する二つの直線方向をＸ方向及びＹ方向とし、前記キャリアの表面に垂直する直線方向をＺ方向としてＸＹＺ三次元座標系を形成し、前記オフセット値はＸオフセット値、Ｙオフセット値及びＲＺオフセット値の中の少なくとも一つであり、ＲＺはＺ軸を中心として回転する方向であることを特徴とする請求項６に記載の半導体再配線方法。
【請求項８】
再配線構造を形成するステップは、
まず、オフセット値が前記臨界範囲より大きい電気的接続点に対してマスクレス露光方式を用いて露光するステップと、
次に、オフセット値が前記臨界範囲より小さい電気的接続点に対してマスク露光方式を用いて露光し、露光する際には既にマスクレス方式マスクレス露光方式を利用して露光された箇所を遮蔽するステップと、
オフセット値が前記臨界範囲内にある電気的接続点に対して、現在領域を囲む隣接する領域の数を計算し、これら隣接する領域において何れかの露光方式が選択される回数が隣接する領域の数の半分より多い場合には、現在領域は当該露光方式を選択して露光されるステップと、
を含むことを特徴とする請求項６に記載の半導体再配線方法。
【請求項９】
再配線構造を形成するステップは、
まず、オフセット値が前記臨界範囲より小さい電気的接続点に対してマスク露光方式を用いて露光するステップ、
次に、オフセット値が前記臨界範囲より大きい電気的接続点に対してマスクレス露光方式を用いて露光し、露光時にマスク露光方式を利用して露光された箇所を遮蔽するステップと、
オフセット値が前記臨界範囲内にある電気的接続点に対して、現在領域を囲む隣接する領域の数を計算し、これら隣接する領域において何れかの露光方式が選択される回数が隣接する領域の数の半分より多い場合には、現在領域は当該露光方式を選択して露光されるステップと、を含むことを特徴とする請求項６に記載の半導体再配線方法。
【請求項１０】
前記臨界範囲は５μｍ〜７μｍであることを特徴とする請求項６に記載の半導体再配線方法。
【請求項１１】
前記半導体素子はチップであることを特徴とする請求項６に記載の半導体再配線方法。
【発明の詳細な説明】
【技術分野】
【０００１】
本発明は半導体分野に関し、特に半導体の再配線方法に関する。
【背景技術】
【０００２】
集積回路技術の持続的な発展に伴い、電子製品は小型化、スマート化、高性能及び高信頼性方向に発展しつつある。集積回路パッケージは集積回路の性能に直接影響を及ぼすだけでなく、電子システム全体の小型化、低コスト及び信頼性も制約する。集積回路チップのサイズが次第に縮小され、集積度が次第に向上するにつれて、集積回路パッケージに対してますます高い要求がなされている。
【０００３】
ファンアウト型ウェハレベルパッケージング（Ｆａｎ  Ｏｕｔ  Ｗａｆｅｒ  Ｌｅｖｅｌ  Ｐａｃｋａｇｅ、略してＦＯＷＬＰ)は、図１に示すように、チップウェハを独立したチップ２に切断した後、新しいキャリア１上に再配置してウェハレベルパッケージングを行うパッケージングプロセスである。従来のウェハレベルパッケージングプロセスによって、新しいキャリア1上に新しいパッケージ体３を形成することができる（図２に示す）。 図４にシングルパッケージ体のパッケージ構造が示されている。図４において、パッケージ体３内にチップ２を埋め込み、チップ２のボンディングパッド４をリソグラフィ、ＣＶＤ、ＰＶＤ、エッチング及び電解メッキなどのプロセスを通じて下部絶縁層７、金属層５及び上部絶縁層６からなる再配線構造を形成し、新しいＩ／Ｏポート（即ち、金属層５から引き出された電気的接続点）上に半田ボール８を形成して新しいパッケージ体３に均一に分布し、複数の新パッケージ体３は新しいキャリア１上に配列されて図２に示す構造を形成する。
【０００４】
典型的なファンアウト型ウェハレベルパッケージング再配線プロセス方法は、リソグラフィプロセスを採用して上部絶縁層６、金属層５、及び下部絶縁層７のパターン及び位置を定義し、さらにＣＶＤ、ＰＶＤ、及び電気メッキなどのプロセスによって絶縁層及び金属層を生成する。主流のリソグラフィ技術（即ちマスク露光方式）は、まず目標パターンの一定の比率に応じてマスクを製造し、光学投影方式でチップ上に塗布された感光性接着剤の部分領域で反応が発生するようにしてパターン及び位置を定義する。大規模の量産歩留まりを満足するチップ再配置装置のチップ位置決め精度は７μｍ〜１０μｍしかないため（前記リソグラフィプロセスで要求される位置決め精度は５μｍ未満である）、リソグラフィ率が低く、大規模の量産が困難である。
【０００５】
さらに、マスクレス露光方式技術もあるが、その原理はマスクの代わりに光変調器を利用して、リアルタイム制御により所望のパターンに変調し、マスクレス露光方式を採用する際の構造は図３に示す通りである。このような方式はチップの再配置の位置決め精度が正確でないという問題を解決することができるが、このような方式は新しいキャリア１上に全体のすべてのリソグラフィ領域に対して適合計算する必要があるため、リソグラフィを行う毎の歩留まりが極めて低く（各リソグラフィ時に２~３時間必要）、現在のファンアウト型ウェハレベルパッケージングプロセスの生産サイクル（５~１０分）を満たすことができない。
【発明の概要】
【発明が解決しようとする課題】
【０００６】
前述の問題を解決するために、本発明はマスクレス露光方式とマスク露光方式とを結合し、両者の長所を組み合わせて用いることによって、単にマスクレス露光方式を用いる際に比べて時間を節約することができるとともに、効率が向上し、単にマスク露光方式を用いる際に比べてリソグラフィ精度を向上させることができる半導体再配線方法を提供する。
【課題を解決するための手段】
【０００７】
前述の目的を達するために、本発明は、
それぞれが複数の電気的接続点を有する複数の半導体素子を載置するためのキャリアを設置するステップ１と、
各電気的接続点の前記キャリアに対する位置を測定し、測定した位置と前記電気的接続点が前記キャリアに対する標準位置とを比較して各電気的接続点のオフセット値を得るステップ２と、
得られたオフセット値に基づいてマスクレス露光方式によって各電気的接続点上に再配線構造を形成して前記オフセット値を修正するステップ３と、
マスク露光方式によって前記キャリアに対して単一化処理を行って再配線構造の上部に配線層及び／または半田ボールを形成するステップ４と、を含む半導体再配線方法を提供する。
【０００８】
好ましくは、ステップ３は、
第１誘電層を堆積するステップと、
第１誘電層上に第１フォトレジスト層をコーティングするステップと、
ステップ２で得られたオフセット値に基づいて、マスクレス露光方式によって第１フォトレジスト層に対応する一つの電気的接続点とアライメントされる複数の第１フォトレジストパターンを形成するステップと、
第１フォトレジスト層をマスクとして第１誘電層をエッチングし、第１誘電層に複数の第１開口を形成し、各第１開口に対応する電気的接続点を露出させるステップと、
第１フォトレジスト層を除去するステップと、
第２フォトレジスト層をコーティングするステップと、
前記オフセット値に基づいて、マスクレス露光方式によって第２フォトレジスト層に複数の第２フォトレジストパターンを形成して前記再配線構造を形成するための領域を定義するステップと、
前記領域に金属を充填して前記再配線構造を形成するステップと、を含む。
【０００９】
好ましくは、ステップ４は、
第２誘電層を堆積するステップと、
第２誘電層上に第３フォトレジスト層をコーティングするステップと、
マスク露光方式によって第３フォトレジスト層にそれぞれ一つのボール搭載パッド領域に対応する複数の第３フォトレジストパターンを形成するステップと、第３フォトレジスト層をマスクとして第２誘電層をエッチングし、第２誘電層に複数の第２開口を形成し、各第２開口に再配線構造を部分的に露出させるステップと、
露出された一部再配線構造に半田ボールを形成するステップと、を含む。
【００１０】
好ましくは、前記再配線構造の領域はステップ４における前記第二開口の中において再配線構造のみ露出されるように定義される。
【００１１】
好ましくは、前記半導体素子はチップである。
【００１２】
好ましくは、本発明はさらに、
それぞれが複数の電気的接続点を有する複数の半導体素子を載置するためのキャリアを設置するステップと、
各電気的接続点の前記キャリアに対する位置を測定するステップと、
測定した位置と前記電気的接続点が前記キャリアに対する標準位置とを比較して各電気的接続点のオフセット値を得るステップと、
前記オフセット値と既設の臨界範囲とを比較し、比較結果に基づいてリソグラフィを行い、前記電気的接続点上に再配線構造を形成するステップであって、
オフセット値が前記臨界範囲より小さい電気的接続点に対してマスク露光方式を採用し、
オフセット値が前記臨界範囲より大きい電気的接続点に対してマスクレス露光方式を採用し、
オフセット値が前記臨界範囲内にある電気的接続点に対して前記電気的接続点を囲む他の電気的接続点で最も多く採用される露光方式を選択することを含む再配線構造を形成するステップと、
キャリアをマスク露光方式によって単一化処理して、再配線構造上に配線層及び／または半田ボールを形成するステップと、を含む半導体再配線方法を提供する。
【００１３】
好ましくは、互いに垂直し且つ前記キャリアの表面に同時に平行する二つの直線方向をＸ方向及びＹ方向とし、前記キャリアの表面に垂直する直線方向をＺ方向としてＸＹＺ三次元座標系を形成し、前記オフセット値はＸオフセット値、Ｙオフセット値及びＲＺオフセット値の中の少なくとも一つであり、ＲＺはＺ軸を中心として回転する方向である。
【００１４】
好ましくは、再配線構造を形成するステップは、
まず、オフセット値が前記臨界範囲より大きい電気的接続点に対してマスクレス露光方式を用いて露光するステップと、
次に、オフセット値が前記臨界範囲より小さい電気的接続点に対してマスク露光方式を用いて露光し、露光する際には既にマスクレス方式マスクレス露光方式を利用して露光された箇所を遮蔽するステップと、
オフセット値が前記臨界範囲内にある電気的接続点に対して、現在領域を囲む隣接する領域の数を計算し、これら隣接する領域において何れかの露光方式が選択される回数が隣接する領域の数の半分より多い場合には、現在領域は当該露光方式を選択して露光されるステップと、を含む。
【００１５】
好ましくは、再配線構造を形成するステップは、
まず、オフセット値が前記臨界範囲より小さい電気的接続点に対してマスク露光方式を用いて露光するステップ、
次に、オフセット値が前記臨界範囲より大きい電気的接続点に対してマスクレス露光方式を用いて露光し、露光時にマスク露光方式を利用して露光された箇所を遮蔽するステップと、
オフセット値が前記臨界範囲内にある電気的接続点に対して、現在領域を囲む隣接する領域の数を計算し、これら隣接する領域において何れかの露光方式が選択される回数が隣接する領域の数の半分より多い場合には、現在領域は当該露光方式を選択して露光されるステップと、を含む。
【００１６】
好ましくは、前記臨界範囲は５μｍ〜７μｍである
【００１７】
好ましくは、前記半導体素子はチップである。
【発明の効果】
【００１８】
従来技術に比べて、本発明は、キャリア上の各電気的接続点のオフセット値を計算した後、まずマスクレス露光方式方式によってオフセット値の補正を行い、電気的接続点上に再配線構造を形成した後、マスク露光方式によってキャリアに対して単一化処理を行って（オフセット値を考慮する必要がない）、再配線構造の上方に配線層及び／または半田ボールを形成する。このように、マスクレス露光方式とマスク露光方式とを組み合わせることによって、マスクレス露光方式のみを用いる際に比べて効率を向上させ、時間を節約することができるという有益な効果を奏する。
【００１９】
本発明は半導体再配線方法をさらに提供するものであり、キャリア上の各電気的接続点のオフセット値を計算した後、オフセット値に対して臨界範囲を設置して、オフセット値が前記臨界範囲より小さい電気的接続点に対してマスク露光方式を採用し、オフセット値が前記臨界範囲より大きい電気的接続点に対してマスクレス露光方式を採用し、オフセット値が前記臨界範囲内にある電気的接続点に対して、現在領域を囲む隣接する領域の数を計算し、これら隣接する領域において何れかの露光方式が選択される回数が隣接する領域の数の半分より多い場合には、現在領域は当該露光方式を選択して露光される。このように、状況合わせて露光方式を選択し、高精度が要求される場合にはマスクレス露光方式を選択し、精度に対する要求が低い場合にはマスク露光方式を選択し、マスク露光方式とマスクレス露光方式を互いに組み合わせることによって、プロセスの効率が向上するだけでなく、時間が節約され、且つ精密度が保証される。
【図面の簡単な説明】
【００２０】
【図１】従来技術におけるファンアウト型ウェハレベルパッケージの構造を示す図面である。
【図２】従来技術におけるファンアウト型ウェハレベルパッケージの構造を示す図面である。
【図３】従来技術においてマスクレス露光方式技術を用いるファンアウト型ウェハレベルパッケージの構造を示す図面である。
【図４】従来技術におけるシングルパッケージ体のパッケージ構造を示す図面である。
【図５】本発明の実施例１におけるキャリア上のチップのオフセットを示す図である。
【図６】本発明の実施例１における方法のフローチャートである。
【図７】本発明の実施例１においてチップ上に保護層が堆積されたことを示す図である。
【図８】本発明の実施例１において保護層にフォトレジストが堆積されたことを示す図である。
【図９】本発明の実施例１においてフォトレジストに対して露光及び現像をしたことを示す図である。
【図１０】本発明の実施例１において保護層に対して露光及び現像をしたことを示す概略図である。
【図１１】本発明の実施例１において図１０の構造にフォトレジストを堆積したことを示す図である。
【図１２】本発明の実施例１においてフォトレジストに対して露光及び現像をしたことを示す図である。
【図１３】本発明の実施例１において図１２の構造に金属層を堆積したことを示す図である。
【図１４】本発明の実施例１において図１３の構造に保護層を堆積したことを示す図である。
【図１５】本発明の実施例１において図１４の構造にフォトレジストを堆積したことを示す図である。
【図１６】本発明の実施例１において図１５の構造に対してフォトレジストに対して露光及び現像をしたことを示す図である。
【図１７】本発明の実施例１においてボール搭載パッドを露光したことを示す図である。
【図１８】本発明の実施例１においてボールの搭載を示す図である。
【図１９】本発明の実施例２における方法のフローチャートである。
【図２０】本発明の実施例２においてチップ上に保護層が堆積されたことを示す図である。
【図２１】本発明の実施例２において図２０の構造にフォトレジストを堆積したことを示す図である。
【図２２】本発明の実施例２において保護層に対してリソグラフィを行って電気的接続点を露光させることを示す図である。
【図２３】本発明の実施例２において図２２の構造に金属シード層を堆積して導通線路を形成することを示す図である。
【図２４】本発明の実施例２において図２３の構造に保護層を堆積したことを示す図である。
【図２５】本発明の実施例２において導通線路を露光させることを示す図である。
【図２６】本発明の実施例２においてボール搭載パッドを形成することを示す図である。
【図２７】本発明の実施例２においてボール搭載パッドに保護層を堆積することを示す図である。
【図２８】本発明の実施例２において図２７の構造に対してリソグラフィを行って半田ボールを形成したことを示す図である。
【発明を実施するための形態】
【００２１】
以下、本発明の前記目的、特徴及び利点をより分かりやすく明確に理解するために、添付図面を結合して本発明の具体的な実施形態について詳しく説明する。
【実施例１】
【００２２】
本発明の実施例１はファンアウト型ウェハパッケージング方法を提供する。図５に示すように、キャリア１００上でチップの再配置が完了されるものであり、図５においては、水平横方向に配列された３つのチップ２１０、２２０及び２３０が示され、各チップ上に２つのＩ／Ｏポートがそれぞれ配置される。即ち、２つの電気的接続点が設置され、６つの電気的接続点２１１、２１２、２２１、２２２、２３１、２３２が形成される。
【００２３】
水平横方向をＸ軸、縦方向をＺ軸、ＸＺ平面に垂直する方向をＹ軸として、ＸＹＺ三次元座標系を設定する。
【００２４】
キャリア１００上に複数のチップが配置され、図５には３つのチップ２１０、２２０、２３０のみが概略的に示され、後続するボール搭載プロセスにおけるパラメータによって、各チップ上の電気的接続点及びボール搭載パッドに対してその座標値の基準値が定義される。
【００２５】
図５に現れるように、前段のプロセスが原因で、キャリア１００上に配列された３つのチップは程度は異なるもののオフセットが発生している。特に、複数のチップの中において、チップ２１０およびチップ２３０の中心軸ＬＬは各パッケージ体の中心軸ＵＵに対するオフセットが大きく、オフセットピッチは最大７μｍに達し、そのため、各電気的接続点の実際座標値は標準値に対して必ずオフセットが発生する。
【００２６】
従って、ボール搭載プロセスを行う前に、３つのチップ上の電気的接続点に対する位置補正を行い、標準値に対してオフセットのないボール搭載パッドを得てこそ正確にボールを搭載することができる。位置補正方法は、リソグラフィを通じて再配線することにより、電気的接続点を位置補正後のボール搭載パッドに連通させるものである。
【００２７】
図６に示すように、具体的な実施プロセスは以下の通りである。
ステップ１．０１：
まず、キャリア１００上で再配置されたチップを段階的に走査してチップ位置レイアウト（ｍａｐｐｉｎｇ）図を形成し、図７に示すように、チップの再配置が完了されたキャリア１００のチップデバイスの表面に保護層材料を堆積して保護層３１０を形成する。
ここで、保護層材料は、誘電体材料または有機材料から選択することができる。保護層３１０の堆積プロセスは、蒸着、酸化などの様々な方法を採用することができる。
【００２８】
ステップ１．０２：
ステップ１．０１で形成された保護層３１０上にフォトレジスト４１０を堆積する（図８参照）。
【００２９】
ステップ１．０３：
マスクレス露光方式機能を有する装置を利用して、６つの電気的接続点２１１、２１２、２２１、２２２、２３１、２３２に対応する領域で露光プロセスを行い、露光、現像、硬化などのリソグラフィプロセスによって再配線する電気的接続点に対応する領域を定義して製作する（図９参照）。
ここで、マスクレス露光方式装置は、予め入力したチップ位置レイアウト図及びリソグラフィ定義パターンによってチップとのアライメントによってキャリア１００上で対応するリソグラフィ領域を見つけることができ、ステップ１．０３が完了すると、フォトレジスト４１０には、電気的接続点と一対一でアライメントされたフォトレジストパターン４１１が形成される。
【００３０】
ステップ１．０４：
ステップ１．０３においてリソグラフィプロセスによって定義された電気的接続点領域で覆われた保護層材料を除去する（図１０を参照）。
ここで、保護層材料の除去方式は、ウェットエッチングまたはドライエッチングなどの方式により実現することができ、ステップ１．０４が終わると、保護層３１０に複数の開口３１１が形成され、各開口３１１は一つの電気的接続点に対応し、開口の底部に前記電気的接続点を露出させ、後に金属配線を通じて電気的接続点を引き出せるようにする。
【００３１】
ステップ１．０５：
図１１に示すように、ステップ１．０４で形成された構造の上にフォトレジスト４２０を堆積する。
【００３２】
ステップ１．０６：
マスクレス露光方式機能を有する装置を利用して、露光、現像、硬化などのリソグラフィプロセスにより金属再配線領域を定義して製作する。金属再配線によってチップ電気的接続点との相互接続を実現するものであり、金属再配線の金属線路位置はキャリア１００上の基準によって統一的に定義され、チップの位置オフセットによって微調整及び補償される。
具体的には、オフセットのない標準金属配線パターンに基づいて各チップの位置オフセットを考慮して修正された金属配線パターン４２１を形成する（図１２参照）。
例えば、チップの中心軸がパッケージ体の中心軸に対して所定量だけ左にオフセットする場合には、標準金属配線パターンに基づいてパターンを右側へ延伸及び／または右側へ所定距離だけ移動して修正後の金属配線パターンを形成することができ、前記延伸及び／または移動距離は前記オフセット量以上であってもよい。
チップの中心軸がパッケージ体の中心軸に対して右側にオフセットする場合には、標準金属配線パターンに基づいてパターンを左側へ延伸及び／または左側へ所定距離移動させて修正された金属配線パターンを形成する。
その他、前記修正後の金属配線パターン４２１はステップ１．０４で形成された開口３１１を露出させなければならない。ステップ１．０６で形成された各金属配線パターンの形状、大きさ、及び位置の中の１つ以上は互いに異なってもよく、即ち、前記各金属配線パターンがキャリア１００全体における分布は規則的でないことを容易に理解することができる。
【００３３】
ステップ１．０７：
ステップ１．０６で形成された構造上に金属シード層をスパッタリングし、さらに、化学メッキ、電気メッキなどによって再配線金属線路５００を形成する（図１３参照）。前記金属線路５００は後続プロセスにおいてボールを搭載するためのボール搭載パッドを形成するために用いられるか、または、上層金属にさらに連結される。
ここで、成長させる金属材料は銅、アルミニウム、タングステンなどの金属であることができ、前述した３つの金属材料に制限されない。
【００３４】
この段階まででは、金属線路５００を形成することによってチップ上の電気的接続点の位置補正が実現される。次に、単一化処理により後続する配線及び／またはボール搭載プロセスを完成する。ここで、単一化処理を統一化処理と理解してもよく、単一のチップのキャリア１００上での位置オフセットを考慮する必要はなく、オフセットのない標準位置に基づいて各チップを統一して直接処理する。
【００３５】
以下では、単一化処理によりボールを直接搭載するプロセスを例に挙げて説明する。
【００３６】
ステップ１．０８：
図１４に示すように、残留フォトレジストを除去した後、保護層３２０を堆積させる。
保護層３２０の材料は、誘電材料または有機材料から選択することができ、保護層３２０の堆積プロセスは蒸着、酸化、またはスパッタリングなどの様々な方法を用いることができる。
【００３７】
ステップ１．０９：
図１５に示すように、ステップ１．０８で形成された構造上にフォトレジスト４３０を堆積させる。
【００３８】
ステップ１．１０：
マスク露光方式機能を有する装置を利用して、キャリア１００を統一のための基準として標準値に対してオフセットのないボール搭載パッド６００の位置及びパターンサイズを定義し、金属線路５００と一対一で対応するフォトレジストパターン４３１を形成する（図１６参照）。
単一化処理方式を用いることによって、ステップ１．１０で形成されたフォトレジストパターン４３１はキャリア１００全体にわたって規則的な分布を有することが容易に理解される。
【００３９】
ステップ１．１１：
リソグラフィプロセスによって定義されたボール搭載パッド６００の領域を覆う保護層材料３２０を除去して、下方の金属線路５００の一部を露出させた後、フォトレジスト４３０を除去し、図１７に示すように、露出された一部の金属線路によりボール搭載パッド６００が形成される。
保護層材料の除去方法は、ウェットエッチングまたはドライエッチングにより実現することができる。
【００４０】
ステップ１．１２：
図１８に示すように、半田ボール７００の製造プロセスを完成する。
【００４１】
本実施例では、マスクレス露光方式とマスク露光方式とを結合することによって、単にマスクレス露光方式方式を使用する際に比べて、効率を向上させることができ、また時間を節約することができる。
【実施例２】
【００４２】
本発明の実施例２では、ファンアウトウエハパッケージング方法を提供する。キャリア１００のチップ位置数が少ない場合、まずキャリア１００上に再配置されたチップの位置を走査してチップ配置レイアウト図を形成し、また、オフセット値については、臨界範囲を設定し、臨界範囲は具体的な作業条件に応じて設定されることができ、本実施例では５μｍ〜７μｍのオフセットを臨界基準とする。例えば、チップの位置のオフセット値が臨界範囲より大きい領域ではマスクレス露光を採用した後、全体においてマスク露光方式を採用し、このような方式によってファンアウトウエハパッケージングの歩留まりを大幅に向上させることができる。
【００４３】
または、露光中に、オフセット値が臨界範囲よりも大きい領域に対してはマスクレス露光を採用し、オフセット値が臨界範囲よりも小さい領域に対してはマスク露光を採用し、オフセット値が臨界範囲内にある領域に対しては前記領域を囲む他の領域で選択される回数が最も多い露光方式を選択して露光する。
露光前のリソグラフィシステムでは、全領域の露光方式は予め定義されており、オフセット値が臨界範囲内にある領域でマスク露光方式を選択すれば、オフセット値が臨界範囲より小さい領域とともにマスク露光が行われ、オフセット値が臨界範囲内にある領域でマスクレス露光方式を選択すれば、オフセット値が臨界範囲より大きい領域とともにマスクレス露光を行う。
【００４４】
ここで、オフセット値が臨界範囲より大きい領域及び臨界範囲より小さい領域の露光順序は限定されず、例えばオフセット値が臨界範囲より大きい領域及び臨界範囲内でマスクレス露光方式を選択すべき領域はマスクレス露光を採用して露光し、その後残りの領域に対してマスク露光方式を採用して露光し、露光と同時に既に露光された領域に対して遮蔽処理をしてもよい。またはオフセット値が臨界範囲より小さい領域及び臨界範囲内でマスク露光方式を選択すべき領域に対してマスク露光方式を採用して露光し、残りの領域はマスクレス露光方式を採用して露光し、露光と同時に既に露光した領域に対して遮蔽処理をしてもよい。
【００４５】
具体的な方法は図１９に示す通りであり、具体的なステップは以下の通りである。
ステップ２．０１：
キャリア１００のチップレイアウトに対して位置走査してチップ位置レイアウト図を作成する。
【００４６】
ステップ２．０２：
図２０に示すように、チップを再配置したキャリア１００のチップデバイス表面に保護層材料を堆積して保護層３１０を形成する。保護層３１０の材料は誘電材料または有機材料から選択されることができる。
保護層３１０の堆積プロセスは、蒸着、酸化などの様々な方法を採用することができる。
【００４７】
ステップ２．０３：
図２１に示すように、ステップ２．０２で形成された構造上にフォトレジスト４１０を堆積する。
【００４８】
ステップ２．０４：水平方向をＸ軸、垂直方向をＺ軸、ＸＺ平面に垂直する方向をY軸としてＸＹＺ三次元座標系を形成する。図２２に示すように、オフセット値は、Ｘオフセット値、Ｙオフセット値、及びＲＺオフセット値に分けられ、ＲＺはＺ軸を中心として回転する方向であり、電気的接続点の前記何れか一つのオフセット値が臨界範囲より大きい領域に対して、マスクレス露光方式機能を有する装置を利用して露光プロセスを行い、電気的接続点の前記何れか一つのオフセット値が臨界範囲より小さい領域に対して、マスク露光方式機能を有する装置を利用して露光プロセスを行い、オフセット値が臨界範囲内にある領域に対しては、前記領域を囲む他の領域の中で選択された回数が最も多い露光方式を選択して露光した後、電気的接続点に対応する領域の保護層３１０を除去する。
【００４９】
マスクレス露光及びマスク露光の順序は限定されず、例えば、まずオフセット値が臨界範囲より大きい領域及び臨界範囲内でマスクレス露光方式を選択すべき領域に対してマスクレス露光方式を採用して露光し、その後、 残りの領域に対してマスク露光方式を採用して露光し、露光と同時に既に露光された領域に対して遮蔽処理をしてもよい。またはオフセット値が臨界範囲より小さい領域及び臨界範囲内でマスク露光方式を採用すべき領域に対してマスク露光方式を採用して露光し、残りの領域に対してマスクレス露光方式を採用して露光し、露光と同時に既に露光された領域に対して遮蔽処理をしてもよい。
【００５０】
保護層材料の除去方式はウェットエッチングまたはドライエッチングなどの方式により実現することができる。
【００５１】
オフセット値が臨界範囲内にある領域に対して、前記領域を囲む他の領域の中で選択される回数が最も多い露光方式を選択して露光するステップは、現在の領域を囲む隣接する領域の数を計算するステップと、これら隣接する領域の中で何れか一つの露光方式が選択された回数が隣接する領域の数の半分より多い場合には、現在の領域は当該露光方式を選択して露光するステップとを含む。
例えば、オフセット値が臨界範囲内にある或る領域の周囲に８つ隣接する領域があり、この８つの隣接する領域の中半分以上の領域がマスクレス露光方式を用いる場合、該領域もマスクレス露光方式を用いる。この８の隣接する領域の中半分以上の領域がマスク露光方式を用いる場合、該領域もマスク露光方式を用いる。この８つの隣接する領域の中で４つの領域はマスク露光方式を用い、他の４つの領域はマスクレス露光方式を用いる場合、該領域はマスク露光方式及びマスクレス露光方式の中の何れか一つを用いることができる。
【００５２】
ステップ２．０５：
第１実施例のステップ１．０５〜１．０６と類似する方法を採用して、フォトレジストによって電気的接続点を修正した領域を定義し、金属シード層をスパッタリングし、さらに化学メッキ、電気メッキなどにより、修正電気的接続点２４１を形成する（図２３に示す）。図２３から分かるように、各修正電気的接続点２４１と対応するパッケージ体との間の相対位置は基本的に統一するものであり、対応するチップの中軸線との相対位置は統一しない。それにより、修正電気的接続点２４１の位置補償によってチップの位置オフセットを補正する。その他に、各修正電気的接続点２４１のそれぞれは、対応する電気的接続点に連結される。
【００５３】
ここまでにより、修正電気的接続点２４１によってチップ上の電気的接続点の位置補償が実現される。その後、単一化処理をするだけで後続する配線及び／またはボール搭載プロセスを完成する。ここにおける単一化処理は統一化処理として理解してもよい。即ち、キャリア１００上の単一チップの位置オフセットを考慮する必要がなく、オフセットのない標準位置に基づいて各チップに対して統一化の処理を直接行う。
【００５４】
以下、単一化処理により配線及びボール搭載プロセスを行う例について説明する。
【００５５】
ステップ２．０６：
図２４に示すように、ステップ２．０５で形成された構造上に保護層３２０を堆積する。
【００５６】
ステップ２．０７：
図２５に示すように、マスク露光方式機能を有する装置を利用して、リソグラフィプロセスによって修正電気的接続点２４１が位置する領域を定義し、前記領域上に覆われている保護層３２０を除去する。
【００５７】
ステップ２．０８：
マスク露光方式機能を有する装置を利用して露光プロセスにより上層金属配線領域を定義して形成する。図２６に示すように、金属シード層をスパッタリングした後、さらに化学メッキ、電気メッキなどの方法によって上層金属線路を形成する。単一的な処理方式を用いるので、ステップ２．０８で形成された上層金属線路がキャリア１００全体での分布が規則的であることは容易に理解できる。
成長させる金属材料は、銅、アルミニウム、タングステンなどの金属であることができ、前記３つの金属材料に限定されない。
【００５８】
ステップ２．０９：
図２７に示すように、ステップ２．０８で形成された構造上に保護層３３０を堆積する。
保護層材料は、誘電材料または有機材料から選択されることができ、保護層３３０の堆積プロセスは蒸着、酸化、またはスパッタリングなどの様々な方法を用いることができる。
【００５９】
ステップ２．１０：
マスク露光方式機能を有する装置を利用して、オフセットのないボール搭載パッド６００の位置及びパターンサイズを定義し、ボール搭載パッド６００に対応する領域を覆っている保護層３３０を除去し、露出された上層金属線路の部分はボール搭載パッド６００であり、最後に、図２８に示すように、ボール搭載パッド６００上に半田ボール７００の製作プロセスを完成する。
【００６０】
本実施例は異なるオフセット値を有する異なる領域に対して異なる露光方式を用い、マスクレス露光方式及びマスク露光方式を互いに結合することによって、リソグラフィの効率が向上され、時間が節約される。
【００６１】
本発明では以上の実施例について説明したが、本発明は前述の実施例に限定されるのではない。例えば、キャリア１００はチップ以外の電気的接続点を有する他の半導体素子を載置することができる。本発明が属する技術分野において通常の知識を有する者は本発明の精神及び範囲内で発明に対して各種修正及び変形を行うことができることは自明である。このように、本発明のこのような修正及び変形は本発明の特許請求範囲及び均等な技術の範囲に属するのであれば、本発明もこのような修正及び変形を含むものとする。
【符号の説明】
【００６２】
図１〜図４において：
１−新しいキャリア、２−チップ、３−パッケージ体、４− ボンディングパッド、５−金属層、６−上部絶縁層、７−下部絶縁層、８− 半田ボール ；
図５〜図２８において
１００−キャリア、２１０、２２０、２３０−チップ、２１１、２１２、２２１、２２２、２３１、２３２−電気的接続点、２４１−修正電気的接続点、３１０、３２０、３３０−保護層、３１１−開口、４１０、４２０、４３０−フォトレジスト、４１１、４３１−フォトレジストパターン、４２１−金属配線パターン、５００−金属線路、６００−ボール搭載パッド、７００−半田ボール；
ＬＬ−チップ中心軸、ＵＵ−パッケージ体中心軸。
【図１】
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【図２】
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【図３】
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【図４】
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【図５】
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【図６】
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【図７】
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【図８】
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【図９】
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【図１０】
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【図１１】
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【図１２】
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【図１３】
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【図１４】
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【図１５】
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【図１６】
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【図１７】
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【図１８】
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【図１９】
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【図２０】
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【図２１】
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【図２２】
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【図２３】
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【図２４】
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【図２５】
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【図２６】
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【図２７】
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【図２８】
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【国際調査報告】
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