【手続補正書】
【提出日】平成18年12月8日(2006.12.8)
【手続補正１】
【補正対象書類名】明細書
【補正対象項目名】特許請求の範囲
【補正方法】変更
【補正の内容】
【特許請求の範囲】
【請求項１】
複数の仮想ダイレクトメモリアクセスチャネルをサポートするためのダイレクトメモリアクセスエンジンであって、
ダイレクトメモリアクセスコントローラを含み、前記ダイレクトメモリアクセスコントローラは、
物理ダイレクトメモリアクセス制御ブロックと、
物理ダイレクトメモリアクセスチャネルリソースと、
前記物理ダイレクトメモリアクセス制御ブロックに結合され、前記物理ダイレクトメモリアクセス制御ブロックおよび前記物理ダイレクトメモリアクセスチャネルリソースを共有する複数の仮想ダイレクトメモリアクセスチャネルとを含み、前記ダイレクトメモリアクセスエンジンはさらに、
前記複数の仮想ダイレクトメモリアクセスチャネルに対するパラメータを格納するパラメータテーブルを含むメモリと、
前記物理ダイレクトメモリアクセス制御ブロックおよび前記物理ダイレクトメモリアクセスチャネルリソースに結合される物理ダイレクトメモリアクセスチャネルとを含む、ダイレクトメモリアクセスエンジン。
【請求項２】
複数の仮想ダイレクトメモリアクセスチャネルをサポートするためのダイレクトメモリアクセスエンジンであって、
ダイレクトメモリアクセスコントローラを含み、前記ダイレクトメモリアクセスコントローラは、
物理ダイレクトメモリアクセス制御ブロックと、
物理ダイレクトメモリアクセスチャネルリソースと、
前記物理ダイレクトメモリアクセス制御ブロックおよび前記物理ダイレクトメモリアクセスチャネルリソースに結合された、物理ダイレクトメモリアクセスチャネルと、
前記物理ダイレクトメモリアクセス制御ブロックに結合され、前記物理ダイレクトメモリアクセスチャネル、前記物理ダイレクトメモリアクセス制御ブロックおよび前記物理ダイレクトメモリアクセスチャネルリソースを共有する複数の仮想ダイレクトメモリアクセスチャネルと、
前記複数の仮想ダイレクトメモリアクセスチャネルに対するパラメータを格納するパラメータテーブルを含むメモリとを含む、ダイレクトメモリアクセスエンジン。
【請求項３】
前記複数の仮想ダイレクトメモリアクセスチャネルのうちアクティブな仮想ダイレクトメモリアクセスチャネルに対するパラメータが、パラメータテーブルから物理ダイレクトメモリアクセスチャネルリソースおよび物理ダイレクトメモリアクセス制御ブロックにロードされる、請求項１または２記載のダイレクトメモリアクセスエンジン。
【請求項４】
前記複数の仮想ダイレクトメモリアクセスチャネルのうちのアクティブな仮想ダイレクトメモリアクセスチャネルについてのパラメータを、前記パラメータテーブルから、前記物理ダイレクトメモリアクセスチャネルリソースおよび前記ダイレクトメモリアクセス制御ブロックにロードする実行ユニットをさらに含む、請求項１または２記載のダイレクトメモリアクセスエンジン。
【請求項５】
所与の時間には前記複数の仮想ダイレクトメモリアクセスチャネルのうち１つのチャネルがアクティブになる、請求項１または２記載のダイレクトメモリアクセスエンジン。
【請求項６】
前記物理ダイレクトメモリアクセスチャネルリソースおよび前記物理ダイレクトメモリアクセス制御ブロックが、前記複数の仮想ダイレクトメモリアクセスチャネルのうちアクティブな仮想ダイレクトメモリアクセスチャネルに対するパラメータを格納する、請求項１または２記載のダイレクトメモリアクセスエンジン。
【請求項７】
前記ダイレクトメモリアクセスコントローラが、前記パラメータに基づいて、前記物理ダイレクトメモリアクセスチャネルを介して、前記複数の仮想ダイレクトメモリアクセスチャネルのうちアクティブな仮想ダイレクトメモリアクセスチャネルに対するダイレクトメモリアクセス転送を行なう、請求項１または２のいずれかに記載のダイレクトメモリアクセスエンジン。
【請求項８】
前記複数の仮想ダイレクトメモリアクセスチャネルのうちアクティブなチャネルに対するダイレクトメモリアクセスリクエスト線をさらに含む、請求項１または２記載のダイレクトメモリアクセスエンジン。
【請求項９】
前記複数の仮想ダイレクトメモリアクセスチャネルのうちアクティブなチャネルに対するダイレクトメモリアクセスアクノレッジ線をさらに含む、請求項１、２または４記載のダイレクトメモリアクセスエンジン。
【請求項１０】
複数の仮想ダイレクトメモリアクセスチャネルをサポートするためのマイクロコントローラであって、
実行ユニットと、前記実行ユニットに結合されたダイレクトメモリアクセスユニットとを含み、
前記ダイレクトメモリアクセスユニットが、請求項１乃至９いずれか１項記載のダイレクトメモリアクセスエンジンを含む、
マイクロコントローラ。
【請求項１１】
前記ダイレクトメモリアクセスエンジンは、前記複数の仮想ダイレクトメモリアクセスチャネルのうちアクティブなチャネルに対するダイレクトメモリアクセスリクエスト線と、前記複数の仮想ダイレクトメモリアクセスチャネルのうちアクティブなチャネルに対するダイレクトメモリアクセスアクノレッジ線とを含み、
前記ダイレクトメモリアクセスリクエスト線を受け、前記ダイレクトメモリアクセスアクノレッジ線を提供するために、前記ダイレクトメモリアクセスエンジンに結合されるダイレクトメモリアクセスリクエスト／アクノレッジポートブロックをさらに含む、
請求項１０記載のマイクロコントローラ。
【請求項１２】
前記ダイレクトメモリアクセスリクエスト／アクノレッジポートブロックが、
前記アクティブな仮想ダイレクトメモリアクセスチャネルに対応するダイレクトメモリアクセスアクノレッジ信号を前記ダイレクトメモリアクセスコントローラから前記ダイレクトメモリアクセスアクノレッジ線へ導くためのステアリング論理を含む、請求項１１記載のマイクロコントローラ。
【請求項１３】
前記ダイレクトメモリアクセスアクノレッジ信号を前記ダイレクトメモリアクセスリクエスト／アクノレッジポートブロックに与え、かつ前記ダイレクトメモリアクセスアクノレッジ信号を前記ダイレクトメモリアクセスリクエスト／アクノレッジポートブロックから受けるように前記ダイレクトメモリアクセスリクエスト／アクノレッジポートブロックに結合された装置をさらに含む、請求項１１記載のマイクロコントローラ。
【請求項１４】
複数の仮想ダイレクトメモリアクセスチャネルをサポートするためにダイレクトメモリアクセスエンジンを用いてダイレクトメモリアクセス転送を制御する方法であって、
ダイレクトメモリアクセスエンジンはダイレクトメモリアクセスコントローラを含み、前記ダイレクトメモリアクセスコントローラは、物理ダイレクトメモリアクセス制御ブロックと、物理ダイレクトメモリアクセスチャネルリソースと、複数の仮想ダイレクトメモリアクセスチャネルとを有し、
前記複数の仮想ダイレクトメモリアクセスチャネルは、前記物理ダイレクトメモリアクセス制御ブロックおよび前記物理ダイレクトメモリアクセスチャネルリソースを共有しており、
前記ダイレクトメモリアクセスエンジンはさらに物理ダイレクトメモリアクセスチャネルを有し、前記ダイレクトメモリアクセスエンジンはさらに、前記複数の仮想ダイレクトメモリアクセスチャネルに対するパラメータを格納するためのパラメータテーブルを有するメモリを含み、前記方法は、
前記複数の仮想ダイレクトメモリアクセスチャネルのうち第１のアクティブな仮想ダイレクトメモリアクセスチャネルに対するパラメータテーブルからのパラメータを前記ダイレクトメモリアクセスコントローラにロードするステップと、
前記ダイレクトメモリアクセスコントローラにロードされたパラメータに基づいて前記物理ダイレクトメモリアクセスチャネルを介して第１のアクティブな仮想ダイレクトメモリアクセスチャネルに対するダイレクトメモリアクセス転送を行なうステップとを含む、方法。
【請求項１５】
複数の仮想ダイレクトメモリアクセスチャネルをサポートするためにダイレクトメモリアクセスエンジンを用いてダイレクトメモリアクセス転送を制御する方法であって、
ダイレクトメモリアクセスエンジンはダイレクトメモリアクセスコントローラを含み、前記ダイレクトメモリアクセスコントローラは、物理ダイレクトメモリアクセス制御ブロックと、物理ダイレクトメモリアクセスチャネルリソースと、物理ダイレクトメモリアクセスチャネルと、複数の仮想ダイレクトメモリアクセスチャネルとを有し、
前記複数の仮想ダイレクトメモリアクセスチャネルは、物理ダイレクトメモリアクセスチャネル、物理ダイレクトメモリアクセス制御ブロックおよび物理ダイレクトメモリアクセスチャネルリソースを共有しており、
前記ダイレクトメモリアクセスエンジンはさらに、前記複数の仮想ダイレクトメモリアクセスチャネルに対するパラメータを格納するためのパラメータテーブルを有するメモリを含み、前記方法は、
前記複数の仮想ダイレクトメモリアクセスチャネルのうち第１のアクティブな仮想ダイレクトメモリアクセスチャネルに対するパラメータテーブルからのパラメータを前記ダイレクトメモリアクセスコントローラにロードするステップと、
前記ダイレクトメモリアクセスコントローラにロードされたパラメータに基づいて前記物理ダイレクトメモリアクセスチャネルを介して第１のアクティブな仮想ダイレクトメモリアクセスチャネルに対するダイレクトメモリアクセス転送を行なうステップとを含む、方法。
【請求項１６】
前記複数の仮想ダイレクトメモリアクセスチャネルのうち第２のアクティブな仮想ダイレクトメモリアクセスチャネルに対するパラメータテーブルからのパラメータを前記ダイレクトメモリアクセスコントローラにロードするステップと、
前記ダイレクトメモリアクセスコントローラにロードされたパラメータに基づいて前記物理ダイレクトメモリアクセスチャネルを介して第２のアクティブな仮想ダイレクトメモリアクセスチャネルに対するダイレクトメモリアクセス転送を行なうステップとをさらに含む、請求項１４または１５記載の方法。
【請求項１７】
前記ロードするステップが実行ユニットにより行なわれる、請求項１４または１５記載の方法。
【請求項１８】
前記ダイレクトメモリアクセス転送を行なうステップが、前記ダイレクトメモリアクセス制御ブロックにより制御される、請求項１４または１５記載の方法。
【請求項１９】
マイクロコントローラ内に前記ダイレクトメモリアクセスエンジンを設けるステップをさらに含む、請求項１４または１５記載の方法。
【請求項２０】
前記ロードするステップが、
前記パラメータの一部を前記物理ダイレクトメモリアクセスチャネルリソースにロードするステップを含む、請求項１４または１５記載の方法。
【請求項２１】
前記ロードするステップが、
前記パラメータの一部を前記物理ダイレクトメモリアクセス制御ブロックにロードするステップをさらに含む、請求項１４または１５載の方法。