(57)【要約】【課題】  石英基板上に薄膜トランジスタを形成するに際し、シリコン基板用の半導体装置を共用可能とすることで、良好でコストの低い薄膜トランジスタを得る、薄膜トランジスタの製造方法を提供する。【解決手段】  透光性基板１の一方の面に、所定の厚みとなるように、成膜条件の異なる少なくとも２つのシリコン膜２，３を積層する工程と、その後、前記シリコン膜２，３が形成されていない、前記透光性基板の他方の面に、薄膜トランジスタを形成する工程と、を備えた薄膜トランジスタの製造方法である。成膜条件の異なるシリコン膜５として、引張応力を生じる第１のシリコン膜２と、この引張応力を略相殺する大きさの圧縮応力を生じる第２のシリコン膜３とを積層する。ここで、熱ＣＶＤ法によって、第１のシリコン膜２を形成し、高密度プラズマＣＶＤ法によって、第２のシリコン膜３を形成する。【選択図】        図１
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【特許請求の範囲】
【請求項１】
透光性基板の一方の面に、膜応力の絶対値が、２．０×１０９ｄｙｎ／ｃｍ２以下となる所定の膜厚のシリコン膜を形成する工程と、
その後、前記シリコン膜が形成されていない、前記透光性基板の他方の面に、薄膜トランジスタを形成する工程と、
を備えたことを特徴とする薄膜トランジスタの製造方法。
【請求項２】
透光性基板の一方の面に、所定の厚みとなるように、成膜条件の異なる少なくとも２つのシリコン膜を積層する工程と、
その後、前記シリコン膜が形成されていない、前記透光性基板の他方の面に、薄膜トランジスタを形成する工程と、
を備えたことを特徴とする薄膜トランジスタの製造方法。
【請求項３】
成膜条件の異なる前記シリコン膜として、引張応力を生じる第１のシリコン膜と、前記引張応力を略相殺する大きさの圧縮応力を生じる第２のシリコン膜とを積層することを特徴とする請求項２に記載の薄膜トランジスタの製造方法。
【請求項４】
熱ＣＶＤ法によって、前記第１のシリコン膜を形成し、プラズマＣＶＤ法によって、前記第２のシリコン膜を形成することを特徴とする請求項３に記載の薄膜トランジスタの製造方法。
【請求項５】
請求項１又は請求項２〜４のいずれか一項に記載の薄膜トランジスタの製造方法において、前記透光性基板上に薄膜トランジスタを形成した後、前記シリコン膜を剥離する工程を備えたことを特徴とする薄膜トランジスタの製造方法。
【発明の詳細な説明】
【技術分野】
【０００１】
本発明は、薄膜トランジスタの製造方法に関する。
【背景技術】
【０００２】
薄膜トランジスタは、液晶表示装置や有機ＥＬ（エレクトロルミネセンス）表示装置などの電気光学装置において、画素のスイッチング素子として広く用いられている。
このような薄膜トランジスタは、その用途の多さからコストの低減が望まれている。この要望を実現する方法として、前記薄膜トランジスタを、シリコン基板用の半導体製造装置（半導体製造ライン）によって製造し、製造装置の共用化を図ることで、前記薄膜トランジスタのコスト低減することが考えられる。
ところで、前記の電気光学装置のスイッチング素子としての薄膜トランジスタは、透光性のある石英基板上に形成されている。
しかしながら、前記半導体製造装置における、光を用いてシリコン基板を検出する基板検出センサは、シリコン基板と異なり透光性のある石英基板を検出することができない。
【０００３】
そこで、石英基板の裏面を光を透過しない高融点金属膜で覆い、その上にシリコン膜を形成することで、前記基板検出センサが光を透過しない前記高融点金属膜により石英基板の検出を可能にし、石英基板とシリコン基板との間で半導体製造装置を共用化を図った技術がある（例えば、特許文献１参照）。
【特許文献１】特開平１１−３３０４８０号公報
【発明の開示】
【発明が解決しようとする課題】
【０００４】
このように、石英基板（透光性基板）を高融点金属膜で覆っていると、前記高融点金属膜上をシリコン膜で覆っていても、例えば前記石英基板上に薄膜トランジスタを形成する際の高温プロセスによって、前記高融点金属膜が拡散し、形成される薄膜トランジスタが汚染されるおそれがある。
薄膜トランジスタへの金属汚染を防止するためには、石英基板を覆うのに高融点金属膜を使用することなく、前記シリコン膜のみを使用し、前記基板検出センサが石英基板を検出できることが好ましい。このとき、石英基板を概ね５μｍ以上となる厚い膜厚のシリコン膜で覆うことで、このシリコン膜が前記高融点金属膜と同様に光を透過させないようになり、前記基板検出センサによって石英基板を良好に検出できるようになる。
しかしながら、シリコン膜の厚みが５μｍ以上となると、その膜応力が大きくなり、石英基板に反りを生じさせてしまう。このように反りの生じた石英基板上には、良好に薄膜トランジスタを形成することができなくなってしまう。
したがって、石英基板とシリコン基板との間で半導体製造装置を共用することは実用的ではなく、薄膜トランジスタのコストの低減を図ることは難しかった。
【０００５】
本発明は前記事情に鑑みてなされたもので、その目的とするところは、石英基板上に薄膜トランジスタを形成するに際し、シリコン基板用の半導体装置を共用可能とすることで、良好でコストの低い薄膜トランジスタを得る、薄膜トランジスタの製造方法を提供することにある。
【課題を解決するための手段】
【０００６】
本発明の薄膜トランジスタの製造方法においては、透光性基板の一方の面に、膜応力の絶対値が、２．０×１０９ｄｙｎ／ｃｍ２以下となる所定の膜厚のシリコン膜を形成する工程と、その後、前記シリコン膜が形成されていない、前記透光性基板の他方の面に、薄膜トランジスタを形成する工程と、を備えたことを特徴とする。
【０００７】
本発明の薄膜トランジスタの製造方法によれば、前記透光性基板の一方の面を覆うシリコン膜が、膜応力が透光性基板の反りに与える影響は非常にに小さい（絶対値で２．０×１０９ｄｙｎ／ｃｍ２以下、望ましくは１．０×１０９ｄｙｎ／ｃｍ２以下）ので、前記シリコン膜が形成された透光性基板が反ることはない。このように、透光性基板に反りが生じないので、露光工程等においてプロセス上の問題が生じず、この透光性基板上に良好に薄膜トランジスタを形成することができる。
ここで、前記透光性基板が、例えば前記シリコン膜の厚みが光を透過しない所定の厚みとなっているので、前記シリコン膜が形成された透光性基板の面はシリコン基板と同様に、光を透過することがない。
よって、前記シリコン膜に覆われた透光性基板の面は、シリコン基板と同様に光を透過することがないので、例えばシリコン基板用の半導体製造装置における基板検出センサが、前記透光性基板をシリコン基板として検出するようになる。
すなわち、前記半導体製造装置は、透光性基板とシリコン基板とを検出可能となるので、前記透光性基板と前記シリコン基板との間で、前記半導体製造装置を共用することができる。したがって、透光性基板上に薄膜トランジスタを製造する際のコストを低減することができる。
また、透光性基板上には、シリコン膜のみを形成しているので、従来の製造方法における高融点金属膜による金属汚染を防止できる。
【０００８】
本発明の薄膜トランジスタの製造方法においては、透光性基板の一方の面に、所定の厚みとなるように、成膜条件の異なる少なくとも２つのシリコン膜を積層する工程と、その後、前記シリコン膜が形成されていない、前記透光性基板の他方の面に、薄膜トランジスタを形成する工程と、
を備えたことを特徴とする。
【０００９】
本発明の薄膜トランジスタの製造方法によれば、成膜条件の異なるシリコン膜として、例えば圧縮応力を生じるシリコン膜と、引張応力を発生するシリコン膜とを、互いの応力が相殺するするようにして重ね合わせれば、前記シリコン膜の膜応力によって透光性基板が反ることはない。
よって、透光性基板に反りが生じないので、この透光性基板上に良好に薄膜トランジスタを形成することができる。
ここで、前記シリコン膜が、前述したような光を透過しない所定の厚みとすることで、前記シリコン膜が形成された透光性基板の面は、シリコン基板と同様に、光を透過することがない。
前記透光性基板は、十分な膜厚のシリコン膜に覆われているので、シリコン基板用の半導体製造装置における基板検出センサによっても検出することができ、この半導体製造装置を透光性基板にも用いることができる。
したがって、透光性基板とシリコン基板との間で、前記半導体製造装置を共用することができ、透光性基板上に薄膜トランジスタを製造する際のコストを低減することができる。
また、透光性基板上には、シリコン膜のみを形成しているので、従来の製造方法における高融点金属膜による金属汚染を防止できる。よって、コストが低く、良好な薄膜トランジスタを得ることができる。
【００１０】
前記薄膜トランジスタの製造方法においては、成膜条件の異なる前記シリコン膜として、引張応力を生じる第１のシリコン膜と、前記引張応力を略相殺する大きさの圧縮応力を生じる第２のシリコン膜とを積層することが好ましい。
このようにすれば、第１のシリコン膜と第２のシリコン膜とを成膜することで、前記シリコン膜によって透光性基板上に生じる膜応力が略相殺されて、透光性基板上に膜応力が発生するのを防止するようになる。よって、前記透光性基板に反りが生じることを防止することができる。
【００１１】
ここで、前記薄膜トランジスタの製造方法では、熱ＣＶＤ法によって、前記第１のシリコン膜を形成し、プラズマＣＶＤ法によって、前記第２のシリコン膜を形成することが好ましい。
このようにすれば、例えば低圧ＣＶＤ（ＬＰＣＶＤ）法により第１のシリコン膜を形成することで、第１のシリコン膜に引張応力を生じさせることができる。
また、例えば高密度プラズマＣＶＤ（ＨＤＰＣＶＤ）法により第２のシリコン膜を形成することで、第２のシリコン膜に圧縮応力を生じさせることができる。
したがって、第１のシリコン膜と第２のシリコン膜とが積層されることで、引張応力と圧縮応力とが相殺されて、透光性基板を覆うシリコン膜の膜応力が生じることを防止できる。
【００１２】
前記薄膜トランジスタの製造方法においては、前記透光性基板上に薄膜トランジスタを形成した後、前記シリコン膜を剥離する工程を備えたことが好ましい。
このようにすれば、コストが低く、良好な薄膜トランジスタを備えつつ、両面が透光性を有した透光性基板を得ることができる。よって、この透光性基板を、例えば光透過型液晶パネルや、有機ＥＬ表示装置の透光性を有する基板として用いることができる。
【発明を実施するための最良の形態】
【００１３】
以下に、本発明の薄膜トランジスタの製造方法における一実施形態について説明する。
図１は、本実施形態における薄膜トランジスタの製造工程を説明する図である。
本実施形態では、透光性基板として石英基板を用いて、この石英基板上にｎチャネル型の多結晶シリコンＴＦＴ（薄膜トランジスタ）を製造する工程について説明する。
【００１４】
まず、石英基板の一方の面に、所定の厚みとなるように、成膜条件の異なる少なくとも２つのシリコン膜、具体的には後述する第１のシリコン膜と第２のシリコン膜とを積層する。ここで、前記の所定の厚みとは、後述するように、前記石英基板１に裏面側に形成されるシリコン膜が光を透過させない膜厚、すなわち、５μｍ以上の厚みを示している。
【００１５】
１つ目の成膜条件により、第１のシリコン膜を形成する。
ここで、図１（ａ）に示すように、厚みが６２５μｍの石英基板１を用意する。そして、熱ＣＶＤ（Chemical Vapor Deposition）法として、減圧ＣＶＤ（Low-Pressure-ＣＶＤ）法を行うためのＣＶＤ装置（図示せず）の反応炉内に、前記石英基板１を入れる。
減圧ＣＶＤ法では、反応炉内を真空ポンプで減圧し反応ガスとして、シランガス(ＳｉＨ４)を流している。また、減圧ＣＶＤ法では、成長速度は遅いが、減圧することで平均自由工程が長くなり膜厚の均一性が高いものとすることができる。
本実施形態では、６１５℃の条件によって前述した減圧ＣＶＤ法を行うことで、図１（ｂ）に示したように、前記石英基板１の両面に２．７μｍの膜厚のポリシリコン膜（第１のシリコン膜）２を形成した。
【００１６】
ところで、前記の減圧ＣＶＤ法によって成膜されたポリシリコン膜２は、膜応力として引張応力を発生することが実験的に知られており、本実施形態では、＋１．０×１０１０ｄｙｎ／ｃｍ２の引張応力を発生する。
このとき、図１（ａ）に示したように、ポリシリコン膜２は前記石英基板１の両面に形成されているので、前記石英基板１の表面と裏面との間で前記ポリシリコン膜２の引張応力は相殺される。よって、前記ポリシリコン膜２の膜応力が前記石英基板１に、影響を与えることは無い。
【００１７】
次に、２つ目の成膜条件によって、第２のシリコン膜を形成する。
ここで、両面にポリシリコン膜２が形成された、前記石英基板１を、高密度プラズマＣＶＤ法を行うためのＣＶＤ装置（図示せず）の反応炉内に入れる。
高密度プラズマＣＶＤ法では、プラズマ中において、ガス分子が解離し化学反応（ラジカル反応）が促進され、前記の減圧ＣＶＤに比べて低い温度（２５０〜４００℃）で成膜することができる。なお、高密度プラズマＣＶＤ法では、前述した減圧ＣＶＤと異なり、構造上枚葉式装置のため、一方の面側にのみシリコン膜が形成される。
【００１８】
本実施形態では、４００℃以下の条件によって前述した高密度プラズマＣＶＤ法を行うことで、図１（ｃ）に示したように、一方のポリシリコン膜２側の面上（図中下側）に、２．７μｍの膜厚のアモルファスシリコン膜（第２のシリコン膜）３を形成した。なお、以下の説明においては、前記アモルファスシリコン膜３が形成された側を、前記石英基板１の裏面側とし、この石英基板１の表面に、後述する工程によって薄膜トランジスタを形成する。
【００１９】
ところで、高密度プラズマＣＶＤ法によって成膜されたアモルファスシリコン膜３には、膜応力として圧縮応力を発生することが実験的に知られており、本実施形態では、−１．０×１０１０ｄｙｎ／ｃｍ２の圧縮応力を発生する。
よって、前記石英基板１の裏面上には、前記ポリシリコン膜２と前記アモルファスシリコン膜３とが積層されて、合計５．４μｍのシリコン膜５が形成した状態となる。このとき、前記ポリシリコン膜２による引張応力（＋１．０×１０１０ｄｙｎ／ｃｍ２）と、前記アモルファスシリコン膜３による圧縮応力（−１．０×１０１０ｄｙｎ／ｃｍ２）とが相殺される。よって、前記ポリシリコン膜２と前記アモルファスシリコン膜３とから構成されるシリコン膜５は、前記石英基板１に対して膜応力を生じないものとなる。
【００２０】
一方、前記石英基板１の表面（図１（ｃ）中上側）には、前記ポリシリコン膜２のみが形成された状態となっている。ここで、このポリシリコン膜２は、前述したように、引張応力（＋１．０×１０１０ｄｙｎ／ｃｍ２）を生じるようになっているため、前記石英基板１の表面には、依然として引張応力が残留した状態となっている。
【００２１】
そこで、図１（ｄ）に示すように、前記石英基板１の表面側に形成されたポリシリコン膜２を、例えばドライエッチング等によって除去する。よって、前記石英基板１は、その裏面側に、膜厚５．４μｍのシリコン膜５を備えた構造となる。また、前述したように、前記シリコン膜５は膜応力を生じないため、前記石英基板１に反りを生じさせることがなく、したがって、石英基板１上に５μｍ以上のシリコン膜を形成した際の基板の反りを防止できる。
よって、石英基板１に反りが生じないため、後述するように、この石英基板１上に良好なｎチャネル型の多結晶シリコンＴＦＴ（薄膜トランジスタ）を形成することができる。
【００２２】
ところで、前記石英基板１上にプロセス上問題となる反りを生じさせないためには、前記シリコン膜５における膜応力の絶対値が２．０×１０９ｄｙｎ／ｃｍ２以下、望ましくは１．０×１０９ｄｙｎ／ｃｍ２以下となればよいことが実験等によって分かっている。よって、前記シリコン膜５において、前記圧縮力と前記引張力とを完全に相殺して、このシリコン膜５が生じる膜応力を無くすことは難しい場合には、前記石英基板１上に、膜応力の絶対値が２．０×１０９ｄｙｎ／ｃｍ２以下、望ましくは１．０×１０９ｄｙｎ／ｃｍ２以下となるように、所定の膜厚（５μｍ以上）のシリコン膜５を形成することで、前記石英基板１の反りを防止することができる。
【００２３】
前記シリコン膜５は、その膜厚が５．４μｍ（５μｍ以上）となっており、前述した所定の厚みを満たしている。すなわち、前記シリコン膜５が形成された石英基板１の裏面側は、シリコン基板と同様に光を透過することがない。
【００２４】
ところで、石英基板等の透光性基板上に形成される薄膜トランジスタは、例えば液晶表示装置、及び有機ＥＬ表示装置等の電気光学装置において広く用いられており、その用途の多さからコストの低減が望まれている。そこで、シリコン基板用の半導体製造装置（半導体製造ライン）を用いて、前記石英基板１上に薄膜トランジスタを製造すれば、コスト低減を図ることができる。なお、前述した半導体装置としては、シリコンウエハ（シリコン基板）上に、トランジスタを形成するための装置であって、具体的にはリソグラフィ、ドライエッチング、イオン注入、ＣＶＤ等の各装置である。
【００２５】
前記半導体製造装置が備える基板検出センサ（図示しない）は、例えば光出射部からのレーザ光線を、シリコン基板の表面上で反射させて、その反射光を光受光部によって受けてシリコン基板を検出する、光検出型のものである。そして、前述したように、石英基板１の裏面側に設けられたシリコン膜５は、十分な膜厚から構成されており、光を透過しない。
よって、前記シリコン基板用の基板検出センサは、シリコン基板同様に、前記石英基板１を検出することが可能となる。
すなわち、本発明を採用すれば、シリコン基板用の半導体製造装置によって、前記石英基板１をシリコン基板として認識することができ、後述する工程で、多結晶シリコンＴＦＴを形成することができる。
【００２６】
次に、前記シリコン膜５が形成されていない、前記石英基板１の表面に、シリコン基板用の半導体製造装置を用いて、図２に示す、ｎチャネル型の多結晶シリコンＴＦＴ（薄膜トランジスタ）５０を形成する工程について説明する。なお、前記多結晶シリコンＴＦＴの製造工程は、公知の方法によるため、図示を省略して説明する。
【００２７】
まず、裏面側に前記シリコン膜５が形成された前記石英基板１の表面に、シリコン酸化膜等の絶縁膜からなる下地保護膜１１をプラズマＣＶＤ法等によって成膜する。
そして、前記下地保護膜１１を形成した石英基板１の全面に、非晶質シリコン膜をプラズマＣＶＤ法等により成膜する。
【００２８】
次に、この非晶質シリコン膜をフォトリソグラフィー法により、形成する能動層の形状にパターニングする。すなわち、非晶質シリコン膜上にフォトレジストを塗布した後、フォトレジストの露光、現像、非晶質シリコン膜のエッチング、フォトレジストの除去を行うことにより、非晶質シリコン膜のパターニングを行う。
【００２９】
そして、減圧雰囲気下、窒素雰囲気中で、前記非晶質シリコン膜を形成した石英基板１の全面に、非晶質シリコン膜側からレーザーを照射することにより、パターニングした非晶質シリコン膜をアニールし、能動層として機能する多結晶シリコン膜２２を形成する。なお、この工程において、レーザーを照射された非晶質シリコン膜は、非晶質シリコン膜に照射されたレーザーエネルギーにより加熱されて溶融され、冷却固化過程を経て多結晶化する。
【００３０】
次に、前記多結晶シリコン膜２２を形成した石英基板１の全面に、シリコン酸化膜、シリコン窒化膜等からなるゲート絶縁膜３１を５０〜１５０ｎｍの厚さに成膜する。
前記ゲート絶縁膜３１を形成した石英基板１の表面の全面に、スパッタリング法等により、アルミニウム、タンタル、モリブデン等の金属、又はこれらの金属のいずれかを主成分とする合金等の導電性材料を成膜した後、フォトリソグラフィー法によりパターニングし、３００〜８００ｎｍの厚さのゲート電極３２を形成する。すなわち、導電性材料を成膜した石英基板１上にフォトレジストを塗布した後、フォトレジストの露光、現像、導電性材料のエッチング、フォトレジストの除去を行うことにより、導電性材料をパターニングし、ゲート電極３２を形成する。
【００３１】
前記ゲート電極３２をマスクとして、約０．１×１０１３〜約１０×１０１３／ｃｍ２のドーズ量で低濃度の不純物イオン（リンイオン）を打ち込み、ゲート電極３２に対して自己整合的に低濃度ソース領域２２ｂ、低濃度ドレイン領域２２ｃを形成する。ここで、ゲート電極３２の直下に位置し、不純物イオンが導入されなかった部分はチャネル領域２２ａとなる。
前記ゲート電極３２より幅広のレジストマスク（図示略）を形成して高濃度の不純物イオン（リンイオン）を約０．１×１０１５〜約１０×１０１５／ｃｍ２のドーズ量で打ち込み、高濃度ソース領域２２ｄ、及び高濃度ドレイン領域２２ｅを形成する。
【００３２】
なお、ＬＤＤ（Lightly Doped Drain）構造のソース領域及びドレイン領域を形成する代わりに、低濃度の不純物の打ち込みを行わずにゲート電極３２より幅広のレジストマスクを形成した状態で高濃度の不純物（リンイオン）を打ち込み、オフセット構造のソース領域及びドレイン領域を形成しても良い。また、ゲート電極３２をマスクとして高濃度の不純物を打ち込み、セルフアライン構造のソース領域及びドレイン領域を形成しても良い。
【００３３】
次に、前記ゲート電極３２の表面側にＣＶＤ法等により、シリコン酸化膜等からなる層間絶縁膜３３を３００〜８００ｎｍの厚さに成膜する。
そして、この工程後に、レーザーアニールを行うことにより、ソース領域２２ｂ、２２ｄ及びドレイン領域２２ｃ、２２ｅに注入された不純物の活性化を行う。
【００３４】
そして、所定のパターンのレジストマスク（図示略）を形成した後、該レジストマスクを介して層間絶縁膜３３のドライエッチングを行い、層間絶縁膜３３において高濃度ソース領域２２ｄ及び高濃度ドレイン領域２２ｅに対応する部分にコンタクトホール３４、３５をそれぞれ形成する。
【００３５】
前記層間絶縁膜３３の全面に、アルミニウム、チタン、窒化チタン、タンタル、モリブデン、又はこれらの金属のいずれかを主成分とする合金等の導電性材料を、スパッタリング法等により成膜した後、フォトリソグラフィー法によりパターニングし、４００〜８００ｎｍの厚さのソース電極３６及びドレイン電極３７を形成する。
すなわち、導電性材料を成膜した石英基板１上にフォトレジストを塗布した後、フォトレジストの露光、現像、導電性材料のエッチング、フォトレジストの除去を行うことにより、導電性材料をパターニングし、ソース電極３６及びドレイン電極３７を形成する。
以上のようにして、本実施形態における薄膜トランジスタ、すなわちｎチャネル型の多結晶シリコンＴＦＴ５０を製造することができる。
【００３６】
前記石英基板１の表面上に、ｎチャネル型の多結晶シリコンＴＦＴ５０を形成した後、石英基板１の用途に応じて、適宜裏面側のシリコン膜５をドライエッチングなどで除去するようにしてもよい。このようにすれば、コストが低く、良好な多結晶シリコンＴＦＴ（薄膜トランジスタ）５０を備えつつ、両面が透光性を有した石英基板１を得ることができる。
よって、この石英基板１を、例えば光透過型液晶パネルや、有機ＥＬ表示装置の透光性を有する基板として用いることができる。
【００３７】
本発明の薄膜トランジスタの製造方法によれば、成膜条件の異なるシリコン膜として、引張応力を発生するポリシリコン膜２と、圧縮応力を生じるアモルファスシリコン膜３とを、互いの応力が相殺するするようにして重ね合わせてシリコン膜５を形成しており、かつ、前記シリコン膜５の膜応力の絶対値は、石英基板１が反らない程度に小さい（２．０×１０９ｄｙｎ／ｃｍ２以下、望ましくは１．０×１０９ｄｙｎ／ｃｍ２以下）ので、このシリコン膜５の膜応力によって石英基板１が反ることはない。
よって、石英基板１に反りが生じないので、この石英基板１上に良好にｎチャネル型の多結晶シリコンＴＦＴ５０を良好に形成できる。
また、前記シリコン膜５は、前述したように光を透過しない５μｍ以上の厚みとなっているので、前記シリコン膜５が形成された透光性基板の面は、シリコン基板と同様に、光を透過することがない。
よって、前記石英基板１は、十分な膜厚のシリコン膜５に覆われているので、シリコン基板用の半導体製造装置における基板検出センサでも検出することができ、石英基板１を半導体製造装置で用いることができる。
したがって、石英基板１とシリコン基板との間で、前記半導体製造装置を共用することができ、石英基板１上に薄膜トランジスタを製造する際の製造コストを低減することができる。
また、石英基板１上には、シリコン膜のみを形成しているので、従来の製造方法における高融点金属膜による金属汚染を防止できる。
【００３８】
なお、本発明は前記実施形態に限定されることなく種々の変更が可能である。例えば、前記実施形態では、シリコン膜５として、前記ポリシリコン膜２における引張応力と、前記アモルファスシリコン膜３における圧縮応力と相殺するように積層して形成したが、成膜条件を調節してＣＶＤ法を行うことで、石英基板を反らせない程度に小さい（絶対値で２．０×１０９ｄｙｎ／ｃｍ２以下、望ましくは１．０×１０９ｄｙｎ／ｃｍ２以下）膜応力を有し、厚みが５μｍ以上となる１層のシリコン膜から形成するようにしてもよい。
【図面の簡単な説明】
【００３９】
【図１】（ａ）〜（ｄ）は、薄膜トランジスタの製造工程を示す図である。
【図２】本発明により形成された薄膜トランジスタを示す側断面図である。
【符号の説明】
【００４０】
１…石英基板（透光性基板）、２…ポリシリコン膜（第１のシリコン膜）、３…アモルファスシリコン膜（第２のシリコン膜）、５…シリコン膜、５０…多結晶シリコンＴＦＴ（薄膜トランジスタ）
【図１】
2006269894.tif 000003
【図２】
2006269894.tif 000004