(57)【要約】【課題】高画質を維持したまま、データ駆動部の更なる小型化と更なる省電力化とを可能にする表示装置、及びその駆動方法を提供する。【解決手段】表示装置のＤ／Ａ変換部（250）では、ＤＡＣ（DAC1〜DACk）がデータライン（DL1〜DLm）より少ない。各ＤＡＣの共通入力ライン（CIL1〜CILk）にはＲ、Ｇ、Ｂのデジタル画像信号が所定の順序で入力される。各ＤＡＣの共通出力ライン（COL1〜COLk）は信号選択部（252）内のトランジスタ（Tr1 、Tr2、Tr3）と出力バッファ部（260）内のアンプ（AMP）とを通して三つのデータラインに連結されている。それらのトランジスタ（Tr1 、Tr2、Tr3）は選択信号（S1、S2、S3）に従ってオンオフされる。それにより、デジタル画像信号の入力順に合わせて三つのデータラインの中から一つがアナログ画像信号の出力先として選択される。【選択図】図９
2006189878.tif 000002
【特許請求の範囲】
【請求項１】
複数のスキャンライン、複数のデータライン、及び前記スキャンラインと前記データラインとのそれぞれに連結されたスイッチング素子、を有する表示装置の駆動方法であり、
前記スキャンラインに対して順次、スキャン信号を出力する段階、
一定数Ｎ個のグループに分けられた前記データラインに対し、Ｎ個の画像信号を第１の順序で出力する段階、及び、
前記Ｎ個の画像信号を前記第１の順序で出力する段階に続いて、前記データラインに対し、Ｎ個の画像信号を、前記第１の順序とは異なる第２の順序で出力する段階、
を含む表示装置の駆動方法。
【請求項２】
前記Ｎが３である、請求項１に記載の表示装置の駆動方法。
【請求項３】
前記Ｎ個の画像信号のうち少なくとも一つが他と異なる、請求項１に記載の表示装置の駆動方法。
【請求項４】
前記Ｎ個の画像信号が、レッド、グリーン、ブルーの色情報を含む、請求項１に記載の表示装置の駆動方法。
【請求項５】
前記Ｎ個の画像信号を前記第１の順序で出力する段階と、それに続く、前記Ｎ個の画像信号を前記第２の順序で出力する段階とが一定数のフレームごとに繰り返される、請求項１に記載の表示装置の駆動方法。
【請求項６】
前記スキャンラインの一つに対して前記スキャン信号が出力される時間を複数の期間に分割し、前記期間のそれぞれで、前記Ｎ個の画像信号を別々に前記データラインに対して出力する、請求項１に記載の表示装置の駆動方法。
【請求項７】
複数のスキャンライン、複数のデータライン、及び、前記スキャンラインと前記データラインとのそれぞれに連結されたスイッチング素子、を含む表示パネル、
前記スキャンラインに対して順次、スキャン信号を出力するスキャン駆動部、並びに、
一定数Ｎ個のグループに分けられた前記データラインに対し、Ｎ個の画像信号を第１の順序で出力し、続いて、前記データラインに対し、Ｎ個の画像信号を、前記第１の順序とは異なる第２の順序で出力するデータ駆動部、
を有する表示装置。
【請求項８】
前記スキャン駆動部が前記表示パネルに形成されている、請求項７に記載の表示装置。
【請求項９】
前記データ駆動部が、
外部からＮ個のデジタル画像信号を受信し、受信された前記Ｎ個のデジタル画像信号をアナログ画像信号に変換し、変換された前記Ｎ個のアナログ画像信号を出力するデジタル／アナログ変換部、及び、
前記第１又は第２の順序に従って前記Ｎ個のアナログ画像信号を選択し、前記データラインに対して出力する信号選択部、
を含む、請求項７に記載の表示装置。
【請求項１０】
前記デジタル／アナログ変換部が、
前記Ｎ個のデジタル画像信号が提供される共通入力ラインと、
前記Ｎ個のアナログ画像信号が出力される共通出力ラインと、
に連結されている、請求項９に記載の表示装置。
【請求項１１】
前記信号選択部が、前記共通出力ラインに連結された複数の並列スイッチ、を含む、請求項１０に記載の表示装置。
【請求項１２】
前記並列スイッチがＭＯＳトランジスタを少なくとも一つ含む、請求項１１に記載の表示装置。
【請求項１３】
前記信号選択部が、外部から提供される少なくとも一つの選択信号に応じて前記Ｎ個のアナログ画像信号を選択する、請求項１１に記載の表示装置。
【請求項１４】
前記選択信号を生成し、生成された前記選択信号を前記信号選択部に提供するタイミングコントローラ、をさらに有する、請求項１３に記載の表示装置。
【請求項１５】
前記信号選択部が、外部から提供されるＮ個の選択信号に従って前記Ｎ個のアナログ画像信号を前記第１又は第２の順序で選択する、請求項９に記載の表示装置。
【請求項１６】
前記スイッチング素子が、
前記データラインの一つと電気的に結合した第１電極、
前記スキャンラインの一つと電気的に結合した第２電極、及び、
アモルファス−シリコンから形成されたチャンネル層、
を含む、請求項７に記載の表示装置。
【請求項１７】
特定の表示領域に連結され、外部から前記表示領域にアナログ画像信号を伝送して画像を表示させるＭ個のデータライン、及び、
それぞれが前記データラインのうちＰ個（ＰはＭより小さい）と連結され、連結された前記Ｐ個のデータラインに対して前記アナログ画像信号を出力する、Ｎ個（ＮはＭより大きい）のデジタル／アナログ変換部、
を有する表示装置。
【請求項１８】
前記Ｐが３である、請求項１７記載の表示装置。
【請求項１９】
前記表示領域がデルタ配列を成す、請求項１８に記載の表示装置。
【請求項２０】
前記表示装置が、
前記Ｎ個のデジタル／アナログ変換部のそれぞれと前記Ｐ個のデータラインとの間を連結し、連結された前記デジタル／アナログ変換部の一つによって生成されたＰ個の前記アナログ画像信号を第１の順序で、連結された前記Ｐ個のデータラインに伝送し、続いて、前記連結されたデジタル／アナログ変換部によって生成されたＰ個の前記アナログ画像信号を、前記第１の順序とは異なる第２の順序で、連結された前記Ｐ個のデータラインに伝送する信号選択部、
をさらに有する請求項１７記載の表示装置。
【請求項２１】
少なくとも一つの前記信号選択部を制御するタイミングコントローラ、をさらに有する、請求項２０に記載の表示装置。
【請求項２２】
前記第１及び第２の順序でのＮ個の画像信号の出力が一定数のフレームごとに繰り返される、請求項２０に記載の表示装置。
【請求項２３】
前記信号選択部が、前記第１及び第２の順序を含むＰ個の異なる順序でＰ個の前記アナログ画像信号を伝送する、請求項２０に記載の表示装置。
【請求項２４】
前記Ｐ個の異なる順序での前記アナログ画像信号の伝送が、連続するＰ個のフレームで行われる、請求項２３に記載の表示装置。
【発明の詳細な説明】
【技術分野】
【０００１】
本発明は表示装置に関し、特に表示装置の駆動方法に関する。
【背景技術】
【０００２】
表示装置の中でも特に表示パネルが薄型であるものとしては液晶表示装置（ＬＣＤ）が一般的によく利用される。ＬＣＤは液晶を用いて画像を表示する。ＬＣＤの駆動回路は液晶に電圧を印加してその分子配列を変化させることで、液晶の光透過率を変換する。それにより、画素の輝度を制御して画面に画像を再現する。
ＬＣＤの駆動方式は、スイッチング素子とＴＮ液晶とを用いたアクティブマトリックス表示方式、及び、ＳＴＮ液晶を用いたパッシブマトリックス表示方式、に分類される。これら２つの方式は次の点で大きく異なる。アクティブマトリックス表示方式はＴＦＴ−ＬＣＤで使用され、ＴＦＴをスイッチとして用いてＬＣＤを駆動する。それに対し、パッシブマトリックス表示方式はトランジスタを使用しない。この差異により、パッシブマトリックス表示方式での駆動回路はアクティブマトリックス表示方式での駆動回路より簡単である。
【０００３】
ＴＦＴ−ＬＣＤはアモルファスシリコン（a−Si）型ＴＦＴ−ＬＣＤと多結晶シリコン（poly−Si）型ＴＦＴ−ＬＣＤとに大別される。a−Si型ＴＦＴ−ＬＣＤは大画面化が容易で歩留まりが高いという長所がある。一方、poly−Si型ＴＦＴ−ＬＣＤは消費電力が小さく、コストが低いという長所がある。a−Si型ＴＦＴ−ＬＣＤでは駆動回路がフレキシブルプリント回路基板にＣＯＦ（Chip  On  Film）方式で実装され、そのフレキシブルプリント回路基板を通して表示パネルのガラス基板に設置されたデータラインやゲートラインに連結される。一方、poly−Si型ＴＦＴ−ＬＣＤでは駆動回路がガラス基板に直接実装され、データラインやゲートラインと一体化される。このように、駆動回路がガラス基板に内蔵可能であるという点では、poly−Si型ＴＦＴ−ＬＣＤがa−Si型ＴＦＴ−ＬＣＤより有利である。但し、近年では、a−Si型ＴＦＴ−ＬＣＤでも、電源供給部を一つのプリント回路基板に統合することで駆動回路全体を小型化する技術が知られている（例えば特許文献1参照）。特にゲート駆動部は、上記のプリント回路基板から供給される電圧をゲートラインに対して順次印加し、かつ遮断するだけで良いので、その回路構成が比較的簡単であり、小型化が容易である。
【特許文献１】特開2000−356783号公報
【発明の開示】
【発明が解決しようとする課題】
【０００４】
データ駆動部は一般に、デジタル／アナログコンバータ（ＤＡＣ）50と出力バッファ（ＡＭＰ）60とをそれぞれ、データラインと同数ずつ含む（図３参照）。ＤＡＣ1〜nは、外部から提供されたデジタル画像信号をアナログ画像信号に変換する。ＡＭＰ1〜nはＤＡＣ1〜nと一対一に連結され、ＤＡＣ1〜nから出力されるアナログ画像信号を増幅し、データラインに供給する。特にＤＡＣ1〜nはそれぞれ、複数の抵抗素子で構成された配列を含む。従って、データ駆動部はゲート駆動部とは異なり、回路構成が比較的複雑であり、更なる小型化が困難である。更に、デジタル画像信号が１ビット増加するごとに、ＤＡＣに内蔵される抵抗素子の配列の規模は２倍ずつ増加する。それ故、画像の更なる高精細化に伴ってデジタル画像信号のビット数が増加するほど、データ駆動部ではＤＡＣ内の抵抗素子の配列で消費される電力が幾何級数的に増加する。その結果、更なる高画質化とデータ駆動部の更なる省電力化との両立が困難であった。
【０００５】
本発明の目的は、高画質を維持したまま、データ駆動部の更なる小型化と更なる省電力化とを可能にする表示装置、及びその駆動方法を提供することにある。
【課題を解決するための手段】
【０００６】
本発明の一つの観点による表示装置は、表示パネル、スキャン駆動部、及びデータ駆動部を有する。表示パネルは、複数のスキャンライン、複数のデータライン、及びスキャンラインとデータラインとのそれぞれに連結されたスイッチング素子を含む。好ましくは、スイッチング素子が、データラインの一つと電気的に結合した第１電極、スキャンラインの一つと電気的に結合した第２電極、及び、アモルファス−シリコンから形成されたチャンネル層、を含む。スキャン駆動部はスキャンラインに対して順次、スキャン信号を出力する。好ましくは、スキャン駆動部が表示パネルに形成されている。データ駆動部は、一定数Ｎ個のグループに分けられたデータラインに対してＮ個の画像信号を第１の順序で出力し、続いて、データラインに対してＮ個の画像信号を、第１の順序とは異なる第２の順序で出力する。データ駆動部は特に、データラインに対して出力されるべきＮ個の画像信号の順序を、好ましくは一定数のフレームごとに変更する。
【０００７】
データ駆動部は好ましくは、デジタル／アナログ変換部（以下、ＤＡＣと略す）及び信号選択部を含む。ＤＡＣは外部からＮ個のデジタル画像信号を受信し、受信されたＮ個のデジタル画像信号をアナログ画像信号に変換し、変換されたＮ個のアナログ画像信号を出力する。ＤＡＣは好ましくは、Ｎ個のデジタル画像信号が提供される共通入力ラインと、Ｎ個のアナログ画像信号が出力される共通出力ラインと、に連結されている。信号選択部は、第１又は第２の順序に従ってＮ個のアナログ画像信号を選択し、データラインに対して出力する。好ましくは、信号選択部が、共通出力ラインに連結された複数の並列スイッチを含む。ここで、その並列スイッチが好ましくは、ＭＯＳトランジスタを少なくとも一つ含む。信号選択部が更に好ましくは、外部から提供される少なくとも一つの選択信号に応じてＮ個のアナログ画像信号を選択する。その場合、本発明による上記の表示装置が好ましくは、上記の選択信号を生成し、生成された選択信号を信号選択部に提供するタイミングコントローラ、をさらに有する。その他に、信号選択部が、外部から提供されるＮ個の選択信号に従ってＮ個のアナログ画像信号を第１又は第２の順序で選択しても良い。
【０００８】
本発明の別の観点による表示装置は、Ｍ個のデータラインとＮ個のＤＡＣとを有する。ここで、ＭはＮより大きい数である。Ｍ個のデータラインはそれぞれ特定の表示領域（好ましくは表示セル（サブピクセルともいう）、または単位セル（画素、若しくはピクセルともいう））に連結され、外部からその表示領域にアナログ画像信号を伝送して画像を表示させる。Ｎ個のＤＡＣのそれぞれはＭ個のデータラインのうちＰ個と連結され、連結されたＰ個のデータラインに対して上記のアナログ画像信号を出力する。ここで、ＰはＭより小さい数である。好ましくは、Ｐは３である。そのとき、Ｐ＝３個のデータラインに対するアナログ画像信号は特に、レッド、ブルー、グリーンの色情報である。その場合、更に好ましくは、上記の表示領域がデルタ配列を成す。
【０００９】
本発明のこの表示装置は好ましくは、Ｎ個のＤＡＣのそれぞれとＰ個のデータラインとの間を連結する信号選択部、をさらに有する。信号選択部は、連結されたＤＡＣの一つによって生成されたＰ個のアナログ画像信号を第１の順序で、連結された上記Ｐ個のデータラインに伝送し、続いて、連結された上記のＤＡＣによって生成されたＰ個のアナログ画像信号を第２の順序で、連結された上記Ｐ個のデータラインに伝送する。ここで、第２の順序は第１の順序とは異なる。本発明によるこの表示装置は更に、少なくとも一つの信号選択部を制御するためのタイミングコントローラ、を有しても良い。好ましくは、第１及び第２の順序によるアナログ画像信号の伝送が一定数のフレームごとに繰り返される。その他に、信号選択部が、第１及び第２の順序を含むＰ個の異なる順序でＰ個のアナログ画像信号を伝送しても良い。その場合、好ましくは、そのＰ個の異なる順序によるアナログ画像信号の伝送が、連続するＰ個のフレームで行われる。
【００１０】
本発明による表示装置の駆動方法は、上記のように、複数のスキャンライン、複数のデータライン、及びスキャンラインとデータラインとのそれぞれに連結されたスイッチング素子、を有する表示装置を対象とする。本発明による駆動方法は好ましくは、複数のスキャンラインに対して順次、スキャン信号を出力する段階、一定数Ｎ個のグループに分けられたデータラインに対してＮ個の画像信号を第１の順序で出力する段階、その段階に続いて、データラインに対してＮ個の画像信号を、第１の順序とは異なる第２の順序で出力する段階、を有する。ここで、一定数Ｎは好ましくは３である。一方、好ましくは、上記Ｎ個の画像信号のうち少なくとも一つが他と異なる。更に好ましくは、上記Ｎ個の画像信号が、レッド、ブルー、グリーンの色情報を含む。好ましくは、Ｎ個の画像信号を第１の順序で出力する段階と、それに続く、Ｎ個の画像信号を第２の順序で出力する段階とが、一定数のフレームごとに繰り返される。特に、その一定数が好ましくはＮである。
【００１１】
本発明による上記の駆動方法は好ましくは、スキャンラインの一つに対してスキャン信号が出力される時間を複数の期間に分割し、それぞれの期間で、Ｎ個の画像信号を別々にデータラインに対して出力する。その場合、Ｎ個の画像信号の順序は、好ましくはフレームごとに異なるので、連続する二つのフレーム間では互いに対応する期間に異なる画像信号（好ましくは異なる色情報）が出力される。
【発明の効果】
【００１２】
本発明による上記の表示装置、及びその駆動方法では、一定数の画像信号がデータラインに所定の順序で出力される。それにより、一定数の画像信号間、すなわち一定数のデータライン間ではデータ駆動部内の同じ構成要素、特にデジタル／アナログコンバータ（ＤＡＣ）が共用可能である。従って、データラインの総数よりそれらの構成要素（特にＤＡＣ）の総数が削減可能であるので、データ駆動部の更なる小型化、及び更なる省電力化が容易である。更に、一定数の画像信号の出力順が上記の通り、好ましくはフレームごとに異なる。従って、それらの画像信号を受ける表示領域間では液晶キャパシタの平均的な充電時間と平均的な放電時間とがいずれも共通である。その結果、高画質が維持される。
【発明を実施するための最良の形態】
【００１３】
以下、図面を参照しながら、本発明の望ましい実施形態を詳細に説明する。
本発明の実施形態による表示装置は好ましくは液晶表示装置（ＴＦＴ−ＬＣＤ）である。ここで、ＴＦＴ−ＬＣＤの構成は一般に、poly−Si型（図１参照）とa−Si型（図２参照）との二種類に分けられる。図１に示されているように、poly−Si型ＴＦＴ−ＬＣＤでは、ガラス基板10上にデータ駆動部12とゲート駆動部14とが表示セルアレイ15と共に形成される。データ駆動部12とゲート駆動部14とは端子部16とフィルムケーブル18とを通して外部のプリント回路基板20に連結される。ここで、そのプリント回路基板20には統合制御部が含まれる（図示せず）。統合制御部は二つの駆動部12、14に対して電力と画像信号とを提供する。このようにpoly−Si型ＴＦＴ−ＬＣＤでは、二つの駆動部12、14がガラス基板10と一体化されるので、製造コストが節減され、電力損失が最小化される。一方、図２に示されているように、a−Si型ＴＦＴ−ＬＣＤでは、データフレキシブルプリント回路基板32上にＣＯＦ方式でデータ駆動チップ34が実装される。データ駆動チップ34はデータフレキシブルプリント回路基板32を通じてデータプリント回路基板36と表示セルアレイ30のデータラインとに連結される。同様に、ゲートフレキシブルプリント回路基板38上にＣＯＦ方式でゲート駆動チップ40が実装され、ゲートフレキシブルプリント回路基板38を通じてゲートプリント回路基板42と表示セルアレイ30のゲートラインとに連結される。
【００１４】
本発明の実施形態によるＴＦＴ−ＬＣＤは好ましくはa−Si型である（図４参照）。その他に、poly−Si型であっても良い。図４に示されているように、本発明の実施形態によるＴＦＴ−ＬＣＤ100は、液晶表示パネル120、フレキシブルプリント回路基板150、及び駆動チップ160を有する。液晶表示パネル120はＴＦＴ基板130とカラーフィルタ基板140とを含む。
【００１５】
ＴＦＴ基板130はa−Si製であり、表示セルアレイ回路とスキャン駆動部とを含む（図示せず）。表示セルアレイ回路は、マトリックス状に配置された複数の表示セルを含む。表示セルは個別に輝度を変化させ得る。表示セルアレイ回路は好ましくは、互いに隣接する三つの表示セルを一つの単位セルとして使用する。各単位セルでは三つの表示セルの輝度がそれぞれ、レッド（Ｒ）、グリーン（Ｇ）、ブルー（Ｂ）の三原色の輝度に対応する。Ｒ、Ｇ、Ｂ間での輝度のバランスが調節されることで、各単位セルが個別に色を表現できる。ＴＦＴ基板130の一定の領域には駆動チップ160が実装されている。駆動チップ160は統合制御部とデータ駆動部とを含み（図示せず）、フレキシブルプリント回路基板150から提供される駆動電圧とデジタル画像信号とに基づいて各表示セルの輝度を調節する。それにより、液晶表示パネル120の表示が制御される。
【００１６】
カラーフィルタ基板140はカラーフィルタと透明共通電極とを含む（図示せず）。カラーフィルタ基板140はＴＦＴ基板130と平行に接着されている。ここで、ＴＦＴ基板130とカラーフィルタ基板140との間には液晶が封入されている。カラーフィルタ基板140にはＲ、Ｇ、Ｂの三種類のカラーフィルタが形成されている。各カラーフィルタは、表示セルアレイ回路の各単位セルに含まれている三つの表示セルのそれぞれに対向している。特に本発明の実施形態によるＴＦＴ−ＬＣＤでは、カラーフィルタ基板140上でカラーフィルタが、ストライプ配列（図５参照）ではなく、デルタ配列を成す（図６参照）。ストライプ配列では、図５に示されているように、Ｒ、Ｇ、Ｂそれぞれのカラーフィルタがいずれも同じ矩形状であり、更に、三つのカラーフィルタで構成される単位セル141、141Aがいずれも同じ矩形状である。特に、各単位セル141、141Aでは同じ色のカラーフィルタが同じ位置に形成されている。それにより、同じ色のカラーフィルタが一列に並ぶので、カラーフィルタ基板全体が、Ｒ、Ｇ、Ｂの三列から成るストライプを含む。一方、ＴＦＴ基板130ではデータラインが直線形状である。デルタ配列は、図６に示されているように、Ｒ、Ｇ、Ｂそれぞれのカラーフィルタがいずれも同じ矩形状である点で、図５に示されているストライプ配列と共通する。しかし、デルタ配列では、図５に示されているストライプ配列とは異なり、三つのカラーフィルタで構成される単位セル142がそれぞれ異なる形状を持つ。更に、形が異なる二つの単位セル142が隣接する。一方、ＴＦＴ基板130ではデータラインが細かなジグザク形状である。デルタ配列は光の混色特性に優れているので、特にデジタルカメラの表示装置に適している。
【００１７】
フレキシブルプリント回路基板150は所定の回路パターンを含み、外部から供給されるデジタル画像信号と駆動電圧とを、液晶表示パネル120上に形成された各部に提供する。駆動チップ160はＴＦＴ基板130上に外付けされ、フレキシブルプリント回路基板150とＴＦＴ基板130上の他の回路とに電気的に連結されている。ここで、ＴＦＴ基板130が特にpoly−Si型である場合、駆動チップ160がＴＦＴ基板130に内蔵されても良い。駆動チップ160は特に、フレキシブルプリント回路基板150から提供されるデジタル画像信号と駆動電圧とに基づき、データ信号、データタイミング信号、スキャンタイミング信号、及びスキャン信号を生成し、ＴＦＴ基板130のスキャン駆動部と表示セルアレイ回路とに提供する。ここで、スキャン信号はフレキシブルプリント回路基板150から直接、スキャン駆動部と表示アレイ回路とに提供されても良い。
【００１８】
図７は本発明の実施形態によるＴＦＴ−ＬＣＤ100の回路構成の概略を示すブロック図である。図７に示されているように、ＴＦＴ基板130上には、表示セルアレイ回路131とスキャン駆動部132とが形成され、駆動チップ160が外付けされている。表示セルアレイ回路131は、表示パネルの列方向に延びるm個のデータラインDL1〜DLmと、表示パネルのライン方向に延びるn個のスキャンラインSL1〜SLnとを含む。データラインDL1〜DLmとスキャンラインSL1〜SLnとの各交差点には表示セルが一つずつ設置されている。ここで、表示セルは上記の通り、三原色Ｒ、Ｇ、Ｂのそれぞれに対応する三つのグループに分けられている（図５、６参照）。それに併せて、m個のデータラインDL1〜DLmも三原色Ｒ、Ｇ、Ｂのそれぞれに対応する三つのグループに分けられる（特にm＝3k。ここで、整数kは表示パネルの一ラインに含まれている単位セルの数に相当する）。各表示セルにはスイッチングトランジスタST1が形成されている。スイッチングトランジスタST1は好ましくはＭＯＳトランジスタであり、特にそのチャンネル層がアモルファスシリコンに形成されている。更に、第１電極であるドレインがデータラインDL1に連結され、第２電極であるゲートがスキャンラインSL1に連結され、第３電極であるソースが透明画素電極PFに連結される。透明画素電極PEは液晶LCを通し、カラーフィルタ基板140（図４参照）に形成された透明共通電極CEと対向している。駆動チップ160は、フレキシブルプリント回路基板150から提供されるデジタル画像信号と駆動電圧とに基づいてアナログ画像信号を生成し、それに従ってデータラインDL1〜DLmの各電圧を変化させる（詳細は後述参照）。更に好ましくは、駆動チップ160がスキャン駆動部132に対して制御信号とスキャン信号とを出力する。スキャン駆動部132は、シフトレジスタ、レベルシフタ、及び出力バッファを含み（図示せず）、駆動チップ160から提供される制御信号に従って、駆動チップ160から提供されるスキャン信号を、スキャンラインSL1〜SLnに対して順次出力する。スキャンラインの一つSL1に対してスキャン信号が出力されるとき、そのスキャンラインSL1に連結されているスイッチングトランジスタST1がオンする。それにより、そのスイッチングトランジスタST1に連結されているデータラインDL1の電圧が透明画素電極PEに対して印加され、透明画素電極PEと透明共通電極CEとの間の電圧が変化する。そのとき、液晶LCでは分子の配向が変化するので光透過率が変化する。それらの変化は透明電極PE、CE間の電圧、すなわちデータラインDL1の電圧で高精度に制御可能である。こうして、液晶LCを通過する光量が電気的に制御されることで、各表示セルの階調が高精度に調節される。
【００１９】
駆動チップ160はタイミングコントローラ270とデータ駆動部200とを内蔵し、それらを利用してデータラインDL1〜DL3kの各電圧を制御する（図８参照）。図８に示されているように、タイミングコントローラ270は、三原色のデジタル画像信号R、G、B、ドットクロックCLK、制御信号CS、及び三つの選択信号S1、S2、S3を出力する。ドットクロックCLKは、タイミングコントローラ270が個々のデジタル画像信号R、G、Bを出力するタイミングを示す。ここで、タイミングコントローラ270は好ましくは表示パネルのラインごとに、対応する三原色のデジタル画像信号R、G、Bを所定の順序で出力する。更に好ましくは、各スキャンラインに対してスキャン信号を出力する時間が三つの期間に分割され、各期間に異なる色のデジタル画像信号が出力される。制御信号CSは、タイミングコントローラ270が表示パネルの各ラインに対応する一連のデジタル画像信号の先頭を出力するタイミングを示す。選択信号S1、S2、S3は、タイミングコントローラ270によるデジタル画像信号の出力タイミングをＲ、Ｇ、Ｂの色別に示す（詳細は後述参照）。
【００２０】
一方、データ駆動部200は、シフトレジスタ部210、データレジスタ部220、データラッチ部230、レベルシフタ部240、デジタル／アナログ（Ｄ／Ａ）変換部250、及び出力バッファ部260を含む。シフトレジスタ部210は外部から印加される二種類の電源電圧VDD、VSSによって駆動される。シフトレジスタ部210は各データラインDL1〜DL3kに対応する3k個の出力端子を持つ。タイミングコントローラ270から制御信号CSを受信するとき、シフトレジスタ部210は先頭のデータラインDL1に対応する出力端子から順に、ドットクロックCLKのパルスを一つずつ出力する。データレジスタ部220は、シフトレジスタ部210から出力される各パルスに同期してデジタル画像信号R、G、Bを一つずつ入力して貯える。表示パネルの一つのラインに対応する一連のデジタル画像信号が貯えられるごとに、データレジスタ部220は貯えられた一連のデジタル画像データを一度にデータラッチ部230に対して出力する。データラッチ部230はデータレジスタ部220から一度に出力された一連のデジタル画像信号を所定時間ラッチする。そのラッチ期間では、レベルシフト部240が、データラッチ部230にラッチされたデジタル画像信号の各レベルを所定のレベルまで変位させる。Ｄ／Ａ変換部250は、レベルシフト部240からデジタル画像信号を受信し、外部から印加されるガンマ基準電圧251に基づいてアナログ画像信号に変換する。Ｄ／Ａ変換部250は更に、タイミングコントローラ270から特定の信号ライン253を通して選択信号S1、S2、S3を受信し、三原色のアナログ画像信号R、G、Bを選択信号S1、S2、S3により示される順序で出力バッファ部260に出力する（詳細は後述参照）。出力バッファ部260は、Ｄ／Ａ変換部250から受信されるアナログ画像信号を増幅し、各データラインDL1〜DL3kに出力する。
【００２１】
図９はＤ／Ａ変換部250と出力バッファ部260との回路構成を示すブロック図である。図９に示されているように、Ｄ／Ａ変換部250は複数のデジタル／アナログコンバータ（ＤＡＣ）と信号選択部252とを含む。出力バッファ部260は、各データラインDL1〜DLmに個別に連結されたm個のアンプAMPを含む。Ｄ／Ａ変換部250では特に従来のものとは異なり、ＤＡＣDAC1〜DACkの個数kがデータラインDL1〜DLmの個数mの1／3倍である（k＝m／3）。各ＤＡＣDAC1〜DACkは共通入力ラインCIL1〜CILkと共通出力ラインCOL1〜COLkとをそれぞれ一つずつ持つ。各共通入力ラインCIL1〜CILkは好ましくは一つの信号線から成る。その他に、三つの信号線を含んでも良い。各ＤＡＣDAC1〜DACkの共通入力ラインCIL1〜CILkには、レベルシフト部240から三原色Ｒ、Ｇ、Ｂのデジタル画像信号が一組ずつ入力される。ここで、入力される一組のデジタル画像信号の順序は、タイミングコントローラ270から出力される三原色のデジタル画像信号R、G、Bの順序と等しい。一方、各ＤＡＣDAC1〜DACkの共通出力ラインCOL1〜COLkにはデータラインが三つずつ連結され、更にそれら三つのデータラインを通して同じ一つの単位セルに連結されている。例えば、先頭から三つの隣接するデータラインDL1〜DL3が先頭のＤＡＣDAC1の共通出力ラインCOL1に連結されている。
【００２２】
信号選択部252は好ましくは、k組の並列スイッチSW1 〜SWkを含む。各並列スイッチSW1〜SWkは好ましくは、三つのＭＯＳトランジスタTr1 、Tr2、Tr3 の並列接続から成る。各ＭＯＳトランジスタTr1 、Tr2、Tr3 は各ＤＡＣDAC1〜DACkの共通出力ラインCOL1〜COLkを、出力バッファ部260に含まれている各出力バッファAMPに連結する。一方、各ＭＯＳトランジスタTr1 、Tr2、Tr3のゲート端子が信号線253（図８参照）に連結され、タイミングコントローラ270から選択信号S1、S2、S3を受信する。それにより、各ＭＯＳトランジスタTr1 、Tr2、Tr3が選択信号S1、S2、S3に従ってオンオフされ、各共通出力ラインCOL1〜COLkを通して出力されるアナログ画像信号の伝送経路が選択される。特に、タイミングコントローラ270から出力される三原色のデジタル画像信号R、G、Bの順序に合わせて、各共通出力ラインCOL1〜COLkに連結された三つのデータラインの中から一つがアナログ画像信号の出力先として選択される。
【００２３】
スキャンラインの一つに対してスキャン信号が出力される間、ＤＡＣDAC1〜DACkはＲ、Ｇ、Ｂの三つのデジタル画像信号を所定の順序で受信してアナログ画像信号に変換し、共通出力ラインCOL1〜COLkに出力する。一方、並列スイッチSW1 〜SWkが同じ順序で、Ｒ、Ｇ、Ｂの各色に対応するデータラインを共通出力ラインCOL1〜COLkに連結するので、ＤＡＣDAC1〜DACkにより変換されたＲ、Ｇ、Ｂの三つのアナログ画像信号が対応するデータラインに正しく出力される。こうして、一つの単位セルに対するＲ、Ｇ、Ｂの画像信号を一つのＤＡＣで処理できるので、ＤＡＣDAC1〜DACkの総数kをデータラインDL1〜DLmの総数mより削減できる。その結果、データ駆動部200が更に小型化され、その消費電力が更に低減する。
【００２４】
駆動チップ160はデータラインに対して画像信号を、例えば図１０に示されているタイミングチャートに従って出力しても良い。図１０、１２に示されているように、まず、スキャン信号がアクティブに維持されている時間1H、すなわち一つのスキャンラインに対してスキャン信号が出力される時間が三つの期間T1、T2、T3に等分割される。ここで、図１０、１２では上記の時間1Hがゲートオン信号のアクティブ期間（以下、ゲートオン期間という）として表されている。次に、各期間T1、T2、T3に異なる色の画像信号R、G、Bがデータラインに出力される。図１０では特に、各ゲートオン期間1Hに出力されるＲ、Ｇ、Ｂの画像信号の順序が一定である。その順序が例えばＲ−Ｇ−Ｂである場合、スキャンラインSL1に関するゲートオン期間1Hのうち、先頭の期間T1ではＲの画像信号が第１データラインDL1に出力される（図１１参照）。従って、第１データラインDL1に連結された第１スイッチングトランジスタST1を通して第１液晶キャパシタC1（透明電極PE、CEとその間に挟まれている液晶LCとによって構成される等価容量（図７参照））が充電される（図１３参照）。二番目の期間T2ではＧの画像信号が第２データラインDL2に出力される。従って、第２データラインDL2に連結された第２スイッチングトランジスタST2を通して第２液晶キャパシタC2が充電され、それと同時に第１液晶キャパシタC1が放電する。最後の期間T3ではＢの画像信号が第３データラインDL3に出力される。従って、第３データラインDL3に連結された第３スイッチングトランジスタST3を通して第３液晶キャパシタC3が充電され、それと同時に第１及び第２液晶キャパシタC1、C2が放電する。図１３に示されているように、各液晶キャパシタC1〜C3に蓄積されている電荷量の変化、すなわち各液晶キャパシタC1〜C3の両端電圧の変化は一般に、対応する画像信号R、G、Bの変化より遅れる。その遅れが十分に無視できる場合は、表示パネルの画質は十分に高く維持される。
【００２５】
図１０に示されている駆動方法では、画像信号R、G、Bの変化に対して各液晶キャパシタC1〜C3の両端電圧の変化の遅れが過大である場合、各ゲートオン期間1H中での実際の発光時間について、同じ単位セルに含まれている、Ｒ、Ｇ、Ｂの三つの表示セル間での差異が顕著になる。具体的には、先頭の期間T1に出力される画像信号に対応する色（図１０ではＲ）は実際の発光時間が長く、最後の期間T3に出力される画像信号に対応する色（図１０ではＢ）は実際の発光時間が短い。カラーフィルタがデルタ配列を採用する場合、データラインが比較的複雑な形状を持つので、上記の発光時間の差異が更に顕著になりやすい。その差異が顕著である場合、画質の更なる向上が困難である。特に、液晶キャパシタC1〜C3間での充放電量の差異が、連続する複数のフレームで累積されて増大しやすいので、表示パネルに縦線現象のような表示不良のおそれが生じる。そこで、駆動チップ160は、より好ましくは、図１０に示されている駆動方法に代え、以下のような駆動方法を採用する（図１４〜１７参照）。図１４に示されているタイミングチャートでは特に図１０に示されているタイミングチャートとは異なり、各ゲートオン期間1Hに出力されるＲ、Ｇ、Ｂの画像信号の順序が、好ましくはフレームごとに変化する。図１４では例えば、各ゲートオン期間1Hに出力される三つの画像信号の順序が、第１フレームでは第１の順序Ｒ−Ｇ−Ｂであるが、第２フレームでは第２の順序Ｇ−Ｂ−Ｒに変化している。更に、第３フレームではその順序が第３の順序Ｂ−Ｒ−Ｇに変化している。このように、連続する三つのフレーム間では、いずれの単位セルに対しても、入力される画像信号の順序が異なる。
【００２６】
単位セルに第１の順序Ｒ−Ｇ−Ｂで画像信号が入力される第１フレームでは、各表示セルの液晶キャパシタC1〜C3（図１１参照）に蓄積される電荷量が図１５のように変化する。単位セルに第２の順序Ｇ−Ｂ−Ｒで画像信号が入力される第２フレームでは、各液晶キャパシタC1〜C3の電荷量が図１６のように変化する。単位セルに第３の順序Ｂ−Ｒ−Ｇで画像信号が入力される第３フレームでは、各液晶キャパシタC1〜C3の電荷量が図１７のように変化する。  図１５〜１７から明らかに理解されるように、連続する第１〜第３フレーム間では、同じ単位セルに含まれている三つの液晶キャパシタC1、C2、C3間で充放電量の各平均値が共通である。従って、連続する三つのフレーム間で平均すれば、同じ単位セルに含まれている三つの表示セルが同じ発光時間を保つ。それ故、図１４に示されている駆動方法では、図１０に示されている駆動方法とは異なり、画質の更なる向上が容易である。特に、縦線現象のような表示不良を確実に防止できる。これらの効果は更に、カラーフィルタの配列パターンやそれに対応するデータラインの形状には依存しない。その結果、特にデルタ配列のカラーフィルタが採用される表示装置では、図１４に示されている駆動方法が有利である。
【００２７】
本発明の上記の実施形態による駆動チップ160は、図１４に示されている駆動方法を、具体的には次のように実行する（図１８参照）。ステップS11では、一つのフレームについて、スキャンラインの一つに対してスキャン信号が出力されるごとに、そのスキャンラインに連結されている単位セルに対し、Ｒ、Ｇ、Ｂの画像信号が一定の順序で伝送される。特に、そのフレームではゲートオン期間ごとに、タイミングコントローラ270が三つの選択信号S1、S2、S3を、画像信号の出力順に相当する順序で信号選択部252に出力する。ステップS12では、直前のフレームに関するステップS11で選択されていた画像信号の順序を、別の順序に変更する。
【００２８】
例えば、ステップS11では、Ｒ、Ｇ、Ｂの画像信号が第１の順序Ｒ−Ｇ−Ｂで各単位セルに伝送される場合、三つの選択信号S1、S2、S3が第１の順序Ｒ−Ｇ−Ｂに相当する順序S1−S2−S3で信号選択部252に出力される。一つのフレームに含まれる全ての画像信号が単位セルに伝送された場合、続いて、ステップS12では、画像信号の伝送順が第１の順序Ｒ−Ｇ−Ｂから第２の順序Ｇ−Ｂ−Ｒに変更される。それにより、次のフレームに関するステップS11では、Ｒ、Ｇ、Ｂの画像信号が第２の順序Ｇ−Ｂ−Ｒで各単位セルに伝送され、三つの選択信号S1、S2、S3が第２の順序Ｇ−Ｂ−Ｒに相当する順序S2−S3−S1で信号選択部252に出力される。同様に、ステップS11、S12が繰り返されることで、更にその次のフレームでは、Ｒ、Ｇ、Ｂの画像信号が第３の順序Ｂ−Ｒ−Ｇで各単位セルに伝送され、三つの選択信号S1、S2、S3が第３の順序Ｂ−Ｒ−Ｇに相当する順序S3−S1−S2で信号選択部252に出力される。
【００２９】
本発明の上記の実施形態による駆動チップ160では、タイミングコントローラ270が三つの選択信号S1、S2、S3を、画像信号の出力順に相当する順序で信号選択部252に出力する。その他に、タイミングコントローラから出力される一つの選択信号に基づき、または、レベルシフト部等、前段の回路から出力される画像信号自体に基づき、信号選択部が独自に、画像信号の出力順を判断しても良い。
本発明の上記の実施形態による駆動方法では、Ｒ、Ｇ、Ｂの画像信号の出力順がフレームごとに変更される。その他に、その順序の変更が、連続する２以上の一定数のフレームごとに行われても良い。
【産業上の利用可能性】
【００３０】
本発明は上記の通り、表示装置、特にその駆動方法に関し、一つの単位セルに出力されるＲ、Ｇ、Ｂの三つの画像信号を一つのデジタル／アナログコンバータで処理し、更にそれらの画像信号の出力順を変化させる。このように、本発明は明らかに、産業上利用可能である。
【図面の簡単な説明】
【００３１】
【図１】poly−Si型ＴＦＴ−ＬＣＤの一般的な構成を示す模式図
【図２】a−Si型ＴＦＴ−ＬＣＤの一般的な構成を示す模式図
【図３】従来のデータ駆動部に含まれているデジタル／アナログコンバータと出力バッファとの概略を示すブロック図
【図４】本発明の実施形態による液晶表示パネルを示す斜視図
【図５】カラーフィルタのストライプ配列を示す模式図
【図６】本発明の実施形態によるカラーフィルタのデルタ配列を示す模式図
【図７】本発明の実施形態によるＴＦＴ−ＬＣＤの回路構成の概略を示すブロック図
【図８】本発明の実施形態による駆動チップの回路構成の概略を示すブロック図
【図９】本発明の実施形態によるデジタル／アナログ変換部と出力バッファ部とを示すブロック図
【図１０】本発明の実施形態による一つの駆動方法を示すタイミングチャート
【図１１】液晶表示装置に含まれている表示セルを表す等価回路図
【図１２】図１０に示されているタイミングチャートに従って出力される、Ｒ、Ｇ、Ｂの画像信号を示す波形図
【図１３】図１０に示されている駆動方法について、同じ単位セルに含まれている三つの液晶キャパシタに蓄積されている各電荷量の変化を表すグラフ
【図１４】本発明の実施形態による別の駆動方法を示すタイミングチャート
【図１５】図１４に示されている駆動方法について、同じ単位セルに含まれている三つの液晶キャパシタに蓄積されている各電荷量の、第１フレームでの変化を表すグラフ
【図１６】図１４に示されている駆動方法について、同じ単位セルに含まれている三つの液晶キャパシタに蓄積されている各電荷量の、第２フレームでの変化を表すグラフ
【図１７】図１４に示されている駆動方法について、同じ単位セルに含まれている三つの液晶キャパシタに蓄積されている各電荷量の、第３フレームでの変化を表すグラフ
【図１８】本発明の実施形態による表示装置の駆動方法を示すフローチャート
【符号の説明】
【００３２】
100      ＴＦＴ−ＬＣＤ
120      液晶表示パネル
130      ＴＦＴ基板
140      カラーフィルタ基板
150      フレキシブルプリント回路基板
160      駆動チップ
210      シフトレジスタ部
220      データレジスタ部
230      データラッチ部
240      レベルシフタ部
250      デジタル／アナログ変換部
252      信号選択部
【図１】
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【図２】
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【図３】
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【図４】
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【図５】
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【図６】
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【図７】
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【図８】
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【図９】
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【図１０】
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【図１１】
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【図１２】
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【図１３】
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【図１４】
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【図１５】
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【図１６】
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【図１７】
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【図１８】
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