(57)【要約】【課題】ＳＩＭＤ演算の対象となるオペランドの位置に関する制約が少ない、柔軟性の高いＳＩＭＤ演算を実行するプロセッサを提供する。【解決手段】デコード部２０と演算部４０等を備え、デコード部２０が命令「ｖｈａｄｄｈ  Ｒｃ，Ｒａ，Ｒｂ」を解読すると、算術論理・比較演算器４１等は、（i）レジスタＲａの上位１６ビットとレジスタＲｂの上位１６ビットとを加算し、結果をレジスタＲｃの上位１６ビットに格納し、それと並行して、（ii）レジスタＲａの下位１６ビットとレジスタＲｂの上位１６ビットとを加算し、結果をレジスタＲｃの下位１６ビットに格納する。【選択図】図１
2006338684.tif 000002
【特許請求の範囲】
【請求項１】
１つの命令で複数のデータを演算するＳＩＭＤ型の命令を実行するプロセッサであって、
命令を解読する解読手段と、
解読手段による解読結果に基づいて、命令を実行する実行手段とを備え、
前記実行手段は、演算の種類を指定する命令コードとｎ（≧２）個のデータの並びからなる第１データ群を指定する第１オペランドとｎ個のデータの並びからなる第２データ群を指定する第２オペランドとを含むＳＩＭＤ型の命令が前記解読手段によって解読された場合に、前記第１データ群を構成するｎ個のデータの並びにおける第ｉ番目のデータと前記第２データ群を構成するｎ個のデータの並びにおける第ｊ番目のデータとからなるｎ組それぞれに対して前記命令コードで指定される演算を行い、
前記ｉ＝１，２，…，ｎ、前記ｊ＝一定である
ことを特徴とするプロセッサ。
【請求項２】
前記ｎは、２であり、
前記第１データ群は、第１番目データと第２番目データとからなり、
前記第２データ群は、第１番目データと第２番目データとからなり、
前記実行手段は、前記第１データ群の第１番目データと第２データ群の第１番目データとの組に対して前記演算を行うとともに、前記第１データ群の第２番目データと第２データ群の第１番目データとの組に対して前記演算を行う
ことを特徴とする請求項１記載のプロセッサ。
【請求項３】
前記ｎは、２であり、
前記第１データ群は、第１番目データと第２番目データとからなり、
前記第２データ群は、第１番目データと第２番目データとからなり、
前記実行手段は、前記第１データ群の第１番目データと第２データ群の第２番目データとの組に対して前記演算を行うとともに、前記第１データ群の第２番目データと第２データ群の第２番目データとの組に対して前記演算を行う
ことを特徴とする請求項１記載のプロセッサ。
【請求項４】
前記ｎは、２であり、
前記第１データ群は、第１番目データと第２番目データとからなり、
前記第２データ群は、第１番目データと第２番目データとからなり、
前記実行手段は、
第１命令が前記解読手段によって解読された場合に、前記第１データ群の第１番目データと第２データ群の第１番目データとの組に対して前記演算を行うとともに、前記第１データ群の第２番目データと第２データ群の第１番目データとの組に対して前記演算を行い、
第２命令が前記解読手段によって解読された場合に、前記第１データ群の第１番目データと第２データ群の第２番目データとの組に対して前記演算を行うとともに、前記第１データ群の第２番目データと第２データ群の第２番目データとの組に対して前記演算を行う
ことを特徴とする請求項１記載のプロセッサ。
【請求項５】
前記命令コードが指定する演算の種類は、乗算、積和又は積差であり、
前記命令は、演算の結果を格納するための第３データを指定する第３オペランドを含み、
前記実行手段は、前記２つの組に対して前記演算を行って得られた結果それぞれの下位部分を前記第３データに格納する
ことを特徴とする請求項２〜４のいずれか１項に記載のプロセッサ。
【請求項６】
前記命令コードが指定する演算の種類は、乗算、積和又は積差であり、
前記命令は、演算の結果を格納するための第３データを指定する第３オペランドを含み、
前記実行手段は、前記２つの組に対して前記演算を行って得られた結果それぞれの上位部分を前記第３データに格納する
ことを特徴とする請求項２〜４のいずれか１項に記載のプロセッサ。
【請求項７】
前記命令コードが指定する演算の種類は、乗算、積和又は積差であり、
前記命令は、演算の結果を格納するための第３データを指定する第３オペランドを含み、
前記実行手段は、前記２つの組に対して前記演算を行って得られた２つの結果のいずれかを前記第３データに格納する
ことを特徴とする請求項２〜４のいずれか１項に記載のプロセッサ。
【請求項８】
前記ｎは、４であり、
前記第１データ群は、第１〜第４番目データの並びからなり、
前記第２データ群は、第１〜第４番目データの並びからなり、
前記実行手段は、前記第１データ群の第１番目データと第２データ群の第１番目データとの組、前記第１データ群の第２番目データと第２データ群の第１番目データとの組、前記第１データ群の第３番目データと第２データ群の第１番目データとの組、及び、前記第１データ群の第４番目データと第２データ群の第１番目データとの組に対して前記演算を行う
ことを特徴とする請求項１記載のプロセッサ。
【請求項９】
前記ｎは、４であり、
前記第１データ群は、第１〜第４番目データの並びからなり、
前記第２データ群は、第１〜第４番目データの並びからなり、
前記実行手段は、前記第１データ群の第１番目データと第２データ群の第２番目データとの組、前記第１データ群の第２番目データと第２データ群の第２番目データとの組、前記第１データ群の第３番目データと第２データ群の第２番目データとの組、及び、前記第１データ群の第４番目データと第２データ群の第２番目データとの組に対して前記演算を行う
ことを特徴とする請求項１記載のプロセッサ。
【請求項１０】
前記ｎは、４であり、
前記第１データ群は、第１〜第４番目データの並びからなり、
前記第２データ群は、第１〜第４番目データの並びからなり、
前記実行手段は、前記第１データ群の第１番目データと第２データ群の第３番目データとの組、前記第１データ群の第２番目データと第２データ群の第３番目データとの組、前記第１データ群の第３番目データと第２データ群の第３番目データとの組、及び、前記第１データ群の第４番目データと第２データ群の第３番目データとの組に対して前記演算を行う
ことを特徴とする請求項１記載のプロセッサ。
【請求項１１】
前記ｎは、４であり、
前記第１データ群は、第１〜第４番目データの並びからなり、
前記第２データ群は、第１〜第４番目データの並びからなり、
前記実行手段は、前記第１データ群の第１番目データと第２データ群の第４番目データとの組、前記第１データ群の第２番目データと第２データ群の第４番目データとの組、前記第１データ群の第３番目データと第２データ群の第４番目データとの組、及び、前記第１データ群の第４番目データと第２データ群の第４番目データとの組に対して前記演算を行う
ことを特徴とする請求項１記載のプロセッサ。
【請求項１２】
前記命令コードが指定する演算の種類は、乗算、積和又は積差であり、
前記命令は、演算の結果を格納するための第３データを指定する第３オペランドを含み、
前記実行手段は、前記４つの組に対して前記演算を行って得られた結果それぞれの下位部分を前記第３データに格納する
ことを特徴とする請求項８〜１１のいずれか１項に記載のプロセッサ。
【請求項１３】
前記命令コードが指定する演算の種類は、乗算、積和又は積差であり、
前記命令は、演算の結果を格納するための第３データを指定する第３オペランドを含み、
前記実行手段は、前記４つの組に対して前記演算を行って得られた結果それぞれの上位部分を前記第３データに格納する
ことを特徴とする請求項８〜１１のいずれか１項に記載のプロセッサ。
【請求項１４】
前記命令コードが指定する演算の種類は、乗算、積和又は積差であり、
前記命令は、演算の結果を格納するための第３データを指定する第３オペランドを含み、
前記実行手段は、前記４つの組に対して前記演算を行って得られた４つの結果のうちの２つを前記第３データに格納する
ことを特徴とする請求項８〜１１のいずれか１項に記載のプロセッサ。
【発明の詳細な説明】
【技術分野】
【０００１】
本発明は、ＤＳＰやＣＰＵ等のプロセッサに関し、特にＳＩＭＤ型の命令を実行するプロセッサに関する。
【背景技術】
【０００２】
従来、ＳＩＭＤ（Single Instruction Multiple Data）型の命令をサポートしているプロセッサとして、米国インテル社のＰｅｎｔｉｕｍ（登録商標）／同III／同４のＭＭＸ／ＳＳＥ／ＳＳＥ２等がある。
【０００３】
例えば、ＭＭＸであれば、６４ビット長のＭＭＸレジスタに格納された最大８個の整数を対象として、１つの命令で同一のオペレーションを実行することができる。
【発明の開示】
【発明が解決しようとする課題】
【０００４】
しかしながら、上記のような従来のプロセッサは、ＳＩＭＤ演算の対象となるオペランドの位置に関する制約が多いという問題がある。
【０００５】
例えば、第１レジスタの上位桁及び下位桁それぞれに数値Ａ及びＢが格納され、第２レジスタの上位桁及び下位桁それぞれに数値Ｃ及びＤが格納された状態で、第１レジスタと第２レジスタをオペランドとするＳＩＭＤ型の加算命令を従来のプロセッサが実行した場合には、得られる加算値は、Ａ＋Ｃ、及び、Ｂ＋Ｄである。つまり、両レジスタの上位桁に格納されたデータ同士の加算値と両レジスタの下位桁に格納されたデータ同士の加算値が得られることとなり、レジスタでのデータの格納位置によって演算対象が一義的に決定されてしまう。
【０００６】
そのために、例えば、上記のような第１レジスタ及び第２レジスタに対して、Ａ＋Ｄ、及び、Ｂ＋Ｃという加算値を求めたい場合には、一方のレジスタに格納された上位桁のデータと下位桁のデータの格納位置を入れ替えてから、ＳＩＭＤ型の加算命令を実行したり、あるいは、ＳＩＭＤ型の加算命令を用いることなく、通常のＳＩＳＤ（Single Instruction Single Data）型の加算命令を２回実行したりする必要がある。
【０００７】
ところで、近年の通信のデジタル化に伴い、フーリエ変換やフィルタ処理等のデジタル信号処理が必要とされる画像処理や音声処理の分野では、複数のデータに対して同一の演算処理を施すことが必要とされるが、その場合に、例えば、データの並びにおける中心位置から左右対称に位置するデータに対して同一の演算を施す等の処理が必要とされるケースが多い。このようなケースでは、演算の対象となる２種類のオペランドは逆順に並べられ、例えば、２つのレジスタにおける一方の上位桁に格納されたデータと他方の下位桁に格納されたデータとを対象として演算をしなければならない。
【０００８】
ところが、従来のプロセッサによるＳＩＭＤ演算では、上述のように、演算の対象となるオペランドは同じ順序で並べられている必要があるために、オペランドの並び替え等が必要とされ、デジタル信号処理に多くの時間を要してしまうという問題がある。
【０００９】
そこで、本発明は、このような状況に鑑みてなされたものであり、ＳＩＭＤ演算の対象となるオペランドの位置に関する制約が少ない、柔軟性の高いＳＩＭＤ演算を実行するプロセッサを提供することを目的とする。より具体的には、例えば、デジタル信号処理を高速に実行するマルチメディア用途に適したプロセッサを提供することを目的とする。
【課題を解決するための手段】
【００１０】
上記目的を達成するために、本発明に係るプロセッサは、１つの命令で複数のデータを演算するＳＩＭＤ型の命令を実行するプロセッサであって、命令を解読する解読手段と、解読手段による解読結果に基づいて、命令を実行する実行手段とを備え、前記実行手段は、演算の種類を指定する命令コードとｎ（≧２）個のデータの並びからなる第１データ群を指定する第１オペランドとｎ個のデータの並びからなる第２データ群を指定する第２オペランドとを含むＳＩＭＤ型の命令が前記解読手段によって解読された場合に、前記第１データ群を構成するｎ個のデータの並びにおける第ｉ番目のデータと前記第２データ群を構成するｎ個のデータの並びにおける第ｊ番目のデータとからなるｎ組それぞれに対して前記命令コードで指定される演算を行い、前記ｉ＝１，２，…，ｎ、前記ｊ＝一定であることを特徴とする。
【００１１】
たとえば、前記ｎは、２であり、前記第１データ群は、第１番目データと第２番目データとからなり、前記第２データ群は、第１番目データと第２番目データとからなり、前記実行手段は、前記第１データ群の第１番目データと第２データ群の第１番目データとの組に対して前記演算を行うとともに、前記第１データ群の第２番目データと第２データ群の第１番目データとの組に対して前記演算を行う。
【００１２】
ここで、前記命令コードが指定する演算の種類は、乗算、積和又は積差であり、前記命令は、演算の結果を格納するための第３データを指定する第３オペランドを含み、前記実行手段は、前記２つの組に対して前記演算を行って得られた結果それぞれの下位部分又は上位部分を前記第３データに格納してもよい。
【００１３】
また、たとえば、前記ｎは、４であり、前記第１データ群は、第１〜第４番目データの並びからなり、前記第２データ群は、第１〜第４番目データの並びからなり、前記実行手段は、前記第１データ群の第１番目データと第２データ群の第１番目データとの組、前記第１データ群の第２番目データと第２データ群の第１番目データとの組、前記第１データ群の第３番目データと第２データ群の第１番目データとの組、及び、前記第１データ群の第４番目データと第２データ群の第１番目データとの組に対して前記演算を行う。
【００１４】
ここで、前記命令コードが指定する演算の種類は、乗算、積和又は積差であり、前記命令は、演算の結果を格納するための第３データを指定する第３オペランドを含み、前記実行手段は、前記４つの組に対して前記演算を行って得られた結果それぞれの下位部分又は上位部分を前記第３データに格納してもよい。
【００１５】
なお、本発明は、このような特徴的な命令を実行するプロセッサとして実現することができるだけでなく、複数のデータ等に対する演算処理方法として実現したり、特徴的な命令を含むプログラムとして実現したりすることもできる。そして、そのようなプログラムは、ＣＤ−ＲＯＭ等の記録媒体やインターネット等の伝送媒体を介して流通させることができるのは言うまでもない。
【発明の効果】
【００１６】
本発明に係るプロセッサは、１つの命令で複数のデータを演算するＳＩＭＤ型の命令を実行するプロセッサであって、２つのデータ列に対して、同一順位のデータ同士だけでなく、一方のデータ列の演算対象を共通（位置を固定）にしたデータ組に対して並列に演算を実行する。したがって、複数のデータ要素に対して共通のデータ要素との演算を繰り返すが高速化され、マルチメディア処理等に好適なプロセッサが実現される。
【００１７】
ここで、演算の種類が乗算、積和又は積差である場合には、得られた演算結果それぞれの下位部分だけを出力したり、上位部分だけを出力したり、一部の演算結果だけを出力してもよい。これによって、複素数の内積等において、整数データを扱う場合や固定小数点データを扱う場合に必要となるビット切り出し処理が演算とともに実行されるので、複素数等の２次元データを用いる演算、例えば、２次元座標を用いる画像処理や振幅と位相の２次元表現が用いられる音声信号の処理等が高速化される。
【００１８】
以上のように、本発明に係るプロセッサは、通常のマイコンに比べて並列性が高く、ＡＶメディア系信号処理が高速であり、携帯電話、モバイルＡＶ機器、デジタルＴＶ、ＤＶＤ等に共通のコアプロセッサとして使用可能であり、高性能・高コストパフォーマンスなマルチメディア機器の出現が望まれる今日における実用的価値は極めて高いと言える。
【発明を実施するための最良の形態】
【００１９】
本発明に係るプロセッサのアーキテクチャについて説明する。本プロセッサの命令は通常のマイコンに比べて並列性が高く、ＡＶメディア系信号処理技術分野をターゲットとして開発された汎用プロセッサである。携帯電話、モバイルＡＶ機器、デジタルＴＶ、ＤＶＤ等に共通コアを使用することにより、ソフト再利用性を向上させることができる。また、本プロセッサは、高性能・高コストパフォーマンスで多くのメディア処理を実現することができ、さらに、開発効率向上を目的とした高級言語開発環境を提供する。
【００２０】
図１は、本プロセッサの概略ブロック図である。本プロセッサ１は、命令制御部１０、デコード部２０、レジスタファイル３０、演算部４０、Ｉ／Ｆ部５０、命令メモリ部６０、データメモリ部７０、拡張レジスタ部８０及びＩ／Ｏインターフェース部９０から構成される。演算部４０は、ＳＩＭＤ型命令の演算を実行する算術論理・比較演算器４１〜４３、乗算・積和演算器４４、バレルシフタ４５、除算器４６及び変換器４７からなる。乗算・積和演算器４４は、ビット精度を落とさないように、最長で６５ビットで累算する。また、乗算・積和演算器４４は、算術論理・比較演算器４１〜４３と同様、ＳＩＭＤ型命令の実行が可能である。更に、このプロセッサ１は、算術論理・比較演算命令が最大３並列実行可能である。
【００２１】
図２は、算術論理・比較演算器４１〜４３の概略図を示す。算術論理・比較演算器４１〜４３それぞれは、ＡＬＵ部４１ａ、飽和処理部４１ｂ及びフラグ部４１ｃから構成される。ＡＬＵ部４１ａは、算術演算器、論理演算器、比較器、ＴＳＴ器からなる。対応する演算データのビット幅は、８ビット(演算器を４並列で使用)、１６ビット(演算器を２並列で使用)、３２ビットである(全演算器で３２ビットデータ処理)。更に算術演算結果に対しては、フラグ部４１ｃ等により、オーバーフローの検出とコンディションフラグの生成が行われる。各演算器、比較器、ＴＳＴ器の結果は、算術右シフト、飽和処理部４１ｂによる飽和、最大・最小値検出、絶対値生成処理が行われる。
【００２２】
図３は、バレルシフタ４５の構成を示すブロック図である。バレルシフタ４５は、セレクタ４５ａ、４５ｂ、上位バレルシフタ４５ｃ、下位バレルシフタ４５ｄ及び飽和処理部４５ｅから構成され、データの算術シフト(２の補数体系のシフト)または、論理シフト(符号なしシフト)を実行する。通常は、３２ビットもしくは、６４ビットのデータを入出力としている。レジスタ３０ａ、３０ｂに格納された被シフトデータに対して、別のレジスタまたは即値でシフト量が指定される。データは、左６３ビット〜右６３ビットの算術または論理シフトが行われ、入力ビット長で出力される。
【００２３】
また、バレルシフタ４５は、ＳＩＭＤ型命令に対して、８、１６、３２、６４ビットのデータをシフトすることができる。例えば、８ビットデータのシフトを４並列で処理することができる。
【００２４】
算術シフトは、２の補数体系のシフトであり、加算や減算時の小数点の位置合わせや、２のべき乗の乗算(２、２の２乗、２の（−１）乗、２の（−２）乗倍など)等のために行われる。
【００２５】
図４は、変換器４７の構成を示すブロック図である。変換器４７は、飽和ブロック(SAT)４７ａ、BSEQブロック４７ｂ、MSKGENブロック４７ｃ、VSUMBブロック４７、BCNTブロック４７ｅ及びILブロック４７ｆから構成される。
【００２６】
飽和ブロック(SAT)４７ａは、入力データに対する飽和処理を行う。３２ビットデータを飽和処理するブロックを２つ持つことにより、２並列のＳＩＭＤ型命令をサポートする。
【００２７】
BSEQブロック４７ｂは、MSBから連続する０か１をカウントする。
MSKGENブロック４７ｃは、指定されたビット区間を１、それ以外を０として出力する。
【００２８】
VSUMBブロック４７ｄは、入力データを指定されたビット幅に区切り、その総和を出力する。
【００２９】
BCNTブロック４７ｅは、入力データで１となっているビットの数をカウントする。
ILブロック４７ｆは、入力データを指定されたビット幅に区切り、各データブロックを入れ換えた値を出力する。
【００３０】
図５は、除算器４６の構成を示すブロック図である。除算器４６は、被除数を６４ビット、除数を３２ビットとし、商と剰余を３２ビットずつ出力する。商と剰余を求めるまでに３４サイクルを必要とする。符号付き、符号なし、両方のデータを扱うことが可能である。ただし、被除数と除数において符号の有無の設定は共通とする。その他、オーバーフローフラグ、０除算フラグを出力する機能を有する。
【００３１】
図６は、乗算・積和演算器４４の構成を示すブロック図である。乗算・積和演算器４４は、２つの３２ビット乗算器（MUL）４４ａ、４４ｂ、３つの６４ビット加算器（Adder）４４ｃ〜４４ｅ、セレクタ４４ｆ及び飽和処理部（Saturation）４４ｇから構成され、以下の乗算、積和演算を行う。
【００３２】
・３２×３２ビットのsignedの乗算、積和、積差演算
・３２×３２ビットのunsignedの乗算
・１６×１６ビットの２並列のsignedの乗算、積和、積差演算
・３２×１６ビットの２並列のsignedの乗算、積和、積差演算
【００３３】
これらの演算を整数、固定小数点フォーマット（ｈ１、ｈ２、ｗ１、ｗ２）のデータに対して行う。また、これらの演算に対し、丸め、飽和を行う。
【００３４】
図７は、命令制御部１０の構成を示すブロック図である。命令制御部１０は、命令キャッシュ１０ａ、アドレス管理部１０ｂ、命令バッファ１０ｃ〜１０ｅ、ジャンプバッファ１０ｆ及びローテーション部（rotation）１０ｇから構成され、通常時及び分岐時の命令供給を行う。１２８ビットの命令バッファを３つ（命令バッファ１０ｃ〜１０ｅ）持つことにより、最大並列実行数に対応している。分岐処理に関しては、分岐実行前に、ジャンプバッファ１０ｆ等を介して、後述するＴＡＲレジスタに予め分岐先アドレスを格納する(settar命令)。ＴＡＲレジスタに格納された分岐先アドレスを使用して、分岐を行う。
【００３５】
なお、本プロセッサ１はＶＬＩＷアーキテクチャを持つプロセッサである。ここで、ＶＬＩＷアーキテクチャとは、１つの命令語中に複数の命令(ロード、ストア、演算、分岐など)を格納し、それらを全て同時に実行するアーキテクチャである。プログラマは、並列実行可能な命令を１つの発行グループとして記述することによって、その発行グループを並列処理させることができる。本明細書では、発行グループの区切りを“;;”で示す。以下に表記例を示す。
【００３６】
（例１）
mov r1, 0x23;;
【００３７】
この命令記述は、命令movのみを実行することを意味する。
【００３８】
（例２）
mov r1, 0x38
add r0, r1, r2
sub r3, r1, r2;;
【００３９】
これらの命令記述は、命令mov、add、subを３並列で実行することを意味する。
【００４０】
命令制御部１０は、発行グループを識別し、デコード部２０に送る。デコード部２０では、発行グループの命令を解析し、必要な資源を制御する。
【００４１】
次に、本プロセッサ１が備えるレジスタについて説明する。
本プロセッサ１のレジスタセットは、以下の表１に示される通りである。
【００４２】
【表１】
2006338684.tif 000003
【００４３】
また、本プロセッサ１のフラグセット（後述する条件フラグレジスタ等で管理されるフラグ）は、以下の表２に示される通りである。
【００４４】
【表２】
2006338684.tif 000004
【００４５】
図８は、汎用レジスタ（Ｒ０〜Ｒ３１）３０ａの構造を示す図である。汎用レジスタ（Ｒ０〜Ｒ３１）３０ａは、実行対象となっているタスクのコンテキストの一部を構成し、データまたはアドレスを格納する３２ビットのレジスタ群である。なお、汎用レジスタＲ３０およびＲ３１は、それぞれグローバルポインタ、スタックポインタとして、ハードウェアが使用する。
【００４６】
図９は、リンクレジスタ（ＬＲ）３０ｃの構造を示す図である。なお、このリンクレジスタ（ＬＲ）３０ｃと関連して、本プロセッサ１は、図示されていない退避レジスタ（ＳＶＲ）も備える。リンクレジスタ（ＬＲ）３０ｃは、関数コール時のリターンアドレスを格納する３２ビットのレジスタである。なお、退避レジスタ（ＳＶＲ）は、関数コール時の条件フラグレジスタのコンディションフラグ（CFR.CF）を退避する１６ビットのレジスタである。リンクレジスタ（ＬＲ）３０ｃは、後述する分岐レジスタ（ＴＡＲ）と同様に、ループ高速化にも使用される。下位１ビットは常に０が読み出されるが、書き込み時には０を書き込む必要がある。
【００４７】
例えば、call(brl,jmpl)命令を実行した場合には、本プロセッサ１は、リンクレジスタ（ＬＲ）３０ｃに戻りアドレスを退避し、退避レジスタ（ＳＶＲ）にコンディションフラグ(CFR.CF)を退避する。また、jmp命令を実行した場合には、リンクレジスタ（ＬＲ）３０ｃから戻りアドレス(分岐先アドレス)を取り出し、プログラムカウンタ（ＰＣ）を復帰させる。さらに、ret(jmpr)命令を実行した場合には、リンクレジスタ（ＬＲ）３０ｃから分岐先アドレス(戻りアドレス)を取り出し、プログラムカウンタ（ＰＣ）に格納(復帰)する。さらに、退避レジスタ（ＳＶＲ）からコンディションフラグを取り出し、条件フラグレジスタ（ＣＦＲ）３２のコンディションンフラグ領域CFR.CFに格納(復帰)する。
【００４８】
図１０は、分岐レジスタ（ＴＡＲ）３０ｄの構造を示す図である。分岐レジスタ（ＴＡＲ）３０ｄは、分岐ターゲットアドレスを格納する３２ビットのレジスタである。主に、ループの高速化に用いられる。下位１ビットは常に０が読み出されるが、書き込み時には０を書き込む必要がある。
【００４９】
例えば、jmp,jloop命令を実行した場合には、本プロセッサ１は、分岐レジスタ（ＴＡＲ）３０ｄから分岐先アドレスを取り出し、プログラムカウンタ（ＰＣ）に格納する。分岐レジスタ（ＴＡＲ）３０ｄに格納されたアドレスの命令が分岐用命令バッファに格納されている場合は、分岐ペナルティが０になる。分岐レジスタ（ＴＡＲ）３０ｄにループの先頭アドレスを格納しておくことでループを高速化することができる。
【００５０】
図１１は、プログラム状態レジスタ（ＰＳＲ）３１の構造を示す図である。プログラム状態レジスタ（ＰＳＲ）３１は、実行対象となっているタスクのコンテキストの一部を構成し、以下に示されるプロセッサ状態情報を格納する３２ビットのレジスタである。
【００５１】
ビットＳＷＥ：ＶＭＰ（Virtual Multi-Processor）のＬＰ（Logical Processor）切替えイネーブルを示す。「０」はＬＰ切替え不許可を示し、「１」はＬＰ切替え許可を示す。
【００５２】
ビットＦＸＰ：固定小数点モードを示す。「０」はモード０を示し、「１」はモード１を示す。
【００５３】
ビットＩＨ：割込み処理フラグであり、マスカブル割込み処理中であることを示す。「１」は割込み処理中であることを示し、「０」は割込み処理中でないことを示す。割込みが発生すると自動的にセットされる。rti命令で割込みから復帰したところが、他の割込み処理中かプログラム処理中であるのかを見分けるために使用される。
【００５４】
ビットＥＨ：エラーまたはＮＭＩを処理中であることを示すフラグである。「０」はエラー/ＮＭＩ割込み処理中でないことを示し、「１」はエラー/ＮＭＩ割込み処理中であることを示す。ＥＨ＝１のとき、非同期エラーまたはＮＭＩが発生した場合は、マスクされる。また、ＶＭＰイネーブル時はＶＭＰのプレート切り替えがマスクされる。
【００５５】
ビットＰＬ［１：０］：特権レベルを示す。「００」は特権レベル０、つまり、プロセッサアブストラクションレベルを示し、「０１」は特権レベル１（設定できない）を示し、「１０」は特権レベル２、つまり、システムプログラムレベルを示し、「１１」は特権レベル３、つまり、ユーザプログラムレベルを示す。
【００５６】
ビットＬＰＩＥ３：ＬＰ固有割込み３イネーブルを示す。「１」は割込み許可を示し、「０」は割込み不許可を示す。
【００５７】
ビットＬＰＩＥ２：ＬＰ固有割込み２イネーブルを示す。「１」は割込み許可を示し、「０」は割込み不許可を示す。
【００５８】
ビットＬＰＩＥ１：ＬＰ固有割込み１イネーブルを示す。「１」は割込み許可を示し、「０」は割込み不許可を示す。
【００５９】
ビットＬＰＩＥ０：ＬＰ固有割込み０イネーブルを示す。「１」は割込み許可を示し、「０」は割込み不許可を示す。
【００６０】
ビットＡＥＥ：ミスアライメント例外イネーブルを示す。「１」はミスアライメント例外許可を示し、「０」はミスアライメント例外不許可を示す。
【００６１】
ビットＩＥ：レベル割込みイネーブルを示す。「１」はレベル割込み許可を示し、「０」はレベル割込み不許可を示す。
【００６２】
ビットＩＭ［７：０］：割込みマスクを示す。レベル０〜７まで定義され、個々のレベルでマスクすることができる。レベル０が最も高いレベルとなる。ＩＭによりマスクされていない割込み要求のうち最も高いレベルを持った割込み要求のみがプロセッサ１に受理される。割込み要求を受理すると受理したレベル以下のレベルはハードウェアで自動的にマスクされる。IM[0]はレベル0のマスクであり、IM[1]はレベル1のマスクであり、IM[2]はレベル2のマスクであり、IM[3]はレベル3のマスクであり、IM[4]はレベル4のマスクであり、IM[5]はレベル5のマスクであり、IM[6]はレベル6のマスクであり、IM[7]はレベル7のマスクである。
【００６３】
ｒｅｓｅｒｖｅｄ：予約ビットを示す。常に０が読み出される。書き込む時は０を書き込む必要がある。
【００６４】
図１２は、条件フラグレジスタ（ＣＦＲ）３２の構造を示す図である。条件フラグレジスタ（ＣＦＲ）３２は、実行対象となっているタスクのコンテキストの一部を構成する３２ビットのレジスタであり、コンディションフラグ(条件フラグ)、オペレーションフラグ(演算フラグ)、ベクタコンディションフラグ(ベクタ条件フラグ)、演算命令用ビット位置指定フィールド、SIMDデータアライン情報フィールドから構成される。
【００６５】
ビットＡＬＮ［１：０］：アラインモードを示す。valnvc命令のアラインモードを設定する。
【００６６】
ビットＢＰＯ［４：０］：ビットポジションを示す。ビット位置指定の必要な命令で使用する。
【００６７】
ビットＶＣ０〜ＶＣ３：ベクタ条件フラグである。ＬＳＢ側のバイトあるいはハーフワードから順にＶＣ０に対応し、ＭＳＢ側がＶＣ３に対応する。
【００６８】
ビットＯＶＳ：オーバーフローフラグ(サマリー)である。飽和発生やオーバーフロー検出でセットされる。検出されなかった場合は、命令実行前の値を保持する。クリアはソフトで行う必要がある。
【００６９】
ビットＣＡＳ：キャリーフラグ(サマリー)である。addc命令でキャリーまたはsubc命令でボローが発生した場合セットされる。addc命令でキャリーもしくはsubc命令でボローが発生しなかった場合は、命令実行前の値を保持する。クリアはソフトで行う必要がある。
【００７０】
ビットＣ０〜Ｃ７：コンディションフラグである。フラグＣ７は常に値が１である。フラグＣ７へのＦＡＬＳＥ条件の反映(０書き込み)は無視される。
【００７１】
ｒｅｓｅｒｖｅｄ：予約ビットを示す。常に０が読み出される。書き込む時は０を書き込む必要がある。
【００７２】
図１３は、アキュームレータ（Ｍ０，Ｍ１）３０ｂの構造を示す図である。このアキュームレータ（Ｍ０，Ｍ１）３０ｂは、実行対象となっているタスクのコンテキストの一部を構成し、図１３（ａ）に示される３２ビットレジスタMH0-MH1（乗除算・積和用レジスタ(上位３２ビット)）と、図１３（ｂ）に示される３２ビットレジスタML0-ML1乗除算・積和用レジスタ(下位３２ビット)とからなる。
【００７３】
レジスタMH0-MHは、乗算命令では結果の上位３２ビットを格納するのに使用される。積和命令ではアキュムレータの上位３２ビットとして使用される。また、ビットストリームを取り扱う場合に汎用レジスタと組み合わせて使用することができる。レジスタML0-ML1は、乗算命令では結果の下位３２ビットを格納するのに使用される。積和命令ではアキュムレータの下位３２ビットとして使用される。
【００７４】
図１４は、プログラムカウンタ（ＰＣ）３３の構造を示す図である。このプログラムカウンタ（ＰＣ）３３は、実行対象となっているタスクのコンテキストの一部を構成し、実行中の命令のアドレスを保持する３２ビットのカウンタである。下位１ビットは常に０が格納される。
【００７５】
図１５は、ＰＣ退避用レジスタ（ＩＰＣ）３４の構造を示す図である。このＰＣ退避用レジスタ（ＩＰＣ）３４は、実行対象となっているタスクのコンテキストの一部を構成する３２ビットのレジスタであり、下位１ビットは常に０が読み出されるが、書き込み時には０を書き込む必要がある。
【００７６】
図１６は、ＰＳＲ退避用レジスタ（ＩＰＳＲ）３５の構造を示す図である。このＰＳＲ退避用レジスタ（ＩＰＳＲ）３５は、実行対象となっているタスクのコンテキストの一部を構成し、プログラム状態レジスタ（ＰＳＲ）３１を退避するための３２ビットのレジスタであり、プログラム状態レジスタ（ＰＳＲ）３１の予約ビットに対応する部分は常に０が読み出されるが、書き込み時には０を書き込む必要がある。
【００７７】
次に、本プロセッサ１のメモリ空間について説明する。本プロセッサ１では、４ＧＢのリニアなメモリ空間を３２分割し、１２８ＭＢ単位の空間に命令ＳＲＡＭ（Static RAM）とデータＳＲＡＭが割り当てられる。この１２８ＭＢの空間を１ブロックとして、ＳＡＲ(ＳＲＡＭ Area Register)にアクセスしたいブロックを設定する。アクセスされたアドレスがＳＡＲで設定された空間である場合は、直接命令ＳＲＡＭ/データＳＲＡＭに対してアクセスを行うが、ＳＡＲで設定された空間でない場合は、バスコントローラ（ＢＣＵ）に対してアクセス要求を出する。ＢＣＵにはオン・チップ・メモリ（ＯＣＭ）、外部メモリ、外部デバイス、Ｉ／Ｏポート等が接続されており、それらのデバイスに対して読み書きを行うことができる。
【００７８】
図１７は、本プロセッサ１のパイプライン動作を示すタイミング図である。本プロセッサ１は、本図に示されるように、基本的に命令フェッチ、命令割り当て(ディスパッチ)、デコード、実行、書き込みの５段パイプラインで構成されている。
【００７９】
図１８は、本プロセッサ１による命令実行時の各パイプライン動作を示すタイミング図である。命令フェッチステージでは、プログラムカウンタ（ＰＣ）３３で指定されるアドレスの命令メモリをアクセスし、命令を命令バッファ１０ｃ〜１０ｅ等に転送する。命令割り当てステージでは、分岐系命令に対する分岐先アドレス情報の出力、入力レジスタ制御信号の出力、可変長命令の割り当てを行い、命令をインストラクションレジスタ（ＩＲ）に転送する。デコードステージでは、ＩＲをデコード部２０に入力し、演算器制御信号、メモリアクセス信号を出力する。実行ステージでは、演算を実行、演算結果をデータメモリか汎用レジスタ（Ｒ０〜Ｒ３１）３０ａに出力する。書き込みステージでは、データ転送、演算結果を汎用レジスタに格納する。
【００８０】
本プロセッサ１は、ＶＬＩＷアーキテクチャにより上記の処理を最高３並列で行うことができる。したがって、図１８に示された動作については、本プロセッサ１は、図１９に示されるタイミングで並列に実行する。
【００８１】
次に、以上のように構成された本プロセッサ１の命令セットについて説明する。
以下の表３〜表５は、本プロセッサ１が実行する命令をカテゴリー別に分類した表である。
【００８２】
【表３】
2006338684.tif 000005
【００８３】
【表４】
2006338684.tif 000006
【００８４】
【表５】
2006338684.tif 000007
【００８５】
なお、表中の「演算器」は、その命令が使用する演算器を示す。演算器の略号の意味は次の通りである。つまり、「Ａ」はＡＬＵ命令、「Ｂ」は分岐命令、「Ｃ」は変換命令、「ＤＩＶ」は除算命令、「ＤＢＧＭ」はデバッグ命令、「Ｍ」はメモリアクセス命令、「Ｓ１」、「Ｓ２」はシフト命令、「Ｘ１」、「Ｘ２」は乗算命令を意味する。
【００８６】
図２０は、本プロセッサ１が実行する命令のフォーマットを示す図である。そのフォーマットには、図２０（ａ）に示される１６ビット命令フォーマットと、図２０（ｂ）に示される３２ビット命令フォーマットとがある。
【００８７】
なお、図中における略号の意味は次の通りである。つまり、「Ｅ」はエンドビット（並列実行の境界）、「Ｆ」はフォーマットビット（００、０１、１０：１６ビット命令フォーマット、１１：３２ビット命令フォーマット）、「Ｐ」はプレディケート（実行条件：８個の条件フラグＣ０〜Ｃ７のいずれかを指定）、「ＯＰ」はオペコードフィールド、「Ｒ」はレジスタフィールド、「Ｉ」は即値フィールド、「Ｄ」ディスプースメントフィールドを意味する。なお、「Ｅ」フィールドはＶＬＩＷに特有のもので、Ｅ＝０の命令は次の命令と並列に実行される。つまり、「Ｅ」フィールドによって並列度が可変のＶＬＩＷを実現している。
【００８８】
図２１〜図３６は、本プロセッサ１が実行する命令の概略的な機能を説明する図である。つまり、図２１は、カテゴリー「ALUadd（加算）系」に属する命令を説明する図であり、図２２は、カテゴリー「ALUsub（減算）系」に属する命令を説明する図であり、図２３は、カテゴリー「ALUlogic（論理演算）系ほか」に属する命令を説明する図であり、図２４は、カテゴリー「CMP（比較演算）系」に属する命令を説明する図であり、図２５は、カテゴリー「mul（乗算）系」に属する命令を説明する図であり、図２６は、カテゴリー「mac（積和演算）系」に属する命令を説明する図であり、図２７は、カテゴリー「msu（積差演算）系」に属する命令を説明する図であり、図２８は、カテゴリー「MEMｌd（メモリ読み出し）系」に属する命令を説明する図であり、図２９は、カテゴリー「MEMstore（メモリ書き出し）系」に属する命令を説明する図であり、図３０は、カテゴリー「BRA（分岐）系」に属する命令を説明する図であり、図３１は、カテゴリー「BSasl（算術バレルシフト）系ほか」に属する命令を説明する図であり、図３２は、カテゴリー「BSlsr（論理バレルシフト）系ほか」に属する命令を説明する図であり、図３３は、カテゴリー「CNVvaln（算術変換）系」に属する命令を説明する図であり、図３４は、カテゴリー「CNV（一般変換）系」に属する命令を説明する図であり、図３５は、カテゴリー「SATvlpk（飽和処理）系」に属する命令を説明する図であり、図３６は、カテゴリー「ETC（その他）系」に属する命令を説明する図である。
【００８９】
これらの図において、項目「ＳＩＭＤ」は、その命令の型（ＳＩＳＤ（SINGLE）かＳＩＭＤかの区別）を示し、項目「サイズ」は、演算の対象となる個々のオペランドのサイズを示し、項目「命令」は、その命令のオペコードを示し、項目「オペランド」は、その命令のオペランドを示し、項目「ＣＦＲ」は、条件フラグレジスタの変化を示し、項目「ＰＳＲ」は、プロセッサ状態レジスタの変化を示し、項目「代表的な動作」は、動作の概要を示し、項目「演算器」は、使用される演算器を示し、項目「３１１６」は、命令のサイズを示す。
【００９０】
図３７〜図７４８は、本プロセッサ１が実行する命令の詳細な機能を説明する図である。なお、命令の説明に用いられている各種記号の意味は、以下の表６〜表１０の通りである。
【００９１】
【表６】
2006338684.tif 000008
【００９２】
【表７】
2006338684.tif 000009
【００９３】
【表８】
2006338684.tif 000010
【００９４】
【表９】
2006338684.tif 000011
【００９５】
【表１０】
2006338684.tif 000012
【００９６】
図３７〜図１１９は、「load」関連の命令を説明する図である。
図１２０〜図１８４は、「store」関連の命令を説明する図である。
図１８５〜図１８６は、「memory(etc)」関連の命令を説明する図である。
図１８７〜図２０６は、「external register」関連の命令を説明する図である。
図２０７〜図２４７は、「branch」関連の命令を説明する図である。
図２４８〜図２６４は、「VMP/interupt」関連の命令を説明する図である。
図２６５〜図２５８は、「program interrupt」関連の命令を説明する図である。
図２５９〜図３０３は、「arithmetic」関連の命令を説明する図である。
図３０４〜図３１７は、「logic」関連の命令を説明する図である。
図３１８〜図３５９は、「compare」関連の命令を説明する図である。
図３６０〜図４２０は、「move」関連の命令を説明する図である。
図４２１は、「nop」関連の命令を説明する図である。
図４２２〜図４４１は、「shift(S1)」関連の命令を説明する図である。
図４４２〜図４６０は、「shift(S2)」関連の命令を説明する図である。
図４６１〜図３８０は、「extract」関連の命令を説明する図である。
図４７１〜図４７４は、「mask」関連の命令を説明する図である。
図４７５〜図４８０は、「saturation」関連の命令を説明する図である。
図４８１〜図５１２は、「conversion」関連の命令を説明する図である。
図５１３〜図５１６は、「bit count」関連の命令を説明する図である。
図５１７〜図５２０は、「etc」関連の命令を説明する図である。
図５２１〜図５２６は、「mul(X1)」関連の命令を説明する図である。
図５２７〜図５３１は、「mul(X2)」関連の命令を説明する図である。
図５３２〜図５４３は、「mac(X1)」関連の命令を説明する図である。
図５４４〜図５４７は、「mac(X2)」関連の命令を説明する図である。
図５４８〜図５５９は、「msu(X1)」関連の命令を説明する図である。
図５６０〜図５６３は、「msu(X2)」関連の命令を説明する図である。
図５６４〜図５６５は、「divide」関連の命令を説明する図である。
図５６６〜図５６９は、「debug」関連の命令を説明する図である。
図５７０〜図６１５は、「SIMD arithmetic」関連の命令を説明する図である。
図６１６〜図６３９は、「SIMD compare」関連の命令を説明する図である。
図６４０〜図６６４は、「SIMD shift(S1)」関連の命令を説明する図である。
図６６５〜図６７５は、「SIMD shift(S2)」関連の命令を説明する図である。
図６７６〜図６８０は、「SIMD saturation」関連の命令を説明する図である。
図６８１〜図６８２は、「SIMD etc」関連の命令を説明する図である。
図６８３〜図６９９は、「SIMD mul(X2)」関連の命令を説明する図である。
図７００〜図７２８は、「SIMD mac(X2)」関連の命令を説明する図である。
図７２９〜図７４８は、「SIMD msu(X2)」関連の命令を説明する図である。
【００９７】
次に、いくつかの特徴的な命令について、本プロセッサ１の動作を説明する。
【００９８】
（１）ＳＩＭＤ２項演算を、オペランドをクロスして行う命令
まず、２並列ＳＩＭＤ演算のうち、クロスの位置関係にあるオペランドを対象として演算を行う命令について説明する。
【００９９】
［命令ｖｘａｄｄｈ］
命令ｖｘａｄｄｈは、ハーフワード（１６ビット）単位で、クロスの位置関係にある２組のオペランドを加算するＳＩＭＤ型の命令である。例えば、
ｖｘａｄｄｈ  Ｒｃ，Ｒａ，Ｒｂ
であれば、プロセッサ１は、算術論理・比較演算器４１等により、
（i）レジスタＲａの上位１６ビットとレジスタＲｂの下位１６ビットとを加算し、結果をレジスタＲｃの上位１６ビットに格納し、それと並行して、
（ii）レジスタＲａの下位１６ビットとレジスタＲｂの上位１６ビットとを加算し、結果をレジスタＲｃの下位１６ビットに格納する。
【０１００】
このような命令は、対称型フィルタ（中心から左右対称の係数）で乗算を減らすために、予め同じ係数が乗算される値同士を加算（又は、減算）しておく場合に有効である。
【０１０１】
なお、本プロセッサ１は、減算命令（ｖｘｓｕｂｈ等）についても、この加算命令と同様の処理を実行する。
【０１０２】
［命令ｖｘｍｕｌ］
命令ｖｘｍｕｌは、ハーフワード（１６ビット）単位で、クロスの位置関係にある２組のオペランドを乗算し、それらの結果の下位ハーフワードそれぞれを残す（ＳＩＭＤ格納する）ＳＩＭＤ型の命令である。例えば、
ｖｘｍｕｌ  Ｒｃ，Ｒａ，Ｒｂ
であれば、プロセッサ１は、乗算・積和演算器４４等により、
（i）レジスタＲａの上位１６ビットとレジスタＲｂの下位１６ビットとを乗算し、その乗算結果を演算レジスタＭＨｍの上位１６ビットと演算レジスタＭＬｍの上位１６ビットに格納するとともに、その乗算結果の下位１６ビットをレジスタＲｃの上位１６ビットに格納し、それと並行して、
（ii）レジスタＲａの下位１６ビットとレジスタＲｂの上位１６ビットとを乗算し、その乗算結果を演算レジスタＭＨｍの下位１６ビットと演算レジスタＭＬｍの下位１６ビットに格納するとともに、その乗算結果の下位１６ビットをレジスタＲｃの下位１６ビットに格納する。
【０１０３】
このような命令は、複素数の内積に有効である。結果の下位を取り出すのは整数データを扱う場合に有効である（主に画像）。
【０１０４】
［命令ｖｘｆｍｕｌｈ］
命令ｖｘｍｕｌｈは、ハーフワード（１６ビット）単位で、クロスの位置関係にある２組のオペランドを乗算し、それらの結果の上位ハーフワードそれぞれを残す（ＳＩＭＤ格納する）ＳＩＭＤ型の命令である。例えば、
ｖｘｆｍｕｌｈ  Ｒｃ，Ｒａ，Ｒｂ
であれば、プロセッサ１は、乗算・積和演算器４４等により、
（i）レジスタＲａの上位１６ビットとレジスタＲｂの下位１６ビットとを乗算し、その乗算結果を演算レジスタＭＨｍの上位１６ビットと演算レジスタＭＬｍの上位１６ビットに格納するとともに、その乗算結果の上位１６ビットをレジスタＲｃの上位１６ビットに格納し、それと並行して、
（ii）レジスタＲａの下位１６ビットとレジスタＲｂの上位１６ビットとを乗算し、その乗算結果を演算レジスタＭＨｍの下位１６ビットと演算レジスタＭＬｍの下位１６ビットに格納するとともに、その乗算結果の上位１６ビットをレジスタＲｃの下位１６ビットに格納する。
【０１０５】
このような命令は、複素数の内積に有効である。結果の上位を取り出すのは固定小数点データを扱う場合に有効である。Ｑ３１／Ｑ１５と呼ばれる標準的なファーマット（ＭＳＢ詰め）に適用することができる。
【０１０６】
［命令ｖｘｆｍｕｌｗ］
命令ｖｘｆｍｕｌｗは、ハーフワード（１６ビット）単位で、クロスの位置関係にある２組のオペランドを乗算し、一方の乗算結果のみ残す（非ＳＩＭＤ格納する）ＳＩＭＤ型の命令である。例えば、
ｖｘｆｍｕｌｈ  Ｒｃ，Ｒａ，Ｒｂ
であれば、プロセッサ１は、乗算・積和演算器４４等により、
（i）レジスタＲａの上位１６ビットとレジスタＲｂの下位１６ビットとを乗算し、その乗算結果を演算レジスタＭＨｍの上位１６ビットと演算レジスタＭＬｍの上位１６ビットに格納するとともに、その乗算結果（ワード）をレジスタＲｃに格納し、それと並行して、
（ii）レジスタＲａの下位１６ビットとレジスタＲｂの上位１６ビットとを乗算し、その乗算結果を演算レジスタＭＨｍの下位１６ビットと演算レジスタＭＬｍの下位１６ビットに格納する（レジスタＲｃには格納しない）。
【０１０７】
このような命令は、精度が１６ビットで足りなくなりＳＩＭＤが維持できなくなる場合に有効である（オーディオなど）。
【０１０８】
［命令ｖｘｍａｃ］
命令ｖｘｍａｃは、ハーフワード（１６ビット）単位で、クロスの位置関係にある２組のオペランドの積和演算を行い、それらの結果の下位ハーフワードそれぞれを残す（ＳＩＭＤ格納する）ＳＩＭＤ型の命令である。例えば、
ｖｘｍａｃ  Ｍｍ，Ｒｃ，Ｒａ，Ｒｂ，Ｍｎ
であれば、プロセッサ１は、乗算・積和演算器４４等により、
（i）レジスタＲａの上位１６ビットとレジスタＲｂの下位１６ビットとを乗算し、その乗算結果と演算レジスタＭＨｎ及びＭＬｎの上位１６ビットからなる３２ビットとを加算し、その加算結果の３２ビットを演算レジスタＭＨｍ及びＭＬｍの上位１６ビットからなる３２ビット領域に格納するとともに、その加算結果の下位１６ビットをレジスタＲｃの上位１６ビットに格納し、それと並行して、
（ii）レジスタＲａの下位１６ビットとレジスタＲｂの上位１６ビットとを乗算し、その乗算結果と演算レジスタＭＨｎ及びＭＬｎの下位１６ビットからなる３２ビットとを加算し、その加算結果の３２ビットを演算レジスタＭＨｍ及びＭＬｍの下位１６ビットからなる３２ビット領域に格納するとともに、その加算結果の下位１６ビットをレジスタＲｃの下位１６ビットに格納する。
【０１０９】
このような命令は、複素数の内積に有効である。結果の下位を取り出すのは整数データを扱う場合に有効である（主に画像）。
【０１１０】
［命令ｖｘｆｍａｃｈ］
命令ｖｘｍａｃは、ハーフワード（１６ビット）単位で、クロスの位置関係にある２組のオペランドの積和演算を行い、それらの結果の上位ハーフワードそれぞれを残す（ＳＩＭＤ格納する）ＳＩＭＤ型の命令である。例えば、
ｖｘｆｍａｃｈ  Ｍｍ，Ｒｃ，Ｒａ，Ｒｂ，Ｍｎ
であれば、プロセッサ１は、乗算・積和演算器４４等により、
（i）レジスタＲａの上位１６ビットとレジスタＲｂの下位１６ビットとを乗算し、その乗算結果と演算レジスタＭＨｎ及びＭＬｎの上位１６ビットからなる３２ビットとを加算し、その加算結果の３２ビットを演算レジスタＭＨｍ及びＭＬｍの上位１６ビットからなる３２ビット領域に格納するとともに、その加算結果の上位１６ビットをレジスタＲｃの上位１６ビットに格納し、それと並行して、
（ii）レジスタＲａの下位１６ビットとレジスタＲｂの上位１６ビットとを乗算し、その乗算結果と演算レジスタＭＨｎ及びＭＬｎの下位１６ビットからなる３２ビットとを加算し、その加算結果の３２ビットを演算レジスタＭＨｍ及びＭＬｍの下位１６ビットからなる３２ビット領域に格納するとともに、その加算結果の上位１６ビットをレジスタＲｃの下位１６ビットに格納する。
【０１１１】
このような命令は、複素数の内積に有効である。結果の上位を取り出すのは固定小数点データを扱う場合に有効である。Ｑ３１／Ｑ１５と呼ばれる標準的なファーマット（ＭＳＢ詰め）に適用することができる。
【０１１２】
［命令ｖｘｆｍａｃｗ］
命令ｖｘｆｍａｃｈは、ハーフワード（１６ビット）単位で、クロスの位置関係にある２組のオペランドを乗算し、一方の乗算結果のみ残す（非ＳＩＭＤ格納する）ＳＩＭＤ型の命令である。例えば、
ｖｘｆｍａｃｈ  Ｍｍ，Ｒｃ，Ｒａ，Ｒｂ，Ｍｎ
であれば、プロセッサ１は、乗算・積和演算器４４等により、
（i）レジスタＲａの上位１６ビットとレジスタＲｂの下位１６ビットとを乗算し、その乗算結果と演算レジスタＭＨｎ及びＭＬｎの上位１６ビットからなる３２ビットとを加算し、その加算結果の３２ビットを演算レジスタＭＨｍ及びＭＬｍの上位１６ビットからなる３２ビット領域に格納するとともに、その加算結果の３２ビットをレジスタＲｃに格納し、それと並行して、
（ii）レジスタＲａの下位１６ビットとレジスタＲｂの上位１６ビットとを乗算し、その乗算結果と演算レジスタＭＨｎ及びＭＬｎの下位１６ビットからなる３２ビットとを加算し、その加算結果の３２ビットを演算レジスタＭＨｍ及びＭＬｍの下位１６ビットからなる３２ビット領域に格納する（レジスタＲｃには格納しない）。
【０１１３】
このような命令は、精度が１６ビットで足りなくなりＳＩＭＤが維持できなくなる場合に有効である（オーディオなど）。
【０１１４】
なお、本プロセッサ１は、積差命令（ｖｘｍｓｕ、ｖｘｍｓｕｈ、ｖｘｍｓｕｗ等）についても、これらの積和命令と同様の処理を実行する。
【０１１５】
また、本プロセッサ１は、以上のようなクロスの位置関係にある２組のオペランドに対する演算（２並列ＳＩＭＤによる加算、減算、乗算、積和、積差）だけでなく、これを拡張したｎ組のオペランドに対する演算（４並列、８並列ＳＩＭＤ演算など）を実行する機能を備えてもよい。
【０１１６】
例えば、いま、レジスタＲａに格納されている４つのバイトデータを上位からＲａ１、Ｒａ２，Ｒａ３，Ｒａ４とし、レジスタＲｂに格納されている４つのバイトデータを上位からＲｂ１、Ｒｂ２，Ｒｂ３，Ｒｂ４とした場合に、レジスタＲａとレジスタＲｂとをオペランドとするＳＩＭＤ演算命令であって、以下のようなクロスの位置関係にあるバイトデータに対する演算を並列に実行する命令を備えてもよい。つまり、
（i）１対称クロスの命令
Ｒａ１とＲｂ４、Ｒａ２とＲｂ３、Ｒａ３とＲｂ２、Ｒａ４とＲｂ１、それぞれを演算対象とする４並列ＳＩＭＤ型の演算命令を備えてもよい。
（ii）２対称クロスの命令
Ｒａ１とＲｂ２、Ｒａ２とＲｂ１、Ｒａ３とＲｂ４、Ｒａ４とＲｂ３、それぞれを演算対象とする４並列ＳＩＭＤ型の演算命令を備えてもよい。
（iii）２重クロスの命令
Ｒａ１とＲｂ３、Ｒａ２とＲｂ４、Ｒａ３とＲｂ１、Ｒａ４とＲｂ２、それぞれを演算対象とする４並列ＳＩＭＤ型の演算命令を備えてもよい。
【０１１７】
そして、これらの４並列ＳＩＭＤ型の演算の種類は、上記２並列ＳＩＭＤ型の演算と同様に、加算、減算、乗算、積和、積差のいずれについても適用することができる。さらに、乗算、積和、積差については、上記２並列ＳＩＭＤ型の演算命令（ｖｘｍｕｌ，ｖｘｆｍｕｌｈ，ｖｘｆｍｕｌｗなど）と同様に、４つの演算結果それぞれの下位バイトだけをレジスタＲｃ等にＳＩＭＤ格納したり、４つの演算結果それぞれの上位バイトだけをレジスタＲｃ等にＳＩＭＤ格納したり、４つの演算結果のうちの２つだけをレジスタＲｃ等にＳＩＭＤ格納したりする命令を備えてもよい。
【０１１８】
なお、上記のようなクロスの位置関係にあるデータに対する３種類の演算は、一般化すると以下のように表現することができる。つまり、いま、演算の対象となるデータの組が、第１データ群を構成するｎ個のデータの並びにおける第ｉ番目のデータと第２データ群を構成するｎ個のデータの並びにおける第ｊ番目のデータとすると、
上記（i）１対称クロスの命令では、ｊ＝ｎ−ｉ＋１  が成立し、
上記（ii）２対称クロスの命令では、ｊ＝ｉ−（−１）＾（ｉ  ｍｏｄ  ２）  が成立し、
上記（iii）２重クロスの命令では、ｊ＝ｎ−ｉ＋１＋（−１）＾（ｉ  ｍｏｄ  ２）  が成立する。ここで、「＾」はべき乗を意味し、「ｍｏｄ」は剰余を意味する。
【０１１９】
以上のような命令は、複素数の内積等、２個の複素数を同時に演算する場合に有効である。
【０１２０】
（２）ＳＩＭＤ２項演算を、一方のオペランドを固定して行う命令
次に、２並列ＳＩＭＤ演算のうち、一方のオペランドを固定して行う（一方のオペランドを共通とする）演算命令について説明する。
【０１２１】
［命令ｖｈａｄｄｈ］
命令ｖｈａｄｄｈは、ハーフワード（１６ビット）単位で、一方のオペランド（レジスタ中の上位１６ビット）を共通とする２組のオペランドを加算するＳＩＭＤ型の命令である。例えば、
ｖｈａｄｄｈ  Ｒｃ，Ｒａ，Ｒｂ
であれば、プロセッサ１は、算術論理・比較演算器４１等により、
（i）レジスタＲａの上位１６ビットとレジスタＲｂの上位１６ビットとを加算し、結果をレジスタＲｃの上位１６ビットに格納し、それと並行して、
（ii）レジスタＲａの下位１６ビットとレジスタＲｂの上位１６ビットとを加算し、結果をレジスタＲｃの下位１６ビットに格納する。
【０１２２】
このような命令は、２つの配列の要素間の加減算で２つの配列のアライメントがずれておりＳＩＭＤ適用が困難な場合に有効である。
【０１２３】
なお、本プロセッサ１は、減算命令（ｖｈｓｕｂｈ等）についても、この加算命令と同様の処理を実行する。
【０１２４】
［命令ｖｈｍｕｌ］
命令ｖｈｍｕｌは、ハーフワード（１６ビット）単位で、一方のオペランド（レジスタ中の上位１６ビット）を共通とする２組のオペランドを乗算し、それらの結果の下位ハーフワードそれぞれを残す（ＳＩＭＤ格納する）ＳＩＭＤ型の命令である。例えば、
ｖｈｍｕｌ  Ｒｃ，Ｒａ，Ｒｂ
であれば、プロセッサ１は、乗算・積和演算器４４等により、
（i）レジスタＲａの上位１６ビットとレジスタＲｂの上位１６ビットとを乗算し、その乗算結果を演算レジスタＭＨｍの上位１６ビットと演算レジスタＭＬｍの上位１６ビットに格納するとともに、その乗算結果の下位１６ビットをレジスタＲｃの上位１６ビットに格納し、それと並行して、
（ii）レジスタＲａの下位１６ビットとレジスタＲｂの上位１６ビットとを乗算し、その乗算結果を演算レジスタＭＨｍの下位１６ビットと演算レジスタＭＬｍの下位１６ビットに格納するとともに、その乗算結果の下位１６ビットをレジスタＲｃの下位１６ビットに格納する。
【０１２５】
このような命令は、ゲインコントロールなど全要素に係数を乗ずる場合、ループをイタレーションで展開し、ＳＩＭＤで並列処理するとき、要素がずれてＳＩＭＤ適用が困難な場合に有効である。基本的には、下記の下位固定の命令とペア（交互）で使用する。結果の下位を取り出すのは整数データを扱う場合に有効である（主に、画像）。
【０１２６】
［命令ｖｈｆｍｕｌｈ］
命令ｖｈｍｕｌｈは、ハーフワード（１６ビット）単位で、一方のオペランド（レジスタ中の上位１６ビット）を共通とする２組のオペランドを乗算し、それらの結果の上位ハーフワードそれぞれを残す（ＳＩＭＤ格納する）ＳＩＭＤ型の命令である。例えば、
ｖｈｆｍｕｌｈ  Ｒｃ，Ｒａ，Ｒｂ
であれば、プロセッサ１は、乗算・積和演算器４４等により、
（i）レジスタＲａの上位１６ビットとレジスタＲｂの上位１６ビットとを乗算し、その乗算結果を演算レジスタＭＨｍの上位１６ビットと演算レジスタＭＬｍの上位１６ビットに格納するとともに、その乗算結果の上位１６ビットをレジスタＲｃの上位１６ビットに格納し、それと並行して、
（ii）レジスタＲａの下位１６ビットとレジスタＲｂの上位１６ビットとを乗算し、その乗算結果を演算レジスタＭＨｍの下位１６ビットと演算レジスタＭＬｍの下位１６ビットに格納するとともに、その乗算結果の上位１６ビットをレジスタＲｃの下位１６ビットに格納する。
【０１２７】
このような命令は、上記と同様に有効である。結果の上位を取り出すのは固定小数点データを扱う場合に有効である。Ｑ３１／Ｑ１５と呼ばれる標準的なファーマット（ＭＳＢ詰め）に適用することができる。
【０１２８】
［命令ｖｈｆｍｕｌｗ］
命令ｖｈｆｍｕｌｗは、ハーフワード（１６ビット）単位で、一方のオペランド（レジスタ中の上位１６ビット）を共通とする２組のオペランドを乗算し、一方の乗算結果のみ残す（非ＳＩＭＤ格納する）ＳＩＭＤ型の命令である。例えば、
ｖｈｆｍｕｌｈ  Ｒｃ，Ｒａ，Ｒｂ
であれば、プロセッサ１は、乗算・積和演算器４４等により、
（i）レジスタＲａの上位１６ビットとレジスタＲｂの上位１６ビットとを乗算し、その乗算結果を演算レジスタＭＨｍの上位１６ビットと演算レジスタＭＬｍの上位１６ビットに格納するとともに、その乗算結果（ワード）をレジスタＲｃに格納し、それと並行して、
（ii）レジスタＲａの下位１６ビットとレジスタＲｂの上位１６ビットとを乗算し、その乗算結果を演算レジスタＭＨｍの下位１６ビットと演算レジスタＭＬｍの下位１６ビットに格納する（レジスタＲｃには格納しない）。
【０１２９】
このような命令は精度確保に有効である。
【０１３０】
［命令ｖｈｍａｃ］
命令ｖｈｍａｃは、ハーフワード（１６ビット）単位で、一方のオペランド（レジスタ中の上位１６ビット）を共通とする２組のオペランドの積和演算を行い、それらの結果の下位ハーフワードそれぞれを残す（ＳＩＭＤ格納する）ＳＩＭＤ型の命令である。例えば、
ｖｈｍａｃ  Ｍｍ，Ｒｃ，Ｒａ，Ｒｂ，Ｍｎ
であれば、プロセッサ１は、乗算・積和演算器４４等により、
（i）レジスタＲａの上位１６ビットとレジスタＲｂの上位１６ビットとを乗算し、その乗算結果と演算レジスタＭＨｎ及びＭＬｎの上位１６ビットからなる３２ビットとを加算し、その加算結果の３２ビットを演算レジスタＭＨｍ及びＭＬｍの上位１６ビットからなる３２ビット領域に格納するとともに、その加算結果の下位１６ビットをレジスタＲｃの上位１６ビットに格納し、それと並行して、
（ii）レジスタＲａの下位１６ビットとレジスタＲｂの上位１６ビットとを乗算し、その乗算結果と演算レジスタＭＨｎ及びＭＬｎの下位１６ビットからなる３２ビットとを加算し、その加算結果の３２ビットを演算レジスタＭＨｍ及びＭＬｍの下位１６ビットからなる３２ビット領域に格納するとともに、その加算結果の下位１６ビットをレジスタＲｃの下位１６ビットに格納する。
【０１３１】
このような命令は、ＦＩＲ（フィルタ）などでループをイタレーションで展開し、ＳＩＭＤで並列処理するとき、要素がずれてＳＩＭＤ適用が困難な場合に有効である。基本的には、下記の下位固定の命令とペア（交互）で使用する。結果の下位を取り出すのは整数データを扱う場合に有効である（主に、画像）。
【０１３２】
［命令ｖｈｆｍａｃｈ］
命令ｖｈｍａｃは、ハーフワード（１６ビット）単位で、一方のオペランド（レジスタ中の上位１６ビット）を共通とする２組のオペランドの積和演算を行い、それらの結果の上位ハーフワードそれぞれを残す（ＳＩＭＤ格納する）ＳＩＭＤ型の命令である。例えば、
ｖｈｆｍａｃｈ  Ｍｍ，Ｒｃ，Ｒａ，Ｒｂ，Ｍｎ
であれば、プロセッサ１は、乗算・積和演算器４４等により、
（i）レジスタＲａの上位１６ビットとレジスタＲｂの上位１６ビットとを乗算し、その乗算結果と演算レジスタＭＨｎ及びＭＬｎの上位１６ビットからなる３２ビットとを加算し、その加算結果の３２ビットを演算レジスタＭＨｍ及びＭＬｍの上位１６ビットからなる３２ビット領域に格納するとともに、その加算結果の上位１６ビットをレジスタＲｃの上位１６ビットに格納し、それと並行して、
（ii）レジスタＲａの下位１６ビットとレジスタＲｂの上位１６ビットとを乗算し、その乗算結果と演算レジスタＭＨｎ及びＭＬｎの下位１６ビットからなる３２ビットとを加算し、その加算結果の３２ビットを演算レジスタＭＨｍ及びＭＬｍの下位１６ビットからなる３２ビット領域に格納するとともに、その加算結果の上位１６ビットをレジスタＲｃの下位１６ビットに格納する。
【０１３３】
このような命令は、上記と同様に有効である。結果の上位を取り出すのは固定小数点データを扱う場合に有効である。Ｑ３１／Ｑ１５と呼ばれる標準的なファーマット（ＭＳＢ詰め）に適用することができる。
【０１３４】
［命令ｖｈｆｍａｃｗ］
命令ｖｈｆｍａｃｈは、ハーフワード（１６ビット）単位で、一方のオペランド（レジスタ中の上位１６ビット）を共通とする２組のオペランドを乗算し、一方の乗算結果のみ残す（非ＳＩＭＤ格納する）ＳＩＭＤ型の命令である。例えば、
ｖｈｆｍａｃｈ  Ｍｍ，Ｒｃ，Ｒａ，Ｒｂ，Ｍｎ
であれば、プロセッサ１は、乗算・積和演算器４４等により、
（i）レジスタＲａの上位１６ビットとレジスタＲｂの上位１６ビットとを乗算し、その乗算結果と演算レジスタＭＨｎ及びＭＬｎの上位１６ビットからなる３２ビットとを加算し、その加算結果の３２ビットを演算レジスタＭＨｍ及びＭＬｍの上位１６ビットからなる３２ビット領域に格納するとともに、その加算結果の３２ビットをレジスタＲｃに格納し、それと並行して、
（ii）レジスタＲａの下位１６ビットとレジスタＲｂの上位１６ビットとを乗算し、その乗算結果と演算レジスタＭＨｎ及びＭＬｎの下位１６ビットからなる３２ビットとを加算し、その加算結果の３２ビットを演算レジスタＭＨｍ及びＭＬｍの下位１６ビットからなる３２ビット領域に格納する（レジスタＲｃには格納しない）。
【０１３５】
このような命令は、精度確保に有効である。
なお、本プロセッサ１は、積差命令（ｖｈｍｓｕ、ｖｈｍｓｕｈ、ｖｈｍｓｕｗ等）についても、これらの積和命令と同様の処理を実行する。
【０１３６】
また、これらの命令では、レジスタ中の上位１６ビットが固定（共通化）されたが、レジスタ中の下位１６ビットを固定（共通化）する命令（ｖｌａｄｄｈ、ｖｌｓｕｂｈ、ｖｌｍｕｌ、ｖｌｆｍｕｌｈ、ｖｌｆｍｕｌｗ、ｖｌｍａｃ、ｖｌｍｓｕ、ｖｌｆｍａｃｈ、ｖｌｍｓｕｈ、ｖｌｆｍａｃｗ、ｖｌｍｓｕｗ等）についても、本プロセッサ１は、これらの演算命令と同様の処理を実行する。このような命令は、上記の上位固定の命令とペアで使用すると有効である。
【０１３７】
また、本プロセッサ１は、以上のような一方のオペランド（レジスタ中の上位１６ビット）を共通とする２組のオペランドに対する演算（２並列ＳＩＭＤによる加算、減算、乗算、積和、積差）だけでなく、これを拡張したｎ組のオペランドに対する演算（４並列、８並列ＳＩＭＤ演算など）を実行する機能を備えてもよい。
【０１３８】
例えば、いま、レジスタＲａに格納されている４つのバイトデータを上位からＲａ１、Ｒａ２，Ｒａ３，Ｒａ４とし、レジスタＲｂに格納されている４つのバイトデータを上位からＲｂ１、Ｒｂ２，Ｒｂ３，Ｒｂ４とした場合に、レジスタＲａとレジスタＲｂとをオペランドとするＳＩＭＤ演算命令であって、以下のような一方のオペランド（レジスタ中の１バイト）を共通とするバイトデータに対する演算を並列に実行する命令を備えてもよい。つまり、
（i）最上位固定の命令
Ｒａ１とＲｂ１、Ｒａ２とＲｂ１、Ｒａ３とＲｂ１、Ｒａ４とＲｂ１、それぞれを演算対象とする４並列ＳＩＭＤ型の演算命令を備えてもよい。
（i）中上位固定の命令
Ｒａ１とＲｂ２、Ｒａ２とＲｂ２、Ｒａ３とＲｂ２、Ｒａ４とＲｂ２、それぞれを演算対象とする４並列ＳＩＭＤ型の演算命令を備えてもよい。
（i）中下位位固定の命令
Ｒａ１とＲｂ３、Ｒａ２とＲｂ３、Ｒａ３とＲｂ３、Ｒａ４とＲｂ３、それぞれを演算対象とする４並列ＳＩＭＤ型の演算命令を備えてもよい。
（i）最下位固定の命令
Ｒａ１とＲｂ４、Ｒａ２とＲｂ４、Ｒａ３とＲｂ４、Ｒａ４とＲｂ４、それぞれを演算対象とする４並列ＳＩＭＤ型の演算命令を備えてもよい。
【０１３９】
そして、これらの４並列ＳＩＭＤ型の演算の種類は、上記２並列ＳＩＭＤ型の演算と同様に、加算、減算、乗算、積和、積差のいずれについても適用することができる。さらに、乗算、積和、積差については、上記２並列ＳＩＭＤ型の演算命令（ｖｈｍｕｌ，ｖｈｆｍｕｌｈ，ｖｈｆｍｕｌｗなど）と同様に、４つの演算結果それぞれの下位バイトだけをレジスタＲｃ等にＳＩＭＤ格納したり、４つの演算結果それぞれの上位バイトだけをレジスタＲｃ等にＳＩＭＤ格納したり、４つの演算結果のうちの２つだけをレジスタＲｃ等にＳＩＭＤ格納したりする命令を備えてもよい。このような命令は、以下のようなケースに有効である。つまり、２つの要素を１要素ずつずらしながら要素ごとの演算をする場合に有効である。１個ずれ、２個ずれ、３個ずれの演算が必要となるからである。
【０１４０】
以上のようなオペランドの一方を固定した演算を一般化して表現すると、次のようになる。つまり、本プロセッサ１は、ｎ（≧２）個のデータの並びからなる第１データ群を指定する第１オペランドとｎ個のデータの並びからなる第２データ群を指定する第２オペランドとを含むＳＩＭＤ型の命令に対して、ｉ＝１，２，…，ｎ、ｊ＝一定値とした場合における第１データ群の第ｉ番目データと第２データ群の第ｊ番目データとの組からなるｎ組それぞれに対して演算を行ってもよい。
【０１４１】
（３）ＳＩＭＤ２項演算を実行し、その結果をビットシフトする命令
次に、２並列ＳＩＭＤ演算のうち、クロスの位置関係にあるオペランドを対象として演算を行う命令について説明する。
【０１４２】
［命令ｖａｄｄｓｈ］
命令ｖａｄｄｓｈは、ハーフワード（１６ビット）単位で２組のオペランドを加算し、その結果を１ビットだけ算術右シフトするＳＩＭＤ型の命令である。例えば、
ｖａｄｄｓｈ  Ｒｃ，Ｒａ，Ｒｂ
であれば、プロセッサ１は、算術論理・比較演算器４１等により、
（i）レジスタＲａの上位１６ビットとレジスタＲｂの上位１６ビットとを加算し、結果を１ビットだけ算術右シフトした値をレジスタＲｃの上位１６ビットに格納し、それと並行して、
（ii）レジスタＲａの下位１６ビットとレジスタＲｂの下位１６ビットとを加算し、結果を結果を１ビットだけ算術右シフトした値をレジスタＲｃの下位１６ビットに格納する。
【０１４３】
このような命令は、加算により１６ビット精度におさまらなくなる前にシフトダウンして精度を確保するときに有効である。ケースによっては丸めが必要である。ＦＦＴ（バタフライ）では複素数同士の加減算が繰り返されるので多用される。
【０１４４】
なお、本プロセッサ１は、減算命令（ｖｓｕｂｓｈ等）についても、この加算命令と同様の処理を実行する。
【０１４５】
また、本プロセッサ１は、以上のような２組のオペランドに対する演算（２並列ＳＩＭＤによる加算、減算）だけでなく、これを拡張したｎ組のオペランドに対する演算（４並列、８並列ＳＩＭＤ演算など）を実行する機能を備えてもよい。
【０１４６】
例えば、いま、レジスタＲａに格納されている４つのバイトデータを上位からＲａ１、Ｒａ２，Ｒａ３，Ｒａ４とし、レジスタＲｂに格納されている４つのバイトデータを上位からＲｂ１、Ｒｂ２，Ｒｂ３，Ｒｂ４とした場合に、レジスタＲａとレジスタＲｂとをオペランドとするＳＩＭＤ演算命令であって、以下のような演算とビットシフトとを行う命令を備えてもよい。つまり、Ｒａ１とＲｂ１、Ｒａ２とＲｂ２、Ｒａ３とＲｂ３、Ｒａ４とＲｂ４、それぞれを演算対象とする４並列ＳＩＭＤ型の演算命令を備えてもよい。例えば、バイト単位で４組のオペランドを加算し、その結果を１ビットだけ算術右シフトする命令ｖａｄｄｓｂなどである。
【０１４７】
このような命令は、同様に精度確保に有効である。主に平均をとる場合に使用する（縦の平均）。
【０１４８】
また、このようなＳＩＭＤ演算とシフトとを行う特徴的な命令は、上記のような右方向に１ビットだけシフトさせる命令に限られない。つまり、そのシフト量は、固定及び可変のいずれであってもよいし、右方向及び左方向のいずれであってもよい。また、右シフト時にこぼれたビットを丸めるようにしてもよい（例えば、命令ｖａｄｄｓｒｈや命令ｖａｄｄｓｒｂなど）。
【０１４９】
（４）ＳＩＭＤ（ベクトル）データを塁加算してスカラ化又はベクトルの低次元化をする命令
【０１５０】
次に、ベクトルデータをスカラ化又はベクトルの低次元化をするＳＩＭＤ型の命令について説明する。
【０１５１】
［命令ｖｓｕｍｈ］
命令ｖｓｕｍｈは、ハーフワード（１６ビット）単位で、２つのＳＩＭＤデータ（ベクトルデータ）を加算し、スカラ化するＳＩＭＤ型の命令である。例えば、
ｖｓｕｍｈ  Ｒｂ，Ｒａ
であれば、プロセッサ１は、算術論理・比較演算器４１等により、レジスタＲａの上位１６ビットとレジスタＲａの下位１６ビットとを加算し、結果をレジスタＲｂに格納する。
【０１５２】
このような命令は、様々な用途に使うことができる。平均（横の平均）、個別に演算（積和、加算）した結果を足し合わせる等である。
【０１５３】
［命令ｖｓｕｍｈ２］
命令ｖｓｕｍｈ２は、バイト単位で、２つのＳＩＭＤデータ（ベクトルデータ）を組とする２組それぞれについて、要素を塁加算し、スカラ化するＳＩＭＤ型の命令である。例えば、
ｖｓｕｍｈ２  Ｒｂ，Ｒａ
であれば、プロセッサ１は、算術論理・比較演算器４１等により、
（i）レジスタＲａの最上位バイトと中上位バイトとを塁加算し、結果をレジスタＲｂの上位１６ビットに格納し、それと並行して、
（ii）レジスタＲａの中下位バイトと最下位バイトとを塁加算し、結果をレジスタＲｂの下位１６ビットに格納する。
【０１５４】
このような命令は、画像処理、動き補償（ＭＣ）、ハーフペル用命令として有効である。
【０１５５】
なお、本プロセッサ１は、以上のような２並列ＳＩＭＤデータをスカラ化する演算だけでなく、これを拡張したｎ（４、８など）個の要素からなるｎ並列ＳＩＭＤデータをスカラ化する演算を実行する機能を備えてもよい。
【０１５６】
例えば、いま、レジスタＲａに格納されている４つのバイトデータを上位からＲａ１、Ｒａ２，Ｒａ３，Ｒａ４とした場合に、それらＲａ１、Ｒａ２，Ｒａ３及びＲａ４を塁加算し、その結果をレジスタＲｂに格納する命令を備えてもよい。
【０１５７】
また、本プロセッサ１は、単に複数の要素データからなるベクトルを１つの要素データからなるスカラに変換するだけでなく、その要素データの個数を減少させるというベクトルの低次元化を行ってもよい。
【０１５８】
また、演算の種類は、加算だけに限られず、平均値を算出する演算であってもよい。このような命令は、平均、演算結果の足し合わせ等に有効である。
【０１５９】
（５）その他ＳＩＭＤに関する命令
次に、以上の分類に属さないその他のＳＩＭＤ型の命令について説明する。
【０１６０】
［命令ｖｅｘｔｈ］
命令ｖｅｘｔｈは、ハーフワード（１６ビット）単位で、２つのＳＩＭＤデータそれぞれを符号拡張するＳＩＭＤ型の命令である。例えば、
ｖｅｘｔｈ  Ｍｍ，Ｒｂ，Ｒａ
であれば、プロセッサ１は、変換器４７の飽和ブロック(SAT)４７ａ等により、
（i）レジスタＲａの上位１６ビットを３２ビットに符号拡張し、その結果を演算レジスタＭＨｍの上位１６ビットと演算レジスタＭＬｍの上位１６ビットに格納し、それと並行して、
（ii）レジスタＲａの下位１６ビットを３２ビットに符号拡張し、その結果を演算レジスタＭＨｍの下位１６ビットと演算レジスタＭＬｍの下位１６ビットに格納し、それと並行して、
（iii）レジスタＲａの３２ビットをレジスタＲｂに格納する。
【０１６１】
なお、符号拡張とは、符号情報を維持したままデータの長さを大きくすることをいい、例えば、ハーフワードで表現された符号付き数値をワードで表現された同じ数値に変換することである。具体的には、元のデータの符号ビット（最上位ビット）の値で拡張した上位ビットを埋め尽くす処理である。
【０１６２】
このような命令は、ＳＩＭＤデータのアキュムレータへの転送（精度が必要な場合）に有効である。
【０１６３】
［命令ｖａｓｕｂｂ］
命令ｖａｓｕｂｂは、バイト単位で、４組のＳＩＭＤデータそれぞれを減算し、その結果得られる４つの符号を条件フラグレジスタに格納するＳＩＭＤ型の命令である。例えば、
ｖａｓｕｂｂ  Ｒｃ，Ｒｂ，Ｒａ
であれば、プロセッサ１は、算術論理・比較演算器４１等により、
（i）レジスタＲｂの最上位８ビットからレジスタＲａの最上位８ビットを減算し、その結果をレジスタＲｃの最上位８ビットに格納するとともに、その符号を条件フラグレジスタ（ＣＦＲ）３２のＶＣ３に格納し、それと並行して、
（ii）レジスタＲｂの中上位８ビットからレジスタＲａの中上位８ビットを減算し、その結果をレジスタＲｃの中上位８ビットに格納するとともに、その符号を条件フラグレジスタ（ＣＦＲ）３２のＶＣ２に格納し、それと並行して、
（iii）レジスタＲｂの中下位８ビットからレジスタＲａの中下位８ビットを減算し、その結果をレジスタＲｃの中下位８ビットに格納するとともに、その符号を条件フラグレジスタ（ＣＦＲ）３２のＶＣ１に格納し、それと並行して、
（iv）レジスタＲｂの最下位８ビットからレジスタＲａの最下位８ビットを減算し、その結果をレジスタＲｃの最下位８ビットに格納するとともに、その符号を条件フラグレジスタ（ＣＦＲ）３２のＶＣ０に格納する。
【０１６４】
このような命令は、絶対値差分和を得ることに一時的に９ビット精度が必要とされる場合に有効である。
【０１６５】
［命令ｖａｂｓｓｕｍｂ］
命令ｖａｂｓｓｕｍｂは、バイト単位で、４組のＳＩＭＤデータそれぞれを絶対値加算し、その結果と他の４バイトデータとを加算するＳＩＭＤ型の命令である。例えば、
ｖａｂｓｓｕｍｂ  Ｒｃ，Ｒａ，Ｒｂ
であれば、プロセッサ１は、算術論理・比較演算器４１等により、レジスタＲａの最上位８ビットの絶対値と中上位８ビットの絶対値と中下位８ビットの絶対値と最下位８ビットの絶対値とを加算し、その結果とレジスタＲｂの３２ビットとを加算し、得られた結果をレジスタＲｃに格納する。なお、本プロセッサ１は、条件フラグレジスタ（ＣＦＲ）３２のフラグＶＣ０〜ＶＣ３によって、レジスタＲａに格納された各バイトの絶対値を特定する。
【０１６６】
このような命令は、上記命令ｖａｓｕｂｂと組み合わせて使用することにより、複数組のデータに対して、各組の差分を算出した後に、それぞれの差分の絶対値を合計した値が得られ、画像処理の動き予測の差分絶対値和を算出する場合等に有効である。
【０１６７】
（６）その他マスク演算等に関する命令
次に、ＳＩＭＤ型の命令ではないが、特徴的な処理を行う命令について説明する。
【０１６８】
［命令ａｄｄｍｓｋ］
命令ａｄｄｍｓｋは、２つのオペランドの一方の一部のビット（上位）をマスクして加算する命令である。例えば、
ａｄｄｍｓｋ  Ｒｃ，Ｒａ，Ｒｂ
であれば、プロセッサ１は、算術論理・比較演算器４１や変換器４７等により、条件フラグレジスタ（ＣＦＲ）３２のＢＰＯで指定された範囲（下位ビット）でのみレジスタＲａとレジスタＲｂに格納されたデータを加算してレジスタＲｃに格納するとともに、指定されていない範囲（上位ビット）についてはレジスタＲａの値をそのままレジスタＲｃに格納する。
【０１６９】
このような命令は、モジュロアドレッシング（ＤＳＰでは一般的）への対応として有効である。バタフライ演算の準備のため予め特定のパターンにデータを並べ替えるあめに必要である。
【０１７０】
なお、本プロセッサ１は、減算命令（ｓｕｂｍｓｋ等）についても、この加算命令と同様の処理を実行する。
【０１７１】
［命令ｍｓｋｂｒｖｈ］
命令ｍｓｋｂｒｖｈは、２つのオペランドの一方の一部のビット（下位）をリバース（ビットの並びを逆順に）した後に、他方のオペランドとビット連結する命令である。例えば、
ｍｓｋｂｒｖｈ  Ｒｃ，Ｒａ，Ｒｂ
であれば、プロセッサ１は、変換器４７等により、レジスタＲｂの下位１６ビットを逆順にした後に、条件フラグレジスタ（ＣＦＲ）３２のＢＰＯで指定されたビット位置で、レジスタＲａのデータとレジスタＲｂのデータとを連結し、結果をレジスタＲｃに格納する。このとき、レジスタＲｂの上位１６ビットのうち、ＢＰ０で指定された位置よりも下位部分が０にマスクされる。
【０１７２】
このような命令は、リバースアドレッシングに対応し、バタフライ演算の準備のために予め特定のパターンにデータを並べ替えるのに必要である。
【０１７３】
なお、本プロセッサ１は、１６ビットを逆順にするだけでなく、１バイト等の領域を逆順にする命令（ｍｓｋｂｒｖｂ等）についても、この命令と同様の処理を実行する。
【０１７４】
［命令ｍｓｋ］
命令ｍｓｋは、オペランドを構成するビットのうち、指定された２つのビット位置で挟まれた領域をマスク（０に）する、又は、その領域の外をマスクする命令である。例えば、
ｍｓｋ  Ｒｃ，Ｒａ，Ｒｂ
であれば、プロセッサ１は、変換器４７等により、
（i）Ｒｂ［１２：８］≧Ｒｂ［４：０］である場合には、
レジスタＲａに格納された３２ビットのうち、レジスタＲｂの第０〜４の５ビットＲｂ［４：０］で指定されるビット位置からレジスタＲｂの第８〜１２の５ビットＲｂ［１２：８］で指定されるビット位置についてはそのままにし、他のビットについてはマスク（０に）して、レジスタＲｃに格納する。
（ii）Ｒｂ［１２：８］＜Ｒｂ［４：０］である場合には、
レジスタＲａに格納された３２ビットのうち、レジスタＲｂの第８〜１２の５ビットＲｂ［１２：８］で指定されるビット位置からレジスタＲｂの第０〜４の５ビットＲｂ［４：０］で指定されるビット位置についてはマスク（０に）し、他のビットについてはそのままにして、レジスタＲｃに格納する。
【０１７５】
このような命令は、ビットフィールドの抽出、挿入（組み立て）に使用することができる。ＶＬＤ／ＶＬＣをソフトで行う場合に使用することができる。
【０１７６】
［命令ｂｓｅｑ］
命令ｂｓｅｑは、オペランドのＭＳＢの１ビット下から連続する符号ビットの数を数える命令である。例えば、
ｂｓｅｑ  Ｒｂ，Ｒａ
であれば、プロセッサ１は、変換器４７のBSEQブロック４７ｂにより、レジスタＲａの１ビット下から、連続する符号ビットの数を数えて結果をレジスタＲｂに格納する。なお、レジスタＲａの値が０である場合には、レジスタＲｂに０を格納する。
【０１７７】
このような命令は、有効桁の検出に使用することができる。ダイナミックレンジを大きく取るため、一部浮動小数点演算を行う場合がある。例えば、配列内の最も有効桁の多いデータに合わせて全てのデータを正規化し、演算するといったことに使用することができる。
【０１７８】
［命令ｌｄｂｐ］
命令ｌｄｂｐは、メモリから２バイトのデータを符号拡張してレジスタにロードする命令である。例えば、
ｌｄｂｐ  Ｒｂ：Ｒｂ＋１，（Ｒａ，Ｄ９）
であれば、プロセッサ１は、Ｉ／Ｆ部５０等により、レジスタＲａの値にディスプレースメント値（Ｄ９）を加算したアドレスから２つのバイトデータを符号拡張してレジスタＲａとレジスタ（Ｒａ＋１）それぞれにロードする。
【０１７９】
このような命令は、データ供給を高速にする。
なお、本プロセッサ１は、２つのレジスタへのロードだけでなく、１つのレジスタの上位ハーフワードと下位ハーフワードへのロード等（ｌｄｂｈ等）についても、このロード命令と同様の処理（符号拡張を伴うロード）を実行する。
［命令ｒｄｅ］
命令ｒｄｅは、外部レジスタの値を読み込み、読み込みの失敗時にエラー例外を発生する命令である。例えば、
ｒｄｅ  Ｃ０：Ｃ１，Ｒｂ，（Ｒａ，Ｄ５）
であれば、プロセッサ１は、Ｉ／Ｆ部５０等により、レジスタＲａの値にディスプレースメント値（Ｄ５）を加算した値を外部レジスタ番号とし、その外部レジスタ（拡張レジスタ部８０）の値をレジスタＲｂに読み込むとともに、読み込みの成功・失敗を条件フラグレジスタ（ＣＦＲ）３２のコンディションフラグＣ０及びＣ１に出力する。失敗時には拡張レジスタエラー例外を発生する。
【０１８０】
このような命令は、ハードアクセラレータを制御するための命令として有効である。ハードがエラーを返したら例外が発生し、フラグにも反映される。
【０１８１】
なお、本プロセッサ１は、外部レジスタからの読み込みだけでなく、外部レジスタへの書き出し（命令ｗｔｅ）についても、この読み出し命令と同様の処理（フラグのセット、例外の発生）を実行する。
【０１８２】
［命令ａｄｄａｒｖｗ］
命令ａｄｄａｒｖｗは、絶対値丸め（ゼロから離れる方向に丸め）の加算を行う命令である。例えば、
ａｄｄａｒｖｗ  Ｒｃ，Ｒｂ，Ｒａ
であれば、プロセッサ１は、算術論理・比較演算器４１等により、レジスタＲａの３２ビットとレジスタＲｂの３２ビットとを加算し、その結果が正であれば、丸めるビットを切り上げる処理をし、結果が負であれば、丸めるビットを切り下げる処理をする。具体的には、レジスタＲａとＲｂの値を加算し、レジスタＲａの値が正である場合に１を加算する。なお、絶対値丸めを行う場合、レジスタＲｂには丸めするビットより下位のビットを１で埋めた値をいれておく。
【０１８３】
このような命令は、絶対値丸め（ゼロから離れる方向に丸め）の加算ＩＤＣＴ（Inverse Discrete Cosine Transform）に有効である。
【産業上の利用可能性】
【０１８４】
本発明は、ＤＳＰやＣＰＵ等のプロセッサとして、特にＳＩＭＤ型の命令を実行するプロセッサとして、例えば、携帯電話、モバイルＡＶ機器、デジタルＴＶ、ＤＶＤ等に共通のコアプロセッサとして、利用することができる。
【図面の簡単な説明】
【０１８５】
【図１】本発明に係るプロセッサの概略ブロック図である。
【図２】同プロセッサの算術論理・比較演算器の概略図を示す。
【図３】同プロセッサのバレルシタの構成を示すブロック図である。
【図４】同プロセッサの変換器の構成を示すブロック図である。
【図５】同プロセッサの除算器の構成を示すブロック図である。
【図６】同プロセッサの乗算・積和演算器の構成を示すブロック図である。
【図７】同プロセッサの命令制御部の構成を示すブロック図である。
【図８】同プロセッサの汎用レジスタ（Ｒ０〜Ｒ３１）の構造を示す図である。
【図９】同プロセッサのリンクレジスタ（ＬＲ）の構造を示す図である。
【図１０】同プロセッサの分岐レジスタ（ＴＡＲ）の構造を示す図である。
【図１１】同プロセッサのプログラム状態レジスタ（ＰＳＲ）の構造を示す図である。
【図１２】同プロセッサの条件フラグレジスタ（ＣＦＲ）の構造を示す図である。
【図１３】同プロセッサのアキュームレータ（Ｍ０，Ｍ１）の構造を示す図である。
【図１４】同プロセッサのプログラムカウンタ（ＰＣ）の構造を示す図である。
【図１５】同プロセッサのＰＣ退避用レジスタ（ＩＰＣ）の構造を示す図である。
【図１６】同プロセッサのＰＳＲ退避用レジスタ（ＩＰＳＲ）の構造を示す図である。
【図１７】同プロセッサのパイプライン動作を示すタイミング図である。
【図１８】同プロセッサによる命令実行時の各パイプライン動作を示すタイミング図である。
【図１９】同プロセッサの並列動作を示す図である。
【図２０】同プロセッサが実行する命令のフォーマットを示す図である。
【図２１】カテゴリー「ALUadd（加算）系」に属する命令を説明する図である。
【図２２】カテゴリー「ALUsub（減算）系」に属する命令を説明する図である。
【図２３】カテゴリー「ALUlogic（論理演算）系ほか」に属する命令を説明する図である。
【図２４】カテゴリー「CMP（比較演算）系」に属する命令を説明する図である。
【図２５】カテゴリー「mul（乗算）系」に属する命令を説明する図である。
【図２６】カテゴリー「mac（積和演算）系」に属する命令を説明する図である。
【図２７】カテゴリー「msu（積差演算）系」に属する命令を説明する図である。
【図２８】カテゴリー「MEMｌd（メモリ読み出し）系」に属する命令を説明する図である。
【図２９】カテゴリー「MEMstore（メモリ書き出し）系」に属する命令を説明する図である。
【図３０】カテゴリー「BRA（分岐）系」に属する命令を説明する図である。
【図３１】カテゴリー「BSasl（算術バレルシフト）系ほか」に属する命令を説明する図である。
【図３２】カテゴリー「BSlsr（論理バレルシフト）系ほか」に属する命令を説明する図である。
【図３３】カテゴリー「CNVvaln（算術変換）系」に属する命令を説明する図である。
【図３４】カテゴリー「CNV（一般変換）系」に属する命令を説明する図である。
【図３５】カテゴリー「SATvlpk（飽和処理）系」に属する命令を説明する図である。
【図３６】カテゴリー「ETC（その他）系」に属する命令を説明する図である。
【図３７】命令「ld Rb,(Ra,D10)」を説明する図である。
【図３８】命令「ld Rb3,(Ra3,D5)」を説明する図である。
【図３９】命令「ld Rb,(GP,D13)」を説明する図である。
【図４０】命令「ld Rb2,(GP,D6)」を説明する図である。
【図４１】命令「ld Rb2,(GP)」を説明する図である。
【図４２】命令「ld Rb,(SP,D13)」を説明する図である。
【図４３】命令「ld Rb2,(SP,D6)」を説明する図である。
【図４４】命令「ld Rb2,(SP)」を説明する図である。
【図４５】命令「ld Rb,(Ra+)I10」を説明する図である。
【図４６】命令「ld Rb,(Ra+)」を説明する図である。
【図４７】命令「ld Rb2,(Ra2+)」を説明する図である。
【図４８】命令「ld Rb,(Ra)」を説明する図である。
【図４９】命令「ld Rb2,(Ra2)」を説明する図である。
【図５０】命令「ldh Rb,(Ra,D9)」を説明する図である。
【図５１】命令「ldh Rb3,(Ra3,D4)」を説明する図である。
【図５２】命令「ldh Rb,(GP,D12)」を説明する図である。
【図５３】命令「ldh Rb2,(GP,D5)」を説明する図である。
【図５４】命令「ldh Rb2,(GP)」を説明する図である。
【図５５】命令「ldh Rb,(SP,D12)」を説明する図である。
【図５６】命令「ldh Rb2,(SP,D5)」を説明する図である。
【図５７】命令「ldh Rb2,(SP)」を説明する図である。
【図５８】命令「ldh Rb,(Ra+)I9」を説明する図である。
【図５９】命令「ldh Rb,(Ra+)」を説明する図である。
【図６０】命令「ldh Rb2,(Ra2+)」を説明する図である。
【図６１】命令「ldh Rb,(Ra)」を説明する図である。
【図６２】命令「ldh Rb2,(Ra2)」を説明する図である。
【図６３】命令「ldhu Rb,(Ra,D9)」を説明する図である。
【図６４】命令「ldhu Rb,(GP,D12)」を説明する図である。
【図６５】命令「ldhu Rb,(SP,D12)」を説明する図である。
【図６６】命令「ldhu Rb,(Ra+)I9」を説明する図である。
【図６７】命令「ldhu Rb,(Ra+)」を説明する図である。
【図６８】命令「ldhu Rb,(Ra)」を説明する図である。
【図６９】命令「ldb Rb,(Ra,D8)」を説明する図である。
【図７０】命令「ldb Rb,(GP,D11)」を説明する図である。
【図７１】命令「ldb Rb,(SP,D11)」を説明する図である。
【図７２】命令「ldb Rb,(Ra+)I8」を説明する図である。
【図７３】命令「ldb Rb,(Ra+)」を説明する図である。
【図７４】命令「ldb Rb,(Ra)」を説明する図である。
【図７５】命令「ldbu Rb,(Ra,D8)」を説明する図である。
【図７６】命令「ldbu Rb,(GP,D11)」を説明する図である。
【図７７】命令「ldbu Rb,(SP,D11)」を説明する図である。
【図７８】命令「ldbu Rb,(Ra+)I8」を説明する図である。
【図７９】命令「ldbu Rb,(Ra+)」を説明する図である。
【図８０】命令「ldbu Rb,(Ra)」を説明する図である。
【図８１】命令「ldp Rb:Rb+1,(Ra,D11)」を説明する図である。
【図８２】命令「ldp Rb:Rb+1,(GP,D14)」を説明する図である。
【図８３】命令「ldp Rb:Rb+1,(SP,D14)」を説明する図である。
【図８４】命令「ldp Rb:Rb+1,(SP,D7)」を説明する図である。
【図８５】命令「ldp Rb:Rb+1,(SP)」を説明する図である。
【図８６】命令「ldp Rb:Rb+1,(Ra+)I11」を説明する図である。
【図８７】命令「ldp Rb2:Rb2+1,(Ra2+)」を説明する図である。
【図８８】命令「ldp Rb:Rb+1,(Ra+)」を説明する図である。
【図８９】命令「ldp Rb:Rb+1,(Ra)」を説明する図である。
【図９０】命令「ldp LR:SVR,(Ra,D14)」を説明する図である。
【図９１】命令「ldp LR:SVR,(Ra)」を説明する図である。
【図９２】命令「ldp LR:SVR,(GP,D14)」を説明する図である。
【図９３】命令「ldp LR:SVR,(SP,D14)」を説明する図である。
【図９４】命令「ldp LR:SVR,(SP,D7)」を説明する図である。
【図９５】命令「ldp LR:SVR,(SP)」を説明する図である。
【図９６】命令「ldp TAR:UDR,(Ra,D11)」を説明する図である。
【図９７】命令「ldp TAR:UDR,(GP,D14)」を説明する図である。
【図９８】命令「ldp TAR:UDR,(SP,D14)」を説明する図である。
【図９９】命令「ldhp Rb:Rb+1,(Ra,D10)」を説明する図である。
【図１００】命令「ldhp Rb:Rb+1,(Ra+)I10」を説明する図である。
【図１０１】命令「ldhp Rb2:Rb2+1,(Ra2+)」を説明する図である。
【図１０２】命令「ldhp Rb:Rb+1, (Ra+)」を説明する図である。
【図１０３】命令「ldhp Rb:Rb+1,(Ra)」を説明する図である。
【図１０４】命令「ldbp Rb:Rb+1,(Ra,D9)」を説明する図である。
【図１０５】命令「ldbp Rb:Rb+1,(Ra+)I9」を説明する図である。
【図１０６】命令「ldbp Rb:Rb+1,(Ra+)」を説明する図である。
【図１０７】命令「ldbp Rb:Rb+1,(Ra)」を説明する図である。
【図１０８】命令「ldbh Rb,(Ra+)I7」を説明する図である。
【図１０９】命令「ldbh Rb,(Ra+)」を説明する図である。
【図１１０】命令「ldbh Rb,(Ra)」を説明する図である。
【図１１１】命令「ldbuh Rb,(Ra+)I7」を説明する図である。
【図１１２】命令「ldbuh Rb,(Ra+)」を説明する図である。
【図１１３】命令「ldbuh Rb,(Ra)」を説明する図である。
【図１１４】命令「ldbhp Rb:Rb+1,(Ra+)I7」を説明する図である。
【図１１５】命令「ldbhp Rb:Rb+1,(Ra+)」を説明する図である。
【図１１６】命令「ldbhp Rb:Rb+1,(Ra)」を説明する図である。
【図１１７】命令「ldbuhp Rb:Rb+1,(Ra+)I7」を説明する図である。
【図１１８】命令「ldbuhp Rb:Rb+1,(Ra+)」を説明する図である。
【図１１９】命令「ldbuhp Rb:Rb+1,(Ra)」を説明する図である。
【図１２０】命令「st (Ra,D10),Rb」を説明する図である。
【図１２１】命令「st (Ra3,D5),Rb3」を説明する図である。
【図１２２】命令「st (GP,D13),Rb」を説明する図である。
【図１２３】命令「st (GP,D6),Rb2」を説明する図である。
【図１２４】命令「st (GP),Rb2」を説明する図である。
【図１２５】命令「st (SP,D13),Rb」を説明する図である。
【図１２６】命令「st (SP,D6),Rb2」を説明する図である。
【図１２７】命令「st (SP),Rb2」を説明する図である。
【図１２８】命令「st (Ra+)I10,Rb」を説明する図である。
【図１２９】命令「st (Ra+),Rb」を説明する図である。
【図１３０】命令「st (Ra2+),Rb2」を説明する図である。
【図１３１】命令「st (Ra),Rb」を説明する図である。
【図１３２】命令「st (Ra2),Rb2」を説明する図である。
【図１３３】命令「sth (Ra,D9),Rb」を説明する図である。
【図１３４】命令「sth (Ra3,D4),Rb3」を説明する図である。
【図１３５】命令「sth (GP,D12),Rb」を説明する図である。
【図１３６】命令「sth (GP,D5),Rb2」を説明する図である。
【図１３７】命令「sth (GP),Rb2」を説明する図である。
【図１３８】命令「sth (SP,D12),Rb」を説明する図である。
【図１３９】命令「sth (SP,D5),Rb2」を説明する図である。
【図１４０】命令「sth (SP),Rb2」を説明する図である。
【図１４１】命令「sth (Ra+)I9,Rb」を説明する図である。
【図１４２】命令「sth (Ra+),Rb」を説明する図である。
【図１４３】命令「sth (Ra2+),Rb2」を説明する図である。
【図１４４】命令「sth (Ra),Rb」を説明する図である。
【図１４５】命令「sth (Ra2),Rb2」を説明する図である。
【図１４６】命令「stb (Ra,D8),Rb」を説明する図である。
【図１４７】命令「stb (GP,D11),Rb」を説明する図である。
【図１４８】命令「stb (SP,D11),Rb」を説明する図である。
【図１４９】命令「stb (Ra+)I8,Rb」を説明する図である。
【図１５０】命令「stb (Ra+),Rb」を説明する図である。
【図１５１】命令「stb (Ra),Rb」を説明する図である。
【図１５２】命令「stp (Ra,D11),Rb:Rb+1」を説明する図である。
【図１５３】命令「stp (GP,D14),Rb:Rb+1」を説明する図である。
【図１５４】命令「stp (SP,D14),Rb:Rb+1」を説明する図である。
【図１５５】命令「stp (SP,D7),Rb:Rb+1」を説明する図である。
【図１５６】命令「stp (SP),Rb:Rb+1」を説明する図である。
【図１５７】命令「stp (Ra+)I11,Rb:Rb+1」を説明する図である。
【図１５８】命令「stp (Ra+),Rb:Rb+1」を説明する図である。
【図１５９】命令「stp (Ra2+),Rb2:Rb2+1」を説明する図である。
【図１６０】命令「stp (Ra),Rb:Rb+1」を説明する図である。
【図１６１】命令「stp (Ra,D11),LR:SVR」を説明する図である。
【図１６２】命令「stp (Ra),LR:SVR」を説明する図である。
【図１６３】命令「stp (GP,D14),LR:SVR」を説明する図である。
【図１６４】命令「stp (SP,D14),LR:SVR」を説明する図である。
【図１６５】命令「stp (SP,D7),LR:SVR」を説明する図である。
【図１６６】命令「stp (SP),LR:SVR」を説明する図である。
【図１６７】命令「stp (Ra,D11),TAR:UDR」を説明する図である。
【図１６８】命令「stp (GP,D14),TAR:UDR」を説明する図である。
【図１６９】命令「stp (SP,D14),TAR:UDR」を説明する図である。
【図１７０】命令「sthp (Ra,D10),Rb:Rb+1」を説明する図である。
【図１７１】命令「sthp (Ra+)I10,Rb:Rb+1」を説明する図である。
【図１７２】命令「sthp (Ra+),Rb:Rb+1」を説明する図である。
【図１７３】命令「sthp (Ra2+),Rb2:Rb2+1」を説明する図である。
【図１７４】命令「sthp (Ra),Rb:Rb+1」を説明する図である。
【図１７５】命令「stbp (Ra,D9),Rb:Rb+1」を説明する図である。
【図１７６】命令「stbp (Ra+)I9,Rb:Rb+1」を説明する図である。
【図１７７】命令「stbp (Ra+),Rb:Rb+1」を説明する図である。
【図１７８】命令「stbp (Ra),Rb:Rb+1」を説明する図である。
【図１７９】命令「stbh (Ra+)I7,Rb」を説明する図である。
【図１８０】命令「stbh (Ra+),Rb」を説明する図である。
【図１８１】命令「stbh (Ra),Rb」を説明する図である。
【図１８２】命令「stbhp (Ra+)I7,Rb:Rb+1」を説明する図である。
【図１８３】命令「stbhp (Ra+),Rb:Rb+1」を説明する図である。
【図１８４】命令「stbhp (Ra),Rb:Rb+1」を説明する図である。
【図１８５】命令「dpref (Ra,D8)」を説明する図である。
【図１８６】命令「ldstb Rb,(Ra)」を説明する図である。
【図１８７】命令「rd C0:C1,Rb,(D11)」を説明する図である。
【図１８８】命令「rd C0:C1,Rb,(Ra,D5)」を説明する図である。
【図１８９】命令「rd C0:C1,Rb,(Ra)」を説明する図である。
【図１９０】命令「rd C0:C1,Rb2,(Ra2)」を説明する図である。
【図１９１】命令「rd C2:C3,Rb,(Ra,D5)」を説明する図である。
【図１９２】命令「rd C2:C3,Rb,(Ra)」を説明する図である。
【図１９３】命令「rde C0:C1,Rb,(Ra,D5)」を説明する図である。
【図１９４】命令「rde C0:C1,Rb,(Ra)」を説明する図である。
【図１９５】命令「rde C2:C3,Rb,(Ra,D5)」を説明する図である。
【図１９６】命令「rde C2:C3,Rb,(Ra)」を説明する図である。
【図１９７】命令「wt C0:C1,(D11),Rb」を説明する図である。
【図１９８】命令「wt C0:C1,(Ra,D5),Rb」を説明する図である。
【図１９９】命令「wt C0:C1,(Ra),Rb」を説明する図である。
【図２００】命令「wt C0:C1,(Ra2),Rb2」を説明する図である。
【図２０１】命令「wt C2:C3,(Ra,D5),Rb」を説明する図である。
【図２０２】命令「wt C2:C3,(Ra),Rb」を説明する図である。
【図２０３】命令「wte C0:C1,(Ra,D5),Rb」を説明する図である。
【図２０４】命令「wte C0:C1,(Ra),Rb」を説明する図である。
【図２０５】命令「wte C2:C3,(Ra,D5),Rb」を説明する図である。
【図２０６】命令「wte C2:C3,(Ra),Rb」を説明する図である。
【図２０７】命令「br D20」を説明する図である。
【図２０８】命令「br D9」を説明する図である。
【図２０９】命令「brl D20」を説明する図である。
【図２１０】命令「call D20」を説明する図である。
【図２１１】命令「brl D9」を説明する図である。
【図２１２】命令「call D9」を説明する図である。
【図２１３】命令「jmp LR」を説明する図である。
【図２１４】命令「jmp TAR」を説明する図である。
【図２１５】命令「jmpl LR」を説明する図である。
【図２１６】命令「call LR」を説明する図である。
【図２１７】命令「jmpl TAR」を説明する図である。
【図２１８】命令「call TAR」を説明する図である。
【図２１９】命令「jmpr LR」を説明する図である。
【図２２０】命令「ret」を説明する図である。
【図２２１】命令「jmpf LR」を説明する図である。
【図２２２】命令「jmpf C6,C2:C4,TAR」を説明する図である。
【図２２３】命令「jmpf Cm,TAR」を説明する図である。
【図２２４】命令「jmpf TAR」を説明する図である。
【図２２５】命令「jloop C6,TAR,Ra,I8」を説明する図である。
【図２２６】命令「jloop C6,TAR,Ra」を説明する図である。
【図２２７】命令「jloop C6,TAR,Ra2」を説明する図である。
【図２２８】命令「jloop C6,TAR,Ra2,-1」を説明する図である。
【図２２９】命令「jloop C6,Cm,TAR,Ra,I8」を説明する図である。
【図２３０】命令「jloop C6,Cm,TAR,Ra」を説明する図である。
【図２３１】命令「jloop C6,Cm,TAR,Ra2」を説明する図である。
【図２３２】命令「jloop C6,Cm,TAR,Ra2,-1」を説明する図である。
【図２３３】命令「jloop C6,C2:C4,TAR,Ra,I8」を説明する図である。
【図２３４】命令「jloop C6,C2:C4,TAR,Ra」を説明する図である。
【図２３５】命令「jloop C6,C2:C4,TAR,Ra2」を説明する図である。
【図２３６】命令「jloop C6,C2:C4,TAR,Ra2,-1」を説明する図である。
【図２３７】命令「jloop C5,LR,Ra,I8」を説明する図である。
【図２３８】命令「jloop C5,LR,Ra」を説明する図である。
【図２３９】命令「settar D9」を説明する図である。
【図２４０】命令「settar C6,Cm,D9」を説明する図である。
【図２４１】命令「settar C6,D9」を説明する図である。
【図２４２】命令「settar C6,C2:C4,D9」を説明する図である。
【図２４３】命令「settar C6,C4,D9」を説明する図である。
【図２４４】命令「setlr D9」を説明する図である。
【図２４５】命令「setlr C5,D9」を説明する図である。
【図２４６】命令「setbb TAR」を説明する図である。
【図２４７】命令「setbb LR」を説明する図である。
【図２４８】命令「intd」を説明する図である。
【図２４９】命令「inte」を説明する図である。
【図２５０】命令「vmpswd」を説明する図である。
【図２５１】命令「vmpswe」を説明する図である。
【図２５２】命令「vmpsleep」を説明する図である。
【図２５３】命令「vmpwait」を説明する図である。
【図２５４】命令「vmpsus」を説明する図である。
【図２５５】命令「rti」を説明する図である。
【図２５６】命令「piNl(pi0l,pi1l,pi2l,pi3l,pi4l,pi5l,pi6l,pi7l)」を説明する図である。
【図２５７】命令「piN(pi0,pi1,pi2,pi3,pi4,pi5,pi6,pi7)」を説明する図である。
【図２５８】命令「scN(sc0,sc1,sc2,sc3,sc4,sc5,sc6,sc7)」を説明する図である。
【図２５９】命令「add Rc,Ra,Rb」を説明する図である。
【図２６０】命令「add Rc3,Ra3,Rb3」を説明する図である。
【図２６１】命令「add Ra2,Rb2」を説明する図である。
【図２６２】命令「add Rb,Ra,I12」を説明する図である。
【図２６３】命令「add Ra2,I5」を説明する図である。
【図２６４】命令「add SP,I19」を説明する図である。
【図２６５】命令「add SP,I11」を説明する図である。
【図２６６】命令「addu Rb,GP,I13」を説明する図である。
【図２６７】命令「addu Rb,SP,I13」を説明する図である。
【図２６８】命令「addu Ra3,SP,I6」を説明する図である。
【図２６９】命令「addvw Rc,Ra,Rb」を説明する図である。
【図２７０】命令「addvh Rc,Ra,Rb」を説明する図である。
【図２７１】命令「addc Rc,Ra,Rb」を説明する図である。
【図２７２】命令「adds Rc,Ra,Rb」を説明する図である。
【図２７３】命令「addsr Rc,Ra,Rb」を説明する図である。
【図２７４】命令「s1add Rc,Ra,Rb」を説明する図である。
【図２７５】命令「s1add Rc3,Ra3,Rb3」を説明する図である。
【図２７６】命令「s2add Rc,Ra,Rb」を説明する図である。
【図２７７】命令「s2add Rc3,Ra3,Rb3」を説明する図である。
【図２７８】命令「addmsk Rc,Ra,Rb」を説明する図である。
【図２７９】命令「addarvw Rc,Ra,Rb」を説明する図である。
【図２８０】命令「sub Rc,Rb,Ra」を説明する図である。
【図２８１】命令「sub Rc3,Rb3,Ra3」を説明する図である。
【図２８２】命令「sub Rb2,Ra2」を説明する図である。
【図２８３】命令「sub Rb,Ra,I12」を説明する図である。
【図２８４】命令「sub Ra2,I5」を説明する図である。
【図２８５】命令「sub SP,I19」を説明する図である。
【図２８６】命令「sub SP,I11」を説明する図である。
【図２８７】命令「subc Rc,Rb,Ra」を説明する図である。
【図２８８】命令「subvw Rc,Rb,Ra」を説明する図である。
【図２８９】命令「subvh Rc,Rb,Ra」を説明する図である。
【図２９０】命令「subs Rc,Rb,Ra」を説明する図である。
【図２９１】命令「submsk Rc,Rb,Ra」を説明する図である。
【図２９２】命令「rsub Rb,Ra,I8」を説明する図である。
【図２９３】命令「rsub Ra2,I4」を説明する図である。
【図２９４】命令「rsub Ra2,Rb2」を説明する図である。
【図２９５】命令「neg Rb,Ra」を説明する図である。
【図２９６】命令「neg Ra2」を説明する図である。
【図２９７】命令「negvh Rb,Ra」を説明する図である。
【図２９８】命令「negvw Rb,Ra」を説明する図である。
【図２９９】命令「abs Rb,Ra」を説明する図である。
【図３００】命令「absvw Rb,Ra」を説明する図である。
【図３０１】命令「absvh Rb,Ra」を説明する図である。
【図３０２】命令「max Rc,Ra,Rb」を説明する図である。
【図３０３】命令「min Rc,Ra,Rb」を説明する図である。
【図３０４】命令「and Rc,Ra,Rb」を説明する図である。
【図３０５】命令「and Ra2,Rb2」を説明する図である。
【図３０６】命令「and Rb,Ra,I8」を説明する図である。
【図３０７】命令「andn Rc,Ra,Rb」を説明する図である。
【図３０８】命令「andn Ra2,Rb2」を説明する図である。
【図３０９】命令「andn Rb,Ra,I8」を説明する図である。
【図３１０】命令「or Rc,Ra,Rb」を説明する図である。
【図３１１】命令「or Ra2,Rb2」を説明する図である。
【図３１２】命令「or Rb,Ra,I8」を説明する図である。
【図３１３】命令「xor Rc,Ra,Rb」を説明する図である。
【図３１４】命令「xor Ra2,Rb2」を説明する図である。
【図３１５】命令「xor Rb,Ra,I8」を説明する図である。
【図３１６】命令「not Rb,Ra」を説明する図である。
【図３１７】命令「not Ra2」を説明する図である。
【図３１８】命令「cmpCC Cm,Ra,Rb」を説明する図である。
【図３１９】命令「cmpCC C6,Ra2,Rb2」を説明する図である。
【図３２０】命令「cmpCC」を説明する図である。
【図３２１】命令「cmpCC C6,Ra2,I4」を説明する図である。
【図３２２】命令「cmpCC」を説明する図である。
【図３２３】命令「cmpCC」を説明する図である。
【図３２４】命令「cmpCCn Cm,Ra,Rb,Cn」を説明する図である。
【図３２５】命令「cmpCCn Cm,Ra,I5,Cn」を説明する図である。
【図３２６】命令「cmpCCn Cm:Cm+1,Ra,Rb,Cn」を説明する図である。
【図３２７】命令「cmpCCn Cm:Cm+1,Ra,I5,Cn」を説明する図である。
【図３２８】命令「cmpCCa Cm:Cm+1,Ra,Rb,Cn」を説明する図である。
【図３２９】命令「cmpCCa Cm:Cm+1,Ra,I5,Cn」を説明する図である。
【図３３０】命令「cmpCCo Cm:Cm+1,Ra,Rb,Cn」を説明する図である。
【図３３１】命令「cmpCCo Cm:Cm+1,Ra,I5,Cn」を説明する図である。
【図３３２】命令「tstz Cm,Ra,Rb」を説明する図である。
【図３３３】命令「tstz C6,Ra2,Rb2」を説明する図である。
【図３３４】命令「tstz Cm,Ra,I5」を説明する図である。
【図３３５】命令「tstz C6,Ra2,I4」を説明する図である。
【図３３６】命令「tstz Cm:Cm+1,Ra,Rb」を説明する図である。
【図３３７】命令「tstz Cm:Cm+1,Ra,I5」を説明する図である。
【図３３８】命令「tstzn Cm,Ra,Rb,Cn」を説明する図である。
【図３３９】命令「tstzn Cm,Ra,I5,Cn」を説明する図である。
【図３４０】命令「tstzn Cm:Cm+1,Ra,Rb,Cn」を説明する図である。
【図３４１】命令「tstzn Cm:Cm+1,Ra,I5,Cn」を説明する図である。
【図３４２】命令「tstza Cm:Cm+1,Ra,Rb,Cn」を説明する図である。
【図３４３】命令「tstza Cm:Cm+1,Ra,I5,Cn」を説明する図である。
【図３４４】命令「tstzo Cm:Cm+1,Ra,Rb,Cn」を説明する図である。
【図３４５】命令「tstzo Cm:Cm+1,Ra,I5,Cn」を説明する図である。
【図３４６】命令「tstn Cm,Ra,Rb」を説明する図である。
【図３４７】命令「tstn C6,Ra2,Rb2」を説明する図である。
【図３４８】命令「tstn Cm,Ra,I5」を説明する図である。
【図３４９】命令「tstn C6,Ra2,I4」を説明する図である。
【図３５０】命令「tstn Cm:Cm+1,Ra,Rb」を説明する図である。
【図３５１】命令「tstn Cm:Cm+1,Ra,I5」を説明する図である。
【図３５２】命令「tstnn Cm,Ra,Rb,Cn」を説明する図である。
【図３５３】命令「tstnn Cm,Ra,I5,Cn」を説明する図である。
【図３５４】命令「tstnn Cm:Cm+1,Ra,Rb,Cn」を説明する図である。
【図３５５】命令「tstnn Cm:Cm+1,Ra,I5,Cn」を説明する図である。
【図３５６】命令「tstna Cm:Cm+1,Ra,Rb,Cn」を説明する図である。
【図３５７】命令「tstna Cm:Cm+1,Ra,I5,Cn」を説明する図である。
【図３５８】命令「tstno Cm:Cm+1,Ra,Rb,Cn」を説明する図である。
【図３５９】命令「tstno Cm:Cm+1,Ra,I5,Cn」を説明する図である。
【図３６０】命令「mov Rb,Ra」を説明する図である。
【図３６１】命令「mov Ra2,Rb」を説明する図である。
【図３６２】命令「mov Ra,I16」を説明する図である。
【図３６３】命令「mov Ra2,I8」を説明する図である。
【図３６４】命令「mov Rb,TAR」を説明する図である。
【図３６５】命令「mov Rb2,TAR」を説明する図である。
【図３６６】命令「mov Rb,LR」を説明する図である。
【図３６７】命令「mov Rb2,LR」を説明する図である。
【図３６８】命令「mov Rb,SVR」を説明する図である。
【図３６９】命令「mov Rb,PSR」を説明する図である。
【図３７０】命令「mov Rb,CFR」を説明する図である。
【図３７１】命令「mov Rb,MH0」を説明する図である。
【図３７２】命令「mov Rb2,MH0」を説明する図である。
【図３７３】命令「mov Rb,MH1」を説明する図である。
【図３７４】命令「mov Rb2,MH1」を説明する図である。
【図３７５】命令「mov Rb,ML0」を説明する図である。
【図３７６】命令「mov Rb,ML1」を説明する図である。
【図３７７】命令「mov Rb,IPC」を説明する図である。
【図３７８】命令「mov Rb,IPSR」を説明する図である。
【図３７９】命令「mov Rb,PC」を説明する図である。
【図３８０】命令「mov Rb,EPC」を説明する図である。
【図３８１】命令「mov Rb,EPSR」を説明する図である。
【図３８２】命令「mov Rb,PSR0」を説明する図である。
【図３８３】命令「mov Rb,PSR1」を説明する図である。
【図３８４】命令「mov Rb,PSR2」を説明する図である。
【図３８５】命令「mov Rb,PSR3」を説明する図である。
【図３８６】命令「mov Rb,CFR0」を説明する図である。
【図３８７】命令「mov Rb,CFR1」を説明する図である。
【図３８８】命令「mov Rb,CFR2」を説明する図である。
【図３８９】命令「mov Rb,CFR3」を説明する図である。
【図３９０】命令「mov LR,Rb」を説明する図である。
【図３９１】命令「mov LR,Rb2」を説明する図である。
【図３９２】命令「mov TAR,Rb」を説明する図である。
【図３９３】命令「mov TAR,Rb2」を説明する図である。
【図３９４】命令「mov SVR,Rb」を説明する図である。
【図３９５】命令「mov PSR,Rb」を説明する図である。
【図３９６】命令「mov CFR,Rb」を説明する図である。
【図３９７】命令「mov MH0,Rb」を説明する図である。
【図３９８】命令「mov MH0,Rb2」を説明する図である。
【図３９９】命令「mov MH1,Rb」を説明する図である。
【図４００】命令「mov MH1,Rb2」を説明する図である。
【図４０１】命令「mov ML0,Rb」を説明する図である。
【図４０２】命令「mov ML1,Rb」を説明する図である。
【図４０３】命令「mov IPC,Rb」を説明する図である。
【図４０４】命令「mov IPSR,Rb」を説明する図である。
【図４０５】命令「mov EPC,Rb」を説明する図である。
【図４０６】命令「mov EPSR,Rb」を説明する図である。
【図４０７】命令「mov PSR0,Rb」を説明する図である。
【図４０８】命令「mov PSR1,Rb」を説明する図である。
【図４０９】命令「mov PSR2,Rb」を説明する図である。
【図４１０】命令「mov PSR3,Rb」を説明する図である。
【図４１１】命令「mov CFR0,Rb」を説明する図である。
【図４１２】命令「mov CFR1,Rb」を説明する図である。
【図４１３】命令「mov CFR2,Rb」を説明する図である。
【図４１４】命令「mov CFR3,Rb」を説明する図である。
【図４１５】命令「mvclovs Cm:Cm+1」を説明する図である。
【図４１６】命令「movcf Ci,Cj,Cm,Cn」を説明する図である。
【図４１７】命令「mvclcas Cm:Cm+1」を説明する図である。
【図４１８】命令「sethi Ra,I16」を説明する図である。
【図４１９】命令「setlo Ra,I16」を説明する図である。
【図４２０】命令「vcchk」を説明する図である。
【図４２１】命令「nop」を説明する図である。
【図４２２】命令「asl Rc,Ra,Rb」を説明する図である。
【図４２３】命令「asl Rb,Ra,I5」を説明する図である。
【図４２４】命令「asl Ra2,I4」を説明する図である。
【図４２５】命令「aslvw Rc,Ra,Rb」を説明する図である。
【図４２６】命令「aslvw Rb,Ra,I5」を説明する図である。
【図４２７】命令「aslvh Rc,Ra,Rb」を説明する図である。
【図４２８】命令「aslvh Rb,Ra,I5」を説明する図である。
【図４２９】命令「asr Rc,Ra,Rb」を説明する図である。
【図４３０】命令「asr Rb,Ra,I5」を説明する図である。
【図４３１】命令「asr Ra2,I4」を説明する図である。
【図４３２】命令「asrvw Rc,Ra,Rb」を説明する図である。
【図４３３】命令「asrvh Rc,Ra,Rb」を説明する図である。
【図４３４】命令「lsl Rc,Ra,Rb」を説明する図である。
【図４３５】命令「lsl Rc,Ra,I5」を説明する図である。
【図４３６】命令「lsl Ra2,I4」を説明する図である。
【図４３７】命令「lsr Rc,Ra,Rb」を説明する図である。
【図４３８】命令「lsr Rb,Ra,I5」を説明する図である。
【図４３９】命令「rol Rc,Ra,Rb」を説明する図である。
【図４４０】命令「rol Rb,Ra,I5」を説明する図である。
【図４４１】命令「ror Rb,Ra,I5」を説明する図である。
【図４４２】命令「aslp Mm,Ra,Mn,Rb」を説明する図である。
【図４４３】命令「aslp Mm,Rb,Mn,I6」を説明する図である。
【図４４４】命令「aslp Mm,Rc,MHn,Ra,Rb」を説明する図である。
【図４４５】命令「aslp Mm,Rb,MHn,Ra,I6」を説明する図である。
【図４４６】命令「aslpvw Mm,Ra,Mn,Rb」を説明する図である。
【図４４７】命令「aslpvw Mm,Rb,Mn,I6」を説明する図である。
【図４４８】命令「asrp Mm,Ra,Mn,Rb」を説明する図である。
【図４４９】命令「asrp Mm,Rb,Mn,I6」を説明する図である。
【図４５０】命令「asrp Mm,Rc,MHn,Ra,Rb」を説明する図である。
【図４５１】命令「asrp Mm,Rb,MHn,Ra,I6」を説明する図である。
【図４５２】命令「asrpvw Mm,Ra,Mn,Rb」を説明する図である。
【図４５３】命令「lslp Mm,Ra,Mn,Rb」を説明する図である。
【図４５４】命令「lslp Mm,Rb,Mn,I6」を説明する図である。
【図４５５】命令「lslp Mm,Rc,MHn,Ra,Rb」を説明する図である。
【図４５６】命令「lslp Mm,Rb,MHn,Ra,I6」を説明する図である。
【図４５７】命令「lsrp Mm,Ra,Mn,Rb」を説明する図である。
【図４５８】命令「lsrp Mm,Rb,Mn,I6」を説明する図である。
【図４５９】命令「lsrp Mm,Rc,MHn,Ra,Rb」を説明する図である。
【図４６０】命令「lsrp Mm,Rb,MHn,Ra,I6」を説明する図である。
【図４６１】命令「extr Rc,Ra,Rb」を説明する図である。
【図４６２】命令「extr Rb,Ra,Ib5,Ia5」を説明する図である。
【図４６３】命令「ext Rb,Ra,I5」を説明する図である。
【図４６４】命令「exth Ra2」を説明する図である。
【図４６５】命令「extb Ra2」を説明する図である。
【図４６６】命令「extru Rc,Ra,Rb」を説明する図である。
【図４６７】命令「extru Rb,Ra,Ib5,Ia5」を説明する図である。
【図４６８】命令「extu Rb,Ra,I5」を説明する図である。
【図４６９】命令「exthu Ra2」を説明する図である。
【図４７０】命令「extbu Ra2」を説明する図である。
【図４７１】命令「mskgen Rc,Rb」を説明する図である。
【図４７２】命令「mskgen Rb,Ib5,Ia5」を説明する図である。
【図４７３】命令「msk Rc,Ra,Rb」を説明する図である。
【図４７４】命令「msk Rb,Ra,Ib5,Ia5」を説明する図である。
【図４７５】命令「satw Mm,Rb,Mn」を説明する図である。
【図４７６】命令「sath Rb,Ra」を説明する図である。
【図４７７】命令「sat12 Rb,Ra」を説明する図である。
【図４７８】命令「sat9 Rb,Ra」を説明する図である。
【図４７９】命令「satb Rb,Ra」を説明する図である。
【図４８０】命令「satbu Rb,Ra」を説明する図である。
【図４８１】命令「extw Mm,Rb,Ra」を説明する図である。
【図４８２】命令「vintllh Rc,Ra,Rb」を説明する図である。
【図４８３】命令「vintlhh Rc,Ra,Rb」を説明する図である。
【図４８４】命令「vintllb Rc,Ra,Rb」を説明する図である。
【図４８５】命令「vintlhb Rc,Ra,Rb」を説明する図である。
【図４８６】命令「valn Rc,Ra,Rb」を説明する図である。
【図４８７】命令「valn1 Rc,Ra,Rb」を説明する図である。
【図４８８】命令「valn2 Rc,Ra,Rb」を説明する図である。
【図４８９】命令「valn3 Rc,Ra,Rb」を説明する図である。
【図４９０】命令「valnvc1 Rc,Ra,Rb」を説明する図である。
【図４９１】命令「valnvc2 Rc,Ra,Rb」を説明する図である。
【図４９２】命令「valnvc3 Rc,Ra,Rb」を説明する図である。
【図４９３】命令「valnvc4 Rc,Ra,Rb」を説明する図である。
【図４９４】命令「vxchngh Rb,Ra」を説明する図である。
【図４９５】命令「byterev Rb,Ra」を説明する図である。
【図４９６】命令「vstovb Rb,Ra」を説明する図である。
【図４９７】命令「vstovh Rb,Ra」を説明する図である。
【図４９８】命令「vlunpkh Rb:Rb+1,Ra」を説明する図である。
【図４９９】命令「vlunpkhu Rb:Rb+1,Ra」を説明する図である。
【図５００】命令「vlunpkb Rb:Rb+1,Ra」を説明する図である。
【図５０１】命令「vlunpkbu Rb:Rb+1,Ra」を説明する図である。
【図５０２】命令「vhunpkh Rb:Rb+1,Ra」を説明する図である。
【図５０３】命令「vhunpkb Rb:Rb+1,Ra」を説明する図である。
【図５０４】命令「vunpk1 Rb,Mn」を説明する図である。
【図５０５】命令「vunpk2 Rb,Mn」を説明する図である。
【図５０６】命令「vlpkh Rc,Rb,Ra」を説明する図である。
【図５０７】命令「vlpkhu Rc,Rb,Ra」を説明する図である。
【図５０８】命令「vlpkb Rc,Rb,Ra」を説明する図である。
【図５０９】命令「vlpkbu Rc,Rb,Ra」を説明する図である。
【図５１０】命令「vhpkh Rc,Ra,Rb」を説明する図である。
【図５１１】命令「vhpkb Rc,Ra,Rb」を説明する図である。
【図５１２】命令「vexth Mm,Rb,Ra」を説明する図である。
【図５１３】命令「bseq0 Rb,Ra」を説明する図である。
【図５１４】命令「bseq1 Rb,Ra」を説明する図である。
【図５１５】命令「bseq Rb,Ra」を説明する図である。
【図５１６】命令「bcnt1 Rb,Ra」を説明する図である。
【図５１７】命令「rndvh Rb,Ra」を説明する図である。
【図５１８】命令「mskbrvb Rc,Ra,Rb」を説明する図である。
【図５１９】命令「mskbrvh Rc,Ra,Rb」を説明する図である。
【図５２０】命令「movp Rc:Rc+1,Ra,Rb」を説明する図である。
【図５２１】命令「hmul Mm,Rc,Ra,Rb」を説明する図である。
【図５２２】命令「lmul Mm,Rc,Ra,Rb」を説明する図である。
【図５２３】命令「fmulhh Mm,Rc,Ra,Rb」を説明する図である。
【図５２４】命令「fmulhhr Mm,Rc,Ra,Rb」を説明する図である。
【図５２５】命令「fmulhw Mm,Rc,Ra,Rb」を説明する図である。
【図５２６】命令「fmulhww Mm,Rc,Ra,Rb」を説明する図である。
【図５２７】命令「mul Mm,Rc,Ra,Rb」を説明する図である。
【図５２８】命令「mul Mm,Rb,Ra,I8」を説明する図である。
【図５２９】命令「mulu Mm,Rc,Ra,Rb」を説明する図である。
【図５３０】命令「mulu Mm,Rb,Ra,I8」を説明する図である。
【図５３１】命令「fmulww Mm,Rc,Ra,Rb」を説明する図である。
【図５３２】命令「hmac Mm,Rc,Ra,Rb,Mn」を説明する図である。
【図５３３】命令「hmac M0,Rc,Ra,Rb,Rx」を説明する図である。
【図５３４】命令「lmac Mm,Rc,Ra,Rb,Mn」を説明する図である。
【図５３５】命令「lmac M0,Rc,Ra,Rb,Rx」を説明する図である。
【図５３６】命令「fmachh Mm,Rc,Ra,Rb,Mn」を説明する図である。
【図５３７】命令「fmachh M0,Rc,Ra,Rb,Rx」を説明する図である。
【図５３８】命令「fmachhr Mm,Rc,Ra,Rb,Mn」を説明する図である。
【図５３９】命令「fmachhr M0,Rc,Ra,Rb,Rx」を説明する図である。
【図５４０】命令「fmachw Mm,Rc,Ra,Rb,Mn」を説明する図である。
【図５４１】命令「fmachw M0,Rc,Ra,Rb,Rx」を説明する図である。
【図５４２】命令「fmachww Mm,Rc,Ra,Rb,Mn」を説明する図である。
【図５４３】命令「fmachww M0,Rc,Ra,Rb,Rx」を説明する図である。
【図５４４】命令「mac Mm,Rc,Ra,Rb,Mn」を説明する図である。
【図５４５】命令「mac M0,Rc,Ra,Rb,Rx」を説明する図である。
【図５４６】命令「fmacww Mm,Rc,Ra,Rb,Mn」を説明する図である。
【図５４７】命令「fmacww M0,Rc,Ra,Rb,Rx」を説明する図である。
【図５４８】命令「hmsu Mm,Rc,Ra,Rb,Mn」を説明する図である。
【図５４９】命令「hmsu M0,Rc,Ra,Rb,Rx」を説明する図である。
【図５５０】命令「lmsu Mm,Rc,Ra,Rb,Mn」を説明する図である。
【図５５１】命令「lmsu M0,Rc,Ra,Rb,Rx」を説明する図である。
【図５５２】命令「fmsuhh Mm,Rc,Ra,Rb,Mn」を説明する図である。
【図５５３】命令「fmsuhh M0,Rc,Ra,Rb,Rx」を説明する図である。
【図５５４】命令「fmsuhhr Mm,Rc,Ra,Rb,Mn」を説明する図である。
【図５５５】命令「fmsuhhr M0,Rc,Ra,Rb,Rx」を説明する図である。
【図５５６】命令「fmsuhw Mm,Rc,Ra,Rb,Mn」を説明する図である。
【図５５７】命令「fmsuhw M0,Rc,Ra,Rb,Rx」を説明する図である。
【図５５８】命令「fmsuhww Mm,Rc,Ra,Rb,Mn」を説明する図である。
【図５５９】命令「fmsuhww M0,Rc,Ra,Rb,Rx」を説明する図である。
【図５６０】命令「msu Mm,Rc,Ra,Rb,Mn」を説明する図である。
【図５６１】命令「msu M0,Rc,Ra,Rb,Rx」を説明する図である。
【図５６２】命令「fmsuww Mm,Rc,Ra,Rb,Mn」を説明する図である。
【図５６３】命令「fmsuww M0,Rc,Ra,Rb,Rx」を説明する図である。
【図５６４】命令「div MHm,Rc,MHn,Ra,Rb」を説明する図である。
【図５６５】命令「divu MHm,Rc,MHn,Ra,Rb」を説明する図である。
【図５６６】命令「dbgm0」を説明する図である。
【図５６７】命令「dbgm1」を説明する図である。
【図５６８】命令「dbgm2 I15」を説明する図である。
【図５６９】命令「dbgm3 I15」を説明する図である。
【図５７０】命令「vaddh Rc,Ra,Rb」を説明する図である。
【図５７１】命令「vxaddh Rc,Ra,Rb」を説明する図である。
【図５７２】命令「vhaddh Rc,Ra,Rb」を説明する図である。
【図５７３】命令「vladdh Rc,Ra,Rb」を説明する図である。
【図５７４】命令「vaddhvh Rc,Ra,Rb」を説明する図である。
【図５７５】命令「vxaddhvh Rc,Ra,Rb」を説明する図である。
【図５７６】命令「vhaddhvh Rc,Ra,Rb」を説明する図である。
【図５７７】命令「vladdhvh Rc,Ra,Rb」を説明する図である。
【図５７８】命令「vsaddh Rb,Ra,I8」を説明する図である。
【図５７９】命令「vaddsh Rc,Ra,Rb」を説明する図である。
【図５８０】命令「vaddsrh Rc,Ra,Rb」を説明する図である。
【図５８１】命令「vaddhvc Rc,Ra,Rb」を説明する図である。
【図５８２】命令「vaddrhvc Rc,Ra,Rb」を説明する図である。
【図５８３】命令「vaddb Rc,Ra,Rb」を説明する図である。
【図５８４】命令「vsaddb Rb,Ra,I8」を説明する図である。
【図５８５】命令「vaddsb Rc,Ra,Rb」を説明する図である。
【図５８６】命令「vaddsrb Rc,Ra,Rb」を説明する図である。
【図５８７】命令「vsubh Rc,Rb,Ra」を説明する図である。
【図５８８】命令「vxsubh Rc,Rb,Ra」を説明する図である。
【図５８９】命令「vhsubh Rc,Rb,Ra」を説明する図である。
【図５９０】命令「vlsubh Rc,Rb,Ra」を説明する図である。
【図５９１】命令「vsubhvh Rc,Rb,Ra」を説明する図である。
【図５９２】命令「vxsubhvh Rc,Rb,Ra」を説明する図である。
【図５９３】命令「vhsubhvh Rc,Rb,Ra」を説明する図である。
【図５９４】命令「vlsubhvh Rc,Rb,Ra」を説明する図である。
【図５９５】命令「vssubh Rb,Ra,I8」を説明する図である。
【図５９６】命令「vsubb Rc,Rb,Ra」を説明する図である。
【図５９７】命令「vssubb Rb,Ra,I8」を説明する図である。
【図５９８】命令「vsubsh Rc,Rb,Ra」を説明する図である。
【図５９９】命令「vsrsubh Rb,Ra,I8」を説明する図である。
【図６００】命令「vsrsubb Rb,Ra,I8」を説明する図である。
【図６０１】命令「vsumh Rb,Ra」を説明する図である。
【図６０２】命令「vsumh2 Rb,Ra」を説明する図である。
【図６０３】命令「vsumrh2 Rb,Ra」を説明する図である。
【図６０４】命令「vnegh Rb,Ra」を説明する図である。
【図６０５】命令「vneghvh Rb,Ra」を説明する図である。
【図６０６】命令「vnegb Rb,Ra」を説明する図である。
【図６０７】命令「vabshvh Rb,Ra」を説明する図である。
【図６０８】命令「vasubb Rc,Rb,Ra」を説明する図である。
【図６０９】命令「vsgnh Rb,Ra」を説明する図である。
【図６１０】命令「vmaxh Rc,Ra,Rb」を説明する図である。
【図６１１】命令「vmaxb Rc,Ra,Rb」を説明する図である。
【図６１２】命令「vminh Rc,Ra,Rb」を説明する図である。
【図６１３】命令「vminb Rc,Ra,Rb」を説明する図である。
【図６１４】命令「vsel Rc,Ra,Rb」を説明する図である。
【図６１５】命令「vmovt Rb,Ra」を説明する図である。
【図６１６】命令「vscmpeqb Ra,I5」を説明する図である。
【図６１７】命令「vscmpneb Ra,I5」を説明する図である。
【図６１８】命令「vscmpgtb Ra,I5」を説明する図である。
【図６１９】命令「vscmpleb Ra,I5」を説明する図である。
【図６２０】命令「vscmpgeb Ra,I5」を説明する図である。
【図６２１】命令「vscmpltb Ra,I5」を説明する図である。
【図６２２】命令「vscmpeqh Ra,I5」を説明する図である。
【図６２３】命令「vscmpneh Ra,I5」を説明する図である。
【図６２４】命令「vscmpgth Ra,I5」を説明する図である。
【図６２５】命令「vscmpleh Ra,I5」を説明する図である。
【図６２６】命令「vscmpgeh Ra,I5」を説明する図である。
【図６２７】命令「vscmplth Ra,I5」を説明する図である。
【図６２８】命令「vcmpeqh Ra,Rb」を説明する図である。
【図６２９】命令「vcmpneh Ra,Rb」を説明する図である。
【図６３０】命令「vcmpgth Ra,Rb」を説明する図である。
【図６３１】命令「vcmpleh Ra,Rb」を説明する図である。
【図６３２】命令「vcmpgeh Ra,Rb」を説明する図である。
【図６３３】命令「vcmplth Ra,Rb」を説明する図である。
【図６３４】命令「vcmpeqb Ra,Rb」を説明する図である。
【図６３５】命令「vcmpneb Ra,Rb」を説明する図である。
【図６３６】命令「vcmpgtb Ra,Rb」を説明する図である。
【図６３７】命令「vcmpleb Ra,Rb」を説明する図である。
【図６３８】命令「vcmpgeb Ra,Rb」を説明する図である。
【図６３９】命令「vcmpltb Ra,Rb」を説明する図である。
【図６４０】命令「vaslh Rc,Ra,Rb」を説明する図である。
【図６４１】命令「vaslh Rb,Ra,I4」を説明する図である。
【図６４２】命令「vaslvh Rc,Ra,Rb」を説明する図である。
【図６４３】命令「vaslvh Rb,Ra,I4」を説明する図である。
【図６４４】命令「vasrh Rb,Ra,I4」を説明する図である。
【図６４５】命令「vasrvh Rc,Ra,Rb」を説明する図である。
【図６４６】命令「vlslh Rc,Ra,Rb」を説明する図である。
【図６４７】命令「vlslh Rb,Ra,I4」を説明する図である。
【図６４８】命令「vlsrh Rc,Ra,Rb」を説明する図である。
【図６４９】命令「vlsrh Rb,Ra,I4」を説明する図である。
【図６５０】命令「vrolh Rc,Ra,Rb」を説明する図である。
【図６５１】命令「vrolh Rb,Ra,I4」を説明する図である。
【図６５２】命令「vrorh Rb,Ra,I4」を説明する図である。
【図６５３】命令「vasrh Rc,Ra,Rb」を説明する図である。
【図６５４】命令「vaslb Rc,Ra,Rb」を説明する図である。
【図６５５】命令「vaslb Rb,Ra,I3」を説明する図である。
【図６５６】命令「vasrb Rc,Ra,Rb」を説明する図である。
【図６５７】命令「vasrb Rb,Ra,I3」を説明する図である。
【図６５８】命令「vlslb Rc,Ra,Rb」を説明する図である。
【図６５９】命令「vlslb Rb,Ra,I3」を説明する図である。
【図６６０】命令「vlsrb Rc,Ra,Rb」を説明する図である。
【図６６１】命令「vlsrb Rb,Ra,I3」を説明する図である。
【図６６２】命令「vrolb Rc,Ra,Rb」を説明する図である。
【図６６３】命令「vrolb Rb,Ra,I3」を説明する図である。
【図６６４】命令「vrorb Rb,Ra,I3」を説明する図である。
【図６６５】命令「vasl Mm,Ra,Mn,Rb」を説明する図である。
【図６６６】命令「vasl Mm,Rb,Mn,I5」を説明する図である。
【図６６７】命令「vaslvw Mm,Ra,Mn,Rb」を説明する図である。
【図６６８】命令「vaslvw Mm,Rb,Mn,I5」を説明する図である。
【図６６９】命令「vasr Mm,Ra,Mn,Rb」を説明する図である。
【図６７０】命令「vasr Mm,Rb,Mn,I5」を説明する図である。
【図６７１】命令「vasrvw Mm,Ra,Mn,Rb」を説明する図である。
【図６７２】命令「vlsl Mm,Ra,Mn,Rb」を説明する図である。
【図６７３】命令「vlsl Mm,Rb,Mn,I5」を説明する図である。
【図６７４】命令「vlsr Mm,Ra,Mn,Rb」を説明する図である。
【図６７５】命令「vlsr Mm,Rb,Mn,I5」を説明する図である。
【図６７６】命令「vsath Mm,Rb,Mn」を説明する図である。
【図６７７】命令「vsath12 Rb,Ra」を説明する図である。
【図６７８】命令「vsath9 Rb,Ra」を説明する図である。
【図６７９】命令「vsath8 Rb,Ra」を説明する図である。
【図６８０】命令「vsath8u Rb,Ra」を説明する図である。
【図６８１】命令「vrndvh Rb,Mn」を説明する図である。
【図６８２】命令「vabssumb Rc,Ra,Rb」を説明する図である。
【図６８３】命令「vmul Mm,Rc,Ra,Rb」を説明する図である。
【図６８４】命令「vxmul Mm,Rc,Ra,Rb」を説明する図である。
【図６８５】命令「vhmul Mm,Rc,Ra,Rb」を説明する図である。
【図６８６】命令「vlmul Mm,Rc,Ra,Rb」を説明する図である。
【図６８７】命令「vfmulh Mm,Rc,Ra,Rb」を説明する図である。
【図６８８】命令「vxfmulh Mm,Rc,Ra,Rb」を説明する図である。
【図６８９】命令「vhfmulh Mm,Rc,Ra,Rb」を説明する図である。
【図６９０】命令「vlfmulh Mm,Rc,Ra,Rb」を説明する図である。
【図６９１】命令「vfmulhr Mm,Rc,Ra,Rb」を説明する図である。
【図６９２】命令「vxfmulhr Mm,Rc,Ra,Rb」を説明する図である。
【図６９３】命令「vhfmulhr Mm,Rc,Ra,Rb」を説明する図である。
【図６９４】命令「vlfmulhr Mm,Rc,Ra,Rb」を説明する図である。
【図６９５】命令「vfmulw Mm,Rc,Ra,Rb」を説明する図である。
【図６９６】命令「vxfmulw Mm,Rc,Ra,Rb」を説明する図である。
【図６９７】命令「vhfmulw Mm,Rc,Ra,Rb」を説明する図である。
【図６９８】命令「vlfmulw Mm,Rc,Ra,Rb」を説明する図である。
【図６９９】命令「vpfmulhww Mm,Rc:Rc+1,Ra,Rb」を説明する図である。
【図７００】命令「vmac Mm,Rc,Ra,Rb,Mn」を説明する図である。
【図７０１】命令「vmac M0,Rc,Ra,Rb,Rx」を説明する図である。
【図７０２】命令「vxmac Mm,Rc,Ra,Rb,Mn」を説明する図である。
【図７０３】命令「vxmac M0,Rc,Ra,Rb,Rx」を説明する図である。
【図７０４】命令「vhmac Mm,Rc,Ra,Rb,Mn」を説明する図である。
【図７０５】命令「vhmac M0,Rc,Ra,Rb,Rx」を説明する図である。
【図７０６】命令「vlmac Mm,Rc,Ra,Rb,Mn」を説明する図である。
【図７０７】命令「vlmac M0,Rc,Ra,Rb,Rx」を説明する図である。
【図７０８】命令「vfmach Mm,Rc,Ra,Rb,Mn」を説明する図である。
【図７０９】命令「vfmach M0,Rc,Ra,Rb,Rx」を説明する図である。
【図７１０】命令「vxfmach Mm,Rc,Ra,Rb,Mn」を説明する図である。
【図７１１】命令「vxfmach M0,Rc,Ra,Rb,Rx」を説明する図である。
【図７１２】命令「vhfmach Mm,Rc,Ra,Rb,Mn」を説明する図である。
【図７１３】命令「vhfmach M0,Rc,Ra,Rb,Rx」を説明する図である。
【図７１４】命令「vlfmach Mm,Rc,Ra,Rb,Mn」を説明する図である。
【図７１５】命令「vlfmach M0,Rc,Ra,Rb,Rx」を説明する図である。
【図７１６】命令「vfmachr Mm,Rc,Ra,Rb,Mn」を説明する図である。
【図７１７】命令「vfmachr M0,Rc,Ra,Rb,Rx」を説明する図である。
【図７１８】命令「vxfmachr Mm,Rc,Ra,Rb,Mn」を説明する図である。
【図７１９】命令「vxfmachr M0,Rc,Ra,Rb,Rx」を説明する図である。
【図７２０】命令「vhfmachr Mm,Rc,Ra,Rb,Mn」を説明する図である。
【図７２１】命令「vhfmachr M0,Rc,Ra,Rb,Rx」を説明する図である。
【図７２２】命令「vlfmachr Mm,Rc,Ra,Rb,Mn」を説明する図である。
【図７２３】命令「vlfmachr M0,Rc,Ra,Rb,Rx」を説明する図である。
【図７２４】命令「vfmacw Mm,Rc,Ra,Rb,Mn」を説明する図である。
【図７２５】命令「vxfmacw Mm,Rc,Ra,Rb,Mn」を説明する図である。
【図７２６】命令「vhfmacw Mm,Rc,Ra,Rb,Mn」を説明する図である。
【図７２７】命令「vlfmacw Mm,Rc,Ra,Rb,Mn」を説明する図である。
【図７２８】命令「vpfmachww Mm,Rc:Rc+1,Ra,Rb,Mn」を説明する図である。
【図７２９】命令「vmsu Mm,Rc,Ra,Rb,Mn」を説明する図である。
【図７３０】命令「vmsu M0,Rc,Ra,Rb,Rx」を説明する図である。
【図７３１】命令「vxmsu Mm,Rc,Ra,Rb,Mn」を説明する図である。
【図７３２】命令「vxmsu M0,Rc,Ra,Rb,Rx」を説明する図である。
【図７３３】命令「vhmsu Mm,Rc,Ra,Rb,Mn」を説明する図である。
【図７３４】命令「vhmsu M0,Rc,Ra,Rb,Rx」を説明する図である。
【図７３５】命令「vlmsu Mm,Rc,Ra,Rb,Mn」を説明する図である。
【図７３６】命令「vlmsu M0,Rc,Ra,Rb,Rx」を説明する図である。
【図７３７】命令「vfmsuh Mm,Rc,Ra,Rb,Mn」を説明する図である。
【図７３８】命令「vfmsuh M0,Rc,Ra,Rb,Rx」を説明する図である。
【図７３９】命令「vxfmsuh Mm,Rc,Ra,Rb,Mn」を説明する図である。
【図７４０】命令「vxfmsuh M0,Rc,Ra,Rb,Rx」を説明する図である。
【図７４１】命令「vhfmsuh Mm,Rc,Ra,Rb,Mn」を説明する図である。
【図７４２】命令「vhfmsuh M0,Rc,Ra,Rb,Rx」を説明する図である。
【図７４３】命令「vlfmsuh Mm,Rc,Ra,Rb,Mn」を説明する図である。
【図７４４】命令「vlfmsuh M0,Rc,Ra,Rb,Rx」を説明する図である。
【図７４５】命令「vfmsuw Mm,Rc,Ra,Rb,Mn」を説明する図である。
【図７４６】命令「vxfmsuw Mm,Rc,Ra,Rb,Mn」を説明する図である。
【図７４７】命令「vhfmsuw Mm,Rc,Ra,Rb,Mn」を説明する図である。
【図７４８】命令「vlfmsuw Mm,Rc,Ra,Rb,Mn」を説明する図である。
【符号の説明】
【０１８６】
１    プロセッサ
１０    命令制御部
１０ａ  命令キャッシュ
１０ｂ  アドレス管理部
１０ｃ〜１０ｅ  命令バッファ
１０ｆ  ジャンプバッファ
１０ｇ  ローテーション部
２０    デコード部
３０    レジスタファイル
３０ａ  汎用レジスタ（Ｒ０〜Ｒ３１）
３０ｂ  アキュームレータ（ＭＨ，ＭＬ）
３０ｃ  リンクレジスタ（ＬＲ）
３０ｄ  分岐レジスタ（ＴＡＲ）
３１    プログラム状態レジスタ（ＰＳＲ）
３２    条件フラグレジスタ（ＣＦＲ）
３３    プログラムカウンタ（ＰＣ）
３４    ＰＣ退避用レジスタ（ＩＰＣ）
３５    ＰＳＲ退避用レジスタ（ＩＰＳＲ）
４０    演算部
４１〜４３  算術論理・比較演算器
４１ａ  ＡＬＵ部
４１ｂ  飽和処理部
４１ｃ  フラグ部
４４    積和演算器
４４ａ、４４ｂ  乗算器
４４ｃ〜４４ｅ  加算器
４４ｆ  セレクタ
４４ｇ  飽和処理部
４５    バレルシフタ
４５ａ、４５ｂ  セレクタ
４５ｃ  上位バレルシフタ
４５ｄ  下位バレルシフタ
４５ｅ  飽和処理部
４６    除算器
４７    変換器
４７ａ  SATブロック
４７ｂ  BSEQブロック
４７ｃ  MSKGENブロック
４７ｄ  VSUMBブロック
４７ｅ  BCNTブロック
４７ｆ  ILブロック
５０    Ｉ／Ｆ部
６０    命令メモリ部
７０    データメモリ部
８０    拡張レジスタ部
９０    Ｉ／Ｏインターフェース部
【図１】
2006338684.tif 000013
【図２】
2006338684.tif 000014
【図３】
2006338684.tif 000015
【図４】
2006338684.tif 000016
【図５】
2006338684.tif 000017
【図６】
2006338684.tif 000018
【図７】
2006338684.tif 000019
【図８】
2006338684.tif 000020
【図９】
2006338684.tif 000021
【図１０】
2006338684.tif 000022
【図１１】
2006338684.tif 000023
【図１２】
2006338684.tif 000024
【図１３】
2006338684.tif 000025
【図１４】
2006338684.tif 000026
【図１５】
2006338684.tif 000027
【図１６】
2006338684.tif 000028
【図１７】
2006338684.tif 000029
【図１８】
2006338684.tif 000030
【図１９】
2006338684.tif 000031
【図２０】
2006338684.tif 000032
【図２１】
2006338684.tif 000033
【図２２】
2006338684.tif 000034
【図２３】
2006338684.tif 000035
【図２４】
2006338684.tif 000036
【図２５】
2006338684.tif 000037
【図２６】
2006338684.tif 000038
【図２７】
2006338684.tif 000039
【図２８】
2006338684.tif 000040
【図２９】
2006338684.tif 000041
【図３０】
2006338684.tif 000042
【図３１】
2006338684.tif 000043
【図３２】
2006338684.tif 000044
【図３３】
2006338684.tif 000045
【図３４】
2006338684.tif 000046
【図３５】
2006338684.tif 000047
【図３６】
2006338684.tif 000048
【図３７】
2006338684.tif 000049
【図３８】
2006338684.tif 000050
【図３９】
2006338684.tif 000051
【図４０】
2006338684.tif 000052
【図４１】
2006338684.tif 000053
【図４２】
2006338684.tif 000054
【図４３】
2006338684.tif 000055
【図４４】
2006338684.tif 000056
【図４５】
2006338684.tif 000057
【図４６】
2006338684.tif 000058
【図４７】
2006338684.tif 000059
【図４８】
2006338684.tif 000060
【図４９】
2006338684.tif 000061
【図５０】
2006338684.tif 000062
【図５１】
2006338684.tif 000063
【図５２】
2006338684.tif 000064
【図５３】
2006338684.tif 000065
【図５４】
2006338684.tif 000066
【図５５】
2006338684.tif 000067
【図５６】
2006338684.tif 000068
【図５７】
2006338684.tif 000069
【図５８】
2006338684.tif 000070
【図５９】
2006338684.tif 000071
【図６０】
2006338684.tif 000072
【図６１】
2006338684.tif 000073
【図６２】
2006338684.tif 000074
【図６３】
2006338684.tif 000075
【図６４】
2006338684.tif 000076
【図６５】
2006338684.tif 000077
【図６６】
2006338684.tif 000078
【図６７】
2006338684.tif 000079
【図６８】
2006338684.tif 000080
【図６９】
2006338684.tif 000081
【図７０】
2006338684.tif 000082
【図７１】
2006338684.tif 000083
【図７２】
2006338684.tif 000084
【図７３】
2006338684.tif 000085
【図７４】
2006338684.tif 000086
【図７５】
2006338684.tif 000087
【図７６】
2006338684.tif 000088
【図７７】
2006338684.tif 000089
【図７８】
2006338684.tif 000090
【図７９】
2006338684.tif 000091
【図８０】
2006338684.tif 000092
【図８１】
2006338684.tif 000093
【図８２】
2006338684.tif 000094
【図８３】
2006338684.tif 000095
【図８４】
2006338684.tif 000096
【図８５】
2006338684.tif 000097
【図８６】
2006338684.tif 000098
【図８７】
2006338684.tif 000099
【図８８】
2006338684.tif 000100
【図８９】
2006338684.tif 000101
【図９０】
2006338684.tif 000102
【図９１】
2006338684.tif 000103
【図９２】
2006338684.tif 000104
【図９３】
2006338684.tif 000105
【図９４】
2006338684.tif 000106
【図９５】
2006338684.tif 000107
【図９６】
2006338684.tif 000108
【図９７】
2006338684.tif 000109
【図９８】
2006338684.tif 000110
【図９９】
2006338684.tif 000111
【図１００】
2006338684.tif 000112
【図１０１】
2006338684.tif 000113
【図１０２】
2006338684.tif 000114
【図１０３】
2006338684.tif 000115
【図１０４】
2006338684.tif 000116
【図１０５】
2006338684.tif 000117
【図１０６】
2006338684.tif 000118
【図１０７】
2006338684.tif 000119
【図１０８】
2006338684.tif 000120
【図１０９】
2006338684.tif 000121
【図１１０】
2006338684.tif 000122
【図１１１】
2006338684.tif 000123
【図１１２】
2006338684.tif 000124
【図１１３】
2006338684.tif 000125
【図１１４】
2006338684.tif 000126
【図１１５】
2006338684.tif 000127
【図１１６】
2006338684.tif 000128
【図１１７】
2006338684.tif 000129
【図１１８】
2006338684.tif 000130
【図１１９】
2006338684.tif 000131
【図１２０】
2006338684.tif 000132
【図１２１】
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【図１２２】
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【図３７７】
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【図３７８】
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【図３７９】
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【図３８０】
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【図３８１】
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【図３８２】
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【図３８３】
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【図３８４】
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【図３８５】
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【図３８６】
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【図３８７】
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【図３８８】
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【図３８９】
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【図３９０】
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【図３９１】
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【図３９２】
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【図３９３】
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【図６６７】
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【図６６８】
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【図６６９】
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【図６７０】
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【図６７１】
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【図６７２】
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【図６７５】
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【図６７６】
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【図６７９】
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【図６８０】
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【図６８８】
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【図６８９】
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【図６９０】
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【図７００】
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【図７４７】
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【図７４８】
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