(57)【要約】【課題】  基板により引き起こされる損失を改善するための、損失性基板上で用いられるオンチップ回路パッドを提供すること。【解決手段】  ミリメートル波アプリケーションにおいて基板により引き起こされる損失を減少させる分路伝送ライン・スタブを含ませることによって寄生容量を調整する、遮蔽された回路パッドが提供される。回路パッドは、シールドが該回路パッドの下方に配置され、分路伝送ライン・スタブが該回路パッドに取り付けられた状態で、基板上に配置される。したがって、ミリメートル波アプリケーションのための、制御されたインピーダンスが得られる。次に、回路パッドとシールドとの間の間隔を最小にすることができる。【選択図】      図５
2006191027.tif 000002
【特許請求の範囲】
【請求項１】
基板と、
前記基板上の回路パッドと、
前記回路パッドの下方のシールドと、
前記回路パッドに取り付けられた分路伝送ライン・スタブと、
を備えることを特徴とするデバイス。
【請求項２】
前記基板が損失性基板からなる、請求項１に記載のデバイス。
【請求項３】
前記デバイスがミリメートル波アプリケーションにおいて設けられる、請求項１に記載のデバイス。
【請求項４】
前記分路伝送ライン・スタブが寄生容量を調整してなくするものである、請求項１に記載のデバイス。
【請求項５】
前記分路伝送ライン・スタブが前記シールドに短絡されている、請求項４に記載のデバイス。
【請求項６】
前記分路伝送ライン・スタブが、コンデンサ又は直線ビアの一方によって前記シールドに短絡されている、請求項１に記載のデバイス。
【請求項７】
前記回路パッドと前記シールドとの間の間隔をさらに含み、前記間隔が最小にされる、請求項１に記載のデバイス。
【請求項８】
制御されたインピーダンスをさらに含む、請求項１に記載のデバイス。
【請求項９】
前記回路パッドへの給電ラインをさらに含み、前記給電ラインは、オフチップ負荷インピーダンスと同じ特性ライン・インピーダンスを含む、請求項８に記載のデバイス。
【請求項１０】
第２の基板、前記第２の基板上の第２の回路パッド、前記第２の回路パッドの下方の第２のシールド、及び該第２の回路パッドに取り付けられた第２の分路伝送ライン・スタブをさらに含み、前記デバイスが差動型パッド構造からなる、請求項１に記載のデバイス。
【請求項１１】
集積チップと、
前記集積チップ上の接地パッドと、
前記集積チップ上の回路パッドと、
前記回路パッドの下方のシールドと、
前記回路パッドに取り付けられた分路伝送ライン・スタブと、
前記集積チップ上の前記回路パッド及び前記接地パッドに接続されたリードフレームと、
を備えることを特徴とする集積回路パッケージ。
【請求項１２】
前記リードフレームは、ワイヤ・ボンディング及びフリップ・チップ型ボール・ボンディングの一方によって、前記回路パッド及び前記接地パッドに接続される、請求項１１に記載の集積回路チップ。
【請求項１３】
回路パッドを準備するステップと、
前記回路パッドに接続される伝送ライン・スタブの長さを求めるステップと、
前記回路パッドへの給電ラインに対するインピーダンスを求めるステップと、
を含み、
オンチップの給電ラインが、オフチップ負荷インピーダンスと同じ特性ライン・インピーダンスを有することを特徴とする方法。
【請求項１４】
前記回路パッドの容量を求めるステップをさらに含む、請求項１３に記載の方法。
【請求項１５】
前記回路パッドの前記容量が共振されるように、前記伝送ライン・スタブの長さが選択される、請求項１４に記載の方法。
【請求項１６】
前記オフチップ負荷インピーダンスが、オンチップの回路に接続された給電ラインの端部において現れるものである、請求項１３に記載の方法。
【請求項１７】
寄生容量が調整されてなくされる、請求項１３に記載の方法。
【請求項１８】
前記給電ラインに対する前記インピーダンスが該給電ラインの長さとは無関係である、請求項１３に記載の方法。
【請求項１９】
ミリメートル波アプリケーションが適用される、請求項１３に記載の方法。
【請求項２０】
前記回路パッドの下方にシールドを準備するステップと、該回路パッドと前記シールドとの間の間隔を最小にするステップとをさらに含む、請求項１３に記載の方法。
【発明の詳細な説明】
【技術分野】
【０００１】
本発明は、一般に、ミリメートル波周波数範囲で作動する回路のためのオンチップ回路パッドに関し、より具体的には、基板により引き起こされる損失を改善するための、損失性基板上で用いられるオンチップ回路パッドに関する。
【背景技術】
【０００２】
ミリメートル波周波数範囲で作動する電子製品は、例えば、パーソナル・エリア・ネットワーク及び自動車のレーダーのような用途に必要な速度及び電力を提供するために、ヒ化ガリウム（ＧａＡｓ）又はリン化インジウム（ＩｎＰ）の半導体技術に基づくことができる。しかしながら、コスト及び電力消費を低減させるために、これらのヒ化ガリウム（ＧａＡｓ）又はリン化インジウム（ＩｎＰ）ベースの半導体製品のシステム・サイズを劇的に減少させることが必要である。
【０００３】
例えば、高度な無線集積回路のためといった、ミリメートル波周波数範囲における速度及び電力の解決法を提供するために、シリコン・ゲルマニウム（ＳｉＧｅ）プロセス技術が、良い位置につけることが実証された。しかしながら、標準的なシリコン基板は、通常、低い抵抗率を有するので、ミリメートル波周波数において、基板がオンチップ相互接続の信号損失に大きな影響を与えることがある。このように、ミリメートル波周波数において、損失性基板は、入出力接続の物理的サイズによって、例えば、入出力接続（ＩＯ）の信号損失に大きな影響を与えることがある。
【０００４】
オンチップ回路パッドのような入出力接続は、より低い周波数の作動のために設計されている。図１及び図２は、基板上に設けられたオンチップ回路パッドの例示的な実施形態の正面図及び側面図を示す。図１及び図２に示されるように、オンチップ回路パッドは、例えば、八角形の形状を有する上部金属板１１０からなることができる。このパッドは、例えば、ワイヤ・ボンディング又はフリップ・チップ型ボール・パッケージングのための空間構造を提供するように、１００μｍ×１００μｍのような十分大きいものであることを理解すべきである。
【０００５】
図１及び図２に示されるように、回路パッド１１０が基板１００上に設けられ、そこでは、該基板１００によって生じる損失を減少させるために、中実の金属シールド１１２が、該回路パッド１１０の下方に設けられる。図１及び図２に示される実施形態において、回路パッド１１０と金属シールド１１２との間の間隔（ｓｐａｃｉｎｇ）ｈ１が基板１００上に与えられ、該回路パッド１１０と該金属シールド１１２との間に形成される寄生容量を最小にするように、この間隔ｈ１が最大にされる。つまり、間隔ｈ１が増大するにつれて、寄生容量が減少する。
【０００６】
図１及び図２に示されるように、パッド構造体を、入力バッファ又は出力ドライバのようなオンチップ回路に接続するために、給電ライン１１４が提供される。典型的な通信システムにおいて、この構造体は、低雑音増幅器又は電力増幅器とすることができる。
【発明の開示】
【発明が解決しようとする課題】
【０００７】
構造体の大きな寄生容量のために、ミリメートル波周波数範囲で作動させること、図１及び図２の例示的な実施形態におけるような、中実の金属シールドをオンチップ回路パッドのすぐ下に設けることは、通常、望ましいことでない。
【課題を解決するための手段】
【０００８】
したがって、本発明の種々の例示的な実施形態によると、寄生容量が分路伝送ライン・スタブ（ｓｈｕｎｔ  ｔｒａｎｓｍｉｓｓｉｏｎ  ｌｉｎｅ  ｓｔｕｂｓ）によって調整されてなくされる（ｔｕｎｅ  ｏｕｔ）、改善した遮断された回路パッドが提供される。パッド容量を効果的に無効にするように、線路スタブ（ｌｉｎｅ  ｓｔｕｂｓ）を含ませることができ、組み合わされた構造体が、オフチップ電源とオンチップ回路との間で高インピーダンス・ノードだけを示す。このように、シールドは決して回路の性能に影響を及ぼすものではなく、それ以上考慮することなくシールドを用い、ミリメートル波アプリケーションにおいて基板により誘発された損失を減少させることができる。
【０００９】
本発明の種々の例示的な実施形態によると、基板と、該基板上に配置された回路パッドと、該回路パッドの下方に配置されたシールドと、該回路パッドに取り付けられた分路伝送ライン・スタブとを含むデバイスが提供される。
【００１０】
本発明の種々の例示的な実施形態によると、寄生容量を調整してなくする（ｔｕｎｅ  ｏｕｔ）方法が提供される。
【００１１】
これらの例示的な実施形態において、方法が、パッド容量を求めるステップと、回路パッドに接続される所要スタブ長を求めるステップと、外部電源又は負荷インピーダンスを入力するステップと、オンチップの給電ラインについてのインピーダンスとして外部電源又は負荷インピーダンスを提供するステップとを含む。
【００１２】
本発明の種々の例示的な実施形態によると、ミリメートル波アプリケーションのために、制御されたインピーダンスが得られる。すなわち、調整された回路パッドが高インピーダンス・ノードを表すので、回路パッドは、動作帯域において、電気的に透明であるとみなすことができる。したがって、オフチップ負荷又は電源インピーダンスは、決して変えられず、給電ラインへの入力において現れる（ｖｉｓｉｂｌｅ）。すなわち、オンチップの給電ラインが、オフチップ電源又は負荷インピーダンスと同じ特性ライン・インピーダンスを有するように選択される場合には、該オフチップ電源又は負荷インピーダンスは、オンチップ回路に接続されている給電ラインの他方の端部においても現れる。このインピーダンスは、給電ラインの長さに左右されるものではない。したがって、給電ラインの長さは問題ではなく、如何なるインピーダンス整合ネットワークにおいても考慮する必要がない。
【００１３】
このように、本発明の種々の例示的な実施形態によると、給電ラインの長さは、オンチップ回路を回路パッドに接続するのに必要とされるいずれの長さを有することもできる。
【００１４】
本発明の種々の例示的な実施形態によると、オンチップ回路への如何なる損傷もなく、回路パッドとシールドとの間の間隔を最小にすることができる。
【００１５】
本発明のこれら及び他の例示的な実施形態、態様、目的、特徴、及び利点が説明され、又は、添付の図面と共に読まれる例示的な実施形態の以下の詳細な説明から明らかになるであろう。
【発明を実施するための最良の形態】
【００１６】
図３及び図４は、それぞれ、本発明の例示的な実施形態による、基板上に設けられた例示的なオンチップ回路及びこれに取り付けられた伝送ライン・スタブの正面図及び側面図である。より具体的には、図３及び図４は、損失性基板２００上に設けられた例示的なオンチップ回路パッド２１０及び伝送ライン・スタブ２１２を示しており、図３は、基板２００の平面図を概略的に示し、図４は、線ＩＩ−ＩＩ´に沿って取られた図３の基板２００の概略的な断面図である。
【００１７】
ここで図３及び図４を参照すると、回路パッド２１０が、図１及び図２の例示的なフレームワークに基づいて基板２００上に設けられる。基板２００は、例えば、溶融石英（ＳｉＯ２）、酸化アルミニウム、ポリスチレン、セラミック、テフロン・ベースの基板、ＦＲ４等のような誘電／絶縁材料、或いは低抵抗率又は高低効率のシリコン、若しくはヒ化ガリウム（ＧａＡｓ）、リン化インジウム（ＩｎＰ）等のような半導体材料を含む、何らかの適切な材料から構成できることを理解すべきである。
【００１８】
本発明の種々の例示的な実施形態によると、損失のない基板は必ずしもシールドを必要としないので、損失性（ｌｏｓｓｙ）基板を基板２００として用い得ることを理解すべきである。
【００１９】
本発明の種々の例示的な実施形態によると、回路パッド２１０は、ＤＣから１００ＧＨｚまでのような、あまり低い周波数でなく非常に広い帯域とすることができるが、一般的な通信システムの作動帯域をカバーするのに十分な程広い周波数帯域内にすることができることも理解すべきである。例えば、種々の例示的な実施形態において、帯域幅は、５０ＧＨｚから７０ＧＨｚまでをカバーすることができる。
【００２０】
図３及び図４に示されるように、回路パッド２１０には、該回路パッド２１０に取り付けられた伝送ライン・スタブ２２０が設けられている。図３及び図４に示される例示的な実施形態において、金属シールド２１２が、回路パッド２１０及び伝送ライン・スタブ２２０の下方に設けられている。この金属シールド２１２は、損失性基板２００によって生じる回路パッド２１０に対する損失を減少させるように、間隔ｈ２だけ、該回路パッド２１０及び伝送ライン・スタブ２２０の下方に設けられている。金属シールド２１２と共に回路パッド２１０及び伝送ライン・スタブ２２０は、基板２００の上部金属化層の一部として形成することができる。
【００２１】
図１及び図２のシールド１２０のような正方形状のシールドの代わりに伝送ライン・スタブ２２０を付加した結果、該伝送ライン・スタブ２２０の下方に突出部分を含む図３及び図４のシールド２１２が用いられる。しかしながら、シールド２１２は、本発明の種々の例示的な実施形態に従った図３及び図４に示される例示的な形状に制限されるものでなく、回路パッド２１０及び伝送ライン・スタブ２２０を遮蔽するための遮蔽機能を提供する如何なる形状も用い得ることを理解すべきである。
【００２２】
図３に示されるように、オンチップ給電を回路パッド２１０に提供するために、給電ライン２１４が設けられる。パッド構造体を、入力バッファ又は出力ドライバのようなオンチップ回路に接続するために、給電ライン２１４が設けられる。一般的な通信システムにおいて、パッド構造体は、低雑音増幅器又は電力増幅器とすることができる。ミリメートル波周波数において、給電ライン２１４は、信号分布又は望ましくない反射を最小にするように、特性インピーダンス（Ｚ０）を有する伝送ラインから作ることができる。パッド容量と協働して、外部のオフチップ電源からオンチップ集積回路への最適なインピーダンス整合を達成するように、給電ライン２１４の長さ及び幅のような大きさを選択することができる。特定の回路のためのインピーダンス整合を達成するために、コンデンサ、インダクタ、又は伝送ラインのような付加的な整合要素を必要とすることがあることを理解すべきである。
【００２３】
本発明の種々の例示的な実施形態によると、伝送ライン・スタブ２２０を分路して望ましくない寄生容量を調整してなくし、損失性基板によって生じる損失を減少させる。したがって、回路パッド２１０とシールド２１２との間の間隔ｈ２とは無関係に、寄生容量を調整することができる。このように、間隔ｈ２を最小にして、ラインの半導体バックエンドの金属スタック内の有効な遮蔽を行うことができる。例えば、抵抗率の低い接地（ｇｒｏｕｎｄ）シールドを提供するために、回路パッド２１０により近い、銅層のような厚い金属層を選択することができる。
【００２４】
図４に示されるように、コンデンサ２３０又は直線（ｓｔｒａｉｇｈｔ）ビアによって、最終的に、伝送ライン・スタブ２２０を接地シールド２１２に短絡させることができる。入力及び出力信号がＡＣ結合される用途に、簡単なビアを用い得ること、及びＤＣ結合された入力又は出力信号の場合には、短絡を防止するために、分路コンデンサが望まれることを理解すべきである。
【００２５】
述べられたように、ミリメートル波周波数で伝送ライン・スタブ２２０を短絡させることによって、望ましくない寄生容量がゼロまで減少されるか、又は調整される。こうしたミリメートル波周波数において、十分な帯域幅を有する作動の中心周波数において構造体が真のインピーダンスとなるように、分路伝送ライン・スタブ２２０の長さを選択することができる。この調整により、中心周波数において、回路パッド２１０が電気的に透明にされる。周波数が中心周波数から遠ざかるにつれて、回路パッド２１０はより透明でなくなる。しかしながら、パッド及びスタブ容量は、非常に低い品質係数を有するので、結合された構造体が非常に広い帯域幅を持つことができる。したがって、同様の特性インピーダンスを有するオンチップ伝送ラインを回路パッド２１０に接続し、インピーダンスを再整合する必要なしに、入出力信号をオンチップのいずれかの場所に伝えることができる。
【００２６】
本発明の種々の例示的な実施形態によると、ミリメートル波周波数のための制御されたインピーダンスが得られる。すなわち、調整された回路パッド２１０が高いインピーダンス・ノードを示すので、回路パッド２１０は、作動帯域において電気的に透明であるとみなすことができる。したがって、オフチップ負荷又は電源インピーダンスは、決して変更されず、給電ライン２１４への入力においても現れる。
【００２７】
種々の用途において、外部のオフチップ電源又は負荷インピーダンスは、５０オームとなるように選択することができる。オフチップ電源又は負荷インピーダンスと同じ５０オームの特性ライン・インピーダンスを有するように、オンチップ給電ライン２１４が選択される場合には、オフチップ電源又は負荷インピーダンスは、オンチップ回路に接続される給電ライン２１４の他方の端部においても現れる。このインピーダンスは、給電ライン２１４の長さに関係なく、一般に、伝送ラインの入力が従来技術のパッドにおけるように容量性である場合はそうではない。したがって、給電ライン２１４の長さは問題でなく、如何なるインピーダンス整合ネットワークにおいても考慮する必要がない。実際のチップ配置において、給電ライン２１４の長さが、オンチップ回路を回路パッド２１０に接続するのに必要とされる如何なる長さを有することもできるので、この設計は、非常に便利である。
【００２８】
本発明の種々の例示的な実施形態によると、パッド容量が共振される（ｒｅｓｏｎａｔｅｄ）ように、伝送ライン・スタブ２２０の長さが選択されることを理解すべきである。つまり、異なる回路パッド２１０は、より長いか又はより短いスタブ２２０を必要とする。
【００２９】
図５は、差動型（ｄｉｆｆｅｒｅｎｔｉａｌ）パッド構造体を形成するように、２つの回路パッドが組み合わされた、本発明の１つの例示的な実施形態を示す。図５に示される例示的な実施形態において、差動型回路には、ミリメートル波アプリケーションに広く用いられる接地・信号・接地構成が与えられる。しかしながら、本発明の実施形態は、この接地・信号・接地構成に制限されるものでなく、本発明に従った他の構成も用い得ることを理解すべきである。
【００３０】
図５に示されるように、回路パッド３１０及び３５０が基板３００上に設けられ、これらに、それぞれ分路スタブ３２０及び３６０が取り付けられる。これらにそれぞれに設けられたコンデンサ３３０及び３７０を用いて、伝送ラインを両端で短絡させることができる。図５に示される例示的な実施形態においては、空間の使用を減らすために、スタブ３２０及び３６０が曲げられている。しかしながら、本発明の例示的な実施形態は、いずれかの特定の構造に制限されるものではないことを理解すべきである。
【００３１】
金属シールド３１２は、回路パッド３１０及びスタブ３２０の下方に設けられ、金属シールド３５２は、回路パッド３５０及びスタブ３６０の下方に設けられている。図５に示されるように、シールド３１２の形状は、回路パッド３１０及びスタブ３２０の形状によって決定され、シールド３５２の形状は、回路パッド３２０及びスタブ３６０の形状によって決定される。
【００３２】
図５に示される例示的な実施形態において、回路パッド３１０及び３５０は、接地・信号・接地構成で提供され、代替的に、該回路パッド３１０及び３５０は、接地パッド３４２、３４４、及び３４６の間に提供される。
【００３３】
例示目的のために、本発明の例示的な実施形態は、特に、基板及びこうした基板を半導体集積回路パッケージ内に組み込むことに関して説明される。しかしながら、本発明は、一般に、例えば、所定の用途及び／又は作動周波数に適した基板の何らかの統合にも適用可能である。
【００３４】
より具体的には、図６は、半導体集積回路パッケージ内に組み込まれた、本発明の例示的な実施形態による例示的な基板の統合を示す。図６に示されるように、基板４００は、例えば、ワイヤ・ボンディングを介して回路パッケージ内に組み込まれたチップである。一般に、ボンディングは、チップと基板の間を相互接続し、電力分布及び信号分散のための電気経路を提供するために、半導体製造において広く用いられる。図６に示されるように、ワイヤ・ボンディングは、基板４００上の回路パッド４１０及び４５０並びに接地パッド４４２、４４４、及び４４６をリードフレーム４０００に接続するために提供される。
【００３５】
図６に示される例示的な実施形態において、接地パッド４４２、４４４、及び４４６は、それぞれワイヤ要素４８１、４８３、及び４８５を介して接地されたリードフレーム４０００に接続され、接地接続する。回路パッド４１０は、ワイヤ要素４８２を介して接続パッド４８００に接続されて正の電気経路を提供し、回路パッド４５０は、ワイヤ要素４８６を介して接続パッド４８１０に接続されて負の電気経路を提供する。
【００３６】
図６に示される例示的な実施形態において、ワイヤ要素４８１−４８６は、一端が基板４００の表面に取り付けられ、もう一方の端部がリードフレーム４０００の表面に取り付けられることになる。本発明は、図６に示されるワイヤ・ボンディング構造に限られるものではないこと、及び、例えばフリップ・チップ型ボール・ボンディングのような他の構造も用い得ることも理解すべきである。
【００３７】
例えば、図７は、本発明の例示的な実施形態による基板の、半導体集積回路パッケージ内への更に別の統合を示す。
【００３８】
より具体的には、図７は、電力及び信号分布のための電気経路を提供するために、例えばフリップ・チップ型ボール・ボンディングを介して回路パッケージ内に組み込まれたチップとしての基板５００を示す。図７に示されるように、基板５００上の回路パッド５１０及び５５０並びに接地パッド５４２、５４４、及び５４６をリードフレーム５０００に接続するために、フリップ・チップ型ボール・ボンディングが提供される。
【００３９】
図７に示される例示的な実施形態において、接地パッド５４２、５４４、及び５４６は、それぞれ接地ボール５８１、５８３、及び５８５を介して接地されたリードフレーム５０００に接続され、接地接続する。回路パッド５１０は、正の信号ボール５８２に接続されて正の電気経路を提供し、回路パッド５５０は、負の信号ボール５８６に接続されて負の電気経路を提供する。
【００４０】
本発明の例示的な実施形態による基板は、比較的小さいパッケージ内に組み込まれた集積回路チップとしてパッケージし、例えば、無線周波数（ＲＦ）又は無線通信チップを構築できることを理解すべきである。例えば、図６及び図７は、アンテナ及び集積回路チップ内に、チップから別のチップに、又は単一のチップからそのパッケージだけに一体的にパッケージする概略的な斜視図とすることができる。そのような場合には、回路パッドは、ダイポール・アンテナのようなアンテナを、集積回路チップの集積回路に接続される差動給電のような組み込まれたアンテナ給電ネットワークに接続することを可能にする。給電ネットワークのフレームワークは、例えば、所定の用途及び／又はチップが接続されるデバイスのタイプのために望まれるインピーダンスによって変わる。
【００４１】
図６及び図７の例示的な実施形態は、基板のパッケージ化の例証となる実施形態にすぎないこと、及び当業者であれば本明細書の教示に基づいて他のフレームワークを容易に考え得ることを理解すべきである。
【００４２】
図８は、本発明の例示的な実施形態による、寄生容量を調整する例示的な方法のフローチャートを示す。ステップ６００で開始し、制御は、ステップ６１０に進み、そこで、回路パッドが調整システムに入力され、寄生容量を調整する。次に、６２０において、パッド容量を求める。パッド容量は、電磁シミュレーション又は測定によって求めることができることを理解すべきである。次に、制御は、ステップ６３０に進む。
【００４３】
ステップ６３０において、回路パッドに接続される所要のスタブ長を求める。シミュレータにおける分析計算又は電気伝送ラインモデルを用いて、本発明の種々の例示的な実施形態に従った所要のスタブ長を見出すことができる。本発明の種々の例示的な実施形態によると、パッド容量が共振されるように伝送ライン・スタブの長さが選択されることを理解すべきである。
【００４４】
次に、ステップ６４０において、外部電源又は負荷インピーダンスが入力される。上述のように、種々の用途において、外部のオフチップ電源又は負荷インピーダンスは、５０オームになるように選択することができる。次に、ステップ６５０において、外部電源又は負荷インピーダンスが、オンチップの給電ラインのためのインピーダンスとして提供される。したがって、オンチップの給電ラインは、該オンチップの給電ラインがオフチップ電源又は負荷インピーダンスと同じ５０オームの特性ライン・インピーダンスを有するように選択され、次に、オフチップ電源又は負荷インピーダンスは、オンチップ回路に接続される給電ラインの他方の端部においても現れる。このインピーダンスは、給電ラインの長さに関係なく、よって給電ラインの長さは問題でなく、如何なるインピーダンス整合ネットワークにおいても考慮する必要がない。
【００４５】
次に、制御は、ステップ６６０に進み、ここでプロセスが終了する。
【００４６】
本発明による基板、及びパッケージ内への該基板の統合は、集積位相アレイ・システム、パーソナル・エリア・ネットワーク、レーダー給電、冗長性に起因する高信頼性、ポイント・ツー・ポイント・システム等のような多数の用途を可能にすることを理解すべきである。さらに、本発明による集積回路チップ・パッケージの使用は、空間、サイズ、コスト、及び重量を著しく節約するものであり、このことは、事実上何らかの商業用途又は軍事用途のためのプレミアムである。
【００４７】
例示目的のために添付図面を参照して例示的な実施形態を説明したが、本発明は、これらの正確な実施形態に限られるものでなく、当業者であれば、本発明の範囲から逸脱することなく、他の種々の変更及び修正をなすことができることを理解すべきである。
【図面の簡単な説明】
【００４８】
【図１】基板上に設けられたオンチップ回路パッドの例示的な周知の実施形態の正面図である。
【図２】基板上に設けられたオンチップ回路パッドの例示的な周知の実施形態の側面図である。
【図３】本発明による、基板上に設けられた分路伝送ライン・スタブを有するオンチップ回路パッドの例示的な実施形態の正面図である。
【図４】本発明による、基板上に設けられた分路伝送ライン・スタブを有するオンチップ回路パッドの例示的な実施形態の正面図である。
【図５】差動型パッド構造体のために２つの回路パッドが組み合わせられた、本発明の１つの例示的な実施形態を示す。
【図６】ワイヤ・ボンディング技術を用いて、例示的な半導体集積回路パッケージ内に組み込まれた、本発明の例示的な実施形態による例示的な基板を示す。
【図７】フリップ・チップ型ボンディング技術を用いて、更に別の例示的な半導体集積回路パッケージ内に組み込まれた、本発明の１つの例示的な実施形態による例示的な基板を示す。
【図８】本発明の例示的な実施形態に従って寄生容量を調整する例示的な方法のフローチャートを示す。
【符号の説明】
【００４９】
２００、３００、４００、５００：基板
１１０、２１０、３１０、３５０、４１０、４５０、５１０、５５０：回路パッド
１１４、２１４：給電ライン
１２０、２１２、３１２、３５２：シールド
２２０、３２０、３６０：伝送ライン・スタブ
２３０、３３０、３７０：コンデンサ
３４２、３４４、３４６、４４２、４４４、４４６、５４２、５４４、５４６：接地パッド
４８１、４８２、４８３、４８４、４８５、４８６：ワイヤ要素
５８１、５８３、５８５：接地ボール
４０００、５０００：リードフレーム
４８００、４８１０：接続パッド
【図１】
2006191027.tif 000003
【図２】
2006191027.tif 000004
【図３】
2006191027.tif 000005
【図４】
2006191027.tif 000006
【図５】
2006191027.tif 000007
【図６】
2006191027.tif 000008
【図７】
2006191027.tif 000009
【図８】
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