(57)【要約】【課題】ラインメモリへのアクセス動作の安定性を向上する。【解決手段】メモリ制御部１２３は、ラインメモリ２０９を構成する２４個のＳＲＡＭ素子からなるメモリ素子２１１を備える。メモリ制御部１２３は、書込アドレス生成部２０５において用いる書込アドレスの生成パターンおよび読出アドレス生成部２４７において用いる読出アドレスの生成パターンを切り換えるＬＥＤタイプ判断部２４３を備える。【選択図】図２
2006175695.tif 000002
【特許請求の範囲】
【請求項１】
ＬＥＤヘッドに接続するラインメモリを制御するメモリ制御装置であって、
前記ラインメモリを構成する複数のメモリ素子と、
外部からデータを受信する受信手段と、
前記受信手段が受信したデータを前記ラインメモリに書き込む書込手段と、
前記書込手段におけるデータの書込アドレスを生成する書込アドレス生成手段と、
前記書込アドレス生成手段における前記書込アドレスの生成パターンを複数記憶する書込パターン記憶部と、
前記ＬＥＤヘッドにデータを送信する送信手段と、
前記ラインメモリからデータを読み出して前記送信手段に送信する読出手段と、
前記読出手段におけるデータの読出アドレスを生成する読出アドレス生成手段と、
前記読出アドレス生成手段における前記読出アドレスの生成パターンを複数記憶する読出パターン記憶手段と、
前記書込アドレス生成手段において用いる前記書込アドレスの生成パターンおよび前記読出アドレス生成手段において用いる前記読出アドレスの生成パターンを切り換える選択器と、
を備えるメモリ制御装置。
【請求項２】
請求項１に記載のメモリ制御装置において、
前記メモリ素子は、ＳＲＡＭ素子であるメモリ制御装置。
【請求項３】
請求項１または２に記載のメモリ制御装置において、
前記ＬＥＤヘッドの種類を記憶するＬＥＤヘッド種類記憶手段をさらに備え、
前記選択器は、前記ＬＥＤヘッド記憶手段から前記ＬＥＤヘッドの種類を示す情報を取得し、前記情報に基づいて、前記書込アドレスの生成パターンおよび前記読出アドレスの生成パターンを切り換えるように構成されているメモリ制御装置。
【請求項４】
請求項１乃至３いずれかに記載のメモリ制御装置を備える画像形成装置。
【発明の詳細な説明】
【技術分野】
【０００１】
本発明は、メモリ制御装置およびそれを用いる画像形成装置に関する。
【背景技術】
【０００２】
従来のＬＥＤプリンタ装置としては、例えば特許文献１に記載されたものがある。同文献に記載されたＬＥＤプリンタ装置を図１１に示す。このＬＥＤプリンタ装置では、ＣＰＵ１は、湿度センサ２２による周囲湿度の検出結果を読み込む。ＣＰＵ１は、１ライン分の画データの印刷に際して、温度センサ２１の検出結果および湿度センサ２２の検出結果に従って感光体ドラム２３の最適な露光時間、すなわち、ＬＥＤプリントヘッド８０を構成するＬＥＤ素子の発光時間をたとえばＲＯＭ２に予め記憶されているテーブルから読み込む等して決定する。
【０００３】
この構成によれば、周囲温度および周囲湿度の影響を抑制して所定濃度の印刷画像を得ることができるＬＥＤプリンタ装置が得られる旨、特許文献１に記載されている。
【特許文献１】特開２００３−３１２０５７号公報
【発明の開示】
【発明が解決しようとする課題】
【０００４】
しかしながら、上記文献記載のＬＥＤプリンタ装置においては、複数機種の生産に用いるラインメモリを共通化する場合、それぞれのＬＥＤプリンタ装置の機種の仕向、仕様などにあわせてラインメモリへのデータの書き込みパターン・読み出しパターンを使い分けする必要がある。このため、ラインメモリの構成、使用方法を分けなければならない場合に、ラインメモリをある程度大きいサイズで用意し、高速でアクセス（読み出し、書き込み）する必要がある。
【０００５】
その結果、大きい容量のラインメモリを用いる場合には、ラインメモリの配置としてはエリアが小さくなり物理面積は小さく済むが、高速アクセスによりアクセス動作が不安定になりやすい。よって、ラインメモリへのアクセスの高速動作が必要でタイミング調整が難しくなり、ノイズが発生しやすいなどの課題を抱えている。また、アクセス動作を安定させるためには、大容量のバッファを用いてアクセス時間を調整してデータを出力する必要があるという課題もある。
【課題を解決するための手段】
【０００６】
本発明によれば、
ＬＥＤヘッドに接続するラインメモリを制御するメモリ制御装置であって、
前記ラインメモリを構成する複数のメモリ素子と、
外部からデータを受信する受信手段と、
前記受信手段が受信したデータを前記ラインメモリに書き込む書込手段と、
前記書込手段におけるデータの書込アドレスを生成する書込アドレス生成手段と、
前記書込アドレス生成手段における前記書込アドレスの生成パターンを複数記憶する書込パターン記憶手段と、
前記ＬＥＤヘッドにデータを送信する送信手段と、
前記ラインメモリからデータを読み出して前記送信手段に送信する読出手段と、
前記読出手段におけるデータの読出アドレスを生成する読出アドレス生成手段と、
前記読出アドレス生成手段における前記読出アドレスの生成パターンを複数記憶する読出パターン記憶手段と、
前記書込アドレス生成手段において用いる前記書込アドレスの生成パターンおよび前記読出アドレス生成手段において用いる前記読出アドレスの生成パターンを切り換える選択器と、
を備えるメモリ制御装置が提供される。
【０００７】
この構成によれば、ラインメモリを小さいサイズの複数のメモリ素子に分けることができる。このため、メモリ素子より大きい仕様のメモリ空間を用いるラインメモリ使用パターンを選択する場合は、カスケード方式、パラレル方式などの扱いやすい構成に複数のメモリ素子を接続することにより、高速アクセスを減らすことができる。その結果、この構成によれば、複数のメモリ素子へのアクセスのタイミング検証、調整を容易にし、ノイズの発生を抑えることにより、ラインメモリへのアクセス動作の安定性を向上できる。
【０００８】
また、本発明によれば、上記のメモリ制御装置を備える画像形成装置が提供される。この構成によれば、上述のメモリ制御装置の場合と同様の作用により、ラインメモリへのアクセス動作の安定性を向上できる。
【発明の効果】
【０００９】
本発明によれば、複数のメモリ素子からなるラインメモリを備えるため、ラインメモリへのアクセス動作の安定性を向上できる。
【発明を実施するための最良の形態】
【００１０】
本発明に係るメモリ制御装置において、上記メモリ素子は、ＳＲＡＭ素子としてもよい。この構成によれば、ＳＲＡＭ素子は、外部バスインターフェースが一定周期のクロック信号に同期して動作するため、メモリ素子へのアクセス動作の安定性が向上する。
【００１１】
本発明に係るメモリ制御装置は、ＬＥＤヘッドの種類を記憶するＬＥＤヘッド種類記憶手段をさらに備えてもよい。この場合、上記選択器は、ＬＥＤヘッド記憶手段からＬＥＤヘッドの種類を示す情報を取得し、この情報に基づいて、書込アドレスの生成パターンおよび読出アドレスの生成パターンを切り換えるように構成することができる。
【００１２】
この構成によれば、あらかじめＬＥＤヘッドの種類が記憶されたＬＥＤヘッド記憶手段を備えるため、ＬＥＤヘッドの種類を検出するための検出手段および検出動作を省略することができる。また、このため、メモリ制御装置を小型化し、動作を迅速化できる。
【００１３】
以下、本発明の実施の形態について、図面を用いて説明する。尚、すべての図面において、同様な構成要素には同様の符号を付し、適宜説明を省略する。
【００１４】
<実施形態１>
図１は、本実施の形態に係る画像形成装置１１０の構成を説明するための機能ブロック図である。本実施形態では、画像形成装置１１０は、複合型カラープリンタであり、スキャナ機能やコピー機能を有する。図１は、本発明に関連する主要な要素を示している。
【００１５】
画像形成装置１１０の各構成要素は、任意のコンピュータのＣＰＵ、メモリ、メモリにロードされた本図の構成要素を実現するプログラム、そのプログラムを格納するハードディスクなどの記憶ユニット、ネットワーク接続用インターフェースを中心にハードウェアとソフトウェアの任意の組合せによって実現される。そして、その実現方法、装置には、いろいろな変形例があることは、当業者には理解されるところである。すなわち、本明細書において説明する各図は、ハードウェア単位の構成ではなく、機能単位のブロックを示している。
【００１６】
画像形成装置１１０は、例えばネットワークファクシミリ装置、ＭＦＰ（Ｍｕｌｔｉ  Ｆｕｎｃｔｉｏｎａｌ  Ｐｅｒｉｐｈｅｒａｌ）などである。画像形成装置１１０は、ネットワーク１４１を介して、サーバ１４５、ＦＡＸ端末１３１、Ｅ−ｍａｉｌ端末１３３、Ｉ−ＦＡＸ端末１３５に接続される。なお、ネットワークとは、ＬＡＮ、インターネット、公衆回線（ＰＳＴＮ）などのすべてを含む概念である。
【００１７】
画像形成装置１１０は、他の通信端末装置と複数の通信方式で通信が可能である。画像形成装置１１０は、例えばＦＡＸ（ファックスあるいはファクシミリ）端末１３１、Ｅ−ｍａｉｌ（Ｅメールまたは電子メール）端末１３３、Ｉ−ＦＡＸ（インターネットファックス）端末１３５およびサーバ１４５との通信が可能である。ＦＡＸ端末１３１は、ＰＳＴＮ（公衆交換電話網）を通じて通信する他のＧ３ファックス端末である。Ｅ−ｍａｉｌ端末１３３およびＩ−ＦＡＸ端末１３５は、インターネットなどのネットワークを介して通信する他のコンピュータおよび他のインターネットファックス端末などである。また、画像形成装置１１０とサーバ１４５とは、ＵＳＢなどのインターフェースで接続することもできる。画像形成装置１１０は、ネットワーク１４１、サーバ１４５（ファイルサーバ）、ＦＡＸ端末１３１、Ｅ−ｍａｉｌ端末１３３、Ｉ−ＦＡＸ端末１３５などとともに、画像形成システムを構築している。
【００１８】
画像形成装置１１０は、ＣＭＹＫタイプのＬＥＤヘッド１２５を備える。画像形成装置１１０は、ＬＥＤヘッド１２５に接続するメモリ制御部１２３を備える。画像形成装置１１０は、ＬＥＤヘッド１２５の種類を記憶する記憶装置１４３を備える。
【００１９】
より詳細に説明すると、画像形成装置１１０は、通信部１１１と、表示部１１５と、記憶装置１４３と、操作部１１３と、用紙搬送部１２１と、記録紙格納トレイ（不図示）と、中央制御部１１７と、メモリ制御部１２３と、ＬＥＤヘッド１２５とを備える。なお、図１において、本発明の本質に関わらない部分の構成については、省略してある。
【００２０】
通信部１１１は、ＦＡＸ端末１３１、Ｅ−ｍａｉｌ端末１３３、Ｉ−ＦＡＸ端末１３５およびサーバ１４５などを含む外部ネットワークに接続し、外部ネットワークから原稿画像データおよび原稿画像データを出力する際の部数を含む付属データを取得する。操作部１１３は、例えば操作ボタン、スイッチ、レバー、キーボード、タッチパネルなどである。表示部１１５は、各種情報表示、操作画面表示であり、画像形成装置１１０の動作や状態表示などを行う。表示部１１５は、例えばランプ、ＬＥＤ、ＣＲＴモニタ、液晶ディスプレイなどである。
【００２１】
中央制御部１１７は、画像形成装置１１０の各種要素とともに装置全体を制御する。記憶装置１４３は、電話帳などの情報を記憶する記憶領域を含んでもよい。
【００２２】
なお、ネットワーク１４１は、ファクシミリ方式、電子メール方式、あるいはその他の方式のいずれによりデータ通信を行うネットワークであってもよい。すなわち、ネットワーク１４１は、ＰＳＴＮ（公衆交換電話網）、ＬＡＮ、ＷＡＮ、あるいは他の通信網のいずれであってもよい。
【００２３】
図２は、実施の形態に用いるメモリ制御部の構成を説明するための機能ブロック図である。メモリ制御部１２３は、ＬＥＤヘッド１２５に接続するラインメモリ２０９を制御するように構成されている。なお、本実施の形態では、ラインメモリ２０９も、メモリ制御部１２３の一部である。
【００２４】
メモリ制御部１２３は、ラインメモリ２０９を構成する２４個の（複数）のＳＲＡＭ素子からなるメモリ素子２１１を備える。メモリ制御部１２３は、中央制御部１１７（外部）からデータを受信する受信部２０１を備える。
【００２５】
メモリ制御部１２３は、受信部２０１が受信したデータをラインメモリ２０９に書き込む書込部２０３を備える。メモリ制御部１２３は、書込部２０３におけるデータの書込アドレスを生成する書込アドレス生成部２０５を備える。すなわち、書込アドレス生成部２０５は、アドレスカウント機能を有し、このアドレスに基づいて書込部２０３がデータの並べ替えおよび書き込むタイミングの調整を行う。メモリ制御部１２３は、書込アドレス生成部２０５における書込アドレスの生成パターンを複数記憶する書込パターン記憶部２０７を備える。
【００２６】
メモリ制御部１２３は、ＬＥＤヘッド１２５にデータを送信する送信部２５１を備える。メモリ制御部１２３は、ラインメモリ２０９からデータを読み出して送信部２５１に送信する読出部２４５を備える。メモリ制御部１２３は、読出部２４５におけるデータの読出アドレスを生成する読出アドレス生成部２４７を備える。すなわち、読出アドレス生成部２４７は、アドレスカウント機能を有し、このアドレスに基づいて読出部２４５がデータの並べ替えおよび読み出すタイミングの調整を行う。メモリ制御部１２３は、読出アドレス生成部２４７における読出アドレスの生成パターンを複数記憶する読出パターン記憶部２４９を備える。
【００２７】
メモリ制御部１２３は、書込アドレス生成部２０５において用いる書込アドレスの生成パターンおよび読出アドレス生成部２４７において用いる読出アドレスの生成パターンを切り換えるＬＥＤタイプ判断部２４３（選択器）を備える。
【００２８】
１つの画像形成装置１１０（ＬＥＤプリンタ）においては、１つのメーカーのＬＥＤヘッド１２５（１種類のＬＥＤヘッド１２５）が用いられる。ＣＭＹＫの色相ごとにそれぞれ１本ずつＬＥＤヘッド１２５がある場合でも、あるいはＣＭＹＫの色相に対して共通のＬＥＤヘッド１２５が１本だけある場合でも、同様である。
【００２９】
ＬＥＤヘッド１２５に信号を送る際、ＬＥＤヘッド１２５のメーカーによってラインメモリ２０９の使い方が異なる。よって、各々のメーカーにあわせたラインメモリ２０９の使い方が必要になる。
【００３０】
一方、それぞれ異なるＬＥＤヘッド１２５を用いる３種類の画像形成装置１１０でメモリ制御部１２３を共用することにより、ラインメモリ２０９の種類を低減したい（製造コスト低減のため）という要望がある。そのため、３種類の画像形成装置１１０でメモリ制御部１２３を共通化しようとすると、メモリ制御部１２３は、通常の場合、３種類のラインメモリ２０９を備える必要がある。
【００３１】
そこで、本実施形態では、ラインメモリ２０９を構成する共通の最小メモリ単位であるメモリ素子２１１ごとにメモリ空間（バンク）の使用方法を切り換えることにより、それぞれ異なるＬＥＤヘッド１２５を用いる３種類の画像形成装置１１０でメモリ制御部１２３を共用している。
【００３２】
メモリ制御部１２３は、メモリ素子２１１に対しては、順次書き込み、順次読み込むため、メモリ素子２１１のアクセス（読み書き）に対してシフトレジスタは介していない。
【００３３】
ラインメモリ２０９を構成する２４個の（複数）のＳＲＡＭ素子からなるメモリ素子２１１の配置は、後述する３種類のどのタイプのＬＥＤヘッドを用いても対応できるメモリ素子２１１の配置である。なお、メモリ素子２１１は、ＡＳＩＣにより構成するＳＲＡＭのチップを用いることができる。もっとも、他の種類のメモリ（通常のＤＲＡＭやフラッシュメモリ）を用いることもできる。
【００３４】
図３は、実施の形態に用いるラインメモリの構成を説明するための機能ブロック図である。ここでは、ｔｙｐｅ１のＬＥＤヘッド１２５を用いている。すなわち、ｔｙｐｅ１のＬＥＤヘッド１２５のメモリ使用パターンにあわせて、２４個のメモリ素子２１１からなるラインメモリ２０９のメモリ空間（バンク＝Ｂａｎｋ）を構成している。
【００３５】
メモリ素子２１１ｆ、２１１ｓ、２１１ｔは、Ｂａｎｋ０を構成する。メモリ素子２１２ｆ、２１２ｓは、Ｂａｎｋ１を構成する。メモリ素子２２１ｆ、２２１ｓ、２２１ｔは、Ｂａｎｋ２を構成する。メモリ素子２２２ｆ、２２２ｓは、Ｂａｎｋ３を構成する。メモリ素子２３１ｆ、２３１ｓ、２３１ｔは、Ｂａｎｋ４を構成する。メモリ素子２３２ｆ、２３２ｓは、Ｂａｎｋ５を構成する。メモリ素子２４１ｆ、２４１ｓ、２４１ｔは、Ｂａｎｋ６を構成する。メモリ素子２４２ｆ、２４２ｓは、Ｂａｎｋ７を構成する。
【００３６】
なお、メモリ素子２１２ｔ、２２２ｔ、２３２ｔ、２４２ｔは、いずれのＢａｎｋにおいても用いられていない。
【００３７】
図４は、実施の形態に用いるラインメモリの構成を説明するための機能ブロック図である。ここでは、ｔｙｐｅ２のＬＥＤヘッド１２５を用いている。すなわち、ｔｙｐｅ２のＬＥＤヘッド１２５のメモリ使用パターンにあわせて、２４個のメモリ素子２１１からなるラインメモリ２０９のメモリ空間（バンク＝Ｂａｎｋ）を構成している。
【００３８】
メモリ素子２１１ｆ、２１１ｓ、２１１ｔ、２１２ｆ、２１２ｓ、２１２ｔは、Ｂａｎｋ０を構成する。メモリ素子２２１ｆ、２２１ｓ、２２１ｔ、２２２ｆ、２２２ｓ、２２２ｔは、Ｂａｎｋ１を構成する。メモリ素子２３１ｆ、２３１ｓ、２３１ｔ、２３２ｆ、２３２ｓ、２３２ｔは、Ｂａｎｋ２を構成する。メモリ素子２４１ｆ、２４１ｓ、２４１ｔ、２４２ｆ、２４２ｓ、２４２ｔは、Ｂａｎｋ３を構成する。
【００３９】
図５は、実施の形態に用いるラインメモリの構成を説明するための機能ブロック図である。ここでは、ｔｙｐｅ３のＬＥＤヘッド１２５を用いている。すなわち、ｔｙｐｅ３のＬＥＤヘッド１２５のメモリ使用パターンにあわせて、２４個のメモリ素子２１１からなるラインメモリ２０９のメモリ空間（バンク＝Ｂａｎｋ）を構成している。
【００４０】
メモリ素子２１１ｆ、２１１ｓ、２１１ｔ、２１２ｆ、２１２ｓ、２１２ｔ、２２１ｆ、２２１ｓ、２２１ｔ、２２２ｆ、２２２ｓ、２２２ｔは、Ｂａｎｋ０を構成する。メモリ素子２３１ｆ、２３１ｓ、２３１ｔ、２３２ｆ、２３２ｓ、２３２ｔ、２４１ｆ、２４１ｓ、２４１ｔ、２４２ｆ、２４２ｓ、２４２ｔは、Ｂａｎｋ１を構成する。
【００４１】
図６は、実施の形態に用いる書込アドレス生成部の構成を説明するための機能ブロック図である。書込アドレス生成部２０５は、ライトデータ加工モジュール６０１と、セレクター６０３とを備える。
【００４２】
ライトデータ加工モジュール６０１は、ライトヘッド転送信号およびシステムクロック信号を受信する。ライトデータ加工モジュール６０１からセレクター６０３へは、３種類のＬＥＤヘッド１２５のタイプに応じたライト信号およびライトアドレスがそれぞれ送信される。セレクター６０３から書込部２０３へは、選択されたＬＥＤヘッド１２５のタイプに応じたライト信号およびライトアドレスが送信される。
【００４３】
このとき、ライトデータ加工モジュール６０１は、ＬＥＤタイプ判断部２４３からＬＥＤヘッド１２５のタイプについての情報を受信すると、ＬＥＤヘッド１２５のタイプに応じた書込パターンを書込パターン記憶部２０７から取得する。ライトデータ加工モジュール６０１は、書込パターンに基づいて、ライトアドレスを生成する。
【００４４】
書込アドレス生成部２０５は、ライトデータ（書込データ）をＬＥＤヘッド１２５のタイプごとに特有の順番に（複数のメモリ素子２１１からなるラインメモリ２０９の構成とあわせて）変換し、データ数をカウントアップしながら、ライト信号およびライトアドレス（あわせて制御信号と称する）を送出する。その後、画データは書込部２０３においてＬＥＤヘッド１２５のタイプごとに特有の順番に並べ替えられ、４画素単位で制御されつつメモリ素子２１１に書き込まれる。
【００４５】
図７は、実施の形態に用いるラインメモリの構成を説明するための機能ブロック図である。図７（ａ）は、ラインメモリの１／３を８セット重ねた構成（１ライン分）を説明するための機能ブロック図である。メモリ素子２１１ｆ、２１２ｆ、２２１ｆ、２２２ｆ、２３１ｆ、２３２ｆ、２４１ｆ、２４２ｆは、それぞれ制御信号を受信し、画データに変換して送信する。
【００４６】
メモリ素子２１１ｆ、２１２ｆ、２２１ｆ、２２２ｆ、２３１ｆ、２３２ｆ、２４１ｆ、２４２ｆは、それぞれ８セットずつ積み重ねられており、それぞれ、１セット目から８セット目までのブロック順に、１〜１０２４ｄｏｔ、１０２５〜２０４８ｄｏｔ、２０４９〜３０７２ｄｏｔ、３０７３〜４０９６ｄｏｔ、４０９７〜５１２０ｄｏｔ、５１２１〜６１４４ｄｏｔ、６１４５〜７１６８ｄｏｔ、７１６９〜８１９２ｄｏｔのデータが書き込まれるように構成されている。
【００４７】
ＬＥＤヘッド１２５のタイプがｔｙｐｅ２の場合では、ラインメモリの１／３を８セット重ねた構成（１ライン分）の個々のブロックのデータ容量を必要最大画素数の１／８単位に構成する。すなわち、１ラインあたり全ドットとして７６８０画素が要求される場合、必要最大画素数の１／８画素（１０２４ドット）を、１２８ドット単位でメモリ素子２１１を切り替えて順に書き込む。１／８の画素数が終了すると、再度アドレスを上位のブロックにインクリメントし、同様に書き込む。
【００４８】
図７（ｂ）は、図７（ａ）で示す画データの送信後の処理を説明するための機能ブロック図である。送信された画データは、読出部２４５に受信される。また、ＬＥＤタイプ判断部２４３による画データ選択信号は、読出アドレス生成部２４７に受信される。読出アドレス生成部２４７は、ＬＥＤヘッドのタイプに応じた読出パターンを読出パターン記憶部２４９から取得し、読出パターンに基づいて、読出アドレスを生成して読出部２４５に送信する。読出部２４５は、読出アドレスに基づいて、画データを読み出してＬＥＤヘッドのタイプに応じて並べ替える。
【００４９】
図８は、実施の形態に用いるラインメモリの構成を説明するための機能ブロック図である。図８（ａ）は、ラインメモリの１／３を８セット重ねた構成（１ライン分）を説明するための機能ブロック図である。メモリ素子２１１ｆ、２１２ｆ、２２１ｆ、２２２ｆ、２３１ｆ、２３２ｆ、２４１ｆ、２４２ｆは、それぞれ制御信号を受信し、画データに変換して送信する。
【００５０】
ＬＥＤヘッド１２５のタイプがｔｙｐｅ２の場合では、ラインメモリの１／３を８セット重ねた構成（１ライン分）の個々のブロックのデータ容量を必要最大画素数の１／４単位に構成する。すなわち、１ラインあたり全ドットとして７６８０画素が要求される場合、７６８０／４＝１９２０なので、ラインメモリの１／３を８セット重ねた構成（１ライン分）の各ブロックは１９２０画素単位とする。
【００５１】
メモリ素子２１１ｆ、２１２ｆ、２２１ｆ、２２２ｆ、２３１ｆ、２３２ｆ、２４１ｆ、２４２ｆは、それぞれ８セットずつ積み重ねられており、それぞれのブロック順に、１〜１９２０ｄｏｔ、１９２１〜３８４０ｄｏｔ、３８４１〜５７６０ｄｏｔ、５７６１〜７６８０ｄｏｔのデータが書き込まれるように構成されている。
【００５２】
図８（ｂ）は、図８（ａ）で示す画データの送信後の処理を説明するための機能ブロック図である。送信された画データは、読出部２４５に受信される。また、ＬＥＤタイプ判断部２４３による画データ選択信号は、読出アドレス生成部２４７に受信される。読出アドレス生成部２４７は、ＬＥＤヘッドのタイプに応じた読出パターンを読出パターン記憶部２４９から取得し、読出パターンに基づいて、読出アドレスを生成して読出部２４５に送信する。読出部２４５は、読出アドレスに基づいて、画データを読み出してＬＥＤヘッドのタイプに応じて並べ替える。
【００５３】
図９は、実施の形態に用いるラインメモリの構成を説明するための機能ブロック図である。図９（ａ）は、ラインメモリの１／３を８セット重ねた構成（１ライン分）を説明するための機能ブロック図である。メモリ素子２１１ｆ、２１２ｆ、２２１ｆ、２２２ｆ、２３１ｆ、２３２ｆ、２４１ｆ、２４２ｆは、それぞれ制御信号を受信し、画データに変換して送信する。
【００５４】
ＬＥＤヘッド１２５のタイプがｔｙｐｅ３の場合では、ラインメモリの１／３を８セット重ねた構成（１ライン分）の個々のＢａｎｋのデータ容量を必要最大画素数の１／２単位で、ＯＤＤ、ＥＶＥＮごとに構成する。すなわち、１ラインあたり全ドットとして７６８０画素が要求される場合、７６８０／２＝３８４０なので、ラインメモリの１／３を８セット重ねた構成（１ライン分）の各Ｂａｎｋは３８４０画素単位で奇数／偶数で分ける構成とする。
【００５５】
メモリ素子２１１ｆ、２１２ｆ、２２１ｆ、２２２ｆ、２３１ｆ、２３２ｆ、２４１ｆ、２４２ｆは、それぞれ８セットずつ積み重ねられており、それぞれのブロック順に、奇数アドレスのみ１〜７６７９ｄｏｔ、偶数アドレスのみ２〜７６８０ｄｏｔのデータが書き込まれるように構成されている。
【００５６】
図９（ｂ）は、図９（ａ）で示す画データの送信後の処理を説明するための機能ブロック図である。送信された画データは、読出部２４５に受信される。また、ＬＥＤタイプ判断部２４３による画データ選択信号は、読出アドレス生成部２４７に受信される。読出アドレス生成部２４７は、ＬＥＤヘッドのタイプに応じた読出パターンを読出パターン記憶部２４９から取得し、読出パターンに基づいて、読出アドレスを生成して読出部２４５に送信する。読出部２４５は、読出アドレスに基づいて、画データを読み出してＬＥＤヘッドのタイプに応じて並べ替える。
【００５７】
以下、本実施の形態に係る画像形成装置の動作について説明する。
図１０は、本実施の形態に係る画像形成装置の動作を説明するためのフローチャートである。画像形成装置１１０の動作フローは、ＬＥＤタイプ判断部２４３にてレジスタの設定をすれば、ＬＥＤヘッド１２５ごとのメーカー対応に切り替わり、複数のメモリ素子２１１からなるラインメモリ２０９に対してライトしてリードするだけの単純なフローである。すなわち、一連のフローは、単純化すれば、「メーカー設定」→「各条件設定」→「印字動作開始」→「メモリライト」→「メモリリード」→「印字」となる。
【００５８】
詳しく説明すると、画像形成装置１１０の主電源が投入されると、ＬＥＤタイプ判断部２４３は、記憶装置１４３に記憶されているＬＥＤヘッド１２５の種類についての情報を読み込む（Ｓ１０１）。ＬＥＤタイプ判断部２４３は、読み込んだ情報に基づいて、ＬＥＤヘッド１２５の種類がｔｙｐｅ１、ｔｙｐｅ２、ｔｙｐｅ３のいずれであるか判断する（Ｓ１０３）。
【００５９】
ＬＥＤタイプ判断部２４３は、ＬＥＤヘッド１２５の種類がｔｙｐｅ１である場合には、書込アドレス生成部２０５および読出アドレス生成部２４７に判断結果を送信する。書込アドレス生成部２０５および読出アドレス生成部２４７は、書込パターン記憶部２０７および読出パターン記憶部２４９からそれぞれ設定を読み出して、ｔｙｐｅ１の各条件設定を行う（Ｓ１０５）。
【００６０】
ＬＥＤタイプ判断部２４３は、ＬＥＤヘッド１２５の種類がｔｙｐｅ２である場合には、書込アドレス生成部２０５および読出アドレス生成部２４７に判断結果を送信する。書込アドレス生成部２０５および読出アドレス生成部２４７は、書込パターン記憶部２０７および読出パターン記憶部２４９からそれぞれ設定を読み出して、ｔｙｐｅ２の各条件設定を行う（Ｓ１０７）。
【００６１】
ＬＥＤタイプ判断部２４３は、ＬＥＤヘッド１２５の種類がｔｙｐｅ３である場合には、書込アドレス生成部２０５および読出アドレス生成部２４７に判断結果を送信する。書込アドレス生成部２０５および読出アドレス生成部２４７は、書込パターン記憶部２０７および読出パターン記憶部２４９からそれぞれ設定を読み出して、ｔｙｐｅ３の各条件設定を行う（Ｓ１０９）。
【００６２】
いずれの場合においても、各条件設定が完了すると、中央制御部１１７は、各条件に基づいて印字動作を開始する（Ｓ１１１）。すなわち、中央制御部１１７は、印字すべきデータを受信部２０１に送信する。受信部２０１は、受信したデータを書込アドレス生成部２０５および書込部２０３に送信する。
【００６３】
書込アドレス生成部２０５は、書込パターンに基づいて書込アドレスを生成する。書込部２０３は、書込アドレスに基づいて、複数のメモリ素子２２１からなるラインメモリ２０９にデータを書き込む（メモリライトする）（Ｓ１１３）。
【００６４】
次いで、読出アドレス生成部２４７は、読出パターンに基づいて読出アドレスを生成する。読出部２４５は、読出アドレスに基づいて、複数のメモリ素子２２１からなるラインメモリ２０９からデータを読み出す（メモリリードする）（Ｓ１１５）。
【００６５】
読出部２５１は、読み出したデータを送信部２５１に送信する。送信部２５１は、データをＬＥＤヘッド１２５に送信する。ＬＥＤヘッドは、受信したデータに基づいて用紙に印字を行う（Ｓ１１７）。印字が完了すると、中央制御部１１７は、一連のフローを終了する。
【００６６】
以下、本実施の形態に係る画像形成装置１１０の作用効果について説明する。
画像形成装置１１０の構成によれば、ラインメモリ２０９を小さいサイズの複数のメモリ素子２１１に分けることができる。このため、メモリ素子２１１より大きい仕様のメモリ空間を用いるラインメモリ２０９の使用パターンを選択する場合は、カスケード方式、パラレル方式などの扱いやすい構成に複数のメモリ素子２１１を接続することにより、高速アクセスを減らすことができる。その結果、この構成によれば、複数のメモリ素子２１１へのアクセスのタイミング検証、調整を容易にし、ノイズの発生を抑えることにより、ラインメモリ２０９へのアクセス動作の安定性を向上できる。
【００６７】
画像形成装置１１０の構成によれば、上述の理由により、それぞれ異なるＬＥＤヘッド１２５を用いる３種類の画像形成装置１１０において、メモリ制御部１２３を共用することができる。そのため、ラインメモリ２０９およびメモリ制御部１２３の種類を低減することができる。その結果、ラインメモリ２０９、メモリ制御部１２３、画像形成装置１１０の製造コストおよび設計コストを低減することができる。
【００６８】
以上、図面を参照して本発明の実施形態について述べたが、これらは本発明の例示であり、上記以外の様々な構成を採用することもできる。
【００６９】
例えば、上記実施の形態では、小さいメモリサイズのメモリ素子２１１と、大きいメモリサイズのメモリ素子２１１とを混在して用いても良い。この場合、小さいメモリサイズのメモリ素子２１１に対して、大きいメモリサイズのメモリ素子２１１を偶数個接続することにより、消費電流の低減を行うことができる。
【００７０】
また、上記実施の形態では、メモリ素子２１１のメモリサイズには制限はないが、たとえば使用上最も小さいサイズで使用できる仕様にあわせることができる。
【図面の簡単な説明】
【００７１】
【図１】実施の形態に係る画像形成装置の構成を説明するための機能ブロック図である。
【図２】実施の形態に用いるメモリ制御部の構成を説明するための機能ブロック図である。
【図３】実施の形態に用いるラインメモリの構成を説明するための機能ブロック図である。
【図４】実施の形態に用いるラインメモリの構成を説明するための機能ブロック図である。
【図５】実施の形態に用いるラインメモリの構成を説明するための機能ブロック図である。
【図６】実施の形態に用いる書込アドレス生成部の構成を説明するための機能ブロック図である。
【図７】実施の形態に用いるラインメモリの構成を説明するための機能ブロック図である。
【図８】実施の形態に用いるラインメモリの構成を説明するための機能ブロック図である。
【図９】実施の形態に用いるラインメモリの構成を説明するための機能ブロック図である。
【図１０】本実施の形態に係る画像形成装置の動作を説明するためのフローチャートである。
【図１１】従来公知のＬＥＤプリンタ装置の構成を説明するための機能ブロック図である。
【符号の説明】
【００７２】
１  ＣＰＵ
２  ＲＯＭ
２１  温度センサ
２２  湿度センサ
２３  感光体ドラム
８０  ＬＥＤプリントヘッド
１１０  画像形成装置
１１１  通信部
１１３  操作部
１１５  表示部
１１７  中央制御部
１１９  記憶装置
１２１  用紙搬送部
１２３  メモリ制御部
１２５  ＬＥＤヘッド
１３１  ＦＡＸ端末
１３３  Ｅ−ｍａｉｌ端末
１３５  Ｉ−ＦＡＸ端末
１４１  ネットワーク
１４３  記憶装置
１４５  サーバ
２０１  受信部
２０３  書込部
２０５  書込アドレス生成部
２０７  書込パターン記憶部
２０９  ラインメモリ
２１１  メモリ素子
２１２  メモリ素子
２２１  メモリ素子
２２２  メモリ素子
２３１  メモリ素子
２３２  メモリ素子
２４１  メモリ素子
２４２  メモリ素子
２４３  ＬＥＤタイプ判断部
２４５  読出部
２４７  読出アドレス生成部
２４９  読出パターン記憶部
２５１  送信部
６０１  ライトデータ加工モジュール
６０３  セレクター
【図１】
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【図２】
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【図３】
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【図４】
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【図５】
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【図６】
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【図７】
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【図８】
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【図９】
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【図１０】
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【図１１】
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