(57)【要約】【課題】デバイス基板に設けられた電子デバイス等それぞれの固有の事情によって電極形成に係る温度や気圧などの作業条件が制限されることのない、信頼性の高い複数のボール状の導電端子を備えた電子装置を提供する。【解決手段】電子デバイス等５及びパッド電極６が表面に設けられたデバイス基板４を準備する。そして、デバイス基板４ではなくガラスなどから成る第１の支持基板１にビアホール３を形成させ、このビアホール３の底部とパッド電極６の表面とが重なるようにデバイス基板４表面に第１の支持基板１を接着する。このビアホール３の側壁に貫通電極８を形成し、さらに、貫通電極８に電気的に接続する導電端子１１を第１の支持基板１表面に形成する。【選択図】図３
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【特許請求の範囲】
【請求項１】
デバイス基板上に形成されたパッド電極と、
前記デバイス基板の表面に接着された第１の支持基板と、
前記第１の支持基板の表面から前記パッド電極の表面に到達するビアホールと、
前記ビアホールに埋め込まれ、前記パッド電極と電気的に接続する貫通電極と、
前記貫通電極に電気的に接続する導電端子と、を備えることを特徴とする電子装置。
【請求項２】
前記ビアホールの断面がテーパー形状であることを特徴とする請求項１に記載の電子装置。
【請求項３】
前記デバイス基板と前記第１の支持基板との間にキャビティを有することを特徴とする請求項１または請求項２に記載の電子装置。
【請求項４】
前記第１の支持基板は、半導体基板または絶縁性基板から成ることを特徴とする請求項１、請求項２、請求項３のいずれかに記載の電子装置。
【請求項５】
前記第１の支持基板の表面上に、前記貫通電極から連続して接続された配線層を備えることを特徴とする請求項１、請求項２、請求項３、請求項４のいずれかに記載の電子装置。
【請求項６】
前記デバイス基板と前記第１の支持基板とは同じ基板材料を用いることを特徴とする請求項１、請求項２、請求項３、請求項４、請求項５のいずれかに記載の電子装置。
【請求項７】
前記デバイス基板の裏面に接着された第２の支持基板を備えることを特徴とする請求項１、請求項２、請求項３、請求項４、請求項５、請求項６のいずれかに記載の電子装置。
【請求項８】
前記第２の支持基板は半導体基板または絶縁性基板から成ることを特徴とする請求項７に記載の電子装置。
【請求項９】
前記デバイス基板上に半導体デバイス又はＭＥＭＳデバイスが形成されていることを特徴とする請求項１、請求項２、請求項３、請求項４、請求項５、請求項６、請求項７、請求項８のいずれかに記載の電子装置。
【請求項１０】
前記デバイス基板は半導体基板または絶縁性基板から成ることを特徴とする請求項１、請求項２、請求項３、請求項４、請求項５、請求項６、請求項７、請求項８、請求項９のいずれかに記載の電子装置。
【請求項１１】
第１の支持基板の表面から裏面に到達するビアホールを形成する工程と、
デバイス基板の表面に形成されたパッド電極に前記ビアホールが重なるように前記第１の支持基板を接着する工程と、
前記ビアホール内に前記パッド電極と電気的に接続する貫通電極を形成する工程と、
前記貫通電極に電気的に接続する導電端子を形成する工程と、を備えることを特徴とする電子装置の製造方法。
【請求項１２】
前記ビアホールをテーパー形状に加工することを特徴とする請求項１１に記載の電子装置の製造方法。
【請求項１３】
前記第１の支持基板の裏面にキャビティを形成する工程を備えることを特徴とする請求項１１または請求項１２に記載の電子装置の製造方法。
【請求項１４】
前記貫通電極を形成した後に、前記貫通電極から連続して接続された配線層を形成する工程を備えることを特徴とする請求項１１、請求項１２、請求項１３のいずれかに記載の電子装置の製造方法。
【請求項１５】
前記導電端子を形成した後に前記デバイス基板を複数のチップに分割する工程を備えることを特徴とする請求項１１、請求項１２、請求項１３、請求項１４のいずれかに記載の電子装置の製造方法。
【発明の詳細な説明】
【技術分野】
【０００１】
本発明は、複数のボール状の導電端子を備えた電子装置に関するものである。
【背景技術】
【０００２】
近年、新たなパッケージ技術として、ＷＣＳＰ（Wafer Level Chip Size Package）が注目されている。ＷＣＳＰとは、半導体チップの外形寸法と略同サイズの外形寸法を有する小型パッケージをいう。以下一例としてＢＧＡ（Ball Grid Array）型の電子装置で説明する。
【０００３】
従来より、ＷＣＳＰの一種として、貫通電極を有したＢＧＡ型の電子装置が知られている。このＢＧＡ型の電子装置は、半導体基板を貫通してその表面のパッド電極と接続された貫通電極を有する。この電子装置の裏面には、半田等の金属部材から成るボール状の導電端子が複数配列され、これらの導電端子は配線層を介して前記貫通電極に接続されている。
【０００４】
そして、このＢＧＡ型の電子装置を電子機器に組み込む際には、各導電端子をプリント基板上の配線パターンに圧着することで、半導体チップとプリント基板上に搭載される外部回路とを電気的に接続している。
【０００５】
このようなＢＧＡ型の電子装置は、側部に突出したリードピンを有するＳＯＰ（Small Outline Package）やＱＦＰ（Quad Flat Package）等の他のＣＳＰ型の半導体装置に比べて、多数の導電端子を設けることが出来、しかも小型化できるという長所を有する。このＢＧＡ型の電子装置は、例えば携帯電話機に搭載されるデジタルカメラのイメージセンサチップとしての用途がある。
【０００６】
図６は、従来のＢＧＡ型の電子装置の貫通電極部の断面図である。シリコン（Ｓｉ）等から成るデバイス基板１００の表面には、ＣＣＤ（Charge Coupled Device）等の半導体デバイスが設けられ、さらに、パッド電極１０１が層間絶縁膜１０２を介して形成されている。また、デバイス基板１００の表面には、例えばガラス基板のような支持基板１０３がエポキシ樹脂等から成る樹脂層１０４を介して接着されている。
【０００７】
また、デバイス基板１００を貫通し、パッド電極１０１に到達するビアホール１０５が形成されている。このビアホール１０５の側壁及びデバイス基板１００の裏面にはシリコン酸化膜（ＳｉＯ２膜）もしくはシリコン窒化膜（ＳｉＮ膜）等から成る絶縁膜１０６が形成されている。
【０００８】
さらに、ビアホール１０５の中にはパッド電極１０１と接続されたバリア層１０７及び貫通電極１０８が形成されている。デバイス基板１００の表面には、貫通電極１０８に連続して接続された配線層１０９が延在している。そして、デバイス基板１００の裏面の貫通電極１０８、配線層１０９及び絶縁膜１０６を被覆して、ソルダーレジストから成る保護層１１０が形成されている。配線層１０９上の保護層１１０には開口部が形成され、この開口部を通して配線層１０９と接続されたボール状の導電端子１１１が形成されている。  
【０００９】
以上のように、従来のＢＧＡ型の半導体装置では、デバイス基板１００に貫通電極１０８を形成し、デバイス基板１００の裏面に外部回路と電気的に接続するための導電端子１１１を形成していた。  
【特許文献１】特開２００３−３０９２２１号公報
【特許文献２】特開平１０−９２７０２号公報
【特許文献３】特開２００１−３５１８９２号公報
【発明の開示】
【発明が解決しようとする課題】
【００１０】
しかしながら、上述したＢＧＡ型の電子装置では、デバイス基板１００に設けられた電子デバイス等それぞれの固有の事情から、デバイス基板１００に貫通電極１０８を形成する過程において温度条件や気圧条件などの作業条件が制限される場合がある。また、貫通電極１０８を形成する過程で、デバイス基板１００表面の電子デバイス等が劣化し、電子装置の歩留まりが低下するという問題がある。
【課題を解決するための手段】
【００１１】
本発明は上記課題に鑑みてなされたものであり、その主な特徴は以下のとおりである。すなわち、本発明の電子装置は、デバイス基板上に形成されたパッド電極と、前記デバイス基板の表面に接着された第１の支持基板と、前記第１の支持基板の表面から前記パッド電極の表面に到達するビアホールと、前記ビアホールに埋め込まれ、前記パッド電極と電気的に接続される貫通電極と、前記貫通電極に電気的に接続する導電端子と、を備えることを特徴とする。
【００１２】
また、本発明に係る電子装置の製造方法は、以下の特徴を有する。すなわち、本発明に係る電子装置の製造方法は、第１の支持基板の表面から裏面に到達するビアホールを形成する工程と、デバイス基板の表面に形成されたパッド電極に前記ビアホールが重なるように前記第１の支持基板を接着する工程と、前記ビアホール内に前記パッド電極と電気的に接続する貫通電極を形成する工程と、前記貫通電極に電気的に接続する導電端子を形成する工程と、を備えることを特徴とする。
【発明の効果】
【００１３】
本発明に係る電子装置及びその製造方法によれば、デバイス基板側ではなく支持基板側に貫通電極を形成しているので、デバイス基板に設けられた電子デバイス等それぞれの固有の事情で電極形成に係る作業条件が限定されることが少なく、電子装置の微細加工に適している。また、従来のようにデバイス基板側に貫通電極を形成するための工程を要しないので、製造コストを抑えるとともに、デバイス基板表面の電子デバイス等の劣化を防止し、電子装置の歩留まりを高くすることができる。
【発明を実施するための最良の形態】
【００１４】
次に、本発明の実施形態について図面を参照しながら説明する。まず、本発明に係る電子装置の構造について図４を参照しながら説明する。
【００１５】
図４は本発明に係る電子装置の断面図である。シリコン（Ｓｉ）等の半導体から成るデバイス基板４の表面には、ＣＣＤ等の半導体デバイスや、マイクロ・エレクトロ・メカニカル・システム（Micro Electro Mechanical System）を利用したデバイス（ＭＥＭＳデバイス）が設けられている。以下、これらのデバイスを「電子デバイス等５」と略称する。
【００１６】
さらに、デバイス基板４の表面にはパッド電極６が形成されている。また、電子デバイス等５とパッド電極６とは不図示の配線を用いて電気的に接続されている。これらの配線は例えば１μｍの薄さで形成されている。なお、デバイス基板４はガラス，セラミック，石英等の絶縁体から成るものであってもよい。
【００１７】
デバイス基板４の表面には、例えばエポキシ樹脂から成る不図示の樹脂層を介して第１の支持基板１が接着されている。これと同様に、デバイス基板４の裏面には、不図示の樹脂層を介して第２の支持基板７が接着されている。なお、第１の支持基板１及び第２の支持基板７は、ガラス，セラミック，石英等の絶縁体から成るものが好ましいが、シリコン等の半導体から成るものであってもよい。デバイス基板４の裏面に第２の支持基板７を備えることで、工程作業時等の強度対策、特に真空化したときの強度を保つことができる。
【００１８】
ここで、第１の支持基板１の裏面とデバイス基板４の表面との間の空間には、キャビティ２が形成され、そのキャビティ２内に電子デバイス等５が封止されている。ここで、キャビティ２の高さは、数μｍ〜数１０μｍ程度であるが、これには限られない。
【００１９】
また、キャビティ２は、真空状態もしくは不活性ガス（例えばＮ２）を充填した状態にして電子デバイス等５を封止する。これにより、封止された電子デバイス等５は大気に触れることがなくなるため、酸化等による腐食や劣化を防ぐことができる。従って、デバイス基板４上に形成された電子デバイス等５の寿命や信頼性を向上させることができる。なお、本実施形態に係る電子装置ではキャビティ２を設けた構成であるが、これに限定されず、キャビティ２を設けない構成であってもよい。
【００２０】
また、第１の支持基板１には、これを貫通し、パッド電極６に到達するビアホール３が形成されている。ここで、ビアホール３は、その断面が表面から深くなるほど細くなるテーパー形状に形成されている。これにより、後述するようにメッキ法で貫通電極８を形成する場合に、メッキ用のシード層をスパッタリング法で形成することができるなどの利点がある。なお、ビアホール３は、図５に示すようにストレート形状に加工してもよい。
【００２１】
また、ビアホール３の側壁には、例えば銅（Ｃｕ）のような導電材料から成る貫通電極８が形成されている。この貫通電極８は、ビアホール３の底部においてパッド電極６と電気的に接続されている。
【００２２】
そして、貫通電極８から第１の支持基板１の表面上に配線層９が延びており、さらに、この配線層９上にはソルダーレジスト等から成る保護層１０が被着されている。配線層９上の保護層１０には開口部が形成され、この開口部を通して配線層９と接続されたボール状の導電端子１１が所望の位置に形成されている。  
【００２３】
このようにして、デバイス基板４上のパッド電極６から、第１の支持基板１表面に形成された導電端子１１に至るまでの配線が可能となる。なお、貫通電極８はビアホール３内にアルミや銅等の配線材料を充填して形成させても良く、また、保護層１０はビアホール３内にソルダーレジスト等の樹脂を充填して形成させてもよい。かかる構成によれば、特に真空化した際にビアホール３の強度が向上する。
【００２４】
また、本発明に係る電子装置は、第１の支持基板１とデバイス基板４とを同じ基板材料で構成しても良い。かかる構成によれば、第１の支持基板１に係る貫通電極８とデバイス基板４に係るパッド電極６との接点が温度サイクル（膨張係数の相違）によって劣化することを防ぐことができ、さらに、キャビティ２内の気密度が温度サイクルによって低下することを防ぐことができる。
【００２５】
次に、この電子装置の製造方法について図１乃至図５を参照して説明する。ここで、図２（ｃ）乃至図３（ｃ）及び図５は本発明に係る電子装置の貫通電極部分の拡大図である。
【００２６】
まず、図１（ａ）に示すようにガラス等から成る第１の支持基板１を準備する。ここで、第１の支持基板はガラス，セラミック，石英等の絶縁体から成るものが好ましいが、シリコン等の半導体から成るものであってもよい。
【００２７】
次に、図１（ｂ）に示すように、第１の支持基板の裏面にキャビティ２をエッチングやレーザービーム照射等の方法により、例えば凹状に加工する。ここで、キャビティ２の高さは数μｍ〜数１０μｍ程度であるが、これには限定されない。
【００２８】
次に、図１（ｃ）に示すように、第１の支持基板１の表面から裏面に到達するビアホール３をエッチングやレーザービーム照射等の方法により形成する。なお、第１の支持基板１がシリコン等の半導体から成るものであった場合には、この第１の支持基板１と後に形成する貫通電極８とを絶縁するために、ビアホール３形成後に、第１の支持基板１の表面にシリコン酸化膜や窒化膜などの絶縁膜を形成させる工程が必要である。従って、第１の支持基板１がガラス等の絶縁体から成る場合には、当該絶縁膜を形成する工程を要しないので製造工程を減らすことができる。
【００２９】
次に、図２（ａ）に示すように、基板表面に電子デバイス等５が形成されたデバイス基板４を準備する。さらに、デバイス基板４の表面には、電子デバイス等５と電気的に接続された外部接続用電極であるパッド電極６が形成されている。ここで、パッド電極６は、例えばアルミニウム（Ａｌ）や銅（Ｃｕ）から成り、好ましくは約１μｍの膜厚を有して形成される。
【００３０】
また、デバイス基板４の裏面には、必要に応じて第２の支持基板７が形成されている。この第２の支持基板７はエポキシ樹脂等から成る不図示の樹脂層を介してデバイス基板４の裏面に接着されている。
【００３１】
次に、デバイス基板４の表面に、例えばエポキシ樹脂から成る不図示の樹脂層を塗布する。そして、図２（ｂ）に示すように、この樹脂層を介してデバイス基板４の表面に、既にビアホール３が形成された第１の支持基板１を、ビアホール３の底部とパッド電極６の表面とが重なるように接着する。なお、図２（ｂ）の貫通電極形成部分の拡大図が図２（ｃ）である。
【００３２】
また、真空状態もしくは不活性ガス（例えばＮ２）を充填した状態にして電子デバイス等５を封止する場合には、デバイス基板４と第１の支持基板１とを、樹脂層を介して接着するのではなく常温接合法により接着することが好ましい。この場合、樹脂層を介しての接着では、樹脂からガスが出ること、接着の強さ、樹脂のクラック、温度サイクルに対する信頼性低下などの問題が多く、真空封止やガス封止に適さないからである。
【００３３】
なお、常温接合法とは、被接合物の接合面となる表面にエネルギー波（プラズマ、イオンビーム、電子ビーム、ラジカルビーム、レーザー等）を照射して洗浄し、被接合物同士を常温接着する技術である（特開平１０―９２７０２公報，特開２００１−３５１８９２参照）。なお、ここでは常温とあるが接合強度を向上させるために加熱下で行うこともできる。
【００３４】
次に、ビアホール３内に銅（Ｃｕ）から成る不図示のシード層を無電解メッキにより０．１μｍ〜０．２μｍ程度に形成する。この不図示のシード層は後述する電解メッキ時のメッキ成長のためのシード（種）となる。なお、上述したように、ビアホール３がテーパー形状で形成されている場合には、シード層形成のためにスパッタ法を用いることができる。
【００３５】
次に、図３（ａ）に示すように、ビアホール３内に、電解メッキ法により、銅（Ｃｕ）から成る貫通電極８及びこの貫通電極８と連続して接続された配線層９を形成する。ここで、貫通電極８の膜厚は、ビアホール３内に完全もしくは不完全に埋め込まれるような厚さに調整される。このようにして、貫通電極８はビアホール３の底部でパッド電極６に電気的に接続される。
【００３６】
なお、電解メッキ法以外の方法、例えば、ビアホール３内にＣＶＤ法やＭＯＣＶＤ法により銅（Ｃｕ）やアルミニウム（Ａｌ）等の金属を埋め込むことで、貫通電極８及び配線層９を形成してもよい。また、スパッタリング法等を用いてアルミニウム（Ａｌ）等の金属を形成しても良い。
【００３７】
次に、第１の支持基板１の表面の配線層９を不図示のホトレジスト層を用いて所定のパターンにパターニングする。次に、図３（ｂ）に示すように、第１の支持基板１の表面に、これを被覆して、例えばソルダーレジストのようなレジスト材料から成る保護層１０を形成する。保護層１０のうち配線層９に対応する位置に開口部が設けられる。
【００３８】
そして、図３（ｃ）に示すように当該開口部で露出する配線層９の所定の領域上に、ハンダを印刷し、このハンダを熱処理でリフローさせることで、ボール状の導電端子１１が形成される。なお、配線層９は第１の支持基板１の表面の所望領域に、所望の本数形成することができ、導電端子１１の数や形成領域を自由に選択できる。
【００３９】
そして、図４に示すように、デバイス基板４のダイシングラインに沿って、ダイシングブレードやレーザービーム等により切断し、個々のチップに分割する。なお、本実施形態では、配線層９上に導電端子１１を形成しているが、本発明はこれに限定されず、貫通電極８から延びた配線層９を形成しないで、ビアホール３内に埋め込まれた貫通電極８上に、導電端子１１を形成してもよい。
【図面の簡単な説明】
【００４０】
【図１】本発明の電子装置及びその製造方法を説明する断面図である。
【図２】本発明の電子装置及びその製造方法を説明する断面図である。
【図３】本発明の電子装置及びその製造方法を説明する断面図である。
【図４】本発明の電子装置及びその製造方法を説明する断面図である。
【図５】本発明の電子装置及びその製造方法を説明する断面図である。
【図６】従来例に係る電子装置を説明する断面図である。
【符号の説明】
【００４１】
１  第１の支持基板      ２  キャビティ          ３  ビアホール    
４  デバイス基板        ５  電子デバイス等      ６  パッド電極
７  第２の支持基板      ８  貫通電極            ９  配線層
１０  保護層            １１  導電端子        １００  デバイス基板
１０１  パッド電極      １０２  層間絶縁膜      １０３  支持基板
１０４  樹脂層          １０５  ビアホール      １０６  絶縁膜
１０７  バリア層        １０８  貫通電極        １０９  配線層
１１０  保護層          １１１  導電端子
【図１】
2006196619.tif 000003
【図２】
2006196619.tif 000004
【図３】
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【図４】
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【図５】
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【図６】
2006196619.tif 000008