(57)【要約】【課題】 ジャンクション領域にシード又は結晶粒境界が形成されないように、キャッピング層をパターニングして結晶化することにより、薄膜トランジスターの素子特性を向上させて均一な値を得ることができる薄膜トランジスター及びその製造方法を提供する。【解決手段】  本発明による薄膜トランジスターの製造方法は、基板上に非晶質シリコン層を形成する段階と、前記非晶質シリコン層を結晶化してパターニングして半導体層パターンを形成段階と、前記半導体層パターン上にゲート絶縁膜を形成する段階と、前記ゲート絶縁膜上にゲート電極を形成する段階と、を含み、前記半導体層パターン内にはシード又は結晶粒境界が存在するが、ジャンクション領域にはシード又は結晶粒境界が存在しないことを特徴とする。【選択図】  図２
2006013425.tif 000002
【特許請求の範囲】
【請求項１】
基板と、
前記基板上に形成された半導体層パターンと、
前記半導体層パターン上に形成されたゲート絶縁膜と、
前記ゲート絶縁膜上に形成されたゲート電極と、を含み、
前記半導体層パターン内にはシード又は結晶粒境界が存在するが、ジャンクション領域にはシード又は結晶粒境界が存在しないこと
を特徴とする薄膜トランジスター。
【請求項２】
前記半導体層パターン内に存在するシード又は結晶粒境界は、前記半導体層パターンのアクティブ領域に存在すること
を特徴とする請求項１に記載の薄膜トランジスター。
【請求項３】
前記ジャンクション領域は、ジャンクションからソース領域又はドレーン領域に１μmまで形成されること
を特徴とする請求項１に記載の薄膜トランジスター。
【請求項４】
前記シードは、前記ジャンクション領域からコンタクトホール方向に１〜３μm離隔された所に形成されること
を特徴とする請求項１に記載の薄膜トランジスター。
【請求項５】
前記ジャンクション領域の結晶化比率は、０.７〜０.９であること
を特徴とする請求項１に記載の薄膜トランジスター。
【請求項６】
前記絶縁基板と前記半導体層パターンとの間に形成されたバッファー層をさらに含むこと
を特徴とする請求項１に記載の薄膜トランジスター。
【請求項７】
前記バッファー層は、シリコン窒化膜又はシリコン酸化膜からなること
を特徴とする請求項６に記載の薄膜トランジスター。
【請求項８】
前記薄膜トランジスターは、液晶表示素子又は有機電界発光素子として使用されること
を特徴とする請求項１に記載の薄膜トランジスター。
【請求項９】
基板上に非晶質シリコン層を形成する段階と、
前記非晶質シリコン層を結晶化しパターニングして半導体層パターンを形成する段階と、
前記半導体層パターン上にゲート絶縁膜を形成する段階と、
前記ゲート絶縁膜上にゲート電極を形成する段階と、を含み、
前記半導体層パターン内にはシード又は結晶粒境界が存在するが、ジャンクション領域にはシード又は結晶粒境界が存在しないこと
を特徴とする薄膜トランジスターの製造方法。
【請求項１０】
前記半導体層パターン内に存在するシード又は結晶粒境界は、前記半導体層パターンのアクティブ領域に存在すること
を特徴とする請求項９に記載の薄膜トランジスターの製造方法。
【請求項１１】
前記半導体層パターンを形成する段階は、前記非晶質シリコン層上に第１のキャッピング層を形成した後にパターニングする段階と、
前記第１のキャッピング層パターン上に第２のキャッピング層を形成する段階と、
前記第２のキャッピング層上に金属触媒層を形成する段階と、
前記金属触媒を拡散させる段階と、
前記非晶質シリコン層を結晶化して多結晶シリコン層を形成する段階と、を含むこと
を特徴とする請求項９に記載の薄膜トランジスターの製造方法。
【請求項１２】
前記第１のキャッピング層は、前記シードが前記ジャンクション領域からコンタクトホール方向に１〜３μm離隔された所に形成されるようにパターニングすること
を特徴とする請求項１１に記載の薄膜トランジスターの製造方法。
【請求項１３】
前記第１のキャッピング層パターンは、シリコン窒化膜又はシリコン酸化膜からなること
を特徴とする請求項１１に記載の薄膜トランジスターの製造方法。
【請求項１４】
前記第２のキャッピング層は、シリコン窒化膜又はシリコン酸化膜からなること
を特徴とする請求項１１に記載の薄膜トランジスターの製造方法。
【請求項１５】
前記第１のキャッピング層パターンは、第２のキャッピング層より厚いこと
を特徴とする請求項１１に記載の薄膜トランジスターの製造方法。
【請求項１６】
前記第１のキャッピング層パターンは、第２のキャッピング層より高密度であること
を特徴とする請求項１１に記載の薄膜トランジスターの製造方法。
【請求項１７】
前記第１のキャッピング層又は第２のキャッピング層は、プラズマ強化化学気相蒸着(ＰＥＣＶＤ)法を用いて形成すること
を特徴とする請求項１１に記載の薄膜トランジスターの製造方法。
【請求項１８】
前記金属触媒は、ニッケルであること
を特徴とする請求項１１に記載の薄膜トランジスターの製造方法。
【請求項１９】
前記金属触媒層は、プラズマ化学気相法(ＣＶＤ)又はスパッター方法を用いて形成すること
を特徴とする請求項１１に記載の薄膜トランジスターの製造方法。
【請求項２０】
前記金属触媒の拡散は、熱処理により行われること
を特徴とする請求項１１に記載の薄膜トランジスターの製造方法。
【請求項２１】
前記熱処理は、２００〜７００℃で行われること
を特徴とする請求項２０に記載の薄膜トランジスターの製造方法。
【請求項２２】
前記非晶質シリコン層の結晶化は、熱処理により行われること
を特徴とする請求項１１に記載の薄膜トランジスターの製造方法。
【請求項２３】
前記熱処理は、４００〜１０００℃で行われること
を特徴とする請求項２２に記載の薄膜トランジスターの製造方法。
【請求項２４】
前記基板と前記非晶質シリコン層との間にバッファー層を形成する段階をさらに含むこと
を特徴とする請求項９に記載の薄膜トランジスターの製造方法。
【発明の詳細な説明】
【技術分野】
【０００１】
本発明は、薄膜トランジスター及びその製造方法に関し、より詳しくは、ジャンクション(junction)領域にシード(seed)又は結晶粒境界(Grain Boundary)が存在しない薄膜トランジスター及びその製造方法に関する。
【背景技術】
【０００２】
一般に、多結晶シリコン層は、高い電界効果移動度と高速動作回路に適用が可能であり、ＣＭＯＳ回路構成が可能である長所により、薄膜トランジスター用半導体層の用途として多く使用されている。このような多結晶シリコン層を用いた薄膜トランジスターは、主に能動行列液晶ディスプレー装置(ＡＭＬＣＤ)の能動素子と、有機電界発光素子(ＯＬＥＤ)のスイッチング素子及び駆動素子に使用される。
【０００３】
この時、薄膜トランジスターに使用する多結晶シリコン層の製作は、直接蒸着法、高温熱処理を用いた技術又はレーザー熱処理方法などを用いて製作する。レーザー熱処理方法は、低温工程が可能であり、高い電界効果移動度を具現することができるが、高価のレーザー装備が必要なので代替技術が研究されている。
【０００４】
現在、金属を用いて非晶質シリコンを結晶化する方法は、固相結晶化(ＳＰＣ：Solid Phase Crystallization)より低い温度で短時間内に結晶化させる長所を有するので活発に研究されている。金属を用いた結晶化方法は、金属誘導結晶化(ＭＩＣ：Metal Induced Crystallization) 方法と、金属誘導側面結晶化(ＭＩＬＣ：Metal Induced Lateral Crystallization)方法に区分される。しかし、金属を用いた前記方法の場合にも金属汚染により薄膜トランジスターの素子特性が低下される問題点がある。
【０００５】
一方、金属量を減らして良質の多結晶シリコン層を形成するために、イオン注入機を利用して金属のイオン濃度を調節して高温処理、急速熱処理又はレーザー照射により良質の多結晶シリコン層を形成する技術と、金属誘導結晶化方法により多結晶シリコン層の表面を平坦化させるために、粘性がある有機膜と液状の金属を混合してスピンコーティング方法により薄膜を蒸着した後に熱処理工程により結晶化する方法が開発されている。しかし、前記結晶化方法の場合にも多結晶シリコン層において一番重であるグレーンサイズの大型化及び均一度側面に問題がある。
【０００６】
前記問題を解決するために、キャッピング層を用いた結晶化方法により多結晶シリコン層を製造する方法(韓国公開特許番号２００３−００６０４０３)が開発された。前記方法は、基板上に非晶質シリコン層を形成して前記非晶質シリコン層上にキャッピング層を形成した後、前記キャッピング層上に金属触媒層を蒸着して熱処理或いはレーザーを用いて金属触媒をキャッピング層を通じて非晶質シリコン層に拡散させてシードを形成させた後に、これを用いて多結晶シリコン層を得る方法である。前記方法は、金属触媒がキャッピング層を通じて拡散されるので、必要以上の金属汚染を防止できる長所がある。
【０００７】
しかし、前記方法を通じて製作された薄膜トランジスターの場合は、シードが形成される領域が多量の結晶化金属触媒を含んでいるので多くのトラップ(Trap)が形成される。前記トラップとは、半導体層内にシード又は結晶粒境界が存在してエネルギーバンドの不連続を誘発するなど一種の欠陷(defect)として作用することを言う。したがって、前記トラップがジャンクション領域に存在する場合には、薄膜トランジスターの特性劣化及び特性不均一を発生させる問題点がある。
【発明の開示】
【発明が解決しようとする課題】
【０００８】
したがって、本発明は上述したような従来技術の問題点を解決するためになされたもので、その目的は、ジャンクション領域にシード又は結晶粒境界が形成されないように、キャッピング層をパターニングして結晶化することにより、薄膜トランジスターの素子特性を向上させて均一な値を得ることができる薄膜トランジスター及びその製造方法を提供することにある。
【課題を解決するための手段】
【０００９】
前記目的を達成するための本発明による薄膜トランジスターは、基板と、前記基板上に形成された半導体層パターンと、前記半導体層パターン上に形成されたゲート絶縁膜と、前記ゲート絶縁膜上に形成されたゲート電極と、を含み、前記半導体層パターン内にはシード又は結晶粒境界が存在するが、ジャンクション領域にはシード又は結晶粒境界が存在しないことを特徴とする。
【００１０】
好ましくは、前記半導体層パターン内に存在するシード又は結晶粒境界は、前記半導体層パターンのアクティブ領域に存在する。
【００１１】
好ましくは、前記ジャンクション領域は、ジャンクションからソース領域又はドレーン領域に１μmまで形成され、前記シードは、前記ジャンクション領域からコンタクトホール方向に１〜３μm離隔された所に形成され、前記ジャンクション領域の結晶化比率は、０．７〜０.９である。
【００１２】
好ましくは、前記絶縁基板と前記半導体層パターンとの間に形成されたバッファー層をさらに含み、前記バッファー層は、シリコン窒化膜又はシリコン酸化膜からなる。
【００１３】
好ましくは、前記薄膜トランジスターは、液晶表示素子又は有機電界発光素子として使用される。
【００１４】
また、本発明による薄膜トランジスターの製造方法は、基板上に非晶質シリコン層を形成する段階と、前記非晶質シリコン層を結晶化しパターニングして半導体層パターンを形成する段階と、前記半導体層パターン上にゲート絶縁膜を形成する段階と、前記ゲート絶縁膜上にゲート電極を形成する段階と、を含み、前記半導体層パターン内にはシード又は結晶粒境界が存在するが、ジャンクション領域にはシード又は結晶粒境界が存在しないことを特徴とする。
【００１５】
好ましくは、前記半導体層パターン内に存在するシード又は結晶粒境界は、前記半導体層パターンのアクティブ領域に存在する。
【００１６】
好ましくは、前記半導体層パターンを形成する段階は、前記非晶質シリコン層上に第１のキャッピング層を形成した後にパターニングする段階と、前記第１のキャッピング層パターン上に第２のキャッピング層を形成する段階と、前記第２のキャッピング層上に金属触媒層を形成する段階と、前記金属触媒を拡散させる段階と、前記非晶質シリコン層を結晶化して多結晶シリコン層を形成する段階と、を含む。
【００１７】
好ましくは、前記第１のキャッピング層は、前記シードが前記ジャンクション領域からコンタクトホール方向に１〜３μm離隔された所に形成されるようにパターニングする。
【００１８】
好ましくは、前記第１のキャッピング層パターン又は前記第２のキャッピング層は、シリコン窒化膜又はシリコン酸化膜からなり、前記第１のキャッピング層パターンは、第２のキャッピング層より厚い、前記第１のキャッピング層パターンは、第２のキャッピング層より高密度である。
【００１９】
好ましくは、前記第１のキャッピング層又は第２のキャッピング層は、プラズマ強化化学気相蒸着(ＰＥＣＶＤ)法を用いて形成する。
【００２０】
好ましくは、前記金属触媒は、ニッケルであり、前記金属触媒層は、プラズマ化学気相法(ＣＶＤ)又はスパッター(Sputter)方法を用いて形成する。
【００２１】
好ましくは、前記金属触媒の拡散は、２００〜７００℃の熱処理により行われ、前記非晶質シリコン層の結晶化は、４００〜１０００℃の熱処理により行われる。より好ましくは、前記金属触媒の拡散及び前記非晶質シリコン層の結晶化は、熱処理により同時に行われる。
【００２２】
好ましくは、前記基板と前記非晶質シリコン層との間にバッファー層を形成する段階をさらに含む。
【発明の効果】
【００２３】
本発明によれば、シード又は結晶粒境界がジャンクション領域に形成されないように、第１のキャッピング層をパターニングして結晶化することにより、ジャンクション領域にトラップが発生することを防止し、素子特性を向上させて均一な値を得ることができる効果がある。
【発明を実施するための最良の形態】
【００２４】
以下に添付図面を参照しながら、本発明の好適な実施の形態について詳細に説明する。なお，本明細書及び図面において，実質的に同一の機能構成を有する構成要素については，同一の符号を付することにより重複説明を省略する。
【００２５】
図１は、本発明の第１の実施形態による薄膜トランジスターの断面構造図である。
【００２６】
図１を参照すれば、基板１０上に半導体層パターン１１が形成されている。前記基板１０は、絶縁基板を使用すること望ましく、ガラスも使用できる。前記半導体層パターン１１は、ソース/ドレーン領域１２、１３及びチャンネル層１４からなり、前記半導体層パターン１１内には、シード又は結晶粒境界が存在する。
【００２７】
しかし、前記ソース/ドレーン領域１２、１３とチャンネル層１４が接する領域、即ち、ジャンクション領域１５にはシード又は結晶粒境界が存在しない。前記半導体層パターン内に存在するシード又は結晶粒境界は、前記半導体層パターンのアクティブ領域に存在することができる。ジャンクションとは、ソース/ドレーン領域とチャンネル層が接する所を意味する。前記ジャンクション領域１５は、必ずソース/ドレーン領域とチャンネル層が接するジャンクションだけを意味することではなく、電界が形成される場合に影響を及ぶ領域、即ち、チャンネル層ではないソース/ドレーン領域へ１μmまでを意味する。
【００２８】
前記ジャンクション領域１５にシードが存在する場合、ジャンクション領域１５に後述するトラップが発生して薄膜トランジスターの特性劣化及び特性不均一を発生させる問題点があるので、本発明では、結晶化する際に、第１のキャッピング層パターンを通じて前記ジャンクション領域１５にシードが形成されないように調節する。 
【００２９】
シードは、ジャンクション領域１５から１〜３μm離隔された所に形成されることが望ましい。シードが上述した位置に形成された場合、結晶粒(Grain)内部でも結晶比が良い領域にチャンネル層が形成できる。その詳細な説明は、図３により後術する。
【００３０】
前記半導体層パターン１１上にゲート絶縁膜１６が形成され、前記ゲート絶縁膜１６上にゲート電極１７が形成されている。前記ゲート絶縁膜１６及びゲート電極１７の上部にコンタクトホールを含んだ層間絶縁膜１８が形成されており、前記コンタクトホールを通じてソース/ドレーン領域１２、１３と接触されるソース/ドレーン電極１９、２０が形成されている。
【００３１】
図２は、ジャンクション領域に発生したトラップを示す薄膜トランジスターの平面図である。
【００３２】
図２を参照すれば、前記ジャンクション領域１５にシードが形成されてトラップ２１が発生したことが分かる。また、前記ジャンクション領域１５に結晶粒境界が形成されて同様にトラップ２１が発生したことが分かる。前記トラップ２１がジャンクション領域１５に存在する場合、連続的なエネルギーバンドが不連続的になって欠陷として作用するようになる。したがって、薄膜トランジスターの素子特性が低下される問題点がある。本発明では、キャッピング層パターンを通じてシード又は結晶粒境界の位置を調節して前記トラップ発生を除去することができる。
【００３３】
図３Ａは、成長が完了された結晶粒のＳＥＭ写真であり、図面符号３１は結晶粒中心部分を、図面符号３２は結晶粒中心部分と結晶粒境界との間を、図面符号３３は結晶粒境界を示す。
【００３４】
図３Ｂ〜図３Ｄは、図３Ａに示した結晶粒内部の位置による結晶性の差を示すラマングラフである。フラフにおいて、Ｘ軸は加えた波数(wave number, cm-1)を示し、Ｙ軸は測定された成分のビーム強度(Beam Intensity)を示す。前記結晶性とは、非晶質成分のビーム強度に対する結晶成分のビーム強度の比率を相対的な値で示すのである。前記ラマングラフにおいて、円満な部分は非晶質成分を示し、ピーク(peak)部分は結晶成分を示す。
【００３５】
図３Ｂは、結晶粒中心部分の結晶性を示し、測定の結果、その値は、０.４５と確認された。即ち、結晶成分に比べて非晶質成分が相対的に多いことを意味し、とても低い結晶化を示している。
【００３６】
図３Ｃは、結晶粒中心部分と結晶粒境界との間での結晶性を示し、測定の結果、その値は、０.７４と確認された。即ち、結晶粒中心部分及び結晶粒境界でのより結晶性が非常に高いことが分かる。
【００３７】
図３Ｄは、結晶粒境界での結晶性を示し、測定の結果、その値は、０.５２と確認された。即ち、結晶粒中心部分よりは結晶性が多少高いと言えるが、やっぱり低い結晶化を示していることが分かる。
【００３８】
上述のように、一つの結晶粒内部でもその内部位置によって結晶比が変わるので、チャンネル層の形成位置がどの部分であるかによって薄膜トランジスターの特性が均一又は不均一になる。本発明では、上述のように、シードの位置をジャンクション領域１５から１〜３μm離隔された所に位置させて結晶性が良い部分にチャンネル層を形成できるようにする。
【００３９】
図４Ａ〜図４Ｄは、本発明の第１の実施形態による薄膜トランジスターの製造方法を説明する工程図である。
【００４０】
図４Ａを参照すれば、基板４０上に非晶質シリコン層４１を蒸着する。前記非晶質シリコン層４１は、プラズマを用いた化学気相蒸着法(ＣＶＤ)により形成できる。
【００４１】
前記非晶質シリコン層４１上に第１のキャッピング層を形成する。前記第１のキャッピング層は、シリコン窒化膜又はシリコン酸化膜からなることができ、プラズマ強化化学気相蒸着法を用いて形成できる。 次に、前記第１のキャッピング層をパターニングして第１のキャッピング層パターン４２を形成する。この時、後述するシード又は結晶粒境界がジャンクション領域５１に形成されないように、前記第１のキャッピング層をパターニングする。詳しく説明すれば、チャンネル形成部４３と後述するソース/ドレーン領域が接して形成されるジャンクション領域５１を第１のキャッピング層パターン４２で覆って後述する金属触媒の拡散により生成するシードがジャンクション領域５１に形成されないように、前記第１のキャッピング層をパターニングする。その結果、後述する半導体層パターン内にはシード又は結晶粒境界が形成されるが、前記ジャンクション領域５１にはシードが形成されない。前記半導体層パターン内に存在するシード又は結晶粒境界は、前記半導体層パターンのアクティブ領域に存在することができる。また、第１のキャッピングパターンの幅を調節して前記ジャンクション領域５１に結晶粒境界が形成されないように調節する。前記第１のキャッピング層パターンの幅は、第１のキャッピング層がパターニングされないで残っている部分の幅を意味する。したがって、ジャンクション領域５１にトラップが発生することを防止できる。
【００４２】
前記第１のキャッピング層パターン４２は、シリコン窒化膜又はシリコン酸化膜を厚く形成するか高密度で調節して金属触媒が拡散不能に調節する。即ち、前記第１のキャッピング層パターン４２は、金属触媒拡散不能層としての役割を担当する。
【００４３】
図４Ｂを参照すれば、前記第１のキャッピング層パターン４２上に第２のキャッピング層４４を形成する。前記第２のキャッピング層４４は、シリコン窒化膜又はシリコン酸化膜からなることができ、その厚さを前記第１のキャッピング層パターン４２より薄くするか、前記第１のキャッピング層パターン４２より低密度で調節して金属触媒が拡散可能に調節する。即ち、前記第２のキャッピング層４４は、金属触媒拡散可能層としての役割を担当する。一般に、酸化膜又は窒化膜は、不純物の拡散においてバリアー(barrier)として作用するので、シリコン酸化膜又はシリコン窒化膜を高密度で調節することによって、金属触媒が拡散することを防止できる。一方、シリコン酸化膜又はシリコン窒化膜を低密度で調節する場合、金属触媒の拡散が容易になる。
【００４４】
次に、前記第２のキャッピング層４４上に金属触媒４５層を形成する。前記金属触媒４５は、ニッケルが望ましく、前記金属触媒４５層は、スパッターを用いて形成できる。また、イオン注入方法により形成でき、プラズマを用いて形成することもできる。プラズマを用いた方法は、前記第２のキャッピング層４４上に金属物質を配置してそれをプラズマに露出させて形成することができる。
【００４５】
図４Ｃを参照すれば、前記金属触媒４５を拡散させる。前記拡散は、２００〜７００℃で１時間の間に熱処理することにより拡散されることができ、前記金属触媒４５は、熱処理により前記第２のキャッピング層４４をパスして前記非晶質シリコン層４１に拡散される。拡散された前記金属触媒４５は、前記非晶質シリコン層４１でシード４６を形成する。前記シード４６とは、金属触媒がシリコンと接して形成される金属シリサイドを意味する。前記シード４６は、前記ジャンクション領域５１を除外した後述する半導体層パターンに形成される。図３Ａ〜図３Ｃのように、前記シードは、前記ジャンクション領域からコンタクトホール方向に１〜３μm離隔された所に形成することが望ましい。後述する結晶化は、前記シード４６から行われるが、普通は金属触媒の中で１/１００程度だけが拡散して前記シードを形成する。第１のキャッピング層パターン４２により拡散されなかった金属触媒は、前記第２のキャッピング層４４に残るようになる。
【００４６】
次に、前記非晶質シリコン層４１を結晶化して多結晶シリコン層を形成する。前記結晶化は、熱処理により実行され、前記熱処理は、ファーネス(Furnace)で長期間加熱することにより行われ、この時、結晶化温度は、４００〜１０００℃が望ましい。前記温度で熱処理する場合、前記シード４６から側面へ成長して隣接した結晶粒と接して結晶粒境界を形成することにより完全結晶化される。前記結晶化方法により形成された多結晶シリコン層のグレーンは、その直径が２０〜２００μmであり、大きくは３００μmまで成長できる。
【００４７】
図４Ｄを参照すれば、前記第１のキャッピング層パターン４２、第２ののキャッピング層４４及び金属触媒４５を結晶化した後にエッチング(etching)により除去する。前記構造物を除去することによって結晶化された多結晶シリコン層に発生する必要以上の金属汚染を防止することができる。
【００４８】
次に、前記多結晶シリコン層をパターニングしてイオン注入工程を通じてソース/ドレーン領域４８、４９及びチャンネル層５０を形成する。即ち、半導体層パターン４７を形成する。前記半導体層パターン４７上にゲート絶縁膜５２を形成した後に前記ゲート絶縁膜５２上に金属層及びフォトレジスト層を順次に積層する。前記フォトレジスト層をパターニングして前記パターニングされたフォトレジスト層をマスクとして前記金属層を蝕刻することによりゲート電極５３を形成する。前記結果物を用いて薄膜トランジスターを完成することができる。
【００４９】
以上、添付の図面を参照しながら本発明の好適な実施の形態について説明したが、本発明は係る例に限定されない。当業者であれば、特許請求の範囲に記載された範疇内において、各種の変更例または修正例に想到し得ることは明らかであり、それらについても当然に本発明の技術的範囲に属するものと了解される。
【図面の簡単な説明】
【００５０】
【図１】本発明の第１の実施形態による薄膜トランジスターの断面構造図である。
【図２】ジャンクション領域に発生したトラップを示す薄膜トランジスターの平面図である。
【図３Ａ】成長が完了した結晶粒のＳＥＭ写真である。
【図３Ｂ】結晶粒内部の位置による結晶性の差を示すラマングラフである。
【図３Ｃ】結晶粒内部の位置による結晶性の差を示すラマングラフである。
【図３Ｄ】結晶粒内部の位置による結晶性の差を示すラマングラフである。
【図４Ａ】本発明の第１の実施形態による薄膜トランジスターの製造方法を説明する工程図である。
【図４Ｂ】本発明の第１の実施形態による薄膜トランジスターの製造方法を説明する工程図である。
【図４Ｃ】本発明の第１の実施形態による薄膜トランジスターの製造方法を説明する工程図である。
【図４Ｄ】本発明の第１の実施形態による薄膜トランジスターの製造方法を説明する工程図である。
【符号の説明】
【００５１】
１０、４０  基板
１１、４７  半導体層パターン
１２、４８  ソース領域
１３、４９  ドレーン領域
１４、５０  チャンネル層
１５、５１  ジャンクション領域
１６、５２  ゲート絶縁膜
１７、５３  ゲート電極
１８  層間絶縁膜
１９  ソース電極
２０  ドレーン電極
２１  トラップ
４１  非晶質シリコン層
４２  第１のキャッピング層パターン
４３  チャンネル形成部
４４  第２ののキャッピング層
４５  金属触媒
４６  シード
【図１】
2006013425.tif 000003
【図２】
2006013425.tif 000004
【図３Ａ】
2006013425.tif 000005
【図３Ｂ】
2006013425.tif 000006
【図３Ｃ】
2006013425.tif 000007
【図３Ｄ】
2006013425.tif 000008
【図４Ａ】
2006013425.tif 000009
【図４Ｂ】
2006013425.tif 000010
【図４Ｃ】
2006013425.tif 000011
【図４Ｄ】
2006013425.tif 000012