(57)【要約】【解決手段】構造物および該構造物を製造する方法は、トレンチ・キャパシタのためのキャパシタ・トレンチ（ＣＴ）と、トレンチ抵抗器のための抵抗器トレンチ（ＲＴ）とを使用する。この構造物は一般に半導体構造物である。第１の例では、キャパシタ・トレンチ（ＣＴ）が、抵抗器トレンチ（ＲＴ）よりも幅が狭い線幅寸法（ＬＷＣ）を有する。トレンチ線幅のこの違いが、トレンチ・キャパシタおよびトレンチ抵抗器を製造する効率的な方法を提供する。第２の例では、トレンチ抵抗器が、抵抗器トレンチ（ＲＴ）の周縁に導体材料（１８ａ、１８ｂ）を含み、抵抗器トレンチ（ＲＴ）の中心部分に抵抗器材料（２０）を含む。【選択図】図４
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【特許請求の範囲】
【請求項１】
単一の基板（１０）内に配置されたトレンチ・キャパシタとトレンチ抵抗器とを含む構造物であって、前記トレンチ・キャパシタのために使用されるキャパシタ・トレンチ（ＣＴ）が、前記トレンチ抵抗器のために使用される抵抗器トレンチ（ＲＴ）よりも幅が狭い線幅寸法（ＬＷＣ）を有する構造物。
【請求項２】
前記単一の基板（１０）が単一の半導体基板を含む、請求項１に記載の構造物。
【請求項３】
前記トレンチ・キャパシタが、前記キャパシタ・トレンチ（ＣＴ）を埋める導体材料（１８ｃ）を含み、
前記トレンチ抵抗器が、
前記抵抗器トレンチ（ＲＴ）の周縁に配置された前記導体材料（１８ａ、１８ｂ）と、
前記抵抗器トレンチの中心に配置された抵抗器材料（２０）と
を含む、
請求項１に記載の構造物。
【請求項４】
前記抵抗器材料（２０）が、前記抵抗器トレンチ（ＲＴ）内の前記導体材料（１８ａ、１８ｂ）と接触した、請求項３に記載の構造物。
【請求項５】
前記抵抗器材料（２０）が、誘電材料（１９ａ、１９ｂ）によって、前記抵抗器トレンチ（ＲＴ）内の前記導体材料（１８ａ、１８ｂ）から分離された、請求項３に記載の構造物。
【請求項６】
前記導体材料（１８ａ、１８ｂ）がポリシリコン導体材料を含み、
前記抵抗器材料がポリシリコン抵抗器材料を含む、
請求項３に記載の構造物。
【請求項７】
前記ポリシリコン導体材料が、前記ポリシリコン抵抗器材料よりも高いドーピング濃度を有する、請求項６に記載の構造物。
【請求項８】
その中に配置されたキャパシタ・トレンチ（ＣＴ）と抵抗器トレンチ（ＲＴ）とを含む基板（１０）であって、前記キャパシタ・トレンチ（ＣＴ）および前記抵抗器トレンチ（ＲＴ）がそれぞれ、その側壁と底面とのうちの少なくとも一方の内部に配置された導体領域（１４ｂ、１４ａ）を含む基板（１０）と、
前記キャパシタ・トレンチ（ＣＴ）内の前記導体領域（１４ｂ）は完全に覆うが、前記抵抗器トレンチ（ＲＴ）内の前記導体領域（１４ａ）は完全には覆わない誘電材料層（１６ｃ、１６ａ、１６ｂ）と、
前記キャパシタ・トレンチ（ＣＴ）は完全に埋めるが、前記抵抗器トレンチ（ＲＴ）は不完全に埋め、その中の前記導体領域（１４ａ）と接触しない、前記誘電材料層（１６ｃ、１６ａ、１６ｂ）上に配置された導体材料層（１８ｃ、１８ａ、１８ｂ）と、
前記抵抗器トレンチ（ＲＴ）を埋め、その中の前記導体領域（１４ａ）と接触するように配置された抵抗器材料層（２０）と
を含む構造物。
【請求項９】
前記キャパシタ・トレンチ（ＣＴ）が、前記抵抗器トレンチ（ＲＴ）よりも幅が狭い線幅（ＬＷＣ）を有する、請求項８に記載の構造物。
【請求項１０】
前記抵抗器材料層（２０）が、前記抵抗器トレンチ（ＲＴ）内の前記導体材料層（１８ａ、１８ｂ）と接触した、請求項８に記載の構造物。
【請求項１１】
前記抵抗器材料層（２０）が、前記抵抗器トレンチ（ＲＴ）内の前記導体材料層（１８ａ、１８ｂ）と接触していない、請求項８に記載の構造物。
【請求項１２】
前記抵抗器トレンチ（ＲＴ）内の前記導体材料層（１８ａ、１８ｂ）と前記抵抗器材料層（２０）との間に配置され、前記導体材料層（１８ａ、１８ｂ）と前記抵抗器材料層（２０）とを分離する第２の誘電材料層（１９ａ、１９ｂ）をさらに含む、請求項８に記載の構造物。
【請求項１３】
前記キャパシタ・トレンチ（ＣＴ）を含む前記導体領域（１４ｂ）が、前記抵抗器トレンチ（ＲＴ）を含む前記導体領域（１４ａ）と接触した、請求項８に記載の構造物。
【請求項１４】
前記キャパシタ・トレンチ（ＣＴ）を含む前記導体領域（１４ｂ）を、前記抵抗器トレンチ（ＲＴ）を含む前記導体領域（１４ａ）に接続するように配置された追加の別個の導体領域（１４ｅ）をさらに含む、請求項８に記載の構造物。
【請求項１５】
構造物を製造する方法であって、
基板（１０）内にキャパシタ・トレンチ（ＣＴ）と抵抗器トレンチ（ＲＴ）とを形成するステップであって、前記キャパシタ・トレンチ（ＣＴ）および前記抵抗器トレンチ（ＲＴ）がそれぞれ、その側壁と底面とのうちの少なくとも一方の内部に配置された導体領域（１４ｂ、１４ａ）を含むステップと、
前記キャパシタ・トレンチ（ＣＴ）内の前記導体領域（１４ｂ）は完全に覆うが、前記抵抗器トレンチ（ＲＴ）内の前記導体領域（１４ａ）は完全には覆わないように誘電材料層（１６ｃ、１６ａ、１６ｂ）を形成するステップと、
前記キャパシタ・トレンチ（ＣＴ）は完全に埋めるが、前記抵抗器トレンチ（ＲＴ）は不完全に埋め、その中の前記導体領域（１４ａ）を露出させ、前記導体領域（１４ａ）と接触しない、前記誘電材料層（１６ｃ、１６ａ、１６ｂ）上に配置された導体材料層（１８ｃ、１８ａ、１８ｂ）を形成するステップと、
前記抵抗器トレンチ（ＲＴ）を埋め、その中の前記導体領域（１４ａ）と接触するように抵抗器材料層（２０）を形成するステップと
を含む方法。
【請求項１６】
前記基板（１０）内に前記キャパシタ・トレンチ（ＣＴ）と前記抵抗器トレンチ（ＲＴ）とを形成する前記ステップが、前記基板（１０）内の前記抵抗器トレンチ（ＲＴ）よりも幅が狭い線幅（ＬＷＣ）を有する前記キャパシタ・トレンチ（ＣＴ）を形成することを含む、請求項１５に記載の方法。
【請求項１７】
前記誘電材料層（１６ｃ、１６ａ、１６ｂ）を形成する前記ステップ、および前記導体材料層（１８ｃ、１８ａ、１８ｂ）を形成する前記ステップが、前記キャパシタ・トレンチ（ＣＴ）および抵抗器トレンチ（ＲＴ）内にブランケット誘電材料層（１６）を形成し、その上にブランケット導体材料層（１８）を、前記キャパシタ・トレンチ（ＣＴ）は完全に埋め、前記抵抗器トレンチ（ＲＴ）は不完全に埋めるように形成し、次いで、前記抵抗器トレンチ（ＲＴ）の底面の前記導体領域（１４ａ）を露出させるように、前記ブランケット導体材料層（１８）およびブランケット誘電材料層（１６）をエッチングすることを含む、請求項１５に記載の方法。
【請求項１８】
前記抵抗器トレンチ（ＲＴ）内の前記導体材料層（１８ａ、１８ｂ）と前記抵抗器材料層（２０）との間に配置され、前記導体材料層（１８ａ、１８ｂ）と前記抵抗器材料層（２０）とを分離する第２の誘電材料層（１９ａ、１９ｂ）を形成するステップをさらに含む、請求項１５に記載の方法。
【請求項１９】
前記第２の誘電材料層（１９ａ、１９ｂ）を形成する前記ステップが、前記導体材料層（１８ａ、１８ｂ）を酸化させることを含む、請求項１８に記載の方法。
【請求項２０】
前記第２の誘電材料層（１９ａ、１９ｂ）を形成する前記ステップが、前記抵抗器トレンチ（ＲＴ）内の前記導体材料層（１８ａ、１８ｂ）および前記導体領域（１４ａ）上に前記第２の誘電層を付着させ、次いで、前記抵抗器トレンチ（ＲＴ）内の前記導体領域（１４ａ）から前記第２の誘電材料層の一部分を除去することを含む、請求項１８に記載の方法。
【発明の詳細な説明】
【技術分野】
【０００１】
本発明は一般に、半導体構造物内のキャパシタおよび抵抗器に関する。より具体的には、本発明は、半導体構造物内に効率的に製造されたキャパシタおよび抵抗器に関する。
【背景技術】
【０００２】
トランジスタおよびダイオードを半導体回路内の能動デバイスとして使用することに加えて、抵抗器に連結されたキャパシタを半導体回路内の受動デバイスとして使用することも一般的になった。一部の例では、抵抗器に連結されたキャパシタを使用して、共振回路を形成することができる。さらに、キャパシタと抵抗器の組合せは、単一の半導体基板上にアナログ・デバイス、ディジタル・デバイスおよび受動デバイスを集積することによって得られる「システム・オン・チップ」回路内でも一般的に使用されている。
【０００３】
システム・オン・チップ回路およびシステム・オン・チップ応用の文脈で抵抗器に連結されたキャパシタを使用する半導体回路の設計および開発は一般的だが、これらも、他の半導体回路と同様に、デバイスおよび構造物の寸法を低減させ、同時にデバイス性能を向上させ、または維持するという継続的な要求の影響を受ける。そのため、キャパシタ、抵抗器などの受動デバイスは一般に、ディープ・トレンチ・キャパシタおよびディープ・トレンチ抵抗器の文脈で実現される。ディープ・トレンチ・キャパシタおよびディープ・トレンチ抵抗器は、半導体基板などの基板上の約１００から約２００ナノメートル（ｎｍ）の投影面積寸法によって特徴づけられる。ディープ・トレンチ・キャパシタおよびディープ・トレンチ抵抗器はさらに、半導体基板などの基板内に約５から約１０のミクロンの深さを有する。
【０００４】
Ｂｏｙｄ他は、米国特許第５３５２９２３号で、集積回路内のトレンチ抵抗器および該トレンチ抵抗器の製造方法を教示している。この‘９２３号特許に開示されたトレンチ抵抗器および方法は、一対のコンタクト部分の線幅が、この一対のコンタクト部分を分離する中心部分よりも大きい抵抗器トレンチを使用する。
【０００５】
Ｃｈａｋｒａｖａｒｔｉ他は、米国特許第６５２８３８３号で、ディープ・トレンチ・キャパシタとディープ・トレンチ抵抗器とを含む半導体構造物、ならびにその製造方法を教示している。これらのディープ・トレンチ・キャパシタおよびディープ・トレンチ抵抗器のために使用される一対のディープ・トレンチは、単一の半導体基板に同時にエッチングされる。
【特許文献１】米国特許第５３５２９２３号
【特許文献２】米国特許第６５２８３８３号
【発明の開示】
【発明が解決しようとする課題】
【０００６】
半導体デバイスの性能要件は確実に高まっており、半導体デバイスおよび構造物寸法も確実に低減していっているため、小さな寸法で高い性能を有する半導体デバイスおよび半導体構造物を提供することが引き続き求められている。抵抗器に連結されたキャパシタを含む半導体デバイスおよび半導体構造物が含まれる。
【課題を解決するための手段】
【０００７】
本発明は、トレンチ抵抗器に連結されたトレンチ・キャパシタを単一の基板上に含む一対の構造物、および該構造物の１つを製造する方法を提供する。該構造物の１つでは、トレンチ・キャパシタのために使用されるキャパシタ・トレンチが、トレンチ抵抗器のために使用されるトレンチよりも小さい線幅寸法を有する。他の構造および方法では、トレンチ抵抗器が、（１）抵抗器トレンチを含む導体領域と接触しない導体材料層と、（２）抵抗器トレンチを含む導体領域と接触した抵抗器材料層とを含む。
【０００８】
本発明の構造物は一般に半導体構造物だが、上記の構造物および方法が半導体構造物を与える必要は必ずしもない（すなわち本発明の構造物および方法は半導体基板以外の基板を使用することができる）。
【０００９】
本発明に基づく第１の構造物は、単一の基板内に配置されたトレンチ・キャパシタとトレンチ抵抗器とを含む。トレンチ・キャパシタのために使用されるキャパシタ・トレンチは、トレンチ抵抗器のために使用されるトレンチよりも幅が狭い線幅寸法を有する。
【００１０】
本発明に基づく第２の構造物は、その中に配置されたキャパシタ・トレンチと抵抗器トレンチとを含む基板を含む。キャパシタ・トレンチおよび抵抗器トレンチはそれぞれ、その側壁と底面とのうちの少なくとも一方の内部に配置された導体領域をさらに含む。この構造物はさらに、キャパシタ・トレンチ内の導体領域は完全に覆うが、抵抗器トレンチ内の導体領域は完全には覆わない誘電材料層を含む。この構造物はさらに、キャパシタ・トレンチは完全に埋めるが、抵抗器トレンチは不完全に埋め、その中の導体領域と接触しない、誘電材料層上に配置された導体材料層を含む。最後に、この構造物は、抵抗器トレンチを埋め、その中の導体領域と接触するように配置された抵抗器材料層を含む。
【００１１】
本発明に基づく方法は、基板内にキャパシタ・トレンチと抵抗器トレンチとを形成するステップを含む。キャパシタ・トレンチおよび抵抗器トレンチはそれぞれ、その側壁と底面とのうちの少なくとも一方の内部に配置された導体領域を含む。この方法はさらに、キャパシタ・トレンチ内の導体領域を完全は覆うが、抵抗器トレンチ内の導体領域は完全には覆わないように誘電材料層を形成するステップを含む。この方法はさらに、キャパシタ・トレンチは完全に埋めるが、抵抗器トレンチは不完全に埋め、その中の導体領域を露出させ、導体領域と接触しない、誘電材料層上に配置された導体材料層を形成するステップを含む。最後に、この方法は、抵抗器トレンチを埋め、その中の導体領域と接触するように抵抗器材料層を形成するステップを含む。
【００１２】
本発明の目的、特徴および利点は、以下の「発明を実施するための最良の形態」の文脈において理解される。「発明を実施するための最良の形態」は、本開示の重要な部分を構成する添付図面の文脈において理解される。
【発明を実施するための最良の形態】
【００１３】
本発明は、トレンチ抵抗器に連結されたトレンチ・キャパシタを単一の基板上に含む一対の構造物、および該構造物の１つを製造する方法を提供する。該構造物の１つでは、トレンチ・キャパシタのために使用されるキャパシタ・トレンチが、トレンチ抵抗器のために使用されるトレンチよりも小さい線幅寸法を有する。他の構造および方法では、トレンチ抵抗器が、（１）抵抗器トレンチを含む導体領域と接触しない導体材料層と、（２）抵抗器トレンチを含む導体領域と接触した抵抗器材料層とを含む。
【００１４】
図１から図４は、本発明の第１の実施形態に基づくトレンチ・キャパシタとトレンチ抵抗器とを含む半導体構造物を製造する漸進的な諸段階の結果を示す一連の概略断面図を示す。
【００１５】
図１は、その中に配置されたキャパシタ・トレンチＣＴと抵抗器トレンチＲＴとを含む半導体基板１０を示す。したがって、半導体基板１０はエッチングされた半導体基板である。キャパシタ・トレンチＣＴおよび抵抗器トレンチＲＴの側壁の位置は、半導体基板１０上に配置されたパターン形成された一連のハード・マスク層１２ａ、１２ｂおよび１２ｃによって画定される。最後に、抵抗器導体コネクタ領域１４ａが、半導体基板１０内の抵抗器トレンチＲＴを取り囲み、第１のキャパシタ極板領域１４ｂ（すなわち一般に導体領域でもある）が、半導体基板１０内のキャパシタ・トレンチＣＴを取り囲む。
【００１６】
図１はさらに、抵抗器トレンチ線幅ＬＷＲおよびキャパシタ・トレンチ線幅ＬＷＣを示す。抵抗器トレンチ線幅ＬＷＲはキャパシタ・トレンチ線幅ＬＷＣよりも大きい。抵抗器トレンチ線幅ＬＷＲは、キャパシタ・トレンチ線幅ＬＷＣの約１．２から約４倍であることが好ましい。より好ましくは、抵抗器トレンチ線幅ＬＷＲが、キャパシタ・トレンチ線幅ＬＷＣの約１．５から約３倍である。抵抗器トレンチ線幅ＬＷＲは一般に約１０００から約５０００オングストローム、キャパシタ・トレンチ線幅ＬＷＣは一般に約５００から約２０００オングストロームである。抵抗器トレンチＲＴおよびキャパシタ・トレンチＣＴはそれぞれ一般に、約４から約１０ミクロンの単一のトレンチ深さを有するが、抵抗器トレンチＲＴおよびキャパシタ・トレンチＣＴに対するこのような単一のトレンチ深さは、この実施形態または本発明を限定しない。むしろ、この実施形態および本発明では、抵抗器トレンチＲＴの深さが、キャパシタ・トレンチＣＴの深さと同じでも、または同じでなくてもよい。
【００１７】
図１に示された半導体基板１０、構造物および層はそれぞれ、半導体製造技術分野の従来の材料を含み、半導体製造技術分野の従来の寸法を有することができる。さらに、図１に示された半導体基板１０、構造物および層はそれぞれ、半導体製造技術分野の従来の方法を使用して形成することができる。
【００１８】
例えば、半導体基板１０は、限定はされないが、シリコン、ゲルマニウム、シリコンゲルマニウム合金、炭化シリコン、炭化シリコンゲルマニウム合金、および化合物（すなわちＩＩＩ−ＶおよびＩＩ−ＶＩ）半導体材料を含む半導体材料を含むことができる。化合物半導体材料の非限定的な例には、ガリウムヒ素、インジウムヒ素およびインジウムリン半導体材料が含まれる。半導体基板１０はさらに、例えばシリコン・オン・インシュレータ基板などのセミコンダクタ・オン・インシュレータ（ＳＯＩ）基板を含むことができる。半導体基板１０は単一の結晶方位を有してもよく、または異なる結晶学的方位を有する表面領域を含んでもよい。後者は、半導体技術分野においてハイブリッド基板と呼ばれている。半導体基板１０は一般に、適当なバルク・ドーピングを有するシリコンまたはシリコンゲルマニウム合金半導体材料を含み、あるいは適当なバルク・ドーピングを有するシリコンまたはシリコンゲルマニウム合金半導体材料からなる。特にＰ−バルク・ドーピングが一般的だが、本発明はそれだけに限定されない。
【００１９】
パターン形成された一連のハード・マスク層１２ａ、１２ｂおよび１２ｃは、限定はされないが、酸化物、窒化物または酸窒化物、あるいはこれらの任意の組合せなどのハード・マスク材料を含むことができる。パターン形成された一連のハード・マスク層１２ａ、１２ｂおよび１２ｃはあるいは、上記のハード・マスク材料の複合物または積層物を含んでもよい。パターン形成された一連のハード・マスク層１２ａ、１２ｂおよび１２ｃは一般に、追加的に応力吸収材料の役目も果たす対応する酸化物ハード・マスク材料上に位置を合わせて配置された窒化物または酸窒化物ハード・マスク材料を含む。
【００２０】
パターン形成された一連のハード・マスク層１２ａ、１２ｂおよび１２ｃは、いくつかあるうちの任意の方法を使用して形成することができる。非限定的な例には、熱酸化法、化学蒸着法（プラズマ化学蒸着法および低圧化学蒸着法を含む）および物理蒸着法が含まれる。パターン形成された一連のハード・マスク層１２ａ、１２ｂおよび１２ｃはそれぞれ一般に、約５００から約２０００オングストロームの厚さを有する。
【００２１】
最後に、抵抗器導体コネクタ領域１４ａおよび（導体領域でもある）第１のキャパシタ極板領域１４ｂは一般に、抵抗器トレンチＲＴおよびキャパシタ・トレンチＣＴの側壁位置および床（すなわち底面）位置から半導体基板１０内に適当なドーパントを導入した結果である。ドーパント導入法の非限定的な例には、熱拡散法、イオン注入法、プラズマ・ドーピング法、プラズマ・イオン浸漬注入法、気相ドーピング法、固相ドーピング法、液相ドーピング法、および上記の方法の適当な任意の組合せが含まれる。基板１０がＰ型半導体材料を含むとき、抵抗器導体コネクタ領域１４ａおよび第１のキャパシタ極板領域１４ｂはそれぞれ一般に、１立方センチメートルあたり約１ｅ１８から約１ｅ２２ドーパント原子のＮ型ドーピングを有する。このＮ型ドーピングは、適当なＮ型ドーパントを使用して達成することができる。リンおよびヒ素は一般的なＮ型ドーパントの例である。
【００２２】
図１の半導体構造物を製造するには、最初に、（半導体基板１０を形成するために後にエッチングされる）半導体基板を用意する。半導体基板の表面に、ブランケット・ハード・マスク層を形成し、配置する。ブランケット・ハード・マスク層上に、パターン形成された一連のフォトレジスト層を形成し、配置する。パターン形成された一連のフォトレジスト層をマスクとして使用して、ブランケット・ハード・マスク層から、パターン形成された一連のハード・マスク層１２ａ、１２ｂおよび１２ｃを形成する。少なくともパターン形成された一連のハード・マスク層１２ａ、１２ｂおよび１２ｃ（および任意選択でパターン形成された一連のフォトレジスト層）をマスクとして使用して、半導体基板１０内に、抵抗器トレンチＲＴとキャパシタ・トレンチＣＴとを同時にエッチングする。最後に、半導体基板１０内に抵抗器導体コネクタ領域１４ａおよび第１のキャパシタ極板領域１４ｂを形成し、配置する。
【００２３】
図２は、図１に示された半導体構造物上に形成され、配置された第１のブランケット誘電層１６を示す。第１のブランケット誘電層１６は、パターン形成された一連のハード・マスク層１２ａ、１２ｂおよび１２ｃの上面および側壁部分、ならびにキャパシタ・トレンチＣＴおよび抵抗器トレンチＲＴの側壁および床部分を連続的に覆うように配置される。図２は、第１のブランケット誘電層１６上に形成され、配置された第１のブランケット・トレンチ充填層１８も示している。
【００２４】
第１の例では、第１のブランケット誘電層１６が、酸化物、窒化物または酸窒化物誘電材料、あるいはこれらの任意の組合せなど、一般的に従来の誘電材料を含む（一般にシリコンの酸化物、窒化物または酸窒化物だが、その他の酸化物、窒化物および酸窒化物も排除されない）。上記の一般的に従来の誘電材料は、真空で測定された約３から約２０の誘電率を有する。第１のブランケット誘電層１６はあるいは、約２０から少なくとも約１００の誘電率を有する一般的により高い誘電率の誘電材料を含んでもよい。このような一般的により高い誘電率の誘電材料には、限定はされないが、酸化ハフニウム、ケイ酸ハフニウム、酸化チタン、酸化ランタン、チタン酸バリウムストロンチウム（ＢＳＴ）およびジルコン酸チタン酸鉛（ＰＺＴ）が含まれる。上記の２つのタイプの誘導材料はいずれも、いくつかあるうちの任意の方法を使用して形成することができる。非限定的な例には、熱酸化法、熱窒化法、熱酸窒化法、化学蒸着法（いくつかの変法がある）、原子層付着法および物理蒸着法が含まれる。
【００２５】
第１のブランケット誘電層１６は一般に、厚さ約２０から約７０オングストロームの窒化シリコン誘電材料を少なくとも部分的に含むが、本発明はこれだけに限定されない。第１のブランケット誘電層１６は一般に共形であり、化学蒸着または原子層付着法を使用して付着されるが、本発明はこれだけに限定されない。
【００２６】
第１のブランケット・トレンチ充填層１８の厚さ、ならびに抵抗器トレンチＲＴおよびキャパシタ・トレンチＣＴの線幅は、第１のブランケット・トレンチ充填層１８が、キャパシタ・トレンチＣＴを少なくとも上面まで完全に埋めるが、抵抗器トレンチＲＴは完全には埋めないように決められる。限定はされないが、先に開示したとおり、抵抗器トレンチＲＴは一般に、約１０００から約５０００オングストロームの抵抗器トレンチ線幅ＬＷＲを有し、キャパシタ・トレンチは一般に、約５００から約２０００オングストロームのキャパシタ・トレンチ線幅ＬＷＣを有する。第１のブランケット・トレンチ充填層１８は、パターン形成されたハード・マスク層１２ａ、１２ｂおよび１２ｃの上面から測定された約２５０から約１０００オングストロームの厚さを有する。
【００２７】
第１のブランケット・トレンチ充填層１８は、本発明に対して適当ないくつかのトレンチ充填材料のうちの任意の材料を含むことができる。導体トレンチ充填材料が最も適当であり、状況によっては、半導体トレンチ充填材料も使用可能だが、半導体トレンチ充填材料は一般にあまり望ましくない。導体トレンチ充填材料の非限定的な例には、金属、金属合金、金属窒化物、金属シリサイド、ポリサイドおよびドープされた（１立方センチメートルあたり１ｅ１８から１ｅ２２ドーパント原子）ポリシリコン導体材料が含まれる。これらの組合せおよびこれらの多重層も企図される。第１のブランケット・トレンチ充填層１８は共形であり、キャパシタ・トレンチＣＴ全体を完全に埋めることが好ましい。あるいは、第１のブランケット・トレンチ充填層１８は、キャパシタ・トレンチＣＴの上面で離れていた部分が接触し、したがってキャパシタ・トレンチＣＴ内に埋め込まれた１つまたは複数の空隙を生ずるように形成される。
【００２８】
導体トレンチ充填材料の上記の非限定的な例は、当技術分野の従来の方法を使用して形成することができる。この方法の非限定的な例には、化学蒸着法、原子層付着法、物理蒸着法、スパッタリング法、熱アニール法、プラズマ処理法およびイオン注入法が含まれる。第１のブランケット・トレンチ充填層１８は一般に、前述の約２５０から約１０００オングストロームの厚さを有するドープされたポリシリコン・トレンチ充填材料を含む。
【００２９】
図３は、（１）抵抗器トレンチＲＴの周縁に配置され、したがって抵抗器トレンチＲＴを不完全に埋め、したがって抵抗器開口ＲＡを部分的に画定した（具体的には、抵抗器導体コネクタ領域１４ａと接触しない）パターン形成された一対の第１のトレンチ充填層１８ａおよび１８ｂ、ならびに（２）キャパシタ・トレンチＣＴ内に配置され、キャパシタ・トレンチＣＴを完全に埋めた第２のキャパシタ極板１８ｃと示す。図３はさらに、（１）抵抗器トレンチＲＴ内のパターン形成された一対の第１のトレンチ充填層１８ａおよび１８ｂの下に形成され、配置されたパターン形成された一対の第１の誘電層１６ａおよび１６ｂ、ならびに（２）第２のキャパシタ極板１８ｃと第１のキャパシタ極板領域１４ｂとの間に配置されたパターン形成されたキャパシタ誘電層１６ｃを示す。パターン形成された一対の第１のトレンチ充填層１８ａ、１８ｂおよび第２のキャパシタ極板層１８ｃ、ならびにパターン形成された一対の第１の誘電層１６ａ、１６ｂおよびパターン形成されたキャパシタ誘電層１６ｃは一般に、第１のブランケット・トレンチ充填層１８の異方性エッチング、およびそれに続く第１のブラケット誘電層１６のエッチング（異方性でもまたは等方性でもよい）に付随して形成される。
【００３０】
この実施形態では、異方性エッチングが異方性エッチング剤を使用して実施される。異方性エッチング剤は一般に異方性プラズマ・エッチング剤である。第１のブランケット・トレンチ充填層１８がドープされたポリシリコン導体材料を含むとき、第１のブランケット・トレンチ充填層１８は、塩素を含むエッチング・ガス組成物を含むプラズマ・エッチング剤を使用してエッチングすることができる。第１のブランケット・トレンチ充填層１８の異方性エッチングの後、抵抗器トレンチＲＴの底面の第１のブランケット誘電層１６の一部が露出し、キャパシタ・トレンチＣＴの底面の第１のブランケット誘電層１６は露出しない。次いで、抵抗器トレンチＲＴの底面の第１のブランケット誘電層１６の露出部分がエッチングされる。第１のブランケット誘電層１６が、酸化シリコン誘電材料または他のシリコンを含む誘電材料を含むとき、第１のブランケット誘電層１６は、フッ素を含むエッチング・ガス組成物を含むプラズマ・エッチング剤を使用してエッチングすることができる。あるいは、第１のブランケット誘電層１６は、一般に等方性エッチング・プロセスであるウェット・エッチング・プロセスを使用してエッチングすることもできる。例えば、第１のブランケット誘電層１６が酸化シリコン誘電材料を含むとき、第１のブランケット誘電層１６は、フッ化水素酸を含む水性溶液またはフッ化水素酸材料を使用して効率的にエッチングすることができる。図３に示されているように、このエッチングは、抵抗器開口ＲＡの露出した床部分が抵抗器導体コネクタ領域１４ａを含むように実施される。すなわち、このエッチング・ステップは、抵抗器開口ＲＡを形成するときに、抵抗器トレンチＲＴ内の半導体基板１０の一部分を露出させる。
【００３１】
図４は、図３に示された抵抗器開口ＲＡ内に形成され、配置されたパターン形成された第２の抵抗器充填層２０を示す。パターン形成された第２の抵抗器充填層２０は、いくつかあるうちの任意の抵抗器材料を含むことができる。この抵抗器材料は一般に、図２に示された第１のブランケット・トレンチ充填層１８または図３に示されたパターン形成された第１のトレンチ充填層１８ａおよび１８ｂを構成する導体材料よりも高い抵抗率を有する。この抵抗器材料はさらに、金属窒化物、金属シリサイド、ポリサイド、半導体材料、より薄くドープされた（すなわち１立方センチメートルあたり約１ｅ４から約１ｅ１０ドーパント原子のドーパント濃度を有する）ポリシリコン材料、および場合によってはドープされていないポリシリコン材料のうちのいくつかのタイプの材料を含むことができる。この抵抗器材料はさらに、第１のブランケット・トレンチ充填層１８を形成するために使用される方法と類似の、等価の、または同一の方法を使用して形成することができる。
【００３２】
パターン形成された第２の抵抗器充填層２０は一般に、化学蒸着法を使用して付着させたより薄くドープされた（前述のドーパント濃度を有する）ポリシリコン材料、またはドープされていないポリシリコン材料を含む。第１のブランケット・トレンチ充填層１８に関して先に説明した他の方法を使用してもよい。より薄くドープされたポリシリコン材料は一般に、抵抗器開口ＲＡを完全に埋める十分な厚さを有するブランケット層として付着される。厚さは一般に約１０００から約５０００オングストロームだが、本発明はこの厚さに限定されない。次いで、しばしばパターン形成された一連のハード・マスク層１２ａ、１２ｂおよび１２ｃを平坦化ストップ層として使用して、第２のブランケット抵抗器充填層の過剰な部分を平坦化することができる。いくつかあるうちの任意の平坦化法を使用することができる。非限定的な例には、反応性イオン・エッチング・エッチバック平坦化法、機械平坦化法および化学機械研磨平坦化法が含まれる。特に化学機械研磨平坦化法が一般的である。
【００３３】
図４は、その中に形成、配置された本発明の第１の実施形態に基づくトレンチ・キャパシタとトレンチ抵抗器とを有する半導体構造物の概略断面図を示す。
【００３４】
トレンチ・キャパシタは、第１のキャパシタ極板領域１４ｂと、パターン形成されたキャパシタ誘電層１６ｃと、第２のキャパシタ極板１８ｃとを含む。トレンチ抵抗器は、抵抗器導体コネクタ領域１４ａと、パターン形成された一対の第１の誘電層１６ａおよび１６ｂと、パターン形成された一対の第１のトレンチ充填層１８ａおよび１８ｂと、パターン形成された第２の抵抗器充填層２０とを含む。図４に示されているように、トレンチ・キャパシタとトレンチ抵抗器は、単一の半導体基板１０内に集積されている。トレンチ・キャパシタおよびトレンチ抵抗器は自己整合法を使用して製造される。この自己整合法に付随して、トレンチ・キャパシタのために使用されるキャパシタ・トレンチは、トレンチ抵抗器のために使用される抵抗器トレンチよりも小さい線幅寸法を有する。
【００３５】
図５から図８は、その中に配置された本発明の第２の実施形態に基づくトレンチ・キャパシタとトレンチ抵抗器とを有する半導体構造物を製造する漸進的な諸段階の結果を示す一連の概略断面図を示す。
【００３６】
図５から図８は概ね、図１から図４に対応し、同一の参照符号は同様の構造物または同一の構造物を表す。具体的には、図５は図１を、図６は図２を複写したものである。しかし、例外として、図７および図８は（図３および図４と比較して）、パターン形成された一対の第１のトレンチ充填層１８ａおよび１８ｂを覆うように形成され、配置されたパターン形成された一対の第２の共形誘電層１９ａおよび１９ｂを示す。パターン形成された一対の第２の共形誘電層１９ａおよび１９ｂは、パターン形成された一対の第１の誘電層１６ａおよび１６ｂとともに、パターン形成された一対の第１のトレンチ充填層１８ａおよび１８ｂを完全にカプセル化する。したがって、本発明の第２の実施形態では、パターン形成された一対の第１のトレンチ充填層１８ａおよび１８ｂが、パターン形成された第２の抵抗器充填層２０から完全に分離される。したがって、たとえパターン形成された一対の第１のトレンチ充填層１８ａおよび１８ｂが高導電率のトレンチ充填材料を含む場合であっても、パターン形成された一対の第１のトレンチ充填層１８ａおよび１８ｂは、パターン形成された第２の抵抗器充填層２０を構成する抵抗材料の抵抗特性に影響を与えない。
【００３７】
パターン形成された一対の第２の共形誘電層１９ａおよび１９ｂは、パターン形成された一対の第１の誘電層１６ａおよび１６ｂを形成するために使用される材料、寸法および方法と類似の、等価の、または同一の材料を含み、厚さ寸法を有し、および方法を使用して形成することができる。より一般的には、パターン形成された一対の第２の共形誘電層１９ａおよび１９ｂは、約５０から約１５０オングストロームの厚さを有する酸化シリコン材料を含む。パターン形成された一対の第１のトレンチ充填層１８ａおよび１８ｂがポリシリコン材料を含むとき、この酸化シリコン材料は、パターン形成された一対の第１のトレンチ充填層１８ａおよび１８ｂの熱アニールおよび酸化（すなわち熱酸化）に付随して形成することができる。代替材料を使用することもでき、限定はされないが、化学蒸着法、熱付着法、原子層付着法、物理蒸着法などの代替付着法を使用することもできる。このような付着法は一般に、第２のブランケット共形誘電層を形成し、この第２のブランケット共形誘電層は一般に、パターン形成された一対の第２の共形誘電層１９ａおよび１９ｂを形成するときに、抵抗器開口ＲＡの床から第２のブランケット共形誘電層の一部を除去するために異方性エッチングされる。
【００３８】
図８は、本発明の第２の実施形態に基づくトレンチ・キャパシタとトレンチ抵抗器とを含む半導体構造物の概略断面図を示す。第２の実施形態と第１の実施形態の両方が、第１のキャパシタ極板領域１４ｂと、パターン形成されたキャパシタ誘電層１６ｃと、第２のキャパシタ極板１８ｃとを含むトレンチ・キャパシタを有する点では、第２の実施形態は一般に第１の実施形態と一致している。さらに、トレンチ抵抗器が、パターン形成された一対の第１の誘電層１６ａ、１６ｂおよびパターン形成された一対の第１のトレンチ充填層１８ａ、１８ｂによって、パターン形成された第２の抵抗器充填層２０から部分的に分離された抵抗器導体コネクタ領域１４ａを含む点で、第２の実施形態と第１の実施形態とは一般に同様である。しかし、第２の実施形態はさらに、パターン形成された一対の第１のトレンチ充填層１８ａおよび１８ｂを、パターン形成された第２の抵抗器充填層２０から電気的に完全に分離する、パターン形成された一対の第２の共形誘電層１９ａおよび１９ｂを含む。最後に、第１の実施形態と第２の実施形態ではともに、トレンチ・キャパシタのために使用されるキャパシタ・トレンチが、トレンチ抵抗器のために使用される抵抗器トレンチよりも幅が狭い線幅寸法を有する。
【００３９】
図９から図１１は、図４に示されたトレンチ・キャパシタとトレンチ抵抗器とを含む半導体構造物（すなわち本発明の第１の実施形態）への一連のコンタクトを形成した結果を示す一連の概略断面図を示す。第１の例では、図９が図４に一致し、同一の参照符号が同一の構造物を表す。
【００４０】
図１０は、抵抗器導体コネクタ領域１４ａと連続して配置されたコンタクト導体コネクタ領域１４ｃと、第１のキャパシタ極板領域１４ｂと連続して配置されたコンタクト導体コネクタ領域１４ｄとを示す。コンタクト導体コネクタ領域１４ｃおよび１４ｄはそれぞれ一般に、抵抗器導体コネクタ領域１４ａおよび第１のキャパシタ極板領域１４ｂを形成するために使用されるドーパント極性およびドーズ量に近いドーパント極性およびドーズ量を用いたイオン注入法を使用して形成される。代替として他のドーパント導入法を使用してもよいが、それらの方法は一般に、代替の処理スキームを要求すると考えられる。ドーパントの極性は同じである。
【００４１】
イオン注入法を使用するとき、一対のコンタクト導体コネクタ領域１４ｃおよび１４ｄは、図９の半導体構造物の適当なマスキングおよびそれに続く適当なイオン注入プロセス・ステップに付随して形成することができる。このイオン注入プロセス・ステップは、パターン形成された一対のハード・マスク層１２ａおよび１２ｃを貫通する十分なイオン注入エネルギーを使用することが好ましい。
【００４２】
図１１は、コンタクト導体コネクタ領域１４ｃ、１４ｄ、パターン形成された第２の抵抗器充填層２０、および第２のキャパシタ極板１８ｃとそれぞれ１つずつ接触するように配置された一連のコンタクト領域２２ａ、２２ｂ、２２ｃおよび２２ｄを示す。
【００４３】
一対のコンタクト領域２２ａおよび２２ｄのための位置を提供するため、パターン形成されたハード・マスク層１２ａおよび１２ｃはそれぞれさらにパターン形成されて、２度にわたってパターン形成された一対のハード・マスク層１２ａ′および１２ａ″、ならびに２度にわたってパターン形成された一対のハード・マスク層１２ｃ′および１２ｃ″を提供する。パターン形成された一対のハード・マスク層１２ａおよび１２ｃのこのようなパターン形成は、半導体基板１０を構成する単結晶シリコン材料を一般に含むコンタクト導体コネクタ領域１４ｃおよび１４ｄの部分を露出させる。上記の開示によれば、一般に、パターン形成された第２の抵抗器充填層２０と第２のキャパシタ極板１８ｃはともに、ドーパント濃度は異なるとはいえ、ポリシリコン材料を含む。
【００４４】
コンタクト領域２２ａ、２２ｂ、２２ｃおよび２２ｄはそれぞれ一般に、半導体製造技術分野における従来のシリサイド材料を含む。あるいは、コンタクト領域２２ａおよび２２ｄは、シリサイド材料が上に重なったドープされたポリシリコンを含んでもよい。ある種の金属、金属合金、金属窒化物などの他のコンタクト材料も排除されないが、それらは処理がより難しい可能性があり、または、図１１に示されたトレンチ・キャパシタおよびトレンチ抵抗器に対する電気的接続に比べて効率が低下する可能性がある。
【００４５】
コンタクト領域２２ａ、２２ｂ、２２ｃおよび２２ｄは、限定はされないが、チタン、タングステン、コバルトおよびニッケルシリサイドならびにこれらの合金を含むグループから選択された金属シリサイドを含むことができる。コンタクト領域２２ａ、２２ｂ、２２ｃおよび２２ｄはそれぞれ一般に、自己整合シリサイド（すなわちサリサイド）法を使用して形成されるが、他の方法も排除されない。このような自己整合シリサイド法は、金属シリサイドを形成する金属層を、シリコン基板（すなわちアモルファス、多結晶または単結晶シリコン基板）上に形成し、次いで積層されたこの構造物を熱アニールして、領域選択的な金属シリサイド層を得ることを含む。反応しなかった金属シリサイド形成金属の過剰部分は、金属シリサイド形成金属の組成に対して適当なエッチング剤を使用して除去される。特定の金属シリサイド形成金属は一般に、一般に湿式化学エッチング剤である特定のエッチング剤の中でエッチングされる。いくつかの実施形態では、この選択的エッチング・プロセスに続いて第２の熱アニールを実施してもよい。
【００４６】
図１１は、本発明の第１の実施形態に基づく半導体構造物内のトレンチ・キャパシタとトレンチ抵抗器の導体接続スキームの第１の実施形態を示す。この導体接続スキームは、トレンチ・キャパシタを、トレンチ抵抗器とは別個に配線することを含む。トレンチ・キャパシタは、（１）コンタクト導体コネクタ領域１４ｄおよびコンタクト領域２２ｄを介して第１のキャパシタ極板領域１４ｂに配線され、（２）コンタクト層２２ｃ介して第２のキャパシタ極板１８ｃに配線される。トレンチ抵抗器は、（１）抵抗器導体コネクタ領域１４ａ、コンタクト導体コネクタ領域１４ｃおよびコンタクト領域２２ａを介してパターン形成された第２の抵抗器充填層２０の（抵抗器開口ＲＡの底面の）第１の側に配線され、（２）コンタクト領域２２ｂを介して、パターン形成された第２の抵抗器充填層２０の露出した第２の側に配線される。
【００４７】
図１２から図１４は、本発明の第１の実施形態に基づくトレンチ・キャパシタとトレンチ抵抗器とを含む半導体構造物に対するコンタクト構造の第２の実施形態を形成した結果を示す一連の概略断面図を示す。
【００４８】
図１２は、図９および図４と一致し、図９および図４と同一である。同一の参照符号は同一の構造を指す。
【００４９】
図１３は、抵抗器導体コネクタ領域１４ａと第１のキャパシタ極板領域１４ｂの最も近い部分間に配置されたブリッジング導体コネクタ領域１４ｅを示す。ブリッジング導体コネクタ領域１４ｅは、図１０に示されたコンタクト導体コネクタ領域１４ｃおよび１４ｄを形成するために使用される方法と類似の、等価の、または同一の方法を使用して形成することができる。
【００５０】
図１４はさらに、図１１に示されたものと同一の一対のコンタクト領域２２ｂおよび２２ｃを示す。この場合も、一対のコンタクト領域２２ｂおよび２２ｃは一般にシリサイド・コンタクト材料を含む。
【００５１】
図１４は、本発明の第１の実施形態に基づく半導体構造物内のトレンチ・キャパシタとトレンチ抵抗器とを相互接続する第２の実施形態を示す。図１４では、トレンチ・キャパシタ内の第１のキャパシタ極板領域１４ｂと、トレンチ抵抗器内の抵抗器導体コネクタ領域１４ａとを接続するブリッジング導体コネクタ領域１４ｅを使用することによって、トレンチ・キャパシタとトレンチ抵抗器が直列に配線されている。トレンチ抵抗器に直列に接続されたトレンチ・キャパシタに対する外部接続は、コンタクト領域２２ｂおよび２２ｃによって達成される。
【００５２】
図１５および図１６は、本発明の第１の実施形態に基づく半導体構造物内のトレンチ・キャパシタとトレンチ抵抗器とを接続する第３の実施形態を示す一対の概略断面図を示す。
【００５３】
図１５は、その他の点では図４、図９または図１２に示されたトレンチ・キャパシタおよびトレンチ抵抗器と類似しているが、トレンチ抵抗器内の抵抗器導体コネクタ領域１４ａがトレンチ・キャパシタ内の第１のキャパシタ極板領域１４ｂと接触しているトレンチ・キャパシタおよびトレンチ抵抗器を示す。したがって、トレンチ・キャパシタとトレンチ抵抗器とを接続するこの第３の実施形態では、抵抗器導体コネクタ領域１４ａと第１のキャパシタ極板領域１４ｂとの間の電気的連続が有効な接触または重複に付随して達成されるため、図１３および図１４に示された第２の実施形態にはあるブリッジング導体コネクタ領域（すなわちブリッジング導体コネクタ領域１４ｅ）が必要ない。図１６に示されているように、第３の実施形態もやはり、直列に接続されたトレンチ抵抗器およびトレンチ・キャパシタに接続するための一対のコンタクト領域２２ｂおよび２２ｃを提供する。
【００５４】
トレンチ・キャパシタとトレンチ抵抗器とを相互接続するこの第３の実施形態では、抵抗器導体コネクタ領域１４ａと第１のキャパシタ極板領域１４ｂとの接触または重複を、トレンチ抵抗器をトレンチ・キャパシタの方へ横方向に単純に移動させることによって達成することができる。代替として、より深いイオン注入を使用することによって、抵抗器導体コネクタ領域１４ａおよび第１のキャパシタ極板領域１４ｂを大きくしてもよい。追加の代替として、上記の両方の代替法を使用した構造物を使用してもよい。
【００５５】
図９から図１６で説明したトレンチ抵抗器とトレンチ・キャパシタとを接続する実施形態は、図８に示された本発明の第２の実施形態に適用することも可能である。
【００５６】
本発明の上記の好ましい実施形態は本発明を例示するものであって、本発明を限定するものではない。単一の半導体基板に集積された本発明の好ましい実施形態に基づくトレンチ・キャパシタとトレンチ抵抗器とを含む半導体構造物の方法、材料、構造および寸法に変更および修正を加え、同時に、本発明に基づく集積されたトレンチ・キャパシタとトレンチ抵抗器とを含む構造物であって、添付の特許請求の範囲に基づく構造物を提供することができる。
【００５７】
本発明の構造物および該構造物の製造方法は集積回路の製造において有用であり、半導体構造物内のキャパシタおよび抵抗器に対して特に有用である。
【図面の簡単な説明】
【００５８】
【図１】本発明の第１の実施形態に基づくトレンチ・キャパシタとトレンチ抵抗器とを含む半導体構造物を製造する漸進的な諸段階の結果を示す一連の概略断面図の１つを示す図である。
【図２】本発明の第１の実施形態に基づくトレンチ・キャパシタとトレンチ抵抗器とを含む半導体構造物を製造する漸進的な諸段階の結果を示す一連の概略断面図の１つを示す図である。
【図３】本発明の第１の実施形態に基づくトレンチ・キャパシタとトレンチ抵抗器とを含む半導体構造物を製造する漸進的な諸段階の結果を示す一連の概略断面図の１つを示す図である。
【図４】本発明の第１の実施形態に基づくトレンチ・キャパシタとトレンチ抵抗器とを含む半導体構造物を製造する漸進的な諸段階の結果を示す一連の概略断面図の１つを示す図である。
【図５】本発明の第２の実施形態に基づくトレンチ・キャパシタとトレンチ抵抗器とを含む半導体構造物を製造する漸進的な諸段階の結果を示す一連の概略断面図の１つを示す図である。
【図６】本発明の第２の実施形態に基づくトレンチ・キャパシタとトレンチ抵抗器とを含む半導体構造物を製造する漸進的な諸段階の結果を示す一連の概略断面図の１つを示す図である。
【図７】本発明の第２の実施形態に基づくトレンチ・キャパシタとトレンチ抵抗器とを含む半導体構造物を製造する漸進的な諸段階の結果を示す一連の概略断面図の１つを示す図である。
【図８】本発明の第２の実施形態に基づくトレンチ・キャパシタとトレンチ抵抗器とを含む半導体構造物を製造する漸進的な諸段階の結果を示す一連の概略断面図の１つを示す図である。
【図９】本発明の第１の実施形態に基づくトレンチ・キャパシタとトレンチ抵抗器とを相互接続する第１の実施形態の漸進的な諸段階を示す一連の概略断面図の１つを示す図である。
【図１０】本発明の第１の実施形態に基づくトレンチ・キャパシタとトレンチ抵抗器とを相互接続する第１の実施形態の漸進的な諸段階を示す一連の概略断面図の１つを示す図である。
【図１１】本発明の第１の実施形態に基づくトレンチ・キャパシタとトレンチ抵抗器とを相互接続する第１の実施形態の漸進的な諸段階を示す一連の概略断面図の１つを示す図である。
【図１２】本発明の第１の実施形態に基づくトレンチ・キャパシタとトレンチ抵抗器とを相互接続する第２の実施形態の漸進的な諸段階を示す一連の概略断面図の１つを示す図である。
【図１３】本発明の第１の実施形態に基づくトレンチ・キャパシタとトレンチ抵抗器とを相互接続する第２の実施形態の漸進的な諸段階を示す一連の概略断面図の１つを示す図である。
【図１４】本発明の第１の実施形態に基づくトレンチ・キャパシタとトレンチ抵抗器とを相互接続する第２の実施形態の漸進的な諸段階を示す一連の概略断面図の１つを示す図である。
【図１５】本発明の第１の実施形態に基づくトレンチ・キャパシタとトレンチ抵抗器とを相互接続する第３の実施形態の漸進的な諸段階を示す一対の概略断面図の１つを示す図である。
【図１６】本発明の第１の実施形態に基づくトレンチ・キャパシタとトレンチ抵抗器とを相互接続する第３の実施形態の漸進的な諸段階を示す一対の概略断面図の１つを示す図である。
【図１】
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【図２】
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【図３】
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【図４】
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【図５】
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【図６】
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【図７】
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【図８】
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【図９】
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【図１０】
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【図１１】
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【図１２】
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【図１３】
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【図１４】
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【図１５】
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【図１６】
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【手続補正書】
【提出日】平成21年3月13日(2009.3.13)
【手続補正１】
【補正対象書類名】特許請求の範囲
【補正対象項目名】全文
【補正方法】変更
【補正の内容】
【特許請求の範囲】
【請求項１】
単一の基板（１０）内に配置されたトレンチ・キャパシタとトレンチ抵抗器とを含む構造物であって、前記トレンチ・キャパシタのために使用されるキャパシタ・トレンチ（ＣＴ）が、前記トレンチ抵抗器のために使用される抵抗器トレンチ（ＲＴ）よりも幅が狭い線幅寸法（ＬＷＣ）を有する構造物。
【請求項２】
前記トレンチ・キャパシタが、前記キャパシタ・トレンチ（ＣＴ）を埋める導体材料（１８ｃ）を含み、
前記トレンチ抵抗器が、
前記抵抗器トレンチ（ＲＴ）の周縁に配置された前記導体材料（１８ａ、１８ｂ）と、
前記抵抗器トレンチの中心に配置された抵抗器材料（２０）と
を含む、
請求項１に記載の構造物。
【請求項３】
前記抵抗器材料（２０）が、前記抵抗器トレンチ（ＲＴ）内の前記導体材料（１８ａ、１８ｂ）と接触した、請求項２に記載の構造物。
【請求項４】
前記抵抗器材料（２０）が、誘電材料（１９ａ、１９ｂ）によって、前記抵抗器トレンチ（ＲＴ）内の前記導体材料（１８ａ、１８ｂ）から分離された、請求項２に記載の構造物。
【請求項５】
前記導体材料（１８ａ、１８ｂ）がポリシリコン導体材料を含み、
前記抵抗器材料がポリシリコン抵抗器材料を含み、
前記ポリシリコン導体材料が、前記ポリシリコン抵抗器材料よりも高いドーピング濃度を有する、請求項３に記載の構造物。
【請求項６】
その中に配置されたキャパシタ・トレンチ（ＣＴ）と抵抗器トレンチ（ＲＴ）とを含む基板（１０）であって、前記キャパシタ・トレンチ（ＣＴ）および前記抵抗器トレンチ（ＲＴ）がそれぞれ、その側壁と底面とのうちの少なくとも一方の内部に配置された導体領域（１４ｂ、１４ａ）を含む基板（１０）と、
前記キャパシタ・トレンチ（ＣＴ）内の前記導体領域（１４ｂ）は完全に覆うが、前記抵抗器トレンチ（ＲＴ）内の前記導体領域（１４ａ）は完全には覆わない誘電材料層（１６ｃ、１６ａ、１６ｂ）と、
前記キャパシタ・トレンチ（ＣＴ）は完全に埋めるが、前記抵抗器トレンチ（ＲＴ）は不完全に埋め、その中の前記導体領域（１４ａ）と接触しない、前記誘電材料層（１６ｃ、１６ａ、１６ｂ）上に配置された導体材料層（１８ｃ、１８ａ、１８ｂ）と、
前記抵抗器トレンチ（ＲＴ）を埋め、その中の前記導体領域（１４ａ）と接触するように配置された抵抗器材料層（２０）と
を含む構造物。
【請求項７】
前記キャパシタ・トレンチ（ＣＴ）が、前記抵抗器トレンチ（ＲＴ）よりも幅が狭い線幅（ＬＷＣ）を有する、請求項６に記載の構造物。
【請求項８】
前記抵抗器材料層（２０）が、前記抵抗器トレンチ（ＲＴ）内の前記導体材料層（１８ａ、１８ｂ）と接触した、請求項６に記載の構造物。
【請求項９】
前記抵抗器材料層（２０）が、前記抵抗器トレンチ（ＲＴ）内の前記導体材料層（１８ａ、１８ｂ）と接触していない、請求項６に記載の構造物。
【請求項１０】
前記抵抗器トレンチ（ＲＴ）内の前記導体材料層（１８ａ、１８ｂ）と前記抵抗器材料層（２０）との間に配置され、前記導体材料層（１８ａ、１８ｂ）と前記抵抗器材料層（２０）とを分離する第２の誘電材料層（１９ａ、１９ｂ）をさらに含む、請求項６に記載の構造物。
【請求項１１】
前記キャパシタ・トレンチ（ＣＴ）を含む前記導体領域（１４ｂ）が、前記抵抗器トレンチ（ＲＴ）を含む前記導体領域（１４ａ）と接触した、請求項６に記載の構造物。
【請求項１２】
前記キャパシタ・トレンチ（ＣＴ）を含む前記導体領域（１４ｂ）を、前記抵抗器トレンチ（ＲＴ）を含む前記導体領域（１４ａ）に接続するように配置された追加の別個の導体領域（１４ｅ）をさらに含む、請求項６に記載の構造物。
【請求項１３】
構造物を製造する方法であって、
基板（１０）内にキャパシタ・トレンチ（ＣＴ）と抵抗器トレンチ（ＲＴ）とを形成するステップであって、前記キャパシタ・トレンチ（ＣＴ）および前記抵抗器トレンチ（ＲＴ）がそれぞれ、その側壁と底面とのうちの少なくとも一方の内部に配置された導体領域（１４ｂ、１４ａ）を含むステップと、
前記キャパシタ・トレンチ（ＣＴ）内の前記導体領域（１４ｂ）は完全に覆うが、前記抵抗器トレンチ（ＲＴ）内の前記導体領域（１４ａ）は完全には覆わないように誘電材料層（１６ｃ、１６ａ、１６ｂ）を形成するステップと、
前記キャパシタ・トレンチ（ＣＴ）は完全に埋めるが、前記抵抗器トレンチ（ＲＴ）は不完全に埋め、その中の前記導体領域（１４ａ）を露出させ、前記導体領域（１４ａ）と接触しない、前記誘電材料層（１６ｃ、１６ａ、１６ｂ）上に配置された導体材料層（１８ｃ、１８ａ、１８ｂ）を形成するステップと、
前記抵抗器トレンチ（ＲＴ）を埋め、その中の前記導体領域（１４ａ）と接触するように抵抗器材料層（２０）を形成するステップと
を含む方法。
【請求項１４】
前記誘電材料層（１６ｃ、１６ａ、１６ｂ）を形成する前記ステップ、および前記導体材料層（１８ｃ、１８ａ、１８ｂ）を形成する前記ステップが、前記キャパシタ・トレンチ（ＣＴ）および抵抗器トレンチ（ＲＴ）内にブランケット誘電材料層（１６）を形成し、その上にブランケット導体材料層（１８）を、前記キャパシタ・トレンチ（ＣＴ）は完全に埋め、前記抵抗器トレンチ（ＲＴ）は不完全に埋めるように形成し、次いで、前記抵抗器トレンチ（ＲＴ）の底面の前記導体領域（１４ａ）を露出させるように、前記ブランケット導体材料層（１８）およびブランケット誘電材料層（１６）をエッチングすることを含む、請求項１３に記載の方法。
【請求項１５】
前記抵抗器トレンチ（ＲＴ）内の前記導体材料層（１８ａ、１８ｂ）と前記抵抗器材料層（２０）との間に配置され、前記導体材料層（１８ａ、１８ｂ）と前記抵抗器材料層（２０）とを分離する第２の誘電材料層（１９ａ、１９ｂ）を形成するステップをさらに含む、請求項１３に記載の方法。
【請求項１６】
前記第２の誘電材料層（１９ａ、１９ｂ）を形成する前記ステップが、前記抵抗器トレンチ（ＲＴ）内の前記導体材料層（１８ａ、１８ｂ）および前記導体領域（１４ａ）上に前記第２の誘電層を付着させ、次いで、前記抵抗器トレンチ（ＲＴ）内の前記導体領域（１４ａ）から前記第２の誘電材料層の一部分を除去することを含む、請求項１５に記載の方法。
【国際調査報告】
2009522820.tif 000019