(57)【特許請求の範囲】
【請求項１】
二次元電子ガスが生成される化合物半導体積層構造と、
前記化合物半導体積層構造の上方に形成されたゲート電極と
を含み、
前記化合物半導体積層構造は、前記二次元電子ガスの生成部位の下方にｐ型半導体層を有しており、
前記ｐ型半導体層は、前記ゲート電極の直下に位置整合する部分がその他の部分よりもイオン化アクセプタ量が多く、
前記ｐ型半導体層は、前記その他の部分が不活性不純物を含有することを特徴とする化合物半導体装置。
【請求項２】
二次元電子ガスが生成される化合物半導体積層構造と、
前記化合物半導体積層構造の上方に形成されたゲート電極と
を含み、
前記化合物半導体積層構造は、前記二次元電子ガスの生成部位の下方にｐ型半導体層を有しており、
前記ｐ型半導体層は、前記ゲート電極の直下に位置整合する部分がその他の部分よりもイオン化アクセプタ量が多く、
前記ｐ型半導体層は、前記その他の部分が前記イオン化アクセプタ量の多い部分よりも薄いことを特徴とする化合物半導体装置。
【請求項３】
前記ｐ型半導体層は、ｐ−ＧａＮ、ｐ−ＡｌＧａＮ、ｐ−ＩｎＡｌＮ、及びｐ−ＡｌＮから選ばれた１種を材料とすることを特徴とする請求項１または２に記載の化合物半導体装置。
【請求項４】
二次元電子ガスが生成される化合物半導体積層構造を形成する工程と、
前記化合物半導体積層構造の上方にゲート電極を形成する工程と
を含み、
前記化合物半導体積層構造を形成する際に、前記二次元電子ガスの生成部位の下方に相当する部分にｐ型半導体層を形成し、
前記ｐ型半導体層は、前記ゲート電極の直下に位置整合する部分がその他の部分よりもイオン化アクセプタ量が多く、
前記ｐ型半導体層は、前記その他の部分が不活性不純物を含有することを特徴とする化合物半導体装置の製造方法。
【請求項５】
二次元電子ガスが生成される化合物半導体積層構造を形成する工程と、
前記化合物半導体積層構造の上方にゲート電極を形成する工程と
を含み、
前記化合物半導体積層構造を形成する際に、前記二次元電子ガスの生成部位の下方に相当する部分にｐ型半導体層を形成し、
前記ｐ型半導体層は、前記ゲート電極の直下に位置整合する部分がその他の部分よりもイオン化アクセプタ量が多く、
前記ｐ型半導体層は、前記その他の部分が前記イオン化アクセプタ量の多い部分よりも薄いことを特徴とする化合物半導体装置の製造方法。
【請求項６】
前記ｐ型半導体層は、ｐ−ＧａＮ、ｐ−ＡｌＧａＮ、ｐ−ＩｎＡｌＮ、及びｐ−ＡｌＮから選ばれた１種を材料とすることを特徴とする請求項４または５に記載の化合物半導体装置の製造方法。
【発明の詳細な説明】
【技術分野】
【０００１】
本発明は、化合物半導体装置及びその製造方法に関する。
【背景技術】
【０００２】
窒化物半導体装置は、高い飽和電子速度及びワイドバンドギャップ等の特徴を利用し、高耐圧及び高出力の半導体デバイスとしての開発が活発に行われている。窒化物半導体デバイスとしては、電界効果トランジスタ、特に高電子移動度トランジスタ（High Electron Mobility Transistor：ＨＥＭＴ）についての報告が数多くなされている。特に、ＧａＮを電子走行層として、ＡｌＧａＮを電子供給層として用いたＡｌＧａＮ／ＧａＮ・ＨＥＭＴが注目されている。ＡｌＧａＮ／ＧａＮ・ＨＥＭＴでは、ＧａＮとＡｌＧａＮとの格子定数差に起因した歪みがＡｌＧａＮに生じる。これにより発生したピエゾ分極及びＡｌＧａＮの自発分極により、高濃度の二次元電子ガス（２ＤＥＧ）が得られる。そのため、高耐圧及び高出力が実現できる。
【先行技術文献】
【特許文献】
【０００３】
【特許文献１】特公平７−９３４２８号公報
【特許文献２】特開２００８−１１２８６８号公報
【発明の概要】
【発明が解決しようとする課題】
【０００４】
窒化物半導体デバイスを電力用途に用いる場合には、安全動作及び既存システムとの整合性の観点から、いわゆるノーマリオフが強く求められる。ところが、例えばＡｌＧａＮ／ＧａＮ・ＨＥＭＴでは、その強いピエゾ分極及び自発分極の作用により電子走行層の電子濃度が非常に高く、ノーマリオフの実現が比較的難しい。現在、ノーマリオフ化のためには様々な手法が検討されており、化合物半導体層に形成したリセスを埋め込むようにゲート電極を形成したゲートリセス構造、化合物半導体層とゲート電極との間にｐ−ＧａＮ層を形成したｐ−ＧａＮキャップ構造等の様々な構造が提案されている。その中でも、ｐ−ＧａＮキャップ構造は、ｐ型半導体層によるエネルギーバンドの持ち上げ効果を用いることにより、閾値の正方向へのシフトが大きく、ノーマリオフ化に適していることが知られている。
【０００５】
しかしながら、ｐ−ＧａＮキャップ構造においては、ｐ−ＧａＮ層の挿入により、必ずゲート電極と２ＤＥＧの生成部位との距離が増加するため、ピンチオフ特性の劣化、ｇｍの低下を惹起するという問題があった。また更に、横方向の導電性を確保するため、ゲート電極の直下以外に位置するｐ−ＧａＮ層を除去する必要があるところ、この除去時のエッチングダメージにより、電流コラプス等のトラップ起因の特性劣化を惹起するという問題があった。
【０００６】
本発明は、上記の課題に鑑みてなされたものであり、電流コラプス等のトラップ起因の特性劣化を防止し、ピンチオフ特性及びｇｍを向上させるも、確実なノーマリオフを実現する信頼性の高い化合物半導体装置及びその製造方法を提供することを目的とする。
【課題を解決するための手段】
【０００７】
化合物半導体装置の一態様は、二次元電子ガスが生成される化合物半導体積層構造と、前記化合物半導体積層構造の上方に形成された電極とを含み、前記化合物半導体積層構造は、前記二次元電子ガスの生成部位の下方にｐ型半導体層を有しており、前記ｐ型半導体層は、前記電極の下方に位置整合する部分がその他の部分よりもイオン化アクセプタ量が多い。
【０００８】
化合物半導体装置の製造方法の一態様は、二次元電子ガスが生成される化合物半導体積層構造を形成する工程と、前記化合物半導体積層構造の上方に電極を形成する工程とを含み、前記化合物半導体積層構造を形成する際に、前記二次元電子ガスの生成部位の下方に相当する部分にｐ型半導体層を形成し、前記ｐ型半導体層は、前記電極の下方に位置整合する部分がその他の部分よりもイオン化アクセプタ量が多い。
【発明の効果】
【０００９】
上記の諸態様によれば、電流コラプス等のトラップ起因の特性劣化を防止し、ピンチオフ特性及びｇｍを向上させるも、確実なノーマリオフを実現する信頼性の高い化合物半導体装置が得られる。
【図面の簡単な説明】
【００１０】
【図１】第１の実施形態によるＡｌＧａＮ／ＧａＮ・ＨＥＭＴの製造方法を工程順に示す概略断面図である。
【図２】図１に引き続き、第１の実施形態によるＡｌＧａＮ／ＧａＮ・ＨＥＭＴの製造方法を工程順に示す概略断面図である。
【図３】第１の実施形態によるＡｌＧａＮ／ＧａＮ・ＨＥＭＴにおける代表的な伝達特性（ドレイン電流−ゲート電圧特性）について、従来のｐ−ＧａＮキャップ構造を採用した比較例のＡｌＧａＮ／ＧａＮ・ＨＥＭＴとの比較に基づいて調べた結果を示す特性図である。
【図４】第２の実施形態によるＡｌＧａＮ／ＧａＮ・ＨＥＭＴの製造方法を工程順に示す概略断面図である。
【図５】図４に引き続き、第２の実施形態によるＡｌＧａＮ／ＧａＮ・ＨＥＭＴの製造方法を工程順に示す概略断面図である。
【図６】第３の実施形態によるＡｌＧａＮ／ＧａＮ・ＨＥＭＴの製造方法を工程順に示す概略断面図である。
【図７】図６に引き続き、第３の実施形態によるＡｌＧａＮ／ＧａＮ・ＨＥＭＴの製造方法を工程順に示す概略断面図である。
【図８】第４の実施形態によるＡｌＧａＮ／ＧａＮ・ＨＥＭＴの製造方法を工程順に示す概略断面図である。
【図９】図８に引き続き、第４の実施形態によるＡｌＧａＮ／ＧａＮ・ＨＥＭＴの製造方法を工程順に示す概略断面図である。
【図１０】第５の実施形態によるＡｌＧａＮ／ＧａＮ・ＨＥＭＴの製造方法を工程順に示す概略断面図である。
【図１１】図１０に引き続き、第５の実施形態によるＡｌＧａＮ／ＧａＮ・ＨＥＭＴの製造方法を工程順に示す概略断面図である。
【図１２】第６の実施形態によるＩｎＡｌＮ／ＧａＮ・ＨＥＭＴの製造方法を工程順に示す概略断面図である。
【図１３】図１２に引き続き、第６の実施形態によるＩｎＡｌＮ／ＧａＮ・ＨＥＭＴの製造方法を工程順に示す概略断面図である。
【図１４】第７の実施形態によるＡｌＧａＮ／ＧａＮ・ＨＥＭＴの製造方法を工程順に示す概略断面図である。
【図１５】図１４に引き続き、第７の実施形態によるＡｌＧａＮ／ＧａＮ・ＨＥＭＴの製造方法を工程順に示す概略断面図である。
【図１６】第８の実施形態によるＡｌＧａＮ／ＧａＮ・ＨＥＭＴの製造方法を工程順に示す概略断面図である。
【図１７】図１６に引き続き、第８の実施形態によるＡｌＧａＮ／ＧａＮ・ＨＥＭＴの製造方法を工程順に示す概略断面図である。
【図１８】第９の実施形態によるＡｌＧａＮ／ＧａＮ・ＨＥＭＴの製造方法を工程順に示す概略断面図である。
【図１９】図１８に引き続き、第９の実施形態によるＡｌＧａＮ／ＧａＮ・ＨＥＭＴの製造方法を工程順に示す概略断面図である。
【図２０】第１０の実施形態によるＡｌＧａＮ／ＧａＮ・ＨＥＭＴの製造方法を工程順に示す概略断面図である。
【図２１】図２０に引き続き、第１０の実施形態によるＡｌＧａＮ／ＧａＮ・ＨＥＭＴの製造方法を工程順に示す概略断面図である。
【図２２】第１〜第１０の実施形態から選ばれたＨＥＭＴを用いたＨＥＭＴチップを示す概略平面図である。
【図２３】第１〜第１０の実施形態から選ばれたＨＥＭＴを用いたＨＥＭＴチップのディスクリートパッケージを示す概略平面図である。
【図２４】第１１の実施形態によるＰＦＣ回路を示す結線図である。
【図２５】第１２の実施形態による電源装置の概略構成を示す結線図である。
【図２６】第１３の実施形態による高周波増幅器の概略構成を示す結線図である。
【発明を実施するための形態】
【００１１】
以下、諸実施形態について図面を参照して詳細に説明する。以下の諸実施形態では、化合物半導体装置の構成について、その製造方法と共に説明する。
なお、以下の図面において、図示の便宜上、相対的に正確な大きさ及び厚みに示していない構成部材がある。
【００１２】
（第１の実施形態）
本実施形態では、化合物半導体装置としてショットキー型のＡｌＧａＮ／ＧａＮ・ＨＥＭＴを開示する。
図１及び図２は、第１の実施形態によるＡｌＧａＮ／ＧａＮ・ＨＥＭＴの製造方法を工程順に示す概略断面図である。
【００１３】
先ず、図１（ａ）に示すように、成長用基板として例えば半絶縁性のＳｉＣ基板１上に、ｉ（インテンショナリ・アンドープ）−ＧａＮ層２ａ及びｐ−ＧａＮ部２ｂ１となるｐ−ＧａＮ層を順次形成する。
成長用基板としては、ＳｉＣ基板の代わりに、Ｓｉ基板、サファイア基板、ＧａＡｓ基板、ＧａＮ基板等を用いても良い。また、基板の導電性としては、半絶縁性、導電性を問わない。
【００１４】
ＳｉＣ基板１上に、例えば有機金属気相成長（ＭＯＶＰＥ：Metal Organic Vapor Phase Epitaxy）法により、ｉ−ＧａＮ層２ａ及びｐ−ＧａＮ部２ｂ１となるｐ−ＧａＮ層を順次成長する。ＭＯＶＰＥ法の代わりに、分子線エピタキシー（ＭＢＥ：Molecular Beam Epitaxy）法等を用いても良い。
ｉ−ＧａＮ層２ａは、ｉ−ＧａＮを例えば３μｍ程度の厚みに成長することで形成される。ｐ−ＧａＮ部２ｂ１となるｐ−ＧａＮ層は、ｐ−ＧａＮを例えば５０ｎｍ程度の厚みに成長することで形成される。
【００１５】
ＧａＮの成長には、原料ガスとしてＧａ源であるトリメチルガリウム（ＴＭＧａ）ガス及びアンモニア（ＮＨ3）ガスの混合ガスを用いる。ＴＭＧａガスの流量は適宜設定し、ＮＨ3ガスの流量は、１００ｓｃｃｍ〜１０ｓｌｍ程度とする。また、成長圧力は５０Torr〜３００Torr程度、成長温度は１０００℃〜１２００℃程度とする。
【００１６】
ＧａＮをｐ型として成長する際、即ちｐ−ＧａＮ部２ｂ１となるｐ−ＧａＮ層の形成には、ｐ型不純物であるＭｇ、Ｃ、Ｚｎ等、例えばＭｇをＧａＮの原料ガスに添加する。ここでは、例えばＭｇを含む例えばＣｐ２Ｍｇガスを所定の流量で原料ガスに添加し、ＧａＮにＭｇをドーピングする。Ｍｇのドーピング濃度は、１×１０16／ｃｍ3程度〜１×１０21／ｃｍ3程度、例えば１×１０19／ｃｍ3程度とする。
ｐ−ＧａＮ層を形成した後、４００℃〜１２００℃程度、例えば８００℃程度でｐ−ＧａＮ層を熱処理し、ｐ型不純物であるＭｇを活性化する。
【００１７】
続いて、図１（ｂ）に示すように、バックバリア層２ｂを形成する。
先ず、ｐ−ＧａＮ層上にレジストを塗布し、リソグラフィーによりレジストを加工する。これにより、ｐ−ＧａＮ層のゲート電極の形成予定位置の下方に位置整合する部分（ｐ−ＧａＮ部２ｂ１となる部分）を覆い、他の部分を開口するレジストマスクが形成される。
このレジストマスクを用いて、ｐ−ＧａＮのｐ型不純物を不活性する不純物、例えばアルゴン（Ａｒ）を加速エネルギー１５ｋｅＶ、ドーズ量１×１０14／ｃｍ2の条件でイオン注入する。不活性不純物として、Ａｒ以外にホウ素（Ｂ），酸素（Ｏ），リン（Ｐ），鉄（Ｆｅ）等を用いても良い。このイオン注入により、ｐ−ＧａＮ層のゲート電極の形成予定位置以外の部分が不活性し、ｐ-−ＧａＮとなってｐ-−ＧａＮ部２ｂ２，２ｂ３が形成される。ｐ-−ＧａＮ部２ｂ２，２ｂ３は、イオン化アクセプタ濃度がｐ−ＧａＮ部２ｂ１よりも低濃度である。レジストマスクは、アッシング処理又は所定の薬液を用いたウェット処理により除去される。
【００１８】
以上により、ゲート電極の形成予定位置の下方に位置整合する部分に形成されたｐ−ＧａＮ部２ｂ１と、ｐ−ＧａＮ部２ｂ１の両側に形成されたｐ-−ＧａＮ部２ｂ２，２ｂ３とを有するバックバリア層２ｂが形成される。バックバリア層２ｂでは、ｐ−ＧａＮ部２ｂ１は、ｐ-−ＧａＮ部２ｂ２，２ｂ３よりもイオン化アクセプタ量が多い、ここではイオン化アクセプタ濃度が高い部分となる。
【００１９】
続いて、図１（ｃ）に示すように、バックバリア層２ｂ上に、電子走行層２ｃ、中間層２ｄ、及び電子供給層２ｅを順次形成する。
ＭＯＶＰＥ法により、バックバリア層２ｂ上に、電子走行層２ｃ、中間層２ｄ、及び電子供給層２ｅとなる各化合物半導体を順次成長する。電子走行層２ｃは、ｉ−ＧａＮを１００ｎｍ程度の厚みに成長することで形成される。中間層２ｄは、ｉ−ＡｌＧａＮを５ｎｍ程度の厚みに成長することで形成される。電子供給層２ｅは、ｎ−ＡｌＧａＮを３０ｎｍ程度の厚みに成長することで形成される。中間層２ｄは形成しない場合もある。電子供給層は、ｉ−ＡｌＧａＮを形成するようにしても良い。
【００２０】
ＧａＮの成長には、原料ガスとしてＧａ源であるトリメチルガリウム（ＴＭＧａ）ガス及びアンモニア（ＮＨ3）ガスの混合ガスを用いる。ＡｌＧａＮの成長には、原料ガスとしてＴＭＡｌガス、ＴＭＧａガス及びＮＨ3ガスの混合ガスを用いる。成長する化合物半導体層に応じて、ＴＭＡｌガス、ＴＭＧａガスの供給の有無及び流量を適宜設定する。共通原料であるＮＨ3ガスの流量は、１００ｓｃｃｍ〜１０ｓｌｍ程度とする。また、成長圧力は５０Torr〜３００Torr程度、成長温度は１０００℃〜１２００℃程度とする。
【００２１】
ＡｌＧａＮをｎ型として成長する際、即ち電子供給層２ｅ（ｎ−ＡｌＧａＮ）の形成には、ｎ型不純物をＡｌＧａＮの原料ガスに添加する。ここでは、例えばＳｉを含む例えばシラン（ＳｉＨ4）ガスを所定の流量で原料ガスに添加し、ＡｌＧａＮにＳｉをドーピングする。Ｓｉのドーピング濃度は、１×１０18／ｃｍ3程度〜１×１０20／ｃｍ3程度、例えば５×１０18／ｃｍ3程度とする。
以上により、ｉ−ＧａＮ層２ａ、バックバリア層２ｂ、電子走行層２ｃ、中間層２ｄ、及び電子供給層２ｅが順次積層されてなる化合物半導体積層構造２が形成される。
【００２２】
続いて、素子分離構造を形成する。
詳細には、化合物半導体積層構造２の素子分離領域に例えばアルゴン（Ａｒ）を注入する。これにより、化合物半導体積層構造２及びＳｉＣ基板１の表層部分に素子分離構造が形成される。素子分離構造により、化合物半導体積層構造２上で活性領域が画定される。
なお、素子分離は、上記の注入法の代わりに、例えばＳＴＩ（Shallow Trench Isolation）法を用いて行っても良い。
【００２３】
続いて、図２（ａ）に示すように、ソース電極３及びドレイン電極４を形成する。
電極材料として例えばＴａ／Ａｌ（下層がＴａ、上層がＡｌ）を用いる。電極形成には、蒸着法及びリフトオフ法に適した例えば庇構造２層レジストを用いる。このレジストを化合物半導体積層構造２上に塗布し、ソース電極及びドレイン電極の各形成予定位置を開口するレジストマスクを形成する。このレジストマスクを用いて、例えば蒸着法により、Ｔａ／Ａｌを堆積する。Ｔａの厚みは２０ｎｍ程度、Ａｌの厚みは２００ｎｍ程度とする。リフトオフ法により、庇構造のレジストマスク及びその上に堆積したＴａ／Ａｌを除去する。その後、ＳｉＣ基板１を、例えば窒素雰囲気中において４００℃〜１０００℃、例えば５５０℃程度で熱処理し、残存したＴａ／Ａｌを電子供給層２ｅとオーミックコンタクトさせる。なお、Ｔａ／Ａｌが熱処理を行わずとも電子供給層２ｅとオーミックコンタクトする場合には、当該熱処理を行わなくても良い。以上により、Ｔａ／Ａｌからなるソース電極３及びドレイン電極４が形成される。
【００２４】
続いて、図２（ｂ）に示すように、化合物半導体積層構造２の表面に、開口５ａを有する保護膜５を形成する。
詳細には、先ず、ソース電極３上及びドレイン電極４上を含む化合物半導体積層構造２の全面にＳｉＮを、プラズマＣＶＤ法又はスパッタ法等により例えば２ｎｍ程度〜２００ｎｍ、例えば２０ｎｍ程度の厚みに堆積する。以上により、保護膜５が形成される。
【００２５】
次に、保護膜５の全面にレジストを塗布し、リソグラフィーによりレジストを加工する。これにより、保護膜５のゲート電極の形成予定位置を露出する開口を有するレジストマスクが形成される。
このレジストマスクを用いて、保護膜５を例えばフッ素系ガスをエッチングガスとして用いてドライエッチングする。これにより、保護膜５のゲート電極の形成予定位置に開口５ａが形成される。レジストマスクは、アッシング処理又は所定の薬液を用いたウェット処理により除去される。
【００２６】
続いて、図２（ｃ）に示すように、ゲート電極６を形成する。
電極材料として例えばＮｉ／Ａｕ（下層がＮｉ、上層がＡｕ）を用いる。電極形成には、蒸着法及びリフトオフ法に適した例えば庇構造２層レジストを用いる。このレジストを開口５ａ内を含む保護膜５上に塗布し、開口５ａを含むゲート電極の形成予定位置を開口するレジストマスクを形成する。このレジストマスクを用いて、例えば蒸着法により、Ｎｉ／Ａｕを堆積する。Ｎｉの厚みは３０ｎｍ程度、Ａｕの厚みは４００ｎｍ程度とする。リフトオフ法により、庇構造のレジストマスク及びその上に堆積したＮｉ／Ａｕを除去する。これにより、開口５ａ内をゲートメタルで埋め込み化合物半導体積層構造２の表面とショットキー接触する、ゲート電極６が形成される。ゲート電極６は、開口５ａ内を埋め込み保護膜５上に乗り上げるＮｉと、Ｎｉ上に堆積したＡｕとから、いわゆるオーバーハング形状に形成される。
【００２７】
しかる後、ソース電極３及びドレイン電極４、ゲート電極６の電気的接続等の諸工程を経て、ショットキー型のＡｌＧａＮ／ＧａＮ・ＨＥＭＴが形成される。
【００２８】
本実施形態によるＡｌＧａＮ／ＧａＮ・ＨＥＭＴでは、化合物半導体積層構造２の２ＤＥＧの生成部位の下方にバックバリア層２ｂが形成されている。バックバリア層２ｂのイオン化アクセプタ濃度の比較的高いｐ−ＧａＮ部２ｂ１により、確実なノーマリオフが実現する。更に、バックバリア層２ｂの形成位置が２ＤＥＧの生成部位の下方であることから、ゲート電極６と２ＤＥＧとの距離が短く保持され、ｇｍが向上する。また、化合物半導体積層構造２の表面には、ドライエッチングしないためにエッチングダメージはなく、エッチングダメージに起因したトラップ起因の現象（電流コラプス等）も抑制される。
【００２９】
バックバリア層２ｂは、ｐ−ＧａＮ部２ｂ１の両側にｐ-−ＧａＮ部２ｂ２，２ｂ３を有している。従来のｐ−ＧａＮキャップ構造、即ちチャネル直下にｐ−ＧａＮを埋め込み、水平方向の濃度変調を施す構造においては、構造的に必ず再成長のプロセスが必須であり、再成長界面が存在する。この界面は、一旦結晶成長装置の外の雰囲気に曝されることもあり、様々な欠陥の原因となる。デバイスの高電圧動作時には、この欠陥がリークパスとなり、電源オフ時のリーク電流が増加することが懸念される。本実施形態では、電極間（即ちゲート電極６の直下以外の、ソース電極３−ゲート電極６間、ゲート電極６−ドレイン電極４間）の下方に位置整合するｐ-−ＧａＮ部２ｂ２，２ｂ３の存在により、再成長界面のリークパスが低減され、良好なピンチオフ特性を得ることができる。
【００３０】
本実施形態によるＡｌＧａＮ／ＧａＮ・ＨＥＭＴにおける代表的な伝達特性（ドレイン電流−ゲート電圧特性）について、従来のｐ−ＧａＮキャップ構造を採用した比較例のＡｌＧａＮ／ＧａＮ・ＨＥＭＴとの比較に基づいて調べた。その結果を図３に示す。
【００３１】
比較例では、ピンチオフ時のリーク電流が大きく、最大ドレイン電流（Ｉｄmax）が小さいという問題がある。これに対して本実施形態では、ゲート電極と２ＤＥＧとの距離低減及び再成長界面のリークパス低減により、良好なピンチオフ特性が得られていることが判る。
【００３２】
以上説明したように、本実施形態によれば、電流コラプス等のトラップ起因の特性劣化を防止し、ピンチオフ特性及びｇｍを向上させるも、確実なノーマリオフを実現する信頼性の高いＡｌＧａＮ／ＧａＮ・ＨＥＭＴが得られる。
【００３３】
（第２の実施形態）
本実施形態では、化合物半導体装置としてＭＩＳ型のＡｌＧａＮ／ＧａＮ・ＨＥＭＴを開示する。
なお、第１の実施形態によるＡｌＧａＮ／ＧａＮ・ＨＥＭＴと同様の構成部材等については、同符号を付して詳しい説明を省略する。
図４及び図５は、第２の実施形態によるＡｌＧａＮ／ＧａＮ・ＨＥＭＴの製造方法における主要工程を示す概略断面図である。
【００３４】
先ず、図４（ａ）〜図５（ａ）に示すように、第１の実施形態の図１（ａ）〜図２（ａ）の諸工程を経る。このとき、図５（ａ）に示すように、ソース電極３及びドレイン電極４が形成される。
【００３５】
続いて、図５（ｂ）に示すように、化合物半導体積層構造２の表面に保護膜５を形成する。
詳細には、ソース電極３上及びドレイン電極４上を含む化合物半導体積層構造２の全面にＳｉＮを、プラズマＣＶＤ法又はスパッタ法等により例えば２ｎｍ程度〜２００ｎｍ、例えば２０ｎｍ程度の厚みに堆積する。以上により、保護膜５が形成される。本実施形態では、保護膜５はゲート絶縁膜としても機能する。
【００３６】
続いて、図５（ｃ）に示すように、ゲート電極６を形成する。
電極材料として例えばＮｉ／Ａｕ（下層がＮｉ、上層がＡｕ）を用いる。電極形成には、蒸着法及びリフトオフ法に適した例えば庇構造２層レジストを用いる。このレジストを保護膜５上に塗布し、ゲート電極の形成予定位置を開口するレジストマスクを形成する。このレジストマスクを用いて、例えば蒸着法により、Ｎｉ／Ａｕを堆積する。Ｎｉの厚みは３０ｎｍ程度、Ａｕの厚みは４００ｎｍ程度とする。リフトオフ法により、庇構造のレジストマスク及びその上に堆積したＮｉ／Ａｕを除去する。これにより、保護膜５上にゲート電極６が形成される。
【００３７】
しかる後、ソース電極３及びドレイン電極４、ゲート電極６の電気的接続等の諸工程を経て、ＭＩＳ型のＡｌＧａＮ／ＧａＮ・ＨＥＭＴが形成される。
【００３８】
以上説明したように、本実施形態によれば、電流コラプス等のトラップ起因の特性劣化を防止し、ピンチオフ特性及びｇｍを向上させるも、確実なノーマリオフを実現する信頼性の高いＡｌＧａＮ／ＧａＮ・ＨＥＭＴが得られる。
【００３９】
（第３の実施形態）
本実施形態では、化合物半導体装置としてＭＩＳ型のＡｌＧａＮ／ＧａＮ・ＨＥＭＴを開示する。
なお、第１の実施形態によるＡｌＧａＮ／ＧａＮ・ＨＥＭＴと同様の構成部材等については、同符号を付して詳しい説明を省略する。
図６及び図７は、第３の実施形態によるＡｌＧａＮ／ＧａＮ・ＨＥＭＴの製造方法における主要工程を示す概略断面図である。
【００４０】
先ず、図６（ａ）〜図６（ｃ）に示すように、第１の実施形態の図１（ａ）〜図１（ｃ）の諸工程を経る。このとき、図６（ｃ）に示すように、化合物半導体積層構造２が形成される。
【００４１】
続いて、素子分離構造を形成した後、図７（ａ）に示すように、電子供給層４ｅに電極用リセス４ｅ１を形成した後、ソース電極３及びドレイン電極４を形成する。
詳細には、先ず、化合物半導体積層構造２の全面にレジストを塗布し、リソグラフィーによりレジストを加工する。これにより、電子供給層４ｅにおけるゲート電極の形成予定位置を露出する開口を有するレジストマスクが形成される。
このレジストマスクを用いて、電子供給層２ｅの表層の一部を、例えばフッ素系ガスをエッチングガスとして用いてドライエッチングする。これにより、電子供給層２ｅのゲート電極の形成予定位置に電極用リセス４ｅ１が形成される。レジストマスクは、アッシング処理又は所定の薬液を用いたウェット処理により除去される。
【００４２】
次に、電極材料として例えばＴａ／Ａｌ（下層がＴａ、上層がＡｌ）を用いる。電極形成には、蒸着法及びリフトオフ法に適した例えば庇構造２層レジストを用いる。このレジストを化合物半導体積層構造２上に塗布し、ソース電極及びドレイン電極の各形成予定位置を開口するレジストマスクを形成する。このレジストマスクを用いて、例えば蒸着法により、Ｔａ／Ａｌを堆積する。Ｔａの厚みは２０ｎｍ程度、Ａｌの厚みは２００ｎｍ程度とする。リフトオフ法により、庇構造のレジストマスク及びその上に堆積したＴａ／Ａｌを除去する。その後、ＳｉＣ基板１を、例えば窒素雰囲気中において４００℃〜１０００℃、例えば５５０℃程度で熱処理し、残存したＴａ／Ａｌを電子供給層２ｅとオーミックコンタクトさせる。なお、Ｔａ／Ａｌが熱処理を行わずとも電子供給層２ｅとオーミックコンタクトする場合には、当該熱処理を行わなくても良い。以上により、Ｔａ／Ａｌからなるソース電極３及びドレイン電極４が形成される。
【００４３】
続いて、図７（ｂ）に示すように、化合物半導体積層構造２の表面に保護膜５を形成する。
詳細には、ソース電極３上及びドレイン電極４上を含む化合物半導体積層構造２の全面にＳｉＮを、プラズマＣＶＤ法又はスパッタ法等により例えば２ｎｍ程度〜２００ｎｍ、例えば２０ｎｍ程度の厚みに堆積する。以上により、保護膜５が形成される。本実施形態では、保護膜５はゲート絶縁膜としても機能する。
【００４４】
続いて、図７（ｃ）に示すように、ゲート電極６を形成する。
電極材料として例えばＮｉ／Ａｕ（下層がＮｉ、上層がＡｕ）を用いる。電極形成には、蒸着法及びリフトオフ法に適した例えば庇構造２層レジストを用いる。このレジストを保護膜５上に塗布し、ゲート電極の形成予定位置を開口するレジストマスクを形成する。このレジストマスクを用いて、例えば蒸着法により、Ｎｉ／Ａｕを堆積する。Ｎｉの厚みは３０ｎｍ程度、Ａｕの厚みは４００ｎｍ程度とする。リフトオフ法により、庇構造のレジストマスク及びその上に堆積したＮｉ／Ａｕを除去する。これにより、電極用リセス４ｅ１内を保護膜５を介してゲートメタルで埋め込むゲート電極６が形成される。ゲート電極６は、保護膜５を介して電極用リセス４ｅ１内を埋め込み保護膜５上に乗り上げるＮｉと、Ｎｉ上に堆積したＡｕとから、いわゆるオーバーハング形状に形成される。
【００４５】
しかる後、ソース電極３及びドレイン電極４、ゲート電極６の電気的接続等の諸工程を経て、ＭＩＳ型のＡｌＧａＮ／ＧａＮ・ＨＥＭＴが形成される。
【００４６】
以上説明したように、本実施形態によれば、電流コラプス等のトラップ起因の特性劣化を防止し、ピンチオフ特性及びｇｍを向上させるも、確実なノーマリオフを実現する信頼性の高いＡｌＧａＮ／ＧａＮ・ＨＥＭＴが得られる。
【００４７】
（第４の実施形態）
本実施形態では、化合物半導体装置としてＭＩＳ型のＡｌＧａＮ／ＧａＮ・ＨＥＭＴを開示する。
なお、第１の実施形態によるＡｌＧａＮ／ＧａＮ・ＨＥＭＴと同様の構成部材等については、同符号を付して詳しい説明を省略する。
図８及び図９は、第４の実施形態によるＡｌＧａＮ／ＧａＮ・ＨＥＭＴの製造方法における主要工程を示す概略断面図である。
【００４８】
先ず、図８（ａ）〜図８（ｂ）に示すように、第１の実施形態の図１（ａ）〜図１（ｂ）の諸工程を経る。このとき、図８（ｂ）に示すように、バックバリア層２ｂが形成される。
【００４９】
続いて、図８（ｃ）に示すように、バックバリア層２ｂ上に、電子走行層２ｃ、中間層２ｄ、及び電子供給層２ｅ、キャップ層２ｆを順次形成する。
ＭＯＶＰＥ法により、バックバリア層２ｂ上に、電子走行層２ｃ、中間層２ｄ、電子供給層２ｅ、及びキャップ層２ｆとなる各化合物半導体を順次成長する。電子走行層２ｃは、ｉ−ＧａＮを１００ｎｍ程度の厚みに成長することで形成される。中間層２ｄは、ｉ−ＡｌＧａＮを５ｎｍ程度の厚みに成長することで形成される。電子供給層２ｅは、ｎ−ＡｌＧａＮを３０ｎｍ程度の厚みに成長することで形成される。キャップ層２ｆは、ｎ−ＧａＮを１０ｎｍ程度の厚みに成長することで形成される。中間層２ｄは形成しない場合もある。電子供給層は、ｉ−ＡｌＧａＮを形成するようにしても良い。
【００５０】
ＧａＮの成長には、原料ガスとしてＧａ源であるＴＭＧａガス及びＮＨ3ガスの混合ガスを用いる。ＡｌＧａＮの成長には、原料ガスとしてＴＭＡｌガス、ＴＭＧａガス及びＮＨ3ガスの混合ガスを用いる。成長する化合物半導体層に応じて、ＴＭＡｌガス、ＴＭＧａガスの供給の有無及び流量を適宜設定する。共通原料であるＮＨ3ガスの流量は、１００ｓｃｃｍ〜１０ｓｌｍ程度とする。また、成長圧力は５０Torr〜３００Torr程度、成長温度は１０００℃〜１２００℃程度とする。
【００５１】
ＡｌＧａＮ、ＧａＮをｎ型として成長する際、即ち電子供給層２ｅ（ｎ−ＡｌＧａＮ）及びキャップ層２ｆ（ｎ−ＧａＮ）の形成には、ｎ型不純物をＡｌＧａＮ、ＧａＮの原料ガスに添加する。ここでは、例えばＳｉを含む例えばシラン（ＳｉＨ4）ガスを所定の流量で原料ガスに添加し、ＡｌＧａＮ、ＧａＮにＳｉをドーピングする。Ｓｉのドーピング濃度は、１×１０18／ｃｍ3程度〜１×１０20／ｃｍ3程度、例えば５×１０18／ｃｍ3程度とする。
以上により、ｉ−ＧａＮ層２ａ、バックバリア層２ｂ、電子走行層２ｃ、中間層２ｄ、電子供給層２ｅ、及びキャップ層２ｆが順次積層されてなる化合物半導体積層構造２が形成される。
【００５２】
続いて、素子分離構造を形成した後、図９（ａ）に示すように、ソース電極３及びドレイン電極４を形成する。
詳細には、先ず、化合物半導体積層構造２の全面にレジストを塗布し、リソグラフィーによりレジストを加工する。これにより、電子供給層４ｅにおけるソース電極及びドレイン電極の各形成予定位置を露出する開口を有するレジストマスクが形成される。
このレジストマスクを用いて、電子供給層２ｅの表面が露出するまで、例えばフッ素系ガスをエッチングガスとして用いてキャップ層２ｆをドライエッチングする。これにより、キャップ層２ｆソース電極及びドレイン電極の各形成予定位置に電極用リセス２ｆ１，２ｆ２が形成される。レジストマスクは、アッシング処理又は所定の薬液を用いたウェット処理により除去される。
【００５３】
次に、電極材料として例えばＴａ／Ａｌ（下層がＴａ、上層がＡｌ）を用いる。電極形成には、蒸着法及びリフトオフ法に適した例えば庇構造２層レジストを用いる。このレジストを化合物半導体積層構造２上に塗布し、電極用リセス２ｆ１，２ｆ２を露出する開口を有するレジストマスクを形成する。このレジストマスクを用いて、例えば蒸着法により、Ｔａ／Ａｌを堆積する。Ｔａの厚みは２０ｎｍ程度、Ａｌの厚みは２００ｎｍ程度とする。リフトオフ法により、庇構造のレジストマスク及びその上に堆積したＴａ／Ａｌを除去する。その後、ＳｉＣ基板１を、例えば窒素雰囲気中において４００℃〜１０００℃、例えば５５０℃程度で熱処理し、残存したＴａ／Ａｌを電子供給層２ｅとオーミックコンタクトさせる。なお、Ｔａ／Ａｌが熱処理を行わずとも電子供給層２ｅとオーミックコンタクトする場合には、当該熱処理を行わなくても良い。以上により、電極用リセス２ｆ１，２ｆ２を埋め込むように、Ｔａ／Ａｌからなるソース電極３及びドレイン電極４が形成される。
【００５４】
続いて、図９（ｂ）に示すように、化合物半導体積層構造２の表面に保護膜５を形成する。
詳細には、ソース電極３上及びドレイン電極４上を含む化合物半導体積層構造２の全面にＳｉＮを、プラズマＣＶＤ法又はスパッタ法等により例えば２ｎｍ程度〜２００ｎｍ、例えば２０ｎｍ程度の厚みに堆積する。以上により、保護膜５が形成される。本実施形態では、保護膜５はゲート絶縁膜としても機能する。
【００５５】
続いて、図９（ｃ）に示すように、ゲート電極６を形成する。
電極材料として例えばＮｉ／Ａｕ（下層がＮｉ、上層がＡｕ）を用いる。電極形成には、蒸着法及びリフトオフ法に適した例えば庇構造２層レジストを用いる。このレジストを保護膜５上に塗布し、ゲート電極の形成予定位置を開口するレジストマスクを形成する。このレジストマスクを用いて、例えば蒸着法により、Ｎｉ／Ａｕを堆積する。Ｎｉの厚みは３０ｎｍ程度、Ａｕの厚みは４００ｎｍ程度とする。リフトオフ法により、庇構造のレジストマスク及びその上に堆積したＮｉ／Ａｕを除去する。これにより、保護膜５上にゲート電極６が形成される。
【００５６】
しかる後、ソース電極３及びドレイン電極４、ゲート電極６の電気的接続等の諸工程を経て、ＭＩＳ型のＡｌＧａＮ／ＧａＮ・ＨＥＭＴが形成される。
【００５７】
以上説明したように、本実施形態によれば、電流コラプス等のトラップ起因の特性劣化を防止し、ピンチオフ特性及びｇｍを向上させるも、確実なノーマリオフを実現する信頼性の高いＡｌＧａＮ／ＧａＮ・ＨＥＭＴが得られる。
【００５８】
（第５の実施形態）
本実施形態では、化合物半導体装置としてＭＩＳ型のＡｌＧａＮ／ＧａＮ・ＨＥＭＴを開示する。
なお、第１の実施形態によるＡｌＧａＮ／ＧａＮ・ＨＥＭＴと同様の構成部材等については、同符号を付して詳しい説明を省略する。
図１０及び図１１は、第５の実施形態によるＡｌＧａＮ／ＧａＮ・ＨＥＭＴの製造方法における主要工程を示す概略断面図である。
【００５９】
先ず、図１０（ａ）に示すように、第１の実施形態の図１（ａ）の工程を実行し、ＳｉＣ基板１上に、ｉ−ＧａＮ層２ａ及びｐ−ＧａＮ部２ｂ１となるｐ−ＧａＮ層が順次形成される。
【００６０】
続いて、図１０（ｂ）に示すように、バックバリア層２ｂを形成する。
先ず、ｐ−ＧａＮ層上にレジストを塗布し、リソグラフィーによりレジストを加工する。これにより、ｐ−ＧａＮ層のゲート電極の形成予定位置の下方に位置整合する部分（ｐ−ＧａＮ部２ｂ１となる部分）を覆い、他の部分を開口するレジストマスクが形成される。本実施形態では、レジストマスクで覆われるｐ−ＧａＮ層の部分は、ゲート電極の形成予定位置の下方に位置整合する部分を含み、ドレイン電極の形成予定位置に位置整合する部分に偏倚するように延在している。
【００６１】
このレジストマスクを用いて、ｐ−ＧａＮのｐ型不純物を不活性する不純物、例えばアルゴン（Ａｒ）を加速エネルギー１５ｋｅＶ、ドーズ量１×１０14／ｃｍ2の条件でイオン注入する。不活性不純物として、Ａｒ以外にホウ素（Ｂ），酸素（Ｏ），リン（Ｐ），鉄（Ｆｅ）等を用いても良い。このイオン注入により、ｐ−ＧａＮ層のゲート電極の形成予定位置以外の部分が不活性し、ｐ-−ＧａＮとなってｐ-−ＧａＮ部２ｂ４，２ｂ５が形成される。ｐ-−ＧａＮ部２ｂ５，２ｂ５は、イオン化アクセプタ濃度がｐ−ＧａＮ部２ｂ１よりも低濃度である。レジストマスクは、アッシング処理又は所定の薬液を用いたウェット処理により除去される。
【００６２】
以上により、ゲート電極の形成予定位置の下方に位置整合する部分に形成されたｐ−ＧａＮ部２ｂ１と、ｐ−ＧａＮ部２ｂ１の両側に形成されたｐ-−ＧａＮ部２ｂ４，２ｂ５とを有するバックバリア層２ｂが形成される。バックバリア層２ｂでは、ｐ−ＧａＮ部２ｂ１は、ｐ-−ＧａＮ部２ｂ４，２ｂ５よりもイオン化アクセプタ量が多い、ここではイオン化アクセプタ濃度が高い部分となる。ｐ−ＧａＮ部２ｂ１は、ゲート電極の形成予定位置の下方に位置整合する部分を含み、ドレイン電極の形成予定位置に位置整合する部分に偏倚するように延在している。
【００６３】
続いて、図１０（ｃ）に示すように、バックバリア層２ｂ上に、電子走行層２ｃ、中間層２ｄ、及び電子供給層２ｅを順次形成する。
ＭＯＶＰＥ法により、バックバリア層２ｂ上に、電子走行層２ｃ、中間層２ｄ、及び電子供給層２ｅとなる各化合物半導体を順次成長する。電子走行層２ｃは、ｉ−ＧａＮを１００ｎｍ程度の厚みに成長することで形成される。中間層２ｄは、ｉ−ＡｌＧａＮを５ｎｍ程度の厚みに成長することで形成される。電子供給層２ｅは、ｎ−ＡｌＧａＮを３０ｎｍ程度の厚みに成長することで形成される。中間層２ｄは形成しない場合もある。電子供給層は、ｉ−ＡｌＧａＮを形成するようにしても良い。
【００６４】
ＧａＮの成長には、原料ガスとしてＧａ源であるトリメチルガリウム（ＴＭＧａ）ガス及びアンモニア（ＮＨ3）ガスの混合ガスを用いる。ＡｌＧａＮの成長には、原料ガスとしてＴＭＡｌガス、ＴＭＧａガス及びＮＨ3ガスの混合ガスを用いる。成長する化合物半導体層に応じて、ＴＭＡｌガス、ＴＭＧａガスの供給の有無及び流量を適宜設定する。共通原料であるＮＨ3ガスの流量は、１００ｓｃｃｍ〜１０ｓｌｍ程度とする。また、成長圧力は５０Torr〜３００Torr程度、成長温度は１０００℃〜１２００℃程度とする。
【００６５】
ＡｌＧａＮをｎ型として成長する際、即ち電子供給層２ｅ（ｎ−ＡｌＧａＮ）の形成には、ｎ型不純物をＡｌＧａＮの原料ガスに添加する。ここでは、例えばＳｉを含む例えばシラン（ＳｉＨ4）ガスを所定の流量で原料ガスに添加し、ＡｌＧａＮにＳｉをドーピングする。Ｓｉのドーピング濃度は、１×１０18／ｃｍ3程度〜１×１０20／ｃｍ3程度、例えば５×１０18／ｃｍ3程度とする。
以上により、ｉ−ＧａＮ層２ａ、バックバリア層２ｂ、電子走行層２ｃ、中間層２ｄ、及び電子供給層２ｅが順次積層されてなる化合物半導体積層構造２が形成される。
【００６６】
続いて、素子分離構造を形成した後、図１１（ａ）に示すように、電子供給層４ｅに電極用リセス４ｅ１を形成した後、ソース電極３及びドレイン電極４を形成する。
詳細には、先ず、化合物半導体積層構造２の全面にレジストを塗布し、リソグラフィーによりレジストを加工する。これにより、電子供給層４ｅにおけるゲート電極の形成予定位置を露出する開口を有するレジストマスクが形成される。
このレジストマスクを用いて、電子供給層２ｅの表層の一部を、例えばフッ素系ガスをエッチングガスとして用いてドライエッチングする。これにより、電子供給層２ｅのゲート電極の形成予定位置に電極用リセス４ｅ１が形成される。レジストマスクは、アッシング処理又は所定の薬液を用いたウェット処理により除去される。
【００６７】
次に、電極材料として例えばＴａ／Ａｌ（下層がＴａ、上層がＡｌ）を用いる。電極形成には、蒸着法及びリフトオフ法に適した例えば庇構造２層レジストを用いる。このレジストを化合物半導体積層構造２上に塗布し、ソース電極及びドレイン電極の各形成予定位置を開口するレジストマスクを形成する。このレジストマスクを用いて、例えば蒸着法により、Ｔａ／Ａｌを堆積する。Ｔａの厚みは２０ｎｍ程度、Ａｌの厚みは２００ｎｍ程度とする。リフトオフ法により、庇構造のレジストマスク及びその上に堆積したＴａ／Ａｌを除去する。その後、ＳｉＣ基板１を、例えば窒素雰囲気中において４００℃〜１０００℃、例えば５５０℃程度で熱処理し、残存したＴａ／Ａｌを電子供給層２ｅとオーミックコンタクトさせる。なお、Ｔａ／Ａｌが熱処理を行わずとも電子供給層２ｅとオーミックコンタクトする場合には、当該熱処理を行わなくても良い。以上により、Ｔａ／Ａｌからなるソース電極３及びドレイン電極４が形成される。
【００６８】
続いて、図１１（ｂ）に示すように、化合物半導体積層構造２の表面に保護膜５を形成する。
詳細には、ソース電極３上及びドレイン電極４上を含む化合物半導体積層構造２の全面にＳｉＮを、プラズマＣＶＤ法又はスパッタ法等により例えば２ｎｍ程度〜２００ｎｍ、例えば２０ｎｍ程度の厚みに堆積する。以上により、保護膜５が形成される。本実施形態では、保護膜５はゲート絶縁膜としても機能する。
【００６９】
続いて、図１１（ｃ）に示すように、ゲート電極６を形成する。
電極材料として例えばＮｉ／Ａｕ（下層がＮｉ、上層がＡｕ）を用いる。電極形成には、蒸着法及びリフトオフ法に適した例えば庇構造２層レジストを用いる。このレジストを保護膜５上に塗布し、ゲート電極の形成予定位置を開口するレジストマスクを形成する。このレジストマスクを用いて、例えば蒸着法により、Ｎｉ／Ａｕを堆積する。Ｎｉの厚みは３０ｎｍ程度、Ａｕの厚みは４００ｎｍ程度とする。リフトオフ法により、庇構造のレジストマスク及びその上に堆積したＮｉ／Ａｕを除去する。これにより、電極用リセス４ｅ１内を保護膜５を介してゲートメタルで埋め込むゲート電極６が形成される。ゲート電極６は、保護膜５を介して電極用リセス４ｅ１内を埋め込み保護膜５上に乗り上げるＮｉと、Ｎｉ上に堆積したＡｕとから、いわゆるオーバーハング形状に形成される。
【００７０】
しかる後、ソース電極３及びドレイン電極４、ゲート電極６の電気的接続等の諸工程を経て、ＭＩＳ型のＡｌＧａＮ／ＧａＮ・ＨＥＭＴが形成される。
【００７１】
以上説明したように、本実施形態によれば、電流コラプス等のトラップ起因の特性劣化を防止し、ピンチオフ特性及びｇｍを向上させるも、確実なノーマリオフを実現する信頼性の高いＡｌＧａＮ／ＧａＮ・ＨＥＭＴが得られる。
【００７２】
（第６の実施形態）
本実施形態では、化合物半導体装置としてＭＩＳ型のＩｎＡｌＮ／ＧａＮ・ＨＥＭＴを開示する。
なお、第１の実施形態によるＡｌＧａＮ／ＧａＮ・ＨＥＭＴと同様の構成部材等については、同符号を付して詳しい説明を省略する。
図１２及び図１３は、第６の実施形態によるＩｎＡｌＮ／ＧａＮ・ＨＥＭＴの製造方法における主要工程を示す概略断面図である。
【００７３】
先ず、図１２（ａ）〜図１２（ｂ）に示すように、第１の実施形態の図１（ａ）〜図１（ｂ）の諸工程を経る。このとき、図１２（ｂ）に示すように、バックバリア層２ｂが形成される。
【００７４】
続いて、図１２（ｃ）に示すように、バックバリア層２ｂ上に、電子走行層２ｃ、中間層２ｄ、及び電子供給層１１を順次形成する。
ＭＯＶＰＥ法により、バックバリア層２ｂ上に、電子走行層２ｃ、中間層２ｄ、及び電子供給層１１となる各化合物半導体を順次成長する。電子走行層２ｃは、ｉ−ＧａＮを１００ｎｍ程度の厚みに成長することで形成される。中間層２ｄは、ｉ−ＡｌＧａＮを５ｎｍ程度の厚みに成長することで形成される。電子供給層１１は、ｉ−ＩｎＡｌＮを２０ｎｍ程度の厚みに成長することで形成される。中間層２ｄは形成しない場合もある。電子供給層は、ｉ−ＩｎＡｌＮを形成するようにしても良い。
【００７５】
ＧａＮの成長には、原料ガスとしてＧａ源であるトリメチルガリウム（ＴＭＧａ）ガス及びアンモニア（ＮＨ3）ガスの混合ガスを用いる。ＡｌＧａＮの成長には、原料ガスとしてＴＭＡｌガス、ＴＭＧａガス及びＮＨ3ガスの混合ガスを用いる。成長する化合物半導体層に応じて、ＴＭＡｌガス、ＴＭＧａガスの供給の有無及び流量を適宜設定する。ＩｎＡｌＮの成長には、原料ガスとしてＩｎ源であるトリメチルインジウム（ＴＭＩｎ）ガス、ＴＭＡｌガス及びアンモニア（ＮＨ3）ガスの混合ガスを用いる。共通原料であるＮＨ3ガスの流量は、１００ｓｃｃｍ〜１０ｓｌｍ程度とする。また、成長圧力は５０Torr〜３００Torr程度、成長温度は１０００℃〜１２００℃程度とする。
【００７６】
以上により、ｉ−ＧａＮ層２ａ、バックバリア層２ｂ、電子走行層２ｃ、中間層２ｄ、及び電子供給層１１が順次積層されてなる化合物半導体積層構造２が形成される。
【００７７】
続いて、素子分離構造を形成した後、図１３（ａ）に示すように、ソース電極３及びドレイン電極４を形成する。
電極材料として例えばＴａ／Ａｌ（下層がＴａ、上層がＡｌ）を用いる。電極形成には、蒸着法及びリフトオフ法に適した例えば庇構造２層レジストを用いる。このレジストを化合物半導体積層構造２上に塗布し、ソース電極及びドレイン電極の各形成予定位置を開口するレジストマスクを形成する。このレジストマスクを用いて、例えば蒸着法により、Ｔａ／Ａｌを堆積する。Ｔａの厚みは２０ｎｍ程度、Ａｌの厚みは２００ｎｍ程度とする。リフトオフ法により、庇構造のレジストマスク及びその上に堆積したＴａ／Ａｌを除去する。その後、ＳｉＣ基板１を、例えば窒素雰囲気中において４００℃〜１０００℃、例えば５５０℃程度で熱処理し、残存したＴａ／Ａｌを電子供給層１１とオーミックコンタクトさせる。なお、Ｔａ／Ａｌが熱処理を行わずとも電子供給層１１とオーミックコンタクトする場合には、当該熱処理を行わなくても良い。以上により、Ｔａ／Ａｌからなるソース電極３及びドレイン電極４が形成される。
【００７８】
続いて、図１３（ｂ）に示すように、化合物半導体積層構造２の表面に、開口５ａを有する保護膜５を形成する。
詳細には、先ず、ソース電極３上及びドレイン電極４上を含む化合物半導体積層構造２の全面にＳｉＮを、プラズマＣＶＤ法又はスパッタ法等により例えば２ｎｍ程度〜２００ｎｍ、例えば２０ｎｍ程度の厚みに堆積する。以上により、保護膜５が形成される。
【００７９】
次に、保護膜５の全面にレジストを塗布し、リソグラフィーによりレジストを加工する。これにより、保護膜５のゲート電極の形成予定位置を露出する開口を有するレジストマスクが形成される。
このレジストマスクを用いて、保護膜５を例えばフッ素系ガスをエッチングガスとして用いてドライエッチングする。これにより、保護膜５のゲート電極の形成予定位置に開口５ａが形成される。レジストマスクは、アッシング処理又は所定の薬液を用いたウェット処理により除去される。
【００８０】
続いて、図１３（ｃ）に示すように、ゲート電極６を形成する。
電極材料として例えばＮｉ／Ａｕ（下層がＮｉ、上層がＡｕ）を用いる。電極形成には、蒸着法及びリフトオフ法に適した例えば庇構造２層レジストを用いる。このレジストを開口５ａ内を含む保護膜５上に塗布し、開口５ａを含むゲート電極の形成予定位置を開口するレジストマスクを形成する。このレジストマスクを用いて、例えば蒸着法により、Ｎｉ／Ａｕを堆積する。Ｎｉの厚みは３０ｎｍ程度、Ａｕの厚みは４００ｎｍ程度とする。リフトオフ法により、庇構造のレジストマスク及びその上に堆積したＮｉ／Ａｕを除去する。これにより、開口５ａ内をゲートメタルで埋め込み化合物半導体積層構造２の表面とショットキー接触する、ゲート電極６が形成される。ゲート電極６は、開口５ａ内を埋め込み保護膜５上に乗り上げるＮｉと、Ｎｉ上に堆積したＡｕとから、いわゆるオーバーハング形状に形成される。
【００８１】
しかる後、ソース電極３及びドレイン電極４、ゲート電極６の電気的接続等の諸工程を経て、ＭＩＳ型のＩｎＡｌＮ／ＧａＮ・ＨＥＭＴが形成される。
【００８２】
以上説明したように、本実施形態によれば、電流コラプス等のトラップ起因の特性劣化を防止し、ピンチオフ特性及びｇｍを向上させるも、確実なノーマリオフを実現する信頼性の高いＩｎＡｌＮ／ＧａＮ・ＨＥＭＴが得られる。
【００８３】
なお、本実施形態では、電子供給層１１としてｉ−ＩｎＡｌＮ層を形成したが、ｉ−ＩｎＡｌＮ層の代わりに、例えばＩｎＡｌＧａＮ層を形成しても良い。
【００８４】
（第７の実施形態）
本実施形態では、化合物半導体装置としてＭＩＳ型のＡｌＧａＮ／ＧａＮ・ＨＥＭＴを開示する。
なお、第１の実施形態によるＡｌＧａＮ／ＧａＮ・ＨＥＭＴと同様の構成部材等については、同符号を付して詳しい説明を省略する。
図１４及び図１５は、第７の実施形態によるＡｌＧａＮ／ＧａＮ・ＨＥＭＴの製造方法における主要工程を示す概略断面図である。
【００８５】
先ず、図１４（ａ）に示すように、第１の実施形態の図１（ａ）の工程を実行し、ＳｉＣ基板１上に、ｉ−ＧａＮ層２ａ及びｐ−ＧａＮ部２ｂ１となるｐ−ＧａＮ層（例えば、Ｍｇ濃度１×１０19／ｃｍ3程度、膜厚５０ｎｍ程度）が順次形成される。
【００８６】
続いて、図１４（ｂ）に示すように、バックバリア層２ｂを形成する。
先ず、ｐ−ＧａＮ層上にレジストを塗布し、リソグラフィーによりレジストを加工する。これにより、ｐ−ＧａＮ層のゲート電極の形成予定位置の下方に位置整合する部分（ｐ−ＧａＮ部２ｂ１となる部分）を覆い、他の部分を開口するレジストマスクが形成される。
【００８７】
このレジストマスクを用いて、ｐ−ＧａＮ層の他の部分を、塩素系ガスをエッチングガスとしてドライエッチングし、当該他の部分の膜厚を減少させる。ここでは、当該他の部分の膜厚を１０ｎｍ程度とする。
【００８８】
以上により、ゲート電極の形成予定位置の下方に位置整合する部分に形成されたｐ−ＧａＮ部２ｂ１と、ｐ−ＧａＮ部２ｂ１の両側でｐ−ＧａＮ部２ｂ１よりも薄いｐ-−ＧａＮ部２ｂ６，２ｂ７とを有するバックバリア層２ｂが形成される。バックバリア層２ｂでは、ｐ−ＧａＮ部２ｂ１とｐ-−ＧａＮ部２ｂ６，２ｂ７とではイオン化アクセプタ濃度は同一であるが、ｐ−ＧａＮ部２ｂ１がｐ-−ＧａＮ部２ｂ６，２ｂ７よりも厚くイオン化アクセプタ量が多い部分となる。
【００８９】
続いて、図１４（ｃ）に示すように、バックバリア層２ｂ上に、電子走行層２ｃ、中間層２ｄ、及び電子供給層２ｅを順次形成する。
ＭＯＶＰＥ法により、バックバリア層２ｂ上に、電子走行層２ｃ、中間層２ｄ、及び電子供給層２ｅとなる各化合物半導体を順次成長する。電子走行層２ｃは、ｉ−ＧａＮを１００ｎｍ程度の厚みに成長することで形成される。中間層２ｄは、ｉ−ＡｌＧａＮを５ｎｍ程度の厚みに成長することで形成される。電子供給層２ｅは、ｎ−ＡｌＧａＮを３０ｎｍ程度の厚みに成長することで形成される。中間層２ｄは形成しない場合もある。電子供給層は、ｉ−ＡｌＧａＮを形成するようにしても良い。
【００９０】
ＧａＮの成長には、原料ガスとしてＧａ源であるトリメチルガリウム（ＴＭＧａ）ガス及びアンモニア（ＮＨ3）ガスの混合ガスを用いる。ＡｌＧａＮの成長には、原料ガスとしてＴＭＡｌガス、ＴＭＧａガス及びＮＨ3ガスの混合ガスを用いる。成長する化合物半導体層に応じて、ＴＭＡｌガス、ＴＭＧａガスの供給の有無及び流量を適宜設定する。共通原料であるＮＨ3ガスの流量は、１００ｓｃｃｍ〜１０ｓｌｍ程度とする。また、成長圧力は５０Torr〜３００Torr程度、成長温度は１０００℃〜１２００℃程度とする。
【００９１】
ＡｌＧａＮをｎ型として成長する際、即ち電子供給層２ｅ（ｎ−ＡｌＧａＮ）の形成には、ｎ型不純物をＡｌＧａＮの原料ガスに添加する。ここでは、例えばＳｉを含む例えばシラン（ＳｉＨ4）ガスを所定の流量で原料ガスに添加し、ＡｌＧａＮにＳｉをドーピングする。Ｓｉのドーピング濃度は、１×１０18／ｃｍ3程度〜１×１０20／ｃｍ3程度、例えば５×１０18／ｃｍ3程度とする。
以上により、ｉ−ＧａＮ層２ａ、バックバリア層２ｂ、電子走行層２ｃ、中間層２ｄ、及び電子供給層２ｅが順次積層されてなる化合物半導体積層構造２が形成される。
【００９２】
続いて、素子分離構造を形成した後、図１５（ａ）に示すように、電子供給層４ｅに電極用リセス４ｅ１を形成した後、ソース電極３及びドレイン電極４を形成する。
詳細には、先ず、化合物半導体積層構造２の全面にレジストを塗布し、リソグラフィーによりレジストを加工する。これにより、電子供給層４ｅにおけるゲート電極の形成予定位置を露出する開口を有するレジストマスクが形成される。
このレジストマスクを用いて、電子供給層２ｅの表層の一部を、例えばフッ素系ガスをエッチングガスとして用いてドライエッチングする。これにより、電子供給層２ｅのゲート電極の形成予定位置に電極用リセス４ｅ１が形成される。レジストマスクは、アッシング処理又は所定の薬液を用いたウェット処理により除去される。
【００９３】
次に、電極材料として例えばＴａ／Ａｌ（下層がＴａ、上層がＡｌ）を用いる。電極形成には、蒸着法及びリフトオフ法に適した例えば庇構造２層レジストを用いる。このレジストを化合物半導体積層構造２上に塗布し、ソース電極及びドレイン電極の各形成予定位置を開口するレジストマスクを形成する。このレジストマスクを用いて、例えば蒸着法により、Ｔａ／Ａｌを堆積する。Ｔａの厚みは２０ｎｍ程度、Ａｌの厚みは２００ｎｍ程度とする。リフトオフ法により、庇構造のレジストマスク及びその上に堆積したＴａ／Ａｌを除去する。その後、ＳｉＣ基板１を、例えば窒素雰囲気中において４００℃〜１０００℃、例えば５５０℃程度で熱処理し、残存したＴａ／Ａｌを電子供給層２ｅとオーミックコンタクトさせる。なお、Ｔａ／Ａｌが熱処理を行わずとも電子供給層２ｅとオーミックコンタクトする場合には、当該熱処理を行わなくても良い。以上により、Ｔａ／Ａｌからなるソース電極３及びドレイン電極４が形成される。
【００９４】
続いて、図１５（ｂ）に示すように、化合物半導体積層構造２の表面に保護膜５を形成する。
詳細には、ソース電極３上及びドレイン電極４上を含む化合物半導体積層構造２の全面にＳｉＮを、プラズマＣＶＤ法又はスパッタ法等により例えば２ｎｍ程度〜２００ｎｍ、例えば２０ｎｍ程度の厚みに堆積する。以上により、保護膜５が形成される。本実施形態では、保護膜５はゲート絶縁膜としても機能する。
【００９５】
続いて、図１５（ｃ）に示すように、ゲート電極６を形成する。
電極材料として例えばＮｉ／Ａｕ（下層がＮｉ、上層がＡｕ）を用いる。電極形成には、蒸着法及びリフトオフ法に適した例えば庇構造２層レジストを用いる。このレジストを保護膜５上に塗布し、ゲート電極の形成予定位置を開口するレジストマスクを形成する。このレジストマスクを用いて、例えば蒸着法により、Ｎｉ／Ａｕを堆積する。Ｎｉの厚みは３０ｎｍ程度、Ａｕの厚みは４００ｎｍ程度とする。リフトオフ法により、庇構造のレジストマスク及びその上に堆積したＮｉ／Ａｕを除去する。これにより、電極用リセス４ｅ１内を保護膜５を介してゲートメタルで埋め込むゲート電極６が形成される。ゲート電極６は、保護膜５を介して電極用リセス４ｅ１内を埋め込み保護膜５上に乗り上げるＮｉと、Ｎｉ上に堆積したＡｕとから、いわゆるオーバーハング形状に形成される。
【００９６】
しかる後、ソース電極３及びドレイン電極４、ゲート電極６の電気的接続等の諸工程を経て、ＭＩＳ型のＡｌＧａＮ／ＧａＮ・ＨＥＭＴが形成される。
【００９７】
以上説明したように、本実施形態によれば、電流コラプス等のトラップ起因の特性劣化を防止し、ピンチオフ特性及びｇｍを向上させるも、確実なノーマリオフを実現する信頼性の高いＡｌＧａＮ／ＧａＮ・ＨＥＭＴが得られる。
【００９８】
（第８の実施形態）
本実施形態では、化合物半導体装置としてＭＩＳ型のＡｌＧａＮ／ＧａＮ・ＨＥＭＴを開示する。
なお、第１の実施形態によるＡｌＧａＮ／ＧａＮ・ＨＥＭＴと同様の構成部材等については、同符号を付して詳しい説明を省略する。
図１６及び図１７は、第８の実施形態によるＡｌＧａＮ／ＧａＮ・ＨＥＭＴの製造方法における主要工程を示す概略断面図である。
【００９９】
先ず、図１６（ａ）に示すように、ＳｉＣ基板１上に、ｉ−ＧａＮ層２ａ及びｐ−ＡｌＧａＮ部１２ａとなるｐ−ＡｌＧａＮ層を順次形成する。
詳細には、ＳｉＣ基板１上に、ＭＯＶＰＥ法により、ｉ−ＧａＮ層２ａ及びｐ−ＡｌＧａＮ部１２ａとなるｐ−ＡｌＧａＮ層を順次成長する。
ｉ−ＧａＮ層２ａは、ｉ−ＧａＮを例えば３μｍ程度の厚みに成長することで形成される。ｐ−ＡｌＧａＮ部１２ａとなるｐ−ＡｌＧａＮ層は、ｐ−ＡｌＧａＮを例えば５０ｎｍ程度の厚みに成長することで形成される。
【０１００】
ＧａＮの成長には、原料ガスとしてＧａ源であるＴＭＧａガス及びＮＨ3ガスの混合ガスを用いる。ＡｌＧａＮの成長には、原料ガスとしてＧａ源であるＴＭＧａガス、Ａｌ源であるＴＭＡｌガス、及びＮＨ3ガスの混合ガスを用いる。ＴＭＧａガス、ＴＭＡｌガスの流量は適宜設定し、ＮＨ3ガスの流量は、１００ｓｃｃｍ〜１０ｓｌｍ程度とする。また、成長圧力は５０Torr〜３００Torr程度、成長温度は１０００℃〜１２００℃程度とする。
【０１０１】
ＡｌＧａＮをｐ型として成長する際、即ちｐ−ＡｌＧａＮ部１２ａとなるｐ−ＡｌＧａＮ層の形成には、ｐ型不純物であるＭｇ、Ｃ、Ｚｎ等、例えばＭｇをＡｌＧａＮの原料ガスに添加する。ここでは、例えばＭｇを含む例えばＣｐ２Ｍｇガスを所定の流量で原料ガスに添加し、ＡｌＧａＮにＭｇをドーピングする。Ｍｇのドーピング濃度は、１×１０16／ｃｍ3程度〜１×１０21／ｃｍ3程度、例えば１×１０19／ｃｍ3程度とする。
ｐ−ＡｌＧａＮ層を形成した後、４００℃〜１２００℃程度、例えば８００℃程度でｐ−ＡｌＧａＮ層を熱処理し、ｐ型不純物であるＭｇを活性化する。
【０１０２】
続いて、図１６（ｂ）に示すように、バックバリア層１２を形成する。
先ず、ｐ−ＡｌＧａＮ層上にレジストを塗布し、リソグラフィーによりレジストを加工する。これにより、ｐ−ＡｌＧａＮ層のゲート電極の形成予定位置の下方に位置整合する部分（ｐ−ＡｌＧａＮ部１２ａとなる部分）を覆い、他の部分を開口するレジストマスクが形成される。
【０１０３】
このレジストマスクを用いて、ｐ−ＡｌＧａＮのｐ型不純物を不活性する不純物、例えばアルゴン（Ａｒ）を加速エネルギー１５ｋｅＶ、ドーズ量１×１０14／ｃｍ2の条件でイオン注入する。不活性不純物として、Ａｒ以外にホウ素（Ｂ），酸素（Ｏ），リン（Ｐ），鉄（Ｆｅ）等を用いても良い。このイオン注入により、ｐ−ＡｌＧａＮ層のゲート電極の形成予定位置以外の部分が不活性し、ｐ-−ＡｌＧａＮとなってｐ-−ＡｌＧａＮ部１２ｂ，１２ｃが形成される。ｐ-−ＡｌＧａＮ部１２ｂ，１２ｃは、イオン化アクセプタ濃度がｐ−ＡｌＧａＮ部１２ａよりも低濃度である。レジストマスクは、アッシング処理又は所定の薬液を用いたウェット処理により除去される。
【０１０４】
以上により、ゲート電極の形成予定位置の下方に位置整合する部分に形成されたｐ−ＡｌＧａＮ部１２ａと、ｐ−ＡｌＧａＮ部１２ａの両側に形成されたｐ-−ＡｌＧａＮ部１２ｂ，１２ｃとを有するバックバリア層１２が形成される。バックバリア層１２では、ｐ−ＡｌＧａＮ部１２ａは、ｐ-−ＡｌＧａＮ部１２ｂ，１２ｃよりもイオン化アクセプタ量が多い、ここではイオン化アクセプタ濃度が高い部分となる。
【０１０５】
続いて、図１６（ｃ）に示すように、バックバリア層１２上に、電子走行層２ｃ、中間層２ｄ、及び電子供給層２ｅを順次形成する。
ＭＯＶＰＥ法により、バックバリア層１２上に、電子走行層２ｃ、中間層２ｄ、及び電子供給層２ｅとなる各化合物半導体を順次成長する。電子走行層２ｃは、ｉ−ＧａＮを１００ｎｍ程度の厚みに成長することで形成される。中間層２ｄは、ｉ−ＡｌＧａＮを５ｎｍ程度の厚みに成長することで形成される。電子供給層２ｅは、ｎ−ＡｌＧａＮを３０ｎｍ程度の厚みに成長することで形成される。中間層２ｄは形成しない場合もある。電子供給層は、ｉ−ＡｌＧａＮを形成するようにしても良い。
【０１０６】
ＧａＮの成長には、原料ガスとしてＧａ源であるＴＭＧａガス及びアンモニア（ＮＨ3）ガスの混合ガスを用いる。ＡｌＧａＮの成長には、原料ガスとしてＴＭＡｌガス、ＴＭＧａガス及びＮＨ3ガスの混合ガスを用いる。成長する化合物半導体層に応じて、ＴＭＡｌガス、ＴＭＧａガスの供給の有無及び流量を適宜設定する。共通原料であるＮＨ3ガスの流量は、１００ｓｃｃｍ〜１０ｓｌｍ程度とする。また、成長圧力は５０Torr〜３００Torr程度、成長温度は１０００℃〜１２００℃程度とする。
【０１０７】
ＡｌＧａＮをｎ型として成長する際、即ち電子供給層２ｅ（ｎ−ＡｌＧａＮ）の形成には、ｎ型不純物をＡｌＧａＮの原料ガスに添加する。ここでは、例えばＳｉを含む例えばシラン（ＳｉＨ4）ガスを所定の流量で原料ガスに添加し、ＡｌＧａＮにＳｉをドーピングする。Ｓｉのドーピング濃度は、１×１０18／ｃｍ3程度〜１×１０20／ｃｍ3程度、例えば５×１０18／ｃｍ3程度とする。
以上により、ｉ−ＧａＮ層２ａ、バックバリア層１２、電子走行層２ｃ、中間層２ｄ、及び電子供給層２ｅが順次積層されてなる化合物半導体積層構造２が形成される。
【０１０８】
続いて、素子分離構造を形成した後、図１７（ａ）に示すように、電子供給層４ｅに電極用リセス４ｅ１を形成した後、ソース電極３及びドレイン電極４を形成する。
詳細には、先ず、化合物半導体積層構造２の全面にレジストを塗布し、リソグラフィーによりレジストを加工する。これにより、電子供給層４ｅにおけるゲート電極の形成予定位置を露出する開口を有するレジストマスクが形成される。
このレジストマスクを用いて、電子供給層２ｅの表層の一部を、例えばフッ素系ガスをエッチングガスとして用いてドライエッチングする。これにより、電子供給層２ｅのゲート電極の形成予定位置に電極用リセス４ｅ１が形成される。レジストマスクは、アッシング処理又は所定の薬液を用いたウェット処理により除去される。
【０１０９】
次に、電極材料として例えばＴａ／Ａｌ（下層がＴａ、上層がＡｌ）を用いる。電極形成には、蒸着法及びリフトオフ法に適した例えば庇構造２層レジストを用いる。このレジストを化合物半導体積層構造２上に塗布し、ソース電極及びドレイン電極の各形成予定位置を開口するレジストマスクを形成する。このレジストマスクを用いて、例えば蒸着法により、Ｔａ／Ａｌを堆積する。Ｔａの厚みは２０ｎｍ程度、Ａｌの厚みは２００ｎｍ程度とする。リフトオフ法により、庇構造のレジストマスク及びその上に堆積したＴａ／Ａｌを除去する。その後、ＳｉＣ基板１を、例えば窒素雰囲気中において４００℃〜１０００℃、例えば５５０℃程度で熱処理し、残存したＴａ／Ａｌを電子供給層２ｅとオーミックコンタクトさせる。なお、Ｔａ／Ａｌが熱処理を行わずとも電子供給層２ｅとオーミックコンタクトする場合には、当該熱処理を行わなくても良い。以上により、Ｔａ／Ａｌからなるソース電極３及びドレイン電極４が形成される。
【０１１０】
続いて、図１７（ｂ）に示すように、化合物半導体積層構造２の表面に保護膜５を形成する。
詳細には、ソース電極３上及びドレイン電極４上を含む化合物半導体積層構造２の全面にＳｉＮを、プラズマＣＶＤ法又はスパッタ法等により例えば２ｎｍ程度〜２００ｎｍ、例えば２０ｎｍ程度の厚みに堆積する。以上により、保護膜５が形成される。本実施形態では、保護膜５はゲート絶縁膜としても機能する。
【０１１１】
続いて、図１７（ｃ）に示すように、ゲート電極６を形成する。
電極材料として例えばＮｉ／Ａｕ（下層がＮｉ、上層がＡｕ）を用いる。電極形成には、蒸着法及びリフトオフ法に適した例えば庇構造２層レジストを用いる。このレジストを保護膜５上に塗布し、ゲート電極の形成予定位置を開口するレジストマスクを形成する。このレジストマスクを用いて、例えば蒸着法により、Ｎｉ／Ａｕを堆積する。Ｎｉの厚みは３０ｎｍ程度、Ａｕの厚みは４００ｎｍ程度とする。リフトオフ法により、庇構造のレジストマスク及びその上に堆積したＮｉ／Ａｕを除去する。これにより、電極用リセス４ｅ１内を保護膜５を介してゲートメタルで埋め込むゲート電極６が形成される。ゲート電極６は、保護膜５を介して電極用リセス４ｅ１内を埋め込み保護膜５上に乗り上げるＮｉと、Ｎｉ上に堆積したＡｕとから、いわゆるオーバーハング形状に形成される。
【０１１２】
しかる後、ソース電極３及びドレイン電極４、ゲート電極６の電気的接続等の諸工程を経て、ＭＩＳ型のＡｌＧａＮ／ＧａＮ・ＨＥＭＴが形成される。
【０１１３】
以上説明したように、本実施形態によれば、電流コラプス等のトラップ起因の特性劣化を防止し、ピンチオフ特性及びｇｍを向上させるも、確実なノーマリオフを実現する信頼性の高いＡｌＧａＮ／ＧａＮ・ＨＥＭＴが得られる。
【０１１４】
（第９の実施形態）
本実施形態では、化合物半導体装置としてＭＩＳ型のＡｌＧａＮ／ＧａＮ・ＨＥＭＴを開示する。
なお、第１の実施形態によるＡｌＧａＮ／ＧａＮ・ＨＥＭＴと同様の構成部材等については、同符号を付して詳しい説明を省略する。
図１８及び図１９は、第９の実施形態によるＡｌＧａＮ／ＧａＮ・ＨＥＭＴの製造方法における主要工程を示す概略断面図である。
【０１１５】
先ず、図１８（ａ）に示すように、ＳｉＣ基板１上に、ｉ−ＧａＮ層２ａ及びｐ−ＩｎＡｌＮ部１３ａとなるｐ−ＩｎＡｌＮ層を順次形成する。
詳細には、ＳｉＣ基板１上に、ＭＯＶＰＥ法により、ｉ−ＧａＮ層２ａ及びｐ−ＩｎＡｌＮ部１３ａとなるｐ−ＩｎＡｌＮ層を順次成長する。
ｉ−ＧａＮ層２ａは、ｉ−ＧａＮを例えば３μｍ程度の厚みに成長することで形成される。ｐ−ＩｎＡｌＮ部１３ａとなるｐ−ＩｎＡｌＮ層は、ｐ−ＩｎＡｌＮを例えば５０ｎｍ程度の厚みに成長することで形成される。
【０１１６】
ＧａＮの成長には、原料ガスとしてＧａ源であるＴＭＧａガス及びＮＨ3ガスの混合ガスを用いる。ＩｎＡｌＮの成長には、原料ガスとしてＩｎ源であるＴＭＩｎガス、Ａｌ源であるＴＭＡｌガス、及びＮＨ3ガスの混合ガスを用いる。ＴＭＩｎガス、ＴＭＡｌガスの流量は適宜設定し、ＮＨ3ガスの流量は、１００ｓｃｃｍ〜１０ｓｌｍ程度とする。また、成長圧力は５０Torr〜３００Torr程度、成長温度は１０００℃〜１２００℃程度とする。
【０１１７】
ＩｎＡｌＮをｐ型として成長する際、即ちｐ−ＩｎＡｌＮ部１３ａとなるｐ−ＩｎＡｌＮ層の形成には、ｐ型不純物であるＭｇ、Ｃ、Ｚｎ等、例えばＭｇをＩｎＡｌＮの原料ガスに添加する。ここでは、例えばＭｇを含む例えばＣｐ２Ｍｇガスを所定の流量で原料ガスに添加し、ＩｎＡｌＮにＭｇをドーピングする。Ｍｇのドーピング濃度は、１×１０16／ｃｍ3程度〜１×１０21／ｃｍ3程度、例えば１×１０19／ｃｍ3程度とする。
ｐ−ＩｎＡｌＮ層を形成した後、４００℃〜１２００℃程度、例えば８００℃程度でｐ−ＩｎＡｌＮ層を熱処理し、ｐ型不純物であるＭｇを活性化する。
【０１１８】
続いて、図１８（ｂ）に示すように、バックバリア層１３を形成する。
先ず、ｐ−ＩｎＡｌＮ層上にレジストを塗布し、リソグラフィーによりレジストを加工する。これにより、ｐ−ＩｎＡｌＮ層のゲート電極の形成予定位置の下方に位置整合する部分（ｐ−ＩｎＡｌＮ部１３ａとなる部分）を覆い、他の部分を開口するレジストマスクが形成される。
【０１１９】
このレジストマスクを用いて、ｐ−ＩｎＡｌＮのｐ型不純物を不活性する不純物、例えばアルゴン（Ａｒ）を加速エネルギー１５ｋｅＶ、ドーズ量１×１０14／ｃｍ2の条件でイオン注入する。不活性不純物として、Ａｒ以外にホウ素（Ｂ），酸素（Ｏ），リン（Ｐ），鉄（Ｆｅ）等を用いても良い。このイオン注入により、ｐ−ＡｌＧａＮ層のゲート電極の形成予定位置以外の部分が不活性し、ｐ-−ＩｎＡｌＮとなってｐ-−ＩｎＡｌＮ部１３ｂ，１３ｃが形成される。ｐ-−ＩｎＡｌＮ部１３ｂ，１３ｃは、イオン化アクセプタ濃度がｐ−ＩｎＡｌＮ部１３ａよりも低濃度である。レジストマスクは、アッシング処理又は所定の薬液を用いたウェット処理により除去される。
【０１２０】
以上により、ゲート電極の形成予定位置の下方に位置整合する部分に形成されたｐ−ＩｎＡｌＮ部１３ａと、ｐ−ＩｎＡｌＮ部１３ａの両側に形成されたｐ-−ＩｎＡｌＮ部１３ｂ，１３ｃとを有するバックバリア層１３が形成される。バックバリア層１３では、ｐ−ＩｎＡｌＮ部１３ａは、ｐ-−ＩｎＡｌＮ部１３ｂ，１３ｃよりもイオン化アクセプタ量が多い、ここではイオン化アクセプタ濃度が高い部分となる。
【０１２１】
続いて、図１８（ｃ）に示すように、バックバリア層１３上に、電子走行層２ｃ、中間層２ｄ、及び電子供給層２ｅを順次形成する。
ＭＯＶＰＥ法により、バックバリア層１３上に、電子走行層２ｃ、中間層２ｄ、及び電子供給層２ｅとなる各化合物半導体を順次成長する。電子走行層２ｃは、ｉ−ＧａＮを１００ｎｍ程度の厚みに成長することで形成される。中間層２ｄは、ｉ−ＡｌＧａＮを５ｎｍ程度の厚みに成長することで形成される。電子供給層２ｅは、ｎ−ＡｌＧａＮを３０ｎｍ程度の厚みに成長することで形成される。中間層２ｄは形成しない場合もある。電子供給層は、ｉ−ＡｌＧａＮを形成するようにしても良い。
【０１２２】
ＧａＮの成長には、原料ガスとしてＧａ源であるＴＭＧａガス及びＮＨ3ガスの混合ガスを用いる。ＡｌＧａＮの成長には、原料ガスとしてＴＭＡｌガス、ＴＭＧａガス及びＮＨ3ガスの混合ガスを用いる。成長する化合物半導体層に応じて、ＴＭＡｌガス、ＴＭＧａガスの供給の有無及び流量を適宜設定する。共通原料であるＮＨ3ガスの流量は、１００ｓｃｃｍ〜１０ｓｌｍ程度とする。また、成長圧力は５０Torr〜３００Torr程度、成長温度は１０００℃〜１２００℃程度とする。
【０１２３】
ＡｌＧａＮをｎ型として成長する際、即ち電子供給層２ｅ（ｎ−ＡｌＧａＮ）の形成には、ｎ型不純物をＡｌＧａＮの原料ガスに添加する。ここでは、例えばＳｉを含む例えばシラン（ＳｉＨ4）ガスを所定の流量で原料ガスに添加し、ＡｌＧａＮにＳｉをドーピングする。Ｓｉのドーピング濃度は、１×１０18／ｃｍ3程度〜１×１０20／ｃｍ3程度、例えば５×１０18／ｃｍ3程度とする。
以上により、ｉ−ＧａＮ層２ａ、バックバリア層１３、電子走行層２ｃ、中間層２ｄ、及び電子供給層２ｅが順次積層されてなる化合物半導体積層構造２が形成される。
【０１２４】
続いて、素子分離構造を形成した後、図１９（ａ）に示すように、電子供給層４ｅに電極用リセス４ｅ１を形成した後、ソース電極３及びドレイン電極４を形成する。
詳細には、先ず、化合物半導体積層構造２の全面にレジストを塗布し、リソグラフィーによりレジストを加工する。これにより、電子供給層４ｅにおけるゲート電極の形成予定位置を露出する開口を有するレジストマスクが形成される。
このレジストマスクを用いて、電子供給層２ｅの表層の一部を、例えばフッ素系ガスをエッチングガスとして用いてドライエッチングする。これにより、電子供給層２ｅのゲート電極の形成予定位置に電極用リセス４ｅ１が形成される。レジストマスクは、アッシング処理又は所定の薬液を用いたウェット処理により除去される。
【０１２５】
次に、電極材料として例えばＴａ／Ａｌ（下層がＴａ、上層がＡｌ）を用いる。電極形成には、蒸着法及びリフトオフ法に適した例えば庇構造２層レジストを用いる。このレジストを化合物半導体積層構造２上に塗布し、ソース電極及びドレイン電極の各形成予定位置を開口するレジストマスクを形成する。このレジストマスクを用いて、例えば蒸着法により、Ｔａ／Ａｌを堆積する。Ｔａの厚みは２０ｎｍ程度、Ａｌの厚みは２００ｎｍ程度とする。リフトオフ法により、庇構造のレジストマスク及びその上に堆積したＴａ／Ａｌを除去する。その後、ＳｉＣ基板１を、例えば窒素雰囲気中において４００℃〜１０００℃、例えば５５０℃程度で熱処理し、残存したＴａ／Ａｌを電子供給層２ｅとオーミックコンタクトさせる。なお、Ｔａ／Ａｌが熱処理を行わずとも電子供給層２ｅとオーミックコンタクトする場合には、当該熱処理を行わなくても良い。以上により、Ｔａ／Ａｌからなるソース電極３及びドレイン電極４が形成される。
【０１２６】
続いて、図１９（ｂ）に示すように、化合物半導体積層構造２の表面に保護膜５を形成する。
詳細には、ソース電極３上及びドレイン電極４上を含む化合物半導体積層構造２の全面にＳｉＮを、プラズマＣＶＤ法又はスパッタ法等により例えば２ｎｍ程度〜２００ｎｍ、例えば２０ｎｍ程度の厚みに堆積する。以上により、保護膜５が形成される。本実施形態では、保護膜５はゲート絶縁膜としても機能する。
【０１２７】
続いて、図１９（ｃ）に示すように、ゲート電極６を形成する。
電極材料として例えばＮｉ／Ａｕ（下層がＮｉ、上層がＡｕ）を用いる。電極形成には、蒸着法及びリフトオフ法に適した例えば庇構造２層レジストを用いる。このレジストを保護膜５上に塗布し、ゲート電極の形成予定位置を開口するレジストマスクを形成する。このレジストマスクを用いて、例えば蒸着法により、Ｎｉ／Ａｕを堆積する。Ｎｉの厚みは３０ｎｍ程度、Ａｕの厚みは４００ｎｍ程度とする。リフトオフ法により、庇構造のレジストマスク及びその上に堆積したＮｉ／Ａｕを除去する。これにより、電極用リセス４ｅ１内を保護膜５を介してゲートメタルで埋め込むゲート電極６が形成される。ゲート電極６は、保護膜５を介して電極用リセス４ｅ１内を埋め込み保護膜５上に乗り上げるＮｉと、Ｎｉ上に堆積したＡｕとから、いわゆるオーバーハング形状に形成される。
【０１２８】
しかる後、ソース電極３及びドレイン電極４、ゲート電極６の電気的接続等の諸工程を経て、ＭＩＳ型のＡｌＧａＮ／ＧａＮ・ＨＥＭＴが形成される。
【０１２９】
以上説明したように、本実施形態によれば、電流コラプス等のトラップ起因の特性劣化を防止し、ピンチオフ特性及びｇｍを向上させるも、確実なノーマリオフを実現する信頼性の高いＡｌＧａＮ／ＧａＮ・ＨＥＭＴが得られる。
【０１３０】
なお、本実施形態では、バックバリア層としてｐ−ＩｎＡｌＮ層（ｐ−ＩｎＡｌＮ及びｐ-−ＩｎＡｌＮ）を形成したが、ｐ−ＩｎＡｌＮ層の代わりにｐ−ＡｌＮ層（ｐ−ＡｌＮ及びｐ-−ＡｌＮ）を形成しても良い。
【０１３１】
（第１０の実施形態）
本実施形態では、化合物半導体装置としてＭＩＳ型のＡｌＧａＮ／ＧａＮ・ＨＥＭＴを開示する。
なお、第１の実施形態によるＡｌＧａＮ／ＧａＮ・ＨＥＭＴと同様の構成部材等については、同符号を付して詳しい説明を省略する。
図２０及び図２１は、第１０の実施形態によるＡｌＧａＮ／ＧａＮ・ＨＥＭＴの製造方法における主要工程を示す概略断面図である。
【０１３２】
先ず、図２０（ａ）に示すように、ＳｉＣ基板１上に、ｉ−ＧａＮ層２ａを形成する。
詳細には、ＳｉＣ基板１上に、ＭＯＶＰＥ法により、ｉ−ＧａＮを例えば３μｍ程度の厚みに成長し、ｉ−ＧａＮ層２ａを形成する。
【０１３３】
ＧａＮの成長には、原料ガスとしてＧａ源であるＴＭＧａガス及びＮＨ3ガスの混合ガスを用いる。ＡｌＧａＮの成長には、原料ガスとしてＧａ源であるＴＭＧａガス、Ａｌ源であるＴＭＡｌガス、及びＮＨ3ガスの混合ガスを用いる。ＴＭＧａガス、ＴＭＡｌガスの流量は適宜設定し、ＮＨ3ガスの流量は、１００ｓｃｃｍ〜１０ｓｌｍ程度とする。また、成長圧力は５０Torr〜３００Torr程度、成長温度は１０００℃〜１２００℃程度とする。
【０１３４】
続いて、図２０（ｂ）に示すように、バックバリア層２ｂを形成する。
先ず、ｉ−ＧａＮ層２ａ上にレジストを塗布し、リソグラフィーによりレジストを加工する。これにより、ｉ−ＧａＮ層２ａのゲート電極の形成予定位置の下方に位置整合する部分（ｐ−ＧａＮ部となる部分）を開口し、ｉ−ＧａＮ層２ａの他の部分を覆うレジストマスクが形成される。
【０１３５】
このレジストマスクを用いて、ｐ型不純物であるＭｇ、Ｃ、Ｚｎ等、例えばＭｇをｉ−ＧａＮ層２ａの表層部分にイオン注入する。４００℃〜１２００℃程度、例えば８００℃程度で熱処理し、ｐ型不純物であるＭｇを活性化する。以上により、ｉ−ＧａＮ層２ａの表層には、ゲート電極の形成予定位置の下方に位置整合する部分にｐ−ＧａＮ部２ｂ１が形成される。ｐ−ＧａＮ部２ｂ１は、イオン化アクセプタ濃度が１×１０16／ｃｍ3程度〜１×１０21／ｃｍ3程度、例えば１×１０19／ｃｍ3程度となる。レジストマスクは、アッシング処理又は所定の薬液を用いたウェット処理により除去される。
【０１３６】
次に、ｐ−ＧａＮ部２ｂ１上を含むｉ−ＧａＮ層２ａ上にレジストを塗布し、リソグラフィーによりレジストを加工する。これにより、ｐ−ＧａＮ部２ｂ１を覆い、ｉ−ＧａＮ層２ａの他の部分を開口するレジストマスクが形成される。
【０１３７】
このレジストマスクを用いて、ｐ型不純物であるＭｇ、Ｃ、Ｚｎ等、例えばＭｇをｉ−ＧａＮ層２ａの表層部分にイオン注入する。４００℃〜１２００℃程度、例えば８００℃程度で熱処理し、ｐ型不純物であるＭｇを活性化する。以上により、ｉ−ＧａＮ層２ａの表層には、ｐ−ＧａＮ部２ｂ１の両側にｐ-−ＧａＮ部２ｂ８，２ｂ９が形成される。ｐ-−ＧａＮ部２ｂ８，２ｂ９は、厚みがｐ−ＧａＮ部２ｂ１と同一であり、イオン化アクセプタ濃度がｐ−ＧａＮ部２ｂ１よりも低濃度である。レジストマスクは、アッシング処理又は所定の薬液を用いたウェット処理により除去される。
【０１３８】
以上により、ゲート電極の形成予定位置の下方に位置整合する部分に形成されたｐ−ＧａＮ部２ｂ１と、ｐ−ＧａＮ部２ｂ１の両側に形成されたｐ-−ＧａＮ部２ｂ８，２ｂ９とを有するバックバリア層２ｂが形成される。バックバリア層２ｂでは、ｐ−ＧａＮ部２ｂ１は、ｐ-−ＧａＮ部２ｂ８，２ｂ９よりもイオン化アクセプタ量が多い、ここではイオン化アクセプタ濃度が高い部分となる。
【０１３９】
続いて、図２０（ｃ）に示すように、バックバリア層２ｂ上に、電子走行層２ｃ、中間層２ｄ、及び電子供給層２ｅを順次形成する。
ＭＯＶＰＥ法により、バックバリア層２ｂ上に、電子走行層２ｃ、中間層２ｄ、及び電子供給層２ｅとなる各化合物半導体を順次成長する。電子走行層２ｃは、ｉ−ＧａＮを１００ｎｍ程度の厚みに成長することで形成される。中間層２ｄは、ｉ−ＡｌＧａＮを５ｎｍ程度の厚みに成長することで形成される。電子供給層２ｅは、ｎ−ＡｌＧａＮを３０ｎｍ程度の厚みに成長することで形成される。中間層２ｄは形成しない場合もある。電子供給層は、ｉ−ＡｌＧａＮを形成するようにしても良い。
【０１４０】
ＧａＮの成長には、原料ガスとしてＧａ源であるＴＭＧａガス及びＮＨ3ガスの混合ガスを用いる。ＡｌＧａＮの成長には、原料ガスとしてＴＭＡｌガス、ＴＭＧａガス及びＮＨ3ガスの混合ガスを用いる。成長する化合物半導体層に応じて、ＴＭＡｌガス、ＴＭＧａガスの供給の有無及び流量を適宜設定する。共通原料であるＮＨ3ガスの流量は、１００ｓｃｃｍ〜１０ｓｌｍ程度とする。また、成長圧力は５０Torr〜３００Torr程度、成長温度は１０００℃〜１２００℃程度とする。
【０１４１】
ＡｌＧａＮをｎ型として成長する際、即ち電子供給層２ｅ（ｎ−ＡｌＧａＮ）の形成には、ｎ型不純物をＡｌＧａＮの原料ガスに添加する。ここでは、例えばＳｉを含む例えばシラン（ＳｉＨ4）ガスを所定の流量で原料ガスに添加し、ＡｌＧａＮにＳｉをドーピングする。Ｓｉのドーピング濃度は、１×１０18／ｃｍ3程度〜１×１０20／ｃｍ3程度、例えば５×１０18／ｃｍ3程度とする。
以上により、ｉ−ＧａＮ層２ａ、バックバリア層２ｂ、電子走行層２ｃ、中間層２ｄ、及び電子供給層２ｅが順次積層されてなる化合物半導体積層構造２が形成される。
【０１４２】
続いて、素子分離構造を形成した後、図２１（ａ）に示すように、電子供給層４ｅに電極用リセス４ｅ１を形成した後、ソース電極３及びドレイン電極４を形成する。
詳細には、先ず、化合物半導体積層構造２の全面にレジストを塗布し、リソグラフィーによりレジストを加工する。これにより、電子供給層４ｅにおけるゲート電極の形成予定位置を露出する開口を有するレジストマスクが形成される。
このレジストマスクを用いて、電子供給層２ｅの表層の一部を、例えばフッ素系ガスをエッチングガスとして用いてドライエッチングする。これにより、電子供給層２ｅのゲート電極の形成予定位置に電極用リセス４ｅ１が形成される。レジストマスクは、アッシング処理又は所定の薬液を用いたウェット処理により除去される。
【０１４３】
次に、電極材料として例えばＴａ／Ａｌ（下層がＴａ、上層がＡｌ）を用いる。電極形成には、蒸着法及びリフトオフ法に適した例えば庇構造２層レジストを用いる。このレジストを化合物半導体積層構造２上に塗布し、ソース電極及びドレイン電極の各形成予定位置を開口するレジストマスクを形成する。このレジストマスクを用いて、例えば蒸着法により、Ｔａ／Ａｌを堆積する。Ｔａの厚みは２０ｎｍ程度、Ａｌの厚みは２００ｎｍ程度とする。リフトオフ法により、庇構造のレジストマスク及びその上に堆積したＴａ／Ａｌを除去する。その後、ＳｉＣ基板１を、例えば窒素雰囲気中において４００℃〜１０００℃、例えば５５０℃程度で熱処理し、残存したＴａ／Ａｌを電子供給層２ｅとオーミックコンタクトさせる。なお、Ｔａ／Ａｌが熱処理を行わずとも電子供給層２ｅとオーミックコンタクトする場合には、当該熱処理を行わなくても良い。以上により、Ｔａ／Ａｌからなるソース電極３及びドレイン電極４が形成される。
【０１４４】
続いて、図２１（ｂ）に示すように、化合物半導体積層構造２の表面に保護膜５を形成する。
詳細には、ソース電極３上及びドレイン電極４上を含む化合物半導体積層構造２の全面にＳｉＮを、プラズマＣＶＤ法又はスパッタ法等により例えば２ｎｍ程度〜２００ｎｍ、例えば２０ｎｍ程度の厚みに堆積する。以上により、保護膜５が形成される。本実施形態では、保護膜５はゲート絶縁膜としても機能する。
【０１４５】
続いて、図２１（ｃ）に示すように、ゲート電極６を形成する。
電極材料として例えばＮｉ／Ａｕ（下層がＮｉ、上層がＡｕ）を用いる。電極形成には、蒸着法及びリフトオフ法に適した例えば庇構造２層レジストを用いる。このレジストを保護膜５上に塗布し、ゲート電極の形成予定位置を開口するレジストマスクを形成する。このレジストマスクを用いて、例えば蒸着法により、Ｎｉ／Ａｕを堆積する。Ｎｉの厚みは３０ｎｍ程度、Ａｕの厚みは４００ｎｍ程度とする。リフトオフ法により、庇構造のレジストマスク及びその上に堆積したＮｉ／Ａｕを除去する。これにより、電極用リセス４ｅ１内を保護膜５を介してゲートメタルで埋め込むゲート電極６が形成される。ゲート電極６は、保護膜５を介して電極用リセス４ｅ１内を埋め込み保護膜５上に乗り上げるＮｉと、Ｎｉ上に堆積したＡｕとから、いわゆるオーバーハング形状に形成される。
【０１４６】
しかる後、ソース電極３及びドレイン電極４、ゲート電極６の電気的接続等の諸工程を経て、ＭＩＳ型のＡｌＧａＮ／ＧａＮ・ＨＥＭＴが形成される。
【０１４７】
以上説明したように、本実施形態によれば、電流コラプス等のトラップ起因の特性劣化を防止し、ピンチオフ特性及びｇｍを向上させるも、確実なノーマリオフを実現する信頼性の高いＡｌＧａＮ／ＧａＮ・ＨＥＭＴが得られる。
【０１４８】
以上、第１〜第１０の実施形態を説明したが、これらの実施形態では、その特徴を適宜組み合わせることができる。数例を以下に示す。
例えば、第６の実施形態によるＩｎＡｌＮ／ＧａＮ・ＨＥＭＴにおいて、第３の実施形態の特徴であるゲートリセス構造（電子供給層１１に形成された電極リセスに（保護膜５を介して）ゲート電極６が形成される構造）を採用することができる。
また例えば、第６の実施形態によるＩｎＡｌＮ／ＧａＮ・ＨＥＭＴにおいて、第１の実施形態の特徴であるショットキー接触の構造（保護膜５の開口５ａを通じてゲート電極６が化合物半導体積層構造２とショットキー接触する）構造）を採用することができる。
また例えば、第９又は第１０の実施形態によるＡｌＧａＮ／ＧａＮ・ＨＥＭＴにおいて、第５の実施形態の特徴であるバックバリア層のイオン化アクセプタ量の多い部分の偏倚延在構造を採用することができる。
また例えば、第９又は第１０の実施形態によるＡｌＧａＮ／ＧａＮ・ＨＥＭＴにおいて、第７の実施形態の特徴であるバックバリア層の膜厚を部分的に変えた構造を採用することができる。
【０１４９】
第１〜第１０の実施形態によるＨＥＭＴは、いわゆるディスクリートパッケージに適用される。
このディスクリートパッケージでは、第１〜第１０の実施形態によるＨＥＭＴのチップが搭載される。以下、第１〜第１０の実施形態によるＨＥＭＴのチップ（以下、ＨＥＭＴチップと言う）のディスクリートパッケージについて例示する。
【０１５０】
ＨＥＭＴチップの概略構成を図２２に示す。
ＨＥＭＴチップ１００では、その表面に、上述したＡｌＧａＮ／ＧａＮ・ＨＥＭＴのトランジスタ領域１０１と、ドレイン電極が接続されたドレインパッド１０２と、ゲート電極が接続されたゲートパッド１０３と、ソース電極が接続されたソースパッド１０４とが設けられている。
【０１５１】
図２３は、ディスクリートパッケージを示す概略平面図である。
ディスクリートパッケージを作製するには、先ず、ＨＥＭＴチップ１００を、ハンダ等のダイアタッチ剤１１１を用いてリードフレーム１１２に固定する。リードフレーム１１２にはドレインリード１１２ａが一体形成されており、ゲートリード１１２ｂ及びソースリード１１２ｃがリードフレーム１１２と別体として離間して配置される。
【０１５２】
続いて、Ａｌワイヤ１１３を用いたボンディングにより、ドレインパッド１０２とドレインリード１１２ａ、ゲートパッド１０３とゲートリード１１２ｂ、ソースパッド１０４とソースリード１１２ｃをそれぞれ電気的に接続する。
その後、モールド樹脂１１４を用いて、トランスファーモールド法によりＨＥＭＴチップ１００を樹脂封止し、リードフレーム１１２を切り離す。以上により、ディスクリートパッケージが形成される。
【０１５３】
（第１１の実施形態）
本実施形態では、第１〜第１０の実施形態から選ばれたＨＥＭＴを備えたＰＦＣ（Power Factor Correction）回路を開示する。
図２４は、ＰＦＣ回路を示す結線図である。
【０１５４】
ＰＦＣ回路２０は、スイッチ素子（トランジスタ）２１と、ダイオード２２と、チョークコイル２３と、コンデンサ２４，２５と、ダイオードブリッジ２６と、交流電源（ＡＣ）２７とを備えて構成される。スイッチ素子２１に、第１〜第１０の実施形態から選ばれたＨＥＭＴが適用される。
【０１５５】
ＰＦＣ回路２０では、スイッチ素子２１のドレイン電極と、ダイオード２２のアノード端子及びチョークコイル２３の一端子とが接続される。スイッチ素子２１のソース電極と、コンデンサ２４の一端子及びコンデンサ２５の一端子とが接続される。コンデンサ２４の他端子とチョークコイル２３の他端子とが接続される。コンデンサ２５の他端子とダイオード２２のカソード端子とが接続される。コンデンサ２４の両端子間には、ダイオードブリッジ２６を介してＡＣ２７が接続される。コンデンサ２５の両端子間には、直流電源（ＤＣ）が接続される。なお、スイッチ素子２１には不図示のＰＦＣコントローラが接続される。
【０１５６】
本実施形態では、第１〜第１０の実施形態から選ばれたＨＥＭＴをＰＦＣ回路２０に適用する。これにより、信頼性の高いＰＦＣ回路３０が実現する。
【０１５７】
（第１２の実施形態）
本実施形態では、第１〜第１０の実施形態から選ばれたＨＥＭＴを備えた電源装置を開示する。
図２５は、第１２の実施形態による電源装置の概略構成を示す結線図である。
【０１５８】
本実施形態による電源装置は、高圧の一次側回路３１及び低圧の二次側回路３２と、一次側回路３１と二次側回路３２との間に配設されるトランス３３とを備えて構成される。
一次側回路３１は、第１１の実施形態によるＰＦＣ回路２０と、ＰＦＣ回路２０のコンデンサ２５の両端子間に接続されたインバータ回路、例えばフルブリッジインバータ回路３０とを有している。フルブリッジインバータ回路３０は、複数（ここでは４つ）のスイッチ素子３４ａ，３４ｂ，３４ｃ，３４ｄを備えて構成される。
二次側回路３２は、複数（ここでは３つ）のスイッチ素子３５ａ，３５ｂ，３５ｃを備えて構成される。
【０１５９】
本実施形態では、一次側回路３１を構成するＰＦＣ回路が第２の実施形態によるＰＦＣ回路２０であると共に、フルブリッジインバータ回路３０のスイッチ素子３４ａ，３４ｂ，３４ｃ，３４ｄが、第１〜第１０の実施形態から選ばれたＨＥＭＴとされている。一方、二次側回路３２のスイッチ素子３５ａ，３５ｂ，３５ｃは、シリコンを用いた通常のＭＩＳ・ＦＥＴとされている。
【０１６０】
本実施形態では、第１１の実施形態によるＰＦＣ回路２０と、第１〜第１０の実施形態から選ばれたＨＥＭＴとを、高圧回路である一次側回路３１に適用する。これにより、信頼性の高い大電力の電源装置が実現する。
【０１６１】
（第１３の実施形態）
本実施形態では、第１〜第１０の実施形態から選ばれたＨＥＭＴを備えた高周波増幅器を開示する。
図２６は、第１３の実施形態による高周波増幅器の概略構成を示す結線図である。
【０１６２】
本実施形態による高周波増幅器は、ディジタル・プレディストーション回路４１と、ミキサー４２ａ，４２ｂと、パワーアンプ４３とを備えて構成される。
ディジタル・プレディストーション回路４１は、入力信号の非線形歪みを補償するものである。ミキサー４２ａは、非線形歪みが補償された入力信号と交流信号をミキシングするものである。パワーアンプ４３は、交流信号とミキシングされた入力信号を増幅するものであり、第１の実施形態及び変形例のうちから選ばれた１種によるＡｌＧａＮ／ＧａＮ・ＨＥＭＴを有している。なお図２６では、例えばスイッチの切り替えにより、出力側の信号をミキサー４２ｂで交流信号とミキシングしてディジタル・プレディストーション回路４１に送出できる構成とされている。
【０１６３】
本実施形態では、第１〜第１０の実施形態から選ばれたＨＥＭＴを高周波増幅器に適用する。これにより、信頼性の高い高耐圧の高周波増幅器が実現する。
【０１６４】
以下、化合物半導体装置及びその製造方法、並びに電源装置及び高周波増幅器の諸態様を付記としてまとめて記載する。
【０１６５】
（付記１）二次元電子ガスが生成される化合物半導体積層構造と、
前記化合物半導体積層構造の上方に形成された電極と
を含み、
前記化合物半導体積層構造は、前記二次元電子ガスの生成部位の下方にｐ型半導体層を有しており、
前記ｐ型半導体層は、前記電極の下方に位置整合する部分がその他の部分よりもイオン化アクセプタ量が多いことを特徴とする化合物半導体装置。
【０１６６】
（付記２）前記ｐ型半導体層は、ｐ−ＧａＮ、ｐ−ＡｌＧａＮ、ｐ−ＩｎＡｌＮ、及びｐ−ＡｌＮから選ばれた１種を材料とすることを特徴とする付記１に記載の化合物半導体装置。
【０１６７】
（付記３）前記ｐ型半導体層は、前記その他の部分が不活性不純物を含有することを特徴とする付記１又は２に記載の化合物半導体装置。
【０１６８】
（付記４）前記ｐ型半導体層は、前記その他の部分が前記イオン化アクセプタ量の多い部分よりも薄いことを特徴とする付記１又は２に記載の化合物半導体装置。
【０１６９】
（付記５）前記ｐ型半導体層は、前記その他の部分が前記イオン化アクセプタ量の多い部分よりもイオン化アクセプタ濃度が低いことを特徴とする付記１又は２に記載の化合物半導体装置。
【０１７０】
（付記６）前記ｐ型半導体層は、前記イオン化アクセプタ量の多い部分が前記電極の片方側に偏倚するように延在することを特徴とする付記１〜５のいずれか１項に記載の化合物半導体装置。
【０１７１】
（付記７）前記電極は、前記化合物半導体積層構造に接触して形成されることを特徴とする付記１〜５のいずれか１項に記載の化合物半導体装置。
【０１７２】
（付記８）前記電極は、前記化合物半導体積層構造上で絶縁膜を介して形成されることを特徴とする付記１〜５のいずれか１項に記載の化合物半導体装置。
【０１７３】
（付記９）前記電極は、前記化合物半導体積層構造に形成されたリセスを前記絶縁膜を介して埋め込むように形成されることを特徴とする付記８に記載の化合物半導体装置。
【０１７４】
（付記１０）二次元電子ガスが生成される化合物半導体積層構造を形成する工程と、
前記化合物半導体積層構造の上方に電極を形成する工程と
を含み、
前記化合物半導体積層構造を形成する際に、前記二次元電子ガスの生成部位の下方に相当する部分にｐ型半導体層を形成し、
前記ｐ型半導体層は、前記電極の下方に位置整合する部分がその他の部分よりもイオン化アクセプタ量が多いことを特徴とする化合物半導体装置の製造方法。
【０１７５】
（付記１１）前記ｐ型半導体層は、ｐ−ＧａＮ、ｐ−ＡｌＧａＮ、ｐ−ＩｎＡｌＮ、及びｐ−ＡｌＮから選ばれた１種を材料とすることを特徴とする付記１０に記載の化合物半導体装置の製造方法。
【０１７６】
（付記１２）前記ｐ型半導体層は、前記その他の部分が不活性不純物を含有することを特徴とする付記１０又は１１に記載の化合物半導体装置の製造方法。
【０１７７】
（付記１３）前記ｐ型半導体層は、前記その他の部分が前記イオン化アクセプタ量の多い部分よりも薄いことを特徴とする付記１０又は１１に記載の化合物半導体装置の製造方法。
【０１７８】
（付記１４）前記ｐ型半導体層は、前記その他の部分が前記イオン化アクセプタ量の多い部分よりもイオン化アクセプタ濃度が低いことを特徴とする付記１０又は１１に記載の化合物半導体装置の製造方法。
【０１７９】
（付記１５）前記ｐ型半導体層は、前記イオン化アクセプタ量の多い部分が前記電極の片方側に偏倚するように延在することを特徴とする付記１０〜１４のいずれか１項に記載の化合物半導体装置の製造方法。
【０１８０】
（付記１６）前記電極は、前記化合物半導体積層構造に接触して形成されることを特徴とする付記１０〜１４のいずれか１項に記載の化合物半導体装置の製造方法。
【０１８１】
（付記１７）前記電極は、前記化合物半導体積層構造上で絶縁膜を介して形成されることを特徴とする付記１０〜１４のいずれか１項に記載の化合物半導体装置の製造方法。
【０１８２】
（付記１８）前記電極は、前記化合物半導体積層構造に形成されたリセスを前記絶縁膜を介して埋め込むように形成されることを特徴とする付記１７に記載の化合物半導体装置の製造方法。
【０１８３】
（付記１９）変圧器と、前記変圧器を挟んで高圧回路及び低圧回路とを備えた電源回路であって、
前記高圧回路はトランジスタを有しており、
前記トランジスタは、
二次元電子ガスが生成される化合物半導体積層構造と、
前記化合物半導体積層構造の上方に形成された電極と
を含み、
前記化合物半導体積層構造は、前記二次元電子ガスの生成部位の下方にｐ型半導体層を有しており、
前記ｐ型半導体層は、前記電極の下方に位置整合する部分がその他の部分よりもイオン化アクセプタ量が多いことを特徴とする電源回路。
【０１８４】
（付記２０）入力した高周波電圧を増幅して出力する高周波増幅器であって、
トランジスタを有しており、
前記トランジスタは、
二次元電子ガスが生成される化合物半導体積層構造と、
前記化合物半導体積層構造の上方に形成された電極と
を含み、
前記化合物半導体積層構造は、前記二次元電子ガスの生成部位の下方にｐ型半導体層を有しており、
前記ｐ型半導体層は、前記電極の下方に位置整合する部分がその他の部分よりもイオン化アクセプタ量が多いことを特徴とする高周波増幅器。
【符号の説明】
【０１８５】
１  ＳｉＣ基板
２  化合物半導体積層構造
２ａ  ｉ−ＧａＮ層
２ｂ，１２，１３  バックバリア層
２ｂ１  ｐ−ＧａＮ部
２ｂ２，２ｂ３，２ｂ４，２ｂ５，２ｂ６，２ｂ７，２ｂ８，２ｂ９  ｐ-−ＧａＮ部
２ｃ  電子走行層
２ｄ  中間層
２ｅ，１１  電子供給層
２ｅ１，２ｆ１，２ｆ２  電極用リセス
２ｆ  キャップ層
３  ソース電極
４  ドレイン電極
５  保護膜
６  ゲート電極
１２ａ  ｐ−ＡｌＧａＮ部
１２ｂ，１２ｃ  ｐ-−ＡｌＧａＮ部
１３ａ  ｐ−ＩｎＡｌＮ部
１３ｂ，１３ｃ  ｐ-−ＩｎＡｌＮ部
２０  ＰＦＣ回路
２１，３４ａ，３４ｂ，３４ｃ，３４ｄ，３５ａ，３５ｂ，３５ｃ  スイッチ素子
２２  ダイオード
２３  チョークコイル
２４，２５  コンデンサ
２６  ダイオードブリッジ
３０  フルブリッジインバータ回路
３１  一次側回路
３２  二次側回路
３３  トランス
４１  ディジタル・プレディストーション回路
４２ａ，４２ｂ  ミキサー
４３  パワーアンプ
１００  ＨＥＭＴチップ
１０１  トランジスタ領域
１０２  ドレインパッド
１０３  ゲートパッド
１０４  ソースパッド
１１１  ダイアタッチ剤
１１２  リードフレーム
１１２ａ  ドレインリード
１１２ｂ  ゲートリード
１１２ｃ  ソースリード
１１３  Ａｌワイヤ
１１４  モールド樹脂
【図１】
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【図２】
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【図３】
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【図４】
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【図５】
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【図６】
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【図７】
0006054621.tif 000008
【図８】
0006054621.tif 000009
【図９】
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【図１０】
0006054621.tif 000011
【図１１】
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【図１２】
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【図１３】
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【図１４】
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【図１５】
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【図１６】
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【図１７】
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【図１８】
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【図１９】
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【図２０】
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【図２１】
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【図２２】
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【図２３】
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【図２４】
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【図２５】
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【図２６】
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