(57)【特許請求の範囲】
【請求項１】
入力電圧を出力電圧に変換するコンバータユニットであって、
前記コンバータユニットを電圧源に接続する及び前記電圧源から前記入力電圧を受け取るための入力端子と、
負荷を駆動するために前記コンバータユニットを前記負荷に接続するための出力端子と、
制御可能なスイッチと、
前記制御可能なスイッチに接続されているインダクタと、
前記インダクタ電流を検出するための電流検出器と、
前記制御可能なスイッチの両端において測定される電圧の勾配を検出する電圧勾配検出器と、
前記インダクタ電流及び前記電圧勾配に基づいて前記制御可能なスイッチを制御する制御ユニットと、
を有するコンバータユニットにおいて、
前記電圧勾配検出器は、互いに逆平行に接続されていると共にコンデンサを介して前記制御可能なスイッチに接続されている２つのダイオードと、前記２つのダイオードにおいて電圧を検出する電圧検出器と、オフセット電位を前記２つのダイオードへ供給するオフセット電圧源とを有する、
コンバータユニット。
【請求項２】
前記制御ユニットは、前記検出されたインダクタ電流に基づいて前記制御可能なスイッチをオフに切り替え、前記検出電圧勾配に基づいて前記制御可能なスイッチをオンに切り替える、請求項１に記載のコンバータユニット。
【請求項３】
前記制御ユニットは、インダクタ電流が閾値に到達するときに前記制御可能なスイッチをオフに切り替え、前記電圧勾配が所定の値に到達するときに前記制御可能なスイッチをオンに切り替えるのに適している、請求項２に記載のコンバータユニット。
【請求項４】
前記電流検出器は、抵抗器であって、前記制御可能なスイッチと前記抵抗器における電圧を検出する電圧検出器とに直列に接続されている抵抗器を有する、請求項１に記載のコンバータユニット。
【請求項５】
前記抵抗器は、前記インダクタに直列に接続されている、請求項４に記載のコンバータユニット。
【請求項６】
前記電圧勾配検出器は、基準抵抗器を介して前記２つのダイオードに接続された基準電圧源を有する、請求項１乃至５の何れか一項に記載のコンバータユニット。
【請求項７】
前記電流検出器は、互いと並列に接続されていると共に前記インダクタ電流を複数の検出電流に分割する前記制御可能なスイッチと並列に接続されている複数のセンサ・スイッチを有する、請求項１に記載のコンバータユニット。
【請求項８】
前記電流検出器は、前記検出電流のうちの１つを基準電流と比較する比較器回路を有する、請求項７に記載のコンバータユニット。
【請求項９】
センサ・スイッチが、前記インダクタ電流に対応する前記検出抵抗において検出電圧を検出するために検出抵抗を介して前記制御可能なスイッチと並列に接続されている、請求項１に記載のコンバータユニット。
【請求項１０】
前記制御ユニットは、前記制御可能なスイッチを前記インダクタ電流に基づいてオフに制御する及び２つの異なる連続的な電圧勾配値に基づいてオンに制御する、請求項１に記載のコンバータユニット。
【請求項１１】
前記制御ユニットは、前記電圧勾配及び前記インダクタ電流に基づいて前記制御可能なスイッチを制御するための少なくとも１つの論理的ゲートを有する、請求項１に記載のコンバータユニット。
【発明の詳細な説明】
【技術分野】
【０００１】
本発明は、入力電圧を出力電圧に変換するためのコンバータユニット及び対応する方法に関する。
【背景技術】
【０００２】
電力変換の分野において、スイッチングモード電源（ＳＭＰＳ）は標準的な選択である。同期コンバータとしてインダクタと一緒に２つの制御可能なスイッチを有する、又は非同期コンバータとしてインダクタ及びダイオード又はコンデンサと一緒に１つの制御可能なスイッチを有するＳＭＰＳの様々な実施化が知られている。以下の記載において、このようなステップダウン（又はバック）コンバータは、一例のＳＭＰＳトポロジとして使用されるが、この概念は、ブースト、バックブースト及びクラスＥ等のコンバータに適用されることもできる。
【０００３】
ＳＭＰＳの出力電圧は、前記制御可能なスイッチをオン／オフに切り替えることにより制御され、通常、高周波制御ループ及び低周波制御ループが前記制御可能なスイッチを制御するのに使用される。一例として１つの制御可能なスイッチを有する非同期ＳＭＰＳを使用することにより、前記出力電圧は、スイッチング周波数に基づいて又は前記制御可能なスイッチのデューティサイクルに基づいて制御されることができ、デューティサイクルの制御は、固定された周波数を有するランプ信号を基準信号と比較することにより達成されることができ、前記切替時間は、前記ランプ信号が前記基準信号に到達したときに決定される。この場合、前記低周波制御ループは、例えば、前記入力電流、前記出力電流、前記出力電圧又は前記出力電力に基づいて、前記基準信号を供給し、前記高周波制御ループは、前記ランプ信号及び前記基準信号に基づいて前記スイッチングを制御する。通常、前記制御可能なスイッチは、前記ランプ信号が前記基準信号よりも低い場合、オンに切り替えられ、前記制御可能なスイッチは、前記ランプ信号が前記基準信号よりも高い場合、オフに切り替えられる。前記コンバータの前記出力又は出力電流は、前記低周波制御ループによって、前記基準信号をより高い値又はより低い値に設定することにより制御されることができる。
【０００４】
前記コンバータユニットの切替損失を最小化するように、前記切替時間は、前記制御可能なスイッチの両端における電圧に同期されなければならない。非同期ＳＭＰＳにおいて、前記制御可能なスイッチの両端における前記電圧がゼロであるとき（ゼロ電圧スイッチング）又は局所的な最小値に到達したとき（バレースイッチング）、前記制御可能なスイッチはオンに切り替えられる。このことは、前記制御可能なスイッチの切替損失を最小化するのに役立つ。
【発明の概要】
【発明が解決しようとする課題】
【０００５】
既存の最高水準の技術であるコントローラは、前記インダクタの電流がゼロである場合又は最小の値が検出される場合、前記制御可能なスイッチのスイッチをオンに切り替えられるように構成される。これらのコントローラにおいて、例えば基準信号と組み合わせられるランプ信号のような、発振器回路と組み合わせて低周波制御ループにより決定されるオン時間制御を利用することは、一般的である。
【０００６】
代替的な解決策において、前記インダクタ電流がピークの閾値に到達する場合、前記制御可能なスイッチはオフに切り替えられ、前記インダクタ電流がゼロを交差する場合、前記制御可能なスイッチはオンに切り替えられる。しかしながら、前記ダイオードのスイッチング遅延及び逆回復時間（reverse recovery time）のため、このことは、次善の切替時間（a suboptimal switching time）を得ることができ、従って、切替損失は、このような方式によって、最小化されない。
【０００７】
欧州特許出願第２ ５２８ ２１６号から、前記インダクタ電流及び前記スイッチ電圧に基づいた閾値制御を使用する自己振動バックンバータが、知られている。しかしながら、前記制御可能なスイッチのオン遷移の検出は、整流器ユニットが前記入力端子に接続されている場合のＡＣからＤＣ用途に対して難しい。このことは、交流サイクルの異なる点においてもゼロ電圧スイッチング又はバレースイッチングの何れかが必要とされることによるものであり、固定された電圧閾値を介して容易に取り扱われない。結果として、このスイッチング損失は、このような場合には最小化されない。
【０００８】
米国特許第２０１２２８６７５２号（Ｄ１）、スイッチング・レギュレータのための制御回路を開示している。前記回路は、インダクタ、制御可能なスイッチ及び電流検出器を有する。検出される当該インダクタ電流は、前記スイッチを制御するのに使用される。前記制御回路は、ｈｉｇｈ側可変電流源及びｌｏｗ側可変電流源のうちの少なくとも１つの電流値を制御するスルーレート制御部も含んでおり、前記スルーレート制御部は、前記スイッチへ供給される前記スイッチ電圧信号の変化のレートを規定する。
【０００９】
米国特許第４８８８８２号（Ｄ２）は、共振フライバック高電圧源のための同期回路を開示している。前記回路は、負勾配検出回路を備えている。前記負勾配検出回路の基本的な機能は、当該負勾配のｄＶＤｔがゼロに等しいまで、前記フライバック波形の落下勾配において、スイッチを無効にすることにある。
【００１０】
本発明の目的は、高い力率及び低い技術的な労力によって入力電圧を出力電圧に変換する改善されたコンバータユニット及び入力電圧を出力電圧に変換する対応する方法を提供することにある。
【課題を解決するための手段】
【００１１】
本発明の１つの見地によれば、入力電圧を出力電圧に変換するためのコンバータユニットは、
前記コンバータユニットを電圧源に接続する及び前記電圧源から前記入力電圧を受け取るための入力端子と、
負荷を駆動するために前記コンバータユニットを前記負荷に接続するための出力端子と、
制御可能なスイッチと、
前記制御可能なスイッチに接続されているインダクタと、
前記インダクタの電流を検出するための電流検出器と、
前記制御可能なスイッチの両端において測定される電圧の傾斜を検出する電圧勾配検出器と、
前記インダクタ電流及び前記電圧勾配に基づいて前記制御可能なスイッチを制御する制御ユニットと、
を有し、前記電圧勾配検出器は、互いに逆平行に接続されていると共にコンデンサを介して前記制御可能なスイッチに接続されている２つのダイオード、前記２つのダイオードにおける電圧を検出するための電圧検出器、及びオフセットされた電位を前記２つのダイオードへ供給するオフセット電圧源を有する。
【００１２】
本発明の好ましい実施例は、添付の従属請求項において規定される。添付の請求項に記載の方法は、添付の請求項に記載されている装置及び前記従属請求項に規定されているものと類似及び／又は同一の好ましい実施例を有することを理解されたい。
【００１３】
本発明は、検出された前記インダクタ電流及び前記制御可能なスイッチの両端における電圧降下の勾配に基づいて前記コンバータユニットの前記制御可能なスイッチを切り替えるための着想に基づいている。前記制御可能なスイッチが前記インダクタ電流に基づいてオフに切り替えられるので、一定の、低周波入力電流に相当する高い力率が達成されることができるように、同じ電流閾値がＡＣサイクル全体にわたって印加されることができる。前記制御可能なスイッチが前記勾配検出に基づいてオンに切り替えられるので、前記スイッチ電圧の最小値は、前記制御可能なスイッチが当該最小電圧において正確に切り替えられることができ前記制御可能なスイッチのスイッチング損失が最小化されるように前記サイクルの初期に検出されることができる。従って、前記力率は、前記コンバータユニットの技術的な労力が低減されるように乗算回路の必要性又は前記低周波制御部ループの平均化を必要とすることなしに増大されることができる一方で、低いスイッチング損失を維持する。前記電圧勾配検出器は、互いに逆平行に接続されていると共に、コンデンサを介して前記制御可能なスイッチに接続されている２つのダイオードと、前記２つのダイオードにおける電圧を検出する電圧検出器とを有するので、前記電圧勾配が正であるときに論理ｈｉｇｈ電圧を検出し、前記電圧勾配が負のときに論理ｌｏｗ電圧を検出する実現性が提供される。前記コンデンサを介する前記電流は、前記制御可能なスイッチの両端の電圧の勾配に比例している。前記電圧勾配検出器は、オフセット電位を前記２つのダイオードへ供給するためのオフセット電圧源を有するので、前記電圧勾配検出がより信頼性が高いものであるように、前記オフセット電位に対して前記２つのダイオードにおいて検出される論理ｌｏｗ及び論理ｈｉｇｈ電圧値を区別することができる。
【００１４】
好ましい実施例において、ダイオード又はコンデンサのような、ブロッキング装置は前記制御可能なスイッチに接続されている。つまり、前記制御可能なスイッチ、前記インダクタ及び前記ブロッキング装置は、共通ノードを共有している。従って、前記コンバータユニットは、ステップアップ・コンバータ、ステップダウン・コンバータ又はクラスＥのＳＭＰＳとして形成されることができる。
【００１５】
好ましい実施例において、前記制御ユニットは、検出された前記インダクタ電流に基づいて前記制御可能なスイッチをオフに切り替え、検出された前記電圧勾配に基づいて前記制御可能なスイッチをオンに切り替える。当該ピーク電流の制御は、良好な力率を得るための簡潔な解決案であり、前記電圧勾配の使用は、前記制御可能なスイッチが適当な時間におけるスイッチングによりオンに切り替えられるときの前記スイッチング損失を減少することを可能にすることができる。
【００１６】
好ましい実施例において、前記制御ユニットは、前記インダクタ電流が閾値値に到達する場合に前記制御可能なスイッチをオフに切り替え、前記電圧勾配が所定の値に到達する場合に前記制御可能なスイッチをオンに切り替える。このことは、前記力率を増大させるために前記制御可能なスイッチを正確に制御する一方で、低いスイッチング損失を保持するという可能性である。
【００１７】
好ましい実施例において、前記電流検出器は前記制御可能なスイッチに直列に接続されている抵抗器を有すると共に、前記抵抗器の両端の電圧を検出するための電圧検出器を有する。このことは、前記制御可能なスイッチが低い技術的な労力によってオンである間、前記インダクタ電流を検出するという可能性であり、差動電圧測定は、前記抵抗器が接地に接続されている場合、省略されることができる。
【００１８】
前記抵抗器を前記インダクタに直列に接続することが更に好ましい。このことは、低い技術的な労力によってインダクタ電流を検出するという可能性である。
【００１９】
好ましい実施例において、前記電圧勾配検出器は、例えば、前記２つのダイオードに基準抵抗器を介して接続されている基準電圧源により実現される基準電流源を有する。このことは、前記電圧勾配検出器を調整し、前記制御可能なスイッチを起動させるためのトリガ・ポイントを調整するという可能性である。
【００２０】
好ましい実施例において、前記電流検出器は、互いに並列に接続されていると共に前記インダクタ電流を複数の検出電流に分ける前記制御可能なスイッチと並列に接続されている複数のセンサ・スイッチを有する。このことは、集積回路内に集積されることができる低い技術的な労力によって電流検出器を提供するという可能性である。
【００２１】
好ましい実施例において、前記電流検出器は、検出された電流のうちの１つを基準電流と比較する比較器回路を有する。このことは、低い技術的な労力によって正確に前記検出された電流のうちの１つに基づいて前記インダクタ電流を決定するという可能性である。
【００２２】
好ましい実施例において、センサ・スイッチは、前記インダクタ電流に対応する検出抵抗において検出電圧を検出するために前記検出抵抗を介して前記制御可能なスイッチと並列に接続される。このことは、低い技術的な労力及び高い精度によって前記インダクタ電流を検出するという可能性である。
【００２３】
好ましい実施例において、前記制御ユニットは、前記インダクタ電流及び２つの異なる連続的な電圧勾配値に基づいて前記制御可能なスイッチを制御するのに適している。このことは、前記電圧が降下し始め前記電圧勾配が負である場合に前記制御ユニットを準備し、前記電圧勾配値が後続するゼロ交差又は電圧最小値の十分に近くに到達した場合に前記制御可能なスイッチをオンに切り替えるという可能性である。このことは、前記前記制御可能なスイッチを切り替えることの堅牢性を向上するという可能性である。
【００２４】
好ましい実施例において、前記制御ユニットは、前記電圧勾配及び前記インダクタ電流に基づいて前記制御可能なスイッチを制御する少なくとも１つの論理ゲートを有する。このことは、低い技術的な労力によって前記制御可能なスイッチの当該制御を実施化するという可能性である。
【００２５】
別の好ましい実施例では、前記コンバータユニットは、ステップダウン・コンバータである。
【００２６】
別の好ましい実施例では、前記コンバータユニットは、ステップアップ・コンバータである。
【００２７】
別の好ましい実施例では、前記コンバータユニットは、共振クラスＥコンバータである。
【００２８】
上述したように、本発明は、閾値値と比較した前記インダクタ電流に基づいて及び前記制御可能なスイッチの両端の電圧の電圧勾配に基づいて前記制御可能なスイッチを切り替えるという着想に基づく。前記制御可能なスイッチは、前記インダクタ電流が前記閾値に到達する場合、オフに切り替えられ、前記制御可能なスイッチの両端における電圧が最小値に到達する又は零交差点に到達する場合にオンに切り替えられる。ＡＣサイクル全体にわたって一定のインダクタ電流閾値を利用することは、一定の、低周波入力電流から生じるもののように、高い力率を提供する。前記電圧勾配の検出のため遅延又は回復時間は補償されることができ、前記制御可能なスイッチは、正確に前記零交差点において又は最小値において切り替えられることができ、この結果、前記制御可能なスイッチの前記スイッチング損失が低減される。従って、前記コンバータユニットの力率は、低い技術的な労力によって前記制御可能なスイッチを正確に切り替えることにより最小化されたスイッチング損失によって増大されることができる。
【００２９】
本発明のこれら及び他の見地は、以下に記載される実施例を参照して、明らかになり、説明されるであろう。
【図面の簡単な説明】
【００３０】
【図１】入力電圧を出力電圧に変換するためのコンバータユニットの模式的なブロック図を示している。
【図２】図１に示されるコンバータユニットの実施例の詳細なブロック図を示している。
【図３】当該コンバータユニット及び前記制御可能なスイッチを制御するための対応する制御信号の電圧及び電流のタイミング図を示している。
【図４】図１に示される制御ユニットの実施例の詳細なブロック図を示している。
【図５】当該コンバータユニット及び前記制御可能なスイッチを制御するための対応する制御信号の電圧及び電流のタイミング図を示している。
【発明を実施するための形態】
【００３１】
図１は、１０によって全体的に示されている例示的なステップダウン・コンバータユニットの模式的なブロック図を示している。コンバータユニット１０は、前記コンバータユニットを入力電圧Ｖ１０を供給する電圧源１６に接続するための入力端子１２、１４を有する。入力端子１４は、更に接地電位１７に接続されている。前記コンバータユニットは、更に、負荷（図示略）を駆動するように前記負荷へ出力電圧Ｖ２０及び出力電流Ｉ２０を供給するための出力端子１８、２０を有する。コンバータユニット１０は、入力端子１２、１４と並列に接続された制御可能なスイッチ２２及びダイオード２４と、制御可能なスイッチ２２とダイオード２４との間のノード２８に接続されていると共に出力端子のうちの１つ２０に接続されているインダクタ２６とを有する。前記制御可能なスイッチは、好ましくはトランジスタであり、最も好ましくはＭＯＳＦＥＴである。出力端子１８、２０は、更に、出力電圧Ｖ２０をフィルタリングするためのフィルタキャパシタ３０に接続されている。コンバータユニット１０は、更に、入力電圧Ｖ１０を出力電圧Ｖ２０に変換するために制御可能なスイッチ２２を切り替える駆動信号として供給されるゲート電圧ＶＧを介して制御可能なスイッチ２２を制御する制御ユニット３２を有する。コンバータユニット１０は、ＤＣ―ＤＣ又はＡＣ―ＤＣコンバータであって、この場合、入力電圧Ｖ１０を下方の出力電圧Ｖ２０に変換するステップダウン・コンバータである。入力電圧Ｖ１０は、定電圧又は整流されたＡＣ電圧であっても良い。
【００３２】
出力電圧Ｖ２０は、以下で記載されるように制御可能なスイッチ２２のデューティサイクル及び周波数により設定される。
【００３３】
コンバータユニット１０は、更に、制御可能なスイッチ２２のオン状態においてインダクタ２６のインダクタ電流Ｉ３０を検出する制御可能なスイッチ２２に接続された電流検出器３４を有する。電流センサ３４は、制御可能なスイッチ２２のオン状態においてインダクタ電流Ｉ３０に対応する電圧を検出するために、検出抵抗３６と検出抵抗３６の両端における電圧降下を測定する電圧検出器（図示略）とを有する。検出抵抗３６は、入力端子１４若しくは接地と制御可能なスイッチ２２のとの間に又は制御可能なスイッチ２２とインダクタ２６との間に接続されることができる。
【００３４】
コンバータユニット１０は、更に、制御可能なスイッチ２２の両端において降下するスイッチ電圧Ｖ３０の電圧勾配を検出するための電圧勾配検出器３８を有する。電圧勾配検出器３８は、コンデンサ４０を介してノード２８に接続されており、互いに逆平行に接続されていると共にコンデンサ４０及びオフセット電圧Ｖ４０を供給するオフセット電圧供給４６に直列に接続されている２つのダイオード４２、４４を有する。電圧勾配検出器３８は、スイッチ電圧Ｖ３０の電圧勾配を示している電圧勾配検出器３８において電圧を検出する電圧検出器４８に接続されている。
【００３５】
制御ユニット３２は、インダクタ電流Ｉ３０及び電圧検出器４８により検出された電圧勾配信号５０に基づいて制御可能なスイッチ２２を制御するために電流センサ３４及び電圧勾配検出器３８に接続されている。
【００３６】
検出抵抗３６の両端における電圧は、測定されたインダクタ電流Ｉ３０を、制御可能なスイッチ２２をオフに切り替えるための基準値と比較する比較装置に供給される。前記電圧勾配検出器は、前記電圧勾配が正である場合に論理ｈｉｇｈ値を有すると共に前記電圧勾配がオフセット電圧源４６により供給されるオフセット電圧Ｖ４０に対して負である場合に論理ｌｏｗ値を有する電圧勾配信号５０を供給する。詳細には、電圧勾配信号５０は、前記電圧勾配が正である場合にオフセット電圧Ｖ４０よりも高い１つのダイオード降下であり、前記電圧勾配が負である場合にオフセット電圧Ｖ４０よりも低い１つのダイオード降下を有する。電圧勾配信号５０は、スイッチ電圧Ｖ３０の電圧勾配がゼロに等しいとき又はスイッチ電圧Ｖ３０が最小値を有するとき、制御可能なスイッチ２２をオンに切り替えるために制御ユニット３２に供給される。
【００３７】
制御可能なスイッチ２２をオフにする手順は、次の通りである。制御可能なスイッチ２２がオンにされる場合、インダクタ電流Ｉ３０は上昇し始める。或る点においてインダクタ電流Ｉ３０は予め規定されたインダクタ電流閾値レベルに到達し、制御ユニット３２に供給される対応する電流センサ信号が変化する。この電流センサ信号は、制御ユニット３２に（或る遅延時間の後）制御可能なスイッチ２２をオフにさせる。従って、制御可能なスイッチ２２は、インダクタ電流Ｉ３０及びインダクタ電流閾値に基づいてオフに切り替えられる。
【００３８】
制御可能なスイッチをオンにする手順は、以下の通りである。制御可能なスイッチ２２がオフにされる場合、インダクタ電流Ｉ３０は最終的に減少し始める。ダイオード２４の接合静電容量、当該オフにされた制御可能なスイッチ２２の出力静電容量及び電圧勾配検出コンデンサ４０の静電容量は、ここで、インダクタ２６に対して直列である３つの並列な静電容量であり、共振ＬＣ回路を形成する。或る点において、インダクタ電流Ｉ３０はゼロを交差し、（例えば、前記ダイオードの逆回復が完了した後）前記ＬＣ回路の共振間隔が始まりスイッチ電圧Ｖ３０を減少させる。この点において、電圧勾配検出器３８は、負の電圧勾配を示す又は検出する。対応する電圧勾配信号５０は制御ユニット３２へ供給され、制御ユニット３２は遅延後に制御可能なスイッチ２２をオンに切り替える。つまり、前記スイッチは、前記電圧勾配が最初に負になった後の或る点においてオンにされる。
【００３９】
代替的な実施例において、スイッチ電圧Ｖ３０の最小値は、スイッチ電圧が最初にいつ減少し始めるかを検出することにより決定される。ひとたびこの条件が満たされると、制御ユニット３２は、スイッチ電圧Ｖ３０の勾配が次にゼロの十分近くに来たときに制御可能なスイッチ２２をオンに切り替える。つまり、前記スイッチは、前記電圧勾配における負から正への遷移に近い或る点においてオンにされる。
【００４０】
これらの２つの実施例は、前記対応するゼロ電圧スイッチング条件が満たされている場合、中間スイッチングのための電圧閾値比較と組み合わされて提供されることができる。当該第１の実施例は、この実施例が前記共振間隔のタイミングの変化に対する許容誤差に関してあまり堅牢性を有さない場合でさえも、実行速度の観点から最適な電圧勾配の検出である。電圧閾値比較のための付加的な回路は、０電圧スイッチング条件が満たされるときに自動的に伝導し始める前記ＭＯＳＦＥＴの本体ダイオードの特性に依存して必要であり得る。前記本体ダイオードがあまりに損失性のものである場合、前記付加的な検出回路は前記ＭＯＳＦＥＴの前記本体ダイオードの伝導を最小化する又は防止するために望ましいものであり得る。
【００４１】
電流センサ３４の代替的な実施例において、インダクタ電流Ｉ３０の極一部（small fraction）は、前記インダクタ電流閾値を表している閾値電流レベルと比較される。インダクタ電流Ｉ３０は、互いに並列に及び制御可能なスイッチ２２に対して直列に接続される多数のＦＥＴセルにより測定される。少数のこれらのＦＥＴセルの電流は、制御可能なスイッチ２２をオフに切り替えるために縮尺変更されたインダクタ電流閾値と比較される。このことは、前記ゲート・コネクタ及び前記ＦＥＴセルのソースコネクタが相互接続されると仮定している。
【００４２】
更なる代替的な実施例において、電流センサ３４は、多数のＦＥＴセルを有し、前記ドレイン及び前記ゲート・コネクタが相互接続され、少数のソースコネクタは前記他のＦＥＴセルから切り離される。検出抵抗は、分離されたＦＥＴソースと他のＦＥＴセルのソースコネクタとの間で接続される。前記検出抵抗両端の電圧は、インダクタ電流Ｉ３０に対応して測定されることができ、前記検出抵抗の前記抵抗がＦＥＴセルの量に対して小さい場合、インダクタ電流Ｉ３０は、十分な精度により測定されることができる。
【００４３】
更なる代替的な実施例において、Ｉ３０の縮尺変更された変形である誘導結合電流を供給するために、追加の巻線が、前記インダクタ上に構成されることができる。この場合、この縮尺変更された電流は、上述した技術の何れかを使用して検出されることができる。
【００４４】
一般に、コンバータユニット１０の構成要素は、別々の構成要素であるが、コンバータユニット１０は集積回路として実施化されることができる、並びに／又は１つ以上のアナログ‐デジタル及び／若しくはデジタル‐アナログコンバータを使用しているデジタル領域の信号処理を実行することができる。
【００４５】
図２は、コンバータユニット１０の実施例及び制御可能なスイッチ２２を制御するための制御ユニット３２の実施例を示している。同一の要素は、同じ符号により示されており、ここでは、単に違いのみが詳細に説明される。
【００４６】
電流センサ３４は、検出抵抗３６と基準電圧源５４に接続されている比較器５２とを有する。前記基準電圧源は、前記インダクタ電流閾値を決定するための閾値電圧として基準電圧を供給する。比較器５２は、検出抵抗３６の両端の電圧が、基準電圧源５４により供給される基準電圧よりも高いか否かを示している信号Ｖｉを供給する。信号Ｖｉは、以下に記載するように制御可能なスイッチ２２を切り替える制御ユニット３２に供給される。
【００４７】
電圧勾配検出器３８は、ダイオード４２、４４の両端の電圧を決定するための逆平行ダイオード４２、４４に並列に接続されている電圧検出器４８としての比較器を有する。比較器４８は、スイッチ電圧Ｖ３０の勾配が正であるか又は負であるかを示す信号Ｖｓを供給する。信号Ｖｓは、制御可能なスイッチ２２を切り替える制御ユニット３２に供給される。
【００４８】
信号Ｖｉは、インダクタ電流Ｉ３０が前記閾値よりも低い場合に論理ｈｉｇｈであり、インダクタ電流Ｉ３０が前記閾値よりも高い場合に論理ｌｏｗである。信号Ｖｓは、スイッチ電圧Ｖ３０の勾配が正である場合に論理ｈｉｇｈであり、スイッチ電圧Ｖ３０の勾配が負である場合に論理ｌｏｗである。
【００４９】
制御ユニット３２は、図２に模式的に示されている。制御ユニット３２は、ＮＡＮＤラッチ５６として実施化されるフリップフロップ５６を有している。信号Ｖｉ及びＶｓがフリップフロップ５６内に供給され、フリップフロップ５６は、制御可能なスイッチ２２のゲート・コネクタにインバータ５８を介して接続される。信号Ｖｉ及びＶｓは、インダクタ電流Ｉ３０及びスイッチ電圧Ｖ３０の勾配に基づいて制御可能なスイッチ２２をオン及びオフに切り替えるようにＮＡＮＤラッチ５６内に供給される。制御ユニット３２は、更に、制御可能なスイッチをオンに切り替えるようにタイムアウト信号ＶＤを含むようにフリップフロップ５６に接続されているＡＮＤゲート６０を有する。タイムアウト信号ＶＤは、スイッチ電圧Ｖ３０の最小値が検出されたか否かにかかわらず、あまりに多くの時間が経過している場合に、スイッチ２２を起動させるタイマー回路（図示略）からの信号である。タイムアウト信号ＶＤは、当該タイムアウト条件に達した場合に論理ｌｏｗであり、通常の動作においては論理ｈｉｇｈである。当該タイムアウト回路は、主に制御ユニット３２のスタートアップの振る舞いを援助するのに利用される。従って、制御ユニット３２は、閾値に対するインダクタ電流Ｉ３０に基づき及びスイッチ電圧Ｖ３０の勾配に基づき制御可能なスイッチのスイッチをオフに切り替える。
【００５０】
図３は、スイッチ電圧Ｖ３０、インダクタ電流Ｉ３０、信号Ｖｉ及びＶｓ及び制御可能なスイッチ２２を切り替えるための駆動信号として供給されるゲート電圧ＶＧのタイミング図を示している。
【００５１】
インダクタ電流Ｉ３０は図３ａに示されており、スイッチ電圧Ｖ３０は図３ｂに示されている。
【００５２】
比較器５２により供給される信号Ｖｉが図３ｃに示されており、インダクタ電流Ｉ３０が閾値よりも高いか又は低いかを示している。インダクタ電流Ｉ３０はｔ１において閾値電流に到達し、信号Ｖｉはその後直ぐに電流検出器３４における遅延によりｔ２において論理ｌｏｗに切り替えられる。インダクタ電流Ｉ３０の実際のピークは、しばらく後に、ｔ３において当該システムの遅延及び共振により生じる。図１に示されている位置における電流検出抵抗３６の場合、信号Ｖｉは、制御可能なスイッチがｔ４においてオフにされた直後に論理ｈｉｇｈに切り替えられる。
【００５３】
インダクタ２６と直列の電流検出抵抗３６の場合、信号Ｖｉは、Ｉ３０が前記電流閾値よりも低くまで降下した直後に論理ｈｉｇｈに切り替えられるが、このコンフィギュレーションは、これらの波形に示されていない。
【００５４】
図３ｄに示されている信号Ｖｓはスイッチ電圧Ｖ３０の勾配を示しており、信号Ｖｓはスイッチ電圧Ｖ３０の勾配がｔ５において十分に負である場合に論理ｌｏｗに切り替えられ、スイッチ電圧Ｖ３０の勾配がｔ６において十分に正である場合に論理ｈｉｇｈへ切り替えられる。
【００５５】
信号Ｖｉ及びＶｓは、図３ｅに示されるようにゲート電圧ＶＧを供給するためにＮＡＮＤラッチ５６によって組み合わせられる。ゲート信号ＶＧは、Ｖｉがｔ９において論理ｌｏｗになった直後に論理ｌｏｗになり、ＶＧは、Ｖｓがｔ８において論理ｌｏｗになった直後に論理ｈｉｇｈになる。
【００５６】
図４は、コンバータユニット１０の第２実施例の模式的なブロック図を示している。同一の要素は、同じ符号により示されており、ここでは、単に違いのみが詳細に説明される。
【００５７】
電圧勾配検出器３８は、更に、抵抗器６４及びローカル電圧源６６を含む電流源６２を有する。電流源６２は、ダイオード４２、４４においてソース又はシンク電流を検出ノード６７へ供給する。電流源６２によって、閾値は、スイッチ電圧Ｖ３０の勾配がいつ「正」又は「負」の何れかであるとして検出されるか決定するために調整される。信号Ｖｓは、（遅延の後）十分に負である勾配が検出されたとき、論理ｈｉｇｈから論理ｌｏｗまで変化する。ｈｉｇｈからｌｏｗへの遷移のためのトリガ・ポイントを調整することによって、当該回路遅延は、コンバータユニット１０の正確な動作のために補償されることができる。オフセット電圧Ｖ４０は、ローカル電圧源６６により供給される供給電圧Ｖ５０よりも十分に低い。従って、比較器４８のダイオード４２、４４の電圧降下は、ごく僅かである。
【００５８】
図４において、制御ユニット３２の更なる実施例は、第２のフリップフロップ６８を有して示されており、スイッチ電圧Ｖ３０が低下し始めたことを示す信号Ｖｐは、設定のための準備信号（prepare-for-set signal）としてフリップフロップ５６に接続されている論理に供給される。信号Ｖｐが受け取られた場合、電圧勾配検出器３８はスイッチ電圧Ｖ３０の勾配の次の零交差点がいつ生じるかを決定し、次いで、制御可能なスイッチ２２のスイッチオンを決定するために使用される。信号ＶｐはＡＮＤゲート６０に接続されている付加的なＮＡＮＤゲート７０に供給され、「設定のための準備」信号Ｖｐをリセットするのを可能にするために第２のフリップフロップ６８にも接続される。
【００５９】
制御可能なスイッチ２２のスイッチオフ手順は、この実施例において、過去の実施例と同一である。スイッチオン手順は、以下の通りである。制御可能なスイッチ２２がオフにされた場合、インダクタ電流Ｉ３０は最終的に減少し始める。インダクタ電流Ｉ３０がゼロまで減少し、逆回復時間（ある場合）が経過した場合、共振間隔はスイッチ電圧Ｖ３０をゼロに向かって減少させ始める。スイッチ電圧Ｖ３０が減少し始めたとき、電圧勾配検出器３８は負の電圧勾配を示し、電圧勾配は、当該変化を起動するために付加的な電流源６２に対して十分に負のものであることを必要とする。このことは、信号Ｖｐをｈｉｇｈに切り替える。電圧勾配検出器３８は、更に、電圧勾配が或る後の時間に信号Ｖｓを論理ｌｏｗから論理ｈｉｇｈまで切り替えることによって、ゼロの十分に近くに来たことを示す。両方の信号Ｖｐが論理ｈｉｇｈであり、信号Ｖｓが切り替わったので、ゲート電圧ＶＧは遅延の後に論理ｈｉｇｈに切り替えられ、制御可能なスイッチ２２はオンに切り替えられる。
【００６０】
図５は、図４の実施例に従ってスイッチ電圧Ｖ３０、インダクタ電流Ｉ３０、信号Ｖｉ、信号Ｖｐ、信号Ｖｓ及びゲート電圧ＶＧのタイミング図を示している。インダクタ電流は図５ａに示されており、スイッチ電圧Ｖ３０は図５ｂに示されている。
【００６１】
図５ｃにおける信号Ｖｉは、インダクタ電流Ｉ３０が閾値電流よりも高いときを示しており、図３ｃに示されている信号と同一である。
【００６２】
図５ｅの信号Ｖｓは、スイッチ電圧Ｖ３０の勾配が十分に負になるときであるｔ５において論理ｌｏｗへ切り替わる。このことは、図５ｄにおけるＶｐを、直後のある時点において、ｔ７において、ｈｉｇｈにし、「設定のための準備」条件が達成されることを示す。スイッチ電圧Ｖ３０の勾配がゼロの十分に近くに来るときに、Ｖｓはｔ６において論理ｌｏｗから論理ｈｉｇｈまで切り替えられる。ＶｐがｈｉｇｈでありＶｓが切り替わっているので、このことは、図５ｆにおけるゲート信号ＶＧを或る遅延の後に論理ｈｉｇｈにさせ、前記制御可能なスイッチがｔ８においてオンに切り替えられる。更に、我々は、我々がもはや前記「設定のための準備」条件にないので、Ｖｐ信号を論理ｌｏｗにリセットするトリガとしてＶｓのｌｏｗからｈｉｇｈの遷移を使用する。
【００６３】
設定のための準備信号としての信号Ｖｐ及び当該スイッチングを決定する信号Ｖｓのため、前記スイッチオン手順は、動作の間の共振間隔のタイミングの変化に対してより堅牢性を有する。
【００６４】
他の実施例において、前記電流閾値は、より高い力率をもたらすために、入力電圧Ｖ１０のＡＣサイクル内で調整されることができる。前記電流又は電圧検出は、コンバータユニット１０のそれぞれの導体への誘導結合を介して実施化されることができる。更なる実施例において、制御可能なスイッチ２２を切り替えることは、当該第１の検出されたゼロ勾配を越えて又は当該第１の検出されたゼロ勾配の後のゼロに近い電圧勾配の検出に基づいても良く、このような検出のために前記設定のための準備信号は調整されることができる。
【００６５】
コンバータユニット１０は、ブースト・コンバータ、バックコンバータ、バックブースト・コンバータ、クラスＥコンバータ又はフライバック・コンバータであっても良い。
【００６６】
本発明は、添付図面及び上述の明細書において説明され記載されたが、このような例及び記載は、説明的又は例示的なものであり、限定的なものではないとみなされるべきである。本発明は、開示されている実施例に限定されるものではない。開示されている前記実施例に対する他の変化は、前記添付図面、本明細書及び添付請求項の熟慮により、添付請求項に記載の本発明を実施する際に当業者により理解され、行われることができる。
【００６７】
添付の請求項において、「有する」なる語は他の要素又はステップを排除するものではなく、単数形は複数形を排除するものではない。単一の要素又は他のユニットが、前記請求項に列挙されている幾つかの項目の機能を実現しても良い。特定の手段が、相互に異なる従属請求項において引用されているという単なる事実は、これらの手段の組み合わせが有利になるように使用されることができないと示すものではない。
【００６８】
添付請求項における如何なる符号も、この範囲を制限するものとしてみなしてはならない。
【図１】
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【図２】
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【図３ａ）】
0006010257.tif 000004
【図３ｂ）】
0006010257.tif 000005
【図３ｃ）】
0006010257.tif 000006
【図３ｄ）】
0006010257.tif 000007
【図３ｅ）】
0006010257.tif 000008
【図４】
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【図５ａ）】
0006010257.tif 000010
【図５ｂ）】
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【図５ｃ）】
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【図５ｄ）】
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【図５ｅ）】
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【図５ｆ）】
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