(57)【特許請求の範囲】
【請求項１】
電子デバイスであって、
ドリフト領域と、
前記ドリフト領域の表面上のショットキー接点と、
前記ショットキー接点に隣接する前記ドリフト領域内のエッジ終端と、
を含み、
前記エッジ終端は、前記ドリフト領域の前記表面から距離ｄだけ窪んだ凹部領域と該凹部領域内のエッジ終端構造とを含み、
前記エッジ終端構造は、前記凹部領域内に複数のフローティングガードリングを含み、
前記ショットキー接点の下で前記ドリフト領域の前記表面は、上層フローティングガードリングを含み、前記凹部領域の表面は、複数の下層フローティングガードリングを含み、前記上層フローティングガードリング及び前記複数の下層フローティングガードリングは、前記ドリフト領域の第１の導電型と逆の第２の導電型を有し、前記複数の下層フローティングガードリングは、前記ショットキー接点によって定められた活性領域を取り囲み、互いに電気的に分離された第２の導電型のリングを含む、
ことを特徴とする電子デバイス。
【請求項２】
前記ドリフト領域の前記表面上で前記ショットキー接点と接触する複数のドープ領域を更に含み、
前記ドリフト領域は、第１の導電型を有し、前記複数のドープ領域は、該第１の導電型と逆の第２の導電型を有する、
ことを特徴とする請求項１に記載の電子デバイス。
【請求項３】
前記エッジ終端構造は、前記ショットキー接点によって定められた活性領域に隣接する前記凹部領域の表面で第１のフローティングガードリング及び第２のフローティングガードリングを含み、
前記エッジ終端構造は、前記第１のフローティングガードリングと前記第２のフローティングガードリング間の前記凹部領域の表面で低ドープ領域を更に含み、
前記低ドープ領域、前記第１のフローティングガードリング及び第２のフローティングガードリングは、前記ドリフト領域の第１の導電性と逆の第２の導電性を有する、
ことを特徴とする請求項１に記載の電子デバイス。
【請求項４】
活性領域と前記凹部領域の間の前記ドリフト領域に側壁を更に含み、
前記フローティングガードリングは、前記ショットキー接点に隣接して前記側壁の基部に位置付けられる、
ことを特徴とする請求項１に記載の電子デバイス。
【請求項５】
前記距離ｄは、前記ドリフト領域の前記表面から該ドリフト領域内への接合障壁ショットキー領域の深さよりも大きいことを特徴とする請求項２に記載の電子デバイス。
【請求項６】
半導体デバイスを形成する方法であって、
半導体層を与える段階と、
前記半導体層に該半導体層内のメサを定める凹部領域を与える段階であって、該メサが、該凹部領域の床面から垂直方向にオフセットされた水平メサ表面を含む前記凹部領域を与える段階と、
前記凹部領域に、該凹部領域の表面に複数のフローティングガードリングを含む接合終端構造を与える段階であって、前記複数のフローティングガードリングは、前記半導体層の第１の導電型と逆の第２の導電型を有し、前記複数のフローティングガードリングは、前記メサを取り囲み、互いに電気的に分離された第２の導電型のリングを含む、段階と、
前記水平メサ表面上に金属接点を与える段階と、
を含むことを特徴とする方法。
【請求項７】
前記接合終端構造を与える段階は、前記半導体層の前記凹部領域内にドーパントイオンを注入して該半導体層の該凹部領域の表面で低ドープ領域を形成する段階を含むことを特徴とする請求項６に記載の方法。
【請求項８】
前記接合終端構造を与える段階は、前記半導体層の前記凹部領域に、第１のフローティングガードリング及び第２のフローティングガードリングを形成する段階を更に含み、
前記第１のフローティングガードリング及び前記第２のフローティングガードリングは、前記低ドープ領域のドーパント濃度よりも高いドーパント濃度を有する、
ことを特徴とする請求項７に記載の方法。
【請求項９】
前記メサ表面上に前記金属接点を与える段階の前に該メサ表面に隣接するドリフト層に複数の接合障壁領域を与える段階を更に含むことを特徴とする請求項６に記載の方法。
【請求項１０】
前記メサの床面が、前記メサ表面から約０．５ミクロンの距離だけ垂直に離間していることを特徴とする請求項６に記載の方法。
【請求項１１】
前記ショットキー接点と接触する前記ドリフト領域の前記表面において、上層フローティングガードリングを更に含み、
前記上層フローティングガードリングは、前記凹部領域内の前記複数のフローティングガードリングから電気的に分離される、
ことを特徴とする請求項１に記載の電子デバイス。
【請求項１２】
前記ショットキー接点と接触する前記ドリフト領域の前記表面において、上層ガードリングを更に含み、
前記上層フローティングガードリングは、前記凹部領域内の前記複数のフローティングガードリングから電気的に分離される、
ことを特徴とする請求項６に記載の方法。
【発明の詳細な説明】
【技術分野】
【０００１】
本発明は、マイクロ電子デバイスに関し、より具体的には、マイクロ電子デバイスのためのエッジ終端に関する。
【背景技術】
【０００２】
高電圧シリコンカーバイド（ＳｉＣ）デバイスは、高電圧を扱うことができ、かつその活性領域のサイズに応じて約１００アンペア又はそれよりも大きい電流を扱うことができる。高電圧ＳｉＣデバイスは、特に、電力の調整、分配、及び制御の分野でいくつかの重要な用途を有する。
【０００３】
従来型の電力デバイス構造は、ドリフト領域として機能するｎエピタキシャル層がその上に形成されたｎ型ＳｉＣ基板を有する。このデバイスは、このｎ層上のｐｎ及び／又はショットキー接合を典型的に含み、これは、逆バイアス方向の電圧を遮断し、かつ順方向バイアス方向の電流フローを与えるための主接合として機能する。イオン注入によって典型的に形成されるｐ型接合終端拡張（ＪＴＥ）領域は、主接合を取り囲むことができる。ＪＴＥ領域を形成するのに使用されるインプラントは、アルミニウム、ホウ素、又は他の適切なｐ型ドーパントとすることができる。接合終端領域の目的は、ショットキー接合のエッジでの電界集中を低減又は防止し、かつ空乏領域がデバイスの表面と相互作用することを低減又は防止することである。表面効果は、空乏領域が不均一に拡がる原因になる可能性があり、これは、デバイスの降伏電圧に悪影響を及ぼす場合がある。他の終端技術は、表面効果によってより強く影響を受ける場合があるガードリング及びフローティングフィールドリングを含む。チャンネルストップ領域も、デバイスのエッジまでの空乏領域の拡張を防止／低減するために窒素又はリンのようなｎ型ドーパントの注入によって形成することができる。
【０００４】
接合終端拡張（ＪＴＥ）に加えて、多重フローティングガードリング（ＭＦＧＲ）及びフィールドプレート（ＦＰ）は、高電圧シリコンカーバイドデバイスに一般的に使用される終端方式である。別の従来型エッジ終端技術は、メサエッジ終端である。
【０００５】
フィールドプレート終端もデバイスのエッジ終端のための従来型の技術であり、対費用効果が高い場合がある。従来型フィールドプレートデバイスにおいて、高電界は、金属フィールドプレートの下の酸化物層によって支持される。この技術は、半導体における最高電界が比較的低いシリコンデバイスに対して良好に機能する。しかし、ＳｉＣデバイスにおいては、遮断状態での電界は非常に高く（〜２ＭＶ／ｃｍ）、これは、酸化物−半導体インタフェースでは２．５倍に増大する。これは、非常に高い酸化物電界をもたらし、かつ長期信頼性の問題を引き起こす場合がある。従って、フィールドプレート終端は、ＳｉＣデバイスでの使用には不適な場合がある。
【０００６】
ＪＴＥに加えた多重フローティングガードリングの使用は、インプラント投与量変動に対するＪＴＥの感度を低減するための技術として提案された。Ｋｉｎｏｓｈｉｔａ他著「ガードリング支援型ＲＥＳＵＲＦ：ＳｉＣ電力デバイスのための安定で高い降伏電圧を与える新規な終端構造」，「Ｔｅｃｈ．Ｄｉｇｅｓｔ  ｏｆ  ＩＳＰＳＤ’０２」、ｐｐ．２５３−２５６を参照することができる。Ｋｉｎｏｓｈｉｔａ他は、こうした技術がインプラント投与量変動に対する感度を低減したことを報告した。しかし、ガードリングがＪＴＥの内側エッジとＪＴＥの外側の両方に追加されるので、終端のために利用される面積は、ＪＴＥ単独の面積の殆ど３倍まで増大した。
【０００７】
従来型ＪＴＥ終端式ショットキーダイオードが図１に示されている。図示のように、ショットキーダイオード１０は、ｎ＋基板１４上のｎドリフト層１２を含む。図１は、ショットキーダイオード構造の半分を示し、この構造は、鏡像部分（図示せず）を含むことができる。アノードショットキー接点２３がドリフト層１２上にあり、カソード接点２５がｎ＋基板１４上にある。複数のＪＴＥゾーン２０Ａ、２０Ｂ、２０Ｃを含む接合終端拡張（ＪＴＥ）領域２０が、ショットキー接点２３に隣接してｎドリフト層１２内に与えられる。ＪＴＥゾーン２０Ａ、２０Ｂ、２０Ｃは、ショットキー接合からの距離に伴って段階的に外側の方向に低下する電荷のレベルを有することができるｐ型領域である。３つのＪＴＥゾーン２０Ａ、２０Ｂ、２０Ｃが示されているが、より多く又は少ないＪＴＥゾーンを与えることができる。
【０００８】
ＪＴＥゾーン２０Ａ、２０Ｂ、２０Ｃは、ｎドリフト層１２へのイオンの連続注入によって形成することができる。しかし、こうした注入は、複数のマスク及び注入段階を必要とし、製造の複雑性及び経費を増大させる。これは、ＪＴＥゾーンの数が増加する時に悪化する場合がある。更に、こうした手法によって与えられる段階的ドープ勾配は、理想的終端を与えない場合がある。
【０００９】
ＳｉＣショットキーダイオードの付加的な従来型終端は、Ｓｉｎｇｈ他著「低漏れ高収量４Ｈ−ＳｉＣショットキーダイオードにおける平面状終端」，ＩＳＰＳＤ’９７、ｐｐ．１５７−１６０に説明されている。ＳｉＣショットキー障壁ダイオードのためのｐ型エピタキシガードリング終端は、Ｕｅｎｏ他著「高電圧ＳｉＣショットキー障壁ダイオードのためのガードリング終端」，「ＩＥＥＥ  Ｅｌｅｃｔｒｏｎ  Ｄｅｖｉｃｅ  Ｌｅｔｔｅｒｓ」、第１６巻、第７号、７月、１９９５，ｐｐ．３３１−３３２に説明されている。更に、他の終端技術は、「電圧吸収エッジを有するｐｎ接合を含むＳｉＣ半導体デバイス」という名称の公開ＰＣＴ出願番号ＷＯ  ９７／０８７５４に説明されている。
【００１０】
別の種類の接合終端は、本発明の出願人に譲渡された米国特許第７，０２６，６５０号明細書に開示されており、その開示内容は、完全に説明されたものとして本明細書に引用により組み込まれている。
【００１１】
ガードリング終端を有する接合障壁ショットキー（ＪＢＳ）ダイオードが図２及び図３に示されている。図２は、ガードリングエッジ終端を有する接合障壁ショットキーダイオード３０の断面図であり、図３は、ショットキー接点を除いた接合障壁ショットキーダイオード３０の平面図である。ＪＢＳダイオードの構造は、融合ｐｎ接合ショットキー（ＭＰＳ）ダイオードの構造に類似していることが理解されるであろうが、デバイスの作動は、順方向導通モードにおいて僅かに異なっている。本明細書におけるＪＢＳダイオード構造への参照は、類似のＭＰＳ構造を参照することも意図している。
【００１２】
デバイス３０は、シリコンカーバイド基板１４を含む。基板は、第１の導電型を有するドーパントでドープすることができ、かつ２Ｈ、４Ｈ、６Ｈ、３Ｃ、及び／又は１５Ｒのポリタイプを有することができる。
【００１３】
デバイス３０は、第１の導電型の低濃度ドープドリフト層１２を含む。ショットキー接点３４が、ドリフト層１２と共にショットキー障壁接合を形成する。カソード接点４６が、ｎ型基板１４上にある。
【００１４】
ガードリング構造が、ショットキー接点３４とドリフト層１２の間のショットキー接合に隣接するドリフト層１２にあたえられ、かつその下方に延びている。ガードリング構造は、デバイスの活性領域（すなわち、ショットキー接合を含む領域）の周りの同心リングを形成する第２の導電型の複数のガードリング３８を含む。ガードリング３８は、例えば、イオン注入によって形成することができる。ガードリング形成は、２００６年４月１１日に付与された「シリコンカーバイドデバイスのための多重フローティングガードリングエッジ終端」という名称の米国特許第７，０２６，６５０号明細書、及び２００６年６月８日に公開された「シリコンカーバイドデバイスのためのエッジ終端構造及びそれを組み込むシリコンカーバイドデバイスの製造方法」という名称の米国特許公開第２００６／０１１８７９２号明細書に詳細に説明されており、これらは、本発明の出願人に譲渡され、引用によって本明細書に組み込まれている。
【００１５】
この構造内には、ドリフト層１２の表面でガードリング３８の間に与えられる第２の導電型の低ドープ領域３６も含まれる。低ドープ領域３６は、最外側ガードリング３８の外側に拡張することができ、ガードリングが延びる深さよりも浅い深さであるドリフト層１２内の深さに形成することができる。一部の実施形態において、低ドープ領域３６は、例えば、先に参照した米国特許第７，０２６，６５０号明細書及び米国特許公開第２００６／０１１８７９２号明細書に説明されているように表面電荷補償領域を与える。一部の実施形態において、低ドープ領域は、例えば、米国特許第７，０２６，６５０号明細書及び米国特許公開第２００６／０１１８７９２号明細書に説明されているようにドリフト層の表面上の表面電界軽減（ＲＥＳＵＲＦ）領域を与えることができる。低ドープ領域３６は、隣接するガードリング３８の間に完全又は不完全に拡張することができる。更に、低ドープ領域３６は、ドリフト層１２内にガードリング３８よりも深く又は浅く拡張することができる。
【００１６】
デバイス３０は、基板１４の反対側のドリフト層１２の表面上の第２の導電型の複数の接合障壁領域４２を更に含む。接合障壁領域４２は、イオン注入によって形成することができる。一部の実施形態において、接合障壁領域４２は、本発明の出願人に譲渡され、その開示内容が本明細書において引用により組み込まれている米国特許公開第２００６／０２５５４２３号明細書に示す構造を有することができる。
【００１７】
ショットキーダイオードは、本発明の出願人に譲渡され、その開示内容が本明細書において引用により組み込まれている米国特許公開第２００９／０２８９２６２号明細書、第２００８／００２９８３８号明細書、米国特許第７，７２８，４０２号明細書、及び／又は米国特許公開第２００９／０２８９２６２号明細書に示す構造を有することができる。
【００１８】
ショットキー接点３４は、接合障壁領域４２に接触する。デバイスに逆方向バイアスが印加された時に、接合障壁領域４２とドリフト層１２の間のｐｎ接合に発生した空乏領域が逆方向バイアスに耐え、それによってショットキー接合が保護される。
【先行技術文献】
【特許文献】
【００１９】
【特許文献１】ＷＯ  ９７／０８７５４
【特許文献２】米国特許第７，０２６，６５０号明細書
【特許文献３】米国特許公開第２００６／０１１８７９２号明細書
【特許文献４】米国特許公開第２００６／０２５５４２３号明細書
【特許文献５】米国特許公開第２００９／０２８９２６２号明細書
【特許文献６】米国特許公開第２００８／００２９８３８号明細書
【特許文献７】米国特許第７，７２８，４０２号明細書
【非特許文献】
【００２０】
【非特許文献１】Ｋｉｎｏｓｈｉｔａ他著「ガードリング支援型ＲＥＳＵＲＦ：ＳｉＣ電力デバイスのための安定で高い降伏電圧を与える新規な終端構造」，「Ｔｅｃｈ．Ｄｉｇｅｓｔ  ｏｆ  ＩＳＰＳＤ’０２」、ｐｐ．２５３−２５６
【非特許文献２】Ｓｉｎｇｈ他著「低漏れ高収量４Ｈ−ＳｉＣショットキーダイオードにおける平面状終端」，ＩＳＰＳＤ’９７、ｐｐ．１５７−１６０
【非特許文献３】Ｕｅｎｏ他著「高電圧ＳｉＣショットキー障壁ダイオードのためのガードリング終端」，「ＩＥＥＥ  Ｅｌｅｃｔｒｏｎ  Ｄｅｖｉｃｅ  Ｌｅｔｔｅｒｓ」、第１６巻、第７号、７月、１９９５，ｐｐ．３３１−３３２
【発明の概要】
【発明が解決しようとする課題】
【００２１】
半導体電力デバイスは、高レベルの電圧及び／又は電流を遮断し（逆方向遮断状態において）又は通過させる（順方向作動状態において）ように設計される。例えば、逆方向遮断状態において、半導体電力デバイスは、数百から数千ボルトの電位に耐えることができる。しかし、高い逆電圧では、半導体電力デバイスは、デバイスを通って何らかの電流を流し始める場合がある。「漏れ電流」として説明されるこの電流は、極めて望ましくないと考えられる。漏れ電流は、典型的にドリフト層のドーピング及び厚みの関数であるデバイスの設計電圧遮断機能を超えて逆電圧が増大した時に流れ始める場合がある。しかし、漏れ電流は、デバイスのエッジ終端及び／又は主接合の故障のような他の理由で発生する可能性がある。
【課題を解決するための手段】
【００２２】
一部の実施形態による電子デバイスは、ドリフト領域と、ドリフト領域の表面上のショットキー接点と、ショットキー接点に隣接するドリフト領域内のエッジ終端とを含む。エッジ終端は、ドリフト層の表面から距離ｄだけ窪んだ凹部領域と凹部領域内のエッジ終端構造とを含む。
【００２３】
電子デバイスは、ドリフト領域の表面上のショットキー接点と接触する複数のドープ領域を更に含むことができ、ドリフト領域は、第１の導電型を有し、複数のドープ領域は、第１の導電型と逆の第２の導電型を有する。距離ｄは、約０．２ミクロンから約１ミクロンとすることができる。一部の実施形態において、距離ｄは、約０．４ミクロンから約０．８ミクロンとすることができ、かつ一部の実施形態において、距離ｄは、約０．５ミクロンとすることができる。
【００２４】
エッジ終端構造は、凹部領域の表面上のガードリングを含むことができる。エッジ終端構造は、凹部領域の表面上の低ドープ領域を更に含むことができる。低ドープ領域とガードリング構造は、ドリフト領域の第１の導電性と逆の第２の導電性を有することができる。
【００２５】
電子デバイスは、活性領域と凹部領域の間の側壁を更に含むことができ、ショットキー接点に隣接して側壁の基部には、ガードリングを位置付けることができる。
【００２６】
距離ｄは、ドリフト領域の表面からドリフト領域内への接合障壁ショットキー領域の深さよりも大きい場合がある。
【００２７】
ドリフト領域は、シリコンカーバイドを含むことができる。特定の実施形態において、ドリフト領域は、２Ｈ、４Ｈ、６Ｈ、及び／又は１５Ｒのポリタイプを有するシリコンカーバイドを含むことができる。
【００２８】
一部の実施形態による電子デバイスは、７８０ｍＪ／ｃｍ2よりも大きいアバランシェ定格を有する。アバランシェ定格は、ＶBR×ＩR×ｔpulse／活性領域面積として定義することができ、式中、ＶBRは、デバイスの降伏電圧であり、ＩRは、デバイスの逆方向定格電流であり、ｔpulseは、デバイス故障が生じる電流パルスの最低持続時間である。一部の実施形態において、アバランシェ定格は、１０００ｍＪ／ｃｍ2よりも大きい場合がある。更に別の実施形態において、アバランシェ定格は、１２００ｍＪ／ｃｍ2よりも大きい場合がある。更に別の実施形態において、アバランシェ定格は、１５００ｍＪ／ｃｍ2よりも大きい場合がある。
【００２９】
一部の実施形態による電子デバイスは、理論アバランシェ降伏電圧よりも１００Ｖ低い電圧未満である漏れ電圧を有し、ここで漏れ電圧は、少なくとも１００μＡ／ｃｍ2の漏れ電流が生じるデバイスへの逆電圧として定義される。一部の実施形態において、電子デバイスは、デバイスの理論アバランシェ降伏電圧よりも２５Ｖ低い電圧未満である漏れ電圧を有することができる。
【００３０】
一部の実施形態による電子デバイスは、第１の導電型を有するドリフト領域と、ドリフト領域の表面上で第１の導電型と逆の第２の導電型を有する第１の領域を含む活性領域と、電子デバイスが逆方向にバイアスされた時に電圧に耐えるように構成された活性領域と第１の領域の間のｐｎ接合と、活性領域に隣接するドリフト領域内のエッジ終端とを含む。エッジ終端は、ドリフト領域の表面から距離ｄだけ窪んだ凹部領域と、凹部領域内のエッジ終端構造とを含む。エッジ終端構造は、ガードリングを含むことができる。
【００３１】
エッジ終端構造は、凹部領域での低ドープ領域を含むことができ、低ドープ領域及びガードリングは、ドリフト領域の第１の導電型と逆の第２の導電型を有する。
【００３２】
電子デバイスは、デバイスの理論アバランシェ降伏電圧よりも２５Ｖ低い電圧未満である漏れ電圧を有することができる。
【００３３】
電子デバイスは、ＭＯＳＦＥＴを含むことができ、複数のドープ領域は、デバイスの単位セルを定めるウェルを含むことができる。
【００３４】
電子デバイスは、ショットキーダイオードを含むことができ、複数のドープ領域は、逆電圧がデバイスに印加された時に電圧に耐えるように構成された接合障壁領域を含むことができる。
【００３５】
一部の実施形態によるショットキーダイオードは、シリコンカーバイドドリフト領域と、シリコンカーバイドドリフト領域上のショットキー接点と、ショットキー接点を取り囲むシリコンカーバイドドリフト層内のエッジ終端構造とを含む。エッジ終端構造は、デバイスに逆方向バイアスが印加された時に、ショットキー接点の逆方向降伏の前にアバランシェ降伏が発生するように構成される。
【００３６】
一部の実施形態による半導体デバイスの形成の方法は、半導体層を与える段階と、半導体層内にメサを定める半導体層内に凹部領域を与える段階であって、メサが、凹部領域の床面から垂直方向にオフセットした水平メサ表面を含む前記凹部領域を与える段階と、凹部領域内に接合終端構造を与える段階と、メサ表面上に金属接点を与える段階とを含む。
【００３７】
接合終端構造を与える段階は、半導体層の凹部領域内にドーパントイオンを注入して半導体層の凹部領域の表面に表面電荷補償領域を形成する段階を含むことができる。
【００３８】
接合終端構造を与える段階は、半導体層の凹部領域内にガードリングを形成する段階を含むことができ、ガードリングは、表面電荷補償領域のドーパント濃度よりも高いドーパント濃度を有する。
【００３９】
本方法は、メサ表面上に金属接点を与える前に、メサ表面に隣接するドリフト層内に複数の接合障壁領域を与える段階を更に含むことができる。
【００４０】
メサ床面は、メサ表面から約０．５ミクロンの距離だけ垂直方向に離間することができる。
【図面の簡単な説明】
【００４１】
【図１】従来型接合終端拡張（ＪＴＥ）終端を有するＳｉＣショットキーを示す図である。
【図２】ガードリングエッジ終端を含む接合障壁ショットキーダイオードの断面図である。
【図３】ショットキー接点を除いた図２の接合障壁ショットキーダイオードの平面図である。
【図４】典型的なショットキーダイオードに関する逆電流に対する逆電圧の例示的なグラフを示す図である。
【図５Ａ】一部の実施形態によるガードリングエッジ終端を含む接合障壁ショットキーダイオードの断面図である。
【図５Ｂ】一部の実施形態によるガードリングエッジ終端を含む接合障壁ショットキーダイオードの断面図である。
【図６】一部の実施形態によるショットキーダイオードに関する逆電流に対する逆電圧の例示的なグラフを示す図である。
【図７】ショットキー金属の周りの逆方向降伏を示す従来型接合障壁ショットキーダイオードの熱画像を示す図である。
【図８】実質的に均一な逆方向降伏を示す一部の実施形態による接合障壁ショットキーダイオードの熱画像を示す図である。
【図９】実質的に均一なアバランシェ降伏を示す一部の実施形態による接合障壁ショットキーダイオードの熱画像を示す図である。
【図１０】一部の実施形態による接合障壁ショットキーダイオードの形成を示す図である。
【図１１】一部の実施形態による接合障壁ショットキーダイオードの形成を示す図である。
【図１２】一部の実施形態による接合障壁ショットキーダイオードの形成を示す図である。
【図１３】一部の実施形態による凹部エッジ終端領域を含む電力ＭＯＳＦＥＴの平面図である。
【図１４Ａ】一部の実施形態による凹部エッジ終端領域を含む電力ＭＯＳＦＥＴの一部分の詳細図である。
【図１４Ｂ】図１４ＡのＡ−Ａ’線に沿って取った一部の実施形態による凹部エッジ終端領域を含む電力ＭＯＳＦＥＴの一部分の断面図である。
【図１５Ａ】更に別の実施形態による凹部エッジ終端領域を含む電力ＭＯＳＦＥＴの一部分の詳細図である。
【図１５Ｂ】図１５ＡのＢ−Ｂ’線に沿って取った更に別の実施形態による凹部エッジ終端領域を含む電力ＭＯＳＦＥＴの一部分の断面図である。
【発明を実施するための形態】
【００４２】
本発明の実施形態を示す添付図面を参照して本発明の実施形態をここでより完全に説明する。しかし、本発明は、多くの異なる形態に具現化することができ、本明細書に説明する実施形態に制限されると解釈すべきではない。むしろ、これらの実施形態は、本発明の開示が十分かつ完全になり、本発明の範囲を当業者に完全に伝えるように与えられている。同じ数字は、全体を通じて同様な要素を指している。
【００４３】
以下でより詳細に説明するように、本発明の実施形態は、ショットキーダイオード、接合障壁ショットキー（ＪＢＳ）ダイオード、融合ｐｎショットキー（ＭＰＳ）ダイオード、ＭＯＳＦＥＴ、絶縁ゲートバイポーラデバイス（ＩＧＢＴ）、ＭＯＳ制御サイリスタ、及び他のこうした半導体デバイスのような半導体デバイスのための改良されたエッジ終端を提供することができる。本発明の特定の実施形態は、シリコンカーバイド（ＳｉＣ）デバイスのためのエッジ終端を提供する。例えば、本発明の実施形態は、ＳｉＣショットキーダイオード、ＪＢＳダイオード、ＭＰＳダイオード、ＭＯＳＦＥＴ、ＩＧＢＴ、ＭＯＳ制御サイリスタ、及び他のこうしたＳｉＣデバイスのためのエッジ終端として利用することができる。
【００４４】
ＪＢＳショットキーダイオードに関する例示的な漏れ電流特性は図４に示されている。特に、図４は、一般的なショットキーダイオードに関する逆方向漏れ電流（ＩR）に対する逆電流（ＶR）の例示的な曲線５２である。図４のグラフにおいて、逆方向漏れ電流ＩRは、逆電圧の上昇に伴って増大する。逆方向漏れ電流が予め設定されたレベルＩ0に到達する逆電圧は、デバイスの定格降伏電圧と定義される。
【００４５】
ダイオードへの逆電圧が、臨界レベル、すなわち、理論アバランシェ降伏点（ＶAV）まで上昇すると、増大した電界は、半導体デバイス内部の原子それ自体のイオン化を開始し、アバランシェ降伏をもたらす。アバランシェ降伏が発生すると、逆電流は急激に増大する。アバランシェ降伏に起因する逆電流特性を示す例示的な曲線は、曲線５４で示されている。
【００４６】
一部の用途においては、過剰の逆電流又は電圧がデバイスに印加された時にアバランシェ降伏に耐えるように設計されることがデバイスに対して望ましい。アバランシェ降伏で存続することができるデバイスのためには、アバランシェ降伏が、デバイスの局所域ではなく、均一に発生することが望ましい。降伏が局所域で発生すると、デバイスを通過する電流が極めて不均一になる可能性があり、「ホットスポット」の形成を引き起こして、デバイスが過熱して破壊する場合がある。
【００４７】
アバランシェ降伏特性は、デバイスがその最大電界の近くで作動可能になるのに望ましいものである。できるだけ低い漏れ電流、かつできるだけ高い定格降伏電圧（ＶBR）を有することもデバイスに対して望ましい。一部の実施形態は、低い漏れ電流及び／又はより均一なアバランシェ降伏特性を有する高電力デバイスを与える。
【００４８】
従来型電力半導体の活性領域は、デバイスの設計降伏電圧よりも低い電圧で降伏を開始し、かつ漏れ電流を流すことができる。ＪＢＳデバイスにおいて、漏れ電流は、図３に示すＪＢＳ領域４２の端部４２’の近くのようなデバイスの高電界領域で、及び／又は高電界が発生する場合があるデバイスのエッジに最も近いショットキー接点の外側領域で流れ始めることができる。
【００４９】
一部の実施形態による凹部ガードリング終端を有する接合障壁ショットキー（ＪＢＳ）ダイオードが図５Ａ及び図５Ｂに示されており、これらの図は、一部の実施形態による接合障壁ショットキーダイオード１００及び接合障壁ショットキーダイオード１００’それぞれの断面図である。
【００５０】
図５Ａを参照すると、デバイス１００は、基板１１４を含む。基板は、第１の導電型を有するドーパントでドープしたシリコンカーバイドとすることができ、かつ２Ｈ、４Ｈ、６Ｈ、３Ｃ及び／又は１５Ｒのポリタイプを有することができる。一部の実施形態において、基板１１４は、シリコン、窒化ガリウム及びその合金のようなＩＩＩ族窒化物、砒化ガリウム及びその合金のようなＩＩＩ族砒化物、ダイヤモンド、又は他の種類の半導体材料を含むことができる。
【００５１】
デバイス１００は、第１の導電型の低濃度ドープドリフト層１１２を含む。ショットキー接点１３２は、ドリフト層１１２と共にショットキー障壁接合を形成する。カソード接点１４６は、ｎ型基板１１４上にある。
【００５２】
デバイス１００は、ショットキー接点１３２の下方のドリフト層１１２の表面に第２の導電型の複数の接合障壁領域１４２を更に含む。接合障壁領域１４２もイオン注入によって形成することができる。一部の実施形態において、接合障壁領域１４２は、米国特許公開第２００６／０２５５４２３号明細書に示すような構造を有することができ、その開示内容は、本明細書において引用により組み込まれている。
【００５３】
ショットキーダイオードは、米国特許公開第２００９／０２８９２６２号明細書、第２００８／００２９８３８号明細書、及び／又は米国特許第７，７２８，４０２号明細書に示すような構造を有することができ、それらの開示内容は、本明細書において引用により組み込まれている。
【００５４】
ショットキー接点１３２は、接合障壁領域１４２に接触する。逆方向バイアスがデバイスに印加された時に、接合障壁領域１４２とドリフト層１１２の間のｐｎ接合に発生した空乏層が逆方向バイアスに耐え、それによってショットキー接合が保護される。
【００５５】
凹部エッジ終端構造１５０が、ショットキー接点１３２とドリフト層１１２の間のショットキー接合を含む活性領域１５５に隣接するドリフト層１１２の表面に与えられる。エッジ終端構造１５０は、ショットキー接合に隣接するドリフト層１１２の凹部領域１４８内に形成された凹部ガードリング構造を含むことができる。凹部領域１４８は、例えば、ドリフト層を選択的にエッチングすることによって形成することができる。シリコンカーバイドをエッチングする技術は、当業技術で公知である。一部の実施形態において、凹部エッジ終端構造は、接合終端拡張（ＪＴＥ）エッジ終端構造のような他の種類の終端構造を含むことができる。従って、本発明の実施形態は、ガードリング終端構造に制限されないことが理解されるであろう。
【００５６】
凹部領域１４８は、ドリフト層１１２の上面１１２Ａから約０．２ミクロンから約１ミクロンとすることができる距離ｄだけ窪むことができる。一部の実施形態において、凹部領域１４８は、上面１１２Ａから約０．３ミクロンから約１ミクロンとすることができる距離ｄだけ窪むことができる。一部の実施形態において、凹部領域１４８は、上面１１２Ａから約０．４ミクロンから約０．８ミクロンとすることができる距離ｄだけ窪むことができる。一部の実施形態において、凹部領域１４８は、上面１１２Ａから約０．５ミクロンとすることができる距離ｄだけ窪むことができる。
【００５７】
ドリフト層１１２の凹部領域１４８は、使用されるガードリングの数に基づく幅ｗを有することができる。一部の実施形態において、ドリフト層１１２の凹側ゾーン１５０は、約１５ミクロンから約１０００ミクロンの幅ｗを有することができる。
【００５８】
凹部ガードリング構造１５０は、デバイスの活性領域１５５（すなわち、ショットキー接合を含む領域）の周りの同心リング（円であることを要しない）を形成する第２の導電型の複数のガードリング１３８を含む。ガードリング１３８は、例えば、イオン注入によって形成することができる。ガードリング形成は、２００６年４月１１日に付与された「シリコンカーバイドデバイスのための多重フローティングガードリングエッジ終端」という名称の米国特許第７，０２６，６５０号明細書、及び２００６年６月８日に公開された「シリコンカーバイドデバイスのためのエッジ終端及びそれを組み込むシリコンカーバイドデバイスの製造方法」という名称の米国特許公開第２００６／０１１８７９２号明細書に詳細に説明されており、これらは、本発明の出願人に譲渡され、本明細書において引用により組み込まれている。
【００５９】
特定の実施形態において、ガードリング１３８は、ドリフト層１１２の凹部表面１１２Ｂの下の約０．３ミクロンの深さまで形成することができ、約１Ｅ１８ｃｍ-3よりも大きいドーピング濃度を有することができる。
【００６０】
ガードリングは、活性領域１５５と活性領域１４８とを分離する側壁１４５に隣接する基部に第１のガードリング１３８ａを含むことができる。すなわち、第１のガードリング１３８ａは、凹部領域１４８によって定められるショットキーメサ１４０の側壁１４５に隣接する凹部領域１４８の内側コーナと重なり合って形成することができる。
【００６１】
この構造内には、ドリフト層１１２の表面でガードリング１３８の間に与えられた低ドープ領域１３６も含まれる。低ドープ領域１３６は、最外側ガードリング１３８の外側に拡張することができ、ガードリングが延びる深さよりも小さいドリフト層１１２内の深さに形成することができる。一部の実施形態において、低ドープ領域１３６は、例えば、先に参照した米国特許第７，０２６，６５０号明細書及び米国特許公開第２００６／０１１８７９２号明細書に説明されたような表面電荷補償領域を与えることができる。一部の実施形態において、低ドープ領域は、例えば、米国特許第７，０２６，６５０号明細書及び米国特許公開第２００６／０１１８７９２号明細書に説明されているようにドリフト層の表面上の表面電界軽減（ＲＥＳＵＲＦ）領域を与えることができる。低ドープ領域１３６は、隣接するガードリング１３８の間に完全又は不完全に拡張することができる。更に、低ドープ領域１３６は、ドリフト層１１２内にガードリング１３８よりも深く又は浅く拡張することができる。
【００６２】
一部の実施形態において、低ドープ領域１３６は、ドリフト領域１１２の凹部表面１１２Ｂより下に約０．２ミクロンの深さに注入することができ、約１Ｅ１７ｃｍ-3のドーピング濃度を有することができる。
【００６３】
図５Ｂは、ショットキーメサ１４０の側壁が傾斜し、ショットキーメサ１４０上のガードリング１４４が、デバイスの凹部領域１５０内の第１のガードリング１３８ａと組み合わされているデバイス１００’の実施形態を示している。
【００６４】
ドリフト層の凹部領域１４８内のガードリング構造１５０の具備は、逆方向漏れ電流を低減することができ、同時に、例えば、より詳細に以下で説明する図６−図９に示すように、アバランシェ降伏をデバイス内でより均一な及び／又は一貫したものとする。
【００６５】
特定の理論に束縛されることは望まないが、ガードリング領域の凹部は、ＪＢＳ領域１４２に接近したショットキー障壁の端部４２’のための付加的な遮蔽を与え、従って、それらの端部の近くの高電界によって生じる漏れ電流が低減されると現在考えられている。
【００６６】
更に、ガードリング構造の凹部は、特に主接合に最も近い２つのガードリング１３８ａと１３８ｂの間の間隙１６０の近くで、制御されたアバランシェ降伏をより受けやすい構造を与えるとも現在考えられている。従って、デバイスがその降伏電圧に到達すると、アバランシェ降伏がより制御され、及び／又は均一な形で発生することができる。均一なアバランシェ降伏は、デバイス内のホットスポットの形成を生じる可能性を低減し、従って、デバイスの致命的な故障をもたらす可能性も低減する。
【００６７】
従来型のＪＢＳショットキーダイオード及び一部の実施形態によるＪＢＳショットキーダイオードに対して測定された漏れ電流特性が図６に示されている。特に、図６は、標準的なショットキーダイオードに関する逆方向漏れ電流（ＩR）に対する逆電圧（ＶR）の曲線１５２と、一部の実施形態によるＪＢＳショットキーダイオードに関する逆方向漏れ電流（ＩR）に対する逆電圧（ＶR）の曲線１５６とを示している。図６に示すショットキーダイオードの両方は、０．３１ｃｍ×０．３１ｃｍ又は０．０９６１ｃｍ2の面積を有する活性領域を有していた。図６に示すように、本発明の実施形態によるＪＢＳダイオードの電流−電圧曲線１５６は、従来型ＪＢＳショットキーダイオードよりも低い漏れ電流を示すことができ、かつアバランシェ降伏によって逆電流が急激に増大するポイントまで、より密接に低漏れ電流の理想特性に従うアバランシェ降伏特性を有することができる。
【００６８】
特に、図６に示すように、一部の実施形態によるデバイスは、２ｍＡの所定の逆電流での従来型のＪＢＳショットキーダイオードに関する定格降伏電圧（ポイント１６２）に比べて非常に高い定格降伏電圧（ポイント１６６）を有することができる。その特性が図６の曲線１５６で示されるデバイスに対しては、理論降伏電圧は約２０００Ｖである。図６から理解することができるように、２ｍＡの所定の逆電流レベルでの曲線１５６のデバイスへの逆電圧は、曲線１５２で示される従来型のデバイスよりもデバイスの理論降伏電圧に遥かに近い。
【００６９】
特に、一部の実施形態によるデバイスは、デバイスの理論降伏電圧から約１００Ｖ低い２０ｍＡ／ｃｍ2の所定の逆電流での電圧を有することができる。一部の実施形態において、一部の実施形態によるデバイスは、デバイスの理論降伏電圧から約２５Ｖ低い２０ｍＡ／ｃｍ2の所定の逆電流での電圧を有することができる。
【００７０】
更に別の実施形態によるデバイスは、デバイスの理論降伏電圧から約１００Ｖ低い１００ｍＡ／ｃｍ2の所定の逆電流での電圧を有することができる。更に別の実施形態において、一部の実施形態によるデバイスは、デバイスの理論降伏電圧から約２５Ｖ低い１００ｍＡ／ｃｍ2の所定の逆電流での電圧を有することができる。
【００７１】
一部の実施形態によるショットキーデバイスは、降伏の発現の前に生じる比較的低い逆方向漏れ電流を有するアバランシェ降伏を発生する可能性があり、これは、問題のデバイスのサイズに依存する場合がある。例えば、一部の実施形態において、ショットキーデバイスは、降伏の発現の前に１００Ｖ低い逆電圧で５２０μＡ／ｃｍ2程度の低い逆方向漏れ電流を発生する場合がある。更に別の実施形態において、ショットキーデバイスは、降伏の発現の前に１００Ｖ低い逆電圧で０.５ｍＡ／ｃｍ2未満の逆方向漏れ電流を発生する場合がある。更に別の実施形態において、ショットキーデバイスは、降伏の発現の前に１００Ｖ低い逆電圧で１０ｍＡ／ｃｍ2未満の逆方向漏れ電流を発生する可能性があり、更に別の実施形態において、ショットキーデバイスは、降伏の発現の前に１００Ｖ低い逆電圧で２０ｍＡ／ｃｍ2未満の逆方向漏れ電流を発生することができる。
【００７２】
図７は、従来型の制御障壁ショットキーダイオードの熱画像であり、ショットキー金属の周囲を取り囲む逆方向降伏が示されている。特に、図７の熱画像は、図６のポイント１６２での定格逆方向降伏電流で作動する従来型のＪＢＳショットキーダイオードに対応する。図７の熱画像は、いくつかの「ホットスポット」１７２を表し、デバイスを通過する電流レベルの不均一な増大が示されている。特に、降伏は、図２に示すポイント５０に近いショットキー金属の周囲内部のスポットで、すなわち、ショットキー金属３４がドリフト領域１２に対してショットキー接合を形成する最外側ポイントで発生し始めるように見える。ショットキー接合は、局所化した加熱及び／又は高い逆電流に影響を受け取る場合があるので、この部位は、ショットキーデバイスに発生する降伏のためには好ましくない部位である。対照的に、降伏は、より頑強なｐｎ接合を含むデバイスのエッジ終端領域内部で発生することがより好ましい。
【００７３】
更に、図７の加熱パターンは、デバイスのショットキー接合が、真のアバランシェ降伏条件に到達する前に降伏する場合があることを示している。対照的に、一部の実施形態によるデバイスでは、逆方向バイアスがデバイスに印加された時に、ショットキー接合が降伏する前にアバランシェ降伏が発生する可能性がある。
【００７４】
図８は、一部の実施形態による接合障壁ショットキーダイオードの熱画像であり、実質的に均一な逆方向漏れが示されている。特に、図８の熱画像は、図６のポイント１６４で作動する一部の実施形態によるＪＢＳショットキーダイオードに対応する。デバイスは、降伏電圧の近くで作動しているが、図８の熱画像は、デバイスの周りの非常に均一な温度を示している。
【００７５】
図９は、一部の実施形態による接合障壁ショットキーダイオードの熱画像であり、実質的に均一なアバランシェ降伏が示されている。特に、図９の熱画像は、図６のポイント１６６での定格逆方向降伏電流で作動する一部の実施形態によるＪＢＳショットキーダイオードに対応する。図９の熱画像は、デバイスの周囲の周りのより均一な加熱を示し、かつデバイスの僅かな局所加熱を示し、一部の実施形態によるデバイス内でアバランシェ降伏がより均一に発生することが示されている。更に、図９の加熱パターンは、アバランシェ降伏がショットキー接合ではなくエッジ終端内で好ましく発生している場合があることを示している。
【００７６】
図１０−図１２は、一部の実施形態による接合障壁ショットキーダイオードの形成を説明している。図１０−図１２を参照すると、半導体層１１２が基板１１４上に与えられる。半導体層１１２及び基板１１４は、シリコン、シリコンカーバイド、窒化ガリウム及びその合金のようなＩＩＩ族窒化物、砒化ガリウム及びその合金のようなＩＩＩ族砒化物、ダイヤモンド、又はあらゆる他の種類の半導体を含むことができる。
【００７７】
マスク２０２が、半導体層１１２上に形成され、半導体層１１２は、例えば、反応性イオン２０５を用いて異方性エッチングされ、半導体層１１２内の凹部領域２３０が形成される。凹部領域２３０は、その上に半導体層１１２が形成された基板１１４の表面にほぼ平行な床面２３０Ａを含む。凹部領域２３０は、半導体層１１２内のメサ２２０も定め、メサ２２０は、凹部領域の床面２３０Ａにほぼ平行なメサ表面２２０Ａを有する。
【００７８】
凹部領域の床面２３０Ａは、メサ表面２２０Ａから約０．２ミクロン又はそれよりも大きい距離だけ垂直方向にオフセットすることができる。一部の実施形態において、凹部領域の床面２３０Ａは、メサ表面２２０Ａから約０．５ミクロンの距離だけ垂直方向にオフセットすることができる。
【００７９】
同じマスク２０２又は異なるマスクを用いて、ドーパントイオン２１０を凹部領域の床面２３０Ａを通って半導体１１２内  に選択的に注入することができ、先に参照した米国特許第７，０２６，６５０号明細書に説明されているように低濃度ドープ表面電荷補償領域１３６が形成される。表面電荷補償領域１３６は、半導体層１１２の導電型と逆の導電型を有することができる。
【００８０】
次に、マスク２０２を除去することができ、１つ又はそれよりも多くの注入マスク（図示せず）をメサ表面２２０内の接合障壁領域１４２及び／又はガードリング１４４と、凹部領域２３０内のガードリング１３８とを形成するために使用することができる。接合障壁領域１４２及び／又はガードリング１４４、１３８は、表面電荷補償領域１３６と同じ導電型を有することができ、表面電荷補償領域１３６よりもドーピング濃度が高い。
【００８１】
ショットキー接点１３２（図５Ａ）のような金属接点をメサ表面上に形成することができ、金属接点１４６（図５Ａ）を基板１１４の反対側に形成することができる。
【００８２】
一部の実施形態によるショットキーデバイスは、７８０ｍＪ／ｃｍ2よりも大きいアバランシェ定格を有することができる。一部の実施形態において、一部の実施形態によるショットキーデバイスは、１０００ｍＪ／ｃｍ2よりも大きいアバランシェ定格を有することができる。一部の実施形態において、一部の実施形態によるショットキーデバイスは、１２００ｍＪ／ｃｍ2よりも大きいアバランシェ定格を有することができ、更に別の実施形態において、一部の実施形態によるショットキーデバイスは、１５００ｍＪ／ｃｍ2よりも大きいアバランシェ定格を有することができる。
【００８３】
アバランシェ定格は、以下のように定義される。
【００８４】
アバランシェ定格＝ＶBR×ＩR×ｔpulse／チップ面積
すなわち、アバランシェ定格は、デバイスの降伏電圧（ＶBR）掛けるデバイスの逆方向定格電流（ＩR）掛けるデバイス故障が生じる電流パルスの最低持続時間（ｔpulse）割るデバイスの活性領域の面積に等しい。
【００８５】
シリコンカーバイドショットキーダイオードに関連して主に説明したが、本明細書に説明した凹部ガードリング終端構造は、多くの様々な種類のデバイス及び多くの様々な種類の材料システムに併せて使用することができることが理解されるであろう。上述したように、本発明の実施形態は、ＭＯＳＦＥＴ及びＩＧＢＴのような半導体デバイスの改善した性能安定性を提供することができる。例えば、本発明の実施形態は、ＭＯＳＦＥＴの高電界でのセル端部保護として利用することができる。
【００８６】
特に、図１３は、一部の実施形態による凹部エッジ終端領域３３０を含む電力ＭＯＳＦＥＴ３００の平面図である。電力ＭＯＳＦＥＴ３００は、ゲート接点３０４と、デバイスの活性領域３１５内の複数の単位セル３１０に沿って延びる複数のゲートバス線３０６とを含む。凹部エッジ終端領域３３０は、活性領域３１５を取り囲む。エッジ終端領域３３０は、複数のガードリング３３８と表面電荷補償３３６とを含むことができる。一部の実施形態において、エッジ終端領域３３０は、接合終端拡張（ＪＴＥ）を含むことができる。
【００８７】
図１４Ａは、一部の実施形態による凹部エッジ終端領域３３０を含む電力ＭＯＳＦＥＴ３００の一部分３２０の詳細図であり、図１４Ｂは、図１４ＡのＡ−Ａ’線に沿って取った一部の実施形態による凹部エッジ終端領域３３０を含む電力ＭＯＳＦＥＴ３００の一部分の断面図である。
【００８８】
図１４Ａ及び図１４Ｂを参照すると、ＭＯＳＦＥＴ３００の単位セル３１０は、ｎ型ドリフト層３４０内に形成されたｐウェル３４２を含む。ｎ＋ソース接点３４８とｐ＋接点領域３５０は、ｐウェル３４２内に与えられる。（導電型は、一例として示され、一部の実施形態によるデバイスは、開示されたものと逆の導電型を有することができる。）図１４Ｂは、酸化物層３５６、ソース接点３５８、電界酸化物３５２、及び基板３６０を含む電力ＭＯＳＦＥＴの付加的な詳細を示している。
【００８９】
ガードリング３３８は、活性領域３１５に隣接する凹部エッジ終端領域３３０内に与えられる。
【００９０】
図１４Ａを参照すると、逆方向バイアスがデバイスに印加された時に、ｐウェル領域３４２の終点３５８の近くに高電界が存在する場合がある。特定の理論に束縛されることは望まないが、単位セル３１０の終点に隣接する凹部エッジ終端領域３３０の具備は、これらの終点での電界を低下させ、これらの終点の近くでデバイスが降伏する可能性を低減し、かつ活性領域３１５で降伏が開始する前にエッジ終端領域内でアバランシェ降伏が発生する可能性を増大させると現在考えられている。
【００９１】
図１５Ａは、更に別の実施形態による凹部エッジ終端領域を含む電力ＭＯＳＦＥＴの一部分の詳細図であり、図１５Ｂは、図１５ＡのＢ−Ｂ’線に沿って取った更に別の実施形態による凹部エッジ終端領域を含む電力ＭＯＳＦＥＴの一部分の断面図である。
【００９２】
図１５Ａ及び図１５Ｂを参照すると、ＭＯＳＦＥＴ３００の単位セル３１０は、ｎ型ドリフト層３４０内に形成されたｐウェル３４２を含む。ｎ＋ソース接点３４８とｐ＋接点領域３５０は、ｐウェル３２４内に与えられる。（導電型は、一例として示され、一部の実施形態によるデバイスは、開示されたものと逆の導電型を有することができる。）図１４Ｂは、酸化物層３５６、ソース接点３５８，電界酸化物３５２、及び基板３６０を含む電力ＭＯＳＦＥＴの付加的な詳細を示している。
【００９３】
ガードリング３３８は、活性領域３１５に隣接する凹部エッジ終端領域３３０内に与えられる。
【００９４】
用語第１及び第２は、本明細書において様々な要素を説明するために使用することができるが、これらの要素は、これらの用語によって制限すべきでないことは理解されるであろう。これらの用語は、１つの要素を別の要素と区別するためにのみ使用される。例えば、本発明の範囲から逸脱することなく、第１の要素を第２の要素と呼ぶことができ、同様に、第２の要素を第１の要素と呼ぶことができる。本明細書で使用する時の用語「及び／又は」は、関連した列挙項目の１つ又はそれよりも多くのいずれか又は全ての組合せを含む。
【００９５】
本明細書に使用される術語は、特定の実施形態を説明する目的のみであって、本発明を制限するように想定されているものではない。本明細書で使用する時の「ａ」、「ａｎ」、及び「ｔｈｅ」は、関連がそうでないと明確に示す場合を除き、複数形を依然として含むことを意図している。用語「ｃｏｍｐｒｉｓｓ」、「ｃｏｍｐｒｉｓｉｎｇ」、「ｉｎｃｌｕｄｅｓ」、及び／又は「ｉｎｃｌｕｄｉｎｇ」は、本明細書で使用する時に図示の特徴、整数、段階、作動、要素、及び／又は構成要素の存在を指定するが、１つ又はそれよりも多くの他の特徴、整数、段階、作動、要素、構成要素、及び／又はそれらの群の存在又は追加を除外しないことも更に理解されるであろう。
【００９６】
特に明記しない限り、本明細書で使用する全ての用語（技術用語及び科学用語を含む）は、本発明が属する分野の業者によって一般的に理解されるのと同じ意味を有する。本明細書で使用する用語は、本明細書及び当業技術の関連におけるそれらの意味と適合する意味を有すると解釈されなければならず、本明細書で特にそのように定義されない限り、理想化されるか又は過度に形式的な意味に解釈されないことになることは更に理解されるであろう。
【００９７】
層、領域、又は基板のような要素が別の要素「上」である又はその「上に」拡張すると言う時に、この要素は、直接にその他の要素上にある又は直接にその上に拡張することができ、又は介在要素も存在することができることは理解されるであろう。一方、要素が、別の要素「上に直接に」ある又はその「上に直接に」拡張すると言う時に、介在要素は存在しない。要素が別の要素に「接続される」又は「結合される」と言う時に、この要素は、直接にその他の要素に接続又は結合することができ、又は介在要素が存在することができることは理解されるであろう。一方、要素が別の要素に「直接に接続される」又は「直接に結合される」と言う時には介在要素は存在しない。
【００９８】
「下方」、「上方」、「上側」、「下側」、「水平」、「横」、「垂直」、「の下」、「の上」などのような相対語は、図示の１つの要素、層、又は領域の別の要素、層、又は領域に対する関係を説明するために本明細書で使用することができる。これらの用語は、図で表された方向に加えて、デバイスの様々な方向を包含することを意図することは理解されるであろう。
【００９９】
本発明の実施形態を本発明の理想的な実施形態（かつ中間構造）の模式図である断面図を参照して本明細書に説明した。図面における層及び領域の厚みは、明確にするために誇張されている場合がある。更に、例えば、製造の技術及び／又は許容範囲の結果としてこの図の形状からの変動が考えられる。従って、本発明の実施形態は、本明細書で示された領域の特定の形状に制限されると解釈すべきではなく、例えば、製造に起因する形状での偏差を含むことになる。例えば、矩形として示された注入領域は、丸い又は湾曲した特徴を典型的に有し、及び／又は注入領域から非注入領域への不連続な変化でなくてそのエッジでの注入濃度の勾配を典型的に有することになる。同様に、注入によって形成された埋め込み領域は、埋め込み領域とそれを通って注入が行われる表面との間の領域内に幾らかの注入を引き起こす場合がある。従って、図示の領域は、本質的に概略的であり、それらの形状は、デバイスの領域の実際の形状を示すことを意図せず、かつ本発明の範囲を制限することを意図しない。
【０１００】
本発明の一部の実施形態は、層及び／又は領域内の主なキャリア濃度によるｎ型又はｐ型のような導電型を有するとして特徴付けられた半導体層及び／又は領域に関連して説明した。従って、ｎ型材料は、負に帯電した電子の主な平衡濃度を有し、それに対してｐ型材料は、正に帯電した正孔の主な平衡濃度を有する。一部の材料は、「＋」又は「−」を付して示すことができ（ｎ＋、ｎ、ｐ＋、ｐ−、ｎ＋＋、ｎ−、ｐ＋＋、ｐ−−などにおけるように）、別の層又は領域と比べた主なキャリアの相対的により大きい（「＋」）、又はより小さい（「−」）濃度が示されている。しかし、こうした表示は、層又は領域内の主な又は少数キャリアの特定の濃度の存在を意味しない。
【０１０１】
多くの異なる実施形態を以上の説明及び添付図面に関連して本明細書に開示した。これらの実施形態のあらゆる結合及び小結合を逐語的に説明することは、過剰な繰返しで曖昧になることを理解しなければならない。従って、全ての実施形態は、あらゆる方法及び／又は組合せで結合することができ、添付図面を含む本明細書は、本明細書に説明した実施形態及びそれらを製造して使用する方法及び処理の全ての結合及び小結合の記述的仕様を構成すると解釈されなければならず、あらゆるこうした結合及び小結合に対する特許請求の範囲を支持することになる。
【０１０２】
図面及び明細書において、本発明の典型的な好ましい実施形態を開示しており、特定の用語を使用しているが、それらは、網羅的及び説明的な意味のみで使用され、制限の目的では用いられておらず、本発明の範囲は、以下の特許請求の範囲に列挙されている。
【符号の説明】
【０１０３】
１００  接合障壁ショットキーダイオード
１３８  ガードリング
１４８  凹部領域
１５０  エッジ終端構造
１５５  活性領域
【図１】
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【図２】
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【図３】
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【図４】
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【図５Ａ】
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【図５Ｂ】
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【図６】
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【図７】
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【図８】
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【図９】
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【図１０】
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【図１１】
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【図１２】
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【図１３】
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【図１４Ａ】
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【図１４Ｂ】
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【図１５Ａ】
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【図１５Ｂ】
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